JP2009071929A - 回路システムおよび半導体装置 - Google Patents
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Abstract
【解決手段】回路システムは、発振回路と、上記発振回路からの出力信号をカウントする多段数の計数カウンタとからなる。計数カウンタは、直列に接続される複数の部分的カウンタに分割される。さらに、2つの部分的カウンタの間に付加回路が設けられ、この付加回路は、テストモードと通常モードのいずれであるかを示すモード信号を入力し、通常モードでは、前段側の部分的カウンタの出力信号を後段側の部分的カウンタに入力し、テストモードでは、それぞれの部分的カウンタの1段目に発振回路からの出力信号を直接に入力する。
【選択図】図2
Description
いま、通常使用状態(通常モード)で複数の種類の遅延回路を、一つの基本発振回路と多段のカウンタ回路を共有して構成する回路システムを考える。図1は、そのような回路システムの1例であり、発振回路10と、発振された信号を計数するカウンタ回路12とからなる。カウンタ回路12は、直列に接続された多段のフリップフロップからなる。フリップフロップの段数は任意であるが、図では12段である。フリップフロップは、いずれもリセット信号によりリセットされる。この回路システムでは、たとえば4段目、8段目及び12段目のフリップフロップから出力が取り出せて、3種類の遅延時間を出力できる。
Claims (9)
- 発振回路と、上記発振回路からの出力信号をカウントする多段数の計数カウンタとからなり、
上記計数カウンタは、直列に接続される複数の部分的カウンタに分割され、
さらに、2つの上記部分的カウンタの間に付加回路が設けられ、
この付加回路は、テストモードと通常モードのいずれであるかを示すモード信号を入力し、通常モードでは、前段側の部分的カウンタの出力信号を後段側の部分的カウンタに入力し、テストモードでは、それぞれの上記部分的カウンタの1段目に上記発振回路からの出力信号を直接に入力する
回路システム。 - 請求項1に記載された回路システムにおいて、
上記付加回路は、さらに、すべての上記部分的カウンタの最終段からの信号のAND演算をするAND回路と、テストモードにおいて、上記AND回路から信号が出力されるときに、上記部分的カウンタの最終段の出力信号を出力する出力回路とを備える
回路システム。 - 請求項1または2に記載された回路システムにおいて、
さらに、上記モード信号を外部から入力するコントロール入力端子を有し、上記コントロール入力端子は上記付加回路に接続される
回路システム。 - 請求項1または2に記載された回路システムにおいて、
さらに、モード信号を上記付加回路に供給するトリミング回路を有し、トリミング回路に含まれるトリミングヒューズが破壊されない状態ではテストモードであることを示す信号を上記付加回路に供給し、トリミングヒューズが破壊された状態では通常モードであることを示す信号を上記付加回路に供給する、
回路システム。 - 請求項1または2に記載された回路システムにおいて、
さらに、上記モード信号を記憶する記憶回路を有し、上記記憶回路は上記モード信号を上記付加回路に出力する
回路システム。 - 上記発振回路は、テストモードと通常モードで発振周波数が切り替えられる、請求項1〜5のいずれかに記載された回路システム。
- 互いに異なる動作を行う複数の電子回路と、
前記複数の電子回路のいずれかに要求される遅延時間をカウントして、当該電子回路に信号を出力する、請求項1〜6のいずれかに記載された回路システムと
からなる半導体装置。 - 前記複数の電子回路は、それぞれ、異常電圧を検出する検出回路であることを特徴とする請求項7に記載された半導体装置。
- 2次電池の過充電、過放電、充電過電流および放電過電流の少なくとも1つを検出する検出回路と、
前記検出回路による過充電、過放電、充電過電流および放電過電流の上記少なくとも1つの検出時からの遅延時間をカウントする請求項1〜5のいずれかに記載された回路システムと、
からなる、前記2次電池を保護する半導体装置。
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2007
- 2007-09-11 JP JP2007235367A patent/JP2009071929A/ja active Pending
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