JP2008294159A - Manufacturing method of semiconductor device and semiconductor device - Google Patents

Manufacturing method of semiconductor device and semiconductor device Download PDF

Info

Publication number
JP2008294159A
JP2008294159A JP2007137131A JP2007137131A JP2008294159A JP 2008294159 A JP2008294159 A JP 2008294159A JP 2007137131 A JP2007137131 A JP 2007137131A JP 2007137131 A JP2007137131 A JP 2007137131A JP 2008294159 A JP2008294159 A JP 2008294159A
Authority
JP
Japan
Prior art keywords
metal pad
film
semiconductor device
semiconductor substrate
interlayer film
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2007137131A
Other languages
Japanese (ja)
Other versions
JP5272331B2 (en
Inventor
Shuji Asano
修治 淺野
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Denso Corp
Original Assignee
Denso Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Denso Corp filed Critical Denso Corp
Priority to JP2007137131A priority Critical patent/JP5272331B2/en
Publication of JP2008294159A publication Critical patent/JP2008294159A/en
Application granted granted Critical
Publication of JP5272331B2 publication Critical patent/JP5272331B2/en
Expired - Fee Related legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/11Manufacturing methods
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/14Structure, shape, material or disposition of the bump connectors prior to the connecting process of a plurality of bump connectors

Abstract

<P>PROBLEM TO BE SOLVED: To provide a manufacturing method of a semiconductor device with which the semiconductor device having suitable mechanical strength on a contact interface between a conductive bump and a metal pad can be manufactured through simpler processes, and the semiconductor device manufactured by the manufacturing method. <P>SOLUTION: When the semiconductor device is manufactured, a first inter-layer formation stage of forming a LOCOS oxide film 12 where the peripheral edge portion of the metal pad 30 is formed on the top surface RS of the semiconductor substrate 10, a metal film formation stage of forming a metal film to predetermined film thickness on the top surface RS of the semiconductor substrate 10 including the top surface of the LOCOS oxide film 12, and a shaping stage of shaping the plane-view shape of the metal film into a predetermined shape are carried out as a metal pad formation stage. Through the metal pad formation stage, a side sectional-view shape of the top surface of the LOCOS oxide film 12 and the top surface RS of the semiconductor substrate 10 is transferred to the side sectional view shape of the metal pad 30. <P>COPYRIGHT: (C)2009,JPO&INPIT

Description

本発明は、半導体装置の製造方法及びこの製法にて製造された半導体装置に関する。   The present invention relates to a manufacturing method of a semiconductor device and a semiconductor device manufactured by this manufacturing method.

従来、半導体装置の製造方法及びその製法にて製造された半導体装置として、例えば特許文献1及び2に記載の技術が知られている。以下、特許文献1及び2に記載の技術も含め、従来の技術について説明する。   Conventionally, as a semiconductor device manufacturing method and a semiconductor device manufactured by the manufacturing method, for example, techniques disclosed in Patent Documents 1 and 2 are known. Hereinafter, conventional techniques including those described in Patent Documents 1 and 2 will be described.

従来の半導体装置では、パッケージ基板あるいは半導体チップの金属パッド上に形成された導電性バンプを介して、半導体チップを配線基板と電気的に接続している。ここで、金属パッドは、円錐状あるいは半球状の窪みが該金属パッドの表面に形成されている。これにより、球状を有することが多い導電性バンプと金属パッドとの接触界面の面積が増大し、接触界面における機械強度の向上が図られている。
特開平9−162240号公報 特開平10−50768号公報
In the conventional semiconductor device, the semiconductor chip is electrically connected to the wiring substrate through conductive bumps formed on the package substrate or the metal pads of the semiconductor chip. Here, the metal pad has a conical or hemispherical depression formed on the surface of the metal pad. As a result, the area of the contact interface between the conductive bump, which often has a spherical shape, and the metal pad is increased, and the mechanical strength at the contact interface is improved.
JP-A-9-162240 Japanese Patent Laid-Open No. 10-50768

ところで、こうした円錐状あるいは半球状の窪みは、以下のようにして形成される。詳しくは、まず、パッケージ基板又は半導体チップの表面に対し、例えばCVD(化学気相成長)を通じて金属膜を一定膜厚にて堆積形成する。次に、一定膜厚にて形成された金属膜を例えば平面視矩形状に整形し、平板状の金属パッドを形成する。そして、金属パッドの表面を研削することにより、円錐状あるいは半球状の窪みを形成する。このように、円錐状あるいは半球状の窪みを金属パッドの表面に対して形成しようとすると、一般に、加工プロセスは複雑になってしまう。   By the way, such conical or hemispherical depressions are formed as follows. Specifically, first, a metal film is deposited and formed on the surface of the package substrate or semiconductor chip with a constant film thickness, for example, through CVD (chemical vapor deposition). Next, the metal film formed with a constant film thickness is shaped into, for example, a rectangular shape in plan view, and a flat metal pad is formed. Then, a conical or hemispherical depression is formed by grinding the surface of the metal pad. As described above, when a conical or hemispherical depression is formed on the surface of the metal pad, the processing process is generally complicated.

また、パッケージ基板又は半導体チップの表面に形成された金属パッドの数が多くなるほど、さらには、半導体装置の体格が小型化するほど(金属パッドの微細化が進展するほど)、こうした従来の構造を有する半導体装置を製造することは難しくなる。   Further, as the number of metal pads formed on the surface of the package substrate or the semiconductor chip increases, and as the size of the semiconductor device becomes smaller (the metal pads become finer), such a conventional structure is improved. It becomes difficult to manufacture a semiconductor device having the same.

本発明は、こうした実情に鑑みてなされたものであって、その目的は、導電性バンプと金属パッドとの接触界面における好適な機械強度を有する半導体装置を、より簡素なプロセスにて製造することのできる半導体装置の製造方法及びその製法にて製造された半導体装置を提供することにある。   The present invention has been made in view of such circumstances, and its object is to manufacture a semiconductor device having suitable mechanical strength at a contact interface between a conductive bump and a metal pad by a simpler process. An object of the present invention is to provide a method for manufacturing a semiconductor device and a semiconductor device manufactured by the method.

こうした目的を達成するため、請求項1に記載の発明では、半導体素子を半導体基板に作製する素子作製工程と、前記半導体基板の表面に金属パッドを形成する金属パッド形成工程と、前記金属パッド形成工程にて形成された金属パッドと導電性バンプとを接合する接合工程とを備え、他の半導体装置あるいは回路基板と当該半導体装置とをこれら導電性バンプ及び金属パッドを介して電気的に接続する、半導体装置の製造方法として、前記金属パッド形成工程は、前記半導体基板の表面のうちの前記金属パッドの周縁部が形成される部分に第1層間膜を形成する第1層間膜形成工程と、前記第1層間膜形成工程にて形成された第1層間膜の表面を含む前記半導体基板の表面に所定の膜厚にて金属膜を形成する金属膜形成工程と、前記金属膜形成工程にて形成された金属膜の平面視形状を所定の形状に整形する整形工程とを有しており、前記金属パッド形成工程を通じて、前記第1層間膜及び前記半導体基板の各表面の側面断面視形状を、前記金属パッドの表面の側面断面視形状に転写することとした。   In order to achieve such an object, according to the first aspect of the present invention, an element manufacturing process for manufacturing a semiconductor element on a semiconductor substrate, a metal pad forming process for forming a metal pad on the surface of the semiconductor substrate, and the metal pad formation A bonding step of bonding the metal pad formed in the step and the conductive bump, and electrically connecting another semiconductor device or a circuit board to the semiconductor device via the conductive bump and the metal pad. As a method for manufacturing a semiconductor device, the metal pad forming step includes a first interlayer film forming step of forming a first interlayer film on a portion of the surface of the semiconductor substrate where a peripheral portion of the metal pad is formed; A metal film forming step of forming a metal film with a predetermined thickness on a surface of the semiconductor substrate including a surface of the first interlayer film formed in the first interlayer film forming step; and the metal film A shaping step of shaping the metal film formed in the forming step into a predetermined shape, and through the metal pad forming step, side surfaces of the first interlayer film and each surface of the semiconductor substrate The sectional view shape was transferred to the side sectional view shape of the surface of the metal pad.

半導体装置の製造方法としてのこのような方法では、第1層間膜形成工程を通じて、半導体基板の表面のうちの金属パッドの周縁部を形成する部分に第1層間膜を形成し、金属膜形成工程を通じて、第1層間膜の表面を含む半導体基板の表面に所定の膜厚にて金属膜を形成し、整形工程を通じて、金属膜の平面視形状を所定の形状に整形することで、金属パッドを完成する。これにより、金属パッドの側面断面視形状は、第1層間膜及び半導体基板の各表面の側面断面視形状が転写されることになる。ここで、平坦面を有することの多い半導体基板の表面に第1層間膜が形成されるため、第1層間膜及び半導体基板の各表面の側面断面視形状は凹凸を有する形状となる。そうした凹凸が金属パッドの側面断面視形状に転写されるため、背景技術の欄に記載した従来技術と同様に、金属パッドと導電性バンプとの接触界面の面積が増大し、接触界面における機械強度は向上している。ただし、上記製法は、従来技術とは異なり、金属パッドの表面を研削することで該金属パッドの表面に凹凸を形成するわけではないため、加工プロセスが煩雑にならない。すなわち、上記製法では、より簡素なプロセスにて、金属パッドを形成し、ひいては半導体装置を製造することができるようになる。   In such a method as a method for manufacturing a semiconductor device, a first interlayer film is formed on a portion of the surface of the semiconductor substrate where the peripheral portion of the metal pad is formed through the first interlayer film forming process, and the metal film forming process is performed. Forming a metal film with a predetermined film thickness on the surface of the semiconductor substrate including the surface of the first interlayer film, and shaping the metal pad into a predetermined shape through a shaping process, thereby forming the metal pad Complete. Thereby, the side cross-sectional view shape of the metal pad is transferred from the side cross-sectional view shape of each surface of the first interlayer film and the semiconductor substrate. Here, since the first interlayer film is formed on the surface of the semiconductor substrate, which often has a flat surface, the side cross-sectional shape of each surface of the first interlayer film and the semiconductor substrate is uneven. Since such irregularities are transferred to the side cross-sectional shape of the metal pad, the area of the contact interface between the metal pad and the conductive bump increases as in the prior art described in the background section, and the mechanical strength at the contact interface is increased. Is improving. However, unlike the prior art, the above manufacturing method does not form irregularities on the surface of the metal pad by grinding the surface of the metal pad, so that the processing process is not complicated. That is, in the above manufacturing method, the metal pad can be formed by a simpler process, and as a result, the semiconductor device can be manufactured.

上記請求項1に記載の発明において、例えば請求項2に記載の発明では、前記金属パッド形成工程を通じて、前記半導体基板の表面に平行な第1平坦面と該第1平坦面に対して傾斜する傾斜面とが組み合わされた側面断面視メサ状の窪みを、前記金属パッドの表面に形成することとした。   In the first aspect of the present invention, for example, in the second aspect of the present invention, the first flat surface parallel to the surface of the semiconductor substrate and the first flat surface are inclined through the metal pad forming step. A mesa-shaped depression in side sectional view combined with an inclined surface is formed on the surface of the metal pad.

上記製法にて製造される半導体装置では、金属パッドは、半導体基板の表面に平行な第1平坦面と該第1平坦面に対して傾斜する傾斜面とが組み合わされた側面断面視メサ状の窪みを有し、導電性バンプはそうした窪みに収められることになる。そのため、導電性バンプは、金属パッドと接合する際、金属パッドの第1平坦面だけでなく、金属パッドの傾斜面にも接触するようになり、導電性バンプと金属パッドとの接触面積が大きくなる。したがって、導電性バンプと金属パッドとの接触界面における機械強度が向上する。接触界面における機械強度がこのように向上すると、当該製法にて製造された半導体装置が例えば自動車等に搭載され、自動車の運転中に生じる振動が加えられたとしても、導電性バンプと金属パッドとが振動に耐え切れず互いに乖離するようなことは抑制されるようになる。   In the semiconductor device manufactured by the above manufacturing method, the metal pad has a mesa shape in a side sectional view in which a first flat surface parallel to the surface of the semiconductor substrate and an inclined surface inclined with respect to the first flat surface are combined. There are depressions, and the conductive bumps will be housed in such depressions. Therefore, when the conductive bump is bonded to the metal pad, the conductive bump comes into contact with not only the first flat surface of the metal pad but also the inclined surface of the metal pad, and the contact area between the conductive bump and the metal pad is large. Become. Therefore, the mechanical strength at the contact interface between the conductive bump and the metal pad is improved. When the mechanical strength at the contact interface is improved in this way, even if the semiconductor device manufactured by the manufacturing method is mounted on, for example, an automobile and vibrations generated during the operation of the automobile are applied, the conductive bump and the metal pad Are not able to withstand vibrations and deviate from each other.

また、導電性バンプと金属パッドとの接触界面に例えば水分が浸入するようなことがあると、接触界面の腐食を招き、ひいては、接触界面の機械強度を低下させてしまうことにもなりかねない。その点、上記製法にて製造される半導体装置では、導電性バンプは、金属パッドの第1平坦面だけでなく、金属パッドの傾斜面とも接触しているため、導電性バンプと金属パッドの第1平坦面との接触界面に水分が浸入することがそもそも抑制されている。したがって、導電性バンプと金属パッドの第1平坦面との接触界面の腐食を防止することができるようになり、導電性バンプと金属パッドとの接触界面に水分が浸入するようなことがあっても、導電性バンプと金属パッドの第1平坦面との接触界面の機械強度を維持することができるようになる。   In addition, if moisture enters the contact interface between the conductive bump and the metal pad, for example, corrosion of the contact interface may be caused, which in turn may reduce the mechanical strength of the contact interface. . In that respect, in the semiconductor device manufactured by the above manufacturing method, the conductive bump is in contact with not only the first flat surface of the metal pad but also the inclined surface of the metal pad. In the first place, the entry of moisture into the contact interface with the flat surface is suppressed. Accordingly, corrosion of the contact interface between the conductive bump and the first flat surface of the metal pad can be prevented, and moisture may enter the contact interface between the conductive bump and the metal pad. However, the mechanical strength of the contact interface between the conductive bump and the first flat surface of the metal pad can be maintained.

さらに、上記製法にて製造された半導体装置では、接合工程を通じて金属パッドと導電性バンプとを接合するにあたり、金属パッドの所望とする位置に導電性バンプが正確に載置されないようなことがあったとしても、導電性バンプは、傾斜面に誘導されて、金属パッド中央部(所望位置)に形成された側面断面視メサ状の窪みに自ら収まるようになる。すなわち、自己アライメント補正効果を得ることができるようになる。なお、半導体装置の体格が小さくになるにつれて導電性バンプを所望位置に載置することが難しくなるため、こうした自己アライメント補正効果は、半導体装置の体格の小型化を図る際により有用となる。   Further, in the semiconductor device manufactured by the above manufacturing method, when the metal pad and the conductive bump are bonded through the bonding process, the conductive bump may not be accurately placed at a desired position of the metal pad. Even so, the conductive bumps are guided to the inclined surface and fit themselves in a mesa-shaped depression formed in the center part (desired position) of the metal pad. That is, a self-alignment correction effect can be obtained. Since it becomes difficult to place the conductive bumps at a desired position as the size of the semiconductor device becomes smaller, such a self-alignment correction effect becomes more useful when the size of the semiconductor device is reduced.

上記請求項2に記載の方法において、例えば請求項3に記載の発明のように、前記第1層間膜形成工程では、前記第1層間膜として、前記半導体基板の表面の熱酸化を通じてLOCOS酸化膜を形成しており、前記金属パッド形成工程を通じて、前記LOCOS酸化膜及び前記半導体基板の各表面の側面断面視形状を前記金属パッド表面の側面断面視形状に転写することで、前記窪みを有する金属パッドを形成することが望ましい。   In the method according to claim 2, for example, as in the invention according to claim 3, in the first interlayer film forming step, a LOCOS oxide film is formed as the first interlayer film through thermal oxidation of the surface of the semiconductor substrate. And transferring the LOCOS oxide film and the side cross-sectional view shape of each surface of the semiconductor substrate to the side cross-sectional view shape of the metal pad surface through the metal pad forming step. It is desirable to form a pad.

LOCOS酸化膜は一般に知られた技術であり、一般的な半導体プロセスを通じて形成することができるため、上記製法によれば、第1層間膜を形成するための特別な半導体プロセスを新たに追加することなく、一般的な半導体プロセスを通じて第1層間膜を容易に形成することができるようになる。また、そうしたLOCOS酸化膜は半導体基板の構成材料よりも硬度が大きいため、上記製法にて製造された半導体装置は、当該装置全体としての硬度が向上するようになる。そのため、例えば半導体装置に外力が加わったとしても、半導体基板に作製された半導体素子が所定の機能を維持することができるようになる。   Since the LOCOS oxide film is a generally known technique and can be formed through a general semiconductor process, a special semiconductor process for forming the first interlayer film is newly added according to the above manufacturing method. The first interlayer film can be easily formed through a general semiconductor process. In addition, since the LOCOS oxide film has a hardness higher than that of the constituent material of the semiconductor substrate, the hardness of the semiconductor device manufactured by the above-described manufacturing method is improved as a whole. Therefore, for example, even if an external force is applied to the semiconductor device, the semiconductor element manufactured on the semiconductor substrate can maintain a predetermined function.

また、例えば請求項4に記載の発明のように、前記第1層間膜形成工程では、前記第1層間膜として、前記LOCOS酸化膜の上表面に多結晶シリコン膜を形成しており、前記金属パッド形成工程を通じて、前記多結晶シリコン膜の膜厚を調整することで、前記傾斜面の傾斜角度を調整することが望ましい。上記LOCOS酸化膜と同様に、多結晶シリコン膜も一般に知られた技術であるため、一般的な半導体プロセスを通じて傾斜面の傾斜角度を調整することができるようになる。   For example, as in the invention described in claim 4, in the first interlayer film forming step, a polycrystalline silicon film is formed on the upper surface of the LOCOS oxide film as the first interlayer film, and the metal It is desirable to adjust the inclination angle of the inclined surface by adjusting the thickness of the polycrystalline silicon film through the pad forming process. Similar to the LOCOS oxide film, since the polycrystalline silicon film is a generally known technique, the inclination angle of the inclined surface can be adjusted through a general semiconductor process.

上記請求項1に記載の方法において、例えば請求項5に記載の発明では、前記金属パッド形成工程を通じて、前記金属パッドの表面の周縁部が前記導電性バンプを包み込むように該導電性バンプの表面に沿って傾斜し、且つ、前記金属パッドの表面の中央部が前記導電性バンプに向かって凸となる側面断面視形状の窪みを、前記金属パッドの表面に形成することが望ましい。こうした製法にて製造される半導体装置では、上記請求項2に記載の製法にて製造される半導体装置に準じた効果が得られるようになる。ただし、導電性バンプは、金属パッドと接続される際、金属パッドの表面に沿って変形する。そのため、金属パッドの表面の中央部が導電性バンプに向けて凸となっているため、導電性バンプと金属パッドとの接触界面の面積はより大きくなる。   In the method according to claim 1, for example, in the invention according to claim 5, the surface of the conductive bump is formed so that a peripheral portion of the surface of the metal pad wraps the conductive bump through the metal pad forming step. It is desirable to form a depression on the surface of the metal pad in a side sectional view shape that is inclined along the surface of the metal pad and the central portion of the surface of the metal pad is convex toward the conductive bump. In the semiconductor device manufactured by such a manufacturing method, an effect equivalent to that of the semiconductor device manufactured by the manufacturing method according to claim 2 can be obtained. However, the conductive bump is deformed along the surface of the metal pad when connected to the metal pad. Therefore, since the center part of the surface of the metal pad is convex toward the conductive bump, the area of the contact interface between the conductive bump and the metal pad becomes larger.

上記請求項5に記載の方法において、例えば請求項6に記載の発明のように、前記金属パッド形成工程は、前記半導体基板の表面のうちの、前記凸となる部分に対応する部分に、第2層間膜を形成する第2層間膜形成工程をさらに備えており、前記金属パッド形成工程を通じて、前記第1層間膜及び前記第2層間膜並びに前記半導体基板の各表面の側面断面視形状を、前記金属パッドの表面の側面断面視形状に転写することとした。   In the method according to claim 5, as in the invention according to claim 6, for example, the metal pad forming step is performed on a portion of the surface of the semiconductor substrate corresponding to the convex portion. A second interlayer film forming step of forming two interlayer films, and through the metal pad forming step, the side sectional view shape of each surface of the first interlayer film, the second interlayer film, and the semiconductor substrate, The surface of the metal pad was transferred to a side sectional view shape.

半導体装置の製造方法としてのこのような方法では、第2層間膜形成工程を通じて、半導体基板の表面のうちの、盛り上げられた部分に対応する部分に第2層間膜を形成し、金属膜形成工程を通じて、第1層間膜及び第2層間膜の表面を含む半導体基板の表面に所定の膜厚にて金属膜を形成し、整形工程を通じて、金属膜の平面視形状を所定の形状に整形することで、金属パッドを完成する。これにより、金属パッドの表面の側面断面視形状は、第1層間膜及び第2層間膜並びに半導体基板の各表面の側面断面視形状が転写されることになる。ここで、平坦面を有することの多い半導体基板の表面に、第1層間膜及び第2層間膜が形成されるため、第1層間膜及び第2層間膜並びに半導体基板の各表面の側面断面視形状はより多くの凹凸を有する形状となる。したがって、金属パッドと導電性バンプとの接触界面の面積がさらに増大し、接触界面における機械強度はさらに向上するようになる。   In such a method as a method of manufacturing a semiconductor device, a second interlayer film is formed in a portion corresponding to the raised portion of the surface of the semiconductor substrate through a second interlayer film forming step, and a metal film forming step Forming a metal film with a predetermined film thickness on the surface of the semiconductor substrate including the surfaces of the first interlayer film and the second interlayer film, and shaping the shape of the metal film in plan view into a predetermined shape through a shaping step. The metal pad is completed. As a result, the side sectional view shape of the surface of the metal pad is transferred from the first interlayer film, the second interlayer film, and the side sectional view shape of each surface of the semiconductor substrate. Here, since the first interlayer film and the second interlayer film are formed on the surface of the semiconductor substrate that often has a flat surface, the first interlayer film, the second interlayer film, and each surface of the surface of the semiconductor substrate are viewed in a side sectional view. The shape is a shape having more unevenness. Therefore, the area of the contact interface between the metal pad and the conductive bump is further increased, and the mechanical strength at the contact interface is further improved.

上記請求項6に記載の方法において、例えば請求項7に記載の発明のように、前記第2層間膜形成工程では、前記第2層間膜として、前記半導体基板の表面の熱酸化を通じてLOCOS酸化膜を形成しており、前記金属パッド形成工程を通じて、前記LOCOS酸化膜及び前記半導体基板の各表面の側面断面視形状を前記金属パッド表面の側面断面視形状に転写することで、前記窪みを有する金属パッドを形成することとしてもよい。LOCOS酸化膜は一般に知られた技術であり、一般的な半導体プロセスを通じて形成することができることは既述した通りである。そのため、上記製法によれば、第2層間膜を形成するための特別な半導体プロセスを新たに追加することなく、一般的な半導体プロセスを通じて第2層間膜を容易に形成することができるようになる。また、第2層間膜は半導体基板の構成材料よりも硬度が大きいため、上記製法にて製造された半導体装置も、当該装置全体としての硬度が向上するようになる。そのため、例えば半導体装置に外力が加わったとしても、半導体基板に作製された半導体素子が所定の機能を維持することができるようになる。   In the method according to claim 6, as in the invention according to claim 7, for example, in the second interlayer film forming step, a LOCOS oxide film is formed as the second interlayer film through thermal oxidation of the surface of the semiconductor substrate. And transferring the LOCOS oxide film and the side cross-sectional view shape of each surface of the semiconductor substrate to the side cross-sectional view shape of the metal pad surface through the metal pad forming step. A pad may be formed. As described above, the LOCOS oxide film is a generally known technique and can be formed through a general semiconductor process. Therefore, according to the above manufacturing method, the second interlayer film can be easily formed through a general semiconductor process without newly adding a special semiconductor process for forming the second interlayer film. . Further, since the second interlayer film has a hardness higher than that of the constituent material of the semiconductor substrate, the hardness of the semiconductor device manufactured by the above manufacturing method is improved as a whole. Therefore, for example, even if an external force is applied to the semiconductor device, the semiconductor element manufactured on the semiconductor substrate can maintain a predetermined function.

上記請求項7に記載の方法において、例えば請求項8に記載の発明のように、前記第2層間膜形成工程では、前記第2層間膜として、前記LOCOS酸化膜の上表面に多結晶シリコン膜を形成しており、前記金属パッド形成工程を通じて、前記多結晶シリコン膜の膜厚を調整することで、前記第1平坦面の一部の盛り上げられる高さを調整することが望ましい。上記LOCOS酸化膜と同様に、多結晶シリコン膜も一般に知られた技術であるため、一般的な半導体プロセスを通じて第1平坦面の一部の盛り上げ高さを調節することができるようになる。   In the method according to claim 7, as in the invention according to claim 8, for example, in the second interlayer film forming step, a polycrystalline silicon film is formed on the upper surface of the LOCOS oxide film as the second interlayer film. It is desirable to adjust the height of the raised portion of the first flat surface by adjusting the thickness of the polycrystalline silicon film through the metal pad forming step. Similar to the LOCOS oxide film, since the polycrystalline silicon film is a generally known technique, the raised height of a part of the first flat surface can be adjusted through a general semiconductor process.

一方、上記目的を達成するため、請求項9に記載の発明では、半導体素子が作製された半導体基板の表面に所定の厚みにて形成される金属パッドと、前記半導体基板と前記金属パッドの周縁部との間に形成される第1層間膜とを備え、前記金属パッドと導電性バンプとが接合されることで、これら金属パッド及び導電性バンプを介して他の半導体装置あるいは回路基板と電気的に接続される半導体装置として、前記第1層間膜及び前記半導体基板の各表面の側面断面視形状が、前記金属パッドの表面の側面断面視形状に転写されていることとした。こうした構成の半導体装置は、上記請求項1に記載の製法を通じて製造される。そのため、上記構成によれば、上記請求項1に記載の効果に準じた効果を得ることができるようになる。   On the other hand, in order to achieve the above object, in the invention according to claim 9, a metal pad formed with a predetermined thickness on a surface of a semiconductor substrate on which a semiconductor element is manufactured, and a periphery of the semiconductor substrate and the metal pad A first interlayer film formed between the metal pads and the conductive bumps, and the metal pads and the conductive bumps are bonded to each other to electrically connect with other semiconductor devices or circuit boards via the metal pads and the conductive bumps. As a semiconductor device to be connected, the side sectional view shape of each surface of the first interlayer film and the semiconductor substrate is transferred to the side sectional view shape of the surface of the metal pad. The semiconductor device having such a configuration is manufactured through the manufacturing method according to the first aspect. Therefore, according to the above configuration, it is possible to obtain an effect according to the effect described in claim 1.

上記請求項9に記載の構成において、例えば請求項10に記載の発明では、前記金属パッドには、前記半導体基板の表面に平行な第1平坦面と該第1平坦面に対して傾斜する傾斜面とが組み合わされた側面断面視メサ状の窪みが形成されていることとした。こうした構成の半導体装置は、上記請求項2に記載の製法を通じて製造される。そのため、上記構成によれば、上記請求項2に記載の効果に準じた効果を得ることができるようになる。   In the configuration according to claim 9, for example, in the invention according to claim 10, the metal pad includes a first flat surface parallel to a surface of the semiconductor substrate and an inclination inclined with respect to the first flat surface. It was assumed that a mesa-shaped depression in a side sectional view combined with a surface was formed. The semiconductor device having such a configuration is manufactured through the manufacturing method according to the second aspect. Therefore, according to the above configuration, it is possible to obtain an effect according to the effect described in claim 2.

上記請求項10に記載の構成において、例えば請求項11に記載の発明では、前記第1層間膜は、前記半導体基板の表面を熱酸化することで形成されるLOCOS酸化膜を含んでおり、前記傾斜面の傾斜角度は、前記LOCOS酸化膜のバーズビーク部によって所定角度に形成されていることとした。こうした構成を有する半導体装置は、上記請求項3に記載の製法を通じて製造される。そのため、上記構成によれば、上記請求項3に記載の効果に準じた効果を得ることができるようになる。   In the configuration described in claim 10, for example, in the invention described in claim 11, the first interlayer film includes a LOCOS oxide film formed by thermally oxidizing the surface of the semiconductor substrate. The inclination angle of the inclined surface is formed at a predetermined angle by the bird's beak portion of the LOCOS oxide film. A semiconductor device having such a configuration is manufactured through the manufacturing method according to claim 3. Therefore, according to the above configuration, an effect according to the effect described in claim 3 can be obtained.

上記請求項11に記載の構成において、例えば請求項12に記載の発明では、前記第1層間膜は、前記LOCOS酸化膜の上表面に形成された多結晶シリコン膜を含んでおり、前記傾斜面の傾斜角度は、前記多結晶シリコン膜の膜厚によって所定角度に形成されていることとした。こうした構成を有する半導体装置は、上記請求項4に記載の製法を通じて製造される。そのため、上記構成によれば、上記請求項4に記載の効果に準じた効果を得ることができるようになる。   In the configuration described in claim 11, for example, in the invention described in claim 12, the first interlayer film includes a polycrystalline silicon film formed on an upper surface of the LOCOS oxide film, and the inclined surface is formed. The inclination angle is formed at a predetermined angle depending on the thickness of the polycrystalline silicon film. The semiconductor device having such a configuration is manufactured through the manufacturing method according to the above-described fourth aspect. Therefore, according to the above configuration, it is possible to obtain an effect according to the effect described in claim 4.

また、上記請求項9〜12のいずれかに記載の構成において、例えば請求項13に記載の発明のように、前記金属パッドと前記第1層間膜との間に絶縁膜が形成されていることとすれば、導電性を有することの多い半導体基板を、電極パッド(ひいては導電性バンプ)と電気的に絶縁することができるようになる。なお、上記請求項9〜13のいずれかに記載の構成において、例えば請求項14に記載のように、前記金属パッドは、前記半導体基板を貫通する貫通電極と一体に形成されていることとしてもよい。   In the structure according to any one of claims 9 to 12, an insulating film is formed between the metal pad and the first interlayer film as in the invention according to claim 13, for example. Then, a semiconductor substrate that often has conductivity can be electrically insulated from the electrode pads (and thus conductive bumps). In the structure according to any one of the ninth to thirteenth aspects, the metal pad may be formed integrally with a through electrode penetrating the semiconductor substrate, for example, according to the fourteenth aspect. Good.

また、上記請求項9に記載の構成において、例えば請求項15に記載の発明では、前記金属パッドには、該金属パッドの表面の周縁部が前記導電性バンプを包み込むように該導電性バンプの表面に沿って傾斜し、且つ、前記金属パッドの表面の中央部が前記導電性バンプに向かって凸となる側面断面視形状の窪みが形成されていることとした。こうした構成を有する半導体装置は、上記請求項5に記載の製法を通じて製造される。そのため、上記構成によれば、上記請求項5に記載の効果に準じた効果を得ることができるようになる。   Further, in the configuration according to the ninth aspect, in the invention according to the fifteenth aspect, for example, the conductive bump of the metal pad is encased in a peripheral portion of a surface of the metal pad. A depression having a shape in a side cross-sectional view that is inclined along the surface and is convex toward the conductive bump at the center of the surface of the metal pad is formed. A semiconductor device having such a configuration is manufactured through the manufacturing method according to claim 5. Therefore, according to the above configuration, it is possible to obtain an effect according to the effect described in claim 5.

上記請求項15に記載の構成において、例えば請求項16に記載の発明のように、前記半導体基板と前記金属パッドの中央部との間に形成される第2層間膜をさらに備え、前記第1層間膜及び前記第2層間膜並びに前記半導体基板の各表面の側面断面視形状が、前記金属パッドの表面の側面断面視形状に転写されていることとしてもよい。こうした構成を有する半導体装置は、上記請求項6に記載の製法を通じて製造される。そのため、上記構成によれば、上記請求項6に記載の効果に準じた効果を得ることができるようになる。   The structure according to claim 15, further comprising a second interlayer film formed between the semiconductor substrate and a central portion of the metal pad, as in the invention according to claim 16, for example. The side sectional view shape of each surface of the interlayer film, the second interlayer film, and the semiconductor substrate may be transferred to the side sectional view shape of the surface of the metal pad. A semiconductor device having such a configuration is manufactured through the manufacturing method according to the sixth aspect. Therefore, according to the above configuration, it is possible to obtain an effect according to the effect described in the sixth aspect.

上記請求項16に記載の構成において、例えば請求項17に記載の発明では、前記第2層間膜は、前記半導体基板の表面を熱酸化することで形成されるLOCOS酸化膜を含んでおり、前記第1平坦面の一部は、前記LOCOS酸化膜によって所定の高さに盛り上げられていることとした。こうした構成を有する半導体装置は、上記請求項7に記載の製法を通じて製造される。そのため、上記構成によれば、上記請求項7に記載の効果に準じた効果を得ることができるようになる。   In the structure described in claim 16, for example, in the invention described in claim 17, the second interlayer film includes a LOCOS oxide film formed by thermally oxidizing the surface of the semiconductor substrate, A part of the first flat surface is raised to a predetermined height by the LOCOS oxide film. The semiconductor device having such a configuration is manufactured through the manufacturing method according to claim 7. Therefore, according to the above configuration, it is possible to obtain an effect according to the effect described in claim 7.

上記請求項16または17に記載の構成において、例えば請求項18に記載の発明では、前記第2層間膜は、多結晶シリコン膜を含んでおり、前記第1平坦面の一部は、前記多結晶シリコン膜の膜厚によって所定の高さに盛り上げられていることとした。こうした構成を有する半導体装置は、上記請求項8に記載の製法を通じて製造される。そのため、上記構成によれば、上記請求項8に記載の効果に準じた効果を得ることができるようになる。   In the configuration according to the sixteenth or seventeenth aspect, for example, in the invention according to the eighteenth aspect, the second interlayer film includes a polycrystalline silicon film, and a part of the first flat surface is the polycrystal silicon film. The film is raised to a predetermined height depending on the thickness of the crystalline silicon film. A semiconductor device having such a configuration is manufactured through the manufacturing method according to claim 8. Therefore, according to the above configuration, it is possible to obtain an effect according to the effect described in claim 8.

上記請求項15〜18のいずれかに記載の構成において、例えば請求項19に記載の発明のように、前記金属パッドと前記第2層間膜との間に絶縁膜が形成されていることとすれば、導電性を有することの多い半導体基板を、電極パッド(ひいては導電性バンプ)と電気的に絶縁することができるようになる。   In the structure according to any one of claims 15 to 18, an insulating film is formed between the metal pad and the second interlayer film, for example, as in the invention according to claim 19. For example, a semiconductor substrate that is often conductive can be electrically insulated from the electrode pads (and thus conductive bumps).

上記請求項9〜19のいずれかに記載の構成において、例えば請求項20に記載の発明では、前記第1層間膜は、前記半導体基板の周縁部に形成されていることとした。半導体装置としてのこのような構成によれば、半導体基板の周縁部に形成された硬度の大きな第1層間膜がフレームとして機能するため、例えば当該半導体装置に外力が加わったとしても、半導体基板に作製された半導体素子を好適に保護することができるようになる。   In the structure according to any one of claims 9 to 19, for example, in the invention according to claim 20, the first interlayer film is formed at a peripheral portion of the semiconductor substrate. According to such a configuration as the semiconductor device, the first interlayer film having a large hardness formed on the peripheral portion of the semiconductor substrate functions as a frame. For example, even if an external force is applied to the semiconductor device, the semiconductor substrate The manufactured semiconductor element can be suitably protected.

なお、例えば請求項21に記載の発明のように、当該半導体装置は、前記請求項9〜20のいずれか一項に記載の半導体装置を2つ有するものであり、これら2つの半導体装置は、各半導体装置が有する電極パッドと前記導電性バンプとが接合されることにより、互いに電気的に接続されていることとしてもよい。   For example, as in the invention described in claim 21, the semiconductor device includes two semiconductor devices described in any one of claims 9 to 20, and these two semiconductor devices include: The electrode pads included in each semiconductor device and the conductive bumps may be joined to be electrically connected to each other.

以下、本発明に係る半導体装置の製造方法及び半導体装置の一実施の形態について、図1〜図3を参照して説明する。なお、図1(a)〜(d)は、本発明に係る半導体装置の製造方法の一実施の形態について、その製造プロセスを示す側面断面図であり、図2(a)及び(b)は、図1(a)〜(d)に示す製造プロセスに続く製造プロセスを示す側面断面図である。また、図3は、本発明に係る半導体装置の一実施の形態について、その断面構造を側面から示す側面断面図である。   Hereinafter, a semiconductor device manufacturing method and a semiconductor device according to an embodiment of the present invention will be described with reference to FIGS. 1A to 1D are side cross-sectional views showing a manufacturing process of an embodiment of a method for manufacturing a semiconductor device according to the present invention. FIGS. 2A and 2B are FIGS. FIG. 2 is a side sectional view showing a manufacturing process subsequent to the manufacturing process shown in FIGS. FIG. 3 is a side sectional view showing a sectional structure of an embodiment of the semiconductor device according to the present invention from the side.

はじめに、図1及び図2を併せ参照しつつ、本発明に係る半導体装置の製造方法の一実施の形態について説明する。なお、この製法を用いることで、図3にその側面断面構造を示す後述の半導体装置が製造されることになる。   First, an embodiment of a method of manufacturing a semiconductor device according to the present invention will be described with reference to FIGS. By using this manufacturing method, a semiconductor device described later whose side cross-sectional structure is shown in FIG. 3 is manufactured.

まず、半導体装置を製造するにあたり、準備工程として、例えば単結晶シリコン(Si)から構成された所定の厚さの半導体基板10を準備する。   First, in manufacturing a semiconductor device, a semiconductor substrate 10 having a predetermined thickness made of, for example, single crystal silicon (Si) is prepared as a preparation process.

半導体基板10を準備すると、熱酸化マスク形成工程として、半導体基板10の表面RSの全面に対し、例えばCVD(化学気相成長)等を通じて、耐酸化性を有する例えばシリコン窒化膜(SiN)40を所定の膜厚にて形成する。そして、半導体基板10の表面RS全面に形成されたシリコン窒化膜40を、図1(a)に示すように、所望の位置(本実施の形態では略中央)を残してエッチング除去する。こうして形成されたシリコン窒化膜40は、続く熱酸化工程において、熱酸化マスクとして機能する。   When the semiconductor substrate 10 is prepared, as a thermal oxidation mask formation step, for example, a silicon nitride film (SiN) 40 having oxidation resistance is formed on the entire surface RS of the semiconductor substrate 10 through, for example, CVD (chemical vapor deposition). It is formed with a predetermined film thickness. Then, the silicon nitride film 40 formed on the entire surface RS of the semiconductor substrate 10 is removed by etching leaving a desired position (substantially the center in the present embodiment) as shown in FIG. The silicon nitride film 40 thus formed functions as a thermal oxidation mask in the subsequent thermal oxidation process.

熱酸化マスク形成工程を終えると、続く熱酸化工程として、シリコン窒化膜40が形成された半導体基板10を酸化性雰囲気に晒すことで、シリコンと酸素、あるいは、シリコンと水分を化学反応させる。こうした熱酸化により、図1(b)に示すように、半導体基板10の表面RSのうちのシリコン窒化膜40に覆われていない部分に、LOCOS酸化膜(SiO2)12が形成される。ちなみに、半導体基板10の表面RSのうちのシリコン窒化膜40に覆われている部分は基本的に熱酸化されない。ただし、シリコン窒化膜40に覆われているとはいえ、シリコン窒化膜40端部の直下においては、該シリコン窒化膜40と半導体基板10の表面RSとの間に上記酸化性雰囲気が入り込むため、半導体基板10を構成するシリコンは熱酸化される。こうしたLOCOS酸化膜12の形成過程に起因して、同図1(b)中に一点鎖線で囲むように、LOCOS酸化膜12の中央部から端部に向けて徐々に膜厚が薄くなる、いわゆるバーズビーク部12aが形成されることになる。なお、この熱酸化工程では、LOCOS酸化膜12の形成後、半導体基板10の表面RSの略中央に形成されていたシリコン窒化膜40をエッチング除去する。このようにして、所望の位置で開口するLOCOS酸化膜12が半導体基板10の上表面に形成されることになる。なお、図1(a)及び(b)にそれぞれ示す熱酸化マスク形成工程及び熱酸化工程によって、特許請求の範囲に記載の第1層間膜形成工程が構成されている。   When the thermal oxidation mask formation process is finished, as a subsequent thermal oxidation process, the semiconductor substrate 10 on which the silicon nitride film 40 is formed is exposed to an oxidizing atmosphere, thereby causing silicon and oxygen or silicon and moisture to chemically react. By such thermal oxidation, as shown in FIG. 1B, a LOCOS oxide film (SiO 2) 12 is formed in a portion of the surface RS of the semiconductor substrate 10 that is not covered with the silicon nitride film 40. Incidentally, the portion covered with the silicon nitride film 40 in the surface RS of the semiconductor substrate 10 is basically not thermally oxidized. However, although the oxide film is covered with the silicon nitride film 40, the oxidizing atmosphere enters between the silicon nitride film 40 and the surface RS of the semiconductor substrate 10 immediately below the end of the silicon nitride film 40. Silicon constituting the semiconductor substrate 10 is thermally oxidized. Due to the formation process of the LOCOS oxide film 12, the film thickness gradually decreases from the center portion to the end portion of the LOCOS oxide film 12 so as to be surrounded by a one-dot chain line in FIG. Bird's beak part 12a will be formed. In this thermal oxidation step, after the LOCOS oxide film 12 is formed, the silicon nitride film 40 formed at the approximate center of the surface RS of the semiconductor substrate 10 is removed by etching. In this way, the LOCOS oxide film 12 opening at a desired position is formed on the upper surface of the semiconductor substrate 10. The first interlayer film forming step described in the claims is constituted by the thermal oxidation mask forming step and the thermal oxidation step shown in FIGS. 1 (a) and 1 (b), respectively.

半導体基板10の表面RSにLOCOS酸化膜12が形成されると、図1(c)に示すように、絶縁膜形成工程として、LOCOS酸化膜12の表面を含む半導体基板10の表面RSに所定の膜厚にて絶縁膜を形成する。詳しくは、LOCOS酸化膜12の上表面、及び、半導体基板10の表面RSのうちのLOCOS酸化膜12に形成された孔を介して露出する部分に対し、例えばCVD(化学気相成長)を通じて、電気的な絶縁性を有する例えばシリコン酸化膜(SiO2)20を所定の膜厚にて形成する。このようにして形成されたシリコン酸化膜20は、図1(c)に示すように、LOCOS酸化膜12の上表面並びに半導体基板10の表面RSを均一の膜厚にて覆うこととなる。   When the LOCOS oxide film 12 is formed on the surface RS of the semiconductor substrate 10, as shown in FIG. 1C, a predetermined amount is formed on the surface RS of the semiconductor substrate 10 including the surface of the LOCOS oxide film 12, as shown in FIG. An insulating film is formed with a film thickness. Specifically, the upper surface of the LOCOS oxide film 12 and the portion of the surface RS of the semiconductor substrate 10 exposed through the holes formed in the LOCOS oxide film 12 are subjected to, for example, CVD (chemical vapor deposition). For example, a silicon oxide film (SiO2) 20 having electrical insulation is formed with a predetermined film thickness. The silicon oxide film 20 thus formed covers the upper surface of the LOCOS oxide film 12 and the surface RS of the semiconductor substrate 10 with a uniform film thickness, as shown in FIG.

ちなみに、シリコン酸化膜20は、後述する金属パッド形成工程を通じて形成される金属パッドと半導体基板10との電気的な絶縁が、当該半導体装置の動作時においても維持することができる膜厚に設定されている。さらに、シリコン酸化膜20は、LOCOS酸化膜12及びバーズビーク部12a並びに半導体基板10の各上表面の側面断面視形状がシリコン酸化膜20の上表面の側面断面視形状に転写されるだけの膜厚に設定されている。   Incidentally, the silicon oxide film 20 is set to a film thickness that can maintain the electrical insulation between the metal pad formed through the metal pad forming process described later and the semiconductor substrate 10 even during the operation of the semiconductor device. ing. Further, the silicon oxide film 20 has such a film thickness that the LOCOS oxide film 12, the bird's beak part 12 a, and the side cross-sectional shape of each upper surface of the semiconductor substrate 10 are transferred to the side cross-sectional shape of the upper surface of the silicon oxide film 20. Is set to

こうして絶縁膜形成工程を終えると、金属膜形成工程として、LOCOS酸化膜12の上表面、及び、半導体基板10の表面RSのうちのLOCOS酸化膜12の開口を介して露出する部分(正確には、シリコン酸化膜20の上表面)の全面に対して、例えばCVD(化学気相成長)を通じて、例えばアルミニウム膜を所定膜厚に成膜する。そして、続く整形工程として、図1(d)に示すように、シリコン酸化膜20上表面の全面に形成されたアルミニウム膜を所定の形状(本実施の形態では平面視正方形)に整形することで、金属パッドを完成する(整形工程)。なお、図1(a)及び(b)に示す第1層間膜形成工程、図1(c)に示す絶縁膜形成工程、並びに、図1(d)に示す金属膜形成工程及び整形工程によって、特許請求の範囲に記載の金属パッド形成工程が構成されている。   When the insulating film forming step is finished in this manner, as a metal film forming step, the upper surface of the LOCOS oxide film 12 and the portion of the surface RS of the semiconductor substrate 10 exposed through the opening of the LOCOS oxide film 12 (more precisely, For example, an aluminum film is formed to a predetermined film thickness on the entire surface of the silicon oxide film 20 by, for example, CVD (chemical vapor deposition). Then, as a subsequent shaping process, as shown in FIG. 1 (d), the aluminum film formed on the entire surface of the silicon oxide film 20 is shaped into a predetermined shape (square in plan view in the present embodiment). Complete the metal pad (shaping process). The first interlayer film forming step shown in FIGS. 1A and 1B, the insulating film forming step shown in FIG. 1C, and the metal film forming step and the shaping step shown in FIG. The metal pad forming process described in the claims is configured.

ちなみに、金属膜形成工程にて形成される金属膜も、LOCOS酸化膜12及びバーズビーク部12a並びに半導体基板10の各上表面の(正確には、シリコン酸化膜20の上表面の)側面断面視形状が金属膜の上表面の側面断面形状に転写されるだけの膜厚に設定されている。   Incidentally, the metal film formed in the metal film forming step is also a cross-sectional side view shape of each upper surface of the LOCOS oxide film 12, the bird's beak portion 12a, and the semiconductor substrate 10 (more precisely, the upper surface of the silicon oxide film 20). Is set to a film thickness that can be transferred to the side sectional shape of the upper surface of the metal film.

したがって、図1(d)に示すように、金属パッド30の中央部には、半導体基板10の表面RSに平行な第1平坦面FS1と該第1平坦面FS1に対して傾斜する傾斜面SSとが組み合わされた側面断面視メサ状の窪み30aが形成されることになる。さらに、金属パッド30の周縁部には、半導体基板10の表面に平行な第2平坦面FS2が形成され、中央部の第1平坦面FS1と周縁部の第2平坦面FS2との間には、半導体基板10の厚み方向に段差Dが生じることになる。   Accordingly, as shown in FIG. 1 (d), at the center of the metal pad 30, there are a first flat surface FS1 parallel to the surface RS of the semiconductor substrate 10 and an inclined surface SS that is inclined with respect to the first flat surface FS1. Is formed in a mesa-shaped depression 30a in a side sectional view. Further, a second flat surface FS2 parallel to the surface of the semiconductor substrate 10 is formed at the peripheral edge portion of the metal pad 30, and between the first flat surface FS1 at the center portion and the second flat surface FS2 at the peripheral portion. As a result, a step D occurs in the thickness direction of the semiconductor substrate 10.

次に、図2(a)に示すように、導電性バンプ載置工程として、球状の導電性バンプ50を金属パッド30の窪み30aに載置する。ここで、本実施の形態では、金属パッド30の所望とする位置に導電性バンプ50が正確に載置されず、載置位置が所望位置から僅かにずれるようなことがあったとしても、金属パッド30に上記段差D(正確には傾斜面SS)が形成されているため、導電性バンプ50は、傾斜面SSによって誘導され、金属パッド30の窪み30aに自ら収まる。すなわち、金属パッド30は、自己アライメント補正効果を奏することになる。   Next, as shown in FIG. 2A, the spherical conductive bump 50 is placed in the recess 30 a of the metal pad 30 as a conductive bump placement step. Here, in the present embodiment, even if the conductive bump 50 is not accurately placed at a desired position of the metal pad 30 and the placement position may slightly deviate from the desired position, the metal bump 30 Since the step D (precisely, the inclined surface SS) is formed on the pad 30, the conductive bump 50 is guided by the inclined surface SS and fits in the recess 30 a of the metal pad 30. That is, the metal pad 30 has a self-alignment correction effect.

こうして導電性バンプ50が金属パッド30の所望位置に載置されると、次に、接合工程を実行する。接合工程では、図2(b)に示すように、先の図1(d)に示した半導体基板10と全く同一の構造を有する半導体基板10を上下反転して保持する。そして、導電性バンプ50が載置された半導体基板10を、図中に矢指するように図中の下方から上方に向けて近づけ、導電性バンプ50と金属パッド30とを接触させ、これら導電性バンプ50と金属パッド30とを接合する。なお、保持された半導体基板10が有する金属パッド30に導電性バンプ50を接触させる際、その金属パッド30にも窪み30aが形成されているため、接触位置が僅かにずれたとしても、導電性バンプ50は、傾斜面SSによって誘導され、金属パッド30の窪み30aに自ら収まることになる。すなわち、金属パッド30は、ここでも、自己アライメント補正効果を奏することになる。ちなみに、半導体装置の体格が小さくなるにつれて、導電性バンプを所望位置に正確に載置すること並びに導電性バンプと金属パッドとを正確に所望位置にて接触させることは難しくなる。こうした自己アライメント補正効果は、半導体装置の体格の小型化を図る際により有用となる。   When the conductive bumps 50 are thus placed at desired positions on the metal pads 30, a bonding process is performed next. In the bonding step, as shown in FIG. 2B, the semiconductor substrate 10 having the same structure as that of the semiconductor substrate 10 shown in FIG. Then, the semiconductor substrate 10 on which the conductive bumps 50 are placed is made to approach from the lower side to the upper side as indicated by arrows in the drawing, and the conductive bumps 50 and the metal pads 30 are brought into contact with each other, so that these conductive The bump 50 and the metal pad 30 are joined. Note that when the conductive bump 50 is brought into contact with the metal pad 30 of the held semiconductor substrate 10, the metal pad 30 is also formed with a recess 30a. The bump 50 is guided by the inclined surface SS and fits in the recess 30a of the metal pad 30 itself. That is, the metal pad 30 also exhibits a self-alignment correction effect here. Incidentally, as the size of the semiconductor device becomes smaller, it becomes difficult to accurately place the conductive bumps at a desired position and to bring the conductive bumps and the metal pads into contact at the desired position accurately. Such a self-alignment correction effect is more useful in reducing the size of the semiconductor device.

また、本実施の形態では、実際には、所定の機能を有する半導体素子を半導体基板に作製する素子作製工程も実行されるが、そうした素子作製工程では、例えば半導体基板10内部に不純物を導入するウェル形成工程等、一般に知られた技術を通じて素子を作成するため、ここでの詳細な説明を割愛する。   In this embodiment, an element manufacturing process for manufacturing a semiconductor element having a predetermined function on a semiconductor substrate is also actually performed. In such an element manufacturing process, for example, impurities are introduced into the semiconductor substrate 10. In order to create an element through a well-known technique such as a well formation process, a detailed description is omitted here.

以上説明した半導体装置の製造方法によって製造される、本実施の形態の半導体装置は、図3に示す構造を有することになる。   The semiconductor device of the present embodiment manufactured by the semiconductor device manufacturing method described above has the structure shown in FIG.

詳しくは、図3に示すように、半導体装置1は、基本的に、例えば単結晶シリコン(Si)から構成された所定の厚さの半導体基板10を備えており、この半導体基板10には、上記素子作製工程を通じて、所定の機能を有する図示しない半導体素子が複数作製されている。   Specifically, as shown in FIG. 3, the semiconductor device 1 basically includes a semiconductor substrate 10 having a predetermined thickness made of, for example, single crystal silicon (Si). Through the element manufacturing process, a plurality of semiconductor elements (not shown) having a predetermined function are manufactured.

また、図3に示すように、金属パッド30の中央部には、半導体基板10の表面RSに平行な第1平坦面FS1と該第1平坦面FS1に対して傾斜する傾斜面SSとが組み合わされた側面断面視メサ状の窪み30aが形成されている。さらに、金属パッド30の周縁部には、半導体基板10の表面に平行な第2平坦面FS2が形成されている。   Further, as shown in FIG. 3, a first flat surface FS1 parallel to the surface RS of the semiconductor substrate 10 and an inclined surface SS inclined with respect to the first flat surface FS1 are combined in the central portion of the metal pad 30. A side-view sectional mesa-shaped depression 30a is formed. Furthermore, a second flat surface FS2 parallel to the surface of the semiconductor substrate 10 is formed at the peripheral edge of the metal pad 30.

これにより、導電性バンプ50は、金属パッド30と接合する際、第1平坦面FS1だけでなく傾斜面SSにも接触するようになり、導電性バンプ50と金属パッド30との接触面積が大きくなる。したがって、導電性バンプ50と金属パッド30との接触界面における機械強度が向上する。そのため、当該半導体装置1を例えば自動車等に搭載しても、導電性バンプ50と金属パッド30とが自動車の運転中に生じる振動に耐え切れず互いに乖離するようなことは抑制されるようになる。   As a result, when the conductive bump 50 is bonded to the metal pad 30, the conductive bump 50 comes into contact with not only the first flat surface FS1 but also the inclined surface SS, and the contact area between the conductive bump 50 and the metal pad 30 is large. Become. Therefore, the mechanical strength at the contact interface between the conductive bump 50 and the metal pad 30 is improved. Therefore, even when the semiconductor device 1 is mounted on, for example, an automobile, the conductive bumps 50 and the metal pads 30 are prevented from being separated from each other without being able to withstand vibrations generated during the operation of the automobile. .

また、導電性バンプ50と金属パッド30との接触界面に例えば水分等の異物が浸入するようなことがあると、接触界面の腐食を招き、ひいては、接触界面の機械強度を低下させてしまうことにもなりかねないところ、本実施の形態の半導体装置1では、導電性バンプ50と金属パッド30の第1平坦面FS1との接触界面にそうした水分が浸入することがそもそも抑制されている。したがって、少なくとも、導電性バンプ50と金属パッド30の第1平坦面FS1との接触界面の腐食を防止することができるようになり、導電性バンプ50と金属パッド30との接触界面に水分が浸入するようなことがあっても、導電性バンプ50と金属パッド30の第1平坦面FS1との接触界面の機械強度を維持することができる。   In addition, if a foreign substance such as moisture enters the contact interface between the conductive bump 50 and the metal pad 30, corrosion of the contact interface may be caused, thereby reducing the mechanical strength of the contact interface. However, in the semiconductor device 1 of the present embodiment, the entry of such moisture into the contact interface between the conductive bump 50 and the first flat surface FS1 of the metal pad 30 is suppressed in the first place. Accordingly, at least corrosion of the contact interface between the conductive bump 50 and the first flat surface FS1 of the metal pad 30 can be prevented, and moisture enters the contact interface between the conductive bump 50 and the metal pad 30. Even if this happens, the mechanical strength of the contact interface between the conductive bump 50 and the first flat surface FS1 of the metal pad 30 can be maintained.

また、図3に示すように、半導体装置1では、金属パッド30に窪み30aを形成するために用いられたLOCOS酸化膜12が、金属パッド30の周縁部と半導体基板10との間に残されている。LOCOS酸化膜12は、半導体基板10を構成する材料である単結晶シリコン(Si)よりも硬度が大きい。そうした硬度の大きいLOCOS酸化膜12が半導体基板10に残されているため、半導体装置1全体としての硬度が向上する。そのため、例えば当該半導体装置1に外力が加えられたとしても、半導体基板10に作製された半導体素子が所定の機能を維持することができるようになる。   As shown in FIG. 3, in the semiconductor device 1, the LOCOS oxide film 12 used for forming the depression 30 a in the metal pad 30 is left between the peripheral portion of the metal pad 30 and the semiconductor substrate 10. ing. The LOCOS oxide film 12 is harder than single crystal silicon (Si), which is a material constituting the semiconductor substrate 10. Since the LOCOS oxide film 12 having such a high hardness is left on the semiconductor substrate 10, the hardness of the semiconductor device 1 as a whole is improved. Therefore, for example, even if an external force is applied to the semiconductor device 1, the semiconductor element manufactured on the semiconductor substrate 10 can maintain a predetermined function.

本実施の形態では、こうした効果を有する半導体装置1を既述した製法にて製造している。すなわち、背景技術の欄に記載した従来技術とは異なり、金属膜形成工程にて形成された金属膜の表面を研削するという複雑な加工プロセスを通じて金属パッドの表面に断面メサ状の窪み30aを形成しているわけではなく、半導体基板10の表面RSにLOCOS酸化膜12を予め形成しておき、金属膜形成工程ではこれら半導体基板10の表面RS及びLOCOS酸化膜12上表面に一定膜厚にて金属膜を形成するという簡素なプロセスを通じて、金属パッド30の表面に断面メサ状の窪み30aを形成している。換言すれば、上記効果を有する半導体装置を、より簡素なプロセスにて製造することができるようになる。   In the present embodiment, the semiconductor device 1 having such an effect is manufactured by the manufacturing method described above. That is, unlike the prior art described in the background section, the mesa-shaped depression 30a is formed on the surface of the metal pad through a complicated processing process of grinding the surface of the metal film formed in the metal film forming step. However, the LOCOS oxide film 12 is formed in advance on the surface RS of the semiconductor substrate 10, and in the metal film forming step, the surface RS of the semiconductor substrate 10 and the surface on the LOCOS oxide film 12 are formed with a constant film thickness. Through a simple process of forming a metal film, a recess 30a having a mesa cross section is formed on the surface of the metal pad 30. In other words, the semiconductor device having the above effects can be manufactured by a simpler process.

なお、本発明に係る半導体装置の製造方法及び半導体装置は、上記実施の形態で例示した方法及び構成に限られるものではなく、本実施の形態を適宜変更した例えば次の形態として実行することもできる。   Note that the semiconductor device manufacturing method and the semiconductor device according to the present invention are not limited to the method and configuration illustrated in the above embodiment, and may be executed as the following embodiment, which is appropriately modified from the present embodiment. it can.

上記実施の形態では、先の図1(c)に示したように、LOCOS酸化膜12の表面を含む半導体基板10の表面RSに所定の膜厚にてシリコン酸化膜(絶縁膜)20を形成する絶縁膜形成工程を備えていたが、こうしたシリコン酸化膜20については、必要に応じて形成したり割愛したりしてもよい。例えば、半導体基板10及び金属パッド30を同一の電位にしたいのであれば、こうしたシリコン酸化膜20を形成する絶縁膜形成工程を割愛することとしてもよい。こうした製法にて製造される半導体装置は、シリコン酸化膜20が割愛された構成を有することになる。   In the above embodiment, as shown in FIG. 1C, the silicon oxide film (insulating film) 20 is formed with a predetermined thickness on the surface RS of the semiconductor substrate 10 including the surface of the LOCOS oxide film 12. However, the silicon oxide film 20 may be formed or omitted as necessary. For example, if the semiconductor substrate 10 and the metal pad 30 are desired to have the same potential, the insulating film forming step for forming the silicon oxide film 20 may be omitted. The semiconductor device manufactured by such a manufacturing method has a configuration in which the silicon oxide film 20 is omitted.

また、上記実施の形態では、先の図1(d)に示したように、シリコン酸化膜20は略均一の厚みに形成されるため、第1平坦面FS1と第2平坦面FS2との段差Dは、LOCOS酸化膜12の厚みに主に依存して一定に定められていた。しかしながら、こうした段差Dを必要に応じて小さくしたり大きくしたりしてもよい。具体的には、図1(d)に対応する図として例えば図4(a)に示すように、例えば多結晶シリコン膜(第1層間膜)60をLOCOS酸化膜12の上表面に形成することで、段差D1を調整することとしてもよい。ちなみに、多結晶シリコン膜60の膜厚を厚くするほど、段差D1が大きくなるため、第1平坦面FS1に対する傾斜面SSの傾斜角度は大きくなる。一方、多結晶シリコン膜60の膜厚を薄くするほど、段差D1が小さくなるため、第1平坦面FS1に対する傾斜面SSの傾斜角度は小さくなる。このように、傾斜角度が所望の角度となるように、多結晶シリコン膜60の膜厚を調整することとしてもよい。こうした製法にて製造される半導体装置は、第1平坦面FS1に対する傾斜面SSの傾斜角度が所望の角度に形成された構造を有することとなる。   In the above embodiment, since the silicon oxide film 20 is formed to have a substantially uniform thickness as shown in FIG. 1D, the level difference between the first flat surface FS1 and the second flat surface FS2. D was determined to be constant depending mainly on the thickness of the LOCOS oxide film 12. However, the step D may be reduced or increased as necessary. Specifically, as shown in FIG. 4A as a diagram corresponding to FIG. 1D, for example, a polycrystalline silicon film (first interlayer film) 60 is formed on the upper surface of the LOCOS oxide film 12. Thus, the step D1 may be adjusted. Incidentally, as the thickness of the polycrystalline silicon film 60 is increased, the step D1 is increased, and the inclination angle of the inclined surface SS with respect to the first flat surface FS1 is increased. On the other hand, as the thickness of the polycrystalline silicon film 60 is reduced, the step D1 is reduced, so that the inclination angle of the inclined surface SS with respect to the first flat surface FS1 is reduced. Thus, the film thickness of the polycrystalline silicon film 60 may be adjusted so that the inclination angle becomes a desired angle. The semiconductor device manufactured by such a manufacturing method has a structure in which the inclination angle of the inclined surface SS with respect to the first flat surface FS1 is formed at a desired angle.

また、上記実施の形態において、例えば図4(b)に示すように、半導体基板10の表面RSから裏面BSに至る貫通電極35を、金属パッド30と一体になるように形成する貫通電極形成工程をさらに備えることとしてもよい。具体的には、半導体基板10の表面RSに金属パッド30を形成した後、半導体基板10の裏面BSから金属パッド30に向けて例えばドライエッチングを通じて貫通孔10aを形成する。そして、例えばアルミニウム(Al)等の導電材料をスパッタリングを通じて貫通孔10aに埋め込むことにより、金属パッド30と一体となるように貫通電極35を形成する。こうした製法にて製造される半導体装置は、金属パッド30と一体に形成された貫通電極35を有することとなる。   In the above embodiment, for example, as shown in FIG. 4B, the through electrode forming step of forming the through electrode 35 extending from the front surface RS to the back surface BS of the semiconductor substrate 10 so as to be integrated with the metal pad 30. May be further provided. Specifically, after forming the metal pad 30 on the front surface RS of the semiconductor substrate 10, the through hole 10 a is formed from the back surface BS of the semiconductor substrate 10 toward the metal pad 30 through, for example, dry etching. Then, a through electrode 35 is formed so as to be integrated with the metal pad 30 by embedding a conductive material such as aluminum (Al) in the through hole 10a through sputtering. The semiconductor device manufactured by such a manufacturing method has the through electrode 35 formed integrally with the metal pad 30.

また、上記実施の形態において、例えば図5(a)に示すように、半導体基板10の表面RSのうちの金属パッド31の中央部が形成される部分にLOCOS酸化膜13を形成することで、第1平坦面FS1の一部を導電性バンプ50に向けて盛り上げて第3平坦面FS3としてもよい。既述したように、導電性バンプ50は、金属パッド31と接合される際、金属パッド31の表面に沿って変形する。そのため、こうした製法にて製造された半導体装置では、導電性バンプ50と金属パッド31との接触界面の面積をより大きくすることができるようになる。   In the above embodiment, for example, as shown in FIG. 5A, the LOCOS oxide film 13 is formed on a portion of the surface RS of the semiconductor substrate 10 where the central portion of the metal pad 31 is formed. A part of the first flat surface FS1 may be raised toward the conductive bump 50 to form the third flat surface FS3. As described above, the conductive bump 50 is deformed along the surface of the metal pad 31 when being joined to the metal pad 31. Therefore, in the semiconductor device manufactured by such a manufacturing method, the area of the contact interface between the conductive bump 50 and the metal pad 31 can be further increased.

なお、こうした変形例では、図5(a)に示したように、シリコン酸化膜20は略均一の厚みに形成されるため、第1平坦面FS1と該第1平坦面FS1の一部が盛り上げられた第3平坦面FS3との高さの差は、LOCOS酸化膜13の厚みに主に依存して一定に定められる。しかしながら、必要に応じて、こうした盛り上がり高さを高くしたり低くしたりしてもよい。すなわち、例えば多結晶シリコン(第2層間膜)膜をLOCOS酸化膜13の上表面に形成することで、盛り上がり高さを調整することとしてもよい。ちなみに、多結晶シリコン膜の膜厚を厚くするほど、盛り上がり高さは高くなるため、導電性バンプ50と金属パッド31との接触界面の面積をより大きくすることができるようになる。一方、多結晶シリコン膜の膜厚を薄くするほど、盛り上がり高さは低くなるため、導電性バンプ50と金属パッド31との接触界面の面積をより小さくすることができるようになる。このように、盛り上がり高さが所望の高さとなるように、多結晶シリコン膜の膜厚を調整することとしてもよい。こうした製法にて製造される半導体装置は、第1平坦面の一部が導電性バンプ50に向けて盛り上げられた構造を有することとなる。   In such a modification, as shown in FIG. 5A, since the silicon oxide film 20 is formed to have a substantially uniform thickness, the first flat surface FS1 and a part of the first flat surface FS1 are raised. The difference in height from the third flat surface FS3 is determined to be constant depending mainly on the thickness of the LOCOS oxide film 13. However, the raised height may be increased or decreased as necessary. That is, for example, the rising height may be adjusted by forming a polycrystalline silicon (second interlayer film) film on the upper surface of the LOCOS oxide film 13. Incidentally, since the rising height increases as the thickness of the polycrystalline silicon film is increased, the area of the contact interface between the conductive bump 50 and the metal pad 31 can be further increased. On the other hand, as the thickness of the polycrystalline silicon film is reduced, the rising height is reduced, so that the area of the contact interface between the conductive bump 50 and the metal pad 31 can be further reduced. In this way, the thickness of the polycrystalline silicon film may be adjusted so that the raised height becomes a desired height. The semiconductor device manufactured by such a manufacturing method has a structure in which a part of the first flat surface is raised toward the conductive bump 50.

また、上記変形例では、LOCOS酸化膜13上表面に例えば多結晶シリコン膜を形成していたが、これらLOCOS酸化膜13及びシリコン膜を必ずしも併用する必要はない。すなわち、例えば図5(b)に示すように、半導体基板10の表面RSのうちの金属パッド31の中央部が形成される部分に例えば多結晶シリコン膜14のみを形成することで、第1平坦面FS1の一部を導電性バンプ50に向けて盛り上げて第3平坦面FS3としてもよい。これによっても、LOCOS酸化膜13及び多結晶シリコン膜を併用した場合に準じた効果を得ることができる。なお、こうしたLOCOS酸化膜13及び多結晶シリコン膜が特許請求の範囲に記載した第2層間膜に相当する。   In the above modification, for example, a polycrystalline silicon film is formed on the surface of the LOCOS oxide film 13, but it is not always necessary to use the LOCOS oxide film 13 and the silicon film in combination. That is, as shown in FIG. 5B, for example, only the polycrystalline silicon film 14 is formed on a portion of the surface RS of the semiconductor substrate 10 where the central portion of the metal pad 31 is formed, so that the first flatness is obtained. A part of the surface FS1 may be raised toward the conductive bump 50 to form the third flat surface FS3. Also by this, an effect equivalent to the case where the LOCOS oxide film 13 and the polycrystalline silicon film are used together can be obtained. The LOCOS oxide film 13 and the polycrystalline silicon film correspond to the second interlayer film described in the claims.

さらに、上記変形例では、先の図5(a)及び(b)に示したように、金属パッド31と第2層間膜(LOCOS酸化膜13あるいは多結晶シリコン膜14)との間に、所定の膜厚にて例えばシリコン酸化膜20(絶縁膜)を形成していたが、こうしたシリコン酸化膜20については、既述したように、必要に応じて形成したり割愛したりしてもよい。   Furthermore, in the above modification, as shown in FIGS. 5A and 5B, a predetermined amount is provided between the metal pad 31 and the second interlayer film (LOCOS oxide film 13 or polycrystalline silicon film 14). For example, the silicon oxide film 20 (insulating film) is formed with a thickness of 5 nm. However, as described above, the silicon oxide film 20 may be formed or omitted as necessary.

またさらに、上記変形例では、半導体基板10の表面RSに平行な第1平坦面FS1とこの第1平坦面FS1に対して傾斜する傾斜面SSとが組み合わさるとともに、平坦面FS1の一部が導電性バンプ50に向けて盛り上げられた側面断面視形状の窪みとしていたが、第1平坦面FS1及び第3平坦面FS3については、平坦でなくともよい。要は、金属パッドの表面の周縁部が導電性バンプを包み込むように該導電性バンプの表面に沿って傾斜し、且つ、金属パッドの表面の中央部が前記導電性バンプに向かって凸となる側面断面視形状の窪みであれば、所期の目的を達成することはできる。   Furthermore, in the above modification, the first flat surface FS1 parallel to the surface RS of the semiconductor substrate 10 and the inclined surface SS inclined with respect to the first flat surface FS1 are combined, and a part of the flat surface FS1 is formed. Although the depression is formed in a side sectional view raised toward the conductive bump 50, the first flat surface FS1 and the third flat surface FS3 may not be flat. In short, the peripheral portion of the surface of the metal pad is inclined along the surface of the conductive bump so as to wrap the conductive bump, and the central portion of the surface of the metal pad is convex toward the conductive bump. If the depression has a side sectional view shape, the intended purpose can be achieved.

上記実施の形態では、金属パッド30または31の周縁部にのみ、LOCOS酸化膜12を形成していたが、これに限らない。例えば半導体基板10の周縁部に金属パッド30または31を複数形成する必要がある場合には、図7にその斜視構造を示すように、半導体基板10の向かい合う1組の対辺に沿ってLOCOS酸化膜12が形成された半導体装置としてもよい。LOCOS酸化膜12は、半導体基板10よりも硬度が大きいことは既述した通りである。したがって、上記構造を採用することにより、半導体基板10に形成されたLOCOS酸化膜12がフレームとして機能するため、例えば当該半導体装置に外力が加わったとしても、半導体基板10に作製された半導体素子を好適に保護することができるようになる。なお、半導体基板10の向かい合う1組の対辺に沿ってのみLOCOS酸化膜12を形成することに限らず、半導体基板10の向かい合う2組の対辺に沿ってLOCOS酸化膜12を形成することとしてもよい。逆に、半導体基板10の1辺に沿ってのみLOCOS酸化膜12を形成することとしてもよい。要は、半導体基板10の周縁部にLOCOS酸化膜12を形成すれば、上記効果に準じた効果を得ることはできる。   In the above embodiment, the LOCOS oxide film 12 is formed only on the peripheral edge of the metal pad 30 or 31, but the present invention is not limited to this. For example, when it is necessary to form a plurality of metal pads 30 or 31 on the periphery of the semiconductor substrate 10, a LOCOS oxide film is formed along a pair of opposite sides of the semiconductor substrate 10 as shown in a perspective view of FIG. 12 may be a semiconductor device. As described above, the LOCOS oxide film 12 is harder than the semiconductor substrate 10. Therefore, by employing the above structure, the LOCOS oxide film 12 formed on the semiconductor substrate 10 functions as a frame. For example, even if an external force is applied to the semiconductor device, the semiconductor element manufactured on the semiconductor substrate 10 is It can be suitably protected. Note that the LOCOS oxide film 12 is not limited to being formed only along one pair of opposite sides of the semiconductor substrate 10, and the LOCOS oxide film 12 may be formed along two pairs of opposite sides of the semiconductor substrate 10. . Conversely, the LOCOS oxide film 12 may be formed only along one side of the semiconductor substrate 10. In short, if the LOCOS oxide film 12 is formed on the peripheral edge of the semiconductor substrate 10, an effect similar to the above effect can be obtained.

上記実施の形態では、半導体装置1は、先の図3に示したように、先の図1(d)に示した半導体基板10を2つ有しており、これら半導体基板がそれぞれ有する金属パッド30と導電性バンプ50とが接合されることにより、互いに電気的に接続されていたが、半導体装置の構造はこれに限らない。他に例えば、図3に対応する図として図6に示すように、先の図5(a)に示した、金属パッド31の中央部が盛り上げられた構造を有する半導体基板と、先の図4(b)に示した、貫通電極35と一体となった金属パッド30を有する半導体基板とを2つ有し、これら半導体基板がそれぞれ有する金属パッド31及び30と導電性バンプ50とを接合することにより、互いに電気的に接続された半導体装置1aとしてもよい。要は、こうした2つの半導体基板の組み合わせは任意であり、上述したような、適宜変更が加えられた半導体基板を2つ用いて、半導体装置を製造することとしてもよい。   In the above embodiment, as shown in FIG. 3, the semiconductor device 1 has two semiconductor substrates 10 shown in FIG. 1D, and the metal pads each of these semiconductor substrates have. 30 and the conductive bump 50 are joined to each other to be electrically connected, but the structure of the semiconductor device is not limited to this. In addition, for example, as shown in FIG. 6 as a diagram corresponding to FIG. 3, the semiconductor substrate having a structure in which the central portion of the metal pad 31 is raised as shown in FIG. Two semiconductor substrates each having the metal pad 30 integrated with the through electrode 35 shown in (b) are bonded, and the metal pads 31 and 30 and the conductive bump 50 respectively included in the semiconductor substrate are bonded. Thus, the semiconductor devices 1a that are electrically connected to each other may be used. In short, the combination of these two semiconductor substrates is arbitrary, and the semiconductor device may be manufactured using two semiconductor substrates appropriately modified as described above.

上記実施の形態では、上記整形工程において、金属膜のうちの金属パッド30あるいは31の周縁部となる部分を除去せず残したため、金属パッド30あるいは31の周縁部は、半導体基板10の表面RSに平行な第2平坦面FS2となっていたが、こうした第2平坦面FS2を形成しなくてもよい。換言すれば、第1平坦面FS1及び傾斜面SSのみが金属パッド30あるいは31に形成されていることとしてもよい。これによっても、所期の目的を達成することはできる。   In the above embodiment, in the shaping step, the portion of the metal film that becomes the peripheral portion of the metal pad 30 or 31 is left without being removed, so that the peripheral portion of the metal pad 30 or 31 is the surface RS of the semiconductor substrate 10. However, the second flat surface FS2 need not be formed. In other words, only the first flat surface FS1 and the inclined surface SS may be formed on the metal pad 30 or 31. This also achieves the intended purpose.

上記実施の形態では、第1層間膜として、半導体基板10の表面RSにLOCOS酸化膜12を形成していたがこれに限らない。他に例えば、TEOS膜等を形成し、これを用いて金属パッドに窪みを形成することとしてもよい。これによっても、所期の目的を達成することはできる。   In the above embodiment, the LOCOS oxide film 12 is formed on the surface RS of the semiconductor substrate 10 as the first interlayer film, but the present invention is not limited to this. In addition, for example, a TEOS film or the like may be formed and a depression may be formed in the metal pad using the TEOS film. This also achieves the intended purpose.

本発明に係る半導体装置の製造方法の一実施の形態について、(a)〜(d)は、その製造プロセスを示す側面断面図。BRIEF DESCRIPTION OF THE DRAWINGS (a)-(d) is side sectional drawing which shows the manufacturing process about one Embodiment of the manufacturing method of the semiconductor device which concerns on this invention. (a)及び(b)は、同実施の形態の半導体装置の製造方法について、図1に続く製造プロセスを示す側面断面図。(A) And (b) is side surface sectional drawing which shows the manufacturing process following FIG. 1 about the manufacturing method of the semiconductor device of the embodiment. 本発明に係る半導体装置の一実施の形態について、その断面構造を側面方向から示す側面断面図。1 is a side cross-sectional view showing a cross-sectional structure of an embodiment of a semiconductor device according to the present invention from a side surface direction; (a)及び(b)は、同実施の形態の半導体装置の変形例について、その断面構造側面方向から示す側面断面図。(A) And (b) is side surface sectional drawing shown from the cross-section structure side surface direction about the modification of the semiconductor device of the embodiment. (a)及び(b)は、同実施の形態の半導体装置の他の変形例について、その断面構造を側面方向から示す側面断面図。(A) And (b) is side surface sectional drawing which shows the cross-sectional structure from the side surface direction about the other modification of the semiconductor device of the embodiment. 同実施の形態の半導体装置のさらに他の変形例について、その断面構造を側面方向から示す側面断面図。Side surface sectional drawing which shows the cross-section from the side surface direction about the further another modification of the semiconductor device of the embodiment. 同実施の形態の半導体装置のさらに他の変形例について、その斜視構造を示す斜視図。The perspective view which shows the perspective structure about the further another modification of the semiconductor device of the embodiment.

符号の説明Explanation of symbols

1…半導体装置、10…半導体基板、10a…貫通孔、12…LOCOS酸化膜(第1層間膜)、12a…バーズビーク部、13…LOCOS酸化膜(第2層間膜)、14…多結晶シリコン膜(第2層間膜)、20…シリコン酸化膜(絶縁膜)、30、31…金属パッド、30a…窪み、35…貫通電極、40…シリコン窒化膜、50…導電性バンプ、60…多結晶シリコン膜(第1層間膜)。 DESCRIPTION OF SYMBOLS 1 ... Semiconductor device, 10 ... Semiconductor substrate, 10a ... Through-hole, 12 ... LOCOS oxide film (1st interlayer film), 12a ... Bird's beak part, 13 ... LOCOS oxide film (2nd interlayer film), 14 ... Polycrystalline silicon film (Second interlayer film), 20 ... silicon oxide film (insulating film), 30, 31 ... metal pad, 30a ... depression, 35 ... penetrating electrode, 40 ... silicon nitride film, 50 ... conductive bump, 60 ... polycrystalline silicon Film (first interlayer film).

Claims (21)

半導体素子を半導体基板に作製する素子作製工程と、前記半導体基板の表面に金属パッドを形成する金属パッド形成工程と、前記金属パッド形成工程にて形成された金属パッドと導電性バンプとを接合する接合工程とを備え、他の半導体装置あるいは回路基板と当該半導体装置とをこれら導電性バンプ及び金属パッドを介して電気的に接続する、半導体装置の製造方法であって、
前記金属パッド形成工程は、
前記半導体基板の表面のうちの前記金属パッドの周縁部が形成される部分に第1層間膜を形成する第1層間膜形成工程と、
前記第1層間膜形成工程にて形成された第1層間膜の表面を含む前記半導体基板の表面に所定の膜厚にて金属膜を形成する金属膜形成工程と、
前記金属膜形成工程にて形成された金属膜の平面視形状を所定の形状に整形する整形工程とを有しており、
前記金属パッド形成工程を通じて、前記第1層間膜及び前記半導体基板の各表面の側面断面視形状を、前記金属パッドの表面の側面断面視形状に転写することを特徴とする、半導体装置の製造方法。
An element manufacturing process for manufacturing a semiconductor element on a semiconductor substrate, a metal pad forming process for forming a metal pad on the surface of the semiconductor substrate, and a metal pad and a conductive bump formed in the metal pad forming process are joined. A method of manufacturing a semiconductor device, comprising: a bonding step, and electrically connecting another semiconductor device or circuit board and the semiconductor device via the conductive bump and the metal pad,
The metal pad forming step includes
A first interlayer film forming step of forming a first interlayer film on a portion of the surface of the semiconductor substrate where the peripheral edge of the metal pad is formed;
A metal film forming step of forming a metal film with a predetermined film thickness on the surface of the semiconductor substrate including the surface of the first interlayer film formed in the first interlayer film forming step;
A shaping step of shaping the metal film formed in the metal film forming step into a predetermined shape in plan view,
A method of manufacturing a semiconductor device, wherein, through the metal pad forming step, a side sectional view shape of each surface of the first interlayer film and the semiconductor substrate is transferred to a side sectional view shape of the surface of the metal pad. .
前記金属パッド形成工程を通じて、前記半導体基板の表面に平行な第1平坦面と該第1平坦面に対して傾斜する傾斜面とが組み合わされた側面断面視メサ状の窪みを、前記金属パッドの表面に形成することを特徴とする、請求項1に記載の半導体装置の製造方法。   Through the metal pad forming step, a mesa-shaped depression in a side cross-sectional view in which a first flat surface parallel to the surface of the semiconductor substrate and an inclined surface inclined with respect to the first flat surface are combined is formed on the metal pad. The method of manufacturing a semiconductor device according to claim 1, wherein the semiconductor device is formed on a surface. 前記第1層間膜形成工程では、前記第1層間膜として、前記半導体基板の表面の熱酸化を通じてLOCOS酸化膜を形成しており、
前記金属パッド形成工程を通じて、前記LOCOS酸化膜及び前記半導体基板の各表面の側面断面視形状を前記金属パッド表面の側面断面視形状に転写することで、前記窪みを有する金属パッドを形成することを特徴とする、請求項2に記載の半導体装置の製造方法。
In the first interlayer film forming step, a LOCOS oxide film is formed as the first interlayer film through thermal oxidation of the surface of the semiconductor substrate,
The metal pad having the depression is formed by transferring the side cross-sectional view shape of each surface of the LOCOS oxide film and the semiconductor substrate to the side cross-sectional view shape of the metal pad surface through the metal pad forming step. The method of manufacturing a semiconductor device according to claim 2, wherein the method is characterized in that:
前記第1層間膜形成工程では、前記第1層間膜として、前記LOCOS酸化膜の上表面に多結晶シリコン膜を形成しており、
前記金属パッド形成工程を通じて、前記多結晶シリコン膜の膜厚を調整することで、前記傾斜面の傾斜角度を調整することを特徴とする、請求項3に記載の半導体装置の製造方法。
In the first interlayer film forming step, a polycrystalline silicon film is formed on the upper surface of the LOCOS oxide film as the first interlayer film,
4. The method of manufacturing a semiconductor device according to claim 3, wherein an inclination angle of the inclined surface is adjusted by adjusting a film thickness of the polycrystalline silicon film through the metal pad forming step. 5.
前記金属パッド形成工程を通じて、前記金属パッドの表面の周縁部が前記導電性バンプを包み込むように該導電性バンプの表面に沿って傾斜し、且つ、前記金属パッドの表面の中央部が前記導電性バンプに向かって凸となる側面断面視形状の窪みを、前記金属パッドの表面に形成することを特徴とする、請求項1に記載の半導体装置の製造方法。   Through the metal pad forming step, the peripheral portion of the surface of the metal pad is inclined along the surface of the conductive bump so as to wrap the conductive bump, and the central portion of the surface of the metal pad is the conductive layer. 2. The method of manufacturing a semiconductor device according to claim 1, wherein a depression having a side sectional view that is convex toward the bump is formed on a surface of the metal pad. 3. 前記金属パッド形成工程は、前記半導体基板の表面のうちの、前記凸となる部分に対応する部分に、第2層間膜を形成する第2層間膜形成工程をさらに備えており、
前記金属パッド形成工程を通じて、前記第1層間膜及び前記第2層間膜並びに前記半導体基板の各表面の側面断面視形状を、前記金属パッドの表面の側面断面視形状に転写することを特徴とする、請求項5に記載の半導体装置の製造方法。
The metal pad forming step further includes a second interlayer film forming step of forming a second interlayer film on a portion of the surface of the semiconductor substrate corresponding to the convex portion,
Through the metal pad forming step, the side sectional view shape of each surface of the first interlayer film, the second interlayer film, and the semiconductor substrate is transferred to the side sectional view shape of the surface of the metal pad. A method for manufacturing a semiconductor device according to claim 5.
前記第2層間膜形成工程では、前記第2層間膜として、前記半導体基板の表面の熱酸化を通じてLOCOS酸化膜を形成しており、
前記金属パッド形成工程を通じて、前記LOCOS酸化膜及び前記半導体基板の各表面の側面断面視形状を前記金属パッド表面の側面断面視形状に転写することで、前記窪みを有する金属パッドを形成することを特徴とする、請求項6に記載の半導体装置の製造方法。
In the second interlayer film forming step, a LOCOS oxide film is formed as the second interlayer film through thermal oxidation of the surface of the semiconductor substrate,
The metal pad having the depression is formed by transferring the side cross-sectional view shape of each surface of the LOCOS oxide film and the semiconductor substrate to the side cross-sectional view shape of the metal pad surface through the metal pad forming step. The method of manufacturing a semiconductor device according to claim 6, wherein the method is characterized in that:
前記第2層間膜形成工程では、前記第2層間膜として、前記LOCOS酸化膜の上表面に多結晶シリコン膜を形成しており、
前記金属パッド形成工程を通じて、前記多結晶シリコン膜の膜厚を調整することで、前記第1平坦面の一部の盛り上げられる高さを調整することを特徴とする、請求項7に記載の半導体装置の製造方法。
In the second interlayer film forming step, a polycrystalline silicon film is formed on the upper surface of the LOCOS oxide film as the second interlayer film,
8. The semiconductor according to claim 7, wherein the raised height of a part of the first flat surface is adjusted by adjusting a film thickness of the polycrystalline silicon film through the metal pad forming step. Device manufacturing method.
半導体素子が作製された半導体基板の表面に所定の厚みにて形成される金属パッドと、前記半導体基板と前記金属パッドの周縁部との間に形成される第1層間膜とを備え、前記金属パッドと導電性バンプとが接合されることで、これら金属パッド及び導電性バンプを介して他の半導体装置あるいは回路基板と電気的に接続される半導体装置であって、
前記第1層間膜及び前記半導体基板の各表面の側面断面視形状が、前記金属パッドの表面の側面断面視形状に転写されていることを特徴とする半導体装置。
A metal pad formed with a predetermined thickness on a surface of a semiconductor substrate on which a semiconductor element is manufactured; and a first interlayer film formed between the semiconductor substrate and a peripheral portion of the metal pad, A semiconductor device that is electrically connected to another semiconductor device or a circuit board via the metal pad and the conductive bump by bonding the pad and the conductive bump,
The semiconductor device according to claim 1, wherein a side sectional view shape of each surface of the first interlayer film and the semiconductor substrate is transferred to a side sectional view shape of the surface of the metal pad.
前記金属パッドには、前記半導体基板の表面に平行な第1平坦面と該第1平坦面に対して傾斜する傾斜面とが組み合わされた側面断面視メサ状の窪みが形成されていることを特徴とする請求項9に記載の半導体装置。   The metal pad is formed with a mesa-shaped depression in a side sectional view in which a first flat surface parallel to the surface of the semiconductor substrate and an inclined surface inclined with respect to the first flat surface are combined. The semiconductor device according to claim 9. 前記第1層間膜は、前記半導体基板の表面を熱酸化することで形成されるLOCOS酸化膜を含んでおり、
前記傾斜面の傾斜角度は、前記LOCOS酸化膜のバーズビーク部によって所定角度に形成されていることを特徴とする請求項10に記載の半導体装置。
The first interlayer film includes a LOCOS oxide film formed by thermally oxidizing the surface of the semiconductor substrate,
The semiconductor device according to claim 10, wherein an inclination angle of the inclined surface is formed at a predetermined angle by a bird's beak portion of the LOCOS oxide film.
前記第1層間膜は、前記LOCOS酸化膜の上表面に形成された多結晶シリコン膜を含んでおり、
前記傾斜面の傾斜角度は、前記多結晶シリコン膜の膜厚によって所定角度に形成されていることを特徴とする請求項11に記載の半導体装置。
The first interlayer film includes a polycrystalline silicon film formed on the upper surface of the LOCOS oxide film,
The semiconductor device according to claim 11, wherein an inclination angle of the inclined surface is formed at a predetermined angle depending on a film thickness of the polycrystalline silicon film.
前記金属パッドと前記第1層間膜との間に絶縁膜が形成されていることを特徴とする請求項9〜12のいずれか一項に記載の半導体装置。   The semiconductor device according to claim 9, wherein an insulating film is formed between the metal pad and the first interlayer film. 前記金属パッドは、前記半導体基板を貫通する貫通電極と一体に形成されていることを特徴とする請求項9〜13のいずれか一項に記載の半導体装置。   The semiconductor device according to claim 9, wherein the metal pad is formed integrally with a through electrode penetrating the semiconductor substrate. 前記金属パッドには、該金属パッドの表面の周縁部が前記導電性バンプを包み込むように該導電性バンプの表面に沿って傾斜し、且つ、前記金属パッドの表面の中央部が前記導電性バンプに向かって凸となる側面断面視形状の窪みが形成されていることを特徴とする請求項9に記載の半導体装置。   The metal pad is inclined along the surface of the conductive bump so that the peripheral edge of the surface of the metal pad wraps the conductive bump, and the central portion of the surface of the metal pad is the conductive bump. The semiconductor device according to claim 9, wherein a recess having a shape in a side sectional view that is convex toward the side is formed. 前記半導体基板と前記金属パッドの中央部との間に形成される第2層間膜をさらに備え、
前記第1層間膜及び前記第2層間膜並びに前記半導体基板の各表面の側面断面視形状が、前記金属パッドの表面の側面断面視形状に転写されていることを特徴とする請求項15に記載の半導体装置。
A second interlayer film formed between the semiconductor substrate and a central portion of the metal pad;
The side cross-sectional view shape of each surface of the first interlayer film, the second interlayer film, and the semiconductor substrate is transferred to the side cross-sectional view shape of the surface of the metal pad. Semiconductor device.
前記第2層間膜は、前記半導体基板の表面を熱酸化することで形成されるLOCOS酸化膜を含んでおり、
前記第1平坦面の一部は、前記LOCOS酸化膜によって所定の高さに盛り上げられていることを特徴とする請求項16に記載の半導体装置。
The second interlayer film includes a LOCOS oxide film formed by thermally oxidizing the surface of the semiconductor substrate,
The semiconductor device according to claim 16, wherein a part of the first flat surface is raised to a predetermined height by the LOCOS oxide film.
前記第2層間膜は、多結晶シリコン膜を含んでおり、
前記第1平坦面の一部は、前記多結晶シリコン膜の膜厚によって所定の高さに盛り上げられていることを特徴とする請求項16または17に記載の半導体装置。
The second interlayer film includes a polycrystalline silicon film,
18. The semiconductor device according to claim 16, wherein a part of the first flat surface is raised to a predetermined height depending on a thickness of the polycrystalline silicon film.
前記金属パッドと前記第2層間膜との間に絶縁膜が形成されていることを特徴とする請求項15〜18のいずれか一項に記載の半導体装置。   The semiconductor device according to claim 15, wherein an insulating film is formed between the metal pad and the second interlayer film. 前記第1層間膜は、前記半導体基板の周縁部に形成されていることを特徴とする請求項9〜19のいずれか一項に記載の半導体装置。   The semiconductor device according to claim 9, wherein the first interlayer film is formed on a peripheral edge portion of the semiconductor substrate. 当該半導体装置は、前記請求項9〜20のいずれか一項に記載の半導体装置を2つ有するものであり、これら2つの半導体装置は、各半導体装置が有する電極パッドと前記導電性バンプとが接合されることにより、互いに電気的に接続されていることを特徴とする半導体装置。   The said semiconductor device has two semiconductor devices as described in any one of the said Claims 9-20, and these two semiconductor devices are the electrode pad which each semiconductor device has, and the said conductive bump. A semiconductor device which is electrically connected to each other by being joined.
JP2007137131A 2007-05-23 2007-05-23 Semiconductor device Expired - Fee Related JP5272331B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2007137131A JP5272331B2 (en) 2007-05-23 2007-05-23 Semiconductor device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2007137131A JP5272331B2 (en) 2007-05-23 2007-05-23 Semiconductor device

Publications (2)

Publication Number Publication Date
JP2008294159A true JP2008294159A (en) 2008-12-04
JP5272331B2 JP5272331B2 (en) 2013-08-28

Family

ID=40168586

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2007137131A Expired - Fee Related JP5272331B2 (en) 2007-05-23 2007-05-23 Semiconductor device

Country Status (1)

Country Link
JP (1) JP5272331B2 (en)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011171370A (en) * 2010-02-16 2011-09-01 Renesas Electronics Corp Method for manufacturing semiconductor device, particle and semiconductor device

Citations (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03106030A (en) * 1989-09-20 1991-05-02 Fujitsu Ltd Manufacture of semiconductor device
JPH05291364A (en) * 1992-04-08 1993-11-05 Sony Corp Semiconductor device
JPH08330313A (en) * 1995-03-24 1996-12-13 Shinko Electric Ind Co Ltd Semiconductor device and its fabrication
JPH0982747A (en) * 1995-09-12 1997-03-28 Seiko Epson Corp Semiconductor device pad electrode structure and its manufacture
JPH10233507A (en) * 1996-03-13 1998-09-02 Seiko Instr Inc Semiconductor integrated circuit and its manufacture
JP2004158678A (en) * 2002-11-07 2004-06-03 Sanyo Electric Co Ltd Bonding pad
JP2005093486A (en) * 2003-09-12 2005-04-07 Seiko Epson Corp Semiconductor device and its manufacturing method
JP2006511938A (en) * 2002-12-20 2006-04-06 アギア システムズ インコーポレーテッド Structure and method for bonding to copper interconnect structures

Patent Citations (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03106030A (en) * 1989-09-20 1991-05-02 Fujitsu Ltd Manufacture of semiconductor device
JPH05291364A (en) * 1992-04-08 1993-11-05 Sony Corp Semiconductor device
JPH08330313A (en) * 1995-03-24 1996-12-13 Shinko Electric Ind Co Ltd Semiconductor device and its fabrication
JPH0982747A (en) * 1995-09-12 1997-03-28 Seiko Epson Corp Semiconductor device pad electrode structure and its manufacture
JPH10233507A (en) * 1996-03-13 1998-09-02 Seiko Instr Inc Semiconductor integrated circuit and its manufacture
JP2004158678A (en) * 2002-11-07 2004-06-03 Sanyo Electric Co Ltd Bonding pad
JP2006511938A (en) * 2002-12-20 2006-04-06 アギア システムズ インコーポレーテッド Structure and method for bonding to copper interconnect structures
JP2005093486A (en) * 2003-09-12 2005-04-07 Seiko Epson Corp Semiconductor device and its manufacturing method

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011171370A (en) * 2010-02-16 2011-09-01 Renesas Electronics Corp Method for manufacturing semiconductor device, particle and semiconductor device

Also Published As

Publication number Publication date
JP5272331B2 (en) 2013-08-28

Similar Documents

Publication Publication Date Title
US8049296B2 (en) Semiconductor wafer
TWI296139B (en)
JP5183708B2 (en) Semiconductor device and manufacturing method thereof
JP4787559B2 (en) Semiconductor device and manufacturing method thereof
JP2009004507A (en) Package for electronic component, manufacturing method thereof, and electronic component device
JP2006093367A (en) Manufacturing method of semiconductor device
JP5350022B2 (en) Semiconductor device and mounting body including the semiconductor device
JP2007005401A (en) Semiconductor device and its manufacturing method
JP2011109104A (en) Method for sealing electronic component
JP4837939B2 (en) Semiconductor device and manufacturing method of semiconductor device
WO2009118995A1 (en) Semiconductor device and method for manufacturing the same
JP3791459B2 (en) Semiconductor device and manufacturing method thereof
JP2010062178A (en) Semiconductor device
JP2008205078A (en) Semiconductor device and manufacturing method thereof
JP6823955B2 (en) Electronic components and their manufacturing methods
JPH10199925A (en) Semiconductor device and manufacturing method thereof
JP5272331B2 (en) Semiconductor device
JP2009212332A (en) Semiconductor device and semiconductor manufacturing method
JP2009176833A (en) Semiconductor device and its manufacturing method
JP4511148B2 (en) Manufacturing method of semiconductor device
JP2005101144A (en) Semiconductor device and method for manufacturing semiconductor device
JP2002367956A (en) Electrode pad of semiconductor device and method of manufacturing the same
US8168526B2 (en) Semiconductor chip package and method for manufacturing thereof
JP3296270B2 (en) Semiconductor device and manufacturing method thereof
JP2006013276A (en) Semiconductor device and its manufacturing method

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20100407

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20110502

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20120717

A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20120905

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20130416

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20130429

R151 Written notification of patent or utility model registration

Ref document number: 5272331

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R151

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

LAPS Cancellation because of no payment of annual fees