JP2008146545A - アドレス生成回路、バッファ回路、情報処理装置および撮像システム - Google Patents
アドレス生成回路、バッファ回路、情報処理装置および撮像システム Download PDFInfo
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Abstract
【解決手段】メモリ空間上で二次元のリングバッファ構造を有する画像バッファは、その内部に基準座標が設定される。加算器241は画像バッファ内の基準座標のY座標値とY方向のオフセットとを加算する。剰余算器242は加算器241の出力を画像バッファのY方向のサイズによって割った際の剰余を出力する。乗算器243は剰余算器242の出力と画像バッファのX方向のサイズとを乗算する。加算器251は画像バッファ内の基準座標のX座標値とX方向のオフセットとを加算する。剰余算器252は加算器251の出力を画像バッファのX方向のサイズによって割った際の剰余を出力する。加算器261は、画像バッファの開始アドレスと、乗算器243の出力と、剰余算器252の出力とを加算して、目的データのアドレスとして出力する。
【選択図】図2
Description
生成アドレス=sa+((yb+yo)%ys)・xs+((xb+xo)%xs)
但し、「A%B」は、AをBによって割った際の剰余を表す。
110 プロセッサ
200 アドレス生成回路
211 開始アドレスレジスタ
221 Y方向サイズレジスタ
222 Y方向基準レジスタ
223 Y方向オフセットレジスタ
231 X方向サイズレジスタ
232 X方向基準レジスタ
233 X方向オフセットレジスタ
241 加算器
242 剰余算器
243 乗算器
251 加算器
252 剰余算器
261 加算器
291 生成アドレスレジスタ
400 バス
410 アドレスバス
420 データバス
500 撮像装置
600 画像データ
610 画像バッファ
630 画素データ
Claims (6)
- メモリ空間上の二次元のバッファ領域における目的データの第1の方向の座標値を前記バッファ領域の前記第1の方向の大きさによって割った剰余を生成する第1の剰余生成回路と、
前記目的データの前記バッファ領域における前記第1の方向に直交する第2の方向の座標値を前記バッファ領域の前記第2の方向の大きさによって割った剰余を生成する第2の剰余生成回路と、
前記第2の剰余生成回路により生成された値に前記バッファ領域の前記第1の方向の大きさを乗じた値を算出する乗算回路と、
前記第1の剰余生成回路により生成された値と前記乗算回路により算出された値と前記バッファ領域の開始アドレスとを加算して前記目的データの前記メモリ空間におけるアドレスを出力する加算回路と
を具備することを特徴とするアドレス生成回路。 - 前記バッファ領域内の所定領域の開始位置の前記バッファ領域における第1の方向の座標値と前記目的データの前記所定領域における前記第1の方向の座標値とを加算して前記目的データの前記バッファ領域における前記第1の方向の座標値を前記第1の剰余生成回路に供給する第2の加算回路と、
前記バッファ領域内の所定領域の開始位置の前記バッファ領域における前記第1の方向に直交する第2の方向の座標値と前記目的データの前記所定領域における前記第2の方向の座標値とを加算して前記目的データの前記バッファ領域における前記第2の方向の座標値を前記第2の剰余生成回路に供給する第3の加算回路と
をさらに具備することを特徴とする請求項1記載のアドレス生成回路。 - 前記バッファ領域は画像データの一部を保持する画像バッファであり、
前記目的データは前記画像データを構成する画素データである
ことを特徴とする請求項1記載のアドレス生成回路。 - 内部に二次元のバッファ領域を有するメモリと、
前記バッファ領域における目的データの第1の方向の座標値を前記バッファ領域の前記第1の方向の大きさによって割った剰余を生成する第1の剰余生成回路と、
前記目的データの前記バッファ領域における前記第1の方向に直交する第2の方向の座標値を前記バッファ領域の前記第2の方向の大きさによって割った剰余を生成する第2の剰余生成回路と、
前記第2の剰余生成回路により生成された値に前記バッファ領域の前記第1の方向の大きさを乗じた値を算出する乗算回路と、
前記第1の剰余生成回路により生成された値と前記乗算回路により算出された値と前記バッファ領域の開始アドレスとを加算して前記目的データの前記メモリにおけるアドレスを出力する加算回路と
を具備することを特徴とするバッファ回路。 - プロセッサと、前記プロセッサのメモリ空間を記憶するメモリとを備える情報処理装置であって、
前記メモリは、前記メモリ空間上の二次元のバッファ領域を有し、
前記プロセッサは、
前記バッファ領域における目的データの第1の方向の座標値を前記バッファ領域の前記第1の方向の大きさによって割った剰余を生成する第1の剰余生成回路と、
前記目的データの前記バッファ領域における前記第1の方向に直交する第2の方向の座標値を前記バッファ領域の前記第2の方向の大きさによって割った剰余を生成する第2の剰余生成回路と、
前記第2の剰余生成回路により生成された値に前記バッファ領域の前記第1の方向の大きさを乗じた値を算出する乗算回路と、
前記第1の剰余生成回路により生成された値と前記乗算回路により算出された値と前記バッファ領域の開始アドレスとを加算して前記目的データの前記メモリにおけるアドレスを出力する加算回路と
を具備することを特徴とする情報処理装置。 - 撮像手段と、
前記撮像手段によって撮像された画像データの一部を二次元のバッファ領域に保持するメモリと、
前記バッファ領域における目的画素データの第1の方向の座標値を前記バッファ領域の前記第1の方向の大きさによって割った剰余を生成する第1の剰余生成回路と、
前記目的画素データの前記バッファ領域における前記第1の方向に直交する第2の方向の座標値を前記バッファ領域の前記第2の方向の大きさによって割った剰余を生成する第2の剰余生成回路と、
前記第2の剰余生成回路により生成された値に前記バッファ領域の前記第1の方向の大きさを乗じた値を算出する乗算回路と、
前記第1の剰余生成回路により生成された値と前記乗算回路により算出された値と前記バッファ領域の開始アドレスとを加算して前記目的画素データの前記メモリにおけるアドレスを出力する加算回路と
を具備することを特徴とする撮像システム。
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