JP2008141312A - 符号化装置、復号装置、送信機及び受信機 - Google Patents
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Abstract
【解決手段】組織ビット、前記組織ビットに対応する第1冗長ビット及び前記組織ビットに対応する第2冗長ビットを生成する符号化部を有する符号化装置であって、前記組織ビット、前記組織ビットに対応する第1冗長ビット及び前記組織ビットに対応する第2冗長ビットのそれぞれ2つずつから、一方の組織ビットと前記一方の組織ビットに対応する第1冗長ビットとからなる組と、他方の組織ビットと前記他方の組織ビットに対応する第1冗長ビットとからなる組と、前記一方の組織ビットに対応する第2冗長ビットと前記他方の組織ビットに対応する第2冗長ビットとからなる組と、を生成する生成部を備える。
【選択図】図3
Description
すると次のようになる。
MSB:1の確率 PM,1 = ( P1,0 + P0,1 ) = 0.15
LSB:0の確率 PL,0 = ( P0,0 + P1,1 ) = 0.75
LSB:1の確率 PL,1 = ( P0,1 + P1,1 ) = 0.25
これを、更に合成すると、図16に示すように、Ich(In-phase channel)の信号データパターンが(1,1),(1,0),(0,0),(0,1)である確率は、次のように求められる。
P1,0' = PM,1 × PL,0 = 0.1125
P0,0' = PM,0 × PL,0 = 0.6375
P0,1' = PM,0 × PL,1 = 0.2175
この確率は、元々の確率と一致しない。これは、各ビットに分離することによる、ビット間の相関情報の喪失を意味している。畳み込み符号、ターボ符号といった誤り訂正は冗長なビットを含むビット系列として機能するため、各ビットに信号を分離することで特性の劣化を招く。特性の劣化を防ぐには、16QAMの場合、2ビット毎に信号が送信されるため、2ビット毎に信号を処理することが望ましい。
またはQ成分ベース)とする(図19:1bit)と、ビットベースでターボ復号を行い、ビットベースのインターリーブをした場合(図19:1‐bit,S‐P pair)に比べ、特性が劣化する。シンボルベースのインターリーブをすることで、第1パリティビットと第2パリティビットとの相関がよくなり、ノイズに対して弱くなるからである。しかし、シンボルベースでターボ符号を行い、シンボルベースのインターリーブとする(図19:2‐bit)と、ビットベースでターボ復号を行い、ビットベースのインターリーブをした場合(図19:1‐bit,S‐P pair)の特性より良い特性となる。
0)と比べて2倍のパターンを記憶する必要がある。多値数が更に多い場合、記憶すべきパターン数は指数関数的に増大する。図22のように、例えば256QAMの場合、I成分及びQ成分共に4ビットが1つのまとまりとなり、1度に16(=24)通りのパター
ンを比較、記憶することになる。このため、多値数が多いシンボルベースのターボ符号では、非常に大きなメモリが必要となる。
組織ビット、前記組織ビットに対応する第1冗長ビット及び前記組織ビットに対応する第2冗長ビットを生成する符号化部を有する符号化装置であって、
前記組織ビット、前記組織ビットに対応する第1冗長ビット及び前記組織ビットに対応する第2冗長ビットのそれぞれ2つずつから、
一方の組織ビットと前記一方の組織ビットに対応する第1冗長ビットとからなる組と、
他方の組織ビットと前記他方の組織ビットに対応する第1冗長ビットとからなる組と、
前記一方の組織ビットに対応する第2冗長ビットと前記他方の組織ビットに対応する第2冗長ビットとからなる組と、を生成する生成部、
を備える符号化装置である。
組織ビット、前記組織ビットに対応する第1冗長ビット及び前記組織ビットに対応する第2冗長ビットを生成する符号化部を有する符号化装置であって、
前記組織ビット、前記第1冗長ビット及び前記第2冗長ビットのそれぞれ2n個ずつか
ら、
任意のn個の組織ビットと前記任意のn個の組織ビットに対応するn個の第1冗長ビットとからなる組と、
前記任意のn個の組織ビット以外のn個の組織ビットと前記任意のn個の組織ビット以外のn個の組織ビットに対応するn個の第1冗長ビットとからなる組と、
前記2n個の第2冗長ビットからなる組と、を生成する生成部、
を備える符号化装置である。
組織ビットと前記組織ビットに対応する第1冗長ビットとからなる組が2組と、
前記2組のそれぞれの前記組織ビットに対応する第2冗長ビットからなる組と、が入力される復号装置であって、
前記各組単位の尤度を算出する算出部と、
前記組織ビットと前記組織ビットに対応する第1冗長ビットとからなる組の尤度を使用して1つの組織ビット毎に復号する第1復号部と、
前記第1復号部が出力する前記組織ビットの尤度と、前記組織ビットに対応する第2冗長ビットからなる組の尤度を使用して2つの組織ビット毎に復号する第2復号部と、
を備える復号装置である。
〈システム構成〉
図1は、実施形態における受信機と送信機の構成例を示す。送信機10は、入力データを符号化するベースバンド部100と、ベースバンド部100からの送信データを無線周波数にアップコンバートするRF部200と、送信アンテナ250とを備える。受信機20は、受信アンテナ250と、受信した信号を無線周波数からダウンコンバートするRF部400と、RF部400からの受信データを復号するベースバンド部300とを備える。
図2は、送信機のベースバンド部100を詳細に説明する図である。ベースバンド部100は、ターボ符号化部150、シンボルマッピング部110を備える。ターボ符号化部150は、2つの符号化部102及び104、インターリーバ120を備える。
図1に示したように、受信機20は、受信アンテナ250と、受信した信号を無線周波数からダウンコンバートするRF部400と、RF部400からの受信データを復号するベースバンド部300とを備える。
備える。
図6は、受信機10のベースバンド部300の受信信号処理部360の構成例を示す図である。受信信号処理部360は、受信信号の基準振幅を算出する基準振幅算出部362と、受信信号の干渉電力を算出する干渉電力算出部364と、受信信号、基準振幅、干渉電力から尤度を算出する尤度算出部366を備える。
が遠い信号点ほど、log尤度は小さくなる。
図8は、受信機20のベースバンド部300のターボ復号部350を示す図である。ターボ復号部350は、2つのMAP302、304、加算部312、314、インターリーバ322、デインターリーバ324、及び、組織ビット成分抽出部326を備える。
ビットの尤度を減算する。MAP2(304)の出力には、MAP2(304)に入力した尤度の影響が含まれるので、その影響を除去するためである。
図9は、MAPにおける尤度の算出方法を示す図である。
ット)が(i、j)を取り得る尤度である。
求められる。
図10は、組織ビットとパリティビットとを同じシンボルにマッピングしたターボ復号の例を示す図である。図10の上部はMAP1(302)の処理を示し、下部はMAP2(304)の処理を示す。
つのシンボルに2つの組織ビットが入るためである。また、MAP2では、4つの第2パリティビットが1つのシンボルにマッピングされているため、4つの組織ビット分ずつ処理される。また、インターリーブもこの単位で行われる。従来の256QAMのシンボルベースのターボ符号では、どちらのMAPでも、4つの組織ビット分ずつ処理されていたため、メモリ使用量が多くなっていた。本実施形態では、従来に比べて1度に処理する量が少ないので、メモリ使用量を削減することができる。
次にターボ復号の変形例を示す。上述した(ターボ復号1)と異なる部分について説明する。
図12は、本実施形態の特性を示す図である。図12の横軸はSN比(SNR;Signal
Noise Ratio)であり、縦軸はBLER(Block Error Ratio)である。組織ビットと第
1パリティビットとの相関を維持し、ビットベース及びシンボルベースでターボ符号を行い、ビットベースのインターリーブをした場合(ターボ復号1、図12:2bit,S‐P pair,P2 2‐bit)と、組織ビットと第1パリティビットとの相関を維持し、第2パリティビットのシンボルを分割し、ビットベースでターボ符号を行い、ビットベースでインターリーブした場合(ターボ復号2、図12:2bit,S‐P pair)と、の特性グラフである。他の3本のグラフは、図19のものと同一である。
上記した実施形態は、以下の発明を開示する。以下の発明は、必要に応じて適宜組み合わせることができる。
組織ビット、前記組織ビットに対応する第1冗長ビット及び前記組織ビットに対応する第2冗長ビットを生成する符号化部を有する符号化装置であって、
前記組織ビット、前記組織ビットに対応する第1冗長ビット及び前記組織ビットに対応する第2冗長ビットのそれぞれ2つずつから、
一方の組織ビットと前記一方の組織ビットに対応する第1冗長ビットとからなる組と、
他方の組織ビットと前記他方の組織ビットに対応する第1冗長ビットとからなる組と、
前記一方の組織ビットに対応する第2冗長ビットと前記他方の組織ビットに対応する第2冗長ビットとからなる組と、を生成する生成部
を備える符号化装置。(1)
(付記2)
組織ビット、前記組織ビットに対応する第1冗長ビット及び前記組織ビットに対応する第2冗長ビットを生成する符号化部を有する符号化装置であって、
前記組織ビット、前記第1冗長ビット及び前記第2冗長ビットのそれぞれ2n個ずつから、
任意のn個の組織ビットと前記任意のn個の組織ビットに対応するn個の第1冗長ビットとからなる組と、
前記任意のn個の組織ビット以外のn個の組織ビットと前記任意のn個の組織ビット以外のn個の組織ビットに対応するn個の第1冗長ビットとからなる組と、
前記2n個の第2冗長ビットからなる組と、を生成する生成部、
を備える符号化装置。(2)
(付記3)
組織ビットと前記組織ビットに対応する第1冗長ビットとからなる組が2組と、
前記2組のそれぞれの前記組織ビットに対応する第2冗長ビットからなる組と、が入力
される復号装置であって、
前記各組単位の尤度を算出する算出部と、
前記組織ビットと前記組織ビットに対応する第1冗長ビットとからなる組の尤度を使用して1つの組織ビット毎に復号する第1復号部と、
前記第1復号部が出力する前記組織ビットの尤度と、前記組織ビットに対応する第2冗長ビットからなる組の尤度を使用して2つの組織ビット毎に復号する第2復号部と、
を備える復号装置。(3)
(付記4)
組織ビットと前記組織ビットに対応する第1冗長ビットとからなる組が2組と、
前記2組のそれぞれの前記組織ビットに対応する第2冗長ビットからなる組と、が入力される復号装置であって、
前記各組単位の尤度、及び、前記第2冗長ビットの各ビット単位の尤度を算出する算出部と、
前記組織ビットと前記組織ビットに対応する第1冗長ビットとからなる組の尤度を使用して1つの組織ビット毎に復号する第1復号部と、
前記第1復号部が出力する前記組織ビットの尤度と、前記第2冗長ビットの各ビット単位の尤度を使用して1つの組織ビット毎に復号する第2復号部と、
を備える復号装置。(4)
(付記5)
n個の組織ビットと前記n個の組織ビットに対応するn個の第1冗長ビットとからなる組が2組と、
前記2組のそれぞれの前記組織ビットに対応する2n個の第2冗長ビットからなる組と、が入力される復号装置であって、
前記各組単位の尤度を算出する算出部と、
n個の組織ビットと前記n個の組織ビットに対応するn個の第1冗長ビットとからなる組の2組の尤度を使用してn個の組織ビット毎に復号する第1復号部と、
前記第1復号部が出力する前記2n個の組織ビットの尤度と、前記2組のそれぞれの前記組織ビットに対応する2n個の第2冗長ビットからなる組の尤度を使用して2n個の組織ビット毎に復号する第2復号部と、
を備える復号装置。(5)
(付記6)
n個の組織ビットと前記n個の組織ビットに対応するn個の第1冗長ビットとからなる組が2組と、
前記2組のそれぞれの前記組織ビットに対応する2n個の第2冗長ビットからなる組と、が入力される復号装置であって、
前記各組単位の尤度、及び、前記n個の組織ビットに対応する前記第2冗長ビットのnビット単位の尤度を算出する算出部と、
前記組織ビットと前記組織ビットに対応する第1冗長ビットとからなる組の尤度を使用してn個の組織ビット毎に復号する第1復号部と、
前記第1復号部が出力する前記組織ビットの尤度と、前記第2冗長ビットの各ビット単位の尤度を使用してn個の組織ビット毎に復号する第2復号部と、
を備える復号装置。
組織ビット、前記組織ビットに対応する第1冗長ビット及び前記組織ビットに対応する第2冗長ビットを生成する符号化部を有し、多値変調方式の複数ビットからなるシンボルを生成して送信する送信機であって、
前記組織ビット、前記組織ビットに対応する第1冗長ビット及び前記組織ビットに対応する第2冗長ビットのそれぞれ2つずつから、
一方の組織ビットと前記一方の組織ビットに対応する第1冗長ビットとからなるシンボ
ルと、
他方の組織ビットと前記他方の組織ビットに対応する第1冗長ビットとからなるシンボルと、
前記一方の組織ビットに対応する第2冗長ビットと前記他方の組織ビットに対応する第2冗長ビットとからなるシンボルと、を生成する生成部、
を有する符号化処理部を備える送信機。
組織ビット、前記組織ビットに対応する第1冗長ビット及び前記組織ビットに対応する第2冗長ビットを生成する符号化部を有し、多値変調方式の複数ビットからなるシンボルを生成して送信する送信機であって、
前記組織ビット、前記第1冗長ビット及び前記第2冗長ビットのそれぞれ2n個ずつから、
任意のn個の組織ビットと前記任意のn個の組織ビットに対応するn個の第1冗長ビットとからなるシンボルと、
前記任意のn個の組織ビット以外のn個の組織ビットと前記任意のn個の組織ビット以外のn個の組織ビットに対応するn個の第1冗長ビットとからなるシンボルと、
前記2n個の第2冗長ビットからなるシンボルと、を生成する生成部、
を有する符号化処理部を備える送信機。
多値変調方式の複数ビットからなるシンボルを受信して復調し、
組織ビットと前記組織ビットに対応する第1冗長ビットとからなるシンボルが2シンボルと、
前記2シンボルのそれぞれの前記組織ビットに対応する第2冗長ビットからなるシンボルと、が入力される受信機であって、
前記各シンボル単位の尤度を算出する算出部と、
前記組織ビットと前記組織ビットに対応する第1冗長ビットとからなるシンボルの尤度を使用して1つの組織ビット毎に復号する第1復号部と、
前記第1復号部が出力する前記組織ビットの尤度と、前記組織ビットに対応する第2冗長ビットからなるシンボルの尤度を使用して2つの組織ビット毎に復号する第2復号部と、
を有する復号処理部を備える受信機。
多値変調方式の複数ビットからなるシンボルを受信して復調し、
組織ビットと前記組織ビットに対応する第1冗長ビットとからなるシンボルが2シンボルと、
前記2シンボルのそれぞれの前記組織ビットに対応する第2冗長ビットからなるシンボルと、が入力される受信機であって、
前記各シンボル単位の尤度、及び、前記第2冗長ビットの各ビット単位の尤度を算出する算出部と、
前記組織ビットと前記組織ビットに対応する第1冗長ビットとからなるシンボルの尤度を使用して1つの組織ビット毎に復号する第1復号部と、
前記第1復号部が出力する前記組織ビットの尤度と、前記第2冗長ビットの各ビット単位の尤度を使用して1つの組織ビット毎に復号する第2復号部と、
を有する復号処理部を備える受信機。
多値変調方式の複数ビットからなるシンボルを受信して復調し、
n個の組織ビットと前記n個の組織ビットに対応するn個の第1冗長ビットとからなるシンボルが2シンボルと、
前記2シンボルのそれぞれの前記組織ビットに対応する2n個の第2冗長ビットからなるシンボルと、が入力される受信機であって、
前記各シンボル単位の尤度を算出する算出部と、
n個の組織ビットと前記n個の組織ビットに対応するn個の第1冗長ビットとからなるシンボルの2シンボルの尤度を使用してn個の組織ビット毎に復号する第1復号部と、
前記第1復号部が出力する前記2n個の組織ビットの尤度と、前記2シンボルのそれぞれの前記組織ビットに対応する2n個の第2冗長ビットからなるシンボルの尤度を使用して2n個の組織ビット毎に復号する第2復号部と、
を有する復号処理部を備える受信機。
多値変調方式の複数ビットからなるシンボルを受信して復調し、
n個の組織ビットと前記n個の組織ビットに対応するn個の第1冗長ビットとからなるシンボルが2シンボルと、
前記2シンボルのそれぞれの前記組織ビットに対応する2n個の第2冗長ビットからなるシンボルと、が入力される受信機であって、
前記各シンボル単位の尤度、及び、前記n個の組織ビットに対応する前記第2冗長ビットのnビット単位の尤度を算出する算出部と、
前記組織ビットと前記組織ビットに対応する第1冗長ビットとからなるシンボルの尤度を使用してn個の組織ビット毎に復号する第1復号部と、
前記第1復号部が出力する前記組織ビットの尤度と、前記第2冗長ビットの各ビット単位の尤度を使用してn個の組織ビット毎に復号する第2復号部と、
を有する復号処理部を備える受信機。
20 受信機
100 送信機のベースバンド部
102 符号化部
104 符号化部
110 シンボルマッピング部
120 インターリーバ
150 ターボ符号部
200 RF部
250 送信アンテナ
300 受信機のベースバンド部
302 MAP1
304 MAP2
312 加算部
314 加算部
322 インターリーバ
324 デインターリーバ
326 組織ビット成分抽出部
350 ターボ復号部
360 受信信号処理部
362 基準振幅算出部
364 干渉電力算出部
366 尤度算出部
400 RF部
450 受信アンテナ
Claims (5)
- 組織ビット、前記組織ビットに対応する第1冗長ビット及び前記組織ビットに対応する第2冗長ビットを生成する符号化部を有する符号化装置であって、
前記組織ビット、前記組織ビットに対応する第1冗長ビット及び前記組織ビットに対応する第2冗長ビットのそれぞれ2つずつから、
一方の組織ビットと前記一方の組織ビットに対応する第1冗長ビットとからなる組と、
他方の組織ビットと前記他方の組織ビットに対応する第1冗長ビットとからなる組と、
前記一方の組織ビットに対応する第2冗長ビットと前記他方の組織ビットに対応する第2冗長ビットとからなる組と、を生成する生成部、
を備える符号化装置。 - 組織ビット、前記組織ビットに対応する第1冗長ビット及び前記組織ビットに対応する第2冗長ビットを生成する符号化部を有する符号化装置であって、
前記組織ビット、前記第1冗長ビット及び前記第2冗長ビットのそれぞれ2n個ずつから、
任意のn個の組織ビットと前記任意のn個の組織ビットに対応するn個の第1冗長ビットとからなる組と、
前記任意のn個の組織ビット以外のn個の組織ビットと前記任意のn個の組織ビット以外のn個の組織ビットに対応するn個の第1冗長ビットとからなる組と、
前記2n個の第2冗長ビットからなる組と、を生成する生成部、
を備える符号化装置。 - 組織ビットと前記組織ビットに対応する第1冗長ビットとからなる組が2組と、
前記2組のそれぞれの前記組織ビットに対応する第2冗長ビットからなる組と、が入力される復号装置であって、
前記各組単位の尤度を算出する算出部と、
前記組織ビットと前記組織ビットに対応する第1冗長ビットとからなる組の尤度を使用して1つの組織ビット毎に復号する第1復号部と、
前記第1復号部が出力する前記組織ビットの尤度と、前記組織ビットに対応する第2冗長ビットからなる組の尤度を使用して2つの組織ビット毎に復号する第2復号部と、
を備える復号装置。 - 組織ビットと前記組織ビットに対応する第1冗長ビットとからなる組が2組と、
前記2組のそれぞれの前記組織ビットに対応する第2冗長ビットからなる組と、が入力される復号装置であって、
前記各組単位の尤度、及び、前記第2冗長ビットの各ビット単位の尤度を算出する算出部と、
前記組織ビットと前記組織ビットに対応する第1冗長ビットとからなる組の尤度を使用して1つの組織ビット毎に復号する第1復号部と、
前記第1復号部が出力する前記組織ビットの尤度と、前記第2冗長ビットの各ビット単位の尤度を使用して1つの組織ビット毎に復号する第2復号部と、
を備える復号装置。 - n個の組織ビットと前記n個の組織ビットに対応するn個の第1冗長ビットとからなる組が2組と、
前記2組のそれぞれの前記組織ビットに対応する2n個の第2冗長ビットからなる組と、が入力される復号装置であって、
前記各組単位の尤度を算出する算出部と、
n個の組織ビットと前記n個の組織ビットに対応するn個の第1冗長ビットとからなる
組の2組の尤度を使用してn個の組織ビット毎に復号する第1復号部と、
前記第1復号部が出力する前記2n個の組織ビットの尤度と、前記2組のそれぞれの前記組織ビットに対応する2n個の第2冗長ビットからなる組の尤度を使用して2n個の組織ビット毎に復号する第2復号部と、
を備える復号装置。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2006323436A JP4675312B2 (ja) | 2006-11-30 | 2006-11-30 | 符号化装置、復号装置、送信機及び受信機 |
EP07121836A EP1931036A3 (en) | 2006-11-30 | 2007-11-29 | Coding device, decoding device, transmitter and receiver |
US11/987,335 US8000403B2 (en) | 2006-11-30 | 2007-11-29 | Coding device, decoding device, transmitter and receiver |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2006323436A JP4675312B2 (ja) | 2006-11-30 | 2006-11-30 | 符号化装置、復号装置、送信機及び受信機 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2008141312A true JP2008141312A (ja) | 2008-06-19 |
JP4675312B2 JP4675312B2 (ja) | 2011-04-20 |
Family
ID=39315155
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2006323436A Expired - Fee Related JP4675312B2 (ja) | 2006-11-30 | 2006-11-30 | 符号化装置、復号装置、送信機及び受信機 |
Country Status (3)
Country | Link |
---|---|
US (1) | US8000403B2 (ja) |
EP (1) | EP1931036A3 (ja) |
JP (1) | JP4675312B2 (ja) |
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JP4618977B2 (ja) | 2000-11-22 | 2011-01-26 | ノーテル・ネットワークス・リミテッド | 時空間トレリス符号化方法およびその装置 |
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-
2006
- 2006-11-30 JP JP2006323436A patent/JP4675312B2/ja not_active Expired - Fee Related
-
2007
- 2007-11-29 US US11/987,335 patent/US8000403B2/en not_active Expired - Fee Related
- 2007-11-29 EP EP07121836A patent/EP1931036A3/en not_active Withdrawn
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Also Published As
Publication number | Publication date |
---|---|
EP1931036A3 (en) | 2009-06-24 |
US8000403B2 (en) | 2011-08-16 |
US20080130784A1 (en) | 2008-06-05 |
JP4675312B2 (ja) | 2011-04-20 |
EP1931036A2 (en) | 2008-06-11 |
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Date | Code | Title | Description |
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A621 | Written request for application examination |
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|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20101021 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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|
A61 | First payment of annual fees (during grant procedure) |
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|
FPAY | Renewal fee payment (event date is renewal date of database) |
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