JP2008125120A - 符号化装置 - Google Patents
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Abstract
【解決手段】所定の順序で復号される複数の符号化データを生成する符号化手段と、前記符号化手段が生成した前記符号化データを記憶する記憶手段と、前記記憶手段から前記符号化データを読み出して復号先に送信する制御手段とを有し、前記制御手段は、前記符号化手段が生成した前記複数の符号化データのうち最初の前記符号化データを前記記憶手段に書き込んでから読み出して復号先に送信するまでの第1の遅延時間を決定し前記復号先で前記複数の符号化データのうち最初の前記符号化データを受信してから当該最初の符号化データを復号に供するまでの第2の遅延時間を決定することを特徴とする符号化装置。
【選択図】図1
Description
エンコードシステムの設計者は、そのモデルによって適切に処理されるストリームを生成するように、エンコードシステムの設計を試みる。
また、技術者は、このモデルを基にデコードシステムを設計し、しばしば、そのデコーダをHRDの動作にできる限り近いものになるように努める。そのようなモデルは、正確に実現できない理想的な動作や動作を有する場合があり、デコーダの設計技術者は、理想的でない特性および理想的でない動作を補償する手段を付加する必要がある。
t=0における、tai(0)=0と、デコーダのバッファの満杯状態を示すデコーダバッファフルネス(decoder_buffer_fullness(t) と呼ぶ) は:
decoder _buffer_fullness(0) ビット
である。
続くピクチャがデコーダのバッファに到達する時間を示す到達時間は、以下の式(1)で規定される。
しかしながら、それは最近、式(3)のように変更された。
前述した式(1)で定義されるように各ピクチャがデコーダに最初に到達する初期到達時間は、デコーダへのデータの入力を示す曲線Kのある点として得られる。
デコーダバッファからデータが出力することを示すデコーダバッファ出力曲線Lは、pb_removal_delayフィールドおよびinitial_cpb_removal_delayで示されるタイングに対応している。
図4に記述された変数の幾つかは、ビットストリームに格納されて伝送され、他の変数は(ドラフト(草案)の)規格内に記述されているだけである。下記表1は、これらの変数をさらに詳しく説明している。
この場合、これらは、単に、例えば、バッファモデル0などの一つの所定のモデルの変数である。
このモデル自体は複雑である。
前述した表1に示されるように、ビットストリーム内に比較的多数のフィールドのデータをエンコードおよび挿入するという要求がある。これは、ビットストリームのオーバヘッドを増大させる。
これらのフィールドのデータを演算して生成するために、例えば、図2に示すように、比較的複雑な構成を有するエンコーダを実現する必要がある。その結果、図6に示すように、比較的複雑な処理を遂行するデコーダを実現する必要がある。
しかしながら、多くのアプリケーションにおいて、1回のみエンコード処理を行う1パス方式のエンコーダは、エンコード処理の開始で、decodering_delayの適切な値を設定することができない。
本発明は、前記バッファモデルの非ゼロ開始時間(バッファへのデータの入力の開始時間がゼロではない)を用いた符号化装置に関する。
本発明は、前記バッファモデルに対しての非ゼロバッファフルネス(バッファが満杯になる時間(ゼロ)ではないこと)を用いた符号化装置に関する。
本発明は、デコード遅延パラメータを選択的に送信する選択送信(伝送)符号化装置に関する。
可変ビットレート・タイミングモデルは、ビデオデータなどのデータを符号化するエンコードシステムの設計者およびデコードシステムの設計者が相互運用を行うための参考となるように規定されている。このモデルは、所定の非ゼロ特性(バッファへのデータの入力の時間がゼロではないと言う特性)を用いて、ビットストリームの連続再生を行えるように初期化可能である。所定のタイミング情報は隠蔽され(conceal)、実行の複雑さおよびビットオーバヘッドを削減している。
(1)本発明のバッファモデルは簡略化される。
(2)initial_cpb_removal_delay_offsetが冗長になり、そのため、ビットストリームのオーバヘッドが低減される。
(3)本発明のエンコーダはこれらのフィールドを計算およびエンコードする必要がない。
(4)本発明のデコーダは、これらのフィールドをデコードおよび処理しない。
(5)本発明のモデルは、ランダムアクセスシナリオをサポートするのに適している。
(6)本発明のエンコーダは、ストリームの開始時に、decodering_delay(decoding_delay)を決定する必要がない。
タイミングイベントに関係する所定のデコーダをシフトする(デコードする時間をずらす)代わりに、時間ベース自体のシフトが、デコードすべき最初のピクチャの最初のビットに対してのゼロ到達時間(到達時間が0)より長い時間、許容して行われる。
このことは、下記式(6)で示される。
続くピクチャの到達時間についての式(7)は、従来技術においてもそのまま規定されている、例えば、
tai(n)>=taf(n−1)
すなわち、tai(n)>=taf(n−1)は、エンコーダバッファが空の場合に許可される。
(デコーダバッファがアンダーフローあるいはオーバーフローしないというその他の制約は以前として適用される)
Claims (2)
- 所定の順序で復号される複数の符号化データを生成する符号化手段と、
前記符号化手段が生成した前記符号化データを記憶する記憶手段と、
前記記憶手段から前記符号化データを読み出して復号先に送信する制御手段とを有し、
前記制御手段は、前記符号化手段が生成した前記複数の符号化データのうち最初の前記符号化データを前記記憶手段に書き込んでから読み出して復号先に送信するまでの第1の遅延時間を決定し、
前記復号先で前記複数の符号化データのうち最初の前記符号化データを受信してから当該最初の符号化データを復号に供するまでの第2の遅延時間を決定
することを特徴とする符号化装置。 - 前記制御手段は、前記第2の遅延時間を示す遅延時間情報を前記復号先に送信し、前記決定した第1の遅延時間を基に、前記最初の符号化データを前記復号先に送信
することを特徴とする請求項1記載の符号化装置。
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