JP2008103533A - 半導体装置用トレイと実装機 - Google Patents
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Abstract
【課題】簡単な構成により誤収納を防止した半導体装置用トレイ及びトレイ誤搭載を防止した実装機を提供する。
【解決手段】外周枠によって囲まれ、格子状に区画された半導体装置収納部を設ける。上記外周壁は、上部外周壁12と下部外周壁11とに分けられ、上記上部外周壁12の外側は、下部外周壁11の内側よりも小さくされて、他の同様な半導体装置用トレイの上記下部外周壁11を嵌合して積み重ね可能にされる。上記外周壁の一部に、上記下部外周壁11外側が上記上部外周壁12内側よりも内側に至る凹部3又は、上記上部外周壁12内側が上記下部外周壁11外側よりも外側に至る凸部5を有する。実装機は、上記半導体装置用トレイが搭載可能な部品収納部を備える。上記部品収納部は、上記半導体装置用トレイの凹部3又は凸部5と嵌合される凸部又は凹部を持つスライド治具4を有する。
【選択図】図1
【解決手段】外周枠によって囲まれ、格子状に区画された半導体装置収納部を設ける。上記外周壁は、上部外周壁12と下部外周壁11とに分けられ、上記上部外周壁12の外側は、下部外周壁11の内側よりも小さくされて、他の同様な半導体装置用トレイの上記下部外周壁11を嵌合して積み重ね可能にされる。上記外周壁の一部に、上記下部外周壁11外側が上記上部外周壁12内側よりも内側に至る凹部3又は、上記上部外周壁12内側が上記下部外周壁11外側よりも外側に至る凸部5を有する。実装機は、上記半導体装置用トレイが搭載可能な部品収納部を備える。上記部品収納部は、上記半導体装置用トレイの凹部3又は凸部5と嵌合される凸部又は凹部を持つスライド治具4を有する。
【選択図】図1
Description
この発明は、半導体装置用トレイと実装機(マウンター)に適用して有効な技術に関し、例えばパッケージの大きさが同じとされる複数通りの半導体装置に共用されるものに利用して有効な技術に関するものである。
半導体装置用トレイは、外周枠に設けられたリブによって格子状に区画された半導体装置収納部を有している。上記半導体装置収納部には、それに適合された半導体装置が搭載され、かかる半導体装置の出荷搬送時に用いられ、そのまま実装機に搭載されて自動実装に供される。このようなトレイに関しては、例えば特開平11−349087号公報、特開2005−067693号公報があり、実装機による部品実装方法に関しては、例えば特開2006−140255号公報がある。また、トレイ設計基準としてJEDEC規格がある。
特開平11−349087号公報
特開2005−067693号公報
特開2006−140255号公報
トレイ設計基準であるJEDEC(Joint Electron Device Engineering Council)規格では、各部のサイズ等が細かく決められているだけである。半導体装置は、様々な大きさ及び形態のパッケージに関する規格が用意されている。例えば、BGA、LGA、SOPあるいはQFPのように外観が異なるパッケージでも同じ大きさのものが存在するので、誤って本来とは異なるトレイに収納して出荷してしまうことがある。更に、QFPパッケージでは、厚みのみが2.7mm、1.4mm及び1.0mmのように異なる複数通りのパッケージ(QFP,LQFP及びTQFP)があり、それぞれを区別してトレイに収納して出荷するには細心の注意が必要である。また、半導体装置が正しく適合したトレイに収納されて出荷されても、それぞれの見分けが難しいので実装機に搭載する際に誤って別の半導体装置が収納されたトレイを搭載してしまうことにより、誤った実装を行ってしまうという問題を有する。そこで、本願発明者においては、半導体装置の誤収納、あるいは実装機への誤搭載を防止した半導体装置用トレイ及び実装機の開発に至った。
この発明の目的は、簡単な構成により誤収納を防止した半導体装置用トレイ及びトレイ誤搭載を防止した実装機を提供することにある。この発明の前記ならびにそのほかの目的と新規な特徴は、本明細書の記述および添付図面から明らかになるであろう。
本願において開示される発明のうち代表的なものの概要を簡単に説明すれば、下記の通りである。すなわち、外周枠によって囲まれ、格子状に区画された半導体装置収納部を設ける。上記外周壁は、上部外周壁と下部外周壁とに分けられ、上記上部外周壁の外側は、下部外周壁の内側よりも小さくされて、他の同様な半導体装置用トレイの上記下部外周壁を嵌合して積み重ね可能にされる。上記外周壁の一部に、上記下部外周壁外側が上記上部外周壁外側よりも内側に至る凹部又は、上記上部外周壁外側が上記下部外周壁外側よりも外側に至る凸部を有する。
本願において開示される発明のうち他の代表的なものの概要を簡単に説明すれば、下記の通りである。すなわち、半導体装置用トレイとして、外周枠によって囲まれ、格子状に区画された半導体装置収納部を設ける。上記外周壁は、上部外周壁と下部外周壁とに分けられ、上記上部外周壁の外側は、下部外周壁の内側よりも小さくされて、他の同様な半導体装置用トレイの上記下部外周壁を嵌合して積み重ね可能にされる。上記外周壁の一部に、上記下部外周壁外側が上記上部外周壁外側よりも内側に至る凹部又は、上記上部外周壁外側が上記下部外周壁外側よりも外側に至る凸部を有する。実装機は、上記半導体装置用トレイが搭載可能な部品収納部を備える。上記部品収納部は、上記半導体装置用トレイの凹部又は凸部と嵌合される凸部又は凹部を持つスライド治具を有する。
上記凹部又は凸部により異なる種類のトレイの嵌合による積み重ねが不可能になり、かかる凹部又は凸部の位置及び数により使用するトレイの区別及び異種混合が防止できる。実装機において、上記凹部又は凸部に対応した凸部又は凹部を持つスライド治具により異なるトレイの搭載を防止できる。
図1には、この発明に係る半導体装置用トレイの一実施例の平面図が示されている。半導体装置用トレイは、長方形からなる外壁部1と、短辺側の両側に設けられた把手部2及び識別用の凹部(切欠)3を有する。上記外壁部1は、トレイ設計基準であるJEDEC規格に適合するよう形成される。上記外壁部1は、脚部又はスカート部とも呼ばれるものであり、かかる外壁部1に対して内側に格子状にリブが設けられて半導体装置の収納部が形成される。この収納部は、収納される半導体装置の大きさに対応して上記格子状に形成される図示しないリブによって個々の半導体装置を収納する収納部が構成される。
図2には、この発明に係る半導体装置用トレイの一実施例の平面図及び側面図が示されている。側面図は、長手方向の側面及び短手方向の側面がそれぞれ示されている。上記外壁部1により設けられたリブにより1つの半導体装置の収納部は、4×10のように区分けされている。外壁部1は、下部外壁部11と上部外壁部12に分けられている。上部外壁部12の外側周囲は、下部外周壁11の内側周囲よりも小さくされて、他の同様な半導体装置用トレイの上記下部外周壁11を嵌合して積み重ね可能にされる。つまり、上側トレイの上記下部外壁部11は、下側トレイの上部外壁部12に嵌め込んで多段積み重ね可能とされる。このような積み重ね可能であるという条件を満足させつつ、上記外周壁1(11,12)の一部に、上記下部外周壁11の外側が上記上部外周壁12の外側よりも内側に至る凹部3が設けられる。特に制限されないが、上記凹部3の形状は、半円形にされる。
JEDEC規格では、上記4×10のような収納部のうち*印を付した6箇所は、穴無しとされる(6positions without holes)。また、図3の一部拡大図に示したように、トレイの1つの角には、トレイインデックスが設けられる。このトレイインデックスを基準にしてトレイの方向が決められる。このトレイインデックスを基準にして、収納部に収納される半導体装置のICインディックスの位置が決められる。つまり、トレイのインディックス(図2の右下部、図3の左下部)に対して半導体装置(IC)の1ピンが同じ方向(図3では左下)になるように配列させて収納される。
図4には、この発明に係る半導体装置用トレイの凹部の一実施例の説明図が示されている。同図には、外壁部1と凹部3の外観とそれぞれに対応した断面Bと断面Aが対応して示されている。外壁部1は、下部外壁部11と上部外壁部12から構成される。このような外壁部1の切欠部としての凹部3が設けられる。この凹部3は、半円形とされる。凹部3の下部外周壁11’と上部外壁部12’は、上記断面Bに対応した外壁部1の下部外壁部11と上部外壁部12に対応してそれぞれ同様に切欠部が設けられる。この実施例では、最大切欠量、つまり上記断面Aにおいて下部外壁部11' の外側は、上記上部外壁部12の外側よりも内側となるようにされる。同図では、下部外壁部11' の外側は、上記上部外壁部12の外側よりも内側となるよう、上記上部外壁部12の内側よりも内側となるようにされる。上記外壁部1は、一定の幅の天面13を有している。
JEDEC規格では、上記外壁部1の全体の高さは、7.62mmとされ、そのうち上部外壁部12(12’)の高さは、1.27mmのように決められている。同図では、発明の理解を容易にするために、上記下部外壁部11,11’と上部外壁部12,12’は、上記のような実際の長さの比率とは異なるほぼ同じ比率で示されている。
図5には、この発明に係る半導体装置用トレイを2段積み重ねた状態の説明図が示されている。同図は、前記図4と同様に外壁部1と凹部3の外観とそれぞれに対応した断面Bと断面Aが対応して示されている。同図においては、同じ種類の2つのトレイ、つまりは同じ位置に上記凹部3が設けられた2つのトレイが積み重ねられた状態を示している。このように同じ位置に凹部3が設けられた2つのトレイは、上記凹部3を含んで上側トレイの上記下部外壁部11,11’は、下側トレイの上部外壁部12,12’に嵌め込んで多段積み重ね可能とされる。このような積み重ねを可能にするためには、上記下部下部外壁部11,11’の高さが、上記JEDEC規格のように上記上部外壁部12,12’よりも高いことが必要である。
図6には、この発明に係る半導体装置用トレイを2段積み重ねた状態の説明図が示されている。同図は、前記図4と同様に外壁部1と凹部3の外観とそれぞれに対応した断面Bと断面Aが対応して示されている。同図においては、異なる種類の2つのトレイ、つまりは異なる位置に上記凹部3が設けられた2つのトレイが積み重ねられた状態を示している。このように異なる位置に凹部3が設けられた2つのトレイは、前記図5のように上記凹部3を含んで上側トレイの上記下部外壁部11,11’は、下側トレイの上部外壁部12,12’に嵌め込んで多段積み重ねることが不可能とされる。つまり、上側トレイの凹部3の外側外壁部11’が下側トレイにおいて同じ位置に凹部3が無くことによりの天面13に接触して前記のような嵌合ができなくなる。
上記のような凹部3を形成する位置をトレイの種類毎に変えること、あるいはその数を複数設けることなどを組み合わせることにより、同じもの同士のみが前記多段での積み重ねが可能にされる。このような構成により、異なる種類のトレイを容易に識別することができるので、例えば、BGA、LGA、SOPあるいはQFPのように外観が異なるパッケージでも同じ大きさのものが存在して、それぞれに異なる種類のトレイを割り当てるようにすることにより、誤って本来とは異なるトレイに収納して出荷してしまうことを簡単に防止することができる。特に、QFPパッケージのように、厚みのみが異なる複数通りのパッケージ(QFP,LQFP及びTQFP)のトレイの識別も容易となる。
図7には、この発明が適用される実装機の一実施例の説明図が示されている。実装機(マウンター)は、部品収納部を有する。部品収納部は、同図に拡大透視図として示されているように、前記のようにそれぞれに半導体装置が収納され、積み重ねられた複数のトレイ(外壁1がトレイの代表として示されている)が収納(装着)される。このように装着されたトレイ束の下部(又は上部)からトレイ1を1枚づつ切り出し、スライド治具4に載せられて水平移動し装置内部に移動させられる。上記スライド治具4は、アルミニュウム等の金属製の部品である。
図8には、この発明に係るトレイとそれが載せられるスライド治具の一実施例の平面図が示されている。前記のようにトレイの外壁部1に凹部3が設けられる。これに対応して、かかるトレイが載せられるスライド治具4には、凸部5が設けられる。この凸部5が設けられる位置と、上記トレイの凹部が設けられる位置が合致しているなら、同図に示すようにトレイをスライド治具4への正しく載置することが可能となり、誤ったトレイのスライド治具4への載置を容易に見分けるようにすることができる。例えば、スライド治具4に対して高さセンサを設けおけば、上記のような誤ったトレイのスライド治具4への載置を容易に見出して、水平移動し装置内部に移動を停止して実装機の上部に設けられた警報ランプ等を点灯させる。
図9には、この発明に係るスライド治具の他の一実施例の平面図が示されている。図9(A)に示した前記のような凸部は、図9(B)に示したように上記トレイの凹部3の位置に適合したピンに置き換えることが可能である。例えば、1つのスライド治具に複数通りのトレイの凹部の位置にピン挿入穴を設けておいて、上記部品収納部にトレイを収納(装着)する際に、上記収納されたトレイに対応して上記スライド治具4のピン挿入穴にピンを挿入する。これにより、スライド治具をトレイに対応して逐一取り替えることなく、誤ったトレイを搭載したとしても、それを簡単に見分けることができる。
図10には、実装機の実装動作を説明するための外観図が示されている。実装機では、上記スライド治具4に載せられて内部に移動させられた半導体装置をアームで半導体装置を吸着し、実装基板の実装位置に移動させて半田付等の実装動作を行う。この実装動作において、誤った半導体装置が収納されたトレイは、上記のような凸部又はピンが干渉してトレイ装着が不可能となることから、誤った半導体装置の実装基板への取付が未然に防止することができる。上記アームは、例えば、新しいトレイの搭載のために上記図2に示した*を付した部分で吸着して、空きトレイを実装機から取り外すときも使用される。
図11には、この発明に係る半導体装置用トレイの一実施例の平面図が示されている。図11(A)は、前記説明した基本形であるトレイの平面図が示されている。これに対して、図11(B)には、上記図11(A)に示したトレイとの識別のために、凹部3が4箇所に設けられる例が示されている。この4個のうち、図11(A)に対応した凹部3と位置が異なる3個のうちの1個ずつを設けると、それにより4種類のトレイを識別できる。そして、上記4個のうちの2個の組み合わせ、3個の組み合わせ及び4個全部設けるもの等のように識別数を増加させることができる。上記4箇所の他にも、前記のような積み重ねが不可能となるように4辺の外壁部の一部に凹部を設けるようにすれば、半導体装置の全品種に一対一対応で識別機能を設けることも可能である。
図12には、この発明に係る半導体装置用トレイを重ねた状態の一例の側面図が示されている。1つだけ種類の異なる、つまりは凹部3が設けられる位置が異なるトレイが混合した場合、前記のように積み重ねができなく、異なるトレイの上部と下部にそれぞれ隙間が発生する。これにより、異なるトレイの混合が簡単に見分けられる。また、前記のように積み重ねが不能であるということの他に、目視においても、同図で点線で示したように凹部の位置が異なるので見分けも簡単となる。このような目視機能を効果的に生かすためには、例えばトレイインデックスが設けられる長辺側に限定して上記凹部を設けるように決めて置くことが便利である。このように、異なる型番(=異なる切欠部位置)のトレイは、物理的に重なり合わないことに加え、上記トレイインデックスで特定された側面での目視により異品種混入が容易となる。
図13には、この発明に係る半導体用トレイを用いた半導体装置の出荷梱包の説明図が示されている。半導体装置が収納された複数のトレイは、積み重ねられて長辺両側に設けられたバンドで纏められる。上部には、乾燥材と湿度インジケータが載置され、防湿袋に入れられる。防湿袋の上面には、内装ラベルが貼られられる。そして、内装箱に入れられテープで封印される。この時、本願発明に係るトレイを用いた場合、前記図12に示したように異なるトレイの誤った混合が簡単に見分けることができる。
また、この発明に係る半導体用トレイは、リユーストレイ運用時の選別作業を容易にすることが可能となり、異品種品の誤納入の軽減に繋がる。リユーストレイとは、半導体メーカが一度顧客(実装メーカ)に製品を搭載して納入したトレイを、専門の業者が回収して再利用できるように選別・洗浄等を施し、再度半導体メーカに納めることをいい、資源有効利用に供するシステムである。
以上、本発明者によってなされた発明を実施態様にもとづき具体的に説明したが、本発明は上記実施態様に限定されるものではなく、その要旨を逸脱しない範囲で種々変更可能であることはいうまでもない。例えば、上記トレイに設けられる識別用の凹部は、凸部であってもよい。このとき、凸部が種類の異なる他のトレイとの積み重ねによる嵌合わを不可能にするために、凸部上部外周壁外側が上記下部外周壁外側よりも少なくとも外側に至るようにすればよい。これに対応して、実装機に設けられるスライド治具に凹部を設けるようにすればよい。ただし、既存の実装機への装着を考慮するなら、前記実施例のように凹部(切欠部)とした方が便利である。上記トレイに設けられる凹部の形状は、前記のような半円形の他に三角形、四角形等種々の実施形態を採ることができる。このようなトレイの切欠部に対応して、上記実装機のスライド治具の形状も合わせるようにすればよい。この発明は、前記JEDEC規格に適合されるもの他、JEDEC規格のように外壁部が上部と下部に分けられて上記同様に嵌合可能にされるものであれば何であってもよい。この発明は、半導体装置用トレイとそれに適合した実装機に広く利用することができる。
1…外壁部、11,11’…下部外壁部、12,12’…上部外壁部、13…天面、2…把手、3…凹部(切欠部)、4…スライド治具、5…凸部(ピン)。
Claims (5)
- 外周壁と、
上記外周枠によって囲まれ、格子状に区画された半導体装置収納部とを有し、
上記外周壁は、
上部外周壁と下部外周壁とに分けられ、
上記上部外周壁の外側周囲は、下部外周壁の内側周囲よりも小さくされて、他の同様な半導体装置用トレイの上記下部外周壁を嵌合して積み重ね可能にされ、
上記外周壁の一部に、上記下部外周壁外側が上記上部外周壁外側よりも内側に至る凹部又は、上記上部外周壁外側が上記下部外周壁外側よりも外側に至る凸部を有する半導体装置用トレイ。 - 請求項1において、
上記凹部又は凸部は、半円形である半導体装置用トレイ。 - 請求項2において、
上記凸部又は凸部は、上記半導体収納部の大きさが同じ複数の半導体装置用トレイにおいて、
その位置及び数が異なる複数通りが形成される半導体装置用トレイ。 - 外周壁と、
上記外周枠によって囲まれ、格子状に区画された半導体装置収納部とを有し、
上記外周壁は、
上部外周壁と下部外周壁とに分けられ、
上記上部外周壁の外側周囲は、下部外周壁の内側周囲よりも小さくされて、他の同様な半導体装置用トレイの上記下部外周壁を嵌合して積み重ね可能にされ、
上記外周壁の一部に、上記下部外周壁外側が上記上部外周壁内側よりも内側に至る凹部又は、上記上部外周壁内側が上記下部外周壁外側よりも外側に至る凸部を有する半導体装置用トレイが搭載可能な部品収納部を備え、
上記部品収納部は、
上記半導体装置用トレイの凹部又は凸部と嵌合される凸部又は凹部を持つスライド治具を有する実装機。 - 請求項4において、
上記部品収納部は、積み重ねられた状態の複数の半導体装置用トレイが搭載可能である実装機。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2006284957A JP2008103533A (ja) | 2006-10-19 | 2006-10-19 | 半導体装置用トレイと実装機 |
Applications Claiming Priority (1)
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Publications (1)
Publication Number | Publication Date |
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JP2008103533A true JP2008103533A (ja) | 2008-05-01 |
Family
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Family Applications (1)
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JP2006284957A Pending JP2008103533A (ja) | 2006-10-19 | 2006-10-19 | 半導体装置用トレイと実装機 |
Country Status (1)
Country | Link |
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JP (1) | JP2008103533A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010225969A (ja) * | 2009-03-25 | 2010-10-07 | Panasonic Corp | 電子部品実装装置及び電子部品実装方法 |
US11329244B2 (en) | 2014-08-22 | 2022-05-10 | Arizona Board Of Regents On Behalf Of Arizona State University | Organic light-emitting diodes with fluorescent and phosphorescent emitters |
-
2006
- 2006-10-19 JP JP2006284957A patent/JP2008103533A/ja active Pending
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US11329244B2 (en) | 2014-08-22 | 2022-05-10 | Arizona Board Of Regents On Behalf Of Arizona State University | Organic light-emitting diodes with fluorescent and phosphorescent emitters |
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