JP2007508592A - 液晶マイクロディスプレイ - Google Patents
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Abstract
本発明は、液晶マトリックスマイクロディスプレイ、特に、液晶セルのマトリックスアレイを制御するための電子回路が一体化されたモノリシックシリコン基板に具現された液晶マトリックスマイクロディスプレイに関する。
マトリックスには、行および列のクロスオーバにおける各ドットのために、このクロスオーバに位置する基本液晶セルを制御するための基本電子回路が含まれる。この回路には、画像フレームの期間に、列によって印加されるアナログ電圧を蓄積するための少なくとも1つの蓄積コンデンサ(Ca、Cb)であって、その第1の端子がトランジスタ(Ta、Tb)のゲートに連結された蓄積コンデンサと、2つの電圧供給端子間で直列になった基本電流源(SC1)およびスイッチングトランジスタ(Ta、Tb)であって、スイッチングトランジスタのドレインが液晶セル(LC)に連結された基本電流源およびスイッチングトランジスタと、が含まれる。少なくとも1行の全てのセルに共通の周期的な電圧ランプが、この行のセルにおける蓄積コンデンサの第2の端子に印加される。
【選択図】図2
マトリックスには、行および列のクロスオーバにおける各ドットのために、このクロスオーバに位置する基本液晶セルを制御するための基本電子回路が含まれる。この回路には、画像フレームの期間に、列によって印加されるアナログ電圧を蓄積するための少なくとも1つの蓄積コンデンサ(Ca、Cb)であって、その第1の端子がトランジスタ(Ta、Tb)のゲートに連結された蓄積コンデンサと、2つの電圧供給端子間で直列になった基本電流源(SC1)およびスイッチングトランジスタ(Ta、Tb)であって、スイッチングトランジスタのドレインが液晶セル(LC)に連結された基本電流源およびスイッチングトランジスタと、が含まれる。少なくとも1行の全てのセルに共通の周期的な電圧ランプが、この行のセルにおける蓄積コンデンサの第2の端子に印加される。
【選択図】図2
Description
本発明は、液晶マトリックスマイクロディスプレイ、特に、液晶セルのマトリックスアレイを制御するための電子回路が一体化されたモノリシックシリコン基板に具現された液晶マトリックスマイクロディスプレイに関する。
本明細書において目的とする液晶ディスプレイは、黒/白の2値情報だけでなく、中間のグレーレベルを表示できるものである。グレーレベルと言うとき、それは、反射または透過における輝度のレベルであり、この表現「グレーレベル」は、カラーディスプレイにおける場合のように、考慮する光が着色されている場合であっても、本明細書において用いられる。
グレーレベルを伴う情報を、受動画素(画像ドット)を備えた構成において表示するために、黒に対応するレベルと白に対応するレベルとの間の中間レベルのアナログ電圧を、2つの電極間の液晶からなる各基本セルに印加することができる。基本セルに対応する画像ドットの輝度(透過または反射における)は、実際には、セルに印加される電圧レベルに依存する。マトリックスの各行のために、この画素に望ましいグレーレベルに対応するDC電圧が、第1に、行の各画素に短い間印加される。この電圧を、画素レベルで、ローカルな蓄積コンデンサにおけるメモリに配置し、次に、このコンデンサを、コンデンサを充電する役割を果たす回路から絶縁し、そして次の行に行って、前記次の行の画素に望ましい他のDC電圧を、この新しい行の蓄積コンデンサに印加する。このように、この画素に望ましいDC電圧を、行の各画素の蓄積コンデンサにおけるメモリに配置した後で、蓄積コンデンサは液晶セルに連結される。したがって、液晶セルは、所望のグレーレベルに対応する電圧を受け取り(容量分割比内で)、放電することなく、この電圧を保持する。したがって、この電圧は、画像フレームの期間を通し、液晶セルの端子にわたって維持される。グレーレベルを伴う画像を生成するためのこの種の解決法は、残念にも不正確である。なぜなら、それは、蓄積コンデンサ、および液晶セルの固有静電容量の数値間の比率に依存するからである。これらの値が不正確であるのは、一方では、コンデンサが非常に小さい(集積回路の実装面積および消費の理由で)からであり、他方では、蓄積コンデンサの値が、その端子にわたる電圧に依存するからである(実際には、このコンデンサは、MOSトランジスタゲートに基づいて具現されている)。
液晶マトリックスの別のタイプの構成(パルス幅変調を用いてアクティブ画素を備えた構成)は、同じ電圧(たとえば5ボルトの全体的な供給電圧Vdd)を、全ての画素、すなわち全ての液晶セルに印加するが、しかしその電圧を、フレーム時間の一部、すなわち所望のグレーレベルに依存する一部の時間、印加することにある。このような画素は、全フレーム期間の間、電圧Vddをその液晶セルで受け取り、そして「ノーマリホワイト」と呼ばれるタイプのマトリックスのために「黒」画素になる。すなわち、セルに印加される電圧がないときに、反射モードでも透過モードでも最大の光レベルを提供する。他のこのような画素は、フレーム期間のゼロまたはほんの一部の間、電圧Vddをそのセルで受け取り、「白」になる。最後に、他のこのような画素は、フレーム期間の所定の一部の間、電圧Vddをそのセルで受け取る。フレーム周波数が少なくとも25Hzの場合には、目は、電圧Vddの印加期間およびこの電圧の非印加期間を同化し、合計フレーム期間に対する、電圧Vddの印加期間の比率に比例する等価なグレーレベルを見る。
セルに印加される電圧の値は固定され(Vdd)、それゆえセルまたは蓄積コンデンサの静電容量値における隔たりから独立しているだけでなく、さらにこの電圧は、反応時間および画像のコントラストの理由で有利なので、できる限り高くなる。
しかしながら、画素に割り当てられるグレーレベルに依存して、各画素によって異なる、フレーム期間の一部の間に、各フレームで全てのセルに電圧Vddを印加することは、解決困難な問題を提起することが理解できる。
これらの問題の中で、特に、これらの期間を管理する電子回路の電流消費の問題がある。特に、画素レベルに位置する回路の電流消費の問題がある。なぜなら、期間Vddの印加時間を計算しなければならないのは各画素のレベルであり、またフレーム期間の可変割合のためにセルの制御を実行しなければならないのは、画素レベルだからである。各画素用のこの電流消費は、何十万または何百万にさえ達する可能性のある画素数によって増加される。また、各画素のレベルで設けられる電子回路の実装面積の問題がある。なぜなら、この回路は、数百の行および列を有するマトリックスのために、何十万回も再現されるからである。基本ディスプレイセルの典型的な寸法は、10マイクロメートル×10マイクロメートルであり、セルに関連する電子回路は、この範囲に収容しなければならない。
各セルを制御するために用いられるトランジスタの数を制限することが特に必要であり、本発明の目的は、各画素とローカルに関連するトランジスタの数を最小限にする方法および回路を提案することである。
この目的のために、本発明は、液晶ディスプレイマトリックスを制御する方法、すなわち、基本液晶セルに関連する蓄積コンデンサに、所望のグレーレベルに対応するアナログDC電圧を短い間印加することと、コンデンサの端子をトランジスタのゲートに連結し、次に、このトランジスタのソースが接地に連結され、そのドレインが電流源を横切って電圧源Vddに連結されることと、フレーム期間に単調に変化するDC電圧ランプを、蓄積コンデンサの別の端子に印加することとからなる方法を提案する。
セルは、このトランジスタのドレインに連結され、その明るさ「黒」または「白」の状態は、このドレインに存在する高または低レベルに依存する。
単調なランプは、原則としては本質的に線形である。しかしながら、それは、完全には線形でなくてもよい。ランプの輪郭に影響を及ぼすことによって、システムのある一定の非線形性を補正したい場合には、ランプが完全には線形でないことが、特に考えられる。非線形的な輪郭を備えたランプによるこのような補正は、たとえば、ある一定の輝度範囲における視覚的な知覚を改善する役割を果たす可能性がある。
本発明による方法は、次の仕方で働く。コンデンサに印加された電圧ランプは、コンデンサによってトランジスタのゲートに伝えられる。ランプの電圧が予めコンデンサに蓄積された電圧に印加されるために、コンデンサに蓄積された電圧(所望のグレーレベルに対応する電圧)がより大きくなり、したがって、ゲートは、それだけ高いレベルから始まる電圧ランプを受け取る。ゲートにおける電圧ランプは、フレーム期間にわたって広がる。開始時にトランジスタはオフであり、そのゲートの電圧は、接地されている(またはより一般的には、固定電位の)ソースに比べて不十分である。トランジスタがオンではない間は電流を導通できない電流源を通して電力を供給されるトランジスタのドレインは、Vddと等しい電位レベルであるので、したがって、セルは、第1の状態(たとえば「黒」)にある。ゲートの電圧がトランジスタの閾値電圧VTに達した瞬間に、トランジスタは導通し始め、トランジスタのドレインの電位をゼロに戻す。この瞬間は、最初にコンデンサに蓄積され、かつ所望のグレーレベルと関連する電圧レベルに依存する。液晶セルは、このドレインに接続され、状態を急に変化させ(それはたとえば「白」状態をとる)、そしてフレームの残りの間はこの状態に留まる。したがって、目によって同化されるセルの平均輝度は、コンデンサに最初に蓄積された電圧レベルに依存する。
電圧ランプは、ゼロ電圧レベルと、トランジスタの閾値電圧VTの値とほぼ等しい電圧レベルとの間で変化するのが好ましいが、閾値電圧は、従来的にはゲート−ソース電圧値であり、この値の上ではトランジスタはオンであり、その下ではオフである。
グレーレベルを表わし、かつ蓄積コンデンサに印加されるアナログDC電圧は、0ボルト(基準0ボルトは、フレーム期間のトランジスタのソース電圧である)と、同じ閾電圧値VTとの間で変化する。液晶セルは、各フレームに応じて変化する期間に、供給電圧Vddかまたは0ボルト電圧のいずれかを受け取る。
したがって、本発明は、画像ドットまたは画素のアクティブマトリックスおよび周辺回路を含む液晶マトリックスディスプレイであって、このマトリックスが、アドレス線と各行のドットに表示されるグレーレベルを表わすアナログ電圧を供給するための列とのクロスアレイと、行および列のクロスオーバにおける各ドットのための、このクロスオーバに位置する基本液晶セルを制御するための基本電子回路と、を含み、この基本回路が、
− 画像フレーム期間に、列によって印加されるアナログ電圧を蓄積するための少なくとも1つの蓄積コンデンサにして、この蓄積コンデンサの第1の端子がトランジスタのゲートに連結された蓄積コンデンサと、
− 2つの電圧供給端子間で直列になった基本電流源およびスイッチングトランジスタにして、スイッチングトランジスタのドレインが液晶セルに連結されている基本電流源およびスイッチングトランジスタと、
を含み、
周辺回路が、少なくとも1行の全てのセルに共通の、周期的な電圧ランプを受け取るための手段を含み、ランプが、この行のセルの蓄積コンデンサの第2の端子に印加される液晶マトリックスディスプレイ、を提案する。
− 画像フレーム期間に、列によって印加されるアナログ電圧を蓄積するための少なくとも1つの蓄積コンデンサにして、この蓄積コンデンサの第1の端子がトランジスタのゲートに連結された蓄積コンデンサと、
− 2つの電圧供給端子間で直列になった基本電流源およびスイッチングトランジスタにして、スイッチングトランジスタのドレインが液晶セルに連結されている基本電流源およびスイッチングトランジスタと、
を含み、
周辺回路が、少なくとも1行の全てのセルに共通の、周期的な電圧ランプを受け取るための手段を含み、ランプが、この行のセルの蓄積コンデンサの第2の端子に印加される液晶マトリックスディスプレイ、を提案する。
このトランジスタのゲート−ソース閾値電圧がVT(この電圧の上で、トランジスタは導通を始める)である場合には、ランプは、VTの振幅を有するのが好ましい。ランプは、画像フレームの期間にわたり、0からVTへ、またはVTからゼロへ変化する。グレーレベルを表わすアナログ電圧は、原則として0とVTとの間で変化する。
電圧ランプは、ディスプレイマトリックスおよびその制御回路を含むモノリシック集積回路の内部または外部に存在するランプジェネレータによって生成される。
本発明は、二重メモリを備えた基本電子回路に各画像ドットが関連しているディスプレイに用いてもよく、この基本電子回路には、1つではなく2つの蓄積コンデンサと、同じ液晶セルに連結され、かつ2つのうちの1つのフレームを交互に動作させる2つのスイッチングトランジスタとがあり、また電圧値が奇数フレームの間に1つのコンデンサに印加されるのに対して、もう一方のコンデンサは、それが前の偶数フレームの間に受け取った電圧を保持するが、その逆でもある。次に、第1のコンデンサに連結されたトランジスタの導通は、奇数フレームの間に無効にされ、偶数フレームの間に有効にされる。二重メモリを備えたこれらの画像ドットの場合には、ランプジェネレータを用いて、マトリックスの全ての画像ドット用に決められたランプを生成することができる。ランプは周期的であり、その周期は画像フレームの周期である。したがって2つのランプジェネレータ(または同一のランプジェネレータの2つの部分)が、2つのうちの1つのフレームを交互に動作させるが、しかし両方とも、マトリックスの全てのドットに供給する。
これに反して、画像ドットが単純なメモリ(単一の蓄積コンデンサおよび単一のスイッチングトランジスタ)を備えたものである場合には、異なるランプが画像ドットの各行に印加され、したがって、1行当たり1つのランプジェネレータが必要になる。このランプは、行のセルにおけるコンデンサの蓄積動作の後に始まり、フレーム期間の残りの間続く。電圧を蓄積する動作は行ごとに実行されるので、ある行のセルにおける蓄積動作の終了を待って、次の行で同じ動作を行うことが必要である。したがって、ランプは、全て同様の期間であるが、行から行へ調子を合わせてシフトされる。
本発明は、連続的な画像フレームが異なる色光を変調するカラーシーケンシャルディスプレイに特に適用可能である。各画像フレームは、単一色のディスプレイに対応し、前記色光が、このフレームの間にマトリックスの前に放射されて、この色に特有の情報に応じてマトリックスによって空間的に変調されるようにする。色光は、この色の供給源(その後、続く色に対応する情報を含む蓄積コンデンサへのランプの印加に同期して、続くフレームのための異なる色の供給源)によって得られる。そうでなければ、色光は、選択された色に関連する情報を含む蓄積コンデンサへのランプの印加とやはり同期して、この色のフィルタ(その後、続くフレームのための他の色のフィルタ)が前方を横切っている白色光から得られる。
本発明の他の特徴および利点は、添付の図面に関連して提供した以下の詳細な説明を読むことによって明らかとなるであろう。
以下において、液晶セルが反射モード(光が観察者の側からディスプレイの方へ放射される)で作動しようと、透過モード(光がディスプレイの背後から生じる)で作動しようと、「ノーマリホワイト」タイプの液晶セルだけが考慮される。「ノーマリホワイト」タイプのセルは、ゼロ電圧がセルの電極間に印加されたときに最大輝度(白)を、また最大供給電圧Vddがセルに永続的に印加されたときに最小輝度(黒)を有するものとして観察者によって見られる。
図1は、液晶マイクロディスプレイを制御するための電子装置の全体的な構成を表わす。マトリックスには、行および列に構成された、個別の画像ドットまたは画素P11、P12、P21、P22等が含まれる。グレーレベル情報(またはもちろんカラーレベル情報)は、最小レベル0ボルトと最大レベルVTとの間で変化するアナログ電圧の形態で、列導体C1、C2等によって与えられる。
図1のダイヤグラムは、画素が、このアナログ電圧を蓄積するための、偶数および奇数の連続的なフレーム中に交互に動作する2つのコンデンサを含む場合、および画素が、各フレームで内容が更新されるただ1つの蓄積コンデンサを含む場合の両方に有効である。我々は、これら2つのタイプの構造の違いに後で戻る。
所定の瞬間に列に印加される電圧レベルは、この列と、行選択レジスタRLによってこの瞬間に作動される行との交点に位置する画素で表示されるグレーレベルを表わす。各行に固有の行導体L1、L2等によって、所定の瞬間にこの行の全ての画素を作動させることが可能になり、一度に単一の行が作動するように、他の行の画素は不作動にされる。我々は、行導体L1が、二重メモリを備えたマトリックスのために2つの行導体L1a、L2aに細分されることを後で見てみるが、しかし行の全ての画素はやはり同時に作動される。作動された行の画素は、この瞬間に存在する電圧をそれぞれの列導体で受け取り、それを各画素内の蓄積コンデンサに蓄積する。不作動にされた画素はそれを受け取らず、以前に蓄積できた電圧をメモリに保持する。フレームの間に画素の輝度を操作する(我々が見て取れるように間接的に)のは、フレーム期間を通してメモリに配置されたこのアナログ電圧である。
マトリックスの各ドットに割り当てられる新しい輝度を決定するために、行は、フレームの間に次々に作動される。行の連続的な作動シーケンスを実行するのは、制御レジスタRLである。行の各作動のために、この行に対応するグレーレベル電圧が列導体に印加され、これらの電圧は、次の行のために変更される。
行の選択中に列に印加されるアナログ電圧は、次の方法で、アナログ/デジタル変換に基づいて確立してもよい。すなわち、デジタルレジスタRCが、この瞬間に選択された列および行の交点に位置するドットに印加されるグレーレベルを表わすデジタル値(たとえば8ビットで符号化された)を各列のために含んでいる。レジスタRCは、各新しい行選択において再充電され、また同期化回路(図示せず)が、もちろん、行および列動作を同期させる役割を果たす。レジスタからのデジタル出力(1列当たり1つの出力)が、この列に対応する比較器CMP1、CMP2...に印加される。比較器は、さらに、レジスタRCに含むことができる0から最大値(最大値は、8ビットを備えたレジスタでは1列当たり255である)まで周期的および定期的にカウントするカウンタCPTの内容を受け取る。カウンタの内容が、確定された列のためにレジスタに含まれた値に達すると、この列に関連する比較器は、単一の短いパルスを供給する。カウンタCPTは、すべての列に対して同じである。列に関連する比較器CMP1、CMP2、...によって供給されるパルスは、それぞれの列導体C1、C2に位置しているスイッチK1、K2、...を閉じる。このように閉じることにより、我々が見て取れるように、所望のグレーレベルを表わすアナログ電圧が、スイッチによってこの列に印加される。カウンタの周期は、行の周期である。すなわち、カウンタは、新しい行が選択されるたびにカウントを開始し、この行の画素にグレーレベルを蓄積するようにする。
スイッチK1、K2、...によって列に印加されるアナログ電圧は、カウンタCPTと同期して動作し、かつ0から最大値(VT)まで線形的に変化する電圧を生成する線形電圧ランプジェネレータから生じる。このランプは、行の各新しい選択と共に更新される。これは、ドットのマトリックス全体に共通である。したがって、カウンタが、0から最大の内容までカウントするにつれて、ランプは、0からその最大値まで上昇する。したがって、ランプの瞬間的な電圧は、カウンタの内容に比例する。スイッチを閉じるためのパルスは、カウンタの内容が所望の値と等しい瞬間に立ち上がり、またランプは、この瞬間に、この値に比例する値を有する。列レジスタRCから生じる、所望のグレーレベルを表わす値を、選択された行の画素におけるメモリにロードするために、列導体に印加されるのは、この瞬間におけるランプの瞬時値である。
例として、ランプジェネレータは、単に、カウンタCPTの内容を受け取るデジタル/アナログ変換器DACによって構成してもよい。
本発明によるディスプレイの全体的な構成においてまた発見されるのは、別のランプジェネレータGRであり、このランプジェネレータは、マトリックスの画素が二重メモリを有する場合には、2つのランプジェネレータGra、Grbにおそらく分割される。このランプジェネレータは、各フレームにおいて電圧ランプを提供するが、この電圧ランプは、原則として線形であり、画像フレームの期間に等しい、0から最高電圧までの上昇期間を有する。このランプジェネレータは、行および列の各クロスオーバにローカルに存在する基本液晶セルの電極に印加される電圧の駆動段階中に、マトリックスの全ての画素に、原則として線形の電圧ランプを印加する役割を果たす。しかしながら、次のことに留意されたい。すなわち、単純なメモリを備えた画素の場合には、ランプジェネレータは、マトリックスにある行と同じ数の、調子を合わせてシフトされるランプを生成できなければならず、各ランプがそれぞれの行に印加されるのに対して、二重のメモリを備えた画素の場合には、ジェネレータは、後で説明する対処に従って、マトリックスの全てのドットに対して単一のランプを生成するだけで十分である。ランプジェネレータは、ディスプレイマトリックスを担持する集積回路にか、またはこの集積回路の外部に具現してもよく、後者の場合、集積回路には、ランプ信号の受信のために確保された入力部が含まれる。
図2は、行L1および列C1のクロスオーバに位置する画素に関連する基本電子回路の構成を示すが、この回路は、このクロスオーバの場所に位置している。図示した構成は、各画素が、画素にローカルに蓄積されるグレーレベルを表わすアナログ電圧の二重メモリを含む実施形態に、対応する。
全体的として、二重メモリを備えた画素の動作方法は、以下の通りである。奇数フレームの間に、それぞれのグレーレベルを画素それぞれの第1のメモリに蓄積する動作が実行され、以前の偶数フレームの間に第2のメモリに蓄積したグレーレベルを用いて、セルのディスプレイを駆動する。奇数フレームに続く偶数フレームの間に、以前に第1のメモリに蓄積された電圧を用いて、各画素に関連する液晶セルによってディスプレイを駆動し、この時間の間に、新しいグレーレベルが、同じセルに関連する第2のメモリに蓄積される。したがって、各フレームの期間全体を、セルのディスプレイを駆動する動作に用いることができるのに対して、1画素当たりただ1つの蓄積メモリがあった場合には、蓄積動作のためにフレームの一部を用い、セルの本来の制御のためにフレームの別の一部を用いることが必要であったろう。
第1のメモリは第1の蓄積コンデンサCaによって構成され、第2のメモリは第2の蓄積コンデンサCbによって構成される。コンデンサCaは、行選択スイッチL1aを介して列導体C1に、第1の端子により連結してもよく、コンデンサCbは、別の行選択スイッチKL1bによって同じ列導体C1に、第1の端子により連結してもよい。この接続を確立するために、スイッチKL1aは、奇数フレームの間だけ、かつ行L1が、その行の画素に新しいグレーレベルを蓄積する動作のために、行選択レジスタRLによって選択されたときだけ、閉じられる。スイッチKL1bは、偶数フレームの間だけ、かつグレーレベルを受け取るのが行L1の順番であるときだけ、閉じられる。奇数フレームの間、行の画素にグレーレベルを蓄積する動作の間に、コンデンサCaの第2の端子は接地され、その結果、この瞬間に列C1に存在するアナログ電圧は、スイッチKL1aを横切って、コンデンサCaの端子に印加される。思い出されるであろうが、この電圧は、ランプの電圧レベルが、列レジスタRCによって数的に定義された値に一致する瞬間に、スイッチK1(図1)によってサンプリングされたランプから生じる。
スイッチKL1aは、第1の行導体L1aによって制御され、スイッチKL1bは、第2の行導体L1bによって制御される。行L1は、これらの2つの導体によって定義され、行選択レジスタは、確定されたフレームのために用いられる行導体の選択を決定する。L1aは奇数フレーム用であり、L1bは偶数フレーム用であるが、しかしそれは、常に画素L1の行の画素の問題である。
フレームが奇数フレームかまたは偶数フレームかどうかに依存して、コンデンサCaまたはCbにアナログ電圧をロードした後で、対応する行選択スイッチKL1aまたはKL1bが開かれ、コンデンサCaまたはCbは、これからは絶縁されて、このフレームの残りの間(すなわち、他の行の充電の間)、および次のフレームの間(すなわち、本来の表示動作の間)一定の電荷を保持する。
アナログ電圧を行に蓄積した後、行選択レジスタの順序付けによって、次の行が選択される。スイッチを閉じるための行の選択は、奇数フレームの間ではスイッチKL1aだけに、偶数フレームの間ではスイッチKL1bだけに影響を及ぼす。
蓄積コンデンサCaの第1の端子(すなわち、スイッチKL1aに連結された端子)はまた、参照符号Taによって示されたMOSトランジスタのゲートに連結されているのに対して、コンデンサCbの第1の端子は、MOSトランジスタTbのゲートに連結されている。
トランジスタTaのソースは、接地(すなわち、ゼロと見なすことができる電位基準)に連結されるが、偶数フレームの間だけである。スイッチKT1aは、トランジスタTaのソースと接地との間に置かれて、奇数フレームの間は、トランジスタTaによる電流の導通をディスエーブルする。マトリックスの全ての画素のスイッチKT1aは、偶数フレームの全期間は閉じられるが奇数フレーム期間は開くように、同時に制御される。同じように、トランジスタTbのソースは、奇数フレームの全期間は閉じられ、かつ偶数フレームの間は開かれるスイッチKT1bによって、接地に連結される。
トランジスタTaのドレインおよびトランジスタTbのドレインは、図1の基本回路がローカルに関連する画素に対応する液晶セルLCの第1の電極に連結されている。特に、セルは、トランジスタTaのドレインによって偶数フレームの間にか、またはトランジスタTbのドレインによって奇数フレームの間に、セルの電極に電圧を印加することにより制御される。
セルには、一般に全マトリックスに共通であり、かつ最初は0ボルトの接地電位にされていると見なされる第2の電極が含まれる。
トランジスタTaおよびTbのドレインは、さらに、一般的な電源Vddとドレインとの間に連結されたPMOSトランジスタによって構成された同一の定電流源SC1に連結されるが、このトランジスタは、自身における電流が固定されるように、そのゲートを電位Vpolに接続している。特に、ゲート電位は、このトランジスタにおける電流が固定電流源(図示せず)の電流のイメージであるように、従来の電流ミラー装置によって決定してもよい。定電流の値は、従来的には電位Vpolによっておよびトランジスタのチャンネルのジオメトリによって決定される。全ての画素の定電流源は、同一である。この電流源SC1は、フレームが奇数かまたは偶数かに依存して、トランジスタTaまたはトランジスタTbに、たとえば約100ナノアンペアのオーダの固定電流を供給するが、しかしながら、トランジスタTa(またはTb)がオン状態にあり、オフ状態にないという条件に基づいて供給する。見て取れるように、これらのトランジスタの状態は、コンデンサCaまたはCbによってそのゲートに印加される電位によって決定される。
最後に、奇数フレームの間にコンデンサCaの第2の端子に印加される電位はゼロであるが、しかし偶数フレームの間に、この第2の端子は、図1に関連して言及した、マトリックスの全てのセルに共通の線形電圧ランプジェネレータによって決定される電位を印加される。反対に、奇数フレームの間に、同じ電圧ランプが、コンデンサCbの第2の端子に印加されるのに対して、偶数フレームの間は、ゼロ電位がこの端子に維持される。
ランプジェネレータは線形アナログ電圧ランプを生成するが、このランプは、フレームの開始時に0から始まり、フレームの終了時に、トランジスタTaまたはTbをスイッチオンするための閾値電圧VTと好ましくは等しい最大値に達する。この閾値電圧VTは、VTより大きな値がトランジスタを導通状態にしかつVTより低い値がトランジスタの導通をディスエーブルするように、トランジスタのゲートとソースとの間に印加される電圧の境界である。これは、従来通りに約1ボルトであってもよいが、しかしトランジスタに自由に閾値を選択させることが可能である。
我々は、ここで、挿入句的に次のことを言いたい。すなわち、蓄積コンデンサに蓄積されるアナログ電圧は、0に等しい最小値と、原則としてVTに等しい最大値との間で変化可能な値を原則として有し、任意の中間値は、白レベル(最小値0のための)と黒レベル(最大値VTのための)との間の中間のグレーレベルを備えた照度を生じることができるように意図されている、ということである。
ディスプレイマトリックスは次の方法で動作する。すなわち、奇数フレームの間に、行ごとに、0とVTとの間に位置しかつ各画素に望ましいグレーレベルを表わすアナログ電圧値Viで、マトリックスの全てのコンデンサCaを充電した後、スイッチKT1aは、トランジスタTaのソースを接地するために、次の偶数フレームの開始時に閉じられ、そして0から始まって、フレームの期間に等しい時間の後にVTに達する線形電圧ランプが、コンデンサCaの第2の端子に印加される。それゆえ、トランジスタTaのゲートに存在する電圧は、所定の瞬間のランプ、およびコンデンサに最初に充電された電圧Viの電圧合計Vrである。
この電圧合計Vrは線形的に変化し、Viから始まってVi+VTで終了する。トランジスタTaのゲートに印加される電圧Vrが、トランジスタTaの導通閾値である値VT未満である限り、トランジスタTaは、電流源SC1が電流を導通せずかつトランジスタのドレイン電圧(また、液晶の第1の電極に印加される電圧)がVddに等しいように、オフに留まり、第2の電極または対向電極は、0ボルトである。液晶は、いわゆる「ノーマリホワイト」マトリックスのために「黒」状態である。ゲートに印加される電圧がVTより大きくなると、トランジスタTaは導通状態になり、電極を接地する。液晶は、「白」状態に切り換わる。
セルが黒である時間と、セルが白である時間との間の比率は、コンデンサCaに蓄積されるグレーレベル値Viに正比例する。Vi=0に対しては、トランジスタTaは、フレームの終了時だけ導通状態になり、セルに印加される電圧は、全フレームの間、Vddである。セルは、フレーム時間の100%の間、黒である。Vi=Vdd(Viの最大可能値)に対しては、トランジスタは、正にフレームの開始から導通状態になり、セルに印加される電圧は、全フレームの間、0である。セルは、フレーム時間の100%の間、白である。中間のViに対しては、セルは、フレーム時間の比率Vi/VTの間は黒(Vddの印加)であり、フレーム時間の一部(VT−Vi)/VTの間は白(0ボルトの印加)である。フレーム周期は短く(典型的には1/25秒)、目は、黒と白との間の変化を同化する。目によって知覚される等価なグレーレベルは、値Vi/VTによって、したがって値Viによって直接表わされる(ノーマリホワイトセルに関しては、Viが大きければそれだけ明るいグレー)。
図2のダイヤグラムにおいて、スイッチは、MOSトランジスタによって具現されている。コンデンサCaおよびCbもまた、原則としてMOSトランジスタによって具現されているが、これらのトランジスタのドレインおよびソースが結合されて、チャンネルと一緒に第1のコンデンサ電極を形成し、その絶縁ゲートが、第2の電極を形成する。本発明による図に関して、画素に関連する回路にはわずかな数の素子しか含まれず、その結果、この回路の全体的な実装面積が抑えられることに留意されたい。
動作方法は、前のフレームの間に蓄積されたグレーレベル電圧を、フレーム全体のために保持するコンデンサCaまたはCbの能力に部分的に依存する。本発明による回路は、コンデンサの電荷を失わせる電流リーク経路がほとんどないことを示す。
図2のダイヤグラムにおいて、液晶セルが、第1の電極をトランジスタTaおよびTbのドレインに連結し、第2の電極または対向電極を接地に連結していると、簡略化のために仮定されている。しかしながら、液晶の端子にゼロ平均電圧が存在するように対処することによって液晶を減極することが、一般に必要であるが、そうでないのは、第2の電極が常に接地されている場合、および第1が0ボルトとVddとの間を振動する場合である。この理由で、従来的には対処がなされ、そして本発明は、この対策と共存可能で、液晶に印加される電圧の方向を周期的に逆にする。
たとえば、第1のフレームまたは第1の一連のフレームにおいて、対向電極が0ボルトである場合、第2のフレームまたは第2の一連のフレームにおいて、対向電極がVddであることを保証するように、対処をしてもよい。しかしながら、対向電極がVddであれば、セルは、第1の電極が0ボルトであるという条件で黒になり、第1の電極がVddであるという条件で、白になる。このことが意味するのは、同じグレーレベルを得るためには、コンデンサに蓄積された、このレベルを表わすアナログ電圧がViである場合に、Viではなく、平均電圧Vdd−Viと同等のものをセルの第1の電極に印加することが必要である、ということである。このことは、フレーム時間の一部Vi/VTの間に0ボルトの電圧を、そして一部(VT−Vi)/VTの間に電圧Vddを印加することが必要であることを意味する。したがって、これは、対向電極が0ボルトであり、かつ電圧Vddが一部Vi/VTの間に印加され、電圧Vddが一部(VT−Vi)/VTの間に印加される場合の反対である。
したがって、液晶セルの分極のこの交替を実行できるように望む場合に、ランプジェネレータによって供給され、かつ画素のコンデンサCaおよびCbに印加されるランプの方向を周期的に逆にすることは、極めて簡単にできるであろう。したがって、たとえば、偶数フレームの間にコンデンサCaに印加されるランプは、フレームの開始時にVTから始まり、フレームの終了時に0ボルトまで線形的に低下する降下ランプであってもよい。
液晶の第2の電極に印加される分極0またはVddが交替されるのと同時の、ランプの方向の交替による分極の交替は、全てのフレームまたは1つおきのフレームで周期的に行なうことができる。それが全てのフレームである場合には、2つの蓄積コンデンサの1つが上昇ランプを規則正しく受け取り、もう一方が降下ランプを規則正しく受け取ることを保証するように対処してもよい。
全てのフレームで、2つのコンデンサのために同じ上昇ランプを保持し、かつセルのマトリックスの対向電極における分極の交替と同期して列レジスタRCにおけるデジタルデータを単に逆にすることもまた可能である。また、列レジスタにおけるデジタルデータの値を逆にせずに、たとえば、電圧Viを確立するデジタル/アナログ変換器によって生成されるランプを逆にすることによって、アナログ電圧Viの値の大きさを逆にすることもまた可能である。これは、カウンタCPTの内容ではなく、このカウンタの内容の補数を変換器に印加することによって行うことができる。ここで繰り返すと、変換器の入力におけるこの変化を、対向電極の分極の変化と同期させることが必要である。
たとえば、このマトリックスを備えたカラーシーケンシャルディスプレイを作製したい場合には、第1の色に対応するグレーレベル情報が、確定されたフレーム、たとえば奇数フレーム用の列レジスタへ導入され、この情報が、全ての行に対して、画素のメモリに連続的に蓄積される。この情報の表示用のアクティブフレームである次の偶数フレームの間に、第2の色に対応する情報がメモリに配置され、かつディスプレイによって変調される第1の色光が放射される。次の奇数フレームを待って、第2の色の情報を表示する。
異なる用途(色がないか、または連続的なカラーモードで動作しない任意の事象における)のためには、単に、1つのコンデンサCa、1つのトランジスタTb、画素の1行当たり1つの行導体を含む単純なメモリを備えた画素で十分である。したがって、これによって、コンデンサCb、トランジスタTb、スイッチKT1a、KT1b、KL1b、導体L1bを省くこと、およびより小さな実装面積を有するメモリドットを得ることが可能になる。しかしながら、これによって、画素の各行のために、ランプジェネレータを設けることが必要になる。画像フレームの表示は、プログレッシブである。第1の画像行の情報が、列レジスタに蓄積され、選択レジスタRLによるこの行の選択の間に、アナログ電圧Viに変換される。直後に、この行の選択の停止によって、一方では次の行の選択が、他方ではフレームの期間を有する電圧ランプの始動が開始され、このランプが、蓄積コンデンサCaに印加される。第2行に対しては、ランプの印加は、第2の行の選択の終了からちょうど始まり、またランプは、同じ期間を有する等々である。したがって、線形ランプ生成周辺回路は、より複雑である。
Claims (12)
- 基本液晶セル(LC)に関連する蓄積コンデンサ(Ca、Cb)に、所望のグレーレベルに対応するアナログDC電圧(Vi)を短い間印加することと、前記コンデンサの第1の端子をトランジスタ(Ta、Tb)のゲートに連結し、次に、前記トランジスタのソースが接地に連結され、そのドレインが、前記セルの電極に連結され、そしてさらに電流源(SC1)を横切って電圧源Vddに連結されることと、前記蓄積コンデンサの第2の端子に、フレーム期間に単調に変化するDC電圧ランプを印加することとからなる、液晶ディスプレイマトリックスの画素を制御する方法。
- 前記電圧ランプが、ゼロ電圧レベルと、前記トランジスタのスイッチオン閾値電圧VTの値とほぼ等しい電圧レベルとの間で、本質的に線形的な仕方で変化することを特徴とする、請求項1に記載の方法。
- 前記グレーレベルを表わし、かつ前記蓄積コンデンサに印加される前記アナログDC電圧が、0ボルトと、同じ閾値電圧値VTとの間で変化することを特徴とする、請求項2に記載の方法。
- 前記液晶セルが、Vi/VTまたは(VT−Vi)/VTと等しい、フレーム期間の一部の間に供給電圧Vddを、かつ残りの時間にゼロ電圧を受け取ることを特徴とする、請求項3に記載の方法。
- ランプジェネレータが、前記マトリックスの各行に関連し、アナログ電圧が前記行のドットそれぞれの蓄積コンデンサに充電された後にランプが始まることを特徴とする、請求項1〜4のいずれか一項に記載の方法。
- 2つの蓄積コンデンサ(Ca、Cb)および2つのトランジスタ(Ta、Tb)が、各基本液晶セルと関連し、前記第1のコンデンサおよび前記第1のトランジスタが、前記第2のコンデンサおよび前記第2のトランジスタと交互に動作するが、それは、前記セルの制御が前記第2のトランジスタおよび前記第2のコンデンサによって達成されているうちに、グレーレベルを表わすアナログ電圧を、偶数フレームの間に前記第1のコンデンサに1行づつ蓄積するため、および前記セルの制御が前記第1のトランジスタおよび前記第2のコンデンサによって達成されているうちに、グレーレベルを表わすアナログ電圧を、偶数フレームの間に前記第2のコンデンサに1行づつ蓄積するためであり、前記第1の蓄積コンデンサの第2の端子が、奇数フレームの間は0ボルトに維持され、前記偶数フレームの間に線形ランプを受け取り、これと反対に、前記第2のコンデンサの第2の端子が、前記偶数フレームの間は0ボルトに維持され、前記奇数フレームの間に線形ランプを受け取ることを特徴とする、請求項1〜4のいずれか一項に記載の方法。
- 画像ドットのアクティブマトリックス、および周辺回路を含む液晶マトリックスディスプレイであって、前記マトリックスが、アドレス線(L1a、L1b)と各行のドットに表示されるグレーレベルを表わすアナログ電圧を供給するための列(C1、C2)とのクロスアレイと、行および列のクロスオーバにおける各ドットのための、このクロスオーバに位置する基本液晶セルを制御するための基本電子回路と、を含み、前記基本回路が、
− 画像フレームの期間に、前記列によって印加されたアナログ電圧(Vi)を蓄積するための少なくとも1つの蓄積コンデンサ(Ca、Cb)にして、前記蓄積コンデンサの第1の端子がトランジスタ(Ta、Tb)のゲートに連結された蓄積コンデンサと、
− 2つの電圧供給端子間で直列になった基本電流源(SC1)およびスイッチングトランジスタ(Ta、Tb)にして、前記スイッチングトランジスタのドレインが前記液晶セル(LC)に連結されている基本電流源およびスイッチングトランジスタと、
を含み、
前記周辺回路が、少なくとも1行の全てのセルに共通の周期的な電圧ランプ(GR)を受け取るための手段を含み、前記ランプが、この行のセルの前記蓄積コンデンサの第2の端子に印加される液晶マトリックスディスプレイ。 - 前記トランジスタをスイッチオンするためのゲート−ソース閾値電圧がVTであり、前記ランプがVTの振幅を有し、前記グレーレベルを表わす前記アナログ電圧が、0とVTとの間で変化できることを特徴とする、請求項7に記載のマトリックスディスプレイ。
- 各画像ドットに関連する前記基本回路が、2つの蓄積コンデンサ(Ca、Cb)と、同じ基本セル(LC)に連結され、かつ2つのうちの1つのフレームを交互に動作させる2つのスイッチングトランジスタと、を含む二重メモリを備えた回路であり、電圧値が奇数フレームの間に第1のコンデンサ(Ca)に印加されるのに対して、前記第2のコンデンサ(Cb)が、それが前の偶数フレームの間に受け取った電圧を保持し、またその逆でもあり、前記回路が、前記第1のコンデンサに連結された前記トランジスタをスイッチオフするためのディスエーブル装置(KT1a)を含んで、前記奇数フレームの間に前記トランジスタをディスエーブルするようにし、前記第2のコンデンサに連結された前記トランジスタをスイッチオフするためのディスエーブル装置(KT1b)を含んで、前記偶数フレームの間にこのトランジスタをディスエーブルするようにすることを特徴とする、請求項7および8のいずれか一項に記載のマトリックスディスプレイ。
- 前記偶数フレームの間に、全ての前記第1のコンデンサにランプを印加するための、かつ前記奇数フレームの間に、前記マトリックスの全ての前記第2のコンデンサにランプを印加するための手段を含むことを特徴とする、請求項9に記載のマトリックスディスプレイ。
- 各画像ドットに関連する前記基本回路が、単一の蓄積コンデンサおよび単一のスイッチングトランジスタを備えた単純なメモリを有する回路であることと、前記マトリックスのドットの行の前記蓄積コンデンサに、この行のセルの前記コンデンサにおける蓄積動作の後に始まりかつフレーム期間の残りの間続くランプを印加するための手段が設けられ、前記コンデンサにアナログ電圧を蓄積する動作が、1行ずつ実行されることとを特徴とする、請求項7および8のいずれか一項に記載のマトリックスディスプレイ。
- 連続画像フレームが異なる色光の変調のために働くカラーシーケンシャルディスプレイを構成することを特徴とする、請求項7〜10にいずれか一項に記載のマトリックスディスプレイ。
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Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101186878B1 (ko) * | 2005-08-26 | 2012-10-02 | 엘지디스플레이 주식회사 | 브이에이 모드 액정표시장치 및 그 구동방법 |
US8059114B2 (en) * | 2007-11-14 | 2011-11-15 | Infineon Technologies Ag | Organic light emitting diode driver |
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US10607556B2 (en) * | 2014-11-07 | 2020-03-31 | The Hong Kong University Of Science And Technology | Driving scheme for ferroelectric liquid crystal displays |
Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH03105312A (ja) * | 1989-09-11 | 1991-05-02 | Deutsche Thomson Brandt Gmbh | 液晶表示装置のための制御回路 |
JPH04310925A (ja) * | 1991-04-10 | 1992-11-02 | Sharp Corp | 液晶表示装置 |
JPH07253764A (ja) * | 1994-03-15 | 1995-10-03 | Sharp Corp | 液晶表示装置 |
JPH09212140A (ja) * | 1995-11-30 | 1997-08-15 | Toshiba Corp | 表示装置 |
JPH11338404A (ja) * | 1998-04-30 | 1999-12-10 | Hewlett Packard Co <Hp> | アナログ駆動回路 |
JP2002023705A (ja) * | 2000-07-03 | 2002-01-25 | Hitachi Ltd | 液晶表示装置 |
JP2003043999A (ja) * | 2001-08-03 | 2003-02-14 | Toshiba Corp | 表示画素回路および自己発光型表示装置 |
Family Cites Families (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5997940A (en) * | 1994-08-30 | 1999-12-07 | Thomson-Csf | Method for protecting porous components subjected to large potential differences and components thus produced |
KR100270147B1 (ko) * | 1996-03-01 | 2000-10-16 | 니시무로 타이죠 | 액정표시장치 |
JP3305946B2 (ja) * | 1996-03-07 | 2002-07-24 | 株式会社東芝 | 液晶表示装置 |
US6525709B1 (en) * | 1997-10-17 | 2003-02-25 | Displaytech, Inc. | Miniature display apparatus and method |
WO1999038148A1 (en) * | 1998-01-23 | 1999-07-29 | Fed Corporation | High resolution active matrix display system on a chip with high duty cycle for full brightness |
US6046736A (en) * | 1998-08-17 | 2000-04-04 | Sarnoff Corporation | Self scanned amorphous silicon integrated display having active bus and reduced stress column drivers |
JP3668394B2 (ja) * | 1999-09-13 | 2005-07-06 | 株式会社日立製作所 | 液晶表示装置およびその駆動方法 |
WO2001054107A1 (en) * | 2000-01-21 | 2001-07-26 | Emagin Corporation | Gray scale pixel driver for electronic display and method of operation therefor |
US6861810B2 (en) * | 2001-10-23 | 2005-03-01 | Fpd Systems | Organic electroluminescent display device driving method and apparatus |
TWI286236B (en) * | 2002-09-17 | 2007-09-01 | Adv Lcd Tech Dev Ct Co Ltd | Memory circuit, display circuit, and display device |
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2003
- 2003-10-17 FR FR0312186A patent/FR2861205B1/fr not_active Expired - Fee Related
-
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Patent Citations (7)
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---|---|---|---|---|
JPH03105312A (ja) * | 1989-09-11 | 1991-05-02 | Deutsche Thomson Brandt Gmbh | 液晶表示装置のための制御回路 |
JPH04310925A (ja) * | 1991-04-10 | 1992-11-02 | Sharp Corp | 液晶表示装置 |
JPH07253764A (ja) * | 1994-03-15 | 1995-10-03 | Sharp Corp | 液晶表示装置 |
JPH09212140A (ja) * | 1995-11-30 | 1997-08-15 | Toshiba Corp | 表示装置 |
JPH11338404A (ja) * | 1998-04-30 | 1999-12-10 | Hewlett Packard Co <Hp> | アナログ駆動回路 |
JP2002023705A (ja) * | 2000-07-03 | 2002-01-25 | Hitachi Ltd | 液晶表示装置 |
JP2003043999A (ja) * | 2001-08-03 | 2003-02-14 | Toshiba Corp | 表示画素回路および自己発光型表示装置 |
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