JP2007115762A - 半導体検査装置及び半導体検査方法 - Google Patents
半導体検査装置及び半導体検査方法 Download PDFInfo
- Publication number
- JP2007115762A JP2007115762A JP2005303208A JP2005303208A JP2007115762A JP 2007115762 A JP2007115762 A JP 2007115762A JP 2005303208 A JP2005303208 A JP 2005303208A JP 2005303208 A JP2005303208 A JP 2005303208A JP 2007115762 A JP2007115762 A JP 2007115762A
- Authority
- JP
- Japan
- Prior art keywords
- semiconductor
- inspected
- semiconductor substrate
- inspection
- appearance
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Images
Landscapes
- Testing Or Measuring Of Semiconductors Or The Like (AREA)
Abstract
【課題】半導体製造工程における欠陥検出検査を高精度で行うことが可能な半導体検査装置及び半導体検査方法を提供する。
【解決手段】半導体素子の形成される被検査半導体基板1の露出した導電体層の表面に、窒素を含む反応層を形成する手段と、前記被検査半導体基板における前記半導体素子内の位置に対応する電気的特性の情報を取得する手段と、前記電気的特性情報に基づき選択された領域における外観検査を行う手段を備える。
【選択図】図1
【解決手段】半導体素子の形成される被検査半導体基板1の露出した導電体層の表面に、窒素を含む反応層を形成する手段と、前記被検査半導体基板における前記半導体素子内の位置に対応する電気的特性の情報を取得する手段と、前記電気的特性情報に基づき選択された領域における外観検査を行う手段を備える。
【選択図】図1
Description
本発明は、半導体装置の製造工程における検査装置及び検査方法に関する。
半導体装置の製造工程において行われている欠陥検出検査として、ウエハ状態での電気的特性検査によるスクリーニングが行われている。これは、接触又は非接触のプローピングにより電子の流れを検出し、パターン間のショート、パターンオープン、抵抗異常など電気的な不良を抽出するものである。
例えば、半導体基板に形成されたCu配線間において、印加電圧20mVでの電流を測定して電気的特性検査を行ったとき、4μAの電流を検出すると、5kohmの抵抗値を持つ欠陥(ダスト)による配線間ショート不良として抽出することができる。
このような欠陥検出検査において、配線上に形成される酸化膜に起因する電気的特性測定時のノイズを除去することにより、測定精度を向上させる手法が提案されている(例えば特許文献1参照)。しかしながら、半導体装置の微細化に伴い、さらなる測定精度の向上が要求されている。
特開平10−163280号公報
そこで、本発明は、半導体製造工程における欠陥検出検査を高精度で行うことが可能な半導体検査装置及び半導体検査方法を提供するものである。
本発明の一態様によれば、半導体素子の形成される被検査半導体基板の露出した導電体層の表面に、窒素を含む反応層を形成する手段と、前記半導体素子内の位置に対応する電気的特性の情報を取得する手段と、前記電気的特性情報に基づき選択された領域における外観検査を行う手段を備えることを特徴とする半導体検査装置が提供される。
また、本発明の一態様によれば、半導体素子の形成される被検査半導体基板の露出した導電体層の表面に、窒素を含む反応層を形成する工程と、前記被検査半導体基板における半導体素子の位置情報に対応する電気的特性情報を取得する工程と、前記電気的特性情報に基づき選択された領域における外観検査を行う工程を備えることを特徴とする半導体検査方法が提供される。
本発明の一実施態様によれば、半導体製造工程における欠陥検出検査を高精度で行うことが可能となる。
以下本発明の実施形態について、図を参照して説明する。
(実施形態1)
図1に本実施形態の半導体検査装置を示す。図に示すように、被検査半導体基板1が、搬送手段2により、前処理室3から電気的特性評価室4を経て外観検査評価室5へと、連続して移動可能となっている。
図1に本実施形態の半導体検査装置を示す。図に示すように、被検査半導体基板1が、搬送手段2により、前処理室3から電気的特性評価室4を経て外観検査評価室5へと、連続して移動可能となっている。
前処理室3は、外気の遮断が可能であり、被検査半導体基板1の導電体層上に窒化膜(金属窒化膜)を形成することが可能な窒素含有ガス(以下窒素ガス)を供給するガス供給手段6及び加熱手段7を備えており、評価前の処理が行われる。
電気的特性評価が行われる電気的特性評価室4は、所定の電圧を印加する電源(図示せず)と、被検査半導体基板1に接触させるプローブ8を有する電気的特性測定手段9を備えている。そして、この電気的特性測定手段9は、電気的特性評価結果及びその位置情報を解析する電気的特性解析手段10と接続されている。
外観評価が行われる外観評価室5は、電気的特性解析手段10と接続され、外観欠陥を検出するための例えば光学、電子線を用いた画像検査装置11を備えている。そして、この画像検査装置11は、外観評価結果を保存・解析、フィードバックするための外観検査結果解析手段12と接続されている。
このような半導体検査装置を用いて、半導体基板の検査を行う。先ず、図2に示すような配線間寸法100nmのCu埋め込み配線層1a、1a’が形成された被検査半導体基板1を、図3に示すように、搬送用ケース13に格納して、前処理室3に機械搬送する。尚、Cu埋め込み配線層1a’は、その配線層のプロービング専用領域を示している。前処理室3への外気を遮断した後、ガス供給手段6により、窒素ガスを導入する。このとき、窒素ガスを85℃まで加熱手段7により加熱して、被検査半導体基板1の表面に2分間吹きかけることにより、図4に示すように、Cu埋め込み配線層1a、1a’表面に、例えば1nm〜10nm未満の膜厚のCuNx反応層1b、1b’を形成する。
ここで、CuNx反応層1b、1b’は、電気的特性測定時における表面のリーク電流を抑えるために形成される。これは、半導体素子の微細化に伴い、電気的特性測定の際、配線間など導電体パターン間にリーク電流が発生し、これがノイズとなって欠陥の検出が困難となるという、ウエハ径が300mm以上となると共に、デザインルールが100nm以下となる世代において、新たに見出された問題に対応するためである。例えば、配線間100nmのとき、印加電圧20mVで電気的特性を測定すると、表面のリーク電流が10μA程度発生するため、本来検出すべき電気的欠陥箇所(例えば5kohmの抵抗値を持つ欠陥)を正確かつ高精度に検出することが困難となってしまう。しかしながら、導電体パターン表面に薄いCuNx反応層を形成することにより、表面リーク電流を10pA程度まで抑えることができる。
次いで、前処理室3をオープンにし、図5に示すように、被検査半導体基板1を電気的特性評価室4に搬送し、電気的特性評価を行う。そして、プローブ8を配線層のプロービング専用領域1a’に接触させ、例えば印加電圧20mVにおける電流を測定する。このとき、プローブ8は、CuNx反応層1b’を貫通し、Cu埋め込み配線層1a’に接触させる。
このようにして、電気的特性測定を行い、Cu埋め込み配線層1a、1a’間のショート、配線オープン、ヴィアのオープンや、下層配線、上層配線間のショートなどの電気的特性異常が検出される。
そして、得られた電気的特性測定結果は、その位置情報(座標)とともに電気的特性解析手段10において特性解析用のソフトウエアにて処理され、その解析結果に基づき、異常と認められた領域に絞り込んで、外観評価が行われる。
電気的特性評価が行われた被検査半導体基板1を、図6に示すように、電気的特性評価室4より外観評価室5に搬送し、外観評価を行う。先ず、光学又は電子線を用いた画像検査装置11により、電気的特性解析手段10において、電気的特性が異常と認められた領域の画像データの取得を行う。そして、電気的特性が異常と認められた領域の画像と、被検査半導体基板1内に存在する同じパターンの画像情報(基準画像情報)とを比較することにより、ダストや配線形状・寸法異常などの欠陥を検出する。尚、画像情報(基準画像情報)は被検査半導体基板内の情報に限定されるものではなく、図7に示すように、CAD情報14から取得したパターンの配置情報など外部から入力される情報を用いることが可能である。さらに、外観検査結果解析手段12おいて、欠陥のデータとその位置情報(座標)の解析を行う。
そして、電気的特性が異常と認められた領域すべてにおいて、同様に画像評価、解析を行い、これらの解析情報を不良抽出、或いはプロセス異常の検出を行うためにフィードバックする。
このようにして、半導体素子の微細化に伴い困難となる欠陥検査において、リーク電流を抑えて電気的特性評価を行い、その結果に基づいて外観評価を行なうことにより、ノイズを抑え、欠陥を高精度、高感度でかつ高速に検出、フィードバックすることが可能となる。
本実施形態において、前処理室3においてCuNx反応層1b、1b’を形成する際、窒素ガスを85℃まで加熱手段により加熱して導入しているが、窒素ガスの温度は、25℃以上、200℃以下とすることが好ましい。より好ましくは40℃以上である。また、予めアルコールなどによりCu配線層表面を還元処理し、室温で窒素ガスを導入してもCuNx反応層の形成は可能である。
(実施形態2)
本実施形態においては、実施形態1と同様に電気的特性評価及び外観評価を行うが、CuNx反応層の形成方法が異なっている。
本実施形態においては、実施形態1と同様に電気的特性評価及び外観評価を行うが、CuNx反応層の形成方法が異なっている。
図8に本実施形態の半導体検査装置を構成する前処理室を示す。図に示すように、実施形態1と同様に、被検査半導体基板21が、搬送手段22により、前処理室23から電気的特性評価室を経て外観検査評価室へと、連続して移動可能となっている。
前処理室23は、減圧処理可能であり、半導体基板21上に窒素ガスを供給するガス供給手段26、ガス排出手段39、プラズマ発生手段40を備えており、評価前の処理が行われる。
電気的特性評価室及び外観評価室は、実施形態1と同様の構成となっている。
このような半導体検査装置を用いて、以下のように半導体基板の検査を行う。先ず、実施形態1と同様に、配線間寸法100nmのCu埋め込み配線層が形成された被検査半導体基板21を、搬送用ケースに格納して、前処理室23に機械搬送する。そして、前処理室23内への外気を遮断した後、ガス排出手段39によりポンプなどを用いて空気を排出することにより、減圧状態とした後、ガス供給手段26により、窒素ガスを導入しながらプラズマ発生手段40によりプラズマ放電を生成させ、生成した窒素プラズマ41を2分間被検査半導体基板21表面に供給する。Cu埋め込み配線層表面に、1nm〜10nm未満の膜厚のCuNx反応層を形成する。尚、このとき、300℃以上、より好ましくは350以上450℃以下で基板を加熱しても良い
このようにしてCu埋め込み配線層表面にCuNx反応層が形成された被検査半導体基板21について、実施形態1と同様に、電気的特性評価、外観評価及びその解析を行なう。
このようにしてCu埋め込み配線層表面にCuNx反応層が形成された被検査半導体基板21について、実施形態1と同様に、電気的特性評価、外観評価及びその解析を行なう。
本実施形態において、実施形態1と同様に、これまで半導体素子の微細化に伴い困難となる欠陥検査において、リーク電流を抑えて電気的特性評価を行い、その結果に基づいて外観評価を行なうことにより、ノイズを抑え、欠陥を高精度、高感度でかつ高速に検出、フィードバックすることが可能となる。
これら実施形態において、画像評価、解析を行う部位の数を規定していないが、特に限定されることなく、自由に設定することができる。また、このような外観検査は、所定の電気的特性異常(例えば、ショートのみ、オープンのみなど)に限定して行うことも可能である。そして、このような電気的特性検査を経て実施される外観検査は、画像認識技術を用いて、基準パターンと比較して異なる点を抽出することにより、ダスト、形状異常、寸法異常を検出するものである。
また、これら実施形態において、Cu配線層が形成された半導体基板を検査しているが、Cuに限定されるものではなく、Al、Co、Ni、Tiを主とする導電体材料、或いはこれらを含有する合金を用いた配線層が形成された半導体基板の評価に適応することが可能である。
尚、本発明は、上述した実施形態に限定されるものではない。その他要旨を逸脱しない範囲で種々変形して実施することができる。
1、21 被検査半導体基板
2、22 搬送手段
3、23 前処理室
4 電気的特性評価室
5 外観検査評価室
6、26 ガス供給手段
7 加熱手段
8、28 プローブ
9、29 電気的特性測定手段
10、30 電気的特性解析手段
11、31 画像検査装置
12、32 外観検査結果解析手段
39 ガス排出手段
40 プラズマ発生手段
41 窒素プラズマ
2、22 搬送手段
3、23 前処理室
4 電気的特性評価室
5 外観検査評価室
6、26 ガス供給手段
7 加熱手段
8、28 プローブ
9、29 電気的特性測定手段
10、30 電気的特性解析手段
11、31 画像検査装置
12、32 外観検査結果解析手段
39 ガス排出手段
40 プラズマ発生手段
41 窒素プラズマ
Claims (5)
- 半導体素子の形成される被検査半導体基板の露出した導電体層の表面に、窒素を含む反応層を形成する手段と、
前記被検査半導体基板における前記半導体素子内の位置に対応する電気的特性の情報を取得する手段と、
前記電気的特性情報に基づき選択された領域の外観検査を行う手段を備えることを特徴とする半導体検査装置。 - 前記反応層を形成する手段は、前記被検査半導体基板の表面を、窒素を含有するガス及び/又はプラズマにて処理することを特徴とする請求項1に記載の半導体検査装置。
- 半導体素子の形成される被検査半導体基板の露出した導電体層の表面に、窒素を含む反応層を形成する工程と、
前記被検査半導体基板における前記半導体素子の位置に対応する電気的特性の情報を取得する工程と、
前記電気的特性情報に基づき選択された領域の外観検査を行う工程を備えることを特徴とする半導体検査方法。 - 前記外観検査を行う工程において、前記選択された領域におけるパターンと、前記被検査半導体基板の他の領域に存在する同じパターンとを比較することにより、欠陥を検出することを特徴とする請求項3に記載の半導体検査方法。
- 前記外観検査を行う工程において、前記選択された領域におけるパターンと、そのパターンの設計パターンとを比較することにより、欠陥を検出することを特徴とする請求項3に記載の半導体検査方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005303208A JP2007115762A (ja) | 2005-10-18 | 2005-10-18 | 半導体検査装置及び半導体検査方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005303208A JP2007115762A (ja) | 2005-10-18 | 2005-10-18 | 半導体検査装置及び半導体検査方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2007115762A true JP2007115762A (ja) | 2007-05-10 |
Family
ID=38097705
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2005303208A Pending JP2007115762A (ja) | 2005-10-18 | 2005-10-18 | 半導体検査装置及び半導体検査方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2007115762A (ja) |
-
2005
- 2005-10-18 JP JP2005303208A patent/JP2007115762A/ja active Pending
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US7888961B1 (en) | Apparatus and method for electrical detection and localization of shorts in metal interconnect lines | |
US20110080180A1 (en) | Varying capacitance voltage contrast structures to determine defect resistance | |
US6902941B2 (en) | Probing of device elements | |
US11669957B2 (en) | Semiconductor wafer measurement method and system | |
US7339391B2 (en) | Defect detection method | |
WO2015066050A1 (en) | Detecting ic reliability defects | |
JP4891036B2 (ja) | 半導体装置の製造方法および半導体検査装置 | |
JP2004150840A (ja) | 半導体集積回路の不良解析装置、システムおよび検出方法 | |
JP2002026100A (ja) | 半導体基板および電気回路製造プロセスの検査方法並びに電気回路装置の製造方法 | |
JP2005236094A (ja) | 半導体装置の製造方法、不良解析方法および不良解析システム | |
JP2007115762A (ja) | 半導体検査装置及び半導体検査方法 | |
JP4290316B2 (ja) | 配線ショート箇所の検査方法及び検査装置 | |
JP2003100832A (ja) | 半導体装置の検査方法およびプログラム | |
JP2004022570A (ja) | 評価用素子を含む半導体装置及び該評価用素子を用いた故障解析方法 | |
JPS59228726A (ja) | 不良解析装置 | |
JP3904418B2 (ja) | 電子デバイスの製造方法および電子デバイス用ウエハ | |
JP2008041757A (ja) | 半導体検査装置および半導体検査方法 | |
JP2011014798A (ja) | 半導体検査装置および半導体検査方法 | |
JP2009206295A (ja) | 半導体欠陥検査装置、および半導体欠陥検査方法 | |
JP2009290032A (ja) | 評価解析システム及びプローブカード | |
JP2010056264A (ja) | シリコンウェーハの評価方法および製造方法 | |
JP2005347773A (ja) | 試料検査装置 | |
KR100576474B1 (ko) | 반도체 소자의 미세 결함 검출 방법 | |
JP2000031228A (ja) | 半導体装置の製造方法及び検査方法 | |
JP2007266300A (ja) | 欠陥検出方法 |