JP2007103656A - Semiconductor device and its manufacturing method - Google Patents
Semiconductor device and its manufacturing method Download PDFInfo
- Publication number
- JP2007103656A JP2007103656A JP2005291248A JP2005291248A JP2007103656A JP 2007103656 A JP2007103656 A JP 2007103656A JP 2005291248 A JP2005291248 A JP 2005291248A JP 2005291248 A JP2005291248 A JP 2005291248A JP 2007103656 A JP2007103656 A JP 2007103656A
- Authority
- JP
- Japan
- Prior art keywords
- layer
- semiconductor device
- wiring
- film
- shock absorbing
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/02—Bonding areas ; Manufacturing methods related thereto
- H01L24/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L24/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/02—Bonding areas ; Manufacturing methods related thereto
- H01L24/03—Manufacturing methods
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/0212—Auxiliary members for bonding areas, e.g. spacers
- H01L2224/02122—Auxiliary members for bonding areas, e.g. spacers being formed on the semiconductor or solid-state body
- H01L2224/02163—Auxiliary members for bonding areas, e.g. spacers being formed on the semiconductor or solid-state body on the bonding area
- H01L2224/02165—Reinforcing structures
- H01L2224/02166—Collar structures
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/04042—Bonding areas specifically adapted for wire connectors, e.g. wirebond pads
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/05001—Internal layers
- H01L2224/05073—Single internal layer
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/0554—External layer
- H01L2224/05541—Structure
- H01L2224/05548—Bonding area integrally formed with a redistribution layer on the semiconductor or solid-state body
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/0554—External layer
- H01L2224/0555—Shape
- H01L2224/05556—Shape in side view
- H01L2224/05558—Shape in side view conformal layer on a patterned surface
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/0554—External layer
- H01L2224/05599—Material
- H01L2224/056—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/05617—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
- H01L2224/05624—Aluminium [Al] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/4805—Shape
- H01L2224/4807—Shape of bonding interfaces, e.g. interlocking features
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/484—Connecting portions
- H01L2224/4845—Details of ball bonds
- H01L2224/48451—Shape
- H01L2224/48453—Shape of the interface with the bonding area
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/484—Connecting portions
- H01L2224/48463—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01004—Beryllium [Be]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01005—Boron [B]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01006—Carbon [C]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01013—Aluminum [Al]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01014—Silicon [Si]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01022—Titanium [Ti]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01024—Chromium [Cr]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01028—Nickel [Ni]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01029—Copper [Cu]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01033—Arsenic [As]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01074—Tungsten [W]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01078—Platinum [Pt]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01079—Gold [Au]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/049—Nitrides composed of metals from groups of the periodic table
- H01L2924/0494—4th Group
- H01L2924/04941—TiN
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/049—Nitrides composed of metals from groups of the periodic table
- H01L2924/0504—14th Group
- H01L2924/05042—Si3N4
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/14—Integrated circuits
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/181—Encapsulation
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Manufacturing & Machinery (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
- Wire Bonding (AREA)
Abstract
Description
本発明は、一般的には集積回路半導体装置におけるワイヤボンディング接続に関し、特に、前記半導体装置の能動回路領域上でのワイヤボンディング接続を可能とする前記能動回路領域上に配置されたボンディングパッドおよびその製造方法に関する。 The present invention generally relates to wire bonding connection in an integrated circuit semiconductor device, and more particularly, to a bonding pad disposed on the active circuit region that enables wire bonding connection on the active circuit region of the semiconductor device, and the same It relates to a manufacturing method.
通常の集積回路半導体装置は、能動回路領域の周辺部に配置されたボンディングパッドを有する。これらのボンディングパッドは、ボールボンディング接続またはスティッチボンディング接続のいずれかを可能とするように十分な大きさでなければならない。従ってボンディングパッドのため半導体装置が大きくなるという問題があった。 A typical integrated circuit semiconductor device has a bonding pad arranged at the periphery of an active circuit region. These bonding pads must be large enough to allow either a ball bonding connection or a stitch bonding connection. Therefore, there is a problem that the semiconductor device becomes large due to the bonding pad.
(第1の従来技術)
このボンディングパッドのため半導体装置が大きくなるという問題を改善するために、図37に示す特許文献1に開示された技術が提案されている。この特許文献1のものによれば、能動回路上にポリイミド層を介してボンディングパッドを形成するとともに接続孔によりボンディングパッドと能動回路とを電気的に接続した後、ボンディングパッドにワイヤをボンディングするというものであり、この結果として、能動回路領域の周辺部に配置されたボンディングパッドを削減できるというものである。
(First prior art)
In order to improve the problem that the semiconductor device becomes large due to the bonding pad, a technique disclosed in
上記した特許文献1に示す能動回路上ボンディングパッドでは、ワイヤをボンディングする際のボンディング衝撃をボンディングパッド下層のポリイミド層により吸収・緩和する構造であるが、図37に示すようにボンディングパッドと下部の能動回路とを電気的に接続する接続部にもボンディング衝撃が作用し、この接続部での接続不良が発生するという問題があった。
The above-mentioned bonding pad on the active circuit shown in
(第2の従来技術)
ボンディングパッドのため半導体装置が大きくなるという基本的な問題の改善に加え、ボンディング衝撃によりボンディングパッドと能動回路との接続部での接続不良が発生するという特許文献1の不具合を改善するために、図38に示すような特許文献2に開示された技術が提案されている。
(Second prior art)
In addition to improving the basic problem that the semiconductor device becomes large due to the bonding pad, in order to improve the defect of
この特許文献2の技術によれば、能動回路上に実質的に中断箇所を持たない無機材料からなるパシベーション材料層を形成した後、能動回路上にボンディングパッドを形成し、ワイヤをボンディングする領域から離れた箇所に形成された接続孔を介して能動回路とボンディングパッドとを電気的に接続するというものである。
According to the technique of this
この特許文献2の技術による能動回路上ボンディングパッドでは、能動回路との接続孔はボンディング領域から離れておりボンディングパッドの一部を延長した接続配線により能動回路と接続するためボンディング衝撃により接続部での接続不良が発生するという問題は改善できる。
In the bonding pad on the active circuit according to the technique of this
しかし、ボンディングパッドおよび接続配線ともに露出した構造となるため特許文献2の半導体装置をモールド樹脂により実装した場合、前記接続部を含む接続配線の耐環境信頼性において問題があった。
However, since both the bonding pad and the connection wiring are exposed, there is a problem in the environmental reliability of the connection wiring including the connection portion when the semiconductor device of
加えて、ボンディング衝撃を金属材料からなるボンディングパッドと無機材料からなるパシベーション材料層とで吸収・緩和する構造であるため、能動回路の配線段差が大きく急峻な場合にはボンディング衝撃によりパシベーション材料層にクラックが発生する。 In addition, since the bonding shock is absorbed and relaxed by a bonding pad made of a metal material and a passivation material layer made of an inorganic material, if the wiring step of the active circuit is large and steep, the bonding shock causes the passivation material layer to Cracks occur.
また、半導体装置の使用時の環境温度変化が大きい場合、ボンディング衝撃により発生したクラックが伸展しボンディングパッドと能動回路の配線が短絡するという問題点があった。加えて、ボンディング衝撃によるパシベーション材料層のクラックに起因する経時劣化現象が検出できないという問題点があった。
ボンディングパッドのため半導体装置が大きくなるという問題を改善する能動回路上ボンディングパッドにおいて、能動回路とボンディングパッドと電気的に接続する接続孔にボンディング衝撃が作用する場合にはボンディング衝撃により接合部に不良が発生するという問題がある。 The bonding pad on the active circuit improves the problem that the semiconductor device becomes large due to the bonding pad. If a bonding impact acts on the connection hole electrically connected to the active circuit and the bonding pad, the bonding impact is defective due to the bonding impact. There is a problem that occurs.
また、接続孔をボンディング領域から離して形成しボンディングパッドの一部を延長した接続配線で接続する構造においてボンディングパッドとともに接続配線が露出する構造の場合には耐環境信頼性が劣化するという問題がある。 In addition, in the structure in which the connection hole is formed away from the bonding region and the connection wiring is connected with the bonding pad extended, there is a problem that the environmental reliability is deteriorated in the structure in which the connection wiring is exposed together with the bonding pad. is there.
加えて、配線段差が大きく急峻な能動回路上に無機材料による絶縁層を介してボンディングパッドを形成した構造ではボンディング衝撃により前記絶縁層にクラックが発生し初期不良もしくは信頼性不良が発生するという問題点がある。 In addition, in a structure in which a bonding pad is formed on an active circuit with a large wiring step via an insulating layer made of an inorganic material, a crack is generated in the insulating layer due to bonding impact, resulting in an initial failure or a reliability failure. There is a point.
本発明は、ボンディング衝撃による能動回路とボンディングパッドとの接合部不良および能動回路とボンディングパッドとの間の絶縁層不良の発生を抑止するとともに、ボンディング衝撃に対しフェールセーフ的な構造でありボンディング衝撃に起因する不良を検出可能とした能動回路上ボンディングパッドを有する半導体装置およびその製造方法を提供するものである。 The present invention suppresses the occurrence of defective bonding between the active circuit and the bonding pad due to the bonding impact and the failure of the insulating layer between the active circuit and the bonding pad, and has a fail-safe structure against the bonding shock. The present invention provides a semiconductor device having a bonding pad on an active circuit that can detect a defect caused by the above-described problem and a method for manufacturing the same.
本発明による半導体装置においては、半導体装置の能動回路上に絶縁膜を介して平面構造において複数の開口を持つ衝撃吸収梁を形成し、能動回路を保護する保護膜を介して衝撃吸収梁上に保護膜に設けた接続孔により能動回路と接続された厚い電極を形成し、厚い電極にボンディング接続時に必要な領域のみ開口した保護樹脂層で半導体装置を被覆する構造であり、前記衝撃吸収梁を被覆する保護膜の表面段差以上に前記の厚い電極の厚さを設定することにより、ボンディング面方向の超音波振動に起因するボンディング衝撃を主として厚い電極で吸収・緩和することが可能となるとともに、下層へ伝播した衝撃により前記保護膜にクラックが発生した場合においても前記衝撃吸収梁によりその後のクラックの伸展を抑止することができ能動回路との短絡が発生しないフェールセーフ構造である。 In the semiconductor device according to the present invention, an impact absorbing beam having a plurality of openings in a planar structure is formed on an active circuit of the semiconductor device via an insulating film, and is formed on the impact absorbing beam via a protective film that protects the active circuit. A thick electrode connected to the active circuit is formed by a connection hole provided in the protective film, and the semiconductor device is covered with a protective resin layer that is opened only in a necessary region at the time of bonding connection to the thick electrode. By setting the thickness of the thick electrode above the surface step of the protective film to be coated, it becomes possible to absorb and mitigate the bonding impact caused by the ultrasonic vibration in the bonding surface direction mainly with the thick electrode, Even when a crack is generated in the protective film due to an impact propagated to the lower layer, the impact absorbing beam can suppress subsequent crack extension. It is a fail-safe structure in which short-circuiting between the circuit does not occur.
また前記衝撃吸収梁に形成する開口部の平面形状を円形もしくは多角形にすることにより、ボンディング衝撃に対する指向性を無くすことができ能動回路上でのボンディングパッドの配置位置自由度を向上できる。 In addition, by making the planar shape of the opening formed in the shock absorbing beam circular or polygonal, directivity with respect to bonding impact can be eliminated and the bonding pad layout position freedom on the active circuit can be improved.
加えてボンディング接続に必要な領域のみ開口した保護樹脂層で半導体装置を被覆する構造であるため、実装後の半導体装置においてボンディングパッドと能動回路を接続する接続配線に起因する耐環境信頼性の劣化現象を抑止できる。 In addition, since the semiconductor device is covered with a protective resin layer that is opened only in the area necessary for bonding connection, degradation of environmental reliability due to connection wiring connecting the bonding pad and active circuit in the mounted semiconductor device The phenomenon can be suppressed.
本発明の別の半導体装置においては、半導体装置の能動回路上に絶縁膜を介して平面構造において複数の開口を持つ衝撃吸収梁を形成し、能動回路を保護する保護膜を介して衝撃吸収梁上に厚いパッド電極を形成し、厚いパッド電極を被服しその一部を延長し保護膜に設けた接続孔により能動回路と接続するよう被覆金属配線層を形成し、厚いパッド電極へのボンディング接続時に必要な領域のみ開口した保護樹脂層で半導体装置を被覆する構造である。 In another semiconductor device of the present invention, an impact absorbing beam having a plurality of openings in a planar structure is formed on an active circuit of the semiconductor device via an insulating film, and the impact absorbing beam is protected via a protective film that protects the active circuit. A thick pad electrode is formed on top, a thick pad electrode is coated, a part of it is extended, and a covering metal wiring layer is formed to connect to the active circuit through a connection hole provided in the protective film, and bonding connection to the thick pad electrode In some cases, the semiconductor device is covered with a protective resin layer that is opened only in necessary regions.
厚いパッド電極を被覆金属配線層より機械的強度の高い金属材料で形成するとともにその厚さを前記衝撃吸収梁上に形成した前記保護膜の表面段差以上に設定することにより、ボンディング面方向の超音波振動に起因するボンディング衝撃を主として前記被覆金属配線層を変形させることで吸収・緩和するとともに、下層へ伝播するボンディング衝撃を機械的強度の高い厚いパッド電極で分散することによりボンディング衝撃による能動回路への影響を従来構造より低減できる。 By forming the thick pad electrode with a metal material having a mechanical strength higher than that of the coated metal wiring layer and setting the thickness to be equal to or greater than the surface step of the protective film formed on the shock absorbing beam, it is possible to Absorbing and mitigating bonding impact caused by sonic vibration mainly by deforming the coated metal wiring layer, and dispersing the bonding impact propagating to the lower layer with thick pad electrodes with high mechanical strength, thereby active circuit due to bonding impact Can be reduced compared to the conventional structure.
加えて、ボンディング衝撃により前記保護膜にクラックが発生した場合においても前記衝撃吸収梁によりクラックの伸展を抑止し能動回路との短絡を発生させないフェールセーフ構造である。 In addition, even when a crack is generated in the protective film due to a bonding impact, the fail-absorbing structure prevents the extension of the crack by the impact absorbing beam and does not cause a short circuit with the active circuit.
また、前記衝撃吸収梁に形成する開口部の平面形状を円形もしくは多角形にすることにより、ボンディング衝撃に対する指向性を無くすことができ能動回路上でのボンディングパッドの配置位置自由度を向上できる。 In addition, by making the planar shape of the opening formed in the shock absorbing beam circular or polygonal, directivity with respect to bonding impact can be eliminated, and the freedom of arrangement position of the bonding pad on the active circuit can be improved.
更に、前記厚いパッドと能動回路との接続部は保護樹脂層で保護されているため実装後の耐環境信頼性の劣化を抑止できる。 Furthermore, since the connection portion between the thick pad and the active circuit is protected by a protective resin layer, it is possible to suppress degradation of environmental resistance reliability after mounting.
また本発明の更に別の半導体装置においては、半導体装置の能動回路上に絶縁膜を介して平面構造において複数の開口を持つ衝撃吸収梁を形成し、能動回路を保護する保護膜を形成したのち衝撃吸収梁の近傍に接続孔を形成し、衝撃吸収梁と接続孔を被覆するよう厚いパッド電極を形成し厚いパッド電極と能動回路とを電気的に接続する。 In still another semiconductor device of the present invention, an impact absorbing beam having a plurality of openings in a planar structure is formed on an active circuit of the semiconductor device via an insulating film, and a protective film for protecting the active circuit is formed. A connection hole is formed in the vicinity of the shock absorbing beam, a thick pad electrode is formed so as to cover the shock absorbing beam and the connection hole, and the thick pad electrode and the active circuit are electrically connected.
また衝撃吸収梁は、その一部を延長し保護膜に設けた別の接続孔により最上層配線層と接続される。厚いパッド電極を被覆金属配線層により被服した後、厚いパッド電極へのボンディング接続時に必要な領域のみ開口した保護樹脂層で半導体装置を被覆する構造である。 Further, the shock absorbing beam is connected to the uppermost wiring layer through another connection hole that is partially extended and provided in the protective film. After the thick pad electrode is coated with the covering metal wiring layer, the semiconductor device is covered with a protective resin layer that is opened only in a region necessary for bonding connection to the thick pad electrode.
厚いパッド電極を被覆金属配線層より機械的強度の高い金属材料で形成するとともにその厚さを前記衝撃吸収梁上に形成した前記保護膜の表面段差以上に設定することにより、ボンディング面方向の超音波振動に起因するボンディング衝撃を主として前記被覆金属配線層を変形させることで吸収・緩和することが可能となるとともに、下層へ伝播するボンディング衝撃を機械的強度の高い厚いパッド電極で分散することができボンディング衝撃による能動回路への影響を従来構造より低減できる。 By forming the thick pad electrode with a metal material having a mechanical strength higher than that of the coated metal wiring layer and setting the thickness to be equal to or greater than the surface step of the protective film formed on the shock absorbing beam, it is possible to It is possible to absorb and mitigate bonding impact caused by sonic vibration mainly by deforming the coated metal wiring layer and to disperse the bonding impact propagating to the lower layer with a thick pad electrode with high mechanical strength. The effect on the active circuit due to bonding impact can be reduced compared to the conventional structure.
加えて、衝撃により前記保護膜にクラックが発生した場合においても前記衝撃吸収梁によりクラックの伸展を抑止することができ能動回路との短絡を発生させないフェールセーフ構造であり、最上層配線を介して厚いパッド電極と衝撃吸収梁間の漏洩電流を測定することにより前記のクラック発生を検出することができるという自己診断機能を有する。 In addition, even when a crack is generated in the protective film due to an impact, the impact absorbing beam can suppress the extension of the crack, and a fail-safe structure that does not cause a short circuit with an active circuit. It has a self-diagnosis function capable of detecting the occurrence of cracks by measuring the leakage current between the thick pad electrode and the shock absorbing beam.
また、前記衝撃吸収梁に形成する開口部の平面形状を円形もしくは多角形にすることにより、ボンディング衝撃に対する指向性を無くすことができ能動回路上のボンディングパッドの配置位置自由度を向上できる。 Further, by making the planar shape of the opening formed in the shock absorbing beam circular or polygonal, directivity with respect to bonding impact can be eliminated, and the position of the bonding pad on the active circuit can be improved.
更に、前記厚いパッドと能動回路との接続部は保護樹脂層で保護されているため実装後の耐環境信頼性の劣化を抑止できる。 Furthermore, since the connection portion between the thick pad and the active circuit is protected by a protective resin layer, it is possible to suppress degradation of environmental resistance reliability after mounting.
(第1の実施形態)
以下、添付図面を参照しつつ、本発明の実施例を説明する。
図1は、本発明に係る能動回路上に配置されたボンディングパッド部の第1の実施例を示す模式的な平面図である。また、図2は図1中A−A´線で示す部分の模式的な断面図である。
(First embodiment)
Hereinafter, embodiments of the present invention will be described with reference to the accompanying drawings.
FIG. 1 is a schematic plan view showing a first embodiment of a bonding pad portion disposed on an active circuit according to the present invention. FIG. 2 is a schematic cross-sectional view taken along the line AA ′ in FIG.
第1の実施例は、図2に示すように第1の配線2で結線された能動回路1を被覆した層間絶縁層3の上面に、能動回路1が機能するよう第1の接続孔4を介して接続された第2の配線5と、平面構造において複数の開口を持つ衝撃吸収梁6がボンディング接続領域に設ける。
In the first embodiment, as shown in FIG. 2, the first connection hole 4 is formed on the upper surface of the interlayer insulating layer 3 covering the
第2の配線5と衝撃吸収梁6を設けた前記能動回路1を保護膜7により被覆し、図1に示すように保護膜7上に衝撃吸収梁6を被覆しその一部が保護膜7に設けられた第2接続孔8を介して能動回路1と電気的に接続されるよう厚い電極9を設け、ワイヤ11をボンディングする際に必要な領域のみ開口した保護樹脂層10により表面を保護した構造である。
The
第1の実施例において、衝撃吸収梁6を被覆する保護膜7の表面段差以上の膜厚に厚い電極9の膜厚を設定することが望ましい。
In the first embodiment, it is desirable to set the film thickness of the
この膜厚に設定された厚い電極9にワイヤをボンディング接続する際、図2に示すように接続部の最下面は衝撃吸収梁6を被覆する保護膜7の最上面と同じかまたは高い位置となりボンディング衝撃の主要因である超音波振動の作用面は前記保護膜7の最上面より高くなるため、ボンディング衝撃は前記厚い電極9により吸収・緩和される。
When the wire is bonded to the
このボンディング衝撃の吸収・緩和性とボンディング接続性を両立するために、前記厚い電極9の材質としてはアルミ,アルミ合金,銅,ニッケル,クロム,チタン,チタン窒化膜,チタンタングステンのいずれか、またはこれらのうちの2以上のものの積層膜が望ましい。
In order to achieve both the absorption / relaxation of bonding impact and bonding connectivity, the
更に厚い電極9より下層に伝播したボンディング衝撃によって保護膜7にクラックが発生したとしても、クラックを発生させた後の過剰な衝撃は複数の開口を持つ網目状の前記衝撃吸収梁6を機械的に変形させることにより吸収される。
Even if a crack is generated in the
これによりクラックの伸展を抑止できる。加えて、衝撃吸収梁6は前記能動回路1と電気的に絶縁されているため、保護膜7に発生したクラックを介して前記の厚い電極9と衝撃吸収梁6が電気的に短絡しても能動回路1に誤動作は発生しない。
Thereby, extension of a crack can be suppressed. In addition, since the
加えて、第1の実施形態による能動回路上ボンディングパッドの配置に関し、能動回路1の表面段差状態の依存性またボンディング接続時に印加される超音波振動の方向依存性を無くすために、前記衝撃吸収梁6の開口形状は図3に示す円形もしくは図4に示す多角形が望ましい。
In addition, with respect to the arrangement of the bonding pads on the active circuit according to the first embodiment, the shock absorption is performed in order to eliminate the dependency of the surface step state of the
また機械的変形によるボンディング衝撃性を向上と製造過程の複雑さ低減を両立させるために、衝撃吸収梁6は前記の第2の配線5と同一材料でありアルミまたはアルミ合金を主材料とすることが望ましい。
Further, in order to improve both the bonding impact due to mechanical deformation and reduce the complexity of the manufacturing process, the
また層間絶縁膜3は、衝撃吸収梁6と能動回路1との絶縁性に加え平坦性を確保するためシリコン酸化膜を主体とする膜が望ましく、保護膜7はボンディング衝撃に対する耐量を高めるため層間絶縁膜3より機械強度の高いシリコン窒化膜が望ましい。前記保護樹脂層10は段差被覆性に優れ機械強度が高くかつ、耐熱性・耐湿性の高いポリイミド樹脂膜が望ましい。
The interlayer insulating film 3 is preferably a film mainly composed of a silicon oxide film in order to ensure flatness in addition to the insulation between the
(第2の実施形態)
図5は、本発明に係る能動回路上に配置されたボンディングパッド部の第2の実施例を示す模式的な断面図である。
(Second Embodiment)
FIG. 5 is a schematic sectional view showing a second embodiment of the bonding pad portion arranged on the active circuit according to the present invention.
第2の実施形態は、図5に示すように第1の実施例と同様に第1の配線32で結線された能動回路31を被覆した層間絶縁層33の上面に、能動回路31が機能するよう第2の配線35と、平面構造において複数の開口を持つ衝撃吸収梁36がボンディング接続領域に設ける。
In the second embodiment, as shown in FIG. 5, the
第2の配線35と衝撃吸収梁36を設けた前記能動回路31は段差を緩和する処置を施した第2の層間絶縁層37と保護膜38により被覆し、保護膜38上に前記衝撃吸収梁36を被覆しその一部が第2の接続孔39を介して能動回路31と電気的に接続されるよう厚い電極40を設け、ボンディング接続時に必要な領域のみ開口した保護樹脂層41により表面を保護する構造である。
The
第2の実施例において、衝撃吸収梁36を被覆する保護膜38の表面段差以上の膜厚に厚い電極40の膜厚を設定することが望ましい。また前記第2の層間絶縁層37の段差緩和処置は、衝撃吸収梁36上厚い電極40の表面窪み部のテーパー角(図5中θと記載した角度)が45°以上になるような段差緩和処置であることが望ましい。
In the second embodiment, it is desirable to set the film thickness of the
この構造によれば、ワイヤをボンディング接続する際の接続部の最下面は衝撃吸収梁36を被覆する保護膜38の最上面と同じかまたは高い位置となりボンディング衝撃の主要因である超音波振動の作用面は前記保護膜38の最上面より高くなるとともに衝撃の鉛直方向成分より平面方向成分が大きくなり、厚い電極40によるボンディング衝撃の吸収・緩和がより効率的なものとなる。
According to this structure, the lowermost surface of the connecting portion when bonding the wires is the same as or higher than the uppermost surface of the
厚い電極40の材質としては、第1の実施例と同様にアルミ,アルミ合金,銅,ニッケル,クロム,チタン,チタン窒化膜,チタンタングステンのいずれか、またはこれらのうちの2以上のものの積層膜が望ましい。
As the material of the
また第2の実施例においても、第1の実施例と同様に前記厚い電極40より下層に伝播したボンディング衝撃により前記保護膜38にクラックが発生したとしても、クラックを発生させた後の過剰な衝撃は複数の開口を持つ網目状の前記衝撃吸収梁36を機械的に変形させることにより吸収され、クラックの伸展は抑止される。
Also in the second embodiment, as in the first embodiment, even if a crack is generated in the
加えて衝撃吸収梁36は前記能動回路31と電気的に絶縁されているため、保護膜38および第2の層間絶縁層37に発生したクラックを介して前記の厚い電極40と衝撃吸収梁36が電気的に短絡しても能動回路31に誤動作は発生しない。
In addition, since the
(※以下、段落番号は提案書の番号とずれます)
また第2の実施例においても、能動回路31の表面段差状態の依存性またボンディング接続時の超音波振動の方向依存性を無くすために、前記衝撃吸収梁36の開口形状は図3に示す円形もしくは図4に示す多角形が望ましく、また機械的変形によるボンディング衝撃性を向上と製造過程の複雑さ低減を両立させるために、衝撃吸収梁36は前記の第2の配線35と同一材料でありアルミまたはアルミ合金を主材料とすることが望ましい。
(* The following paragraph numbers will be different from the proposal numbers.)
Also in the second embodiment, the opening shape of the
前記第2の層間絶縁膜37は段差緩和処置を実施したシリコン酸化膜を主体とする膜が望ましく、層間絶縁膜33,保護膜37および保護樹脂層41は、第1の実施例と同様に、それぞれシリコン酸化膜を主体とする膜,シリコン窒化膜,ポリイミド樹脂膜が望ましい。
The second
(第3の実施形態)
本発明に係る第3の実施例の能動回路上に配置されたボンディングパッド部の模式的な断面図を図6に示す。
(Third embodiment)
FIG. 6 shows a schematic sectional view of the bonding pad portion arranged on the active circuit of the third embodiment according to the present invention.
第3の実施例は、図6に示すように第1の実施例と同様に第1の配線52で結線された能動回路51を被覆した層間絶縁層53の上面に、能動回路51が機能するよう第1の接続孔54を介して接続された第2の配線55と平面構造において複数の開口を持つ衝撃吸収梁56を配し、保護膜57により被覆する。
In the third embodiment, as shown in FIG. 6, the
衝撃吸収梁56上方に保護膜57を介して厚いパッド電極59が設けその上面と全側面を被覆金属配線層60により被覆する。被覆金属配線層60の一部を延長した配線により第2接続孔58を介して厚いパッド電極59と前記能動回路51とを電気的に接続し、ワイヤ62をボンディングする際に必要な領域のみ開口した保護樹脂層61により表面を保護した構造である。
A
第3の実施例の厚いパッド電極59において、衝撃吸収梁56を被覆する保護膜57の表面段差以上の膜厚に厚いパッド電極59の膜厚を設定することが望ましい。また厚いパッド電極59の材質としては被覆する被覆金属配線層60より機械的強度が高い材料が望ましく、アルミ合金,銅,ニッケル,クロム,タングステン,チタン,チタン窒化膜,チタンタングステンのいずれか、またはこれらのうちの2以上のものの積層膜が望ましい。
In the
また前記被覆金属配線層60は、主たる構成材料として厚いパッド電極59の構成材料より機械的強度の低い材料でありワイヤボンディング時の接合強度を確保可能な材料が望ましく、アルミ,アルミ合金,金のいずれかかまたは、上層がアルミまたはアルミ合金いずれかであり下層がチタン,チタン窒化膜,チタンタングステンのいずれかで構成された2層積層膜が望ましい。
The coated
厚いパッド電極59と被覆金属配線層60をこれらの材料により構成することにより、ワイヤボンディング時の衝撃は主に被覆金属配線層60の変形により吸収・緩和されるとともに、過剰な衝撃の下層への伝播は機械的強度の高い厚いパッド電極59により分散されるため下層への影響を低減できる。
By configuring the
また第3の実施例では、前記の厚いパッド電極59と能動回路51とは厚いパッド電極59を被覆する被覆金属配線層60の一部により第2の接続孔58を介して接続されているため接続部の配線被覆段差を低くできるため、図6に示すように保護樹脂層61による接続部の被覆が十分なものとなり接合部の高信頼性化が図れる。
In the third embodiment, the
加えて層間絶縁層53, 衝撃吸収梁56および保護樹脂層61は、その機能および望ましい材料は第1の実施例または第2の実施例と同じであるためその記載を省略する。
In addition, since the functions and desirable materials of the interlayer insulating
また保護膜57は第1の実施例に記載の保護膜7と同じかもしくは第2の実施例に記載の第2の層間絶縁層37および保護膜38と同じ膜による2層積層膜で構成されていることが望ましい。
The
(第4の実施形態)
本発明に係る第4の実施例の能動回路上に配置されたボンディングパッド部の模式的な断面図を図7に示すとともに図7中のB部の詳細図を図8に示す。
(Fourth embodiment)
FIG. 7 shows a schematic sectional view of the bonding pad portion arranged on the active circuit of the fourth embodiment according to the present invention, and FIG. 8 shows a detailed view of a portion B in FIG.
第4の実施例は、図7に示すように第1の実施例と同様に第1の配線72で結線された能動回路71を被覆した層間絶縁層73の上面に、能動回路71が機能するよう第1の接続孔74を介して接続された第2の配線75と平面構造において複数の開口を持つ衝撃吸収梁76を配し、保護膜77により被覆する。衝撃吸収梁76上に密着強化金属層79とシード電極層80を介して厚いパッド電極81を設けその上面と全側面を被覆金属配線層82により被覆する。
In the fourth embodiment, as shown in FIG. 7, the
厚いパッド電極81は密着強化金属層79,シード電極層80および被覆金属配線層82の一部を延長した配線により第2の接続孔78を介して能動回路71は電気的に接続され、ワイヤ84をボンディングする際に必要な領域のみ開口した保護樹脂層83により表面を保護した構造である。
The
第4の実施例において、密着強化金属層79は保護膜77との密着性の高い金属薄膜が望ましく、チタン,チタン窒化膜,チタンタングステンのいずれかかまたはこれらのうちの2以上のものの積層膜で構成されていることが望ましい。
In the fourth embodiment, the adhesion reinforcing
厚いパッド電極81はシード電極層80と同一材質でありシード電極層80を形成時の種として用いるメッキ法により形成される金属膜が望ましく、材質としては電気抵抗が低く機械強度の高い銅が望ましい。またその膜厚については、第3の実施例に記載の厚いパッド電極59と同じ要件を満たすことが望ましい。
The
ボンディング衝撃の吸収・緩和に対する被覆金属配線層82で被覆した厚いパッド電極81の機能は第3の実施例と同様でありその詳細は省略するが、第4の実施例においては、前記密着強化金属層79を介して保護膜77上に厚いパッド電極81を設けるため、ボンディング時の超音波衝撃によるせん断力に対する厚いパッド電極81の付着耐量が向上し信頼性の高いボンディングパッドを得ることが出来る。
The function of the
また厚いパッド電極81と前記能動回路71を接続する配線も、図8に示すように密着強化金属層79,シード電極層80および被覆金属配線層82の積層構造により構成されるため、厚いパッド電極81に対する接続性および保護膜77に対する密着性が高く、信頼性の高い接続配線を得ることができる。
Further, the wiring connecting the
加えて層間絶縁層73, 衝撃吸収梁76および保護樹脂層83は、その機能および望ましい材料は第1の実施例または第2の実施例と同じであるためその記載を省略する。
In addition, since the functions and desirable materials of the interlayer insulating
また保護膜77は第1の実施例に記載の保護膜7と同じかもしくは、第2の実施例に記載の第2の層間絶縁層37および保護膜38と同じ膜による2層積層膜が望ましい。
Further, the
(第5の実施形態)
本発明に係る第5の実施例の能動回路上に配置されたボンディングパッド部の模式的な断面図を図9に示すとともに図9中のC部の拡大断面例を図10に示す。
(Fifth embodiment)
FIG. 9 shows a schematic cross-sectional view of the bonding pad portion disposed on the active circuit of the fifth embodiment according to the present invention, and FIG. 10 shows an enlarged cross-sectional example of the portion C in FIG.
第5の実施例は、図9に示すように第1の実施例と同様に第1の配線72で結線された能動回路71を被覆した層間絶縁層73の上面に、能動回路71が機能するよう第1の接続孔74を介して接続された第2の配線75と平面構造において複数の開口を持つ衝撃吸収梁76を配し、保護膜77により被覆する。衝撃吸収梁76上に密着強化金属層79と介して厚いパッド電極81を設け、厚いパッド電極81の上面と全側面を被覆金属配線層82により被覆する。
In the fifth embodiment, as shown in FIG. 9, the
また厚いパッド電極81は密着強化金属層79と被覆金属配線層82との一部を延長し積層した配線,第2の接続孔78,第2の配線75および第1の接続孔74を経由して能動回路71と電気的に接続し、ワイヤ84をボンディングする際に必要な領域のみ開口した保護樹脂層83により表面を保護した構造である。
Further, the
第5の実施例においては、厚いパッド電極81は上面および全側面を被覆金属配線層82により底面を密着強化金属層79により完全に封止される。厚いパッド電極81を形成する際にシード電極層80を用いる場合においても図10に示すように厚いパッド電極81に加えシード電極層80も密着強化金属層79と被覆金属配線層82により完全に封止される。
In the fifth embodiment, the
また第2の接続孔78を介して能動回路71と厚いパッド電極81を接続する接続配線は密着強化金属層79と被覆金属配線層82との積層により形成するため、電気抵抗またはその製造工程上の簡便さを優先させ厚いパッド電極81の構成材料として材質面で耐湿性にやや劣る材料を用いた場合においても、耐環境性を劣化させることなく信頼性の高いボンディングパッドおよび接続配線を得ることができる。
Further, since the connection wiring for connecting the
第5の実施例による能動回路上ボンディングパッドにおいても、ボンディング接続時の衝撃に対する吸収・緩和機能およびに耐せん断性については第4の実施例と同様であり、密着強化金属層79,シード電極層80,厚いパッド電極81および被覆金属配線層82それぞれの機能および望ましい材料は第4の実施例と同じであるためその詳細は省略する。加えて、層間絶縁層73, 衝撃吸収梁76,保護膜77および保護樹脂層83についても第4の実施例と同じであるためその詳細は省略する。
Also in the bonding pad on the active circuit according to the fifth embodiment, the absorption / relaxation function and the shear resistance against the impact at the time of bonding connection are the same as those of the fourth embodiment, and the adhesion strengthening
(第6の実施形態)
図11は、本発明に係る能動回路上に配置されたボンディングパッド部の第6の実施例を示す模式的な平面図である。また、図12は第6の実施例を示す模式的な平面図11のD−D´での断面図である。
(Sixth embodiment)
FIG. 11 is a schematic plan view showing a sixth embodiment of the bonding pad portion arranged on the active circuit according to the present invention. FIG. 12 is a cross-sectional view taken along the line DD ′ of the
第6の実施例は、図12に示すように第1の実施例と同様に第1の配線92で結線された能動回路91を被覆した層間絶縁層93の上面に、能動回路91が機能するよう第1の接続孔94を介して接続された第2の配線95と平面構造において複数の開口を持つ衝撃吸収梁96と配し保護膜97により被覆する。
In the sixth embodiment, as shown in FIG. 12, the
衝撃吸収梁96の近傍にボンディングパッドと能動回路91を電気的に接続する第2の接続孔98を設けた後、衝撃吸収梁96と第2の接続孔98を被覆するよう厚いパッド電極99を設け、ワイヤ101をボンディングする際に必要な領域のみ開口した保護樹脂層100により表面を保護した構造である。
After providing a
図11および図12に示すように第6の実施例においては、厚いパッド電極91は衝撃吸収梁96の近傍に設けた第2の接続孔98を介して能動回路91と電気的に接続するため、接続配線が不要となり能動回路上ボンディングパッド構造において更に省面積効果を高めることができる。
As shown in FIGS. 11 and 12, in the sixth embodiment, the
加えて厚いパッド電極91へワイヤ101をボンディング接続する際にはボンディングボールの接続面が衝撃吸収梁96上のみに形成されるよう第2の接続孔98を配置することにより、第1の実施例で記載したように衝撃吸収梁96によりボンディング衝撃の伝搬を抑止するフェールセーフ構造であるため、厚いパッド電極91直下の第2の接続孔98においてボンディング衝撃による接続不具合は発生しない。
In addition, when the
衝撃吸収梁96において、その機能は前述のように第1の実施例と同じであり望ましい材質も同じであるため、その詳細は省略する。同様に、層間絶縁層93および保護樹脂層100それぞれの機能および望ましい材料も第1の実施例と同じであるためその詳細は省略する。
Since the function of the
また厚いパッド電極91は、第3の実施例から第5の実施例に記載の構造および材質が望ましい。加えて保護膜97については、前述の理由により第1の実施例に記載の保護膜7と同じかもしくは第2の実施例に記載の第2の層間絶縁層37および保護膜38と同じ膜による2層積層膜で構成されていることが望ましい。
The
(第7の実施形態)
図13は、本発明に係る能動回路上に配置されたボンディングパッド部の第7の実施例を示す模式的な平面図である。また、図14は第7の実施例を示す模式的な平面図13のE−E´での断面図であり、図15は図14中のF部の拡大断面例を示す。
(Seventh embodiment)
FIG. 13 is a schematic plan view showing a seventh embodiment of the bonding pad portion disposed on the active circuit according to the present invention. FIG. 14 is a cross-sectional view taken along the line EE ′ of the schematic plan view 13 showing the seventh embodiment, and FIG. 15 shows an enlarged cross-sectional example of the F portion in FIG.
第7の実施例は、図13および14に示すように第1の実施例と同様に第1の配線112で結線された能動回路111を被覆した層間絶縁層113の上面に、能動回路111が機能するよう第1の接続孔114を介して接続された第2の配線115と平面構造において複数の開口を持つ衝撃吸収梁116と配し保護膜117により被覆する。衝撃吸収梁116の近傍にボンディングパッドと能動回路111を電気的に接続する第2の接続孔118を設けた後、密着強化金属層119と介して衝撃吸収梁116と第2の接続孔118を被覆するよう厚いパッド電極121を設け、厚いパッド電極121の上面と全側面を被覆金属配線層122により被覆する。
In the seventh embodiment, as shown in FIGS. 13 and 14, the
また衝撃吸収梁116はその一部を延長し第3の接続孔127を介して最上層配線126に電気的に接続し、ワイヤ84をボンディングする際に必要な領域のみ開口した保護樹脂層124により表面を保護した構造である。
The
第7の実施例は、衝撃吸収梁116は第3の接続孔127を介して最上層配線126に接続されているため、ボンディング衝撃により衝撃吸収梁116を被覆している保護膜117にクラックが発生しボンディング接続時に厚いパッド電極121と衝撃吸収梁116とが短絡した場合または実使用時の環境変化による前記クラックが経時的に伸展しパッド電極121と衝撃吸収梁116とが短絡した場合に厚いパッド電極121と衝撃吸収梁116との間の漏洩電流を計測することにより前期クラックの有無を検出することができる。
In the seventh embodiment, since the
すなわち、第7の実施例による半導体装置は、第6の実施例と同様に衝撃吸収梁116の近傍に設けた第2の接続孔118を介して厚いパッド電極121と能動回路111とを電気的に接続するため接続配線が不要となり省面積効果を高めることができることに加え、ボンディング衝撃による不良および使用環境下における経時劣化によるボンディング部の不良を検出できる自己診断機能を持つ半導体装置である。
That is, the semiconductor device according to the seventh embodiment electrically connects the
また厚いパッド電極121は、第5の実施例と同様に上面および全側面を被覆金属配線層122により底面を密着強化金属層119により完全に封止される。厚いパッド電極121を形成する際にシード電極層120を用いる場合においても図15に示すように厚いパッド電極121に加えシード電極層120も密着強化金属層119と被覆金属配線層122により完全に封止される。
Further, the
また最上層配線126は、密着強化金属層119と同一材質で形成された最上層配線密着層129と被覆金属配線層122と同一構造同一材質で形成された最上層配線被覆層129の積層により構成されることが望ましい。
In addition, the
加えて第7の実施例も、衝撃吸収梁116を有するためボンディング衝撃の伝搬を抑止するフェールセーフ構造の半導体装置であり、構造および材質は第1の実施例と同じであり望ましい材質も同じであるため、その詳細は省略する。同様に、層間絶縁層93および保護樹脂層100それぞれの機能および望ましい材料も第1の実施例と同じであるためその詳細は省略する。
In addition, the seventh embodiment is also a fail-safe semiconductor device that has a
また前述のように、密着強化金属層119, シード電極層120,厚いパッド電極121およびは、被覆金属配線層122それぞれの機能および望ましい材料も第5の実施例と同じであるためその詳細は省略する。
Further, as described above, the adhesion reinforcing
加えて保護膜124については、前述の理由により第1の実施例に記載の保護膜7と同じかもしくは第2の実施例に記載の第2の層間絶縁層37および保護膜38と同じ膜による2層積層膜で構成されていることが望ましい。
In addition, the
(第1の実施方法)
本発明による第1の実施例と第2の実施例の製造方法について、第1の実施例を例に図16から図20を参照しつつ第1の実施方法を説明する。
(First implementation method)
The manufacturing method of the first embodiment and the second embodiment according to the present invention will be described with reference to FIGS. 16 to 20 by taking the first embodiment as an example.
図16に示すように、機能するよう第1の配線302で結線した能動回路301を層間絶縁膜303で被覆し第1の接続孔304を形成した後、第1の金属膜305を成膜する。この際、層間絶縁膜304は段差緩和処置を実施したシリコン酸化膜を主体とする膜が望ましく、第1の金属膜305はアルミまたはアルミ合金を主材料とすることが望ましい。
As shown in FIG. 16, the
その後、図17に示すように、マスク材を用いて第1の金属膜305を加工し第2の配線306と衝撃吸収梁307を形成する。この際、衝撃吸収梁307は複数の開口を持ちその開口形状が円形または多角形となるよう加工する。
Thereafter, as shown in FIG. 17, the
図18に示すように保護膜308で能動回路301を被覆した後、第2の接続孔309を形成し、保護膜308上に衝撃吸収梁307を被覆するとともに第2の接続孔309を介して能動回路301と電気的に接続されるよう厚い電極310を設ける(図19参照)。その後、図20に示すように保護樹脂層311で被覆し厚い電極310にボンディングする際に必要な領域のみ開口する。
As shown in FIG. 18, after covering the
この際、保護膜308はシリコン窒化膜もしくは第2の実施例で記載した平坦化処理を実施したシリコン酸化膜上にシリコン窒化膜を形成した積層膜が望ましく、厚い電極310は膜厚を衝撃吸収梁307上の保護膜308における表面段差以上の膜厚に設定しその材質としてアルミ,アルミ合金,銅,ニッケル,クロム,チタン,チタン窒化膜,チタンタングステンのいずれか、またはこれらのうちの2以上のものの積層膜が望ましい。
At this time, the
また保護樹脂層311は段差被覆性に優れ機械強度が高くかつ、耐熱性・耐湿性の高いポリイミド樹脂膜が望ましい。
The
(第2の実施方法)
本発明による第3の実施例と第7の実施例の製造方法について、第7の実施例を例に図21から図29を参照しつつ第2の実施方法を説明する。
(Second implementation method)
The manufacturing method of the third embodiment and the seventh embodiment according to the present invention will be described with reference to FIGS. 21 to 29 with the seventh embodiment as an example.
機能するよう第1の配線502で結線した能動回路501を層間絶縁膜503で被覆し、第1の接続孔504を形成した後第1の金属膜505を成膜する(図21参照)。この際、層間絶縁膜504は段差緩和処置を実施したシリコン酸化膜を主体とする膜が望ましく、第1の金属膜505はアルミまたはアルミ合金を主材料とすることが望ましい。
The
その後、図22に示すように、マスク材を用いて第1の金属膜505を加工し第2の配線506と衝撃吸収梁507を形成する。この際、衝撃吸収梁507は複数の開口を持ちその開口形状が円形または多角形となるよう加工する。
After that, as shown in FIG. 22, the
図23に示すように保護膜508で能動回路501を被覆した後、第3の接続孔509を形成し密着強化膜510を形成する(図24参照)。同時にその後形成する厚いパッド電極と前記能動回路501とを電気的に接続するための接続孔を衝撃吸収梁507の近傍に形成する。
As shown in FIG. 23, after covering the
この際、保護膜508はシリコン窒化膜もしくは第2の実施例で記載した平坦化処理を実施したシリコン酸化膜上にシリコン窒化膜を形成した積層膜が望ましい。また密着強化膜510は保護膜508との密着性の高い金属薄膜が望ましくチタン,チタン窒化膜,チタンタングステンのいずれか、またはこれらのうちの2以上のものの積層膜で構成されていることが望ましい。
At this time, the
次に、図25に示すように厚い金属膜511を形成しフォトリソグラフィ技術によりマスク材512を衝撃吸収梁507と前記の能動回路501と電気的に接続するための接続孔を被覆するよう形成する。この際厚い金属膜511は、その膜厚を衝撃吸収梁507上の保護膜508の表面段差以上の膜厚となるよう設定し、その材質として電気抵抗が低く機械強度の高い銅が望ましい。
Next, as shown in FIG. 25, a
その後マスク材512を用いて厚い金属膜511をエッチングし厚いパッド電極513を形成する。(図26参照)。この際のエッチングは能動回路501にダメージを与えない湿式エッチングが望ましい。
Thereafter, the
次に図27に示すように、被覆金属膜514を成膜したのちフォトリソグラフィ技術により厚いパッド電極513を被覆するとともに少なくとも第3の接続孔509を介して衝撃吸収梁507と電気的に接続する配線ができるようマスク材515を形成する。この際被覆金属膜514は、上層がワイヤボンディング時の接合強度を確保可能なアルミまたはアルミ合金いずれかであり、下層が上層金属と厚いパッド電極との反応を抑止できるチタン,チタン窒化膜,チタンタングステンのいずれかで構成された2層積層膜が望ましい。また厚いパッド電極513を被覆するマスク材は、平面的大きさを厚いパッド電極513の大きさより大きくなるよう設定する。
Next, as shown in FIG. 27, after forming a
その後マスク材515を用いて被覆金属膜514と密着強化膜510とを連続してエッチング除去し、厚いパッド電極513を封止するよう密着強化金属層516および被覆金属配線層517を形成するとともに、最上層配線を形成する最上層配線密着強化層518と最上層配線被覆層519を形成する(図28参照)。この際のエッチング除去も能動回路501にダメージを与えない湿式エッチングが望ましい。
Subsequently, the
最後に、図29に示すように保護樹脂層520で被覆し厚いパッド電極513にボンディングする際に必要な領域のみ開口する。保護樹脂層520の材質としては、段差被覆性に優れ機械強度が高くかつ耐熱性・耐湿性の高いポリイミド樹脂膜が望ましい。
Finally, as shown in FIG. 29, only a region necessary for bonding to the
(第3の実施方法)
本発明による第4の実施例と第7の実施例に対する別の製造方法について、第7の実施例を例に図30から図36を参照しつつ第3の実施方法を説明する。
(Third implementation method)
As another manufacturing method for the fourth and seventh embodiments according to the present invention, the third embodiment will be described with reference to FIGS. 30 to 36 in the seventh embodiment.
図30に示すように、第2の実施方法と同様な製造方法により第2の配線506と衝撃吸収梁507を形成した後能動回路501を保護膜508で被覆する。更に第2の実施方法と同様に第3の接続孔509と密着強化膜510を形成した後、密着強化膜510にシード金属層601を成膜する(図31参照)。
As shown in FIG. 30, after the
次に図32に示すように、フォトリソグラフィ技術により形成したマスク材602を用いシード金属層601を電極として電気メッキ法により厚いパッド電極603を形成する。シード金属層601と厚いパッド電極603の材質としては電気抵抗が低く機械強度の高い銅が望ましく、加えて厚いパッド電極603の膜厚は衝撃吸収梁507上の保護膜508の表面段差以上の膜厚となるよう設定することが望ましい。
Next, as shown in FIG. 32, a
マスク材602を除去した後、湿式エッチング法か厚いパッド電極603の形成時の電気メッキとは逆のバイアスを印加した電気分解かまたは両者の複合処理により厚いパッド電極603下部以外の領域のシード金属層601を除去する(図33参照)。
After removing the
その後、図34に示すように、被覆金属膜604を成膜した後フォトリソグラフィ技術により厚いパッド電極603を被覆するとともに少なくとも第3の接続孔509を介して衝撃吸収梁507と電気的に接続する配線ができるようマスク材605を形成する。
Then, as shown in FIG. 34, after forming a
この際被覆金属膜604は、上層がワイヤボンディング時の接合強度を確保可能なアルミまたはアルミ合金いずれかであり、下層が上層金属と厚いパッド電極との反応を抑止できるチタン,チタン窒化膜,チタンタングステンのいずれかで構成された2層積層膜が望ましく前記密着強化膜510と同一構造・材料であることが望ましい。また厚いパッド電極603を被覆するマスク材は、平面的大きさを厚いパッド電極603の大きさより大きくなるよう設定する。
At this time, the
次に、マスク材605を用いて被覆金属膜604と密着強化膜510とを連続してエッチング除去し、厚い電極603を封止するよう密着強化金属層605および被覆金属配線層606を形成するとともに、最上層配線を形成する最上層配線密着強化層607と最上層配線被覆層608を形成する(図35参照)。この際のエッチング除去も能動回路501にダメージを与えない湿式エッチングが望ましい。
Next, the
最後に、図36に示すように保護樹脂層609で被覆し厚いパッド電極603にボンディングする際に必要な領域のみ開口する。保護樹脂層609の材質としては、段差被覆性に優れ機械強度が高くかつ耐熱性・耐湿性の高いポリイミド樹脂膜が望ましい。
Finally, as shown in FIG. 36, only a region necessary for bonding to the
図面中、1,31,51,71,91,111,301,501は能動回路、2,32,52,72,92,112,302,502は第1の配線、3,33,53,73,93,113,303,503は層間絶縁層、4,34,54,74,94,114,304,504は第1の接続孔、5,35,55,75,95,115,306,506は第2の配線、6,36,56,76,96,116,307,507は衝撃吸収梁、7,38,57,77,97,117,308,508は保護膜、8,39,58,78,98,118,309,509は第2の接続孔、9,40,310は厚い電極、10,41,61,83,100,124,311,520,609は保護樹脂層、11,62,84,101,125,312,521,610はボンディングワイヤ、21は円形の開口部を持つ衝撃吸収梁、22は多角形の開口部を持つ衝撃吸収梁,37は第2の層間絶縁層、59,81,99,121,513,603は厚いパッド電極、60,82,122,516,606は被覆金属配線層、79,119,515,605は密着強化金属層、80,120,601はシート゛金属層、123はボンディングパット領域、126は最上層配線、127,509は第3の接続孔、128,518,607は最上層配線密着強化層、129,519,608は最上層配線被覆層、201は能動回路、202は下部金属層、203はレベル間酸化物層、204は導体、205は上部金属層、206は保護膜、207は接続孔、208はポリイミド層、209はボンディングパッド、210は導電性ワイヤ、211は樹脂形成化合物、221は半導体本体、222は第1の金属層、223は絶縁層、224は第2の金属層、225はパシベーション材料層、226は接続領域、227はワイヤボンディング領域、228はワイヤ、305,505は第1の金属膜、510は密着強化金属膜,511は厚い金属膜、512,515,602はマスク材、514,604は被覆金属膜である。
In the drawing, 1, 31, 51, 71, 91, 111, 301, 501 are active circuits, 2, 32, 52, 72, 92, 112, 302, 502 are first wirings, 3, 33, 53, 73. , 93, 113, 303, 503 are interlayer insulating layers, 4, 34, 54, 74, 94, 114, 304, 504 are first connection holes, 5, 35, 55, 75, 95, 115, 306, 506. Is a second wiring, 6, 36, 56, 76, 96, 116, 307, 507 are shock absorbing beams, 7, 38, 57, 77, 97, 117, 308, 508 are protective films, 8, 39, 58 78, 98, 118, 309, 509 are second connection holes, 9, 40, 310 are thick electrodes, 10, 41, 61, 83, 100, 124, 311, 520, 609 are protective resin layers, 62, 84, 101, 125, 312, 52 1, 610 is a bonding wire, 21 is a shock absorbing beam having a circular opening, 22 is a shock absorbing beam having a polygonal opening, 37 is a second interlayer insulating layer, 59, 81, 99, 121, 513 , 603 is a thick pad electrode, 60, 82, 122, 516 and 606 are coated metal wiring layers, 79, 119, 515 and 605 are adhesion strengthening metal layers, 80, 120 and 601 are sheet metal layers, and 123 is a bonding pad area. , 126 is the uppermost layer wiring, 127 and 509 are the third connection holes, 128, 518 and 607 are the uppermost layer wiring adhesion reinforcing layers, 129, 519 and 608 are the uppermost layer wiring covering layers, 201 is the active circuit, and 202 is the lower portion Metal layer, 203 interlevel oxide layer, 204 conductor, 205 upper metal layer, 206 protective film, 207 connection hole, 208 polyimide layer, 209
Claims (81)
前記能動回路が機能するよう接続された第1の配線と、
層間絶縁層の一部に設けられた第1の接続孔を介して前記第1の配線と接続された第2の配線と、
前記層間絶縁層上に形成され平面構造において複数の開口を持つ衝撃吸収梁と、
前記能動回路を保護するよう形成された保護膜と、
前記保護膜の一部に設けられた第2の接続孔を介して前期第2の配線と接続され且つ前記衝撃吸収梁上を十分に被覆するよう配置された厚い電極と、
前記能動回路を被覆し且つ前記衝撃吸収梁上にボンディング接続時に必要な領域を開口した保護樹脂層と
を備えたことを特徴とする半導体装置。 An active circuit provided on the surface of the semiconductor substrate;
A first wiring connected so that the active circuit functions;
A second wiring connected to the first wiring through a first connection hole provided in a part of the interlayer insulating layer;
A shock absorbing beam formed on the interlayer insulating layer and having a plurality of openings in a planar structure;
A protective film formed to protect the active circuit;
A thick electrode connected to the second wiring in the previous period through a second connection hole provided in a part of the protective film and arranged to sufficiently cover the shock absorbing beam;
A semiconductor device comprising: a protective resin layer that covers the active circuit and has an opening necessary for bonding connection on the shock absorbing beam.
前記能動回路が機能するよう接続された第1の配線と、
層間絶縁層の一部に設けられた第1の接続孔を介して前記第1の配線と接続された第2の配線と、
前記絶縁層上に形成され平面構造において複数の開口を持つ衝撃吸収梁と、
前記衝撃吸収梁の段差を緩和するよう形成した第2の層間絶縁層と、
前記能動回路を保護するよう前記第2の層間絶縁層上に形成された保護膜と、
前記第2の層間絶縁層と前記保護膜とを開口して形成した第2の接続孔を介して前記第2の配線と接続され且つ前記衝撃吸収梁上を十分に被覆するよう配置された厚い電極と、
前記能動回路を被覆し且つ前記衝撃吸収梁上にボンディング接続時に必要な領域を開口した保護樹脂層と
を備えたことを特徴とする半導体装置。 An active circuit provided on the surface of the semiconductor substrate;
A first wiring connected so that the active circuit functions;
A second wiring connected to the first wiring through a first connection hole provided in a part of the interlayer insulating layer;
A shock absorbing beam formed on the insulating layer and having a plurality of openings in a planar structure;
A second interlayer insulating layer formed so as to alleviate the step of the shock absorbing beam;
A protective film formed on the second interlayer insulating layer to protect the active circuit;
The second interlayer insulating layer and the protective film are connected to the second wiring through a second connection hole formed by opening the second interlayer insulating layer and the protective film, and are thick enough to cover the shock absorbing beam. Electrodes,
A semiconductor device comprising: a protective resin layer that covers the active circuit and has an opening necessary for bonding connection on the shock absorbing beam.
前記能動回路が機能するよう接続された第1の配線と、
層間絶縁層の一部に設けられた第1の接続孔を介して前記第1の配線と接続された第2の配線と、
前記層間絶縁層上に形成され平面構造において複数の開口を持つ衝撃吸収梁と、
前記能動回路を保護するよう形成された保護膜と、
前記衝撃吸収梁上を十分に被覆するよう前記保護膜上に形成された厚いパッド電極と、
前記厚いパッド電極の上面および全側面を被覆し且つその一部が前記保護膜に設けられた第2の接続孔を介して前記第2の配線と接続された被覆金属配線層と、
前記能動回路を被覆し且つ前記衝撃吸収梁上にボンディング接続時に必要な領域を開口した保護樹脂層と
を備えたことを特徴とする半導体装置。 An active circuit provided on the surface of the semiconductor substrate;
A first wiring connected so that the active circuit functions;
A second wiring connected to the first wiring through a first connection hole provided in a part of the interlayer insulating layer;
A shock absorbing beam formed on the interlayer insulating layer and having a plurality of openings in a planar structure;
A protective film formed to protect the active circuit;
A thick pad electrode formed on the protective film to sufficiently cover the shock absorbing beam;
A coated metal wiring layer that covers the upper surface and all side surfaces of the thick pad electrode and a part of which is connected to the second wiring via a second connection hole provided in the protective film;
A semiconductor device comprising: a protective resin layer that covers the active circuit and has an opening necessary for bonding connection on the shock absorbing beam.
前記能動回路が機能するよう接続された第1の配線と、
層間絶縁層の一部に設けられた第1の接続孔を介して前記第1の配線と接続された第2の配線と、
前記層間絶縁層上に形成され平面構造において複数の開口を持つ衝撃吸収梁と、
前記能動回路を保護するよう形成された保護膜と、
前記保護膜との密着性を向上するための密着強化金属層と、
厚いパッド電極を形成するためのシード電極層を介して前記衝撃吸収梁上を十分に被覆するよう前記保護膜上に形成された厚いパッド電極と、
前記厚いパッド電極の上面および全側面を被覆し且つその一部が前記密着強化金属層と前記シード電極層とを介して保護膜に設けられた第2の接続孔により前記第2の配線と接続された被覆金属配線層と、
前記能動回路を被覆し且つ前記衝撃吸収梁上にボンディング接続時に必要な領域を開口した保護樹脂層と
を備えたことを特徴とする半導体装置。 An active circuit provided on the surface of the semiconductor substrate;
A first wiring connected so that the active circuit functions;
A second wiring connected to the first wiring through a first connection hole provided in a part of the interlayer insulating layer;
A shock absorbing beam formed on the interlayer insulating layer and having a plurality of openings in a planar structure;
A protective film formed to protect the active circuit;
An adhesion reinforcing metal layer for improving adhesion with the protective film;
A thick pad electrode formed on the protective film so as to sufficiently cover the shock absorbing beam via a seed electrode layer for forming a thick pad electrode;
The thick pad electrode covers the upper surface and all side surfaces, and a part of the thick pad electrode is connected to the second wiring through a second connection hole provided in the protective film via the adhesion reinforcing metal layer and the seed electrode layer. Coated metal wiring layer,
A semiconductor device comprising: a protective resin layer that covers the active circuit and has an opening necessary for bonding connection on the shock absorbing beam.
前記能動回路が機能するよう接続された第1の配線と、
層間絶縁層の一部に設けられた第1の接続孔を介して前記第1の配線と接続された第2の配線と、
前記層間絶縁層上に形成され平面構造において複数の開口を持つ衝撃吸収梁と、
前記能動回路を保護するよう形成された保護膜と、
前記保護膜との密着性を向上するための密着強化金属層を介して前記衝撃吸収梁上を十分に被覆するよう前記保護膜上に形成された厚いパッド電極と、
前記厚いパッド電極の上面および全側面を被覆し且つその一部が密着強化金属層を介して保護膜に設けられた第2の接続孔により前記第2の配線と接続された被覆金属配線層と、
前記能動回路を被覆し且つ前記衝撃吸収梁上にボンディング接続時に必要な領域を開口した保護樹脂層と
を備えたことを特徴とする半導体装置。 An active circuit provided on the surface of the semiconductor substrate;
A first wiring connected so that the active circuit functions;
A second wiring connected to the first wiring through a first connection hole provided in a part of the interlayer insulating layer;
A shock absorbing beam formed on the interlayer insulating layer and having a plurality of openings in a planar structure;
A protective film formed to protect the active circuit;
A thick pad electrode formed on the protective film so as to sufficiently cover the shock absorbing beam via an adhesion reinforcing metal layer for improving adhesion with the protective film;
A coated metal wiring layer that covers the upper surface and all side surfaces of the thick pad electrode, and a portion of which is connected to the second wiring by a second connection hole provided in the protective film via an adhesion reinforcing metal layer; ,
A semiconductor device comprising: a protective resin layer that covers the active circuit and has an opening necessary for bonding connection on the shock absorbing beam.
前記能動回路が機能するよう接続された第1の配線と、
層間絶縁層の一部に設けられた第1の接続孔を介して前記第1の配線と接続された第2の配線と、
前記層間絶縁層上に形成され平面構造において複数の開口を持つ衝撃吸収梁と、
前記能動回路を保護するよう形成された保護膜と、
前記衝撃吸収梁上を十分に被覆するよう前記保護膜上に形成され且つその一部が前記衝撃吸収梁に隣接する位置の前記保護膜に設けられた第2の接続孔を介して前記第2の配線と接続された厚いパッド電極と、
前記能動回路を被覆し且つ前記衝撃吸収梁上にボンディング接続時に必要な領域を開口した保護樹脂層と
を備えたことを特徴とする半導体装置。 An active circuit provided on the surface of the semiconductor substrate;
A first wiring connected so that the active circuit functions;
A second wiring connected to the first wiring through a first connection hole provided in a part of the interlayer insulating layer;
A shock absorbing beam formed on the interlayer insulating layer and having a plurality of openings in a planar structure;
A protective film formed to protect the active circuit;
The second film is formed on the protective film so as to sufficiently cover the shock absorbing beam, and a part of the second film is formed through a second connection hole provided in the protective film at a position adjacent to the shock absorbing beam. A thick pad electrode connected to the wiring of
A semiconductor device comprising: a protective resin layer that covers the active circuit and has an opening necessary for bonding connection on the shock absorbing beam.
前記能動回路が機能するよう接続された第1の配線と、
層間絶縁層の一部に設けられた第1の接続孔を介して前記第1の配線と接続された第2の配線と、
前記層間絶縁層上に形成され平面構造において複数の開口を持つ衝撃吸収梁と、
前記能動回路を保護するよう形成された保護膜と、
前記保護膜との密着性を向上するための密着強化金属層と、
厚いパッド電極を形成するためのシード電極層と、
前記衝撃吸収梁上を十分に被覆するよう前記保護膜上に形成され且つその一部が前記衝撃吸収梁に隣接する位置の前記保護膜に設けられた第2の接続孔を介して前記第2の配線と接続された厚いパッド電極と、
前記厚いパッド電極の上面および全側面を被覆し被覆金属配線層と、
前記衝撃吸収梁と第3の接続孔を介して接続された最上層配線と、
前記能動回路を被覆し且つ前記衝撃吸収梁上にボンディング接続時に必要な領域を開口した保護樹脂層と
を備えたことを特徴とする半導体装置。 An active circuit provided on the surface of the semiconductor substrate;
A first wiring connected so that the active circuit functions;
A second wiring connected to the first wiring through a first connection hole provided in a part of the interlayer insulating layer;
A shock absorbing beam formed on the interlayer insulating layer and having a plurality of openings in a planar structure;
A protective film formed to protect the active circuit;
An adhesion reinforcing metal layer for improving adhesion with the protective film;
A seed electrode layer for forming a thick pad electrode;
The second film is formed on the protective film so as to sufficiently cover the shock absorbing beam, and a part of the second film is formed through a second connection hole provided in the protective film at a position adjacent to the shock absorbing beam. A thick pad electrode connected to the wiring of
A coated metal wiring layer covering the top and all sides of the thick pad electrode;
A top layer wiring connected to the shock absorbing beam via a third connection hole;
A semiconductor device comprising: a protective resin layer that covers the active circuit and has an opening necessary for bonding connection on the shock absorbing beam.
層間絶縁層を形成する工程と、
第1の接続孔を前記層間絶縁層に形成する工程と、
第2の配線を形成する工程と、
平面構造において複数の開口を持つ衝撃吸収梁を形成する工程と、
前記能動回路を被覆するよう保護膜を形成する工程と、
前記第2の配線と接続するため前記保護膜の一部に第2の接続孔を開口する工程と、
前記衝撃吸収梁上を十分に被覆し且つ第2の接続孔を介して前記第2の配線と接続するよう成形された厚い電極を形成する工程と、
前記衝撃吸収梁上の前記厚い電極にボンディング接続できるよう必要な領域を開口した保護樹脂層により前記能動回路を被覆する工程と
を備えたことを特徴とする半導体装置の製造方法。 Connecting a first wiring to an active circuit provided on a surface of a semiconductor substrate so that the active circuit functions;
Forming an interlayer insulating layer;
Forming a first connection hole in the interlayer insulating layer;
Forming a second wiring;
Forming a shock absorbing beam having a plurality of openings in a planar structure;
Forming a protective film to cover the active circuit;
Opening a second connection hole in a part of the protective film to connect to the second wiring;
Forming a thick electrode sufficiently covering the shock absorbing beam and connected to the second wiring via a second connection hole;
And a step of covering the active circuit with a protective resin layer having a necessary region opened so as to be bonded to the thick electrode on the shock absorbing beam.
層間絶縁層を形成する工程と、
第1の接続孔を前記層間絶縁層に形成する工程と、
第2の配線を形成する工程と、
平面構造において複数の開口を持つ衝撃吸収梁を形成する工程と、
前記能動回路を被覆するよう保護膜を形成する工程と、
前記第2の配線と接続するため前記保護膜の一部に第2の接続孔を開口する工程と、
前記衝撃吸収梁上を十分に被覆し且つ前記第2の接続孔を介して前記第2の配線と接続するよう成形された密着強化金属層を形成する工程と、
厚いパッド電極を形成するためのシード電極層を形成する工程と、
前記衝撃吸収梁上に厚いパッド電極を形成する工程と、
前記厚いパッド電極の上面および全側面を被覆し且つその一部が前記密着強化金属層と前記シード電極層を介して前記保護膜に設けられた前記第2の接続孔により第2の配線と接続されるよう成形された被覆金属配線層を形成する工程と、
前記厚いパッド電極にボンディング接続できるよう必要な領域を開口した保護樹脂層により前記能動回路を被覆する工程と
を備えたことを特徴とする半導体装置の製造方法。 Connecting the first wiring to the active circuit provided on the surface of the semiconductor substrate so that the active circuit functions;
Forming an interlayer insulating layer;
Forming a first connection hole in the interlayer insulating layer;
Forming a second wiring;
Forming a shock absorbing beam having a plurality of openings in a planar structure;
Forming a protective film to cover the active circuit;
Opening a second connection hole in a part of the protective film to connect to the second wiring;
Forming an adhesion-strengthening metal layer formed to cover the shock absorbing beam sufficiently and connect to the second wiring through the second connection hole;
Forming a seed electrode layer for forming a thick pad electrode;
Forming a thick pad electrode on the shock absorbing beam;
The thick pad electrode covers the upper surface and all side surfaces, and part of the thick pad electrode is connected to the second wiring by the second connection hole provided in the protective film via the adhesion reinforcing metal layer and the seed electrode layer. Forming a coated metal wiring layer shaped to be,
And a step of covering the active circuit with a protective resin layer having an opening necessary for bonding connection with the thick pad electrode.
層間絶縁層を形成する工程と、
第1の接続孔を前記層間絶縁層に形成する工程と、
第2の配線を形成する工程と、
平面構造において複数の開口を持つ衝撃吸収梁を形成する工程と、
前記能動回路を被覆するよう保護膜を形成する工程と、
前記第2の配線と接続するため第2の接続孔を前記衝撃吸収梁の近傍に開口する工程と、
前記衝撃吸収梁上を十分に被覆し且つ前記第2の接続孔を介して前記第2の配線と接続するよう成形された密着強化金属層を形成する工程と、
前記密着強化金属層を介して前記衝撃吸収梁上に厚いパッド電極を形成する工程と、
前記厚いパッド電極の上面および全側面を被覆し且つその一部が前記密着強化金属層を介して前記保護膜に設けられた前記第2の接続孔により前記第2の配線と接続されるよう成形された被覆金属配線層を形成する工程と、
前記厚いパッド電極にボンディング接続できるよう必要な領域を開口した保護樹脂層により前記能動回路を被覆する工程と
を備えたことを特徴とする半導体装置の製造方法。 Connecting a first wiring to an active circuit provided on a surface of a semiconductor substrate so that the active circuit functions;
Forming an interlayer insulating layer;
Forming a first connection hole in the interlayer insulating layer;
Forming a second wiring;
Forming a shock absorbing beam having a plurality of openings in a planar structure;
Forming a protective film to cover the active circuit;
Opening a second connection hole in the vicinity of the shock absorbing beam for connection to the second wiring;
Forming an adhesion-strengthening metal layer formed to cover the shock absorbing beam sufficiently and connect to the second wiring through the second connection hole;
Forming a thick pad electrode on the shock-absorbing beam via the adhesion-strengthening metal layer;
Formed so as to cover the upper surface and all the side surfaces of the thick pad electrode and to be connected to the second wiring by the second connection hole provided in the protective film through the adhesion reinforcing metal layer. Forming a coated metal wiring layer,
And a step of covering the active circuit with a protective resin layer having an opening necessary for bonding connection with the thick pad electrode.
層間絶縁層を形成する工程と、
第1の接続孔を層間絶縁層に形成する工程と、
第2の配線を形成する工程と、
平面構造において複数の開口を持つ衝撃吸収梁を形成する工程と、
前記能動回路を被覆するよう保護膜を形成する工程と、
前記衝撃吸収梁に隣接する位置の前記保護膜の一部に前記第2の配線と接続するため第2の接続孔を開口する工程と、
前記衝撃吸収梁上を十分に被覆し且つ前記第2の接続孔を介して前記第2の配線と接続するよう成形された密着強化金属層を形成する工程と、
前記衝撃吸収梁上を十分に被覆するよう前記保護膜上に形成され且つその一部が前記保護膜に設けられた前記第2の接続孔を介して前記第2の配線と接続するよう厚いパッド電極を形成する工程と、
前記厚いパッド電極下部以外のシード電極層を除去する工程と、
前記厚いパッド電極の上面および全側面を被覆するよう被覆金属配線層を形成する工程と、
前記保護膜に設けられた第3の接続孔を介して前記衝撃吸収梁と接続されるよう最上層配線を形成する工程と、
前記厚いパッド電極にボンディング接続できるよう必要な領域を開口した保護樹脂層により前記能動回路を被覆する工程と
を備えたことを特徴とする半導体装置の製造方法。 Connecting a first wiring to an active circuit provided on a surface of a semiconductor substrate so that the active circuit functions;
Forming an interlayer insulating layer;
Forming a first connection hole in the interlayer insulating layer;
Forming a second wiring;
Forming a shock absorbing beam having a plurality of openings in a planar structure;
Forming a protective film to cover the active circuit;
Opening a second connection hole to connect the second wiring to a part of the protective film at a position adjacent to the shock absorbing beam;
Forming an adhesion-strengthening metal layer formed to cover the shock absorbing beam sufficiently and connect to the second wiring through the second connection hole;
A thick pad formed on the protective film so as to sufficiently cover the shock absorbing beam and a part thereof being connected to the second wiring via the second connection hole provided in the protective film. Forming an electrode;
Removing the seed electrode layer other than the bottom of the thick pad electrode;
Forming a coated metal wiring layer so as to cover the upper surface and all side surfaces of the thick pad electrode;
Forming a top layer wiring to be connected to the shock absorbing beam via a third connection hole provided in the protective film;
And a step of covering the active circuit with a protective resin layer having an opening necessary for bonding connection with the thick pad electrode.
80. The method of manufacturing a semiconductor device according to claim 68, wherein the protective resin layer is a polyimide resin film.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005291248A JP4645398B2 (en) | 2005-10-04 | 2005-10-04 | Semiconductor device and manufacturing method thereof |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005291248A JP4645398B2 (en) | 2005-10-04 | 2005-10-04 | Semiconductor device and manufacturing method thereof |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2007103656A true JP2007103656A (en) | 2007-04-19 |
JP4645398B2 JP4645398B2 (en) | 2011-03-09 |
Family
ID=38030298
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2005291248A Expired - Fee Related JP4645398B2 (en) | 2005-10-04 | 2005-10-04 | Semiconductor device and manufacturing method thereof |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP4645398B2 (en) |
Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7642653B2 (en) | 2006-10-24 | 2010-01-05 | Denso Corporation | Semiconductor device, wiring of semiconductor device, and method of forming wiring |
JP2010087248A (en) * | 2008-09-30 | 2010-04-15 | Kyocera Kinseki Corp | Metal material burying device for wafer and metal material burying method for wafer |
JP2010087249A (en) * | 2008-09-30 | 2010-04-15 | Kyocera Kinseki Corp | Metal material burying device for wafer and metal material burying method for wafer |
WO2015108024A1 (en) * | 2014-01-16 | 2015-07-23 | オリンパス株式会社 | Semiconductor device, solid-state imaging device, and imaging device |
JP2018186312A (en) * | 2009-06-18 | 2018-11-22 | ローム株式会社 | Semiconductor device |
JP2021193745A (en) * | 2015-12-18 | 2021-12-23 | ローム株式会社 | Semiconductor device |
US11824014B2 (en) | 2020-03-30 | 2023-11-21 | Mitsubishi Electric Corporation | Semiconductor device |
Citations (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6216022B2 (en) * | 1982-08-09 | 1987-04-10 | Hitachi Ltd | |
JPH04180227A (en) * | 1990-11-15 | 1992-06-26 | Toshiba Corp | Semiconductor device |
JPH05109937A (en) * | 1991-10-18 | 1993-04-30 | Seiko Epson Corp | Manufacture of semiconductor device |
JPH07201909A (en) * | 1993-12-28 | 1995-08-04 | Toshiba Corp | Semiconductor device |
JPH0818007A (en) * | 1994-06-27 | 1996-01-19 | Matsushita Electric Ind Co Ltd | Semiconductor device |
JPH11186320A (en) * | 1997-12-09 | 1999-07-09 | Samsung Electron Co Ltd | Semiconductor element with multilayered pad, and manufacture thereof |
JP2003142527A (en) * | 2001-10-31 | 2003-05-16 | Mitsubishi Electric Corp | Method for manufacturing semiconductor device |
JP2003218151A (en) * | 2002-01-24 | 2003-07-31 | Seiko Epson Corp | Method for forming electroless plated bump, semiconductor device, and its manufacturing method |
JP2003243394A (en) * | 2002-02-19 | 2003-08-29 | Fuji Electric Co Ltd | Method for fabricating semiconductor device |
JP2004014609A (en) * | 2002-06-04 | 2004-01-15 | Sharp Corp | Semiconductor device and its manufacturing method |
JP2004055628A (en) * | 2002-07-17 | 2004-02-19 | Dainippon Printing Co Ltd | Semiconductor device of wafer level and its manufacturing method |
JP2005236277A (en) * | 2004-01-22 | 2005-09-02 | Kawasaki Microelectronics Kk | Semiconductor integrated circuit |
-
2005
- 2005-10-04 JP JP2005291248A patent/JP4645398B2/en not_active Expired - Fee Related
Patent Citations (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6216022B2 (en) * | 1982-08-09 | 1987-04-10 | Hitachi Ltd | |
JPH04180227A (en) * | 1990-11-15 | 1992-06-26 | Toshiba Corp | Semiconductor device |
JPH05109937A (en) * | 1991-10-18 | 1993-04-30 | Seiko Epson Corp | Manufacture of semiconductor device |
JPH07201909A (en) * | 1993-12-28 | 1995-08-04 | Toshiba Corp | Semiconductor device |
JPH0818007A (en) * | 1994-06-27 | 1996-01-19 | Matsushita Electric Ind Co Ltd | Semiconductor device |
JPH11186320A (en) * | 1997-12-09 | 1999-07-09 | Samsung Electron Co Ltd | Semiconductor element with multilayered pad, and manufacture thereof |
JP2003142527A (en) * | 2001-10-31 | 2003-05-16 | Mitsubishi Electric Corp | Method for manufacturing semiconductor device |
JP2003218151A (en) * | 2002-01-24 | 2003-07-31 | Seiko Epson Corp | Method for forming electroless plated bump, semiconductor device, and its manufacturing method |
JP2003243394A (en) * | 2002-02-19 | 2003-08-29 | Fuji Electric Co Ltd | Method for fabricating semiconductor device |
JP2004014609A (en) * | 2002-06-04 | 2004-01-15 | Sharp Corp | Semiconductor device and its manufacturing method |
JP2004055628A (en) * | 2002-07-17 | 2004-02-19 | Dainippon Printing Co Ltd | Semiconductor device of wafer level and its manufacturing method |
JP2005236277A (en) * | 2004-01-22 | 2005-09-02 | Kawasaki Microelectronics Kk | Semiconductor integrated circuit |
Cited By (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7642653B2 (en) | 2006-10-24 | 2010-01-05 | Denso Corporation | Semiconductor device, wiring of semiconductor device, and method of forming wiring |
JP2010087248A (en) * | 2008-09-30 | 2010-04-15 | Kyocera Kinseki Corp | Metal material burying device for wafer and metal material burying method for wafer |
JP2010087249A (en) * | 2008-09-30 | 2010-04-15 | Kyocera Kinseki Corp | Metal material burying device for wafer and metal material burying method for wafer |
JP2018186312A (en) * | 2009-06-18 | 2018-11-22 | ローム株式会社 | Semiconductor device |
WO2015108024A1 (en) * | 2014-01-16 | 2015-07-23 | オリンパス株式会社 | Semiconductor device, solid-state imaging device, and imaging device |
JP2015135839A (en) * | 2014-01-16 | 2015-07-27 | オリンパス株式会社 | Semiconductor device, solid-state imaging apparatus, and imaging apparatus |
JP2021193745A (en) * | 2015-12-18 | 2021-12-23 | ローム株式会社 | Semiconductor device |
JP2022058899A (en) * | 2015-12-18 | 2022-04-12 | ローム株式会社 | Semiconductor device |
JP7247289B2 (en) | 2015-12-18 | 2023-03-28 | ローム株式会社 | semiconductor equipment |
US11674983B2 (en) | 2015-12-18 | 2023-06-13 | Rohm Co., Ltd. | SiC semiconductor device with current sensing capability |
JP7336550B2 (en) | 2015-12-18 | 2023-08-31 | ローム株式会社 | semiconductor equipment |
US11824014B2 (en) | 2020-03-30 | 2023-11-21 | Mitsubishi Electric Corporation | Semiconductor device |
Also Published As
Publication number | Publication date |
---|---|
JP4645398B2 (en) | 2011-03-09 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP4645398B2 (en) | Semiconductor device and manufacturing method thereof | |
JP4242336B2 (en) | Semiconductor device | |
JP3611561B2 (en) | Semiconductor device | |
JP4938983B2 (en) | Semiconductor integrated circuit | |
JP5893287B2 (en) | Semiconductor device and substrate | |
JP2004014609A (en) | Semiconductor device and its manufacturing method | |
JP6008603B2 (en) | Semiconductor device | |
JP2011146563A (en) | Semiconductor device | |
JP6301763B2 (en) | Semiconductor device and manufacturing method of semiconductor device | |
US8089156B2 (en) | Electrode structure for semiconductor chip with crack suppressing dummy metal patterns | |
JP4492926B2 (en) | Semiconductor device | |
JP2010050177A (en) | Semiconductor device | |
JP2007214349A (en) | Semiconductor device | |
CN100456466C (en) | Semiconductor device | |
CN107230671B (en) | Semiconductor integrated circuit chip and semiconductor integrated circuit wafer | |
JP2009176833A (en) | Semiconductor device and its manufacturing method | |
JP4675146B2 (en) | Semiconductor device | |
JP4675147B2 (en) | Semiconductor device | |
JP2003218110A (en) | Semiconductor device | |
JP4759229B2 (en) | Semiconductor device | |
JP2005285971A (en) | Semiconductor device | |
JP6435562B2 (en) | Semiconductor device and manufacturing method of semiconductor device | |
JP4525143B2 (en) | Semiconductor device | |
WO2021187187A1 (en) | Semiconductor device, method for manufacturing semiconductor device, and electronic apparatus | |
JP3998675B2 (en) | Semiconductor device |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20071010 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20080206 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20100629 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20100729 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20100831 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20101018 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20101109 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20101122 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20131217 Year of fee payment: 3 |
|
R151 | Written notification of patent or utility model registration |
Ref document number: 4645398 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R151 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20131217 Year of fee payment: 3 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
LAPS | Cancellation because of no payment of annual fees |