JP2007057633A - Plasma display panel driving circuit and plasma display device - Google Patents

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Hideki Nakada
秀樹 中田
Hiroyasu Makino
弘康 牧野
Yasuhiro Arai
康弘 新井
Junpei Hashiguchi
淳平 橋口
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Matsushita Electric Industrial Co Ltd
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Abstract

<P>PROBLEM TO BE SOLVED: To provide a PDP driving circuit and a plasma display device that control a discharge current upon sustain discharge by controlling an impedance in a discharge path, and thereby, that display an image with suppressed luminance without degrading the grayscale property. <P>SOLUTION: The PDP driving circuit is equipped with: a scan electrode driving circuit 501 having a sustain pulse generating circuit 511, an initialization waveform generating circuit 52, a scan pulse generating circuit 53, and a switching circuit comprising switching elements S9<SB>1</SB>, S9<SB>2</SB>, S10<SB>1</SB>, S10<SB>2</SB>; and a sustain pulse generating circuit 61. The switching circuit is configured by connecting in series a first switch comprising the switching elements S9<SB>1</SB>, S9<SB>2</SB>connected in parallel and a second switch comprising switching elements S10<SB>1</SB>, S10<SB>2</SB>connected in parallel with body diodes disposed in a direction opposite to those of the switching elements S9<SB>1</SB>, S9<SB>2</SB>. <P>COPYRIGHT: (C)2007,JPO&INPIT

Description

本発明は、壁掛けテレビや大型モニターに用いられるプラズマディスプレイパネルの駆動回路およびプラズマディスプレイ装置に関する。   The present invention relates to a plasma display panel drive circuit and a plasma display device used for a wall-mounted television or a large monitor.

AC型として代表的な交流面放電型プラズマディスプレイパネル(以下、「PDP」と略記する)は、面放電を行う走査電極および維持電極を配列して形成したガラス基板からなる前面板と、データ電極を配列して形成したガラス基板からなる背面板とを、両電極がマトリックスを組むように、しかも間隙に放電空間を形成するように平行に対向配置し、その外周部をガラスフリット等の封着材によって封着することにより構成されている。そして、前面板と背面板との両基板間には、隔壁によって区画された放電セルが設けられ、この隔壁間のセル空間に蛍光体層が形成された構成である。このような構成のPDPにおいては、ガス放電により紫外線を発生させ、この紫外線で赤色(R)、緑色(G)および青色(B)の各色の蛍光体を励起して発光させることによりカラー表示を行っている。   An AC surface discharge type plasma display panel (hereinafter abbreviated as “PDP”) representative of an AC type includes a front plate made of a glass substrate formed by arranging scan electrodes and sustain electrodes for performing surface discharge, and data electrodes. And a back plate made of a glass substrate formed by arranging the electrodes in parallel so as to form a discharge space in the gap so that both electrodes form a matrix, and the outer periphery thereof is a sealing material such as glass frit It is comprised by sealing by. Discharge cells partitioned by barrier ribs are provided between both the front and back substrates, and a phosphor layer is formed in the cell space between the barrier ribs. In the PDP having such a configuration, ultraviolet light is generated by gas discharge, and phosphors of each color of red (R), green (G), and blue (B) are excited by the ultraviolet light to emit light, thereby performing color display. Is going.

図9は、PDP10の構造を示す斜視図である。第1の基板であるガラス製の前面板20上には、ストライプ状の走査電極22とストライプ状の維持電極23とで対をなす表示電極が複数形成されている。そして走査電極22と維持電極23とを覆うように誘電体層24が形成され、その誘電体層24上に保護層25が形成されている。   FIG. 9 is a perspective view showing the structure of the PDP 10. On the glass front plate 20 which is the first substrate, a plurality of display electrodes which are paired with a stripe-shaped scan electrode 22 and a stripe-shaped sustain electrode 23 are formed. A dielectric layer 24 is formed so as to cover the scan electrode 22 and the sustain electrode 23, and a protective layer 25 is formed on the dielectric layer 24.

第2の基板である背面板30上には、走査電極22および維持電極23と立体交差するように、誘電体層33で覆われた複数のストライプ状のデータ電極32が形成されている。誘電体層33上にはデータ電極32と平行に複数の隔壁34が配置され、この隔壁34間の誘電体層33上に蛍光体層35が設けられている。また、データ電極32は隣り合う隔壁34の間の位置に配置されている。   A plurality of stripe-shaped data electrodes 32 covered with a dielectric layer 33 are formed on the back plate 30 as the second substrate so as to three-dimensionally intersect the scan electrodes 22 and the sustain electrodes 23. A plurality of barrier ribs 34 are disposed on the dielectric layer 33 in parallel with the data electrodes 32, and a phosphor layer 35 is provided on the dielectric layer 33 between the barrier ribs 34. Further, the data electrode 32 is disposed at a position between the adjacent partition walls 34.

これら前面板20と背面板30とは、走査電極22および維持電極23とデータ電極32とが直交するように、微小な放電空間を挟んで対向配置されるとともに、その外周部をガラスフリット等の封着材によって封着している。そして放電空間には、例えばネオン(Ne)とキセノン(Xe)の混合ガスが放電ガスとして封入されている。放電空間は、隔壁34によって複数の区画に仕切られており、各区画には赤色(R)、緑色(G)および青色(B)の各色に発光する蛍光体層35が順次配置されている。そして、走査電極22および維持電極23とデータ電極32とが交差する部分に放電セルが形成され、各色に発光する蛍光体層35が形成された隣接する3つの放電セルにより1つの画素が構成される。この画素を構成する放電セルが形成された領域が画像表示領域となり、画像表示領域の周囲は、ガラスフリットが形成された領域等のように画像表示が行われない非表示領域となる。   The front plate 20 and the back plate 30 are arranged to face each other with a minute discharge space so that the scan electrode 22, the sustain electrode 23, and the data electrode 32 are orthogonal to each other, and the outer peripheral portion thereof is made of glass frit or the like. It is sealed with a sealing material. In the discharge space, for example, a mixed gas of neon (Ne) and xenon (Xe) is sealed as a discharge gas. The discharge space is partitioned into a plurality of sections by partition walls 34, and phosphor layers 35 that emit red (R), green (G), and blue (B) light are sequentially disposed in each section. A discharge cell is formed at a portion where the scan electrode 22 and the sustain electrode 23 intersect with the data electrode 32, and one adjacent pixel is formed by three adjacent discharge cells on which the phosphor layers 35 that emit light of each color are formed. The An area where the discharge cells constituting this pixel are formed becomes an image display area, and the periphery of the image display area becomes a non-display area where image display is not performed, such as an area where glass frit is formed.

図10は、PDP10の電極配列図である。行方向にn行の走査電極SC〜SC(図9の走査電極22)とn行の維持電極SU〜SU(図9の維持電極23)とが交互に配列され、列方向にはm列のデータ電極D〜D(図9のデータ電極32)が配列されている。そして、一対の走査電極SC、維持電極SU(i=1〜n)と1つのデータ電極D(j=1〜m)とを含む放電セルCi,jが放電空間内に形成され、放電セルCの総数は(m×n)個になる。 FIG. 10 is an electrode array diagram of the PDP 10. N rows of scan electrodes SC 1 to SC n (scan electrodes 22 in FIG. 9) and n rows of sustain electrodes SU 1 to SU n (sustain electrodes 23 in FIG. 9) are alternately arranged in the row direction. Are arranged in m rows of data electrodes D 1 to D m (data electrodes 32 in FIG. 9). A discharge cell C i, j including a pair of scan electrodes SC i , sustain electrodes SU i (i = 1 to n) and one data electrode D j (j = 1 to m) is formed in the discharge space. The total number of discharge cells C is (m × n).

このような構成のPDP10においては、ガス放電により紫外線を発生させ、その紫外線でR、G、Bの各色の蛍光体を励起して発光させることによりカラー表示を行っている。また、PDP10は、1フィールド期間を複数のサブフィールドに分割し、発光させるサブフィールドの組み合わせによって駆動されることにより階調表示を行う。各サブフィールドは初期化期間、書込み期間および維持期間からなり、画像データを表示するために、初期化期間、書込み期間および維持期間でそれぞれ異なる信号波形を各電極に印加している。   In the PDP 10 having such a configuration, color display is performed by generating ultraviolet rays by gas discharge and exciting the phosphors of R, G, and B colors with the ultraviolet rays to emit light. Further, the PDP 10 divides one field period into a plurality of subfields, and performs gradation display by being driven by a combination of subfields that emit light. Each subfield includes an initialization period, an address period, and a sustain period. In order to display image data, different signal waveforms are applied to the respective electrodes in the initialization period, the address period, and the sustain period.

図11は、PDP10の各電極に印加する各駆動電圧波形を示す図である。図11に示すように、各サブフィールドは初期化期間、書込み期間、維持期間を有している。また、それぞれのサブフィールドは発光期間の重みを変えるため維持期間における維持パルスの数を異ならせている以外はほぼ同様の動作を行い、各サブフィールドにおける動作原理もほぼ同様であるので、ここでは1つのサブフィールドについてのみ動作を説明する。   FIG. 11 is a diagram showing each drive voltage waveform applied to each electrode of the PDP 10. As shown in FIG. 11, each subfield has an initialization period, an address period, and a sustain period. Each subfield performs substantially the same operation except that the number of sustain pulses in the sustain period is changed in order to change the weight of the light emission period, and the operation principle in each subfield is also substantially the same. The operation will be described for only one subfield.

まず、初期化期間では、例えば、正のパルス電圧を全ての走査電極SC〜SCに印加し、走査電極SC〜SCおよび維持電極SU〜SUを覆う誘電体層24上の保護層25および蛍光体層35上に必要な壁電荷を蓄積する。加えて、放電遅れを小さくして書込み放電を安定して発生させるためのプライミング(放電のための起爆剤=励起粒子)を発生させるという働きを持つ。 First, in the initialization period, for example, a positive pulse voltage is applied to all the scan electrodes SC 1 to SC n, and the dielectric layer 24 covering the scan electrodes SC 1 to SC n and the sustain electrodes SU 1 to SU n is applied. Necessary wall charges are accumulated on the protective layer 25 and the phosphor layer 35. In addition, it has a function of generating priming (priming for discharge = excited particles) for reducing the discharge delay and generating the address discharge stably.

具体的には、初期化期間前半部では、データ電極D〜D、維持電極SU〜SUをそれぞれ0(V)に保持し、走査電極SC〜SCには、データ電極D〜Dに対して放電開始電圧以下の電圧Vi1から、放電開始電圧を超える電圧Vi2に向かって緩やかに上昇する傾斜波形電圧を印加する。この傾斜波形電圧が上昇する間に、走査電極SC〜SCと維持電極SU〜SU、データ電極D〜Dとの間でそれぞれ1回目の微弱な初期化放電が起こる。そして、走査電極SC〜SC上部に負の壁電圧が蓄積されるとともに、データ電極D〜D上部および維持電極SU〜SU上部には正の壁電圧が蓄積される。ここで、電極上部の壁電圧とは電極を覆う誘電体層上に蓄積された壁電荷により生じる電圧を表す。 Specifically, in the half of the initializing period, holds the data electrodes D 1 to D m, sustain electrodes SU 1 to SU n in each 0 (V), the scan electrodes SC 1 to SC n, data electrodes D A ramp waveform voltage that gradually rises from a voltage V i1 that is equal to or lower than the discharge start voltage to a voltage V i2 that exceeds the discharge start voltage is applied to 1 to D m . While this ramp waveform voltage rises, the first weak initializing discharge occurs between scan electrodes SC 1 to SC n and sustain electrodes SU 1 to SU n and data electrodes D 1 to D m , respectively. Negative wall voltage is accumulated on scan electrodes SC 1 to SC n top, to the data electrodes D 1 to D m and sustain electrodes SU 1 to SU n positive wall voltage is accumulated. Here, the wall voltage on the electrode represents a voltage generated by wall charges accumulated on the dielectric layer covering the electrode.

初期化期間後半部では、維持電極SU〜SUを正電圧Veに保ち、走査電極SC〜SCには、維持電極SU〜SUに対して放電開始電圧以下となる電圧Vi3から放電開始電圧を超える電圧Vi4に向かって緩やかに下降する傾斜波形電圧を印加する。この間に、走査電極SC〜SCと維持電極SU〜SU、データ電極D〜Dとの間でそれぞれ2回目の微弱な初期化放電が起こる。そして、走査電極SC〜SC上部の負の壁電圧および維持電極SU〜SU上部の正の壁電圧が弱められ、データ電極D〜D上部の正の壁電圧は書込み動作に適した値に調整される。以上により初期化動作が終了する(以下、初期化期間に各電極に印加される駆動電圧波形を「初期化波形」と略記する)。 In the second half of the initializing period, maintaining the sustain electrodes SU 1 to SU n to a positive voltage Ve, the scan electrodes SC 1 to SC n, the voltage V i3 which is a discharge start voltage or less with respect to sustain electrodes SU 1 to SU n Is applied with a ramp waveform voltage that gradually falls toward voltage V i4 exceeding the discharge start voltage. During this time, the second weak initializing discharge occurs between the scan electrodes SC 1 to SC n and the sustain electrodes SU 1 to SU n and the data electrodes D 1 to D m , respectively. Then, negative wall voltage and sustain electrodes SU 1 to SU n positive wall voltage on scan electrodes SC 1 to SC n upper are weakened, positive wall voltage on data electrodes D 1 to D m upper address operation It is adjusted to a suitable value. This completes the initialization operation (hereinafter, the drive voltage waveform applied to each electrode during the initialization period is abbreviated as “initialization waveform”).

次に、書込み期間では、全ての走査電極SC〜SCに順次負の走査パルスを印加することによって走査を行う。そして、走査電極SC〜SCを走査している間に、表示データにもとづきデータ電極D〜Dに正の書込みパルス電圧を印加する。こうして走査電極SC〜SCとデータ電極D〜Dとの間に書込み放電が発生し、走査電極SC〜SC上の保護層25の表面に壁電荷が形成される。 Next, in the address period, scanning is performed by sequentially applying a negative scan pulse to all the scan electrodes SC 1 to SC n . Then, while scanning the scan electrodes SC 1 to SC n, and applies the positive write pulse voltage to the data electrodes D 1 to D m based on the display data. Thus, address discharge is generated between scan electrodes SC 1 to SC n and data electrodes D 1 to D m, and wall charges are formed on the surface of protective layer 25 on scan electrodes SC 1 to SC n .

具体的には、書込み期間では、走査電極SC〜SCを一旦電圧Vscnに保持する。次に、放電セルCp,1〜Cp,m(pは1〜nの整数)の書込み動作では、走査電極SCに走査パルス電圧Vadを印加するとともに、データ電極D〜Dのうちp行目に表示すべき映像信号に対応するデータ電極D(DはD〜Dのうち映像信号にもとづき選択されるデータ電極)に正の書込みパルス電圧Vdを印加する。こうして、書込みパルス電圧が印加されたデータ電極Dと走査パルス電圧が印加された走査電極SCとの交差部に対応する放電セルCp,qで書込み放電が発生する。この書込み放電により放電セルCp,qの走査電極SC上部に正電圧が蓄積され、維持電極SU上部に負電圧が蓄積されて、書込み動作が終了する。以下、同様の書込み動作をn行目の放電セルCn,qに至るまで行い、書込み動作が終了する。 Specifically, in the address period, scan electrodes SC 1 to SC n are temporarily held at voltage Vscn. Next, in the address operation of the discharge cells C p, 1 to C p, m (p is an integer of 1 to n), the scan pulse voltage Vad is applied to the scan electrode SC p and the data electrodes D 1 to D m are applied. among p data electrode D q corresponding to the video signal to be displayed on line (D q data electrodes selected based on the video signal of the D 1 to D m) for applying a positive write pulse voltage Vd to. Thus, the discharge cells corresponding to the intersections of the scan electrodes SC P to which the scan pulse voltage and the write pulse voltage data electrode is applied D q is applied C p, writing discharge q occur. The address discharge by the discharge cell C p, a positive voltage to the scan electrodes SC p top of q is accumulated, and a negative voltage is accumulated on sustain electrode SU p top, the write operation is completed. Thereafter, the same address operation is performed until the discharge cell C n, q in the n- th row , and the address operation is completed.

続く維持期間では、一定の期間、走査電極SC〜SCと維持電極SU〜SUとの間に放電を維持するのに充分な電圧を印加する。これにより、走査電極SC〜SCと維持電極SU〜SUとの間に放電プラズマが生成され、一定の期間、蛍光体層35を励起発光させる。このとき、書込み期間において書込みパルス電圧が印加されなかった放電空間では、放電は発生せず蛍光体層35の励起発光は起こらない。 In the subsequent sustain period, applying a sufficient voltage to maintain the discharge between the fixed period, the scan electrodes SC 1 to SC n and sustain electrodes SU 1 to SU n. Thus, the scan electrodes SC 1 discharge plasma between to SC n and sustain electrodes SU 1 to SU n are generated, a period of time, to excite the phosphor to emit light layer 35. At this time, in the discharge space where the address pulse voltage is not applied in the address period, no discharge occurs and excitation light emission of the phosphor layer 35 does not occur.

具体的には、維持期間では、走査電極SC〜SCを0(V)に一旦戻した後、走査電極SC〜SCに正の維持パルス電圧Vsusを印加する。その後、維持電極SU〜SUを0(V)に戻す。このとき、書込み放電を起こした放電セルCp,qにおける走査電極SC上部と維持電極SU上部との間の電圧は、正の維持パルス電圧Vsusに加えて、書込み期間において走査電極SC上部および維持電極SU上部に蓄積された壁電圧が加算されて、放電開始電圧より大きくなり、1回目の維持放電が発生する。そして、維持放電を起こした放電セルCp,qでは、維持放電発生時における走査電極SCと維持電極SUとの電位差を打ち消すように走査電極SC上部に負電圧が蓄積され、維持電極SU上部に正電圧が蓄積される。こうして、1回目の維持放電が終了する。1回目の維持放電の後、維持電極SU〜SUにVsusを印加し、その後、走査電極SC〜SCを0(V)に戻す。このとき、1回目の維持放電を起こした放電セルCp,qにおける走査電極SC上部と維持電極SU上部との間の電圧は、正の維持パルス電圧Vsusに加えて、1回目の維持放電において走査電極SC上部および維持電極SU上部に蓄積された壁電圧が加算されて放電開始電圧より大きくなり、2回目の維持放電が発生する。以降同様に、走査電極SC〜SCと維持電極SU〜SUとに維持パルスを交互に印加することにより、書込み放電を起こした放電セルCp,qに対して維持パルスの回数だけ維持放電が継続して行われる。 Specifically, in the sustain period, scan electrodes SC 1 to SC n are once returned to 0 (V), and then positive sustain pulse voltage Vsus is applied to scan electrodes SC 1 to SC n . Thereafter, returning the sustain electrodes SU 1 to SU n to 0 (V). At this time, the voltage between the discharge cell C p having generated the address discharge, the scan electrode SC p upper part of q and sustain electrode SU p top, in addition to the positive sustain pulse voltage Vsus, scanning in the address periods electrode SC p It is subject to and sustain electrode SU p accumulated wall voltage in the upper, larger than the discharge start voltage, first sustain discharge is generated. A discharge cell C p having undergone the sustain discharge, the q, negative voltage to the scan electrodes SC p top so as to cancel the potential difference between the sustain electrode SU p and scan electrode SC P during the sustain discharge occurs is accumulated, sustain electrodes A positive voltage is accumulated on the top of SU p . Thus, the first sustain discharge is completed. After the first sustain discharge, is applied to Vsus to the sustain electrodes SU 1 to SU n, then returned to the scan electrodes SC 1 to SC n to 0 (V). In this case, first discharge cell C p having undergone the sustain discharge, the voltage between the scan electrodes SC p upper and the sustain electrode SU p upper part of q, in addition to the positive sustain pulse voltage Vsus, maintaining first In discharge, the wall voltages accumulated on scan electrode SC p and sustain electrode SU p are added to become higher than the discharge start voltage, and a second sustain discharge is generated. Thereafter, in the same manner, by applying sustain pulses alternately to scan electrodes SC 1 to SC n and sustain electrodes SU 1 to SU n , the number of sustain pulses is equal to the number of sustain pulses for discharge cells C p and q in which address discharge has occurred. The sustain discharge is continuously performed.

図12は、PDP10を組み込んだプラズマディスプレイ装置の電気的構成を示すブロック図である。図12に示すプラズマディスプレイ装置は、ADコンバータ1、映像信号処理回路2、サブフィールド処理回路3、データ電極駆動回路4、走査電極駆動回路5、維持電極駆動回路6、PDP10を備えている。   FIG. 12 is a block diagram showing an electrical configuration of a plasma display device incorporating the PDP 10. The plasma display device shown in FIG. 12 includes an AD converter 1, a video signal processing circuit 2, a subfield processing circuit 3, a data electrode driving circuit 4, a scanning electrode driving circuit 5, a sustain electrode driving circuit 6, and a PDP 10.

ADコンバータ1は、入力されたアナログの映像信号をデジタルの映像信号に変換する。映像信号処理回路2は、入力されたデジタルの映像信号を発光期間の重みの異なる複数のサブフィールドの組み合わせによってPDP10に発光表示するため、1フィールドの映像信号から各サブフィールドの制御を行うサブフィールドデータに変換する。   The AD converter 1 converts the input analog video signal into a digital video signal. The video signal processing circuit 2 emits and displays the input digital video signal on the PDP 10 by a combination of a plurality of subfields having different light emission period weights, and controls each subfield from the video signal of one field. Convert to data.

サブフィールド処理回路3は、映像信号処理回路2で作成されたサブフィールドデータからデータ電極駆動回路用制御信号、走査電極駆動回路用制御信号および維持電極駆動回路用制御信号を生成し、データ電極駆動回路4、走査電極駆動回路5、維持電極駆動回路6へそれぞれ出力する。   The subfield processing circuit 3 generates a data electrode drive circuit control signal, a scan electrode drive circuit control signal, and a sustain electrode drive circuit control signal from the subfield data created by the video signal processing circuit 2, and drives the data electrode Output to the circuit 4, the scan electrode drive circuit 5, and the sustain electrode drive circuit 6, respectively.

PDP10は、上述したとおり、行方向にn行の走査電極SC〜SC(図9の走査電極22)とn行の維持電極SU〜SU(図9の維持電極23)とが交互に配列され、列方向にm列のデータ電極D〜D(図9のデータ電極32)が配列されている。そして、一対の走査電極SC、維持電極SU(i=1〜n)と1つのデータ電極D(j=1〜m)とを含む放電セルCi,jが放電空間内に(m×n)個形成され、赤色、緑色および青色の各色に発光する3つの放電セルにより1つの画素が構成される。 As described above, in the PDP 10, n rows of scan electrodes SC 1 to SC n (scan electrodes 22 in FIG. 9) and n rows of sustain electrodes SU 1 to SU n (sustain electrodes 23 in FIG. 9) are alternately arranged in the row direction. The data electrodes D 1 to D m (data electrodes 32 in FIG. 9) are arranged in the column direction. A discharge cell C i, j including a pair of scan electrodes SC i , sustain electrodes SU i (i = 1 to n) and one data electrode D j (j = 1 to m) is formed in the discharge space (m Xn) One pixel is composed of three discharge cells that are formed and emit light in red, green, and blue colors.

データ電極駆動回路4は、データ電極駆動回路用制御信号にもとづいて各データ電極Dを独立して駆動する。 Data electrode driving circuit 4 are independently drives each data electrode D j on the basis of the control signal for the data electrode driving circuit.

走査電極駆動回路5は、維持期間に走査電極SC〜SCに印加する維持パルスを発生するための維持パルス発生回路51を内部に備え、各走査電極SC〜SCをそれぞれ独立して駆動することができる。そして、走査電極駆動回路用制御信号にもとづいて各走査電極SC〜SCを独立して駆動する。 Scan electrode drive circuit 5 includes sustain pulse generation circuit 51 for generating sustain pulses to be applied to scan electrodes SC 1 to SC n in the sustain period, and each scan electrode SC 1 to SC n is independently provided. Can be driven. Then, each of the scan electrodes SC 1 to SC n is independently driven based on the scan electrode drive circuit control signal.

維持電極駆動回路6は、維持期間に維持電極SU〜SUに印加する維持パルスを発生するための維持パルス発生回路61を内部に備え、PDP10の全ての維持電極SU〜SUをまとめて駆動することができる。そして、維持電極駆動回路用制御信号にもとづいて維持電極SU〜SUを駆動する。 Sustain electrode driving circuit 6 includes a sustain pulse generating circuit 61 for generating sustain pulses applied to the sustain electrodes SU 1 to SU n in the sustain period within, summarizes all the sustain electrodes SU 1 to SU n of PDP10 Can be driven. Then, driving the sustain electrodes SU 1 to SU n based on the control signal the sustain electrode driving circuit.

このようなプラズマディスプレイ装置では、その消費電力を削減するため、様々な消費電力削減技術が提案されている。   In such a plasma display device, various power consumption reduction techniques have been proposed in order to reduce the power consumption.

消費電力を削減する技術の一つとして、PDP10が容量性の負荷であることに着目し、インダクタを構成要素に含む共振回路によってそのインダクタとPDP10の容量性負荷とをLC共振させ、PDP10の容量性負荷に蓄えられた電力を電力回収用のコンデンサに回収し、回収した電力をPDP10の駆動に再利用する、いわゆる電力回収回路が開示されている(例えば、特許文献1参照)。   Focusing on the fact that the PDP 10 is a capacitive load as one of the technologies for reducing power consumption, LC resonance is performed between the inductor and the capacitive load of the PDP 10 by a resonance circuit including the inductor as a component, and the capacitance of the PDP 10 A so-called power recovery circuit is disclosed in which power stored in a sexual load is recovered in a capacitor for power recovery, and the recovered power is reused for driving the PDP 10 (see, for example, Patent Document 1).

この技術では、例えば、維持期間における走査電極SC〜SCおよび維持電極SU〜SUへの維持パルス電圧の印加にPDP10から回収した電力を再利用し、維持期間に消費される電力を削減することで、消費電力の削減を実現することができる。 In this technique, for example, the power recovered from the PDP 10 is reused to apply the sustain pulse voltage to the scan electrodes SC 1 to SC n and the sustain electrodes SU 1 to SU n in the sustain period, and the power consumed in the sustain period is reduced. By reducing, power consumption can be reduced.

すなわち、維持パルス発生回路51に、インダクタを備えた共振回路、すなわち電力回収回路を備え、PDP10の容量性負荷(走査電極SC〜SCに生じた容量性負荷)に蓄えられた電力を回収し、その回収された電力を走査電極SC〜SCの駆動電力として再利用する構成にして、消費電力を削減する。また、維持パルス発生回路61に電力回収回路を備え、PDP10の容量性負荷(維持電極SU〜SUに生じた容量性負荷)に蓄えられた電力を回収し、その回収された電力を維持電極SU〜SUの駆動電力として再利用する構成にして、消費電力を削減する。この構成を、図面を用いて説明する。 That is, the sustain pulse generation circuit 51 includes a resonance circuit including an inductor, that is, a power recovery circuit, and recovers the electric power stored in the capacitive load of the PDP 10 (capacitive load generated in the scan electrodes SC 1 to SC n ). Then, the collected power is reused as drive power for scan electrodes SC 1 to SC n to reduce power consumption. Also includes a power recovery circuit in sustain pulse generating circuit 61, the electric power stored in the (capacitive load generated in the sustain electrodes SU 1 ~SU n) PDP10 of the capacitive load is recovered, maintaining the recovered power in the structure is reused as driving power of the electrodes SU 1 to SU n, to reduce power consumption. This configuration will be described with reference to the drawings.

図13は、電力回収回路を備えた走査電極駆動回路5および維持電極駆動回路6が備えた維持パルス発生回路61の回路図である。   FIG. 13 is a circuit diagram of sustain pulse generation circuit 61 provided in scan electrode drive circuit 5 and sustain electrode drive circuit 6 provided with a power recovery circuit.

走査電極駆動回路5は、維持パルス発生回路51、初期化波形発生回路52および走査パルス発生回路53を備えている。   Scan electrode drive circuit 5 includes sustain pulse generation circuit 51, initialization waveform generation circuit 52, and scan pulse generation circuit 53.

維持パルス発生回路51は、電圧値Vsusの定電圧電源V1と、コイルL1と回収コンデンサC1とスイッチング素子S1、S2と逆流防止用ダイオードD1、D2とを有する電力回収部と、スイッチング素子S5、S6を有する電圧クランプ部とからなる。電力回収部では、インダクタンス素子であるコイルL1を用いることによりPDP10の容量性負荷(走査電極SC〜SCに生じた容量性負荷)とコイルL1とをLC共振させて、電力の回収および供給を行う。電力の回収時には、走査電極SC〜SCに生じた容量性負荷に蓄えられた電力を、電流の逆流防止用ダイオードD2およびスイッチング素子S2を介して回収コンデンサC1に移動させる。電力の供給時には、回収コンデンサC1に蓄えられた電力を、スイッチング素子S1および逆流防止用ダイオードD1を介してPDP10(走査電極SC〜SC)に移動する。こうして維持期間における走査電極SC〜SCの駆動を行う。したがって電力回収部では、維持期間において、定電圧電源V1から電力を供給されることなく、LC共振によって走査電極SC〜SCの駆動を行うため、理論的には消費電力は0となる。 The sustain pulse generation circuit 51 includes a constant voltage power source V1 having a voltage value Vsus, a power recovery unit including a coil L1, a recovery capacitor C1, switching elements S1 and S2, and backflow prevention diodes D1 and D2, and switching elements S5 and S6. And a voltage clamp part having The power recovery unit, the coil L1 PDP 10 of the capacitive load by using a (capacitive load generated in scan electrodes SC 1 to SC n) and the coil L1 is an inductance element by LC resonance, the power of recovery and supply I do. At the time of power recovery, the power stored in the capacitive load generated in the scan electrodes SC 1 to SC n is moved to the recovery capacitor C 1 via the current backflow prevention diode D 2 and the switching element S 2. When supplying electric power, the electric power stored in the recovery capacitor C1 is moved to the PDP 10 (scan electrodes SC 1 to SC n ) via the switching element S1 and the backflow prevention diode D1. Thus, scan electrodes SC 1 to SC n are driven in the sustain period. Therefore, since the power recovery unit drives the scan electrodes SC 1 to SC n by LC resonance without supplying power from the constant voltage power source V 1 during the sustain period, the power consumption is theoretically 0.

一方、電圧クランプ部は、電圧値Vsusの定電圧電源V1からスイッチング素子S5を介して走査電極SC〜SCに電力を供給して走査電極SC〜SCを電圧値Vsusにクランプし、また、走査電極SC〜SCをスイッチング素子S6を介して接地電位にクランプすることによって、走査電極SC〜SCの駆動を行う。したがって、電圧クランプ部による走査電極SC〜SCの駆動時においては、電力供給のインピーダンスが非常に小さく維持パルスの立ち上がり立ち下がりは急峻になるが、電源から電力が供給されることによる消費電力が発生する。 On the other hand, the voltage clamp unit clamps the scan electrodes SC 1 to SC n and supplies power to the scan electrodes SC 1 to SC n from the constant-voltage power supply V1 voltage value Vsus through the switching element S5 is the voltage value Vsus, Further, by clamping to the ground potential scan electrodes SC 1 to SC n via the switching element S6, to drive the scan electrodes SC 1 to SC n. Therefore, when the scan electrodes SC 1 to SC n are driven by the voltage clamp unit, the power supply impedance is very small, and the rising and falling edges of the sustain pulse become steep, but the power consumption due to the supply of power from the power source. Occurs.

こうして維持パルス発生回路51は、スイッチング素子S1、S2、S5、S6の切り替えによって、電力回収部と電圧クランプ部とを切り替え、走査電極SC〜SCに印加するための維持パルスを発生する。このとき、LC共振を利用した維持パルス発生回路51では、維持パルスの電圧が極大値になるまで電力回収部によって電力供給を行い、その後電圧クランプ部に切り替えることで、理論的な消費電力が0である電力回収部を最大限に利用した駆動を行うことができ、走査電極駆動回路5の消費電力を低減することができる。 Thus, the sustain pulse generating circuit 51, by switching the switching elements S1, S2, S5, S6, switching power recovery unit and the voltage clamp unit, for generating a sustain pulse to be applied to scan electrodes SC 1 to SC n. At this time, in the sustain pulse generation circuit 51 using LC resonance, power is supplied by the power recovery unit until the voltage of the sustain pulse reaches a maximum value, and then switched to the voltage clamp unit, so that the theoretical power consumption is 0. It is possible to drive using the power recovery unit as much as possible, and to reduce the power consumption of the scan electrode drive circuit 5.

なお、スイッチング素子S1、S2、S5、S6は、MOSFET等のスイッチング動作を行う一般に知られた素子からなる。MOSFETは、一般にボディダイオードと呼ばれる寄生ダイオード(MOSFETの構造に寄生して発生するダイオード)が、スイッチング動作を行う部分に対して並列に、かつスイッチング動作を行う部分に対してアノード、カソードが逆向きに生成される(以下、このような構成を「逆並列」と記す)。そのため、スイッチング素子は、スイッチング動作が遮断状態であってもボディダイオードに対して順方向となる電流を流すことができる。   The switching elements S1, S2, S5, and S6 are generally known elements that perform a switching operation such as a MOSFET. A MOSFET is generally a parasitic diode called a body diode (a diode generated parasitically in the structure of the MOSFET) in parallel to the portion that performs the switching operation, and the anode and cathode that are opposite to the portion that performs the switching operation. (Hereinafter, such a configuration is referred to as “reverse parallel”). For this reason, the switching element can flow a current in the forward direction with respect to the body diode even when the switching operation is in a cut-off state.

初期化波形発生回路52は、MOSFET等のスイッチング動作を行う一般に知られた素子からなるスイッチング素子S21、S22と電圧値Vsetの定電圧電源V2と負の電圧値Vadの定電圧電源V3とを有している。そして、定電圧電源V2からスイッチング素子S21を介して走査電極SC〜SCに電力を供給し、また、定電圧電源V3からスイッチング素子S22を介して走査電極SC〜SCに負の電位となる電力を供給して、初期化波形を発生する。また、スイッチング素子S21は、スイッチング素子S21が遮断(以下、スイッチング素子を遮断させることを「オフ」と略記する)されているときにそのボディダイオードを通って定電圧電源V2から主放電経路(維持パルス発生回路51、初期化波形発生回路52、走査パルス発生回路53が共通して接続され、走査電極SC〜SCへ供給する電力および走査電極SC〜SCからの回収電力が流れる経路)に電流が流れ込まないような向きで配置され、スイッチング素子S22は、スイッチング素子S22がオフのときにそのボディダイオードを通って主放電経路から定電圧電源V3に電流が流れ込まないような向きで配置されている。 The initialization waveform generating circuit 52 includes switching elements S21 and S22 made of a generally known element that performs a switching operation such as a MOSFET, a constant voltage power source V2 having a voltage value Vset, and a constant voltage power source V3 having a negative voltage value Vad. is doing. Then, supplies power to the scan electrodes SC 1 to SC n from the constant-voltage power supply V2 through the switching element S21, also, a negative potential to the scan electrodes SC 1 to SC n from the constant-voltage power supply V3 via the switching element S22 To generate an initialization waveform. The switching element S21 is connected to the main discharge path (maintenance) from the constant-voltage power supply V2 through the body diode when the switching element S21 is cut off (hereinafter, “cutting off the switching element is abbreviated as“ off ”)”. pulse generating circuit 51, initializing waveform generating circuit 52 is connected scan pulse generating circuit 53 is commonly, path recovery power from the power and the scan electrodes SC 1 to SC n supplied to the scan electrodes SC 1 to SC n flows The switching element S22 is arranged in such a direction that current does not flow into the constant voltage power source V3 from the main discharge path through the body diode when the switching element S22 is off. Has been.

こうして初期化波形発生回路52は上述したような初期化波形を発生させ、初期化期間前半部では、データ電極D〜Dに対して放電開始電圧以下の電圧Vi1から、放電開始電圧を超える電圧Vi2、すなわちVsetに向かって緩やかに上昇する傾斜波形を発生させ、初期化期間後半部では、維持電極SU〜SUに対して放電開始電圧以下となる電圧Vi3から放電開始電圧を超える電圧Vi4、すなわちVadに向かって緩やかに下降する傾斜波形を発生させる。 In this way, the initialization waveform generation circuit 52 generates the initialization waveform as described above. In the first half of the initialization period, the discharge start voltage is set from the voltage V i1 that is lower than the discharge start voltage to the data electrodes D 1 to D m . voltage V i2 exceeding, that generates a ramp waveform that rises gently toward the Vset, the second half of the initializing period, the discharge starting voltage from the voltage V i3 to be equal to or less than the discharge starting voltage with respect to sustain electrodes SU 1 to SU n A slope waveform that gradually falls toward the voltage V i4 exceeding V i, that is, Vad is generated.

走査パルス発生回路53は、MOSFET等のスイッチング動作を行う一般に知られた素子からなるスイッチング素子S31、S32と、電圧値Vscnの定電圧電源V4と、定電圧電源V4へ流れ込む電流を防止する逆流防止用ダイオードD31と、コンデンサC31と、2つの入力口を有しスイッチングにより2つの入力口に入力される電力のいずれか一方を出力して走査パルス波形を生成するScanICであるIC31とを有している。   The scan pulse generation circuit 53 includes switching elements S31 and S32 made of a generally known element that performs a switching operation such as a MOSFET, a constant voltage power source V4 having a voltage value Vscn, and a backflow prevention that prevents a current flowing into the constant voltage power source V4. Diode D31, capacitor C31, and IC31, which is a Scan IC that generates scanning pulse waveforms by outputting one of the powers input to the two input ports by switching. Yes.

書込み期間では、全ての走査電極SC〜SCに順次負の走査パルスを印加することによって走査を行う。そのために、書込み期間では、スイッチング素子S31を導通(以下、スイッチング素子を導通させることを「オン」と略記する)させて定電圧電源V4から逆流防止用ダイオードD31およびスイッチング素子S31を介して供給される電圧値Vscnの電力をIC31の一方の入力口に入力する。また、初期化波形発生回路52のスイッチング素子S22をオンにして、定電圧電源V3からスイッチング素子S22を介して供給される負の電圧値Vadの電力をIC31の他方の入力口に入力する。そして、定電圧電源V4から供給される電力と定電圧電源V3から供給される電力とのいずれか一方の電力がIC31で選択され、走査電極SC〜SCに供給される構成としている。すなわち、IC31は、負の走査パルスを印加するタイミングでは定電圧電源V3からの電力を、それ以外のときには定電圧電源V4からの電力を走査電極SC〜SCに供給するようにスイッチング動作する。 In the address period, scanning is performed by sequentially applying a negative scan pulse to all the scan electrodes SC 1 to SC n . Therefore, in the writing period, the switching element S31 is made conductive (hereinafter, the conduction of the switching element is abbreviated as “on”) and supplied from the constant voltage power supply V4 via the backflow prevention diode D31 and the switching element S31. The power of the voltage value Vscn is input to one input port of the IC 31. Also, the switching element S22 of the initialization waveform generating circuit 52 is turned on, and the power of the negative voltage value Vad supplied from the constant voltage power supply V3 via the switching element S22 is input to the other input port of the IC31. Then, one of the power and power supplied from the power and the constant-voltage power supply V3 supplied from the constant-voltage power supply V4 is selected by IC 31, are configured to be supplied to the scan electrodes SC 1 to SC n. That, IC 31 is the timing of applying the negative scan pulse power from the constant-voltage power supply V3, when the other switching operation to supply power from the constant-voltage power supply V4 to scan electrodes SC 1 to SC n .

なお、スイッチング素子S32は、書込み期間ではオフにし、初期化期間および維持期間ではオンにする。これは、スイッチング素子S32をオンさせることによりIC31の2つの入力口に同じ電力が入力されるようにして、IC31のスイッチング状態にかかわらず同じ電力が走査電極SC〜SCに供給されるようにするためである。 Note that the switching element S32 is turned off in the writing period and turned on in the initialization period and the sustain period. This is because the same power is input to the two input ports of the IC 31 by turning on the switching element S32 so that the same power is supplied to the scan electrodes SC 1 to SC n regardless of the switching state of the IC 31. It is to make it.

なお、スイッチング素子S1、S2、S5、S6、S21、S22、S31、S32およびIC31は、サブフィールド処理回路3において作成されたサブフィールド制御信号にもとづき切り替えが制御される。   Switching of the switching elements S1, S2, S5, S6, S21, S22, S31, S32 and the IC 31 is controlled based on the subfield control signal generated in the subfield processing circuit 3.

また、維持パルス発生回路51を初期化波形発生回路52から電気的に分離するために、維持パルス発生回路51と初期化波形発生回路52との間の主放電経路上には、スイッチング素子S9およびS10が直列に、かつそれぞれのボディダイオードが互いに逆方向となるようにして挿入されている(以下、このようなダイオード同士を互いに逆方向にしての直列接続を「バックトゥバック接続」と記す)。このような構成とすることにより、スイッチング素子S9およびS10を同時にオフにすれば、維持パルス発生回路51から初期化波形発生回路52へ流れる電流と、初期化波形発生回路52から維持パルス発生回路51へ流れる電流とのいずれの電流も遮断することができ、維持パルス発生回路51を初期化波形発生回路52から電気的に分離することが可能となる。   Further, in order to electrically isolate sustain pulse generation circuit 51 from initialization waveform generation circuit 52, switching element S9 and switching element S9 are provided on the main discharge path between sustain pulse generation circuit 51 and initialization waveform generation circuit 52. S10 is inserted in series, and the body diodes are inserted in opposite directions (hereinafter referred to as “back-to-back connection”). With such a configuration, if switching elements S9 and S10 are simultaneously turned off, the current flowing from sustain pulse generating circuit 51 to initialization waveform generating circuit 52 and the initializing waveform generating circuit 52 to sustain pulse generating circuit 51 are switched. Any of the current flowing into the current can be cut off, and the sustain pulse generation circuit 51 can be electrically separated from the initialization waveform generation circuit 52.

これは、初期化波形発生回路52の定電圧電源V2からの電力供給時に、それよりも電位の低い維持パルス発生回路51の定電圧電源V1の影響を受けないようにするためであり、また、初期化波形発生回路52における負の電位の定電圧電源V3からの電力供給時に、それよりも高い電位、すなわち維持パルス発生回路51の接地電位(以下、「GND」と略記する)の影響を受けないようにするためである。   This is for preventing the influence of the constant voltage power source V1 of the sustain pulse generating circuit 51 having a lower potential when the power is supplied from the constant voltage power source V2 of the initialization waveform generating circuit 52, and When power is supplied from the constant voltage power supply V3 having a negative potential in the initialization waveform generation circuit 52, it is affected by a higher potential, that is, the ground potential of the sustain pulse generation circuit 51 (hereinafter abbreviated as “GND”). This is to prevent it from occurring.

定電圧電源V2による電力供給時には、電圧値Vsetの定電圧電源V2からそれよりも電位の低い定電圧電源V1へ主放電経路を介して電流が流れ込む恐れがあり、そのような場合には主放電経路の電位が定電圧電源V2の電位Vsetよりも低下してしまい本来の駆動電圧波形を生成することが困難となる。また、負の電圧値Vadの定電圧電源V3による電力供給時には、定電圧電源V3よりも電位の高いGNDから定電圧電源V3へ主放電経路を介して電流が流れ込む恐れがあり、そのような場合には、主放電経路の電位が定電圧電源V3の負の電圧値Vadよりも上昇してしまい本来の駆動電圧波形を生成することが困難となる。   When power is supplied from the constant voltage power supply V2, there is a possibility that current flows from the constant voltage power supply V2 having the voltage value Vset to the constant voltage power supply V1 having a lower potential through the main discharge path. Since the potential of the path is lower than the potential Vset of the constant voltage power source V2, it becomes difficult to generate the original drive voltage waveform. Further, when power is supplied from the constant voltage power supply V3 having a negative voltage value Vad, current may flow from GND having a higher potential than the constant voltage power supply V3 to the constant voltage power supply V3 through the main discharge path. In this case, the potential of the main discharge path rises higher than the negative voltage value Vad of the constant voltage power supply V3, and it becomes difficult to generate the original drive voltage waveform.

しかし、初期化波形発生回路52によって走査電極SC〜SCの駆動が行われる初期化期間において、スイッチング素子S9、S10をオフにすることで、維持パルス発生回路51を初期化波形発生回路52から電気的に分離することができ、そのような電流の流れ込みを遮断することができる。したがって、維持パルス発生回路51によって走査電極SC〜SCの駆動が行われる期間はスイッチング素子S9およびS10をオンにして維持パルス発生回路51を主放電経路に電気的に接続し、それ以外の初期化期間等ではスイッチング素子S9およびS10をオフにして維持パルス発生回路51を主放電経路から電気的に分離する。 However, in the initialization period in which driving is performed in the scan electrodes SC 1 to SC n by an initialization waveform generation circuit 52, by turning OFF the switching element S9, S10, initializing waveform generating circuit sustain pulse generating circuit 51 52 Can be electrically isolated from such a current flow. Therefore, during the period in which scan electrodes SC 1 to SC n are driven by sustain pulse generation circuit 51, switching elements S 9 and S 10 are turned on to electrically connect sustain pulse generation circuit 51 to the main discharge path, In the initialization period or the like, switching elements S9 and S10 are turned off to electrically isolate sustain pulse generating circuit 51 from the main discharge path.

なお、維持パルス発生回路51によって走査電極SC〜SCの駆動が行われる期間は、定電圧電源V1よりも電位が高い定電圧電源V2およびGNDよりも電位が低い定電圧電源V3を主放電経路から電気的に分離しなければならないが、スイッチング素子S21、S22をオフにすることによってそれを行うことができる。これは、スイッチング素子S21のボディダイオードが定電圧電源V2から主放電経路へ流れる電流を遮断する向きになるようにスイッチング素子S21が配置されているからであり、また、スイッチング素子S22のボディダイオードが主放電経路から定電圧電源V3へ流れる電流を遮断する向きになるようにスイッチング素子S22が配置されているからである。 The period in which driving is performed in the scan electrodes SC 1 to SC n by sustain pulse generating circuit 51, main discharge of the constant-voltage power supply V3 potential is lower than the constant voltage source V2 and the GND potential is higher than the constant voltage power supply V1 Although it must be electrically isolated from the path, it can be done by turning off the switching elements S21, S22. This is because the switching element S21 is arranged so that the body diode of the switching element S21 is cut off from the current flowing from the constant voltage power supply V2 to the main discharge path, and the body diode of the switching element S22 is This is because the switching element S22 is arranged so as to cut off the current flowing from the main discharge path to the constant voltage power source V3.

なお、維持電極駆動回路6における維持パルス発生回路61は、電圧値Vsusの定電圧電源V5と、コイルL2と回収コンデンサC2とスイッチング素子S3、S4と逆流防止用ダイオードD3、D4とを有する電力回収部と、スイッチング素子S7、S8を有する電圧クランプ部とからなり、PDP10の容量性負荷(維持電極SU〜SUに生じた容量性負荷)とコイルL2とを共振させて、回収コンデンサC2に電力の回収を行う構成であるが、その動作は維持パルス発生回路51と同様であるので説明を省略する。 The sustain pulse generating circuit 61 in the sustain electrode driving circuit 6 includes a constant voltage power source V5 having a voltage value Vsus, a coil L2, a recovery capacitor C2, switching elements S3 and S4, and backflow prevention diodes D3 and D4. and parts, they consist of a voltage clamp unit having a switching element S7, S8, PDP 10 of the capacitive load (sustain electrodes SU 1 capacitive load generated in the to SU n) and by resonating the coil L2, the recovery capacitor C2 The power is collected, but the operation is the same as that of the sustain pulse generation circuit 51, and thus the description is omitted.

一方、PDPにおいては、消費電力の削減と同様に、画像を見やすく表示することも重要である。そして、画像を見やすくするために明るく表示する技術について様々な提案がなされている。   On the other hand, in the PDP, it is important to display an image in an easy-to-view manner as well as to reduce power consumption. Various proposals have been made regarding a technique for brightly displaying an image so that the image is easy to see.

画像を明るく表示する技術の一つとして、維持期間における維持パルスのパルス数を制御する技術が開示されている。この技術では、放電セルは維持期間に生じる発光の回数が多いほど明るさが増して見えるという原理を応用し、例えば、1フィールドを第1サブフィールドから第8サブフィールド(以下、第1サブフィールドを「SF1」、第2サブフィールドを「SF2」というように略記する)の8つのサブフィールドで構成し、SF1の維持パルス数を1、SF2の維持パルス数を2、以下SF3からSF8までの維持パルス数をそれぞれ4、8、16、32、64、128とした場合に、SF1からSF8までの維持パルス数をそれぞれ2倍の2、4、8、16、32、64、128、256にした2倍モード、SF1からSF8までの維持パルス数をそれぞれ3倍にした3倍モード、同様に4倍にした4倍モードと、サブフィールドの維持パルス数を1倍から2倍、3倍、4倍と変化させる(以下、この維持パルス数の倍率のことを「輝度倍率」と略記する)ことによって維持期間における発光の回数を制御し、画面の明るさを調整することができる。この技術を用いれば、画像の平均的な明るさ(APL:Average Picture Level)を検出し、検出されたAPLにもとづいて輝度倍率を切り替え、APLが低い場合に輝度倍率を上げることで、暗い画像をより明るく表示することが可能となる(例えば、特許文献2参照)。   As a technique for brightly displaying an image, a technique for controlling the number of sustain pulses in the sustain period is disclosed. In this technique, the principle that a discharge cell appears brighter as the number of times of light emission generated in the sustain period is increased. For example, one field is changed from the first subfield to the eighth subfield (hereinafter referred to as the first subfield). (SF1), and the second subfield is abbreviated as “SF2”), the number of sustain pulses of SF1 is 1, the number of sustain pulses of SF2 is 2, and the following SF3 to SF8 When the number of sustain pulses is 4, 8, 16, 32, 64, 128, respectively, the number of sustain pulses from SF1 to SF8 is doubled to 2, 4, 8, 16, 32, 64, 128, 256, respectively. 2 times mode, 3 times mode in which the number of sustain pulses from SF1 to SF8 is tripled, 4 times mode in which the number of sustain pulses is quadrupled, and subfield sustain pulses. Is changed from 1 × to 2 ×, 3 ×, and 4 × (hereinafter, the magnification of the number of sustain pulses is abbreviated as “luminance magnification”) to control the number of times of light emission in the sustain period, thereby increasing the brightness of the screen. Can be adjusted. By using this technique, the average brightness (APL: Average Picture Level) of the image is detected, the luminance magnification is switched based on the detected APL, and when the APL is low, the luminance magnification is increased to increase the dark image. Can be displayed brighter (see, for example, Patent Document 2).

あるいは、維持パルス波形の傾きを急峻にすると維持放電が強く発生して輝度が増すという現象を応用し、APLを検出するとともに検出したAPLにもとづき電力回収部による駆動時間を制御し、APLが低い画像では維持パルス波形の傾きを急峻にして強い維持放電を発生させ、輝度を向上させる技術等も開示されている(例えば、特許文献3参照)。
特公平7−109542号公報 特開平8−286636号公報 特開2001−184024号公報
Or, by applying the phenomenon that the sustain discharge is strongly generated and the brightness is increased when the slope of the sustain pulse waveform is steep, the APL is detected and the driving time by the power recovery unit is controlled based on the detected APL, and the APL is low In the image, a technique for increasing the brightness by generating a strong sustain discharge by making the slope of the sustain pulse waveform steep is disclosed (for example, see Patent Document 3).
Japanese Examined Patent Publication No. 7-109542 JP-A-8-286636 JP 2001-184024 A

上述したような技術によれば、維持期間における維持パルス数を増やす、あるいは維持パルス波形を急峻にして強い維持放電を発生させる等して放電セルの明るさの最大値(以下、「ピーク輝度」と記す)を上げ、放電セルを明るく発光させてダイナミックな画像を表示させることができる。   According to the above-described technique, the maximum value of the brightness of the discharge cell (hereinafter referred to as “peak luminance”) is increased by increasing the number of sustain pulses in the sustain period or generating a strong sustain discharge by sharpening the sustain pulse waveform. The discharge cell can be brightly illuminated to display a dynamic image.

しかし、上述したような技術によれば、放電セルを明るく発光させて画像を明るく表示することが可能となる一方で、放電セルが明るく発光することで画像の中の暗い領域等も明るく表示されてしまい、黒の締りがない白っぽい画像、いわゆる黒が浮いた画像が表示されてしまう場合がある。特に、暗い画像を頻繁に表示させるような全体的に暗いシーンの多い映画等を視聴する場合には、黒が浮いてしまうと画像の品位を損ねてしまう恐れがある。   However, according to the above-described technique, it is possible to brightly display the image by causing the discharge cell to emit light brightly. On the other hand, since the discharge cell emits light brightly, a dark region or the like in the image is also displayed brightly. Thus, a whitish image without black tightening, that is, an image with a so-called black floating may be displayed. In particular, when watching a movie or the like with a lot of dark scenes that frequently display dark images, there is a risk that the quality of the images will be lost if black floats.

あるいは、周囲を暗くしてプラズマディスプレイ装置を視聴するときに不必要に画像が明るく表示される等、プラズマディスプレイ装置の視聴環境と表示される画像の明るさとのバランスがとれていないような場合に、表示された画像がまぶしく感じられる場合がある。   Or, when the surroundings of the plasma display device and the brightness of the displayed image are not balanced, such as when the surroundings are darkened and the plasma display device is viewed unnecessarily brightly, The displayed image may feel dazzling.

そのような場合に、上述した従来技術においては、いわゆるコントラスト調整等の信号処理によって明るさの調整を行い、黒の締まった画像あるいはまぶしく感じることのない画像を表示させて対応していた。例えば、輝度値0から1023までの1024階調で画像表示を行うプラズマディスプレイ装置では、コントラスト調整によってピーク輝度を最大輝度値1023の半分の輝度値511にすると、コントラストが半分、すなわち明るさを半分にした画像を表示することができる。   In such a case, in the above-described prior art, brightness adjustment is performed by signal processing such as so-called contrast adjustment, and a black image or an image that does not feel dazzling is displayed. For example, in a plasma display device that displays an image with 1024 gradations from luminance values 0 to 1023, when the peak luminance is set to a luminance value 511 that is half of the maximum luminance value 1023 by contrast adjustment, the contrast is reduced by half, that is, the brightness is reduced by half. It is possible to display the selected image.

しかしながら、そのようなコントラスト調整等による明るさの調整では、例えばピーク輝度を最大輝度値1023の半分の輝度値511にすることで、輝度値0から511までの512階調で画像表示を行わなくてはならなくなり、表示される画像の階調性が損なわれてしまう。   However, in such brightness adjustment by contrast adjustment or the like, for example, by setting the peak luminance to a luminance value 511 that is half of the maximum luminance value 1023, image display is not performed with 512 gradations from luminance values 0 to 511. The gradation of the displayed image is impaired.

本発明は、このような課題に鑑みてなされたものであり、放電経路におけるインピーダンスを制御することで維持放電の際に放電経路を流れる放電電流を制御し、階調性を損なうことなく明るさを抑えた画像を表示することができるPDP駆動回路およびプラズマディスプレイ装置を提供することを目的とする。   The present invention has been made in view of such problems, and by controlling the impedance in the discharge path, the discharge current flowing through the discharge path during the sustain discharge is controlled, and the brightness is obtained without impairing the gradation. An object of the present invention is to provide a PDP driving circuit and a plasma display device capable of displaying an image with reduced noise.

このような目的を達成するために、本発明のPDP駆動回路は、表示電極対を構成する複数の走査電極および維持電極を有するプラズマディスプレイパネルを駆動して表示電極対に維持放電を発生させるPDP駆動回路であって、維持放電を発生させるために備えられた回路から走査電極または維持電極までのインピーダンスを可変とするように構成したことを特徴とする。   In order to achieve such an object, the PDP driving circuit of the present invention drives a plasma display panel having a plurality of scan electrodes and sustain electrodes constituting a display electrode pair to generate a sustain discharge in the display electrode pair. A drive circuit is characterized in that the impedance from a circuit provided for generating a sustain discharge to a scan electrode or a sustain electrode is variable.

この構成によれば、維持放電を発生させるためにPDP駆動回路に備えられた回路から走査電極または維持電極までの経路におけるインピーダンスを可変とすることで維持放電の際に流れる放電電流を制御し、階調性を損なうことなく明るさを抑えた画像を表示することができる。   According to this configuration, the discharge current flowing during the sustain discharge is controlled by changing the impedance in the path from the circuit provided in the PDP drive circuit to the scan electrode or the sustain electrode in order to generate the sustain discharge, An image with reduced brightness can be displayed without impairing gradation.

また、PDPの走査電極および維持電極に、初期化期間、書込み期間および維持期間を有するサブフィールドの各期間においてそれぞれ異なる駆動波形の電圧を印加してPDPを駆動するPDP駆動回路であって、走査電極に接続される走査電極駆動回路と、維持電極に接続される維持電極駆動回路とを備え、走査電極駆動回路および維持電極駆動回路は、1フィールドを構成する複数のサブフィールドの各維持期間において走査電極または維持電極に印加する維持パルスを発生させる維持パルス発生回路をそれぞれ有し、維持パルス発生回路から走査電極または維持電極までのインピーダンスを可変とするように構成してもよい。   The PDP driving circuit drives the PDP by applying voltages having different driving waveforms to the scan electrode and the sustain electrode of the PDP in each period of the subfield having the initialization period, the address period, and the sustain period. A scan electrode drive circuit connected to the electrodes and a sustain electrode drive circuit connected to the sustain electrodes, the scan electrode drive circuit and the sustain electrode drive circuit in each sustain period of a plurality of subfields constituting one field A sustain pulse generation circuit for generating a sustain pulse to be applied to the scan electrode or the sustain electrode may be provided, and the impedance from the sustain pulse generation circuit to the scan electrode or the sustain electrode may be variable.

この構成によれば、維持パルス発生回路から走査電極または維持電極までの経路である放電経路におけるインピーダンスを可変とすることで維持放電の際に放電経路を流れる放電電流を制御し、階調性を損なうことなく明るさを抑えた画像を表示することができる。   According to this configuration, by changing the impedance in the discharge path, which is the path from the sustain pulse generating circuit to the scan electrode or the sustain electrode, the discharge current flowing through the discharge path during the sustain discharge is controlled, and the gradation is improved. An image with reduced brightness can be displayed without loss.

また、走査電極駆動回路は、維持パルス発生回路と走査電極との間に設けられ初期化期間に走査電極に印加する初期化波形を発生する初期化波形発生回路と、維持パルス発生回路と初期化波形発生回路との間に設けられ初期化波形発生回路と維持パルス発生回路とを電気的に分離するためのスイッチ回路とをさらに備え、スイッチ回路におけるインピーダンスを可変とすることにより維持パルス発生回路から走査電極までのインピーダンスを可変とするように構成してもよい。この構成によれば、初期化波形発生回路と維持パルス発生回路とを電気的に分離するために設けたスイッチ回路におけるインピーダンスを可変にすることで放電経路におけるインピーダンスを可変とすることができる。   The scan electrode driving circuit is provided between the sustain pulse generating circuit and the scan electrode and generates an initializing waveform to be applied to the scan electrode during the initializing period, and the sustain pulse generating circuit is initialized. A switching circuit provided between the waveform generation circuit and electrically separating the initialization waveform generation circuit and the sustain pulse generation circuit; You may comprise so that the impedance to a scanning electrode may be made variable. According to this configuration, the impedance in the discharge path can be made variable by making the impedance in the switch circuit provided for electrically separating the initialization waveform generating circuit and the sustain pulse generating circuit variable.

また、スイッチ回路は、維持パルス発生回路から初期化波形発生回路へ流れる電流を遮断することができる並列に接続された複数のスイッチング素子によって構成された第1のスイッチと初期化波形発生回路から維持パルス発生回路へ流れる電流を遮断することができる並列に接続された複数のスイッチング素子によって構成された第2のスイッチとを有し、第1のスイッチおよび第2のスイッチを構成するそれらの複数のスイッチング素子を選択的に導通させることによりスイッチ回路におけるインピーダンスを可変とするように構成してもよい。この構成によれば、第1のスイッチと第2のスイッチとを同時にオフにすることで初期化波形発生回路と維持パルス発生回路とを電気的に分離することができ、さらに、第1のスイッチおよび第2のスイッチを構成する並列に接続された複数のスイッチング素子を選択的に導通させることでスイッチ回路におけるインピーダンスを可変とすることができる。   Further, the switch circuit is maintained from the first switch and the initialization waveform generation circuit configured by a plurality of switching elements connected in parallel that can cut off a current flowing from the sustain pulse generation circuit to the initialization waveform generation circuit. And a second switch constituted by a plurality of switching elements connected in parallel capable of interrupting a current flowing to the pulse generation circuit, and the plurality of those constituting the first switch and the second switch You may comprise so that the impedance in a switch circuit may be made variable by selectively turning on a switching element. According to this configuration, the initialization waveform generation circuit and the sustain pulse generation circuit can be electrically separated by simultaneously turning off the first switch and the second switch, and further, the first switch The impedance in the switch circuit can be made variable by selectively conducting a plurality of switching elements connected in parallel constituting the second switch.

また、維持パルス発生回路は、PDPの電極の容量性負荷に蓄積された電力をLC共振によって回収コンデンサに回収しその回収した電力をPDPの駆動に再利用する電力回収部と、並列に接続された複数のスイッチング素子によって構成されPDPの電極を電源電位にクランプする電源クランプスイッチおよび並列に接続された複数のスイッチング素子によって構成されPDPの電極を接地電位にクランプする接地クランプスイッチを有するクランプ部とを備え、電源クランプスイッチおよび接地クランプスイッチを構成するそれらの複数のスイッチング素子を選択的に導通させることにより電源クランプスイッチおよび接地クランプスイッチにおけるインピーダンスを可変させ、それにより維持パルス発生回路から走査電極または維持電極までのインピーダンスを可変とするように構成してもよい。この構成によれば、電源クランプスイッチおよび接地クランプスイッチをそれぞれ形成する並列に接続された複数のスイッチング素子を選択的に導通させることで電源クランプスイッチまたは接地クランプスイッチにおけるインピーダンスを可変させ、それにより放電経路におけるインピーダンスを可変とすることができる。   The sustain pulse generation circuit is connected in parallel with a power recovery unit that recovers the power accumulated in the capacitive load of the electrode of the PDP in a recovery capacitor by LC resonance and reuses the recovered power for driving the PDP. A power supply clamp switch configured by a plurality of switching elements to clamp the electrode of the PDP to the power supply potential, and a ground clamp switch configured by a plurality of switching elements connected in parallel to clamp the electrode of the PDP to the ground potential; A plurality of switching elements constituting the power clamp switch and the ground clamp switch are selectively turned on to vary the impedance in the power clamp switch and the ground clamp switch, thereby causing the scan pulse or Maintenance power The impedance to be configured to be variable. According to this configuration, the impedance in the power clamp switch or the ground clamp switch is varied by selectively conducting a plurality of switching elements connected in parallel that respectively form the power clamp switch and the ground clamp switch, thereby discharging. The impedance in the path can be made variable.

また、走査電極駆動回路が有する維持パルス発生回路は、走査電極の容量性負荷とLC共振させて走査電極の容量性負荷に蓄積された電力を回収電力として回収コンデンサに回収する電力回収コイルおよび走査電極の容量性負荷とLC共振させて回収コンデンサに蓄積された回収電力を供給電力として走査電極の容量性負荷に供給する電力供給コイルを有する電力回収部と、一端が電源電位に接続され走査電極を電源電位にクランプする電源クランプスイッチおよび走査電極を接地電位にクランプする接地クランプスイッチを有するクランプ部と、電源クランプスイッチの他端に電源クランプスイッチと直列に接続され電源クランプスイッチを介して電源電位へ流れる電流を遮断することができる並列に接続された複数のスイッチング素子によって構成されたスイッチ回路とを備え、スイッチ回路を構成する複数のスイッチング素子を選択的に導通させることによりスイッチ回路におけるインピーダンスを可変させ、それにより維持パルス発生回路から走査電極までのインピーダンスを可変とするように構成してもよい。この構成によれば、スイッチ回路を構成する複数のスイッチング素子の全てをオフにすることで電源クランプスイッチを介して電源電位へ流れ込む電流を遮断することができ、さらに、それらの複数のスイッチング素子を選択的に導通させることで回収コンデンサから走査電極へ電流を供給する経路におけるインピーダンスを可変させ、それにより放電経路におけるインピーダンスを可変とすることができる。   Further, the sustain pulse generating circuit included in the scan electrode driving circuit includes a power recovery coil and a scan that recover LC in the recovery capacitor as recovered power by causing LC resonance with the capacitive load of the scan electrode. A power recovery unit having a power supply coil for supplying the recovered power stored in the recovery capacitor by LC resonance with the capacitive load of the electrode as supply power to the capacitive load of the scan electrode, and one end connected to the power supply potential and the scan electrode A power supply clamp switch for clamping the power supply potential to the power supply potential and a clamp portion having a ground clamp switch for clamping the scan electrode to the ground potential, and the other end of the power supply clamp switch is connected in series with the power supply clamp switch and the power supply potential via the power supply clamp switch To multiple switching elements connected in parallel that can cut off the current flowing to The switch circuit is configured to vary the impedance in the switch circuit by selectively conducting a plurality of switching elements constituting the switch circuit, thereby varying the impedance from the sustain pulse generating circuit to the scan electrode. You may comprise as follows. According to this configuration, by turning off all of the plurality of switching elements constituting the switch circuit, it is possible to cut off the current flowing into the power supply potential via the power supply clamp switch. By selectively conducting, the impedance in the path for supplying current from the recovery capacitor to the scan electrode can be varied, thereby making the impedance in the discharge path variable.

また、スイッチ回路を、少なくとも1つのスイッチング素子と電源クランプスイッチへ流れる電流を遮断する向きに配置された少なくとも1つのダイオードとを並列に接続して構成してもよい。この構成によれば、スイッチング素子を導通させたときとそうでないときとで回収コンデンサから走査電極へ電流を供給する経路におけるインピーダンスを可変させることができる。   In addition, the switch circuit may be configured by connecting in parallel at least one switching element and at least one diode arranged in a direction to cut off the current flowing to the power clamp switch. According to this configuration, the impedance in the path for supplying current from the recovery capacitor to the scan electrode can be varied depending on whether the switching element is turned on or not.

また、走査電極駆動回路は、書込み期間に走査電極に印加する走査パルスを発生する走査パルス発生回路を有し、走査パルス発生回路は、書込み期間においては走査パルスを発生させるために異なる電圧値の定電圧電源を切り替えて走査電極に印加し維持期間においては維持パルスの通過経路を変更することができる複数のスイッチング素子を有し、維持期間において複数のスイッチング素子を選択的に導通させることにより維持パルスの通過経路を変更させ、それにより維持パルス発生回路から走査電極までのインピーダンスを可変とするように構成してもよい。この構成によれば、維持期間において走査パルス発生回路が有する複数のスイッチング素子を選択的に導通させて維持パルスの通過経路を変更させ、維持パルスがより少ない数のスイッチング素子を通過する場合、より多い数のスイッチング素子を通過する場合、スイッチング素子を並列に通過する場合等で切り替える。それにより放電経路におけるインピーダンスを可変とすることができる。   The scan electrode driving circuit has a scan pulse generation circuit that generates a scan pulse to be applied to the scan electrode in the address period, and the scan pulse generation circuit has different voltage values in order to generate the scan pulse in the address period. It has a plurality of switching elements that can switch the constant voltage power source and apply it to the scan electrodes and change the passage path of the sustain pulse in the sustain period, and maintain by selectively conducting the plurality of switching elements in the sustain period It is also possible to change the pulse passage path, thereby making the impedance from the sustain pulse generating circuit to the scan electrode variable. According to this configuration, the plurality of switching elements included in the scan pulse generation circuit are selectively turned on in the sustain period to change the sustain pulse passage path, and the sustain pulse passes through a smaller number of switching elements. When passing through a large number of switching elements, switching is performed when passing through the switching elements in parallel. Thereby, the impedance in the discharge path can be made variable.

また、本発明のプラズマディスプレイ装置は、第1の基板上に平行に配置されかつ表示電極対を構成する複数の走査電極および維持電極と、放電空間を挟んで第1の基板に対向配置された第2の基板上に走査電極と交差する方向に配置されかつ表示電極対とで放電セルを構成する複数のデータ電極とを有するPDPと、上述したいずれかのPDP駆動回路とを備えたことを特徴とする。この構成によれば、維持パルス発生回路から走査電極または維持電極までの放電経路におけるインピーダンスを可変とすることで維持放電の際に放電経路を流れる放電電流を制御し、階調性を損なうことなく明るさを抑えた画像を表示することができるプラズマディスプレイ装置を構成することができる。   In addition, the plasma display device of the present invention is arranged in parallel to the first substrate with a plurality of scan electrodes and sustain electrodes arranged in parallel on the first substrate and constituting the display electrode pair, with the discharge space interposed therebetween. A PDP having a plurality of data electrodes arranged on a second substrate in a direction intersecting with the scanning electrodes and forming a discharge cell with a display electrode pair, and any of the PDP driving circuits described above Features. According to this configuration, the impedance in the discharge path from the sustain pulse generating circuit to the scan electrode or the sustain electrode can be made variable to control the discharge current flowing through the discharge path during the sustain discharge, without impairing the gradation. A plasma display device capable of displaying an image with reduced brightness can be configured.

本発明によれば、放電経路におけるインピーダンスを制御することによって維持放電の際の放電電流を制御し、それにより階調性を損なうことなく輝度を抑えた画像の表示を行うことができるPDP駆動回路およびプラズマディスプレイ装置を提供することができる。   According to the present invention, the PDP drive circuit can control the discharge current during the sustain discharge by controlling the impedance in the discharge path, thereby displaying an image with reduced luminance without impairing the gradation. In addition, a plasma display device can be provided.

以下、本発明の実施の形態について、図面を参照しながら説明する。   Hereinafter, embodiments of the present invention will be described with reference to the drawings.

(実施の形態1)
図1は、本発明の実施の形態1におけるPDP駆動回路の回路図である。なお、本実施の形態におけるPDP駆動回路が駆動の対象とするPDP10の構造および電極配列は図9および図10に示したPDP10と同様であり、また、本実施の形態におけるPDP駆動回路がPDP10の各電極に印加する各駆動電圧波形は図11に示した駆動電圧波形と同様であり、また、本実施の形態におけるPDP駆動回路およびPDP10が組み込まれたプラズマディスプレイ装置の電気的構成は図12に示した電気的構成のブロック図と同様であるので、それぞれの構成および動作に関する説明は省略する。
(Embodiment 1)
FIG. 1 is a circuit diagram of a PDP drive circuit according to Embodiment 1 of the present invention. The structure and electrode arrangement of the PDP 10 to be driven by the PDP drive circuit in the present embodiment are the same as those of the PDP 10 shown in FIGS. 9 and 10, and the PDP drive circuit in the present embodiment is the PDP 10 Each drive voltage waveform applied to each electrode is the same as the drive voltage waveform shown in FIG. 11, and the electrical configuration of the plasma display apparatus incorporating the PDP drive circuit and PDP 10 in this embodiment is shown in FIG. Since it is the same as the block diagram of the electrical configuration shown, a description of each configuration and operation is omitted.

図1に示すとおり、本発明の実施の形態1におけるPDP駆動回路は電力回収回路を備えた走査電極駆動回路501および維持パルス発生回路61を備え、走査電極駆動回路501は、維持パルス発生回路511と初期化波形発生回路52と走査パルス発生回路53とスイッチング素子S9、S9、S10、S10からなるスイッチ回路とを有している。 As shown in FIG. 1, the PDP drive circuit according to the first embodiment of the present invention includes a scan electrode drive circuit 501 provided with a power recovery circuit and a sustain pulse generation circuit 61. The scan electrode drive circuit 501 includes a sustain pulse generation circuit 511. And an initialization waveform generation circuit 52, a scan pulse generation circuit 53, and a switch circuit composed of switching elements S9 1 , S9 2 , S10 1 , S10 2 .

維持パルス発生回路511は、電圧値Vsusの定電圧電源V1と電力回収部と電圧クランプ部とからなり、電力回収部は、コイルL1と、回収コンデンサC1と、スイッチング素子S1、S2と逆流防止用ダイオードD1、D2とを備えている。また、電圧クランプ部は、電源クランプスイッチであるスイッチング素子S5と、接地クランプスイッチであるスイッチング素子S6とを備えている。   The sustain pulse generation circuit 511 includes a constant voltage power source V1 having a voltage value Vsus, a power recovery unit, and a voltage clamp unit. The power recovery unit is a coil L1, a recovery capacitor C1, switching elements S1 and S2, and a backflow prevention unit. Diodes D1 and D2 are provided. The voltage clamp section includes a switching element S5 that is a power clamp switch and a switching element S6 that is a ground clamp switch.

そして、維持パルス発生回路511では、スイッチング素子S1、S2、S5、S6の切り替えによって、電力回収部と電圧クランプ部とを切り替え、走査電極SC〜SCに印加するための維持パルスを発生する。電力回収部では、インダクタンス素子であるコイルL1を用いることによりPDP10の容量性負荷(図10の走査電極SC〜SCに生じた容量性負荷)とコイルL1のインダクタンスとをLC共振させて、電力の回収および供給を行う。電圧クランプ部では、電圧値Vsusの定電圧電源V1からスイッチング素子S5を介して走査電極SC〜SCに電力を供給して走査電極SC〜SCを電圧値Vsusにクランプし、また、走査電極SC〜SCをスイッチング素子S6を介して接地電位にクランプすることによって、走査電極SC〜SCの駆動を行う。 In sustain pulse generation circuit 511, the power recovery unit and the voltage clamp unit are switched by switching switching elements S1, S2, S5, and S6, and a sustain pulse to be applied to scan electrodes SC 1 to SC n is generated. . In the power recovery unit, by using the coil L1 which is an inductance element, LC resonance is caused between the capacitive load of the PDP 10 (capacitive load generated in the scan electrodes SC 1 to SC n in FIG. 10) and the inductance of the coil L1, Collect and supply power. The voltage clamping unit clamps the scan electrodes SC 1 to SC n and supplies power to the scan electrodes SC 1 to SC n from the constant-voltage power supply V1 voltage value Vsus through the switching elements S5 to the voltage value Vsus, also, by clamping to the ground potential scan electrodes SC 1 to SC n via the switching element S6, to drive the scan electrodes SC 1 to SC n.

初期化波形発生回路52は、MOSFET等のスイッチング動作を行う一般に知られた素子からなるスイッチング素子S21、S22と、定電圧電源V1よりも電位の高い電圧値Vsetの定電圧電源V2と、負の電圧値Vadの定電圧電源V3とを有している。そして、定電圧電源V2からスイッチング素子S21を介して走査電極SC〜SCに電力を供給し、また、定電圧電源V3からスイッチング素子S22を介して走査電極SC〜SCに負の電位の電力を供給して、初期化波形を発生させる。また、スイッチング素子S21は、そのボディダイオードが定電圧電源V2から主放電経路に流れる電流を遮断する向きで配置され、スイッチング素子S22は、そのボディダイオードが主放電経路から定電圧電源V3に流れる電流を遮断する向きで配置されている。 The initialization waveform generating circuit 52 includes switching elements S21 and S22 made of generally known elements that perform a switching operation such as a MOSFET, a constant voltage power supply V2 having a voltage value Vset having a higher potential than the constant voltage power supply V1, and a negative voltage And a constant voltage power supply V3 having a voltage value Vad. Then, supplies power to the scan electrodes SC 1 to SC n from the constant-voltage power supply V2 through the switching element S21, also, a negative potential to the scan electrodes SC 1 to SC n from the constant-voltage power supply V3 via the switching element S22 Is supplied to generate an initialization waveform. The switching element S21 is arranged in such a direction that its body diode cuts off the current flowing from the constant voltage power supply V2 to the main discharge path, and the switching element S22 is the current flowing from the main discharge path to the constant voltage power supply V3 by the body diode. It is arranged in the direction to shut off.

そして、初期化波形発生回路52は、初期化期間前半部では、データ電極D〜Dに対して放電開始電圧以下の電圧Vi1から放電開始電圧を超える電圧Vi2、すなわちVsetに向かって緩やかに上昇する傾斜波形を発生し、初期化期間後半部では、維持電極SU〜SUに対して放電開始電圧以下となる電圧Vi3から放電開始電圧を超える電圧Vi4、すなわちVadに向かって緩やかに下降する傾斜波形を発生して、走査電極SC〜SCに印加する。 Then, in the first half of the initialization period, the initialization waveform generation circuit 52 proceeds from the voltage V i1 that is equal to or lower than the discharge start voltage to the voltage V i2 that exceeds the discharge start voltage, that is, Vset with respect to the data electrodes D 1 to D m . generating a ramp waveform that gradually rises, in the latter half of the initializing period, voltage V i4 exceeding the discharge start voltage from the voltage V i3 to be equal to or less than the discharge starting voltage with respect to sustain electrodes SU 1 to SU n, i.e. towards the Vad generates a gradient waveform gradually decreasing Te, applied to scan electrodes SC 1 to SC n.

走査パルス発生回路53は、MOSFET等のスイッチング動作を行う一般に知られた素子からなるスイッチング素子S31、S32と、電圧値Vscnの定電圧電源V4と、定電圧電源V4へ流れ込む電流を防止する逆流防止用ダイオードD31と、コンデンサC31と、スイッチング動作を行うIC31とを有し、書込み期間において負の走査パルスを発生し、走査電極SC〜SCに順次印加する。 The scan pulse generation circuit 53 includes switching elements S31 and S32 made of a generally known element that performs a switching operation such as a MOSFET, a constant voltage power source V4 having a voltage value Vscn, and a backflow prevention that prevents a current flowing into the constant voltage power source V4. Diode D31, capacitor C31, and IC 31 that performs a switching operation. A negative scan pulse is generated in the address period and sequentially applied to scan electrodes SC 1 to SC n .

また、維持パルス発生回路61は、維持パルス発生回路511と同様の動作により、PDP10の容量性負荷(図10の維持電極SU〜SUに生じた容量性負荷)とコイルL2のインダクタンスとをLC共振させて電力の回収および供給を行い、維持電極SU〜SUの駆動を行う。 The sustain pulse generating circuit 61, the same operation as sustain pulse generating circuit 511, PDP 10 of the capacitive load (capacitive load generated in the sustain electrodes SU 1 to SU n in FIG. 10) and the inductance of the coil L2 perform recovery and supply of electric power by LC resonance, and drives the sustain electrodes SU 1 to SU n.

これらスイッチング素子S1、S2、S5、S6、S21、S22、S31、S32およびIC31は、サブフィールド処理回路3において作成されたサブフィールド制御信号にもとづき切り替えが制御される。   Switching of these switching elements S 1, S 2, S 5, S 6, S 21, S 22, S 31, S 32 and IC 31 is controlled based on a subfield control signal created in the subfield processing circuit 3.

また、維持パルス発生回路511を初期化波形発生回路52から電気的に分離するために、維持パルス発生回路511と初期化波形発生回路52との間の主放電経路上には、ボディダイオードが維持パルス発生回路511から初期化波形発生回路52へ流れる電流を遮断する向きになるように配置され互いに並列に接続されたスイッチング素子S9およびS9からなる第1のスイッチと、ボディダイオードが初期化波形発生回路52から維持パルス発生回路511へ流れる電流を遮断する向きになるように配置され互いに並列に接続されたスイッチング素子S10およびS10からなる第2のスイッチとが直列に接続されて構成されたスイッチ回路が挿入されている。これにより、スイッチング素子S9およびS9とスイッチング素子S10およびS10とを同時にオフにすれば、維持パルス発生回路511から初期化波形発生回路52へ流れる電流と、初期化波形発生回路52から維持パルス発生回路511へ流れる電流とのいずれの電流も遮断することができ、維持パルス発生回路511を初期化波形発生回路52から電気的に分離することが可能となる。 Further, in order to electrically isolate sustain pulse generation circuit 511 from initialization waveform generation circuit 52, a body diode is maintained on the main discharge path between sustain pulse generation circuit 511 and initialization waveform generation circuit 52. a first switch including a pulse generating circuit 511 reset waveform generating circuit 52 a switching element S9 1 and S9 2 connected in parallel with each other are arranged such that the direction of interrupting the flow of current to the initialization body diode configuration and a second switch comprising a waveform generating circuit 52 from the sustain pulse generating circuit 511 is arranged such that the direction of interrupting the flow of current to the connected in parallel with each other on the switching elements S10 1 and S10 2 are connected in series A switched circuit is inserted. Thus, if off the switching element S9 1 and S9 2 and the switching element S10 1 and S10 2 simultaneously, the current flowing from the sustain pulse generating circuit 511 to the reset waveform generation circuit 52, the initializing waveform generating circuit 52 Any of the current flowing to sustain pulse generating circuit 511 can be cut off, and sustain pulse generating circuit 511 can be electrically separated from initialization waveform generating circuit 52.

そして、スイッチング素子S9、S9、S10、S10はそれぞれ独立してオン/オフの制御が可能である。さらに、本発明の実施の形態1においては、スイッチング素子S9およびS10をオンにした場合と、スイッチング素子S9、S9、S10およびS10をオンにした場合とで主放電経路におけるインピーダンスが異なるように構成している。 The switching elements S9 1 , S9 2 , S10 1 , S10 2 can be independently controlled on / off. Further, in the first embodiment of the present invention, in the main discharge path to the case of turning on the switching element S9 1 and S10 1, and if you turn on the switching element S9 1, S9 2, S10 1 and S10 2 in The impedance is different.

本発明者は、実験により、維持放電の際に流れる放電電流と維持放電による発光輝度との間に関連があることを見出した。すなわち、放電電流を制限することで放電の強度を抑制し、発光輝度を抑えられることが分かった。そして、主放電経路のインピーダンスを可変にすることで維持放電の際に流れる放電電流を制御できることが分かった。さらに、本発明者が行った実験では、主放電経路におけるインピーダンスを22mΩ上げると維持放電による発光輝度が10%下がり、同じくインピーダンスを100mΩ上げると発光輝度が50%下がるといった結果が得られた。   The inventor has found through experiments that there is a relationship between the discharge current flowing during the sustain discharge and the light emission luminance due to the sustain discharge. That is, it was found that by limiting the discharge current, the intensity of discharge can be suppressed and the light emission luminance can be suppressed. It was found that the discharge current flowing during the sustain discharge can be controlled by making the impedance of the main discharge path variable. Furthermore, in the experiments conducted by the present inventors, it was found that when the impedance in the main discharge path is increased by 22 mΩ, the emission luminance due to the sustain discharge is reduced by 10%, and when the impedance is increased by 100 mΩ, the emission luminance is reduced by 50%.

そこで、本発明の実施の形態1においては、スイッチング素子S9およびS10をオンにした場合のスイッチング素子S9、S10およびスイッチング素子S9、S10のボディダイオードによる合成インピーダンスと、スイッチング素子S9、S9、S10およびS10をオンにした場合のスイッチング素子S9、S9、S10およびS10による合成インピーダンスとの差が100mΩになるようにスイッチング素子S9、S9、S10およびS10をそれぞれ設ける構成とする。そして、維持期間において、通常の画像を表示させるときにはスイッチング素子S9、S9、S10およびS10を全てオンにし、明るさ抑えた画像を表示させるときにはスイッチング素子S9およびS10だけをオンにして、維持パルス発生回路511に走査電極SC〜SCの駆動を行わせる。 Therefore, in the first embodiment of the present invention, when the switching elements S9 1 and S10 1 are turned on, the combined impedance of the switching diodes S9 1 and S10 1 and the switching elements S9 2 and S10 2 by the body diode, and the switching element S9 1, S9 2, S10 1 and S10 2 switching element S9 1 when you turn, S9 2, S10 1 and S10 the switching element S9 1 as the difference between the combined impedance due 2 is 100 m [Omega, S9 2, S10 1 and S10 2 are provided. Then, on in the sustain period, when displaying the normal image is all on the switching element S9 1, S9 2, S10 1 and S10 2, only the switching element S9 1 and S10 1 when displaying an image with reduced brightness Then, sustain pulse generation circuit 511 drives scan electrodes SC 1 to SC n .

これにより、スイッチング素子S9およびS10だけをオンにした場合には、スイッチング素子S9、S9、S10およびS10の全てをオンにした場合と比較して主放電経路におけるインピーダンスを100mΩ大きくすることができ、放電セルでの維持放電における放電電流を制限して発光輝度を50%下げること、すなわちピーク輝度を50%下げた画像を表示することが可能となる。 Thus, if you turn on only the switching element S9 1 and S10 1 is, 100 m [Omega impedance in the main discharge path as compared with the case of turning on all the switching elements S9 1, S9 2, S10 1 and S10 2 The discharge current in the sustain discharge in the discharge cell can be limited to reduce the light emission luminance by 50%, that is, an image with the peak luminance reduced by 50% can be displayed.

そして、この本発明の実施の形態1による明るさの調整では、コントラスト調整等の信号処理による明るさの調整と異なり、放電セルにおける発光輝度を抑えることでピーク輝度を下げているので、階調性を損なうことなく画像を表示することが可能となる。   In the brightness adjustment according to the first embodiment of the present invention, unlike the brightness adjustment by signal processing such as contrast adjustment, the peak brightness is lowered by suppressing the light emission brightness in the discharge cell. It becomes possible to display an image without impairing the performance.

このように、本発明の実施の形態1によれば、維持パルス発生回路511を初期化波形発生回路52から電気的に分離するために主放電経路上に挿入するスイッチ回路を、並列に接続された複数のスイッチング素子をバックトゥバック接続することによって構成し、オンさせるスイッチング素子の組み合わせによって主放電経路におけるインピーダンスを切り替えられるように構成する。そして、画像を明るく表示させたい場合には、スイッチ回路を構成する全てのスイッチング素子をオンにして主放電経路におけるインピーダンスを下げ、放電電流に制限を加えずに放電セルでの維持放電を発生させる。また、輝度を抑えて画像を表示させたい場合には、スイッチ回路を構成するスイッチング素子を選択的にオンにして主放電経路におけるインピーダンスを上げ、放電電流を制限した維持放電を発生させて発光輝度を下げる。これにより、階調性を損なうことなく輝度を抑えた画像を表示することが可能となり、例えば暗いシーンの多い映画を視聴する場合やプラズマディスプレイ装置の周囲を暗くして視聴する場合等において、明るさを抑えた黒の締まった画像を階調性を損なうことなく表示させることができるようになる。   As described above, according to the first embodiment of the present invention, the switch circuit that is inserted on the main discharge path in order to electrically isolate sustain pulse generation circuit 511 from initialization waveform generation circuit 52 is connected in parallel. A plurality of switching elements are connected by back-to-back connection, and the impedance in the main discharge path can be switched by a combination of switching elements to be turned on. When it is desired to display an image brightly, all the switching elements constituting the switch circuit are turned on to lower the impedance in the main discharge path, and a sustain discharge is generated in the discharge cell without limiting the discharge current. . If you want to display an image with reduced brightness, you can selectively turn on the switching elements that make up the switch circuit to increase the impedance in the main discharge path and generate a sustain discharge that limits the discharge current. Lower. As a result, it is possible to display an image with reduced brightness without impairing the gradation, for example, when viewing a movie with many dark scenes or viewing with a dark surrounding of the plasma display device. This makes it possible to display a black-tight image with reduced roughness without impairing the gradation.

なお、本発明の実施の形態1においては、主放電経路におけるインピーダンスを22mΩ大きくするとピーク輝度が10%下がり、インピーダンスを100mΩ大きくするとピーク輝度が50%下がるとして説明を行ったが、これらの数値は本発明者の行った実験の結果にもとづいた数値を示したに過ぎず、何らこれらの数値に限定されるものではない。これらの数値はPDPの特性や駆動回路の特性によって異なるため、プラズマディスプレイ装置に用いるPDPの発光輝度とインピーダンスとの関係を求める実験を行い、その実験の結果およびプラズマディスプレイ装置の仕様等にもとづき適正な値に設定することが望ましい。   In the first embodiment of the present invention, it has been explained that the peak luminance is reduced by 10% when the impedance in the main discharge path is increased by 22 mΩ, and the peak luminance is reduced by 50% when the impedance is increased by 100 mΩ. Only numerical values based on the results of experiments conducted by the present inventors are shown, and the present invention is not limited to these numerical values. Since these values vary depending on the characteristics of the PDP and the characteristics of the drive circuit, an experiment was conducted to determine the relationship between the light emission luminance and impedance of the PDP used in the plasma display device. It is desirable to set a correct value.

また、本発明の実施の形態1においては、スイッチング素子S9およびS10だけをオンにして主放電経路におけるインピーダンスを大きくする構成を説明したが、例えば、回収コンデンサC1から走査電極SC〜SCへの電力供給時には、スイッチング素子S9だけをオンにしてスイッチング素子S9とスイッチング素子S10、S10のボディダイオードとを通って電力が供給されるようにし、走査電極SC〜SCから回収コンデンサC1への電力回収時には、スイッチング素子S10だけをオンにしてスイッチング素子S10とスイッチング素子S9、S9のボディダイオードとを通って電力が回収されるようにしてもよい。このような構成であっても主放電経路におけるインピーダンスを大きくすることが可能である。 In the first embodiment of the present invention has been described configuration is turned on only the switching element S9 1 and S10 1 to increase the impedance in the main discharge path, for example, scan electrodes SC 1 to SC from the recovery capacitor C1 when power supply to n, so that electric power is supplied to turn on only the switching element S9 1 through a switching element S9 1 and the switching element S10 1, S10 2 of the body diode, the scan electrodes SC 1 to SC n from the time of power recovery to the recovery capacitor C1, may be power through a switching element S10 1 and the switching element S9 1, S9 2 of the body diode is turned on only the switching element S10 1 is recovered. Even with such a configuration, the impedance in the main discharge path can be increased.

また、図1では、スイッチング素子S9、S9、S10およびS10をそれぞれ1つのスイッチング素子として示しているが、これは図面を見やすくするために便宜上それぞれを1つのスイッチング素子として示したに過ぎず、使用するスイッチング素子の定格や駆動時に流れる最大電流等にもとづきそれぞれのスイッチング素子を最適な素子数で構成することが望ましい。 Further, in FIG. 1, the is shown the switching element S9 1, S9 2, S10 1 and S10 2 as one switching element, respectively, which indicated for convenience respectively for the sake of clarity as a single switching element However, it is desirable to configure each switching element with an optimal number of elements based on the rating of the switching elements used, the maximum current that flows during driving, and the like.

また、本発明の実施の形態1では、スイッチ回路における合成インピーダンスを2段階で切り替えられるようにし、通常の発光輝度での画像表示と50%抑えた発光輝度での画像表示とを切り替える構成を説明したが、何らこの構成に限定するものではなく、合成インピーダンスを3段階、あるいはそれ以上で切り替えられるようにスイッチ回路を構成し、発光輝度の抑制具合をより細かく切り替えられるようにしてもよい。   In the first embodiment of the present invention, a configuration in which the combined impedance in the switch circuit can be switched in two stages to switch between image display with normal light emission luminance and image display with light emission luminance reduced by 50% will be described. However, the present invention is not limited to this configuration, and a switch circuit may be configured so that the combined impedance can be switched in three steps or more so that the suppression of the emission luminance can be switched more finely.

(実施の形態2)
本発明の実施の形態1では、図1に示したように、維持パルス発生回路511を初期化波形発生回路52から電気的に分離するために設けたスイッチ回路において、合成インピーダンスを切り替えて放電電流を制限する構成を説明した。しかし、インピーダンスの切り替えによる放電電流の制限は、例えば、維持パルス発生回路における電圧クランプ部の電源クランプスイッチおよび接地クランプスイッチによって行うことも可能である。
(Embodiment 2)
In the first embodiment of the present invention, as shown in FIG. 1, in the switch circuit provided to electrically isolate sustain pulse generation circuit 511 from initialization waveform generation circuit 52, the combined impedance is switched to discharge current. The configuration for limiting the above has been described. However, the discharge current can be limited by switching the impedance, for example, by a power clamp switch and a ground clamp switch in the voltage clamp unit in the sustain pulse generation circuit.

図2は、本発明の実施の形態2におけるPDP駆動回路の回路図である。なお、本実施の形態におけるPDP駆動回路が実施の形態1に示したPDP駆動回路と異なる主な部分は、電圧クランプ部における電源クランプスイッチおよび接地クランプスイッチの構成であるので、ここではその異なる主な部分を中心に説明を行う。   FIG. 2 is a circuit diagram of a PDP drive circuit according to Embodiment 2 of the present invention. The main part of the PDP drive circuit in the present embodiment that is different from the PDP drive circuit shown in the first embodiment is the configuration of the power clamp switch and the ground clamp switch in the voltage clamp unit. The explanation will be focused on these parts.

図2に示すとおり、本発明の実施の形態2におけるPDP駆動回路は電力回収回路を備えた走査電極駆動回路502および維持パルス発生回路62を備え、走査電極駆動回路502は、維持パルス発生回路512と初期化波形発生回路52と走査パルス発生回路53とスイッチング素子S9、S10からなるスイッチ回路とを有している。   As shown in FIG. 2, the PDP drive circuit according to the second embodiment of the present invention includes scan electrode drive circuit 502 and sustain pulse generation circuit 62 that include a power recovery circuit, and scan electrode drive circuit 502 includes sustain pulse generation circuit 512. And an initialization waveform generation circuit 52, a scan pulse generation circuit 53, and a switch circuit composed of switching elements S9 and S10.

維持パルス発生回路512は、電圧値Vsusの定電圧電源V1と電力回収部と電圧クランプ部とからなり、電圧クランプ部は、並列に接続されたスイッチング素子S5、S5によって構成された電源クランプスイッチと、並列に接続されたスイッチング素子S6、S6によって構成された接地クランプスイッチとを備えている。 Sustain pulse generating circuit 512 is composed of a constant-voltage power supply V1 and the power recovery unit and the voltage clamp portion of the voltage value Vsus, voltage clamp unit, a power supply clamp constituted by a switching element S5 1, S5 2 connected in parallel A switch and a ground clamp switch configured by switching elements S6 1 and S6 2 connected in parallel are provided.

また、維持パルス発生回路62は、電圧値Vsusの定電圧電源V5と電力回収部と電圧クランプ部とからなり、電圧クランプ部は、並列に接続されたスイッチング素子S7、S7によって構成された電源クランプスイッチと、並列に接続されたスイッチング素子S8、S8によって構成された接地クランプスイッチとを備えている。 The sustain pulse generating circuit 62 is composed of a constant-voltage power supply V5 and the power recovery unit and the voltage clamp portion of the voltage Vsus, the voltage clamp unit, constituted by a switching element S7 1, S7 2 connected in parallel A power clamp switch and a ground clamp switch configured by switching elements S8 1 and S8 2 connected in parallel are provided.

そして、維持パルス発生回路512では、スイッチング素子S1、S2、S5、S5、S6、S6の切り替えによって電力回収部と電圧クランプ部とを切り替えて走査電極SC〜SCに印加するための維持パルスを発生させ、維持パルス発生回路62では、スイッチング素子S3、S4、S7、S7、S8、S8の切り替えによって電力回収部と電圧クランプ部とを切り替えて維持電極SU〜SUに印加するための維持パルスを発生させる。 Then, the sustain pulse generating circuit 512, is applied to the switching elements S1, S2, S5 1, S5 2, S6 1, S6 scan electrodes SC 1 switches the power recovery unit and the voltage clamp unit by switching the 2 to SC n generates a sustain pulse for sustain the pulse generating circuit 62, the switching elements S3, S4, S7 1, S7 2, S8 1, S8 2 sustain switch the power recovery unit and the voltage clamp unit by switching electrodes SU 1 generating a sustain pulse to be applied to to SU n.

スイッチング素子S5、S5、S6、S6およびスイッチング素子S7、S7、S8、S8はそれぞれ独立してオン/オフの制御が可能であり、例えば定電圧電源V1から走査電極SC〜SCに電力を供給する場合に、スイッチング素子S5だけをオンにした場合とスイッチング素子S5、S5をオンにした場合とで、放電のための電流が流れる経路である放電経路におけるインピーダンスが異なるようにしている。同様に、定電圧電源V5から維持電極SU〜SUに電力を供給する場合に、スイッチング素子S7だけをオンにした場合とスイッチング素子S7、S7をオンにした場合とで、放電経路におけるインピーダンスが異なるようにしている。さらに、走査電極SC〜SCから接地電位に電力を放出する場合に、スイッチング素子S6だけをオンにした場合とスイッチング素子S6、S6をオンにした場合とで放電経路におけるインピーダンスが異なるようにし、維持電極SU〜SUから接地電位に電力を放出する場合に、スイッチング素子S8だけをオンにした場合とスイッチング素子S8、S8をオンにした場合とで放電経路におけるインピーダンスが異なるようにしている。 The switching elements S5 1 , S5 2 , S6 1 , S6 2 and the switching elements S7 1 , S7 2 , S8 1 , S8 2 can be independently controlled on / off, for example, from the constant voltage power supply V1 to the scanning electrode when supplying power to the SC 1 to SC n, you checked only switching element S5 1 and the switching element S5 1, S5 2 in the case of on, the path of current for discharging flow discharge The impedance in the path is made different. Similarly, when supplying power to the sustain electrodes SU 1 to SU n from the constant-voltage power supply V5, in the case of turning on the switching element S7 1, S7 2 if you turn on only the switching element S7 1, discharge The impedance in the path is made different. Furthermore, in the case of releasing the power to the ground potential from the scan electrodes SC 1 to SC n, the impedance in the discharge path in the case where the ON and the switching element S6 1, S6 2 you checked only switching element S6 1 to be different, in the case of releasing the power to the ground potential from the sustain electrode SU 1 to SU n, the discharge path in the case of turning on the switching element S8 1, S8 2 if you turn on only the switching element S8 1 Impedance is different.

そして、通常の画像を表示させるときには放電経路におけるインピーダンスを小さくするためにスイッチング素子S5、S5、S6、S6、S7、S7、S8およびS8によるスイッチング動作によってクランプ動作を行わせ、明るさを抑えた画像を表示させるときには放電経路におけるインピーダンスを大きくするためにスイッチング素子S5、S6、S7およびS8によるスイッチング動作によってクランプ動作を行わせる。 When displaying a normal image, the clamping operation is performed by the switching operation by the switching elements S5 1 , S5 2 , S6 1 , S6 2 , S7 1 , S7 2 , S8 1 and S8 2 in order to reduce the impedance in the discharge path. done was to perform the clamping operation by the switching operation of the switching element S5 1, S6 1, S7 1 and S8 1 in order to increase the impedance in the discharge path when an image is displayed with reduced brightness.

これにより、スイッチング素子S5、S6、S7およびS8によるスイッチング動作のときには、スイッチング素子S5、S5、S6、S6、S7、S7、S8およびS8によるスイッチング動作と比較して放電経路におけるインピーダンスを大きくすることができ、放電セルでの維持放電における放電電流を制限して発光輝度を下げ、明るさを抑えた画像を表示することが可能となる。 Thus, in the switching operation by the switching elements S5 1 , S6 1 , S7 1 and S8 1 , the switching operation by the switching elements S5 1 , S5 2 , S6 1 , S6 2 , S7 1 , S7 2 , S8 1 and S8 2 The impedance in the discharge path can be increased as compared with the above, and the discharge current in the sustain discharge in the discharge cell can be limited to reduce the light emission luminance and display an image with reduced brightness.

このように、本発明の実施の形態2によれば、維持パルス発生回路における電圧クランプ部の電源クランプスイッチおよび接地クランプスイッチをそれぞれ並列に接続された複数のスイッチング素子によって構成し、スイッチング動作をさせるスイッチング素子の組み合わせによって放電経路におけるインピーダンスを切り替えられるように構成する。そして、画像を明るく表示させたい場合には、電源クランプスイッチおよび接地クランプスイッチを構成する全てのスイッチング素子のスイッチング動作によって放電経路におけるインピーダンスを下げ、放電電流に制限を加えずに放電セルでの維持放電を発生させる。また、輝度を抑えて画像を表示させたい場合には、電源クランプスイッチおよび接地クランプスイッチを構成するスイッチング素子を選択的にスイッチング動作させることによって放電経路におけるインピーダンスを上げ、放電電流を制限した維持放電を発生させて発光輝度を下げる。これにより、階調性を損なうことなく輝度を抑えた画像を表示することが可能となり、例えば暗いシーンの多い映画を視聴する場合やプラズマディスプレイ装置の周囲を暗くして視聴する場合等において、明るさを抑えた黒の締まった画像を階調性を損なうことなく表示させることができるようになる。   As described above, according to the second embodiment of the present invention, the power clamp switch and the ground clamp switch of the voltage clamp unit in the sustain pulse generation circuit are configured by the plurality of switching elements connected in parallel, and the switching operation is performed. The impedance in the discharge path can be switched by a combination of switching elements. When it is desired to display an image brightly, the impedance in the discharge path is lowered by the switching operation of all the switching elements constituting the power clamp switch and the ground clamp switch, and the discharge current is not limited and maintained in the discharge cell. Generate a discharge. In addition, when you want to display images with reduced brightness, the switching elements that make up the power clamp switch and ground clamp switch are selectively switched to increase the impedance in the discharge path, and sustain discharge with limited discharge current. To reduce the luminance. As a result, it is possible to display an image with reduced brightness without impairing the gradation, for example, when viewing a movie with many dark scenes or viewing with a dark surrounding of the plasma display device. This makes it possible to display a black-tight image with reduced roughness without impairing the gradation.

なお、図2では、スイッチング素子S5、S5、S6、S6、S7、S7、S8およびS8をそれぞれ1つのスイッチング素子として示しているが、これは図面を見やすくするために便宜上それぞれを1つのスイッチング素子として示したに過ぎず、使用するスイッチング素子の定格や駆動時に流れる最大電流等にもとづきそれぞれのスイッチング素子を最適な素子数で構成することが望ましい。 In FIG. 2, since the switching element S5 1, S5 2, S6 1 , S6 2, S7 1, S7 2, S8 are shown first and S8 2 as one switching element each, which is to clarity For convenience, each is shown as a single switching element, and it is desirable to configure each switching element with the optimum number of elements based on the rating of the switching element used, the maximum current that flows during driving, and the like.

また、本発明の実施の形態2では、電源クランプスイッチおよび接地クランプスイッチにおけるインピーダンスを2段階で切り替える構成を説明したが、何らこの構成に限定するものではなく、インピーダンスを3段階、あるいはそれ以上で切り替えられるように電源クランプスイッチおよび接地クランプスイッチを構成し、発光輝度の抑制具合をより細かく切り替えられるようにしてもよい。   Further, in the second embodiment of the present invention, the configuration in which the impedances of the power clamp switch and the ground clamp switch are switched in two stages has been described. However, the present invention is not limited to this configuration, and the impedance is divided into three stages or more. A power clamp switch and a ground clamp switch may be configured so as to be switched, and the suppression of the emission luminance may be switched more finely.

また、本発明の実施の形態2は、電源クランプスイッチおよび接地クランプスイッチを構成するスイッチング素子S5、S5、S6、S6、S7、S7、S8およびS8の全てを使用してインピーダンスの切り替えを行う構成に限定されるものではなく、それらスイッチング素子の一部、例えばスイッチング素子S5およびS5だけを使用した構成や、スイッチング素子S5、S5、S8およびS8を使用した構成にする等してインピーダンスの切り替えを行ってもよい。 Further, the second embodiment of the present invention uses all of the switching elements S5 1 , S5 2 , S6 1 , S6 2 , S7 1 , S7 2 , S8 1 and S8 2 constituting the power clamp switch and the ground clamp switch. is not limited to the configuration to switch the impedance and, some of them switching element, for example, a configuration in which using only the switching element S5 1 and S5 2, the switching element S5 1, S5 2, S8 1 and S8 2 may be performed to switch the impedance equal to configurations using.

(実施の形態3)
本発明の実施の形態1では、図1に示したように、電力回収部におけるLC共振用のコイルをコイルL1だけで構成した例を説明した。しかし、本発明の実施の形態はこの構成に限定されるものではなく、例えば、電力の回収時と供給時とで共振周波数を変えるために電力回収部のコイルを2つに分けた構成にも適用することが可能である。本発明の実施の形態3では、この構成の一例について説明する。
(Embodiment 3)
In the first embodiment of the present invention, as shown in FIG. 1, the example in which the coil for LC resonance in the power recovery unit is configured only by the coil L1 has been described. However, the embodiment of the present invention is not limited to this configuration. For example, in order to change the resonance frequency between when power is recovered and when it is supplied, the coil of the power recovery unit is divided into two. It is possible to apply. In the third embodiment of the present invention, an example of this configuration will be described.

図3は、本発明の実施の形態3におけるPDP駆動回路の回路図である。なお、本実施の形態におけるPDP駆動回路が実施の形態1に示したPDP駆動回路と異なる主な部分は、維持パルス発生回路の構成であるので、ここではその異なる主な部分を中心に説明を行う。   FIG. 3 is a circuit diagram of a PDP drive circuit according to Embodiment 3 of the present invention. Note that the main part of the PDP drive circuit in this embodiment that is different from the PDP drive circuit shown in Embodiment 1 is the configuration of the sustain pulse generation circuit, and therefore, here, the description will focus on the different main parts. Do.

図3に示すとおり、本発明の実施の形態3におけるPDP駆動回路は、電力回収回路を備えた走査電極駆動回路503および維持パルス発生回路61を備え、走査電極駆動回路503は、維持パルス発生回路513と初期化波形発生回路52と走査パルス発生回路53とスイッチング素子S9からなるスイッチ回路とを有している。   As shown in FIG. 3, the PDP drive circuit according to the third embodiment of the present invention includes scan electrode drive circuit 503 having a power recovery circuit and sustain pulse generation circuit 61, and scan electrode drive circuit 503 has a sustain pulse generation circuit. 513, an initialization waveform generation circuit 52, a scan pulse generation circuit 53, and a switch circuit including a switching element S9.

維持パルス発生回路513は、電圧値Vsusの定電圧電源V1と電力回収部と電圧クランプ部とからなり、電圧クランプ部は、電源クランプスイッチであるスイッチング素子S5と、接地クランプスイッチであるスイッチング素子S6とを備えている。また、電力回収部は、電力供給コイルであるコイルL1Aと、電力回収コイルであるコイルL1Bと、回収コンデンサC1と、スイッチング素子S1、S2と、逆流防止用ダイオードD1、D2とを備えている。この構成により、PDP10の容量性負荷から回収コンデンサC1へ回収される電力はコイルL1Bを通過し、回収コンデンサC1からPDP10の容量性負荷へ供給される電力はコイルL1Aを通過するので、維持パルス発生回路513では、電力の回収時と供給時とで共振周波数を変えての駆動が可能である。さらに、維持パルス発生回路513は、互いに並列に接続されかつコイルL1Aとの接点を間に挟んでスイッチング素子S5に直列に接続されボディダイオードが定電圧電源V1へ流れ込む電流を遮断する向きに配置されたスイッチング素子S10、S10を備えている。 The sustain pulse generation circuit 513 includes a constant voltage power source V1 having a voltage value Vsus, a power recovery unit, and a voltage clamp unit. The voltage clamp unit includes a switching element S5 that is a power clamp switch and a switching element S6 that is a ground clamp switch. And. The power recovery unit includes a coil L1A that is a power supply coil, a coil L1B that is a power recovery coil, a recovery capacitor C1, switching elements S1 and S2, and backflow prevention diodes D1 and D2. With this configuration, power recovered from the capacitive load of the PDP 10 to the recovery capacitor C1 passes through the coil L1B, and power supplied from the recovery capacitor C1 to the capacitive load of the PDP 10 passes through the coil L1A. The circuit 513 can be driven by changing the resonance frequency between when power is recovered and when it is supplied. Further, sustain pulse generating circuit 513 is connected in parallel to each other and is connected in series with switching element S5 with a contact with coil L1A interposed therebetween, and is arranged in such a direction as to cut off the current that the body diode flows into constant voltage power supply V1. and a switching element S10 1, S10 2 was.

また、維持パルス発生回路513と初期化波形発生回路52との間の主放電経路上には、ボディダイオードが維持パルス発生回路513から初期化波形発生回路52へ流れる電流を遮断する向きに配置されたスイッチング素子S9からなるスイッチ回路が挿入されている。そして、スイッチング素子S6のボディダイオードが主放電経路から接地電位へ流れ込む電流を遮断する向きに、スイッチング素子S2のボディダイオードが回収コンデンサC1へ流れ込む電流を遮断する向きにそれぞれ配置されているので、スイッチング素子S2、S6、S9、S10およびS10を同時にオフにすれば、維持パルス発生回路513から初期化波形発生回路52へ流れる電流と、初期化波形発生回路52から維持パルス発生回路513へ流れる電流とのいずれの電流も遮断することができ、維持パルス発生回路513を初期化波形発生回路52から電気的に分離することが可能となる。 On the main discharge path between sustain pulse generation circuit 513 and initialization waveform generation circuit 52, the body diode is arranged in a direction to block the current flowing from sustain pulse generation circuit 513 to initialization waveform generation circuit 52. A switching circuit composed of the switching element S9 is inserted. Since the body diode of the switching element S6 is arranged so as to cut off the current flowing from the main discharge path to the ground potential, and the body diode of the switching element S2 is arranged so as to cut off the current flowing into the recovery capacitor C1, respectively. if element S2, S6, S9, S10 1 and S10 2 off simultaneously, the current flowing from the sustain pulse generating circuit 513 to the reset waveform generation circuit 52, flows from the initialization waveform generating circuit 52 to the sustain pulse generating circuit 513 Any of the currents can be cut off, and sustain pulse generation circuit 513 can be electrically isolated from initialization waveform generation circuit 52.

そして、スイッチング素子S10、S10はそれぞれ独立してオン/オフの制御が可能であり、スイッチング素子S10だけをオンにした場合とスイッチング素子S10、S10をオンにした場合とで、放電経路におけるインピーダンスが異なるように構成されている。 The switching elements S10 1 and S10 2 can be independently turned on / off, and when only the switching element S10 1 is turned on and when the switching elements S10 1 and S10 2 are turned on, It is comprised so that the impedance in a discharge path may differ.

すなわち、本発明の実施の形態3においては、通常の画像を表示させるときにはスイッチング素子S10、S10をオンにして放電経路におけるインピーダンスを小さくし、明るさを抑えた画像を表示させるときにはスイッチング素子S10だけをオンにして放電経路におけるインピーダンスを大きくして、維持パルス発生回路513に走査電極SC〜SCの駆動を行わせる。 That is, in the third embodiment of the present invention, when displaying a normal image, the switching elements S10 1 and S10 2 are turned on to reduce the impedance in the discharge path, and when displaying an image with reduced brightness, the switching element S10 by increasing the impedance at 1 only is turned on discharge path, thereby to sustain pulse generating circuit 513 perform the driving of the scan electrodes SC 1 to SC n.

これにより、スイッチング素子S10だけをオンにしたときには、スイッチング素子S10、S10をオンにしたときよりも放電経路におけるインピーダンスが大きくなるので、放電セルでの維持放電における放電電流を制限して発光輝度を下げ、明るさを抑えた画像を表示することが可能となる。 Thus, when you turn on only the switching element S10 1, since the impedance becomes large in the discharge path than when you turn on the switching element S10 1, S10 2, to limit the discharge current in the sustain discharge in the discharge cells It is possible to display an image with reduced brightness and reduced brightness.

このように、本発明の実施の形態3によれば、電力の回収時と供給時とで共振周波数を変えるために電力回収部のコイルを2つに分けた維持パルス発生回路513において、維持パルス発生回路513を初期化波形発生回路52から電気的に分離するために、ボディダイオードが定電圧電源V1へ流れ込む電流を遮断する向きに配置した複数のスイッチング素子を並列に接続するとともにコイルL1との接点を間に挟んでスイッチング素子S5に直列に接続して設ける。そして、オンさせるスイッチング素子の組み合わせによって放電経路におけるインピーダンスを切り替えられるように構成する。そして、画像を明るく表示させたい場合には、並列に接続された複数のスイッチング素子を全てオンさせることによって放電経路におけるインピーダンスを下げ、放電電流に制限を加えずに放電セルでの維持放電を発生させる。また、輝度を抑えて画像を表示させたい場合には、並列に接続された複数のスイッチング素子を選択的にオンさせることによって放電経路におけるインピーダンスを上げ、放電電流を制限した維持放電を発生させて発光輝度を下げる。これにより、階調性を損なうことなく輝度を抑えた画像を表示することが可能となり、例えば暗いシーンの多い映画を視聴する場合やプラズマディスプレイ装置の周囲を暗くして視聴する場合等において、明るさを抑えた黒の締まった画像を階調性を損なうことなく表示させることができるようになる。   As described above, according to the third embodiment of the present invention, the sustain pulse is generated in the sustain pulse generation circuit 513 in which the coil of the power recovery unit is divided into two to change the resonance frequency between when the power is recovered and when the power is recovered. In order to electrically isolate the generation circuit 513 from the initialization waveform generation circuit 52, a plurality of switching elements arranged in a direction to block the current flowing into the constant voltage power source V1 by the body diode are connected in parallel and connected to the coil L1. Provided in series with the switching element S5 with the contacts in between. And it is comprised so that the impedance in a discharge path can be switched by the combination of the switching element to turn on. If you want to display an image brightly, turn on all of the switching elements connected in parallel to lower the impedance in the discharge path, and generate a sustain discharge in the discharge cell without limiting the discharge current. Let If you want to display images with reduced brightness, you can selectively turn on multiple switching elements connected in parallel to increase the impedance in the discharge path and generate a sustain discharge that limits the discharge current. Reduce the brightness. As a result, it is possible to display an image with reduced brightness without impairing the gradation, for example, when viewing a movie with many dark scenes or viewing with a dark surrounding of the plasma display device. This makes it possible to display a black-tight image with reduced roughness without impairing the gradation.

なお、本発明の実施の形態3では、オンにするスイッチング素子S10、S10の組み合わせによって放電経路におけるインピーダンスを2段階で切り替える構成を説明したが、何らこの構成に限定するものではなく、インピーダンスを3段階、あるいはそれ以上で切り替えられるように複数のスイッチング素子によって構成し、発光輝度の抑制具合をより細かく切り替えられるようにしてもよい。 In the third embodiment of the present invention, the configuration in which the impedance in the discharge path is switched in two stages by the combination of the switching elements S10 1 and S10 2 to be turned on is not limited to this configuration. May be configured by a plurality of switching elements so as to be switched in three stages or more so that the degree of suppression of light emission luminance can be switched more finely.

また、本発明の実施の形態3では、スイッチング素子S10、S10を並列に接続した構成を説明したが、例えばスイッチング素子S10に代えてダイオードD10を用い、スイッチング素子S10とダイオードD10とを並列に接続する構成であっても同様の効果を得ることができる。 Further, in Embodiment 3 of the present invention has been described a configuration of connecting the switching element S10 1, S10 2 in parallel, for example, a diode D10 in place of the switching element S10 2, the switching element S10 1 and the diode D10 The same effect can be obtained even in a configuration in which the two are connected in parallel.

図4は、本発明の実施の形態3におけるPDP駆動回路の他の例の回路図である。図4に示したPDP駆動回路は、電力回収回路を備えた走査電極駆動回路504および維持パルス発生回路61を備え、走査電極駆動回路504は、維持パルス発生回路514と初期化波形発生回路52と走査パルス発生回路53とスイッチング素子S9からなるスイッチ回路とを有している。図4に示すPDP駆動回路が図3に示したPDP駆動回路と異なる部分は、維持パルス発生回路514において、維持パルス発生回路513のスイッチング素子S10に代えてダイオードD10を設けた点である。このとき、ダイオードD10はスイッチング素子S10のボディダイオードと同様に定電圧電源V1へ流れ込む電流を遮断する向きに配置する。これにより、初期化期間および書込み期間においては、スイッチング素子S10をオフにすることで定電圧電源V1へ流れ込む電流を遮断することができる。そして、維持期間においては、スイッチング素子S10をオフにすると、コイルL1Aからスイッチング素子S9までのインピーダンスがダイオードD10とスイッチング素子S10のボディダイオードとによる合成インピーダンスになり、スイッチング素子S10をオンにした場合よりもインピーダンスを大きくすることができる。これにより、上述と同様の効果を得ることができる。 FIG. 4 is a circuit diagram of another example of the PDP drive circuit according to Embodiment 3 of the present invention. The PDP drive circuit shown in FIG. 4 includes a scan electrode drive circuit 504 including a power recovery circuit and a sustain pulse generation circuit 61. The scan electrode drive circuit 504 includes a sustain pulse generation circuit 514, an initialization waveform generation circuit 52, It has a scan pulse generation circuit 53 and a switch circuit composed of a switching element S9. PDP drive circuit and different parts shown in the PDP driving circuit 3 shown in FIG. 4, in the sustain pulse generating circuit 514, in that a diode D10 in place of the switching element S10 2 of sustain pulse generating circuit 513. At this time, the diode D10 is disposed in a direction to shut off the current flowing to the body diode as well as the constant-voltage power supply V1 of the switching element S10 1. Thus, in the initialization period and the write period, it is possible to interrupt a current by turning off the switching element S10 1 flows into the constant-voltage power supply V1. Then, in the sustain period, the switching element S10 1 When off, the impedance of the coil L1A to the switching element (S9) is turned combined impedance due to the diode D10 and switching element S10 1 body diode, turn on the switching element S10 1 Impedance can be made larger than that. Thereby, the effect similar to the above can be acquired.

なお、図3、図4では、スイッチング素子S10、S10をそれぞれ1つのスイッチング素子として示し、ダイオードD10を1つのダイオードとして示しているが、これは図面を見やすくするために便宜上それぞれを1つの素子として示したに過ぎず、使用する素子の定格や駆動時に流れる最大電流等にもとづきそれぞれを最適な素子数で構成することが望ましい。 3 and 4, each of the switching elements S10 1 and S10 2 is shown as one switching element, and the diode D10 is shown as one diode. However, for the sake of clarity, each of the switching elements S10 1 and S10 2 is shown as one switching element. It is only shown as an element, and it is desirable to configure each with an optimum number of elements based on the rating of the element to be used, the maximum current that flows during driving, and the like.

また、本発明の実施の形態3では、スイッチング素子S9において、実施の形態1に示したように互いに並列に接続された複数のスイッチング素子によってスイッチング素子S9を形成し、オンにするスイッチング素子の組み合わせによってインピーダンスを切り替えるようにした構成をさらに加えてもよい。   Further, in the third embodiment of the present invention, in the switching element S9, the switching element S9 is formed by a plurality of switching elements connected in parallel to each other as shown in the first embodiment, and the combination of switching elements to be turned on A configuration in which the impedance is switched by the above may be further added.

なお、本発明の実施の形態1から実施の形態3においては、走査パルス発生回路53におけるScanICであるIC31およびスイッチング素子S31、S32を選択的に導通させることで維持パルスの通過経路を変更し、それにより放電経路におけるインピーダンスを切り替える構成とすることもできる。図5は、本発明の実施の形態における走査パルス発生回路53の回路図である。図5に示すように、IC31の内部はスイッチング素子S41、S42が直列に接続されて構成されており、スイッチング素子S41の他端がスイッチング素子S31とS32との接続点に接続され、スイッチング素子S42の他端は主放電経路に接続されている。そして、スイッチング素子S41とS42との接続点がPDP10の電極、すなわち走査電極SC〜SCに接続されている。また、スイッチング素子S41はそのボディダイオードがスイッチング素子S31、S32を介しての電流が走査電極SC〜SCへ流れるのを遮断する向きに、スイッチング素子S42はそのボディダイオードが走査電極SC〜SCから主放電経路に流れる電流を遮断する向きに配置されており、スイッチング素子S41、S42を切り替えてオンにすることで、スイッチング素子S31またはS32を介してくる電力と主放電経路から流れてくる電力とを切り替えて走査電極SC〜SCへ供給することができる。このような構成において、スイッチング素子S31、S32、S41およびS42を切り替えてオンにすることにより維持パルスの通過経路を変更させ、維持パルスが通過するスイッチング素子の数を変えることで維持パルス発生回路から走査電極SC〜SCまでのインピーダンスを変更することができる。 In the first to third embodiments of the present invention, the sustain pulse passage path is changed by selectively conducting the IC 31 and the switching elements S31 and S32 which are Scan ICs in the scan pulse generation circuit 53, and Thereby, it can also be set as the structure which switches the impedance in a discharge path | route. FIG. 5 is a circuit diagram of scan pulse generation circuit 53 in the embodiment of the present invention. As shown in FIG. 5, the inside of the IC 31 is configured by connecting switching elements S41 and S42 in series, the other end of the switching element S41 is connected to a connection point between the switching elements S31 and S32, and the switching element S42. Is connected to the main discharge path. The connection point between the switching elements S41 and S42 are PDP10 electrodes, are connected to the scan electrodes SC 1 to SC n. The switching element S41 is in the direction in which the body diode to shut off the flow current through the switching element S31, S32 is to scan electrodes SC 1 to SC n, the switching element S42 is the body diode scan electrodes SC 1 ~ It is arranged in such a direction as to cut off the current flowing from SCn to the main discharge path. By switching on switching elements S41 and S42, power flows from switching element S31 or S32 and flows from the main discharge path. It is possible to supply the scan electrodes SC 1 to SC n by switching the electric power. In such a configuration, the switching element S31, S32, S41 and S42 are switched on to change the sustain pulse passage path, and the number of switching elements through which the sustain pulse passes is changed to change the sustain pulse from the sustain pulse generation circuit. The impedances of scan electrodes SC 1 to SC n can be changed.

例えば、スイッチング素子S42をオンにした場合には、維持パルスが通過する走査パルス発生回路53内のスイッチング素子はスイッチング素子S42だけとなり、そのときのインピーダンスはスイッチング素子S42によるものとなる。また、スイッチング素子S42をオフにすると、主放電経路からスイッチング素子S42のボディダイオードを介して走査電極SC〜SCに電力が供給されるため、そのときのインピーダンスはスイッチング素子S42のボディダイオードによるものとなる。あるいは、スイッチング素子S42をオフにして、スイッチング素子S41をオンにすると、そのときのインピーダンスはスイッチング素子S32またはスイッチング素子S32のボディダイオードとスイッチング素子S41との直列回路によるインピーダンスとスイッチング素子S42のボディダイオードによるインピーダンスとが並列となった合成インピーダンスとなる。このように、維持期間において、走査パルス発生回路53内に設けられた複数のスイッチング素子S31、S32、S41およびS42を選択的にオンにすることで、維持パルスが通過する経路を変更させ、それにより放電経路におけるインピーダンスを可変とすることができる。 For example, when the switching element S42 is turned on, the switching element in the scan pulse generation circuit 53 through which the sustain pulse passes is only the switching element S42, and the impedance at that time is due to the switching element S42. Also, turning off the switching element S42, according to the main discharge path for power through the body diode in the scan electrodes SC 1 to SC n switching element S42 is supplied from the impedance at that time the body diode of the switching element S42 It will be a thing. Alternatively, when the switching element S42 is turned off and the switching element S41 is turned on, the impedance at that time is the impedance of the switching element S32 or the series circuit of the body diode of the switching element S32 and the switching element S41 and the body diode of the switching element S42. The combined impedance is parallel to the impedance due to. Thus, in the sustain period, by selectively turning on the plurality of switching elements S31, S32, S41, and S42 provided in the scan pulse generation circuit 53, the path through which the sustain pulse passes is changed. Thus, the impedance in the discharge path can be made variable.

なお、図5では、スイッチング素子S31、S32、S41およびS42をそれぞれ1つのスイッチング素子として示しているが、これは図面を見やすくするために便宜上それぞれを1つのスイッチング素子として示したに過ぎず、使用するスイッチング素子の定格や駆動時に流れる最大電流等にもとづきそれぞれのスイッチング素子を最適な素子数で構成することが望ましい。   In FIG. 5, each of the switching elements S31, S32, S41, and S42 is shown as one switching element. However, this is only shown as one switching element for convenience in order to make the drawing easy to see. It is desirable to configure each switching element with an optimum number of elements based on the rating of the switching element to be operated and the maximum current that flows during driving.

また、図5では、スイッチング素子S31とスイッチング素子S41とを接続する配線上に抵抗が挿入されていない例を示しているが、何らこの構成に限定されるものではなく、例えばそこに抵抗を挿入する等して、インピーダンスの可変幅をさらに大きくするような構成としてもよい。   FIG. 5 shows an example in which no resistor is inserted on the wiring connecting the switching element S31 and the switching element S41. However, the present invention is not limited to this configuration. For example, a resistor is inserted there. For example, the variable width of the impedance may be further increased.

また、本発明の実施の形態1から実施の形態3においては、走査電極駆動回路および維持電極駆動回路にそれぞれ維持パルス発生回路を備え、走査電極SC〜SCおよび維持電極SU〜SUに交互に維持パルスを印加して維持放電を発生させる構成を説明した。しかし、何らこの構成に限定されるものではなく、例えば、走査電極SC〜SCだけに維持パルスを印加して維持放電を発生させるような回路構成であっても、本発明の実施の形態1から実施の形態3に示したインピーダンスを可変させるための構成を適用することが可能である。 In the third embodiment from the first embodiment of the present invention, each includes a sustain pulse generating circuit to the scanning electrode driving circuit and the sustain electrode driving circuit, the scan electrodes SC 1 to SC n and sustain electrodes SU 1 to SU n In the above description, the sustain pulse is alternately applied to generate the sustain discharge. However, the present invention is not limited to this configuration. For example, even in a circuit configuration in which a sustain pulse is applied only to scan electrodes SC 1 to SC n to generate a sustain discharge, the embodiment of the present invention is not limited. It is possible to apply the configuration for varying the impedance shown in the first to third embodiments.

図6は、本発明の実施の形態1におけるPDP駆動回路の他の一例を示した回路図である。図6に示すPDP駆動回路は、走査電極駆動回路506を備え、走査電極駆動回路506は、維持パルス発生回路516と初期化波形発生回路52と走査パルス発生回路53とスイッチング素子S9、S9、S10、S10からなるスイッチ回路とを有している。なお、初期化波形発生回路52、走査パルス発生回路53およびスイッチ回路は、図1に示したPDP駆動回路と同様の構成であり同様の動作を行う。 FIG. 6 is a circuit diagram showing another example of the PDP drive circuit according to Embodiment 1 of the present invention. The PDP drive circuit shown in FIG. 6 includes a scan electrode drive circuit 506. The scan electrode drive circuit 506 includes a sustain pulse generation circuit 516, an initialization waveform generation circuit 52, a scan pulse generation circuit 53, and switching elements S9 1 and S9 2. , S10 1 and S10 2 . The initialization waveform generation circuit 52, the scan pulse generation circuit 53, and the switch circuit have the same configuration as the PDP drive circuit shown in FIG. 1 and perform the same operation.

維持パルス発生回路516は、電圧値Vsusの定電圧電源V1と負の電圧値(−Vsus)の定電圧電源V11と電圧クランプ部とからなり、電圧クランプ部は、走査電極SC〜SCを定電圧電源V1の電位にクランプするためのスイッチング素子S5と定電圧電源V11の負の電位にクランプするためのスイッチング素子S6とを備えている。また、図6に示すPDP駆動回路においては、維持電極SU〜SUは接地電位に接続されている。 Sustain pulse generating circuit 516 is composed of a constant-voltage power supply V11 and the voltage clamp portion of the constant-voltage power supply V1 and a negative voltage value of the voltage value Vsus (-Vsus), the voltage clamp unit, the scan electrodes SC 1 to SC n A switching element S5 for clamping to the potential of the constant voltage power supply V1 and a switching element S6 for clamping to the negative potential of the constant voltage power supply V11 are provided. Further, in the PDP driving circuit shown in FIG. 6, the sustain electrodes SU 1 to SU n is connected to the ground potential.

そして、維持パルス発生回路516が発生する電圧値(−Vsus)からVsusの振幅の維持パルスを走査電極SC〜SCに印加することで、走査電極SC〜SCの電位を(−Vsus)からVsusに、あるいはVsusから(−Vsus)に変化させて維持放電を発生させる。 Then, a sustain pulse having an amplitude of Vsus is applied to scan electrodes SC 1 to SC n from the voltage value (−Vsus) generated by sustain pulse generation circuit 516, so that the potentials of scan electrodes SC 1 to SC n are (−Vsus). ) To Vsus or Vsus to (−Vsus) to generate a sustain discharge.

例えば、図6に示したこのような構成であっても、スイッチング素子S9、S9、S10およびS10を選択的にオンにすることで維持パルス発生回路516から走査電極SC〜SCに至るまでのインピーダンスを可変して、放電セルでの維持放電における放電電流を制限して発光輝度を下げるといった同様の効果を得ることができる。 For example, even in such a configuration shown in FIG. 6, by selectively turning on switching elements S9 1 , S9 2 , S10 1 and S10 2 , scan electrodes SC 1 to SC are supplied from sustain pulse generating circuit 516. It is possible to obtain the same effect that the impedance up to n is varied to limit the discharge current in the sustain discharge in the discharge cell to reduce the light emission luminance.

図7は、本発明の実施の形態1におけるPDP駆動回路のさらに他の一例を示した回路図である。図7に示すPDP駆動回路は、図6に示したPDP駆動回路と同様、走査電極駆動回路506を備え、走査電極駆動回路506は、維持パルス発生回路516と初期化波形発生回路52と走査パルス発生回路53とスイッチング素子S9、S9、S10、S10からなるスイッチ回路とを有している。さらに、図7に示すPDP駆動回路では、維持電極SU〜SUと接地電位との間に、並列に接続されたスイッチング素子S11、S11と並列に接続されたスイッチング素子S12、S12とが直列にかつ互いのボディダイオードがバックトゥバック接続となるように接続されて構成されたスイッチ回路が挿入されている。 FIG. 7 is a circuit diagram showing still another example of the PDP drive circuit according to Embodiment 1 of the present invention. Similar to the PDP drive circuit shown in FIG. 6, the PDP drive circuit shown in FIG. 7 includes a scan electrode drive circuit 506. The scan electrode drive circuit 506 includes a sustain pulse generation circuit 516, an initialization waveform generation circuit 52, and a scan pulse. and a switching circuit comprising a generator circuit 53 and the switching element S9 1, S9 2, S10 1 , S10 2. Further, in the PDP driving circuit shown in FIG. 7, the sustain electrodes SU 1 to SU n and between the ground potential, the switching element S11 1 connected in parallel, S11 2 and switching element S12 1 connected in parallel, S12 2 is inserted in series, and a switch circuit configured such that the body diodes are connected in back-to-back connection is inserted.

例えば、図7に示したような構成では、スイッチング素子S11、S11、S12およびS12を選択的にオンにすることで維持電極SU〜SUと接地電位との間のインピーダンスを可変することができるので、維持パルス発生回路516による走査電極SC〜SCの駆動の際のインピーダンスの可変幅をさらに大きくすることも可能である。なお、PDP10と接地電位とを接続する回路構成は、図7のようにスイッチング素子S11、S11、S12およびS12をバックトゥバック接続となるようにしたものに限らない。本発明は回路構成に限定されるものではない。 For example, in the configuration shown in FIG. 7, the impedance between the ground potential and the sustain electrodes SU 1 to SU n by selectively turning on the switching element S11 1, S11 2, S12 1 and S12 2 Since it can be varied, it is possible to further increase the variable width of the impedance when driving sustain electrodes SC 1 to SC n by sustain pulse generation circuit 516. The circuit configuration for connecting the PDP 10 and the ground potential is not limited to the one in which the switching elements S11 1 , S11 2 , S12 1 and S12 2 are connected to each other as shown in FIG. The present invention is not limited to the circuit configuration.

なお、図6および図7では、実施の形態1に示したインピーダンスを可変させるための構成を他の回路例に適用させた例を示したが、実施の形態2および実施の形態3に示したインピーダンスを可変させるための構成を同様に適用することも可能である。また、走査電極SC〜SCを接地電位に接続して維持電極SU〜SUに維持パルスを印加する構成としてもよいことはいうまでもない。 6 and 7 show an example in which the configuration for varying the impedance shown in the first embodiment is applied to another circuit example. However, the configuration shown in the second and third embodiments is shown. It is also possible to apply a configuration for changing the impedance in the same manner. The scanning electrodes SC 1 to SC n that may be used as the configuration for applying a sustain pulse to the sustain electrodes SU 1 to SU n are connected to the ground potential of course.

また、図6および図7の維持パルス発生回路516には、図1に示したコイルL1、ダイオードD1、D2、スイッチング素子S1、S2および回収コンデンサC1によって形成された電力回収回路を記載していないが、同様の電力回収回路を図6および図7に示した維持パルス発生回路516に備えた構成としてもよい。図8は、本発明の実施の形態1におけるPDP駆動回路のさらに他の一例を示した回路図である。図8に示すPDP駆動回路は、走査電極駆動回路508を備え、走査電極駆動回路508は、維持パルス発生回路518と初期化波形発生回路52と走査パルス発生回路53とスイッチング素子S9、S9、S10、S10からなるスイッチ回路とを有している。このとき、例えば図8に示すように、維持パルス発生回路518において回収コンデンサC1を除くコイルL1、ダイオードD1、D2およびスイッチング素子S1、S2によって電力回収回路を形成し、スイッチング素子S1のドレイン端子およびスイッチング素子S2のソース端子を接地電位に直接接続する構成としてもよい。 Further, the sustain pulse generation circuit 516 in FIGS. 6 and 7 does not describe the power recovery circuit formed by the coil L1, the diodes D1 and D2, the switching elements S1 and S2, and the recovery capacitor C1 shown in FIG. However, the same power recovery circuit may be provided in the sustain pulse generation circuit 516 shown in FIGS. FIG. 8 is a circuit diagram showing still another example of the PDP drive circuit according to Embodiment 1 of the present invention. The PDP drive circuit shown in FIG. 8 includes a scan electrode drive circuit 508. The scan electrode drive circuit 508 includes a sustain pulse generation circuit 518, an initialization waveform generation circuit 52, a scan pulse generation circuit 53, and switching elements S9 1 and S9 2. , S10 1 and S10 2 . At this time, for example, as shown in FIG. 8, in the sustain pulse generation circuit 518, a power recovery circuit is formed by the coil L1, the diodes D1, D2 and the switching elements S1, S2 excluding the recovery capacitor C1, and the drain terminal of the switching element S1 and The source terminal of the switching element S2 may be directly connected to the ground potential.

また、本発明の実施の形態においては、実施の形態1から実施の形態3に示した構成の一部あるいは全てを組み合わせた構成とすることも可能であり、それにより、インピーダンスの可変幅をさらに大きくすることも可能である。   In the embodiment of the present invention, it is possible to adopt a configuration in which some or all of the configurations shown in the first to third embodiments are combined, thereby further increasing the variable width of the impedance. It is also possible to enlarge it.

また、本発明の実施の形態1から実施の形態3においては、スイッチング素子の一部あるいは全てを、高電圧動作時にも低損失で制御が簡単であるという特徴を有する一般に知られた絶縁ゲート型バイポーラトランジスタ(IGBT)で構成してもかまわない。なお、IGBTにはその構造上寄生ダイオードが生成されないので、MOSFETに寄生して生成されるボディダイオード相当のダイオードを設けることが望ましい。   Further, in the first to third embodiments of the present invention, a generally known insulated gate type having a feature that a part or all of the switching elements are low loss and easy to control even during high voltage operation. A bipolar transistor (IGBT) may be used. In addition, since a parasitic diode is not generated in the IGBT due to its structure, it is desirable to provide a diode corresponding to a body diode generated parasitically in the MOSFET.

また、本発明の実施の形態1から実施の形態3においては、あるサブフィールドの維持期間と別のサブフィールドの維持期間とで放電経路におけるインピーダンスを切り替える構成であってもよいが、必ずしも1つの維持期間の全てに亘ってインピーダンスを一定にしておく必要はなく、例えば、1つの維持期間の前半と後半とでインピーダンスを切り替える構成や、1つの維持期間において所定の維持パルス数だけインピーダンスを高くし残りの全てをインピーダンスを低くする構成等、維持期間におけるインピーダンスの切り替えの組み合わせについては自由に設定することが可能である。   In the first to third embodiments of the present invention, the impedance in the discharge path may be switched between the sustain period of one subfield and the sustain period of another subfield. There is no need to keep the impedance constant throughout the sustain period. For example, the impedance is switched between the first half and the second half of one sustain period, or the impedance is increased by a predetermined number of sustain pulses in one sustain period. It is possible to freely set a combination of impedance switching in the sustain period, such as a configuration in which all the remaining impedances are lowered.

本発明に係るPDP駆動回路およびプラズマディスプレイ装置によれば、放電経路におけるインピーダンスを制御することによって維持放電の際の放電電流を制御し、それにより階調性を損なうことなく輝度を抑えた画像の表示を行うことができるので、PDP駆動回路およびプラズマディスプレイ装置として有用である。   According to the PDP driving circuit and the plasma display device according to the present invention, the discharge current at the time of the sustain discharge is controlled by controlling the impedance in the discharge path, thereby reducing the luminance without impairing the gradation. Since display can be performed, it is useful as a PDP driving circuit and a plasma display device.

本発明の実施の形態1におけるPDP駆動回路の回路図1 is a circuit diagram of a PDP drive circuit according to Embodiment 1 of the present invention. 本発明の実施の形態2におけるPDP駆動回路の回路図Circuit diagram of the PDP drive circuit in Embodiment 2 of the present invention 本発明の実施の形態3におけるPDP駆動回路の回路図Circuit diagram of the PDP drive circuit in Embodiment 3 of the present invention 本発明の実施の形態3におけるPDP駆動回路の他の例の回路図The circuit diagram of the other example of the PDP drive circuit in Embodiment 3 of this invention 本発明の実施の形態における走査パルス発生回路の回路図Circuit diagram of scan pulse generation circuit in an embodiment of the present invention 本発明の実施の形態1におけるPDP駆動回路の他の一例を示した回路図The circuit diagram which showed another example of the PDP drive circuit in Embodiment 1 of this invention 本発明の実施の形態1におけるPDP駆動回路のさらに他の一例を示した回路図FIG. 5 is a circuit diagram showing still another example of the PDP drive circuit according to Embodiment 1 of the present invention. 本発明の実施の形態1におけるPDP駆動回路のさらに他の一例を示した回路図FIG. 5 is a circuit diagram showing still another example of the PDP drive circuit according to Embodiment 1 of the present invention. PDPの構造を示す斜視図Perspective view showing structure of PDP 同PDPの電極配列図Electrode arrangement of the PDP 同PDPの各電極に印加する各駆動電圧波形を示す図The figure which shows each drive voltage waveform applied to each electrode of the PDP 同PDPを組み込んだプラズマディスプレイ装置の電気的構成を示すブロック図The block diagram which shows the electrical constitution of the plasma display apparatus incorporating the same PDP 電力回収回路を備えた走査電極駆動回路および維持電極駆動回路が備えた維持パルス発生回路の回路図Circuit diagram of scan electrode drive circuit with power recovery circuit and sustain pulse generation circuit with sustain electrode drive circuit

符号の説明Explanation of symbols

1 ADコンバータ
2 映像信号処理回路
3 サブフィールド処理回路
4 データ電極駆動回路
5,501,502,503,504,506,508 走査電極駆動回路
6 維持電極駆動回路
10 プラズマディスプレイパネル(PDP)
20 (ガラス製の)前面板
22 走査電極
23 維持電極
24,33 誘電体層
25 保護層
30 (ガラス製の)背面板
32 データ電極
34 隔壁
35 蛍光体層
51,61,62,511,512,513,514,516,518 維持パルス発生回路
52 初期化波形発生回路
53 走査パルス発生回路
C1,C2 回収コンデンサ
C31 コンデンサ
L1,L2,L1A,L1B コイル
D1,D2,D3,D31,D4,D10 ダイオード
S1,S2,S3,S4,S5,S5,S5,S6,S6,S6,S7,S7,S7,S8,S8,S8,S9,S9,S9,S10,S10,S10,S11,S11,S12,S12,S21,S22,S31,S32,S41,S42 スイッチング素子
V1,V2,V3,V4,V5 定電圧電源
IC31 ScanIC
DESCRIPTION OF SYMBOLS 1 AD converter 2 Video signal processing circuit 3 Subfield processing circuit 4 Data electrode drive circuit 5,501,502,503,504,506,508 Scan electrode drive circuit 6 Sustain electrode drive circuit 10 Plasma display panel (PDP)
20 (made of glass) front plate 22 scan electrode 23 sustain electrode 24, 33 dielectric layer 25 protective layer 30 (made of glass) back plate 32 data electrode 34 partition 35 phosphor layer 51, 61, 62, 511, 512 513, 514, 516, 518 Sustain pulse generation circuit 52 Initialization waveform generation circuit 53 Scan pulse generation circuit C1, C2 Recovery capacitor C31 Capacitor L1, L2, L1A, L1B Coil D1, D2, D3, D31, D4, D10 Diode S1 , S2, S3, S4, S5, S5 1 , S5 2 , S6, S6 1 , S6 2 , S7, S7 1 , S7 2 , S8, S8 1 , S8 2 , S9, S9 1 , S9 2 , S10, S10 1, S10 2, S11 1, S11 2, S12 1, S12 2, S21, S22, S31, S32, S41, S 42 Switching element V1, V2, V3, V4, V5 Constant voltage power supply IC31 ScanIC

Claims (9)

表示電極対を構成する複数の走査電極および維持電極を有するプラズマディスプレイパネルを駆動して前記表示電極対に維持放電を発生させるプラズマディスプレイパネル駆動回路であって、
前記維持放電を発生させるために備えられた回路から前記走査電極または前記維持電極までのインピーダンスを可変とするように構成したこと
を特徴とするプラズマディスプレイパネル駆動回路。
A plasma display panel driving circuit for driving a plasma display panel having a plurality of scan electrodes and sustain electrodes constituting a display electrode pair to generate a sustain discharge in the display electrode pair,
A plasma display panel driving circuit, wherein an impedance from a circuit provided for generating the sustain discharge to the scan electrode or the sustain electrode is variable.
前記プラズマディスプレイパネルの前記走査電極および前記維持電極に、初期化期間、書込み期間および維持期間を有するサブフィールドの各期間においてそれぞれ異なる駆動波形の電圧を印加して前記プラズマディスプレイパネルを駆動するプラズマディスプレイパネル駆動回路であって、
前記走査電極に接続される走査電極駆動回路と、
前記維持電極に接続される維持電極駆動回路とを備え、
前記走査電極駆動回路および前記維持電極駆動回路は、1フィールドを構成する複数のサブフィールドの各維持期間において前記走査電極または前記維持電極に印加する維持パルスを発生させる維持パルス発生回路をそれぞれ有し、
前記維持パルス発生回路から前記走査電極または前記維持電極までのインピーダンスを可変とするように構成したこと
を特徴とする請求項1記載のプラズマディスプレイパネル駆動回路。
A plasma display for driving the plasma display panel by applying voltages having different drive waveforms to the scan electrode and the sustain electrode of the plasma display panel in each period of a subfield having an initialization period, an address period, and a sustain period A panel drive circuit,
A scan electrode driving circuit connected to the scan electrode;
A sustain electrode drive circuit connected to the sustain electrode,
Each of the scan electrode drive circuit and the sustain electrode drive circuit includes a sustain pulse generation circuit that generates a sustain pulse to be applied to the scan electrode or the sustain electrode in each sustain period of a plurality of subfields constituting one field. ,
2. The plasma display panel driving circuit according to claim 1, wherein an impedance from the sustain pulse generating circuit to the scan electrode or the sustain electrode is variable.
前記走査電極駆動回路は、
前記維持パルス発生回路と前記走査電極との間に設けられ前記初期化期間に前記走査電極に印加する初期化波形を発生する初期化波形発生回路と、
前記維持パルス発生回路と前記初期化波形発生回路との間に設けられ前記初期化波形発生回路と前記維持パルス発生回路とを電気的に分離するためのスイッチ回路とをさらに備え、
前記スイッチ回路におけるインピーダンスを可変とすることにより前記維持パルス発生回路から前記走査電極までのインピーダンスを可変とするように構成したこと
を特徴とする請求項2記載のプラズマディスプレイパネル駆動回路。
The scan electrode driving circuit includes:
An initialization waveform generation circuit that is provided between the sustain pulse generation circuit and the scan electrode and generates an initialization waveform applied to the scan electrode in the initialization period;
A switch circuit provided between the sustain pulse generation circuit and the initialization waveform generation circuit for electrically separating the initialization waveform generation circuit and the sustain pulse generation circuit;
3. The plasma display panel drive circuit according to claim 2, wherein the impedance from the sustain pulse generating circuit to the scan electrode is made variable by making the impedance in the switch circuit variable.
前記スイッチ回路は、前記維持パルス発生回路から前記初期化波形発生回路へ流れる電流を遮断することができる並列に接続された複数のスイッチング素子によって構成された第1のスイッチと前記初期化波形発生回路から前記維持パルス発生回路へ流れる電流を遮断することができる並列に接続された複数のスイッチング素子によって構成された第2のスイッチとを有し、
前記第1のスイッチおよび前記第2のスイッチを構成するそれらの複数のスイッチング素子を選択的に導通させることにより前記スイッチ回路におけるインピーダンスを可変とするように構成したこと
を特徴とする請求項3記載のプラズマディスプレイパネル駆動回路。
The switch circuit includes a first switch configured by a plurality of switching elements connected in parallel and capable of interrupting a current flowing from the sustain pulse generation circuit to the initialization waveform generation circuit, and the initialization waveform generation circuit And a second switch configured by a plurality of switching elements connected in parallel capable of interrupting a current flowing from the sustain pulse generation circuit to the sustain pulse generation circuit,
4. The impedance in the switch circuit is made variable by selectively conducting a plurality of switching elements constituting the first switch and the second switch. Plasma display panel drive circuit.
前記維持パルス発生回路は、前記プラズマディスプレイパネルの電極の容量性負荷に蓄積された電力をLC共振によって回収コンデンサに回収しその回収した電力を前記プラズマディスプレイパネルの駆動に再利用する電力回収部と、並列に接続された複数のスイッチング素子によって構成され前記プラズマディスプレイパネルの電極を電源電位にクランプする電源クランプスイッチおよび並列に接続された複数のスイッチング素子によって構成され前記プラズマディスプレイパネルの電極を接地電位にクランプする接地クランプスイッチを有するクランプ部とを備え、
前記電源クランプスイッチおよび前記接地クランプスイッチを構成するそれらの複数のスイッチング素子を選択的に導通させることにより前記電源クランプスイッチおよび前記接地クランプスイッチにおけるインピーダンスを可変させ、それにより前記維持パルス発生回路から前記走査電極または前記維持電極までのインピーダンスを可変とするように構成したこと
を特徴とする請求項2記載のプラズマディスプレイパネル駆動回路。
The sustain pulse generating circuit includes: a power recovery unit that recovers power accumulated in a capacitive load of the electrode of the plasma display panel in a recovery capacitor by LC resonance and reuses the recovered power for driving the plasma display panel; A power clamp switch configured to clamp the electrodes of the plasma display panel to a power supply potential and a plurality of switching elements connected in parallel; and a ground potential to the electrodes of the plasma display panel A clamp portion having a ground clamp switch for clamping to
By selectively conducting the plurality of switching elements constituting the power clamp switch and the ground clamp switch, impedances in the power clamp switch and the ground clamp switch are varied, thereby causing the sustain pulse generating circuit to 3. The plasma display panel driving circuit according to claim 2, wherein the impedance to the scanning electrode or the sustaining electrode is variable.
前記走査電極駆動回路が有する前記維持パルス発生回路は、
前記走査電極の容量性負荷とLC共振させて前記走査電極の容量性負荷に蓄積された電力を回収電力として回収コンデンサに回収する電力回収コイルおよび前記走査電極の容量性負荷とLC共振させて前記回収コンデンサに蓄積された回収電力を供給電力として前記走査電極の容量性負荷に供給する電力供給コイルを有する電力回収部と、
一端が電源電位に接続され前記走査電極を電源電位にクランプする電源クランプスイッチおよび前記走査電極を接地電位にクランプする接地クランプスイッチを有するクランプ部と、
前記電源クランプスイッチの他端に前記電源クランプスイッチと直列に接続され前記電源クランプスイッチを介して前記電源電位へ流れる電流を遮断することができる並列に接続された複数のスイッチング素子によって構成されたスイッチ回路とを備え、
前記スイッチ回路を構成する複数のスイッチング素子を選択的に導通させることにより前記スイッチ回路におけるインピーダンスを可変させ、それにより前記維持パルス発生回路から前記走査電極までのインピーダンスを可変とするように構成したこと
を特徴とする請求項2記載のプラズマディスプレイパネル駆動回路。
The sustain pulse generating circuit included in the scan electrode driving circuit is:
A power recovery coil that recovers the power accumulated in the capacitive load of the scan electrode by LC resonance with the capacitive load of the scan electrode as a recovered power and the LC load with the capacitive load of the scan electrode and the LC load A power recovery unit having a power supply coil for supplying the recovered power accumulated in the recovery capacitor as supply power to the capacitive load of the scan electrode;
A clamp unit having one end connected to a power supply potential, a power supply clamp switch for clamping the scan electrode to the power supply potential, and a ground clamp switch for clamping the scan electrode to the ground potential;
A switch composed of a plurality of switching elements connected in parallel to the other end of the power clamp switch, connected in series with the power clamp switch and capable of interrupting a current flowing to the power supply potential via the power clamp switch With circuit,
The impedance in the switch circuit is made variable by selectively conducting a plurality of switching elements constituting the switch circuit, thereby making the impedance from the sustain pulse generating circuit to the scan electrode variable. The plasma display panel drive circuit according to claim 2, wherein:
前記スイッチ回路を、少なくとも1つのスイッチング素子と前記電源クランプスイッチへ流れる電流を遮断する向きに配置された少なくとも1つのダイオードとを並列に接続して構成したこと
を特徴とする請求項6記載のプラズマディスプレイパネル駆動回路。
7. The plasma according to claim 6, wherein the switch circuit is configured by connecting in parallel at least one switching element and at least one diode arranged in a direction to cut off a current flowing to the power clamp switch. Display panel drive circuit.
前記走査電極駆動回路は、前記書込み期間に前記走査電極に印加する走査パルスを発生する走査パルス発生回路を有し、
前記走査パルス発生回路は、前記書込み期間においては前記走査パルスを発生させるために異なる電圧値の定電圧電源を切り替えて前記走査電極に印加し前記維持期間においては前記維持パルスの通過経路を変更することができる複数のスイッチング素子を有し、前記維持期間において前記複数のスイッチング素子を選択的に導通させることにより前記維持パルスの通過経路を変更させ、それにより前記維持パルス発生回路から前記走査電極までのインピーダンスを可変とするように構成したこと
を特徴とする請求項2記載のプラズマディスプレイパネル駆動回路。
The scan electrode drive circuit has a scan pulse generation circuit that generates a scan pulse to be applied to the scan electrode during the address period,
The scan pulse generation circuit switches a constant voltage power source having a different voltage value to generate the scan pulse in the address period and applies it to the scan electrode, and changes the passage path of the sustain pulse in the sustain period. A plurality of switching elements that can be switched, and selectively switching the plurality of switching elements in the sustain period to change a passage path of the sustain pulse, thereby causing the sustain pulse generation circuit to the scan electrode. 3. The plasma display panel drive circuit according to claim 2, wherein the impedance of the plasma display panel is variable.
第1の基板上に平行に配置されかつ表示電極対を構成する複数の走査電極および維持電極と、放電空間を挟んで前記第1の基板に対向配置された第2の基板上に前記走査電極と交差する方向に配置されかつ前記表示電極対とで放電セルを構成する複数のデータ電極とを有するプラズマディスプレイパネルと、
請求項1から請求項8のいずれか1項に記載のプラズマディスプレイパネル駆動回路と
を備えたことを特徴とするプラズマディスプレイ装置。
A plurality of scan electrodes and sustain electrodes arranged in parallel on the first substrate and constituting a display electrode pair, and the scan electrodes on a second substrate arranged opposite to the first substrate across a discharge space A plasma display panel having a plurality of data electrodes arranged in a direction intersecting with each other and forming a discharge cell with the display electrode pair;
A plasma display device comprising the plasma display panel drive circuit according to claim 1.
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