JP2007053519A - 位相誤差検出回路およびpsk復調回路 - Google Patents
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Abstract
【課題】 回路規模の増大を抑制しつつ、搬送波再生における位相誤差を検出する。
【解決手段】 直交成分Qおよび同相成分Iが1ビット化されたベースバンド信号BBX、BBYを1ビットA/Dコンバータ107、108にてそれぞれ生成し、位相誤差検出回路111は、1ビット化されたベースバンド信号BBX、BBYのビットエラーに基づいて、同相成分Iおよび直交成分Qの位相の回転方向を求め、ローパスフィルタ110を介して電圧制御発振器109に入力し、電圧制御発振器109は、同相成分Iおよび直交成分Qの右回りの回転頻度と左回りの回転頻度とが等しくなるように搬送波信号の位相を制御しながら、混合器104およびフェイズシフタ112に搬送波信号を供給する。
【選択図】 図1
【解決手段】 直交成分Qおよび同相成分Iが1ビット化されたベースバンド信号BBX、BBYを1ビットA/Dコンバータ107、108にてそれぞれ生成し、位相誤差検出回路111は、1ビット化されたベースバンド信号BBX、BBYのビットエラーに基づいて、同相成分Iおよび直交成分Qの位相の回転方向を求め、ローパスフィルタ110を介して電圧制御発振器109に入力し、電圧制御発振器109は、同相成分Iおよび直交成分Qの右回りの回転頻度と左回りの回転頻度とが等しくなるように搬送波信号の位相を制御しながら、混合器104およびフェイズシフタ112に搬送波信号を供給する。
【選択図】 図1
Description
本発明は位相誤差検出回路およびPSK復調回路に関し、特に、ビットエラーレートに基づいて位相誤差を検出する方法に適用して好適なものである。
PSK(Phase Shift Keying)復調における主要な技術の1つに搬送波再生がある。この搬送波再生では、PSK変調器にて送信された信号から搬送波を再生し、送信信号を復調する技術である。搬送波を再生するためには、受信された信号と受信機のローカル信号との位相誤差を検出する必要がある。
また、例えば、特許文献1には、直交復調された同相信号Iおよび直交信号Qから、マッピングされた位相点をROMテーブルを参照することによって求め、変調方式によりその後の演算(剰余算と減算の値)を変えることにより、位相誤差を検出する方法が開示されている。
特開平10−341264号公報
また、例えば、特許文献1には、直交復調された同相信号Iおよび直交信号Qから、マッピングされた位相点をROMテーブルを参照することによって求め、変調方式によりその後の演算(剰余算と減算の値)を変えることにより、位相誤差を検出する方法が開示されている。
しかしながら、特許文献1に開示された方法では、同相信号Iおよび直交信号Qから位相点を求めるために、同相信号Iおよび直交信号Qを多ビットA/Dコンバータでデジタル信号に変換し、ROMテーブルを参照しながらarctan(Q/I)の演算をする必要がある。このため、多ビットADコンバータと容量の大きなROMが必要となり、回路規模が大きくなるという問題があった。
そこで、本発明の目的は、回路規模の増大を抑制しつつ、搬送波再生における位相誤差を検出することが可能な位相誤差検出回路およびPSK復調回路を提供することである。
上述した課題を解決するために、本発明の一態様に係るPSK復調回路によれば、搬送波信号を生成する搬送波生成手段と、前記搬送波信号の位相をシフトさせながら受信信号に混合することにより、前記受信信号から同相成分および直交成分を抽出する抽出手段と、前記受信信号から抽出された同相成分および直交成分をしきい値と比較することにより、前記同相成分および直交成分をそれぞれ1ビット化する比較手段と、前記1ビット化された同相成分または直交成分のビットエラーに基づいて、前記同相成分および直交成分の位相の回転方向を求める位相誤差検出回路と、前記同相成分および直交成分の右回りの回転頻度と左回りの回転頻度とが等しくなるように前記搬送波信号の位相を制御する位相制御手段とを備えることを特徴とする。
これにより、同相成分または直交成分のビットエラーに基づいて同相成分および直交成分の位相の回転方向を求めることが可能となる。このため、1ビット化された同相成分または直交成分から位相誤差を検出することが可能となり、同相成分または直交成分をデジタル値に変換するための多ビットADコンバータが不要となるとともに、同相成分および直交成分からマッピングされた位相点を算出するためのROMテーブルを設ける必要がなくなり、回路規模の増大を抑制しつつ、搬送波再生を実現することが可能となる。
また、本発明の一態様に係るPSK復調回路によれば、前記受信信号に含まれる同相成分および直交成分がどの象限に属するかを判定する象限判定回路と、前記受信信号のプリアンブル中に含まれるリファレンスデータとの比較結果に基づいて、前記受信信号に含まれる同相成分および直交成分がビットエラーを起こしているかどうかを検出するビットエラー検出回路と、第何象限で同相成分または直交成分のどちらがビットエラーを起こしているかを判定することで、位相の回転方向を求める位相判定回路とを備えることを特徴とする。
これにより、1ビット化された同相成分または直交成分のビットエラーに基づいて、同相成分および直交成分の位相の回転方向を求めることが可能となり、回路規模の増大を抑制しつつ、搬送波再生における位相誤差を検出することが可能となる。
また、本発明の一態様に係るPSK復調回路によれば、位相同期をとる期間の送信電力が小さくなるように制御する送信電力制御手段をさらに備えることを特徴とする。
また、本発明の一態様に係るPSK復調回路によれば、位相同期をとる期間の送信電力が小さくなるように制御する送信電力制御手段をさらに備えることを特徴とする。
これにより、位相同期をとる期間のビットエラーを増大させることが可能となり、同相成分または直交成分のビットエラーに基づいて、搬送波再生における位相誤差を迅速に検出することが可能となる。
また、本発明の一態様に係るPSK復調回路によれば、前記送信電力制御手段は、前記プリアンブル期間中の送信電力を連続的に変化させることを特徴とする。
また、本発明の一態様に係るPSK復調回路によれば、前記送信電力制御手段は、前記プリアンブル期間中の送信電力を連続的に変化させることを特徴とする。
これにより、検出する位相誤差の範囲を変化させることが可能となり、搬送波再生における位相誤差の検出精度を向上させることができる。
また、本発明の一態様に係るPSK復調回路によれば、前記送信電力制御手段は、前記ビットエラーの頻度に基づいて、有線フィードバックにより前記送信電力を制御することを特徴とする。
また、本発明の一態様に係るPSK復調回路によれば、前記送信電力制御手段は、前記ビットエラーの頻度に基づいて、有線フィードバックにより前記送信電力を制御することを特徴とする。
これにより、ビットエラーの頻度が少ない場合においても、位相誤差を迅速に検出することが可能となり、様々の受信環境に対応しつつ、搬送波再生を効率よく行うことができる。
また、本発明の一態様に係る位相誤差検出回路によれば、受信信号に含まれる同相成分または直交成分のビットエラーに基づいて、同相成分および直交成分の位相の回転方向を求めることを特徴とする。
また、本発明の一態様に係る位相誤差検出回路によれば、受信信号に含まれる同相成分または直交成分のビットエラーに基づいて、同相成分および直交成分の位相の回転方向を求めることを特徴とする。
これにより、受信信号に含まれる同相成分および直交成分を多ビットのデジタル値に変換することなく、同相成分および直交成分の位相の回転方向を求めることが可能となる。このため、同相成分または直交成分を多ビットのデジタル値に変換するための多ビットADコンバータが不要となるとともに、同相成分および直交成分からマッピングされた位相点を算出するためのROMテーブルを設ける必要がなくなり、回路規模の増大を抑制しつつ、搬送波再生を実現することが可能となる。
また、本発明の一態様に係る位相誤差検出回路によれば、前記受信信号に含まれる同相成分および直交成分がどの象限に属するかを判定する象限判定回路と、前記受信信号のプリアンブル中に含まれるリファレンスデータとの比較結果に基づいて、前記受信信号に含まれる同相成分および直交成分がビットエラーを起こしているかどうかを検出するビットエラー検出回路と、第何象限で同相成分または直交成分のどちらがビットエラーを起こしているかを判定することで、位相の回転方向を求める位相判定回路とを備えることを特徴とする。
これにより、1ビット化された同相成分または直交成分のビットエラーに基づいて、同相成分および直交成分の位相の回転方向を求めることが可能となり、回路規模の増大を抑制しつつ、搬送波再生における位相誤差を検出することが可能となる。
以下、本発明の実施形態に係る位相誤差検出回路およびPSK復調回路について図面を参照しながら説明する。
図1は、本発明の一実施形態に係るPSK復調回路が提供される無線通信受信機の概略構成を示すブロック図である。
図1において、無線通信受信機には、直交変調された電波を受信するアンテナ101、アンテナ101にて受信され受信信号を増幅するローノイズアンプ102、搬送波信号を生成する電圧制御発振器109、電圧制御発振器109にて生成された搬送波信号の位相をπ/2だけシフトさせるフェイズシフタ112、π/2だけ位相がシフトされた搬送波信号と、ローノイズアンプ102にて増幅された受信信号を混合することにより、受信信号の直交成分Qを復調する混合器103、電圧制御発振器109にて生成された搬送波信号と、ローノイズアンプ102にて増幅された受信信号を混合することにより、受信信号の同相成分Iを復調する混合器104、混合器103にて生成された信号から不要な高域成分を除去するローパスフィルタ105、混合器104にて生成された信号から不要な高域成分を除去するローパスフィルタ106、ローパスフィルタ105にて不要な高域成分が除去された直交成分Qをしきい値と比較することにより、直交成分Qが1ビット化されたベースバンド信号BBXを生成する1ビットA/Dコンバータ107、ローパスフィルタ106にて不要な高域成分が除去された同相成分Iをしきい値と比較することにより、同相成分Iが1ビット化されたベースバンド信号BBYを生成する1ビットA/Dコンバータ108、1ビット化されたベースバンド信号BBX、BBYのビットエラーに基づいて、同相成分Iおよび直交成分Qの位相の回転方向を求める位相誤差検出回路111、位相誤差検出回路111の出力から不要な高域成分を除去するローパスフィルタ110が設けられている。
図1は、本発明の一実施形態に係るPSK復調回路が提供される無線通信受信機の概略構成を示すブロック図である。
図1において、無線通信受信機には、直交変調された電波を受信するアンテナ101、アンテナ101にて受信され受信信号を増幅するローノイズアンプ102、搬送波信号を生成する電圧制御発振器109、電圧制御発振器109にて生成された搬送波信号の位相をπ/2だけシフトさせるフェイズシフタ112、π/2だけ位相がシフトされた搬送波信号と、ローノイズアンプ102にて増幅された受信信号を混合することにより、受信信号の直交成分Qを復調する混合器103、電圧制御発振器109にて生成された搬送波信号と、ローノイズアンプ102にて増幅された受信信号を混合することにより、受信信号の同相成分Iを復調する混合器104、混合器103にて生成された信号から不要な高域成分を除去するローパスフィルタ105、混合器104にて生成された信号から不要な高域成分を除去するローパスフィルタ106、ローパスフィルタ105にて不要な高域成分が除去された直交成分Qをしきい値と比較することにより、直交成分Qが1ビット化されたベースバンド信号BBXを生成する1ビットA/Dコンバータ107、ローパスフィルタ106にて不要な高域成分が除去された同相成分Iをしきい値と比較することにより、同相成分Iが1ビット化されたベースバンド信号BBYを生成する1ビットA/Dコンバータ108、1ビット化されたベースバンド信号BBX、BBYのビットエラーに基づいて、同相成分Iおよび直交成分Qの位相の回転方向を求める位相誤差検出回路111、位相誤差検出回路111の出力から不要な高域成分を除去するローパスフィルタ110が設けられている。
そして、アンテナ101にて受信された電波はローノイズアンプ102で増幅される。そして、電圧制御発振器109にて生成された搬送波信号がローノイズアンプ102にて増幅された受信信号に混合されることにより、受信信号の同相成分Iが復調されるとともに、フェイズシフタ112にてπ/2だけ位相がシフトされた搬送波信号がローノイズアンプ102にて増幅された受信信号に混合されることにより、受信信号の直交成分Qが復調される。
そして、混合器103、104にて生成された信号はローパスフィルタ105、106にて不要な高域成分がそれぞれ除去された後、1ビットA/Dコンバータ107、108にそれぞれ送られる。そして、直交成分Qおよび同相成分Iが1ビット化されたベースバンド信号BBX、BBYが1ビットA/Dコンバータ107、108にてそれぞれ生成され、位相誤差検出回路111に入力される。
そして、位相誤差検出回路111は、1ビット化されたベースバンド信号BBX、BBYのビットエラーに基づいて、同相成分Iおよび直交成分Qの位相の回転方向を求め、ローパスフィルタ110を介して電圧制御発振器109に入力する。そして、電圧制御発振器109は、同相成分Iおよび直交成分Qの右回りの回転頻度と左回りの回転頻度とが等しくなるように搬送波信号の位相を制御しながら、混合器104およびフェイズシフタ112に搬送波信号を供給する。
これにより、1ビット化された同相成分Iまたは直交成分Qから位相誤差を検出することが可能となり、同相成分Iまたは直交成分Qをデジタル値に変換するための多ビットADコンバータが不要となるとともに、同相成分Iおよび直交成分Qからマッピングされた位相点を算出するためのROMテーブルを設ける必要がなくなり、回路規模の増大を抑制しつつ、搬送波再生を実現することが可能となる。
図3は、QPSK受信信号におけるコンスタレーション(同相成分Iおよび直交成分Q)を示す図である。
図3(a)において、QPSK方式では、搬送波の位相変化をπ/2ラジアンおきにすることで、1シンボルで4つの状態、すなわち2ビットの情報伝達が実現される。ここで、受信信号は、理想的な信号点S1〜S4に対してノイズN1〜N4がそれぞれ付加された状態となる。
図3(a)において、QPSK方式では、搬送波の位相変化をπ/2ラジアンおきにすることで、1シンボルで4つの状態、すなわち2ビットの情報伝達が実現される。ここで、受信信号は、理想的な信号点S1〜S4に対してノイズN1〜N4がそれぞれ付加された状態となる。
また、図3(b)において、送受信間で位相オフセットが存在すると、π/4のラインに対して位相角Φだけ信号点S1〜S4が回転する。ここで、1ビット化されたベースバンド信号BBX、BBYがビットエラーを起こしたかどうかを判断することにより、位相角Φの回転方向を判定することができる。例えば、信号点S1が第1象限にあり、信号点S1の直交成分Qにビットエラーが発生したものとすると、信号点S1の位相は右回りの方向にオフセットしていると判断することができる。一方、信号点S1が第1象限にあり、信号点S1の同相成分Iにビットエラーが発生したものとすると、信号点S1の位相は左回りの方向にオフセットしていると判断することができる。
さらに、図3(c)において、プリアンブルの受信期間中では送信電力を下げることにより、信号品質を意図的に劣化させ、ビットエラーを起こし易くすることができる。これにより、ビットエラーを起こす確率を増大させることができ、搬送波を再生させるために必要なビットエラーを短時間で起こさせることができる。
図2は、図1の位相誤差検出回路111の概略構成を示すブロック図である。
図2は、図1の位相誤差検出回路111の概略構成を示すブロック図である。
図2において、位相誤差検出回路111には、受信パケットのプリアンブル中に含まれるリファレンスデータRX、RYの参照結果に基づいて、受信信号に含まれる同相成分Iおよび直交成分Qがどの象限に属するかを判定する象限判定回路121、受信パケットのプリアンブル中に含まれるリファレンスデータRXとの比較結果に基づいて、受信信号に含まれる直交成分Qがビットエラーを起こしているかどうかを検出する排他的論理和回路122、受信パケットのプリアンブル中に含まれるリファレンスデータRYとの比較結果に基づいて、受信信号に含まれる同相成分Iがビットエラーを起こしているかどうかを検出する排他的論理和回路123、第何象限で同相成分Iまたは直交成分Qのどちらがビットエラーを起こしているかを判定することで、π/4のラインに対して位相の右回りのオフセットを検出する判定回路124、第何象限で同相成分Iまたは直交成分Qのどちらがビットエラーを起こしているかを判定することで、π/4のラインに対して位相の左回りのオフセットを検出する判定回路125、π/4のラインに対する右回りのオフセットの頻度を算出する積算回路126、π/4のラインに対する左回りのオフセットの頻度を算出する積算回路127、π/4のラインに対する右回りのオフセットの頻度と左回りのオフセットの頻度とを減算する減算器128、タイミング発生回路130から出力されるタイミングに同期して減算器128による減算結果をサンプリングするサンプルホールド回路129およびサンプルホールド回路129によるサンプリングタイミングおよび積算回路126、127のリセットタイミングを発生させるタイミング発生回路130が設けられている。
そして、位相誤差検出回路111に入力されたベースバンド信号BBX、BBYは排他的論理和回路122、123に送られる。そして、排他的論理和回路122、123にてリファレンスデータRX、RYとそれぞれ排他的論理和をとることにより、ベースバンド信号BBX、BBYがリファレンスデータRX、RYと一致しているかどうかが判定され、その判定結果は判定回路124、125に送られる。また、リファレンスデータRX、RYは象限判定回路121に入力される。そして、象限判定回路121は、リファレンスデータRX、RYを参照することにより、受信信号に含まれる同相成分Iおよび直交成分Qがどの象限に属するかを判定する。
図4は、図2の象限判定回路121の出力値を示す図である。
図4において、リファレンスデータRX、RYが(1,1)の場合、受信信号は第1象限に属すると判定され、象限判定回路121から“1”が出力される。また、リファレンスデータRX、RYが(1,0)の場合、受信信号は第2象限に属すると判定され、象限判定回路121から“2”が出力される。また、リファレンスデータRX、RYが(0,0)の場合、受信信号は第3象限に属すると判定され、象限判定回路121から“3”が出力される。また、リファレンスデータRX、RYが(0,1)の場合、受信信号は第4象限に属すると判定され、象限判定回路121から“4”が出力される。
図4において、リファレンスデータRX、RYが(1,1)の場合、受信信号は第1象限に属すると判定され、象限判定回路121から“1”が出力される。また、リファレンスデータRX、RYが(1,0)の場合、受信信号は第2象限に属すると判定され、象限判定回路121から“2”が出力される。また、リファレンスデータRX、RYが(0,0)の場合、受信信号は第3象限に属すると判定され、象限判定回路121から“3”が出力される。また、リファレンスデータRX、RYが(0,1)の場合、受信信号は第4象限に属すると判定され、象限判定回路121から“4”が出力される。
そして、象限判定回路121による判定結果および判定回路124、125による各判定結果は、判定回路124、125に入力される。そして、判定回路124は、第何象限で同相成分Iまたは直交成分Qのどちらがビットエラーを起こしているかを判定することで、π/4のラインに対して位相の右回りのオフセットの頻度を求める。また、判定回路125は、第何象限で同相成分Iまたは直交成分Qのどちらがビットエラーを起こしているかを判定することで、π/4のラインに対して位相の左回りのオフセットの頻度を求める。
図5(a)は、図2の判定回路124の出力値を示す図、図5(b)は、図2の判定回路125の出力値を示す図である。
図5において、判定回路124では、入力2および入力3が(0,0)の場合、同相成分Iおよび直交成分Qの両方ともビットエラーを起こしておらず、判定不可として“0”を出力する。また、入力2および入力3が(1,1)の場合、同相成分Iおよび直交成分Qの両方ともビットエラーを起こしており、判定不可として“0”を出力する。
図5において、判定回路124では、入力2および入力3が(0,0)の場合、同相成分Iおよび直交成分Qの両方ともビットエラーを起こしておらず、判定不可として“0”を出力する。また、入力2および入力3が(1,1)の場合、同相成分Iおよび直交成分Qの両方ともビットエラーを起こしており、判定不可として“0”を出力する。
また、入力1が“1”で入力2および入力3が(0,1)の場合、第1象限で直交成分Qがビットエラーを起こしているため、位相は右回りの方向にオフセットしているとして“1”を出力する。また、入力1が“1”で入力2および入力3が(1,0)の場合、第1象限で同相成分Iがビットエラーを起こしているため、位相は左回りの方向にオフセットしているとして“0”を出力する。
また、入力1が“2”で入力2および入力3が(0,1)の場合、第2象限で直交成分Qがビットエラーを起こしているため、位相は左回りの方向にオフセットしているとして“0”を出力する。また、入力1が“2”で入力2および入力3が(1,0)の場合、第2象限で同相成分Iがビットエラーを起こしているため、位相は右回りの方向にオフセットしているとして“1”を出力する。
また、入力1が“3”で入力2および入力3が(0,1)の場合、第3象限で直交成分Qがビットエラーを起こしているため、位相は右回りの方向にオフセットしているとして“1”を出力する。また、入力1が“3”で入力2および入力3が(1,0)の場合、第3象限で同相成分Iがビットエラーを起こしているため、位相は左回りの方向にオフセットしているとして“0”を出力する。
また、入力1が“4”で入力2および入力3が(0,1)の場合、第4象限で直交成分Qがビットエラーを起こしているため、位相は左回りの方向にオフセットしているとして“0”を出力する。また、入力1が“4”で入力2および入力3が(1,0)の場合、第4象限で同相成分Iがビットエラーを起こしているため、位相は右回りの方向にオフセットしているとして“1”を出力する。
一方、判定回路125では、入力2および入力3が(0,0)の場合、同相成分Iおよび直交成分Qの両方ともビットエラーを起こしておらず、判定不可として“0”を出力する。また、入力2および入力3が(1,1)の場合、同相成分Iおよび直交成分Qの両方ともビットエラーを起こしており、判定不可として“0”を出力する。
また、入力1が“1”で入力2および入力3が(0,1)の場合、第1象限で直交成分Qがビットエラーを起こしているため、位相は右回りの方向にオフセットしているとして“0”を出力する。また、入力1が“1”で入力2および入力3が(1,0)の場合、第1象限で同相成分Iがビットエラーを起こしているため、位相は左回りの方向にオフセットしているとして“1”を出力する。
また、入力1が“1”で入力2および入力3が(0,1)の場合、第1象限で直交成分Qがビットエラーを起こしているため、位相は右回りの方向にオフセットしているとして“0”を出力する。また、入力1が“1”で入力2および入力3が(1,0)の場合、第1象限で同相成分Iがビットエラーを起こしているため、位相は左回りの方向にオフセットしているとして“1”を出力する。
また、入力1が“2”で入力2および入力3が(0,1)の場合、第2象限で直交成分Qがビットエラーを起こしているため、位相は左回りの方向にオフセットしているとして“1”を出力する。また、入力1が“2”で入力2および入力3が(1,0)の場合、第2象限で同相成分Iがビットエラーを起こしているため、位相は右回りの方向にオフセットしているとして“0”を出力する。
また、入力1が“3”で入力2および入力3が(0,1)の場合、第3象限で直交成分Qがビットエラーを起こしているため、位相は右回りの方向にオフセットしているとして“0”を出力する。また、入力1が“3”で入力2および入力3が(1,0)の場合、第3象限で同相成分Iがビットエラーを起こしているため、位相は左回りの方向にオフセットしているとして“1”を出力する。
また、入力1が“4”で入力2および入力3が(0,1)の場合、第4象限で直交成分Qがビットエラーを起こしているため、位相は左回りの方向にオフセットしているとして“1”を出力する。また、入力1が“4”で入力2および入力3が(1,0)の場合、第4象限で同相成分Iがビットエラーを起こしているため、位相は右回りの方向にオフセットしているとして“0”を出力する。
そして、判定回路124にて位相の右回りのオフセットが検出されると、その検出結果は積算回路126に入力され、位相の右回りのオフセットの頻度が積算回路126にて算出される。また、判定回路125にて位相の左回りのオフセットが検出されると、その検出結果は積算回路127に入力され、位相の左回りのオフセットの頻度が積算回路127にて算出される。
そして、積算回路126にて算出された位相の右回りのオフセットの頻度および積算回路127にて算出された位相の左回りのオフセットの頻度は減算器128に入力され、位相の右回りのオフセットの頻度と位相の左回りのオフセットの頻度とが減算器128にて減算される。そして、減算器128からの出力はサンプルホールド回路129に入力され、タイミング発生回路130にて発生されたサンプリングタイミングに従ってサンプリングされる。
図6(a)はデータのパケット構成を示す図、図6(b)および図6(c)は送信電力を示す図、図6(d)は図2のタイミング発生回路130の出力信号を示す図である。
図6(a)において、受信パケットにはプリアンブルおよびデータが含まれている。そして、プリアンブルにはリファレンスデータRX、RYが含まれ、プリアンブル期間中に位相の調整が行われる。
図6(a)において、受信パケットにはプリアンブルおよびデータが含まれている。そして、プリアンブルにはリファレンスデータRX、RYが含まれ、プリアンブル期間中に位相の調整が行われる。
また、図6(b)において、プリアンブル期間中には送信電力を小さくし、データ期間中には送信電力を通常のレベルに戻すことができる。これにより、位相同期をとる期間のビットエラーを増大させることが可能となり、同相成分Iまたは直交成分Qのビットエラーに基づいて、搬送波再生における位相誤差を迅速に検出することが可能となる。
また、図6(c)において、プリアンブル期間中の送信電力を段階的に変化させることができる。これにより、検出する位相誤差の範囲を変化させることが可能となり、搬送波再生における位相誤差の検出精度を向上させることができる。
また、図6(c)において、プリアンブル期間中の送信電力を段階的に変化させることができる。これにより、検出する位相誤差の範囲を変化させることが可能となり、搬送波再生における位相誤差の検出精度を向上させることができる。
また、図6(d)において、タイミング発生回路130は、サンプルホールド回路129によるサンプリングタイミングおよび積算回路126、127のリセットタイミングを一定の間隔で発生させ、サンプルホールド回路129および積算回路126、127に出力することができる。
なお、送受信機が有線制御ラインを共有する場合、ビットエラーレートに基づいてプリアンブル期間中の送信電力を受信機側から制御するようにしてもよい。すなわち、一定数のビットエラーがプリアンブル期間中に起こらない場合、送信電力を下げるように有線制御ラインにて送信機に通知することにより、ビットエラーレートを増大させることができる。
なお、送受信機が有線制御ラインを共有する場合、ビットエラーレートに基づいてプリアンブル期間中の送信電力を受信機側から制御するようにしてもよい。すなわち、一定数のビットエラーがプリアンブル期間中に起こらない場合、送信電力を下げるように有線制御ラインにて送信機に通知することにより、ビットエラーレートを増大させることができる。
図7は、図1の位相誤差検出回路111のその他の構成例を示すブロック図である。
図7において、図3の位相誤差検出回路111の構成に加え、積算回路126、127の出力を互いに加算する加算器131および一定数のビットエラーがプリアンブル期間中に起こったかどうかを判定する判定回路132が設けられている。
そして、積算回路126にて算出された右回りのオフセットの頻度および積算回路127にて算出された左回りのオフセットの頻度は加算器131に入力され、受信信号のビットエラーの数が加算器131にて算出される。そして、加算器131にて算出されたビットエラーの数は判定回路132に入力され、タイミング発生回路130にて発生されたタイミングに従って一定数のビットエラーがプリアンブル期間中に起こったかどうかが判定される。そして、判定回路132は、一定数のビットエラーがプリアンブル期間中に起こらない場合、送信電力を下げるように制御する送信電力制御信号をPSK送信機に通知する。
図7において、図3の位相誤差検出回路111の構成に加え、積算回路126、127の出力を互いに加算する加算器131および一定数のビットエラーがプリアンブル期間中に起こったかどうかを判定する判定回路132が設けられている。
そして、積算回路126にて算出された右回りのオフセットの頻度および積算回路127にて算出された左回りのオフセットの頻度は加算器131に入力され、受信信号のビットエラーの数が加算器131にて算出される。そして、加算器131にて算出されたビットエラーの数は判定回路132に入力され、タイミング発生回路130にて発生されたタイミングに従って一定数のビットエラーがプリアンブル期間中に起こったかどうかが判定される。そして、判定回路132は、一定数のビットエラーがプリアンブル期間中に起こらない場合、送信電力を下げるように制御する送信電力制御信号をPSK送信機に通知する。
図8は、本発明の一実施形態に係るPSK送信機の概略構成を示すブロック図である。
図8において、PSK送信機には、ベースバンド信号を発生させるベースバンド回路604、局部発振信号を発生させる局部発振器605、局部発振信号にベースバンド信号を混合することにより、ベースバンド信号を無線周波数にアップコンバートする混合器603、混合器603にて生成されたRF(無線周波数)信号を増幅するパワーアンプ602、パワーアンプ602にて増幅されたRF信号を空間に送出するアンテナ601および図7の判定回路132から送られた送信電力制御信号に基づいてパワーアンプ602のゲインを調整する送信電力制御回路606が設けられている。
図8において、PSK送信機には、ベースバンド信号を発生させるベースバンド回路604、局部発振信号を発生させる局部発振器605、局部発振信号にベースバンド信号を混合することにより、ベースバンド信号を無線周波数にアップコンバートする混合器603、混合器603にて生成されたRF(無線周波数)信号を増幅するパワーアンプ602、パワーアンプ602にて増幅されたRF信号を空間に送出するアンテナ601および図7の判定回路132から送られた送信電力制御信号に基づいてパワーアンプ602のゲインを調整する送信電力制御回路606が設けられている。
そして、ベースバンド回路604にて発生されたベースバンド信号は混合器603に送られ、局部発振器605にて生成された局部発振信号と混合されることにより、RF信号が生成される。そして、混合器603にて生成されたRF信号はパワーアンプ602に送られ、一定数のビットエラーがプリアンブル期間中に起こるように増幅された後、アンテナ601を介して空間に放出される。
これにより、一定数のビットエラーがプリアンブル期間中に起こらない場合、送信電力を下げるように有線制御ラインにて送信機に通知することにより、ビットエラーレートを増大させることができ、回路構成の大規模化を抑制しつつ、搬送波を再生させるために必要なビットエラーレートを確保することが可能となる。
101、601 アンテナ、102 ローノイズアンプ、103、104、603 混合器、105、106、110 ローパスフィルタ、107、108 1ビットA/Dコンバータ、109 電圧制御発振器、111 位相誤差検出回路、112 フェイズシフタ、121 象限判定回路、122、123 排他的論理和回路、124、125、132 判定回路、126、127 積算回路、128 減算器、129 サンプルホールド回路、130 タイミング発生回路、131 加算器、602 パワーアンプ、604 ベースバンド回路、605 局部発振器、606 送信電力制御回路
Claims (7)
- 搬送波信号を生成する搬送波生成手段と、
前記搬送波信号の位相をシフトさせながら受信信号に混合することにより、前記受信信号から同相成分および直交成分を抽出する抽出手段と、
前記受信信号から抽出された同相成分および直交成分をしきい値と比較することにより、前記同相成分および直交成分をそれぞれ1ビット化する比較手段と、
前記1ビット化された同相成分または直交成分のビットエラーに基づいて、前記同相成分および直交成分の位相の回転方向を求める位相誤差検出回路と、
前記同相成分および直交成分の右回りの回転頻度と左回りの回転頻度とが等しくなるように前記搬送波信号の位相を制御する位相制御手段とを備えることを特徴とするPSK復調回路。 - 前記受信信号に含まれる同相成分および直交成分がどの象限に属するかを判定する象限判定回路と、
前記受信信号のプリアンブル中に含まれるリファレンスデータとの比較結果に基づいて、前記受信信号に含まれる同相成分および直交成分がビットエラーを起こしているかどうかを検出するビットエラー検出回路と、
第何象限で同相成分または直交成分のどちらがビットエラーを起こしているかを判定することで、位相の回転方向を求める位相判定回路とを備えることを特徴とする請求項1記載のPSK復調回路。 - 位相同期をとる期間の送信電力が小さくなるように制御する送信電力制御手段をさらに備えることを特徴とする請求項1または2記載のPSK復調回路。
- 前記送信電力制御手段は、前記プリアンブル期間中の送信電力を連続的に変化させることを特徴とする請求項3記載のPSK復調回路。
- 前記送信電力制御手段は、前記ビットエラーの頻度に基づいて、有線フィードバックにより前記送信電力を制御することを特徴とする請求項3記載のPSK復調回路。
- 受信信号に含まれる同相成分または直交成分のビットエラーに基づいて、同相成分および直交成分の位相の回転方向を求めることを特徴とする位相誤差検出回路。
- 前記受信信号に含まれる同相成分および直交成分がどの象限に属するかを判定する象限判定回路と、
前記受信信号のプリアンブル中に含まれるリファレンスデータとの比較結果に基づいて、前記受信信号に含まれる同相成分および直交成分がビットエラーを起こしているかどうかを検出するビットエラー検出回路と、
第何象限で同相成分または直交成分のどちらがビットエラーを起こしているかを判定することで、位相の回転方向を求める位相判定回路とを備えることを特徴とする請求項6記載の位相誤差検出回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005236329A JP2007053519A (ja) | 2005-08-17 | 2005-08-17 | 位相誤差検出回路およびpsk復調回路 |
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JP2005236329A JP2007053519A (ja) | 2005-08-17 | 2005-08-17 | 位相誤差検出回路およびpsk復調回路 |
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ID=37917675
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN111579883A (zh) * | 2020-06-01 | 2020-08-25 | 中国科学院国家授时中心 | 一种相位波动测量方法及系统 |
-
2005
- 2005-08-17 JP JP2005236329A patent/JP2007053519A/ja not_active Withdrawn
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