JP2006157630A - Pll回路 - Google Patents
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Abstract
【解決手段】デッドロック検出回路は、クロック信号をカウントするカウンター回路を有し、デッドロック状態で前記カウンター回路が所定数の前記クロック信号をカウントした時に出力する出力信号に応じて、デッドロック検出信号を出力し、前記デッドロック検出信号によりデッドロックが解除される。また、通常動作時にカウンター回路がPLL回路にノイズを与えることがないことを特徴とする。
【選択図】 図2
Description
12 チャージポンプ回路
13 ローパスフィルタ
14 電圧制御発振器
15 分周回路
20 デッドロック検出回路
21 インバータ
22 カウンター回路
23 VCOリセット回路
24 パルスカット回路
25 パワーオンリセット回路
26 フリップフロップ
27 遅延回路
28 OR回路
Claims (7)
- 基準クロック信号と分周クロック信号の位相又は周波数を比較して、分周クロック信号の位相が遅れているか又は進んでいるか、あるいは周波数が低いか又は高いかに応じてUP信号又はDN信号を出力する位相周波数比較器と、
前記UP信号に応じて電流を流出させ、前記DN信号に応じて電流を流入させることにより誤差信号を発生するチャージポンプ回路と、
前記誤差信号を平滑化して制御電圧を出力するローパスフィルタと、
前記制御電圧の高低に応じて周波数が高低に変化する出力クロック信号を発生する電圧制御発振器と、
前記出力クロック信号を所定の分周比で分周して前記分周クロック信号を出力する分周回路と、
デッドロックに陥ったことを検出してデッドロック検出信号を出力するデッドロック検出回路と、を備え、
前記デッドロック検出回路は、クロック信号をカウントするカウンター回路を有し、 デッドロック状態で前記カウンター回路が所定数の前記クロック信号をカウントした時に出力する信号に応じて、デッドロック検出信号を出力し、前記デッドロック検出信号によりデッドロックが解除されることを特徴とするPLL回路。 - 通常動作時に、前記UP信号又は前記DN信号に応じて前記カウンター回路がリセットされることを特徴とする請求項1記載のPLL回路。
- 所定幅以下のパルス幅の、前記UP信号又は前記DN信号をカットするパルスカット回路をさらに備え、前記パルスカット回路の出力信号に応じて前記前記カウンター回路がリセットされることを特徴とする請求項2記載のPLL回路。
- 前記クロック信号が、前記基準クロック信号又は前記基準クロック信号を所定の分周比で分周した信号であることを特徴とする請求項1乃至3のいずれか1項に記載のPLL回路。
- 基準クロック信号と分周クロック信号の位相又は周波数を比較して、分周クロック信号の位相が遅れているか又は進んでいるか、あるいは周波数が低いか又は高いかに応じてUP信号又はDN信号を出力する位相周波数比較器と、
前記UP信号に応じて電流を流出させ、前記DN信号に応じて電流を流入させることにより誤差信号を発生するチャージポンプ回路と、
前記誤差信号を平滑化して制御電圧を出力するローパスフィルタと、
前記制御電圧の高低に応じて周波数が高低に変化する出力クロック信号を発生する電圧制御発振器と、
前記出力クロック信号を所定の分周比で分周して前記分周クロック信号を出力する分周回路と、
デッドロックに陥ったことを検出してデッドロック検出信号を出力するデッドロック検出回路と、を備え、
前記デッドロック検出回路は、クロック信号をカウントするカウンター回路を有し、 前記カウンター回路は、前記UP信号の反転信号又は前記DN信号がリセット信号として入力され、前記カウンター回路が所定数の前記クロック信号をカウントした時に出力する信号に応じて、デッドロックが解除されることを特徴とするPLL回路。 - 所定幅以下のパルス幅の、前記UP信号の反転信号又は前記DN信号をカットするパルスカット回路をさらに備え、前記パルスカット回路の出力信号に応じて前記前記カウンター回路がリセットされることを特徴とする請求項5記載のPLL回路。
- 前記クロック信号が、前記基準クロック信号又は前記基準クロック信号を所定の分周比で分周した信号であることを特徴とする請求項5又は6に記載のPLL回路。
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