JP2006107379A - 情報処理装置及び情報処理方法、並びにコンピュータ・プログラム - Google Patents
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Abstract
【解決手段】 複数の論理アドレスに書き込みが発生したとき、空きページを検索し、可能な限りその空いているページ内にデータの書き込みを行なう。その結果、書き込みページ数を削減することで書き込み時間の削減を行なうようにする。なお、同一ページに入りきらないバイト数の書き込みが必要である場合には、次の空いているページに書き込みを行なうが、このときも同様なアルゴリズムを動作させ、可能な限りそのページに書き込みを行なわせる。
【選択図】 図13
Description
前記メモリにおけるメモリ空間の論理アドレスと物理アドレスの対応関係を管理テーブルを用いて管理するアドレス管理ステップと、
論理アドレスが指定されたメモリへのアクセス要求を受信処理する受信処理ステップと、
指定された論理アドレスに対応する物理アドレスを前記管理テーブル上で探索し、前記メモリ上の該当する物理アドレスにアクセスするメモリ・アクセス制御ステップとを備え、
メモリ・アクセス制御ステップでは、複数の論理アドレスに書き込みが発生したとき、前記管理テーブル上で空きページを検索し、可能な限りその空いているページ内にデータの書き込みを行なうことを特徴とするコンピュータ・プログラムである。
図1には、本発明を適用可能な非接触ICカード通信システムの構成を模式的に示している。
ICカードがリーダ/ライタからデータを受信し、EEPROMから読み出したデータを送信するまでの処理手順は以下の通りとなる。
EEPROM84は、電子マネーなどの価値情報や、ICカードを利用したサービスを実現するためのデータを格納する不揮発性メモリである。この項では、EEPROM84で構成されるメモリ・システムにおける書き込み動作について説明する。
2…ICカード
3…コントローラ
21…ICチップ・モジュール
22…フラッシュ・メモリ
23…変調回路
25…復調回路
26…発振器
27…アンテナ
31…DPU
32…SPU
33…SCC
34…メモリ部
41…ROM部
42…RAM部
51…ICチップ・モジュール
52…コンデンサ
53…ループ・アンテナ
60…アナログ部回路
61…整流器
62…エネルギ監視部
63…過電流保護回路
64…電源電圧制御部
65…参照電圧生成部
66…クロック検出部
67…復調部
68…変調部
80…論理部回路
81…CPU
82…ROM
83…RAM
84…EEPROM
85…SPU
86…暗号処理部
87…CRC論理部
88…I/O部
89…クロックギア
Claims (13)
- ページ単位での消去書き込み可能なメモリへのアクセス動作を行なう情報処理装置であって、
前記メモリにおけるメモリ空間の論理アドレスと物理アドレスの対応関係を管理する管理テーブルと、
論理アドレスが指定されたメモリへのアクセス要求を受信処理する受信処理部と、
指定された論理アドレスに対応する物理アドレスを前記管理テーブル上で探索し、前記メモリ上の該当する物理アドレスにアクセスするメモリ・アクセス制御部とを備え、
メモリ・アクセス制御部は、複数の論理アドレスに書き込みが発生したとき、前記管理テーブル上で空きページを検索し、可能な限りその空いているページ内にデータの書き込みを行なう、
ことを特徴とする情報処理装置。 - 前記受信処理部は、受信信号を受信処理するとともに受信信号から駆動電力を取り出し、受信信号から得られる電力により駆動するとともに受信信号に基づいてメモリへのアクセス動作を行なう、
ことを特徴とする請求項1に記載の情報処理装置。 - 書き込み要求されたデータが同一ページに入りきらないバイト数の書き込みが必要である場合には、前記メモリ・アクセス制御部は、可能な限りそのページに書き込みを行なわせるように、次の空いているページに書き込みを行なう、
ことを特徴とする請求項1に記載の情報処理装置。 - 書き込み要求されたデータの書き込みバイト数がページ・サイズに満たない場合には、前記メモリ・アクセス制御部は、余りのバイト数以下のバイト数が使われているページを見つけ出し、それらのデータを併せて同一ページに書き込みを行なう、
ことを特徴とする請求項1に記載の情報処理装置。 - 前記管理テーブルは、論理アドレスがどの物理アドレスにリンクしているかを示すリンク・テーブルと、物理アドレスがどの論理アドレスからリンクさせられているか示す逆引きテーブルを備える、
ことを特徴とする請求項1に記載の情報処理装置。 - 複数の管理テーブルを備え、
前記メモリ・アクセス制御部は信憑性が高く且つ新しい方の管理テーブルを参照して前記メモリ上の物理アドレスにアクセスする、
ことを特徴とする請求項1に記載の情報処理装置。 - ページ単位での消去書き込み可能なメモリへのアクセス動作を行なう情報処理方法であって、
前記メモリにおけるメモリ空間の論理アドレスと物理アドレスの対応関係を管理テーブルで管理するアドレス管理ステップと、
論理アドレスが指定されたメモリへのアクセス要求を受信処理する受信処理ステップと、
指定された論理アドレスに対応する物理アドレスを前記管理テーブル上で探索し、前記メモリ上の該当する物理アドレスにアクセスするメモリ・アクセス制御ステップとを備え、
メモリ・アクセス制御ステップでは、複数の論理アドレスに書き込みが発生したとき、前記管理テーブル上で空きページを検索し、可能な限りその空いているページ内にデータの書き込みを行なう、
ことを特徴とする情報処理方法。 - 前記受信処理ステップでは、受信信号を受信処理するとともに受信信号から駆動電力を取り出し、受信信号から得られる電力により駆動するとともに受信信号に基づいてメモリへのアクセス動作を行なう、
ことを特徴とする請求項7に記載の情報処理方法。 - 書き込み要求されたデータが同一ページに入りきらないバイト数の書き込みが必要である場合には、前記メモリ・アクセス制御ステップでは、可能な限りそのページに書き込みを行なわせるように、次の空いているページに書き込みを行なう、
ことを特徴とする請求項7に記載の情報処理方法。 - 書き込み要求されたデータの書き込みバイト数がページ・サイズに満たない場合には、前記メモリ・アクセス制御ステップでは、余りのバイト数以下のバイト数が使われているページを見つけ出し、それらのデータを併せて同一ページに書き込みを行なう、
ことを特徴とする請求項7に記載の情報処理方法。 - 前記アドレス管理ステップでは、論理アドレスがどの物理アドレスにリンクしているかを示すリンク・テーブルと、物理アドレスがどの論理アドレスからリンクさせられているか示す逆引きテーブルを管理する、
ことを特徴とする請求項7に記載の情報処理方法。 - 前記アドレス管理ステップでは複数の管理テーブルを管理し、
前記メモリ・アクセス制御ステップでは、信憑性が高く且つ新しい方の管理テーブルを参照して前記メモリ上の物理アドレスにアクセスする、
ことを特徴とする請求項7に記載の情報処理方法。 - ページ単位での消去書き込み可能なメモリへのアクセス動作を行なうための処理をコンピュータ・システム上で実行するようにコンピュータ可読形式で記述されたコンピュータ・プログラムであって、
前記メモリにおけるメモリ空間の論理アドレスと物理アドレスの対応関係を管理テーブルで管理するアドレス管理ステップと、
論理アドレスが指定されたメモリへのアクセス要求を受信処理する受信処理ステップと、
指定された論理アドレスに対応する物理アドレスを前記管理テーブル上で探索し、前記メモリ上の該当する物理アドレスにアクセスするメモリ・アクセス制御ステップとを備え、
メモリ・アクセス制御ステップでは、複数の論理アドレスに書き込みが発生したとき、前記管理テーブル上で空きページを検索し、可能な限りその空いているページ内にデータの書き込みを行なう、
ことを特徴とするコンピュータ・プログラム。
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