JP2005157717A - データ転送方法及びその装置 - Google Patents
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Abstract
【解決手段】 複数のコマンドリスト31〜3nを備え、その一つを用いてCPU1とは独立して制御手段であるアクセス制御部23と実行コマンド部24とが主記憶装置5をDMA制御することによって、CPUが他のコマンドリストにアクセスできる。従って、DMA制御装置が一つの例えばコマンドリスト31に含まれる全コマンドを処理した後には休止時間なしで、直ちにCPUが設定した次の例えばコマンドリスト33を処理できる。
【選択図】 図1
Description
2、2A DMA制御装置
3 コントロールバス
4 メモリバス
5、5A 主記憶装置
10 開始フラグ
11、13、1n エネーブルフラグ
21 制御レジスタ
22 コマンドリストテーブル
23、23A アクセス制御部
24、24A 実行コマンド部
25 ポインタリスト
31、33、3n コマンドリスト
41、43 ポインタ
311、312、313、321、331 コマンド
Claims (10)
- 一つのセントラル・プロセッサ・ユニット(CPU)からダイレクト・メモリ・アクセス(DMA)により所定のコマンドに基づいて記憶装置のデータを転送する方法であって、前記CPUがアクセス可能な複数のコマンドリストを備え、
前記CPUから、データ転送処理中を除く前記コマンドリストにアクセスし、前記コマンドリストのうちの少なくとも一つに転送許可を与えると共に複数の転送許可に対しては所定の順序を指定し、
DMA制御により、前記所定の順序に従い一つのコマンドリストを選択してデータ転送処理中を設定すると共に選択されたコマンドリストに含まれるコマンドに基づいて順次データ転送することを特徴とするデータ転送方法。 - 請求項1に記載のデータ転送方法において、前記所定の順序は前記CPUから転送許可に優先順位として付与され、データ転送を処理するコマンドリストを前記優先順位にしたがって順次選択することを特徴とするデータ転送方法。
- 請求項1に記載のデータ転送方法において、前記コマンドは、転送元で最初にアクセスしてデータを取り出す転送元開始アドレスと、この取り出したデータを転送して格納する転送先開始アドレスと、連続したアドレスに順次転送するデータ数を示す転送サイズとを指定しており、開始アドレスから当該転送サイズに示されるデータ数に対応するアドレスまでのデータを転送することを特徴とするデータ転送方法。
- 請求項1に記載のデータ転送方法において、前記コマンドリストを主記憶装置に備え、前記CPUから受けた転送許可にしたがって前記主記憶装置にアクセスし、転送許可されたコマンドリストから取り出したコマンドに基づいて順次データ転送することを特徴とするデータ転送方法。
- 一つのセントラル・プロセッサ・ユニット(CPU)が選択した一つのコマンドリストにアクセスして一つまたは複数のコマンドを格納し、この格納されたコマンドに基づいてダイレクト・メモリ・アクセス(DMA)によりデータを転送するデータ転送装置において、
前記CPUは、データ転送処理中を除く前記コマンドリストに対して前記コマンドリストに転送許可のエネーブルフラグを設定すると共に前記コマンドを新規または変更して格納する手段と、当該コマンドにしたがったデータ転送を開始させる開始フラグを設定する手段とを備え、
前記データ転送装置は、
データ転送処理中を除く少なくとも一つのコマンドリストに対して、前記CPUにより前記コマンドリストそれぞれに対応する転送許可のエネーブルフラグとデータ転送開始を要求する開始フラグとが設定される制御レジスタと、
データ転送処理中を除く時期に前記CPUによりアクセスされ、少なくとも一つのコマンドを新規または変更して格納する前記コマンドリストを複数で有するコマンドリストテーブルと、
前記開始フラグの設定を受けた際、前記エネーブルフラグの設定されたコマンドリストが複数の場合には所定の順序で、一つのコマンドリストを選択してデータ転送処理中と設定し、選択されたコマンドリストから一つずつのコマンドを受け取ると共に、データ転送対象の記憶装置とアクセスし、受け取った前記コマンドに含まれる信号情報に基づいて転送元アドレスから転送先アドレスへのデータ転送を制御する制御手段と
を備えることを特徴とするデータ転送装置。 - 請求項5に記載のデータ転送装置において、前記CPUのエネーブルフラグを設定する手段は、エネーブルフラグにその優先順位を加えて格納し、前記制御手段はこの優先順位を前記所定の順序とすることを特徴とするデータ転送装置。
- 請求項5に記載のデータ転送装置において、前記コマンドは、転送元で最初にアクセスしてデータを取り出す転送元開始アドレスと、この取り出したデータを転送して格納する転送先開始アドレスと、連続したアドレスに順次転送するデータ数を示す転送サイズとの指定を有しており、前記制御手段は、受け取ったコマンドに基づいて、データ転送対象のアドレスを開始アドレスから連続して順次生成すると共に転送データ数を計数して転送データ数が前記転送サイズの指定数に達した際にデータ転送を終了することを特徴とするデータ転送装置。
- 請求項5に記載のデータ転送装置において、DMA制御装置として前記制御レジスタ、前記コマンドリストテーブル、及び前記制御手段を備え、前記制御レジスタおよび前記コマンドリストテーブルはコントロールバスを介して前記CPUとアクセスする一方、前記制御手段はメモリバスを介して主記憶装置とアクセスすることを特徴とするデータ転送装置。
- 請求項5に記載のデータ転送装置において、前記コマンドリストテーブルは主記憶装置に格納される一方、データ転送装置は前記コマンドリストそれぞれの格納場所をポインタとして有するポインタリストを更に備え、
DMA制御装置として前記制御レジスタ、前記ポインタリスト、及び前記制御手段を備え、かつ
前記制御レジスタ、前記ポインタリスト、および前記コマンドリストテーブルはコントロールバスを介して前記CPUとアクセスし、かつ
前記制御手段は、前記CPUからの前記開始フラグの設定によりメモリバスを介して前記主記憶装置とアクセスし、前記エネーブルフラグを設定された前記ポインタリストにおける対応ポインタの指定を受けて前記主記憶装置から対象となる一つのコマンドリストを選択して取得し、このコマンドリストに含まれるコマンドに基づいて所定のデータ転送を順次制御する
ことを特徴とするデータ転送装置。 - 請求項5に記載のデータ転送装置において、前記制御手段は、
前記開始フラグの設定により前記エネーブルフラグを設定された一つのコマンドリストから選択された一つのコマンドを受け取ると共に、データ転送対象の記憶装置とアクセスし、前記コマンドから受ける信号情報に基づいて転送元アドレスから転送先アドレスへのデータ転送を制御するアクセス制御部と、
開始フラグ及びエネーブルフラグの設定により前記コマンドリストから選択されたコマンドを受け取り、前記アクセス制御部と協同動作して受け取ったコマンドに基づきデータ転送用のアドレスを生成すると共にデータ転送数を照合してデータ転送の終了を通知する実行コマンド部と
を備えることを特徴とするデータ転送装置。
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JP2003394986A JP2005157717A (ja) | 2003-11-26 | 2003-11-26 | データ転送方法及びその装置 |
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2003
- 2003-11-26 JP JP2003394986A patent/JP2005157717A/ja active Pending
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