JP2005071363A - 比較的に小さなアドレス空間からメモリ空間に高速アドレスアクセス(address)するための方法及び装置 - Google Patents
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Abstract
【解決手段】比較的に小さなアドレス空間からメモリ空間に高速アドレスアクセス(address)するための方法及び装置。Nビットバスが2Mアドレスメモリ空間を有するメモリデバイスとのインタフェースをとり、ここでMはNよりも大きい。この方法及び装置は(a)少なくとも2個のレジスタを用意し、(b)メモリ空間内のアドレスを共同定義する複数のNビットバイトのうちの一つのバイトを受け取り、(c)ステップ(b)を完了した結果カウントをインクリメントし、(d)ステップ(c)でインクリメントされたカウントに従って2個のレジスタのうちの一方をアドレス指定(address)し、(e)ステップ(d)でアドレス指定(address)されたレジスタにその一つのバイトを格納することができる。
【選択図】 図5
Description
52: 回路
R1 : レジスタ
R2 : レジスタ
64: 1ビットカウンタ
70、72: 出力バス
62: デマルチプレクサ
68: セレクト出力
26: データバス
22: CPU
3、3': 後続のデータサイクル
60: メモリデバイス
66: Kビットカウンタ
69: デマルチプレクサ
Claims (42)
- Nビットバスを用いて2M個のアドレスを有するメモリ空間に高速アドレスアクセス(address)するための方法であって、ここでMはNよりも大きく、
(a)少なくとも2個のレジスタを用意するステップと、
(b)該メモリ空間内のアドレスを定義する複数のNビットバイトのうちの1つのバイトを受け取るステップと、
(c)ステップ(b)を完了した結果カウントをインクリメントするステップと、
(d)ステップ(c)でインクリメントされたカウントに従って前記2個のレジスタのうちの一つをアドレス指定(address)するステップと、
(e)ステップ(d)でアドレス指定(address)されたレジスタに前記一つのバイトを格納するステップを有することを特徴とする方法。 - 前記複数のバイトのうちのもう一つのバイトを受け取り、ステップ(c)からのカウントをリセットし、カウントのリセットの結果前記2個のレジスタのうちの他方をアドレス指定(address)し、前記他方のレジスタに前記他方のバイトを格納することをさらに有することを特徴とする請求項1に記載の方法。
- (a)メモリアクセスコマンドを受け取るステップと、
(b)前記メモリアクセスコマンドに基づいて前記アドレスにあるメモリ空間にアクセスするステップと、
をさらに有することを特徴とする請求項2に記載の方法。 - 前記メモリアクセスコマンドはデータ書き込みコマンドであることを特徴とする請求項3に記載の方法。
- 前記メモリアクセスコマンドはデータ読み出しコマンドであることを特徴とする請求項3に記載の方法。
- 前記複数のバイトのうちのもう一つのバイトを受け取り、ステップ(c)からのカウントをインクリメントしてインクリメントされた次のカウントを取得し、そのインクリメントされた次のカウントの結果前記2個のレジスタのうちの他方をアドレス指定(address)し、前記他方のレジスタに前記他方のバイトを格納することをさらに有することを特徴とする請求項1に記載の方法。
- (a)メモリアクセスコマンドを受け取るステップと、
(b)前記メモリアクセスコマンドに基づいて前記アドレスにあるメモリ空間にアクセスするステップと、
をさらに有することを特徴とする請求項6に記載の方法。 - 前記メモリアクセスコマンドはデータ書き込みコマンドであることを特徴とする請求項7に記載の方法。
- 前記メモリアクセスコマンドはデータ読み出しコマンドであることを特徴とする請求項7に記載の方法。
- 前記2Mアドレスメモリ空間はメモリデバイスのアドレス空間からなることを特徴とする請求項1に記載の方法。
- 前記2Mアドレスメモリ空間は複数のメモリデバイスのアドレス空間からなることを特徴とする請求項1に記載の方法。
- Nビットバスを用いて2M個のアドレスを有するメモリ空間に高速アドレスアクセス(address)するための装置であって、ここでMはNよりも大きく、
(a)少なくとも2個のレジスタと、
(b)カウンタと、
(c)論理回路とからなり、論理回路は、
(i)メモリ空間内のアドレスを共同定義する複数のNビットバイトのうちの一つのバイトを受け取り、
(ii)ステップ(i)を完了した結果前記カウンタのカウントをインクリメントし、
(iii)ステップ(ii)でインクリメントされたカウントに従って前記2個のレジスタのうちの一方をアドレス指定(address)し、
(iv)ステップ(iii)でアドレス指定(address)された前記レジスタに前記一つのバイトを格納するようになっていることを特徴とする装置。 - 前記論理回路はさらに、前記複数のバイトのうちのもう一つのバイトを受け取り、前記カウンタのカウントをリセットし、そのカウントのリセットの結果前記2個のレジスタのうちの他方をアドレス指定(address)し、前記他方のレジスタに前記他方のバイトを格納するようになっていることを特徴とする請求項12に記載の装置。
- 前記論理回路はさらに、
(a)メモリアクセスコマンドを受け取り、
(b)前記メモリアクセスコマンドに基づいて前記アドレスにあるメモリ空間をアクセスするようになっていることを特徴とする請求項13に記載の装置。 - 前記メモリアクセスコマンドはデータ書き込みコマンドであることを特徴とする請求項14に記載の装置。
- 前記メモリアクセスコマンドはデータ読み出しコマンドであることを特徴とする請求項14に記載の装置。
- 前記論理回路はさらに、前記複数のバイトのうちのもう一つのバイトを受け取り、前記カウンタのカウントをインクリメントしてインクリメントされた次のカウントを取得し、そのインクリメントされた次のカウントの結果前記2個のレジスタのうちの他方をアドレス指定(address)し、前記他方のレジスタに前記他方のバイトを格納するようになっていることを特徴とする請求項12に記載の装置。
- 前記論理回路はさらに、
(a)メモリアクセスコマンドを受け取り、
(b)前記メモリアクセスコマンドに基づいて前記アドレスにあるメモリ空間をアクセスするようになっていることを特徴とする請求項13に記載の装置。 - 前記メモリアクセスコマンドはデータ書き込みコマンドであることを特徴とする請求項18に記載の装置。
- 前記メモリアクセスコマンドはデータ読み出しコマンドであることを特徴とする請求項18に記載の装置。
- 前記2Mアドレスメモリ空間はメモリデバイスのアドレス空間からなることを特徴とする請求項12に記載の装置。
- 前記2Mアドレスメモリ空間は複数のメモリデバイスのアドレス空間からなることを特徴とする請求項12に記載の装置。
- Nビットバスを用いて2M個のアドレスを有するメモリ空間に高速アドレスアクセス(address)するための方法を実行するために機械で実行される命令プログラムを含んだ機械可読媒体であって、該機械は少なくとも2個のレジスタを有し、MはNよりも大きく、該方法は、
(a)メモリ空間内のアドレスを共同定義する複数のNビットバイトのうちの1つのバイトを受け取るステップと、
(b)ステップ(a)を完了した結果カウントをインクリメントするステップと、
(c)ステップ(b)でインクリメントされたカウントに従って該少なくとも2個のレジスタのうちの一つをアドレス指定(address)するステップと、
(d)ステップ(c)でアドレス指定(address)されたレジスタに前記一つのバイトを格納するステップとを有することを特徴とする機械可読媒体。 - 該方法がさらに、前記複数のバイトのうちのもう一つのバイトを受け取り、ステップ(c)からのカウントをリセットし、そのカウントのリセットの結果前記2個のレジスタのうちの他方をアドレス指定(address)し、前記他方のレジスタに前記他方のバイトを格納するように適合されていることを特徴とする請求項23に記載の機械可読媒体。
- 該方法はさらに、
(a)メモリアクセスコマンドを受け取るステップと、
(b)前記メモリアクセスコマンドに基づいて前記アドレスにあるメモリ空間をアクセスするステップとを有するように適合されていることを特徴とする請求項24に記載の機械可読媒体。 - 前記メモリアクセスがデータ書き込みアクセスになるように適合されていることを特徴とする請求項25に記載の機械可読媒体。
- 前記メモリアクセスがデータ読み出しアクセスになるように適合されていることを特徴とする請求項25に記載の機械可読媒体。
- 該方法はさらに、前記複数のバイトのうちのもう一つのバイトを受け取り、ステップ(c)からのカウントをインクリメントしてインクリメントされた次のカウントを取得し、そのインクリメントされた次のカウントの結果前記2個のレジスタのうちの他方をアドレス指定(address)し、それから前記他方のレジスタに前記他方のバイトを格納することからなるように適合されていることを特徴とする請求項23に記載の機械可読媒体。
- (a)メモリアクセスコマンドを受け取るステップと、
(b)前記メモリアクセスコマンドに基づいて前記アドレスにあるメモリ空間にアクセスするステップと、
をさらに有することを特徴とする請求項28に記載の方法。 - 前記メモリアクセスがデータ書き込みアクセスになるように適合されていることを特徴とする請求項29に記載の機械可読媒体。
- 前記メモリアクセスがデータ読み出しアクセスになるように適合されていることを特徴とする請求項29に記載の機械可読媒体。
- 前記2Mアドレスメモリ空間はメモリデバイスのアドレス空間からなることを特徴とする請求項23に記載の機械可読媒体。
- 前記2Mアドレスメモリ空間は複数のメモリデバイスのアドレス空間からなることを特徴とする請求項23に記載の機械可読媒体。
- Nビットバスを用いて2M個のアドレスを有するメモリ空間に高速アドレスアクセス(address)するための方法であって、MはNよりも大きく、
(a)少なくとも2個のレジスタを用意するステップを有し、前記レジスタの各々はメモリ空間内のアドレスを共同定義する複数のNビットバイトのうちの一つを保有し、
(b)メモリアクセスコマンドを受け取るステップを有し、
(c)前記メモリアクセスコマンドの結果前記アドレスにあるメモリ空間にアクセスするステップを有することを特徴とする方法。 - 前記メモリアクセスコマンドはデータ書き込みコマンドであることを特徴とする請求項34に記載の方法。
- 前記メモリアクセスコマンドはデータ読み出しコマンドであることを特徴とする請求項34に記載の方法
- Nビットバスを用いて2M個のアドレスを有するメモリ空間に高速アドレスアクセス(address)するための装置であって、MはNよりも大きく、
(a)少なくとも2個のレジスタを備え、前記レジスタの各々はメモリ空間内のアドレスを共同定義する複数のNビットバイトのうちの一つを保有し、
(b)メモリアクセスコマンドを受け取り、前記メモリアクセスコマンドの結果前記アドレスにあるメモリ空間にアクセスするようになっている論理回路を備えることを特徴とする装置。 - 前記メモリアクセスコマンドはデータ書き込みコマンドであることを特徴とする請求項37に記載の装置。
- 前記メモリアクセスコマンドはデータ読み出しコマンドであることを特徴とする請求項37に記載の装置
- Nビットバスを用いて2M個のアドレスを有するメモリ空間に高速アドレスアクセス(address)するための方法を実行するために機械で実行される命令プログラムを含んだ機械可読媒体であって、MはNよりも大きく、該方法は、
(a)少なくとも2個のレジスタを設けるステップを有し、前記レジスタの各々はメモリ空間内のアドレスを共同定義する複数のNビットバイトのうちの一つを保有し、
(b)メモリアクセスコマンドを受け取るステップを有し、
(c)前記メモリアクセスコマンドの結果前記アドレスにあるメモリ空間にアクセスするステップを有することを特徴とする機械可読媒体。 - 前記方法は前記メモリアクセスコマンドがデータ書き込みコマンドになるように適合されていることを特徴とする請求項40に記載の機械可読媒体。
- 前記方法は前記メモリアクセスコマンドがデータ読み出しコマンドになるように適合されていることを特徴とする請求項40に記載の機械可読媒体。
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