JP2004326739A - Soft start circuit - Google Patents

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明男 莊
Wei Wen Feng
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Abstract

<P>PROBLEM TO BE SOLVED: To provide a soft start circuit which can be manufactured by a capacitor of a relatively small capacity value. <P>SOLUTION: The soft start circuit is equipped with a first current source whose input port is connected to a first voltage; a transistor whose first port is connected to an output port of the first current source and whose second port is connected to a second voltage; and a capacitor one port of which is connected to the output port of the first current source and the other port of which is connected to an input port of the transistor. By coupling the transistor and the capacitor, a ratio value of a soft start voltage generated by the soft start circuit and a time is reduced. Thus, by increasing an equivalent capacity value of the capacitor, the soft start circuit can be manufactured by the capacitor of a relatively small capacity value. <P>COPYRIGHT: (C)2005,JPO&NCIPI

Description

本発明は、ソフト・スタート回路に関し、特に、ソフト・スタート回路の等価容量値を増加して比較的小さい容量値のキャパシタで製作できるようにしたソフト・スタート回路に関する。   The present invention relates to a soft start circuit, and more particularly, to a soft start circuit in which an equivalent capacitance value of a soft start circuit is increased so that the soft start circuit can be manufactured with a capacitor having a relatively small capacitance value.

ソフト・スタート回路の原理は、抵抗容量(RC)の充電回路と制御回路とを使用してカップリングさせ、ロードが電源にオンした瞬間、抵抗容量充電回路を利用して、ロードを流れる電流が比較的緩慢な速度で増加されるように制御し、これによりロードを通過した電流が制御されることにより、緩慢電源でロードにオンした場合に生ずる大電流のロード及びその他カップリング回路に対する傷害を制御できるように図ることにある。   The principle of the soft start circuit is to couple by using a resistance capacitance (RC) charging circuit and a control circuit. At the moment when the load is turned on, the current flowing through the load is utilized by using the resistance capacitance charging circuit. It is controlled to increase at a relatively slow speed, thereby controlling the current passing through the load, thereby preventing a large current load and other damage to the coupling circuit caused when the load is turned on with a slow power supply. The goal is to be able to control it.

従来のソフト・スタート回路は、図1に示すように、固定的な電流源11及びキャパシタ12により組成され、電流源11とキャパシタ12との間の直列節点(Node)Aをソフト・スタート電圧の測量節点としている。
ここで、電流源11の電流をI、直列節点Aのソフト・スタート電圧をV、キャパシタ12の容量値をCとすれば、公式
V(ソフト・スタート)/T=I/C
から分かるように、電流Iが固定値であるので、もしソフト・スタート電圧Vの固定状況において比較的小さいV(ソフト・スタート)/T比を得たいならば、キャパシタ12の容量値を十分に大きな大きさにする必要がある。目前このタイプの回路に適用した常用容量値として、この大きさは常に1nF〜0.1uFの間に介しておるので、このような容量値が対応するキャパシタの体積が一般的な電気器具用品回路に置かれ,且つ、外接キャパシタの方式で活用すれば、勿論問題はないが、この技術を集積回路(Integrated Circuit;IC)に使用すると以下の両種の困難が出現する。
1.上記容量値を有するキャパシタの体積が大き過ぎるために集積回路の製造プロセスに整合できず、集積回路の体積が日増しに縮小された潮流に符合できない。
2.もし、集積回路の製造プロセス・サイズの要求に合うようにキャパシタを作製すると、当該容量値がソフト・スタート回路の保護機能を発揮するには十分でない問題が生ずる。
The conventional soft start circuit is composed of a fixed current source 11 and a capacitor 12, as shown in FIG. 1, and a series node (Node) A between the current source 11 and the capacitor 12 is provided with a soft start voltage. It is a survey node.
Here, if the current of the current source 11 is I, the soft start voltage of the series node A is V, and the capacitance value of the capacitor 12 is C, the formula V (soft start) / T = I / C
As can be seen from the figure, since the current I is a fixed value, if it is desired to obtain a relatively small V (soft start) / T ratio in a fixed state of the soft start voltage V, the capacitance of the capacitor 12 should be sufficiently increased. Must be large. At present, as a normal capacitance value applied to a circuit of this type, since the magnitude is always between 1 nF and 0.1 uF, the volume of the capacitor corresponding to such capacitance value is a general electric appliance part circuit. However, if this technique is used for an integrated circuit (IC), the following two kinds of difficulties will appear if this technique is used for an integrated circuit (IC).
1. Since the volume of the capacitor having the above-mentioned capacitance value is too large, it cannot be matched with the manufacturing process of the integrated circuit, and the volume of the integrated circuit cannot correspond to the tide which is reduced every day.
2. If the capacitor is manufactured to meet the requirements of the manufacturing process size of the integrated circuit, there arises a problem that the capacitance value is not sufficient to exert the protection function of the soft start circuit.

上記問題にかんがみ、本出願人はこれを解決するために、鋭意試験と研究を重ねた結果、ついに本発明の「ソフト・スタート回路」を案出した。   In view of the above problems, the present applicant has conducted intensive tests and researches to solve this problem, and finally has devised the "soft start circuit" of the present invention.

本発明の主たる目的は、ソフト・スタート回路を設計するに当って、その回路の配置方式が該ソフト・スタートより発生したソフト・スタート電圧と時間とのレシオ値を低下することにより、該ソフト・スタート回路に含まれるキャパシタの有効値を増幅することで、ソフト・スタート回路時に比較的小さい容量値(すなわち、比較的小さい体積)のキャパシタで製作できることにある。   A main object of the present invention is to design a soft start circuit by reducing the ratio of the soft start voltage and time generated by the soft start to the soft start voltage. By amplifying the effective value of the capacitor included in the start circuit, a capacitor having a relatively small capacitance value (that is, a relatively small volume) can be manufactured at the time of the soft start circuit.

上記目的を達成するために本発明のソフト・スタート回路は、入力端が第1の電圧に接続された第1の電流源と、第1端が該第1の電流源の出力端に接続され、そして第2端が第2の電圧に接続されたトランジスタと、一端が該第1の電流源の出力端に接続され、他端が該トランジスタの入力端に接続されたキャパシタと、を備えてなるソフト・スタート回路であって、
該トランジスタと該キャパシタとがカップリングして、該ソフト・スタート回路より発生したソフト・スタート電圧と時間とのレシオ値を低下することにより、該キャパシタの等価容量値を増加することで、該ソフト・スタート回路が比較的小さい容量値のキャパシタで製作され得ることを特徴とする(請求項1に対応)。
To achieve the above object, a soft start circuit according to the present invention comprises a first current source having an input terminal connected to a first voltage, and a first terminal connected to an output terminal of the first current source. A transistor having a second end connected to the second voltage, a capacitor having one end connected to the output end of the first current source, and the other end connected to the input end of the transistor. Soft start circuit,
The transistor and the capacitor are coupled, and the ratio of the soft start voltage generated by the soft start circuit to time is reduced, thereby increasing the equivalent capacitance of the capacitor. -The start circuit can be manufactured with a capacitor having a relatively small capacitance value (corresponding to claim 1).

上記本発明に係るソフト・スタート回路において、
該第1の電流源は電流鏡であり、
この電流鏡は2個同一のP型モス電界効果トランジスタ(MOSFET)によりカップリングされてなり、
該電流鏡の入力端は第2の電流源の入力端に接続され、該電流鏡の出力端は該トランジスタの該第1端及び該キャパシタの一端に接続され、該電流鏡の共通ソース端は該第1の電圧に接続され、及び該第2の電流源の出力端は該第2の電圧に接続されてなる(請求項2に対応)。
In the above soft start circuit according to the present invention,
The first current source is a current mirror;
The current mirror is coupled by two identical P-type MOS field effect transistors (MOSFETs),
The input end of the current mirror is connected to the input end of a second current source, the output end of the current mirror is connected to the first end of the transistor and one end of the capacitor, and the common source end of the current mirror is The output terminal of the second current source is connected to the first voltage, and the output terminal of the second current source is connected to the second voltage.

また、上記本発明に係るソフト・スタート回路において、
該第1の電圧は第2の電圧よりも大きく設定され、
該トランジスタはnpn型双極ジャンクション・トランジスタ(BJT)であり、
該トランジスタの該第1端はコレクタ端、該トランジスタの該第2端はエミッタ端、該トランジスタの制御端はベース端であり、及び/又は
該トランジスタはダリントン・トランジスタであり、その中
該ダリントン・トランジスタは第1のnpn型双極ジャンクション・トランジスタ及び第2のnpn型双極ジャンクション・トランジスタをカップリングしてなるものであり、そして該第1のnpn型双極ジャンクション・トランジスタのベース端は該トランジスタの入力端であり、該第1のnpn型双極ジャンクション・トランジスタのエミッタ端は該第2のnpn型双極ジャンクション・トランジスタのベース端に接続され、該第1のnpn型双極ジャンクション・トランジスタのコレクタ端は該第2のnpn型双極ジャンクション・トランジスタのコレクタ端に接続して該トランジスタの第1端が構成され、該第2のnpn型双極ジャンクション・トランジスタのエミッタ端は該トランジスタの第2端である(請求項3に対応)。
In the soft start circuit according to the present invention,
The first voltage is set higher than the second voltage,
The transistor is an npn-type bipolar junction transistor (BJT),
The first end of the transistor is a collector end, the second end of the transistor is an emitter end, the control end of the transistor is a base end, and / or the transistor is a Darlington transistor, wherein the Darlington transistor is The transistor is a coupling of a first npn-type bipolar junction transistor and a second npn-type bipolar junction transistor, and the base end of the first npn-type bipolar junction transistor is connected to the input terminal of the transistor. The emitter end of the first npn-type bipolar junction transistor is connected to the base end of the second npn-type bipolar junction transistor, and the collector end of the first npn-type bipolar junction transistor is connected to the Second npn-type bipolar junction And connected to the collector terminal of the transistor is configured first end of the transistor, the emitter terminal of the npn bipolar junction transistor of the second is the second end of the transistor (corresponding to claim 3).

さらに上記目的を達成するために、本発明に係る他の発明のソフト・スタート回路は、
出力端が第1の電圧に接続されている電流源と、
入力端が該電流源の入力端に接続され、そして共通ソース端が第2の電圧に接続されている第1の電流鏡と、
ソース端が該第2の電圧に接続され、ゲート端が該第1の電流鏡の共通ゲート端に接続されている第1のモス電界効果トランジスタ(MOSFET)と、
ドレーン端が該第1の電流鏡の出力端に接続され、そしてソース端が該第1の電圧に接続されている第2のモス電界効果トランジスタと、
一端が該第1の電流鏡の出力端及び該第2のモス電界効果トランジスタのドレーン端に接続され、そしてその他端が該第2のモス電界効果トランジスタのゲート端に接続されているキャパシタと、
入力端が該第1のモス電界効果トランジスタのドレーン端に接続され、その共通ソース端は該第1の電圧に接続され、その出力端は該キャパシタの他端及び該第2のトランジスタのゲート端に接続されている第2の電流鏡とを備え、その中
該第1の電流鏡、該第1のモス電界効果トランジスタ、該第2の電流鏡及び該第2のモス電界効果トランジスタと該キャパシタとのカップリングにより該ソフト・スター回路より生じたソフト・スタート電圧と時間とのレシオ値が低下することで、該キャパシタの等価容量値を増加させ、これにより該ソフト・スタート回路が比較的小さい容量値のキャパシタで製作され得ることを特徴とする(請求項4に対応)。
To further achieve the above object, a soft start circuit according to another aspect of the present invention includes:
A current source having an output connected to the first voltage;
A first current mirror having an input connected to the input of the current source and a common source connected to a second voltage;
A first MOS field-effect transistor (MOSFET) having a source connected to the second voltage and a gate connected to a common gate of the first current mirror;
A second MOS field effect transistor having a drain end connected to the output end of the first current mirror and a source end connected to the first voltage;
A capacitor having one end connected to the output end of the first current mirror and the drain end of the second MOS field effect transistor, and the other end connected to the gate end of the second MOS field effect transistor;
An input terminal is connected to a drain terminal of the first MOS field effect transistor, a common source terminal is connected to the first voltage, and an output terminal is the other terminal of the capacitor and a gate terminal of the second transistor. A second current mirror connected to the first current mirror, the first MOS field effect transistor, the second current mirror, the second MOS field effect transistor, and the capacitor. The ratio between the soft start voltage and time generated by the soft star circuit is reduced by the coupling with the soft start circuit, thereby increasing the equivalent capacitance value of the capacitor, thereby making the soft start circuit relatively small. It can be manufactured with a capacitor having a capacitance value (corresponding to claim 4).

上記本発明の他の発明のソフト・スタート回路において、
該第1の電圧は前記第2の電圧よりも小さいものであり、
該第1の電流鏡は2個同一の第1のP型モス電界効果トランジスタによりカップリングされてなるものであり、
該第1のモス電界効果トランジスタはP型モス電界効果トランジスタであり、そしてそのチャネルのアスペクト・レシオは第1のP型モス電界トランジスタのチャネルのアスペクト・レシオよりも小さいものとする(請求項5に対応)。
In the soft start circuit according to another embodiment of the present invention,
The first voltage is lower than the second voltage;
The first current mirror is coupled by two identical first P-type MOS field effect transistors;
The first MOS field effect transistor is a P-type MOS field effect transistor, and the aspect ratio of its channel is smaller than the channel aspect ratio of the first P-type MOS field transistor. Corresponding to).

また上記本発明の他の発明のソフト・スタート回路において、
該第2のモス電界効果トランジスタはN型モス電界効果トランジスタであり、
該第2の電流鏡は第1のN型モス電界効果トランジスタ及び第2のN型モス電界効果トランジスタによりカップリングされてなるものであり、
該第1のN型モス電界効果トランジスタのドレーンは第2の電流鏡の入力端であり、そして該第2のN型モス電界効果トランジスタのドレーンは該第2の電流鏡の出力端であり、
該第1のN型モス電界効果トランジスタのチャネルのアスペクト・レシオは該第2のN型モス電界効果トランジスタのチャネルのアスペクト・レシオよりも大きいものとする(請求項6に対応)。
Further, in the soft start circuit of the other invention of the present invention,
The second Moss field effect transistor is an N-type Moss field effect transistor;
The second current mirror is coupled by a first N-type MOS field-effect transistor and a second N-type MOS field-effect transistor;
The drain of the first N-type MOS field effect transistor is the input of a second current mirror, and the drain of the second N-type MOS field effect transistor is the output of the second current mirror;
The aspect ratio of the channel of the first N-type MOS field-effect transistor is larger than the aspect ratio of the channel of the second N-type MOS field-effect transistor (corresponding to claim 6).

さらにまた上記目的を達成するために本発明にかかる他の発明のソフト・スタート回路は、
出力端が第1の電圧に接続されている電流源と、
入力端が電流源の入力端に接続され、そして共通ソース端が第2の電圧に接続されている第1の電流鏡と、
ソース端が該第2の電圧に接続され、ゲート端が該第1の電流鏡の共通ゲート端に接続されている第1のモス電界効果トランジスタと、
ドレーン端が該第1のモス電界効果トランジスタのドレーン端に接続され、そしてソース端が該第1の電圧に接続されている第2のモス電界効果トランジスタと、
一端が該第1のモス電界効果トランジスタのドレーン端及び該第2のモス電界効果トランジスタのドレーン端に接続され、他端が該第2のモス電界効果トランジスタのゲート端に接続されているキャパシタと、
入力端が該第1の電流鏡の出力端に接続され、共通ソース端が該第1の電圧に接続され、そして出力端が該キャパシタの他端及び該第2のモス電界効果トランジスタのゲート端に接続されている第2の電流鏡とを備え、その中
該第1の電流鏡、該第1のモス電界効果トランジスタ、該第2の電流鏡及び該第2のモス電界効果トランジスタと該キャパシタとのカップリングにより、該ソフト・スタート回路より生じたソフト・スタート電圧と時間とのレシオ値が低下することで、該キャパシタの等価容量値を増加させ、これにより該ソフト・スタート回路が比較的小さい容量値のキャパシタで製作され得ることを特徴とする(請求項7に対応)。
Still another object of the present invention is to provide a soft start circuit comprising:
A current source having an output connected to the first voltage;
A first current mirror having an input connected to the input of the current source and a common source connected to the second voltage;
A first MOS field-effect transistor having a source terminal connected to the second voltage and a gate terminal connected to a common gate terminal of the first current mirror;
A second MOS field effect transistor having a drain end connected to the drain end of the first MOS field effect transistor and a source end connected to the first voltage;
A capacitor having one end connected to the drain end of the first MOS field effect transistor and the drain end of the second MOS field effect transistor, and the other end connected to the gate end of the second MOS field effect transistor; ,
An input is connected to the output of the first current mirror, a common source is connected to the first voltage, and an output is the other end of the capacitor and the gate of the second MOS field effect transistor. A second current mirror connected to the first current mirror, the first MOS field effect transistor, the second current mirror, the second MOS field effect transistor, and the capacitor. The ratio between the soft start voltage and the time generated by the soft start circuit decreases due to the coupling with the soft start circuit, thereby increasing the equivalent capacitance value of the capacitor. It can be manufactured with a capacitor having a small capacitance value (corresponding to claim 7).

本発明における他の発明のソフト・スタート回路において、
該第1の電流鏡は第1のP型モス電界効果トランジスタ及び第2のP型モス電界効果トランジスタによりカップリングされてなり、
該第1のP型モス電界効果トランジスタのドレーンは該第1の電流鏡の入力端であり、該第2のP型モス電界効果トランジスタのドレーンは該第1の電流鏡の出力端であり、
該第1のP型モス電界効果トランジスタのチャネルのアスペクト・レシオは該第2のP型モス電界効果トランジスタのチャネルのアスペクト・レシオより大きいものとし、
該第1のモス電界効果トランジスタは、P型モス電界効果トランジスタであり、
該第2のモス電界効果トランジスタはN型モス電界効果トランジスタであり、
該第2の電流鏡は第1のN型モス電界効果トランジスタ及び第2のN型モス電界効果トランジスタによりカップリングされてなり、
該第1のN型モス電界効果トランジスタのドレーンは該第2の電流鏡の入力端であり、そして該第2のN型モス電界効果トランジスタのドレーンは該第2の電流鏡の出力端であり、
該第1のN型モス電界効果トランジスタのチャネルのアスペクト・シレオは該第2のN型モス電界効果トランジスタのチャネルのアスペクト・レシオより大きいものとする(請求項8に対応)。
In a soft start circuit according to another embodiment of the present invention,
The first current mirror is coupled by a first P-type MOS field-effect transistor and a second P-type MOS field-effect transistor;
A drain of the first P-type MOS field effect transistor is an input of the first current mirror, a drain of the second P-type MOS field effect transistor is an output of the first current mirror,
The aspect ratio of the channel of the first P-type MOS field-effect transistor is greater than the aspect ratio of the channel of the second P-type MOS field-effect transistor;
The first Moss field effect transistor is a P-type Moss field effect transistor;
The second Moss field effect transistor is an N-type Moss field effect transistor;
The second current mirror is coupled by a first N-type MOS field effect transistor and a second N-type MOS field effect transistor;
The drain of the first N-type MOS field effect transistor is the input of the second current mirror, and the drain of the second N-type MOS field effect transistor is the output of the second current mirror. ,
The aspect ratio of the channel of the first N-type MOS field-effect transistor is larger than the aspect ratio of the channel of the second N-type MOS field-effect transistor.

本発明は添付の図面を参照しながら最良な実施の形態を説明することにより、一歩進んで理解され得る。   The invention can be understood one step further by describing the best mode with reference to the accompanying drawings.

図2は本発明の第1の実施の形態のソフト・スタート回路の見取図である。この図に示すように、ソフト・スタート回路20は電流源21と、電流鏡22と、キャパシタ23と、npn型双極ジャンクション・トランジスタ(BJT)24とをカップリングしてなるものである。その中、電流鏡22は2個の同一P型モス電界効果トランジスタ221及び222によりカップリングされてなり、かつP型モス電界効果トランジスタ221及び222のゲート端は互いに接続し、ソース端は共に高電圧25に接続されている。そしてP型モス電界効果トランジスタ221のドレーン端は電流鏡22の入力端を形成し、P型モス電界トランジスタ222のドレーン端は電流鏡22の出力端を形成している。   FIG. 2 is a sketch of the soft start circuit according to the first embodiment of the present invention. As shown in the figure, the soft start circuit 20 is formed by coupling a current source 21, a current mirror 22, a capacitor 23, and an npn-type bipolar junction transistor (BJT) 24. The current mirror 22 is coupled by two identical P-type MOS field effect transistors 221 and 222, and the gate ends of the P-type MOS field effect transistors 221 and 222 are connected to each other, and the source ends are both high. Connected to voltage 25. The drain end of the P-type MOS field effect transistor 221 forms the input end of the current mirror 22, and the drain end of the P-type MOS field effect transistor 222 forms the output end of the current mirror 22.

また別に、電流鏡22の入力端は電流源21の入力端に接続され、電流鏡22の出力端はキャパシタ23の一端及びnpn型双極ジャンクション・トランジスタ24のコレクタに接続され、そしてキャパシタ23の他端はnpn型双極ジャンクション・トランジスタ24のベース端に接続され、電流源21の出力端及びnpn型双極ジャンクション・トランジスタ24のエミッタ端は共に低電圧26に接続されている。   Alternatively, the input end of the current mirror 22 is connected to the input end of the current source 21, the output end of the current mirror 22 is connected to one end of the capacitor 23 and the collector of the npn-type bipolar junction transistor 24, and The terminal is connected to the base terminal of the npn-type bipolar junction transistor 24, and the output terminal of the current source 21 and the emitter terminal of the npn-type bipolar junction transistor 24 are both connected to the low voltage 26.

ここで、図2に見るように、電流源21より発生した定電流(その大きさをI′とする)は電流鏡22を経由して映射されるので、npn型双極ジャンクション・トランジスタ24のエミッタ端より流れ出る電流の大きさもI′である。npn型双極ジャンクション・トランジスタの素子特性により、npn双極ジャンクション・トランジスタ24のベース端に流れ込んだ電流とnpn双極ジャンクション・トランジスタ24のコレクタ端に流れ込んだ電流とnpn型双極ジャンクション・トランジスタ24のエミッタ端を流れ出る電流との間には一比例関係1:b:(b+1)が存在するので、キャパシタ23を流れる電流(即ち、npn型双極ジャンクション・トランジスタのベース端に流れ込む電流)の大きさはI′/(b+1)であり、bが十分大きい場合(現代のnpn型双極ジャンクション・トランジスタでは100ないし200の間)、キャパシタ23を流れる電流の大きさをI′/bと見なすことができる。このI′/bを公式
V(ソフト・スタート)/T=I/Cの電流Iに代入すれば、
V(ソフト・スタート)/T=(I′/b)/Cとなり、
V(ソフト・スタート)/T=I′/(bC)を得ることが出来る。
Here, as shown in FIG. 2, the constant current (the magnitude is I ') generated from the current source 21 is projected through the current mirror 22, so that the emitter of the npn-type bipolar junction transistor 24 The magnitude of the current flowing from the end is also I '. Due to the element characteristics of the npn-type bipolar junction transistor, the current flowing into the base of the npn-type bipolar junction transistor 24, the current flowing into the collector of the npn-type bipolar junction transistor 24, and the emitter of the npn-type bipolar junction transistor 24 are reduced. Since there is a linear relationship 1: b: (b + 1) between the current flowing out and the current flowing out, the magnitude of the current flowing through the capacitor 23 (that is, the current flowing into the base end of the npn-type bipolar junction transistor) is I ′ / (B + 1) and if b is large enough (between 100 and 200 for modern npn-type bipolar junction transistors), the magnitude of the current flowing through the capacitor 23 can be considered as I '/ b. By substituting this I '/ b into the current I of the formula V (soft start) / T = I / C,
V (soft start) / T = (I '/ b) / C,
V (soft start) / T = I '/ (bC) can be obtained.

V/T=I′(bC)と見なすこともできる。
これから分かるように、ソフト・スタート電圧Vが固定の状況下で、比較的小さいV/T比を得たい場合、もし本発明に記載のソフト・スタート回路を利用すれば、キャパシタ23の等価容量値をb倍増幅できることにより、吾人に比較的小さい容量値のキャパシタを利用させ、ソフト・スタート電圧と時間との比(V(ソフト・スタート)/I)が十分に小さいソフト・スタート回路を製作することができる。
It can also be considered that V / T = I '(bC).
As can be seen, when it is desired to obtain a relatively small V / T ratio under a condition where the soft start voltage V is fixed, if the soft start circuit according to the present invention is used, the equivalent capacitance value of the capacitor 23 is obtained. To make a soft start circuit with a sufficiently small ratio of soft start voltage to time (V (soft start) / I) by using a capacitor with a relatively small capacitance value. be able to.

図3は本発明に係る第2の好適な実施の形態のソフト・スタート回路を示す回路見取図である。この図に示すように、ソフト・スタート回路30は、電流源31と、キャパシタ33と、ダリントン・トランジスタ34とをカップリングしてなるものである。その中、電流鏡32は2個の同一のP型モス電界効果トランジスタによりカップリングされてなり、そしてP型モス電界効果トランジスタ321及び322のゲート端は互に接続し、ソース端は共に高電圧35に接続され、そしてP型モス電界効果トランジスタ321のドレーン端は電流鏡32の入力端を形成し、P型モス電界効果トランジスタ322のドレーン端は電流鏡32の出力端を形成する。   FIG. 3 is a circuit diagram showing a soft start circuit according to a second preferred embodiment of the present invention. As shown in the figure, the soft start circuit 30 is formed by coupling a current source 31, a capacitor 33, and a Darlington transistor 34. The current mirror 32 is coupled by two identical P-type MOS field-effect transistors, and the gate ends of the P-type MOS field-effect transistors 321 and 322 are connected to each other, and the sources are both high voltage. The drain end of the P-type MOS field effect transistor 321 forms the input end of the current mirror 32, and the drain end of the P-type MOS field effect transistor 322 forms the output end of the current mirror 32.

また、ダリントン・トランジスタ34は2個同一のnpn型双極ジャンクション・トランジスタ341及び342によりカップリングされてなり、その中、npn型双極ジャンクション・トランジスタ341のベース端はダリントン・トランジスタ34の入力端であり、npn型双極ジャンクション・トランジスタ341及び342のコレクタ端は相互接した後電流鏡32の出力端に接続され、npn型双極ジャンクション・トランジスタ341のエミッタ端はnpn型双極ジャンクション・トランジスタ342のベース端に接続され、そしてnpn型双極ジャンクション・トランジスタ342のエミッタ端は低電圧36に接続されている。   The Darlington transistor 34 is coupled by two identical npn-type bipolar junction transistors 341 and 342, and the base end of the npn-type bipolar junction transistor 341 is the input end of the Darlington transistor 34. , Npn-type bipolar junction transistors 341 and 342 have their collector ends connected to each other and then connected to the output end of current mirror 32. The emitter end of npn-type bipolar junction transistor 341 is connected to the base end of npn-type bipolar junction transistor 342. And the emitter end of npn-type bipolar junction transistor 342 is connected to low voltage 36.

さらには、電流鏡32は電流源31の入力端に接続され、電流鏡32の出力端はキャパシタ33の一端及びnpn型双極ジャンクション・トランジスタ341及び342の共通コレクタ端に接続され、そしてキャパシタの他端はダリントン・トランジスタ34の入力端に接続されており、トランジスタ342のエミッタは低電圧36に接続されている。   Further, the current mirror 32 is connected to the input terminal of the current source 31, the output terminal of the current mirror 32 is connected to one end of the capacitor 33 and the common collector terminal of the npn-type bipolar junction transistors 341 and 342, and the other end of the capacitor. The terminal is connected to the input terminal of the Darlington transistor 34, and the emitter of the transistor 342 is connected to the low voltage 36.

ここで図3に見るように、電流源31より発生した定電流(その大きさをI″とする)は電流鏡32を経由して映射されるので、npn型双極ジャンクション・トランジスタ342のエミッタ端より流れ出る電流の大きさもI″である。ダリントン・トランジスタの素子特性(npn型双極ジャンクション・トランジスタ341のコレクタ端及びベース端のレシオ値をbとし、そしてnpn型双極ジャンクション・トランジスタ342も同様)により、npn双極ジャンクション・トランジスタ341のベース端に流れ込む電流とnpn型双極ジャンクション・トランジスタ342のエミッタ端を流れ出る電流との間には一比例関係1:(b+1)2が存在するので、キャパシタ33を流れる電流(即ち、npn型双極ジャンクション・トランジスタ341のベース端に流れ込む電流)の大きさはI″/(b+1)2であり、bが十分大きな場合(現代のnpn型双極ジャンクション・トランジスタでは100ないし200の間にある)、キャパシタ33を流れる電流の大きさをI″/b2とすることが出来る。このI″/b2値を公式
V(ソフト・スタート)/T=I/Cの電流Iに代入すれば
V(ソフト・スタート)/T=(I″/b2)/Cを得ることが出来、
又、V(ソフト・スタート)/T=I″/(b2C)と見なすことが出来る。
Here, as shown in FIG. 3, the constant current generated by the current source 31 (the magnitude is I ″) is projected via the current mirror 32, so that the emitter terminal of the npn-type bipolar junction transistor 342 The magnitude of the current flowing out is also I ″. Due to the element characteristics of the Darlington transistor (the ratio value of the collector terminal and the base terminal of the npn-type bipolar junction transistor 341 is b, and the same applies to the npn-type bipolar junction transistor 342), the npn-type bipolar junction transistor 341 has Since there is a linear relationship 1: (b + 1) 2 between the current flowing in and the current flowing out of the emitter terminal of the npn-type bipolar junction transistor 342, the current flowing through the capacitor 33 (that is, the npn-type bipolar junction transistor 341) The magnitude of the current flowing into the base end of the capacitor 33 is I ″ / (b + 1) 2, and when b is sufficiently large (between 100 and 200 for a modern npn-type bipolar junction transistor), the current flowing through the capacitor 33 is Size of Can be as I "/ b2. By substituting this I ″ / b2 value into the current I of the formula V (soft start) / T = I / C, V (soft start) / T = (I ″ / b2) / C can be obtained.
Also, it can be considered that V (soft start) / T = I ″ / (b2C).

これから分るように、ソフト・スタート電圧Vが固定の状況下で比較的小さいV/T比を得たい場合、もし本発明に記載のソフト・スタート回路を利用すれば、キャパシタ33の等価容量値をb倍増幅できることにより、吾人に比較的小さい容量値のキャパシタを利用させ、ソフト・スタート電圧と時間との比(V(ソフト・スタート)/I)が十分に小さいソフト・スタート回路を製作することができる。   As can be seen, if it is desired to obtain a relatively small V / T ratio under a condition where the soft start voltage V is fixed, if the soft start circuit according to the present invention is used, the equivalent capacitance value of the capacitor 33 is obtained. To make a soft start circuit with a sufficiently small ratio of soft start voltage to time (V (soft start) / I) by using a capacitor with a relatively small capacitance value. be able to.

図4は本発明に係る第3の好適な実施形態のソフト・スタート回路を示す回路見取図である。本実施形態の第1及び第2の好適な実施の形態と異なる所は、第3の実施の形態が相補型モス(complementary MOS;CMOS)製造プロセスの回路設計にある。図4に示すように、該ソフト・スタート回路40は電流源41と、3P型モス電界効果トランジスタ(42,43,44)と、3N型モス電界効果トランジスタ(45,46,47)と、キャパシタ48とによりカップリングされてなるものである。その中、P型モス電界効果トランジスタ42及び44のドレーン、ソース端間のチャネルのアスペクト・レシオは互いに同一であるが、いずれもP型モス電界効果トランジスタ43のチャネルのアスペクト・レシオの倍数(n倍とする)、そしてN型モス電界効果トランジスタ45のチャネルのアスペクト・レシオはN型モス電界効果トランジスタ46の倍数(m倍とする)である。   FIG. 4 is a circuit diagram showing a soft start circuit according to a third preferred embodiment of the present invention. The third embodiment differs from the first and second preferred embodiments in the circuit design of a complementary MOS (CMOS) manufacturing process in the third embodiment. As shown in FIG. 4, the soft start circuit 40 includes a current source 41, a 3P type MOS field effect transistor (42, 43, 44), a 3N type MOS field effect transistor (45, 46, 47), and a capacitor. 48. Among them, the aspect ratio of the channel between the drain and source terminals of the P-type MOS field-effect transistors 42 and 44 is the same as each other, but each is a multiple (n) of the aspect ratio of the channel of the P-type MOS field-effect transistor 43. The aspect ratio of the channel of the N-type MOS field effect transistor 45 is a multiple (m times) of that of the N-type MOS field effect transistor 46.

ここで図4で見るように、P型モス電界効果トランジスタ42,43及び44のソース端はいずれも高電圧491に接続され、そして三者のゲート端は相互に連接していると共に、P型モス電界効果トランジスタ42のドレーンに共通的にショートする。なお、P型モス電界効果トランジスタ42のドレーン端と電流源41の入力端とが互いに接続し、電流源41の出力端は低電圧492に接続している。したがって、P型モス電界効果トランジスタ42及び43は共に一個の電流映射倍率がI/nの電流鏡を組成し、そしてP型モス電界効果トランジスタ42及び44も共に一個の電流映射倍率が1の電流鏡を組成する。   As seen in FIG. 4, the source terminals of the P-type MOS field effect transistors 42, 43 and 44 are all connected to a high voltage 491, and the gate terminals of the three are connected to each other, and The drain of the MOS field effect transistor 42 is short-circuited in common. The drain terminal of the P-type MOS field-effect transistor 42 and the input terminal of the current source 41 are connected to each other, and the output terminal of the current source 41 is connected to the low voltage 492. Thus, both P-type MOS field effect transistors 42 and 43 form a current mirror with a current projection magnification of I / n, and both P-type MOS field effect transistors 42 and 44 have a single current projection magnification of 1 Make up the mirror.

なお、N型モス電界効果トランジスタ45はゲート、ドレーン端のショート方式でP型モス電界効果トランジスタ43のトレーン端と互いに接続し、そして、N型モス電界効果トランジスタ45は共通ゲート端の方式でN型モス電界効果トランジスタ46と、電流映射倍率が1/mの電流鏡を組成する。共通ソース端は低電圧492と互に接続する。   The N-type MOS field-effect transistor 45 is connected to the drain end of the P-type MOS field-effect transistor 43 in a short-circuit manner at the gate and drain ends, and the N-type MOS field-effect transistor 45 is N-type with a common gate end. A current mirror having a current projection magnification of 1 / m and a type MOS field effect transistor 46 are formed. The common source terminal is connected to the low voltage 492.

最後、N型モス電界効果トランジスタ47のドレーン端及びキャパシタ48の一端はP型モス電界効果トランジスタ44のドレーン端に接続され、N型モス電界効果トランジスタ47のゲート端及びキャパシタの他端はショート後共にN型モス電界効果トランジスタ46のドレーン端に接続される。N型モス電界効果トランジスタ47のソース端も又低電圧492と互に接続する。   Finally, the drain end of the N-type MOS field effect transistor 47 and one end of the capacitor 48 are connected to the drain end of the P-type MOS field effect transistor 44, and the gate end of the N-type MOS field effect transistor 47 and the other end of the capacitor are short-circuited. Both are connected to the drain end of the N-type MOS field effect transistor 46. The source end of the N-type MOS field effect transistor 47 is also connected to the low voltage 492.

ここで図4に見るように、電流源41より発生した定電流(その大きさをI’’’とする)はP型モス電界効果トランジスタ42及び44により組成された電流鏡を経由して映射されるので、P型モス電界効果トランジスタのドレーンから流れ出る電流の大きさもI’’’である。なお、P型モス電界効果トランジスタ42及び43により組成された電流鏡を経由して映射されることにより、P型モス電界効果トランジスタから流れ出す電流の大きさをI’’’/nにさせ、この電流が再度N型モス電界効果トランジスタ45及び46により共同して組成された電流鏡を経由して映射されることにより、N型モス電界効果トランジスタ46のドレーン端に流れ込む電流の大きさをI’’’/(mn)に変えさせる。流れ込んだN型モス電界効果トランジスタ47のドレーン端の電流とI’’’/(mn)との比が極めて小さいので、キャパシタ48に流れ込む電流の大きさをI’’’/(mn)としてもよい。   Here, as shown in FIG. 4, the constant current (the magnitude is I ′ ″) generated from the current source 41 is projected through a current mirror composed of P-type MOS field-effect transistors 42 and 44. Therefore, the magnitude of the current flowing out from the drain of the P-type MOS field-effect transistor is also I ′ ″. It should be noted that the current flowing out of the P-type MOS field-effect transistor is set to I ′ ″ / n by being projected through the current mirror composed of the P-type MOS field-effect transistors 42 and 43. The current is again projected through the current mirror formed by the N-type MOS field-effect transistors 45 and 46 so as to reduce the magnitude of the current flowing into the drain end of the N-type MOS field-effect transistor 46 by I ′. '' / (Mn). Since the ratio between the current at the drain end of the N-type MOS field effect transistor 47 and I ′ ″ / (mn) is extremely small, the magnitude of the current flowing into the capacitor 48 is I ′ ″ / (mn). Good.

(1)P型モス電界効果トランジスタ44のドレーンより流れ出る電流の大きさはI’’’であり、そして(2)キャパシタ48を流れる電流の大きさはI’’’/(mn)と見なせるので、m及びnが十分に大きい場合(現代のモス電界効果トランジスタでは25以上)、キャパシタ48を流れる電流値I’’’/(mn)を公式
V(ソフト・スタート)/T=I/Cの電流Iに代入すれば、
V(ソフト・スタート)/T=(I’’’/mn)/Cとなり、
また、V(ソフト・スタート)/T=I’’’(mnC)と見なすことも出来る。
(1) The magnitude of the current flowing out of the drain of the P-type MOS field effect transistor 44 is I ′ ″, and (2) the magnitude of the current flowing through the capacitor 48 can be regarded as I ′ ″ / (mn). , M and n are large enough (more than 25 in modern MOS field-effect transistors), the current value I ′ ″ / (mn) flowing through the capacitor 48 is determined by the formula V (soft start) / T = I / C Substituting for the current I,
V (soft start) / T = (I "'/ mn) / C,
Further, it can be regarded that V (soft start) / T = I ″ ′ (mnC).

これから分かるように、ソフト・スタート電圧が固定の状況下で、比較的小さいV/T比を得たい場合、もし本発明に記載のソフト・スタート回路を利用すれば、キャパシタ48の等価容量値をmn倍増幅できることにより、吾人に極めて小さい容量値を有するキャパシタを利用させ、ソフト・スタート電圧と時間との比(V(ソフト・スタート)/T)が十分に小さいソフト・スタート回路を製作することができる。   As can be seen, when it is desired to obtain a relatively small V / T ratio under a condition where the soft start voltage is fixed, if the soft start circuit according to the present invention is used, the equivalent capacitance of the capacitor 48 can be reduced. By making it possible to use a capacitor having an extremely small capacitance value by being able to amplify by mn times, a soft start circuit with a sufficiently small ratio of soft start voltage to time (V (soft start) / T) is used. Can be.

上記3種の好適な実施の形態から分かるように、本発明に記載のソフト・スタート回路の配置方式は確かに大キャパシタの有効値を増幅できることにより、吾人がソフト・スタート回路を製作する場合に比較的小さい容量値(即ち比較的小さい体積)のキャパシタで比較的小さいソフト・スタート電圧と時間との比に達することが出来る。つまり、緩慢にロードを通過した電流の増加速率を制御し、系統がスタート時により安全に作用するように達することが出来る。特に第3の好適な実施の形態のソフト・スタート回路はCMOSの製造プロセスを回路の実施の環境とし、集積回路の製造プロセス・サイズの要求に応じて製作されたキャパシタと組めるようにして、有効容量値をソフト・スタート回路の保護機能が発揮するに足る大きさにしたので、効果的に集積回路の製造プロセス中に整合でき、全く集積回路が日増にコンパクト化して行く世界潮流に符合することが出来る。したがって、本発明は確実に従来のソフト・スタート回路の技術的欠陥を解決でき、ひいては本発明の目的を達成することが出来る。   As can be seen from the above three preferred embodiments, the arrangement of the soft start circuit according to the present invention is capable of amplifying the effective value of the large capacitor. Relatively low soft start voltage to time ratios can be reached with relatively low capacitance (ie, relatively low volume) capacitors. In other words, it is possible to control the rate of increase of the current passing slowly through the load, so that the system can operate more safely at the start. In particular, the soft start circuit according to the third preferred embodiment makes it possible to use a CMOS manufacturing process as an environment for implementing the circuit and combine it with a capacitor manufactured according to the requirements of the manufacturing process size of the integrated circuit. Capacitance value is large enough to provide the protection function of the soft start circuit, so that it can be effectively matched during the integrated circuit manufacturing process, which is in line with the world trend in which integrated circuits are becoming ever more compact. I can do it. Therefore, the present invention can surely solve the technical deficiencies of the conventional soft start circuit, and can achieve the object of the present invention.

上記実施の形態は本発明の技術的手段をより具体的に説明するもので、当然本発明の技術的思想はこれに限定されず、添付のクレームの範囲を逸脱しない限り、当業者による単純な設計変更、付加、修飾、置換等はいずれも本発明の技術的範囲に属する。   The above-described embodiment describes the technical means of the present invention more specifically. Naturally, the technical idea of the present invention is not limited to this, and a simple one by a person skilled in the art may be used without departing from the scope of the appended claims. Design changes, additions, modifications, substitutions, etc. all belong to the technical scope of the present invention.

従来のソフト・スタート回路の回路見取図である。It is a circuit sketch of the conventional soft start circuit. 本発明に係る第1の好適な実施の形態のソフト・スタート回路を示す見取図である。1 is a sketch drawing showing a soft start circuit according to a first preferred embodiment of the present invention. 本発明に係る第2の好適な実施の形態のソフト・スタート回路を示す見取図である。FIG. 4 is a sketch showing a soft start circuit according to a second preferred embodiment of the present invention. 本発明に係る第3の好適な実施の形態のソフト・スタート回路を示す見取図である。FIG. 11 is a sketch showing a soft start circuit according to a third preferred embodiment of the present invention.

符号の説明Explanation of reference numerals

10,20,30,40…ソフト・スタート回路 11,21,31,41…電流源 22,32…電流鏡 12,23,33,48…キャパシタ 24,341,342…npn型双極ジャンクション・トランジスタ 221,222,321,322,42,43,44…P型モス電界効果トランジスタ 25,35,491…高電圧 26,36,492…低電圧 34…ダリントン・トランジスタ 45,46,47…N型モス電界効果トランジスタ   10, 20, 30, 40 ... soft start circuit 11, 21, 31, 41 ... current source 22, 32 ... current mirror 12, 23, 33, 48 ... capacitor 24, 341, 342 ... npn-type bipolar junction transistor 221 , 222, 321, 322, 42, 43, 44: P-type MOS field effect transistor 25, 35, 491 ... high voltage 26, 36, 492 ... low voltage 34: Darlington transistor 45, 46, 47 ... N-type Moss electric field Effect transistor

Claims (8)

入力端が第1の電圧に接続された第1の電流源と、
第1端が前記第1の電流源の出力端に接続され、そして第2端が第2の電圧に接続されたトランジスタと、
一端が前記第1の電流源の出力端に接続され、他端が前記トランジスタの入力端に接続されたキャパシタと、
を備えてなるソフト・スタート回路であって、
前記トランジスタと前記キャパシタとがカップリングして、前記ソフト・スタート回路より発生したソフト・スタート電圧と時間とのレシオ値を低下することにより、該キャパシタの等価容量値を増加することで、該ソフト・スタート回路が比較的小さい容量値のキャパシタで製作される、
ことを特徴とするソフト・スタート回路。
A first current source having an input connected to the first voltage;
A transistor having a first end connected to the output end of the first current source, and a second end connected to a second voltage;
A capacitor having one end connected to the output end of the first current source and the other end connected to the input end of the transistor;
A soft start circuit comprising:
The transistor and the capacitor are coupled, and the ratio of the soft start voltage generated by the soft start circuit to time is reduced, thereby increasing the equivalent capacitance of the capacitor. The start circuit is made of a capacitor having a relatively small capacitance value;
A soft start circuit characterized by:
前記第1の電流源は電流鏡であり、
この電流鏡は2個同一のP型モス電界効果トランジスタによりカップリングされてなり、
前記電流鏡の入力端は第2の電流源の入力端に接続され、該電流鏡の出力端は前記トランジスタの前記第1端及び前記キャパシタの一端に接続され、該電流鏡の共通ソース端は前記第1の電圧に接続され、及び前記第2の電流源の出力端は前記第2の電圧に接続されてなる、
請求項1記載のソフト・スタート回路。
The first current source is a current mirror;
This current mirror is coupled by two identical P-type MOS field effect transistors,
The input end of the current mirror is connected to the input end of a second current source, the output end of the current mirror is connected to the first end of the transistor and one end of the capacitor, and the common source end of the current mirror is Connected to the first voltage, and an output end of the second current source connected to the second voltage;
The soft start circuit according to claim 1.
前記第1の電圧は前記第2の電圧よりも大きく設定され、
前記トランジスタはnpn型双極ジャンクション・トランジスタであり、
前記トランジスタの前記第1端はコレクタ端、前記トランジスタの前記第2端はエミッタ端、前記トランジスタの制御端はベース端であり、及び/又は
前記トランジスタはダリントン・トランジスタであり、その中
前記ダリントン・トランジスタは第1のnpn型双極ジャンクション・トランジスタ及び第2のnpn型双極ジャンクション・トランジスタをカップリングしてなるものであり、そして該第1のnpn型双極ジャンクション・トランジスタのベース端は該トランジスタの入力端であり、該第1のnpn型双極ジャンクション・トランジスタのエミッタ端は該第2のnpn型双極ジャンクション・トランジスタのベース端に接続され、該第1のnpn型双極ジャンクション・トランジスタのコレクタ端は該第2のnpn型双極ジャンクション・トランジスタのコレクタ端に接続して該トランジスタの第1端が構成され、該第2のnpn型双極ジャンクション・トランジスタのエミッタ端は該トランジスタの第2端である、
請求項1記載のソース・スタート回路。
The first voltage is set higher than the second voltage,
The transistor is an npn-type bipolar junction transistor;
The first end of the transistor is a collector end, the second end of the transistor is an emitter end, the control end of the transistor is a base end, and / or the transistor is a Darlington transistor; The transistor is a coupling of a first npn-type bipolar junction transistor and a second npn-type bipolar junction transistor, and the base end of the first npn-type bipolar junction transistor is connected to the input terminal of the transistor. The emitter end of the first npn-type bipolar junction transistor is connected to the base end of the second npn-type bipolar junction transistor, and the collector end of the first npn-type bipolar junction transistor is connected to the collector end of the first npn-type bipolar junction transistor. Second npn-type bipolar diode And connected to the collector terminal of Nkushon transistor configured first end of the transistor, the emitter terminal of the npn bipolar junction transistor of the second is the second end of the transistor,
The source start circuit according to claim 1.
出力端が第1の電圧に接続されている電流源と、
入力端が前記電流源の入力端に接続され、そして共通ソース端が第2の電圧に接続されている第1の電流鏡と
ソース端が前記第2の電圧に接続され、ゲート端が前記第1の電流鏡の共通ゲート端に接続されている第1のモス電界効果トランジスタと、
ドレーン端が前記第1の電流鏡の出力端に接続され、そしてソース端が前記第1の電圧に接続されている第2のモス電界効果トランジスタと、
一端が前記第1の電流鏡の出力端及び前記第2のモス電界効果トランジスタのドレーン端に接続され、そしてその他端が前記第2のモス電界効果トランジスタのゲート端に接続されているキャパシタと、
入力端が前記第1のモス電界効果トランジスタのドレーン端に接続され、その共通ソース端は前記第1の電圧に接続され、その出力端は前記キャパシタの他端及び前記第2のトランジスタのゲート端に接続されている第2の電流鏡とを備え、その中
前記第1の電流鏡、前記第1のモス電界効果トランジスタ、前記第2の電流鏡及び前記モス電界効果トランジスタと前記キャパシタとのカップリングにより前記ソフト・スター回路より生じたソフト・スタート電圧と時間とのレシオ値が低下することで、前記キャパシタの等価容量値を増加させ、これにより前記ソフト・スタート回路及び比較的小さい容量値のキャパシタで製作され得る、
ことを特徴とするソフト・スタート回路。
A current source having an output connected to the first voltage;
A first current mirror having an input connected to the input of the current source, a common source connected to a second voltage, a source connected to the second voltage, and a gate connected to the second voltage. A first MOS field-effect transistor connected to a common gate end of one current mirror;
A second MOS field effect transistor having a drain end connected to the output end of the first current mirror and a source end connected to the first voltage;
A capacitor having one end connected to the output end of the first current mirror and the drain end of the second MOS field effect transistor, and the other end connected to the gate end of the second MOS field effect transistor;
An input terminal is connected to a drain terminal of the first MOS field effect transistor, a common source terminal thereof is connected to the first voltage, and an output terminal thereof is the other terminal of the capacitor and a gate terminal of the second transistor. A second current mirror connected to the first current mirror, the first MOS field effect transistor, the second current mirror, and a cup between the MOS field effect transistor and the capacitor. The ring reduces the soft start voltage and time ratio generated by the soft star circuit, thereby increasing the equivalent capacitance of the capacitor, thereby increasing the soft start circuit and relatively small capacitance. Can be made with capacitors,
A soft start circuit characterized by:
前記第1の電圧は前記第2の電圧よりも小さいものであり、
前記第1の電流鏡は2個同一の第1のモス電界効果トランジスタによりカップリングされてなるものであり、
前記第1のモス電界効果トランジスタはP型モス電界効果トランジスタであり、そしてそのチャネルのアスペクト・レシオは該第1のP型モス電界トランジスタのチャネルのアスペクト・レシオよりも小さいものとする、
請求項4記載のソフト・スタート回路。
The first voltage is lower than the second voltage;
The first current mirror is coupled by two identical first MOS field effect transistors;
The first MOS field-effect transistor is a P-type MOS field-effect transistor, and the aspect ratio of the channel is smaller than the aspect ratio of the channel of the first P-type MOS field effect transistor;
The soft start circuit according to claim 4.
前記第2のモス電界効果トランジスタはN型モス電界効果トランジスタであり、
前記第2の電流鏡は前記第1のN型モス電界効果トランジスタ及び前記第2のN型モス電界効果トランジスタによりカップリングされてなるものであり、
前記第1のN型モス電界効果トランジスタのドレーンは前記第2の電流鏡の入力端であり、そして前記第2のN型モス電界効果トランジスタのドレーンは該第2の電流鏡の出力端であり、
前記第1のN型モス電界効果トランジスタのチャネルのアスペクト・レシオは前記第2のN型モス電界効果トランジスタのチャネルのアスペクト・レシオよりも大きいものとする、
請求項4に記載のソフト・スタート回路。
The second MOS field-effect transistor is an N-type MOS field-effect transistor;
The second current mirror is coupled by the first N-type MOS field-effect transistor and the second N-type MOS field-effect transistor;
The drain of the first N-type MOS field-effect transistor is the input of the second current mirror, and the drain of the second N-type MOS field-effect transistor is the output of the second current mirror. ,
The aspect ratio of the channel of the first N-type MOS field-effect transistor is larger than the aspect ratio of the channel of the second N-type MOS field-effect transistor.
The soft start circuit according to claim 4.
出力端が第1の電圧に接続されている電流源と、
入力端が電流源の入力端に接続され、そして共通ソース端が第2の電圧に接続されている第1の電流鏡と、
ソース端が前記第2の電圧に接続され、ゲート端が前記第1の電流鏡の共通ゲート端に接続されている第1のモス電界効果トランジスタと、
ドレーン端が前記第1のモス電界効果トランジスタのドレーン端に接続され、そしてソース端が前記第1の電圧に接続されている第2のモス電界効果トランジスタと、
一端が前記第1のモス電界効果トランジスタのドレーン端及び前記第2のモス電界効果トランジスタのドレーン端に接続され、他端が前記第2のモス電界効果トランジスタのゲート端に接続されているキャパシタと、
入力端が前記第1の電流鏡の出力端に接続され、共通ソース端が前記第1の電圧に接続され、そして出力端が前記キャパシタの他端及び前記第2のモス電界効果トランジスタのゲート端に接続されている第2の電流鏡と、
を備え、その中
前記第1の電流鏡、前記第1のモス電界効果トランジスタ、前記第2の電流鏡及び前記第2のモス電界効果トランジスタと前記キャパシタとのカップリングにより、前記ソフト・スタート回路より生じたソフト・スタート電圧と時間とのレシオ値が低下することで、該キャパシタの等価容量値を増加させ、これにより該ソフト・スタート回路が比較的小さい容量値のキャパシタで製作され得る、
ことを特徴とするソフト・スタート回路。
A current source having an output connected to the first voltage;
A first current mirror having an input connected to the input of the current source and a common source connected to the second voltage;
A first MOS field effect transistor having a source terminal connected to the second voltage and a gate terminal connected to a common gate terminal of the first current mirror;
A second MOS field effect transistor having a drain end connected to a drain end of the first MOS field effect transistor and a source end connected to the first voltage;
A capacitor having one end connected to the drain end of the first MOS field effect transistor and the drain end of the second MOS field effect transistor, and the other end connected to the gate end of the second MOS field effect transistor; ,
An input is connected to the output of the first current mirror, a common source is connected to the first voltage, and an output is the other end of the capacitor and the gate of the second MOS field effect transistor. A second current mirror connected to
Wherein the first current mirror, the first MOS field effect transistor, the second current mirror, and the coupling between the second MOS field effect transistor and the capacitor provide the soft start circuit. The resulting lower ratio of soft start voltage to time reduces the equivalent capacitance of the capacitor, so that the soft start circuit can be made with a capacitor of relatively small capacitance.
A soft start circuit characterized by:
前記第1の電流鏡は第1のP型モス電界効果トランジスタ及び第2のP型モス電界効果トランジスタによりカップリングされてなるものであり、
前記第1のP型モス電界効果トランジスタのドレーンは前記第1の電流鏡の入力端であり、そして前記第2のP型モス電界効果トランジスタのドレーンは前記第1の電流鏡の出力端であり、
前記第1のP型モス電界効果トランジスタのチャネルのアスペクト・レシオは前記第2のP型モス電界効果トランジスタのチャネルのアスペクト・レシオより大きいものとし、
前記第1のモス電界効果トランジスタは、P型モス電界効果トランジスタであり、
前記第2のモス電界効果トランジスタはN型モス電界効果トランジスタであり、
前記第2の電流鏡は第1のN型モス電界効果トランジスタ及び第2のN型モス電界効果トランジスタによりカップリングされてなるものであり、
前記第1のN型モス電界効果トランジスタのドレーンは前記第2の電流鏡の入力端であり、そして前記第2のN型モス電界効果トランジスタのドレーンは該第2の電流鏡の出力端であり、
前記第1のN型モス電界効果トランジスタのチャネルのアスペクト・シレオは前記第2のN型モス電界効果トランジスタのチャネルのアスペクト・レシオより大きいものとする、
請求項7記載のソフト・スタート回路。
The first current mirror is coupled by a first P-type MOS field-effect transistor and a second P-type MOS field-effect transistor;
The drain of the first P-type MOS field effect transistor is an input of the first current mirror, and the drain of the second P-type MOS field effect transistor is an output of the first current mirror. ,
An aspect ratio of a channel of the first P-type MOS field-effect transistor is larger than an aspect ratio of a channel of the second P-type MOS field-effect transistor;
The first Moss field effect transistor is a P-type Moss field effect transistor;
The second MOS field-effect transistor is an N-type MOS field-effect transistor;
The second current mirror is coupled by a first N-type MOS field-effect transistor and a second N-type MOS field-effect transistor;
The drain of the first N-type MOS field-effect transistor is the input of the second current mirror, and the drain of the second N-type MOS field-effect transistor is the output of the second current mirror. ,
The aspect ratio of the channel of the first N-type MOS field-effect transistor is larger than the aspect ratio of the channel of the second N-type MOS field-effect transistor.
The soft start circuit according to claim 7.
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