JP2004281975A - 光半導体装置 - Google Patents
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Abstract
【課題】回路との電力伝達効率の良く、かつ伝送レート１０Ｇｂ／ｓにおける高周波伝送特性を劣化させることなく、信頼性が高くコストの安い光半導体装置を提供することを目的とする。
【解決手段】半導体レーザダイオード４０のインピーダンスと、整合抵抗３１ａ、３１ｂの夫々の抵抗値との和を、ＬＤ駆動回路１００のインピーダンス以下とし、かつ、ストリップ差動信号線５６ａ、５６ｂの電気長を、伝送する周波数の略１／８波長としたので、ＬＤ駆動回路１００と半導体レーザダイオード４０との間の電力伝達効率を必要以上に落とすことなく、広帯域に反射波を低減することが出来る。
【選択図】 図５
【解決手段】半導体レーザダイオード４０のインピーダンスと、整合抵抗３１ａ、３１ｂの夫々の抵抗値との和を、ＬＤ駆動回路１００のインピーダンス以下とし、かつ、ストリップ差動信号線５６ａ、５６ｂの電気長を、伝送する周波数の略１／８波長としたので、ＬＤ駆動回路１００と半導体レーザダイオード４０との間の電力伝達効率を必要以上に落とすことなく、広帯域に反射波を低減することが出来る。
【選択図】 図５
Description
【０００１】
【発明の属する技術分野】
この発明は、光半導体素子と、当該光半導体素子との間で電気信号を伝送する信号端子を有し、Ｇｂ／ｓ（ギガビット／秒）以上の速度で光信号の伝送が可能な光半導体装置に関するものである。
【０００２】
【従来の技術】
従来の光半導体装置として、ホトダイオード（光半導体素子）と、プリアンプＩＣと、ピン形状の信号端子（信号ピン）と、信号端子の貫通するフィードスルーを備えたパッケージと、グランド強化のため前記信号端子を挟むように配設された一対のグランド端子を備えたものが開示されている（例えば、特許文献１参照）。
【０００３】
【特許文献１】
特開平１１−２３１１７３号公報（第２−５頁、図２、図４、図５）
【０００４】
特許文献１には、フィードスルー部のみの特性としては最適な設計を実施すれば２０ＧＨｚまで反射波を低減できることが開示され、また、信号端子とプリアンプＩＣとを接続する僅か０．５ｍｍのボンディングワイアで帯域が１７ＧＨｚになることが開示されている。また、その光半導体装置に突設された信号端子を、電子回路（ＩＣ）の搭載された基板（回路基板）の導体パターンに接合する際、信号端子と導体パターンの接合面との間に空隙を設けることなく実装する例が示されている。
【０００５】
光半導体装置の信号端子を基板に固定する場合、光半導体装置と回路基板の熱膨張係数の違いからストレスが発生する。このストレスを緩和して、半田部の破損を防止するために、一般には信号端子に屈曲構造を設けるなどの工夫が必要である（例えば、特許文献２参照）。この方法は、比較的に信号線路の特性インピーダンス変化を小さく出来るので、高周波用途でも使用される。
【０００６】
【特許文献２】
実開平５−２９１５６号公報（第６頁、図１）
【０００７】
しかし、このような屈曲構造を設けた場合、光半導体装置における信号端子の屈曲部分と回路基板との間に空隙が発生し、結果として特性インピーダンスの差異を生じてしまう。このため、信号端子では一定量の反射波が発生する。
【０００８】
別の光半導体装置と回路基板としては、光半導体装置の信号端子と回路基板上の導体パッドとを細いボンディングワイアで接続する例がある（例えば、特許文献３参照）。
【０００９】
しかし、特性インピーダンス変化が大きく、また、信号端子がスタブのように振る舞うなど、高周波帯では反射特性の劣化があるため、比較的に低い周波数の信号伝送用に限られて使用されている。
【００１０】
【特許文献３】
特開平６−３４３０５８号公報（第３−６頁、図２３）
【００１１】
一方、従来の光半導体装置において、光半導体素子（この例では半導体レーザダイオード）付近で生じる電気的な反射波が、光半導体素子の駆動電流波形を劣化させ、結果として光出力波形を劣化することが知られている。このため、光半導体素子と並列に抵抗を入れる方法や、光半導体素子と並列に抵抗と容量の直列回路を入れる方法が開示されている（例えば、特許文献４参照）。
【００１２】
【特許文献４】
特開平９−２００１５０号公報（第２−５頁、図２）
【００１３】
また、信号端子と光半導体素子との接続にマイクロストリップ線路などの分布定数線路を利用する構造が用いられているが、例えば信号端子で発生する反射波や、光半導体素子で発生する反射波の与える影響についてまでは言及されてない（例えば、特許文献５参照）。
【００１４】
【特許文献５】
特開平１−１９２１８８号公報（第２−３頁、図１）
【００１５】
また、アナログ通信の用途では、限られた複数の周波数帯のみで光半導体素子への電力伝達効率を上げれば良い。従来の光半導体装置として、半導体レーザダイオードと接続された１０Ω以下の直列抵抗と、信号端子と、その間に配設されたマイクロストリップ線路とワイヤボンドとを含むインピーダンス整合回路とを備えることが開示されている（例えば、特許文献６、並びに特許文献７参照）。しかし、インピーダンス整合回路として、インダクタンス素子や容量素子を組合せたものの開示があるのみで、デジタル通信に利用できるような広帯域のインピーダンス整合を与えるものではなかった。
【００１６】
【特許文献６】
特開平９−３０７１６９号公報（第２−５頁、図１０）
【００１７】
【特許文献７】
実開平１０−７５００３号公報（第２−６頁、図１）
【００１８】
また、４０Ｇｂ／ｓ以上の高速光信号を伝送する通信用の光半導体装置に関して、電界吸収型変調素子の給電線路に開放型スタブを設け、５９．６ＧＨｚを中心とした急峻な反射減衰特性を有するインピーダンス整合回路が開示されている（例えば、特許文献８参照）。しかし、開放型スタブを２段直列に設けた整合回路を用いて急峻な反射特性を与えることができるものの、デジタル通信に利用できるような広帯域のインピーダンス整合を与えるものではない。
【００１９】
【特許文献８】
実開平１１−３８３７２号公報（第２−６頁、図４）
【００２０】
【発明が解決しようとする課題】
従来技術に示すように、光半導体装置に突設された信号端子を回路基板の導体パターンと接合する際、信号端子と導体パターンの接合部周辺に屈曲構造を設けずに、信号端子における導体パターンとの非接触部分（信号端子の空走部分）の長さを短くすることにより、光半導体装置と回路基板との電気的な反射が生じにくくなる。しかし、このような構造では、光半導体装置と回路基板との間の接合部に機械的、または熱的なストレスが発生する。また、信号端子の空走部分の長さが短くなるように、信号端子の突出面を回路基板に近接配置して半田接合することによって、信号端子の接合時の組立精度が厳しくなり製造コストが高くなる。
【００２１】
一方、光半導体装置と回路基板を電気的に接続する信号端子の接合部において、機械的、または熱的なストレスを低減して信頼性の高い接合を得るためには、信号端子に屈曲構造を設ける必要がある。しかし、信号端子に屈曲構造を設けることによって、屈曲部において光半導体装置の信号端子と回路基板の導体パターン面との間に空隙が生じ、信号端子の空走部分の長さがより長くなって、信号端子付近からの反射が発生するという課題があった。
【００２２】
また、デジタル通信の分野では、広帯域に渡って光半導体素子と回路基板上の電子回路（集積回路）との電力伝達効率を上げる必要がある。しかし、インピーダンス整合を広帯域に渡って完全に行うことはできないため、結果として光半導体素子付近からの反射が発生するという課題があった。アナログ通信用途では、複雑なインピーダンス整合を行なう技術もあるが、広帯域の通過特性や反射特性が求められるデジタル通信には利用できない。
【００２３】
この発明は、上記に鑑みてなされたものであり、光半導体素子と、光半導体素子の信号端子に接続される回路基板との電力伝達効率が良く、広帯域に渡って光半導体素子と信号端子との反射が少なく、かつ、低コストな光半導体装置を得ることを目的とする。
【００２４】
【課題を解決するための手段】上記目的を達成するため、この発明にかかる光半導体装置は、
一対の電極を有する光半導体素子と、
前記光半導体素子の電極と一端が直列接続されるインピーダンス整合用の抵抗と、
前記抵抗の他端と一端が接続される分布定数線路と、
前記分布定数線路の他端と一端が接続される信号端子とを備え、
前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和が、前記信号端子に接続される電気回路のインピーダンスよりも小さく、
かつ前記分布定数線路の特性インピーダンスが、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和とほぼ等しいか、もしくはその０．６倍から１．４倍の範囲であって、
かつ前記分布定数線路の電気長が伝送する信号の周波数における略１／１６波長〜略３／１６波長の長さとしたものである。
【００２５】
また、この発明による係る光半導体装置は、
一対の電極を有する光半導体素子と、
前記光半導体素子の夫々の電極に、夫々一端が接続されるインピーダンス整合用の第１、第２の抵抗と、
差動線路を構成する第１、第２の導体線路を有し、当該夫々の導体線路の一端が前記第１、第２の抵抗の他端と夫々接続された分布定数線路と、
前記分布定数線路の第１、第２の導体線路における他端に、夫々一端が接続された第１、第２の信号端子とを備え、
前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和が、前記第１、第２の信号端子とそれぞれ接続された第１、第２の電気回路のインピーダンスの和より小さく、
かつ前記分布定数線路における差動線路の特性インピーダンスが、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和とほぼ等しいか、もしくはその０．６倍から１．４倍の範囲であって、
かつ前記分布定数線路における差動線路の夫々の電気長が伝送する信号の周波数における１／１６波長〜３／１６波長としたものである。
【００２６】
また、この発明による係る光半導体装置は、
一対の電極を有する光半導体素子と、
前記光半導体素子の電極と一端が直列接続されるインピーダンス整合用の抵抗と、
前記抵抗の他端と一端が接続される分布定数線路と、
前記分布定数線路の他端と一端が接続される信号端子とを備え、
前記光半導体素子のインピーダンスと前記抵抗のインピーダンスの和が前記信号端子と接続される電気回路のインピーダンスよりも小さく、
かつ前記分布定数線路の特性インピーダンスは、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和と、前記電気回路のインピーダンスとの中間であり、
かつ前記分布定数線路の電気長が伝送する信号の周波数における略１／８波長〜３／８波長の長さとしたものである。
【００２７】
また、この発明による係る光半導体装置は、
一対の電極を有する光半導体素子と、
前記光半導体素子の夫々の電極に、夫々一端が接続されるインピーダンス整合用の第１、第２の抵抗と、
差動線路を構成する第１、第２の導体線路を有し、当該夫々の導体線路の一端が前記第１、第２の抵抗の他端と夫々接続された分布定数線路と、
前記分布定数線路の第１、第２の導体線路における他端に、夫々一端が接続された第１、第２の信号端子とを備え、
前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和が、前記第１、第２の信号端子と夫々接続された第１、第２の電気回路のインピーダンスの和より小さく、
かつ前記分布定数線路における差動線路の特性インピーダンスは、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和と、前記第１および第２の電気回路のインピーダンスの和との中間であり、
かつ前記分布定数線路における差動線路の夫々の電気長が伝送する信号の周波数における略１／８波長〜３／８波長の長さとしたものである。
【００２８】
また、この発明による係る光半導体装置は、
一対の電極を有する光半導体素子と、
前記光半導体素子の電極と一端が直列接続されるインピーダンス整合用の抵抗と、
前記抵抗の他端と一端が接続される第１の分布定数線路と、
前記第１の分布定数線路と一端が接続される第２の分布定数線路と、
前記第２の分布定数線路の他端と一端が接続される信号端子とを備え、
前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和が前記信号端子に接続される電気回路のインピーダンスよりも小さく、
かつ前記第１の分布定数線路の特性インピーダンスが、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和とほぼ等しく、
かつ前記第１の分布定数線路の電気長が伝送する信号の周波数における略１／１６波長〜３／１６波長の長さであり、
かつ前記第２の分布定数線路の特性インピーダンスが、伝送する信号の周波数において前記第１の分布定数線路の特性インピーダンスと、前記電気回路のインピーダンスとの中間であり、
かつ前記第２の分布定数線路の電気長が伝送する信号の周波数における略１／８〜略３／８波長の長さとしたものである。
【００２９】
また、この発明による係る光半導体装置は、
一対の電極を有する光半導体素子と、
前記光半導体素子の夫々の電極に、夫々一端が接続されるインピーダンス整合用の第１、第２の抵抗と、
差動線路を構成する第１、第２の導体線路を有し、当該夫々の導体線路の一端が前記第１、第２の抵抗の他端と夫々接続された第１の分布定数線路と、
差動線路を構成する第３、第４の導体線路を有し、当該夫々の導体線路の一端が前記第１、第２の導体線路の他端と夫々接続された第２の分布定数線路と、
前記分布定数線路の第３、第４の導体線路における他端に、夫々一端が接続された第１、第２の信号端子とを備え、
前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和が、前記第１、第２の信号端子と夫々接続された第１、第２の電気回路のインピーダンスの和より小さく、
かつ前記第１の分布定数線路における差動線路の特性インピーダンスが、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和とほぼ等しく、かつ前記第１の分布定数線路における差動線路の夫々の電気長が伝送する信号の周波数における１／１６波長〜３／１６波長の長さであり、
かつ前記第２の分布定数線路における差動線路の特性インピーダンスが、伝送する信号の周波数において前記第１の分布定数線路の差動線路の特性インピーダンスと前記第１および第２の電気回路のインピーダンスの和との中間であり、
かつ前記第２の分布定数線路における差動線路の夫々の電気長が伝送する信号の周波数における略１／８波長〜略３／８波長の長さとしたものである。
【００３０】
【発明の実施の形態】
以下に添付図面を参照して、この発明にかかる光半導体装置の好適な実施の形態を詳細に説明する。
この実施の形態の光半導体装置は、光半導体素子の浮遊容量やワイヤボンド配線などで発生するインダクタンス成分によるインピーダンス変化を、整合用の抵抗を集中定数的に近接して配置し、分布定数線路の特性インピーダンスと電気長とを適宜に設定することにより、そのインピーダンスを信号入力もしくは出力端子のインピーダンスと広帯域にインピーダンス整合し、光半導体素子と信号入力もしくは出力端子との電力伝達効率が広帯域に渡ってよく、反射が少なく、かつ、低コストな光半導体装置を供する。
【００３１】
この実施の形態の光半導体装置は、例えば、ビル内に設置されたサーバ間の接続、異なるビルに設置されたサーバ間の接続などのローカルエリアネットワーク、またはデジタル通信網の幹線系に適用される。
【００３２】
実施の形態１．
図１〜図１２に従って、この発明の実施の形態１の光半導体集積回路について説明する。
この実施の形態１の光半導体集積回路には、安価なキャンパッケージ型のモジュール形態が採用され、パッケージ内には光半導体素子として半導体レーザダイオード（以下ＬＤという）が内蔵されている光半導体素子モジュールと、ＬＤを差動駆動する差動駆動回路が搭載されている集積回路用基板とを備えている。
【００３３】
図１は光半導体素子モジュールを構成する光半導体用パッケージ（以下キャンパッケージという）の外観構成を示すもので、図２はキャンパッケージ１およびレセプタクル２から構成される光半導体素子モジュール（以下、この実施の形態では主にＬＤを搭載した例を示すので、ＬＤモジュールと呼ぶ）３の外観構成を示すもので、図３（ａ）（ｂ）はＬＤモジュール３の水平（図２のｘ軸に平行な方向）断面図，垂直（図２のｙ軸に平行な方向）断面図を示すものである。
【００３４】
図１〜図３に示すように、キャンパッケージ１は、バイアス給電ピン、高周波信号ピンなどがマウントされる円板状のステム１０（導電体）と、複数のセラミック基板が搭載される台形柱状の台座１１（台座ブロック）と、ＬＤ４０から発生されたレーザ光を集光する集光レンズ１２と、台座１１などを外部から密閉するための円筒形のキャップ１３などを備えている。ステム１０は導電性のコバールやＣｕＷ、軟鉄などで成形される。
【００３５】
キャップ１３は、図３に示すように、プロジェクション溶接などによってステム１０に固定される第１キャップ部材１３ａと、この第１キャップ部材１３ａの先端側に外嵌されてＹＡＧ溶接などによって第１キャップ部材１３ａに固定される第２キャップ部材１３ｂとから成る２段円筒形状を成している。具体的には、第１キャップ部材１３ａは段付きの外筒を有し、太い径の外筒の先に細い径の外筒が設けられている。この細い径の外筒の外周に対して、第２キャップ部材１３ｂの一端側の内筒が嵌合し、貫通ＹＡＧ溶接によって第１キャップ部材１３ａと第２キャップ部材１３ｂが固定される。キャップ１３はこのような溶接加工によって比較的安価に製造することができる。
【００３６】
第１キャップ部材１３ａの先端側には、レンズ挿入用の孔１４が形成されており、この孔１４に集光レンズ１２が挿入される。集光レンズ１２は、ネジ、接着材などによって第１キャップ部材１３ａに固定される。第１キャップ部材１３ａの内部空間１５は、ガラス製のウィンドウ１６によって外部から画成されており、これにより台座１１が収納される内部空間１５を気密状態に保つようにしている。なお、集光レンズ１２をキャップ１３の孔１４に接着固定することによって、内部空間１５を気密状態に保つことが可能な場合は、ウィンドウ１６を省略してもよい。
【００３７】
第２キャップ部材１３ｂの集光レンズ１２に対向する部分（他端側）には、レーザ光を通過させるための孔１７が形成されている。この第２キャップ部材１３ｂを第１キャップ部材１３ａに対して摺動させ、レーザ光軸方向に位置決め調整し、第１キャップ部材１３ａにＹＡＧ溶接固定することで、集光レンズ１２とレセプタクル２内のダミーフェルール１８とのレーザ光軸方向の位置合わせを行う。
【００３８】
レセプタクル２は、光ファイバ２０が接続されたフェルール２１（図２参照）が挿入されるフェルール挿入孔１９を有している。フェルール挿入孔１９内のキャンパッケージ１側には、内部に光ファイバ１８ａが配設されているダミーフェルール１８が圧入され固定されている。レセプタクル２におけるダミーフェルール１８が固定される側の一端面は、ＹＡＧ溶接による突き合わせ溶接などによってキャンパッケージ１の第２キャップ部材１３ｂの他端側の端面に固定される。レセプタクル２を第２キャップ部材１３ｂに固定する際に、互いの接合面を当接させた状態でレーザ光軸方向に垂直な２つの方向に対する位置決め調整を行うことで、集光レンズ１２とレセプタクル２内のダミーフェルール１８とのレーザ光軸に直角な２つの方向に関する位置合わせを行う。
【００３９】
光ファイバ２０が接続されているフェルール２１は、フェルール２１がレセプタクル２のフェルール挿入孔１９に挿入されたとき、ダミーフェルール１８の方にフェルール２１を押圧し、かつフェルール２１をレセプタクル２にロック固定するための適宜の機構（図示せず）を有している。したがって、フェルール２１がレセプタクル２のフェルール挿入孔１９に挿入されると、ダミーフェルール１８の光ファイバ１８ａとフェルール２１内の光ファイバ２０の端面同士が当接し、これによりファイバ間が接続（光結合）される。
【００４０】
つぎに、キャンパッケージ１内の構成について説明する。キャンパッケージ１内の構成を説明する前に、キャンパッケージ１内の各構成要素の等価回路を図４を用いて説明する。
【００４１】
図４は、キャンパッケージ１内の各構成要素の回路構成およびキャンパッケージ１内のＬＤ４０を差動駆動する差動駆動回路としてのＬＤ駆動回路１００の回路構成例を示すものである。ＬＤ駆動回路１００は、集積回路（ＩＣ）として集積されており、このＬＤ駆動回路１００は、図６に示すように、キャンパッケージ１と電気接続される集積回路用基板（外部基板）３００に搭載されて、信号源として機能している。また、外部基板３００には、マイクロストリップ差動線路として構成される差動線路基板７０（図５，図６参照）が設けられており、この差動線路基板７０を介してキャンパッケージ１とＬＤ駆動回路としてのＬＤ駆動回路１００が電気接続されている。なお、差動線路基板７０と集積回路基板３００は回路基板を構成し、この差動線路基板７０と集積回路基板３００を多層基板として一体化してもよい。また、差動線路基板７０は信号線路とグランドとの電界結合を強くしてグランデッドコプレーナ差動線路としても良い。
【００４２】
図４に示すように、ＬＤ駆動回路１００は、差動型の入力構成を有する入力バッファ１０２と、正相信号および逆相信号を出力する差動構成をなす一対のトランジスタ１０３，１０４と、バイアス定電流源としてのトランジスタ１０５と、インピーダンス整合をとるための抵抗１０６，１０７とを備えている。
【００４３】
入力バッファ１０２は、入力される正相信号と逆相信号の波形を整形し、整形した正相信号と逆相信号をトランジスタ１０３および１０４のベースに出力する。
【００４４】
差動構成をなす一対のトランジスタ１０３，１０４は、差動増幅器を構成する。トランジスタ１０３，１０４の夫々のコレクタ側は、抵抗１０６および１０７に接続されている。抵抗１０６，１０７の他方側は端子３１２，３１３に接続されている。トランジスタ１０３，１０４の夫々のエミッタは、定電流源であるトランジスタ１０５のコレクタに接続されている。トランジスタ１０３のベースは入力バッファ１０２の逆相信号出力端子に接続され、トランジスタ１０４のベースは入力バッファ１０２の正相信号出力端子に接続されている。すなわち、入力バッファ１０２に正相信号が入力した時にトランジスタ１０３はＯＦＦに、トランジスタ１０４はＯＮとなり、電流Ｉ１と電流Ｉ２が差動状態で流れる。なお、トランジスタ１０３とトランジスタ１０４に流れる電流値はトランジスタ１０５にて決定される。また、トランジスタ１０５のエミッタ側が負電源Ｖｅｅ１に接続されている。
【００４５】
トランジスタ１０３，１０４のエミッタ側の出力端子３１０、３１１は、マイクロストリップ差動線路やグランデッドコプレナ差動線路や後述する高周波信号ピンなどで構成される分布定数回路３０、整合抵抗３１ａ，３１ｂを介してＬＤ４０の一対の電極（カソード、アノード）に接続されている。
【００４６】
キャンパッケージ１側は、分布定数回路３０と、２５Ω程度のインピーダンス整合用の抵抗３１ａ，３１ｂと、集光レンズ１２と、高周波インピーダンスが５Ω程度のＬＤ４０と、高周波インピーダンスが大きいインダクタンス素子としての空芯ソレノイド３３ａ，３３ｂと、空芯ソレノイド３３ａ，３３ｂに並列接続される共振防止抵抗３４ａ，３４ｂと、ＬＤ４０と空芯ソレノイド３３ａ，３３ｂとを接続するためのワイヤボンド３５ａ，３５ｂとを備えている。
【００４７】
ＬＤ４０のカソード側は、ワイヤボンド３５ａと、このワイヤボンド３５ａに直列に接続された空芯ソレノイド３３ａと、共振防止抵抗３４ａの並列回路を介してバイアス定電流源３６の一端に接続されている。バイアス定電流源３６の他端は負電源Ｖｅｅ２に接続されている。ＬＤ４０のアノード側は、ワイヤボンド３５ｂと、このワイヤボンド３５ｂに直列に接続された空芯ソレノイド３３ｂと、共振防止抵抗３４ｂの並列回路を介して接地されている。なお、空芯ソレノイド３３ａと３３ｂは、いずれも整合抵抗３１ａと３１ｂよりもＬＤ４０に近い側でＬＤ４０の一対の電極に電気的に接続されている。負電源Ｖｅｅ１と負電源Ｖｅｅ２は同じ電源としたほうが好ましいが、別の電源としてもよい。
【００４８】
このＬＤ４０の駆動構成によれば、ＬＤ４０のカソード、アノードにソレノイド３３ａ，３３ｂを介してバイアス電源（図４のバイアス給電ピン４４ａに接続されたバイアス定電流源３６、およびバイアス給電ピン４４ｂに接続された接地端子）に夫々接続し、かつ差動型の一対のトランジスタ１０３，１０４によってＬＤ４０のカソード、アノードに高周波の変調信号を差動で入力するようにしている。
【００４９】
すなわち、ＬＤ駆動回路１００のトランジスタ１０４がＯＦＦからＯＮ（トランジスタ１０３がＯＮからＯＦＦ）になると、ＬＤ４０に電流が流れ、ＬＤ４０からのレーザ光出力はＯＦＦからＯＮとなる。また、トランジスタ１０４がＯＮからＯＦＦ（トランジスタ１０３がＯＦＦからＯＮ）になると、ＬＤ４０に流れる電流が小さくなり、ＬＤ４０からのレーザ光出力はＯＮからＯＦＦとなる。
【００５０】
このように、ＬＤ駆動回路１００の差動トランジスタ１０３，１０４より出力された変調電気信号は、分布定数回路３０などを通じてＬＤ４０に伝送され、ＬＤ４０において変調電気信号が光変調信号に変換される。ＬＤ４０から発生された光変調信号は、集光レンズ１２によって光ファイバ１８ａに集光され、光ファイバ１８ａを通じて出力される。
【００５１】
つぎに、図５〜図７を用いてキャンパッケージ１および外部基板３００の各構成要素について説明する。図５は、キャップ１３を外した状態におけるキャンパッケージ１および外部基板３００の一部を示す斜視図であり、図６はその平面図である。また、図７は、ステムとピンと台座の配置関係などを示すための図であり、マイクロストリップ差動線路基板４７、ＬＤチップキャリア４８、セラミック基板４９、受光素子５０などの構成品は図示を省略している。
【００５２】
図５〜図７などに示すように、キャンパッケージ１は、複数のピンがマウントされた円板状のステム１０と、Ａｇロウ付けなどによってステム１０の内壁面に垂直に固定される台形柱状の台座１１とから構成される。ステム１０は、各ピンが貫通するための各貫通孔（後述する）が設けられ、これら各貫通孔にはピンを固定する誘電体（後述する）が収容されている。ステム１０は、板金加工やメタルインジェクションモールド加工によって貫通孔を簡単に形成することができるため、比較的安価に製造できる。
【００５３】
グランドを構成するステム１０には、ＬＤ駆動回路１００からの差動の変調電気信号（以下差動高周波信号ともいう）が伝送される一対の高周波信号ピン４１ａ，４１ｂ（高周波用の信号端子）と、これら高周波信号ピン４１ａ，４１ｂの両側に、高周波信号ピン４１ａ，４１ｂを挟むように配される２本のグランドピン４２ａ，４２ｂ（グランド端子）が固定されている。また、ステム１０には、モニタ用の受光素子（例えばホトダイオード、以下ＰＤという）５０の信号伝送のための１本のモニタ信号ピン４３と、ＬＤ４０に対して外部の直流バイアス電流源からバイアス電流を供給する一対のバイアス給電ピン４４ａ，４４ｂが固定されている。ステム１０には、モニタ用のＰＤ５０を搭載するためのＰＤ用チップキャリア４５とがマウントされている。例えば、高周波信号ピン４１ａから図４に示す正相の電流信号Ｉ２が引き抜かれるとともに、高周波信号ピン４１ｂに対して図４に示す電流信号Ｉ２と逆相の電流信号Ｉ１が与えられる。
【００５４】
これらの信号ピンのうち、高周波信号ピン４１ａ，４１ｂは、気密を保ったままステム１０を介して電気信号を通過させるフィードスルー（フィードスルー部１０ｃ）を構成している。これら各高周波信号ピン４１ａ，４１ｂは、硼珪酸ガラスやソーダバリウムガラスなどの材料で構成される誘電体７７に形成されている貫通孔８０ａ、８０ｂを夫々貫通して挿入され、ステム１０に対し気密封止状態で固定されている。誘電体７７はステム１０に設けられた楕円、長円、または繭形の形状をした貫通孔７４に気密封止状態で収容される。例えば、誘電体７７はガラスビーズを溶融固化することによってステム１０に固定されるとともに、各高周波信号ピン４１ａ，４１ｂを固定する。グランドピン４２ａ，４２ｂは、グランドを構成するステム１０の外壁面に圧着および溶接によって固着されている。高周波信号ピン４１ａ，４１ｂ、およびグランドピン４２ａ，４２ｂは、互いに平行になるように配置されている。ガラス製の誘電体７８はステム１０の貫通孔７５に収容されて気密封止状態で固定され、モニタ信号ピン４３は誘電体７８を貫通して気密封止状態で固定される。同様に、ガラス製の誘電体７９ａはステム１０の貫通孔７６ａに収容されて気密封止状態で固定され、バイアス給電ピン４４ａは誘電体７９ａを貫通して気密封止状態で固定される。ガラス製の誘電体７９ｂはステム１０の貫通孔７６ｂに収容されて気密封止状態で固定され、バイアス給電ピン４４ｂは誘電体７９ｂを貫通して気密封止状態で固定される。かくして、高周波信号ピン４１ａ，４１ｂ、グランドピン４２ａ，４２ｂ、モニタ信号ピン４３、およびバイアス給電ピン４４ａ、４４ｂは、ステム１０の突出面１０ｚから、キャンパッケージ１の外部に突出して固定される。このピンの固定構造は、ガラス製の誘電体を用いることによって、比較的安価に製造することができる。ＰＤ用チップキャリア４５上にマウントされたＰＤ５０は、ＬＤ４０から後方に出射されるモニタ光をモニタするためのものである。
【００５５】
ステム１０に対し台座１１がほぼ垂直に配設されている。台座１１の上面には、マイクロストリップ差動線路基板４６，４７と、ＬＤ用チップキャリア４８と、バイアス回路用基板４９とが搭載されている。台座１１とステム１０とは表面全体に導電性のメッキが施されている。マイクロストリップ差動線路基板４６，４７やＬＤ用チップキャリア４８の裏面に形成され接地導体層となる平面導体板（以下ベタグランドと呼ぶ）が、台座１１の上面に半田接合され電気的に接続されている。また、台座１１は、ＬＤ４０等から発生する熱の放熱経路になっている。
【００５６】
マイクロストリップ差動線路基板４６は、セラミック基板５１と、セラミック基板５１の上面に形成された一対のストリップ差動信号線５２ａ，５２ｂと、セラミック基板５１の裏面に形成されたベタグランド（図示せず）で構成されている。ストリップ差動信号線５２ａ，５２ｂの一端側には、ステム１０から突出された高周波信号ピン４１ａ，４１ｂと接触させて半田付けするためのパッド５３ａ，５３ｂが形成されている。ストリップ差動信号線５２ａ，５２ｂは、小型化のために特性インピーダンスが低く設定された高周波信号ピン４１ａ，４１ｂによる影響を少なくするために、ステム１０に近い入力側の部分５２ｄ（図６）では特性インピーダンスが高くなるよう信号線間隔が大きく設定されている。また、ストリップ差動信号線５２ａ，５２ｂは、信号線間隔が徐々に接近する部分と、間隔が接近して平行に配置される出力側部分とを有している。ステム１０にマウントされる高周波信号ピン４１ａ，４１ｂの端部は、図７に示すように、マイクロストリップ差動線路基板４６のパッド５３ａ，５３ｂにロウ付けまたは半田付けによって接続固定されている。
【００５７】
マイクロストリップ差動線路基板４７は、セラミック基板５５と、セラミック基板５５の上面に形成された一対のストリップ差動信号線５６ａ，５６ｂと、セラミック基板５５の裏面に形成されたベタグランド（図示せず）で構成されている。ストリップ差動信号線５６ａ，５６ｂは、信号線方向を略９０度折り曲げるためのコーナーカーブ部を有している。ストリップ差動信号線５６ａ，５６ｂの途中には、インピーダンス整合用の抵抗３１ａ，３１ｂ（図４参照）がそれぞれ形成されている。ストリップ差動信号線５２ａ，５２ｂと、ストリップ差動信号線５６ａ，５６ｂとは、ワイヤボンド５７ａ，５７ｂによってそれぞれ接続されている。
【００５８】
ＬＤ用チップキャリア４８は、セラミック基板５８と、セラミック基板５８の上面に形成された一対のストリップ差動信号線５９ａ，５９ｂと、セラミック基板５８の裏面に形成されたベタグランド（図示せず）で構成されるマイクロストリップ差動線路を有し、一方のストリップ差動信号線５９ｂ上にＬＤ４０の一方の電極であるアノードが直接当接するように、ＬＤ４０が搭載されている。ＬＤ４０の他方の電極としてのカソードは、ワイヤボンド６０によって他方のストリップ差動信号線５９ａに接続されている。ストリップ差動信号線５６ａ，５６ｂと、ストリップ差動信号線５９ａ，５９ｂとは、ワイヤボンド６１ａ，６１ｂによってそれぞれ接続されている。セラミック基板５８は、熱伝導性の良い窒化アルミ（ＡｌＮ）や炭化シリコン（ＳｉＣ）などの材料から構成されている。ＬＤ４０としては、１０Ｇｂ／ｓの変調が可能な、例えば分布帰還型のレーザダイオード素子が用いられている。なお、ここではＬＤチップキャリア４８とマイクロストリップ線路基板を分離して、抵抗３１ａ、３１ｂの製作で発生するコストを低減させる構成を示したが、一体化しても良い。
【００５９】
バイアス回路用（セラミック）基板４９上には、２本の配線パターン６２ａ，６２ｂと一対のインダクタンス回路（ソレノイド及び共振防止抵抗の並列回路）が形成されている。一方の配線パターン６２ａには、空芯ソレノイド３３ａおよび空芯ソレノイド３３ｂの線間容量とインダクタンスとの共振を防止する共振防止抵抗３４ａが電気的に並列接続されるように配置され、他方の配線パターン６２ｂには、同様に、空芯ソレノイド３３ｂおよび共振防止抵抗３４ｂとが電気的に並列接続されるように配置されている。空芯ソレノイド３３ａおよび空芯ソレノイド３３ｂは互いの磁界が干渉しないように、各ソレノイド３３ａ，３３ｂの中心軸（の延長線）が交差するように、好ましくは直交するように、離間配置されている。２本の配線パターン６２ａ，６２ｂの一方の各端部は、ＬＤ用チップキャリア４８のストリップ差動信号線５９ａ，５９ｂとワイヤボンド３５ａ，３５ｂを介して接続されており、配線パターン６２ａ，６２ｂの他方の端部は、ワイヤボンド６３ａ，６３ｂを介してステム１０に設けられるバイアス給電ピン４４ａ，４４ｂに接続される。
【００６０】
つぎに、外部基板３００側の構成について説明する。外部基板３００には、前述したように、ＬＤ４０を差動駆動するＬＤ駆動回路１００と、このＬＤ駆動回路１００とステム１０に設けられた一対の高周波信号ピン４１ａ，４１ｂおよび一対のグランドピン４２ａ，４２ｂとを接続するマイクロストリップ差動線路基板７０とが設けられている。
【００６１】
マイクロストリップ差動線路基板７０は、ガラスエポキシ基板７３の上面に形成された一対のストリップ差動信号線７１ａ，７１ｂと、この一対のストリップ差動信号線７１ａ，７１ｂを挟むようにストリップ差動信号線７１ａ，７１ｂの外側に配置されるグランド７２ａ，７２ｂと、ガラスエポキシ基板７３の裏面または中間層に配置されてグランド７２ａ，７２ｂに接続されるベタグランド（図示せず）とから構成されている。ストリップ差動信号線７１ａ，７１ｂの一端側には、ステム１０の突出面１０ｚから突出された高周波信号ピン４１ａ，４１ｂと接触させてロウ付けまたは半田付けするためのパッド３０１ａ，３０１ｂが形成されており、高周波信号ピン４１ａ，４１ｂの端部は、マイクロストリップ差動線路基板７０のパッド３０１ａ，３０１ｂにロウ付けまたは半田付けによって接続固定されている。
ストリップ差動信号線７１ａ，７１ｂの途中には、互いの信号線から離間するように突出された特性インピーダンスが他の線路部分より低いスタブ３０２ａ，３０２ｂが形成されている。また、パッド３０１ａ，３０１ｂとスタブ３０２ａ，３０２ｂとの間には、半田レジストや半田の濡れ性の悪い金属を表面層とした半田流れ止め部１０００ａ，１０００ｂを設けて、半田流れ止め部１０００ａ，１０００ｂとスタブ３０２ａ，３０２ｂとの間に半田が流れることを防止している。
【００６２】
パッド３０１ａ，３０１ｂからスタブ３０２ａ，３０２ｂに向かって、ストリップ差動信号線７１ａ，７１ｂの間隔が狭くなっている。すなわち、ストリップ差動信号線７１ａ，７１ｂは、スタブ３０２ａ，３０２ｂよりＬＤ駆動回路１００側に位置する部分３０４では、スタブ３０２ａ，３０２ｂよりステム１０側に位置する部分３０５よりも特性インピーダンスが低くなるよう信号線間隔を小さく設定されており、このようなスタブ３０２ａ，３０２ｂの配置および信号線間隔の調整によって、高周波信号ピン４１ａ，４１ｂなどから反射が発生しないように、各部分の特性インピーダンスを変化させている。
【００６３】
マイクロストリップ差動線路基板７０のグランド７２ａ，７２ｂは、ステム１０に設けられたグランドピン４２ａ，４２ｂに接続固定されている。なお、マイクロストリップ差動線路基板４６、マイクロストリップ差動線路基板４７、およびマイクロストリップ差動線路基板７０における、それら基板上のストリップ差動信号線（７１ａ、７１ｂ、５２ａ、５２ｂ、５６ａ、５６ｂ）と、高周波信号ピン４１（４１ａ、４１ｂ）とは、分布定数線路３０を構成している。また、マイクロストリップ差動線路基板７０のグランド７２ａ，７２ｂは、ステム１０に設けられたグランドピン４２ａ，４２ｂに接続固定されている。なお、マイクロストリップ差動線路基板４６およびマイクロストリップ差動線路基板４７における、それら基板上のストリップ差動信号線（５２ａ、５２ｂ、５６ａ、５６ｂ）は、モジュール内部（キャンパッケージ１内部）の分布定数線路３０ｂを構成している。ストリップ差動信号線５２ａ，５２ｂ、およびストリップ差動信号線５６ａ，５６ｂは、夫々分布定数線路３０ｂの第１、第２の導体線路を構成する。
【００６４】
図６に示すように、ＬＤ駆動回路１００内のトランジスタ１０３（図４参照）のコレクタに接続される逆相信号Ｉ１の出力端子３１０は、ワイヤボンド３２０を介して一方のストリップ差動信号線７１ｂに接続されている。ＬＤ駆動回路１００内のトランジスタ１０４（図４参照）のコレクタに接続される正相信号Ｉ２の出力端子３１１は、ワイヤボンド３２１を介して一方のストリップ差動信号線７１ａに接続されている。ＬＤ駆動回路１００内の抵抗１０６が接続される端子３１２はワイヤボンド３２２を介してグランド７２ｂに接続され、ＬＤ駆動回路１００内の抵抗１０７が接続される端子３１３はワイヤボンド３２３を介してグランド７２ａに接続されている。
なお、オープンコレクタ型のＬＤ駆動回路の場合は、駆動能力を上げるためにコレクタ側に正電圧をかける場合がある。この場合は、端子３１２，３１３がワイヤボンド３２２，３２３を介して図示しないコンデンサの一方の電極に接続され、コンデンサの他方の電極はグランド７２ｂ，７２ａ上に半田付けされる。また、端子３１２，３１３は正電極Ｖｃｃ（図示せず）に接続される。
【００６５】
このように、図４に示したＬＤ駆動回路１００の差動トランジスタ１０３，１０４から出力される差動高周波信号は、図５および図６に示すように、マイクロストリップ差動線路基板７０を介してキャンパッケージ１に入力される。
【００６６】
一般にＬＤ駆動回路１００は、夫々の出力端子３１０、３１１がＬＤ駆動回路１００の有する特性インピーダンスに対してインピーダンス整合するよう設計されている場合が多い。したがって、ＬＤ駆動回路１００を差動形式で動作させて、その出力端子３１０、３１１を差動線路に接続する場合は、例えば接続される差動線路７１ａ、７１ｂの特性インピーダンスを１００Ωで設計することが望ましい。
【００６７】
しかし、ステム１０のフィードスルー部１０ｃにおける高周波信号ピン４１ａ、４１ｂ間の特性インピーダンスを仮に１００Ωとした場合、高周波信号ピン４１ａ、４１ｂの間隔が差動線路７１ａ、７１ｂの間隔よりも大きく広がり、高周波信号ピン４１ａ、４１ｂを内包するフィードスルー部１０ｃの誘電体７７の外形もそれに応じて大きくなる。このため、誘電体７７を収容するステム１０の外径が拡大し、光半導体装置の小型化を妨げることになる。また、誘電体７７が大きくなることにより、誘電体７７の気密封止の歩留まりが低下する等の不都合が生じる。このため、例えば高周波信号ピン４１ａ、４１ｂ間の特性インピーダンスを６０Ω程度にするなど、この特性インピーダンスをＬＤ駆動回路１００の出力端子３１０、３１１の特性インピーダンスよりも下げることによって、誘電体７７およびステム１０の小型化を図っている。
【００６８】
一方、高周波信号ピン４１ａ、４１ｂの相互の間隔や夫々のピン直径が、ステム１０とマイクロストリップ差動線路基板７０の間に形成される空間に配置される部分と、フィードスルー内に配置される部分とで同じ大きさとなる場合には、高周波信号ピン４１ａ、４１ｂの特性インピーダンスが略１４０Ω程度になることが多い。かくして、マイクロストリップ差動線路基板７０にスタブ３０２ａ、３０２ｂを設けて、ＬＤ駆動回路１００側から見れば特性インピーダンスが１００Ωに近くなるようにインピーダンス整合を取ることによって、フィードスルー部分からの反射波の発生を極力抑えている。
【００６９】
しかるに、ステム１０に固着された高周波信号ピン４１ａ、４１ｂとマイクロストリップ差動線路基板７０との半田接合において、接合後の機械的、または熱的なストレスを緩和するには、高周波信号ピン４１ａ、４１ｂに上述の特許文献２に示される態様の屈曲構造を設けて、高周波信号ピン４１ａ、４１ｂとマイクロストリップ差動線路基板７０の接合面との間で、マイクロストリップ差動線路基板７０の板厚方向にある程度の空間２０１を設ける必要がある。ここでは、図７に示すように、高周波信号ピン４１ａ、４１ｂにおけるステム１０側とマイクロストリップ差動線路基板７０側との間の２箇所で、互いに逆方向に折れ曲がって屈曲構造を形成するように屈曲部２００が設けられる。屈曲部２００は、高周波信号ピン４１ａ、４１ｂにおけるステム側の軸線方向とマイクロストリップ差動線路基板７０側の軸線方向とが概ね平行となるように二度折れ曲がっている。屈曲部２００は組立時の寸法公差によってその位置がばらつくため、高周波信号ピン４１ａ、４１ｂとマイクロストリップ差動線路基板７０との接合部の位置が、ステム１０の突出面１０ｚに対して、高周波信号ピン４１ａ、４１ｂの軸線方向にばらつく。このため、高周波信号ピン４１ａ、４１ｂとマイクロストリップ差動線路基板７０の間に設けた空間２０１の長さが製造される個体毎に異なってばらついてしまう。また、屈曲部を曲げ加工するためには、屈曲部２００を形成している高周波信号ピン４１ａ、４１ｂの軸方向の長さＬは少なくとも１ｍｍ程度必要となる。このため、高周波信号ピン４１ａ、４１ｂの空走部分の長さＬ２は、マイクロストリップ差動線路基板７０の端面とステム１０の突出面１０ｚと間の空隙２０２を空走する部分に加えて、屈曲部２００によって形成される空間２０１を空走する部分だけ長くなり、これによってインピーダンスがより大きくなる。結果として、高周波信号ピン４１ａ、４１ｂとマイクロストリップ差動線路基板７０との完全なるインピーダンス整合を成すことは不可能となり、フィードスルー付近においてある程度の反射波が発生することになる。
【００７０】
また、キャンパッケージ１の内部（ステム１０の台座１１側）においても、高周波信号ピン４１ａ、４１ｂからマイクロストリップ差動線路４６を経由し、整合抵抗付きのマイクロストリップ差動線路４７を介して、ＬＤチップキャリア４８に搭載されるＬＤ４０に高周波電力を給電する。高周波信号ピン４１ａ、４１ｂとマイクロストリップ差動線路４７の間の信号伝送経路では、反射波を防止するために、適宜特性インピーダンスを変化させ、要するに、ＬＤ駆動回路１００側から見れば分布定数線路３０の特性インピーダンスが１００Ωに近くなるように信号伝送線路に工夫を施すことで、不要な反射波の発生を抑えている。
【００７１】
ここで、以後の説明を簡単にするため、ＬＤ４０と整合抵抗３１ａ、３１ｂ間を接続する信号伝送線路（ストリップ差動信号線５９ａ、５９ｂ、５６ａ、および５６ｂ上の、ＬＤ４０と整合抵抗３１ａ、３１ｂ間の部分）の電気長を短くし、かつ複数本のワイヤボンド６１ａ、６１ｂの短尺化により、高周波の位相がずれないように半導体レーザダイオード４０と整合抵抗３１ａ、３１ｂとを近接して配置する。これによって結果的に、ＬＤ４０と整合抵抗３１ａ、３１ｂを集中定数回路としてみなせるように配置している。
【００７２】
例えば、ＬＤ４０のインピーダンスの等価回路は、抵抗５Ωと並列に容量２ｐＦ程度が接続された回路で表現できる。さらに、チップキャリア４８に活性層を上側にしてＬＤ４０が実装される場合、ワイヤボンド６０の長さがある程度必要なことと、電極パッドを大きく出来ないことから、ワイア本数が１本となることが多い。このため、ワイヤボンド６０をインダクタンス０．７ｎＨ程度のインダクタンス素子として扱うことによって、一般的に、ＬＤ４０は、このインダクタンス要素と、抵抗および容量の並列回路とが、直列に接続された等価回路となる。
【００７３】
ここで、整合抵抗３１ａ、３１ｂの抵抗を夫々２５Ωとした場合、ＬＤ４０の等価回路と、整合抵抗３１ａ、３１ｂと、高周波電源を接続した回路に関して、その高周波電源側からみたスミスチャートは図８のようになる。図８（ａ）は規格化インピーダンス１００オームで表示したスミスチャートを示し、図８（ｂ）は反射量の周波数依存性を示す図である。
図では直流から１０ＧＨｚまでの特性を実線にて示しており、参考のため７ＧＨｚを黒三角で表示している。図より、信号周波数より十分に低い周波数ではＬＤ４０の抵抗と整合抵抗３１ａ、３１ｂの和と規格化インピーダンスとの不整合による反射が発生し、周波数の上昇と共に徐々に反射が増加していることが分る。
【００７４】
従来の光半導体装置では、ＬＤ駆動回路１００に対してインピーダンス整合した、特性インピーダンス１００Ωの分布定数線路で接続されるのが一般的であり、その場合はスミスチャートの中心周りに分布定数線路の電気長に従って高周波成分の反射点が半波長で１回転の割合で回転するが、インピーダンス整合が改善することはない。従って、整合抵抗３１ａ、３１ｂの抵抗成分を大きすることによって、ＬＤ駆動回路１００から見た負荷インピーダンスが大きくすることでインピーダンス整合を改善することが出来るが、ＬＤ４０に対する高周波信号の電力伝達効率は小さくなってしまうという欠点がある。このため、反射減衰量と電力伝達効率（またはＬＤ駆動回路の駆動能力）の兼ね合いを考慮して、整合抵抗３１ａ、３１ｂの抵抗成分を最適化する必要がある。
【００７５】
この最適化の一例として、ＬＤ駆動回路１００側から見た光半導体装置の反射減衰量を、電力スペクトラム密度の大きい５ＧＨｚまでの帯域を中心として、反射量を図８に示したものよりも改善し、効果的な電気特性を得られた事例について図９〜１２を用いて以下に説明する。この例では、伝送レート１０Ｇｂ／ｓのＮＲＺ（Ｎｏｎ ｒｅｔｕｒｎ ｔｏ ｚｅｒｏ）方式の光半導体装置に関して、整合抵抗３１ａ、３１ｂの抵抗値と、モジュール内部の分布定数線路３０ｂの電気長とを種々に変化させたときの反射量について調べた。
【００７６】
図９は、この実施の形態による光半導体装置の高周波特性を説明するための、（ａ）スミスチャートと、（ｂ）反射量の周波数特性とを示す図（差動線路の直後の特性図その１）である。
図において、ＬＤ駆動回路１００の出力インピーダンスは夫々５０Ωであり、整合抵抗３１ａ、３１ｂの抵抗値は２５Ω、信号リード４１ａ、４１ｂの空走部分の特性インピーダンスは１００Ω、ステム１０のフィードスルー部１０ｃの特性インピーダンスは１００Ω、ストリップ差動信号線５２ａ、５２ｂの幅広部分の特性インピーダンスは１００Ωで、幅の変更部分は短く、ワイヤボンド５７ａ、５７ｂは複数本のワイア接続でありインダクタンスは小さいとした。
さらに、ストリップ差動信号線５６ａ、５６ｂの特性インピーダンスを５５Ωとして、周波数７ＧＨｚにおける電気長を１／１６波長、１／８波長、３／１６波長の長さとした時に、ストリップ差動信号線５６ａ、５６ｂの入り口から見た時のスミスチャートと、反射量の周波数特性を示すものである。
【００７７】
図９より、ストリップ差動信号線５６ａ、５６ｂの電気長を７ＧＨｚで１／８波長とした時には、略７ＧＨｚを中心にして反射量が著しく改善され、かつ広い帯域でその改善効果が維持されていることが分る。また、電気長を７ＧＨｚで３／１６波長とした場合は略５ＧＨｚで反射が改善されている。但し、これは電気長が５ＧＨｚに対して略１／８波長に相当するのであって、設計する周波数と電気長との関係は相対的なものである。
【００７８】
従って、低周波においては、整合抵抗３１ａ、３１ｂの抵抗値の和を、ＬＤ駆動回路１００の特性インピーダンスに対して略半分程度の値（５０Ω）として、電力伝達効率と反射特性を適切に設定する。また、例えば７ＧＨｚ付近の高周波においては、分布定数線路３０ｂを構成する差動線路の特性インピーダンス５５Ωの周りに１／８波長分、つまりスミスチャート上で１／４周期回転させることで、インピーダンス整合を実施するのが好適である。これによって、直流から１０ＧＨｚの広帯域に渡り反射量−１０ｄＢ以上が確保される。これは、対策を施さない場合の図８に示した例が５ＧＨｚでの反射量が−１０ｄＢよりも大きくなるのに対して、反射特性を格別に改善する効果がある。
【００７９】
ここでは、分布定数線路３０ｂを構成する差動線路（ストリップ差動信号線５６ａ、５６ｂ）の特性インピーダンス５５Ωの周りに１／８波長分だけ回転させる際の回転中心が５５Ωとなる例を示したが、その回転中心は５５Ωの０．５倍から１．５倍程度の範囲であれば良く、図１０に差動線路の特性インピーダンスが３５Ωの場合（差動線路の直後の特性図その２）を、図１１に差動線路の特性インピーダンスが７５Ωの場合（差動線路の直後の特性図その３）を示す。
【００８０】
図１０（ａ）のスミスチャートと図１０（ｂ）の反射量の周波数特性図に示す通り、差動線路の特性インピーダンスを、半導体素子のインピーダンスと整合抵抗とのインピーダンスの和の０．６倍にすると、高周波帯域で反射が減るようになり、電気長が７ＧＨｚに対して１／１６波長の際に１０ＧＨｚが反射の最小点となる。また、電気長が７ＧＨｚに対して３／１６波長の際に反射がほぼ一定になった後に反射が劣化していくことが分る。これはこのインピーダンス整合の一方の限界を示すものである。
【００８１】
また、図１１（ａ）のスミスチャートと図１１（ｂ）の反射量の周波数特性図から分るように、差動線路の特性インピーダンスを、半導体素子のインピーダンスと整合抵抗とのインピーダンスの和の１．４倍にすると、高周波帯域で反射が減るようになり、電気長が７ＧＨｚに対して１／１６波長の際に反射がほぼ一定となっていることが分る。これはこのインピーダンス整合方法の他方の限界を示すものである。なお、電気長を徐々に長くすると５ＧＨｚ付近での反射が改善していく様子が分るが、これは別の実施例に示す内容と等価であり、この挙動に関する詳細は後述の別の実施例で説明する。
【００８２】
例えば、電力スペクトラムが５ＧＨｚ以下に集中している伝送レート１０Ｇｂ／ｓのＮＲＺ方式のデジタル通信では、５ＧＨｚ以下の反射減衰量をより改善する方が好ましい場合もある。例えば、差動線路５６ａ、５６ｂの電気長を３／１６波長とすれば、略８ＧＨｚで反射量が−１０ｄＢを超えているが、５ＧＨｚまでは特に反射量が低く抑えられている。これとは逆に、デジタル波形の矩形形状を維持したい場合は３倍高調波である１５ＧＨｚまで反射量を小さくしたいという場合がある。このような場合はストリップ差動信号線５６ａ、５６ｂの電気長を７ＧＨｚに対して１／１６波長とすれば改善が図れることが分る。この様にして、比較的に低い整合抵抗３１ａ、３１ｂであるにも関わらず、広帯域に良好な反射量を維持しながら半導体レーザダイオード４０への電力伝達効率を改善することが出来、格別の効果を奏することとなる。
【００８３】
なお、フィードスルー１０ｃは小型化のために特性インピーダンスを６０Ω程度とすることが多いこと、フィードスルーの部分と信号ピン４１ａ、４１ｂの間隔を変えずにグランドピン４２ａ、４２ｂを配置しても空走部分の特性インピーダンスは１４０Ω程度になることが多いことは前述で説明した。これらの特性インピーダンスと電気長の影響が図９のインピーダンス整合に与える影響が最小になるように、ストリップ差動信号線５２ａ、５２ｂの特性インピーダンスは略１４０Ωに設定し、平均として特性インピーダンスを１００Ωに近づけ、また各部の電気長を比較的に短く設定することで位相の回転を抑えるなどして、反射特性の劣化を最小限になるように設計すればよく、電気信号端子の前後に分布定数線路が挿入されていても良く、または電気信号端子自体が分布定数線路を構成しても良い。
【００８４】
図１２は、図９に示した例で各種設定を行った実際の光半導体装置において、信号ピン４１ａ、４１ｂの空走部分の長さを２〜１０ｍｍの間で可変した際の反射特性を示すものである。図に示す通り、略７ＧＨｚ付近で反射量が改善している様子が分る。また、適切なインピーダンス整合が取られているために、空走部分の特性インピーダンス１４０Ωとフィードスルー部１０ｃの特性インピーダンス６０Ωとの平均値が、規格化インピーダンス（１００Ω）から離れ、かつ空走部分がかなり長くなるまで、反射量が十分に改善されて維持されていることが分る。
【００８５】
このような反射量の低減は、高周波信号ピン４１ａ、４１ｂのピン長が５ｍｍとなるまで（ピン長２ｍｍ〜５ｍｍの間で）維持されるので、高周波信号ピン４１ａ、４１ｂの空走部分の長さを長くしても、反射減衰量を低減させることができる。このピン長は、実開平５−２９１５６号公報に記載されるようなストレス緩和構造のための屈曲構造を設けるに十分な長さである。したがって、光半導体装置の高周波信号ピン４１ａ、４１ｂを、マイクロストリップ差動線路基板７０へ容易に取り付けて半田接合することができるため、低コストな光半導体装置を得ることができる。また、光半導体装置の高周波信号ピン４１ａ、４１ｂとマイクロストリップ差動線路基板７０との、半田接合部に生じる機械的、または熱的なストレスを緩和することが可能となって、半田接合部の信頼性が向上する。
【００８６】
以上の図９に示した例により、ＬＤと整合抵抗とを近接して配置し、ＬＤと整合抵抗の抵抗値の和がＬＤ駆動回路のインピーダンスより低く設定され、整合抵抗に接続される分布定数線路の特性インピーダンスが、伝送する信号の周波数帯よりも十分に低い周波数において、ＬＤと整合抵抗との和とほぼ等しいか、もしくはその０．６倍から１．４倍の範囲として、
かつ、分布定数線路の電気長を伝送する信号の周波数帯における、略１／１６波長〜３／１６波長の長さとすることによって、ＬＤとＬＤ駆動回路との間で高周波信号の電力伝達効率を必要以上に落とすことなく、広帯域に反射波を低減することが出来、かつ、信頼性が高くて、またコストの安い光半導体装置が提供できる。
【００８７】
次に、図１３は、この発明の別の実施の一例を説明する（ａ）スミスチャートと、（ｂ）反射量の周波数特性を示す図である。ここでは、分布定数線路３０ｂを構成するストリップ差動信号線５６ａ、５６ｂの特性インピーダンスを、ＬＤ４０の抵抗５Ωと抵抗３１ａ、３１ｂの夫々２５Ωの和である５５Ωと、規格化インピーダンス１００Ωとの中間である略７４Ωとし、電気長を７ＧＨｚに対して１／８波長、１／４波長、３／８波長として回転させたものである。
【００８８】
従って、図８で例示したスミスチャートにおいてインダクタンス性を有していた７ＧＨｚ付近の反射点は、図１３では例えば電気長が７ＧＨｚに対して１／４波長の場合、７４Ωを中心に１８０度回転して規格化インピーダンス付近で容量性を示す位置に変換されている。
【００８９】
別の見方をすれば略５ＧＨｚに対して１／８波長に近い電気長になっている。従って、図９の例との違いは、図９の例において線路の電気長が３／１６波長の場合と同じく５ＧＨｚにて反射の最小点があるが、スミスチャートにおける回転中心が規格化インピーダンス（１００Ω）に近いので、最小点における整合がより改善される点に格別の効果がある。この効果は、程度の差こそあれ３／８波長でも維持されている。また、分布定数線路３０ｂ（特に、ストリップ差動信号線５６ａ、５６ｂ）の特性インピーダンスが、図９の例で使用するものよりも図１３の例の方が高いので、より幅の狭い線路を構成することができ、幅の制約が厳しい時に有効である。一方、図９のものより図１３のものは電気長、または実際の長さが長くなるので、線路を長くしたい時に有効である。
【００９０】
以上の図１３に示した例により、ＬＤと整合抵抗とを近接して配置し、ＬＤと整合抵抗の抵抗値の和がＬＤ駆動回路のインピーダンスより低く設定され、整合抵抗に接続される分布定数線路の特性インピーダンスが、ＬＤと整合抵抗との和と、ＬＤ駆動回路のインピーダンスとの中間であって、分布定数線路の電気長を略１／８波長〜３／８波長の長さとすることによって、ＬＤとＬＤ駆動回路との間で、高周波信号の電力伝達効率を必要以上に落とすことなく、広帯域に反射波を低減することが出来、かつ、信頼性が高くて、またコストの安い、より好適な光半導体装置が提供できる。
【００９１】
次に、図１４はこの発明のさらに別の実施の一例を説明する（ａ）スミスチャートと、（ｂ）反射量の周波数特性を示す図である。ここでは、図９と同じく特性インピーダンス５５Ω、図９に例示した電気長が７ＧＨｚで１／８波長のストリップ差動信号線５６ａ、５６ｂを接続した後で、この７ＧＨｚにおけるインピーダンス（５５Ω）と規格化インピーダンス（１００Ω）の中間のインピーダンスである９４Ωを有し、電気長が１／４波長のストリップ差動信号線５２ａ、５２ｂを設けたものである。図より、設計波長である７ＧＨｚ付近において非常に良好なインピーダンス整合が取られていることが分る。図９で例示したストリップ差動信号線５６ａ、５６ｂ（５５Ω）で７ＧＨｚのインピーダンス整合がかなり良く取れているために、図１４では効果が小さく見えている。しかし、この実施例は最初の差動線路５６ａ、５６ｂのインピーダンス整合が十分でないときには格別の効果を奏する。なお、この効果は、ストリップ差動信号線５６ａ、５６ｂとして１／１６波長〜３／１６波長、ストリップ差動信号線５２ａ、５２ｂとして１／８波長〜３／８波長の範囲で選定しても維持される。
【００９２】
以上の図１４に示した例により、ＬＤと整合抵抗とを近接して配置し、ＬＤと整合抵抗の抵抗値の和がＬＤ駆動回路のインピーダンスより低く設定され、整合抵抗に接続されるストリップ差動信号線５６ａ、５６ｂ（第１の分布定数線路）の特性インピーダンスが、ＬＤと整合抵抗との和とほぼ同じであって、第１の分布定数線路の電気長を略１／１６波長〜３／１６波長の長さとして、
かつ、信号端子と第１の分布定数線路との間に接続されるストリップ差動信号線５２ａ、５２ｂ（第２の分布定数線路）の特性インピーダンスが、ＬＤと整合抵抗との和と、ＬＤ駆動回路のインピーダンスとの中間であって、第２の分布定数線路の電気長を略１／１８波長〜３／８波長の長さとすることによって、
ＬＤとＬＤ駆動回路との間で、高周波信号の電力伝達効率を必要以上に落とすことなく、広帯域に反射波を低減することが出来、かつ、信頼性が高くて、またコストの安い、より好適な光半導体装置が提供できる。
【００９３】
なお、分布定数線路３０ｂは、線路の特性インピーダンスもしくは電気長が適宜に異なるように、さらに複数に分割された伝送線路（ストリップ差動信号線）で構成して、この複数の伝送線路の平均の特性インピーダンスが、分布定数線路３０ｂの特性インピーダンスの、図９、図１３、図１４に夫々例示した所望の条件を満足し、複数の伝送線路の合計の線路長が前記分布定数線路の電気長の、図９、図１１、図１２に夫々例示した所望の条件を満足するように設定されても良い。
【００９４】
以上説明したこの実施の形態では、光半導体素子として、半導体レーザダイオード（半導体発光素子）を用いた例について示したが、レーザダイオード集積型電界吸収形変調器（別の半導体発光素子）を搭載したものでも、ホトダイオード（半導体受光素子）を用いたものでも、プリアンプ内蔵型ホトダイオードでもよく、同様の効果を奏する。
【００９５】
また、回路基板に搭載されるＬＤ駆動回路１００は、ＬＤ駆動回路を用いた例について示したが、変調器駆動回路でも、トランスインピーダンスアンプＩＣであってもよい。
【００９６】
また、ＬＤ駆動回路１００は、キャンパッケージ１内部に搭載されていてもよい。この場合、ＬＤ駆動回路１００の出力端子３１０、３１１が、マイクロストリップ差動線路基板４６のストリップ差動線５２ａ、５２ｂとワイヤボンドを介して直接接続される。このときのストリップ差動線５２ａ、５２ｂは、分布定数線路３０ｂに接続された信号端子と見なしてもよい。
勿論、ＬＤ駆動回路１００の入力端子Ｐ（図４に記載）は、高周波信号ピン（信号端子）４１ａ、４１ｂに接続される。
【００９７】
さらにまた、この実施の形態では差動駆動方式で説明したが、単相駆動方式でもよく、同様の効果を奏する。
【００９８】
【発明の効果】
この発明によれば、光半導体素子の抵抗性分と並列に見える浮遊容量、更には接続のためのワイヤボンドからなる直列インダクタンスを、低周波は整合抵抗で、高周波は整合抵抗に接続される分布定数回路のインピーダンスと電気長とを最適に配置することで、光半導体素子と信号端子との高周波信号の電力伝達効率を必要以上に落とすことなく、広帯域に反射波を低減することができるとともに、低コストな光半導体装置を得ることができる。
【図面の簡単な説明】
【図１】この発明にかかる実施の形態１の光半導体装置に用いられる光半導体用パッケージの外観構成を示す斜視図である。
【図２】この発明にかかる実施の形態１の光半導体装置に用いられる光半導体用パッケージとレセプタクルが接続されたＬＤモジュールの外観構成を示す斜視図である。
【図３】ＬＤモジュールの水平及び垂直断面図である。
【図４】キャンパッケージ内の構成要素およびＬＤ駆動回路の等価回路図である。
【図５】この発明にかかる実施の形態１のキャンパッケージの内部構成および外部基板の一部構成を示す斜視図である。
【図６】この発明にかかる実施の形態１のキャンパッケージの内部構成および外部基板の一部構成を示す平面図である。
【図７】この発明にかかる実施の形態１のステム部分とマイクロストリップ線路との取付け形態の説明図である。
【図８】この発明にかかる実施の形態１の整合抵抗の直後の、（ａ）スミスチャートと、（ｂ）反射特性の周波数依存性を示す図である。
【図９】この発明にかかる実施の形態１の差動線路の直後の、（ａ）スミスチャートと、（ｂ）反射特性の周波数依存性を示す図（その１）である。
【図１０】この発明にかかる実施の形態１の差動線路の直後の、（ａ）スミスチャートと、（ｂ）反射特性の周波数依存性を示す図である。
【図１１】この発明にかかる実施の形態１の差動線路の直後の、（ａ）スミスチャートと、（ｂ）反射特性の周波数依存性を示す図（その２）である。
【図１２】この発明にかかる実施の形態１の光半導体装置の、反射特性の実験結果の一例を示す図（その３）である。
【図１３】この発明にかかる実施の形態２の差動線路の直後の、（ａ）スミスチャートと、（ｂ）反射特性の周波数依存性を示す図である。
【図１４】この発明にかかる実施の形態３の差動線路の直後の、（ａ）スミスチャートと、（ｂ）反射特性の周波数依存性を示す図である。
【符号の説明】
１ 光半導体用パッケージ（キャンパッケージ）、２ レセプタクル、３ 光半導体素子モジュール（ＬＤモジュール）、１０ ステム、１０ａ 第１ステム部材、１０ｂ 第２ステム部材、１０ｚ ステム外壁面、１１ 台座、１２ 集光レンズ、１３ キャップ、１３ａ 第１キャップ部材、１３ｂ 第２キャップ部材、１４ 孔、１５ 内部空間、１６ ウィンドウ、１７ 孔、１８ ダミーフェルール、１８ａ 光ファイバ、１９ フェルール挿入孔、２０ 光ファイバ、２１ フェルール、３０、３０ｂ 分布定数回路、３１ａ，３１ｂ 整合抵抗、３３ａ，３３ｂ ソレノイド（空芯ソレノイド）、３４ａ，３４ｂ 共振防止抵抗、３５ａ，３５ｂ ワイヤボンド、３６ バイアス定電流源、４０ 半導体レーザダイオード（ＬＤ）、４１ａ，４１ｂ 高周波信号ピン、４２ａ，４２ｂグランドピン、４３ モニタ信号ピン、４４ａ，４４ｂ バイアス給電ピン、４５ ＰＤ用チップキャリア、４６，４７ マイクロストリップ差動線路基板、４６ｂ グランデッドコプレナ差動線路、４８ ＬＤ用チップキャリア、４９ バイアス回路用基板、５０ ホトダイオード（ＰＤ）、５２ａ，５２ｂ，５２ｅ，５２ｆ ストリップ差動信号線、５３ａ，５３ｂ パッド、５４ａ，５４ｂ スタブ、５６ａ，５６ｂ ストリップ差動信号線、５７ａ，５７ｂ ワイヤボンド、５９ａ，５９ｂ ストリップ差動信号線、６０ ワイヤボンド、６１ａ，６１ｂ ワイヤボンド、６２ａ，６２ｂ 配線パターン、６３ａ，６３ｂ ワイヤボンド、７０ グランデッドコプレナ差動線路、７１ａ，７１ｂ 差動信号線、７２ａ，７２ｂ グランド、７７，７８，７９ａ，７９ｂ 誘電体、８０ａ，８０ｂ 貫通孔、１００ ＬＤ駆動回路（集積回路）、１０１ 外部基板、１０２入力バッファ、１０３，１０４ トランジスタ（差動トランジスタ）、１０５トランジスタ（バイアス定電流源）、３００ 集積回路用基板（外部基板）、３０１ａ，３０１ｂ パッド、３０２ａ，３０２ｂ スタブ、４１１ａ，４１１ｂ 屈曲部、１０００ａ，１０００ｂ 半田流れ止め部。
【発明の属する技術分野】
この発明は、光半導体素子と、当該光半導体素子との間で電気信号を伝送する信号端子を有し、Ｇｂ／ｓ（ギガビット／秒）以上の速度で光信号の伝送が可能な光半導体装置に関するものである。
【０００２】
【従来の技術】
従来の光半導体装置として、ホトダイオード（光半導体素子）と、プリアンプＩＣと、ピン形状の信号端子（信号ピン）と、信号端子の貫通するフィードスルーを備えたパッケージと、グランド強化のため前記信号端子を挟むように配設された一対のグランド端子を備えたものが開示されている（例えば、特許文献１参照）。
【０００３】
【特許文献１】
特開平１１−２３１１７３号公報（第２−５頁、図２、図４、図５）
【０００４】
特許文献１には、フィードスルー部のみの特性としては最適な設計を実施すれば２０ＧＨｚまで反射波を低減できることが開示され、また、信号端子とプリアンプＩＣとを接続する僅か０．５ｍｍのボンディングワイアで帯域が１７ＧＨｚになることが開示されている。また、その光半導体装置に突設された信号端子を、電子回路（ＩＣ）の搭載された基板（回路基板）の導体パターンに接合する際、信号端子と導体パターンの接合面との間に空隙を設けることなく実装する例が示されている。
【０００５】
光半導体装置の信号端子を基板に固定する場合、光半導体装置と回路基板の熱膨張係数の違いからストレスが発生する。このストレスを緩和して、半田部の破損を防止するために、一般には信号端子に屈曲構造を設けるなどの工夫が必要である（例えば、特許文献２参照）。この方法は、比較的に信号線路の特性インピーダンス変化を小さく出来るので、高周波用途でも使用される。
【０００６】
【特許文献２】
実開平５−２９１５６号公報（第６頁、図１）
【０００７】
しかし、このような屈曲構造を設けた場合、光半導体装置における信号端子の屈曲部分と回路基板との間に空隙が発生し、結果として特性インピーダンスの差異を生じてしまう。このため、信号端子では一定量の反射波が発生する。
【０００８】
別の光半導体装置と回路基板としては、光半導体装置の信号端子と回路基板上の導体パッドとを細いボンディングワイアで接続する例がある（例えば、特許文献３参照）。
【０００９】
しかし、特性インピーダンス変化が大きく、また、信号端子がスタブのように振る舞うなど、高周波帯では反射特性の劣化があるため、比較的に低い周波数の信号伝送用に限られて使用されている。
【００１０】
【特許文献３】
特開平６−３４３０５８号公報（第３−６頁、図２３）
【００１１】
一方、従来の光半導体装置において、光半導体素子（この例では半導体レーザダイオード）付近で生じる電気的な反射波が、光半導体素子の駆動電流波形を劣化させ、結果として光出力波形を劣化することが知られている。このため、光半導体素子と並列に抵抗を入れる方法や、光半導体素子と並列に抵抗と容量の直列回路を入れる方法が開示されている（例えば、特許文献４参照）。
【００１２】
【特許文献４】
特開平９−２００１５０号公報（第２−５頁、図２）
【００１３】
また、信号端子と光半導体素子との接続にマイクロストリップ線路などの分布定数線路を利用する構造が用いられているが、例えば信号端子で発生する反射波や、光半導体素子で発生する反射波の与える影響についてまでは言及されてない（例えば、特許文献５参照）。
【００１４】
【特許文献５】
特開平１−１９２１８８号公報（第２−３頁、図１）
【００１５】
また、アナログ通信の用途では、限られた複数の周波数帯のみで光半導体素子への電力伝達効率を上げれば良い。従来の光半導体装置として、半導体レーザダイオードと接続された１０Ω以下の直列抵抗と、信号端子と、その間に配設されたマイクロストリップ線路とワイヤボンドとを含むインピーダンス整合回路とを備えることが開示されている（例えば、特許文献６、並びに特許文献７参照）。しかし、インピーダンス整合回路として、インダクタンス素子や容量素子を組合せたものの開示があるのみで、デジタル通信に利用できるような広帯域のインピーダンス整合を与えるものではなかった。
【００１６】
【特許文献６】
特開平９−３０７１６９号公報（第２−５頁、図１０）
【００１７】
【特許文献７】
実開平１０−７５００３号公報（第２−６頁、図１）
【００１８】
また、４０Ｇｂ／ｓ以上の高速光信号を伝送する通信用の光半導体装置に関して、電界吸収型変調素子の給電線路に開放型スタブを設け、５９．６ＧＨｚを中心とした急峻な反射減衰特性を有するインピーダンス整合回路が開示されている（例えば、特許文献８参照）。しかし、開放型スタブを２段直列に設けた整合回路を用いて急峻な反射特性を与えることができるものの、デジタル通信に利用できるような広帯域のインピーダンス整合を与えるものではない。
【００１９】
【特許文献８】
実開平１１−３８３７２号公報（第２−６頁、図４）
【００２０】
【発明が解決しようとする課題】
従来技術に示すように、光半導体装置に突設された信号端子を回路基板の導体パターンと接合する際、信号端子と導体パターンの接合部周辺に屈曲構造を設けずに、信号端子における導体パターンとの非接触部分（信号端子の空走部分）の長さを短くすることにより、光半導体装置と回路基板との電気的な反射が生じにくくなる。しかし、このような構造では、光半導体装置と回路基板との間の接合部に機械的、または熱的なストレスが発生する。また、信号端子の空走部分の長さが短くなるように、信号端子の突出面を回路基板に近接配置して半田接合することによって、信号端子の接合時の組立精度が厳しくなり製造コストが高くなる。
【００２１】
一方、光半導体装置と回路基板を電気的に接続する信号端子の接合部において、機械的、または熱的なストレスを低減して信頼性の高い接合を得るためには、信号端子に屈曲構造を設ける必要がある。しかし、信号端子に屈曲構造を設けることによって、屈曲部において光半導体装置の信号端子と回路基板の導体パターン面との間に空隙が生じ、信号端子の空走部分の長さがより長くなって、信号端子付近からの反射が発生するという課題があった。
【００２２】
また、デジタル通信の分野では、広帯域に渡って光半導体素子と回路基板上の電子回路（集積回路）との電力伝達効率を上げる必要がある。しかし、インピーダンス整合を広帯域に渡って完全に行うことはできないため、結果として光半導体素子付近からの反射が発生するという課題があった。アナログ通信用途では、複雑なインピーダンス整合を行なう技術もあるが、広帯域の通過特性や反射特性が求められるデジタル通信には利用できない。
【００２３】
この発明は、上記に鑑みてなされたものであり、光半導体素子と、光半導体素子の信号端子に接続される回路基板との電力伝達効率が良く、広帯域に渡って光半導体素子と信号端子との反射が少なく、かつ、低コストな光半導体装置を得ることを目的とする。
【００２４】
【課題を解決するための手段】上記目的を達成するため、この発明にかかる光半導体装置は、
一対の電極を有する光半導体素子と、
前記光半導体素子の電極と一端が直列接続されるインピーダンス整合用の抵抗と、
前記抵抗の他端と一端が接続される分布定数線路と、
前記分布定数線路の他端と一端が接続される信号端子とを備え、
前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和が、前記信号端子に接続される電気回路のインピーダンスよりも小さく、
かつ前記分布定数線路の特性インピーダンスが、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和とほぼ等しいか、もしくはその０．６倍から１．４倍の範囲であって、
かつ前記分布定数線路の電気長が伝送する信号の周波数における略１／１６波長〜略３／１６波長の長さとしたものである。
【００２５】
また、この発明による係る光半導体装置は、
一対の電極を有する光半導体素子と、
前記光半導体素子の夫々の電極に、夫々一端が接続されるインピーダンス整合用の第１、第２の抵抗と、
差動線路を構成する第１、第２の導体線路を有し、当該夫々の導体線路の一端が前記第１、第２の抵抗の他端と夫々接続された分布定数線路と、
前記分布定数線路の第１、第２の導体線路における他端に、夫々一端が接続された第１、第２の信号端子とを備え、
前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和が、前記第１、第２の信号端子とそれぞれ接続された第１、第２の電気回路のインピーダンスの和より小さく、
かつ前記分布定数線路における差動線路の特性インピーダンスが、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和とほぼ等しいか、もしくはその０．６倍から１．４倍の範囲であって、
かつ前記分布定数線路における差動線路の夫々の電気長が伝送する信号の周波数における１／１６波長〜３／１６波長としたものである。
【００２６】
また、この発明による係る光半導体装置は、
一対の電極を有する光半導体素子と、
前記光半導体素子の電極と一端が直列接続されるインピーダンス整合用の抵抗と、
前記抵抗の他端と一端が接続される分布定数線路と、
前記分布定数線路の他端と一端が接続される信号端子とを備え、
前記光半導体素子のインピーダンスと前記抵抗のインピーダンスの和が前記信号端子と接続される電気回路のインピーダンスよりも小さく、
かつ前記分布定数線路の特性インピーダンスは、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和と、前記電気回路のインピーダンスとの中間であり、
かつ前記分布定数線路の電気長が伝送する信号の周波数における略１／８波長〜３／８波長の長さとしたものである。
【００２７】
また、この発明による係る光半導体装置は、
一対の電極を有する光半導体素子と、
前記光半導体素子の夫々の電極に、夫々一端が接続されるインピーダンス整合用の第１、第２の抵抗と、
差動線路を構成する第１、第２の導体線路を有し、当該夫々の導体線路の一端が前記第１、第２の抵抗の他端と夫々接続された分布定数線路と、
前記分布定数線路の第１、第２の導体線路における他端に、夫々一端が接続された第１、第２の信号端子とを備え、
前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和が、前記第１、第２の信号端子と夫々接続された第１、第２の電気回路のインピーダンスの和より小さく、
かつ前記分布定数線路における差動線路の特性インピーダンスは、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和と、前記第１および第２の電気回路のインピーダンスの和との中間であり、
かつ前記分布定数線路における差動線路の夫々の電気長が伝送する信号の周波数における略１／８波長〜３／８波長の長さとしたものである。
【００２８】
また、この発明による係る光半導体装置は、
一対の電極を有する光半導体素子と、
前記光半導体素子の電極と一端が直列接続されるインピーダンス整合用の抵抗と、
前記抵抗の他端と一端が接続される第１の分布定数線路と、
前記第１の分布定数線路と一端が接続される第２の分布定数線路と、
前記第２の分布定数線路の他端と一端が接続される信号端子とを備え、
前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和が前記信号端子に接続される電気回路のインピーダンスよりも小さく、
かつ前記第１の分布定数線路の特性インピーダンスが、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和とほぼ等しく、
かつ前記第１の分布定数線路の電気長が伝送する信号の周波数における略１／１６波長〜３／１６波長の長さであり、
かつ前記第２の分布定数線路の特性インピーダンスが、伝送する信号の周波数において前記第１の分布定数線路の特性インピーダンスと、前記電気回路のインピーダンスとの中間であり、
かつ前記第２の分布定数線路の電気長が伝送する信号の周波数における略１／８〜略３／８波長の長さとしたものである。
【００２９】
また、この発明による係る光半導体装置は、
一対の電極を有する光半導体素子と、
前記光半導体素子の夫々の電極に、夫々一端が接続されるインピーダンス整合用の第１、第２の抵抗と、
差動線路を構成する第１、第２の導体線路を有し、当該夫々の導体線路の一端が前記第１、第２の抵抗の他端と夫々接続された第１の分布定数線路と、
差動線路を構成する第３、第４の導体線路を有し、当該夫々の導体線路の一端が前記第１、第２の導体線路の他端と夫々接続された第２の分布定数線路と、
前記分布定数線路の第３、第４の導体線路における他端に、夫々一端が接続された第１、第２の信号端子とを備え、
前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和が、前記第１、第２の信号端子と夫々接続された第１、第２の電気回路のインピーダンスの和より小さく、
かつ前記第１の分布定数線路における差動線路の特性インピーダンスが、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和とほぼ等しく、かつ前記第１の分布定数線路における差動線路の夫々の電気長が伝送する信号の周波数における１／１６波長〜３／１６波長の長さであり、
かつ前記第２の分布定数線路における差動線路の特性インピーダンスが、伝送する信号の周波数において前記第１の分布定数線路の差動線路の特性インピーダンスと前記第１および第２の電気回路のインピーダンスの和との中間であり、
かつ前記第２の分布定数線路における差動線路の夫々の電気長が伝送する信号の周波数における略１／８波長〜略３／８波長の長さとしたものである。
【００３０】
【発明の実施の形態】
以下に添付図面を参照して、この発明にかかる光半導体装置の好適な実施の形態を詳細に説明する。
この実施の形態の光半導体装置は、光半導体素子の浮遊容量やワイヤボンド配線などで発生するインダクタンス成分によるインピーダンス変化を、整合用の抵抗を集中定数的に近接して配置し、分布定数線路の特性インピーダンスと電気長とを適宜に設定することにより、そのインピーダンスを信号入力もしくは出力端子のインピーダンスと広帯域にインピーダンス整合し、光半導体素子と信号入力もしくは出力端子との電力伝達効率が広帯域に渡ってよく、反射が少なく、かつ、低コストな光半導体装置を供する。
【００３１】
この実施の形態の光半導体装置は、例えば、ビル内に設置されたサーバ間の接続、異なるビルに設置されたサーバ間の接続などのローカルエリアネットワーク、またはデジタル通信網の幹線系に適用される。
【００３２】
実施の形態１．
図１〜図１２に従って、この発明の実施の形態１の光半導体集積回路について説明する。
この実施の形態１の光半導体集積回路には、安価なキャンパッケージ型のモジュール形態が採用され、パッケージ内には光半導体素子として半導体レーザダイオード（以下ＬＤという）が内蔵されている光半導体素子モジュールと、ＬＤを差動駆動する差動駆動回路が搭載されている集積回路用基板とを備えている。
【００３３】
図１は光半導体素子モジュールを構成する光半導体用パッケージ（以下キャンパッケージという）の外観構成を示すもので、図２はキャンパッケージ１およびレセプタクル２から構成される光半導体素子モジュール（以下、この実施の形態では主にＬＤを搭載した例を示すので、ＬＤモジュールと呼ぶ）３の外観構成を示すもので、図３（ａ）（ｂ）はＬＤモジュール３の水平（図２のｘ軸に平行な方向）断面図，垂直（図２のｙ軸に平行な方向）断面図を示すものである。
【００３４】
図１〜図３に示すように、キャンパッケージ１は、バイアス給電ピン、高周波信号ピンなどがマウントされる円板状のステム１０（導電体）と、複数のセラミック基板が搭載される台形柱状の台座１１（台座ブロック）と、ＬＤ４０から発生されたレーザ光を集光する集光レンズ１２と、台座１１などを外部から密閉するための円筒形のキャップ１３などを備えている。ステム１０は導電性のコバールやＣｕＷ、軟鉄などで成形される。
【００３５】
キャップ１３は、図３に示すように、プロジェクション溶接などによってステム１０に固定される第１キャップ部材１３ａと、この第１キャップ部材１３ａの先端側に外嵌されてＹＡＧ溶接などによって第１キャップ部材１３ａに固定される第２キャップ部材１３ｂとから成る２段円筒形状を成している。具体的には、第１キャップ部材１３ａは段付きの外筒を有し、太い径の外筒の先に細い径の外筒が設けられている。この細い径の外筒の外周に対して、第２キャップ部材１３ｂの一端側の内筒が嵌合し、貫通ＹＡＧ溶接によって第１キャップ部材１３ａと第２キャップ部材１３ｂが固定される。キャップ１３はこのような溶接加工によって比較的安価に製造することができる。
【００３６】
第１キャップ部材１３ａの先端側には、レンズ挿入用の孔１４が形成されており、この孔１４に集光レンズ１２が挿入される。集光レンズ１２は、ネジ、接着材などによって第１キャップ部材１３ａに固定される。第１キャップ部材１３ａの内部空間１５は、ガラス製のウィンドウ１６によって外部から画成されており、これにより台座１１が収納される内部空間１５を気密状態に保つようにしている。なお、集光レンズ１２をキャップ１３の孔１４に接着固定することによって、内部空間１５を気密状態に保つことが可能な場合は、ウィンドウ１６を省略してもよい。
【００３７】
第２キャップ部材１３ｂの集光レンズ１２に対向する部分（他端側）には、レーザ光を通過させるための孔１７が形成されている。この第２キャップ部材１３ｂを第１キャップ部材１３ａに対して摺動させ、レーザ光軸方向に位置決め調整し、第１キャップ部材１３ａにＹＡＧ溶接固定することで、集光レンズ１２とレセプタクル２内のダミーフェルール１８とのレーザ光軸方向の位置合わせを行う。
【００３８】
レセプタクル２は、光ファイバ２０が接続されたフェルール２１（図２参照）が挿入されるフェルール挿入孔１９を有している。フェルール挿入孔１９内のキャンパッケージ１側には、内部に光ファイバ１８ａが配設されているダミーフェルール１８が圧入され固定されている。レセプタクル２におけるダミーフェルール１８が固定される側の一端面は、ＹＡＧ溶接による突き合わせ溶接などによってキャンパッケージ１の第２キャップ部材１３ｂの他端側の端面に固定される。レセプタクル２を第２キャップ部材１３ｂに固定する際に、互いの接合面を当接させた状態でレーザ光軸方向に垂直な２つの方向に対する位置決め調整を行うことで、集光レンズ１２とレセプタクル２内のダミーフェルール１８とのレーザ光軸に直角な２つの方向に関する位置合わせを行う。
【００３９】
光ファイバ２０が接続されているフェルール２１は、フェルール２１がレセプタクル２のフェルール挿入孔１９に挿入されたとき、ダミーフェルール１８の方にフェルール２１を押圧し、かつフェルール２１をレセプタクル２にロック固定するための適宜の機構（図示せず）を有している。したがって、フェルール２１がレセプタクル２のフェルール挿入孔１９に挿入されると、ダミーフェルール１８の光ファイバ１８ａとフェルール２１内の光ファイバ２０の端面同士が当接し、これによりファイバ間が接続（光結合）される。
【００４０】
つぎに、キャンパッケージ１内の構成について説明する。キャンパッケージ１内の構成を説明する前に、キャンパッケージ１内の各構成要素の等価回路を図４を用いて説明する。
【００４１】
図４は、キャンパッケージ１内の各構成要素の回路構成およびキャンパッケージ１内のＬＤ４０を差動駆動する差動駆動回路としてのＬＤ駆動回路１００の回路構成例を示すものである。ＬＤ駆動回路１００は、集積回路（ＩＣ）として集積されており、このＬＤ駆動回路１００は、図６に示すように、キャンパッケージ１と電気接続される集積回路用基板（外部基板）３００に搭載されて、信号源として機能している。また、外部基板３００には、マイクロストリップ差動線路として構成される差動線路基板７０（図５，図６参照）が設けられており、この差動線路基板７０を介してキャンパッケージ１とＬＤ駆動回路としてのＬＤ駆動回路１００が電気接続されている。なお、差動線路基板７０と集積回路基板３００は回路基板を構成し、この差動線路基板７０と集積回路基板３００を多層基板として一体化してもよい。また、差動線路基板７０は信号線路とグランドとの電界結合を強くしてグランデッドコプレーナ差動線路としても良い。
【００４２】
図４に示すように、ＬＤ駆動回路１００は、差動型の入力構成を有する入力バッファ１０２と、正相信号および逆相信号を出力する差動構成をなす一対のトランジスタ１０３，１０４と、バイアス定電流源としてのトランジスタ１０５と、インピーダンス整合をとるための抵抗１０６，１０７とを備えている。
【００４３】
入力バッファ１０２は、入力される正相信号と逆相信号の波形を整形し、整形した正相信号と逆相信号をトランジスタ１０３および１０４のベースに出力する。
【００４４】
差動構成をなす一対のトランジスタ１０３，１０４は、差動増幅器を構成する。トランジスタ１０３，１０４の夫々のコレクタ側は、抵抗１０６および１０７に接続されている。抵抗１０６，１０７の他方側は端子３１２，３１３に接続されている。トランジスタ１０３，１０４の夫々のエミッタは、定電流源であるトランジスタ１０５のコレクタに接続されている。トランジスタ１０３のベースは入力バッファ１０２の逆相信号出力端子に接続され、トランジスタ１０４のベースは入力バッファ１０２の正相信号出力端子に接続されている。すなわち、入力バッファ１０２に正相信号が入力した時にトランジスタ１０３はＯＦＦに、トランジスタ１０４はＯＮとなり、電流Ｉ１と電流Ｉ２が差動状態で流れる。なお、トランジスタ１０３とトランジスタ１０４に流れる電流値はトランジスタ１０５にて決定される。また、トランジスタ１０５のエミッタ側が負電源Ｖｅｅ１に接続されている。
【００４５】
トランジスタ１０３，１０４のエミッタ側の出力端子３１０、３１１は、マイクロストリップ差動線路やグランデッドコプレナ差動線路や後述する高周波信号ピンなどで構成される分布定数回路３０、整合抵抗３１ａ，３１ｂを介してＬＤ４０の一対の電極（カソード、アノード）に接続されている。
【００４６】
キャンパッケージ１側は、分布定数回路３０と、２５Ω程度のインピーダンス整合用の抵抗３１ａ，３１ｂと、集光レンズ１２と、高周波インピーダンスが５Ω程度のＬＤ４０と、高周波インピーダンスが大きいインダクタンス素子としての空芯ソレノイド３３ａ，３３ｂと、空芯ソレノイド３３ａ，３３ｂに並列接続される共振防止抵抗３４ａ，３４ｂと、ＬＤ４０と空芯ソレノイド３３ａ，３３ｂとを接続するためのワイヤボンド３５ａ，３５ｂとを備えている。
【００４７】
ＬＤ４０のカソード側は、ワイヤボンド３５ａと、このワイヤボンド３５ａに直列に接続された空芯ソレノイド３３ａと、共振防止抵抗３４ａの並列回路を介してバイアス定電流源３６の一端に接続されている。バイアス定電流源３６の他端は負電源Ｖｅｅ２に接続されている。ＬＤ４０のアノード側は、ワイヤボンド３５ｂと、このワイヤボンド３５ｂに直列に接続された空芯ソレノイド３３ｂと、共振防止抵抗３４ｂの並列回路を介して接地されている。なお、空芯ソレノイド３３ａと３３ｂは、いずれも整合抵抗３１ａと３１ｂよりもＬＤ４０に近い側でＬＤ４０の一対の電極に電気的に接続されている。負電源Ｖｅｅ１と負電源Ｖｅｅ２は同じ電源としたほうが好ましいが、別の電源としてもよい。
【００４８】
このＬＤ４０の駆動構成によれば、ＬＤ４０のカソード、アノードにソレノイド３３ａ，３３ｂを介してバイアス電源（図４のバイアス給電ピン４４ａに接続されたバイアス定電流源３６、およびバイアス給電ピン４４ｂに接続された接地端子）に夫々接続し、かつ差動型の一対のトランジスタ１０３，１０４によってＬＤ４０のカソード、アノードに高周波の変調信号を差動で入力するようにしている。
【００４９】
すなわち、ＬＤ駆動回路１００のトランジスタ１０４がＯＦＦからＯＮ（トランジスタ１０３がＯＮからＯＦＦ）になると、ＬＤ４０に電流が流れ、ＬＤ４０からのレーザ光出力はＯＦＦからＯＮとなる。また、トランジスタ１０４がＯＮからＯＦＦ（トランジスタ１０３がＯＦＦからＯＮ）になると、ＬＤ４０に流れる電流が小さくなり、ＬＤ４０からのレーザ光出力はＯＮからＯＦＦとなる。
【００５０】
このように、ＬＤ駆動回路１００の差動トランジスタ１０３，１０４より出力された変調電気信号は、分布定数回路３０などを通じてＬＤ４０に伝送され、ＬＤ４０において変調電気信号が光変調信号に変換される。ＬＤ４０から発生された光変調信号は、集光レンズ１２によって光ファイバ１８ａに集光され、光ファイバ１８ａを通じて出力される。
【００５１】
つぎに、図５〜図７を用いてキャンパッケージ１および外部基板３００の各構成要素について説明する。図５は、キャップ１３を外した状態におけるキャンパッケージ１および外部基板３００の一部を示す斜視図であり、図６はその平面図である。また、図７は、ステムとピンと台座の配置関係などを示すための図であり、マイクロストリップ差動線路基板４７、ＬＤチップキャリア４８、セラミック基板４９、受光素子５０などの構成品は図示を省略している。
【００５２】
図５〜図７などに示すように、キャンパッケージ１は、複数のピンがマウントされた円板状のステム１０と、Ａｇロウ付けなどによってステム１０の内壁面に垂直に固定される台形柱状の台座１１とから構成される。ステム１０は、各ピンが貫通するための各貫通孔（後述する）が設けられ、これら各貫通孔にはピンを固定する誘電体（後述する）が収容されている。ステム１０は、板金加工やメタルインジェクションモールド加工によって貫通孔を簡単に形成することができるため、比較的安価に製造できる。
【００５３】
グランドを構成するステム１０には、ＬＤ駆動回路１００からの差動の変調電気信号（以下差動高周波信号ともいう）が伝送される一対の高周波信号ピン４１ａ，４１ｂ（高周波用の信号端子）と、これら高周波信号ピン４１ａ，４１ｂの両側に、高周波信号ピン４１ａ，４１ｂを挟むように配される２本のグランドピン４２ａ，４２ｂ（グランド端子）が固定されている。また、ステム１０には、モニタ用の受光素子（例えばホトダイオード、以下ＰＤという）５０の信号伝送のための１本のモニタ信号ピン４３と、ＬＤ４０に対して外部の直流バイアス電流源からバイアス電流を供給する一対のバイアス給電ピン４４ａ，４４ｂが固定されている。ステム１０には、モニタ用のＰＤ５０を搭載するためのＰＤ用チップキャリア４５とがマウントされている。例えば、高周波信号ピン４１ａから図４に示す正相の電流信号Ｉ２が引き抜かれるとともに、高周波信号ピン４１ｂに対して図４に示す電流信号Ｉ２と逆相の電流信号Ｉ１が与えられる。
【００５４】
これらの信号ピンのうち、高周波信号ピン４１ａ，４１ｂは、気密を保ったままステム１０を介して電気信号を通過させるフィードスルー（フィードスルー部１０ｃ）を構成している。これら各高周波信号ピン４１ａ，４１ｂは、硼珪酸ガラスやソーダバリウムガラスなどの材料で構成される誘電体７７に形成されている貫通孔８０ａ、８０ｂを夫々貫通して挿入され、ステム１０に対し気密封止状態で固定されている。誘電体７７はステム１０に設けられた楕円、長円、または繭形の形状をした貫通孔７４に気密封止状態で収容される。例えば、誘電体７７はガラスビーズを溶融固化することによってステム１０に固定されるとともに、各高周波信号ピン４１ａ，４１ｂを固定する。グランドピン４２ａ，４２ｂは、グランドを構成するステム１０の外壁面に圧着および溶接によって固着されている。高周波信号ピン４１ａ，４１ｂ、およびグランドピン４２ａ，４２ｂは、互いに平行になるように配置されている。ガラス製の誘電体７８はステム１０の貫通孔７５に収容されて気密封止状態で固定され、モニタ信号ピン４３は誘電体７８を貫通して気密封止状態で固定される。同様に、ガラス製の誘電体７９ａはステム１０の貫通孔７６ａに収容されて気密封止状態で固定され、バイアス給電ピン４４ａは誘電体７９ａを貫通して気密封止状態で固定される。ガラス製の誘電体７９ｂはステム１０の貫通孔７６ｂに収容されて気密封止状態で固定され、バイアス給電ピン４４ｂは誘電体７９ｂを貫通して気密封止状態で固定される。かくして、高周波信号ピン４１ａ，４１ｂ、グランドピン４２ａ，４２ｂ、モニタ信号ピン４３、およびバイアス給電ピン４４ａ、４４ｂは、ステム１０の突出面１０ｚから、キャンパッケージ１の外部に突出して固定される。このピンの固定構造は、ガラス製の誘電体を用いることによって、比較的安価に製造することができる。ＰＤ用チップキャリア４５上にマウントされたＰＤ５０は、ＬＤ４０から後方に出射されるモニタ光をモニタするためのものである。
【００５５】
ステム１０に対し台座１１がほぼ垂直に配設されている。台座１１の上面には、マイクロストリップ差動線路基板４６，４７と、ＬＤ用チップキャリア４８と、バイアス回路用基板４９とが搭載されている。台座１１とステム１０とは表面全体に導電性のメッキが施されている。マイクロストリップ差動線路基板４６，４７やＬＤ用チップキャリア４８の裏面に形成され接地導体層となる平面導体板（以下ベタグランドと呼ぶ）が、台座１１の上面に半田接合され電気的に接続されている。また、台座１１は、ＬＤ４０等から発生する熱の放熱経路になっている。
【００５６】
マイクロストリップ差動線路基板４６は、セラミック基板５１と、セラミック基板５１の上面に形成された一対のストリップ差動信号線５２ａ，５２ｂと、セラミック基板５１の裏面に形成されたベタグランド（図示せず）で構成されている。ストリップ差動信号線５２ａ，５２ｂの一端側には、ステム１０から突出された高周波信号ピン４１ａ，４１ｂと接触させて半田付けするためのパッド５３ａ，５３ｂが形成されている。ストリップ差動信号線５２ａ，５２ｂは、小型化のために特性インピーダンスが低く設定された高周波信号ピン４１ａ，４１ｂによる影響を少なくするために、ステム１０に近い入力側の部分５２ｄ（図６）では特性インピーダンスが高くなるよう信号線間隔が大きく設定されている。また、ストリップ差動信号線５２ａ，５２ｂは、信号線間隔が徐々に接近する部分と、間隔が接近して平行に配置される出力側部分とを有している。ステム１０にマウントされる高周波信号ピン４１ａ，４１ｂの端部は、図７に示すように、マイクロストリップ差動線路基板４６のパッド５３ａ，５３ｂにロウ付けまたは半田付けによって接続固定されている。
【００５７】
マイクロストリップ差動線路基板４７は、セラミック基板５５と、セラミック基板５５の上面に形成された一対のストリップ差動信号線５６ａ，５６ｂと、セラミック基板５５の裏面に形成されたベタグランド（図示せず）で構成されている。ストリップ差動信号線５６ａ，５６ｂは、信号線方向を略９０度折り曲げるためのコーナーカーブ部を有している。ストリップ差動信号線５６ａ，５６ｂの途中には、インピーダンス整合用の抵抗３１ａ，３１ｂ（図４参照）がそれぞれ形成されている。ストリップ差動信号線５２ａ，５２ｂと、ストリップ差動信号線５６ａ，５６ｂとは、ワイヤボンド５７ａ，５７ｂによってそれぞれ接続されている。
【００５８】
ＬＤ用チップキャリア４８は、セラミック基板５８と、セラミック基板５８の上面に形成された一対のストリップ差動信号線５９ａ，５９ｂと、セラミック基板５８の裏面に形成されたベタグランド（図示せず）で構成されるマイクロストリップ差動線路を有し、一方のストリップ差動信号線５９ｂ上にＬＤ４０の一方の電極であるアノードが直接当接するように、ＬＤ４０が搭載されている。ＬＤ４０の他方の電極としてのカソードは、ワイヤボンド６０によって他方のストリップ差動信号線５９ａに接続されている。ストリップ差動信号線５６ａ，５６ｂと、ストリップ差動信号線５９ａ，５９ｂとは、ワイヤボンド６１ａ，６１ｂによってそれぞれ接続されている。セラミック基板５８は、熱伝導性の良い窒化アルミ（ＡｌＮ）や炭化シリコン（ＳｉＣ）などの材料から構成されている。ＬＤ４０としては、１０Ｇｂ／ｓの変調が可能な、例えば分布帰還型のレーザダイオード素子が用いられている。なお、ここではＬＤチップキャリア４８とマイクロストリップ線路基板を分離して、抵抗３１ａ、３１ｂの製作で発生するコストを低減させる構成を示したが、一体化しても良い。
【００５９】
バイアス回路用（セラミック）基板４９上には、２本の配線パターン６２ａ，６２ｂと一対のインダクタンス回路（ソレノイド及び共振防止抵抗の並列回路）が形成されている。一方の配線パターン６２ａには、空芯ソレノイド３３ａおよび空芯ソレノイド３３ｂの線間容量とインダクタンスとの共振を防止する共振防止抵抗３４ａが電気的に並列接続されるように配置され、他方の配線パターン６２ｂには、同様に、空芯ソレノイド３３ｂおよび共振防止抵抗３４ｂとが電気的に並列接続されるように配置されている。空芯ソレノイド３３ａおよび空芯ソレノイド３３ｂは互いの磁界が干渉しないように、各ソレノイド３３ａ，３３ｂの中心軸（の延長線）が交差するように、好ましくは直交するように、離間配置されている。２本の配線パターン６２ａ，６２ｂの一方の各端部は、ＬＤ用チップキャリア４８のストリップ差動信号線５９ａ，５９ｂとワイヤボンド３５ａ，３５ｂを介して接続されており、配線パターン６２ａ，６２ｂの他方の端部は、ワイヤボンド６３ａ，６３ｂを介してステム１０に設けられるバイアス給電ピン４４ａ，４４ｂに接続される。
【００６０】
つぎに、外部基板３００側の構成について説明する。外部基板３００には、前述したように、ＬＤ４０を差動駆動するＬＤ駆動回路１００と、このＬＤ駆動回路１００とステム１０に設けられた一対の高周波信号ピン４１ａ，４１ｂおよび一対のグランドピン４２ａ，４２ｂとを接続するマイクロストリップ差動線路基板７０とが設けられている。
【００６１】
マイクロストリップ差動線路基板７０は、ガラスエポキシ基板７３の上面に形成された一対のストリップ差動信号線７１ａ，７１ｂと、この一対のストリップ差動信号線７１ａ，７１ｂを挟むようにストリップ差動信号線７１ａ，７１ｂの外側に配置されるグランド７２ａ，７２ｂと、ガラスエポキシ基板７３の裏面または中間層に配置されてグランド７２ａ，７２ｂに接続されるベタグランド（図示せず）とから構成されている。ストリップ差動信号線７１ａ，７１ｂの一端側には、ステム１０の突出面１０ｚから突出された高周波信号ピン４１ａ，４１ｂと接触させてロウ付けまたは半田付けするためのパッド３０１ａ，３０１ｂが形成されており、高周波信号ピン４１ａ，４１ｂの端部は、マイクロストリップ差動線路基板７０のパッド３０１ａ，３０１ｂにロウ付けまたは半田付けによって接続固定されている。
ストリップ差動信号線７１ａ，７１ｂの途中には、互いの信号線から離間するように突出された特性インピーダンスが他の線路部分より低いスタブ３０２ａ，３０２ｂが形成されている。また、パッド３０１ａ，３０１ｂとスタブ３０２ａ，３０２ｂとの間には、半田レジストや半田の濡れ性の悪い金属を表面層とした半田流れ止め部１０００ａ，１０００ｂを設けて、半田流れ止め部１０００ａ，１０００ｂとスタブ３０２ａ，３０２ｂとの間に半田が流れることを防止している。
【００６２】
パッド３０１ａ，３０１ｂからスタブ３０２ａ，３０２ｂに向かって、ストリップ差動信号線７１ａ，７１ｂの間隔が狭くなっている。すなわち、ストリップ差動信号線７１ａ，７１ｂは、スタブ３０２ａ，３０２ｂよりＬＤ駆動回路１００側に位置する部分３０４では、スタブ３０２ａ，３０２ｂよりステム１０側に位置する部分３０５よりも特性インピーダンスが低くなるよう信号線間隔を小さく設定されており、このようなスタブ３０２ａ，３０２ｂの配置および信号線間隔の調整によって、高周波信号ピン４１ａ，４１ｂなどから反射が発生しないように、各部分の特性インピーダンスを変化させている。
【００６３】
マイクロストリップ差動線路基板７０のグランド７２ａ，７２ｂは、ステム１０に設けられたグランドピン４２ａ，４２ｂに接続固定されている。なお、マイクロストリップ差動線路基板４６、マイクロストリップ差動線路基板４７、およびマイクロストリップ差動線路基板７０における、それら基板上のストリップ差動信号線（７１ａ、７１ｂ、５２ａ、５２ｂ、５６ａ、５６ｂ）と、高周波信号ピン４１（４１ａ、４１ｂ）とは、分布定数線路３０を構成している。また、マイクロストリップ差動線路基板７０のグランド７２ａ，７２ｂは、ステム１０に設けられたグランドピン４２ａ，４２ｂに接続固定されている。なお、マイクロストリップ差動線路基板４６およびマイクロストリップ差動線路基板４７における、それら基板上のストリップ差動信号線（５２ａ、５２ｂ、５６ａ、５６ｂ）は、モジュール内部（キャンパッケージ１内部）の分布定数線路３０ｂを構成している。ストリップ差動信号線５２ａ，５２ｂ、およびストリップ差動信号線５６ａ，５６ｂは、夫々分布定数線路３０ｂの第１、第２の導体線路を構成する。
【００６４】
図６に示すように、ＬＤ駆動回路１００内のトランジスタ１０３（図４参照）のコレクタに接続される逆相信号Ｉ１の出力端子３１０は、ワイヤボンド３２０を介して一方のストリップ差動信号線７１ｂに接続されている。ＬＤ駆動回路１００内のトランジスタ１０４（図４参照）のコレクタに接続される正相信号Ｉ２の出力端子３１１は、ワイヤボンド３２１を介して一方のストリップ差動信号線７１ａに接続されている。ＬＤ駆動回路１００内の抵抗１０６が接続される端子３１２はワイヤボンド３２２を介してグランド７２ｂに接続され、ＬＤ駆動回路１００内の抵抗１０７が接続される端子３１３はワイヤボンド３２３を介してグランド７２ａに接続されている。
なお、オープンコレクタ型のＬＤ駆動回路の場合は、駆動能力を上げるためにコレクタ側に正電圧をかける場合がある。この場合は、端子３１２，３１３がワイヤボンド３２２，３２３を介して図示しないコンデンサの一方の電極に接続され、コンデンサの他方の電極はグランド７２ｂ，７２ａ上に半田付けされる。また、端子３１２，３１３は正電極Ｖｃｃ（図示せず）に接続される。
【００６５】
このように、図４に示したＬＤ駆動回路１００の差動トランジスタ１０３，１０４から出力される差動高周波信号は、図５および図６に示すように、マイクロストリップ差動線路基板７０を介してキャンパッケージ１に入力される。
【００６６】
一般にＬＤ駆動回路１００は、夫々の出力端子３１０、３１１がＬＤ駆動回路１００の有する特性インピーダンスに対してインピーダンス整合するよう設計されている場合が多い。したがって、ＬＤ駆動回路１００を差動形式で動作させて、その出力端子３１０、３１１を差動線路に接続する場合は、例えば接続される差動線路７１ａ、７１ｂの特性インピーダンスを１００Ωで設計することが望ましい。
【００６７】
しかし、ステム１０のフィードスルー部１０ｃにおける高周波信号ピン４１ａ、４１ｂ間の特性インピーダンスを仮に１００Ωとした場合、高周波信号ピン４１ａ、４１ｂの間隔が差動線路７１ａ、７１ｂの間隔よりも大きく広がり、高周波信号ピン４１ａ、４１ｂを内包するフィードスルー部１０ｃの誘電体７７の外形もそれに応じて大きくなる。このため、誘電体７７を収容するステム１０の外径が拡大し、光半導体装置の小型化を妨げることになる。また、誘電体７７が大きくなることにより、誘電体７７の気密封止の歩留まりが低下する等の不都合が生じる。このため、例えば高周波信号ピン４１ａ、４１ｂ間の特性インピーダンスを６０Ω程度にするなど、この特性インピーダンスをＬＤ駆動回路１００の出力端子３１０、３１１の特性インピーダンスよりも下げることによって、誘電体７７およびステム１０の小型化を図っている。
【００６８】
一方、高周波信号ピン４１ａ、４１ｂの相互の間隔や夫々のピン直径が、ステム１０とマイクロストリップ差動線路基板７０の間に形成される空間に配置される部分と、フィードスルー内に配置される部分とで同じ大きさとなる場合には、高周波信号ピン４１ａ、４１ｂの特性インピーダンスが略１４０Ω程度になることが多い。かくして、マイクロストリップ差動線路基板７０にスタブ３０２ａ、３０２ｂを設けて、ＬＤ駆動回路１００側から見れば特性インピーダンスが１００Ωに近くなるようにインピーダンス整合を取ることによって、フィードスルー部分からの反射波の発生を極力抑えている。
【００６９】
しかるに、ステム１０に固着された高周波信号ピン４１ａ、４１ｂとマイクロストリップ差動線路基板７０との半田接合において、接合後の機械的、または熱的なストレスを緩和するには、高周波信号ピン４１ａ、４１ｂに上述の特許文献２に示される態様の屈曲構造を設けて、高周波信号ピン４１ａ、４１ｂとマイクロストリップ差動線路基板７０の接合面との間で、マイクロストリップ差動線路基板７０の板厚方向にある程度の空間２０１を設ける必要がある。ここでは、図７に示すように、高周波信号ピン４１ａ、４１ｂにおけるステム１０側とマイクロストリップ差動線路基板７０側との間の２箇所で、互いに逆方向に折れ曲がって屈曲構造を形成するように屈曲部２００が設けられる。屈曲部２００は、高周波信号ピン４１ａ、４１ｂにおけるステム側の軸線方向とマイクロストリップ差動線路基板７０側の軸線方向とが概ね平行となるように二度折れ曲がっている。屈曲部２００は組立時の寸法公差によってその位置がばらつくため、高周波信号ピン４１ａ、４１ｂとマイクロストリップ差動線路基板７０との接合部の位置が、ステム１０の突出面１０ｚに対して、高周波信号ピン４１ａ、４１ｂの軸線方向にばらつく。このため、高周波信号ピン４１ａ、４１ｂとマイクロストリップ差動線路基板７０の間に設けた空間２０１の長さが製造される個体毎に異なってばらついてしまう。また、屈曲部を曲げ加工するためには、屈曲部２００を形成している高周波信号ピン４１ａ、４１ｂの軸方向の長さＬは少なくとも１ｍｍ程度必要となる。このため、高周波信号ピン４１ａ、４１ｂの空走部分の長さＬ２は、マイクロストリップ差動線路基板７０の端面とステム１０の突出面１０ｚと間の空隙２０２を空走する部分に加えて、屈曲部２００によって形成される空間２０１を空走する部分だけ長くなり、これによってインピーダンスがより大きくなる。結果として、高周波信号ピン４１ａ、４１ｂとマイクロストリップ差動線路基板７０との完全なるインピーダンス整合を成すことは不可能となり、フィードスルー付近においてある程度の反射波が発生することになる。
【００７０】
また、キャンパッケージ１の内部（ステム１０の台座１１側）においても、高周波信号ピン４１ａ、４１ｂからマイクロストリップ差動線路４６を経由し、整合抵抗付きのマイクロストリップ差動線路４７を介して、ＬＤチップキャリア４８に搭載されるＬＤ４０に高周波電力を給電する。高周波信号ピン４１ａ、４１ｂとマイクロストリップ差動線路４７の間の信号伝送経路では、反射波を防止するために、適宜特性インピーダンスを変化させ、要するに、ＬＤ駆動回路１００側から見れば分布定数線路３０の特性インピーダンスが１００Ωに近くなるように信号伝送線路に工夫を施すことで、不要な反射波の発生を抑えている。
【００７１】
ここで、以後の説明を簡単にするため、ＬＤ４０と整合抵抗３１ａ、３１ｂ間を接続する信号伝送線路（ストリップ差動信号線５９ａ、５９ｂ、５６ａ、および５６ｂ上の、ＬＤ４０と整合抵抗３１ａ、３１ｂ間の部分）の電気長を短くし、かつ複数本のワイヤボンド６１ａ、６１ｂの短尺化により、高周波の位相がずれないように半導体レーザダイオード４０と整合抵抗３１ａ、３１ｂとを近接して配置する。これによって結果的に、ＬＤ４０と整合抵抗３１ａ、３１ｂを集中定数回路としてみなせるように配置している。
【００７２】
例えば、ＬＤ４０のインピーダンスの等価回路は、抵抗５Ωと並列に容量２ｐＦ程度が接続された回路で表現できる。さらに、チップキャリア４８に活性層を上側にしてＬＤ４０が実装される場合、ワイヤボンド６０の長さがある程度必要なことと、電極パッドを大きく出来ないことから、ワイア本数が１本となることが多い。このため、ワイヤボンド６０をインダクタンス０．７ｎＨ程度のインダクタンス素子として扱うことによって、一般的に、ＬＤ４０は、このインダクタンス要素と、抵抗および容量の並列回路とが、直列に接続された等価回路となる。
【００７３】
ここで、整合抵抗３１ａ、３１ｂの抵抗を夫々２５Ωとした場合、ＬＤ４０の等価回路と、整合抵抗３１ａ、３１ｂと、高周波電源を接続した回路に関して、その高周波電源側からみたスミスチャートは図８のようになる。図８（ａ）は規格化インピーダンス１００オームで表示したスミスチャートを示し、図８（ｂ）は反射量の周波数依存性を示す図である。
図では直流から１０ＧＨｚまでの特性を実線にて示しており、参考のため７ＧＨｚを黒三角で表示している。図より、信号周波数より十分に低い周波数ではＬＤ４０の抵抗と整合抵抗３１ａ、３１ｂの和と規格化インピーダンスとの不整合による反射が発生し、周波数の上昇と共に徐々に反射が増加していることが分る。
【００７４】
従来の光半導体装置では、ＬＤ駆動回路１００に対してインピーダンス整合した、特性インピーダンス１００Ωの分布定数線路で接続されるのが一般的であり、その場合はスミスチャートの中心周りに分布定数線路の電気長に従って高周波成分の反射点が半波長で１回転の割合で回転するが、インピーダンス整合が改善することはない。従って、整合抵抗３１ａ、３１ｂの抵抗成分を大きすることによって、ＬＤ駆動回路１００から見た負荷インピーダンスが大きくすることでインピーダンス整合を改善することが出来るが、ＬＤ４０に対する高周波信号の電力伝達効率は小さくなってしまうという欠点がある。このため、反射減衰量と電力伝達効率（またはＬＤ駆動回路の駆動能力）の兼ね合いを考慮して、整合抵抗３１ａ、３１ｂの抵抗成分を最適化する必要がある。
【００７５】
この最適化の一例として、ＬＤ駆動回路１００側から見た光半導体装置の反射減衰量を、電力スペクトラム密度の大きい５ＧＨｚまでの帯域を中心として、反射量を図８に示したものよりも改善し、効果的な電気特性を得られた事例について図９〜１２を用いて以下に説明する。この例では、伝送レート１０Ｇｂ／ｓのＮＲＺ（Ｎｏｎ ｒｅｔｕｒｎ ｔｏ ｚｅｒｏ）方式の光半導体装置に関して、整合抵抗３１ａ、３１ｂの抵抗値と、モジュール内部の分布定数線路３０ｂの電気長とを種々に変化させたときの反射量について調べた。
【００７６】
図９は、この実施の形態による光半導体装置の高周波特性を説明するための、（ａ）スミスチャートと、（ｂ）反射量の周波数特性とを示す図（差動線路の直後の特性図その１）である。
図において、ＬＤ駆動回路１００の出力インピーダンスは夫々５０Ωであり、整合抵抗３１ａ、３１ｂの抵抗値は２５Ω、信号リード４１ａ、４１ｂの空走部分の特性インピーダンスは１００Ω、ステム１０のフィードスルー部１０ｃの特性インピーダンスは１００Ω、ストリップ差動信号線５２ａ、５２ｂの幅広部分の特性インピーダンスは１００Ωで、幅の変更部分は短く、ワイヤボンド５７ａ、５７ｂは複数本のワイア接続でありインダクタンスは小さいとした。
さらに、ストリップ差動信号線５６ａ、５６ｂの特性インピーダンスを５５Ωとして、周波数７ＧＨｚにおける電気長を１／１６波長、１／８波長、３／１６波長の長さとした時に、ストリップ差動信号線５６ａ、５６ｂの入り口から見た時のスミスチャートと、反射量の周波数特性を示すものである。
【００７７】
図９より、ストリップ差動信号線５６ａ、５６ｂの電気長を７ＧＨｚで１／８波長とした時には、略７ＧＨｚを中心にして反射量が著しく改善され、かつ広い帯域でその改善効果が維持されていることが分る。また、電気長を７ＧＨｚで３／１６波長とした場合は略５ＧＨｚで反射が改善されている。但し、これは電気長が５ＧＨｚに対して略１／８波長に相当するのであって、設計する周波数と電気長との関係は相対的なものである。
【００７８】
従って、低周波においては、整合抵抗３１ａ、３１ｂの抵抗値の和を、ＬＤ駆動回路１００の特性インピーダンスに対して略半分程度の値（５０Ω）として、電力伝達効率と反射特性を適切に設定する。また、例えば７ＧＨｚ付近の高周波においては、分布定数線路３０ｂを構成する差動線路の特性インピーダンス５５Ωの周りに１／８波長分、つまりスミスチャート上で１／４周期回転させることで、インピーダンス整合を実施するのが好適である。これによって、直流から１０ＧＨｚの広帯域に渡り反射量−１０ｄＢ以上が確保される。これは、対策を施さない場合の図８に示した例が５ＧＨｚでの反射量が−１０ｄＢよりも大きくなるのに対して、反射特性を格別に改善する効果がある。
【００７９】
ここでは、分布定数線路３０ｂを構成する差動線路（ストリップ差動信号線５６ａ、５６ｂ）の特性インピーダンス５５Ωの周りに１／８波長分だけ回転させる際の回転中心が５５Ωとなる例を示したが、その回転中心は５５Ωの０．５倍から１．５倍程度の範囲であれば良く、図１０に差動線路の特性インピーダンスが３５Ωの場合（差動線路の直後の特性図その２）を、図１１に差動線路の特性インピーダンスが７５Ωの場合（差動線路の直後の特性図その３）を示す。
【００８０】
図１０（ａ）のスミスチャートと図１０（ｂ）の反射量の周波数特性図に示す通り、差動線路の特性インピーダンスを、半導体素子のインピーダンスと整合抵抗とのインピーダンスの和の０．６倍にすると、高周波帯域で反射が減るようになり、電気長が７ＧＨｚに対して１／１６波長の際に１０ＧＨｚが反射の最小点となる。また、電気長が７ＧＨｚに対して３／１６波長の際に反射がほぼ一定になった後に反射が劣化していくことが分る。これはこのインピーダンス整合の一方の限界を示すものである。
【００８１】
また、図１１（ａ）のスミスチャートと図１１（ｂ）の反射量の周波数特性図から分るように、差動線路の特性インピーダンスを、半導体素子のインピーダンスと整合抵抗とのインピーダンスの和の１．４倍にすると、高周波帯域で反射が減るようになり、電気長が７ＧＨｚに対して１／１６波長の際に反射がほぼ一定となっていることが分る。これはこのインピーダンス整合方法の他方の限界を示すものである。なお、電気長を徐々に長くすると５ＧＨｚ付近での反射が改善していく様子が分るが、これは別の実施例に示す内容と等価であり、この挙動に関する詳細は後述の別の実施例で説明する。
【００８２】
例えば、電力スペクトラムが５ＧＨｚ以下に集中している伝送レート１０Ｇｂ／ｓのＮＲＺ方式のデジタル通信では、５ＧＨｚ以下の反射減衰量をより改善する方が好ましい場合もある。例えば、差動線路５６ａ、５６ｂの電気長を３／１６波長とすれば、略８ＧＨｚで反射量が−１０ｄＢを超えているが、５ＧＨｚまでは特に反射量が低く抑えられている。これとは逆に、デジタル波形の矩形形状を維持したい場合は３倍高調波である１５ＧＨｚまで反射量を小さくしたいという場合がある。このような場合はストリップ差動信号線５６ａ、５６ｂの電気長を７ＧＨｚに対して１／１６波長とすれば改善が図れることが分る。この様にして、比較的に低い整合抵抗３１ａ、３１ｂであるにも関わらず、広帯域に良好な反射量を維持しながら半導体レーザダイオード４０への電力伝達効率を改善することが出来、格別の効果を奏することとなる。
【００８３】
なお、フィードスルー１０ｃは小型化のために特性インピーダンスを６０Ω程度とすることが多いこと、フィードスルーの部分と信号ピン４１ａ、４１ｂの間隔を変えずにグランドピン４２ａ、４２ｂを配置しても空走部分の特性インピーダンスは１４０Ω程度になることが多いことは前述で説明した。これらの特性インピーダンスと電気長の影響が図９のインピーダンス整合に与える影響が最小になるように、ストリップ差動信号線５２ａ、５２ｂの特性インピーダンスは略１４０Ωに設定し、平均として特性インピーダンスを１００Ωに近づけ、また各部の電気長を比較的に短く設定することで位相の回転を抑えるなどして、反射特性の劣化を最小限になるように設計すればよく、電気信号端子の前後に分布定数線路が挿入されていても良く、または電気信号端子自体が分布定数線路を構成しても良い。
【００８４】
図１２は、図９に示した例で各種設定を行った実際の光半導体装置において、信号ピン４１ａ、４１ｂの空走部分の長さを２〜１０ｍｍの間で可変した際の反射特性を示すものである。図に示す通り、略７ＧＨｚ付近で反射量が改善している様子が分る。また、適切なインピーダンス整合が取られているために、空走部分の特性インピーダンス１４０Ωとフィードスルー部１０ｃの特性インピーダンス６０Ωとの平均値が、規格化インピーダンス（１００Ω）から離れ、かつ空走部分がかなり長くなるまで、反射量が十分に改善されて維持されていることが分る。
【００８５】
このような反射量の低減は、高周波信号ピン４１ａ、４１ｂのピン長が５ｍｍとなるまで（ピン長２ｍｍ〜５ｍｍの間で）維持されるので、高周波信号ピン４１ａ、４１ｂの空走部分の長さを長くしても、反射減衰量を低減させることができる。このピン長は、実開平５−２９１５６号公報に記載されるようなストレス緩和構造のための屈曲構造を設けるに十分な長さである。したがって、光半導体装置の高周波信号ピン４１ａ、４１ｂを、マイクロストリップ差動線路基板７０へ容易に取り付けて半田接合することができるため、低コストな光半導体装置を得ることができる。また、光半導体装置の高周波信号ピン４１ａ、４１ｂとマイクロストリップ差動線路基板７０との、半田接合部に生じる機械的、または熱的なストレスを緩和することが可能となって、半田接合部の信頼性が向上する。
【００８６】
以上の図９に示した例により、ＬＤと整合抵抗とを近接して配置し、ＬＤと整合抵抗の抵抗値の和がＬＤ駆動回路のインピーダンスより低く設定され、整合抵抗に接続される分布定数線路の特性インピーダンスが、伝送する信号の周波数帯よりも十分に低い周波数において、ＬＤと整合抵抗との和とほぼ等しいか、もしくはその０．６倍から１．４倍の範囲として、
かつ、分布定数線路の電気長を伝送する信号の周波数帯における、略１／１６波長〜３／１６波長の長さとすることによって、ＬＤとＬＤ駆動回路との間で高周波信号の電力伝達効率を必要以上に落とすことなく、広帯域に反射波を低減することが出来、かつ、信頼性が高くて、またコストの安い光半導体装置が提供できる。
【００８７】
次に、図１３は、この発明の別の実施の一例を説明する（ａ）スミスチャートと、（ｂ）反射量の周波数特性を示す図である。ここでは、分布定数線路３０ｂを構成するストリップ差動信号線５６ａ、５６ｂの特性インピーダンスを、ＬＤ４０の抵抗５Ωと抵抗３１ａ、３１ｂの夫々２５Ωの和である５５Ωと、規格化インピーダンス１００Ωとの中間である略７４Ωとし、電気長を７ＧＨｚに対して１／８波長、１／４波長、３／８波長として回転させたものである。
【００８８】
従って、図８で例示したスミスチャートにおいてインダクタンス性を有していた７ＧＨｚ付近の反射点は、図１３では例えば電気長が７ＧＨｚに対して１／４波長の場合、７４Ωを中心に１８０度回転して規格化インピーダンス付近で容量性を示す位置に変換されている。
【００８９】
別の見方をすれば略５ＧＨｚに対して１／８波長に近い電気長になっている。従って、図９の例との違いは、図９の例において線路の電気長が３／１６波長の場合と同じく５ＧＨｚにて反射の最小点があるが、スミスチャートにおける回転中心が規格化インピーダンス（１００Ω）に近いので、最小点における整合がより改善される点に格別の効果がある。この効果は、程度の差こそあれ３／８波長でも維持されている。また、分布定数線路３０ｂ（特に、ストリップ差動信号線５６ａ、５６ｂ）の特性インピーダンスが、図９の例で使用するものよりも図１３の例の方が高いので、より幅の狭い線路を構成することができ、幅の制約が厳しい時に有効である。一方、図９のものより図１３のものは電気長、または実際の長さが長くなるので、線路を長くしたい時に有効である。
【００９０】
以上の図１３に示した例により、ＬＤと整合抵抗とを近接して配置し、ＬＤと整合抵抗の抵抗値の和がＬＤ駆動回路のインピーダンスより低く設定され、整合抵抗に接続される分布定数線路の特性インピーダンスが、ＬＤと整合抵抗との和と、ＬＤ駆動回路のインピーダンスとの中間であって、分布定数線路の電気長を略１／８波長〜３／８波長の長さとすることによって、ＬＤとＬＤ駆動回路との間で、高周波信号の電力伝達効率を必要以上に落とすことなく、広帯域に反射波を低減することが出来、かつ、信頼性が高くて、またコストの安い、より好適な光半導体装置が提供できる。
【００９１】
次に、図１４はこの発明のさらに別の実施の一例を説明する（ａ）スミスチャートと、（ｂ）反射量の周波数特性を示す図である。ここでは、図９と同じく特性インピーダンス５５Ω、図９に例示した電気長が７ＧＨｚで１／８波長のストリップ差動信号線５６ａ、５６ｂを接続した後で、この７ＧＨｚにおけるインピーダンス（５５Ω）と規格化インピーダンス（１００Ω）の中間のインピーダンスである９４Ωを有し、電気長が１／４波長のストリップ差動信号線５２ａ、５２ｂを設けたものである。図より、設計波長である７ＧＨｚ付近において非常に良好なインピーダンス整合が取られていることが分る。図９で例示したストリップ差動信号線５６ａ、５６ｂ（５５Ω）で７ＧＨｚのインピーダンス整合がかなり良く取れているために、図１４では効果が小さく見えている。しかし、この実施例は最初の差動線路５６ａ、５６ｂのインピーダンス整合が十分でないときには格別の効果を奏する。なお、この効果は、ストリップ差動信号線５６ａ、５６ｂとして１／１６波長〜３／１６波長、ストリップ差動信号線５２ａ、５２ｂとして１／８波長〜３／８波長の範囲で選定しても維持される。
【００９２】
以上の図１４に示した例により、ＬＤと整合抵抗とを近接して配置し、ＬＤと整合抵抗の抵抗値の和がＬＤ駆動回路のインピーダンスより低く設定され、整合抵抗に接続されるストリップ差動信号線５６ａ、５６ｂ（第１の分布定数線路）の特性インピーダンスが、ＬＤと整合抵抗との和とほぼ同じであって、第１の分布定数線路の電気長を略１／１６波長〜３／１６波長の長さとして、
かつ、信号端子と第１の分布定数線路との間に接続されるストリップ差動信号線５２ａ、５２ｂ（第２の分布定数線路）の特性インピーダンスが、ＬＤと整合抵抗との和と、ＬＤ駆動回路のインピーダンスとの中間であって、第２の分布定数線路の電気長を略１／１８波長〜３／８波長の長さとすることによって、
ＬＤとＬＤ駆動回路との間で、高周波信号の電力伝達効率を必要以上に落とすことなく、広帯域に反射波を低減することが出来、かつ、信頼性が高くて、またコストの安い、より好適な光半導体装置が提供できる。
【００９３】
なお、分布定数線路３０ｂは、線路の特性インピーダンスもしくは電気長が適宜に異なるように、さらに複数に分割された伝送線路（ストリップ差動信号線）で構成して、この複数の伝送線路の平均の特性インピーダンスが、分布定数線路３０ｂの特性インピーダンスの、図９、図１３、図１４に夫々例示した所望の条件を満足し、複数の伝送線路の合計の線路長が前記分布定数線路の電気長の、図９、図１１、図１２に夫々例示した所望の条件を満足するように設定されても良い。
【００９４】
以上説明したこの実施の形態では、光半導体素子として、半導体レーザダイオード（半導体発光素子）を用いた例について示したが、レーザダイオード集積型電界吸収形変調器（別の半導体発光素子）を搭載したものでも、ホトダイオード（半導体受光素子）を用いたものでも、プリアンプ内蔵型ホトダイオードでもよく、同様の効果を奏する。
【００９５】
また、回路基板に搭載されるＬＤ駆動回路１００は、ＬＤ駆動回路を用いた例について示したが、変調器駆動回路でも、トランスインピーダンスアンプＩＣであってもよい。
【００９６】
また、ＬＤ駆動回路１００は、キャンパッケージ１内部に搭載されていてもよい。この場合、ＬＤ駆動回路１００の出力端子３１０、３１１が、マイクロストリップ差動線路基板４６のストリップ差動線５２ａ、５２ｂとワイヤボンドを介して直接接続される。このときのストリップ差動線５２ａ、５２ｂは、分布定数線路３０ｂに接続された信号端子と見なしてもよい。
勿論、ＬＤ駆動回路１００の入力端子Ｐ（図４に記載）は、高周波信号ピン（信号端子）４１ａ、４１ｂに接続される。
【００９７】
さらにまた、この実施の形態では差動駆動方式で説明したが、単相駆動方式でもよく、同様の効果を奏する。
【００９８】
【発明の効果】
この発明によれば、光半導体素子の抵抗性分と並列に見える浮遊容量、更には接続のためのワイヤボンドからなる直列インダクタンスを、低周波は整合抵抗で、高周波は整合抵抗に接続される分布定数回路のインピーダンスと電気長とを最適に配置することで、光半導体素子と信号端子との高周波信号の電力伝達効率を必要以上に落とすことなく、広帯域に反射波を低減することができるとともに、低コストな光半導体装置を得ることができる。
【図面の簡単な説明】
【図１】この発明にかかる実施の形態１の光半導体装置に用いられる光半導体用パッケージの外観構成を示す斜視図である。
【図２】この発明にかかる実施の形態１の光半導体装置に用いられる光半導体用パッケージとレセプタクルが接続されたＬＤモジュールの外観構成を示す斜視図である。
【図３】ＬＤモジュールの水平及び垂直断面図である。
【図４】キャンパッケージ内の構成要素およびＬＤ駆動回路の等価回路図である。
【図５】この発明にかかる実施の形態１のキャンパッケージの内部構成および外部基板の一部構成を示す斜視図である。
【図６】この発明にかかる実施の形態１のキャンパッケージの内部構成および外部基板の一部構成を示す平面図である。
【図７】この発明にかかる実施の形態１のステム部分とマイクロストリップ線路との取付け形態の説明図である。
【図８】この発明にかかる実施の形態１の整合抵抗の直後の、（ａ）スミスチャートと、（ｂ）反射特性の周波数依存性を示す図である。
【図９】この発明にかかる実施の形態１の差動線路の直後の、（ａ）スミスチャートと、（ｂ）反射特性の周波数依存性を示す図（その１）である。
【図１０】この発明にかかる実施の形態１の差動線路の直後の、（ａ）スミスチャートと、（ｂ）反射特性の周波数依存性を示す図である。
【図１１】この発明にかかる実施の形態１の差動線路の直後の、（ａ）スミスチャートと、（ｂ）反射特性の周波数依存性を示す図（その２）である。
【図１２】この発明にかかる実施の形態１の光半導体装置の、反射特性の実験結果の一例を示す図（その３）である。
【図１３】この発明にかかる実施の形態２の差動線路の直後の、（ａ）スミスチャートと、（ｂ）反射特性の周波数依存性を示す図である。
【図１４】この発明にかかる実施の形態３の差動線路の直後の、（ａ）スミスチャートと、（ｂ）反射特性の周波数依存性を示す図である。
【符号の説明】
１ 光半導体用パッケージ（キャンパッケージ）、２ レセプタクル、３ 光半導体素子モジュール（ＬＤモジュール）、１０ ステム、１０ａ 第１ステム部材、１０ｂ 第２ステム部材、１０ｚ ステム外壁面、１１ 台座、１２ 集光レンズ、１３ キャップ、１３ａ 第１キャップ部材、１３ｂ 第２キャップ部材、１４ 孔、１５ 内部空間、１６ ウィンドウ、１７ 孔、１８ ダミーフェルール、１８ａ 光ファイバ、１９ フェルール挿入孔、２０ 光ファイバ、２１ フェルール、３０、３０ｂ 分布定数回路、３１ａ，３１ｂ 整合抵抗、３３ａ，３３ｂ ソレノイド（空芯ソレノイド）、３４ａ，３４ｂ 共振防止抵抗、３５ａ，３５ｂ ワイヤボンド、３６ バイアス定電流源、４０ 半導体レーザダイオード（ＬＤ）、４１ａ，４１ｂ 高周波信号ピン、４２ａ，４２ｂグランドピン、４３ モニタ信号ピン、４４ａ，４４ｂ バイアス給電ピン、４５ ＰＤ用チップキャリア、４６，４７ マイクロストリップ差動線路基板、４６ｂ グランデッドコプレナ差動線路、４８ ＬＤ用チップキャリア、４９ バイアス回路用基板、５０ ホトダイオード（ＰＤ）、５２ａ，５２ｂ，５２ｅ，５２ｆ ストリップ差動信号線、５３ａ，５３ｂ パッド、５４ａ，５４ｂ スタブ、５６ａ，５６ｂ ストリップ差動信号線、５７ａ，５７ｂ ワイヤボンド、５９ａ，５９ｂ ストリップ差動信号線、６０ ワイヤボンド、６１ａ，６１ｂ ワイヤボンド、６２ａ，６２ｂ 配線パターン、６３ａ，６３ｂ ワイヤボンド、７０ グランデッドコプレナ差動線路、７１ａ，７１ｂ 差動信号線、７２ａ，７２ｂ グランド、７７，７８，７９ａ，７９ｂ 誘電体、８０ａ，８０ｂ 貫通孔、１００ ＬＤ駆動回路（集積回路）、１０１ 外部基板、１０２入力バッファ、１０３，１０４ トランジスタ（差動トランジスタ）、１０５トランジスタ（バイアス定電流源）、３００ 集積回路用基板（外部基板）、３０１ａ，３０１ｂ パッド、３０２ａ，３０２ｂ スタブ、４１１ａ，４１１ｂ 屈曲部、１０００ａ，１０００ｂ 半田流れ止め部。
Claims (15)
- 一対の電極を有する光半導体素子と、
前記光半導体素子の電極と一端が直列接続されるインピーダンス整合用の抵抗と、
前記抵抗の他端と一端が接続される分布定数線路と、
前記分布定数線路の他端と一端が接続される信号端子とを備え、
前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和が、前記信号端子に接続される電気回路のインピーダンスよりも小さく、
かつ前記分布定数線路の特性インピーダンスが、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和とほぼ等しいか、もしくはその０．６倍から１．４倍の範囲であって、
かつ前記分布定数線路の電気長が伝送する信号の周波数における略１／１６波長から略３／１６波長の長さである
ことを特徴とする光半導体装置。 - 一対の電極を有する光半導体素子と、
前記光半導体素子の夫々の電極に、夫々一端が接続されるインピーダンス整合用の第１、第２の抵抗と、
差動線路を構成する第１、第２の導体線路を有し、当該夫々の導体線路の一端が前記第１、第２の抵抗の他端と夫々接続された分布定数線路と、
前記分布定数線路の第１、第２の導体線路における他端に、夫々一端が接続された第１、第２の信号端子とを備え、
前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和が、前記第１、第２の信号端子とそれぞれ接続された第１、第２の電気回路のインピーダンスの和より小さく、
かつ前記分布定数線路における差動線路の特性インピーダンスが、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和とほぼ等しいか、もしくはその０．６倍から１．４倍の範囲であって、
かつ前記分布定数線路における差動線路の夫々の電気長が伝送する信号の周波数における１／１６波長から３／１６波長である
ことを特徴とする光半導体装置。 - 一対の電極を有する光半導体素子と、
前記光半導体素子の電極と一端が直列接続されるインピーダンス整合用の抵抗と、
前記抵抗の他端と一端が接続される分布定数線路と、
前記分布定数線路の他端と一端が接続される信号端子とを備え、
前記光半導体素子のインピーダンスと前記抵抗のインピーダンスの和が前記信号端子と接続される電気回路のインピーダンスよりも小さく、
かつ前記分布定数線路の特性インピーダンスは、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和と、前記電気回路のインピーダンスとの中間であって、
かつ前記分布定数線路の電気長が伝送する信号の周波数における略１／８波長から３／８波長の長さである
ことを特徴とする光半導体装置。 - 一対の電極を有する光半導体素子と、
前記光半導体素子の夫々の電極に、夫々一端が接続されるインピーダンス整合用の第１、第２の抵抗と、
差動線路を構成する第１、第２の導体線路を有し、当該夫々の導体線路の一端が前記第１、第２の抵抗の他端と夫々接続された分布定数線路と、
前記分布定数線路の第１、第２の導体線路における他端に、夫々一端が接続された第１、第２の信号端子とを備え、
前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和が、前記第１、第２の信号端子と夫々接続された第１、第２の電気回路のインピーダンスの和より小さく、
かつ前記分布定数線路における差動線路の特性インピーダンスは、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和と、前記第１および第２の電気回路のインピーダンスの和との中間であって、
かつ前記分布定数線路における差動線路の夫々の電気長が伝送する信号の周波数における略１／８波長から３／８波長の長さである
ことを特徴とする光半導体装置。 - 一対の電極を有する光半導体素子と、
前記光半導体素子の電極と一端が直列接続されるインピーダンス整合用の抵抗と、
前記抵抗の他端と一端が接続される第１の分布定数線路と、
前記第１の分布定数線路と一端が接続される第２の分布定数線路と、
前記第２の分布定数線路の他端と一端が接続される信号端子とを備え、
前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和が前記信号端子に接続される電気回路のインピーダンスよりも小さく、
かつ前記第１の分布定数線路の特性インピーダンスが、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記抵抗のインピーダンスとの和とほぼ等しく、
かつ前記第１の分布定数線路の電気長が伝送する信号の周波数における略１／１６波長〜３／１６波長の長さであって、
かつ前記第２の分布定数線路の特性インピーダンスが、伝送する信号の周波数において前記第１の分布定数線路の特性インピーダンスと、前記電気回路のインピーダンスとの中間であり、
かつ前記第２の分布定数線路の電気長が伝送する信号の周波数における略１／８〜略３／８波長の長さである
ことを特徴とする光半導体装置。 - 一対の電極を有する光半導体素子と、
前記光半導体素子の夫々の電極に、夫々一端が接続されるインピーダンス整合用の第１、第２の抵抗と、
差動線路を構成する第１、第２の導体線路を有し、当該夫々の導体線路の一端が前記第１、第２の抵抗の他端と夫々接続された第１の分布定数線路と、
差動線路を構成する第３、第４の導体線路を有し、当該夫々の導体線路の一端が前記第１、第２の導体線路の他端と夫々接続された第２の分布定数線路と、
前記分布定数線路の第３、第４の導体線路における他端に、夫々一端が接続された第１、第２の信号端子とを備え、
前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和が、前記第１、第２の信号端子と夫々接続された第１、第２の電気回路のインピーダンスの和より小さく、
かつ前記第１の分布定数線路における差動線路の特性インピーダンスが、伝送する信号の周波数より十分に低い周波数において前記光半導体素子のインピーダンスと前記第１および第２の抵抗のインピーダンスとの和とほぼ等しく、かつ前記第１の分布定数線路における差動線路の夫々の電気長が伝送する信号の周波数における１／１６波長〜３／１６波長の長さであり、
かつ前記第２の分布定数線路における差動線路の特性インピーダンスが、伝送する信号の周波数において前記第１の分布定数線路の差動線路の特性インピーダンスと前記第１および第２の電気回路のインピーダンスの和との中間であり、
かつ前記第２の分布定数線路における差動線路の夫々の電気長が伝送する信号の周波数における略１／８波長〜略３／８波長の長さである
ことを特徴とする光半導体装置。 - 前記信号端子と前記分布定数線路の間に配置される、各伝送線路の特性インピーダンスの平均値が、前記電気回路の特性インピーダンスとほぼ等しくなるように構成したことを特徴とする請求項１〜６のいずれかに記載の光半導体装置。
- 前記分布定数線路は、線路の特性インピーダンスもしくは電気長が適宜に異なるように、複数に分割された伝送線路から成り、当該複数の伝送線路の平均の特性インピーダンスが、前記分布定数線路の特性インピーダンスの所望の条件を満足し、前記複数の線路の合計の線路長が前記分布定数線路の電気長の所望の条件を満足することを特徴とする前記請求項１〜６のいずれかに記載の光半導体装置。
- 接地された導電体、および当該導電体に収容された誘電体を有し、当該誘電体の内部を、前記信号端子の一部が貫通するフィードスル−を備えた信号端子であることを特徴とする請求項１〜８のいずれかに記載の光半導体装置。
- 光半導体素子の電極に接続されたバイアス供給回路を備えたことを特徴とする請求項１〜９のいずれかに記載の光半導体装置。
- 抵抗のインピーダンスが、１０Ω〜５０Ωの範囲であることを特徴とする請求項１〜６のいずれかに記載の光半導体装置。
- 信号端子に接続された信号源を内蔵したことを特徴とする請求項１〜６のいずれかに記載の光半導体装置。
- 分布定数線路は、マイクロストリップ線路、コプレーナ線路、グランデッドコプレーナ線路、マイクロストリップ差動線路、コプレーナ差動線路、またはグランデッドコプレーナ差動線路で構成されることを特徴とする請求項１〜６のいずれかに記載の光半導体装置。
- 信号端子は、導電体に収容された硼珪酸ガラス、またはソーダバリウムガラスから成る誘電体を貫通し、当該信号端子は一対のグランド端子に挟まれて配置されたことを特徴とする請求項１〜６のいずれかに記載の光半導体装置。
- 第１、第２の信号端子は、導電体に収容された硼珪酸ガラス、またはソーダバリウムガラスから成る楕円、長円、または繭形の誘電体を貫通して互いに平行に配置され、当該信号端子は一対のグランド端子に挟まれて配置されたことを特徴とする請求項１〜６のいずれかに記載の光半導体装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2003074970A JP2004281975A (ja) | 2003-03-19 | 2003-03-19 | 光半導体装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2003074970A JP2004281975A (ja) | 2003-03-19 | 2003-03-19 | 光半導体装置 |
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| Publication Number | Publication Date |
|---|---|
| JP2004281975A true JP2004281975A (ja) | 2004-10-07 |
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ID=33290402
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| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2003074970A Pending JP2004281975A (ja) | 2003-03-19 | 2003-03-19 | 光半導体装置 |
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| Country | Link |
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Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009245975A (ja) * | 2008-03-28 | 2009-10-22 | Nippon Electric Glass Co Ltd | 光学用キャップ部品 |
| JP2010199324A (ja) * | 2009-02-25 | 2010-09-09 | Nippon Telegr & Teleph Corp <Ntt> | 半導体レーザ素子アレイの実装構造 |
| JP2011155176A (ja) * | 2010-01-28 | 2011-08-11 | Renesas Electronics Corp | 配線構造 |
-
2003
- 2003-03-19 JP JP2003074970A patent/JP2004281975A/ja active Pending
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|---|---|---|---|---|
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| JP2010199324A (ja) * | 2009-02-25 | 2010-09-09 | Nippon Telegr & Teleph Corp <Ntt> | 半導体レーザ素子アレイの実装構造 |
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