JP2004177972A - Active matrix substrate and display device - Google Patents

Active matrix substrate and display device Download PDF

Info

Publication number
JP2004177972A
JP2004177972A JP2003431431A JP2003431431A JP2004177972A JP 2004177972 A JP2004177972 A JP 2004177972A JP 2003431431 A JP2003431431 A JP 2003431431A JP 2003431431 A JP2003431431 A JP 2003431431A JP 2004177972 A JP2004177972 A JP 2004177972A
Authority
JP
Japan
Prior art keywords
insulating film
film
organic semiconductor
bank
display device
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2003431431A
Other languages
Japanese (ja)
Other versions
JP3729196B2 (en
Inventor
Kazuo Yudasaka
一夫 湯田坂
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Seiko Epson Corp
Original Assignee
Seiko Epson Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Seiko Epson Corp filed Critical Seiko Epson Corp
Priority to JP2003431431A priority Critical patent/JP3729196B2/en
Publication of JP2004177972A publication Critical patent/JP2004177972A/en
Application granted granted Critical
Publication of JP3729196B2 publication Critical patent/JP3729196B2/en
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Images

Abstract

<P>PROBLEM TO BE SOLVED: To provide an active matrix substrate, on which a thick insulation film can be suitably formed around an organic semiconductor film of a thin film light emitting element, without damaging the light emitting element. <P>SOLUTION: In the active matrix substrate having a plurality of pixel electrodes, the insulation film is provided around each of the plurality of pixel electrodes. The insulation film includes a first insulation film consisting of an inorganic material and a second insulation film formed on the first insulation film and consisting of an organic material or an inorganic material, in which the insulation film overlaps with a part of the pixel electrode. <P>COPYRIGHT: (C)2004,JPO

Description

本発明は、本発明は有機半導体膜に駆動電流が流れることによって発光するEL(エレクトロルミネッセンス)素子またはLED(発光ダイオード)素子などの薄膜発光素子を薄膜トランジスタ(以下、TFTという。)で駆動制御する表示装置、及びその表示装置に用いるアクティブマトリクス基板に関する。   According to the present invention, a thin film light emitting element such as an EL (electroluminescence) element or an LED (light emitting diode) element that emits light when a drive current flows through an organic semiconductor film is controlled by a thin film transistor (hereinafter, referred to as a TFT). The present invention relates to a display device and an active matrix substrate used for the display device.

EL素子またはLED素子などの電流制御型発光素子を用いたアクティブマトリクス型の表示装置が提案されている。このタイプの表示装置に用いられる発光素子はいずれも自己発光するため、液晶表示装置と違ってバックライトを必要とせず、また、視野角依存性が少ないなどの利点もある。   An active matrix type display device using a current control type light emitting element such as an EL element or an LED element has been proposed. All of the light emitting elements used in this type of display device emit light by themselves, so that unlike a liquid crystal display device, there is an advantage that a backlight is not required and the viewing angle dependency is small.

図22は、このような電荷注入型の有機薄膜EL素子を用いたアクティブマトリクス型表示装置のブロック図である。この図に示すアクティブマトリクス型表示装置1Aでは、透明基板10上に、複数の走査線gateと、該走査線gateの延設方向に対して交差する方向に延設された複数のデータ線sigと、該データ線sigに並列する複数の共通給電線comと、データ線sigと走査線gateとによってマトリクス状に形成された複数の画素7とが構成されている。データ線sigおよび走査線gateに対してはデータ側駆動回路3および走査側駆動回路4が構成されている。各々の画素7には、走査線gateを介して走査信号が供給される導通制御回路50と、この導通制御回路50を介してデータ線sigから供給される画像信号に基づいて発光する薄膜発光素子40とが構成されている。ここに示す例において、導通制御回路50は、走査線gateを介して走査信号がゲート電極に供給される第1のTFT20と、この第1のTFT20を介してデータ線sigから供給される画像信号を保持する保持容量capと、この保持容量capによって保持された画像信号がゲート電極に供給される第2のTFT30とから構成されている。第2のTFT30と薄膜発光素子40とは、後述する対向電極opと共通給電線comとの間に直列に接続している。この薄膜発光素子40は、第2のTFT30がオン状態になったときには共通給電線comから駆動電流が流れ込んで発光するとともに、この発光状態は保持容量capによって所定の期間、保持される。   FIG. 22 is a block diagram of an active matrix display device using such a charge injection type organic thin film EL element. In the active matrix display device 1A shown in this figure, a plurality of scanning lines gate and a plurality of data lines sig extending in a direction intersecting with the extending direction of the scanning lines gate are formed on the transparent substrate 10. , A plurality of common power supply lines com arranged in parallel with the data line sig, and a plurality of pixels 7 formed in a matrix by the data line sig and the scanning line gate. A data side drive circuit 3 and a scan side drive circuit 4 are configured for the data line sig and the scan line gate. Each pixel 7 has a conduction control circuit 50 to which a scanning signal is supplied via a scanning line gate, and a thin film light emitting element which emits light based on an image signal supplied from a data line sig via the conduction control circuit 50 40 are constituted. In the example shown here, the conduction control circuit 50 includes a first TFT 20 for supplying a scanning signal to a gate electrode via a scanning line gate, and an image signal supplied from a data line sig via the first TFT 20. And a second TFT 30 for supplying an image signal held by the storage capacitor cap to the gate electrode. The second TFT 30 and the thin-film light-emitting element 40 are connected in series between a common electrode op and a common power supply line com described later. When the second TFT 30 is turned on, the thin-film light-emitting element 40 emits light when a driving current flows from the common power supply line com, and the light-emitting state is held for a predetermined period by the storage capacitor cap.

このような構成のアクティブマトリクス型表示装置1Aでは、図23および図24(A)、(B)に示すように、いずれの画素7においても、島状の半導体膜を利用して第1のTFT20および第2のTFT30が形成されている。第1のTFT20は、ゲート電極21が走査線gateの一部として構成されている。第1のTFT20は、ソース・ドレイン領域の一方に第1層間絶縁膜51のコンタクホールを介してデータ線sigが電気的に接続し、他方にはドレイン電極22が電気的に接続している。ドレイン電極22は、第2のTFT30の形成領域に向けて延設されており、この延設部分には第2のTFT30のゲート電極31が第1の層間絶縁膜51のコンタクトホールを介して電気的に接続している。第2のTFT30のソース・ドレイン領域の一方には、第1の層間絶縁膜51のコンタクトホールを介して中継電極35が電気的に接続し、この中継電極35には第2の層間絶縁膜52のコンタクトホールを介して薄膜発光素子40の画素電極41が電気的に接続している。   In the active matrix display device 1A having such a configuration, as shown in FIGS. 23 and 24A and 24B, in each of the pixels 7, the first TFT 20 is formed using an island-shaped semiconductor film. And a second TFT 30. In the first TFT 20, the gate electrode 21 is configured as a part of the scanning line gate. In the first TFT 20, the data line sig is electrically connected to one of the source / drain regions via the contact hole of the first interlayer insulating film 51, and the drain electrode 22 is electrically connected to the other. The drain electrode 22 extends toward the formation region of the second TFT 30, and the gate electrode 31 of the second TFT 30 is electrically connected to the extension portion via a contact hole of the first interlayer insulating film 51. Connected. A relay electrode 35 is electrically connected to one of the source / drain regions of the second TFT 30 via a contact hole of a first interlayer insulating film 51, and the relay electrode 35 is connected to a second interlayer insulating film 52. The pixel electrode 41 of the thin-film light emitting element 40 is electrically connected through the contact hole.

画素電極41は、図23および図24(B)、(C)からわかるように各画素7毎に独立して形成されている。画素電極41の上層側には、有機半導体膜43および対向電極opがこの順に積層されている。有機半導体膜43は画素7毎に形成されているが、複数の画素7に跨がってストライプ状に形成される場合もある。対向電極opは、画素7が構成されている表示部11だけでなく、透明基板10の略全面に形成されている。   The pixel electrode 41 is independently formed for each pixel 7 as can be seen from FIGS. 23 and 24B and 24C. On the upper layer side of the pixel electrode 41, an organic semiconductor film 43 and a counter electrode op are stacked in this order. The organic semiconductor film 43 is formed for each pixel 7, but may be formed in a stripe shape over a plurality of pixels 7. The opposing electrode op is formed not only on the display section 11 in which the pixels 7 are formed but also on the substantially entire surface of the transparent substrate 10.

再び、図23および図24(A)において、第2のTFT30のソース・ドレイン領域のもう一方には、第1の層間絶縁膜51のコンタクトホールを介して共通給電線comが電気的に接続している。共通給電線comの延設部分39は、第2のTFT30のゲート電極31の延設部分36に対して、第1の層間絶縁膜51を誘電体膜として挟んで対向し、保持容量capを構成している。   Again, in FIG. 23 and FIG. 24A, the common power supply line com is electrically connected to the other of the source / drain regions of the second TFT 30 via the contact hole of the first interlayer insulating film 51. ing. The extension 39 of the common power supply line com faces the extension 36 of the gate electrode 31 of the second TFT 30 with the first interlayer insulating film 51 interposed therebetween as a dielectric film, and forms a storage capacitor cap. are doing.

しかしながら、前記のアクティブマトリクス型表示装置1Aにおいて、画素電極41に対向する対向電極opは、液晶アクティブマトリクス型表示装置と相違して、同じ透明基板10上においてデータ線sigとの間に第2の層間絶縁膜52しか介在していないので、データ線sigには大きな容量が寄生し、データ側駆動回路3の負荷が大きい。   However, in the active matrix display device 1A, the counter electrode op facing the pixel electrode 41 is different from the liquid crystal active matrix display device in that the counter electrode op is provided on the same transparent substrate 10 between the data line sig and the second electrode op. Since only the interlayer insulating film 52 is interposed, a large capacitance is parasitic on the data line sig, and the load on the data side drive circuit 3 is large.

そこで、本願発明者は、図22、図23、および図25(A)、(B)、(C)に示すように、対向電極opとデータ線sigなどとの間に厚い絶縁膜(バンク層bank/左下がりの斜線を広いピッチで付した領域)を設け、データ線sigに寄生する容量を低減することを提案する。併せて、この絶縁膜(バンク層bank)で有機半導体膜43の形成領域を囲むことによって、インクジェットヘッドから吐出した液状の材料(吐出液)から有機半導体膜43を形成する際に吐出液をバンク層bankでせき止め、吐出液が側方にはみ出すことを防止することを提案する。   Then, as shown in FIGS. 22, 23 and FIGS. 25 (A), (B) and (C), the present inventor has proposed a method of forming a thick insulating film (bank layer) between the opposing electrode op and the data line sig. (a region in which bank / lower left diagonal lines are added at a wide pitch) is proposed to reduce the parasitic capacitance of the data line sig. At the same time, by surrounding the formation region of the organic semiconductor film 43 with this insulating film (bank layer bank), when forming the organic semiconductor film 43 from the liquid material (discharge liquid) discharged from the ink jet head, the discharge liquid is banked. It is proposed to dam by the layer bank to prevent the discharged liquid from protruding to the side.

しかし、かかる構造を採用するにあたって、バンク層bank全体を厚い無機材料から構成すると、成膜時間が長いという問題点がある。また、無機材料からなる厚い膜をパターニングする際には、オーバーエッチング気味になって画素電極41を損傷してしまうおそれがある。一方、バンク層bankをレジストなどの有機材料から構成すると、有機半導体膜43のバンク層bankと接する部分で、バンク層bankを構成する有機材料に含まれる溶剤成分などの影響で有機半導体膜43が劣化するおそれがある。   However, when adopting such a structure, if the entire bank layer bank is made of a thick inorganic material, there is a problem that the film formation time is long. Further, when patterning a thick film made of an inorganic material, the pixel electrode 41 may be damaged due to over-etching. On the other hand, when the bank layer bank is formed of an organic material such as a resist, the organic semiconductor film 43 is formed at a portion of the organic semiconductor film 43 which is in contact with the bank layer bank due to a solvent component contained in the organic material forming the bank layer bank. There is a risk of deterioration.

また、厚いバンク層bankを形成すると、バンク層bankの存在に起因して大きな段差bbが形成されるので、このバンク層bankの上層に形成される対向電極opが前記の段差bbの部分で断線しやすいという問題点がある。このような段差bbで対向電極opに断線が生じると、この部分の対向電極opは周囲の対向電極opから絶縁状態になって表示の点欠陥あるいは線欠陥を発生させる。また、データ側駆動回路3や走査側駆動回路4の表面を覆うバンク層bankの外周縁に沿って対向電極opに断線が起こると、表示部11の対向電極opと端子12との間が完全に絶縁状態になって表示が全くできなくなる。   Further, when a thick bank layer bank is formed, a large step bb is formed due to the existence of the bank layer bank. Therefore, the counter electrode op formed on the bank layer bank is disconnected at the step bb. There is a problem that it is easy to do. When a break occurs in the opposing electrode op due to such a step bb, the opposing electrode op in this portion becomes insulated from the surrounding opposing electrode op and generates a point defect or a line defect in display. Further, when a break occurs in the opposing electrode op along the outer peripheral edge of the bank layer bank covering the surfaces of the data side driving circuit 3 and the scanning side driving circuit 4, the gap between the opposing electrode op of the display unit 11 and the terminal 12 becomes complete. The display becomes insulated and no display can be performed at all.

以上の問題点に鑑みて、本発明の課題は、薄膜発光素子を損傷することなく、当該薄膜発光素子の有機半導体膜の周りに厚い絶縁膜を好適に形成することのできるアクティブマトリクス型表示装置を提供することにある。   In view of the above problems, an object of the present invention is to provide an active matrix display device capable of suitably forming a thick insulating film around an organic semiconductor film of a thin-film light-emitting element without damaging the thin-film light-emitting element. Is to provide.

また、本発明の課題は、有機半導体膜の周りに厚い絶縁膜を形成して寄生容量などを抑えても、この厚い絶縁膜の上層に形成する対向電極に断線などが発生しないアクティブマトリクス型表示装置を提供することにある。
Further, an object of the present invention is to provide an active matrix type display in which even if a thick insulating film is formed around an organic semiconductor film to suppress parasitic capacitance and the like, disconnection does not occur in a counter electrode formed above this thick insulating film. It is to provide a device.

本発明のアクティブマトリックス基板は、複数の画素電極を備えたアクティブマトリクス基板において、前記複数の画素電極の各々の周囲には絶縁膜が設けられており、前記絶縁膜は、無機材料からなる第1の絶縁膜と、前記第1の絶縁膜上に形成されてなり、有機材料又は無機材料からなる第2の絶縁膜と、を含み、前記絶縁膜と前記画素電極の一部とが重なってなることを特徴とする。   The active matrix substrate according to the present invention is an active matrix substrate including a plurality of pixel electrodes, wherein an insulating film is provided around each of the plurality of pixel electrodes, and the insulating film is made of an inorganic material. And a second insulating film formed on the first insulating film and made of an organic material or an inorganic material, wherein the insulating film and a part of the pixel electrode overlap with each other. It is characterized by the following.

また、前記複数の画素電極の各々と、前記複数の画素電極に対向する対向電極と、それらの間に配置した有機半導体膜と、を含む薄膜発光素子を備え、前記有機半導体膜は、前記絶縁膜により区画されてなることを特徴とする。   A thin-film light-emitting element including: each of the plurality of pixel electrodes; a counter electrode facing the plurality of pixel electrodes; and an organic semiconductor film disposed therebetween. It is characterized by being partitioned by a membrane.

また、複数の走査線と、複数のデータ線と、前記複数の走査線と前記複数のデータ線とによりマトリクス状に形成された複数の画素と、を含んでなり、前記複数の画素の各々は、前記複数の走査線のうち対応する走査線にゲート電極が接続されたトランジスタを含む導通制御回路と、画素電極、前記画素電極に対向する対向電極、及び前記画素電極と前記対向電極との間に設けられた有機半導体膜を含む薄膜発光素子と、を備えてなる表示装置において、前記有機半導体膜は、前記データ線及び前記対向電極との間に設けられた絶縁膜により区画され、前記絶縁膜は、無機材料からなる前記第1の絶縁膜と、前記第1の絶縁膜上に形成されてなり有機材料又は無機材料からなる第2の絶縁膜とを含むとともに、前記絶縁膜と前記画素電極の一部とが重なってなることを特徴とする。   Further, a plurality of scanning lines, a plurality of data lines, and a plurality of pixels formed in a matrix by the plurality of scanning lines and the plurality of data lines, each of the plurality of pixels A conduction control circuit including a transistor having a gate electrode connected to a corresponding scanning line among the plurality of scanning lines, a pixel electrode, a counter electrode facing the pixel electrode, and between the pixel electrode and the counter electrode. A thin-film light-emitting element including an organic semiconductor film provided in the display device, wherein the organic semiconductor film is partitioned by an insulating film provided between the data line and the counter electrode, The film includes the first insulating film made of an inorganic material, and a second insulating film formed on the first insulating film and made of an organic material or an inorganic material, and the insulating film and the pixel One of the electrodes Door, characterized in that it is made to overlap.

また、前記画素電極の前記導通制御回路の形成領域と重なる領域は前記絶縁膜で覆われていることを特徴とする。   Further, a region of the pixel electrode overlapping a region where the conduction control circuit is formed is covered with the insulating film.

また、、前記絶縁膜で区画されている領域は、隅部分が丸みを帯びていること、を特徴とする。   Further, in the region partitioned by the insulating film, a corner portion is rounded.

また、前記第1の絶縁膜は、前記複数のデータ線、前記複数の走査線を覆うように形成されていることを特徴とする。   Further, the first insulating film is formed so as to cover the plurality of data lines and the plurality of scanning lines.

また、前記有機半導体膜は、前記複数の画素電極と前記対向電極との間に駆動電流が流れることによって発光することを特徴とする。   The organic semiconductor film emits light when a drive current flows between the plurality of pixel electrodes and the counter electrode.

本発明では、基板上に、複数の走査線と、該走査線の延設方向に対して交差する方向に延設された複数のデータ線と、該データ線と前記走査線とによってマトリクス状に形成された複数の画素からなる表示部とを有し、該画素の各々は、前記走査線を介して走査信号がゲート電極に供給される薄膜トランジスタを含む導通制御回路と、画素毎に形成された画素電極、該画素電極の上層側に積層された有機半導体膜、および該有機半導体膜の上層側に積層された対向電極を具備する薄膜発光素子とを備え、前記データ線から前記導通制御回路を介して供給される画像信号に基づいて前記薄膜発光素子が発光するアクティブマトリクス型表示装置において、前記有機半導体膜の形成領域は当該有機半導体膜よりも厚く形成された絶縁膜によって区画され、該絶縁膜は、当該有機半導体膜よりも厚く形成された無機材料からなる下層側絶縁膜と、該下層側絶縁膜上に積層された有機材料からなる上層側絶縁膜とを備えていることを特徴とする。   In the present invention, a plurality of scanning lines, a plurality of data lines extending in a direction intersecting with the extending direction of the scanning lines, and a matrix of the data lines and the scanning lines are provided on the substrate. A display unit including a plurality of pixels formed, each of which is formed with a conduction control circuit including a thin film transistor in which a scanning signal is supplied to a gate electrode through the scanning line, and a pixel formed for each pixel. A pixel electrode, an organic semiconductor film stacked on the upper side of the pixel electrode, and a thin film light emitting element including a counter electrode stacked on the upper side of the organic semiconductor film, and the conduction control circuit is formed from the data line. In the active matrix display device in which the thin-film light-emitting element emits light based on an image signal supplied via the organic semiconductor film, a region where the organic semiconductor film is formed is defined by an insulating film formed to be thicker than the organic semiconductor film. The insulating film includes a lower insulating film made of an inorganic material and formed thicker than the organic semiconductor film, and an upper insulating film made of an organic material laminated on the lower insulating film. It is characterized by the following.

本発明において、対向電極は少なくとも表示部の全面に形成され、データ線と対向する状態にあるため、このままではデータ線に対して大きな容量が寄生することになる。しかるに本発明では、データ線と対向電極との間に厚い絶縁膜を介在させたので、データ線に容量が寄生することを防止できる。その結果、データ側駆動回路の負荷を低減できるので、低消費電力化あるいは表示動作の高速化を図ることができる。また、厚い絶縁膜を形成するにあたって、それ全体を無機材料からなる膜で構成すると、長い成膜時間を必要とするので、生産性が低下する。しかるに本発明では、薄膜発光素子の有機半導体膜と接する下層側絶縁膜のみを無機材料から構成し、その上層側にはレジストなどの有機材料から構成した上層側絶縁膜を積層する。かかる有機材料から構成した上層側絶縁膜であれば、厚い膜を容易に形成できるので、生産性が向上する。しかも、この上層側絶縁膜は有機半導体膜と接しておらず、有機半導体膜と接するのは無機材料から構成した下層側絶縁膜なので、有機半導体膜は上層側絶縁膜の影響を受けて劣化することがない。それ故、薄膜発光素子は、発光効率の低下や信頼性の低下などを起こさない。   In the present invention, since the counter electrode is formed at least on the entire surface of the display portion and is in a state of facing the data line, a large capacitance is parasitic on the data line as it is. However, in the present invention, since a thick insulating film is interposed between the data line and the counter electrode, it is possible to prevent the data line from having a parasitic capacitance. As a result, the load on the data-side driving circuit can be reduced, so that low power consumption or high-speed display operation can be achieved. In addition, when a thick insulating film is formed by using a film made of an inorganic material as a whole, a long film forming time is required, so that productivity is reduced. However, in the present invention, only the lower insulating film that is in contact with the organic semiconductor film of the thin-film light emitting element is made of an inorganic material, and the upper insulating film made of an organic material such as a resist is stacked on the upper insulating film. If the upper insulating film is made of such an organic material, a thick film can be easily formed, thereby improving the productivity. Moreover, the upper insulating film is not in contact with the organic semiconductor film, and is in contact with the organic semiconductor film because the lower insulating film is made of an inorganic material, so that the organic semiconductor film is deteriorated under the influence of the upper insulating film. Nothing. Therefore, the thin-film light-emitting element does not cause a decrease in luminous efficiency or a decrease in reliability.

本発明において、前記上層側絶縁膜は、前記下層側絶縁膜より狭い幅をもって当該下層側絶縁膜の内側領域に積層されていることが好ましい。このような2段構造とすると、有機材料から構成された上層側絶縁膜は、有機半導体膜により接しにくくなるので、有機半導体膜の劣化をより確実に防止できる。   In the present invention, it is preferable that the upper insulating film is stacked in a region inside the lower insulating film with a width smaller than that of the lower insulating film. With such a two-stage structure, the upper insulating film made of an organic material is less likely to be in contact with the organic semiconductor film, so that deterioration of the organic semiconductor film can be more reliably prevented.

このような2段構造であれば、下層側絶縁膜および上層側絶縁膜の双方を無機材料から構成してもよい。すなわち、本発明の別の形態では、基板上に、複数の走査線と、該走査線の延設方向に対して交差する方向に延設された複数のデータ線と、該データ線と前記走査線とによってマトリクス状に形成された複数の画素からなる表示部とを有し、該画素の各々は、前記走査線を介して走査信号がゲート電極に供給される薄膜トランジスタを含む導通制御回路と、画素毎に形成された画素電極、該画素電極の上層側に積層された有機半導体膜、および該有機半導体膜の上層側に積層された対向電極を具備する薄膜発光素子とを備え、前記データ線から前記導通制御回路を介して供給される画像信号に基づいて前記薄膜発光素子が発光するアクティブマトリクス型表示装置において、前記有機半導体膜の形成領域は当該有機半導体膜よりも厚く形成された絶縁膜によって区画され、該絶縁膜は、無機材料からなる下層側絶縁膜と、該下層側絶縁膜より狭い幅をもって当該下層側絶縁膜の内側領域に積層された無機材料からなる上層側絶縁膜とを備えていることを特徴とする。   In such a two-stage structure, both the lower insulating film and the upper insulating film may be made of an inorganic material. That is, in another aspect of the present invention, a plurality of scanning lines, a plurality of data lines extending in a direction intersecting the direction in which the scanning lines extend on the substrate, A display unit including a plurality of pixels formed in a matrix by lines and each of the pixels includes a conduction control circuit including a thin film transistor in which a scan signal is supplied to a gate electrode through the scan line; A data electrode comprising: a pixel electrode formed for each pixel; an organic semiconductor film laminated on an upper layer side of the pixel electrode; and a thin film light emitting device including a counter electrode laminated on the organic semiconductor film. In the active matrix display device in which the thin-film light-emitting element emits light based on an image signal supplied from the semiconductor device through the conduction control circuit, the formation region of the organic semiconductor film is formed to be thicker than the organic semiconductor film. The lower insulating film made of an inorganic material, and the upper insulating film made of an inorganic material having a width smaller than that of the lower insulating film and stacked in an inner region of the lower insulating film. And a membrane.

このように構成すると、下層側絶縁膜および上層側絶縁膜を構成すべき無機材料からなる膜を形成した後、まず、上層側絶縁膜をパターニングする。この際には、下層側絶縁膜がエッチングストッパーとして機能するので、多少のオーバーエッチングがあっても、画素電極を損傷することはない。かかるパターニングを終えた後には下層側絶縁膜をパターニング形成する。この際には、下層側絶縁膜の1層分をエッチングするだけなので、エッチング制御が容易で、画素電極を損傷するほどのオーバーエッチングが起きない。   With this configuration, after forming a film made of an inorganic material to constitute the lower insulating film and the upper insulating film, first, the upper insulating film is patterned. In this case, since the lower insulating film functions as an etching stopper, even if there is some over-etching, the pixel electrode is not damaged. After the completion of the patterning, the lower insulating film is formed by patterning. At this time, since only one layer of the lower insulating film is etched, the etching control is easy, and over-etching that may damage the pixel electrode does not occur.

本発明では、前記導通制御回路は、前記走査信号がゲート電極に供給される第1のTFT、および該第1のTFTを介してゲート電極が前記データ線に接続する第2のTFTを備え、該第2のTFTと前記薄膜発光素子は、前記データ線および走査線とは別に構成された駆動電流供給用の共通給電線と前記対向電極との間に直列に接続していることが好ましい。すなわち、導通制御回路を1つのTFTと保持容量で構成することも可能ではあるが、表示品位を高くするという観点からすれば各画素の導通制御回路を2つのTFTと保持容量で構成することが好ましい。   In the present invention, the conduction control circuit includes a first TFT to which the scanning signal is supplied to a gate electrode, and a second TFT whose gate electrode is connected to the data line via the first TFT. It is preferable that the second TFT and the thin-film light emitting element are connected in series between a common power supply line for supplying a drive current, which is formed separately from the data line and the scanning line, and the counter electrode. In other words, the conduction control circuit can be composed of one TFT and a storage capacitor, but from the viewpoint of improving display quality, the conduction control circuit of each pixel can be composed of two TFTs and a storage capacitor. preferable.

本発明において、前記絶縁膜は、当該絶縁膜で区画された領域内に前記有機半導体膜をインクジェット法により形成する際に吐出液のはみ出しを防止するバンク層として利用することが好ましい。それには、前記絶縁膜は、膜厚が1μm以上であることが好ましい。   In the present invention, it is preferable that the insulating film is used as a bank layer for preventing a discharge liquid from protruding when the organic semiconductor film is formed in a region defined by the insulating film by an inkjet method. To this end, the insulating film preferably has a thickness of 1 μm or more.

本発明において、前記画素電極の形成領域のうち、前記導通制御回路の形成領域と重なる領域は前記絶縁膜で覆われていることが好ましい。すなわち、前記画素電極の形成領域のうち、前記導通制御回路の形成されていない平坦部分のみについて前記の厚い絶縁膜を開口し、その内側のみに有機半導体膜を形成することが好ましい。このように構成すると、有機半導体膜の膜厚ばらつきに起因する表示むらを防止できる。また、有機半導体膜に膜厚の薄い部分があると、そこに薄膜発光素子の駆動電流が集中し、薄膜発光素子の信頼性が低下することになるが、そのような問題を防止することができる。さらに、画素電極が形成されていても導通制御回路と重なる領域では、たとえ対向電極との間に駆動電流が流れて有機半導体膜が発光しても、この光は導通制御回路に遮られ、表示には寄与しない。かかる表示に寄与しない部分で有機半導体膜に流れる駆動電流は、表示という面からみて無効電流といえる。そこで、本発明では、従来ならこのような無効電流が流れるはずの部分に前記の厚い絶縁膜を形成し、そこに駆動電流が流れることを防止する。その結果、共通給電線に流れる電流が小さくすることができるので、その分、共通給電線の幅を狭くすれば、その結果として、発光面積を増すことができ、輝度、コントラスト比などの表示性能を向上させることができる。   In the present invention, it is preferable that, of the pixel electrode formation region, a region overlapping with the conduction control circuit formation region is covered with the insulating film. That is, it is preferable that the thick insulating film is opened only in a flat portion where the conduction control circuit is not formed in the pixel electrode formation region, and the organic semiconductor film is formed only inside the thick insulating film. With this configuration, it is possible to prevent display unevenness due to variation in the thickness of the organic semiconductor film. In addition, when there is a thin portion in the organic semiconductor film, the driving current of the thin-film light-emitting element is concentrated there, and the reliability of the thin-film light-emitting element is reduced. However, such a problem can be prevented. it can. Furthermore, even if a pixel electrode is formed, even if a driving current flows between the counter electrode and the organic semiconductor film in a region overlapping with the conduction control circuit, the light is blocked by the conduction control circuit and the display is blocked. Does not contribute to The drive current flowing through the organic semiconductor film in a portion that does not contribute to display can be said to be a reactive current from the viewpoint of display. Therefore, in the present invention, the above-described thick insulating film is formed in a portion where such a reactive current would otherwise flow, and a drive current is prevented from flowing therethrough. As a result, the current flowing through the common power supply line can be reduced, and accordingly, if the width of the common power supply line is reduced, the light emitting area can be increased, and the display performance such as brightness and contrast ratio can be increased. Can be improved.

本発明において、前記絶縁膜で区画されている領域に対してその隅部分に丸みをもたせれば、有機半導体膜を角のない丸みをもった平面形状に形成できる。このような形状の有機半導体膜であれば、角部分の駆動電流が集中することがないので、この部分での耐圧不足などの不具合の発生を防止できる。   In the present invention, if the corners of the region defined by the insulating film are rounded, the organic semiconductor film can be formed in a planar shape with no rounded corners. With an organic semiconductor film having such a shape, since a driving current does not concentrate at a corner portion, it is possible to prevent a problem such as insufficient breakdown voltage at this portion.

本発明において、前記有機半導体膜をストライプ状に形成する場合には、前記絶縁膜のうち、前記下層側絶縁膜は、前記画素電極の形成領域のうち前記導通制御回路の形成領域と重なる領域、前記データ線、前記共通給電線、および前記走査線を覆うように形成する一方、前記上層側絶縁膜は前記データ線に沿ってストライプ状に形成し、この上層側絶縁膜でストライプ状に区画された領域内に前記有機半導体膜を、たとえばインクジェット法により形成する。   In the present invention, when the organic semiconductor film is formed in a stripe shape, in the insulating film, the lower insulating film is a region overlapping the conduction control circuit forming region in the pixel electrode forming region, The upper insulating film is formed in a stripe shape along the data line while being formed so as to cover the data line, the common power supply line, and the scanning line, and is partitioned in a stripe shape by the upper insulating film. The organic semiconductor film is formed, for example, by an ink-jet method in the region.

このように構成した場合には、導通制御回路が下層側絶縁膜で覆われているので、各画素のうち、画素電極の平坦部分のみに形成された有機半導体膜のみが発光に寄与する。すなわち、画素電極の平坦部分のみに薄膜発光素子が形成されていることになる。それ故、有機半導体膜は一定の膜厚で形成され、表示むらを起こさない。また、表示に寄与しない部分に駆動電流が流れるのを下層側絶縁膜で防止するので、共通給電線に無駄な電流が流れることを防止できるという効果もある。さらに、このように構成すると、前記絶縁膜のうち、前記下層側絶縁膜と前記上層側絶縁膜が重なる部分は、前記有機半導体膜をインクジェット法により形成する際に吐出液のはみ出しを防止するバンク層として利用できる。このようなバンク層として利用するにあたっては、前記下層側絶縁膜と前記上層側絶縁膜が重なる部分は、膜厚を1μm以上にすることが好ましい。   In such a configuration, since the conduction control circuit is covered with the lower insulating film, only the organic semiconductor film formed only on the flat portion of the pixel electrode in each pixel contributes to light emission. That is, the thin film light emitting element is formed only on the flat portion of the pixel electrode. Therefore, the organic semiconductor film is formed with a constant thickness, and does not cause display unevenness. Further, since the drive current is prevented from flowing to the portion that does not contribute to the display by the lower insulating film, there is also an effect that unnecessary current can be prevented from flowing to the common power supply line. Further, with such a configuration, a portion of the insulating film where the lower-layer insulating film and the upper-layer insulating film overlap each other is a bank for preventing the overflow of the discharge liquid when the organic semiconductor film is formed by the inkjet method. Available as layers. When used as such a bank layer, it is preferable that the portion where the lower insulating film and the upper insulating film overlap has a thickness of 1 μm or more.

また、本発明では、前記絶縁膜は、各画素毎の対向電極部分同士を当該絶縁膜に起因する段差のない平坦部分を介して接続させる第1の途切れ部分を備えていることが好ましい。本発明において、前記絶縁膜を厚く形成すると、この絶縁膜は大きな段差を形成し、その上層側に形成される対向電極に断線が発生させるおそれがある。しかるに本発明では、厚い絶縁膜の所定の位置に第1の途切れ部分を構成し、この部分を平坦にしてある。従って、各領域毎の対向電極は平坦部分に形成された部分を介して電気的に接続するので、たとえ、絶縁膜に起因する段差によってこの部分で断線しても、絶縁膜の第1の途切れ部分に相当する平坦部分を介して確実に電気的に接続しているので、対向基板の断線という不具合が発生しない。それ故、アクティブマトリクス型表示装置において、有機半導体膜の周りに厚い絶縁膜を形成して寄生容量などを抑えたとしても、絶縁膜の上層に形成する対向電極に断線が発生しないので、アクティブマトリクス型表示装置の表示品質および信頼性を向上することができる。   Further, in the present invention, it is preferable that the insulating film has a first discontinuous portion connecting the opposing electrode portions of the respective pixels via a flat portion having no step due to the insulating film. In the present invention, if the insulating film is formed thick, the insulating film forms a large step, and there is a possibility that the opposing electrode formed on the upper layer may be disconnected. However, in the present invention, the first discontinuous portion is formed at a predetermined position of the thick insulating film, and this portion is flattened. Therefore, since the opposing electrodes in each region are electrically connected to each other via the portion formed in the flat portion, even if the portion is disconnected at this portion due to a step caused by the insulating film, the first interruption of the insulating film is caused. Since the electrical connection is securely made via the flat portion corresponding to the portion, the problem of disconnection of the counter substrate does not occur. Therefore, in an active matrix type display device, even if a thick insulating film is formed around an organic semiconductor film to suppress parasitic capacitance and the like, a disconnection does not occur in a counter electrode formed above the insulating film. The display quality and reliability of the type display device can be improved.

本発明においては、前記絶縁膜は、前記データ線および前記走査線に沿って形成されていることにより前記有機半導体膜の形成領域の周りを囲んでいる場合には、前記データ線の延設方向で隣り合う画素の間、前記走査線の延設方向で隣り合う画素の間、またはそれら双方の方向で隣り合う画素の間に相当する部分に前記第1の途切れ部分を構成することが好ましい。   In the present invention, when the insulating film surrounds a region where the organic semiconductor film is formed by being formed along the data line and the scanning line, an extending direction of the data line is provided. Preferably, the first discontinuous portion is formed between adjacent pixels, between adjacent pixels in the scanning line extending direction, or between adjacent pixels in both directions.

また、前記絶縁膜は前記データ線に沿ってストライプ状に延設される場合があり、この場合には、該延設方向の少なくとも一方の端部に前記第1の途切れ部分を構成してもよい。   In some cases, the insulating film extends in a stripe shape along the data line. In this case, the first interrupted portion may be formed at at least one end in the extending direction. Good.

本発明では、前記表示部の周囲には、前記データ線を介してデータ信号を供給するデータ側駆動回路、および前記走査線を介して走査信号を供給する走査側駆動回路を有し、該走査側駆動回路および前記データ側駆動回路の上層側にも前記絶縁膜が形成されているとともに、当該絶縁膜は、前記走査側駆動回路の形成領域と前記データ側駆動回路の形成領域との間に相当する位置には前記対向電極を前記表示部側と基板外周側とを当該絶縁膜に起因する段差のない平坦部分を介して接続させる第2の途切れ部分を備えていることが好ましい。このように構成すると、データ側駆動回路や走査側駆動回路の表面を覆う絶縁膜の外周縁に沿って対向電極に断線が起きても、表示部側の対向電極と基板外周側の対向電極とは該絶縁膜に起因する段差のない平坦部分を介して接続し、表示部側の対向電極と基板外周側の対向電極との間の電気的接続を確保できる。   According to the present invention, a data-side driving circuit for supplying a data signal via the data line and a scanning-side driving circuit for supplying a scanning signal via the scanning line are provided around the display section, The insulating film is also formed on the upper layer side of the side drive circuit and the data side drive circuit, and the insulating film is provided between the formation region of the scan side drive circuit and the formation region of the data side drive circuit. It is preferable that a corresponding portion has a second discontinuous portion connecting the counter electrode to the display portion side and the outer peripheral side of the substrate via a flat portion having no step due to the insulating film. With such a configuration, even if a break occurs in the counter electrode along the outer peripheral edge of the insulating film covering the surface of the data-side drive circuit or the scan-side drive circuit, the counter electrode on the display unit side and the counter electrode on the outer peripheral side of the substrate can be connected. Are connected via a flat portion having no step due to the insulating film, and electrical connection between the counter electrode on the display portion side and the counter electrode on the outer peripheral side of the substrate can be secured.

本発明において、前記途切れ部分では、前記絶縁膜を構成する前記下層側絶縁膜および前記上層側絶縁膜の双方が途切れている構成、あるいは前記絶縁膜を構成する前記下層側絶縁膜および前記上層側絶縁膜のうち、上層側絶縁膜のみが途切れている構成のいずれであってもよい。
In the present invention, in the discontinued portion, a configuration in which both the lower insulating film and the upper insulating film constituting the insulating film are interrupted, or the lower insulating film and the upper layer constituting the insulating film Of the insulating films, any of the configurations in which only the upper insulating film is interrupted may be used.

図面を参照して、本発明の実施の形態を説明する。なお、以下の説明において、図22ないし図25を参照して説明した構成要素と共通する部分には同一の符号を付してある。   Embodiments of the present invention will be described with reference to the drawings. In the following description, the same reference numerals are given to portions common to the components described with reference to FIGS.

実施の形態1Embodiment 1

(全体構成)
図1は、アクティブマトリクス型表示装置の全体のレイアウトを模式的に示すブロック図である。図2は、それに構成されている画素の1つを抜き出して示す平面図、図3(A)、(B)、(C)はそれぞれ図2のA−A′断面図、B−B′断面図、およびC−C′断面図である。
(overall structure)
FIG. 1 is a block diagram schematically showing an overall layout of an active matrix display device. FIG. 2 is a plan view showing one of the pixels formed therein, and FIGS. 3A, 3B, and 3C are AA 'sectional view and BB' sectional view of FIG. 2, respectively. It is a figure and CC 'sectional drawing.

図1に示すアクティブマトリクス型表示装置1では、その基体たる透明基板10の中央部分が表示部11とされている。透明基板10の外周部分のうち、データ線sigの端部には画像信号を出力するデータ側駆動回路3が構成され、走査線gateの端部には走査信号を出力する走査側駆動回路4が構成されている。これらの駆動回路3、4では、N型のTFTとP型のTFTとによって相補型TFTが構成され、この相補型TFTは、シフトレジスタ回路、レベルシフタ回路、アナログスイツチ回路などを構成している。表示部11では、液晶アクティブマトリクス型表示装置のアクティブマトリクス基板と同様、透明基板10上に、複数の走査線gateと、該走査線gateの延設方向に対して交差する方向に延設された複数のデータ線sigと、データ線sigおよび走査線gateによってマトリクス状に形成された複数の画素7とが構成されている。   In the active matrix display device 1 shown in FIG. 1, a central portion of a transparent substrate 10 serving as a base is a display unit 11. In the outer peripheral portion of the transparent substrate 10, a data drive circuit 3 for outputting an image signal is formed at an end of the data line sig, and a scan drive circuit 4 for outputting a scan signal is provided at an end of the scan line gate. It is configured. In these driving circuits 3 and 4, a complementary TFT is formed by the N-type TFT and the P-type TFT, and the complementary TFT forms a shift register circuit, a level shifter circuit, an analog switch circuit and the like. In the display unit 11, similarly to the active matrix substrate of the liquid crystal active matrix type display device, a plurality of scanning lines “gate” are provided on the transparent substrate 10 in a direction intersecting the extending direction of the scanning lines “gate”. A plurality of data lines sig and a plurality of pixels 7 formed in a matrix by the data lines sig and the scanning lines gate are configured.

各々の画素7には、走査線gateを介して走査信号が供給される導通制御回路50と、この導通制御回路50を介してデータ線sigから供給される画像信号に基づいて発光する薄膜発光素子40とが構成されている。ここに示す例においては、導通制御回路50は、走査線gateを介して走査信号がゲート電極に供給される第1のTFT20と、この第1のTFT20を介してデータ線sigから供給される画像信号を保持する保持容量capと、この保持容量capによって保持された画像信号がゲート電極に供給される第2のTFT30とから構成されている。第2のTFT30と薄膜発光素子40とは、後述する対向電極opと共通給電線comとの間に直列に接続している。なお、保持容量capについては共通給電線comとの間に形成した構造の他、走査線gateと並列に形成した容量線との間に形成してもよい。   Each pixel 7 has a conduction control circuit 50 to which a scanning signal is supplied via a scanning line gate, and a thin film light emitting element which emits light based on an image signal supplied from a data line sig via the conduction control circuit 50 40 are constituted. In the example shown here, the conduction control circuit 50 includes a first TFT 20 to which a scanning signal is supplied to a gate electrode via a scanning line gate, and an image supplied from a data line sig via the first TFT 20. A storage capacitor cap for holding signals and a second TFT 30 for supplying an image signal held by the storage capacitor cap to the gate electrode. The second TFT 30 and the thin-film light-emitting element 40 are connected in series between a common electrode op and a common power supply line com described later. The storage capacitor cap may be formed between the scanning line gate and a capacitor line formed in parallel, in addition to the structure formed between the storage capacitor cap and the common power supply line com.

このような構成のアクティブマトリクス型表示装置1では、図2および図3(A)、(B)に示すように、いずれの画素7においても、島状の半導体膜(シリコン膜)を利用して第1のTFT20および第2のTFT30が形成されている。   In the active matrix display device 1 having such a configuration, as shown in FIGS. 2 and 3A and 3B, each of the pixels 7 uses an island-shaped semiconductor film (silicon film). A first TFT 20 and a second TFT 30 are formed.

第1のTFT20は、ゲート電極21が走査線gateの一部として構成されている。第1のTFT20は、ソース・ドレイン領域の一方に第1層間絶縁膜51のコンタクホールを介してデータ線sigが電気的に接続し、他方にはドレイン電極22が電気的に接続している。ドレイン電極22は、第2のTFT30の形成領域に向けて延設されており、この延設部分には第2のTFT30のゲート電極31が第1の層間絶縁膜51のコンタクトホールを介して電気的に接続している。   In the first TFT 20, the gate electrode 21 is configured as a part of the scanning line gate. In the first TFT 20, the data line sig is electrically connected to one of the source / drain regions via the contact hole of the first interlayer insulating film 51, and the drain electrode 22 is electrically connected to the other. The drain electrode 22 extends toward the formation region of the second TFT 30, and the gate electrode 31 of the second TFT 30 is electrically connected to the extension portion via a contact hole of the first interlayer insulating film 51. Connected.

第2のTFT30のソース・ドレイン領域の一方には、第1の層間絶縁膜51のコンタクトホールを介して、データ線sigと同時形成された中継電極35が電気的に接続し、この中継電極35には第2の層間絶縁膜52のコンタクトホールを介して薄膜発光素子40のITO(Indium Tin Oxide)膜からなる透明な画素電極41が電気的に接続している。   A relay electrode 35 formed simultaneously with the data line sig is electrically connected to one of the source / drain regions of the second TFT 30 via a contact hole of the first interlayer insulating film 51. Is electrically connected to a transparent pixel electrode 41 made of an ITO (Indium Tin Oxide) film of the thin-film light emitting element 40 through a contact hole of the second interlayer insulating film 52.

図2および図3(B)、(C)からわかるように、画素電極41は各画素7毎に独立して形成されている。画素電極41の上層側には、ポリフェニレンビニレン(PPV)などの有機半導体膜43、およびリチウム含有アルミニウムやカルシウムなどの金属膜からなる対向電極opがこの順に積層され、薄膜発光素子40が構成されている。ここに示す例では、有機半導体膜43は各画素7に形成されているが、後述するように、複数の画素7に跨がってストライプ状に形成される場合もある。対向電極opは、表示部11全体と、少なくとも端子12が形成されている部分の周囲を除いた領域とに形成されている。この端子12は、対向電極opと同時形成された配線(図示せず。)を利用して形成された対向電極opに電気的に接続する端子を含んでいる。   As can be seen from FIGS. 2 and 3B and 3C, the pixel electrode 41 is formed independently for each pixel 7. On the upper layer side of the pixel electrode 41, an organic semiconductor film 43 such as polyphenylene vinylene (PPV) and a counter electrode op formed of a metal film such as lithium-containing aluminum or calcium are laminated in this order, and a thin-film light emitting element 40 is formed. I have. In the example shown here, the organic semiconductor film 43 is formed in each pixel 7, but may be formed in a stripe shape over a plurality of pixels 7 as described later. The counter electrode op is formed in the entire display unit 11 and in a region excluding at least a portion around a portion where the terminal 12 is formed. The terminal 12 includes a terminal electrically connected to a counter electrode op formed using a wiring (not shown) formed simultaneously with the counter electrode op.

薄膜発光素子40としては、正孔注入層を設けて発光効率(正孔注入率)を高めた構造、電子注入層を設けて発光効率(電子注入率)を高めた構造、正孔注入層および電子注入層の双方を形成した構造を採用することもできる。   As the thin-film light-emitting element 40, a structure in which a hole injection layer is provided to increase luminous efficiency (hole injection rate), a structure in which an electron injection layer is provided to increase luminous efficiency (electron injection rate), a hole injection layer, A structure in which both of the electron injection layers are formed may be adopted.

再び図2および図3(A)において、第2のTFT30のソース・ドレイン領域のもう一方には、第1の層間絶縁膜51のコンタクトホールを介して共通給電線comが電気的に接続している。共通給電線comの延設部分39は、第2のTFT30のゲート電極31の延設部分36に対して、第1の層間絶縁膜51を誘電体膜として挟んで対向し、保持容量capを構成している。保持容量capについては共通給電線comとの間に形成した構造の他、走査線gateと並列に形成した容量線との間に形成してもよく、また、第1のTFT20のドレイン領域と第2のTFT30のゲート電極31とを利用して保持容量capを構成してもよい。   Referring again to FIGS. 2 and 3A, a common power supply line com is electrically connected to the other of the source / drain regions of the second TFT 30 via the contact hole of the first interlayer insulating film 51. I have. The extension 39 of the common power supply line com faces the extension 36 of the gate electrode 31 of the second TFT 30 with the first interlayer insulating film 51 interposed therebetween as a dielectric film, and forms a storage capacitor cap. are doing. The storage capacitor cap may be formed between the scanning line gate and a capacitor line formed in parallel, in addition to the structure formed between the common power supply line com and the storage capacitor cap. The storage capacitor cap may be configured using the gate electrode 31 of the second TFT 30.

このように構成したアクティブマトリクス型表示装置1において、走査信号によって選択されて第1のTFT20がオン状態になると、データ線sigからの画像信号が第1のTFT20を介して第2のTFT30のゲート電極31に印加されるとともに、画像信号が第1のTFT20を介して保持容量capに書き込まれる。その結果、第2のTFT30がオン状態になると、対向電極opおよび画素電極41をそれぞれ負極および正極として電圧が印加され、印加電圧がしきい値電圧を越えた領域で有機半導体膜43に流れる電流(駆動電流)が急激に増大する。従って、発光素子40は、エレクトロルミネッセンス素子あるいはLED素子として発光し、発光素子40の光は、対向電極opに反射されて透明な画素電極41および透明基板10を透過して出射される。このような発光を行うための駆動電流は、対向電極op、有機半導体膜43、画素電極41、第2のTFT30、および共通給電線comから構成される電流経路を流れるため、第2のTFT30がオフ状態になると、流れなくなる。但し、第2のTFT30のゲート電極は、第1のTFT20がオフ状態になっても、保持容量capによって画像信号に相当する電位に保持されるので、第2のTFT30はオン状態のままである。それ故、発光素子40には駆動電流が流れ続け、この画素は点灯状態のままである。この状態は、新たな画像データが保持容量capに書き込まれて、第2のTFT30がオフ状態になるまで維持される。   In the active matrix display device 1 configured as described above, when the first TFT 20 is turned on by being selected by the scanning signal, the image signal from the data line sig is applied to the gate of the second TFT 30 via the first TFT 20. While being applied to the electrode 31, an image signal is written to the storage capacitor cap via the first TFT 20. As a result, when the second TFT 30 is turned on, a voltage is applied using the counter electrode op and the pixel electrode 41 as a negative electrode and a positive electrode, respectively, and a current flowing through the organic semiconductor film 43 in a region where the applied voltage exceeds the threshold voltage. (Drive current) sharply increases. Therefore, the light emitting element 40 emits light as an electroluminescent element or an LED element, and the light of the light emitting element 40 is reflected by the opposing electrode op and transmitted through the transparent pixel electrode 41 and the transparent substrate 10 to be emitted. A drive current for performing such light emission flows through a current path including the counter electrode op, the organic semiconductor film 43, the pixel electrode 41, the second TFT 30, and the common power supply line com. When turned off, the flow stops. However, the gate electrode of the second TFT 30 is held at a potential corresponding to an image signal by the storage capacitor cap even when the first TFT 20 is turned off, so that the second TFT 30 remains on. . Therefore, the driving current continues to flow through the light emitting element 40, and this pixel remains in the lighting state. This state is maintained until new image data is written to the storage capacitor cap and the second TFT 30 is turned off.

(バンク層の構造)
このように構成したアクティブマトリクス型表示装置1において、本形態では、データ線sigには大きな容量が寄生することを防止するため、図1、図2、および図3(A)、(B)、(C)に示すように、データ線sigおよび走査線gateに沿って、有機半導体膜41よりも厚い絶縁膜(バンク層bank/左下がりの1本の斜線、または2本で一組の斜線を広いピッチで付した領域)を設け、このバンク層bankの上層側に対向電極opを形成してある。すなわち、データ線sigと対向電極opとの間に第2の層間絶縁膜52と厚いバンク層bankとが介在しているので、データ線sigに寄生する容量が極めて小さい。それ故、駆動回路3、4の負荷を低減でき、低消費電力化あるいは表示動作の高速化を図ることができる。
(Bank layer structure)
In the active matrix display device 1 configured as described above, in the present embodiment, in order to prevent a large capacitance from being parasitic on the data line sig, FIGS. 1, 2, and 3A, 3B, As shown in (C), along the data line sig and the scanning line gate, an insulating film thicker than the organic semiconductor film 41 (one diagonal line of the bank layer bank / lower left, or a pair of diagonal lines of two lines). A region with a wide pitch) is provided, and an opposing electrode op is formed on the upper side of the bank layer bank. That is, since the second interlayer insulating film 52 and the thick bank layer bank intervene between the data line sig and the counter electrode op, the capacitance parasitic on the data line sig is extremely small. Therefore, the load on the drive circuits 3 and 4 can be reduced, and low power consumption or high-speed display operation can be achieved.

ここで、バンク層bankは、有機半導体膜41よりも厚く形成されたシリコン酸化膜あるいはシリコン窒化膜などの無機材料からなる下層側絶縁膜61と、この下層側絶縁膜61上に積層されたレジストあるいはポリイミド膜などの有機材料からなる上層側絶縁膜62とから構成されている。たとえば、有機半導体膜41、下層側絶縁膜61、および上層側絶縁膜62の膜厚は、それぞれ0.05μm〜0.2μm、0.2μm〜1.0μm、および1μm〜2μmである。   Here, the bank layer bank is composed of a lower insulating film 61 made of an inorganic material such as a silicon oxide film or a silicon nitride film formed thicker than the organic semiconductor film 41 and a resist laminated on the lower insulating film 61. Alternatively, it is composed of an upper insulating film 62 made of an organic material such as a polyimide film. For example, the thicknesses of the organic semiconductor film 41, the lower insulating film 61, and the upper insulating film 62 are 0.05 μm to 0.2 μm, 0.2 μm to 1.0 μm, and 1 μm to 2 μm, respectively.

このような2層構造であれば、上層側絶縁膜62は、厚い膜を形成するのが容易なレジストやポリイミド膜から構成されているため、下層側絶縁膜61のみを無機材料から構成すればよい。従って、バンク層bank全体を無機材料で構成する場合と違って、長い時間をかけて無機材料からなる膜をPECVD法などで成膜する必要がない。それ故、アクティブマトリクス型表示装置1を生産性を高めることができる。   With such a two-layer structure, since the upper insulating film 62 is made of a resist or a polyimide film that can easily form a thick film, if only the lower insulating film 61 is made of an inorganic material, Good. Therefore, unlike the case where the entire bank layer bank is made of an inorganic material, it is not necessary to form a film made of an inorganic material over a long time by a PECVD method or the like. Therefore, the productivity of the active matrix display device 1 can be improved.

また、かかる2層構造であれば、有機半導体膜41は無機材料からなる下層側絶縁膜61とは接しているが、有機材料からなる上層側絶縁膜62とは接していない。それ故、有機半導体膜41は、有機材料から構成されている上層側絶縁膜62の影響を受けて劣化することがないので、薄膜発光素子40では、発光効率の低下や信頼性の低下が起きない。   Further, in such a two-layer structure, the organic semiconductor film 41 is in contact with the lower insulating film 61 made of an inorganic material, but not in contact with the upper insulating film 62 made of an organic material. Therefore, the organic semiconductor film 41 does not deteriorate under the influence of the upper insulating film 62 made of an organic material. Absent.

また、図1からわかるように、透明基板10の周辺領域(表示部11の外側領域)にもバンク層bankが形成されているので、データ側駆動回路3および走査側駆動回路4もバンク層bankによって覆われている。対向電極opは少なくとも表示部11に形成される必要があり、駆動回路領域に形成される必要がない。しかし、対向電極opは、通常、マスクスパッタ法で形成されるので、合わせ精度が悪く、対向電極opと駆動回路とが重なることがある。しかるに本形態では、これらの駆動回路の形成領域に対して対向電極opが重なる状態にあっても、駆動回路の配線層と対向電極opとの間にバンク層bankが介在している。それ故、駆動回路3、4に容量が寄生することを防止できるため、駆動回路3、4の負荷を低減でき、低消費電力化あるいは表示動作の高速化を図ることができる。   As can be seen from FIG. 1, since the bank layer bank is also formed in the peripheral area of the transparent substrate 10 (the area outside the display section 11), the data side driving circuit 3 and the scanning side driving circuit 4 are also provided in the bank layer bank. Covered by The counter electrode op needs to be formed at least in the display unit 11, and does not need to be formed in the drive circuit area. However, since the opposing electrode op is usually formed by the mask sputtering method, alignment accuracy is poor, and the opposing electrode op and the driving circuit may overlap. However, in this embodiment, even when the opposing electrode op overlaps the formation region of these driving circuits, the bank layer bank is interposed between the wiring layer of the driving circuit and the opposing electrode op. Therefore, since parasitic capacitance can be prevented from being generated in the driving circuits 3 and 4, the load on the driving circuits 3 and 4 can be reduced, and low power consumption or high-speed display operation can be achieved.

さらに、本形態では、画素電極41の形成領域のうち、導通制御回路50の中継電極35と重なる領域にもバンク層bankが形成されている。このため、中継電極35と重なる領域には有機半導体膜43が形成されない。すなわち、画素電極41の形成領域のうち、平坦な部分のみに有機半導体膜43が形成されるので、有機半導体膜43は一定の膜厚で形成され、表示むらを起こさない。また、有機半導体膜43に膜厚の薄い部分があると、そこに薄膜発光素子40の駆動電流が集中し、薄膜発光素子40の信頼性が低下することになるが、そのような問題を防止することができる。さらに、中継電極35と重なる領域にバンク層bankがないと、この部分でも対向電極opとの間に駆動電流が流れて有機半導体膜43が発光する。しかし、この光は中継電極35と対向電極opとの間に挟まれて外に出射されず、表示に寄与しない。かかる表示に寄与しない部分で流れる駆動電流は、表示という面からみて無効電流といえる。しかるに本形態では、従来ならこのような無効電流が流れるはずの部分にバンク層bankを形成し、そこに駆動電流が流れることを防止するので、共通給電線comに無駄な電流が流れることが防止できる。それ故、共通給電線comの幅はその分、狭くてよい。その結果として、発光面積を増すことができ、輝度、コントラスト比などの表示性能を向上させることができる。   Further, in the present embodiment, a bank layer bank is also formed in a region where the pixel electrode 41 is formed and overlaps with the relay electrode 35 of the conduction control circuit 50. Therefore, the organic semiconductor film 43 is not formed in a region overlapping with the relay electrode 35. That is, since the organic semiconductor film 43 is formed only in a flat portion in the region where the pixel electrode 41 is formed, the organic semiconductor film 43 is formed to have a constant film thickness and does not cause display unevenness. Further, if the organic semiconductor film 43 has a thin portion, the driving current of the thin-film light-emitting element 40 concentrates there, and the reliability of the thin-film light-emitting element 40 is reduced. can do. Furthermore, if there is no bank layer bank in a region overlapping with the relay electrode 35, a driving current flows between this portion and the counter electrode op, and the organic semiconductor film 43 emits light. However, this light is sandwiched between the relay electrode 35 and the counter electrode op and is not emitted outside, and does not contribute to display. The drive current flowing in such a portion that does not contribute to display can be said to be a reactive current in terms of display. However, in the present embodiment, a bank layer bank is formed in a portion where such a reactive current would otherwise flow, and a drive current is prevented from flowing through the bank layer, thereby preventing a wasteful current from flowing through the common power supply line com. it can. Therefore, the width of the common feed line com may be narrower accordingly. As a result, the light emitting area can be increased, and display performance such as luminance and contrast ratio can be improved.

なお、バンク層bankを黒色のレジストによって形成すると、バンク層bankはブラックマトリクスとして機能し、コントラスト比などの表示の品位が向上する。すなわち、本形態に係るアクティブマトリクス型表示装置1では、対向電極opが透明基板10の表面側において画素7の全面に形成されるため、対向電極opでの反射光がコントラスト比を低下させる。しかるに寄生容量を防止する機能を担うバンク層bankを黒色のレジストで構成すると、バンク層bankはブラックマトリクスとしても機能し、対向電極opからの反射光を遮るので、コントラスト比が向上する。   When the bank layer bank is formed of a black resist, the bank layer bank functions as a black matrix, and display quality such as a contrast ratio is improved. That is, in the active matrix display device 1 according to the present embodiment, since the opposing electrode op is formed on the entire surface of the pixel 7 on the front surface side of the transparent substrate 10, light reflected by the opposing electrode op lowers the contrast ratio. However, if the bank layer bank having the function of preventing the parasitic capacitance is formed of a black resist, the bank layer bank also functions as a black matrix and blocks light reflected from the opposing electrode op, thereby improving the contrast ratio.

(アクティブマトリクス型表示装置の製造方法)
このように形成したバンク層bankは、有機半導体膜43の形成領域を囲むように構成されているので、アクティブマトリクス型表示装置の製造工程では、インクジェットヘッドから吐出した液状の材料(吐出液)から有機半導体膜43を形成する際に吐出液をせき止め、吐出液が側方にはみ出すことを防止する。なお、以下に説明するアクティブマトリクス型表示装置1の製造方法において、透明基板10上に第1のTFT20および第2のTFT30を製造するまでの工程は、アクティブマトリクス型液晶表示装置のアクティブマトリクス基板を製造する工程と略同様であるため、図3(A)、(B)、(C)を参照してその概略のみを簡単に説明する。
(Method of Manufacturing Active Matrix Display Device)
Since the bank layer bank thus formed is configured to surround the formation region of the organic semiconductor film 43, in the manufacturing process of the active matrix display device, a liquid material (discharged liquid) discharged from the inkjet head is used in the manufacturing process of the active matrix display device. When the organic semiconductor film 43 is formed, the discharged liquid is dammed to prevent the discharged liquid from protruding to the side. In the method of manufacturing the active matrix display device 1 described below, the steps up to manufacturing the first TFT 20 and the second TFT 30 on the transparent substrate 10 are performed by using the active matrix substrate of the active matrix liquid crystal display device. Since the manufacturing process is substantially the same, only the outline thereof will be briefly described with reference to FIGS. 3 (A), 3 (B) and 3 (C).

まず、透明基板10に対して、必要に応じて、TEOS(テトラエトキシシラン)や酸素ガスなどを原料ガスとしてプラズマCVD法により厚さが約2000〜5000オングストロームのシリコン酸化膜からなる下地保護膜(図示せず。)を形成した後、下地保護膜の表面にプラズマCVD法により厚さが約300〜700オングストロームのアモルファスのシリコン膜からなる半導体膜を形成する。次にアモルファスのシリコン膜からなる半導体膜に対して、レーザアニールまたは固相成長法などの結晶化工程を行い、半導体膜をポリシリコン膜に結晶化する。   First, if necessary, an underlying protective film made of a silicon oxide film having a thickness of about 2000 to 5000 angstroms by plasma CVD using TEOS (tetraethoxysilane), oxygen gas, or the like as a source gas, if necessary. (Not shown)), a semiconductor film made of an amorphous silicon film having a thickness of about 300 to 700 angstroms is formed on the surface of the base protective film by a plasma CVD method. Next, a crystallization step such as laser annealing or a solid phase growth method is performed on the semiconductor film made of the amorphous silicon film to crystallize the semiconductor film into a polysilicon film.

次に、半導体膜をパターニングして島状の半導体膜とし、その表面に対して、TEOS(テトラエトキシシラン)や酸素ガスなどを原料ガスとしてプラズマCVD法により厚さが約600〜1500オングストロームのシリコン酸化膜または窒化膜からなるゲート絶縁膜57を形成する。   Next, the semiconductor film is patterned into an island-shaped semiconductor film. The surface of the island-shaped semiconductor film is formed with a thickness of about 600 to 1500 angstroms by plasma CVD using TEOS (tetraethoxysilane), oxygen gas or the like as a source gas. A gate insulating film 57 made of an oxide film or a nitride film is formed.

次に、アルミニウム、タンタル、モリブデン、チタン、タングステンなどの金属膜からなる導電膜をスパッタ法により形成した後、パターニングし、ゲート電極21、31、およびゲート電極31の延設部分36を形成する(ゲート電極形成工程)。この工程では走査線gateも形成する。   Next, after a conductive film made of a metal film of aluminum, tantalum, molybdenum, titanium, tungsten, or the like is formed by a sputtering method, patterning is performed to form the gate electrodes 21 and 31 and the extended portion 36 of the gate electrode 31 ( Gate electrode forming step). In this step, a scanning line gate is also formed.

この状態で、高濃度のリンイオンを打ち込んで、ゲート電極21、31に対して自己整合的にソース・ドレイン領域を形成する。なお、不純物が導入されなかった部分がチャネル領域となる。   In this state, high concentration phosphorus ions are implanted to form source / drain regions in a self-aligned manner with respect to the gate electrodes 21 and 31. Note that a portion where the impurity is not introduced becomes a channel region.

次に、第1の層間絶縁膜51を形成した後、各コンタクトホールを形成し、次に、データ線sig、ドレイン電極22、共通給電線com、共通給電線comの延設部分39、および中継電極35を形成する。その結果、第1のTFT20、第2のTFT30、および保持容量capが形成される。   Next, after forming the first interlayer insulating film 51, each contact hole is formed, and then the data line sig, the drain electrode 22, the common power supply line com, the extended portion 39 of the common power supply line com, and the relay An electrode 35 is formed. As a result, the first TFT 20, the second TFT 30, and the storage capacitor cap are formed.

次に、第2の層間絶縁膜52を形成し、この層間絶縁膜には、中継電極35に相当する部分にコンタクトホール形成する。次に、第2の層間絶縁膜52の表面全体にITO膜を形成した後、パターニングし、コンタクトホールを介して第2のTFT30のソース・ドレイン領域に電気的に接続する画素電極41を画素7毎に形成する。   Next, a second interlayer insulating film 52 is formed, and a contact hole is formed in a portion corresponding to the relay electrode 35 in this interlayer insulating film. Next, after an ITO film is formed on the entire surface of the second interlayer insulating film 52, patterning is performed, and the pixel electrode 41 electrically connected to the source / drain region of the second TFT 30 via the contact hole is formed on the pixel 7. It is formed every time.

次に、第2の層間絶縁膜52の表面側にPECVD法などで無機材料からなる膜(下層側絶縁膜61を形成するための無機膜)を形成した後、走査線gateおよびデータ線sigに沿ってレジスト(上層側絶縁膜62)を形成する。しかる後に、このレジストをマスクとして無機材料から成る膜にパターニングを施し、下層側絶縁膜61を形成する。このようにして下層側絶縁膜61をパターニングにより形成する際でも、下層側絶縁膜61が薄いので、オーバーエッチングが起こらない。従って、画素電極41が損傷することはない。   Next, after a film made of an inorganic material (an inorganic film for forming the lower insulating film 61) is formed on the surface side of the second interlayer insulating film 52 by a PECVD method or the like, the scan line gate and the data line sig are formed. A resist (upper-layer insulating film 62) is formed along. Thereafter, using the resist as a mask, the film made of an inorganic material is patterned to form a lower insulating film 61. Even when the lower insulating film 61 is formed by patterning in this manner, overetching does not occur because the lower insulating film 61 is thin. Therefore, the pixel electrode 41 is not damaged.

このようなエッチング工程を行うと、無機材料からなる膜は走査線gateおよびデータ線sigに沿って残り、下層側絶縁膜61が形成される。このようにして下層側絶縁膜61と上層側絶縁膜62とからなる2層構造のバンク層bankが形成される。このときには、データ線sigに沿って残すレジスト部分は共通給電線comを覆うように幅広とする。その結果、発光素子40の有機半導体膜43を形成すべき領域はバンク層bankに囲まれる。   When such an etching step is performed, the film made of the inorganic material remains along the scanning line gate and the data line sig, and the lower insulating film 61 is formed. Thus, a bank layer bank having a two-layer structure including the lower insulating film 61 and the upper insulating film 62 is formed. At this time, the resist portion left along the data line sig is wide so as to cover the common power supply line com. As a result, the region of the light emitting element 40 where the organic semiconductor film 43 is to be formed is surrounded by the bank layer bank.

次に、バンク層bankでマトリクス状に区画された領域内にインクジェット法を利用してR、G、Bに対応する各有機半導体膜43を形成していく。それには、バンク層bankの内側領域に対してインクジェットヘッドから、有機半導体膜43を構成するための液状の材料(前駆体/吐出液)を吐出し、それをバンク層bankの内側領域で定着させて有機半導体膜43を形成する。ここで、バンク層bankの上層側絶縁膜62は、レジストやポリイミド膜から構成されているため、撥水性である。これに対して、有機半導体膜43の前駆体は親水性の溶媒を用いているため、有機半導体膜43の塗布領域はバンク層bankによって確実に規定され、隣接する画素7にはみ出ることがない。それ故、有機半導体膜43などを所定領域内だけに形成できる。   Next, each organic semiconductor film 43 corresponding to R, G, and B is formed in a region partitioned in a matrix by the bank layer bank using an inkjet method. For this purpose, a liquid material (precursor / discharge liquid) for forming the organic semiconductor film 43 is discharged from the ink jet head to the inner region of the bank layer bank, and is fixed in the inner region of the bank layer bank. Thus, an organic semiconductor film 43 is formed. Here, since the upper insulating film 62 of the bank layer bank is made of a resist or a polyimide film, it is water repellent. On the other hand, since the precursor of the organic semiconductor film 43 uses a hydrophilic solvent, the application area of the organic semiconductor film 43 is definitely defined by the bank layer bank, and does not protrude into the adjacent pixels 7. Therefore, the organic semiconductor film 43 and the like can be formed only in the predetermined region.

この工程において、インクジェットヘッドから吐出した前駆体は表面張力の影響で約2μmないし約4μmの厚さに盛り上がるため、バンク層bankは約1μmないし約3μmの厚さが必要である。この状態では、インクジェットヘッドから吐出した前駆体は上層側絶縁膜62に接する状態にあるが、100℃〜150℃の熱処理を施した後は、前駆体から溶媒成分が除去されるので、バンク層bankの内側に定着した後の有機半導体膜43の厚さは約0.05μmから約0.2μmである。それ故、この状態では有機半導体膜43は上層側絶縁膜62には接していない。   In this step, the precursor discharged from the inkjet head rises to a thickness of about 2 μm to about 4 μm due to the effect of surface tension, so that the bank layer bank needs a thickness of about 1 μm to about 3 μm. In this state, the precursor discharged from the inkjet head is in contact with the upper insulating film 62. However, after the heat treatment at 100 ° C. to 150 ° C., the solvent component is removed from the precursor, so that the bank layer The thickness of the organic semiconductor film 43 after being fixed inside the bank is about 0.05 μm to about 0.2 μm. Therefore, in this state, the organic semiconductor film 43 is not in contact with the upper insulating film 62.

なお、予めバンク層bankからなる隔壁が1μm以上の高さであれば、バンク層bankが撥水性でなくても、バンク層bankは隔壁として十分に機能する。かかる厚いバンク層bankを形成しておけば、インクジェット法に代えて、塗布法で有機半導体膜43を形成する場合でもその形成領域を規定できる。   Note that, if the partition wall composed of the bank layer bank has a height of 1 μm or more in advance, the bank layer bank sufficiently functions as a partition even if the bank layer bank is not water-repellent. If such a thick bank layer bank is formed, a region where the organic semiconductor film 43 is formed can be defined even when the organic semiconductor film 43 is formed by a coating method instead of the inkjet method.

しかる後には、透明基板10の略全面に対向電極opを形成する。   Thereafter, the opposing electrode op is formed on substantially the entire surface of the transparent substrate 10.

このような製造方法によれば、インクジェット法を利用して所定の領域にR、G、Bに対応する各有機半導体膜43を形成していけるので、フルカラーのアクティブマトリクス型表示装置1を高い生産性で製造できる。   According to such a manufacturing method, since each organic semiconductor film 43 corresponding to R, G, and B can be formed in a predetermined region by using an ink jet method, a full-color active matrix display device 1 can be produced at a high production rate. It can be manufactured by nature.

なお、図1に示すデータ側駆動回路3や走査側駆動回路4にもTFTが形成されるが、これらのTFTは前記の画素7にTFTを形成していく工程の全部あるいは一部を援用して行われる。それ故、駆動回路を構成するTFTも、画素7のTFTと同一の層間に形成されることになる。また、前記第1のTFT20、および第2のTFT30については、双方がN型、双方がP型、一方がN型で他方がP型のいずれでもよいが、このようないずれの組合せであっても周知の方法でTFTを形成していけるので、その説明を省略する。   Note that TFTs are also formed in the data-side driving circuit 3 and the scanning-side driving circuit 4 shown in FIG. 1, and these TFTs use all or a part of the process of forming the TFTs in the pixel 7 described above. Done. Therefore, the TFT constituting the drive circuit is also formed between the same layers as the TFT of the pixel 7. As for the first TFT 20 and the second TFT 30, both may be N-type, both may be P-type, one may be N-type, and the other may be P-type. Since a TFT can be formed by a well-known method, the description thereof will be omitted.

実施の形態2Embodiment 2

図4(A)、(B)、(C)はそれぞれ、本形態のアクティブマトリクス型表示装置における図2のA−A′線、B−B′線、およびC−C′線に相当する位置での断面図である。なお、本形態と実施の形態1とは基本的な構成が同一なので、共通する部分には同一の符号を図4に付してそれらの詳細な説明を省略する。また、本形態のアクティブマトリクス型表示装置におけるバンク層bankの形成領域は、実施の形態1と同様であるため、同じく図1および図2を参照して説明する。   FIGS. 4A, 4B, and 4C show positions corresponding to the lines AA ', BB', and CC 'in FIG. 2 in the active matrix display device of the present embodiment, respectively. FIG. Since the present embodiment and the first embodiment have the same basic configuration, the same reference numerals are given to the common parts in FIG. 4 and the detailed description thereof will be omitted. Since the formation region of the bank layer bank in the active matrix display device of this embodiment is the same as that of the first embodiment, the description will be made with reference to FIGS.

本形態でも、データ線sigには大きな容量が寄生することを防止するため、図1、図2、図4(A)、(B)、(C)に示すように、データ線sigおよび走査線gateに沿って、有機半導体膜41よりも厚い絶縁膜(バンク層bank/左下がりの1本の斜線、または2本で一組の斜線を広いピッチで付した領域)を設け、このバンク層bankの上層側に対向電極opを形成してある。   Also in the present embodiment, as shown in FIGS. 1, 2, 4A, 4B and 4C, the data line sig and the scanning line An insulating film thicker than the organic semiconductor film 41 (a bank layer bank / a region in which one diagonal line at the lower left or a pair of diagonal lines is provided at a wide pitch) is provided along the gate. The opposing electrode op is formed on the upper layer side.

ここで、バンク層bankは、有機半導体膜41よりも厚く形成されたシリコン酸化膜あるいはシリコン窒化膜などの無機材料からなる下層側絶縁膜61と、この下層側絶縁膜61上に積層されたレジストあるいはポリイミド膜などの有機材料からなる上層側絶縁膜62とから構成されている点では、実施の形態1と同様である。   Here, the bank layer bank is composed of a lower insulating film 61 made of an inorganic material such as a silicon oxide film or a silicon nitride film formed thicker than the organic semiconductor film 41 and a resist laminated on the lower insulating film 61. Alternatively, the second embodiment is the same as the first embodiment in that the second embodiment includes an upper insulating film 62 made of an organic material such as a polyimide film.

本形態では、図4(A)、(B)、(C)からわかるように、有機材料からなる上層側絶縁膜61については、無機材料からなる下層側絶縁膜61より狭い幅をもってこの下層側絶縁膜61の内側領域に積層されている。たとえば、上層側絶縁膜61と画素電極41との重なり部分の幅は1μm〜3μmであり、下層側絶縁膜61と上層側絶縁膜62との間には片側1μm〜5μmのずれがある。このため、バンク層bankは、幅の異なる下層側絶縁膜61と上層側絶縁膜61が積層された2段構造になっている。このような2段構造であれば、上層側絶縁膜62は、厚い膜を形成するのが容易なレジストやポリイミド膜から構成されているので、下層側絶縁膜61のみを無機材料から構成すればよい。従って、厚いバンク層bank全体を無機材料で構成する場合と違って、長い時間をかけて無機材料からなる膜をPECVD法などで成膜する必要がない。それ故、アクティブマトリクス型表示装置1を生産性を高めることができる。また、かかる2段構造であれば、有機半導体膜41は無機材料からなる下層側絶縁膜61とは接しているが、上層側絶縁膜62とは接していない。しかも、上層側絶縁膜62は下層側絶縁膜61より内側に形成されているので、その分、有機半導体膜43と上層側絶縁膜62とは接しにくい。それ故、有機材料から構成されている上層側絶縁膜62の影響を受けて有機半導体膜41が劣化するのを確実に防止でき、薄膜発光素子40では発光効率の低下や信頼性の低下が起きない。   In this embodiment, as can be seen from FIGS. 4A, 4B, and 4C, the upper insulating film 61 made of an organic material has a width smaller than that of the lower insulating film 61 made of an inorganic material. The insulating film 61 is stacked in the inner region. For example, the width of the overlapping portion between the upper insulating film 61 and the pixel electrode 41 is 1 μm to 3 μm, and there is a shift of 1 μm to 5 μm on one side between the lower insulating film 61 and the upper insulating film 62. Therefore, the bank layer bank has a two-stage structure in which the lower insulating film 61 and the upper insulating film 61 having different widths are stacked. With such a two-stage structure, since the upper insulating film 62 is made of a resist or a polyimide film that can easily form a thick film, if only the lower insulating film 61 is made of an inorganic material, Good. Therefore, unlike the case where the entire thick bank layer bank is made of an inorganic material, it is not necessary to form a film made of an inorganic material over a long time by a PECVD method or the like. Therefore, the productivity of the active matrix display device 1 can be improved. Further, in such a two-stage structure, the organic semiconductor film 41 is in contact with the lower insulating film 61 made of an inorganic material, but is not in contact with the upper insulating film 62. Moreover, since the upper insulating film 62 is formed inside the lower insulating film 61, the organic semiconductor film 43 and the upper insulating film 62 are less likely to be in contact with each other. Therefore, it is possible to reliably prevent the organic semiconductor film 41 from deteriorating due to the influence of the upper insulating film 62 made of an organic material. Absent.

その他の構成は実施の形態1と同様である。ここで、いずれの画素7もバンク層bankで囲まれている。このため、インクジェット法を利用して所定の領域にR、G、Bに対応する各有機半導体膜43を形成していけるので、フルカラーのアクティブマトリクス型表示装置1を高い生産性で製造できるなど、実施の形態1と同様な効果を奏する。   Other configurations are the same as those of the first embodiment. Here, each pixel 7 is surrounded by a bank layer bank. For this reason, since each organic semiconductor film 43 corresponding to R, G, and B can be formed in a predetermined region using the inkjet method, the full-color active matrix display device 1 can be manufactured with high productivity. An effect similar to that of the first embodiment is obtained.

このような構造のバンク層bankを形成するにあたっては、第2の層間絶縁膜52の表面側にPECV法などで無機材料からなる膜(下層側絶縁膜61を形成するための無機膜)を形成した後、それを走査線gateおよびデータ線sigに沿って残し、下層側絶縁膜61を形成した後、このパターニングに用いたレジストを除去し、しかる後に、下層側絶縁膜61の上層にそれより幅の狭いレジストやポリイミドを上層側絶縁膜62として形成すればよい。このようにして、下層側絶縁膜61をパターニングにより形成する際でも、下層側絶縁膜61が薄いので、オーバーエッチングが起こらない。従って、画素電極41が損傷することはない。   In forming the bank layer bank having such a structure, a film made of an inorganic material (an inorganic film for forming the lower insulating film 61) is formed on the surface side of the second interlayer insulating film 52 by a PECV method or the like. After that, it is left along the scanning line gate and the data line sig, and after forming the lower insulating film 61, the resist used for the patterning is removed. A narrow resist or polyimide may be formed as the upper insulating film 62. In this way, even when the lower insulating film 61 is formed by patterning, overetching does not occur because the lower insulating film 61 is thin. Therefore, the pixel electrode 41 is not damaged.

実施の形態3Embodiment 3

本形態のアクティブマトリクス型表示装置1は、バンク層bankを構成する材料が実施の形態2と相違するだけで、その構造は実施の形態2で同様である。従って、共通する部分については同一の符号を付して図示し、それらの説明を省略する。また、実施の形態2と同様、図1、図2、および図4を参照して説明する。   The active matrix display device 1 of the present embodiment has the same structure as that of the second embodiment, except that the material forming the bank layer bank is different from that of the second embodiment. Therefore, common portions are denoted by the same reference numerals, and description thereof is omitted. In addition, as in the second embodiment, description will be made with reference to FIGS. 1, 2, and 4.

本形態でも、データ線sigには大きな容量が寄生することを防止するため、図1、図2、図4(A)、(B)、(C)に示すように、データ線sigおよび走査線gateに沿って、有機半導体膜41よりも厚い絶縁膜(バンク層bank/左下がりの1本、または2本で一組の斜線を広いピッチで付した領域)を設け、このバンク層bankの上層側に対向電極opを形成してある。   Also in the present embodiment, as shown in FIGS. 1, 2, 4A, 4B and 4C, the data line sig and the scanning line Along the gate, an insulating film thicker than the organic semiconductor film 41 (a bank layer bank / a region in which one or two lower left lines are provided with a pair of oblique lines at a wide pitch) is provided, and an upper layer of the bank layer bank is provided. A counter electrode op is formed on the side.

ここで、バンク層bankは、有機半導体膜41よりも厚く形成されたシリコン窒化膜などの無機材料からなる下層側絶縁膜61と、この下層側絶縁膜61上に積層されたシリコン酸化膜などの無機材料からなる上層側絶縁膜62とから構成されている。このような2層構造であれば、有機半導体膜43は有機材料と接していないので、有機材料の影響を受けて劣化することがない。それ故、薄膜発光素子40では、発光効率の低下や信頼性の低下が起きない。   Here, the bank layer bank includes a lower insulating film 61 made of an inorganic material such as a silicon nitride film formed thicker than the organic semiconductor film 41, and a silicon oxide film or the like laminated on the lower insulating film 61. And an upper insulating film 62 made of an inorganic material. With such a two-layer structure, since the organic semiconductor film 43 is not in contact with the organic material, the organic semiconductor film 43 does not deteriorate under the influence of the organic material. Therefore, in the thin-film light-emitting element 40, a decrease in luminous efficiency and a decrease in reliability do not occur.

ここで、上層側絶縁膜61については下層側絶縁膜61より狭い幅をもってこの下層側絶縁膜61の内側領域に積層されている。このため、バンク層bankは、幅の異なる下層側絶縁膜61と上層側絶縁膜61が積層された2段構造になっている。   Here, the upper insulating film 61 is stacked in a region inside the lower insulating film 61 with a width smaller than that of the lower insulating film 61. Therefore, the bank layer bank has a two-stage structure in which the lower insulating film 61 and the upper insulating film 61 having different widths are stacked.

かかる2段構造のバンク層bankを形成するにあたっては、下層側絶縁膜61および上層側絶縁膜62を構成すべき無機材料(シリコン窒化膜およびシリコン酸化膜)を順次形成した後、まず、上層側絶縁膜62をパターニングする。この際には、下層側絶縁膜61がエッチングストッパーとして機能するので、多少のオーバーエッチングがあっても画素電極41を損傷することはない。かかるパターニングを終えた後には下層側絶縁膜61をパターニング形成する。この際には、下層側絶縁膜61の1層分をエッチングするだけなので、エッチング制御が容易で、画素電極41を損傷するほどのオーバーエッチングが起きない。   In forming such a two-stage bank layer bank, inorganic materials (silicon nitride film and silicon oxide film) to form the lower insulating film 61 and the upper insulating film 62 are sequentially formed, and then the upper insulating film 61 is formed. The insulating film 62 is patterned. In this case, since the lower insulating film 61 functions as an etching stopper, the pixel electrode 41 is not damaged even if there is some over-etching. After the completion of the patterning, the lower insulating film 61 is formed by patterning. At this time, since only one layer of the lower insulating film 61 is etched, the etching control is easy, and over-etching that damages the pixel electrode 41 does not occur.

その他の構成は実施の形態1、2と同様である。従って、いずれの画素7もバンク層bankで囲まれている。このため、インクジェット法を利用して所定の領域にR、G、Bに対応する各有機半導体膜43を形成していけるので、フルカラーのアクティブマトリクス型表示装置1を高い生産性で製造できるなど、実施の形態1と同様な効果を奏する。
[実施の形態1、2、3の変形例]
なお、上記形態では、データ線sigおよび走査線gateに沿ってバンク層bankを形成してあるため、バンク層bankで各画素7をマトリクス状に区画した構成であったが、データ線sigに沿ってのみバンク層bankを形成してもよい。この場合にも、バンク層bankでストライプ状に区画された領域内にインクジェット法を利用してR、G、Bに対応する各有機半導体膜43をストライプ状に形成できるので、フルカラーのアクティブマトリクス型表示装置1を高い生産性で製造できる。
Other configurations are the same as those of the first and second embodiments. Therefore, each pixel 7 is surrounded by the bank layer bank. For this reason, since each organic semiconductor film 43 corresponding to R, G, and B can be formed in a predetermined region using the inkjet method, the full-color active matrix display device 1 can be manufactured with high productivity. An effect similar to that of the first embodiment is obtained.
[Modifications of Embodiments 1, 2, and 3]
In the above embodiment, since the bank layer bank is formed along the data line sig and the scanning line gate, each pixel 7 is partitioned in a matrix by the bank layer bank. Only the bank layer bank may be formed. Also in this case, the organic semiconductor films 43 corresponding to R, G, and B can be formed in a stripe shape in a region partitioned in a stripe shape by the bank layer bank by using an inkjet method. The display device 1 can be manufactured with high productivity.

また、上記形態では、バンク層bankが区画した領域の隅部分はいずれも角形になっていたが、そこに丸みをもたせれば、有機半導体膜43を角のない丸みをもった平面形状に形成できる。このような形状の有機半導体膜43であれば、角部分の駆動電流が集中することがないので、この部分での耐圧不足などの不具合の発生を防止できる。   In the above embodiment, the corners of the region defined by the bank layer bank are all square. However, if the corners are rounded, the organic semiconductor film 43 can be formed into a flat shape with no rounded corners. it can. In the case of the organic semiconductor film 43 having such a shape, since the driving current does not concentrate on the corner portion, it is possible to prevent a problem such as insufficient breakdown voltage at this portion.

実施の形態4Embodiment 4

本形態のアクティブマトリクス型表示装置1は、基本的な構造が実施の形態1ないし3と同様であるため、同じく図1を参照して説明するとともに、共通する部分には同じ符号を付して図示し、それらの説明を省略する。   Since the basic structure of the active matrix type display device 1 of the present embodiment is the same as that of the first to third embodiments, the description will be made with reference to FIG. They are shown in the drawings and their description is omitted.

図5は、本形態のアクティブマトリクス型表示装置に構成されている画素の1つを抜き出して示す平面図、図6(A)、(B)、(C)はそれぞれ図5のA−A′断面図、B−B′断面図、およびC−C′断面図である。   FIG. 5 is a plan view showing one of the pixels included in the active matrix display device of the present embodiment, and FIGS. 6A, 6B and 6C are AA ′ of FIG. 5, respectively. It is sectional drawing, BB 'sectional drawing, and CC' sectional drawing.

本形態では、以下に説明するように、下層側絶縁膜61と上層側絶縁膜62とを部分的に重ね、それぞれを異なる機能を発揮させている。すなわち、本形態でも、図1に示すように、複数の走査線gateと、該走査線gateの延設方向に対して交差する方向に延設された複数のデータ線sigと、該データ線sigに並列する複数の共通給電線comと、データ線sigと走査線gateとによってマトリクス状に形成された複数の画素7とが構成されている。   In this embodiment, as described below, the lower insulating film 61 and the upper insulating film 62 are partially overlapped with each other to exert different functions. That is, also in the present embodiment, as shown in FIG. 1, a plurality of scanning lines gate, a plurality of data lines sig extending in a direction intersecting the extending direction of the scanning lines gate, and a plurality of data lines sig And a plurality of pixels 7 formed in a matrix by the data lines sig and the scanning lines gate.

本形態においては、図5および図6に示すように、下層側絶縁膜61(左下がりの2本で一組の斜線を付した領域)は、画素電極41の形成領域のうち導通制御回路50の形成領域と重なる領域、データ線sig、共通給電線com、および走査線gateを覆うように形成されている。これに対して、上層側絶縁膜62(左下がりの斜線を広いピッチで付した領域)は、下層側絶縁膜61の形成領域のうち、データ線sigに沿う部分のみにストライプ状に形成されている。また、この上層側絶縁膜62でストライプ状に区画された領域内に有機半導体膜43が形成されている。   In this embodiment, as shown in FIGS. 5 and 6, the lower insulating film 61 (the two regions that are diagonally shaded with two lines descending to the left) is the conduction control circuit 50 in the region where the pixel electrode 41 is formed. Are formed so as to cover the region overlapping the formation region, the data line sig, the common power supply line com, and the scanning line gate. On the other hand, the upper-layer insulating film 62 (region in which the lower left diagonal line is provided at a wide pitch) is formed in a stripe shape only in a portion along the data line sig in the region where the lower-layer insulating film 61 is formed. I have. The organic semiconductor film 43 is formed in a region partitioned by the upper insulating film 62 in a stripe shape.

このように構成した場合も、有機半導体膜43をインクジェット法により形成する際には、下層側絶縁膜61と上層側絶縁膜62が重なる部分を吐出液のはみ出しを防止するバンク層bankとして利用しながら、有機半導体膜43をストライプ状に形成できる。そこで、本形態では、下層側絶縁膜61と上層側絶縁膜62が重なる部分は、膜厚が1μm以上になるように構成してある。   Also in this configuration, when the organic semiconductor film 43 is formed by the inkjet method, a portion where the lower insulating film 61 and the upper insulating film 62 overlap with each other is used as a bank layer bank for preventing the overflow of the discharge liquid. Meanwhile, the organic semiconductor film 43 can be formed in a stripe shape. Therefore, in the present embodiment, the portion where the lower insulating film 61 and the upper insulating film 62 overlap has a film thickness of 1 μm or more.

このように構成した場合も、データ線sigと対向電極opとの間に第2の層間絶縁膜52と厚いバンク層bank(下層側絶縁膜61と上層側絶縁膜62)とが介在しているので、データ線sigに寄生する容量が極めて小さい。それ故、駆動回路3、4の負荷を低減でき、低消費電力化あるいは表示動作の高速化を図ることができる。   Also in this configuration, the second interlayer insulating film 52 and the thick bank layer bank (the lower insulating film 61 and the upper insulating film 62) are interposed between the data line sig and the counter electrode op. Therefore, the parasitic capacitance on the data line sig is extremely small. Therefore, the load on the drive circuits 3 and 4 can be reduced, and low power consumption or high-speed display operation can be achieved.

また、ストライプ状に有機半導体膜43を形成したが、画素電極41の形成領域のうち導通制御回路50の形成領域と重なる領域、および走査線gateは、下層側絶縁膜62で覆われているので、各画素7のうち、画素電極41の平坦部分のみに形成された有機半導体膜43が発光に寄与する。すなわち、画素電極41の平坦部分のみに薄膜発光素子40が形成されていることになる。それ故、有機半導体膜43は一定の膜厚で形成され、表示むらや駆動電流の集中を起こさない。また、表示に寄与しない部分に駆動電流が流れるのを下層側絶縁膜61で防止するので、共通給電線comに無駄な電流が流れることを防止できるという効果もある。   In addition, although the organic semiconductor film 43 is formed in a stripe shape, a region of the formation region of the pixel electrode 41 overlapping with the formation region of the conduction control circuit 50 and the scanning line gate are covered with the lower insulating film 62. The organic semiconductor film 43 formed only on the flat portion of the pixel electrode 41 in each pixel 7 contributes to light emission. That is, the thin film light emitting element 40 is formed only on the flat portion of the pixel electrode 41. Therefore, the organic semiconductor film 43 is formed to have a constant film thickness, and does not cause display unevenness or drive current concentration. Further, since the lower insulating film 61 prevents the drive current from flowing to the portion that does not contribute to the display, there is an effect that it is possible to prevent the useless current from flowing to the common power supply line com.

ここで、下層側絶縁膜61については有機半導体膜41よりも厚く形成されたシリコン酸化膜あるいはシリコン窒化膜などの無機材料から構成し、上層側絶縁膜62についてはレジストあるいはポリイミド膜などの有機材料から構成すれば、下層側絶縁膜61のみを無機材料から構成すればよいことになる。従って、厚いバンク層bank全体を無機材料で構成する場合と違って、長い時間をかけて無機材料からなる膜をPECVD法などで成膜する必要がない。それ故、アクティブマトリクス型表示装置1を生産性を高めることができる。また、かかる2層構造であれば、有機半導体膜41は無機材料からなる下層側絶縁膜61とは接しているが、有機材料からなる上層側絶縁膜62とは接していない。それ故、有機半導体膜41は、有機材料から構成されている上層側絶縁膜62の影響を受けて劣化することがないので、薄膜発光素子40では、発光効率の低下や信頼性の低下が起きないなど、実施の形態1と同様な効果を奏する。   Here, the lower insulating film 61 is composed of an inorganic material such as a silicon oxide film or a silicon nitride film formed thicker than the organic semiconductor film 41, and the upper insulating film 62 is an organic material such as a resist or a polyimide film. In this case, only the lower insulating film 61 may be made of an inorganic material. Therefore, unlike the case where the entire thick bank layer bank is made of an inorganic material, it is not necessary to form a film made of an inorganic material over a long time by a PECVD method or the like. Therefore, the productivity of the active matrix display device 1 can be improved. Further, in such a two-layer structure, the organic semiconductor film 41 is in contact with the lower insulating film 61 made of an inorganic material, but not in contact with the upper insulating film 62 made of an organic material. Therefore, the organic semiconductor film 41 does not deteriorate under the influence of the upper insulating film 62 made of an organic material. There is no similar effect as in the first embodiment.

これに対して、下層側絶縁膜61については有機半導体膜41よりも厚く形成されたシリコン窒化膜などの無機材料から構成し、上層側絶縁膜62については、この下層側絶縁膜61上に積層されたシリコン酸化膜などの無機材料から構成した場合には、有機半導体膜43は有機材料と接していないので、有機材料の影響を受けて劣化することがない。それ故、薄膜発光素子40では、発光効率の低下や信頼性の低下が起きない。また、上層側絶縁膜61については狭い幅で下層側絶縁膜61の内側領域に積層してあるので、上層側絶縁膜62をパターニングする際には、下層側絶縁膜61がエッチングストッパーとして機能するなど、実施の形態3と同様な効果を奏する。   On the other hand, the lower insulating film 61 is formed of an inorganic material such as a silicon nitride film formed thicker than the organic semiconductor film 41, and the upper insulating film 62 is laminated on the lower insulating film 61. In the case where the organic semiconductor film 43 is made of an inorganic material such as a silicon oxide film, the organic semiconductor film 43 is not in contact with the organic material. Therefore, in the thin-film light-emitting element 40, a decrease in luminous efficiency and a decrease in reliability do not occur. Further, since the upper insulating film 61 is laminated with a small width in the inner region of the lower insulating film 61, when patterning the upper insulating film 62, the lower insulating film 61 functions as an etching stopper. For example, the same effects as in the third embodiment can be obtained.

実施の形態5Embodiment 5

図7は、アクティブマトリクス型表示装置の全体のレイアウトを模式的に示すブロック図である。図8は、それに構成されている画素の1つを抜き出して示す平面図、図9(A)、(B)、(C)はそれぞれ、図8のA−A′断面図、B−B′断面図、およびC−C′断面図である。なお、本形態の基本的な構成は、実施の形態1と共通するので、共通する部分については同一の符号を付して図示し、それらの説明を省略する。   FIG. 7 is a block diagram schematically showing the entire layout of the active matrix display device. FIG. 8 is a plan view showing one of the pixels formed therein, and FIGS. 9A, 9B, and 9C are cross-sectional views taken along the line AA 'of FIG. 8, and BB', respectively. It is sectional drawing and CC 'sectional drawing. Since the basic configuration of this embodiment is the same as that of the first embodiment, the same reference numerals are given to the common parts, and the description thereof will be omitted.

本形態でも、本形態のアクティブマトリクス型表示装置1でも、データ線sigおよび走査線gateに沿って、有機半導体膜41よりも厚い絶縁膜(バンク層bank/左下がりの1本の斜線、または2本で一組の斜線を広いピッチで付した領域)を設け、このバンク層bankの上層側に対向電極opを形成してある。すなわち、データ線sigと対向電極opとの間に第2の層間絶縁膜52と厚いバンク層bankとが介在しているので、データ線sigに寄生する容量が極めて小さい。それ故、駆動回路3、4の負荷を低減でき、低消費電力化あるいは表示動作の高速化を図ることができる。   In both the present embodiment and the active matrix type display device 1 of the present embodiment, along the data line sig and the scanning line gate, an insulating film thicker than the organic semiconductor film 41 (bank layer bank / one oblique line at the lower left, or 2). In this book, a pair of diagonal lines are provided at a wide pitch), and a counter electrode op is formed on the upper layer side of the bank layer bank. That is, since the second interlayer insulating film 52 and the thick bank layer bank intervene between the data line sig and the counter electrode op, the capacitance parasitic on the data line sig is extremely small. Therefore, the load on the drive circuits 3 and 4 can be reduced, and low power consumption or high-speed display operation can be achieved.

ここで、バンク層bankは、有機半導体膜41よりも厚く形成されたシリコン酸化膜あるいはシリコン窒化膜などの無機材料からなる下層側絶縁膜61と、この下層側絶縁膜61上に積層されたレジストあるいはポリイミド膜などの有機材料からなる上層側絶縁膜62とから構成されている。たとえば、有機半導体膜41、下層側絶縁膜61、および上層側絶縁膜62の膜厚は、それぞれ0.05μm〜0.2μm、0.2μm〜1.0μm、および1μm〜2μmである。従って、有機半導体膜41は無機材料からなる下層側絶縁膜61とは接しているが、有機材料からなる上層側絶縁膜62とは接していない。それ故、有機半導体膜41は、有機材料から構成されている上層側絶縁膜62の影響を受けて劣化することがないので、薄膜発光素子40では、発光効率の低下や信頼性の低下が起きないなど、実施の形態1と同様な効果を奏する。   Here, the bank layer bank is composed of a lower insulating film 61 made of an inorganic material such as a silicon oxide film or a silicon nitride film formed thicker than the organic semiconductor film 41 and a resist laminated on the lower insulating film 61. Alternatively, it is composed of an upper insulating film 62 made of an organic material such as a polyimide film. For example, the thicknesses of the organic semiconductor film 41, the lower insulating film 61, and the upper insulating film 62 are 0.05 μm to 0.2 μm, 0.2 μm to 1.0 μm, and 1 μm to 2 μm, respectively. Therefore, the organic semiconductor film 41 is in contact with the lower insulating film 61 made of an inorganic material, but is not in contact with the upper insulating film 62 made of an organic material. Therefore, the organic semiconductor film 41 does not deteriorate under the influence of the upper insulating film 62 made of an organic material. There is no similar effect as in the first embodiment.

このように構成したアクティブマトリクス型表示装置1において、有機半導体膜41は、バンク層bankで周囲が囲まれている。このため、このままでは、各画素7の対向電極opはバンク層bankを乗り越えて隣接する画素7の対向電極opと接続することになる。しかるに本形態では、バンク層bankには、データ線sigの延設方向で隣り合う画素7の間に相当する部分に下層側絶縁膜61および上層側絶縁膜62の双方が途切れた途切れ部分off(第1の途切れ部分)が形成されている。また、バンク層bankには、走査線gateの延設方向で隣り合う画素7の間に相当する部分にも下層側絶縁膜61および上層側絶縁膜62の双方が途切れた途切れ部分off(第1の途切れ部分)が形成されている。さらに、バンク層bankには、データ線sigおよび走査線gateの各延設方向の端部のそれぞれに下層側絶縁膜61および上層側絶縁膜62の双方が途切れた途切れ部分off(第1の途切れ部分)が形成されている。   In the active matrix display device 1 configured as described above, the organic semiconductor film 41 is surrounded by the bank layer bank. Therefore, in this state, the counter electrode op of each pixel 7 is connected to the counter electrode op of the adjacent pixel 7 over the bank layer bank. However, in the present embodiment, the bank layer bank is provided with a cut-off portion where both the lower insulating film 61 and the upper insulating film 62 are interrupted at a portion corresponding to a portion between the pixels 7 adjacent in the extending direction of the data line sig. (A first interruption portion) is formed. In the bank layer bank, a portion corresponding to a portion between the pixels 7 adjacent to each other in the direction in which the scanning line gate extends is also a part where both the lower insulating film 61 and the upper insulating film 62 are interrupted (off (first Is formed. Further, in the bank layer bank, at the ends of the data lines sig and the scanning lines gate in the extending directions, both the lower-layer insulating film 61 and the upper-layer insulating film 62 are interrupted at the portions off (first interrupts). Part) is formed.

このような途切れ部分offでは厚いバンク層bankがないので、バンク層bankに起因する大きな段差のない平坦部分であり、この部分に形成されている対向電極opは断線することがない。従って、各画素7の対向電極7は、バンク層bankに起因する段差のない平坦部分を介して確実に接続していることになる。それ故、画素7の周りに厚い絶縁膜(バンク層bank)を形成して寄生容量などを抑えても、この厚い絶縁膜(バンク層bank)の上層に形成する対向電極opに断線が発生しない。   Since there is no thick bank layer bank in such a discontinuous portion off, it is a flat portion without a large step caused by the bank layer bank, and the opposing electrode op formed in this portion does not break. Therefore, the opposing electrodes 7 of each pixel 7 are surely connected via a flat portion without a step caused by the bank layer bank. Therefore, even if a thick insulating film (bank layer bank) is formed around the pixel 7 to suppress parasitic capacitance and the like, disconnection does not occur in the counter electrode op formed on the thick insulating film (bank layer bank). .

また、透明基板10の周辺領域(表示部11の外側領域)において、データ側駆動回路3および走査側駆動回路4はいずれも、バンク層bank(形成領域に斜線を付してある。)によって覆われている。このため、これらの駆動回路の形成領域に対して対向電極opが重なる状態にあっても、駆動回路の配線層と対向電極opとの間にバンク層bankが介在することになる。それ故、駆動回路3、4に容量が寄生することを防止できるため、駆動回路3、4の負荷を低減でき、低消費電力化あるいは表示動作の高速化を図ることができる。   Further, in the peripheral area of the transparent substrate 10 (the area outside the display section 11), both the data-side drive circuit 3 and the scan-side drive circuit 4 are covered by a bank layer bank (the formation area is hatched). Has been done. For this reason, even when the counter electrode op overlaps the formation region of these drive circuits, the bank layer bank is interposed between the wiring layer of the drive circuit and the counter electrode op. Therefore, since parasitic capacitance can be prevented from being generated in the driving circuits 3 and 4, the load on the driving circuits 3 and 4 can be reduced, and low power consumption or high-speed display operation can be achieved.

しかも、走査側駆動回路4およびデータ側駆動回路3の上層側に形成されたバンク層bankは、走査側駆動回路4の形成領域とデータ側駆動回路3の形成領域との間に相当する位置に下層側絶縁膜61および上層側絶縁膜62の双方が途切れた途切れ部分off(第2の途切れ部分)が形成されている。このため、表示部11の側の対向電極opと基板外周側の対向電極opとは、バンク層bankの途切れ部分offを介して接続し、この途切れ部分offもバンク層bankに起因する段差のない平坦部分である。従って、この途切れ部分offに形成されている対向電極opは断線することがないので、表示部11の側の対向電極opと基板外周側の対向電極opとは、バンク層bankの途切れ部分offを介して確実に接続し、基板外周側の対向電極opに配線接続されている端子12と表示部11の対向電極opとは確実に接続している。   Moreover, the bank layer bank formed on the upper layer side of the scanning side driving circuit 4 and the data side driving circuit 3 is located at a position corresponding to between the formation area of the scanning side driving circuit 4 and the formation area of the data side driving circuit 3. A discontinuous portion off (second discontinuous portion) is formed in which both the lower insulating film 61 and the upper insulating film 62 are interrupted. For this reason, the counter electrode op on the display unit 11 side and the counter electrode op on the outer peripheral side of the substrate are connected via a discontinuous portion off of the bank layer bank, and the discontinuous portion off also has no step due to the bank layer bank. It is a flat part. Therefore, since the opposing electrode op formed at the discontinuous portion off does not break, the opposing electrode op on the display unit 11 side and the opposing electrode op on the outer peripheral side of the substrate are separated from the opposing electrode off on the bank layer bank. The terminal 12 connected to the counter electrode op on the outer peripheral side of the substrate by wire is securely connected to the counter electrode op of the display unit 11.

さらに、本形態では、画素電極41の形成領域のうち、導通制御回路50の中継電極35と重なる領域にもバンク層bankが形成されているため、無駄な無効電流が流れることを防止できる。それ故、共通給電線comの幅はその分、狭くてよい。   Furthermore, in the present embodiment, since the bank layer bank is also formed in the region where the pixel electrode 41 is formed and overlaps with the relay electrode 35 of the conduction control circuit 50, it is possible to prevent a useless reactive current from flowing. Therefore, the width of the common feed line com may be narrower accordingly.

このような構成のアクティブマトリクス型表示装置1を製造する際にも、実施の形態1と同様、第2の層間絶縁膜52の表面側に、走査線gateおよびデータ線sigに沿ってバンク層bankを形成する。このとき、バンク層bankの所定部分には途切れ部分offを形成しておく。また、データ線sigに沿って形成するバンク層bankは共通給電線comを覆うように幅広とする。その結果、薄膜発光素子40の有機半導体膜43を形成すべき領域はバンク層bankに囲まれる。   When manufacturing the active matrix display device 1 having such a configuration, similarly to the first embodiment, the bank layer bank is formed on the surface side of the second interlayer insulating film 52 along the scanning lines gate and the data lines sig. To form At this time, a discontinuous portion off is formed in a predetermined portion of the bank layer bank. The bank layer bank formed along the data line sig is wide so as to cover the common power supply line com. As a result, the region of the thin-film light emitting device 40 where the organic semiconductor film 43 is to be formed is surrounded by the bank layer bank.

次に、バンク層bankでマトリクス状に区画された領域内にインクジェット法を利用してR、G、Bに対応する各有機半導体膜43を形成していく。それには、バンク層bankの内側領域に対してインクジェットヘッドから、有機半導体膜43を構成するための液状の材料(前駆体)を吐出し、それをバンク層bankの内側領域で定着させて有機半導体膜43を形成する。ここで、バンク層bankの上層側絶縁膜62は、レジストやポリイミド膜から構成されているため、撥水性である。これに対して、有機半導体膜43の前駆体は親水性の溶媒を用いているため、有機半導体膜43の塗布領域はバンク層bankによって確実に規定され、隣接する画素7にはみ出ることがない。また、有機半導体膜43の形成領域を区画するバンク層bankに途切れ部分offがあったとしても、かかる途切れ部分offは狭いので、有機半導体膜43の塗布領域はバンク層bankによって確実に規定され、隣接する画素7にはみ出ることがない。それ故、有機半導体膜43などを所定領域内だけに形成できる。   Next, each organic semiconductor film 43 corresponding to R, G, and B is formed in a region partitioned in a matrix by the bank layer bank using an inkjet method. To this end, a liquid material (precursor) for forming the organic semiconductor film 43 is discharged from the ink jet head to the inner region of the bank layer bank, and is fixed in the inner region of the bank layer bank. A film 43 is formed. Here, since the upper insulating film 62 of the bank layer bank is made of a resist or a polyimide film, it is water repellent. On the other hand, since the precursor of the organic semiconductor film 43 uses a hydrophilic solvent, the application area of the organic semiconductor film 43 is definitely defined by the bank layer bank, and does not protrude into the adjacent pixels 7. In addition, even if there is a discontinuous portion off in the bank layer bank that divides the formation region of the organic semiconductor film 43, since the discontinuous portion off is narrow, the application region of the organic semiconductor film 43 is definitely defined by the bank layer bank. There is no protrusion to the adjacent pixels 7. Therefore, the organic semiconductor film 43 and the like can be formed only in the predetermined region.

なお、インクジェットヘッドから吐出した前駆体は表面張力の影響で約2μmないし約4μmの厚さに盛り上がるため、バンク層bankは約1μmないし約3μmの厚さが必要である。この状態では、インクジェットヘッドから吐出した前駆体は上層側絶縁膜62に接する状態にあるが、100℃〜150℃の熱処理を施した後は、前駆体から溶媒成分が除去されるので、バンク層bankの内側に定着した後の有機半導体膜43の厚さは約0.05μmから約0.2μmである。それ故、この状態では有機半導体膜43は上層側絶縁膜62には接していない。   Note that the precursor discharged from the inkjet head swells to a thickness of about 2 μm to about 4 μm due to the influence of surface tension, so that the bank layer bank needs to have a thickness of about 1 μm to about 3 μm. In this state, the precursor discharged from the inkjet head is in contact with the upper insulating film 62. However, after the heat treatment at 100 ° C. to 150 ° C., the solvent component is removed from the precursor, so that the bank layer The thickness of the organic semiconductor film 43 after being fixed inside the bank is about 0.05 μm to about 0.2 μm. Therefore, in this state, the organic semiconductor film 43 is not in contact with the upper insulating film 62.

なお、予めバンク層bankからなる隔壁が1μm以上の高さであれば、バンク層bankが撥水性でなくても、バンク層bankは隔壁として十分に機能する。従って、かかる厚いバンク層bankを形成しておけば、インクジェット法に代えて、塗布法で有機半体膜43を形成する場合でもその形成領域を規定できる。   Note that, if the partition wall composed of the bank layer bank has a height of 1 μm or more in advance, the bank layer bank sufficiently functions as a partition even if the bank layer bank is not water-repellent. Therefore, if such a thick bank layer bank is formed, the formation region can be defined even when the organic half film 43 is formed by a coating method instead of the ink jet method.

実施の形態5の変形例1Modification 1 of Embodiment 5

図10は、アクティブマトリクス型表示装置の全体のレイアウトを模式的に示すブロック図である。図11は、それに構成されている画素の1つを抜き出して示す平面図、図12(A)、(B)、(C)はそれぞれ図11のA−A′断面図、B−B′断面図、およびC−C′断面図である。なお、本形態と実施の形態1とは基本的な構成が同一なので、共通する部分には同一の符号を各図に付してそれらの詳細な説明を省略する。   FIG. 10 is a block diagram schematically showing the entire layout of the active matrix display device. FIG. 11 is a plan view showing one of the pixels formed therein, and FIGS. 12A, 12B, and 12C are cross-sectional views taken along the lines AA 'and BB' of FIG. 11, respectively. It is a figure and CC 'sectional drawing. Since the basic configuration of the present embodiment is the same as that of the first embodiment, the same reference numerals are given to the same parts in the respective drawings, and detailed description thereof will be omitted.

図10、図11、および図12(A)、(B)、(C)に示すように、本形態のアクティブマトリクス型表示装置1でも、データ線sigおよび走査線gateに沿って、有機半導体膜41よりも厚い絶縁膜(バンク層bank/左下がりの1本の斜線、または2本で一組の斜線を広いピッチで付した領域)を設け、このバンク層bankの上層側に対向電極opを形成してある。すなわち、データ線sigと対向電極opとの間に第2の層間絶縁膜52と厚いバンク層bankとが介在しているので、データ線sigに寄生する容量が極めて小さい。それ故、駆動回路3、4の負荷を低減でき、低消費電力化あるいは表示動作の高速化を図ることができる。   As shown in FIGS. 10, 11, and 12 (A), (B), and (C), even in the active matrix display device 1 of the present embodiment, the organic semiconductor film is formed along the data lines sig and the scanning lines gate. An insulating film thicker than 41 (bank layer bank / a region where one diagonal line diagonally to the left or two diagonal lines are provided at a wide pitch) is provided, and a counter electrode op is formed on the upper layer side of the bank layer bank. It is formed. That is, since the second interlayer insulating film 52 and the thick bank layer bank intervene between the data line sig and the counter electrode op, the capacitance parasitic on the data line sig is extremely small. Therefore, the load on the drive circuits 3 and 4 can be reduced, and low power consumption or high-speed display operation can be achieved.

ここで、バンク層bankは、有機半導体膜41よりも厚く形成されたシリコン酸化膜あるいはシリコン窒化膜などの無機材料からなる下層側絶縁膜61と、この下層側絶縁膜61上に積層されたレジストあるいはポリイミド膜などの有機材料からなる上層側絶縁膜62とから構成されている。従って、有機半導体膜41は無機材料からなる下層側絶縁膜61とは接しているが、有機材料からなる上層側絶縁膜62とは接していない。それ故、有機半導体膜41は、有機材料から構成されている上層側絶縁膜62の影響を受けて劣化することがないので、薄膜発光素子40では、発光効率の低下や信頼性の低下が起きないなど、実施の形態1と同様な効果を奏する。   Here, the bank layer bank is composed of a lower insulating film 61 made of an inorganic material such as a silicon oxide film or a silicon nitride film formed thicker than the organic semiconductor film 41 and a resist laminated on the lower insulating film 61. Alternatively, it is composed of an upper insulating film 62 made of an organic material such as a polyimide film. Therefore, the organic semiconductor film 41 is in contact with the lower insulating film 61 made of an inorganic material, but is not in contact with the upper insulating film 62 made of an organic material. Therefore, the organic semiconductor film 41 does not deteriorate under the influence of the upper insulating film 62 made of an organic material. There is no similar effect as in the first embodiment.

また、本形態では、データ線sigおよび走査線gateに沿ってバンク層bankを形成してあるため、いずれの画素7もバンク層bankで囲まれている。このため、インクジェット法を利用して所定の領域にR、G、Bに対応する各有機半導体膜43を形成していけるので、フルカラーのアクティブマトリクス型表示装置1を高い生産性で製造できる。   Further, in this embodiment, since the bank layer bank is formed along the data line sig and the scanning line gate, each pixel 7 is surrounded by the bank layer bank. For this reason, since each organic semiconductor film 43 corresponding to R, G, and B can be formed in a predetermined region using the inkjet method, the full-color active matrix display device 1 can be manufactured with high productivity.

しかも、バンク層bankには、走査線gateの延設方向で隣り合う画素7の間に相当する部分に途切れ部分off(第1の途切れ部分)が形成されている。また、バンク層bankには、データ線sigおよび走査線gateの各延設方向の端部のそれぞれにも途切れ部分off(第1の途切れ部分)が形成されている。さらに、走査側駆動回路4およびデータ側駆動回路3の上層側に形成されたバンク層bankは、走査側駆動回路4の形成領域とデータ側駆動回路3の形成領域との間に相当する位置に途切れ部分off(第2の途切れ部分)が形成されている。従って、対向電極opは、バンク層bankに起因する段差のない平坦部分(途切れ部分off)を介して確実に接続し、断線することがない。   In addition, in the bank layer bank, a break portion off (first break portion) is formed in a portion corresponding to a portion between the pixels 7 adjacent in the extending direction of the scanning line gate. Further, in the bank layer bank, a break portion off (first break portion) is also formed at each end of the data line sig and the scanning line gate in the extending direction. Further, the bank layer bank formed on the upper layer side of the scanning side driving circuit 4 and the data side driving circuit 3 is located at a position corresponding to the area between the forming area of the scanning side driving circuit 4 and the forming area of the data side driving circuit 3. A discontinuous portion off (a second discontinuous portion) is formed. Therefore, the opposing electrode op is reliably connected via a flat portion (a break portion off) having no step due to the bank layer bank, and is not disconnected.

実施の形態5の変形例2Modification 2 of Embodiment 5

図13は、アクティブマトリクス型表示装置の全体のレイアウトを模式的に示すブロック図である。図14は、それに構成されている画素の1つを抜き出して示す平面図、図15(A)、(B)、(C)はそれぞれ図14のA−A′断面図、B−B′断面図、およびC−C′断面図である。なお、本形態と実施の形態1とは基本的な構成が同一なので、共通する部分には同一の符号を各図に付してそれらの詳細な説明を省略する。   FIG. 13 is a block diagram schematically showing the overall layout of the active matrix display device. FIG. 14 is a plan view showing one of the pixels formed therein, and FIGS. 15A, 15B, and 15C are cross-sectional views taken along the lines AA 'and BB' of FIG. It is a figure and CC 'sectional drawing. Since the basic configuration of the present embodiment is the same as that of the first embodiment, the same reference numerals are given to the same parts in the respective drawings, and detailed description thereof will be omitted.

図13、図14、および図15(A)、(B)、(C)に示すように、本形態のアクティブマトリクス型表示装置1でも、データ線sigおよび走査線gateに沿って、有機半導体膜41よりも厚い絶縁膜(バンク層bank/左下がりの1本の斜線、または2本で一組の斜線を広いピッチで付した領域)を設け、このバンク層bankの上層側に対向電極opを形成してある。すなわち、データ線sigと対向電極opとの間に第2の層間絶縁膜52と厚いバンク層bankとが介在しているので、データ線sigに寄生する容量が極めて小さい。それ故、駆動回路3、4の負荷を低減でき、低消費電力化あるいは表示動作の高速化を図ることができる。   As shown in FIGS. 13, 14, and 15 (A), (B), and (C), even in the active matrix display device 1 of the present embodiment, the organic semiconductor film is formed along the data lines sig and the scanning lines gate. An insulating film thicker than 41 (bank layer bank / a region where one diagonal line diagonally to the left or two diagonal lines are provided at a wide pitch) is provided, and a counter electrode op is formed on the upper layer side of the bank layer bank. It is formed. That is, since the second interlayer insulating film 52 and the thick bank layer bank intervene between the data line sig and the counter electrode op, the capacitance parasitic on the data line sig is extremely small. Therefore, the load on the drive circuits 3 and 4 can be reduced, and low power consumption or high-speed display operation can be achieved.

ここで、バンク層bankは、有機半導体膜41よりも厚く形成されたシリコン酸化膜あるいはシリコン窒化膜などの無機材料からなる下層側絶縁膜61と、この下層側絶縁膜61上に積層されたレジストあるいはポリイミド膜などの有機材料からなる上層側絶縁膜62とから構成されている。従って、有機半導体膜41は無機材料からなる下層側絶縁膜61とは接しているが、有機材料からなる上層側絶縁膜62とは接していない。それ故、有機半導体膜41は、有機材料から構成されている上層側絶縁膜62の影響を受けて劣化することがないので、薄膜発光素子40では、発光効率の低下や信頼性の低下が起きないなど、実施の形態1と同様な効果を奏する。   Here, the bank layer bank is composed of a lower insulating film 61 made of an inorganic material such as a silicon oxide film or a silicon nitride film formed thicker than the organic semiconductor film 41 and a resist laminated on the lower insulating film 61. Alternatively, it is composed of an upper insulating film 62 made of an organic material such as a polyimide film. Therefore, the organic semiconductor film 41 is in contact with the lower insulating film 61 made of an inorganic material, but is not in contact with the upper insulating film 62 made of an organic material. Therefore, the organic semiconductor film 41 does not deteriorate under the influence of the upper insulating film 62 made of an organic material. There is no similar effect as in the first embodiment.

また、本形態では、データ線sigおよび走査線gateに沿ってバンク層bankを形成してあるため、いずれの画素7もバンク層bankで囲まれている。このため、インクジェット法を利用して所定の領域にR、G、Bに対応する各有機半導体膜43を形成していけるので、フルカラーのアクティブマトリクス型表示装置1を高い生産性で製造できる。   Further, in this embodiment, since the bank layer bank is formed along the data line sig and the scanning line gate, each pixel 7 is surrounded by the bank layer bank. For this reason, since each organic semiconductor film 43 corresponding to R, G, and B can be formed in a predetermined region using the inkjet method, the full-color active matrix display device 1 can be manufactured with high productivity.

しかも、バンク層bankには、データ線sigの延設方向で隣り合う画素7の間に相当する部分に途切れ部分off(第1の途切れ部分)が形成されている。また、バンク層bankには、データ線sigおよび走査線gateの各延設方向の端部のそれぞれにも途切れ部分off(第1の途切れ部分)が形成されている。さらに、走査側駆動回路4およびデータ側駆動回路3の上層側に形成されたバンク層bankは、走査側駆動回路4の形成領域とデータ側駆動回路3の形成領域との間に相当する位置に途切れ部分off(第2の途切れ部分)が形成されている。従って、対向電極opは、バンク層bankに起因する段差のない平坦部分(途切れ部分off)を介して確実に接続し、断線することがない。   In addition, in the bank layer bank, a break portion off (first break portion) is formed in a portion corresponding to a portion between the pixels 7 adjacent in the extending direction of the data line sig. Further, in the bank layer bank, a break portion off (first break portion) is also formed at each end of the data line sig and the scanning line gate in the extending direction. Further, the bank layer bank formed on the upper layer side of the scanning side driving circuit 4 and the data side driving circuit 3 is located at a position corresponding to the area between the forming area of the scanning side driving circuit 4 and the forming area of the data side driving circuit 3. A discontinuous portion off (a second discontinuous portion) is formed. Therefore, the opposing electrode op is reliably connected via a flat portion (a break portion off) having no step due to the bank layer bank, and is not disconnected.

実施の形態5の変形例3Modification 3 of Embodiment 5

図16は、アクティブマトリクス型表示装置の全体のレイアウトを模式的に示すブロック図である。図17は、それに構成されている画素の1つを抜き出して示す平面図、図18(A)、(B)、(C)はそれぞれ図17のA−A′断面図、B−B′断面図、およびC−C′断面図である。なお、本形態と実施の形態1、5とは基本的な構成が同一なので、共通する部分には同一の符号を各図に付してそれらの詳細な説明を省略する。   FIG. 16 is a block diagram schematically showing the overall layout of the active matrix display device. FIG. 17 is a plan view showing one of the pixels formed therein, and FIGS. 18 (A), (B) and (C) are AA 'sectional view and BB' sectional view of FIG. 17, respectively. It is a figure and CC 'sectional drawing. Since the present embodiment and the first and fifth embodiments have the same basic configuration, the same reference numerals are given to the same portions in the respective drawings, and detailed description thereof will be omitted.

図16、図17、および図18(A)、(B)、(C)に示すように、本形態のアクティブマトリクス型表示装置1でも、データ線sigおよび走査線gateに沿って、有機半導体膜41よりも厚い絶縁膜(バンク層bank/左下がりの1本の斜線、または2本で一組の斜線を広いピッチで付した領域)を設け、このバンク層bankの上層側に対向電極opを形成してある。すなわち、データ線sigと対向電極opとの間に第2の層間絶縁膜52と厚いバンク層bankとが介在しているので、データ線sigに寄生する容量が極めて小さい。それ故、駆動回路3、4の負荷を低減でき、低消費電力化あるいは表示動作の高速化を図ることができる。   As shown in FIGS. 16, 17, and 18 (A), (B), and (C), even in the active matrix display device 1 of the present embodiment, the organic semiconductor film is formed along the data lines sig and the scanning lines gate. An insulating film thicker than 41 (bank layer bank / a region where one diagonal line diagonally to the left or two diagonal lines are provided at a wide pitch) is provided, and a counter electrode op is formed on the upper layer side of the bank layer bank. It is formed. That is, since the second interlayer insulating film 52 and the thick bank layer bank intervene between the data line sig and the counter electrode op, the capacitance parasitic on the data line sig is extremely small. Therefore, the load on the drive circuits 3 and 4 can be reduced, and low power consumption or high-speed display operation can be achieved.

ここで、バンク層bankは、有機半導体膜41よりも厚く形成されたシリコン酸化膜あるいはシリコン窒化膜などの無機材料からなる下層側絶縁膜61と、この下層側絶縁膜61上に積層されたレジストあるいはポリイミド膜などの有機材料からなる上層側絶縁膜62とから構成されている。   Here, the bank layer bank is composed of a lower insulating film 61 made of an inorganic material such as a silicon oxide film or a silicon nitride film formed thicker than the organic semiconductor film 41 and a resist laminated on the lower insulating film 61. Alternatively, it is composed of an upper insulating film 62 made of an organic material such as a polyimide film.

また、本形態では、データ線sigおよび走査線gateに沿ってバンク層bankを形成してあるため、いずれの画素7もバンク層bankで囲まれている。このため、インクジェット法を利用して所定の領域にR、G、Bに対応する各有機半導体膜43を形成していけるので、フルカラーのアクティブマトリクス型表示装置1を高い生産性で製造できる。   Further, in this embodiment, since the bank layer bank is formed along the data line sig and the scanning line gate, each pixel 7 is surrounded by the bank layer bank. For this reason, since each organic semiconductor film 43 corresponding to R, G, and B can be formed in a predetermined region using the inkjet method, the full-color active matrix display device 1 can be manufactured with high productivity.

しかも、バンク層bankには、データ線sigの延設方向で隣り合う画素7の間に相当する部分に途切れ部分off(第1の途切れ部分)が形成されている。また、バンク層bankには、データ線sigおよび走査線gateの各延設方向の端部のそれぞれにも途切れ部分off(第1の途切れ部分)が形成されている。さらに、走査側駆動回路4およびデータ側駆動回路3の上層側に形成されたバンク層bankは、走査側駆動回路4の形成領域とデータ側駆動回路3の形成領域との間に相当する位置に途切れ部分off(第2の途切れ部分)が形成されている。   In addition, in the bank layer bank, a break portion off (first break portion) is formed in a portion corresponding to a portion between the pixels 7 adjacent in the extending direction of the data line sig. Further, in the bank layer bank, a break portion off (first break portion) is also formed at each end of the data line sig and the scanning line gate in the extending direction. Further, the bank layer bank formed on the upper layer side of the scanning side driving circuit 4 and the data side driving circuit 3 is located at a position corresponding to the area between the forming area of the scanning side driving circuit 4 and the forming area of the data side driving circuit 3. A discontinuous portion off (a second discontinuous portion) is formed.

但し、本形態において、途切れ部分offでは、バンク層bankを形成するのに用いた下層側絶縁膜61(2本で一組の斜線を付した領域)および上層側絶縁膜62(左下がりの1本の斜線を付した領域)のうち、上層側絶縁膜62のみが途切れており、途切れ部分offであってもそこには下層側絶縁膜61は形成されている。   However, in the present embodiment, in the discontinuous portion off, the lower insulating film 61 (a pair of two shaded regions) and the upper insulating film 62 (the lower left insulating film 62) used to form the bank layer bank. Only the upper insulating film 62 is interrupted in the hatched area), and the lower insulating film 61 is formed even in the interrupted portion off.

このように構成した場合も、途切れ部分offには薄い下層側絶縁膜61があるだけで、厚い上層側絶縁膜62がないので、対向電極opは、途切れ部分offを介して確実に接続し、断線することがない。   Even in the case of such a configuration, since only the thin lower-layer insulating film 61 is provided at the discontinuous portion off, and the thick upper-layer insulating film 62 is not provided, the counter electrode op is reliably connected via the discontinuous portion off. There is no disconnection.

なお、上記形態では、第1の途切れ部分および第2の途切れ部分の双方において下層側絶縁膜61が形成されている構成であったが、本発明はこれに限定されるものではなく、第1の途切れ部分および第2の途切れ部分のいずれか一方のみに下層側絶縁膜61が形成されている構成であってもよい。また、本形態のように途切れ部分に下層側絶縁膜61が形成されている構成は、その他の実施の形態で説明したパターンのバンク層bankに適用してもよい。   Note that, in the above embodiment, the lower insulating film 61 is formed in both the first interrupted portion and the second interrupted portion. However, the present invention is not limited to this. The lower insulating film 61 may be formed in only one of the interrupted portion and the second interrupted portion. Further, the configuration in which the lower insulating film 61 is formed at a break portion as in this embodiment may be applied to the bank layer bank of the pattern described in the other embodiments.

実施の形態6Embodiment 6

図19は、アクティブマトリクス型表示装置の全体のレイアウトを模式的に示すブロック図である。図20は、それに構成されている画素の1つを抜き出して示す平面図、図21(A)、(B)、(C)はそれぞれ図20のA−A′断面図、B−B′断面図、およびC−C′断面図である。なお、本形態と実施の形態1とは基本的な構成が同一なので、共通する部分には同一の符号を各図に付してそれらの詳細な説明を省略する。   FIG. 19 is a block diagram schematically showing the overall layout of the active matrix display device. FIG. 20 is a plan view showing one of the pixels formed therein, and FIGS. 21A, 21B, and 21C are cross-sectional views taken along the lines AA 'and BB' of FIG. 20, respectively. It is a figure and CC 'sectional drawing. Since the basic configuration of the present embodiment is the same as that of the first embodiment, the same reference numerals are given to the same parts in the respective drawings, and detailed description thereof will be omitted.

図19、図20、および図21(A)、(B)、(C)に示すように、本形態のアクティブマトリクス型表示装置1では、データ線sigに沿って、有機半導体膜41よりも厚い絶縁膜(バンク層bank/左下がりの1本の斜線、または2本で一組の斜線を広いピッチで付した領域)を設け、このバンク層bankの上層側に対向電極opを形成してある。すなわち、データ線sigと対向電極opとの間に第2の層間絶縁膜52と厚いバンク層bankとが介在しているので、データ線sigに寄生する容量が極めて小さい。それ故、駆動回路3、4の負荷を低減でき、低消費電力化あるいは表示動作の高速化を図ることができる。   As shown in FIG. 19, FIG. 20, and FIGS. 21A, 21B, and 21C, in the active matrix display device 1 of the present embodiment, the thickness is larger than the organic semiconductor film 41 along the data line sig. An insulating film (bank layer bank / a region where one diagonal line at the lower left or a pair of diagonal lines is provided at a wide pitch) is provided, and a counter electrode op is formed on the upper layer side of the bank layer bank. . That is, since the second interlayer insulating film 52 and the thick bank layer bank intervene between the data line sig and the counter electrode op, the capacitance parasitic on the data line sig is extremely small. Therefore, the load on the drive circuits 3 and 4 can be reduced, and low power consumption or high-speed display operation can be achieved.

ここで、バンク層bankは、有機半導体膜41よりも厚く形成されたシリコン酸化膜あるいはシリコン窒化膜などの無機材料からなる下層側絶縁膜61と、この下層側絶縁膜61上に積層されたレジストあるいはポリイミド膜などの有機材料からなる上層側絶縁膜62とから構成されている。従って、有機半導体膜41は無機材料からなる下層側絶縁膜61とは接しているが、有機材料からなる上層側絶縁膜62とは接していない。それ故、有機半導体膜41は、有機材料から構成されている上層側絶縁膜62の影響を受けて劣化することがないので、薄膜発光素子40では、発光効率の低下や信頼性の低下が起きないなど、実施の形態1と同様な効果を奏する。   Here, the bank layer bank is composed of a lower insulating film 61 made of an inorganic material such as a silicon oxide film or a silicon nitride film formed thicker than the organic semiconductor film 41 and a resist laminated on the lower insulating film 61. Alternatively, it is composed of an upper insulating film 62 made of an organic material such as a polyimide film. Therefore, the organic semiconductor film 41 is in contact with the lower insulating film 61 made of an inorganic material, but is not in contact with the upper insulating film 62 made of an organic material. Therefore, the organic semiconductor film 41 does not deteriorate under the influence of the upper insulating film 62 made of an organic material. There is no similar effect as in the first embodiment.

また、本形態では、データ線sigに沿ってバンク層bankを形成してあるため、バンク層bankでストライプ状に区画された領域内にインクジェット法を利用してR、G、Bに対応する各有機半導体膜43をストライプ状に形成していけるので、フルカラーのアクティブマトリクス型表示装置1を高い生産性で製造できる。   Further, in the present embodiment, since the bank layer bank is formed along the data line sig, each of the areas corresponding to R, G, and B is formed in a region partitioned in a stripe shape by the bank layer bank using the inkjet method. Since the organic semiconductor film 43 can be formed in a stripe shape, the full-color active matrix display device 1 can be manufactured with high productivity.

しかも、バンク層bankには、データ線sigの延設方向の端部に、下層側絶縁膜61および上層側絶縁膜62の双方が途切れた途切れ部分off(第1の途切れ部分)が形成されている。従って、各画素7の対向電極opは、走査線gateの延設方向では、隣接する画素7の対向電極opに対して厚いバンク層bankを乗り越えて接続している。それでも、データ線sigの延設方向を辿っていくと、各画素7の対向電極opは、データ線sigの端部で途切れ部分off(バンク層bankに起因する段差のない平坦部分)を介して、走査線gateの延設方向で隣接する画素7の列と接続している。それ故、各画素7の対向電極opは、バンク層bankに起因する段差のない平坦部分を介して他の画素7の対向電極opに接続しているといえ、いずれの画素7の対向電極opも断線状態になることはない。   Moreover, in the bank layer bank, at the end of the data line sig in the extending direction, a discontinuous portion off (first discontinuous portion) in which both the lower insulating film 61 and the upper insulating film 62 are interrupted is formed. I have. Therefore, the opposing electrode op of each pixel 7 is connected to the opposing electrode op of the adjacent pixel 7 over the thick bank layer bank in the extending direction of the scanning line gate. Nevertheless, when the extending direction of the data line sig is traced, the opposing electrode op of each pixel 7 passes through an end portion of the data line sig via a discontinuous portion off (a flat portion without a step caused by the bank layer bank). , Are connected to columns of pixels 7 adjacent in the direction in which the scanning line gate extends. Therefore, it can be said that the opposing electrode op of each pixel 7 is connected to the opposing electrode op of another pixel 7 via a flat portion without a step caused by the bank layer bank. No disconnection occurs.

また、透明基板10の周辺領域(表示部11の外側領域)において、データ側駆動回路3および走査側駆動回路4はいずれも、バンク層bankによって覆われている。このため、これらの駆動回路の形成領域に対して対向電極opが重なる状態にあっても、駆動回路の配線層と対向電極opとの間にバンク層bankが介在することになる。それ故、駆動回路3、4に容量が寄生することを防止できるため、駆動回路3、4の負荷を低減でき、低消費電力化あるいは表示動作の高速化を図ることができる。   Further, in the peripheral area of the transparent substrate 10 (the area outside the display section 11), the data-side driving circuit 3 and the scanning-side driving circuit 4 are both covered by a bank layer bank. For this reason, even when the counter electrode op overlaps the formation region of these drive circuits, the bank layer bank is interposed between the wiring layer of the drive circuit and the counter electrode op. Therefore, since parasitic capacitance can be prevented from being generated in the driving circuits 3 and 4, the load on the driving circuits 3 and 4 can be reduced, and low power consumption or high-speed display operation can be achieved.

さらに、走査側駆動回路4およびデータ側駆動回路3の上層側に形成されたバンク層bankは、走査側駆動回路4の形成領域とデータ側駆動回路3の形成領域との間に相当する位置に途切れ部分off(第2の途切れ部分)が形成されている。従って、対向電極opは、バンク層bankに起因する段差のない平坦部分(途切れ部分off)を介して確実に接続し、断線することがない。   Further, the bank layer bank formed on the upper layer side of the scanning side driving circuit 4 and the data side driving circuit 3 is located at a position corresponding to the area between the forming area of the scanning side driving circuit 4 and the forming area of the data side driving circuit 3. A discontinuous portion off (a second discontinuous portion) is formed. Therefore, the opposing electrode op is reliably connected via a flat portion (a break portion off) having no step due to the bank layer bank, and is not disconnected.

その他の実施の形態Other embodiments

なお、実施の形態5の変形例3で説明したように、バンク層bankの途切れ部分offでは上層側絶縁膜62のみが途切れているという構成は、実施の形態6に適用してもよい。   As described in the third modification of the fifth embodiment, the configuration in which only the upper insulating film 62 is interrupted at the interrupted portion off of the bank layer bank may be applied to the sixth embodiment.

また、実施の形態5、6で説明したように、バンク層bankに対して途切れ部分offを形成することにより対向電極opの断線を防ぐという発明は、実施の形態3で説明した無機材料からなるバンク層bankを用いた場合に適用することもできる。   Further, as described in the fifth and sixth embodiments, the invention of preventing disconnection of the opposing electrode op by forming a discontinuous portion off in the bank layer bank is made of the inorganic material described in the third embodiment. The present invention can be applied to a case where a bank layer bank is used.

以上説明したように、本発明に係るアクティブマトリクス型表示装置では、有機半導体膜の形成領域を囲むように絶縁膜を形成するのに、この絶縁膜を有機半導体膜よりも厚い無機材料からなる下層側絶縁膜と、その上に積層された有機材料からなる上層側絶縁膜とから構成する。従って、本発明によれば、データ線と対向電極との間に厚い絶縁膜を介在させたので、データ線に容量が寄生することを防止できる。このため、データ側駆動回路の負荷を低減できるので、低消費電力化あるいは表示動作の高速化を図ることができる。また、本発明では、薄膜発光素子の有機半導体膜と接する下層側絶縁膜のみを無機材料から構成し、その上層側には、厚い膜を容易に形成できるレジストなどの有機材料から構成した上層側絶縁膜を積層しているので、生産性が高い。しかも、上層側絶縁膜は有機半導体膜と接しておらず、有機半導体膜と接するのは無機材料から構成した下層側絶縁膜なので、有機半導体膜は上層側絶縁膜の影響を受けて劣化することがない。それ故、薄膜発光素子は発光効率の低下や信頼性の低下などを起こさない。   As described above, in the active matrix type display device according to the present invention, the insulating film is formed so as to surround the formation region of the organic semiconductor film. It is composed of a side insulating film and an upper layer insulating film made of an organic material laminated thereon. Therefore, according to the present invention, since a thick insulating film is interposed between the data line and the counter electrode, it is possible to prevent the capacitance from being parasitic on the data line. For this reason, the load on the data-side driving circuit can be reduced, so that low power consumption or high-speed display operation can be achieved. Further, in the present invention, only the lower insulating film in contact with the organic semiconductor film of the thin-film light-emitting element is formed of an inorganic material, and the upper layer is formed of an organic material such as a resist capable of easily forming a thick film. High productivity because the insulating films are stacked. In addition, the upper insulating film is not in contact with the organic semiconductor film, and is in contact with the organic semiconductor film because the lower insulating film is made of an inorganic material. There is no. Therefore, the thin-film light-emitting element does not cause a decrease in luminous efficiency or reliability.

ここで、上層側絶縁膜を下層側絶縁膜より狭い幅をもってこの下層側絶縁膜の内側領域に積層した場合には、有機材料から構成された上層側絶縁膜は、有機半導体膜により接しにくくなるので、有機半導体膜の劣化をより確実に防止できる。   Here, when the upper insulating film is laminated on the inner region of the lower insulating film with a width smaller than that of the lower insulating film, the upper insulating film made of an organic material is less likely to be in contact with the organic semiconductor film. Therefore, deterioration of the organic semiconductor film can be more reliably prevented.

本発明の別の形態では、有機半導体膜の形成領域を囲むように絶縁膜を形成するのに、無機材料からなる下層側絶縁膜と、この下層側絶縁膜より狭い幅をもってこの下層側絶縁膜の内側領域に積層された無機材料からなる上層側絶縁膜とから構成する。従って、本発明でも、データ線と対向電極との間に厚い絶縁膜を介在させたので、データ線に容量が寄生することを防止できる。このため、データ側駆動回路の負荷を低減できるので、低消費電力化あるいは表示動作の高速化を図ることができる。また、下層側絶縁膜および上層側絶縁膜を構成すべき無機材料からなる膜を形成した後、上層側絶縁膜をパターニングする際には、下層側絶縁膜がエッチングストッパーとして機能するので、多少のオーバーエッチングがあっても画素電極を損傷することはない。かかるパターニングを終えた後に下層側絶縁膜をパターニング形成する際には、下層側絶縁膜の1層分をエッチングするだけなので、エッチング制御が容易で、画素電極を損傷するほどのオーバーエッチングが起きない。   In another embodiment of the present invention, in order to form an insulating film so as to surround a region where an organic semiconductor film is formed, a lower insulating film made of an inorganic material and a lower insulating film having a width smaller than the lower insulating film And an upper-layer insulating film made of an inorganic material laminated in the inner region of. Therefore, also in the present invention, since the thick insulating film is interposed between the data line and the counter electrode, it is possible to prevent the capacitance from being parasitic on the data line. For this reason, the load on the data-side driving circuit can be reduced, so that low power consumption or high-speed display operation can be achieved. Also, when forming a film made of an inorganic material to form the lower insulating film and the upper insulating film, when patterning the upper insulating film, the lower insulating film functions as an etching stopper, so that the The pixel electrode is not damaged by over-etching. When the lower insulating film is formed by patterning after the completion of the patterning, only one layer of the lower insulating film is etched, so that the etching control is easy, and over-etching that may damage the pixel electrode does not occur. .

図1は、本発明の実施の形態1に係るアクティブマトリクス型表示装置の全体のレイアウトを模式的に示すブロック図である。FIG. 1 is a block diagram schematically showing an overall layout of an active matrix display device according to Embodiment 1 of the present invention. 図2は、図1に示すアクティブマトリクス型表示装置に構成されている画素の1つを抜き出して示す平面図である。FIG. 2 is a plan view showing one of the pixels included in the active matrix display device shown in FIG. 図3(A)、(B)、(C)はそれぞれ、図2のA−A′断面図、B−B′断面図、およびC−C′断面図である。3A, 3B, and 3C are an AA 'sectional view, a BB' sectional view, and a CC 'sectional view of FIG. 2, respectively. 図4(A)、(B)、(C)はそれぞれ、本発明の実施の形態2、3に係るアクティブマトリクス型表示装置の図2のA−A′線、B−B′線、およびC−C′線に相当する位置での断面図である。FIGS. 4A, 4B, and 4C respectively show the AA 'line, BB' line, and C of FIG. 2 of the active matrix display device according to the second and third embodiments of the present invention. It is sectional drawing in the position corresponding to the -C 'line. 図5は、本発明の実施の形態4に係るアクティブマトリクス型表示装置に構成されている画素の1つを抜き出して示す平面図である。FIG. 5 is a plan view showing one of the pixels included in the active matrix display device according to Embodiment 4 of the present invention. 図6(A)、(B)、(C)はそれぞれ、図5のA−A′線、B−B′線、およびC−C′線に相当する位置での断面図である。FIGS. 6A, 6B, and 6C are cross-sectional views at positions corresponding to lines AA ', BB', and CC 'in FIG. 5, respectively. 図7は、本発明の実施の形態5に係るアクティブマトリクス型表示装置の全体のレイアウトを模式的に示すブロック図である。FIG. 7 is a block diagram schematically showing an overall layout of an active matrix display device according to Embodiment 5 of the present invention. 図8は、図7に示すアクティブマトリクス型表示装置に構成されている画素の1つを抜き出して示す平面図である。FIG. 8 is a plan view showing one of the pixels included in the active matrix display device shown in FIG. 図9(A)、(B)、(C)はそれぞれ、図8のA−A′線、B−B′線、およびC−C′線に相当する位置での断面図である。9A, 9B, and 9C are cross-sectional views at positions corresponding to lines AA ', BB', and CC 'in FIG. 8, respectively. 図10は、本発明の実施の形態5の変形例1に係るアクティブマトリクス型表示装置の全体のレイアウトを模式的に示すブロック図である。FIG. 10 is a block diagram schematically showing an overall layout of an active matrix display device according to a first modification of the fifth embodiment of the present invention. 図11は、図10に示すアクティブマトリクス型表示装置に構成されている画素の1つを抜き出して示す平面図である。FIG. 11 is a plan view showing one of the pixels included in the active matrix display device shown in FIG. 図12(A)、(B)、(C)はそれぞれ、図11のA−A′線、B−B′線、およびC−C′線に相当する位置での断面図である。12A, 12B, and 12C are cross-sectional views at positions corresponding to lines AA ', BB', and CC 'in FIG. 11, respectively. 図13は、本発明の実施の形態5の変形例2に係るアクティブマトリクス型表示装置の全体のレイアウトを模式的に示すブロック図である。FIG. 13 is a block diagram schematically showing an overall layout of an active matrix display device according to Modification 2 of Embodiment 5 of the present invention. 図14は、図13に示すアクティブマトリクス型表示装置に構成されている画素の1つを抜き出して示す平面図である。FIG. 14 is a plan view showing one of the pixels included in the active matrix display device shown in FIG. 図15(A)、(B)、(C)はそれぞれ、図14のA−A′線、B−B′線、およびC−C′線に相当する位置での断面図である。FIGS. 15A, 15B, and 15C are cross-sectional views at positions corresponding to lines AA ', BB', and CC 'in FIG. 14, respectively. 図16は、本発明の実施の形態5の変形例3に係るアクティブマトリクス型表示装置の全体のレイアウトを模式的に示すブロック図である。FIG. 16 is a block diagram schematically showing an overall layout of an active matrix display device according to Modification 3 of Embodiment 5 of the present invention. 図17は、図16に示すアクティブマトリクス型表示装置に構成されている画素の1つを抜き出して示す平面図である。FIG. 17 is a plan view showing one of the pixels included in the active matrix display device shown in FIG. 図18(A)、(B)、(C)はそれぞれ、図17のA−A′線、B−B′線、およびC−C′線に相当する位置での断面図である。FIGS. 18A, 18B, and 18C are cross-sectional views at positions corresponding to lines AA ', BB', and CC 'in FIG. 17, respectively. 図19は、本発明の実施の形態6に係るアクティブマトリクス型表示装置の全体のレイアウトを模式的に示すブロック図である。FIG. 19 is a block diagram schematically showing the entire layout of the active matrix display device according to Embodiment 6 of the present invention. 図20は、図19に示すアクティブマトリクス型表示装置に構成されている画素の1つを抜き出して示す平面図である。FIG. 20 is a plan view of one of the pixels included in the active matrix display device shown in FIG. 図21(A)、(B)、(C)はそれぞれ、図20のA−A′線、B−B′線、およびC−C′線に相当する位置での断面図である。21A, 21B, and 21C are cross-sectional views at positions corresponding to the line AA ', the line BB', and the line CC 'in FIG. 20, respectively. 図22は、従来および本発明の比較例に係るアクティブマトリクス型表示装置の全体のレイアウトを模式的に示すブロック図である。FIG. 22 is a block diagram schematically illustrating an overall layout of an active matrix display device according to a conventional example and a comparative example of the present invention. 図23は、図22に示すアクティブマトリクス型表示装置に構成されている画素の1つを抜き出して示す平面図である。FIG. 23 is a plan view showing one of the pixels included in the active matrix display device shown in FIG. 図24(A)、(B)、(C)はそれぞれ、図23のA−A′線、B−B′線、およびC−C′線に相当する位置での断面図である。FIGS. 24A, 24B and 24C are cross-sectional views at positions corresponding to lines AA ', BB' and CC 'in FIG. 23, respectively. 図25(A)、(B)、(C)はそれぞれ、比較例に係るアクティブマトリクス型表示装置における図23のA−A′線、B−B′線、およびC−C′線に相当する位置での断面図である。FIGS. 25A, 25B, and 25C respectively correspond to the AA 'line, the BB' line, and the CC 'line of FIG. 23 in the active matrix display device according to the comparative example. It is sectional drawing in a position.

符号の説明Explanation of reference numerals

1 アクティブマトリクス型表示装置
2 表示部
3 データ側駆動回路
4 走査側駆動回路
7 画素
10 透明基板
12 端子
20 第1のTFT
21 第1のTFTのゲート電極
30 第2のTFT
31 第2のTFTのゲート電極
40 発光素子
41 画素電極
43 有機半導体
61 下層側絶縁膜
62 上層側絶縁膜
bank バンク層(絶縁膜)
cap 保持容量
com 共通給電線
gate 走査線
op 対向電極
off パンク層の途切れ部分
sig データ線

DESCRIPTION OF SYMBOLS 1 Active matrix type display apparatus 2 Display part 3 Data side drive circuit 4 Scan side drive circuit 7 Pixel 10 Transparent substrate 12 Terminal 20 First TFT
21 Gate electrode of first TFT 30 Second TFT
31 Gate electrode 40 of second TFT 40 Light emitting element 41 Pixel electrode 43 Organic semiconductor 61 Lower insulating film 62 Upper insulating film bank Bank layer (insulating film)
cap storage capacitor com common power supply line gate scanning line op counter electrode off punctured layer sig data line

Claims (7)

複数の画素電極を備えたアクティブマトリクス基板において、
前記複数の画素電極の各々の周囲には絶縁膜が設けられており、
前記絶縁膜は、無機材料からなる第1の絶縁膜と、前記第1の絶縁膜上に形成されてなり、有機材料又は無機材料からなる第2の絶縁膜と、を含み、
前記絶縁膜と前記画素電極の一部とが重なってなることを特徴とするアクティブマトリクス基板。
In an active matrix substrate having a plurality of pixel electrodes,
An insulating film is provided around each of the plurality of pixel electrodes,
The insulating film includes a first insulating film made of an inorganic material, and a second insulating film formed on the first insulating film and made of an organic material or an inorganic material,
An active matrix substrate, wherein the insulating film and a part of the pixel electrode overlap with each other.
請求項1に記載のアクティブマトリクス基板を備えた表示装置において、前記複数の画素電極の各々と、前記複数の画素電極に対向する対向電極と、それらの間に配置した有機半導体膜と、を含む薄膜発光素子を備え、前記有機半導体膜は、前記絶縁膜により区画されてなることを特徴とする表示装置。   The display device including the active matrix substrate according to claim 1, further comprising: each of the plurality of pixel electrodes, a counter electrode facing the plurality of pixel electrodes, and an organic semiconductor film disposed therebetween. A display device comprising a thin-film light emitting element, wherein the organic semiconductor film is partitioned by the insulating film. 複数の走査線と、複数のデータ線と、前記複数の走査線と前記複数のデータ線とによりマトリクス状に形成された複数の画素と、を含んでなり、前記複数の画素の各々は、前記複数の走査線のうち対応する走査線にゲート電極が接続されたトランジスタを含む導通制御回路と、画素電極、前記画素電極に対向する対向電極、及び前記画素電極と前記対向電極との間に設けられた有機半導体膜を含む薄膜発光素子と、を備えてなる表示装置において、
前記有機半導体膜は、前記データ線及び前記対向電極との間に設けられた絶縁膜により区画され、
前記絶縁膜は、無機材料からなる前記第1の絶縁膜と、前記第1の絶縁膜上に形成されてなり有機材料又は無機材料からなる第2の絶縁膜とを含むとともに、前記絶縁膜と前記画素電極の一部とが重なってなることを特徴とする表示装置。
A plurality of scanning lines, a plurality of data lines, and a plurality of pixels formed in a matrix by the plurality of scanning lines and the plurality of data lines, each of the plurality of pixels, A conduction control circuit including a transistor having a gate electrode connected to a corresponding scan line among a plurality of scan lines; a pixel electrode; a counter electrode facing the pixel electrode; and a conductive control circuit provided between the pixel electrode and the counter electrode. And a thin-film light-emitting element including an organic semiconductor film,
The organic semiconductor film is partitioned by an insulating film provided between the data line and the counter electrode,
The insulating film includes the first insulating film made of an inorganic material, and a second insulating film formed on the first insulating film and made of an organic material or an inorganic material. A display device, wherein a part of the pixel electrode overlaps.
請求項3に記載の表示装置において、前記画素電極の前記導通制御回路の形成領域と重なる領域は前記絶縁膜で覆われていること、を特徴とする表示装置。   4. The display device according to claim 3, wherein a region of the pixel electrode overlapping a region where the conduction control circuit is formed is covered with the insulating film. 5. 請求項3又は4に記載の表示装置において、前記絶縁膜で区画されている領域は、隅部分が丸みを帯びていること、を特徴とする表示装置。   5. The display device according to claim 3, wherein the region partitioned by the insulating film has a rounded corner. 請求項3乃至5のいずれかに記載の表示装置において、前記第1の絶縁膜は、前記複数のデータ線、前記複数の走査線を覆うように形成されていることを特徴とする表示装置。   6. The display device according to claim 3, wherein the first insulating film is formed so as to cover the plurality of data lines and the plurality of scanning lines. 請求項3乃至6のいずれかに記載の表示装置において、前記有機半導体膜は、前記複数の画素電極と前記対向電極との間に駆動電流が流れることによって発光することを特徴とする表示装置。
7. The display device according to claim 3, wherein the organic semiconductor film emits light when a drive current flows between the plurality of pixel electrodes and the counter electrode.
JP2003431431A 1997-08-21 2003-12-25 Organic electroluminescence device Expired - Lifetime JP3729196B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2003431431A JP3729196B2 (en) 1997-08-21 2003-12-25 Organic electroluminescence device

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP22543497 1997-08-21
JP2003431431A JP3729196B2 (en) 1997-08-21 2003-12-25 Organic electroluminescence device

Related Parent Applications (1)

Application Number Title Priority Date Filing Date
JP50545899A Division JP3536301B2 (en) 1997-08-21 1998-08-20 Display device

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2004272119A Division JP3803355B2 (en) 1997-08-21 2004-09-17 Method for manufacturing organic electroluminescence device

Publications (2)

Publication Number Publication Date
JP2004177972A true JP2004177972A (en) 2004-06-24
JP3729196B2 JP3729196B2 (en) 2005-12-21

Family

ID=32715323

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2003431431A Expired - Lifetime JP3729196B2 (en) 1997-08-21 2003-12-25 Organic electroluminescence device

Country Status (1)

Country Link
JP (1) JP3729196B2 (en)

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010134484A (en) * 2010-03-04 2010-06-17 Casio Computer Co Ltd Display panel
US7838872B2 (en) 2005-03-09 2010-11-23 Samsung Electronics Co., Ltd. Organic thin film transistor array panel
US8110831B2 (en) 2007-02-23 2012-02-07 Panasonic Corporation Display device having a polycrystal phosphor layer sandwiched between the first and second electrodes
US8330177B2 (en) 2007-02-27 2012-12-11 Panasonic Corporation Display device

Citations (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5958468A (en) * 1982-09-29 1984-04-04 富士通株式会社 Display
JPS6017479A (en) * 1983-07-09 1985-01-29 キヤノン株式会社 Electric circuit substrate
JPH07235378A (en) * 1993-12-28 1995-09-05 Casio Comput Co Ltd Electroluminescent and its manufacture
JPH08202287A (en) * 1995-01-31 1996-08-09 Futaba Corp Organic electroluminescent display device and its production
JPH08227276A (en) * 1995-02-21 1996-09-03 Pioneer Electron Corp Organic electroluminescence display panel and its production
JPH08241048A (en) * 1994-12-14 1996-09-17 Eastman Kodak Co Electroluminescent device with organic electroluminescent layer
WO1998012689A1 (en) * 1996-09-19 1998-03-26 Seiko Epson Corporation Matrix type display device and method of production thereof
JPH113048A (en) * 1997-06-10 1999-01-06 Canon Inc Electroluminescent element and device and their production
JPH1124604A (en) * 1997-07-02 1999-01-29 Seiko Epson Corp Display device
JPH1165487A (en) * 1997-08-21 1999-03-05 Seiko Epson Corp Active matrix type display device

Patent Citations (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5958468A (en) * 1982-09-29 1984-04-04 富士通株式会社 Display
JPS6017479A (en) * 1983-07-09 1985-01-29 キヤノン株式会社 Electric circuit substrate
JPH07235378A (en) * 1993-12-28 1995-09-05 Casio Comput Co Ltd Electroluminescent and its manufacture
JPH08241048A (en) * 1994-12-14 1996-09-17 Eastman Kodak Co Electroluminescent device with organic electroluminescent layer
JPH08202287A (en) * 1995-01-31 1996-08-09 Futaba Corp Organic electroluminescent display device and its production
JPH08227276A (en) * 1995-02-21 1996-09-03 Pioneer Electron Corp Organic electroluminescence display panel and its production
WO1998012689A1 (en) * 1996-09-19 1998-03-26 Seiko Epson Corporation Matrix type display device and method of production thereof
JPH113048A (en) * 1997-06-10 1999-01-06 Canon Inc Electroluminescent element and device and their production
JPH1124604A (en) * 1997-07-02 1999-01-29 Seiko Epson Corp Display device
JPH1165487A (en) * 1997-08-21 1999-03-05 Seiko Epson Corp Active matrix type display device

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7838872B2 (en) 2005-03-09 2010-11-23 Samsung Electronics Co., Ltd. Organic thin film transistor array panel
US8039296B2 (en) 2005-03-09 2011-10-18 Samsung Electronics Co., Ltd. Organic thin film transistor array panel and manufacturing method thereof
US8110831B2 (en) 2007-02-23 2012-02-07 Panasonic Corporation Display device having a polycrystal phosphor layer sandwiched between the first and second electrodes
US8330177B2 (en) 2007-02-27 2012-12-11 Panasonic Corporation Display device
JP2010134484A (en) * 2010-03-04 2010-06-17 Casio Computer Co Ltd Display panel

Also Published As

Publication number Publication date
JP3729196B2 (en) 2005-12-21

Similar Documents

Publication Publication Date Title
JP3580092B2 (en) Active matrix display
JP3536301B2 (en) Display device
JP3830238B2 (en) Active matrix type device
JP3601059B2 (en) Active matrix type light emitting device and manufacturing method thereof
JP3904016B2 (en) Active matrix display device
JP3729196B2 (en) Organic electroluminescence device
JP2004163941A (en) Display device and active matrix substrate
JP3804646B2 (en) Display device
JP3729195B2 (en) Organic electroluminescence device and manufacturing method thereof
JP3690406B2 (en) Organic electroluminescence device
JP3803342B2 (en) Method for forming organic semiconductor film and method for manufacturing active matrix substrate
JP3803355B2 (en) Method for manufacturing organic electroluminescence device
JP4743093B2 (en) Light emitting device
JP2005116535A (en) Active matrix type device and electroluminescence device
JP4797945B2 (en) Light emitting device

Legal Events

Date Code Title Description
A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20040720

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20040917

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20041130

RD02 Notification of acceptance of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7422

Effective date: 20050111

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A821

Effective date: 20050111

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20050524

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20050722

A911 Transfer to examiner for re-examination before appeal (zenchi)

Free format text: JAPANESE INTERMEDIATE CODE: A911

Effective date: 20050803

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20050913

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20050926

R150 Certificate of patent or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20091014

Year of fee payment: 4

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20101014

Year of fee payment: 5

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20101014

Year of fee payment: 5

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20111014

Year of fee payment: 6

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20121014

Year of fee payment: 7

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20121014

Year of fee payment: 7

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20131014

Year of fee payment: 8

S111 Request for change of ownership or part of ownership

Free format text: JAPANESE INTERMEDIATE CODE: R313113

R350 Written notification of registration of transfer

Free format text: JAPANESE INTERMEDIATE CODE: R350

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

EXPY Cancellation because of completion of term