JP2003522417A - ショットキーダイオード用の防御構造 - Google Patents
ショットキーダイオード用の防御構造Info
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Abstract
Description
omimpuls)からショットキーダイオードを保護するための構造に関するものであ
る。
合には、ダイオードを交換できない場合に蓄積電荷によってスイッチング消耗を
引き起こすため、ダイオードにできる限りわずかな電荷しか蓄積しないようにし
ている。この点に関して、周知のように、ショットキーダイオードは、半導体ボ
ディーにおいて電荷を供給しすぎることがないので、PN接合を備えるダイオー
ド(すなわちPNダイオードおよびPINダイオード)よりも優れている。この
ため、速い順から逆方向および順方向に交互に稼動するようにダイオードを用い
る場合に、ショットキーダイオードを用いることが有利である。
に塗布されたショットキー接触部は、遮断電流を交換できる場合には最大約20
0Vの遮断電圧を有するショットキーダイオードを備えている必要がある(beau
fschlagen)。そして、シリコンからなるショットキーダイオードと比較して、例
えば、炭化珪素(SiC)のようなバンドギャップの大きな半導体物質からなる
ショットキーダイオードの利点は、遮断電圧が著しく高いという点にある。例え
ば、SiCの場合には、遮断電流値は1700V以上に達する。
nung)Vfは、ショットキーダイオードの温度がTであり、一定電流Iのときに
降下する。(なお、例えばSiCを用いた場合、その抵抗値RはT2.5にほぼ比
例している。)これにより、ショットキーダイオードの損失率(Verlustleistun
g)は上昇し、さらなる温度上昇をまねく結果となる。一定時間以上与えられた
臨界電流が超過した場合には、ダイオード許容電圧Vfは非直線的に急激に高ま
る。
0℃の場合の異なる3つのダイオードに対して、ダイオード許容電流Ifに基づ
いたダイオード許容電圧Vfを供給するものである。なお、ダイオードとして、
4A(直流)に設定されたSiCショットキーダイオードを用い、これらのダイ
オードに、それぞれ10msの間、凹型のオーバーフローしたインパルスを入力
して、ダイオード許容電圧Vfの波高値を測定した。また、ダイオードがダメー
ジを受け始める電流値を、黒点で示している。
的なピークが生じる。例えば、そのような電子回路がON状態の場合に、補助コ
ンデンサ(Stuetzenkondensator)を充電するときがそうである。このような最
高値に必要な構成素子を、この非周期的な負荷に耐えるように設計しなければな
らない。しかしながら、通常、この負荷が巨大であるということが、構成素子の
他の力学特性を悪化させ、コストアップを招く結果となる。
C-Stufe)(PFC=力率補正power factor correction)が保護されていないこ
とについて述べる。そのようなPFC段階では、まず初めに、回路網への供給を
ON状態にした後、MOSFETスイッチを遮断する。なお、この状態において
、補助コンデンサが充電される。例えば、300Wに設定されたスイッチング回
路網の場合、補助コンデンサの容量は約220μFに達する。次に、このPFC
段階のダイオードに流れる電流は、最大70Aに達し、I2t負荷は、値4A2s
以上となる可能性がある。このことは、図6から確認できる。(図6では、30
0Wの回路網の入力電圧と、この回路網のSi−PINダイオードのダイオード
電流とを、ON状態にした後の時間tに基づいて示している。) Si−PINダイオードまたは電流供給網を入力電流の最高値から保護するた
めに、現在、様々な措置が検討されている。
ドは、予測される電流の最高値を耐え抜くことができる。しかし、このような巨
大化によって蓄積電荷量が上昇し、このことが必然的に、稼動状態での回路消耗
を高め、部材のコスト高を引き起こすことになる。
る。250W以上の高い出力を有する回路網では、入力電流が最高値に達するこ
とを回避するために、例えば、約10Wの負の温度係数をもつ抵抗値(Kalt-Wid
erstandswerten)を有するサーミスター抵抗器を使用できる。これによって、回
路網の障害と防御自動装置(Sicherungsautomaten)の作動とを回避するのであ
る。しかし、そのようなサーミスター抵抗器を使用する場合、稼動状態において
、300Wの回路網に対して、約0.5Wの余剰抵抗(Restwiderstand)が生じ
る。このことは、サーミスター抵抗器に、約1Wの変動しないまた別の消費電力
をもたらす結果となる。
用できる。これは、サーミスター抵抗器と似た、ダイオードに対して直列接続さ
れている。このブートストラップ抵抗器に対して並列に配置された半導体スイッ
チは、とりわけIGBT(絶縁ゲートを備えたバイポーラトランジスタ)または
サイリスターのように、ON状態にした後にブートストラップ抵抗器をショート
させる(kurzschliessen)。このような方法は比較的費用がかかるが、通常の稼
動状態ではさらなる消費電力をほとんど発生させない。
荷が極端に少ないという点にある。これに関して、「広域バンドギャップ」ショ
ットキーダイオードは、バンドギャップの大きい半導体物質からなり、漏れ電流
がわずかな場合は遮断電圧をさらに高めることができる。これにより、例えば、
スイッチング回路網がPFC段階においてSiCショットキーダイオードを用い
ることによって、そのようなスイッチング回路網では速い順に逆方向および順方
向への交互の稼動を実現できるということが、すでに長い間検討されてきたので
ある。その結果、通常のPINダイオードと比べて、力学上、損失を最低限に抑
制できるようになった。
、入力電流の最高値が高いことに対して極めて敏感に反応するので、いかなる場
合にも、そのような入力電流の最高値からこのダイオードを保護する必要がある
。
、以下のように特に問題を投げかけるものであった。
減少に転じ、このショットキーダイオードの基本物質のコストのゆえに臨界状態
に(kritisch)促進する。とりわけ、このことは、例えば、SiCのような接合
半導体(Verbindungshalbleitern)に当てはまることである。
久電流を有するSiCショットキーダイオードを保護するために、20Wの負の
温度係数をもつ抵抗値を有するサーミスター抵抗器が必須である。これによって
、試みてきたように、SiCダイオードを効果的に保護できる。しかし、そのよ
うなサーミスター抵抗器は、通常の稼動状態において消費電力を高めるのは明ら
かである。さらには、出力のわずかな回路網でも、常に、サーミスター抵抗器を
設置したほうがよい。サーミスター抵抗器を使用する場合にはさらに、再びON
状態にしたときに、サーミスターが冷えるまでのおよそ10sの遅延を確保する
必要がある。
る。しかし、実際には大抵の場合、コストの問題のゆえに実現しない。
にドープされた保護域(Schutzring)によってショットキーダイオードを取り巻
くことがさらに考えられる。しかし、この措置は、ショットキーダイオードのチ
ップの所要面積が、確実に20%ほど上昇することにつながる。そのような半導
体物質およびさらなるプロセス工程が必要となることから、ウェハーのコストが
高くつくため、この解決策の使用は制限されるのである。
インパルスから確実に保護できるショットキーダイオードを保護するための構造
を提供することである。
たはSi−PNダイオードからなる直列接続をショットキーダイオードと並列に
備えることによって、この目的は本発明によって達成される。
ことが好ましい。また、これには例えばGaNをも使用できるが、適した半導体
物質はSiCである。
PN)ダイオードを並列接続することによって、ショットキーダイオードを十分
に保護できる。このことは、とりわけ、入力電流時の稼動に適している。また、
Si-PINダイオードまたはSi−PNダイオードを2つ以上使用することも
できる。PIN(またはPN)ダイオードは、遅くとも、ショットキーダイオー
ドがダイオード許容電圧Vfの著しい上昇を示す(図5参照)電流領域で、電流
の主な部分(Hauptanteil)を受け取る。通常の稼動状態では、例えば、SiC
ショットキーダイオードには、約1.4Vの電圧Vfが降下する。次に、PIN
(またはPN)ダイオードは活発ではなくなり(Si−PNダイオードの閾値電
圧は、およそ0.73Vに達し、その結果、この電圧は直列接続された2つのダ
イオードの場合、約1.46Vの値となる)、それによってあまり影響のない、
余分でわずかな蓄積電荷が生じるだけである。
イッチング回路網の基本構造を示す図である。図2aおよび図2bは、ダイオー
ドに1つまたは2つのSiC−PINダイオードを並列接続できるPFC段階の
操作において、異なるダイオードを配置する場合の、逆電流の最高値の推移を示
す図である。図3は、従来のSi−PINダイオードの構造を示す図である。図
4aおよび4bは、Siダブルダイオード(Si-Doppeldiode)(図4a)、およ
び、ドーピング領域がショットキー接触に用いられているダブルダイオード(図
4b)の構造を示す図である。図5は、ダイオード許容電流Ifに基づくダイオ
ード許容電圧Vfの推移を示す図である。図6は、Si−PINダイオードの使
用中に、300Wの回路網をON状態にした場合の電流および電圧の推移を示す
図である。なお、図5および図6については、すでに冒頭において詳述している
。
力部1には、ブリッジ回路、チョークコイル2およびダイオードデバイス3を接
続する。ダイオードデバイス3は、一方ではスイッチングトランジスタ4と、他
方では補助コンデンサ5と連結している。制御装置6は、スイッチングトランジ
スタ4と他のスイッチングトランジスタ7とのゲート電極と連結している。また
、上記制御装置は、補助コンデンサ5の充電状態を制御・測定し、スイッチング
回路網を制御する。
ている。
たはPN)ダイオード9からなる直列接続とショットキーダイオード10との並
列接続を用いる。なお、ショットキーダイオード10には、例えば、SiCショ
ットキーダイオードを使用できる。
DA4862の使用(Power Factor Controller TDA 4862 Applications)」(Si
emens AT2 9402 E)に記述されている。
9とショットキーダイオード10とが並列接続であることによって、ショットキ
ーダイオード10が入力電流から受ける負担は軽減される。ショットキーダイオ
ードが許容電圧Vfの著しい上昇を示す電流領域においては、遅くとも、PIN
ダイオード9が、電流の主な部分を受け取っているのである。通常の操作では、
例えば、SiCショットキーダイオードの電圧Vfは、ほんの1.4Vほどに降
下する。Si−PINダイオード9は、2×0.73V=1.46Vの閾値電圧
の場合には活発ではなく、上記ダイオード9によって、あまり影響のない、余分
でわずかな遮断遅延電荷が発生するだけである。
するスイッチング曲線を示している。図2aは、0.22μs〜0.38μsの
時間経過を、図2bは、0.15μs〜0.55μsの時間経過をスイッチング
工程にしたがって具体的に示しており、図2aの右上には比較のために図2bを
挙げている。
ダイオードのみが並列に接続されている場合(参照:線−で示されている曲線の
推移)、このダイオード9はON状態になり、逆電流の最高値に達する。それに
対して、SiCショットキーダイオードおよび直列に接続された2つのSi−P
IN(またはPN)ダイオードが並列に位置する場合(参照:点線---で示され
ている曲線の推移)、ON状態にはならず、蓄積電荷量はそのような簡易なダイ
オードへのスイッチ装着(Diodenbeschaltung)と比較できる程度のものである
(参照:線…で示されている曲線の推移)。
来のPN高電圧ダイオードを示している。なお、このシリコン半導体ボディー1
1では、p型伝導帯12が、例えば、拡散によって形成される。半導体ボディー
11および伝導帯12の第1表面13には、縁酸化物層(Rand-Oxidschicht)1
4、ポリアミド層15および、例えば、ルミニウムからなる金属接触層16が位
置している。その一方で、表面13と向かいあう半導体ボディー11の表面17
には、他の金属接触層18が備えられている。なお、ダイオードを、PN接合地
点において記号D1によって示す。
によって、別のNドープされた層19を塗布する(図4a参照)。この層19の
ドーピング量は、界面突破電荷(Flaechendurchbruchsladung)よりも少なく、
(1.3〜1.8)1012cm-2以下である。
ードD2を、逆方向に挿入する。続いて、p+型伝導層20を層19に配置する
。
ン注入によって生成できる。
。ダイオードD2を逆方向に配置する場合、ダイオードD3をダイオードD1と
同じく順方向に挿入する。
することもできる(図4b参照)。また、この層および領域20を使用しないで
もよい。
に空乏層が生じる。n型伝導層19を、荷電粒子を用いて空にすると、伝導帯1
2と層19との間に位置するPN接合の空乏層は、層20の方向に突き出る。そ
してさらに、前方向(Vorwaertsrichtung)への有効電圧を、ドーピングとN型
伝導層19の幅とによって、特定の範囲に設定できる。
、個々のチップとして、またはSiダブルダイオードとして、ハウジングに格納
される(図4a・図4b参照)。このことが、構造の組み立てを著しく緩和して
いる。
面積縮小によって簡単に補える。このようなショットキーダイオードの面積縮小
は、オーバーフローを完全に回避することによって可能となる。
に他のダイオードをここで直列に接続することもできるので、ショットキーダイ
オードに対して並列に、複数のSi−PINダイオードまたはSi−PNダイオ
ードが、互いに直列に配置されている。このSi−PINダイオードまたはSi
−PNダイオードを、半導体ボディーに簡単に組み込むことができる(図4a・
図4b参照)。
ードを並列接続できるPFC段階の操作において、異なるダイオードを配置する
場合の、逆電流の最高値の推移を示す図である。
グ領域がショットキー接触に用いられているダブルダイオード(図4b)の構造
を示す図である。
す図である。
した場合の電流および電圧の推移を示す図である。
に塗布されたショットキー接触部は、遮断電流を交換できる場合には最大約20
0Vの遮断電圧を有するショットキーダイオードを備えている必要がある(beau
fschlagen)。そして、シリコンからなるショットキーダイオードと比較して、
例えば、炭化珪素(SiC)のようなバンドギャップの大きな半導体物質からな
るショットキーダイオードの利点は、遮断電圧が著しく高いという点にある。例
えば、SiCの場合には、遮断電流値は1700V以上に達する。SiCダイオ ードの製造方法については、例えば、アメリカ特許広報5,789,311に記 述がある。
Claims (10)
- 【請求項1】 一時的にオーバーフローしたインパルスからショットキーダイオードを保護す
るための構造において、 ショットキーダイオード(10)に並列に、少なくとも2つのSi−PINダ
イオードまたはSi−PNダイオードからなる直列接続を備えていることを特徴
とするショットキーダイオード用の防御構造。 - 【請求項2】 上記ショットキーダイオード(10)を、接合半導体から形成することを特徴
とする請求項1に記載の構造。 - 【請求項3】 上記ショットキーダイオード(10)を、バンドギャップの大きな半導体物質
から形成することを特徴とする請求項1または2に記載の構造。 - 【請求項4】 上記ショットキーダイオード(10)を、SiCまたはGaNから形成するこ
とを特徴とする請求項1〜3の何れか1項に記載の構造。 - 【請求項5】 上記少なくとも2つのSi−PINダイオードまたはSi−PNダイオード(
9)を、シリコンボディーに組み込むことを特徴とする請求項1〜4の何れか1
項に記載の構造。 - 【請求項6】 上記少なくとも2つのSi−PINダイオードまたはSi−PNダイオード(
9)に関して、もう1つのショットキーダイオード(D3´)を、上記PINダ
イオードまたはPNダイオード(9)と直列に、シリコンボディーに組み込むこ
とを特徴とする請求項1〜5の何れか1項に記載の構造。 - 【請求項7】 上記ショットキーダイオード(10)と、少なくとも2つのSi−PINダイ
オードまたはSi−PNダイオード(9)とが、ハウジングにまとめて備えられ
ていることを特徴とする請求項1〜6の何れか1項に記載の構造。 - 【請求項8】 上記ショットキーダイオード(10)と、少なくとも2つのSi−PINダイ
オードまたはSi−PNダイオード(9)とが、回路網のPFC段階に備えられ
ていることを特徴とする請求項1〜7の何れか1項に記載の構造。 - 【請求項9】 上記PINダイオードまたはPNダイオードに対して直列に位置するショット
キーダイオード(D3´)も、まとめてハウジングまたはPFC段階に備えられ
ていることを特徴とする請求項7または8に記載の構造。 - 【請求項10】 2つのSi−PINダイオードまたはSi−PNダイオードからなる直列接続
のNドープされた層が、(1.3〜1.8)×1012cm2の荷電粒子より少な
い界面突破電荷を有することを特徴とする請求項1〜9の何れか1項に記載の構
造。
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