JP2003324666A - データ伝送回路及び放送受信装置 - Google Patents
データ伝送回路及び放送受信装置Info
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- JP2003324666A JP2003324666A JP2002132428A JP2002132428A JP2003324666A JP 2003324666 A JP2003324666 A JP 2003324666A JP 2002132428 A JP2002132428 A JP 2002132428A JP 2002132428 A JP2002132428 A JP 2002132428A JP 2003324666 A JP2003324666 A JP 2003324666A
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Abstract
(57)【要約】
【目的】 瞬停による不具合発生を防止することができ
るデータ伝送回路を提供する。 【構成】 第１の電源回路１１にサブＣＰＵ８が接続さ
れ、このサブＣＰＵ８によって第２の電源回路１２のオ
ン／オフが制御され、この第２の電源回路１２に接続さ
れたメインＣＰＵ３と前記サブＣＰＵ８との間でデータ
伝送を行う。サブＣＰＵ８は第１の電源回路１１の瞬停
判定と前記メインＣＰＵ３からのパワーオン通知とに基
づいて第２の電源回路１２側での瞬停判定を行い、瞬停
の場合にはサブＣＰＵ８はメインＣＰＵ３におけるパワ
ーオンの理由が瞬停であることをメインＣＰＵ３に通知
する。
るデータ伝送回路を提供する。 【構成】 第１の電源回路１１にサブＣＰＵ８が接続さ
れ、このサブＣＰＵ８によって第２の電源回路１２のオ
ン／オフが制御され、この第２の電源回路１２に接続さ
れたメインＣＰＵ３と前記サブＣＰＵ８との間でデータ
伝送を行う。サブＣＰＵ８は第１の電源回路１１の瞬停
判定と前記メインＣＰＵ３からのパワーオン通知とに基
づいて第２の電源回路１２側での瞬停判定を行い、瞬停
の場合にはサブＣＰＵ８はメインＣＰＵ３におけるパワ
ーオンの理由が瞬停であることをメインＣＰＵ３に通知
する。
Description
【０００１】この発明は、データ伝送回路及びこれを備
えた放送受信装置に関する。
えた放送受信装置に関する。
【０００２】
【従来の技術】衛星や地上波を用いたディジタル放送を
受信する放送受信装置は、専用のアンテナや地上波用ア
ンテナを通して受け取った複数の放送波のなかから任意
の放送波をディジタルチューナによって選択し、この選
択した放送波に含まれる複数のチャンネルのなかから任
意のチャンネル（トランスポートストリーム）をデマル
チプレクス処理によって選択し、この選択したチャンネ
ルのディジタル信号を取り出し、これをデコードするこ
とによって映像・音声信号を出力する。
受信する放送受信装置は、専用のアンテナや地上波用ア
ンテナを通して受け取った複数の放送波のなかから任意
の放送波をディジタルチューナによって選択し、この選
択した放送波に含まれる複数のチャンネルのなかから任
意のチャンネル（トランスポートストリーム）をデマル
チプレクス処理によって選択し、この選択したチャンネ
ルのディジタル信号を取り出し、これをデコードするこ
とによって映像・音声信号を出力する。
【０００３】そして、このようなディジタルテレビ放送
を受信するディジタルチューナと共に、従来からのアナ
ログ放送を受信するアナログチューナも備えたディジタ
ル・アナログ対応の放送受信装置を構成することができ
る。
を受信するディジタルチューナと共に、従来からのアナ
ログ放送を受信するアナログチューナも備えたディジタ
ル・アナログ対応の放送受信装置を構成することができ
る。
【０００４】このようなディジタル・アナログ対応の放
送受信装置では、サブＣＰＵへの給電を行う第１の電源
回路及びメインＣＰＵを含む他の回路への給電を行う第
２の電源回路を備え、スタンバイ時には第２の電源回路
による各回路への給電は行わずにサブＣＰＵがパワーオ
ンキーの入力監視を行い、このパワーオンキーの入力を
サブＣＰＵが検出すると、前記第２の電源回路オン及び
メインＣＰＵの起動を行い、その後（パワーオン後）に
はメインＣＰＵによってサブＣＰＵを含む各種回路が制
御され、この制御の下でサブＣＰＵはアナログ放送受信
部の制御を行うようにしたものがある。
送受信装置では、サブＣＰＵへの給電を行う第１の電源
回路及びメインＣＰＵを含む他の回路への給電を行う第
２の電源回路を備え、スタンバイ時には第２の電源回路
による各回路への給電は行わずにサブＣＰＵがパワーオ
ンキーの入力監視を行い、このパワーオンキーの入力を
サブＣＰＵが検出すると、前記第２の電源回路オン及び
メインＣＰＵの起動を行い、その後（パワーオン後）に
はメインＣＰＵによってサブＣＰＵを含む各種回路が制
御され、この制御の下でサブＣＰＵはアナログ放送受信
部の制御を行うようにしたものがある。
【０００５】そして、かかる受信装置が例えばホテル向
け仕様とされる場合、通常のパワーオン時には或る指定
のチャンネル（イニシャルチャンネル）を映し出すよう
に設定されるが、瞬停が生じたために今見ていたチャン
ネルが前記イニシャルチャンネルに変わってしまうので
は不都合である。すなわち、瞬停の場合には、いわゆる
ラストチャンネルが映し出されるべきであり、通常のパ
ワーオン時にはイニシャルチャンネルが映し出されなけ
ればならない。
け仕様とされる場合、通常のパワーオン時には或る指定
のチャンネル（イニシャルチャンネル）を映し出すよう
に設定されるが、瞬停が生じたために今見ていたチャン
ネルが前記イニシャルチャンネルに変わってしまうので
は不都合である。すなわち、瞬停の場合には、いわゆる
ラストチャンネルが映し出されるべきであり、通常のパ
ワーオン時にはイニシャルチャンネルが映し出されなけ
ればならない。
【０００６】
【発明が解決しようとする課題】サブＣＰＵ及びメイン
ＣＰＵがそれぞれ瞬停の判定機能を持っていれば、第１
の電源回路に接続されているサブＣＰＵは、第１の電源
回路に対して、その立ち上がりが通常のパワーオンによ
るものなのか、あるいは瞬停によるものなのかが分かる
し、第２の電源回路に接続されているメインＣＰＵは、
第２の電源回路に対して、その立ち上がりが通常のパワ
ーオンによるものなのか、あるいは瞬停によるものなの
かが分かる。しかしながら、この場合でもサブＣＰＵ
は、第２の電源回路に瞬停があったかどうかは分からな
い。また、サブＣＰＵが第２の電源回路のオン／オフを
制御する場合は、瞬停があると、第１の電源回路が立ち
上がって、サブＣＰＵが瞬停と判定してから第２の電源
回路をオンするため、第２の電源回路がオンしてからメ
インＣＰＵが瞬停かどうかを判定する迄に時間が経ち、
第２の電源回路側では瞬停を判定できずに通常のパワー
オンと判定することがある。すなわち、２つのＣＰＵで
それぞれ瞬停を判定すると、一方は瞬停で他方は正常パ
ワーオンと判定してしまうことがある。
ＣＰＵがそれぞれ瞬停の判定機能を持っていれば、第１
の電源回路に接続されているサブＣＰＵは、第１の電源
回路に対して、その立ち上がりが通常のパワーオンによ
るものなのか、あるいは瞬停によるものなのかが分かる
し、第２の電源回路に接続されているメインＣＰＵは、
第２の電源回路に対して、その立ち上がりが通常のパワ
ーオンによるものなのか、あるいは瞬停によるものなの
かが分かる。しかしながら、この場合でもサブＣＰＵ
は、第２の電源回路に瞬停があったかどうかは分からな
い。また、サブＣＰＵが第２の電源回路のオン／オフを
制御する場合は、瞬停があると、第１の電源回路が立ち
上がって、サブＣＰＵが瞬停と判定してから第２の電源
回路をオンするため、第２の電源回路がオンしてからメ
インＣＰＵが瞬停かどうかを判定する迄に時間が経ち、
第２の電源回路側では瞬停を判定できずに通常のパワー
オンと判定することがある。すなわち、２つのＣＰＵで
それぞれ瞬停を判定すると、一方は瞬停で他方は正常パ
ワーオンと判定してしまうことがある。
【０００７】この発明は、上記の事情に鑑み、瞬停によ
る不具合発生を防止することができるデータ伝送回路及
び放送受信装置を提供することを目的とする。
る不具合発生を防止することができるデータ伝送回路及
び放送受信装置を提供することを目的とする。
【０００８】
【課題を解決するための手段】この発明のデータ伝送回
路は、上記の課題を解決するために、第１の電源回路に
サブＣＰＵが接続され、このサブＣＰＵによって第２の
電源回路のオン／オフが制御され、この第２の電源回路
に接続されたメインＣＰＵと前記サブＣＰＵとの間でデ
ータ伝送を行うデータ伝送回路であって、第１の電源回
路の瞬停を判定する手段を有し、瞬停の場合にはサブＣ
ＰＵはメインＣＰＵにおけるパワーオンの理由が瞬停で
あることをメインＣＰＵに通知するように構成されたこ
とを特徴とする。
路は、上記の課題を解決するために、第１の電源回路に
サブＣＰＵが接続され、このサブＣＰＵによって第２の
電源回路のオン／オフが制御され、この第２の電源回路
に接続されたメインＣＰＵと前記サブＣＰＵとの間でデ
ータ伝送を行うデータ伝送回路であって、第１の電源回
路の瞬停を判定する手段を有し、瞬停の場合にはサブＣ
ＰＵはメインＣＰＵにおけるパワーオンの理由が瞬停で
あることをメインＣＰＵに通知するように構成されたこ
とを特徴とする。
【０００９】上記構成において、第２の電源回路のオン
／オフを制御するサブＣＰＵは第１の電源回路から給電
を受けており、第１の電源回路で瞬停が生じると第２の
電源回路でも瞬停が生じることになるが、瞬停の場合に
はサブＣＰＵはメインＣＰＵにおけるパワーオンの理由
が瞬停であることをメインＣＰＵに通知するので、メイ
ンＣＰＵにおいて通常のパワーオン時用の処理を行って
しまう事態を回避することができ、瞬停による不具合発
生が防止される。
／オフを制御するサブＣＰＵは第１の電源回路から給電
を受けており、第１の電源回路で瞬停が生じると第２の
電源回路でも瞬停が生じることになるが、瞬停の場合に
はサブＣＰＵはメインＣＰＵにおけるパワーオンの理由
が瞬停であることをメインＣＰＵに通知するので、メイ
ンＣＰＵにおいて通常のパワーオン時用の処理を行って
しまう事態を回避することができ、瞬停による不具合発
生が防止される。
【００１０】前記サブＣＰＵは自身の状態と前記メイン
ＣＰＵからのパワーオン通知とに基づいて第２の電源回
路側での瞬停を判定し、瞬停の場合にはサブＣＰＵはメ
インＣＰＵにおけるパワーオンの理由が瞬停であること
をメインＣＰＵに通知するように構成されているのがよ
い。かかる構成であれば、第２の電源回路側でのみ瞬停
が生じたことをサブＣＰＵ側で知得し、サブＣＰＵはメ
インＣＰＵにおけるパワーオンの理由が瞬停であること
をメインＣＰＵに通知するので、メインＣＰＵにおいて
通常のパワーオン時に行う処理を行ってしまう事態が回
避され、瞬停による不具合発生が防止される。
ＣＰＵからのパワーオン通知とに基づいて第２の電源回
路側での瞬停を判定し、瞬停の場合にはサブＣＰＵはメ
インＣＰＵにおけるパワーオンの理由が瞬停であること
をメインＣＰＵに通知するように構成されているのがよ
い。かかる構成であれば、第２の電源回路側でのみ瞬停
が生じたことをサブＣＰＵ側で知得し、サブＣＰＵはメ
インＣＰＵにおけるパワーオンの理由が瞬停であること
をメインＣＰＵに通知するので、メインＣＰＵにおいて
通常のパワーオン時に行う処理を行ってしまう事態が回
避され、瞬停による不具合発生が防止される。
【００１１】また、この発明の放送受信装置は、上述し
たデータ伝送回路を備え、メインＣＰＵは瞬停通知を受
けた場合にはラストチャンネル受信処理を実行し、通常
パワーオンを示す通知を受けた場合にはイニシャルチャ
ンネル受信処理を実行するように構成されたことを特徴
とする。また、かかる放送受信装置において、アナログ
放送波を受信するアナログ放送受信部と、ディジタル放
送波を受信するディジタル放送受信部とを備え、サブＣ
ＰＵはユーザ操作による指令信号のメインＣＰＵへの伝
送と前記アナログ放送受信部の制御とメインＣＰＵを含
む他の回路への給電を行う電源回路のオン／オフ制御と
を行い、メインＣＰＵは少なくとも前記ディジタル放送
受信部の制御を行うように構成されていてもよい。
たデータ伝送回路を備え、メインＣＰＵは瞬停通知を受
けた場合にはラストチャンネル受信処理を実行し、通常
パワーオンを示す通知を受けた場合にはイニシャルチャ
ンネル受信処理を実行するように構成されたことを特徴
とする。また、かかる放送受信装置において、アナログ
放送波を受信するアナログ放送受信部と、ディジタル放
送波を受信するディジタル放送受信部とを備え、サブＣ
ＰＵはユーザ操作による指令信号のメインＣＰＵへの伝
送と前記アナログ放送受信部の制御とメインＣＰＵを含
む他の回路への給電を行う電源回路のオン／オフ制御と
を行い、メインＣＰＵは少なくとも前記ディジタル放送
受信部の制御を行うように構成されていてもよい。
【００１２】
【発明の実施の形態】以下、この発明の実施形態を図１
及び図２に基づいて説明する。図１は地上波ディジタル
放送及び地上波アナログ放送の両方を視聴できるこの実
施形態の放送受信装置３０を示したブロック図である。
及び図２に基づいて説明する。図１は地上波ディジタル
放送及び地上波アナログ放送の両方を視聴できるこの実
施形態の放送受信装置３０を示したブロック図である。
【００１３】アンテナ１Ａ・１Ｂは、屋外において所定
の方向に向けて配置されており、地上波放送局から送ら
れてくる地上放送波を受信する。
の方向に向けて配置されており、地上波放送局から送ら
れてくる地上放送波を受信する。
【００１４】ディジタルモジュール２は、映像・音声デ
ータを含む高周波ディジタル変調信号のうちから特定周
波数の信号を取り出す。また、ディジタルモジュール２
は、逆インタリーブ回路、誤り訂正回路などを備えるこ
とにより、選択したディジタル変調信号を復調してトラ
ンスポートストリームを出力する。また、ディジタルモ
ジュール２のデマルチプレクサは、前記トランスポート
ストリームを、ＭＰＥＧ２（Ｍｏｖｉｎｇ Ｐｉｃｔｕ
ｒｅ Ｅｘｐｅｒｔｓ Ｇｒｏｕｐ２）のビデオストリ
ーム、オーディオストリーム、およびＰＳＩ／ＳＩ（Ｐ
ｒｏｇｒａｍＳｐｅｃｉｆｉｃ Ｉｎｆｏｒｍａｔｉｏ
ｎ／Ｓｅｒｖｉｃｅ Ｉｎｆｏｒｍａｔｉｏｎ）に分離
復号する。デマルチプレクサは、ビデオストリームとオ
ーディオストリームをデコーダに供給し、ＰＳＩ／ＳＩ
に含まれるサービス情報（番組名、番組詳細等）をメイ
ンＣＰＵ３に供給する。デコーダは、ビデオストリーム
のデコードを行うビデオデコーダ、及びオーディオスト
リームのデコードを行うオーディオデコーダを備える。
ビデオデコーダは、入力された可変長符号を復号して量
子化係数や動きベクトルを求め、逆ＤＣＴ変換や動きベ
クトルに基づく動き補償制御等を行う。オーディオデコ
ーダは、入力された符号化信号を復号して音声データを
生成する。デコードにより生成された映像信号（コンポ
ジット信号、Ｙ／Ｃ信号、コンポーネント信号等）は信
号切替スイッチ４に供給される。ディジタルモジュール
２のＯＳＤ（オンスクリーンディスプレイ）回路は、メ
インＣＰＵ３から出力指示された文字情報に基づくビッ
トマップデータを受信映像データに組み込む回路であ
り、このＯＳＤ回路により、サービス情報に基づくＥＰ
Ｇ（Ｅｌｅｃｔｒｏｎｉｃ Ｐｒｏｇｒａｍ Ｇｕｉｄ
ｅ）画面表示が実現される他、メニュー画面や操作ガイ
ド画面などの表示も行えることになる。
ータを含む高周波ディジタル変調信号のうちから特定周
波数の信号を取り出す。また、ディジタルモジュール２
は、逆インタリーブ回路、誤り訂正回路などを備えるこ
とにより、選択したディジタル変調信号を復調してトラ
ンスポートストリームを出力する。また、ディジタルモ
ジュール２のデマルチプレクサは、前記トランスポート
ストリームを、ＭＰＥＧ２（Ｍｏｖｉｎｇ Ｐｉｃｔｕ
ｒｅ Ｅｘｐｅｒｔｓ Ｇｒｏｕｐ２）のビデオストリ
ーム、オーディオストリーム、およびＰＳＩ／ＳＩ（Ｐ
ｒｏｇｒａｍＳｐｅｃｉｆｉｃ Ｉｎｆｏｒｍａｔｉｏ
ｎ／Ｓｅｒｖｉｃｅ Ｉｎｆｏｒｍａｔｉｏｎ）に分離
復号する。デマルチプレクサは、ビデオストリームとオ
ーディオストリームをデコーダに供給し、ＰＳＩ／ＳＩ
に含まれるサービス情報（番組名、番組詳細等）をメイ
ンＣＰＵ３に供給する。デコーダは、ビデオストリーム
のデコードを行うビデオデコーダ、及びオーディオスト
リームのデコードを行うオーディオデコーダを備える。
ビデオデコーダは、入力された可変長符号を復号して量
子化係数や動きベクトルを求め、逆ＤＣＴ変換や動きベ
クトルに基づく動き補償制御等を行う。オーディオデコ
ーダは、入力された符号化信号を復号して音声データを
生成する。デコードにより生成された映像信号（コンポ
ジット信号、Ｙ／Ｃ信号、コンポーネント信号等）は信
号切替スイッチ４に供給される。ディジタルモジュール
２のＯＳＤ（オンスクリーンディスプレイ）回路は、メ
インＣＰＵ３から出力指示された文字情報に基づくビッ
トマップデータを受信映像データに組み込む回路であ
り、このＯＳＤ回路により、サービス情報に基づくＥＰ
Ｇ（Ｅｌｅｃｔｒｏｎｉｃ Ｐｒｏｇｒａｍ Ｇｕｉｄ
ｅ）画面表示が実現される他、メニュー画面や操作ガイ
ド画面などの表示も行えることになる。
【００１５】信号切替スイッチ４は、ディジタルモジュ
ール２から出力される映像／音声信号と、アナログモジ
ュール６から出力される映像／音声信号とを受け取り、
メインＣＰＵ３の切替指示に従って、いずれか一方の信
号をモニタ５に出力する。
ール２から出力される映像／音声信号と、アナログモジ
ュール６から出力される映像／音声信号とを受け取り、
メインＣＰＵ３の切替指示に従って、いずれか一方の信
号をモニタ５に出力する。
【００１６】アナログモジュール６は、ユーザーが選択
したチャンネルに対応する周波数の信号を選択する選局
処理、及び選択した周波数の信号を復調する処理等を行
ってアナログ映像信号（コンポジット信号、Ｙ／Ｃ信
号、コンポーネント信号等）及びアナログ音声信号を生
成する。
したチャンネルに対応する周波数の信号を選択する選局
処理、及び選択した周波数の信号を復調する処理等を行
ってアナログ映像信号（コンポジット信号、Ｙ／Ｃ信
号、コンポーネント信号等）及びアナログ音声信号を生
成する。
【００１７】メインＣＰＵ３は、ディジタルモジュール
２に対する選局指令や有局チャンネルサーチ等の制御、
メモリ（ＥＥＰＲＯＭ等）７への有局チャンネル情報や
ＯＳＤ表示用データの書込／読出の制御、デマルチプレ
クサに対する制御、デコーダに対する制御、ＯＳＤ回路
に対する制御、信号切替スイッチ４に対する切換指令、
後述するサブＣＰＵ８との間での通信などを行うように
なっている。
２に対する選局指令や有局チャンネルサーチ等の制御、
メモリ（ＥＥＰＲＯＭ等）７への有局チャンネル情報や
ＯＳＤ表示用データの書込／読出の制御、デマルチプレ
クサに対する制御、デコーダに対する制御、ＯＳＤ回路
に対する制御、信号切替スイッチ４に対する切換指令、
後述するサブＣＰＵ８との間での通信などを行うように
なっている。
【００１８】リモコン送信機９は、当該放送受信装置３
０に指令を送出するための送信機である。このリモコン
送信機９に設けられた図示しないキーを操作すると、そ
のキーに対応した指令を意味する信号光（リモコン信
号）が図示しない発光部から送出される。図示しないリ
モコン受光器は、前記信号光を受光し、これを電気信号
に変換してサブＣＰＵ８に与える。
０に指令を送出するための送信機である。このリモコン
送信機９に設けられた図示しないキーを操作すると、そ
のキーに対応した指令を意味する信号光（リモコン信
号）が図示しない発光部から送出される。図示しないリ
モコン受光器は、前記信号光を受光し、これを電気信号
に変換してサブＣＰＵ８に与える。
【００１９】サブＣＰＵ８は、上記リモコン送信機９に
よるリモートコントロール信号や図示しない本体操作部
のキー操作による信号を入力してメインＣＰＵ３に通知
する処理や、アナログモジュール６に対する制御を行
う。
よるリモートコントロール信号や図示しない本体操作部
のキー操作による信号を入力してメインＣＰＵ３に通知
する処理や、アナログモジュール６に対する制御を行
う。
【００２０】サブＣＰＵ８は第１の電源回路１１から電
力供給を受ける。メインＣＰＵ３などの他の回路は、第
２の電源回路１２から電力供給を受ける。第１の電源回
路１１は受信装置３０のプラグ（図示せず）が商用電源
のコンセントに挿入されるとサブＣＰＵ８への電力供給
を開始し、これによって受信装置３０はスタンバイ状態
になる。このスタンバイ状態では、サブＣＰＵ８はリモ
コン送信機９等のパワーキーが押されるのを待つ。そし
て、このスタンバイ状態でパワーキーが押されたとき、
サブＣＰＵ８は第２の電源回路１２に対して電源オンの
操作（指令）を行う。第２の電源回路１２は、これに接
続されている各回路に電力を供給し、受信装置３０はパ
ワーオン状態（テレビＯＮ状態）になる。このとき、メ
インＣＰＵ３も第２の電源回路１２から電力供給を受け
ることになる。そして、サブＣＰＵ８はメインＣＰＵ３
に対して、パワーオンしたことを知らせるため、メイン
ＣＰＵのリセットを解除する。
力供給を受ける。メインＣＰＵ３などの他の回路は、第
２の電源回路１２から電力供給を受ける。第１の電源回
路１１は受信装置３０のプラグ（図示せず）が商用電源
のコンセントに挿入されるとサブＣＰＵ８への電力供給
を開始し、これによって受信装置３０はスタンバイ状態
になる。このスタンバイ状態では、サブＣＰＵ８はリモ
コン送信機９等のパワーキーが押されるのを待つ。そし
て、このスタンバイ状態でパワーキーが押されたとき、
サブＣＰＵ８は第２の電源回路１２に対して電源オンの
操作（指令）を行う。第２の電源回路１２は、これに接
続されている各回路に電力を供給し、受信装置３０はパ
ワーオン状態（テレビＯＮ状態）になる。このとき、メ
インＣＰＵ３も第２の電源回路１２から電力供給を受け
ることになる。そして、サブＣＰＵ８はメインＣＰＵ３
に対して、パワーオンしたことを知らせるため、メイン
ＣＰＵのリセットを解除する。
【００２１】サブＣＰＵ８はリモコン送信機９のキーや
本体キーの入力操作を監視し、入力操作が行われたとき
には、その情報をメインＣＰＵ３に伝送する。そして、
この情報（内容）がディジタル放送に関するものなら
ば、メインＣＰＵ３自身において処理し、その情報（内
容）がアナログ放送に関するものであれば、メインＣＰ
Ｕ３がサブＣＰＵ８に対して、アナログ放送選局などの
指示を伝送する。また、チャンネル情報のメモリ保存
や、アナログ放送を映すのかディジタル放送を映すのか
の判断やＯＳＤ表示等はメインＣＰＵ３が行う。
本体キーの入力操作を監視し、入力操作が行われたとき
には、その情報をメインＣＰＵ３に伝送する。そして、
この情報（内容）がディジタル放送に関するものなら
ば、メインＣＰＵ３自身において処理し、その情報（内
容）がアナログ放送に関するものであれば、メインＣＰ
Ｕ３がサブＣＰＵ８に対して、アナログ放送選局などの
指示を伝送する。また、チャンネル情報のメモリ保存
や、アナログ放送を映すのかディジタル放送を映すのか
の判断やＯＳＤ表示等はメインＣＰＵ３が行う。
【００２２】サブＣＰＵ８とメインＣＰＵ３との間の伝
送経路は、シリアルクロックとシリアルＩ／Ｏラインの
２本の通信ラインでもよいし、シリアルクロックライン
とシリアルＩ／Ｏラインが２本の計３本の通信ラインで
もよく、具体的構成は問わないものである。
送経路は、シリアルクロックとシリアルＩ／Ｏラインの
２本の通信ラインでもよいし、シリアルクロックライン
とシリアルＩ／Ｏラインが２本の計３本の通信ラインで
もよく、具体的構成は問わないものである。
【００２３】ここで、かかる受信装置３０は例えばホテ
ル向け仕様とされ、パワーオン時には或る指定のチャン
ネル（イニシャルチャンネル）を映し出すように設定さ
れ、瞬停の場合には、いわゆるラストチャンネルが映し
出すように構成されている。サブＣＰＵ８（第１の電源
回路１１）側では、それ自身の瞬停を判定する手段を備
えており、メインＣＰＵ３（第２の電源回路１２）側で
は、それ自身の瞬停を判定する手段は備えず、後述する
手法によってサブＣＰＵ８側で第２の電源回路側で瞬停
が生じたか否かを判断する。サブＣＰＵ８（第１の電源
回路１１）側で備える瞬停判定手段としては、一般的な
瞬停検出回路を用いることとしてもよいし、或いは追加
の周辺回路なしで実現するならば、実用新案登録第２，
５４５，７６７号に示された構成等を用いることができ
る。
ル向け仕様とされ、パワーオン時には或る指定のチャン
ネル（イニシャルチャンネル）を映し出すように設定さ
れ、瞬停の場合には、いわゆるラストチャンネルが映し
出すように構成されている。サブＣＰＵ８（第１の電源
回路１１）側では、それ自身の瞬停を判定する手段を備
えており、メインＣＰＵ３（第２の電源回路１２）側で
は、それ自身の瞬停を判定する手段は備えず、後述する
手法によってサブＣＰＵ８側で第２の電源回路側で瞬停
が生じたか否かを判断する。サブＣＰＵ８（第１の電源
回路１１）側で備える瞬停判定手段としては、一般的な
瞬停検出回路を用いることとしてもよいし、或いは追加
の周辺回路なしで実現するならば、実用新案登録第２，
５４５，７６７号に示された構成等を用いることができ
る。
【００２４】サブＣＰＵ８はスタンバイ状態でリモコン
送信機９のキーや本体キーの入力を待ち、パワーキーが
押されたときには第２の電源回路１２をオンする。これ
により、メインＣＰＵ３は動作を開始し、サブＣＰＵ８
にパワーオンしたことを通知し、この通知に対応してサ
ブＣＰＵ８はパワーオンした理由をメインＣＰＵ３に知
らせる。このように瞬停かどうかの判定はサブＣＰＵ８
側で行い、メインＣＰＵ３は瞬停かどうかの判定を行わ
なくて、パワーオンしたことを通知するだけでよい。
送信機９のキーや本体キーの入力を待ち、パワーキーが
押されたときには第２の電源回路１２をオンする。これ
により、メインＣＰＵ３は動作を開始し、サブＣＰＵ８
にパワーオンしたことを通知し、この通知に対応してサ
ブＣＰＵ８はパワーオンした理由をメインＣＰＵ３に知
らせる。このように瞬停かどうかの判定はサブＣＰＵ８
側で行い、メインＣＰＵ３は瞬停かどうかの判定を行わ
なくて、パワーオンしたことを通知するだけでよい。
【００２５】図２に本実施例のフローチャートを示す。
第１の電源回路１１がオンすると、第１の電源回路１１
から電圧の供給を受けたサブＣＰＵ８は、このオンが瞬
停によるものであるかどうかを判断する（ステップＳ
１）。サブＣＰＵ８が瞬停であると判断した場合にはス
テップＳ４に進む。一方、サブＣＰＵ８が通常のオンに
よるものであると判断した場合には、受信装置３０はス
タンバイ状態となり（ステップＳ２）、サブＣＰＵ８は
リモコン送信機９や本体キーのパワーキーが押下された
かどうかを判断する（ステップＳ３）。サブＣＰＵ８は
パワーキーが押下されるまでスタンバイ状態を維持し、
パワーキーが押された場合には第２の電源回路１２に対
しオン操作を行う（ステップＳ４）。オン操作された第
２の電源回路１２によってメインＣＰＵ３などの各回路
に電力が供給される。
第１の電源回路１１がオンすると、第１の電源回路１１
から電圧の供給を受けたサブＣＰＵ８は、このオンが瞬
停によるものであるかどうかを判断する（ステップＳ
１）。サブＣＰＵ８が瞬停であると判断した場合にはス
テップＳ４に進む。一方、サブＣＰＵ８が通常のオンに
よるものであると判断した場合には、受信装置３０はス
タンバイ状態となり（ステップＳ２）、サブＣＰＵ８は
リモコン送信機９や本体キーのパワーキーが押下された
かどうかを判断する（ステップＳ３）。サブＣＰＵ８は
パワーキーが押下されるまでスタンバイ状態を維持し、
パワーキーが押された場合には第２の電源回路１２に対
しオン操作を行う（ステップＳ４）。オン操作された第
２の電源回路１２によってメインＣＰＵ３などの各回路
に電力が供給される。
【００２６】次に、サブＣＰＵ８はメインＣＰＵ３に与
えていたリセット状態を解除する（ステップＳ５）。こ
のリセット解除が行われると、メインＣＰＵ３はサブＣ
ＰＵ８にパワーオンしたことを通知する（ステップＳ
６）。そして、サブＣＰＵ８はメインＣＰＵ３に対して
パワーオンした理由を通知する（ステップＳ７）。
えていたリセット状態を解除する（ステップＳ５）。こ
のリセット解除が行われると、メインＣＰＵ３はサブＣ
ＰＵ８にパワーオンしたことを通知する（ステップＳ
６）。そして、サブＣＰＵ８はメインＣＰＵ３に対して
パワーオンした理由を通知する（ステップＳ７）。
【００２７】ここで、第１の電源回路１１に瞬停が生じ
た場合にはサブＣＰＵ８が瞬停になるのでサブＣＰＵ８
に制御される第２の電源回路１２も瞬停となる。勿論、
第１の電源回路１１と第２の電源回路１２とが共に同時
的に瞬停となる場合もある。一方、第２の電源回路１２
だけに瞬停が起こることがある（ステップＳ１１，Ｓ１
２）。この場合、第１の電源回路１１及びサブＣＰＵ８
は瞬停せずに正常に動作していたわけであり、サブＣＰ
Ｕ８は前述したリセット解除の処理を行ったときのメイ
ンＣＰＵ３からのパワーオン通知と、このようなリセッ
ト解除の処理を行っていないのにメインＣＰＵ３から受
け取るパワーオン通知とを区別することができる。瞬停
による第２の電源回路１２のオン（ステップＳ１２）の
後にメインＣＰＵ３はサブＣＰＵ８にパワーオンしたこ
とを通知してくるため（ステップＳ１２を経たステップ
Ｓ６）、この通知によりサブＣＰＵ８は第２の電源回路
１２で瞬停が生じたことを判断できる。この場合におけ
るメインＣＰＵ３へのパワーオンの理由通知（ステップ
Ｓ７）は、瞬停となる。勿論、ステップＳ１でＹＥＳと
判定された場合も、メインＣＰＵ３へのパワーオンの理
由通知（ステップＳ７）は、瞬停となる。
た場合にはサブＣＰＵ８が瞬停になるのでサブＣＰＵ８
に制御される第２の電源回路１２も瞬停となる。勿論、
第１の電源回路１１と第２の電源回路１２とが共に同時
的に瞬停となる場合もある。一方、第２の電源回路１２
だけに瞬停が起こることがある（ステップＳ１１，Ｓ１
２）。この場合、第１の電源回路１１及びサブＣＰＵ８
は瞬停せずに正常に動作していたわけであり、サブＣＰ
Ｕ８は前述したリセット解除の処理を行ったときのメイ
ンＣＰＵ３からのパワーオン通知と、このようなリセッ
ト解除の処理を行っていないのにメインＣＰＵ３から受
け取るパワーオン通知とを区別することができる。瞬停
による第２の電源回路１２のオン（ステップＳ１２）の
後にメインＣＰＵ３はサブＣＰＵ８にパワーオンしたこ
とを通知してくるため（ステップＳ１２を経たステップ
Ｓ６）、この通知によりサブＣＰＵ８は第２の電源回路
１２で瞬停が生じたことを判断できる。この場合におけ
るメインＣＰＵ３へのパワーオンの理由通知（ステップ
Ｓ７）は、瞬停となる。勿論、ステップＳ１でＹＥＳと
判定された場合も、メインＣＰＵ３へのパワーオンの理
由通知（ステップＳ７）は、瞬停となる。
【００２８】メインＣＰＵ３は、この理由通知によりパ
ワーオンが瞬停によるものであるのかどうかを知り（ス
テップＳ８）、瞬停である場合にはラストＣＨを選択す
る処理を行い（ステップＳ９）、パワーオンが通常のパ
ワーオンによるものである場合には（ステップＳ８でＮ
Ｏ）、メインＣＰＵはイニシャルＣＨを選択する処理を
行う（ステップＳ１０）。なお、ステップＳ９及びステ
ップＳ１０において、ラストＣＨ又はイニシャルＣＨが
ディジタル放送であるならばメインＣＰＵ３が選局処理
を行い、サブＣＰＵ８にディジタル放送受信中であるこ
とを通知する。アナログ放送である場合には、メインＣ
ＰＵ３はサブＣＰＵ８に対して選局指示を送出すること
になる。
ワーオンが瞬停によるものであるのかどうかを知り（ス
テップＳ８）、瞬停である場合にはラストＣＨを選択す
る処理を行い（ステップＳ９）、パワーオンが通常のパ
ワーオンによるものである場合には（ステップＳ８でＮ
Ｏ）、メインＣＰＵはイニシャルＣＨを選択する処理を
行う（ステップＳ１０）。なお、ステップＳ９及びステ
ップＳ１０において、ラストＣＨ又はイニシャルＣＨが
ディジタル放送であるならばメインＣＰＵ３が選局処理
を行い、サブＣＰＵ８にディジタル放送受信中であるこ
とを通知する。アナログ放送である場合には、メインＣ
ＰＵ３はサブＣＰＵ８に対して選局指示を送出すること
になる。
【００２９】このように、瞬停の場合にはサブＣＰＵ８
はメインＣＰＵ３におけるパワーオンの理由が瞬停であ
ることをメインＣＰＵ３に通知するので、メインＣＰＵ
３において通常のパワーオン時用の処理を行ってしまう
事態を回避することができ、瞬停による不具合発生が防
止されることになる。なお、上述した例では、瞬停等に
起因するチャンネル選択の不具合を防止できる放送受信
装置を示したが、このような放送受信装置に限らず、他
の装置においてこの発明のデータ伝送回路を利用するこ
とが可能である。
はメインＣＰＵ３におけるパワーオンの理由が瞬停であ
ることをメインＣＰＵ３に通知するので、メインＣＰＵ
３において通常のパワーオン時用の処理を行ってしまう
事態を回避することができ、瞬停による不具合発生が防
止されることになる。なお、上述した例では、瞬停等に
起因するチャンネル選択の不具合を防止できる放送受信
装置を示したが、このような放送受信装置に限らず、他
の装置においてこの発明のデータ伝送回路を利用するこ
とが可能である。
【００３０】
【発明の効果】以上説明したように、この発明によれ
ば、瞬停の場合にはサブＣＰＵはメインＣＰＵにおける
パワーオンの理由が瞬停であることをメインＣＰＵに通
知するので、メインＣＰＵにおいて通常のパワーオン時
用の処理を行ってしまう事態を回避することができ、瞬
停による不具合発生が防止される。
ば、瞬停の場合にはサブＣＰＵはメインＣＰＵにおける
パワーオンの理由が瞬停であることをメインＣＰＵに通
知するので、メインＣＰＵにおいて通常のパワーオン時
用の処理を行ってしまう事態を回避することができ、瞬
停による不具合発生が防止される。
【図１】この発明の実施形態の放送受信装置を示すブロ
ック図である。
ック図である。
【図２】処理内容を示したフローチャートである。
２ ディジタルモジュール
３ メインＣＰＵ
６ アナログモジュール
８ サブＣＰＵ
１１ 第１の電源回路
１２ 第２の電源回路
Claims (4)
- 【請求項１】 第１の電源回路にサブＣＰＵが接続さ
れ、このサブＣＰＵによって第２の電源回路のオン／オ
フが制御され、この第２の電源回路に接続されたメイン
ＣＰＵと前記サブＣＰＵとの間でデータ伝送を行うデー
タ伝送回路であって、第１の電源回路の瞬停を判定する
手段を有し、瞬停の場合にはサブＣＰＵはメインＣＰＵ
におけるパワーオンの理由が瞬停であることをメインＣ
ＰＵに通知するように構成されたことを特徴とするデー
タ伝送回路。 - 【請求項２】 請求項１に記載のデータ伝送回路におい
て、前記サブＣＰＵは自身の状態と前記メインＣＰＵか
らのパワーオン通知とに基づいて第２の電源回路側での
瞬停を判定し、瞬停の場合にはサブＣＰＵはメインＣＰ
Ｕにおけるパワーオンの理由が瞬停であることをメイン
ＣＰＵに通知するように構成されたことを特徴とするデ
ータ伝送回路。 - 【請求項３】 請求項１又は請求項２に記載のデータ伝
送回路を備える放送受信装置であって、メインＣＰＵは
瞬停通知を受けた場合にはラストチャンネル受信処理を
実行し、通常パワーオンを示す通知を受けた場合にはイ
ニシャルチャンネル受信処理を実行するように構成され
たことを特徴とする放送受信装置。 - 【請求項４】 請求項３に記載の放送受信装置であっ
て、アナログ放送波を受信するアナログ放送受信部と、
ディジタル放送波を受信するディジタル放送受信部とを
備え、サブＣＰＵはユーザ操作による指令信号のメイン
ＣＰＵへの伝送と前記アナログ放送受信部の制御とメイ
ンＣＰＵを含む他の回路への給電を行う電源回路のオン
／オフ制御とを行い、メインＣＰＵは少なくとも前記デ
ィジタル放送受信部の制御を行うように構成されたこと
を特徴とする放送受信装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2002132428A JP4082927B2 (ja) | 2002-05-08 | 2002-05-08 | 放送受信装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2002132428A JP4082927B2 (ja) | 2002-05-08 | 2002-05-08 | 放送受信装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2003324666A true JP2003324666A (ja) | 2003-11-14 |
| JP4082927B2 JP4082927B2 (ja) | 2008-04-30 |
Family
ID=29544501
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2002132428A Expired - Fee Related JP4082927B2 (ja) | 2002-05-08 | 2002-05-08 | 放送受信装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP4082927B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8040059B2 (en) | 2003-08-29 | 2011-10-18 | Semiconductor Energy Laboratory Co., Ltd. | Display device comprising a conductive barrier body in direct contact with a sealing material |
| JP2016207074A (ja) * | 2015-04-27 | 2016-12-08 | シャープ株式会社 | システム起動回路、電気機器およびテレビジョン装置 |
-
2002
- 2002-05-08 JP JP2002132428A patent/JP4082927B2/ja not_active Expired - Fee Related
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8040059B2 (en) | 2003-08-29 | 2011-10-18 | Semiconductor Energy Laboratory Co., Ltd. | Display device comprising a conductive barrier body in direct contact with a sealing material |
| JP2016207074A (ja) * | 2015-04-27 | 2016-12-08 | シャープ株式会社 | システム起動回路、電気機器およびテレビジョン装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP4082927B2 (ja) | 2008-04-30 |
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