JP2003174321A - テレビジョンチューナの発振器 - Google Patents
テレビジョンチューナの発振器Info
- Publication number
- JP2003174321A JP2003174321A JP2001373885A JP2001373885A JP2003174321A JP 2003174321 A JP2003174321 A JP 2003174321A JP 2001373885 A JP2001373885 A JP 2001373885A JP 2001373885 A JP2001373885 A JP 2001373885A JP 2003174321 A JP2003174321 A JP 2003174321A
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- diode
- circuit
- tuning voltage
- oscillation
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Landscapes
- Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
Abstract
少なくすることでPLL動作を正常に動作し、発振周波
数を安定にする。 【解決手段】 バラクタダイオード41bを有し、バラ
クタダイオード41bのカソードに発振周波数設定用の
同調電圧が印加される共振回路41と、共振回路41が
ベースに結合された発振トランジスタ11、12と、少
なくとも発振トランジスタ11、12のベースとグラン
ドとの間に結合され、発振トランジスタ11、12の静
電破壊を防止するダイオード27、28と、同調電圧を
位相ロックループによって生成する同調電圧発生回路3
3とを備え、所定の電圧を分圧し、分圧された電圧が同
調電圧の増減方向と同じ方向に変化する温度補償回路3
5を設けると共に、ダイオード27、28のアノードを
接地し、分圧された電圧をダイオード27のカソードに
印加した。
Description
ーナの発振器に関し、特に、発振トランジスタを構成し
た集積回路を用いたテレビジョンチューナの発振器に関
する。
構成を図2に示す。集積回路50内には互いのエミッタ
が結合して差動的に動作する三対の発振トランジスタ5
1及び52と、53及び54と、55及び56とが構成
される。また、集積回路50内には第一乃至第十の結合
コンデンサ57〜66と、第一乃至第五のダイオード6
7〜71とが構成される。また、集積回路50には、外
部に設けた共振回路を接続するための第一乃至第五の端
子50a〜50eと、電源端子50fと、同調電圧端子
50gとが設けられる。そして、外部から電源端子50
fに印加された電源電圧Vcc(約5ボルト)が各発振
トランジスタ51〜56のコレクタや図示しない他の回
路等に供給される。
二の発振トランジスタ52のコレクタはそれぞれ第一の
結合コンデンサ57、第二の結合コンデンサ58によっ
て第一の端子50aに結合され、第一の発振トランジス
タ51のコレクタと第二の発振トランジスタ52のベー
スはそれぞれ第三の結合コンデンサ59、第四の結合コ
ンデンサ60によって第二の端子50bに結合される。
そして、第一の端子50aには第一のダイオード67の
カソードが接続され、アノードは接地される。また、第
二の端子50bにも第二のダイオード68のカソードが
接続され、アノードは接地される。
四の発振トランジスタ54のコレクタはそれぞれ第五の
結合コンデンサ61、第六の結合コンデンサ62によっ
て第三の端子50cに結合され、第四の発振トランジス
タ54のベースはコンデンサ72によって接地される。
そして、第三の端子50cには第三のダイオード69の
カソードが接続され、アノードは接地される。
六の発振トランジスタ56のコレクタはそれぞれ第七の
結合コンデンサ63、第八の結合コンデンサ64によっ
て第四の端子50dに結合され、第五の発振トランジス
タ55のコレクタと第六の発振トランジスタ56のベー
スはそれぞれ第九の結合コンデンサ65、第十の結合コ
ンデンサ66によって第五の端子50eに結合される。
そして、第四の端子50dには第四のダイオード70の
カソードが接続され、アノードは接地される。また、第
五の端子50eにも第五のダイオード71のカソードが
接続され、アノードは接地される。
1は、外部から第一乃至第五の端子50a〜50eに静
電気が印加されたときに各発振トランジスタ51〜56
が破壊されるのを防止するための保護ダイオードとして
の役目を果たす。
設けられる。第一の共振回路81はインダクタンス素子
81aとアノードが直流的に接地されたバラクタダイオ
ード81bとかなる並列共振回路で構成され、第一の端
子50aと第二の端子50bとの間に接続される。この
結果、第一及び第二の発振トランジスタ51、52と第
一の共振回路81とによって平衡型の発振器が構成さ
れ、これは、例えばVHF帯のハイバンドのテレビジョ
ン信号を受信する場合の局部発振器として使用される。
ス素子82aとアノードがインダクタンス素子82aに
よって直流的に接地されたバラクタダイオード82bと
かなる並列共振回路で構成され、バラクタダイオード8
2bのアノードが第三の端子50cに接続され、カソー
ドは高周波的に接地される。この結果、第三及び第四の
発振トランジスタ53、54と第二の共振回路82とに
よって不平衡型の発振器が構成され、これは、例えばV
HF帯のローバンドのテレビジョン信号を受信する場合
の局部発振器として使用される。
ンス素子83aとアノードが直流的に接地されたバラク
タダイオード83bとかなる並列共振回路で構成され、
第四の端子50dと第五の端子50eとの間に接続され
る。この結果、第五及び第六の発振トランジスタ55、
56と第三の共振回路83とによって平衡型の発振器が
構成され、これは、例えばUHF帯のテレビジョン信号
を受信する場合の局部発振器として使用される。そし
て、各バラクタダイオード81b、82b、83bのカ
ソードは同調電圧端子50gに接続される。
プ抵抗84を介して高電圧Vtu(約30ボルト)が印
加される。そして、集積回路50内には同調電圧端子5
0gとグランドとの間に接続された同調電圧発生回路7
3と、この同調電圧発生回路73を制御するPLL回路
74が構成される。
ET73aと、NPNトランジスタ73bとを有し、ジ
ャンクションFET73aのドレインが抵抗73cによ
って同調電圧端子50gに接続され、ソースはNPNト
ランジスタ73bのコレクタに接続される。そしてNP
Nトランジスタ73bのエミッタは抵抗73dによって
接地される。
固定分周器、可変分周器、位相比較器等を有し、ここに
は発振周波数を設定するためのデータDaと、各発振ト
ランジスタ51〜56から出力される発振信号Aと、基
準信号Refとが入力される。PLLL回路74から出
力された制御電圧はNPNトランジスタ73bに入力さ
れる。これによってジャンクションFET73aとNP
Nトランジスタ73bとは動作点が制御されて可変イン
ピーダンス素子として働く。従って、プルアップ抵抗8
4と同調電圧発生回路73とのインピーダンス比が変化
して同調電圧端子50gにはほぼ2ボルトから25ボル
トの範囲の同調電圧が発生する。この電圧が各バラクタ
ダイオード81b、82b、83bに印加されて発振周
波数が設定される。ここで、たとえば、各共振回路自体
の共振周波数が周囲温度等の環境条件によって変化し、
発振周波数が変化しても、その変化を補正するように同
調電圧が変化して発振周波数は元の状態に戻る。
クタダイオードの容量は正の温度係数を持ち、周囲温度
が高くなると容量値が増える。また、上記の発振器は一
般に絶縁基板上に構成されるが、使用する絶縁基板を廉
価な紙フェノール基板を使用した場合はその温度係数を
含めた共振回路自体の温度係数が一層大きくなる。一
方、上記の保護用のダイオードは等価的な容量成分を持
つが、その容量も正の温度係数持ち、しかも共振回路に
並列に接続される形となっている。
高くなると低い方に大きくずれることとなり、それを補
正するためには同調電圧の大きな変化が必要となる。し
かし、PLL制御による同調電圧の変化範囲には自ずと
限界があり、その限界を超えると、いわゆる引き込みが
出来なくなってロックされなくなり、発振周波数は不定
となってしまうという問題があった。
温度による発振周波数の変化を少なくすることでPLL
動作を正常に動作し、発振周波数を安定にすることを目
的とする。
め、本発明では、バラクタダイオードを有し、前記バラ
クタダイオードのカソードに発振周波数設定用の同調電
圧が印加される共振回路と、前記共振回路がベースに結
合された発振トランジスタと、少なくとも前記発振トラ
ンジスタのベースとグランドとの間に結合され、前記発
振トランジスタの静電破壊を防止するダイオードと、位
相ロックループによって前記同調電圧を発生する同調電
圧発生回路とを備え、所定の電圧を分圧し、分圧された
電圧が前記同調電圧の増減方向と同じ方向に変化する温
度補償回路を設けると共に、前記ダイオードのアノード
を接地し、前記分圧された電圧を前記ダイオードのカソ
ードに印加した。
償回路と前記同調電圧発生回路と前記ダイオードとを一
つの集積回路内に構成した。
抵抗を介して前記同調電圧よりも高い電圧の電圧源に一
端が接続された抵抗手段と、前記抵抗手段の他端にコレ
クタが接続され、エミッタ側が接地されたNPNトラン
ジスタを有し、前記NPNトランジスタはコレクタとエ
ミッタとの間の電圧が前記位相ロックループの制御電圧
によって変化するように制御され、前記温度補償回路は
前記所定の電圧が一端に印加される抵抗と、前記抵抗の
他端側にドレインが接続されると共に、ゲートが接地さ
れたFETとを少なくとも有し、前記FETのソースを
前記NPNトランジスタのコレクタに接続し、前記抵抗
の他端と前記FETのドレインとの間の電圧を前記ダイ
オードのカソードに印加した。
ジョンチューナの発振器を説明する。集積回路10内に
は互いのエミッタが結合して差動的に動作する三対の発
振トランジスタ11及び12と、13及び14と、15
及び16とが構成される。また、集積回路10内には第
一乃至第十の結合コンデンサ17〜26と、第一乃至第
五のダイオード27〜31とが構成される。また、集積
回路10には、外部に設けた共振回路を接続するための
第一乃至第五の端子10a〜10eと、電源端子10f
と、同調電圧端子10gとが設けられる。そして、外部
から電源端子10fに印加された電源電圧Vcc(約5
ボルト)が各発振トランジスタ11〜16のコレクタや
図示しない他の回路等に供給される。
二の発振トランジスタ12のコレクタはそれぞれ第一の
結合コンデンサ17、第二の結合コンデンサ18によっ
て第一の端子10aに結合され、第一の発振トランジス
タ11のコレクタと第二の発振トランジスタ12のベー
スはそれぞれ第三の結合コンデンサ19、第四の結合コ
ンデンサ20によって第二の端子10bに結合される。
そして、第一の端子10aには第一のダイオード27の
カソードが接続され、アノードは接地される。また、第
二の端子10bにも第二のダイオード28のカソードが
接続され、アノードは接地される。
四の発振トランジスタ14のコレクタはそれぞれ第五の
結合コンデンサ21、第六の結合コンデンサ22によっ
て第三の端子10cに結合され、第四の発振トランジス
タ14のベースはコンデンサ32によって接地される。
そして、第三の端子10cには第三のダイオード29の
カソードが接続され、アノードは接地される。
六の発振トランジスタ16のコレクタはそれぞれ第七の
結合コンデンサ23、第八の結合コンデンサ24によっ
て第四の端子10dに結合され、第五の発振トランジス
タ15のコレクタと第六の発振トランジスタ16のベー
スはそれぞれ第九の結合コンデンサ25、第十の結合コ
ンデンサ26によって第五の端子10eに結合される。
そして、第四の端子10dには第四のダイオード30の
カソードが接続され、アノードは接地される。また、第
五の端子10eにも第五のダイオード31のカソードが
接続され、アノードは接地される。
1は、外部から第一乃至第五の端子10a〜10eに静
電気が印加されたときに各発振トランジスタ11〜16
が破壊されるのを防止するための保護ダイオードとして
の役目を果たす。
設けられる。第一の共振回路41はインダクタンス素子
41aとアノードが直流的に接地されたバラクタダイオ
ード41bとかなる並列共振回路で構成され、第一の端
子10aと第二の端子10bとの間に接続される。この
結果、第一及び第二の発振トランジスタ11、12と第
一の共振回路41とによって平衡型の発振器が構成さ
れ、これは、例えばVHF帯のハイバンドのテレビジョ
ン信号を受信する場合の局部発振器として使用される。
ス素子42aとアノードがインダクタンス素子42aに
よって直流的に接地されたバラクタダイオード42bと
かなる並列共振回路で構成され、バラクタダイオード4
2bのアノードが第三の端子10cに接続され、カソー
ドは高周波的に接地される。この結果、第三及び第四の
発振トランジスタ13、14と第二の共振回路42とに
よって不平衡型の発振器が構成され、これは、例えばV
HF帯のローバンドのテレビジョン信号を受信する場合
の局部発振器として使用される。
ンス素子43aとアノードが直流的に接地されたバラク
タダイオード43bとかなる並列共振回路で構成され、
第四の端子10dと第五の端子10eとの間に接続され
る。この結果、第五及び第六の発振トランジスタ15、
16と第三の共振回路43とによって平衡型の発振器が
構成され、これは、例えばUHF帯のテレビジョン信号
を受信する場合の局部発振器として使用される。そし
て、各バラクタダイオード41b、42b、43bのカ
ソードは同調電圧端子10gに接続される。
プ抵抗44を介して高電圧Vtu(約30ボルト)が印
加される。そして、集積回路10内には同調電圧端子1
0gとグランドとの間に接続された同調電圧発生回路3
3と、この同調電圧発生回路33を制御するPLL回路
34と、各発振器の温度変化による発振周波数の変化を
抑えるための温度補償回路35とが構成される。
ET33aと、NPNトランジスタ33bとを有し、ジ
ャンクションFET33aのドレインが抵抗33cによ
って同調電圧端子10gに接続され、ソースはNPNト
ランジスタ33bのコレクタに接続される。ジャンクシ
ョンFET33aと抵抗33cは可変抵抗手段として機
能する。そしてNPNトランジスタ33bのエミッタは
抵抗33dによって接地される。また、NPNトランジ
スタ33bも可変抵抗手段として機能する。
固定分周器、可変分周器、位相比較器、チャージポンプ
等を有し、ここには発振周波数を設定するためのデータ
Daと、各発振トランジスタ11〜16から出力される
発振信号Aと、基準信号Refとが入力される。PLL
L回路34内のチャージポンプから出力された制御電圧
はNPNトランジスタ33bに入力される。これによっ
てジャンクションFET33aとNPNトランジスタ3
3bとは動作点が制御されて可変インピーダンス素子と
して働く。従って、プルアップ抵抗44と同調電圧発生
回路33とのインピーダンス比が変化して同調電圧端子
10gにはほぼ2ボルトから25ボルトの範囲の同調電
圧が発生する。この電圧が各バラクタダイオード41
b、42b、43bに印加されて発振周波数が設定され
る。
35aと、そのドレインと電源端子10fとの間に直列
に接続された二つの抵抗35b、35cとかなり、ジャ
ンクションFET35aのソースは同調電圧発生回路3
3におけるNPNトランジスタ33bのコレクタに接続
される。ジャンクションFET35aは可変抵抗手段と
して機能する。そして、二つの抵抗35b、35cの接
続点には電源電圧を分圧した電圧(ここでは、温度補償
電圧という)が現れ、此がダイオード28、29、31
のカソードに印加される。
ド41b、42b、43bや各ダイオード27〜31の
容量値は正の温度係数を有し、温度が上昇すると容量値
が増加する。従って発振周波数(発振信号Aの周波数)
が低い方に変化する。すると、PLL回路34から同調
電圧発生回路33におけるNPNトランジスタ33bに
入力されている制御電圧が下がり、NPNトランジスタ
33bのコレクタとエミッタとの間の電圧が大きくな
り、同調電圧端子10gに現れる同調電圧も上昇し、発
振周波数を元に戻すように働く。このとき、温度補償回
路35における二つの抵抗35b、35cの接続点の電
圧も上昇する。従って、ダイオード28、29、31の
カソードに印加されている電圧は従来よりも高くなる。
アス電圧が大きくなると減少するので、各ダイオード2
8、29、31によっても発振周波数の変化を抑える効
果が生じる。従って、変化した発振周波数を元に戻すた
めの同調電圧の変化は少なくて済むことになる。温度補
償電圧は上記の三個のダイオードに限らず、第一のダイ
オード27、第四のダイオード30にも印加すれば上記
効果が一層顕著になる。
クタダイオードを有し、バラクタダイオードのカソード
に発振周波数設定用の同調電圧が印加される共振回路
と、共振回路がベースに結合された発振トランジスタ
と、少なくとも発振トランジスタのベースとグランドと
の間に結合され、発振トランジスタの静電破壊を防止す
るダイオードと、位相ロックループによって同調電圧を
発生する同調電圧発生回路とを備え、所定の電圧を分圧
し、分圧された電圧が同調電圧の増減方向と同じ方向に
変化する温度補償回路を設けると共に、ダイオードのア
ノードを接地し、分圧された電圧をダイオードのカソー
ドに印加したので、ダイオードの端子間容量値の変化が
発振周波数の変化を抑える方向に働く。従って、変化し
た発振周波数を元に戻すための同調電圧の変化は少なく
て済むことになる。
同調電圧発生回路とダイオードとを一つの集積回路内に
構成したので、集積回路のみで温度補償ができる。
を介して同調電圧よりも高い電圧の電圧源に一端が接続
された抵抗手段と、抵抗手段の他端にコレクタが接続さ
れ、エミッタ側が接地されたNPNトランジスタを有
し、NPNトランジスタはコレクタとエミッタとの間の
電圧が位相ロックループの制御電圧によって変化するよ
うに制御され、温度補償回路は所定の電圧が一端に印加
される抵抗と、抵抗の他端側にドレインが接続されると
共に、ゲートが接地されたFETとを少なくとも有し、
FETのソースをNPNトランジスタのコレクタに接続
し、抵抗の他端とFETのドレインとの間の電圧をダイ
オードのカソードに印加したので、分圧された電圧が同
調電圧の増減方向と同じ方向に変化する。
を示す回路図である。
示す回路図である。
Claims (3)
- 【請求項1】 バラクタダイオードを有し、前記バラク
タダイオードのカソードに発振周波数設定用の同調電圧
が印加される共振回路と、前記共振回路がベースに結合
された発振トランジスタと、少なくとも前記発振トラン
ジスタのベースとグランドとの間に結合され、前記発振
トランジスタの静電破壊を防止するダイオードと、位相
ロックループによって前記同調電圧を発生する同調電圧
発生回路とを備え、所定の電圧を分圧し、分圧された電
圧が前記同調電圧の増減方向と同じ方向に変化する温度
補償回路を設けると共に、前記ダイオードのアノードを
接地し、前記分圧された電圧を前記ダイオードのカソー
ドに印加したことを特徴とするテレビジョンチューナの
発振器。 - 【請求項2】 前記発振トランジスタと前記温度補償回
路と前記同調電圧発生回路と前記ダイオードとを一つの
集積回路内に構成したことを特徴とする請求項1に記載
のテレビジョンチューナの発振器。 - 【請求項3】 前記同調電圧発生回路はプルアップ抵抗
を介して前記同調電圧よりも高い電圧の電圧源に一端が
接続された抵抗手段と、前記抵抗手段の他端にコレクタ
が接続され、エミッタ側が接地されたNPNトランジス
タを有し、前記NPNトランジスタはコレクタとエミッ
タとの間の電圧が前記位相ロックループの制御電圧によ
って変化するように制御され、前記温度補償回路は前記
所定の電圧が一端に印加される抵抗と、前記抵抗の他端
側にドレインが接続されると共に、ゲートが接地された
FETとを少なくとも有し、前記FETのソースを前記
NPNトランジスタのコレクタに接続し、前記抵抗の他
端と前記FETのドレインとの間の電圧を前記ダイオー
ドのカソードに印加したことを特徴とする請求項1又は
2に記載のテレビジョンチューナの発振器。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2001373885A JP3953798B2 (ja) | 2001-12-07 | 2001-12-07 | テレビジョンチューナの発振器 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2001373885A JP3953798B2 (ja) | 2001-12-07 | 2001-12-07 | テレビジョンチューナの発振器 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2003174321A true JP2003174321A (ja) | 2003-06-20 |
JP3953798B2 JP3953798B2 (ja) | 2007-08-08 |
Family
ID=19182531
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2001373885A Expired - Fee Related JP3953798B2 (ja) | 2001-12-07 | 2001-12-07 | テレビジョンチューナの発振器 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3953798B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN102064801A (zh) * | 2010-11-08 | 2011-05-18 | 中国兵器工业集团第二一四研究所苏州研发中心 | 一种基于cmos工艺实现的全硅时钟发生器 |
-
2001
- 2001-12-07 JP JP2001373885A patent/JP3953798B2/ja not_active Expired - Fee Related
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN102064801A (zh) * | 2010-11-08 | 2011-05-18 | 中国兵器工业集团第二一四研究所苏州研发中心 | 一种基于cmos工艺实现的全硅时钟发生器 |
CN102064801B (zh) * | 2010-11-08 | 2013-09-18 | 中国兵器工业集团第二一四研究所苏州研发中心 | 一种基于cmos工艺实现的全硅时钟发生器 |
Also Published As
Publication number | Publication date |
---|---|
JP3953798B2 (ja) | 2007-08-08 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US20050218947A1 (en) | PLL frequency synthesizer circuit and frequency tuning method thereof | |
US7986194B2 (en) | Oscillator | |
US20080174379A1 (en) | Switch capacitance and varactor banks applied to voltage controlled oscillator having constant frequency tuning sensitivity | |
EP2201686B1 (en) | Voltage controlled oscillator with cascaded emitter follower buffer stages | |
US6853262B2 (en) | Voltage-controlled oscillator circuit which compensates for supply voltage fluctuations | |
US6927643B2 (en) | Oscillator topology for very low phase noise operation | |
US8222963B2 (en) | Voltage-controlled oscillator | |
EP1320188B1 (en) | Oscillator circuit | |
US7312672B2 (en) | Local oscillating circuit for receiving high-band and low-band signal | |
JP3953798B2 (ja) | テレビジョンチューナの発振器 | |
US7355490B2 (en) | Receiver having no tracking error | |
JP2003309777A (ja) | テレビジョンチューナ | |
EP1117177B1 (en) | Voltage controlled oscillator | |
JP3106132U (ja) | テレビジョンチューナ | |
EP1432116B1 (en) | Oscillation circuit for television tuner | |
US7382207B2 (en) | Oscillator circuit suppressing variation of oscillation frequency | |
JPH0319506A (ja) | 水晶発振回路 | |
JP2009164745A (ja) | 発振回路及びテレビジョン信号受信用チューナ | |
JP3105079U (ja) | 発振回路 | |
JP2903934B2 (ja) | 発振回路と、この発振回路を用いたbsチューナ | |
JP3977626B2 (ja) | 発振回路 | |
JP3105078U (ja) | 発振回路 | |
JP3656013B2 (ja) | 電圧制御発振器 | |
JP2532177Y2 (ja) | 高周波集積回路 | |
JPH1065443A (ja) | チューナの局部発振回路 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20040519 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20060308 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20060912 |
|
A521 | Written amendment |
Effective date: 20061102 Free format text: JAPANESE INTERMEDIATE CODE: A523 |
|
RD03 | Notification of appointment of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7423 Effective date: 20061102 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Effective date: 20070410 Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20070425 |
|
R150 | Certificate of patent (=grant) or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
LAPS | Cancellation because of no payment of annual fees |