JP2003161953A - 液晶表示装置の製造方法 - Google Patents
液晶表示装置の製造方法Info
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Abstract
ィブマトリックス型液晶表示装置の製造方法を提供する
こと。 【解決手段】 アレイ基板に対して略平行な電界を発生
させることにより、液晶分子の配列を変化させる、アク
ティブマトリックス型液晶表示装置において、アレイ基
板10上に、配線を形成した後透明な絶縁膜20を成膜
する工程と、該配線側面に、該配線の膜厚に対する比が
0.5以上1.0以下の膜厚の前記絶縁膜を残すよう
に、該絶縁膜をドライエッチングする工程と、前記配線
の膜厚に対する比が0.2以下の膜厚の前記配線のみ、
ウェットエッチングする工程とを含むようにした。
Description
造方法に関し、特に、画素電極近傍の光り抜けを防止す
るようにした、アクティブマトリックス型液晶表示装置
の製造方法に関するものである。
ain Switching)方式と呼ばれる、アレイ基板に対して
略平行な電界を発生させることにより、液晶分子の配列
を変化させる、アクティブマトリックス型液晶表示装置
では、通常、アレイ基板上の櫛型形状の画素電極が、カ
ラーフィルター基板上のブラックマトリックスにより遮
蔽されていないため、画素電極近傍の配向がコントラス
トに影響を与える。画素電極のテーパ角が大きいか、も
しくは画素電極の膜厚が厚いと、画素電極近傍の配向規
制力が弱くなるため、黒表示もしくは中間調表示におい
て画素電極近傍に光り抜けが発生し、コントラスト低下
の原因となる。従来は、上記画素電極のテーパ角を小さ
くするか、もしくは前記画素電極の膜厚を薄く形成する
ことにより、前記画素電極近傍の光り抜けを防止してい
た。
アクティブマトリックス型液晶表示装置の製造方法で
は、以下のような問題点があった。まず、上記画素電極
と同時にチャネル部をエッチングするプロセスの場合、
上記画素電極のテーパを制御するのは困難であるため、
上記画素電極のテーパ角を小さくすることが出来ない。
また、上記画素電極と同時に信号配線を形成する場合、
上記画素電極の膜厚を薄くすると上記信号配線の配線抵
抗が増加するため、上記画素電極の膜厚を薄く形成でき
ない。
めになされたものであり、画素電極近傍の光り抜けを防
止できる、アクティブマトリックス型液晶表示装置の製
造方法を提供することを目的とする。
る液晶表示装置の製造方法は、アレイ基板に対して略平
行な電界を発生させることにより、液晶分子の配列を変
化させる、アクティブマトリックス型液晶表示装置の製
造方法において、上記アレイ基板上に配線を形成した
後、透明な絶縁膜を成膜する工程と、該配線側面に、該
配線の膜厚に対する比が0.5以上1.0以下の膜厚の
前記絶縁膜を残すように、該絶縁膜をエッチングする工
程とを含むようにしたものである。
装置の製造方法は、アレイ基板に対して略平行な電界を
発生させることにより、液晶分子の配列を変化させる、
アクティブマトリックス型液晶表示装置の製造方法にお
いて、上記アレイ基板上に配線を形成した後、透明な絶
縁膜を成膜する工程と、該配線側面に、該配線の膜厚に
対する比が0.5以上1.0以下の膜厚の前記絶縁膜を
残すように、該絶縁膜をエッチングする工程と、前記配
線の膜厚に対する比が0.2以下の膜厚の前記配線の
み、等方性エッチングによりエッチングする工程とを含
む、ようにしたものである。
施の形態1について図面を参照しながら説明する。図1
に、本発明の実施の形態1に係るアクティブマトリック
ス型液晶表示装置の平面構成図を示す。図において、1
0はアレイ基板、1aは走査配線、1bは共通配線、2
aは信号配線、2bは画素電極、3aはスイッチング素
子である。
の製造方法について、図2〜4を用いて説明する。ま
ず、透明なガラスからなるアレイ基板10上に、スパッ
タ装置にて膜厚0.4μmのアルミニウム膜を全面に蒸
着する。次に、フォトリソグラフィ法により、上記アル
ミニウム膜のパターニングを行い、複数の走査配線1a
と複数の共通配線1bを形成する。次いで、その上に絶
縁膜20として化学気相成長法(CVD法)にて、窒化
珪素膜とa-Si膜を形成する。さらにその上に、膜厚
0.2μmのアルミニウム膜を全面に蒸着し、フォトリ
ソグラフィ法により上記アルミニウム膜のパターニング
を行い、信号配線2aと画素電極2bを形成した後、C
VD法により膜厚0.3μmの窒化珪素膜30を形成す
る。この時の図1におけるY−Y’の構成断面図を、図
2に示す。
3μmの前記窒化珪素30のエッチングを行うと同時に
停止することにより、前記画素電極2bの側壁に、幅
0.2μm、厚さ0.15μmの窒化珪素膜30を残
す。この時の図1におけるY−Y’の構成断面図を、図
3に示す。
する。この時の図1におけるY−Y’の構成断面図を、
図4に示す。
ついて、画像検査を行ったところ、画素電極近傍の光り
抜けは見られず、従来の方法で作成された液晶パネルに
対して、コントラストが5%上昇した。なお、窒化珪素
膜30の膜厚を0.3μmから0.15μmまで変化さ
せて同様の実験を行ったところ、コントラストが3%か
ら5%向上した。
2について、図面を参照しながら説明する。本発明の実
施の形態2に係るアクティブマトリックス型液晶表示装
置の構成は、実施の形態1に係る液晶表示装置の構成に
同じである。
製造方法について、図5〜7を用いて説明する。まず、
透明なガラスからなるアレイ基板10上に、スパッタ装
置にて膜厚0.4μmのアルミニウム膜を全面に蒸着す
る。次に、フォトリソグラフィ法により、上記アルミニ
ウム膜のパターニングを行い、複数の走査配線1aと複
数の共通配線1bを形成する。次いで、その上に絶縁膜
20として化学気相成長法(CVD法)にて、窒化珪素
膜とa-Si膜を形成する。さらにその上に、膜厚0.
3μmのアルミニウム膜を全面に蒸着し、フォトリソグ
ラフィ法により上記アルミニウム膜のパターニングを行
い、信号配線2aと画素電極2bを形成した後、CVD
法により膜厚0.3μmの窒化珪素膜30を形成する。
この時の図1におけるY−Y’の構成断面図を、図5に
示す。
ッチングにより、前記画素電極2bを膜厚0.08μm
エッチングする。この時の図1におけるY−Y’の構成
断面図を、図6に示す。最後に絶縁膜40をCVD法に
より形成した。この時の図1におけるY−Y’の構成断
面図を、図7に示す。
関して、画像検査を行ったところ、画素電極近傍の光り
抜けは見られず、従来の方法で作製された液晶パネルに
対してコントラストが7%上昇した。
る液晶表示装置の製造方法によれば、アレイ基板に対し
て略平行な電界を発生させることにより、液晶分子の配
列を変化させる、アクティブマトリックス型液晶表示装
置の製造方法において、上記アレイ基板上に配線を形成
した後、透明な絶縁膜を成膜する工程と、該配線側面
に、該配線の膜厚に対する比が0.5以上1.0以下の
膜厚の前記絶縁膜を残すように、該絶縁膜をエッチング
する工程とを含むものとしたので、前記櫛型電極周辺の
平坦性を高めて、画素内の櫛型電極近傍の配向規制力を
強め、光り抜けを防止することができる。
装置の製造方法によれば、アレイ基板に対して略平行な
電界を発生させることにより、液晶分子の配列を変化さ
せる、アクティブマトリックス型液晶表示装置の製造方
法において、上記アレイ基板上に配線を形成した後、透
明な絶縁膜を成膜する工程と、該配線側面に、該配線の
膜厚に対する比が0.5以上1.0以下の膜厚の前記絶
縁膜を残すように、該絶縁膜をエッチングする工程と、
前記配線の膜厚に対する比が0.2以下の膜厚の前記配
線のみ、等方性エッチングによりエッチングする工程と
を含むものとしたので、前記櫛型電極周辺の平坦性を高
めて、画素内の櫛型電極近傍の配向規制力を強め、光り
向けを防止することができる。
ィブマトリックス型液晶表示装置の平面構成図である。
絶縁膜30を形成した後の、図1におけるY−Y’部の
構成断面図である。
した後の、図1におけるY−Y’部の構成断面図であ
る。
した後、絶縁膜40を形成した後の、図1におけるY−
Y’部の構成断面図である。
した後の、図1におけるY−Y’部の構成断面図であ
る。
グした後の図1におけるY−Y’部の構成断面図であ
る。
グした後、絶縁膜40を形成した後の、図1におけるY
−Y’部の構成断面図である。
Claims (2)
- 【請求項1】 アレイ基板に対して略平行な電界を発生
させることにより、液晶分子の配列を変化させる、アク
ティブマトリックス型液晶表示装置の製造方法におい
て、 上記アレイ基板上に配線を形成した後、透明な絶縁膜を
成膜する工程と、 該配線側面に、該配線の膜厚に対する比が0.5以上
1.0以下の膜厚の前記絶縁膜を残すように、該絶縁膜
をエッチングする工程とを含む、 ことを特徴とする、液晶表示装置の製造方法。 - 【請求項2】 アレイ基板に対して略平行な電界を発生
させることにより、液晶分子の配列を変化させる、アク
ティブマトリックス型液晶表示装置の製造方法におい
て、 上記アレイ基板上に配線を形成した後、透明な絶縁膜を
成膜する工程と、 該配線側面に、該配線の膜厚に対する比が0.5以上
1.0以下の膜厚の前記絶縁膜を残すように、該絶縁膜
をエッチングする工程と、 前記配線の膜厚に対する比が0.2以下の膜厚の前記配
線のみ、等方性エッチングによりエッチングする工程と
を含む、 ことを特徴とする、液晶表示装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2001363175A JP4080732B2 (ja) | 2001-11-28 | 2001-11-28 | 液晶表示装置の製造方法、及び液晶表示装置 |
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Publications (3)
Publication Number | Publication Date |
---|---|
JP2003161953A true JP2003161953A (ja) | 2003-06-06 |
JP2003161953A5 JP2003161953A5 (ja) | 2005-07-21 |
JP4080732B2 JP4080732B2 (ja) | 2008-04-23 |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2009080303A (ja) * | 2007-09-26 | 2009-04-16 | Epson Imaging Devices Corp | 液晶装置および電子機器 |
-
2001
- 2001-11-28 JP JP2001363175A patent/JP4080732B2/ja not_active Expired - Fee Related
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