JP2003115724A - オペアンプ接続回路及びオペアンプ接続方法 - Google Patents
オペアンプ接続回路及びオペアンプ接続方法Info
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- JP2003115724A JP2003115724A JP2001310569A JP2001310569A JP2003115724A JP 2003115724 A JP2003115724 A JP 2003115724A JP 2001310569 A JP2001310569 A JP 2001310569A JP 2001310569 A JP2001310569 A JP 2001310569A JP 2003115724 A JP2003115724 A JP 2003115724A
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Abstract
(57)【要約】
【目的】 本発明は、隣接ピン間ショート時があった場
合に液晶パネルの画面変化により、異常がわかるように
するとともに、該ショート時の温度上昇を抑制する事に
より安全性の高いオペアンプ接続回路を提供しようとす
るものである。 【構成】電源ピン側に設置されたオペアンプにＶcom電
圧を接続することにより、ショート時に画面変化が現れ
るようにし、さらにＶcom電圧で該ショート時の電圧差
を地位作詞ＩＣの温度上昇を小さくしたオペアンプ接続
回路である。
合に液晶パネルの画面変化により、異常がわかるように
するとともに、該ショート時の温度上昇を抑制する事に
より安全性の高いオペアンプ接続回路を提供しようとす
るものである。 【構成】電源ピン側に設置されたオペアンプにＶcom電
圧を接続することにより、ショート時に画面変化が現れ
るようにし、さらにＶcom電圧で該ショート時の電圧差
を地位作詞ＩＣの温度上昇を小さくしたオペアンプ接続
回路である。
Description
【０００１】
【発明の属する技術分野】本発明は例えば液晶パネルの
画像信号処理回路等に用いられる、安全性を改良された
オペアンプ接続回路、及びオペアンプ接続方法、液晶表
示装置に関するものである。
画像信号処理回路等に用いられる、安全性を改良された
オペアンプ接続回路、及びオペアンプ接続方法、液晶表
示装置に関するものである。
【０００２】
【従来の技術】パソコンの開発期間は短期間であり、そ
れに伴い液晶パネルも短期間での開発が必要である。こ
のため、設計段階における回路としては冗長回路を盛り
込み不要な場合は回路を削除する手法がとられている。
れに伴い液晶パネルも短期間での開発が必要である。こ
のため、設計段階における回路としては冗長回路を盛り
込み不要な場合は回路を削除する手法がとられている。
【０００３】その中で、オペアンプにおいては、未使用
のオペアンプの配線処理が重要となってくる。
のオペアンプの配線処理が重要となってくる。
【０００４】従来は未使用のオペアンプの接続回路とし
ては、例えば図２がある。すなわち、図２は、従来のオ
ペアンプ接続回路の回路図を示すものであり、Ｒ１，Ｒ
２はそれぞれ抵抗であり、ＶＲ１はボリュームであり、
Ｃ１はコンデンサであり、ＩＣ２はオペアンプ２個を内
蔵したＩＣである。一方のオペアンプはピン１、２、３
を有し、他方のオペアンプはピン５、６、７を有する。
また、ピン４は接地用のピンであり、ピン８は電源電圧
を供給するためのピンである。
ては、例えば図２がある。すなわち、図２は、従来のオ
ペアンプ接続回路の回路図を示すものであり、Ｒ１，Ｒ
２はそれぞれ抵抗であり、ＶＲ１はボリュームであり、
Ｃ１はコンデンサであり、ＩＣ２はオペアンプ２個を内
蔵したＩＣである。一方のオペアンプはピン１、２、３
を有し、他方のオペアンプはピン５、６、７を有する。
また、ピン４は接地用のピンであり、ピン８は電源電圧
を供給するためのピンである。
【０００５】次に、従来のオペアンプ接続回路の動作を
説明する。
説明する。
【０００６】ピン１，２，３からなるオペアンプは未使
用であり、その配線としてはもっとも安定する接続にし
て発振が起こらない接続方法が必要であり、その手段は
図２に示すように出力を一方の入力に接続し、他方入力
を接地することであり、図中に示すように出力１ピンを
一方の入力２ピンに接続し、入力ピン３を接地４と接続
している。他方ＩＣ１の５，６，７のオペアンプは抵抗
Ｒ１，Ｒ２及びＶＲ１により、調整されたVcom-F電圧を
コンデンサＣ１により安定化した電圧がオペアンプの入
力５ピンに入力され、出力７ピンは入力６ピンに接続さ
れている。オペアンプの特徴には、次の２つがある。
用であり、その配線としてはもっとも安定する接続にし
て発振が起こらない接続方法が必要であり、その手段は
図２に示すように出力を一方の入力に接続し、他方入力
を接地することであり、図中に示すように出力１ピンを
一方の入力２ピンに接続し、入力ピン３を接地４と接続
している。他方ＩＣ１の５，６，７のオペアンプは抵抗
Ｒ１，Ｒ２及びＶＲ１により、調整されたVcom-F電圧を
コンデンサＣ１により安定化した電圧がオペアンプの入
力５ピンに入力され、出力７ピンは入力６ピンに接続さ
れている。オペアンプの特徴には、次の２つがある。
【０００７】すなわち、第１の特徴として、入力差電圧
をゼロに保つという特徴がある。また、第２の特徴とし
て出力インピーダンスが小さいという特徴がある。ここ
では、インピーダンス変換した電圧が出力される。この
電圧によって、安定したコモン電圧が供給され、フリッ
カの小さい液晶表示パネルが実現できる。
をゼロに保つという特徴がある。また、第２の特徴とし
て出力インピーダンスが小さいという特徴がある。ここ
では、インピーダンス変換した電圧が出力される。この
電圧によって、安定したコモン電圧が供給され、フリッ
カの小さい液晶表示パネルが実現できる。
【０００８】
【発明が解決しようとする課題】しかしながら前記のよ
うな従来の構成においては、ピン７−ピン８間がショー
トしたとき、ピン５，６，７のオペアンプでは出力７ピ
ンの電圧がＶａｄ（８．４Ｖ）につり上げられることに
よりオペアンプには最大電流８８ｍＡが流れるので、Ｉ
Ｃ１の温度が非常に高くなる（表面温度１１４℃）。
うな従来の構成においては、ピン７−ピン８間がショー
トしたとき、ピン５，６，７のオペアンプでは出力７ピ
ンの電圧がＶａｄ（８．４Ｖ）につり上げられることに
よりオペアンプには最大電流８８ｍＡが流れるので、Ｉ
Ｃ１の温度が非常に高くなる（表面温度１１４℃）。
【０００９】さらにこの温度上昇が起こっているにもか
かわらず、Ｖcom電圧は正常値であり、液晶パネルの画
像表示には変化が現れない。すなわち異常が起こってい
るにもかかわらず、異常に気づかない状態で使用すると
いう危険な状態が発生する。
かわらず、Ｖcom電圧は正常値であり、液晶パネルの画
像表示には変化が現れない。すなわち異常が起こってい
るにもかかわらず、異常に気づかない状態で使用すると
いう危険な状態が発生する。
【００１０】すなわち、ピン７とピン８との間がショー
トするなどの異常が起こっても、ユーザは異常に気づか
ない状態でオペアンプ接続回路を使用し続けるので危険
であるという課題がある。
トするなどの異常が起こっても、ユーザは異常に気づか
ない状態でオペアンプ接続回路を使用し続けるので危険
であるという課題がある。
【００１１】本発明は、上記課題を考慮し、異常が発生
した場合にはユーザが即座にその異常に気づくことが出
来る安全なオペアンプ接続回路およびオペアンプ接続方
法及び液晶表示装置を提供することを目的とするもので
ある。
した場合にはユーザが即座にその異常に気づくことが出
来る安全なオペアンプ接続回路およびオペアンプ接続方
法及び液晶表示装置を提供することを目的とするもので
ある。
【００１２】
【課題を解決するための手段】上述した課題を解決する
ために、第１の本発明（請求項１に対応）は、オペアン
プＩＣに設けられた入力端子及び出力端子を有し、その
入力及び出力がそれぞれ前記入力端子及び出力端子に接
続され、前記オペアンプＩＣ内に形成されたオペアンプ
複数個と、前記オペアンプＩＣに設けられ、前記オペア
ンプＩＣに電源電圧を供給するために電源端子とを備
え、複数個の前記オペアンプのうち一部のオペアンプが
使用され、それ以外のオペアンプが使用されない場合の
オペアンプ接続回路であって、複数個の前記オペアンプ
のうち、使用されない方のオペアンプの前記入力端子及
び出力端子は、使用される方のオペアンプの前記入力端
子及び出力端子より前記電源端子までの空間的距離が遠
いオペアンプ接続回路である。
ために、第１の本発明（請求項１に対応）は、オペアン
プＩＣに設けられた入力端子及び出力端子を有し、その
入力及び出力がそれぞれ前記入力端子及び出力端子に接
続され、前記オペアンプＩＣ内に形成されたオペアンプ
複数個と、前記オペアンプＩＣに設けられ、前記オペア
ンプＩＣに電源電圧を供給するために電源端子とを備
え、複数個の前記オペアンプのうち一部のオペアンプが
使用され、それ以外のオペアンプが使用されない場合の
オペアンプ接続回路であって、複数個の前記オペアンプ
のうち、使用されない方のオペアンプの前記入力端子及
び出力端子は、使用される方のオペアンプの前記入力端
子及び出力端子より前記電源端子までの空間的距離が遠
いオペアンプ接続回路である。
【００１３】また、第２の本発明（請求項２に対応）
は、前記オペアンプは２つの前記入力端子と１つの前記
出力端子とを有し、使用されない方の前記オペアンプの
それぞれについては、そのオペアンプの前記出力端子が
そのオペアンプの一方の前記入力端子に接続されてお
り、そのオペアンプの他方の前記入力端子は接地されて
おり、そのオペアンプの一方の前記入力端子及びそのオ
ペアンプの他方の前記入力端子及びそのオペアンプの前
記出力端子が前記電源端子と隣り合わないように配置さ
れている第１の本発明のオペアンプ接続回路である。
は、前記オペアンプは２つの前記入力端子と１つの前記
出力端子とを有し、使用されない方の前記オペアンプの
それぞれについては、そのオペアンプの前記出力端子が
そのオペアンプの一方の前記入力端子に接続されてお
り、そのオペアンプの他方の前記入力端子は接地されて
おり、そのオペアンプの一方の前記入力端子及びそのオ
ペアンプの他方の前記入力端子及びそのオペアンプの前
記出力端子が前記電源端子と隣り合わないように配置さ
れている第１の本発明のオペアンプ接続回路である。
【００１４】また、第３の本発明（請求項３に対応）
は、使用される方の前記オペアンプのぞれぞれについて
は、そのオペアンプの前記出力端子がそのオペアンプの
一方の前記入力端子に接続されており、そのオペアンプ
の他方の前記入力端子がバイアス電圧または画像信号ま
たは画像制御信号に接続されている第２の本発明のオペ
アンプ接続回路である。
は、使用される方の前記オペアンプのぞれぞれについて
は、そのオペアンプの前記出力端子がそのオペアンプの
一方の前記入力端子に接続されており、そのオペアンプ
の他方の前記入力端子がバイアス電圧または画像信号ま
たは画像制御信号に接続されている第２の本発明のオペ
アンプ接続回路である。
【００１５】また、第４の本発明（請求項４に対応）
は、前記複数個とは２個であり、複数個の前記オペアン
プのうち一部のオペアンプが使用され、それ以外のオペ
アンプが使用されない場合とは、前記２個のオペアンプ
のうちいずれか一方のオペアンプが使用され、他方のオ
ペアンプが使用されない場合である第１〜３の本発明の
いずれかのオペアンプ接続回路である。
は、前記複数個とは２個であり、複数個の前記オペアン
プのうち一部のオペアンプが使用され、それ以外のオペ
アンプが使用されない場合とは、前記２個のオペアンプ
のうちいずれか一方のオペアンプが使用され、他方のオ
ペアンプが使用されない場合である第１〜３の本発明の
いずれかのオペアンプ接続回路である。
【００１６】また、第５の本発明（請求項５に対応）
は、オペアンプＩＣに設けられた入力端子及び出力端子
を有し、その入力及び出力がそれぞれ前記入力端子及び
出力端子に接続され、前記オペアンプＩＣ内に形成され
たオペアンプ複数個と、前記オペアンプＩＣに設けら
れ、前記オペアンプＩＣに電源電圧を供給するために電
源端子とを備え、複数個の前記オペアンプのうち一部の
オペアンプが使用され、それ以外のオペアンプが使用さ
れない場合のオペアンプ接続方法であって、複数個の前
記オペアンプのうち、使用されない方のオペアンプの前
記入力端子及び出力端子を、使用される方のオペアンプ
の前記入力端子及び出力端子より前記電源端子までの空
間的距離が遠いように配置するオペアンプ接続方法であ
る。
は、オペアンプＩＣに設けられた入力端子及び出力端子
を有し、その入力及び出力がそれぞれ前記入力端子及び
出力端子に接続され、前記オペアンプＩＣ内に形成され
たオペアンプ複数個と、前記オペアンプＩＣに設けら
れ、前記オペアンプＩＣに電源電圧を供給するために電
源端子とを備え、複数個の前記オペアンプのうち一部の
オペアンプが使用され、それ以外のオペアンプが使用さ
れない場合のオペアンプ接続方法であって、複数個の前
記オペアンプのうち、使用されない方のオペアンプの前
記入力端子及び出力端子を、使用される方のオペアンプ
の前記入力端子及び出力端子より前記電源端子までの空
間的距離が遠いように配置するオペアンプ接続方法であ
る。
【００１７】また、第６の本発明（請求項６に対応）
は、前記オペアンプは２つの前記入力端子と１つの前記
出力端子とを有し、使用されない方の前記オペアンプの
それぞれについては、そのオペアンプの前記出力端子を
そのオペアンプの一方の前記入力端子に接続し、そのオ
ペアンプの他方の前記入力端子を接地し、そのオペアン
プの一方の前記入力端子及びそのオペアンプの他方の前
記入力端子及びそのオペアンプの前記出力端子が前記電
源端子と隣り合わないように配置する第５の本発明のオ
ペアンプ接続方法である。
は、前記オペアンプは２つの前記入力端子と１つの前記
出力端子とを有し、使用されない方の前記オペアンプの
それぞれについては、そのオペアンプの前記出力端子を
そのオペアンプの一方の前記入力端子に接続し、そのオ
ペアンプの他方の前記入力端子を接地し、そのオペアン
プの一方の前記入力端子及びそのオペアンプの他方の前
記入力端子及びそのオペアンプの前記出力端子が前記電
源端子と隣り合わないように配置する第５の本発明のオ
ペアンプ接続方法である。
【００１８】また、第７の本発明（請求項７に対応）
は、使用される方の前記オペアンプのぞれぞれについて
は、そのオペアンプの前記出力端子をそのオペアンプの
一方の前記入力端子に接続し、そのオペアンプの他方の
前記入力端子をバイアス電圧または画像信号または画像
制御信号に接続する第６の本発明のオペアンプ接続方法
である。
は、使用される方の前記オペアンプのぞれぞれについて
は、そのオペアンプの前記出力端子をそのオペアンプの
一方の前記入力端子に接続し、そのオペアンプの他方の
前記入力端子をバイアス電圧または画像信号または画像
制御信号に接続する第６の本発明のオペアンプ接続方法
である。
【００１９】また、第８の本発明（請求項８に対応）
は、前記複数個とは２個であり、複数個の前記オペアン
プのうち一部のオペアンプが使用され、それ以外のオペ
アンプが使用されない場合とは、前記２個のオペアンプ
のうちいずれか一方のオペアンプが使用され、他方のオ
ペアンプが使用されない場合である第５〜７の本発明の
いずれかのオペアンプ接続方法である。
は、前記複数個とは２個であり、複数個の前記オペアン
プのうち一部のオペアンプが使用され、それ以外のオペ
アンプが使用されない場合とは、前記２個のオペアンプ
のうちいずれか一方のオペアンプが使用され、他方のオ
ペアンプが使用されない場合である第５〜７の本発明の
いずれかのオペアンプ接続方法である。
【００２０】また、第９の本発明（請求項９に対応）
は、第１〜４のいずれかに記載のオペアンプ接続回路を
用いたオペアンプＩＣと、液晶表示パネルとを備え、前
記オペアンプ接続回路により前記液晶表示パネルに共通
電圧が供給される液晶表示装置である。
は、第１〜４のいずれかに記載のオペアンプ接続回路を
用いたオペアンプＩＣと、液晶表示パネルとを備え、前
記オペアンプ接続回路により前記液晶表示パネルに共通
電圧が供給される液晶表示装置である。
【００２１】例えば、本発明のオペアンプ接続回路は、
一例としてＶcom電圧をオペアンプ５，６，７で構成
し、未使用オペアンプを１，２，３で構成している。す
なわち使用オペアンプと未使用オペアンプを交換してい
る。
一例としてＶcom電圧をオペアンプ５，６，７で構成
し、未使用オペアンプを１，２，３で構成している。す
なわち使用オペアンプと未使用オペアンプを交換してい
る。
【００２２】本発明は前記した構成により、ピン７−ピ
ン８間がショートしたときＶcom電圧が８．４Ｖまでつ
り上げられるため、画像は約１／５だけ暗くなり、はっ
きりと画像変化に気づき、異常であることがわかる。
ン８間がショートしたときＶcom電圧が８．４Ｖまでつ
り上げられるため、画像は約１／５だけ暗くなり、はっ
きりと画像変化に気づき、異常であることがわかる。
【００２３】また、本発明は前記した構成により、ピン
７−ピン８間がショートしたときＶcom電圧が８．４Ｖ
までつり上げられるが、入力電圧は従来の接続回路では
０Ｖ→８．４Ｖの変化に比べ、本発明の回路では約３．
２Ｖ→８．４Ｖの変化とちいさくなり、ＩＣ１の温度上
昇は小さくなる（表面温度98.3℃）。
７−ピン８間がショートしたときＶcom電圧が８．４Ｖ
までつり上げられるが、入力電圧は従来の接続回路では
０Ｖ→８．４Ｖの変化に比べ、本発明の回路では約３．
２Ｖ→８．４Ｖの変化とちいさくなり、ＩＣ１の温度上
昇は小さくなる（表面温度98.3℃）。
【００２４】このように本発明のオペアンプ接続回路は
異常がわかり、また温度上昇も少なくできるというもの
である。
異常がわかり、また温度上昇も少なくできるというもの
である。
【００２５】
【発明の実施の形態】以下に、本発明の実施の形態を図
面を参照して説明する。
面を参照して説明する。
【００２６】図１は本発明の実施の形態におけるオペア
ンプ接続回路の回路図を示すものである。以下、図１に
基づいて本発明のオペアンプ接続回路及びオペアンプ接
続方法の実施の形態について説明する。
ンプ接続回路の回路図を示すものである。以下、図１に
基づいて本発明のオペアンプ接続回路及びオペアンプ接
続方法の実施の形態について説明する。
【００２７】図１において、Ｒ１，Ｒ２はそれぞれ抵抗
であり、ＶＲ１はボリュームであり、Ｃ１はコンデンサ
であり、ＩＣ１はオペアンプ２個を内蔵したＩＣであ
る。また、ピン４は接地用のピンであり、ピン８はオペ
アンプＩＣ１に電源を供給するためのピンである。ＩＣ
１に内蔵されたオペアンプのうち一方のオペアンプは入
力ピン２、３と出力ピン１を有する。また他方のオペア
ンプは入力ピン５、６と出力ピン７を有する。図２に示
すように、入力ピン２、３及び出力ピン１はピン８とは
隣り合わないような位置に配置されている。すなわち、
入力ピン２、３及び出力ピン１は入力ピン５、６及び出
力ピン７よりピン８までの空間的な距離が遠くなるよう
に配置されている。また、出力ピン７は、図示していな
い液晶表示パネルの共通電極に接続されている。
であり、ＶＲ１はボリュームであり、Ｃ１はコンデンサ
であり、ＩＣ１はオペアンプ２個を内蔵したＩＣであ
る。また、ピン４は接地用のピンであり、ピン８はオペ
アンプＩＣ１に電源を供給するためのピンである。ＩＣ
１に内蔵されたオペアンプのうち一方のオペアンプは入
力ピン２、３と出力ピン１を有する。また他方のオペア
ンプは入力ピン５、６と出力ピン７を有する。図２に示
すように、入力ピン２、３及び出力ピン１はピン８とは
隣り合わないような位置に配置されている。すなわち、
入力ピン２、３及び出力ピン１は入力ピン５、６及び出
力ピン７よりピン８までの空間的な距離が遠くなるよう
に配置されている。また、出力ピン７は、図示していな
い液晶表示パネルの共通電極に接続されている。
【００２８】次に、このような本実施の形態の動作を説
明する。
明する。
【００２９】ＩＣ１のピン５，６，７のオペアンプは抵
抗Ｒ１，Ｒ２及びＶＲ１により、調整されたVcom-F電圧
をコンデンサＣ１により安定した電圧がオペアンプの入
力ピン５に入力され、出力ピン７は入力ピン６に接続さ
れＶcomに接続されている。オペアンプには次の２つの
特徴がある。まず、第１の特徴としては、入力差電圧を
ゼロに保つという特徴がある。また、第２の特徴とし
て、出力インピーダンスが小さいという特徴がある。こ
れらの特徴により、インピーダンス変換した電圧が出力
され、この電圧によって、安定したＶcomが供給され、
フリッカの小さい液晶表示パネルが実現できる。また、
ＩＣ１の１，２，３からなるオペアンプは未使用であ
り、その配線としてはもっとも安定するよう出力７ピン
を入力６ピンに接続し、入力ピン５を接地している。
抗Ｒ１，Ｒ２及びＶＲ１により、調整されたVcom-F電圧
をコンデンサＣ１により安定した電圧がオペアンプの入
力ピン５に入力され、出力ピン７は入力ピン６に接続さ
れＶcomに接続されている。オペアンプには次の２つの
特徴がある。まず、第１の特徴としては、入力差電圧を
ゼロに保つという特徴がある。また、第２の特徴とし
て、出力インピーダンスが小さいという特徴がある。こ
れらの特徴により、インピーダンス変換した電圧が出力
され、この電圧によって、安定したＶcomが供給され、
フリッカの小さい液晶表示パネルが実現できる。また、
ＩＣ１の１，２，３からなるオペアンプは未使用であ
り、その配線としてはもっとも安定するよう出力７ピン
を入力６ピンに接続し、入力ピン５を接地している。
【００３０】本実施の形態においてピン７−ピン８間の
ショートがあった場合にはＶcom電圧が８．４Ｖにつり
上げられるため、液晶表示パネルの画面が暗くなる（明
るさ約１／５）。つまり、液晶表示パネルの共通電極と
画素電極との間の電位差が小さくなるので、その共通電
極と画素電極との間に狭持されている液晶層に加えられ
る電場が弱くなる。従って、液晶表示パネルの画面が暗
くなる。また７ピン電圧が約３．２Ｖあるため７ピン−
８ピン差は従来例の８．４Ｖに比べ５．２Ｖと小さくな
るためＩＣ１の温度上昇は小さくなる（従来例で表面温
度１１４℃→本発明例の表面温度９８．３℃）。
ショートがあった場合にはＶcom電圧が８．４Ｖにつり
上げられるため、液晶表示パネルの画面が暗くなる（明
るさ約１／５）。つまり、液晶表示パネルの共通電極と
画素電極との間の電位差が小さくなるので、その共通電
極と画素電極との間に狭持されている液晶層に加えられ
る電場が弱くなる。従って、液晶表示パネルの画面が暗
くなる。また７ピン電圧が約３．２Ｖあるため７ピン−
８ピン差は従来例の８．４Ｖに比べ５．２Ｖと小さくな
るためＩＣ１の温度上昇は小さくなる（従来例で表面温
度１１４℃→本発明例の表面温度９８．３℃）。
【００３１】このように、本実施の形態のオペアンプ接
続回路によれば、ピン７とピン８との間に導電性のゴミ
や、オペアンプ接続回路を実装する際に使用するはんだ
などによりショートが発生した際には、液晶表示パネル
の画面が暗くなるので、ユーザは即座にオペアンプ接続
回路の異常に気づくことが出来るので、異常が起こって
も安全である。
続回路によれば、ピン７とピン８との間に導電性のゴミ
や、オペアンプ接続回路を実装する際に使用するはんだ
などによりショートが発生した際には、液晶表示パネル
の画面が暗くなるので、ユーザは即座にオペアンプ接続
回路の異常に気づくことが出来るので、異常が起こって
も安全である。
【００３２】つまり、電源Ｖad側に設置されたオペアン
プにＶcom電圧バイアスを設けることにより、出力ピン
７−電源ピン８がショートしたときにはＶcomが上昇し
画面が暗くなり、はっきりと異常であることがわかる。
また電源Ｖad側に設置されたオペアンプの入力が約３．
２Ｖであり、従来よりピン８との電圧差が小さくなって
いるため温度上昇が小さいという特徴があり、その実用
的効果は大きい。
プにＶcom電圧バイアスを設けることにより、出力ピン
７−電源ピン８がショートしたときにはＶcomが上昇し
画面が暗くなり、はっきりと異常であることがわかる。
また電源Ｖad側に設置されたオペアンプの入力が約３．
２Ｖであり、従来よりピン８との電圧差が小さくなって
いるため温度上昇が小さいという特徴があり、その実用
的効果は大きい。
【００３３】なお、本実施の形態のＩＣ１は本発明のオ
ペアンプＩＣの例であり、本実施の形態のピン１、２、
３を有するオペアンプは本発明の使用されない方のオペ
アンプの例であり、本実施の形態のピン５、６、７を有
するオペアンプは本発明の使用する方のオペアンプの例
である。
ペアンプＩＣの例であり、本実施の形態のピン１、２、
３を有するオペアンプは本発明の使用されない方のオペ
アンプの例であり、本実施の形態のピン５、６、７を有
するオペアンプは本発明の使用する方のオペアンプの例
である。
【００３４】なお、本実施の形態では、ＩＣ１にオペア
ンプが２つ内蔵されている場合について説明したが、こ
れに限らず３つ以上のオペアンプが内蔵されていても構
わない。３つ以上のオペアンプが内蔵されている場合に
は、それらのオペアンプのうち使用する方のオペアンプ
の各ピンを使用されない方のオペアンプの各ピンよりも
ピン８に空間的に近接するように配置すればよい。
ンプが２つ内蔵されている場合について説明したが、こ
れに限らず３つ以上のオペアンプが内蔵されていても構
わない。３つ以上のオペアンプが内蔵されている場合に
は、それらのオペアンプのうち使用する方のオペアンプ
の各ピンを使用されない方のオペアンプの各ピンよりも
ピン８に空間的に近接するように配置すればよい。
【００３５】さらに、本実施の形態では、ＩＣ１に内蔵
さているオペアンプが２つの入力と１つの出力とを有す
る場合について説明したが、これに限らず。ＩＣ１に内
蔵されているオペアンプが２つ以上の入力を有しても構
わないし、またＩＣ１に内蔵されているオペアンプが２
つ以上の出力を有しても構わない。
さているオペアンプが２つの入力と１つの出力とを有す
る場合について説明したが、これに限らず。ＩＣ１に内
蔵されているオペアンプが２つ以上の入力を有しても構
わないし、またＩＣ１に内蔵されているオペアンプが２
つ以上の出力を有しても構わない。
【００３６】さらに、本実施の形態では、ピン７−ピン
８間のショートがあった場合にはＶcom電圧が８．４Ｖ
につり上げられるため、液晶表示パネルの画面が暗くな
るとして説明したが、これは、液晶表示パネルがノーマ
リブラックの液晶表示パネルの場合であって、液晶表示
パネルがノーマリホワイトの液晶表示パネルの場合に
は、ピン７−ピン８間のショートがあった場合にはＶco
m電圧が８．４Ｖにつり上げられるため、液晶表示パネ
ルの画面が白くなる。いずれの液晶表示パネルであって
もピン７−ピン８間のショートがあった場合には液晶表
示パネルの画面が通常とは異なる画面に変化するのでユ
ーザが即座に異常に気づくことが出来る。
８間のショートがあった場合にはＶcom電圧が８．４Ｖ
につり上げられるため、液晶表示パネルの画面が暗くな
るとして説明したが、これは、液晶表示パネルがノーマ
リブラックの液晶表示パネルの場合であって、液晶表示
パネルがノーマリホワイトの液晶表示パネルの場合に
は、ピン７−ピン８間のショートがあった場合にはＶco
m電圧が８．４Ｖにつり上げられるため、液晶表示パネ
ルの画面が白くなる。いずれの液晶表示パネルであって
もピン７−ピン８間のショートがあった場合には液晶表
示パネルの画面が通常とは異なる画面に変化するのでユ
ーザが即座に異常に気づくことが出来る。
【００３７】さらに、本実施の形態では、オペアンプ接
続回路のピン７が液晶表示パネルの共通電極に接続され
ているとして説明したが、これに限らない。本実施の形
態のオペアンプ接続回路を無線通信機器、オーディオ機
器などの液晶表示パネル以外の機器にも使用することが
出来る。例えば、オーディオ機器のオーディオ回路の基
準電圧に本実施の形態のピン７を接続すれば、ピン７−
ピン８間のショートがあった場合にはオーディオ機器か
ら出力される音が小さくなったりあるいは歪むことにな
るため、オーディオ機器のユーザは即座に異常に気づく
ことが出来る。
続回路のピン７が液晶表示パネルの共通電極に接続され
ているとして説明したが、これに限らない。本実施の形
態のオペアンプ接続回路を無線通信機器、オーディオ機
器などの液晶表示パネル以外の機器にも使用することが
出来る。例えば、オーディオ機器のオーディオ回路の基
準電圧に本実施の形態のピン７を接続すれば、ピン７−
ピン８間のショートがあった場合にはオーディオ機器か
ら出力される音が小さくなったりあるいは歪むことにな
るため、オーディオ機器のユーザは即座に異常に気づく
ことが出来る。
【００３８】なお、本発明のオペアンプＩＣと、液晶表
示パネルとを備え、前記オペアンプ接続回路により前記
液晶表示パネルに共通電圧が供給される液晶表示装置も
本発明に属する。
示パネルとを備え、前記オペアンプ接続回路により前記
液晶表示パネルに共通電圧が供給される液晶表示装置も
本発明に属する。
【００３９】
【発明の効果】以上説明したところから明らかなよう
に、本発明は、異常が発生した場合にはユーザが即座に
その異常に気づくことが出来る安全なオペアンプ接続回
路およびオペアンプ接続方法および液晶表示装置を提供
することが出来る。
に、本発明は、異常が発生した場合にはユーザが即座に
その異常に気づくことが出来る安全なオペアンプ接続回
路およびオペアンプ接続方法および液晶表示装置を提供
することが出来る。
【図１】本発明の実施の形態におけるオペアンプ接続回
路を示す図
路を示す図
【図２】従来のオペアンプ接続回路を示す図
Ｒ１ Vcom-F電圧バイアス抵抗
Ｒ２ Vcom-F電圧バイアス抵抗
ＶＲ１ Vcom-F電圧調整用ボリューム抵抗
ＩＣ１ Vcom電圧供給用ＩＣ
─────────────────────────────────────────────────────
フロントページの続き
(51)Int.Cl.7 識別記号 ＦＩ テーマコート゛(参考）
Ｇ０９Ｇ 3/36 Ｇ０９Ｇ 3/36
Ｆターム(参考） 2H093 NC02 NC21 NC90
5C006 AC25 BB16 BF25 EB01 EB04
5C080 AA10 BB05 DD19 DD20 FF11
JJ03
5J090 AA01 AA47 CA02 CN01 FA16
HA25 HA29 KA67 MA21 TA01
5J500 AA01 AA47 AC02 AF16 AH25
AH29 AK67 AM21 AT01 NC01
Claims (9)
- 【請求項１】 オペアンプＩＣに設けられた入力端子及
び出力端子を有し、その入力及び出力がそれぞれ前記入
力端子及び出力端子に接続され、前記オペアンプＩＣ内
に形成されたオペアンプ複数個と、 前記オペアンプＩＣに設けられ、前記オペアンプＩＣに
電源電圧を供給するために電源端子とを備え、 複数個の前記オペアンプのうち一部のオペアンプが使用
され、それ以外のオペアンプが使用されない場合のオペ
アンプ接続回路であって、 複数個の前記オペアンプのうち、使用されない方のオペ
アンプの前記入力端子及び出力端子は、使用される方の
オペアンプの前記入力端子及び出力端子より前記電源端
子までの空間的距離が遠いオペアンプ接続回路。 - 【請求項２】 前記オペアンプは２つの前記入力端子と
１つの前記出力端子とを有し、 使用されない方の前記オペアンプのそれぞれについて
は、そのオペアンプの前記出力端子がそのオペアンプの
一方の前記入力端子に接続されており、そのオペアンプ
の他方の前記入力端子は接地されており、そのオペアン
プの一方の前記入力端子及びそのオペアンプの他方の前
記入力端子及びそのオペアンプの前記出力端子が前記電
源端子と隣り合わないように配置されている請求項１記
載のオペアンプ接続回路。 - 【請求項３】 使用される方の前記オペアンプのぞれぞ
れについては、そのオペアンプの前記出力端子がそのオ
ペアンプの一方の前記入力端子に接続されており、その
オペアンプの他方の前記入力端子がバイアス電圧または
画像信号または画像制御信号に接続されている請求項２
記載のオペアンプ接続回路。 - 【請求項４】 前記複数個とは２個であり、 複数個の前記オペアンプのうち一部のオペアンプが使用
され、それ以外のオペアンプが使用されない場合とは、
前記２個のオペアンプのうちいずれか一方のオペアンプ
が使用され、他方のオペアンプが使用されない場合であ
る請求項１〜３のいずれかに記載のオペアンプ接続回
路。 - 【請求項５】 オペアンプＩＣに設けられた入力端子及
び出力端子を有し、その入力及び出力がそれぞれ前記入
力端子及び出力端子に接続され、前記オペアンプＩＣ内
に形成されたオペアンプ複数個と、 前記オペアンプＩＣに設けられ、前記オペアンプＩＣに
電源電圧を供給するために電源端子とを備え、 複数個の前記オペアンプのうち一部のオペアンプが使用
され、それ以外のオペアンプが使用されない場合のオペ
アンプ接続方法であって、 複数個の前記オペアンプのうち、使用されない方のオペ
アンプの前記入力端子及び出力端子を、使用される方の
オペアンプの前記入力端子及び出力端子より前記電源端
子までの空間的距離が遠いように配置するオペアンプ接
続方法。 - 【請求項６】 前記オペアンプは２つの前記入力端子と
１つの前記出力端子とを有し、 使用されない方の前記オペアンプのそれぞれについて
は、そのオペアンプの前記出力端子をそのオペアンプの
一方の前記入力端子に接続し、そのオペアンプの他方の
前記入力端子を接地し、そのオペアンプの一方の前記入
力端子及びそのオペアンプの他方の前記入力端子及びそ
のオペアンプの前記出力端子が前記電源端子と隣り合わ
ないように配置する請求項５記載のオペアンプ接続方
法。 - 【請求項７】 使用される方の前記オペアンプのぞれぞ
れについては、そのオペアンプの前記出力端子をそのオ
ペアンプの一方の前記入力端子に接続し、そのオペアン
プの他方の前記入力端子をバイアス電圧または画像信号
または画像制御信号に接続する請求項６記載のオペアン
プ接続方法。 - 【請求項８】 前記複数個とは２個であり、 複数個の前記オペアンプのうち一部のオペアンプが使用
され、それ以外のオペアンプが使用されない場合とは、
前記２個のオペアンプのうちいずれか一方のオペアンプ
が使用され、他方のオペアンプが使用されない場合であ
る請求項５〜７のいずれかに記載のオペアンプ接続方
法。 - 【請求項９】 請求項１〜４のいずれかに記載のオペア
ンプ接続回路を用いたオペアンプＩＣと、 液晶表示パネルとを備え、 前記オペアンプ接続回路により前記液晶表示パネルに共
通電圧が供給される液晶表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2001310569A JP2003115724A (ja) | 2001-10-05 | 2001-10-05 | オペアンプ接続回路及びオペアンプ接続方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2001310569A JP2003115724A (ja) | 2001-10-05 | 2001-10-05 | オペアンプ接続回路及びオペアンプ接続方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2003115724A true JP2003115724A (ja) | 2003-04-18 |
Family
ID=19129517
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2001310569A Pending JP2003115724A (ja) | 2001-10-05 | 2001-10-05 | オペアンプ接続回路及びオペアンプ接続方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2003115724A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1737032A1 (en) * | 2004-03-23 | 2006-12-27 | Rohm Co., Ltd. | Semiconductor integrated circuit device and switching power source device using the same |
-
2001
- 2001-10-05 JP JP2001310569A patent/JP2003115724A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1737032A1 (en) * | 2004-03-23 | 2006-12-27 | Rohm Co., Ltd. | Semiconductor integrated circuit device and switching power source device using the same |
| EP1737032A4 (en) * | 2004-03-23 | 2008-05-28 | Rohm Co Ltd | SEMICONDUCTOR INTEGRATED CIRCUIT DEVICE AND SWITCHING POWER SUPPLY SOURCE DEVICE USING THE SAME |
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