JP2002313983A - 半導体装置 - Google Patents
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- H01L2924/1531—Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
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Landscapes
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Abstract
(57)【要約】
【課題】バンプを外部電極に持つ半導体パッケージにお
いて部材の耐熱性に問題がある場合の半導体装置のバン
プ形成、基板実装をPbを含まないはんだで実現する。 【解決手段】はんだにPbを含まず、しかもバンプ形成
が220℃で可能な材料系として、Sn−Zn、あるい
はこれにBiを添加した組成のはんだをバンプ材料にす
ることにより、バンプ形成温度、および基板実装温度を
をSn−Pb共晶はんだと同等レベルにする事ができ
る。
いて部材の耐熱性に問題がある場合の半導体装置のバン
プ形成、基板実装をPbを含まないはんだで実現する。 【解決手段】はんだにPbを含まず、しかもバンプ形成
が220℃で可能な材料系として、Sn−Zn、あるい
はこれにBiを添加した組成のはんだをバンプ材料にす
ることにより、バンプ形成温度、および基板実装温度を
をSn−Pb共晶はんだと同等レベルにする事ができ
る。
Description
【0001】
【発明の属する技術分野】本発明はBGA(Ball Grid
Allay)、CSP(Chip Size Package)、WPP(Wafe
r Process Package)、などのバンプを外部電極に持つ
半導体装置に関する。
Allay)、CSP(Chip Size Package)、WPP(Wafe
r Process Package)、などのバンプを外部電極に持つ
半導体装置に関する。
【0002】
【従来の技術】BGA、CSP、WPPなど、バンプを
外部電極に持つ半導体装置の需要が増大している。これ
らのバンプを外部電極に持つ半導体装置は例えば、銅
(Cu)の表面にニッケル−金(Ni/Au)、ニッケ
ル−パラジウム−金(Ni/Pd/Au)めっきを施し
た電極パターンにフラックスを印刷により塗布し、その
上にはんだボールを各電極に搭載し、リフロ加熱するこ
とによりバンプを形成する。
外部電極に持つ半導体装置の需要が増大している。これ
らのバンプを外部電極に持つ半導体装置は例えば、銅
(Cu)の表面にニッケル−金(Ni/Au)、ニッケ
ル−パラジウム−金(Ni/Pd/Au)めっきを施し
た電極パターンにフラックスを印刷により塗布し、その
上にはんだボールを各電極に搭載し、リフロ加熱するこ
とによりバンプを形成する。
【0003】通常、バンプや実装用に用いられる材料は
Sn−38mass%PbのいわゆるSn−Pb共晶は
んだである。このはんだ材料は電子部品のはんだ付け
(実装)に長年用いられている材料で歴史も古く、はん
だ接合部の信頼性も高く、非常に優れた材料である。
Sn−38mass%PbのいわゆるSn−Pb共晶は
んだである。このはんだ材料は電子部品のはんだ付け
(実装)に長年用いられている材料で歴史も古く、はん
だ接合部の信頼性も高く、非常に優れた材料である。
【0004】ところが、最近になって、地下水のPb汚
染が懸念されており、その原因の一つに廃棄電化製品の
はんだに含まれるPbの溶出があげられている。これに
伴って、電化製品におけるPbの使用を自主的に廃止す
る動きになっており、Pbを含まない、いわゆるPbフ
リーはんだの実用化が急がれている。
染が懸念されており、その原因の一つに廃棄電化製品の
はんだに含まれるPbの溶出があげられている。これに
伴って、電化製品におけるPbの使用を自主的に廃止す
る動きになっており、Pbを含まない、いわゆるPbフ
リーはんだの実用化が急がれている。
【0005】
【発明が解決しようとする課題】Pbフリーはんだ材料
では例えば、Sn−Pbはんだ材料と同等の材料特性を
有し、ボール製造コストもほぼSn−Pbはんだとほぼ
同等である材料組成の一つであるSn−0〜3.5Ag
−0〜1Cuがバンプ材料として有力になっている。と
ころが、Sn−Ag−Cu系はんだの融点は216℃か
ら227℃の範囲であり、従来のSn−Pb共晶はんだ
よりも30〜40℃高い。したがって、Sn−Ag−C
u組成のはんだを用いて半導体装置にバンプを形成する
ときの温度は240〜250℃と非常に高くなり、部品
によっては耐熱性が確保できない懸念がある。
では例えば、Sn−Pbはんだ材料と同等の材料特性を
有し、ボール製造コストもほぼSn−Pbはんだとほぼ
同等である材料組成の一つであるSn−0〜3.5Ag
−0〜1Cuがバンプ材料として有力になっている。と
ころが、Sn−Ag−Cu系はんだの融点は216℃か
ら227℃の範囲であり、従来のSn−Pb共晶はんだ
よりも30〜40℃高い。したがって、Sn−Ag−C
u組成のはんだを用いて半導体装置にバンプを形成する
ときの温度は240〜250℃と非常に高くなり、部品
によっては耐熱性が確保できない懸念がある。
【0006】したがって、バンプの組成にPbを含ま
ず、しかも、従来のSn−Pb共晶はんだと同じ温度で
のバンプの形成が重要となっている。
ず、しかも、従来のSn−Pb共晶はんだと同じ温度で
のバンプの形成が重要となっている。
【0007】
【課題を解決するための手段】本発明の目的を達成する
ために、はんだにPbを含まず、しかもバンプ形成が2
20℃で可能な材料系として、Sn−Zn系がSn−9
%Znの組成で199℃の融点であることに着目し、S
n−Zn系のはんだをバンプ材料にすることにより、バ
ンプ形成温度をSn−Pb共晶はんだなみにする事がで
きる。
ために、はんだにPbを含まず、しかもバンプ形成が2
20℃で可能な材料系として、Sn−Zn系がSn−9
%Znの組成で199℃の融点であることに着目し、S
n−Zn系のはんだをバンプ材料にすることにより、バ
ンプ形成温度をSn−Pb共晶はんだなみにする事がで
きる。
【0008】
【発明の実施の形態】以下、本発明の実施の形態をいく
つかの実施例を用い、図面を参照して説明する。図1は
本発明本発明で使用したサンプルの概略である。パッケ
ージ寸法は30×30mm、中のダミーチップ3の大き
さは10×10mmである。バンプ5はφ0.76mm
である。なお、一方、パッケージのパッド径はφ0.6
mmで、電極10材質はCuでメタライズはNi(10
〜25mm)/Auめっき(0.5〜1.2mm)とし
た。Sn−8Zn−3Biバンプ5の形成方法には半導
体装置の電極表面10にフラックスを印刷紙した後、ボ
ール転写し、リフロ加熱する方法とはんだ粒子とフラッ
クスが混合したはんだペーストをパッドに印刷した後、
リフロ加熱する方法があり、Sn−Znはんだの場合は
どちらの方法でもバンプ形成は可能である。そのときの
加熱温度はSn−Pb共晶はんだで一般的に採用されて
いる220℃で行った。この温度でバンプ5は溶融し、
電極10と接合されバンプ9の形状となる。
つかの実施例を用い、図面を参照して説明する。図1は
本発明本発明で使用したサンプルの概略である。パッケ
ージ寸法は30×30mm、中のダミーチップ3の大き
さは10×10mmである。バンプ5はφ0.76mm
である。なお、一方、パッケージのパッド径はφ0.6
mmで、電極10材質はCuでメタライズはNi(10
〜25mm)/Auめっき(0.5〜1.2mm)とし
た。Sn−8Zn−3Biバンプ5の形成方法には半導
体装置の電極表面10にフラックスを印刷紙した後、ボ
ール転写し、リフロ加熱する方法とはんだ粒子とフラッ
クスが混合したはんだペーストをパッドに印刷した後、
リフロ加熱する方法があり、Sn−Znはんだの場合は
どちらの方法でもバンプ形成は可能である。そのときの
加熱温度はSn−Pb共晶はんだで一般的に採用されて
いる220℃で行った。この温度でバンプ5は溶融し、
電極10と接合されバンプ9の形状となる。
【0009】FR−4などのプリント基板への実装は基
板8の電極にフラックス、またはフラックスを含んだ前
記はんだペースト6を印刷し、位置合わせ・搭載してリ
フロ加熱を行う。基板実装後の実装体の概略を図2に示
す。実装後のバンプ9の形状はSn−Pb共晶はんだの
それと同じである。
板8の電極にフラックス、またはフラックスを含んだ前
記はんだペースト6を印刷し、位置合わせ・搭載してリ
フロ加熱を行う。基板実装後の実装体の概略を図2に示
す。実装後のバンプ9の形状はSn−Pb共晶はんだの
それと同じである。
【0010】図3は本実施例のNiを下地にAuめっき
が施されているCu電極11にSn−8Zn―3Biは
んだバンプ5接合部の模式図である。接合界面にはNi
−Sn、Au−Znの合金層からなる反応層12が界面
付近に形成されるが、それらの層は薄く、高温放置を行
っても、合金層12はあまり成長しない。このときのバ
ンプの接合強度はせん断試験による評価で平均1200
g/バンプ(n=20)、プローブをはんだバンプに固
着して引っ張る加熱引っ張り試験による評価では平均約
2500g/バンプ(n=10)であった。このはんだを
搭載した半導体パッケージを125℃で長時間放置した
後、前記の強度評価を行ったところ、1000時間経過
後においても強度の低下は見られなかった。また、はん
だ中には細かな針上のBi相13が分散している。一般
にはんだのBiは強度信頼性に悪影響を与えるが、本実
施例の場合、Biのりょうは少ないため、強度に影響し
ない。なお、はんだ中のZnはCuと反応して合金を形
成しやすく、その成長速度も早い。しかもCuはSnと
もCu−Sn合金を形成し、この層も高温放置により厚
く成長する。したがって、電極メタライズがCuの場合
はZnは容易に反応して、界面にCu−Zn合金層を形
成し、しかも高温雰囲気で長時間放置されるとこの層が
厚く成長して、接合強度が低下する懸念があるので、電
極メタライズに、Cu、あるいはその表面にSnめっき
を選択する場合は必要が必要である。
が施されているCu電極11にSn−8Zn―3Biは
んだバンプ5接合部の模式図である。接合界面にはNi
−Sn、Au−Znの合金層からなる反応層12が界面
付近に形成されるが、それらの層は薄く、高温放置を行
っても、合金層12はあまり成長しない。このときのバ
ンプの接合強度はせん断試験による評価で平均1200
g/バンプ(n=20)、プローブをはんだバンプに固
着して引っ張る加熱引っ張り試験による評価では平均約
2500g/バンプ(n=10)であった。このはんだを
搭載した半導体パッケージを125℃で長時間放置した
後、前記の強度評価を行ったところ、1000時間経過
後においても強度の低下は見られなかった。また、はん
だ中には細かな針上のBi相13が分散している。一般
にはんだのBiは強度信頼性に悪影響を与えるが、本実
施例の場合、Biのりょうは少ないため、強度に影響し
ない。なお、はんだ中のZnはCuと反応して合金を形
成しやすく、その成長速度も早い。しかもCuはSnと
もCu−Sn合金を形成し、この層も高温放置により厚
く成長する。したがって、電極メタライズがCuの場合
はZnは容易に反応して、界面にCu−Zn合金層を形
成し、しかも高温雰囲気で長時間放置されるとこの層が
厚く成長して、接合強度が低下する懸念があるので、電
極メタライズに、Cu、あるいはその表面にSnめっき
を選択する場合は必要が必要である。
【0011】なお、Sn−8Zn−3Biバンプ搭載B
GAの基板実装品のついては、厚さ1mmの樹脂基板
(FR−4)に実装した場合、−55〜125℃で10
00サイクル終了後も問題となるクラックは発生してい
ない。
GAの基板実装品のついては、厚さ1mmの樹脂基板
(FR−4)に実装した場合、−55〜125℃で10
00サイクル終了後も問題となるクラックは発生してい
ない。
【0012】前記Sn−Zn系はんだバンプは、メモ
リ、ASIC、CPUといったいくつかの半導体を一つ
のモジュール、あるいはパッケージにまとめたマルチチ
ップモジュール(MCM)あるいはマルチチップパッケ
ージに応用できる。その一例を図4に示す。これはBG
A基板上にWPP(ウエハプロセスパッケージ、WaferP
rocess Package)あるいはウエハレベルCSPと呼ばれ
るシリコンチップ15に配線を施し、チップ上の電極1
6にはんだバンプ17を形成したパッケージ(以後、W
PPと呼ぶ)を搭載したものである。BGA基板4上に
WPPを複数個搭載した場合はMCMであり、一個だけ
の場合はFC−BGA(フリップチップBGA)であ
る。WPPのはんだバンプ17に例えばSn−0.75Cu
(融点227℃)やSn−0.5Sb(融点240℃)
を用い、実装基板用のはんだバンプ9にSn−8Zn−
3Biを用い、基板実装のときの加熱条件をSn−8Z
n−3Biの融点(198℃)近くに低くすることがで
きれば、BGA基板の上にあるWPPバンプ17はんだ
は溶融しない。したがって、高温系のPbフリーはんだ
を温度階層用はんだとしてもちいることが可能となる。
なお、図5の本実施例おけるBGA用バンプの径はφ0
76、ピッチは1.27mmであるのに対して、BGA
基板上のWPPのバンプ17の径はφ0.3、ピッチは
0.5mmである。
リ、ASIC、CPUといったいくつかの半導体を一つ
のモジュール、あるいはパッケージにまとめたマルチチ
ップモジュール(MCM)あるいはマルチチップパッケ
ージに応用できる。その一例を図4に示す。これはBG
A基板上にWPP(ウエハプロセスパッケージ、WaferP
rocess Package)あるいはウエハレベルCSPと呼ばれ
るシリコンチップ15に配線を施し、チップ上の電極1
6にはんだバンプ17を形成したパッケージ(以後、W
PPと呼ぶ)を搭載したものである。BGA基板4上に
WPPを複数個搭載した場合はMCMであり、一個だけ
の場合はFC−BGA(フリップチップBGA)であ
る。WPPのはんだバンプ17に例えばSn−0.75Cu
(融点227℃)やSn−0.5Sb(融点240℃)
を用い、実装基板用のはんだバンプ9にSn−8Zn−
3Biを用い、基板実装のときの加熱条件をSn−8Z
n−3Biの融点(198℃)近くに低くすることがで
きれば、BGA基板の上にあるWPPバンプ17はんだ
は溶融しない。したがって、高温系のPbフリーはんだ
を温度階層用はんだとしてもちいることが可能となる。
なお、図5の本実施例おけるBGA用バンプの径はφ0
76、ピッチは1.27mmであるのに対して、BGA
基板上のWPPのバンプ17の径はφ0.3、ピッチは
0.5mmである。
【0013】
【発明の効果】バンプを外部電極に持つ半導体装置をS
n−9%Znにする事でバンプ形成温度をSn−Pb共
晶はんだなみにする事ができ、耐熱性のない半導体装置
あるいは基板を実装することが可能となる。
n−9%Znにする事でバンプ形成温度をSn−Pb共
晶はんだなみにする事ができ、耐熱性のない半導体装置
あるいは基板を実装することが可能となる。
【図1】本実施で使用したBGAの概略を示す図であ
る。
る。
【図2】BGA実装後の概略を示す図である。
【図3】電極のメタライズがNi/Auめっきの場合の
リフロ加熱後の接合界面組織の模式図である。
リフロ加熱後の接合界面組織の模式図である。
【図4】MCM(FC−BGA)の概略図である。
1…モールド樹脂、2…金線、3…チップ、4…BGA
基板、5…はんだバンプ(Sn−Zn−Bi)、6…フ
ラックスまたははんだペースト、7…電極、8…実装用
基板、9…実装後のはんだバンプ(Sn−Zn−B
i)、10…BGA本体、11…BGA基板電極、12
…合金層(Sn−Ni、Au−Zn)、13…Bi、1
4…WPP用チップ、15…電極、16…はんだバン
プ、17…アンダーフィル。
基板、5…はんだバンプ(Sn−Zn−Bi)、6…フ
ラックスまたははんだペースト、7…電極、8…実装用
基板、9…実装後のはんだバンプ(Sn−Zn−B
i)、10…BGA本体、11…BGA基板電極、12
…合金層(Sn−Ni、Au−Zn)、13…Bi、1
4…WPP用チップ、15…電極、16…はんだバン
プ、17…アンダーフィル。
Claims (3)
- 【請求項1】 外部電極がはんだバンプである半導体装
置において、前記はんだバンプの組成がSn−8〜9Z
n、あるいはこれに添加元素としてBiが多くとも3%
含有された組成であることを特徴とする半導体装置。 - 【請求項2】 前記組成のはんだバンプを有する半導体
装置が複数個搭載されたモジュール。 - 【請求項3】 請求項1、2記載の半導体装置、モジュ
ールが搭載された電子機器。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
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JP2003234433A (ja) * | 2001-10-01 | 2003-08-22 | Matsushita Electric Ind Co Ltd | 半導体装置、半導体装置の実装方法、ならびに実装体およびその製造方法 |
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2001
- 2001-04-11 JP JP2001112154A patent/JP2002313983A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2003234433A (ja) * | 2001-10-01 | 2003-08-22 | Matsushita Electric Ind Co Ltd | 半導体装置、半導体装置の実装方法、ならびに実装体およびその製造方法 |
US6853077B2 (en) | 2001-10-01 | 2005-02-08 | Matsushita Electric Industrial Co., Ltd. | Semiconductor device, semiconductor packaging method, assembly and method for fabricating the same |
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