JP2002251170A - 液晶表示装置 - Google Patents
液晶表示装置Info
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- JP2002251170A JP2002251170A JP2001048781A JP2001048781A JP2002251170A JP 2002251170 A JP2002251170 A JP 2002251170A JP 2001048781 A JP2001048781 A JP 2001048781A JP 2001048781 A JP2001048781 A JP 2001048781A JP 2002251170 A JP2002251170 A JP 2002251170A
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Abstract
(57)【要約】
【課題】 アクティブマトリクス型液晶表示パネルにお
いて液晶に印加される電位の偏りを解消して、フリッカ
ーや焼き付きといった画質課題を生じることなく画像表
示品位を保つことができる液晶表示装置を提供する。 【解決手段】 画像信号に補正信号を重畳させる第１の
補正回路１を有し、補正信号は、液晶表示パネル５の特
性に起因して生じる、液晶画素に印加される電位の偏り
を補正するように調整される。
いて液晶に印加される電位の偏りを解消して、フリッカ
ーや焼き付きといった画質課題を生じることなく画像表
示品位を保つことができる液晶表示装置を提供する。 【解決手段】 画像信号に補正信号を重畳させる第１の
補正回路１を有し、補正信号は、液晶表示パネル５の特
性に起因して生じる、液晶画素に印加される電位の偏り
を補正するように調整される。
Description
【０００１】
【発明の属する技術分野】本発明は、アクティブマトリ
クス型液晶表示パネルを用いて、画像を表示する液晶表
示装置に関するものである。
クス型液晶表示パネルを用いて、画像を表示する液晶表
示装置に関するものである。
【０００２】
【従来の技術】液晶表示装置に用いられるアクティブマ
トリクス型液晶表示パネルの例が、図６に示される。ｍ
行ｎ列のマトリクス状に配置された液晶画素ＬＣ（ＬＣ
１１〜ＬＣｍｎ）に対して、個々の液晶画素を駆動する
ための画素制御用薄膜トランジスタＴ（Ｔ１１〜Ｔｍ
ｎ）が配置されている。各行毎に画素制御用薄膜トラン
ジスタＴのゲートが、行状のゲート線Ｙ（Ｙ１〜Ｙｍ）
にそれぞれ接続されている。各列毎に画素制御用薄膜ト
ランジスタＴのソースが、列状のソース線Ｘ（Ｘ１〜Ｘ
ｎ）にそれぞれ接続されている。各ゲート線Ｙは行制御
回路７に接続されている。各ソース線Ｘは、サンプリン
グ用薄膜トランジスタＴＳ（ＴＳ１〜ＴＳｎ）を介し
て、画像信号ＶＳＩＧが入力される端子に接続されてい
る。各サンプリング用薄膜トランジスタＴＳのゲート
は、列制御回路８に接続されている。
トリクス型液晶表示パネルの例が、図６に示される。ｍ
行ｎ列のマトリクス状に配置された液晶画素ＬＣ（ＬＣ
１１〜ＬＣｍｎ）に対して、個々の液晶画素を駆動する
ための画素制御用薄膜トランジスタＴ（Ｔ１１〜Ｔｍ
ｎ）が配置されている。各行毎に画素制御用薄膜トラン
ジスタＴのゲートが、行状のゲート線Ｙ（Ｙ１〜Ｙｍ）
にそれぞれ接続されている。各列毎に画素制御用薄膜ト
ランジスタＴのソースが、列状のソース線Ｘ（Ｘ１〜Ｘ
ｎ）にそれぞれ接続されている。各ゲート線Ｙは行制御
回路７に接続されている。各ソース線Ｘは、サンプリン
グ用薄膜トランジスタＴＳ（ＴＳ１〜ＴＳｎ）を介し
て、画像信号ＶＳＩＧが入力される端子に接続されてい
る。各サンプリング用薄膜トランジスタＴＳのゲート
は、列制御回路８に接続されている。
【０００３】次に図７を参照して、図６の液晶表示装置
の具体的な動作を説明する。行制御回路７は、外部の制
御回路から供給される制御信号に基づいて、各ゲート線
Ｘを線順次走査し、一水平期間（１Ｈ）毎に一行分の液
晶画素ＬＣを選択する。列制御回路８は、外部の制御回
路から供給される制御信号に基づいて、サンプリング用
薄膜トランジスタＴＳ（ＴＳ１〜ＴＳｎ）にサンプリン
グ信号Ｓ（Ｓ１〜Ｓｎ）を出力し、画像信号ＶＳＩＧを
各ソース線Ｘに順次サンプリングする。選択された１行
分の液晶画素ＬＣに点順次で画像信号ＶＳＩＧの書き込
みが行われる。液晶画素ＬＣに書き込まれた所定のレベ
ルの画像信号は、対向電極電位ＶＣとの間で一定期間保
持される。
の具体的な動作を説明する。行制御回路７は、外部の制
御回路から供給される制御信号に基づいて、各ゲート線
Ｘを線順次走査し、一水平期間（１Ｈ）毎に一行分の液
晶画素ＬＣを選択する。列制御回路８は、外部の制御回
路から供給される制御信号に基づいて、サンプリング用
薄膜トランジスタＴＳ（ＴＳ１〜ＴＳｎ）にサンプリン
グ信号Ｓ（Ｓ１〜Ｓｎ）を出力し、画像信号ＶＳＩＧを
各ソース線Ｘに順次サンプリングする。選択された１行
分の液晶画素ＬＣに点順次で画像信号ＶＳＩＧの書き込
みが行われる。液晶画素ＬＣに書き込まれた所定のレベ
ルの画像信号は、対向電極電位ＶＣとの間で一定期間保
持される。
【０００４】図８は、従来の液晶表示パネルの駆動回路
を示す。この回路は、反転及び非反転入力と出力端子を
持つ演算増幅器２と、抵抗Ｒ１，Ｒ２と、選択回路ＳＷ
１とを有する。この回路によれば、入力された画像信号
が、演算増幅器２と抵抗Ｒ１，Ｒ２により構成された反
転回路により反転され、非反転信号と、反転回路の出力
である反転信号とが、選択回路ＳＷ１により周期的に切
り替えられて、ＶＳＩＧとして液晶表示パネル５に入力
される。それにより、液晶画素ＬＣには直流電圧が印加
されない様になっている。
を示す。この回路は、反転及び非反転入力と出力端子を
持つ演算増幅器２と、抵抗Ｒ１，Ｒ２と、選択回路ＳＷ
１とを有する。この回路によれば、入力された画像信号
が、演算増幅器２と抵抗Ｒ１，Ｒ２により構成された反
転回路により反転され、非反転信号と、反転回路の出力
である反転信号とが、選択回路ＳＷ１により周期的に切
り替えられて、ＶＳＩＧとして液晶表示パネル５に入力
される。それにより、液晶画素ＬＣには直流電圧が印加
されない様になっている。
【０００５】
【発明が解決しようとする課題】サンプリング用薄膜ト
ランジスタＴＳは、短期間で画像信号ＶＳＩＧをソース
線Ｘにサンプリングする必要があるため、トランジスタ
サイズを大きくしてオン抵抗を低く抑えている。そのた
め、トランジスタのゲート−ソース間容量、およびゲー
ト−ドレイン間容量が大きく、サンプリング用薄膜トラ
ンジスタＴＳがオフする際、サンプリング信号Ｓのレベ
ル変化がゲート−ソース間容量もしくはゲート−ドレイ
ン間容量を通じてソース線Ｘの電位を低下させる、いわ
ゆるプッシュダウンが発生する。
ランジスタＴＳは、短期間で画像信号ＶＳＩＧをソース
線Ｘにサンプリングする必要があるため、トランジスタ
サイズを大きくしてオン抵抗を低く抑えている。そのた
め、トランジスタのゲート−ソース間容量、およびゲー
ト−ドレイン間容量が大きく、サンプリング用薄膜トラ
ンジスタＴＳがオフする際、サンプリング信号Ｓのレベ
ル変化がゲート−ソース間容量もしくはゲート−ドレイ
ン間容量を通じてソース線Ｘの電位を低下させる、いわ
ゆるプッシュダウンが発生する。
【０００６】プッシュダウン電圧は、液晶画素ＬＣが対
向電極電位ＶＣに対して正極性に書き込まれる時も、負
極性に書き込まれる時も常に一方向のオフセット電圧と
して作用する。また、ゲート線Ｙには、抵抗成分、およ
び容量成分が配線全体にわたって分布しているため、行
制御回路７から遠ざかるにつれてゲート波形がなまり、
画素制御用薄膜トランジスタＴにおけるプッシュダウン
電圧が、図９に示すように減少する。このため液晶表示
パネルの面内で、液晶画素に書き込まれる電位に偏りが
生じ、フリッカーや焼き付きといった画質課題を生じ
る。
向電極電位ＶＣに対して正極性に書き込まれる時も、負
極性に書き込まれる時も常に一方向のオフセット電圧と
して作用する。また、ゲート線Ｙには、抵抗成分、およ
び容量成分が配線全体にわたって分布しているため、行
制御回路７から遠ざかるにつれてゲート波形がなまり、
画素制御用薄膜トランジスタＴにおけるプッシュダウン
電圧が、図９に示すように減少する。このため液晶表示
パネルの面内で、液晶画素に書き込まれる電位に偏りが
生じ、フリッカーや焼き付きといった画質課題を生じ
る。
【０００７】図１０に、従来例のプッシュダウン電圧が
発生したときの液晶画素の電位を示す。図には、反転期
間と非反転期間が同時に示されている。画素電位は、サ
ンプリング用薄膜トランジスタＴＳによりサンプリング
された、それぞれの液晶画素の電位をプロットしたもの
である。通常反転期間と非反転期間の比率は同じに制御
することから、液晶画素の電位は平均すると、図中に示
す画素中心電位となる。対向電極電位ＶＣは、通常フリ
ッカーや焼き付きを防ぐために、画素中心電位に調整さ
れる。従って図に示すように従来例では、液晶表示パネ
ルの面内で、液晶画素に書き込まれる電位に偏りが生
じ、フリッカーや焼き付きといった画質課題を生じる。
発生したときの液晶画素の電位を示す。図には、反転期
間と非反転期間が同時に示されている。画素電位は、サ
ンプリング用薄膜トランジスタＴＳによりサンプリング
された、それぞれの液晶画素の電位をプロットしたもの
である。通常反転期間と非反転期間の比率は同じに制御
することから、液晶画素の電位は平均すると、図中に示
す画素中心電位となる。対向電極電位ＶＣは、通常フリ
ッカーや焼き付きを防ぐために、画素中心電位に調整さ
れる。従って図に示すように従来例では、液晶表示パネ
ルの面内で、液晶画素に書き込まれる電位に偏りが生
じ、フリッカーや焼き付きといった画質課題を生じる。
【０００８】本発明は、上記のような液晶に印加される
電位の偏りを解消して、フリッカーや焼き付きといった
画質課題を生じることなく画像表示品位を保つことがで
きる液晶表示装置を提供することを目的とする。
電位の偏りを解消して、フリッカーや焼き付きといった
画質課題を生じることなく画像表示品位を保つことがで
きる液晶表示装置を提供することを目的とする。
【０００９】
【課題を解決するための手段】本発明の液晶表示装置
は、アクティブマトリクス型液晶表示パネルを用いた液
晶表示装置であって、基本構成として、画像信号に補正
信号を重畳させる第１の補正回路を有する。前記補正信
号は、前記液晶表示パネルの特性に起因して生じる、液
晶画素に印加される電位の偏りを補正するように調整さ
れる。
は、アクティブマトリクス型液晶表示パネルを用いた液
晶表示装置であって、基本構成として、画像信号に補正
信号を重畳させる第１の補正回路を有する。前記補正信
号は、前記液晶表示パネルの特性に起因して生じる、液
晶画素に印加される電位の偏りを補正するように調整さ
れる。
【００１０】この構成によれば、フリッカーや焼き付き
といった画質課題を生じることなく画像表示品位を保つ
ことができる。
といった画質課題を生じることなく画像表示品位を保つ
ことができる。
【００１１】上記構成において、前記補正信号は、サン
プリング用薄膜トランジスタのゲート−ソース間容量あ
るいはゲート−ドレイン間容量に起因して、前記液晶画
素の画面水平方向の位置に応じて生じる偏りを補正する
ように調整することができる。
プリング用薄膜トランジスタのゲート−ソース間容量あ
るいはゲート−ドレイン間容量に起因して、前記液晶画
素の画面水平方向の位置に応じて生じる偏りを補正する
ように調整することができる。
【００１２】上記構成において好ましくは、前記第１の
補正回路は、画像信号を周期的に非反転および反転を繰
り返すように処理して前記アクティブマトリクス型液晶
表示パネルに供給する反転手段を有し、反転時に前記補
正信号を画像信号に重畳させる様に構成される。これに
より、液晶表示装置の駆動に適した補正回路を構成する
ことができる。
補正回路は、画像信号を周期的に非反転および反転を繰
り返すように処理して前記アクティブマトリクス型液晶
表示パネルに供給する反転手段を有し、反転時に前記補
正信号を画像信号に重畳させる様に構成される。これに
より、液晶表示装置の駆動に適した補正回路を構成する
ことができる。
【００１３】また上記の基本構成に対して、好ましく
は、前記第１の補正回路の動作に起因する前記液晶画素
の位置に応じた輝度の偏りを補正する補正信号を画像信
号に重畳させる第２の補正回路を備える。これにより、
第１の補正回路の動作によって派生する問題を解消し
て、より品位の高い表示が可能となる。
は、前記第１の補正回路の動作に起因する前記液晶画素
の位置に応じた輝度の偏りを補正する補正信号を画像信
号に重畳させる第２の補正回路を備える。これにより、
第１の補正回路の動作によって派生する問題を解消し
て、より品位の高い表示が可能となる。
【００１４】また上記構成において好ましくは、前記第
２の補正回路は、前記第１の補正回路に入力される前の
画像信号に対して補正信号を重畳させる構成とする。
２の補正回路は、前記第１の補正回路に入力される前の
画像信号に対して補正信号を重畳させる構成とする。
【００１５】
【発明の実施の形態】以下、本発明の実施の形態につい
て図面を参照して説明する。
て図面を参照して説明する。
【００１６】（第１の実施の形態）図１に、本発明の第
１の実施の形態における液晶表示装置に用いられる駆動
回路を示す。この駆動回路は、本発明の基本構成に従っ
て構成され、第１の補正回路１のみを備える。なお、ア
クティブマトリクス型液晶表示パネルは、図６に示した
ものと同様の構成である。
１の実施の形態における液晶表示装置に用いられる駆動
回路を示す。この駆動回路は、本発明の基本構成に従っ
て構成され、第１の補正回路１のみを備える。なお、ア
クティブマトリクス型液晶表示パネルは、図６に示した
ものと同様の構成である。
【００１７】第１の補正回路１は、反転及び非反転入力
と出力端子を持つ演算増幅器２と、抵抗Ｒ１，Ｒ２と、
選択回路ＳＷ１から構成されている。演算増幅器２と抵
抗Ｒ１，Ｒ２により構成された反転回路からの反転信号
と、非反転信号とが、選択回路ＳＷ１により周期的に切
り替えられる。以下の説明ではこの切り替え周期は、一
例として一水平期間（１Ｈ）毎であるものとする。補正
信号発生回路４ａは、液晶表示パネル５で生じる液晶に
印加される電位の偏りを補正する補正信号を生成し、演
算増幅器２の非反転入力に供給する。
と出力端子を持つ演算増幅器２と、抵抗Ｒ１，Ｒ２と、
選択回路ＳＷ１から構成されている。演算増幅器２と抵
抗Ｒ１，Ｒ２により構成された反転回路からの反転信号
と、非反転信号とが、選択回路ＳＷ１により周期的に切
り替えられる。以下の説明ではこの切り替え周期は、一
例として一水平期間（１Ｈ）毎であるものとする。補正
信号発生回路４ａは、液晶表示パネル５で生じる液晶に
印加される電位の偏りを補正する補正信号を生成し、演
算増幅器２の非反転入力に供給する。
【００１８】図２に、この構成の回路により駆動される
液晶画素の電位を示す。図に示すＶＳＩＧ中心電圧が補
正信号として、図１の補正信号発生回路４ａより演算増
幅器２の非反転入力に供給される。この補正信号は、図
に示すように、画素中心電位の偏りを小さくするような
波形に調整されている。これにより、フリッカーや焼き
付きといった画質課題を抑制することが可能となる。
液晶画素の電位を示す。図に示すＶＳＩＧ中心電圧が補
正信号として、図１の補正信号発生回路４ａより演算増
幅器２の非反転入力に供給される。この補正信号は、図
に示すように、画素中心電位の偏りを小さくするような
波形に調整されている。これにより、フリッカーや焼き
付きといった画質課題を抑制することが可能となる。
【００１９】（第２の実施の形態）第１の実施の形態の
構成によれば、フリッカーや焼き付きは抑制できるが、
図２に示す画素電位から判るように、輝度の偏りを生じ
てしまう。この問題は、第２の実施の形態の構成により
解決できる。図３に、本発明の第２の実施の形態におけ
る液晶表示装置に用いられる駆動回路を示す。この駆動
回路は、基本構成である第１の補正回路１に加えて、第
２の補正回路３を備える。
構成によれば、フリッカーや焼き付きは抑制できるが、
図２に示す画素電位から判るように、輝度の偏りを生じ
てしまう。この問題は、第２の実施の形態の構成により
解決できる。図３に、本発明の第２の実施の形態におけ
る液晶表示装置に用いられる駆動回路を示す。この駆動
回路は、基本構成である第１の補正回路１に加えて、第
２の補正回路３を備える。
【００２０】第２の補正回路３は、加算回路で構成され
ている。第２の補正回路３には、第１の補正回路に供給
される補正信号に起因して生ずる輝度の偏りを補正する
補正信号が、補正信号発生回路４ｂから供給される。第
２の補正回路３は、この補正信号を画像信号に重畳させ
る。図４に第２の補正回路３の一構成例を示す。
ている。第２の補正回路３には、第１の補正回路に供給
される補正信号に起因して生ずる輝度の偏りを補正する
補正信号が、補正信号発生回路４ｂから供給される。第
２の補正回路３は、この補正信号を画像信号に重畳させ
る。図４に第２の補正回路３の一構成例を示す。
【００２１】図５に、上記構成の回路により駆動される
液晶画素の電位を示す。図３の補正信号発生回路４ｂか
ら第２の補正回路３に供給される補正信号は、図５のＶ
ＳＩＧ（非反転）に示すように、画素電位（非反転）の
輝度の偏りが小さくなるように調整され、画像信号に重
畳される。また、図５のＶＳＩＧ（反転）は、第１の実
施の形態と同様に、第１の補正回路１により図のように
補正され、図のような偏りが小さい画素電位（反転）が
得られる。以上の構成によれば、フリッカーや焼き付
き、及び輝度の偏りという画質課題を抑制することがで
きる。
液晶画素の電位を示す。図３の補正信号発生回路４ｂか
ら第２の補正回路３に供給される補正信号は、図５のＶ
ＳＩＧ（非反転）に示すように、画素電位（非反転）の
輝度の偏りが小さくなるように調整され、画像信号に重
畳される。また、図５のＶＳＩＧ（反転）は、第１の実
施の形態と同様に、第１の補正回路１により図のように
補正され、図のような偏りが小さい画素電位（反転）が
得られる。以上の構成によれば、フリッカーや焼き付
き、及び輝度の偏りという画質課題を抑制することがで
きる。
【００２２】なお、第２の補正回路３を用いなくとも、
輝度の偏りが画像表示上問題ない場合もあり、そのよう
な場合には、第２の補正回路は省略可能である。
輝度の偏りが画像表示上問題ない場合もあり、そのよう
な場合には、第２の補正回路は省略可能である。
【００２３】
【発明の効果】本発明によれば、アクティブマトリクス
型液晶表示パネルを用いた液晶表示装置において、フリ
ッカーや焼き付き及び輝度の偏りなどの画質課題を生じ
ることなく、良好な表示品位を保つことができる。
型液晶表示パネルを用いた液晶表示装置において、フリ
ッカーや焼き付き及び輝度の偏りなどの画質課題を生じ
ることなく、良好な表示品位を保つことができる。
【図１】本発明の第１の実施の形態における液晶表示装
置に用いられる駆動回路の構成を示すブロック図
置に用いられる駆動回路の構成を示すブロック図
【図２】本発明の第１の実施の形態におけるアクティブ
マトリクス型液晶表示パネルの液晶画素電位を示す図
マトリクス型液晶表示パネルの液晶画素電位を示す図
【図３】本発明の第２の実施の形態における液晶表示装
置に用いられる駆動回路の構成を示すブロック図
置に用いられる駆動回路の構成を示すブロック図
【図４】本発明の第２の実施の形態に用いられる第２の
補正回路の構成例を示す図
補正回路の構成例を示す図
【図５】本発明の第２の実施の形態におけるアクティブ
マトリクス型液晶表示パネルの液晶画素電位を示す図
マトリクス型液晶表示パネルの液晶画素電位を示す図
【図６】アクティブマトリクス型液晶表示パネルの構成
を示すブロック図
を示すブロック図
【図７】アクティブマトリクス型液晶表示パネルのタイ
ミングチャート
ミングチャート
【図８】従来例の液晶表示装置に用いられる駆動回路の
構成を示すブロック図
構成を示すブロック図
【図９】アクティブマトリクス型液晶表示パネルのプッ
シュダウン電圧分布を示す図
シュダウン電圧分布を示す図
【図１０】従来例のアクティブマトリクス型液晶表示パ
ネルの液晶画素電位を示す図
ネルの液晶画素電位を示す図
１ 第１の補正回路 ２ 演算増幅器 ３ 第２の補正回路 ４ａ、４ｂ 補正信号発生回路 ５ 液晶表示パネル ７ 行制御回路 ８ 列制御回路
フロントページの続き (51)Int.Cl.7 識別記号 ＦＩ テーマコート゛(参考） Ｇ０９Ｇ 3/20 ６７０ Ｇ０９Ｇ 3/20 ６７０Ｋ
Claims (5)
- 【請求項１】 アクティブマトリクス型液晶表示パネル
を用いた液晶表示装置において、画像信号に補正信号を
重畳させる第１の補正回路を有し、前記補正信号は、前
記液晶表示パネルの特性に起因して生じる、液晶画素に
印加される電位の偏りを補正するように調整されている
ことを特徴とする液晶表示装置。 - 【請求項２】 前記補正信号は、サンプリング用薄膜ト
ランジスタのゲート−ソース間容量あるいはゲート−ド
レイン間容量に起因して前記液晶画素に対する印加電位
に生じるオフセット電圧の、画面水平方向における偏り
を補正するように調整されている請求項１記載の液晶表
示装置。 - 【請求項３】 前記第１の補正回路は、画像信号を周期
的に非反転および反転を繰り返すように処理して前記ア
クティブマトリクス型液晶表示パネルに供給する反転手
段を有し、反転時に前記補正信号を画像信号に重畳させ
る様に構成されていることを特徴とする請求項１または
２記載の液晶表示装置。 - 【請求項４】 前記第１の補正回路の動作に起因する前
記液晶画素の位置に応じた輝度の偏りを補正する補正信
号を画像信号に重畳させる第２の補正回路を備えたこと
を特徴とする請求項１から３のいずれか１項に記載の液
晶表示装置。 - 【請求項５】 前記第２の補正回路は、前記第１の補正
回路に入力される前の画像信号に対して補正信号を重畳
させることを特徴とする請求項４記載の液晶表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2001048781A JP2002251170A (ja) | 2001-02-23 | 2001-02-23 | 液晶表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2001048781A JP2002251170A (ja) | 2001-02-23 | 2001-02-23 | 液晶表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2002251170A true JP2002251170A (ja) | 2002-09-06 |
Family
ID=18909989
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2001048781A Pending JP2002251170A (ja) | 2001-02-23 | 2001-02-23 | 液晶表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2002251170A (ja) |
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007052158A (ja) * | 2005-08-17 | 2007-03-01 | Sanyo Epson Imaging Devices Corp | 電気光学装置及び電子機器 |
| WO2007125738A1 (ja) | 2006-04-28 | 2007-11-08 | Sharp Kabushiki Kaisha | 液晶表示装置及びその駆動方法 |
| WO2010087051A1 (ja) | 2009-01-30 | 2010-08-05 | シャープ株式会社 | 表示装置および表示装置の駆動方法 |
| JP2010281888A (ja) * | 2009-06-02 | 2010-12-16 | Seiko Epson Corp | 集積回路装置、電気光学装置及び電子機器 |
| US8698850B2 (en) | 2008-12-25 | 2014-04-15 | Sharp Kabushiki Kaisha | Display device and method for driving same |
| US8736544B2 (en) | 2008-11-26 | 2014-05-27 | Sharp Kabushiki Kaisha | Liquid crystal display device, liquid crystal display device drive method, and television receiver |
| US8743047B2 (en) | 2008-11-26 | 2014-06-03 | Sharp Kabushiki Kaisha | Liquid crystal display device, method for driving liquid crystal display device, and television receiver |
-
2001
- 2001-02-23 JP JP2001048781A patent/JP2002251170A/ja active Pending
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
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