JP2002217806A - 自動利得制御回路 - Google Patents
自動利得制御回路Info
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Abstract
(57)【要約】
【課題】復調器側で入力信号レベルを検出するためのＡ
／Ｄ変換器が１つで済む自動利得制御回路を提供する。 【解決手段】初段可変利得増幅器１、４、７、１０の利
得は検波回路１７の検波出力電圧である第１自動利得制
御電圧により制御され、可変利得増幅器２４の利得は検
波回路２７の検波出力電圧である第２自動利得制御電圧
により制御され、演算回路２０および４２により（ゲイ
ン／自動利得制御電圧）が同一とされた第１自動利得制
御電圧と第２自動利得制御電圧とを加算器４３にて加算
した電圧に基づいて入力レベルが判定され、判定された
入力レベルに基づいてダイバーシティ用の可変利得増幅
器２、５、８、１１の利得が制御される。したがって、
加算器４３の加算出力電圧によって復調器４０への入力
レベルが判定されることになって、入力レベル判定のた
めの信号をＡ／Ｄ変換するＡ／Ｄ変換器は１つで足りる
ことになる。
／Ｄ変換器が１つで済む自動利得制御回路を提供する。 【解決手段】初段可変利得増幅器１、４、７、１０の利
得は検波回路１７の検波出力電圧である第１自動利得制
御電圧により制御され、可変利得増幅器２４の利得は検
波回路２７の検波出力電圧である第２自動利得制御電圧
により制御され、演算回路２０および４２により（ゲイ
ン／自動利得制御電圧）が同一とされた第１自動利得制
御電圧と第２自動利得制御電圧とを加算器４３にて加算
した電圧に基づいて入力レベルが判定され、判定された
入力レベルに基づいてダイバーシティ用の可変利得増幅
器２、５、８、１１の利得が制御される。したがって、
加算器４３の加算出力電圧によって復調器４０への入力
レベルが判定されることになって、入力レベル判定のた
めの信号をＡ／Ｄ変換するＡ／Ｄ変換器は１つで足りる
ことになる。
Description
【０００１】
【発明の属する技術分野】本発明はデジタル地上波放送
受信機のフロントエンドなどに使用される自動利得制御
回路に関する。
受信機のフロントエンドなどに使用される自動利得制御
回路に関する。
【０００２】
【従来の技術】デジタル地上波放送受信機のフロントエ
ンドなどに使用される従来の自動利得制御回路を含むフ
ロントエンドは、図４に示す如く構成されている。例え
ば位置を異にした４本のアンテナによって受信した同一
チャンネルの信号をそれぞれ高周波選択回路を介して、
可変利得増幅器１、４、７、１０に各別に供給して増幅
し、可変利得増幅器１、４、７、１０の増幅出力を可変
利得増幅器２、５、８、１１に各別に供給して増幅し、
可変利得増幅器２、５、８、１１の増幅出力をトラッキ
ングフィルタ３、６、９、１２に各別に供給して主にイ
メージ周波数除去を目的として帯域制限を行い、トラッ
キングフィルタ３、６、９、１２によって帯域制限され
た出力を合成器１３に供給して合成し、合成器１３の出
力をミキサ１４と局部発振器１５とからなる周波数変換
器によって第１中間周波数に周波数変換し、周波数変換
された第１中間周波信号を検波器１７に供給して検波
し、検波出力電圧を第１自動利得制御電圧とし、該電圧
に基づいて可変利得増幅器１、４、７、１０の利得を制
御する自動利得制御を行っている。
ンドなどに使用される従来の自動利得制御回路を含むフ
ロントエンドは、図４に示す如く構成されている。例え
ば位置を異にした４本のアンテナによって受信した同一
チャンネルの信号をそれぞれ高周波選択回路を介して、
可変利得増幅器１、４、７、１０に各別に供給して増幅
し、可変利得増幅器１、４、７、１０の増幅出力を可変
利得増幅器２、５、８、１１に各別に供給して増幅し、
可変利得増幅器２、５、８、１１の増幅出力をトラッキ
ングフィルタ３、６、９、１２に各別に供給して主にイ
メージ周波数除去を目的として帯域制限を行い、トラッ
キングフィルタ３、６、９、１２によって帯域制限され
た出力を合成器１３に供給して合成し、合成器１３の出
力をミキサ１４と局部発振器１５とからなる周波数変換
器によって第１中間周波数に周波数変換し、周波数変換
された第１中間周波信号を検波器１７に供給して検波
し、検波出力電圧を第１自動利得制御電圧とし、該電圧
に基づいて可変利得増幅器１、４、７、１０の利得を制
御する自動利得制御を行っている。
【０００３】さらに、第１中間周波数信号はバンドパス
フィルタ２１に供給して、隣接チャンネル除去および周
波数変換により生じた高域成分を除去するなどの帯域制
限を行い、バンドパスフィルタ２１の出力を増幅器２２
に供給して増幅し、増幅器２２からの増幅出力はバンド
パスフィルタ２３に供給して帯域制限を行い、バンドパ
スフィルタ２３からの出力は可変利得増幅器２４に供給
して増幅のうえ、ミキサ２５と局部発振器２６とからな
る周波数変換器によって第２中間周波数に周波数変換
し、周波数変換された第２中間周波信号を検波回路２７
に供給して検波し、検波出力電圧を第２自動利得制御電
圧とし、該電圧に基づいて可変利得増幅器２４の利得を
制御する自動利得制御を行っている。
フィルタ２１に供給して、隣接チャンネル除去および周
波数変換により生じた高域成分を除去するなどの帯域制
限を行い、バンドパスフィルタ２１の出力を増幅器２２
に供給して増幅し、増幅器２２からの増幅出力はバンド
パスフィルタ２３に供給して帯域制限を行い、バンドパ
スフィルタ２３からの出力は可変利得増幅器２４に供給
して増幅のうえ、ミキサ２５と局部発振器２６とからな
る周波数変換器によって第２中間周波数に周波数変換
し、周波数変換された第２中間周波信号を検波回路２７
に供給して検波し、検波出力電圧を第２自動利得制御電
圧とし、該電圧に基づいて可変利得増幅器２４の利得を
制御する自動利得制御を行っている。
【０００４】さらにまた、第２中間周波信号は復調器４
０に導いて復調する。一方、第１自動利得制御電圧をＡ
／Ｄ変換器１８に導いてデジタル信号に変換し、同様に
第２自動利得制御電圧をＡ／Ｄ変換器２８に導いてデジ
タル信号に変換し、Ａ／Ｄ変換器１８および２８の変換
出力も復調器４０に供給して、復調器４０においてＡ／
Ｄ変換器１８および２８の変換出力から入力信号のレベ
ルを判定し、該判定出力をＤ／Ａ変換器を含む制御回路
４１に供給してアナログ信号に変換し、該判定出力に基
づくアナログ電圧によって可変利得増幅器２、５、８、
１１の利得を各別に順次、ガードインターバルの期間に
おいて独立して変更する自動利得制御を行うことにより
ダイバーシティ受信を行っている。
０に導いて復調する。一方、第１自動利得制御電圧をＡ
／Ｄ変換器１８に導いてデジタル信号に変換し、同様に
第２自動利得制御電圧をＡ／Ｄ変換器２８に導いてデジ
タル信号に変換し、Ａ／Ｄ変換器１８および２８の変換
出力も復調器４０に供給して、復調器４０においてＡ／
Ｄ変換器１８および２８の変換出力から入力信号のレベ
ルを判定し、該判定出力をＤ／Ａ変換器を含む制御回路
４１に供給してアナログ信号に変換し、該判定出力に基
づくアナログ電圧によって可変利得増幅器２、５、８、
１１の利得を各別に順次、ガードインターバルの期間に
おいて独立して変更する自動利得制御を行うことにより
ダイバーシティ受信を行っている。
【０００５】デジタル地上波放送受信機の場合、デジタ
ル衛星放送受信機と異なって隣接チャンネルや隣隣接チ
ャンネルとのＤ／Ｕ比（desired to undesired powe
r ratio）が大きいため、Ｄ／Ｕ比が大きいときの感度
抑圧や、３次歪みが問題となる。また、変調方式はＯＦ
ＤＭのため、歪みによる影響は単なるＰＳＫ変調の時よ
りも大きいことから、デジタル地上波放送受信機におけ
るフロントエンドの自動利得制御ループを１つのループ
にすることは難しく、図４に示すように、第１中間周波
信号の帯域制限前と帯域制限後とで別々の自動利得制御
ループを構成し、初段の増幅器およびミキサによる歪み
の発生を抑えている。
ル衛星放送受信機と異なって隣接チャンネルや隣隣接チ
ャンネルとのＤ／Ｕ比（desired to undesired powe
r ratio）が大きいため、Ｄ／Ｕ比が大きいときの感度
抑圧や、３次歪みが問題となる。また、変調方式はＯＦ
ＤＭのため、歪みによる影響は単なるＰＳＫ変調の時よ
りも大きいことから、デジタル地上波放送受信機におけ
るフロントエンドの自動利得制御ループを１つのループ
にすることは難しく、図４に示すように、第１中間周波
信号の帯域制限前と帯域制限後とで別々の自動利得制御
ループを構成し、初段の増幅器およびミキサによる歪み
の発生を抑えている。
【０００６】
【発明が解決しようとする課題】上記した理由により自
動利得制御ループが２つ存在するため、ダイバーシティ
のために使用する入力信号レベル検出用の自動利得制御
電圧が２つ存在することから、この２つ存在する自動利
得制御電圧をそれぞれＡ／Ｄ変換器でデジタル信号に変
換し、後段の復調器で入力信号レベルを判断している。
動利得制御ループが２つ存在するため、ダイバーシティ
のために使用する入力信号レベル検出用の自動利得制御
電圧が２つ存在することから、この２つ存在する自動利
得制御電圧をそれぞれＡ／Ｄ変換器でデジタル信号に変
換し、後段の復調器で入力信号レベルを判断している。
【０００７】このように、従来ではデジタル地上波放送
受信機におけるフロントエンドの自動利得制御回路で
は、復調器側で入力信号レベルを検出するために、２つ
のＡ／Ｄ変換器を必要とするとういう問題点があった。
受信機におけるフロントエンドの自動利得制御回路で
は、復調器側で入力信号レベルを検出するために、２つ
のＡ／Ｄ変換器を必要とするとういう問題点があった。
【０００８】本発明は、復調器側で入力信号レベルを検
出するためのＡ／Ｄ変換器が１つで済む自動利得制御回
路を提供することを目的とする。
出するためのＡ／Ｄ変換器が１つで済む自動利得制御回
路を提供することを目的とする。
【０００９】
【課題を解決するための手段】本発明にかかる自動利得
制御回路は、異なる位置に設けられた複数のアンテナか
ら出力される同一チャンネルの信号を各別に増幅する初
段可変利得増幅器の利得を、帯域制限前の第１中間周波
信号を検波した第１自動利得制御電圧によって制御し、
帯域制限後の第１中間周波信号を周波数変換した第２中
間周波信号を検波した第２自動利得制御電圧によって、
帯域制限後の第１中間周波信号を増幅する可変利得増幅
器の利得を制御し、第１自動利得制御電圧の（ゲイン／
自動利得制御電圧）と第２自動利得制御電圧の（ゲイン
／自動利得制御電圧）とを同一にするための演算手段に
よって（ゲイン／自動利得制御電圧）が同一とされた第
１および第２自動利得制御回路の出力を加算した電圧に
よって復調器への入力レベルを判定し、該判定された入
力レベルに基づいて、前記初段可変利得増幅器にそれぞ
れ縦続接続され、かつ出力電圧が合成されて合成出力が
第１中間周波信号に周波数変換されるダイバーシティ用
の可変利得増幅器の利得を、各別に順次独立して制御す
ることを特徴とする。
制御回路は、異なる位置に設けられた複数のアンテナか
ら出力される同一チャンネルの信号を各別に増幅する初
段可変利得増幅器の利得を、帯域制限前の第１中間周波
信号を検波した第１自動利得制御電圧によって制御し、
帯域制限後の第１中間周波信号を周波数変換した第２中
間周波信号を検波した第２自動利得制御電圧によって、
帯域制限後の第１中間周波信号を増幅する可変利得増幅
器の利得を制御し、第１自動利得制御電圧の（ゲイン／
自動利得制御電圧）と第２自動利得制御電圧の（ゲイン
／自動利得制御電圧）とを同一にするための演算手段に
よって（ゲイン／自動利得制御電圧）が同一とされた第
１および第２自動利得制御回路の出力を加算した電圧に
よって復調器への入力レベルを判定し、該判定された入
力レベルに基づいて、前記初段可変利得増幅器にそれぞ
れ縦続接続され、かつ出力電圧が合成されて合成出力が
第１中間周波信号に周波数変換されるダイバーシティ用
の可変利得増幅器の利得を、各別に順次独立して制御す
ることを特徴とする。
【００１０】本発明にかかる自動利得制御回路によれ
ば、初段可変利得増幅器の利得は第１自動利得制御電圧
により制御され、帯域制限後の第１中間周波信号を増幅
する可変利得増幅器の利得は第２自動利得制御電圧によ
り制御され、演算手段により（ゲイン／自動利得制御電
圧）が同一とされた第１自動利得制御電圧と第２自動利
得制御電圧とを合成した電圧に基づいて入力レベルが判
定され、判定された入力レベルに基づいてダイバーシテ
ィ用の可変利得増幅器の利得が制御される。したがっ
て、（ゲイン／自動利得制御電圧）が同一とされた第１
および第２自動利得制御回路の出力を加算した電圧によ
って復調器への入力レベルが判定されることになって、
入力レベル判定のための信号をＡ／Ｄ変換するＡ／Ｄ変
換器は１つで足りることになる。
ば、初段可変利得増幅器の利得は第１自動利得制御電圧
により制御され、帯域制限後の第１中間周波信号を増幅
する可変利得増幅器の利得は第２自動利得制御電圧によ
り制御され、演算手段により（ゲイン／自動利得制御電
圧）が同一とされた第１自動利得制御電圧と第２自動利
得制御電圧とを合成した電圧に基づいて入力レベルが判
定され、判定された入力レベルに基づいてダイバーシテ
ィ用の可変利得増幅器の利得が制御される。したがっ
て、（ゲイン／自動利得制御電圧）が同一とされた第１
および第２自動利得制御回路の出力を加算した電圧によ
って復調器への入力レベルが判定されることになって、
入力レベル判定のための信号をＡ／Ｄ変換するＡ／Ｄ変
換器は１つで足りることになる。
【００１１】本発明にかかる自動利得制御回路におい
て、（ゲイン／自動利得制御電圧）が同一とされた第１
および第２自動利得制御回路の出力を加算した電圧と閾
値を比較して比較結果に基づいて受信可能レベルか否か
を判定する入力レベル判定回路を備えてもよい。
て、（ゲイン／自動利得制御電圧）が同一とされた第１
および第２自動利得制御回路の出力を加算した電圧と閾
値を比較して比較結果に基づいて受信可能レベルか否か
を判定する入力レベル判定回路を備えてもよい。
【００１２】本発明にかかる自動利得制御回路におい
て、入力レベル判定回路を備えたときは、入力レベル判
定回路の出力に基づき入力レベルを判定することができ
る。
て、入力レベル判定回路を備えたときは、入力レベル判
定回路の出力に基づき入力レベルを判定することができ
る。
【００１３】
【発明の実施の形態】以下、本発明にかかる自動利得制
御回路を実施の一形態によって説明する。
御回路を実施の一形態によって説明する。
【００１４】図１は本発明の実施の一形態にかかる自動
利得制御回路を含むデジタル地上波放送受信機における
フロントエンドの構成を示すブロック図である。
利得制御回路を含むデジタル地上波放送受信機における
フロントエンドの構成を示すブロック図である。
【００１５】本発明にかかる自動利得制御回路におい
て、図４に示した自動利得制御回路と同一の構成要素に
は同一の符号を付して、重複を避けるため移同一の構成
要素の説明は省略する。
て、図４に示した自動利得制御回路と同一の構成要素に
は同一の符号を付して、重複を避けるため移同一の構成
要素の説明は省略する。
【００１６】本発明の実施の一形態にかかる自動利得制
御回路は、検波回路１７の検波出力電圧すなわち第１自
動利得制御電圧を、乗算器２０−１と乗算器２０−１の
出力電圧に乗算およびオフセット加算を行う演算器２０
−２とからなる演算回路２０に供給して演算し、検波回
路２８のの検波出力電圧すなわち第２自動利得制御電圧
を、乗算器４２−１と乗算器４２−１の出力に乗算およ
びオフセット加算を行う演算器４２−２とからなる演算
回路４２に供給して演算し、演算回路２０の出力電圧と
演算回路４２の出力電圧とを加算回路４３にて加算し、
加算回路４３の出力電圧をＡ／Ｄ変換器４４に供給して
デジタル信号に変換し、Ａ／Ｄ変換器４４にて変換され
たデジタル信号を復調器４０に供給し、Ａ／Ｄ変換器４
４の出力に基づいて復調器４０において入力信号のレベ
ルを判定するようにしてある。
御回路は、検波回路１７の検波出力電圧すなわち第１自
動利得制御電圧を、乗算器２０−１と乗算器２０−１の
出力電圧に乗算およびオフセット加算を行う演算器２０
−２とからなる演算回路２０に供給して演算し、検波回
路２８のの検波出力電圧すなわち第２自動利得制御電圧
を、乗算器４２−１と乗算器４２−１の出力に乗算およ
びオフセット加算を行う演算器４２−２とからなる演算
回路４２に供給して演算し、演算回路２０の出力電圧と
演算回路４２の出力電圧とを加算回路４３にて加算し、
加算回路４３の出力電圧をＡ／Ｄ変換器４４に供給して
デジタル信号に変換し、Ａ／Ｄ変換器４４にて変換され
たデジタル信号を復調器４０に供給し、Ａ／Ｄ変換器４
４の出力に基づいて復調器４０において入力信号のレベ
ルを判定するようにしてある。
【００１７】乗算器２０−１は検波回路１７の出力電圧
に乗算係数（１／Ｘ）を乗算し、演算器２０−２は乗算
器２０−１の出力電圧に乗算係数Ｂを乗算すると共にオ
フセット値の加算を行い、乗算器４２−１は検波回路２
７の出力電圧に乗算係数（１／Ｙ）を乗算し、演算器４
２−２は乗算器４０−１の出力電圧に乗算係数Ａを乗算
すると共にオフセット値の加算を行って、乗算係数（１
／Ｘ）、Ｂ、（１／Ｙ）、Ａおよびオフセット値を選択
して、演算回路２０の出力電圧によるゲイン／自動利得
制御電圧（ｄＢ／Ｖ）と演算回路４２の出力電圧による
ゲイン／自動利得制御電圧（ｄＢ／Ｖ）が同一になるよ
うに設定する。
に乗算係数（１／Ｘ）を乗算し、演算器２０−２は乗算
器２０−１の出力電圧に乗算係数Ｂを乗算すると共にオ
フセット値の加算を行い、乗算器４２−１は検波回路２
７の出力電圧に乗算係数（１／Ｙ）を乗算し、演算器４
２−２は乗算器４０−１の出力電圧に乗算係数Ａを乗算
すると共にオフセット値の加算を行って、乗算係数（１
／Ｘ）、Ｂ、（１／Ｙ）、Ａおよびオフセット値を選択
して、演算回路２０の出力電圧によるゲイン／自動利得
制御電圧（ｄＢ／Ｖ）と演算回路４２の出力電圧による
ゲイン／自動利得制御電圧（ｄＢ／Ｖ）が同一になるよ
うに設定する。
【００１８】乗算器２０−１、演算器２０−２、乗算器
４２−１、演算器４２−２は抵抗分圧器にて構成するこ
とができ、乗算器２０−１および演算器２０−２は第１
自動利得制御電圧に乗算係数（Ｂ／Ｘ）の乗算を行いか
つオフセット値を加える演算器で構成とすることもで
き、乗算器４２−１および演算器４２−２は第２自動利
得制御電圧に乗算係数（Ａ／Ｙ）の乗算を行いかつオフ
セット値を加える演算器で構成とすることもできる。
４２−１、演算器４２−２は抵抗分圧器にて構成するこ
とができ、乗算器２０−１および演算器２０−２は第１
自動利得制御電圧に乗算係数（Ｂ／Ｘ）の乗算を行いか
つオフセット値を加える演算器で構成とすることもで
き、乗算器４２−１および演算器４２−２は第２自動利
得制御電圧に乗算係数（Ａ／Ｙ）の乗算を行いかつオフ
セット値を加える演算器で構成とすることもできる。
【００１９】演算回路２０の出力電圧と演算回路４２の
出力電圧とは演算増幅器からなる加算回路４３にて加算
し、Ａ／Ｄ変換器４４でＡ／Ｄ変換され、復調器４０に
供給される。加算回路４３では出力電圧がＡ／Ｄ変換器
４４の入力レンジに合うようにそのゲインが設定してあ
る。
出力電圧とは演算増幅器からなる加算回路４３にて加算
し、Ａ／Ｄ変換器４４でＡ／Ｄ変換され、復調器４０に
供給される。加算回路４３では出力電圧がＡ／Ｄ変換器
４４の入力レンジに合うようにそのゲインが設定してあ
る。
【００２０】可変利得増幅器１、４、７、１０の利得を
制御する検波器１７を含む自動利得制御回路の自動利得
制御電圧−ゲイン特性は一般に図２（ａ）の直線ａに示
すような特性であり、可変利得増幅器２４の利得を制御
する検波器２７を含む自動利得制御回路の自動利得制御
電圧−ゲイン特性は一般に図２（ａ）の直線ｂに示すよ
うな特性であって、ゲイン／自動利得制御電圧（ｄＢ／
Ｖ）は検波器１７を含む自動利得制御回路と検波器２７
を含む自動利得制御回路とでは異なっている。
制御する検波器１７を含む自動利得制御回路の自動利得
制御電圧−ゲイン特性は一般に図２（ａ）の直線ａに示
すような特性であり、可変利得増幅器２４の利得を制御
する検波器２７を含む自動利得制御回路の自動利得制御
電圧−ゲイン特性は一般に図２（ａ）の直線ｂに示すよ
うな特性であって、ゲイン／自動利得制御電圧（ｄＢ／
Ｖ）は検波器１７を含む自動利得制御回路と検波器２７
を含む自動利得制御回路とでは異なっている。
【００２１】そこで、上記したように演算回路２０およ
び４２による演算によって、演算回路２０の出力電圧−
ゲイン特性と演算回路４２の出力電圧−ゲイン特性とは
等しくなり、加算回路４３の出力電圧−ゲイン特性は図
２（ｂ）に示すようになって、加算回路４３の出力電圧
に基づいて入力レベルが判定されて、この判定された入
力レベルに基づいて可変利得増幅器２、５、８、１１の
利得が独立して制御されるダイバーシティが行われる。
このようにすることで、フロントエンドのトータルゲイ
ンはほぼリニアな形で表現できて、ダイバーシティ用の
自動利得制御電圧を１つにすることができる。
び４２による演算によって、演算回路２０の出力電圧−
ゲイン特性と演算回路４２の出力電圧−ゲイン特性とは
等しくなり、加算回路４３の出力電圧−ゲイン特性は図
２（ｂ）に示すようになって、加算回路４３の出力電圧
に基づいて入力レベルが判定されて、この判定された入
力レベルに基づいて可変利得増幅器２、５、８、１１の
利得が独立して制御されるダイバーシティが行われる。
このようにすることで、フロントエンドのトータルゲイ
ンはほぼリニアな形で表現できて、ダイバーシティ用の
自動利得制御電圧を１つにすることができる。
【００２２】上記した本発明の実施の一形態にかかる自
動利得制御回路によればダイバーシティ用の自動電圧制
御電圧を１つにすることができて、復調器４０において
ダイバーシティのための入力レベルの計算が簡単にな
る。
動利得制御回路によればダイバーシティ用の自動電圧制
御電圧を１つにすることができて、復調器４０において
ダイバーシティのための入力レベルの計算が簡単にな
る。
【００２３】なお、上記において、ゲイン／自動利得制
御電圧（ｄＢ／Ｖ）を合わせるために演算回路２０と４
２とを備えた場合を説明したが、何れか一方の演算回路
によっても合わせることもできる。
御電圧（ｄＢ／Ｖ）を合わせるために演算回路２０と４
２とを備えた場合を説明したが、何れか一方の演算回路
によっても合わせることもできる。
【００２４】次に本発明の実施の一形態において入力レ
ベル判定回路を設けた例について説明する。
ベル判定回路を設けた例について説明する。
【００２５】図３は図１に示すフロントエンドに入力レ
ベル判定回路を設けた場合の構成を示すブロック図であ
る。
ベル判定回路を設けた場合の構成を示すブロック図であ
る。
【００２６】図３に示すように、閾値データをＤ／Ａ変
換器４５−１でアナログ電圧に変換し、アナログ電圧に
変換された閾値と加算回路４３の出力電圧とを比較器４
５−２で比較し、比較出力を入力レベル判定出力として
送出する入力レベル判定回路４５が、図１に示すフロン
トエンドに設けてある。
換器４５−１でアナログ電圧に変換し、アナログ電圧に
変換された閾値と加算回路４３の出力電圧とを比較器４
５−２で比較し、比較出力を入力レベル判定出力として
送出する入力レベル判定回路４５が、図１に示すフロン
トエンドに設けてある。
【００２７】したがって、閾値を受信可能な入力レベル
に対応した値に設定しておくことによって、加算回路４
３の出力電圧が閾値を超えているか、閾値未満であるか
に基づいて現在の入力レベルが受信可能な入力レベルで
あるか否かを判定することができる。
に対応した値に設定しておくことによって、加算回路４
３の出力電圧が閾値を超えているか、閾値未満であるか
に基づいて現在の入力レベルが受信可能な入力レベルで
あるか否かを判定することができる。
【００２８】
【発明の効果】以上説明したように本発明にかかる自動
利得制御回路によれば、（ゲイン／自動利得制御電圧）
が同一とされた第１および第２自動利得制御回路の出力
を加算した電圧によって復調器への入力レベルが判定さ
れることになって、入力レベル判定のための信号をＡ／
Ｄ変換するＡ／Ｄ変換器は１つで足りるという効果が得
られる。
利得制御回路によれば、（ゲイン／自動利得制御電圧）
が同一とされた第１および第２自動利得制御回路の出力
を加算した電圧によって復調器への入力レベルが判定さ
れることになって、入力レベル判定のための信号をＡ／
Ｄ変換するＡ／Ｄ変換器は１つで足りるという効果が得
られる。
【図１】本発明の実施の一形態にかかる自動利得制御回
路を含むデジタル地上波放送受信機におけるフロントエ
ンドの構成を示すブロック図である。
路を含むデジタル地上波放送受信機におけるフロントエ
ンドの構成を示すブロック図である。
【図２】本発明の実施の一形態にかかる自動利得制御回
路の作用の説明に供する自動利得制御特性図である。
路の作用の説明に供する自動利得制御特性図である。
【図３】図１に示したフロントエンドに入力レベル判定
回路を付加した場合のブロック図である。
回路を付加した場合のブロック図である。
【図４】従来の自動利得制御回路を含むデジタル地上波
放送受信機におけるフロントエンドの構成を示すブロッ
ク図である。
放送受信機におけるフロントエンドの構成を示すブロッ
ク図である。
１、２、４、５、７、８、１０、１１、および２４ 可
変利得増幅器 １３ 合成器 １４および２５ ミキサ １５および２６ 局部発振器 １７および２７ 検波回路 ２０および４２ 演算回路 ４０ 復調器 ４３ 加算回路 ４５ 入力レベル判定回路
変利得増幅器 １３ 合成器 １４および２５ ミキサ １５および２６ 局部発振器 １７および２７ 検波回路 ２０および４２ 演算回路 ４０ 復調器 ４３ 加算回路 ４５ 入力レベル判定回路
Claims (2)
- 【請求項１】異なる位置に設けられた複数のアンテナか
ら出力される同一チャンネルの信号を各別に増幅する初
段可変利得増幅器の利得を、帯域制限前の第１中間周波
信号を検波した第１自動利得制御電圧によって制御し、 帯域制限後の第１中間周波信号を周波数変換した第２中
間周波信号を検波した第２自動利得制御電圧によって、
帯域制限後の第１中間周波信号を増幅する可変利得増幅
器の利得を制御し、 第１自動利得制御電圧の（ゲイン／自動利得制御電圧）
と第２自動利得制御電圧の（ゲイン／自動利得制御電
圧）とを同一にするための演算手段によって（ゲイン／
自動利得制御電圧）が同一とされた第１および第２自動
利得制御回路の出力を加算した電圧によって復調器への
入力レベルを判定し、 該判定された入力レベルに基づいて、前記初段可変利得
増幅器にそれぞれ縦続接続され、かつ出力電圧が合成さ
れて合成出力が第１中間周波信号に周波数変換されるダ
イバーシティ用の可変利得増幅器の利得を、各別に順次
独立して制御することを特徴とする自動利得制御回路。 - 【請求項２】請求項１記載の自動利得制御回路におい
て、（ゲイン／自動利得制御電圧）が同一とされた第１
および第２自動利得制御回路の出力を加算した電圧と閾
値を比較して比較結果に基づいて受信可能レベルか否か
を判定する入力レベル判定回路を備えたことを特徴とす
る自動利得制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2001014010A JP3713206B2 (ja) | 2001-01-23 | 2001-01-23 | 自動利得制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2001014010A JP3713206B2 (ja) | 2001-01-23 | 2001-01-23 | 自動利得制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2002217806A true JP2002217806A (ja) | 2002-08-02 |
| JP3713206B2 JP3713206B2 (ja) | 2005-11-09 |
Family
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Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2001014010A Expired - Fee Related JP3713206B2 (ja) | 2001-01-23 | 2001-01-23 | 自動利得制御回路 |
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| JP (1) | JP3713206B2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007068143A (ja) * | 2005-08-05 | 2007-03-15 | Matsushita Electric Ind Co Ltd | アンテナ整合器とこれを用いた高周波受信装置 |
| JP2007515905A (ja) * | 2003-12-23 | 2007-06-14 | テレフオンアクチーボラゲット エル エム エリクソン（パブル） | フィードバックを有するミキサ |
| CN115372942A (zh) * | 2022-10-21 | 2022-11-22 | 北京微厘光电技术有限公司 | 一种激光测距仪回波处理电路 |
-
2001
- 2001-01-23 JP JP2001014010A patent/JP3713206B2/ja not_active Expired - Fee Related
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|---|---|
| JP3713206B2 (ja) | 2005-11-09 |
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