JP2002009651A - 可変利得増幅器 - Google Patents
可変利得増幅器Info
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- JP2002009651A JP2002009651A JP2000192334A JP2000192334A JP2002009651A JP 2002009651 A JP2002009651 A JP 2002009651A JP 2000192334 A JP2000192334 A JP 2000192334A JP 2000192334 A JP2000192334 A JP 2000192334A JP 2002009651 A JP2002009651 A JP 2002009651A
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- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
- Input Circuits Of Receivers And Coupling Of Receivers And Audio Equipment (AREA)
- Radio Transmission System (AREA)
- Microwave Amplifiers (AREA)
Abstract
(57)【要約】
【課題】 ダイバーシティ方式受信機に用いられる可変
利得増幅器は、利得を下げると雑音指数（Ｎｏｉｓｅ
Ｆｉｇｕｒｅ：以下ＮＦと記す）が劣化する。このため
に、各ブランチ間で制御電圧を共通にしても、双方の可
変利得増幅器のＮＦのばらつきにより、各ブランチの受
信感度を一定にすることができない。 【解決手段】 制御信号により増幅度を可変できる電圧
制御可変増幅器において、前記電圧制御可変増幅器の入
力側に入力側整合回路を接続し、さらに出力側に出力側
整合回路を接続し、前記制御信号に応じて前記入力側整
合回路と前記出力側整合回路を制御することを特徴とす
る可変利得増幅器。
利得増幅器は、利得を下げると雑音指数（Ｎｏｉｓｅ
Ｆｉｇｕｒｅ：以下ＮＦと記す）が劣化する。このため
に、各ブランチ間で制御電圧を共通にしても、双方の可
変利得増幅器のＮＦのばらつきにより、各ブランチの受
信感度を一定にすることができない。 【解決手段】 制御信号により増幅度を可変できる電圧
制御可変増幅器において、前記電圧制御可変増幅器の入
力側に入力側整合回路を接続し、さらに出力側に出力側
整合回路を接続し、前記制御信号に応じて前記入力側整
合回路と前記出力側整合回路を制御することを特徴とす
る可変利得増幅器。
Description
【０００１】
【発明の属する技術分野】 利得を制御する制御電圧に
応じて入出力の整合回路の制御を行うことが可能な可変
利得増幅器に関する。
応じて入出力の整合回路の制御を行うことが可能な可変
利得増幅器に関する。
【０００２】
【従来の技術】 制御電圧により増幅器の利得を可変す
る可変利得増幅器は、主にＡＧＣ（電圧利得制御）回路
等に使用される。ＡＧＣ回路は例えば無線機における受
信装置において、複数のアンテナからの受信系統（ブラ
ンチ）において得られる複数の信号に基づいて、高品質
な受信信号を得るためのダイバシティ方式に利用され
る。ダイバシティ方式では、各ブランチにおいてＡＧＣ
回路を制御する制御回路が設けられ、各ブランチのＡＧ
Ｃ回路の可変利得増幅器を制御する。各ブランチの可変
利得増幅器を制御する方法として、複数のブランチにお
いて受信された信号の中の最大の電力の信号に基づい
て、各ＡＧＣ回路において共通の利得に制御する共通利
得制御法がある。
る可変利得増幅器は、主にＡＧＣ（電圧利得制御）回路
等に使用される。ＡＧＣ回路は例えば無線機における受
信装置において、複数のアンテナからの受信系統（ブラ
ンチ）において得られる複数の信号に基づいて、高品質
な受信信号を得るためのダイバシティ方式に利用され
る。ダイバシティ方式では、各ブランチにおいてＡＧＣ
回路を制御する制御回路が設けられ、各ブランチのＡＧ
Ｃ回路の可変利得増幅器を制御する。各ブランチの可変
利得増幅器を制御する方法として、複数のブランチにお
いて受信された信号の中の最大の電力の信号に基づい
て、各ＡＧＣ回路において共通の利得に制御する共通利
得制御法がある。
【０００３】 図６は、従来例に係るダイバシティ方式
の制御部の構成を示す図である。制御部では、２つのブ
ランチからの信号に対する利得制御を行う。制御部に
は、第１の可変利得増幅器１０１及び第２の可変利得増
幅器１０８と、選択器１０４と、基準電圧発生器１０５
と、比較器１０６と、積分器１０７と方向性結合器１０
２及び１０９と、第１の電力測定器１０３及び第２の電
力測定器１１０と、合成器１１１を有する。
の制御部の構成を示す図である。制御部では、２つのブ
ランチからの信号に対する利得制御を行う。制御部に
は、第１の可変利得増幅器１０１及び第２の可変利得増
幅器１０８と、選択器１０４と、基準電圧発生器１０５
と、比較器１０６と、積分器１０７と方向性結合器１０
２及び１０９と、第１の電力測定器１０３及び第２の電
力測定器１１０と、合成器１１１を有する。
【０００４】 制御部において、第１の可変利得増幅器
１０１が第１のブランチから入力された信号を、利得制
御信号に基づいた所定の利得で増幅する。増幅された信
号を第１の方向性結合器１０２が合成器１１１と電力測
定器１０３に出力し、電力測定器１０３は入力された信
号の電力を測定し、電力に応じた直流電圧を選択器１０
４の一方の入力端子に入力する。また、第２の可変利得
増幅器１０８が第２のブランチから入力された信号を、
利得制御信号に基づいた所定の利得で増幅する。増幅さ
れた信号を方向性結合器１０９が第２の可変利得増幅器
１０８により増幅された信号を合成器１１１と第２の電
力測定器１１０に出力し、第２の電力測定器１１０は入
力された信号の電力を測定し、電力に応じた直流電圧選
択器１０４のもう一方の入力端子に入力する。
１０１が第１のブランチから入力された信号を、利得制
御信号に基づいた所定の利得で増幅する。増幅された信
号を第１の方向性結合器１０２が合成器１１１と電力測
定器１０３に出力し、電力測定器１０３は入力された信
号の電力を測定し、電力に応じた直流電圧を選択器１０
４の一方の入力端子に入力する。また、第２の可変利得
増幅器１０８が第２のブランチから入力された信号を、
利得制御信号に基づいた所定の利得で増幅する。増幅さ
れた信号を方向性結合器１０９が第２の可変利得増幅器
１０８により増幅された信号を合成器１１１と第２の電
力測定器１１０に出力し、第２の電力測定器１１０は入
力された信号の電力を測定し、電力に応じた直流電圧選
択器１０４のもう一方の入力端子に入力する。
【０００５】 次に、選択器１０４が第１の電力測定器
１０３と第２の電力測定器１１０から入力された２つの
直流電圧を比較し、信号電力が大きい直流電圧を比較器
１０６に出力する。基準電圧発生器１０５は、第１の可
変利得増幅器１０１又は第２の可変利得増幅器１０８に
より増幅される信号が目標の電力に達している場合に、
第１の電力測定器１０３又は第２の電力測定器１１０か
ら出力されるべき直流電圧を比較器１０６に入力する。
比較器１０６は選択器１０４から入力された直流電圧と
目標電圧発生器１０５からの直流電圧との差分を積分器
１０７に出力する。積分器１０７は比較器１０６から出
力される差分を逐次加算した制御信号を可変利得増幅器
１０１及び１０８に出力する。これにより、可変利得増
幅器１０１又は、１０８により第１のブランチ又は第２
のブランチからの信号の一方は所定の電力に増幅され
る。
１０３と第２の電力測定器１１０から入力された２つの
直流電圧を比較し、信号電力が大きい直流電圧を比較器
１０６に出力する。基準電圧発生器１０５は、第１の可
変利得増幅器１０１又は第２の可変利得増幅器１０８に
より増幅される信号が目標の電力に達している場合に、
第１の電力測定器１０３又は第２の電力測定器１１０か
ら出力されるべき直流電圧を比較器１０６に入力する。
比較器１０６は選択器１０４から入力された直流電圧と
目標電圧発生器１０５からの直流電圧との差分を積分器
１０７に出力する。積分器１０７は比較器１０６から出
力される差分を逐次加算した制御信号を可変利得増幅器
１０１及び１０８に出力する。これにより、可変利得増
幅器１０１又は、１０８により第１のブランチ又は第２
のブランチからの信号の一方は所定の電力に増幅され
る。
【０００６】
【発明が解決しようとする課題】 上述の従来技術には
次のような問題点があった。前記可変利得増幅器には、
図７に示すように利得を下げると雑音指数（Ｎｏｉｓｅ
Ｆｉｇｕｒｅ：以下ＮＦと記す）が劣化する。このた
めに、各ブランチ間で制御電圧を共通にしても、双方の
可変利得増幅器のＮＦのばらつきにより、各ブランチの
受信感度を一定にすることができない。
次のような問題点があった。前記可変利得増幅器には、
図７に示すように利得を下げると雑音指数（Ｎｏｉｓｅ
Ｆｉｇｕｒｅ：以下ＮＦと記す）が劣化する。このた
めに、各ブランチ間で制御電圧を共通にしても、双方の
可変利得増幅器のＮＦのばらつきにより、各ブランチの
受信感度を一定にすることができない。
【０００７】
【発明を解決するための手段】 上記課題を解決するた
めの本発明の特徴は、制御信号により増幅度を可変でき
る電圧制御可変増幅器において、前記電圧制御可変増幅
器の入力側に入力側整合回路を接続し、さらに出力側に
出力側整合回路を接続し、前記制御信号に応じて前記入
力側整合回路と前記出力側整合回路を制御することを特
徴とする可変利得増幅器を提供することである。
めの本発明の特徴は、制御信号により増幅度を可変でき
る電圧制御可変増幅器において、前記電圧制御可変増幅
器の入力側に入力側整合回路を接続し、さらに出力側に
出力側整合回路を接続し、前記制御信号に応じて前記入
力側整合回路と前記出力側整合回路を制御することを特
徴とする可変利得増幅器を提供することである。
【０００８】
【発明の実施の形態】 本発明に係る可変利得増幅装置
の実施形態について、図面を用いて詳細に説明する。
の実施形態について、図面を用いて詳細に説明する。
【０００９】 図１に本発明に係る可変利得増幅器の１
実施形態の構成図を示す。１は入力側整合回路、２は可
変利得増幅器、３は出力側整合回路、４は制御部を示し
ている。受信信号はまず１の入力側整合回路で入力側イ
ンピーダンスの整合を最適とする。ここで入力側インピ
ーダンス整合は、制御部４より出力される現在の可変利
得増幅器の利得の応じた入力側整合制御信号によって行
われる。入力側整合を施された受信信号は制御部４より
出力される利得制御信号に応じた利得で可変利得増幅器
４により増幅される。増幅された信号は３の出力側整合
回路で出力側インピーダンスの整合を最適とする。ここ
で出力側インピーダンス整合は入力側と同じく、制御部
４より出力される現在の可変利得増幅器の利得に応じた
出力側整合制御信号によって行われる。
実施形態の構成図を示す。１は入力側整合回路、２は可
変利得増幅器、３は出力側整合回路、４は制御部を示し
ている。受信信号はまず１の入力側整合回路で入力側イ
ンピーダンスの整合を最適とする。ここで入力側インピ
ーダンス整合は、制御部４より出力される現在の可変利
得増幅器の利得の応じた入力側整合制御信号によって行
われる。入力側整合を施された受信信号は制御部４より
出力される利得制御信号に応じた利得で可変利得増幅器
４により増幅される。増幅された信号は３の出力側整合
回路で出力側インピーダンスの整合を最適とする。ここ
で出力側インピーダンス整合は入力側と同じく、制御部
４より出力される現在の可変利得増幅器の利得に応じた
出力側整合制御信号によって行われる。
【００１０】 図２は入力側整合回路の一実施例図であ
る。 Ｃ１、Ｃ２及びＬ１は可変利得増幅器２の入力回
路のインピーダンス整合を最適なものとするためのコン
デンサ及び分布定数線路である。図３は出力側整合回路
の一実施例図である。 図３は出力側整合回路の一実施
例図である。 Ｃ３、Ｃ４及びＬ２は可変利得増幅器２
の出力回路のインピーダンス整合を最適なものとするた
めのコンデンサ及び分布定数線路である。なお、Ｃ１、
Ｃ２、Ｃ３、Ｃ４はバリキャップコンデンサであり、後
述する整合制御信号により制御される。
る。 Ｃ１、Ｃ２及びＬ１は可変利得増幅器２の入力回
路のインピーダンス整合を最適なものとするためのコン
デンサ及び分布定数線路である。図３は出力側整合回路
の一実施例図である。 図３は出力側整合回路の一実施
例図である。 Ｃ３、Ｃ４及びＬ２は可変利得増幅器２
の出力回路のインピーダンス整合を最適なものとするた
めのコンデンサ及び分布定数線路である。なお、Ｃ１、
Ｃ２、Ｃ３、Ｃ４はバリキャップコンデンサであり、後
述する整合制御信号により制御される。
【００１１】 図４は制御部４の一実施例図である。１
０はＡ／Ｄ変換器、１１はＲＯＭ、１２、１３、１４、
１５、１６はＤ／Ａ変換器、１７、１８、１９、２０、
２１はＬＰＦを示している。
０はＡ／Ｄ変換器、１１はＲＯＭ、１２、１３、１４、
１５、１６はＤ／Ａ変換器、１７、１８、１９、２０、
２１はＬＰＦを示している。
【００１２】 上記制御部のＲＯＭ１１には、可変利得
増幅器２の出力に対応したアドレスの領域に利得制御信
号データが記憶されており、Ａ／Ｄ変換器１０によりア
ナログ／ディジタル変換された可変利得増幅器２の出力
をアドレスとしてＲＯＭ１１より利得制御電圧データが
出力され、Ｄ／Ａ変換器１３によりディジタル／アナロ
グ変換され、可変利得増幅器２の利得を制御する。
増幅器２の出力に対応したアドレスの領域に利得制御信
号データが記憶されており、Ａ／Ｄ変換器１０によりア
ナログ／ディジタル変換された可変利得増幅器２の出力
をアドレスとしてＲＯＭ１１より利得制御電圧データが
出力され、Ｄ／Ａ変換器１３によりディジタル／アナロ
グ変換され、可変利得増幅器２の利得を制御する。
【００１３】 ここで、従来の技術における課題とし
て、図７に示すように利得を下げるとＮＦが劣化する問
題があった。図７に示した例では、利得制御電圧が３Ｖ
以下になると急激に劣化することがわかる。そこで、予
め各制御電圧に応じて最もＮＦが良好になるように、入
力側整合回路１及び出力側整合回路３のバリキャップコ
ンデンサの制御電圧値を測定し、整合制御電圧としてＲ
ＯＭ１１の可変利得増幅器２の出力に対応したアドレス
の記憶領域に記憶しておく。このときのそれぞれのバリ
キャップＣ１、Ｃ２、Ｃ３、Ｃ４の制御電圧値を利得制
御電圧に応じて出力されるようにＲＯＭ１１に記憶す
る。
て、図７に示すように利得を下げるとＮＦが劣化する問
題があった。図７に示した例では、利得制御電圧が３Ｖ
以下になると急激に劣化することがわかる。そこで、予
め各制御電圧に応じて最もＮＦが良好になるように、入
力側整合回路１及び出力側整合回路３のバリキャップコ
ンデンサの制御電圧値を測定し、整合制御電圧としてＲ
ＯＭ１１の可変利得増幅器２の出力に対応したアドレス
の記憶領域に記憶しておく。このときのそれぞれのバリ
キャップＣ１、Ｃ２、Ｃ３、Ｃ４の制御電圧値を利得制
御電圧に応じて出力されるようにＲＯＭ１１に記憶す
る。
【００１４】 前記ＲＯＭ１１に記憶されたバリキャッ
プＣ１、Ｃ２、Ｃ３、Ｃ４の整合制御信号は、前記ディ
ジタル化された可変利得増幅器２の出力をアドレスとし
てＲＯＭ１１よりそれぞれのバリキャップに出力され、
各利得で最もＮＦの劣化が少ないように入力側整合回路
１、出力側整合回路３を制御する。
プＣ１、Ｃ２、Ｃ３、Ｃ４の整合制御信号は、前記ディ
ジタル化された可変利得増幅器２の出力をアドレスとし
てＲＯＭ１１よりそれぞれのバリキャップに出力され、
各利得で最もＮＦの劣化が少ないように入力側整合回路
１、出力側整合回路３を制御する。
【００１５】 図５には、本発明を実施した場合の利得
制御電圧とＮＦの関係を示している。従来と比較すると
本発明を実施した場合、利得を下げてもＮＦの劣化が抑
えられているのがわかる。
制御電圧とＮＦの関係を示している。従来と比較すると
本発明を実施した場合、利得を下げてもＮＦの劣化が抑
えられているのがわかる。
【００１６】
【発明の効果】 以上のように本発明によれば、可変利
得制御回路の利得を下げてもＮＦの劣化を最小限に抑え
ることができる。本発明をダイバシティ方式の受信機に
適用した場合、ＮＦのばらつきによる受信感度の劣化を
抑えることができ、例えばブランチ間での利得制御電圧
を共通にしたときのブランチ間の受信感度のばらつき
や、利得を下げたブランチの受信感度の劣化を最小限に
抑えることができる。
得制御回路の利得を下げてもＮＦの劣化を最小限に抑え
ることができる。本発明をダイバシティ方式の受信機に
適用した場合、ＮＦのばらつきによる受信感度の劣化を
抑えることができ、例えばブランチ間での利得制御電圧
を共通にしたときのブランチ間の受信感度のばらつき
や、利得を下げたブランチの受信感度の劣化を最小限に
抑えることができる。
【図１】本発明の一実施例における可変利得増幅器構成
図。
図。
【図２】本発明の一実施例における入力側整合回路構成
図。
図。
【図３】本発明の一実施例における出力側整合回路構成
図。
図。
【図４】本発明の一実施例における制御部構成図。
【図５】本発明の一実施例における利得制御電圧とＮＦ
の関係図。
の関係図。
【図６】従来技術におけるダイバシティ方式受信機構成
図。
図。
【図７】従来技術における利得制御電圧とＮＦの関係
図。
図。
フロントページの続き (51)Int.Cl.7 識別記号 ＦＩ テーマコート゛(参考） Ｈ０４Ｂ 7/08 Ｈ０４Ｂ 7/08 Ｆターム(参考） 5J067 AA04 CA35 CA41 FA19 HA29 HA33 KA00 KA11 KA17 KA29 KA31 KA33 KA34 KA42 KA68 KS01 KS11 LS01 SA13 TA01 TA02 5J100 JA01 KA05 LA00 LA02 LA09 QA00 QA01 SA02 5K046 AA05 BA00 DD13 DD19 5K059 CC03 DD37 5K062 AA00 AB03 AD08 AE02 BB03 BB09 BB13 BE05
Claims (1)
- 【請求項１】 制御信号により増幅度を可変できる電圧
制御可変増幅器において、前記電圧制御可変増幅器の入
力側に入力側整合回路を接続し、さらに出力側に出力側
整合回路を接続し、前記制御信号に応じて前記入力側整
合回路と前記出力側整合回路を制御することを特徴とす
る可変利得増幅器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000192334A JP2002009651A (ja) | 2000-06-27 | 2000-06-27 | 可変利得増幅器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000192334A JP2002009651A (ja) | 2000-06-27 | 2000-06-27 | 可変利得増幅器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2002009651A true JP2002009651A (ja) | 2002-01-11 |
Family
ID=18691483
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2000192334A Pending JP2002009651A (ja) | 2000-06-27 | 2000-06-27 | 可変利得増幅器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2002009651A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20030096861A (ko) * | 2002-06-18 | 2003-12-31 | 엘지전자 주식회사 | 전압제어를 통한 주파수 변경 가능한 고주파 증폭기 |
| KR100749932B1 (ko) | 2004-03-05 | 2007-08-16 | 아바고테크놀로지스코리아 주식회사 | 바이패스 스위치를 사용하지 않는 다중 전력 모드 전력증폭 장치 |
| JP2008271517A (ja) * | 2007-03-23 | 2008-11-06 | Matsushita Electric Ind Co Ltd | 高周波電力増幅器、半導体装置、および高周波電力増幅方法 |
-
2000
- 2000-06-27 JP JP2000192334A patent/JP2002009651A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20030096861A (ko) * | 2002-06-18 | 2003-12-31 | 엘지전자 주식회사 | 전압제어를 통한 주파수 변경 가능한 고주파 증폭기 |
| KR100749932B1 (ko) | 2004-03-05 | 2007-08-16 | 아바고테크놀로지스코리아 주식회사 | 바이패스 스위치를 사용하지 않는 다중 전력 모드 전력증폭 장치 |
| JP2008271517A (ja) * | 2007-03-23 | 2008-11-06 | Matsushita Electric Ind Co Ltd | 高周波電力増幅器、半導体装置、および高周波電力増幅方法 |
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