JP2001189551A - 回路基板 - Google Patents

回路基板

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JP2001189551A
JP2001189551A JP37415999A JP37415999A JP2001189551A JP 2001189551 A JP2001189551 A JP 2001189551A JP 37415999 A JP37415999 A JP 37415999A JP 37415999 A JP37415999 A JP 37415999A JP 2001189551 A JP2001189551 A JP 2001189551A
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JP
Japan
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circuit board
board
terminal electrodes
pair
substrate
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Application number
JP37415999A
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English (en)
Inventor
Manabu Ito
学 伊藤
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Nihon Dempa Kogyo Co Ltd
Original Assignee
Nihon Dempa Kogyo Co Ltd
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  • Electric Connection Of Electric Components To Printed Circuits (AREA)

Abstract

(57)【要約】 (修正有) 【課題】電子部品の位置ズレを防止した回路基板を提供
する。 【解決手段】表面実装用の一対の端子電極を有する電子
部品が搭載され、前記端子電極に対応した基板側端子電
極4a,4bを有する回路パターンの形成された回路基
板1において、前記一対の基板側端子電極及び該一対の
基板側端子電極間の基板表面のみを露出して、全面的に
絶縁層5を設けた構成とする。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、表面実装用の電子
部品を搭載する回路基板を産業上の技術分野とし、特に
小型な電子部品を搭載する回路基板に関する。
【0002】
【従来の技術】(発明の背景)電子部品を搭載する回路
基板は種々の電子機器に使用され、例えば水晶発振器で
はガラスエポキシ材が使用されている。そして、電子機
器の小型化に伴い、電子部品の端子電極及びこれに対応
した基板側端子電極も縮小化している。
【0003】(従来技術の一例)第4図及び第5図は一
従来例を説明する図で、第4図は回路基板の平面図、第
5図は同断面図である。回路基板1はガラスエポキシ材
からなり、例えば銅箔を全面に形成してエッチングよっ
て不要部分を除去し、回路パターンを形成する。回路パ
ターンは、電子部品2の一対の端子電極3(ab)を電
気的に接続する基板側端子電極4(ab)(基板端子と
する)を有する。通常では、基板端子4(ab)を除い
て全面的に絶縁層5が形成される。絶縁層5は例えば樹
脂を主とし、パターン間等の電気的短絡及び基板内への
湿気の侵入等を防止する。
【0004】このようなものでは、一般に、基板端子4
(ab)上にマスクを用いてクリーム半田6が塗布さ
れ、各電子部品2の端子電極3(ab)が位置決めされ
て載置される(第6図)。そして、高熱炉を搬送してク
リーム半田6を溶融し、各電子部品2を回路基板1上に
搭載する(第7図)。
【0005】
【発明が解決しようとする課題】(従来技術の問題点)
しかしながら、上記構成の回路基板1では、電子部品2
が小さくなるほど基板端子4(ab)も小さくなる。そ
して、クリーム半田6の塗布面積も小さく、マスクの穴
も小さくなる。このため、クリーム半田6を塗布してマ
スクを外す際、クリーム半田6がマスクに付着して十分
に塗布できない問題を生じた。
【0006】そこで、マスクの厚みを小さくしてクリー
ム半田6を薄くしたところ、クリーム半田6がマスクか
らスムーズに外すことができた。しかし、この場合に
は、絶縁層5の厚みより小さくなり、電子部品2の搭載
に障害を生じた。すなわち、第7図に示したように基板
端子4(ab)の間の絶縁層5と電子部品2の底面とが
接触して、半田によるセルフアライメント(自己整列)
機能を抑止し、電子部品2の位置がずれる問題があった
(第8図)。
【0007】(発明の目的)本発明は、電子部品の位置
ズレを防止した回路基板を提供することを目的とする。
【0008】
【課題を解決するための手段】本発明は、一対の基板端
子4(ab)及び一対の基板端子4(ab)間の基板表
面のみを露出して、全面的に絶縁層5を設けたことを解
決手段とする。
【0009】
【作用】本発明は、基板端子4(ab)間の基板表面を
露出したので、基板端子4(ab)間の障害物を排除
し、クリーム半田6によるセルフアライメント機能を維
持する。以下、本発明の一実施例を説明する。
【0010】
【実施例】第1図及び第2図は本発明の一実施例を説明
する回路基板の図で、第1図は平面図、第2図は断面図
である。なお、前従来例図と同一部分には同番号を付与
してその説明は簡略又は省略する。回路基板1は、前述
のようにガラスエポキシ材からなり、基板端子4(a
b)を有する回路パターンが形成され、樹脂を主とした
絶縁膜5が表面に塗布される。そして、この実施例で
は、基板端子4(ab)及び基板端子4(ab)間の基
板表面を除いて、絶縁膜5が塗布される。換言すると、
基板端子4(ab)及び基板端子4(ab)間のみを露
出して全面的に絶縁膜5を塗布する。そして、複数の基
板端子4(ab)には、発振回路を構成する水晶振動子
やコンデンサ及び抵抗等の表面実装用の各電子部品が、
クリーム半田によって固着し、搭載される。
【0011】このような構成であれば、基板端子4(a
b)間の絶縁層5を除去して障害物を無くしたので、ク
リーム半田6の厚みを小さくしても、電子部品2が絶縁
層5に接触することがない。したがって、電子部品5の
クリーム半田6によるセルフアライメント機能を維持す
る。したがって、電子部品5の位置ズレを防止して正確
に配置できる(第3図)。
【0012】
【他の事項】上記実施例では、回路基板1はガラスエポ
キシ材としたが他の材料であってもよく、絶縁層を必要
とする回路基板に適用できる。また、回路基板1には発
振回路を構成する各素子を搭載するとしたが、どのよう
な回路であってもよい。また、絶縁層5は樹脂を主とし
たがガラス等であってもよく要は絶縁性であればよい。
【0013】
【発明の効果】本発明は、一対の基板端子及び一対の基
板端子4(ab)間の基板表面を露出して、全面的に絶
縁層を設けたので、電子部品の位置ズレを防止した回路
基板を提供できる。
【図面の簡単な説明】
【図1】本発明の一実施例を説明する回路基板の平面図
である。
【図2】本発明の一実施例を説明する回路基板の装着断
面図である。
【図3】本発明の効果を説明する基板端子の装着平面図
である。
【図4】従来例を説明する回路基板の平面図である。
【図5】従来例を説明する回路基板の装着断面図であ
る。
【図6】従来例を説明する回路基板の装着断面図であ
る。
【図7】従来例を説明する回路基板の装着断面図であ
る。
【図8】従来例の問題点を説明する装着平面図である。
【符号の説明】
1 回路基板、2 電子部品、3 端子電極、4 基板
端子、5 絶縁層、6クリ−ム半田.

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】表面実装用の一対の端子電極を有する複数
    の電子部品が搭載され、前記一対の端子電極に対応した
    基板側端子電極を有する回路パターンの形成された回路
    基板において、前記一対の基板側端子電極及び該一対の
    基板側端子電極間の基板表面のみを露出して、全面的に
    絶縁層を設けたことを特徴とする回路基板。
JP37415999A 1999-12-28 1999-12-28 回路基板 Pending JP2001189551A (ja)

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