JP2000050647A - インバータ装置 - Google Patents
インバータ装置Info
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- JP2000050647A JP2000050647A JP10211589A JP21158998A JP2000050647A JP 2000050647 A JP2000050647 A JP 2000050647A JP 10211589 A JP10211589 A JP 10211589A JP 21158998 A JP21158998 A JP 21158998A JP 2000050647 A JP2000050647 A JP 2000050647A
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Abstract
(57)【要約】
【課題】 比較的簡単な構成で確実に異常を検出できる
ようにしたインバータ装置を提供する。 【解決手段】 ２つのトランジスタＴｒ２，Ｔｒ３と、
コンデンサＣ１と、トランスＴ１とから発振回路ＯＳＣ
が構成されている。発振回路ＯＳＣは、正常動作時は、
２つのトランジスタＴｒ２，Ｔｒ３が交互に飽和オン状
態となって発振を継続する。異常検出回路１１は、２つ
のトランジスタＴｒ２，Ｔｒ３がともに飽和オン状態以
外の状態となったことを異常として検出する。異常検出
回路１２が異常を検出したときは、フリップフロップ１
１がリセットされ、トランジスタＴｒ１がオフされる。
ようにしたインバータ装置を提供する。 【解決手段】 ２つのトランジスタＴｒ２，Ｔｒ３と、
コンデンサＣ１と、トランスＴ１とから発振回路ＯＳＣ
が構成されている。発振回路ＯＳＣは、正常動作時は、
２つのトランジスタＴｒ２，Ｔｒ３が交互に飽和オン状
態となって発振を継続する。異常検出回路１１は、２つ
のトランジスタＴｒ２，Ｔｒ３がともに飽和オン状態以
外の状態となったことを異常として検出する。異常検出
回路１２が異常を検出したときは、フリップフロップ１
１がリセットされ、トランジスタＴｒ１がオフされる。
Description
【０００１】
【発明の属する技術分野】本発明は、直流電圧を交流電
圧に変換するインバータ装置に関し、特に異常を検出す
る機能を有するインバータ装置に関する。
圧に変換するインバータ装置に関し、特に異常を検出す
る機能を有するインバータ装置に関する。
【０００２】
【従来の技術】直流電圧を交流電圧に変換して出力する
インバータ装置の異常のうち、入力電流が通常の４倍程
度以上となるようなものは、入力直流電圧を供給する給
電線の途中にフューズなどを挿入することにより、比較
的簡単に対応することができる。しかし、出力トランス
の一部の巻線が短絡したり、負荷が異常に重くなったり
した場合おいて、異常な発振状態となって電流の増加が
４倍程度以下であるときは、フューズを挿入することで
対処することは困難であるが、そのような異常発振状態
が長時間継続することにより、トランジスタやトランス
が高温となって故障に至ることがある。
インバータ装置の異常のうち、入力電流が通常の４倍程
度以上となるようなものは、入力直流電圧を供給する給
電線の途中にフューズなどを挿入することにより、比較
的簡単に対応することができる。しかし、出力トランス
の一部の巻線が短絡したり、負荷が異常に重くなったり
した場合おいて、異常な発振状態となって電流の増加が
４倍程度以下であるときは、フューズを挿入することで
対処することは困難であるが、そのような異常発振状態
が長時間継続することにより、トランジスタやトランス
が高温となって故障に至ることがある。
【０００３】そのような電流値の急激な増加を伴わない
異常を検出する機能を有するインバータ装置として、例
えば図４に示すようなものが従来より知られている。こ
の装置は、トランジスタＴｒ１，Ｔｒ２，Ｔｒ３と、巻
線Ｗ１〜Ｗ３を有するトランスＴ１と、コンデンサＣ１
と、抵抗Ｒ１と、コイルＬ１と、単安定マルチバイブレ
ータ１０１と、バンドパスフィルタ１０２と、整流回路
１０３とを備えており、トランスＴ１の出力側には、当
該インバータ装置の負荷としての蛍光ランプ３０と、バ
ラストコンデンサＣ２１，Ｃ２２とが接続されている。
トランジスタＴｒ２，Ｔｒ３と、コンデンサＣ１と、ト
ランスＴ１とによって発振回路ＯＳＣが構成されてい
る。なお、バラストコンデンサが２つ設けられているの
は、バラストコンデンサ自体の異常に対応するためであ
る。
異常を検出する機能を有するインバータ装置として、例
えば図４に示すようなものが従来より知られている。こ
の装置は、トランジスタＴｒ１，Ｔｒ２，Ｔｒ３と、巻
線Ｗ１〜Ｗ３を有するトランスＴ１と、コンデンサＣ１
と、抵抗Ｒ１と、コイルＬ１と、単安定マルチバイブレ
ータ１０１と、バンドパスフィルタ１０２と、整流回路
１０３とを備えており、トランスＴ１の出力側には、当
該インバータ装置の負荷としての蛍光ランプ３０と、バ
ラストコンデンサＣ２１，Ｃ２２とが接続されている。
トランジスタＴｒ２，Ｔｒ３と、コンデンサＣ１と、ト
ランスＴ１とによって発振回路ＯＳＣが構成されてい
る。なお、バラストコンデンサが２つ設けられているの
は、バラストコンデンサ自体の異常に対応するためであ
る。
【０００４】同図において直流電圧ＶＩＮが供給される
とともに単安定マルチバイブレータ１０１にパルス状の
スタートストップ信号ＳＳが入力されると、単安定マル
チバイブレータ１０１の出力が低レベルとなり、トラン
ジスタＴｒ１がオンする。これにより、トランジスタＴ
ｒ２，Ｔｒ３にバイアス電圧が供給され、発振回路ＯＳ
Ｃが所定の周波数ｆ０で発振を始める。バンドパスフィ
ルタ１０２の通過帯域は、所定周波数ｆ０を中心とした
範囲に設定されており、発振回路ＯＳＣが所定周波数ｆ
０の近傍の周波数で発振しているときは、バンドパスフ
ィルタ１０２の出力信号を整流回路１０３で整流した直
流電圧によりトランジスタＴｒ１がオンできるように構
成されている。したがって、単安定マルチバイブレータ
１０１の出力が高レベルとなっても、トランジスタＴｒ
１は、オン状態を継続し、発振回路ＯＳＣは発振を継続
する。
とともに単安定マルチバイブレータ１０１にパルス状の
スタートストップ信号ＳＳが入力されると、単安定マル
チバイブレータ１０１の出力が低レベルとなり、トラン
ジスタＴｒ１がオンする。これにより、トランジスタＴ
ｒ２，Ｔｒ３にバイアス電圧が供給され、発振回路ＯＳ
Ｃが所定の周波数ｆ０で発振を始める。バンドパスフィ
ルタ１０２の通過帯域は、所定周波数ｆ０を中心とした
範囲に設定されており、発振回路ＯＳＣが所定周波数ｆ
０の近傍の周波数で発振しているときは、バンドパスフ
ィルタ１０２の出力信号を整流回路１０３で整流した直
流電圧によりトランジスタＴｒ１がオンできるように構
成されている。したがって、単安定マルチバイブレータ
１０１の出力が高レベルとなっても、トランジスタＴｒ
１は、オン状態を継続し、発振回路ＯＳＣは発振を継続
する。
【０００５】一方何らかの異常が発生して発振回路ＯＳ
Ｃの発振周波数が所定周波数ｆ０近傍からずれると、バ
ンドパスフィルタ１０２の出力信号レベルが低下し、整
流回路１０３の出力直流電圧が高くなって、トランジス
タＴｒ１がオフされる。これにより、発振回路ＯＳＣの
発振が停止し、負荷（蛍光ランプ３０）への電力供給が
停止する。
Ｃの発振周波数が所定周波数ｆ０近傍からずれると、バ
ンドパスフィルタ１０２の出力信号レベルが低下し、整
流回路１０３の出力直流電圧が高くなって、トランジス
タＴｒ１がオフされる。これにより、発振回路ＯＳＣの
発振が停止し、負荷（蛍光ランプ３０）への電力供給が
停止する。
【０００６】
【発明が解決しようとする課題】しかしながら、上記従
来の装置では以下のような問題点があった。発振回路Ｏ
ＣＳを構成する部品のばらつき、主にトランスＴ１のイ
ンダクタンス及びコンデンサＣ１の静電容量のばらつき
が大きいために、発振回路ＯＳＣの発振周波数のばらつ
きも大きくなり、バンドパスフィルタ１０２の通過帯域
幅をあまり狭くできないことから、異常による発振周波
数の変化が小さい場合には、その異常を確実に検出する
ことが困難であった。
来の装置では以下のような問題点があった。発振回路Ｏ
ＣＳを構成する部品のばらつき、主にトランスＴ１のイ
ンダクタンス及びコンデンサＣ１の静電容量のばらつき
が大きいために、発振回路ＯＳＣの発振周波数のばらつ
きも大きくなり、バンドパスフィルタ１０２の通過帯域
幅をあまり狭くできないことから、異常による発振周波
数の変化が小さい場合には、その異常を確実に検出する
ことが困難であった。
【０００７】またこのように異常の検出精度が低いため
に、バラストコンデンサの短絡の可能性を考慮して該コ
ンデンサを２個設ける必要が生じたり、検出精度が低い
にも拘わらず、異常検出回路の構成が複雑であるといっ
た問題点や、インバータ装置の出力周波数、すなわち発
振回路ＯＳＣの発振周波数を設計上変更すると、バンド
パスフィルタ１０２の特性を変更しなければならないと
いった問題点もあった。
に、バラストコンデンサの短絡の可能性を考慮して該コ
ンデンサを２個設ける必要が生じたり、検出精度が低い
にも拘わらず、異常検出回路の構成が複雑であるといっ
た問題点や、インバータ装置の出力周波数、すなわち発
振回路ＯＳＣの発振周波数を設計上変更すると、バンド
パスフィルタ１０２の特性を変更しなければならないと
いった問題点もあった。
【０００８】本発明は、このような問題点を解決すべく
なされたものであり、比較的簡単な構成で確実に異常を
検出できるようにしたインバータ装置を提供することを
目的とする。
なされたものであり、比較的簡単な構成で確実に異常を
検出できるようにしたインバータ装置を提供することを
目的とする。
【０００９】
【課題を解決するための手段】上記目的を達成するため
請求項１に記載の発明は、直流電圧が入力されることに
より、２つのトランジスタが交互に飽和オン状態となっ
て発振する発振回路を備え、該発振回路の出力電圧を出
力するインバータ装置において、前記２つのトランジス
タがともに飽和オン状態以外の状態となったことを異常
として検出する異常検出手段を備えることを特徴とす
る。
請求項１に記載の発明は、直流電圧が入力されることに
より、２つのトランジスタが交互に飽和オン状態となっ
て発振する発振回路を備え、該発振回路の出力電圧を出
力するインバータ装置において、前記２つのトランジス
タがともに飽和オン状態以外の状態となったことを異常
として検出する異常検出手段を備えることを特徴とす
る。
【００１０】請求項２に記載の発明は、請求項１に記載
のインバータ装置において、前記異常検出手段が異常を
検出したときは、前記発振回路の動作を停止させる停止
手段を備えることを特徴とする。
のインバータ装置において、前記異常検出手段が異常を
検出したときは、前記発振回路の動作を停止させる停止
手段を備えることを特徴とする。
【００１１】請求項３に記載の発明は、請求項１または
２に記載のインバータ装置において、前記発振回路は、
センタタップを有する第１の巻線、交流電圧を出力する
第２の巻線及び前記２つのトランジスタのベースに接続
された第３の巻線からなるトランスと、前記第１の巻線
に並列に接続されたコンデンサとを備え、前記センタタ
ップに入力直流電圧が印加され、前記２つのトランジス
タのコレクタはそれぞれ前記第１の巻線の両端に接続さ
れ、前記２つのトランジスタのエミッタはいずれも接地
され、前記２つのトランジスタのベースには抵抗を介し
て前記入力直流電圧が印加されるように構成されている
ことを特徴とする。
２に記載のインバータ装置において、前記発振回路は、
センタタップを有する第１の巻線、交流電圧を出力する
第２の巻線及び前記２つのトランジスタのベースに接続
された第３の巻線からなるトランスと、前記第１の巻線
に並列に接続されたコンデンサとを備え、前記センタタ
ップに入力直流電圧が印加され、前記２つのトランジス
タのコレクタはそれぞれ前記第１の巻線の両端に接続さ
れ、前記２つのトランジスタのエミッタはいずれも接地
され、前記２つのトランジスタのベースには抵抗を介し
て前記入力直流電圧が印加されるように構成されている
ことを特徴とする。
【００１２】
【発明の実施の形態】以下本発明の実施の形態を図面を
参照して説明する。図１は本発明の一実施形態にかかる
インバータ装置の構成を示す図であり、図４に示す従来
の装置と同一の構成要素には同一の符号を付して示して
いる。すなわち図１に示す装置は、従来と同様にトラン
ジスタＴｒ１，Ｔｒ２，Ｔｒ３と、巻線Ｗ１〜Ｗ３を有
するトランスＴ１と、コンデンサＣ１と、抵抗Ｒ１と、
コイルＬ１とを備えており、トランジスタＴｒ２，Ｔｒ
３と、コンデンサＣ１と、トランスＴ１とによって発振
回路ＯＳＣが構成されている。トランスＴ１の出力側に
は、当該インバータ装置の負荷としての蛍光ランプ３０
と、１つのバラストコンデンサＣ２１とが接続されてい
る。
参照して説明する。図１は本発明の一実施形態にかかる
インバータ装置の構成を示す図であり、図４に示す従来
の装置と同一の構成要素には同一の符号を付して示して
いる。すなわち図１に示す装置は、従来と同様にトラン
ジスタＴｒ１，Ｔｒ２，Ｔｒ３と、巻線Ｗ１〜Ｗ３を有
するトランスＴ１と、コンデンサＣ１と、抵抗Ｒ１と、
コイルＬ１とを備えており、トランジスタＴｒ２，Ｔｒ
３と、コンデンサＣ１と、トランスＴ１とによって発振
回路ＯＳＣが構成されている。トランスＴ１の出力側に
は、当該インバータ装置の負荷としての蛍光ランプ３０
と、１つのバラストコンデンサＣ２１とが接続されてい
る。
【００１３】また図１のインバータ装置は、図４の単安
定マルチバイブレータ１０１、バンドパスフィルタ１０
２及び整流回路１０３に代えて、フリップフロップ１１
及び異常検出回路１２を備えている。フリップフロップ
１１は、スタートストップ信号ＳＳが低レベルから高レ
ベルに立ち上がるとセットされ、その出力は低レベルと
なってトランジスタＴｒ１をオン状態とする。またフリ
ップフロップ１１は、異常検出回路１２の出力が低レベ
ルから高レベルに立ち上がるとリセットされ、その出力
は高レベルとなってトランジスタＴｒ１をオフ状態とす
る。
定マルチバイブレータ１０１、バンドパスフィルタ１０
２及び整流回路１０３に代えて、フリップフロップ１１
及び異常検出回路１２を備えている。フリップフロップ
１１は、スタートストップ信号ＳＳが低レベルから高レ
ベルに立ち上がるとセットされ、その出力は低レベルと
なってトランジスタＴｒ１をオン状態とする。またフリ
ップフロップ１１は、異常検出回路１２の出力が低レベ
ルから高レベルに立ち上がるとリセットされ、その出力
は高レベルとなってトランジスタＴｒ１をオフ状態とす
る。
【００１４】発振回路ＯＳＣの２つのトランジスタＴｒ
２，Ｔｒ３は、正常な状態では、交互の飽和オン状態と
なる。すなわち両トランジスタのコレクタ電圧をそれぞ
れＶＣ１，ＶＣ２とすると、図３（ｂ）（ｃ）に示すよ
うに、時刻ｔ１〜ｔ２の期間は、トランジスタＴｒ２が
飽和オン状態となり、トランジスタＴｒ３のコレクタ電
圧ＶＣ２に発振波形が表れ、時刻ｔ２〜ｔ３の期間では
逆にトランジスタＴｒ３が飽和オン状態となり、トラン
ジスタＴｒ２のコレクタ電圧ＶＣ１に発振波形が表れ、
この動作が繰り返される。そこで本実施形態の異常検出
回路１２は、トランジスタＴｒ２，Ｔｒ３の少なくとも
一方が飽和オン状態にあれば正常と判定して、その出力
を低レベルに維持し、トランジスタＴｒ２，Ｔｒ３がと
もに飽和オン状態でない状態となったとき、異常と判定
してその出力を低レベルから高レベルに変化させるよう
に構成されている。
２，Ｔｒ３は、正常な状態では、交互の飽和オン状態と
なる。すなわち両トランジスタのコレクタ電圧をそれぞ
れＶＣ１，ＶＣ２とすると、図３（ｂ）（ｃ）に示すよ
うに、時刻ｔ１〜ｔ２の期間は、トランジスタＴｒ２が
飽和オン状態となり、トランジスタＴｒ３のコレクタ電
圧ＶＣ２に発振波形が表れ、時刻ｔ２〜ｔ３の期間では
逆にトランジスタＴｒ３が飽和オン状態となり、トラン
ジスタＴｒ２のコレクタ電圧ＶＣ１に発振波形が表れ、
この動作が繰り返される。そこで本実施形態の異常検出
回路１２は、トランジスタＴｒ２，Ｔｒ３の少なくとも
一方が飽和オン状態にあれば正常と判定して、その出力
を低レベルに維持し、トランジスタＴｒ２，Ｔｒ３がと
もに飽和オン状態でない状態となったとき、異常と判定
してその出力を低レベルから高レベルに変化させるよう
に構成されている。
【００１５】したがって、スタートストップ信号ＳＳに
より、セットされたフリップフロップ１１の出力は、異
常検出回路１２の出力が高レベルとならない限り低レベ
ルであり、トランジスタＴｒ１はオン状態を維持し、発
振回路ＯＳＣは発振を継続して、トランスＴ１の巻線Ｗ
２から交流電圧が出力される。
より、セットされたフリップフロップ１１の出力は、異
常検出回路１２の出力が高レベルとならない限り低レベ
ルであり、トランジスタＴｒ１はオン状態を維持し、発
振回路ＯＳＣは発振を継続して、トランスＴ１の巻線Ｗ
２から交流電圧が出力される。
【００１６】またトランジスタＴｒ２及びＴｒ３の両方
が飽和オン状態でない状態となると異常検出回路１２の
出力が高レベルに変化し、フリップフロップ１１がリセ
ットされ、その出力が高レベルに変化する。その結果、
トランジスタＴｒ１がオフ状態となり、発振回路ＯＳＣ
は発振を停止する。
が飽和オン状態でない状態となると異常検出回路１２の
出力が高レベルに変化し、フリップフロップ１１がリセ
ットされ、その出力が高レベルに変化する。その結果、
トランジスタＴｒ１がオフ状態となり、発振回路ＯＳＣ
は発振を停止する。
【００１７】図２は、図１のフリップフロップ１１及び
異常検出回路１２の機能を実現するためのより具体的な
構成を示す回路図である。フリップフロップ１１の機能
は、図２の構成例ではトランジスタＴｒ１及びＴｒ４
と、コンデンサＣ２及び抵抗Ｒ２で実現されており、ま
た図１の異常検出回路１２の機能は、図２のトランジス
タＴｒ５，抵抗Ｒ３〜Ｒ６及びダイオードＤ１，Ｄ２か
らなる異常検出回路１２ａにより実現されている。異常
検出回路１２ａは、異常を検出しないときは、トランジ
スタＴｒ５がオフして、その出力レベルが高レベル（オ
ープンコレクタ）であり、異常を検出したときトランジ
スタＴｒ５がオンしてその出力レベルが低レベルとな
る。
異常検出回路１２の機能を実現するためのより具体的な
構成を示す回路図である。フリップフロップ１１の機能
は、図２の構成例ではトランジスタＴｒ１及びＴｒ４
と、コンデンサＣ２及び抵抗Ｒ２で実現されており、ま
た図１の異常検出回路１２の機能は、図２のトランジス
タＴｒ５，抵抗Ｒ３〜Ｒ６及びダイオードＤ１，Ｄ２か
らなる異常検出回路１２ａにより実現されている。異常
検出回路１２ａは、異常を検出しないときは、トランジ
スタＴｒ５がオフして、その出力レベルが高レベル（オ
ープンコレクタ）であり、異常を検出したときトランジ
スタＴｒ５がオンしてその出力レベルが低レベルとな
る。
【００１８】以下図３も参照して図２の回路の動作を説
明する。スタートストップ信号ＳＳ（図３（ａ））が時
刻ｔ０に高レベルとなると、コンデンサＣ２及びトラン
ジスタＴｒ４のベースエミッタ間内部抵抗によって微分
され、コンデンサＣ２の充電が完了するまでの期間、ト
ランジスタＴｒ４のベースに電流が流れてトランジスタ
Ｔｒ４がオン状態となり、これによりトランジスタＴｒ
１もオン状態となる。そして抵抗Ｒ１を介してトランジ
スタＴｒ２，Ｔｒ３のベースに電流が供給され、発振回
路ＯＳＣが動作を開始するため、ダイオードＤ１，Ｄ２
のアノード側の電圧ＶＤが低下し、トランジスタＴｒ５
はオフ状態となる。その結果、抵抗Ｒ２を介してトラン
ジスタＴｒ４のベースに電流が供給されるので、コンデ
ンサＣ２の充電が完了してもトランジスタＴｒ４及びＴ
ｒ１はオン状態を継続する（フリップフロップ１１のセ
ット状態に対応する）。
明する。スタートストップ信号ＳＳ（図３（ａ））が時
刻ｔ０に高レベルとなると、コンデンサＣ２及びトラン
ジスタＴｒ４のベースエミッタ間内部抵抗によって微分
され、コンデンサＣ２の充電が完了するまでの期間、ト
ランジスタＴｒ４のベースに電流が流れてトランジスタ
Ｔｒ４がオン状態となり、これによりトランジスタＴｒ
１もオン状態となる。そして抵抗Ｒ１を介してトランジ
スタＴｒ２，Ｔｒ３のベースに電流が供給され、発振回
路ＯＳＣが動作を開始するため、ダイオードＤ１，Ｄ２
のアノード側の電圧ＶＤが低下し、トランジスタＴｒ５
はオフ状態となる。その結果、抵抗Ｒ２を介してトラン
ジスタＴｒ４のベースに電流が供給されるので、コンデ
ンサＣ２の充電が完了してもトランジスタＴｒ４及びＴ
ｒ１はオン状態を継続する（フリップフロップ１１のセ
ット状態に対応する）。
【００１９】トランジスタＴｒ１がオン状態となると抵
抗Ｒ１を介してトランジスタＴｒ２及びＴｒ３のベース
に電流が供給され、時刻ｔ６において異常が発生し、時
刻ｔ７において異常検出回路１２ａにより異常が検出さ
れるまでの間は、発振回路ＯＳＣが正常な発振状態を継
続する。すなわち、トランジスタＴｒ２が先ず飽和オン
状態となってそのコレクタ電圧ＶＣ１はほぼ０Ｖ（ＧＮ
Ｄ）になるとともに、トランジスタＴｒ３は、飽和オン
状態からオフ状態となって、コレクタ電圧ＶＣ２は発振
周波数の半周期分の正弦波状の電圧波形を示す（ｔ１〜
ｔ２）。そして電圧ＶＣ２が０Ｖとなり、トランジスタ
Ｔｒ３が飽和オン状態となると、トランジスタＴｒ２が
オフ状態となり、コレクタ電圧ＶＣ１は半周期分の正弦
波状の電圧波形を示す（ｔ２〜ｔ３）。以後回路が正常
である間は、この動作が繰り返される（ｔ３〜ｔ６）。
抗Ｒ１を介してトランジスタＴｒ２及びＴｒ３のベース
に電流が供給され、時刻ｔ６において異常が発生し、時
刻ｔ７において異常検出回路１２ａにより異常が検出さ
れるまでの間は、発振回路ＯＳＣが正常な発振状態を継
続する。すなわち、トランジスタＴｒ２が先ず飽和オン
状態となってそのコレクタ電圧ＶＣ１はほぼ０Ｖ（ＧＮ
Ｄ）になるとともに、トランジスタＴｒ３は、飽和オン
状態からオフ状態となって、コレクタ電圧ＶＣ２は発振
周波数の半周期分の正弦波状の電圧波形を示す（ｔ１〜
ｔ２）。そして電圧ＶＣ２が０Ｖとなり、トランジスタ
Ｔｒ３が飽和オン状態となると、トランジスタＴｒ２が
オフ状態となり、コレクタ電圧ＶＣ１は半周期分の正弦
波状の電圧波形を示す（ｔ２〜ｔ３）。以後回路が正常
である間は、この動作が繰り返される（ｔ３〜ｔ６）。
【００２０】この時刻ｔ０〜ｔ６の期間中は、コレクタ
電圧ＶＣ１またはＶＣ２のいずれかがほぼ０Ｖとなって
いるため、ダイオードＤ１，Ｄ２のアノード側の電圧Ｖ
Ｄは、ほぼ一定の値Ｖｄ（ダイオードの順方向電圧）と
なる（図３（ｄ）参照）。したがって、トランジスタＴ
ｒ５は、オフ状態を維持する。
電圧ＶＣ１またはＶＣ２のいずれかがほぼ０Ｖとなって
いるため、ダイオードＤ１，Ｄ２のアノード側の電圧Ｖ
Ｄは、ほぼ一定の値Ｖｄ（ダイオードの順方向電圧）と
なる（図３（ｄ）参照）。したがって、トランジスタＴ
ｒ５は、オフ状態を維持する。
【００２１】その後時刻ｔ６において、例えばバラスト
コンデンサＣ２１が短絡する異常が発生したときは、負
荷電流（蛍光ランプ３０を流れる電流）が異常に増加す
るため、このとき飽和オン状態にあるトランジスタＴｒ
２のコレクタ電流が増加してコレクタ電圧ＶＣ１が増加
する。その結果時刻ｔ７においてトランジスタＴｒ５が
オン状態となり、トランジスタＴｒ４及びＴｒ１がとも
にオフ状態となり（フリップフロップ１１のリセット状
態に対応する）、トランジスタＴｒ２，Ｔｒ３へのバイ
アス電圧の供給がなくなってともにオフ状態となり、発
振回路ＯＳＣは発振を停止する。
コンデンサＣ２１が短絡する異常が発生したときは、負
荷電流（蛍光ランプ３０を流れる電流）が異常に増加す
るため、このとき飽和オン状態にあるトランジスタＴｒ
２のコレクタ電流が増加してコレクタ電圧ＶＣ１が増加
する。その結果時刻ｔ７においてトランジスタＴｒ５が
オン状態となり、トランジスタＴｒ４及びＴｒ１がとも
にオフ状態となり（フリップフロップ１１のリセット状
態に対応する）、トランジスタＴｒ２，Ｔｒ３へのバイ
アス電圧の供給がなくなってともにオフ状態となり、発
振回路ＯＳＣは発振を停止する。
【００２２】以上のように本実施形態では、発振回路Ｏ
ＳＣを構成する２つのトランジスタＴｒ２，Ｔｒ３がと
もに飽和オン状態以外の状態となったことを異常として
検出する異常検出回路１２（１２ａ）を設け、異常検出
回路１２により異常が検出されたときは、トランジスタ
Ｔｒ１をオフしてトランジスタＴｒ２，Ｔｒ３へのバイ
アス電圧の供給を停止するようにしたので、比較的簡単
な回路構成でインバータ装置またはその負荷の異常を確
実に検出することができ、トランジスタやトランスの故
障などを未然に防止することができる。
ＳＣを構成する２つのトランジスタＴｒ２，Ｔｒ３がと
もに飽和オン状態以外の状態となったことを異常として
検出する異常検出回路１２（１２ａ）を設け、異常検出
回路１２により異常が検出されたときは、トランジスタ
Ｔｒ１をオフしてトランジスタＴｒ２，Ｔｒ３へのバイ
アス電圧の供給を停止するようにしたので、比較的簡単
な回路構成でインバータ装置またはその負荷の異常を確
実に検出することができ、トランジスタやトランスの故
障などを未然に防止することができる。
【００２３】なお本発明は上述した実施形態に限るもの
ではなく、種々の変形が可能である。例えば、異常検出
回路により異常が検出されたときは、発振回路ＯＳＣの
発信を停止させればよく、入力直流電圧ＶＩＮの入力を
停止するようにしてもよいし、あるいはトランジスタＴ
ｒ２，Ｔｒ３のコレクタへの電圧供給を停止するように
してもよい。
ではなく、種々の変形が可能である。例えば、異常検出
回路により異常が検出されたときは、発振回路ＯＳＣの
発信を停止させればよく、入力直流電圧ＶＩＮの入力を
停止するようにしてもよいし、あるいはトランジスタＴ
ｒ２，Ｔｒ３のコレクタへの電圧供給を停止するように
してもよい。
【００２４】
【発明の効果】以上詳述したように本発明は、直流電圧
が入力されることにより、２つのトランジスタが交互に
飽和オン状態となって発振する発振回路を備え、該発振
回路の出力電圧を出力するインバータ装置において、前
記２つのトランジスタがともに飽和オン状態以外の状態
となったことを異常として検出するようにしたので、比
較的簡単な回路構成でインバータ装置またはその負荷の
異常を確実に検出することができる。
が入力されることにより、２つのトランジスタが交互に
飽和オン状態となって発振する発振回路を備え、該発振
回路の出力電圧を出力するインバータ装置において、前
記２つのトランジスタがともに飽和オン状態以外の状態
となったことを異常として検出するようにしたので、比
較的簡単な回路構成でインバータ装置またはその負荷の
異常を確実に検出することができる。
【図１】本発明の一実施形態にかかるインバータ装置の
構成を示す図である。
構成を示す図である。
【図２】図１のインバータ装置のより具体的な構成例を
示す回路図である。
示す回路図である。
【図３】図２の回路の動作を説明するためのタイムチャ
ートである。
ートである。
【図４】従来のインバータ装置の構成を示す図である。
１１ フリップフロップ（停止手段） １２ 異常検出回路（異常検出手段） Ｔｒ１，Ｔｒ４ トランジスタ（停止手段） Ｔｒ２，Ｔｒ３ トランジスタ（発振回路） Ｔｒ５ トランジスタ（異常検出手段） Ｃ１ コンデンサ（発振回路） Ｔ１ トランス（発振回路） Ｗ１，Ｗ２，Ｗ３ 巻線
Claims (3)
- 【請求項１】 直流電圧が入力されることにより、２つ
のトランジスタが交互に飽和オン状態となって発振する
発振回路を備え、該発振回路の出力電圧を出力するイン
バータ装置において、 前記２つのトランジスタがともに飽和オン状態以外の状
態となったことを異常として検出する異常検出手段を備
えることを特徴とするインバータ装置。 - 【請求項２】 前記異常検出手段が異常を検出したとき
は、前記発振回路の動作を停止させる停止手段を備える
ことを特徴とする請求項１に記載のインバータ装置。 - 【請求項３】 前記発振回路は、センタタップを有する
第１の巻線、交流電圧を出力する第２の巻線及び前記２
つのトランジスタのベースに接続された第３の巻線から
なるトランスと、前記第１の巻線に並列に接続されたコ
ンデンサとを備え、前記センタタップに入力直流電圧が
印加され、前記２つのトランジスタのコレクタはそれぞ
れ前記第１の巻線の両端に接続され、前記２つのトラン
ジスタのエミッタはいずれも接地され、前記２つのトラ
ンジスタのベースには抵抗を介して前記入力直流電圧が
印加されるように構成されていることを特徴とする請求
項１または２に記載のインバータ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10211589A JP2000050647A (ja) | 1998-07-27 | 1998-07-27 | インバータ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10211589A JP2000050647A (ja) | 1998-07-27 | 1998-07-27 | インバータ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2000050647A true JP2000050647A (ja) | 2000-02-18 |
Family
ID=16608277
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10211589A Withdrawn JP2000050647A (ja) | 1998-07-27 | 1998-07-27 | インバータ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2000050647A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2014058966A1 (en) * | 2012-10-09 | 2014-04-17 | Murata Manufacturing Co., Ltd. | Lossless over-current detection circuit for royer oscillators and push-pull converters |
-
1998
- 1998-07-27 JP JP10211589A patent/JP2000050647A/ja not_active Withdrawn
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2014058966A1 (en) * | 2012-10-09 | 2014-04-17 | Murata Manufacturing Co., Ltd. | Lossless over-current detection circuit for royer oscillators and push-pull converters |
| US9989564B2 (en) | 2012-10-09 | 2018-06-05 | Murata Manufacturing Co., Ltd. | Lossless over-current detection circuit for Royer oscillators and push-pull converters |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20051004 |