JP2000022442A - 電圧制御発振回路 - Google Patents
電圧制御発振回路Info
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- H03B2202/08—Reduction of undesired oscillations originated from the oscillator in circuit elements external to the oscillator by means associated with the oscillator
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- Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
Abstract
(57)【要約】
【課題】 制御電圧端子に接続されるループフィルタ
の、出力側のコンデンサの影響を受け難い電圧制御発振
回路を提供する。 【解決手段】 増幅回路２と、共振回路３と、バラクタ
ダイオードＤ１と、バラクタダイオードＤ１のカソード
に一端を接続したチョーク素子Ｌ１と、チョーク素子Ｌ
１の他端とグランドとの間に接続されたコンデンサＣ３
と、チョーク素子Ｌ１の他端と制御電圧端子５との間に
接続された抵抗Ｒ２で電圧制御発振回路１０を構成す
る。 【効果】 制御電圧端子に接続されるループフィルタの
出力側に内蔵されるコンデンサによる電圧制御発振回路
の共振系の副共振を無くし、電圧制御発振回路の異常発
振を防止し、制御電圧と発振周波数の関係をほぼ直線的
にすることができる。
の、出力側のコンデンサの影響を受け難い電圧制御発振
回路を提供する。 【解決手段】 増幅回路２と、共振回路３と、バラクタ
ダイオードＤ１と、バラクタダイオードＤ１のカソード
に一端を接続したチョーク素子Ｌ１と、チョーク素子Ｌ
１の他端とグランドとの間に接続されたコンデンサＣ３
と、チョーク素子Ｌ１の他端と制御電圧端子５との間に
接続された抵抗Ｒ２で電圧制御発振回路１０を構成す
る。 【効果】 制御電圧端子に接続されるループフィルタの
出力側に内蔵されるコンデンサによる電圧制御発振回路
の共振系の副共振を無くし、電圧制御発振回路の異常発
振を防止し、制御電圧と発振周波数の関係をほぼ直線的
にすることができる。
Description
【０００１】
【発明の属する技術分野】本発明は電圧制御発振回路、
特に携帯電話などの移動体通信機器に用いられる電圧制
御発振回路に関する。
特に携帯電話などの移動体通信機器に用いられる電圧制
御発振回路に関する。
【０００２】
【従来の技術】近年の携帯電話などの移動体通信機器の
小型化にともなって、そこに用いられる電圧制御発振回
路やＰＬＬ回路などのＲＦ回路の小型化の要求が強まっ
てきている。
小型化にともなって、そこに用いられる電圧制御発振回
路やＰＬＬ回路などのＲＦ回路の小型化の要求が強まっ
てきている。
【０００３】図６に、従来の電圧制御発振回路の回路図
を示す。図６において、電圧制御発振回路１は、増幅回
路２、共振回路３、コンデンサＣ１、Ｃ２、Ｃ３、バラ
クタダイオードＤ１、チョーク素子Ｌ１で構成されてい
る。ここで、増幅回路２は共振回路３に接続され、共振
回路３にはコンデンサＣ１を介して並列にバラクタダイ
オードＤ１が接続されている。バラクタダイオードＤ１
のカソードにはチョーク素子Ｌ１の一端が接続され、チ
ョーク素子Ｌ１の他端はコンデンサＣ３を介してグラン
ドに接続されている。また、チョーク素子Ｌ１に並列に
コンデンサＣ２が接続されている。そして、増幅回路２
の出力は出力端子４に接続され、チョーク素子Ｌ１の他
端は制御電圧端子５に接続されている。
を示す。図６において、電圧制御発振回路１は、増幅回
路２、共振回路３、コンデンサＣ１、Ｃ２、Ｃ３、バラ
クタダイオードＤ１、チョーク素子Ｌ１で構成されてい
る。ここで、増幅回路２は共振回路３に接続され、共振
回路３にはコンデンサＣ１を介して並列にバラクタダイ
オードＤ１が接続されている。バラクタダイオードＤ１
のカソードにはチョーク素子Ｌ１の一端が接続され、チ
ョーク素子Ｌ１の他端はコンデンサＣ３を介してグラン
ドに接続されている。また、チョーク素子Ｌ１に並列に
コンデンサＣ２が接続されている。そして、増幅回路２
の出力は出力端子４に接続され、チョーク素子Ｌ１の他
端は制御電圧端子５に接続されている。
【０００４】ここで、制御電圧端子５は、バラクタダイ
オードＤ１に直流電圧を印加して、バラクタダイオード
Ｄ１の内部容量を変化させることによって、共振回路３
やバラクタダイオードD1などからなる共振系の共振周波
数を変化させ、それによって電圧制御発振回路１の発振
周波数を変化させるための端子である。また、チョーク
素子Ｌ１は制御電圧端子５に接続される負荷が共振回路
に影響しないように設けられたインダクタで、例えば幅
が狭く、一定の長さを持つマイクロストリップ線路など
で構成されている。また、コンデンサＣ３は同じくバイ
パスコンデンサである。そして、コンデンサＣ２はチョ
ーク素子Ｌ１が必ずしも理想的なチョークとして働かな
いのを補うために、チョーク素子Ｌ１とともに発振周波
数付近において共振させて、発振周波数においてバラク
タダイオードＤ１のカソードと制御電圧端子５との間の
インピーダンスをできるだけ高くするために設けられて
いる。
オードＤ１に直流電圧を印加して、バラクタダイオード
Ｄ１の内部容量を変化させることによって、共振回路３
やバラクタダイオードD1などからなる共振系の共振周波
数を変化させ、それによって電圧制御発振回路１の発振
周波数を変化させるための端子である。また、チョーク
素子Ｌ１は制御電圧端子５に接続される負荷が共振回路
に影響しないように設けられたインダクタで、例えば幅
が狭く、一定の長さを持つマイクロストリップ線路など
で構成されている。また、コンデンサＣ３は同じくバイ
パスコンデンサである。そして、コンデンサＣ２はチョ
ーク素子Ｌ１が必ずしも理想的なチョークとして働かな
いのを補うために、チョーク素子Ｌ１とともに発振周波
数付近において共振させて、発振周波数においてバラク
タダイオードＤ１のカソードと制御電圧端子５との間の
インピーダンスをできるだけ高くするために設けられて
いる。
【０００５】通常、電圧制御発振回路の制御電圧端子に
は、ＰＬＬ回路を構成するときにループフィルタが接続
される。ここで、図６において、６はループフィルタを
表している。ループフィルタ６の出力側には抵抗Ｒ１と
コンデンサＣ４が内蔵されており、ループフィルタ６を
電圧制御発振回路１の制御電圧端子５に接続すると、ル
ープフィルタ６に内蔵された抵抗Ｒ１が電圧制御発振回
路１の制御電圧端子５に対して直列に接続され、また、
コンデンサC４が電圧制御発振回路１のコンデンサＣ３
に並列に接続される形となる。
は、ＰＬＬ回路を構成するときにループフィルタが接続
される。ここで、図６において、６はループフィルタを
表している。ループフィルタ６の出力側には抵抗Ｒ１と
コンデンサＣ４が内蔵されており、ループフィルタ６を
電圧制御発振回路１の制御電圧端子５に接続すると、ル
ープフィルタ６に内蔵された抵抗Ｒ１が電圧制御発振回
路１の制御電圧端子５に対して直列に接続され、また、
コンデンサC４が電圧制御発振回路１のコンデンサＣ３
に並列に接続される形となる。
【０００６】
【発明が解決しようとする課題】ところで、ＲＦ回路の
小型化の要求があまり強くないときには、電圧制御発振
回路１とループフィルタ６を間隔をあけて配置すること
ができた。この場合、ループフィルタ６の出力から電圧
制御発振回路１の制御電圧端子５まで、例えば実装基板
上に配線が形成され、電圧制御発振回路１の発振周波数
程度の高周波においては、この配線がインダクタンスと
して働き、ループフィルタ６の出力側のコンデンサＣ４
が電圧制御発振回路１の特性に影響を与えるということ
はなかった。
小型化の要求があまり強くないときには、電圧制御発振
回路１とループフィルタ６を間隔をあけて配置すること
ができた。この場合、ループフィルタ６の出力から電圧
制御発振回路１の制御電圧端子５まで、例えば実装基板
上に配線が形成され、電圧制御発振回路１の発振周波数
程度の高周波においては、この配線がインダクタンスと
して働き、ループフィルタ６の出力側のコンデンサＣ４
が電圧制御発振回路１の特性に影響を与えるということ
はなかった。
【０００７】しかしながら、ＲＦ回路の小型化の要求が
強くなって、電圧制御発振回路５とループフィルタ６の
間隔が小さくなると、両者の間の配線のインダクタンス
成分がほとんど無くなり、ループフィルタ６の出力側の
コンデンサＣ４が、電圧制御発振回路１のコンデンサＣ
３に並列に接続されるようになる。
強くなって、電圧制御発振回路５とループフィルタ６の
間隔が小さくなると、両者の間の配線のインダクタンス
成分がほとんど無くなり、ループフィルタ６の出力側の
コンデンサＣ４が、電圧制御発振回路１のコンデンサＣ
３に並列に接続されるようになる。
【０００８】このように、コンデンサＣ３に並列にコン
デンサＣ４が接続されることにより、電圧制御発振回路
１の共振回路の中に副共振が発生する。特に、ロックア
ップタイムを向上させるために、ループフィルタ６の出
力側のコンデンサＣ４の容量が小さくなっていると、こ
の副共振の周波数が電圧制御発振回路１の発振周波数に
近くなる。逆に言えば、電圧制御発振回路１とループフ
ィルタ６の間隔が大きいときには、両者の間の配線のイ
ンダクタンス成分が大きいために、副共振の周波数が発
振周波数から遠くはなれていたということになる。
デンサＣ４が接続されることにより、電圧制御発振回路
１の共振回路の中に副共振が発生する。特に、ロックア
ップタイムを向上させるために、ループフィルタ６の出
力側のコンデンサＣ４の容量が小さくなっていると、こ
の副共振の周波数が電圧制御発振回路１の発振周波数に
近くなる。逆に言えば、電圧制御発振回路１とループフ
ィルタ６の間隔が大きいときには、両者の間の配線のイ
ンダクタンス成分が大きいために、副共振の周波数が発
振周波数から遠くはなれていたということになる。
【０００９】図７に、電圧制御発振回路１の増幅回路２
と共振回路３の接続点から、バラクタダイオードＤ１や
コンデンサＣ４などをすべて含めて、共振回路３側を見
たインピーダンス（ｍａｇ（Ｚ１１）、Ｚ１１の絶対値
の対数表示）を示す。図７に示すように、本来の発振周
波数ｆ１にインピーダンスの極点（共振点）がある以外
に、それより少し低い周波数ｆ２にもインピーダンスの
極点（副共振点）が存在する。そして、この副共振点の
存在によって、電圧制御発振器の発振周波数を変化させ
たときに、条件によっては異常発振してしまうという問
題がある。
と共振回路３の接続点から、バラクタダイオードＤ１や
コンデンサＣ４などをすべて含めて、共振回路３側を見
たインピーダンス（ｍａｇ（Ｚ１１）、Ｚ１１の絶対値
の対数表示）を示す。図７に示すように、本来の発振周
波数ｆ１にインピーダンスの極点（共振点）がある以外
に、それより少し低い周波数ｆ２にもインピーダンスの
極点（副共振点）が存在する。そして、この副共振点の
存在によって、電圧制御発振器の発振周波数を変化させ
たときに、条件によっては異常発振してしまうという問
題がある。
【００１０】図８に、電圧制御発振回路１の制御電圧端
子５に、並列にコンデンサＣ４が接続された場合の、制
御電圧（制御電圧端子５に印加する直流電圧）と発振周
波数の関係を示す。図７より分かるように、制御電圧が
２．６Ｖを超えたところで異常発振がおきて正常な発振
が停止し、制御電圧が２．８Ｖのときには、制御電圧が
２．６Ｖ以下のときとは大きく離れた周波数で発振を再
開している。また、制御電圧の変化に対する発振周波数
の変化も小さくなっている。
子５に、並列にコンデンサＣ４が接続された場合の、制
御電圧（制御電圧端子５に印加する直流電圧）と発振周
波数の関係を示す。図７より分かるように、制御電圧が
２．６Ｖを超えたところで異常発振がおきて正常な発振
が停止し、制御電圧が２．８Ｖのときには、制御電圧が
２．６Ｖ以下のときとは大きく離れた周波数で発振を再
開している。また、制御電圧の変化に対する発振周波数
の変化も小さくなっている。
【００１１】本発明は上記の問題点を解決することを目
的とするもので、制御電圧端子に接続されるループフィ
ルタの、出力側のコンデンサの影響を受け難い電圧制御
発振回路を提供する。
的とするもので、制御電圧端子に接続されるループフィ
ルタの、出力側のコンデンサの影響を受け難い電圧制御
発振回路を提供する。
【００１２】
【課題を解決するための手段】上記目的を達成するため
に、本発明の電圧制御発振回路は、増幅回路と、該増幅
回路に接続された共振回路と、該共振回路に接続された
バラクタダイオードと、該バラクタダイオードのカソー
ドに一端が接続されたチョーク素子と、該チョーク素子
の他端とグランドとの間に接続されたコンデンサと、前
記チョーク素子の他端に接続されたインダクタンス素子
もしくは抵抗素子とを有することを特徴とする。
に、本発明の電圧制御発振回路は、増幅回路と、該増幅
回路に接続された共振回路と、該共振回路に接続された
バラクタダイオードと、該バラクタダイオードのカソー
ドに一端が接続されたチョーク素子と、該チョーク素子
の他端とグランドとの間に接続されたコンデンサと、前
記チョーク素子の他端に接続されたインダクタンス素子
もしくは抵抗素子とを有することを特徴とする。
【００１３】このように構成することにより、本発明の
電圧制御発振回路は、制御電圧端子に接続されるループ
フィルタの、出力側のコンデンサの影響を受け難くする
ことができる。
電圧制御発振回路は、制御電圧端子に接続されるループ
フィルタの、出力側のコンデンサの影響を受け難くする
ことができる。
【００１４】
【発明の実施の形態】図１に、本発明の電圧制御発振回
路の一実施例を示す。図１において、図６と同一もしく
は同等の部分には同じ記号を付し、その説明を省略す
る。
路の一実施例を示す。図１において、図６と同一もしく
は同等の部分には同じ記号を付し、その説明を省略す
る。
【００１５】図１に示した電圧制御発振回路１０におい
て、チョーク素子Ｌ１の他端と制御電圧端子５との間に
は、抵抗素子である抵抗Ｒ２が接続されている。この場
合、抵抗Ｒ２はチップ抵抗である。
て、チョーク素子Ｌ１の他端と制御電圧端子５との間に
は、抵抗素子である抵抗Ｒ２が接続されている。この場
合、抵抗Ｒ２はチップ抵抗である。
【００１６】このように構成することにより、ループフ
ィルタ６のコンデンサＣ４が、電圧制御発振回路１０の
コンデンサＣ３に対して、少なくとも抵抗Ｒ２を介して
接続されることになる。そのため、高周波的に見れば、
コンデンサＣ４が内部損失の非常に大きいコンデンサに
なったのと同じになり、副共振の周波数ｆ２におけるＱ
が大幅に劣化し、副共振の周波数ｆ２においてほとんど
共振しなくなる。すなわち副共振が存在しなくなる。
ィルタ６のコンデンサＣ４が、電圧制御発振回路１０の
コンデンサＣ３に対して、少なくとも抵抗Ｒ２を介して
接続されることになる。そのため、高周波的に見れば、
コンデンサＣ４が内部損失の非常に大きいコンデンサに
なったのと同じになり、副共振の周波数ｆ２におけるＱ
が大幅に劣化し、副共振の周波数ｆ２においてほとんど
共振しなくなる。すなわち副共振が存在しなくなる。
【００１７】図２に、チョーク素子Ｌ１の他端と制御電
圧端子５の間に抵抗Ｒ２を接続した場合の、電圧制御発
振回路１の増幅回路２と共振回路３の接続点から、共振
回路３側を見たインピーダンス（ｍａｇ（Ｚ１１））を
示す。図２において、破線は従来の電圧制御発振回路１
の特性を、実線は本発明の電圧制御発振回路１０の特性
を示している。図２に示すように、本発明の電圧制御発
振回路１０においては、周波数ｆ２における副共振が無
くなっている。
圧端子５の間に抵抗Ｒ２を接続した場合の、電圧制御発
振回路１の増幅回路２と共振回路３の接続点から、共振
回路３側を見たインピーダンス（ｍａｇ（Ｚ１１））を
示す。図２において、破線は従来の電圧制御発振回路１
の特性を、実線は本発明の電圧制御発振回路１０の特性
を示している。図２に示すように、本発明の電圧制御発
振回路１０においては、周波数ｆ２における副共振が無
くなっている。
【００１８】図３に、本発明の電圧制御発振回路１０の
制御電圧端子５に、ループフィルタ６のコンデンサＣ４
が接続された場合の、制御電圧と発振周波数の関係を示
す。図２より分かるように、副共振が無くなることによ
り、制御電圧の値による異常発振がなくなり、制御電圧
と発振周波数の関係がほぼ直線的になっている。また、
副共振の影響が無くなって、制御電圧の変化に対する発
振周波数の変化も大きくなって改善されている。
制御電圧端子５に、ループフィルタ６のコンデンサＣ４
が接続された場合の、制御電圧と発振周波数の関係を示
す。図２より分かるように、副共振が無くなることによ
り、制御電圧の値による異常発振がなくなり、制御電圧
と発振周波数の関係がほぼ直線的になっている。また、
副共振の影響が無くなって、制御電圧の変化に対する発
振周波数の変化も大きくなって改善されている。
【００１９】このように、チョーク素子Ｌ１の他端と制
御電圧端子５の間に、抵抗素子である抵抗Ｒ２を接続す
ることにより、副共振を無くすことができ、それによっ
て電圧制御発振回路１０の異常発振を防止し、制御電圧
と発振周波数との関係をほぼ直線的にすることができ
る。
御電圧端子５の間に、抵抗素子である抵抗Ｒ２を接続す
ることにより、副共振を無くすことができ、それによっ
て電圧制御発振回路１０の異常発振を防止し、制御電圧
と発振周波数との関係をほぼ直線的にすることができ
る。
【００２０】なお、抵抗素子としてはチップ抵抗に限る
ものではなく、直流的に抵抗として働くものであれば、
厚膜印刷抵抗や薄膜抵抗など別のものでも構わないもの
である。
ものではなく、直流的に抵抗として働くものであれば、
厚膜印刷抵抗や薄膜抵抗など別のものでも構わないもの
である。
【００２１】図４に、本発明の電圧制御発振回路の別の
実施例を示す。図４において、図１と同一もしくは同等
の部分には同じ記号を付し、その説明を省略する。
実施例を示す。図４において、図１と同一もしくは同等
の部分には同じ記号を付し、その説明を省略する。
【００２２】図４に示した電圧制御発振回路２０におい
て、図１との違いは、チョーク素子Ｌ１の他端と制御電
圧端子５との間に、抵抗Ｒ２に代えてインダクタンス素
子であるインダクタＬ２が接続されている点である。イ
ンダクタＬ２は、幅が狭く一定の長さを持つマイクロス
トリップ線路で構成されている。
て、図１との違いは、チョーク素子Ｌ１の他端と制御電
圧端子５との間に、抵抗Ｒ２に代えてインダクタンス素
子であるインダクタＬ２が接続されている点である。イ
ンダクタＬ２は、幅が狭く一定の長さを持つマイクロス
トリップ線路で構成されている。
【００２３】このように構成することにより、ループフ
ィルタ６のコンデンサＣ４が、電圧制御発振回路２０の
コンデンサＣ３に対して、少なくともインダクタＬ２を
介して接続されることになる。そのため、高周波的にみ
れば、コンデンサＣ４のリアクタンス値が変化したのと
同じになり、副共振の周波数ｆ３が、従来の電圧制御発
振回路１の副共振の周波数ｆ２よりも低くなる。そし
て、インダクタＬ２のインダクタンス値が大きいほど、
副共振の周波数ｆ３は低くなる。これは、ループフィル
タと電圧制御発振回路との間隔が大きくて、ループフィ
ルタの出力と電圧制御発振回路の制御電圧端子との間の
配線のインダクタンス成分が大きい場合と同じであり、
副共振があっても電圧制御発振回路にほとんど悪影響を
与えない。
ィルタ６のコンデンサＣ４が、電圧制御発振回路２０の
コンデンサＣ３に対して、少なくともインダクタＬ２を
介して接続されることになる。そのため、高周波的にみ
れば、コンデンサＣ４のリアクタンス値が変化したのと
同じになり、副共振の周波数ｆ３が、従来の電圧制御発
振回路１の副共振の周波数ｆ２よりも低くなる。そし
て、インダクタＬ２のインダクタンス値が大きいほど、
副共振の周波数ｆ３は低くなる。これは、ループフィル
タと電圧制御発振回路との間隔が大きくて、ループフィ
ルタの出力と電圧制御発振回路の制御電圧端子との間の
配線のインダクタンス成分が大きい場合と同じであり、
副共振があっても電圧制御発振回路にほとんど悪影響を
与えない。
【００２４】図５に、チョーク素子Ｌ１の他端と制御電
圧端子５の間にインダクタＬ２を接続した場合の、電圧
制御発振回路１の増幅回路２と共振回路３の接続点か
ら、共振回路３側を見たインピーダンス（ｍａｇ（Ｚ１
１））を示す。図５において、破線は従来の電圧制御発
振回路１の特性を、実線は本発明の電圧制御発振回路２
０の特性を示している。図５に示すように、本発明の電
圧制御発振回路２０においては、副共振点が周波数ｆ２
から周波数ｆ３に移動して、発振周波数ｆ１から離れて
いる。
圧端子５の間にインダクタＬ２を接続した場合の、電圧
制御発振回路１の増幅回路２と共振回路３の接続点か
ら、共振回路３側を見たインピーダンス（ｍａｇ（Ｚ１
１））を示す。図５において、破線は従来の電圧制御発
振回路１の特性を、実線は本発明の電圧制御発振回路２
０の特性を示している。図５に示すように、本発明の電
圧制御発振回路２０においては、副共振点が周波数ｆ２
から周波数ｆ３に移動して、発振周波数ｆ１から離れて
いる。
【００２５】このように、チョーク素子Ｌ１の他端と制
御電圧端子５との間に、インダクタンス素子であるイン
ダクタＬ２を接続することにより、副共振の周波数を発
振周波数から離すことができ、それによって電圧制御発
振回路の異常発振を防止し、制御電圧と発振周波数の関
係をほぼ直線的にすることができる。
御電圧端子５との間に、インダクタンス素子であるイン
ダクタＬ２を接続することにより、副共振の周波数を発
振周波数から離すことができ、それによって電圧制御発
振回路の異常発振を防止し、制御電圧と発振周波数の関
係をほぼ直線的にすることができる。
【００２６】なお、インダクタンス素子としてはマイク
ロストリップ線路に限るものではなく、トリプレート構
造のストリップ線路や、あるいは対応する接地電極の無
い単なるストリップ状の電極であっても構わないもので
ある。また、インダクタとして働くものであれば、線路
や電極に代えてコイルやチップインダクタなど別のもの
としても構わないものである。
ロストリップ線路に限るものではなく、トリプレート構
造のストリップ線路や、あるいは対応する接地電極の無
い単なるストリップ状の電極であっても構わないもので
ある。また、インダクタとして働くものであれば、線路
や電極に代えてコイルやチップインダクタなど別のもの
としても構わないものである。
【００２７】
【発明の効果】本発明の電圧制御発振回路によれば、そ
の一端をバラクタダイオードのカソードに接続したチョ
ーク素子の他端と、制御電圧端子との間に、インダクタ
ンス素子もしくは抵抗素子を接続することによって、制
御電圧端子に接続されるループフィルタの出力側に内蔵
されるコンデンサによる電圧制御発振回路の共振系の副
共振を無くしたり、あるいは副共振の周波数を発振周波
数から遠ざけたりすることができ、それによって電圧制
御発振回路の異常発振を防止し、制御電圧と発振周波数
の関係をほぼ直線的にすることができる。
の一端をバラクタダイオードのカソードに接続したチョ
ーク素子の他端と、制御電圧端子との間に、インダクタ
ンス素子もしくは抵抗素子を接続することによって、制
御電圧端子に接続されるループフィルタの出力側に内蔵
されるコンデンサによる電圧制御発振回路の共振系の副
共振を無くしたり、あるいは副共振の周波数を発振周波
数から遠ざけたりすることができ、それによって電圧制
御発振回路の異常発振を防止し、制御電圧と発振周波数
の関係をほぼ直線的にすることができる。
【図１】本発明の電圧制御発振回路の一実施例を示す回
路図である。
路図である。
【図２】図１の電圧制御発振回路の、増幅回路と共振回
路の接続点から共振回路側を見たインピーダンスを示す
図である。
路の接続点から共振回路側を見たインピーダンスを示す
図である。
【図３】図１の電圧制御発振回路の、制御電圧と発振周
波数の関係を示す図である。
波数の関係を示す図である。
【図４】本発明の電圧制御発振回路の別の実施例を示す
回路図である。
回路図である。
【図５】図４の電圧制御発振回路の、増幅回路と共振回
路の接続点から共振回路側を見たインピーダンスを示す
図である。
路の接続点から共振回路側を見たインピーダンスを示す
図である。
【図６】従来の電圧制御発振回路を示す回路図である。
【図７】図６の電圧制御発振回路の、増幅回路と共振回
路の接続点から共振回路側を見たインピーダンスを示す
図である。
路の接続点から共振回路側を見たインピーダンスを示す
図である。
【図８】図６の電圧制御発振回路の、制御電圧と発振周
波数の関係を示す図である。
波数の関係を示す図である。
２…増幅回路 ３…共振回路 ４…出力端子 ５…制御電圧端子 ６…ループフィルタ １０、２０…電圧制御発振回路 Ｃ１、Ｃ２、Ｃ３、Ｃ４…コンデンサ Ｌ１…チョーク素子 Ｌ２…インダクタ Ｄ１…バラクタダイオード Ｒ１、Ｒ２…抵抗
Claims (1)
- 【請求項１】 増幅回路と、該増幅回路に接続された共
振回路と、該共振回路に接続されたバラクタダイオード
と、該バラクタダイオードのカソードに一端が接続され
たチョーク素子と、該チョーク素子の他端とグランドと
の間に接続されたコンデンサと、前記チョーク素子の他
端に接続されたインダクタンス素子もしくは抵抗素子と
を有することを特徴とする電圧制御発振回路。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10182524A JP2000022442A (ja) | 1998-06-29 | 1998-06-29 | 電圧制御発振回路 |
| US09/338,383 US6424231B2 (en) | 1998-06-29 | 1999-06-23 | Voltage controlled oscillation circuit |
| SE9902463A SE519972C2 (sv) | 1998-06-29 | 1999-06-29 | Spänningsstyrd svängningskrets |
| FI991472A FI115934B (fi) | 1998-06-29 | 1999-06-29 | Jänniteohjattu värähtelypiiri |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10182524A JP2000022442A (ja) | 1998-06-29 | 1998-06-29 | 電圧制御発振回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2000022442A true JP2000022442A (ja) | 2000-01-21 |
Family
ID=16119821
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10182524A Pending JP2000022442A (ja) | 1998-06-29 | 1998-06-29 | 電圧制御発振回路 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US6424231B2 (ja) |
| JP (1) | JP2000022442A (ja) |
| FI (1) | FI115934B (ja) |
| SE (1) | SE519972C2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP6793886B2 (ja) * | 2018-07-12 | 2020-12-02 | 三菱電機株式会社 | 光受信回路 |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07263957A (ja) * | 1994-03-17 | 1995-10-13 | Fujitsu Ltd | 電圧制御発振器 |
| JPH0879069A (ja) * | 1994-09-08 | 1996-03-22 | Mitsubishi Electric Corp | Ｖｃｏ回路及びｐｌｌ回路 |
| US5508665A (en) * | 1994-10-31 | 1996-04-16 | Motorola, Inc. | Oscillator operable in a high impedance mode |
| US5999061A (en) * | 1998-05-05 | 1999-12-07 | Vari-L Company, Inc. | First and second oscillator circuits selectively coupled through passive output circuit to a load |
-
1998
- 1998-06-29 JP JP10182524A patent/JP2000022442A/ja active Pending
-
1999
- 1999-06-23 US US09/338,383 patent/US6424231B2/en not_active Expired - Fee Related
- 1999-06-29 FI FI991472A patent/FI115934B/fi active IP Right Grant
- 1999-06-29 SE SE9902463A patent/SE519972C2/sv not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| FI991472A (fi) | 1999-12-30 |
| FI991472A0 (fi) | 1999-06-29 |
| SE9902463D0 (sv) | 1999-06-29 |
| US6424231B2 (en) | 2002-07-23 |
| SE519972C2 (sv) | 2003-05-06 |
| SE9902463L (sv) | 1999-12-30 |
| US20010045870A1 (en) | 2001-11-29 |
| FI115934B (fi) | 2005-08-15 |
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