ES2886774T3

ES2886774T3 - Componente de impresión de comunicación

Info

Publication number: ES2886774T3
Application number: ES19706345T
Authority: ES
Inventors: Scott A Linn; James Michael Gardner
Original assignee: Hewlett Packard Development Co LP
Current assignee: Hewlett Packard Development Co LP
Priority date: 2019-02-06
Filing date: 2019-02-06
Publication date: 2021-12-20
Anticipated expiration: 2039-02-06
Also published as: AR117886A1; BR112021014773A2; CA3126691C; KR102629138B1; TW202039265A; US11685153B2; PL3717257T3; US11529805B2; CA3126691A1; JP7179190B2; ZA202104412B; AU2019428183A1; AU2019428183B2; KR20210107861A; EP3717257A1; EP3888920A1; JP2022517599A; WO2020162916A1; EP3717257B1; US20230081878A1

Abstract

Un circuito integrado (400) para un componente de impresión (406) que comprende: una pluralidad de bits de memoria (424); una pluralidad de actuadores de disparo de un grupo de pulsos de disparo (418); un circuito de selección para seleccionar al menos un bit de memoria de la pluralidad de bits de memoria (424) y los actuadores de disparo del grupo de pulsos de disparo (418); y un regulador de voltaje de memoria (1402) para proporcionar un voltaje de escritura a al menos un bit de memoria de la pluralidad de bits de memoria (424).

Description

DESCRIPCIÓN

Componente de impresión de comunicación

Antecedentes

Las impresoras y los cartuchos de impresora pueden usar una serie de tecnologías para transportar tinta a un medio. La tinta puede aplicarse a un medio mediante el uso de un dispositivo que se afecta por las diferencias de temperatura a través del dispositivo. La calidad de impresión puede determinarse en parte por el resultado de un trabajo de impresión que coincida con la entrada que se le indica a la impresora que imprima. El documento US2007/236519 describe una matriz de memoria con transistores de puerta flotante y con un sensor de señal que resuelve una corriente conducida por un transistor en uno de más de dos estados discretos. El documento WO2016/068853 describe un método para operar un dispositivo de impresión durante un evento de pérdida de potencia que incluye, con un dispositivo de detección de pérdida de potencia, detectar una pérdida de potencia en varios dispositivos de alto voltaje. El documento WO2019/013788 describe una matriz fluídica que incluye un actuador de fluido que comprende una resistencia eléctrica, un nodo de potencia para suministrar corriente eléctrica a la resistencia para activar el actuador de fluido, y un regulador de voltaje para recibir potencia eléctrica del nodo de potencia y generar un voltaje predeterminado y un cambiador nivel para controlar para dar salida a un voltaje de accionamiento de la puerta del transistor del interruptor del lado bajo mediante el uso del voltaje predeterminado y con base en señales de control para controlar la puerta para controlar el desplazamiento de fluido por el actuador de fluido.

Descripción de los dibujos

Ciertos ejemplos se describen en la siguiente descripción detallada y en referencia a los dibujos, en los que:

La Figura 1 es un diagrama de bloques de un sistema de componentes de impresión de ejemplo;

La Figura 2 es un diagrama de bloques de un sistema de componentes de impresión de matriz múltiple de ejemplo;

La Figura 3 es un diagrama de bloques de un sistema de componentes de impresión de plumas múltiples de ejemplo;

La Figura 4 es un diagrama de bloques de un plano de circuitos de ejemplo;

La Figura 5 es un diagrama de bloques de una arquitectura del sensor de plumas múltiples de ejemplo; La Figura 6 es un diagrama de bloques de una arquitectura de circuitos de impresión de ejemplo;

La Figura 7 es un diagrama de flujo de un método de ejemplo para comunicar datos almacenados desde un cartucho de cabezal de impresión reemplazable de comunicación;

La Figura 8 es un diagrama de bloques de un medio legible por ordenador no transitorio de ejemplo que incluye instrucciones para dirigir un procesador para comunicar datos almacenados desde un cartucho de cabezal de impresión reemplazable de comunicación;

La Figura 9 es un diagrama de flujo de un método de ejemplo para acceder a una celda de memoria;

La Figura 10 es un dibujo que muestra un conjunto de señales de ejemplo para una escritura de registro de configuración;

La Figura 11 es un esquema de un acceso de ejemplo a bits de memoria mediante el uso de múltiples registros habilitados y datos de boquillas;

La Figura 12 es un esquema que muestra un ejemplo de circuitos lógicos que acceden a una celda de memoria;

La Figura 13 es un diagrama de flujo de un método de ejemplo para acceder a una celda de memoria en respuesta a estados de acceso habilitado;

La Figura 14 es un diagrama de bloques de un circuito de ejemplo y un plan de escritura de bits de memoria; La Figura 15 es un diagrama de flujo de un método de ejemplo para proporcionar un voltaje de escritura con un regulador de voltaje de memoria a la combinación seleccionada de bits de memoria; y

La Figura 16 es un diagrama de bloques que ilustra otro ejemplo 1600 de un circuito integrado con múltiples bits de memoria asociados con cada actuador de fluido.

Descripción detallada

Proporcionar fluido, como tintas o agentes, a un medio, como páginas, polvo, cámaras de fluido, etc., puede incluir empujar fluido a través de boquillas con actuadores de fluido. En un ejemplo, el control de los actuadores de fluido puede regularse mediante bits de memoria que se ubican en los circuitos integrados. En un ejemplo, los circuitos integrados es una matriz de impresión posiblemente hecha de silicio. Puede haber una gran cantidad de boquillas, los correspondientes actuadores de fluido y los correspondientes bits de memoria para administrar. Estos bits de memoria pueden conectarse comunicativamente en paralelo por un bus. El bus puede ser un bus analógico de un solo carril. En la presente descripción, el bus puede medir todas las combinaciones de bits de memoria en paralelo. Además, el uso de un bus analógico de un solo carril permite el ordenamiento de un cableado de bus más complejo, traza u organización general de la matriz de impresión. El uso de un bus de un solo carril para medir múltiples bits de memoria en paralelo evita la necesidad de arquitecturas de matriz de bus múltiple. Además, el sistema descrito proporciona un marco para conectar bits de memoria a través de múltiples matrices de impresión con un bus analógico de un solo carril. La reducción en la cantidad de carriles de bus necesarios también puede reducir la cantidad de almohadillas de medición externas porque todos los bits, secciones o divisiones de memoria pueden medirse mediante el uso de una sola almohadilla. En un ejemplo, la almohadilla es externa a la matriz para conectarse a un contacto del lado de la impresora. En un ejemplo, la almohadilla es una almohadilla de señales analógicas para comunicar una señal analógica.

Como se usa en la presente descripción, los bits de memoria específicos para los que se realizan mediciones pueden seleccionarse mediante el uso del bus de un solo carril. En un ejemplo, el bus de un solo carril es una ruta de datos de alta velocidad y puede ser una traza, un cable u otro medio de conexión de comunicación electrónica entre componentes. Los bits de memoria pueden seleccionarse mediante el uso de la información que se transmite como parte de datos primitivos en un paquete de datos. En un ejemplo, el paquete de datos puede denominarse grupo de pulsos de disparo. En un ejemplo, las selecciones específicas de bits de memoria se realizan mediante el uso de datos primitivos para representar un grupo de pulsos de disparo. El paquete de datos, o grupo de pulsos de disparo, también se transmite a través de los circuitos integrados para direccionar o seleccionar actuadores de fluido específicos. Un método para direccionar los actuadores de fluido incluye un número primitivo y un número de dirección. En algunos ejemplos, puede haber un bit de memoria correspondiente a cada actuador de fluido. En otros ejemplos, puede haber más o menos bits de memoria que actuadores de fluido.

Los bits de memoria pueden seleccionarse mediante el uso del mismo carril de selección y lógica de selección para seleccionar la pluralidad de bits de memoria y actuadores fluídicos. En un ejemplo, el paquete de datos que lleva la información para la selección de actuadores de fluido incluye además datos para seleccionar el bit de memoria correspondiente a esos actuadores de fluido específicos, que incluye el número primitivo y el número de dirección.

El uso de sistemas de direccionamiento de esta manera, por ejemplo, mediante el uso de un bus analógico de un solo carril, permite seleccionar y leer múltiples bits de memoria a lo largo del bus analógico de un solo carril hacia la almohadilla. En un ejemplo, la almohadilla es una almohadilla de sensor para comunicar los estados del sensor, además de la señal de bits de memoria.

La misma línea de datos puede usarse para impulsar varios dispositivos de activación de fluidos. Además, el uso de un bus analógico de un solo carril permite seleccionar y leer varios bits de memoria que se ubican dentro de la misma matriz y en la misma dirección, uno a la vez o en combinación en paralelo desde la misma almohadilla. En otro ejemplo, el uso de un solo bus analógico permite seleccionar y leer varios bits de memoria dentro de diferentes matrices de silicio en el mismo cabezal de impresión desde el mismo carril de selección. Los bits de memoria pueden ubicarse en diferentes matrices. Cada matriz puede corresponder a un color diferente. Por ejemplo, una pluma puede ser una pluma de color e incluir tres matrices de impresión de silicio. La otra pluma puede ubicarse en una pluma de tinta negra y puede tener una sola matriz de impresión de silicio. El uso de un solo bus analógico permite seleccionar y leer desde la misma almohadilla varios bits de memoria a través de múltiples matrices de silicio en múltiples cabezales de impresión dentro del sistema de impresión, como una pluma de color y una pluma negra separadas. En la selección de bits de memoria por dirección, cada matriz de silicio única puede seleccionar un bit de memoria en un número de dirección diferente, pero los bits de memoria dentro de la misma matriz pueden seleccionarse en la misma dirección.

Los circuitos integrados puede ser una matriz de impresión. Los circuitos integrados puede usar bits de memoria que son bits de memoria volátil o no volátil (NVM). En un ejemplo, la memoria que se usa en los circuitos integrados es programable una vez (OTP) y puede leerse externamente mediante el uso de la almohadilla analógica. Por ejemplo, el bit o los bits de memoria pueden proporcionar una respuesta analógica esperada o predecible bajo diversas condiciones y combinaciones de medición. Debido a este enfoque más matizado para acceder y realizar lecturas desde múltiples bits de memoria, el acceso a las funciones del cabezal de impresión está más protegido contra el acceso o la manipulación no autorizados. Además, la mayor granularidad de la medición permite un monitoreo de estado más específico de la funcionalidad de los componentes de impresión. Además, en un ejemplo, el direccionamiento o lectura de múltiples bits de memoria en combinación, en paralelo y/o simultáneamente mediante el uso de un bus de un solo carril puede reducir el número de acciones de direccionamiento o lectura, acelerando así la operación. Además, y en contraste, el uso de un bus de varios carriles para intentar lecturas en paralelo usaría múltiples líneas de circuito que podrían acumular espacio en una matriz de impresión. Además, agregar otro cable al cabezal de impresión o cabezales de impresión conllevaría un aumento asociado en el costo y una disminución en la confiabilidad.

El componente de imprimir o el componente de impresión pueden ser extraíbles. Un componente de imprimir extraíble puede quitarse o insertarse desde o dentro de una impresora. El mismo circuito que se usa para seleccionar qué boquillas dispersarán la tinta ante una señal de DISPARO también puede usarse para acceder a la memoria de los circuitos integrados. Los circuitos para seleccionar una boquilla y seleccionar un bit de memoria pueden compartirse. Compartir circuitos permite, en parte, la minimización del área de circuito que se usa. Además, la señalización inadvertida entre estos dos componentes que comparten una línea puede suponer un riesgo de acciones inadvertidas o cambios en la memoria. La presente descripción incluye métodos y dispositivos destinados a protegerse de la señalización inadvertida mediante el uso de una secuencia de acceso antes de permitir el acceso a la memoria.

Como se señaló, los circuitos de la impresora pueden incluir líneas compartidas entre los circuitos de activación de fluido y los circuitos de la celda de memoria. En un ejemplo, y para reducir la complejidad en la matriz, gran parte de una ruta de datos de alta velocidad que se usa para seleccionar boquillas de chorro de tinta tiene un propósito múltiple para seleccionar también elementos de memoria. Las técnicas específicas para la selección de bits de memoria pueden habilitar las salvaguardas con una secuencia de acceso a la memoria para garantizar que los bits de memoria no se seleccionen inadvertidamente durante la impresión. Los bits de memoria que se seleccionan inadvertidamente durante la impresión pueden estar dañados e inutilizables en la memoria del cabezal de impresión.

Las presentes técnicas muestran una secuencia de modo de acceso que se usa para acceder a los modos de lectura y escritura de la memoria en los circuitos integrados como un cabezal de impresión. En un ejemplo, el cabezal de impresión puede incluir una matriz, como una matriz de silicio. La matriz de silicio pueden ser una pieza larga de silicio. Con el fin de reducir el tamaño y por lo tanto el costo del silicio en bruto, el tamaño o perfil de los circuitos puede reducirse mediante múltiples componentes que comparten las mismas líneas de señalización. Por ejemplo, la selección de boquillas puede usar el mismo hardware que se usa para configurar los bits de memoria. En un ejemplo, los bits de memoria o las celdas de memoria pueden ser una memoria no volátil (NVM). El uso de NVM puede usarse para transferir información desde el cabezal de impresión a la impresora. La comunicación de información, como mediciones de grietas y temperaturas fuera de la matriz, permite el cálculo y ajuste de instrucciones al cabezal de impresión de acuerdo con las condiciones detectadas. En un ejemplo, la información que se incluye en la NVM que se comunicará a la impresora puede incluir el comportamiento térmico de una matriz, desplazamientos para una matriz, información de la región, un mapa de color, el número de boquillas, función de la boquilla, temperatura de la matriz en diversas regiones, detección de grietas y otra información.

Para garantizar que se guarden los datos adecuados en la NVM en lugar de ruido o señalización no intencionada para un componente compartido, se usa una secuencia de acceso. La secuencia de acceso puede evitar la escritura inadvertida en la memoria mediante circuitos que también entregan y ejecutan datos de selección de impresión. La capacidad de compartir circuitos sin pérdida de calidad permite ahorros significativos en el área del circuito. Compartir componentes puede incluir, por ejemplo, compartir una ruta de datos para seleccionar tanto los actuadores de fluido como los bits de NVM.

Otra forma de evitar accesos involuntarios a la memoria es restablecer la secuencia de acceso en el flanco descendente de la señal de DISPARO. Esto asegura que los fallos de señal o ruido en una almohadilla de MODO se limiten a una primera etapa de una secuencia de acceso donde los bits de memoria no están expuestos. En cambio, el proceso para acceder a los bits de memoria puede comenzar temporalmente antes de salir rápidamente sin daño o señalización incorrecta.

En un ejemplo, la secuencia para habilitar un modo de acceso a la memoria puede tener seis etapas. En una primera etapa de ejemplo, puede accederse a un registro de configuración para habilitar un modo de memoria. En una segunda etapa de ejemplo, la carga de datos del grupo de pulsos de disparo (FPG) puede incluir el bit o los bits que se escribirán junto con un bit de habilitación de memoria no volátil (habilitación de NVM) que se establece en el encabezado de FPG. Como se usa en la presente descripción, FPG puede referirse a un paquete de datos que se usa para seleccionar una primitiva para disparar. Como se usa en la presente descripción, una primitiva puede referirse a un grupo de dispositivos de activación de fluidos, tales como boquillas. En un ejemplo, el bit de habilitación de NVM puede referirse a un bit de habilitación que se almacena en un elemento de memoria como un elemento semiconductor de óxido metálico de avalancha de puerta flotante (FAMOS). En una tercera etapa de ejemplo, un pulso de un botón de DISPARO desde una señal 0 a una señal 1 hasta un 0, que corresponde a una secuencia de señalización de baja a alta a baja a lo largo de la línea de DISPARO. La señal de DISPARO no solo puede activar los actuadores de fluido para que actúen, sino que también puede afectar la configuración del circuito de memoria y los registros de memoria al borrar los datos. Este borrado o restablecimiento de datos ayuda a prevenir accesos involuntarios a la memoria si el acceso inicial fue en cambio mediante una señalización inadvertida en la misma línea. Una cuarta etapa de ejemplo incluye otro acceso al registro de configuración para habilitar el modo de memoria. Un ejemplo de la quinta etapa incluye una escritura en un registro de configuración de memoria que solo se hace visible una vez que se han ejecutado los cuatro pasos anteriores. Por último, en un ejemplo, puede haber un pulso de la almohadilla de DISPARO desde la señal 0 a la señal 1 hasta un 0. Durante la duración de esta segunda señal de DISPARO que se dispara en un estado de señal alta, el bit o los bits pueden leerse de los elementos de memoria o escribirse en los elementos de memoria.

Con respecto a la carga del grupo de pulsos de disparo, los bits de memoria se seleccionan mediante el uso de la misma ruta de datos de alta velocidad que se usa para seleccionar los datos primitivos del grupo de pulsos de disparo para los actuadores de fluido. Esto significa que los bits de memoria pueden seleccionarse de manera similar por número primitivo y número de dirección con la misma granularidad que los actuadores de fluido individuales. En un ejemplo, siempre que la almohadilla de DISPARO cambia de alto (1) a bajo (0), puede borrarse el bit de habilitación de NVM en un registro de configuración. Como se señaló anteriormente, la limpieza reduce la posibilidad de acceso inadvertido. Cuando se borra el bit de habilitación de NVM del registro de configuración, también se borran todos los bits del registro de configuración de memoria. En consecuencia, la señal de DISPARO descendente inhabilita el acceso adicional a la NVM. Para acceder a la NVM, debe establecerse el bit de habilitación de NVM del registro de configuración, junto con el bit de habilitación de NVM en los datos de desplazamiento. Para estas condiciones iniciales, el orden de ocurrencia es intercambiable siempre que ambas ocurran antes de que se eleve la señal de DISPARO. Cuando la señal de DISPARO sube o es alta, esta señal permite que el bit de habilitación de NVM de desplazar_datos establezca un bloqueo dentro de la matriz de impresión integrada. En un ejemplo, una vez que se establece el bloqueo interno, el bit de habilitación de NVM en un registro de configuración puede reescribirse a un 1 porque el bit de habilitación de NVM se borró por la señal de DISPARO descendente. En este ejemplo, cada vez que el bit de habilitación de NVM es 0, se borra el registro de configuración de memoria. Mediante el uso de un bloqueo interno establecido junto con un bit de habilitación de NVM que se establece en el registro de configuración, el registro de configuración de memoria está habilitado para escritura.

En un ejemplo, un registro de configuración de memoria es un registro oculto en el sentido de que puede funcionar en paralelo a las conexiones del registro de configuración, pero se limita a escribir bits solo después de que se cumplan condiciones complejas en un cierto orden. Como tal, el registro de configuración de memoria puede habilitarse mediante un bit en el flujo de datos de puntos, así como un bit en el registro de configuración, que luego habilita el registro de configuración de memoria para el cambio. Además, en un ejemplo, el registro de configuración de memoria puede usarse como una habilitación final para el modo NVM y también para seleccionar lectura/escritura y bits de memoria de columna o especiales.

Si bien se muestran varias secuencias, se contemplan otros protocolos de escritura en serie más complejos en el alcance de las técnicas descritas aquí. Podrían usarse otras técnicas de acceso complejas para garantizar aún más que no pueda accederse accidentalmente a NVM durante las operaciones normales (no NVM). Las secuencias de acceso y los protocolos que se discuten en la presente descripción también pueden modificarse adicionalmente de varias formas, tales como eliminar el registro de control de memoria que es esencialmente un registro paralelo, oculto al registro de configuración. Además, en los ejemplos que se discuten en la presente descripción con respecto a la señalización, la señal de la almohadilla de MODO también podría usarse para reemplazar la señal de DISPARO para invocar el acceso a la memoria del registro de configuración de la memoria.

La Figura 1 es un diagrama de bloques de un sistema de componentes de impresión de ejemplo 100. El diagrama simplificado incluye y excluye componentes con el fin de proporcionar contexto para mostrar las técnicas.

Un componente de impresión puede ser un cartucho de impresión, un carro de impresión para contener múltiples plumas y cartuchos, o hardware de impresión para organizar otros componentes del sistema de impresión. En un ejemplo, el componente de impresión puede ser extraíble y reemplazable en un sistema de impresión. El componente de impresión puede ser un dispositivo recargable. El componente de impresión puede incluir un tanque, una cámara o un recipiente para un fluido como la tinta. El componente de impresión puede incluir un recipiente reemplazable para fluido.

El componente de impresión puede incluir un circuito integrado 102. El circuito integrado 102 puede ser desechable. El componente de impresión y el circuito integrado 102 pueden unirse físicamente de manera que ambos estén dispuestos al mismo tiempo. En un ejemplo, el componente de impresión y el circuito integrado 102 pueden separarse físicamente de manera que uno pueda desecharse y reemplazarse mientras el otro permanece en un sistema de impresión. El circuito integrado 102 puede incluir varias boquillas a través de las cuales se distribuye fluido. El circuito integrado 102 puede incluir varias boquillas de alimentación de fluido a través de las cuales los actuadores de fluido conducen el fluido en la dirección del medio de impresión. El medio de impresión puede ser papel, plástico y metal, entre otros. En un ejemplo, el circuito integrado 102 puede funcionar mediante inyección piezoeléctrica, inyección térmica u otras tecnologías de impresión mediante el uso de múltiples puntos de dispersión a lo largo del cabezal de impresión.

El circuito integrado 102 puede incluir un número de bits de memoria. En un ejemplo, el circuito integrado 102 puede incluir el bit de memoria A 104, el bit de memoria B 106, el bit de memoria C 108, el bit de memoria D 110, el bit de memoria E 112 y el bit de memoria F 114. En conjunto, estos bits de memoria pueden denominarse como un número de bits de memoria.

El número de bits de memoria puede acoplarse de forma conductiva mediante un bus analógico de un solo carril 116 a una almohadilla 118 que se ubica en el exterior del circuito integrado 102. En un ejemplo, la almohadilla 118 puede ubicarse en el exterior del componente de impresión. El acoplamiento conductivo del número de bits de memoria a la almohadilla 118 puede incluir una conexión electrónica a través de cables o trazas. En un ejemplo, el acoplamiento puede ser a través de otros medios comunicativos que proporcionen información analógica a la almohadilla 118.

Puede seleccionarse, accederse o leerse un bit de memoria, o una combinación específica de bits de memoria, todos a la vez. Una combinación de bits de memoria seleccionados puede identificarse y seleccionarse individualmente para lectura, acceso o acción simultáneos. En un ejemplo, se selecciona un bit de memoria o una combinación de bits de memoria mediante el uso de un modo de acceso a la memoria y el bus analógico de un solo carril 116. En un ejemplo, los bits de memoria se seleccionan mediante un modo de acceso a la memoria que se habilita mediante el uso de un acceso al registro de configuración. En un ejemplo, la configuración de un modo de acceso a la memoria puede realizarse a través de otras estructuras de datos y esquemas de organización distintos a un registro. El uso del modo de acceso a la memoria y el bus analógico de un solo carril para seleccionar, manipular, activar o leer múltiples bits de memoria en paralelo se realiza a través de una ruta de datos en serie para seleccionar la primitiva deseada y la dirección de cada bit de memoria que va a medirse. Una vez que los bits de memoria se seleccionan mediante el uso de información primitiva y de dirección que se transmite a través de una ruta de datos en serie, puede accederse a los bits de memoria o leerlos al mismo tiempo a través del bus analógico de un solo carril compartido 116 hasta la almohadilla 118.

En un ejemplo, una lectura de un bit de memoria puede dar como resultado que se mida una salida de voltaje cuando se aplica una corriente conocida al bit de memoria seleccionado. En un ejemplo, una lectura de un bit de memoria puede dar como resultado que se mida una salida de corriente cuando se aplica un voltaje conocido al bit de memoria seleccionado. De manera similar, estas mediciones para entradas conocidas pueden realizarse para combinaciones de bits de memoria que se miden simultáneamente. La combinación única de bits de memoria que se seleccionan para la medición puede ser predecible y asignable a combinaciones específicas de bits de memoria. En consecuencia, la medición de una combinación de bits de memoria puede realizarse en paralelo con la respuesta en dependencia de cuántos bits se seleccionen y cuántos de los bits seleccionados estén programados. En un ejemplo, un bit de memoria programado puede responder de manera diferente a un bit de memoria no programado. Por lo tanto, cuando se aplica una señal analógica conocida a un bit de memoria o una combinación de bits de memoria, una almohadilla conectada 118 puede detectar una señal de salida analógica que puede usarse para realizar mediciones que transmitan la combinación específica de bits de memoria seleccionados y si esos bits de memoria son programados o no.

A medida que la almohadilla 118 recibe la señal del bus analógico 116, la señal eléctrica puede transmitirse además a un contacto de componente de impresión y, finalmente, a los circuitos del evaluador. La señal eléctrica que se transmite por la almohadilla 118 es una señal eléctrica representativa del número de bits de memoria y, más específicamente, la señal representa la combinación de todos los bits seleccionados del número de bits de memoria.

Los bits de memoria pueden medirse al forzar una corriente o al forzar un voltaje. La señal analógica de salida en respuesta a una corriente o voltaje forzado es distinta tanto para bits de memoria individuales como para combinaciones de bits de memoria. En un ejemplo, un circuito integrado 102 puede incluir mil bits de memoria por circuitos integrados o matriz de impresión. En la presente descripción, cada uno del número de bits de memoria podría conectarse al bus analógico 116. A través de esta conexión, cada uno de los mil bits puede ser individualmente, o un subconjunto en paralelo con base en direcciones comunes, seleccionado y conectado a la almohadilla. En un ejemplo, la almohadilla está en los circuitos integrados del cabezal de impresión o en la matriz. Los bits de memoria pueden ser transistores de efecto de campo semiconductores de óxido metálico de puerta flotante (MOSFET) y pueden comportarse con una resistencia relativamente alta cuando no están programados y una resistencia relativamente menor cuando están programados. Aprovechar esta propiedad de resistencia permite establecer relaciones de respuesta conocidas mediante el uso de la ley de Ohm que relaciona corriente, voltaje y resistencia.

Por ejemplo, cuando se aplica una corriente, puede leerse o medirse un voltaje. Para aplicar una corriente conocida a través de bits de memoria seleccionados, puede usarse una fuente de corriente interna o externa. En un ejemplo, la fuente de corriente externa puede proporcionarse a través de la almohadilla a lo largo del bus analógico de un solo carril. Se aplica una corriente conocida a través del bit de memoria seleccionado o una combinación de bits en paralelo. Como cada memoria se conecta en paralelo, en respuesta a una corriente conocida, cada bit de memoria adicional que se programa reduce una respuesta de voltaje de salida. Esto cumple con la ley de Ohm, donde a medida que aumenta el número de resistencias, es decir, bits de memoria programados, que están cableados en paralelo, el voltaje de salida disminuye de manera predecible. En consecuencia, con base en el voltaje de salida medido, puede conocerse información sobre la combinación de bits de memoria que se selecciona o programa.

De manera correspondiente, cuando se aplica un voltaje conocido como entrada para mediciones de bits de memoria, puede medirse la corriente. Para aplicar un voltaje conocido a través de bits de memoria seleccionados, puede usarse un voltaje interno o externo. En un ejemplo, el voltaje externo puede proporcionarse a través de la almohadilla a lo largo del bus analógico de un solo carril. El voltaje conocido se aplica a través del bit de memoria seleccionado o la combinación de bits en paralelo. Como cada memoria se conecta en paralelo, en respuesta a un voltaje conocido, cada bit de memoria adicional que se programa aumenta una respuesta de corriente de salida. Esto cumple con la ley de Ohm, donde a medida que aumenta el número de resistencias, es decir, bits de memoria programados, que están cableados en paralelo, la corriente de salida aumenta de manera predecible para un voltaje constante y conocido. En consecuencia, con base en la corriente de salida medida, puede conocerse información sobre la combinación de bits de memoria que se selecciona o programa.

La Figura 2 es un diagrama de bloques de un sistema de componentes de impresión de matriz múltiple de ejemplo 200. Los elementos numerados similares son los descritos con respecto a la Figura 1.

En el componente de impresión de la Figura 2, el bit de memoria A 104, el bit de memoria B 106 y el bit de memoria C 108 pueden todos ubicarse en la matriz de impresión A 202. En un ejemplo, la matriz de impresión de la matriz de impresión A 202 puede ser una forma de circuitos integrados. La matriz de impresión de la matriz de impresión A 202 puede ser una matriz de impresión de silicio. Además, en el componente de impresión de la Figura 2, el bit de memoria D 110, el bit de memoria E 112 y el bit de memoria F 114 pueden todos ubicarse en la matriz de impresión B 204. En un ejemplo, la matriz de impresión de la matriz de impresión B 204 puede ser una forma de circuitos integrados. La matriz de impresión de la matriz de impresión B 204 puede ser una matriz de impresión de silicio. La organización del componente de impresión puede permitir la ubicación de un primer bit de memoria tal como el bit de memoria A 104 en una primera matriz tal como la matriz de impresión A 202, y la ubicación de un segundo bit de memoria tal como el bit de memoria D 110 en una segunda matriz tal como la matriz de impresión B 204. En esta organización con bits de memoria que se dividen entre la matriz de impresión, el bus analógico 116 aún puede conectar cada uno de los bits de memoria a través de múltiples matrices en una vía de un solo carril a la almohadilla 118. Como el bus analógico 116 permanece conectado en paralelo a través de múltiples matrices, los bits de memoria de múltiples matrices pueden leerse simultáneamente en paralelo de la misma manera que si todos los bits de memoria no estuvieran separados por la matriz como se ve en la Figura 1. Por ejemplo, podría aplicarse simultáneamente un voltaje conocido a los bits de memoria tanto de la matriz de impresión A 202 como de la matriz de impresión B 204. A medida que se aplica el voltaje conocido a los bits de memoria a través de ambas matrices, la combinación de bits de memoria puede leerse en paralelo a través del bus analógico de un solo carril que se conecta a la almohadilla 118.

En un ejemplo, la matriz de impresión A 202 puede dispensar un primer tipo de fluido, como el rojo. La matriz de impresión B 204 puede dispensar un segundo tipo de fluido, como el azul. La medición, selección y lectura de múltiples bits de memoria aún pueden realizarse a través de múltiples matrices de impresión, cada una de las cuales imprime un color diferente al de la otra matriz de impresión. En un ejemplo, la matriz de impresión A 202 y la matriz de impresión B 204 pueden disponerse en uno o varios cabezales de impresión 206.

La Figura 3 es un diagrama de bloques de un sistema de componentes de impresión de plumas múltiples de ejemplo 300. Los elementos numerados similares son los descritos con respecto a la Figura 1 y la Figura 2.

El componente de impresión de la Figura 3 incluye una pluma de impresión A 302 que contiene uno o varios cabezales de impresión 206. El componente de impresión de la Figura 3 también incluye una pluma de impresión separada B 304. Como se usa en la presente descripción, una pluma de impresión puede ser un carro, soporte, separador, carcasa de impresión, cartucho de impresión u otra fabricación o dispositivo de separación. La pluma de impresión B 304 se muestra con el bit de memoria G 306 y el bit de memoria H 308 dispuestos en la matriz de impresión C 310 y la matriz de impresión D 312, respectivamente. Los bits de memoria y la matriz de impresión de la pluma de impresión B 304 tienen la misma función que los bits de memoria y la matriz de impresión de la pluma de impresión A 302, aunque físicamente distintos entre sí. El bit de memoria G 306 y el bit de memoria H 308 pueden conectarse mediante el bus analógico 116 en paralelo con el bit de memoria A 104, el bit de memoria B 106, el bit de memoria C 108, el bit de memoria D 110, el bit de memoria E 112 y el bit de memoria F 114. Los bits de memoria tanto en la pluma de impresión A 302 como en la pluma de impresión B 304 se acoplan comunicativamente a través del bus analógico 116 a la almohadilla 118.

En este sistema de componentes de impresión de plumas múltiples 300, pueden dividirse bits de memoria entre la matriz de impresión y las plumas de impresión, y el bus analógico 116 puede conectar cada uno de los bits de memoria a través de la matriz múltiple en las plumas de impresión múltiples en una vía de un solo carril a la almohadilla 118. Como el bus analógico 116 permanece conectado en paralelo a través de múltiples matrices, los bits de memoria pueden leerse simultáneamente en paralelo de la misma manera que si todos los bits de memoria no estuvieran separados por matrices como se ve en la Figura 1. Por ejemplo, podría aplicarse simultáneamente un voltaje conocido a los bits de memoria tanto de la matriz de impresión A 202 en la pluma de impresión A 302 como de la matriz de impresión C 310 en la pluma de impresión B 304. La combinación de bits de memoria a través de la matriz y la pluma de impresión puede leerse en paralelo a través del bus analógico de un solo carril que se conecta a la almohadilla 118.

La Figura 4 es un diagrama de bloques de un plano de circuito de ejemplo 400. Es posible que no se muestren varios componentes para facilitar la discusión de las presentes técnicas. Además, las flechas que se muestran no limitan el flujo de datos de una manera que indique exclusivamente un empuje o un tirón de datos por componentes, sino que indican un flujo general de información relevante para las técnicas descritas.

El plan de circuitos 400 puede permitir para una impresora separada 402 incluir un circuito integrado de la impresora 404, o un circuito integrado de aplicación específica (ASIC). La impresora 402 puede usar el circuito integrado de la impresora 404 para procesar o interactuar con los mensajes y datos que se enviarán y recibirán desde un componente de impresión 406. En un ejemplo, el componente de impresión 406 puede ser un cartucho de impresión que es extraíble o recargable. El componente de impresión 406 puede ser una pluma de impresión, un cartucho de impresora, un cabezal de impresión o puede contener un número de cabezales de impresión. En el componente de impresión 406, puede haber una almohadilla de DISPARO 408, una almohadilla de CLK 410, una almohadilla de DATOS 412 y una almohadilla de MODO 414. Estas almohadillas pueden ser contactos de impresora que transmiten señales digitales, analógicas o eléctricas desde la impresora al componente de impresión 406. La almohadilla CLK 410 puede referirse a una almohadilla de reloj. En un ejemplo, la almohadilla CLK 410, la almohadilla de DATOS 412 y la almohadilla de MODO 414 proporcionan información al registro de configuración de la matriz 416 que puede configurar la matriz o cabezal de impresión, que incluye la selección de actuadores de fluido en el grupo de pulso de disparo 418, lo que permite una interruptor de sensor externo 420 para leer la memoria del grupo de pulso de disparo, y habilitar otras resistencias en la matriz, como un interruptor para una resistencia de detección de grietas 422.

El grupo de pulsos de disparo 418 es una agrupación de actuadores de fluido y sus bits de memoria asociados 424 que pueden seleccionarse. En respuesta a la selección, los bits de memoria 424 pueden controlar si los actuadores de fluido se dispararán o no en respuesta a una señal de DISPARO de la almohadilla de DISPARO 408. La almohadilla de DISPARO 408 puede usar un diodo de bloqueo para seleccionar y disparar datos en el bit de memoria 424 en el grupo de pulsos de disparo 418.

Los bits de memoria 424 también pueden almacenar información sobre la función de los actuadores de fluido, como la temperatura y la funcionalidad. Como se discute más a fondo a continuación, un acceso al bit de memoria 424 puede incluir habilitar el acceso a través de un modo de memoria que se está habilitando así como un acceso que se indica en los datos primitivos, así como una señal de DISPARO desde la almohadilla de DISPARO 408. Como se usa en la presente descripción, una primitiva puede referirse al grupo de actuadores de fluido y sus bits de memoria asociados 424.

El interruptor para una resistencia de detección de grietas 422 puede habilitar la resistencia de detección de grietas 426 que puede entretejerse hacia adelante y hacia atrás entre las boquillas 428. En un ejemplo, el fluido es tinta y las boquillas 428 pueden ser boquillas.

El componente de impresión 406 puede incluir un número de otros componentes que incluyen un interruptor N 430 para habilitar un diodo N 432, un interruptor M 434 para habilitar un diodo M 436 y un interruptor S 438 para habilitar un diodo S 440.

Cada uno de estos componentes, los bits de memoria, las resistencias de detección de grietas, los interruptores y diodos, pueden conectarse a un bus de DETECCIÓN analógico de un solo carril 442 que se conecta a una almohadilla de DETECCIÓN 444. En un ejemplo, la almohadilla de DETECCIÓN puede ser una almohadilla que interactúe con el circuito integrado de la impresora 404. En un ejemplo, el circuito integrado de la impresora 404 puede conducir una corriente o un voltaje a través de la almohadilla de DETECCIÓN 444 para determinar una medición analógica de la respuesta a través del número de componentes y resistencias. Estas señales analógicas que son impulsadas a través de la almohadilla de DETECCIÓN 444 o el registro de configuración de matriz 416 o la almohadilla de DISPARO 408 pueden polarizarse o conectarse a tierra. El circuito integrado de la impresora 404 puede incluir su propia polarización analógica y conversión de analógico a digital dentro de la impresora 402 y fuera del componente de impresora 406. En un ejemplo, la eliminación de la conversión analógica a digital puede mover esta operación y el componente fuera de la matriz de impresión. Además, el circuito integrado de la impresora 404 puede forzar una corriente para medir el voltaje de componentes tales como una combinación de los bits de memoria 424. Además, el circuito integrado de la impresora 404 puede forzar un voltaje para medir la corriente de los bits de memoria combinados 424 con el fin de monitorear los sensores en la matriz y los bits de memoria seleccionados correspondientes a los actuadores de fluido.

En la presente descripción, el número de bits de memoria 424 puede seleccionarse mediante la lógica de selección que se usa para seleccionar la pluralidad de bits de memoria y actuadores fluídicos mediante el uso del mismo carril de selección. Además, la señal eléctrica procedente del circuito integrado de la impresora 404 puede ser una fuerza de corriente externa con respecto al componente de impresión 406. La aplicación de la fuerza de corriente externa puede producir un voltaje medido más bajo en una almohadilla, tal como la almohadilla de DETECCIÓN 444 para el número de bits de memoria 424 en relación con el voltaje que se mediría para un solo bit de memoria 424 seleccionado. Esto se debe a que a medida que aumenta el número de resistencias, por ejemplo, los bits de memoria 424 seleccionados, el voltaje de salida para una corriente de entrada establecida y conocida disminuirá. Asimismo, la señal eléctrica procedente del circuito integrado de la impresora 404 puede ser una fuerza de voltaje externa que se aplica al componente de impresión 406. La aplicación de la fuerza de voltaje externa puede resultar en un mayor consumo de corriente medido por la almohadilla, como la almohadilla de DETECCIÓN 444 para el número de bits de memoria 424 en comparación con el consumo de corriente que se mediría para un solo bit de memoria 424 seleccionado. Esto se debe a que a medida que aumenta el número de resistencias, por ejemplo, los bits de memoria 424 seleccionados, aumentará el consumo de corriente para un voltaje de entrada establecido y conocido.

En un ejemplo, el componente de impresión 406 incluye bits de memoria 424 que corresponden a actuadores de fluido próximos a las boquillas 428. Además, la almohadilla, tal como la almohadilla de DETECCIÓN 444, puede conectarse de manera conductora para transmitir una señal eléctrica desde una resistencia de detección de grietas 426 en combinación con el número de bits de memoria 424. Además, esta conexión conductora se realiza a través de un bus de DETECCIÓN analógico de un solo carril 442. En un ejemplo, los bits de memoria 424 corresponden a actuadores de fluido próximos a varias boquillas 428, y la resistencia de detección de grietas 426 se encamina entre las boquillas 428.

La Figura 5 es un diagrama de bloques de una arquitectura del sensor de plumas múltiples de ejemplo 500. Los elementos numerados similares son los descritos con respecto a la Figura 4.

Los circuitos integrados, como una matriz de impresora, puede separarse en varias matrices de silicio para tinta negra y tinta de color. En un ejemplo, a cada matriz puede asignársele su propio color. En un ejemplo, cada color puede tener una matriz correspondiente separada de la otra matriz. La matriz puede disponerse en plumas de impresión separadas.

En la Figura 5, puede haber una pluma de impresión en color 502 para contener una matriz de impresión cian 504, una matriz de impresión magenta 506 y una matriz de impresión amarilla 508. Otras matrices de impresión en color son compatibles, incluidas las combinaciones RBY (rojo, azul, amarillo) de matriz de impresión. Como se ve en la pluma de impresión en color, 502 cada una de las matrices de impresión es una matriz de impresión físicamente separada, sin embargo, el bus de DETECCIÓN analógico de un solo carril 442 sigue siendo común en todas las matrices de color en la pluma de impresión en color 502.

En la arquitectura del sensor de múltiples plumas 500, puede haber una pluma de impresión monocromática, tal como una pluma de impresión negra 510 que lleva una matriz de impresión negra 512. El bus de DETECCIÓN analógico de un solo carril 442 se conecta a la matriz de impresión negro 512 así como a la matriz de impresión a color en la pluma de impresión separada en serie. En consecuencia, una señal forzada a través de la almohadilla de DETECCIÓN 444 podría recopilar una medida de la matriz de impresión que se ubica en múltiples plumas de impresión físicamente separadas que incluyen la pluma de impresión en color 502 y la pluma de impresión monocromática 510. En un ejemplo, las plumas de impresión 502 y 510 pueden ser extraíbles.

En un ejemplo, la almohadilla de detección de un solo contacto, como la almohadilla de DETECCIÓN 444, puede usarse para comunicar datos almacenados desde un bus analógico de un solo carril 442 que se acopla de manera conductiva para comunicar un número de bits de memoria en combinación en una sola señal analógica sobre la única almohadilla de detección de un solo contacto, como la almohadilla de DETECCIÓN 444. En un ejemplo, un primer bit de memoria del número de bits de memoria puede ubicarse en una primera matriz de silicio, como la matriz de impresión cian 504 y un segundo bit de memoria del número de bits de memoria puede ubicarse en una segunda matriz de silicio, como la matriz de impresión magenta 506.

En un ejemplo, el circuito de memoria puede incluir una primera matriz de silicio que se asocia con un primer tipo de fluido, como la matriz de impresión cian 504, y la segunda matriz de silicio se asocia con un segundo tipo de fluido, como la matriz de impresión magenta 506. El circuito de memoria también puede incluir una primera matriz de silicio que se encuentra en una primera pluma de impresión, como la pluma de impresión en color 502, y la segunda matriz de silicio se ubica en una segunda pluma de impresión, como la pluma de impresión monocromática 510. En un ejemplo, la almohadilla de datos 412 puede estar separada para cada matriz de impresión, mientras que la conexión de la almohadilla de MODO, las conexiones de la almohadilla CLK y las conexiones de la almohadilla de DISPARO son compartidas por la matriz de impresión.

La Figura 6 es un diagrama de bloques de una arquitectura de circuitos de impresión de ejemplo 600. Los elementos numerados similares son los descritos con respecto a la Figura 4.

La arquitectura de circuitos de impresión 600 puede incluir un registro de configuración 602, un registro de configuración de memoria 604, un registro de estado 606 y un vigilante 608. Si bien se usa el término registro, también se contemplan otros elementos de almacenamiento. El registro de configuración 602 puede establecerse mediante una serie de almohadillas que incluyen la almohadilla de datos 412, la almohadilla de modo 414 y la almohadilla CLK 410. El registro de configuración puede usarse para establecer señales de control para pruebas, detección de grietas, habilitación del vigilante 608, retardos analógicos que incluyen la polarización de retardo 610, acceso a la memoria a través de los bits de memoria 424 y validación mediante la confirmación de la detección a través de la almohadilla de DETECCIÓN 444. Otras configuraciones del registro de configuración 602 pueden incluir una selección de prueba, una prueba de la almohadilla de detección 444, el retardo de voltaje para los circuitos de boquillas específicas. Una de las razones de estos retrasos podría incluir evitar la interferencia de fluidos por la expulsión de demasiadas gotas de boquillas cercanas al mismo tiempo. El registro de configuración 602 también puede incluir y establecer bits para accesos a los bits de memoria 424 a través de una habilitación de bits de memoria. El registro de configuración 602 puede incluir la habilitación de la detección de grietas y la habilitación del vigilante.

En un ejemplo, el registro de configuración de memoria 604 al menos tres bits, uno de los cuales indica una habilitación de columna de manera que pueda accederse a todos los bits de la columna de memoria en la columna indicada. El registro de configuración de memoria 604 también incluye una habilitación de escritura en memoria para indicar un modo de lectura o escritura. El registro de configuración de memoria 604 también incluye una región habilitada para permitir el acceso a los bits de memoria regionalizados 424.

El registro de estado 606 puede incluir un estado según lo indicado por la almohadilla de DATOS 412, la almohadilla de CLK 410 y la almohadilla de MODO. El registro de estado 606 puede informar sobre el estado del cabezal de impresión... En un ejemplo, un bit del registro de estado 606 puede ser un bit de vigilancia para monitorear un panel de entrada e indicar cuando un estado, como una señal de DISPARO, puede no estar funcionando correctamente. En un ejemplo, el registro de estado también puede incluir bits de revisión para indicar otra información. En un ejemplo, el registro de estado puede usarse durante una prueba de oblea para la alineación de la sonda.

El vigilante 608 asegura que si la señal de DISPARO de la almohadilla de DISPARO 408 se conduce a un nivel alto más allá de un cierto umbral de tiempo, entonces las señales de DISPARO internas se inhabilitan hasta que se borra el fallo. El mecanismo para eliminar la falla es apagando el vigilante 608 o mediante un reinicio externo de la matriz. Por ejemplo, establecer el registro de configuración en cero también borra el bit de fallo de vigilancia detectado en el registro de estado.

La arquitectura de circuitos de impresión 600 incluye otras almohadillas que incluyen VDD, LGND, Nreset, PGND y VPP, entre otras. El VDD puede referirse a una línea de alimentación lógica común (VDD), LGND puede referirse a una línea de tierra lógica común. Nreset puede referirse al reinicio de un vigilante 608 que se disparó. La almohadilla PGND puede incluir una tierra que se conecta a los actuadores de fluido. La almohadilla VPP puede referirse a un bus de potencia compartida (VPP) que se conecta a los actuadores de fluido.

Como se indicó anteriormente, la polarización de retardo 610 puede ajustar los tiempos de disparo almacenados en la boquilla y los datos térmicos 612. La boquilla y los datos térmicos 612 pueden establecerse principalmente en función del reloj, los datos y las líneas de disparo. Los datos térmicos pueden referirse a la temperatura del cabezal de impresión a través de la matriz de boquillas. Las diferencias de temperatura pueden provocar bandas y, por lo tanto, la temperatura de diferentes partes de la matriz de boquillas puede mejorar la calidad de impresión mediante el mantenimiento de la consistencia de la temperatura de la matriz de impresión.

La boquilla y los datos térmicos 612 pueden almacenarse en un elemento de almacenamiento de circuito como un biestable y bloqueo y pueden ejecutarse a través de actuadores de fluido tales como resistencias térmicas de chorro de tinta 614. En un ejemplo, la boquilla y los datos térmicos también brindan acceso a bits de memoria cuando se sigue una secuencia específica. La secuencia de acceso específica para los bits de memoria 424 mediante el uso de la misma boquilla y los mismos datos térmicos se describe más adelante con respecto a la Figura 9 a la 13. Cuando se accede a un bit de memoria, el bit de memoria 424 puede escribirse con un generador de voltaje de memoria 616 que se controla por el registro de configuración de memoria 604.

La Figura 7 es un diagrama de flujo de un método de ejemplo 700 para comunicar datos almacenados desde un cartucho de cabezal de impresión reemplazable de comunicación. En el bloque 702, el método 700 incluye seleccionar un número de bits de memoria. En un ejemplo, el número de bits de memoria corresponde cada uno a un actuador de fluido que se ubica en una matriz de silicio. El número de bits de memoria puede corresponder a varios actuadores de fluido, donde el número de actuadores de fluido se encuentra en varias matrices de silicio. En el bloque 704, el método 700 incluye proporcionar una señal eléctrica analógica de entrada al número de bits de memoria.

En el bloque 706, el método 700 incluye medir una señal eléctrica analógica de salida en una almohadilla de detección de un solo contacto que se conecta comunicativamente al número de bits de memoria, la medición a realizar para el número de bits de memoria en combinación. En un ejemplo, la señal eléctrica analógica de salida se mide para que sea un voltaje más bajo en la almohadilla de detección de un solo contacto al medir el número de bits de memoria en combinación con respecto a un voltaje de comparación para un solo bit de memoria en la almohadilla de detección de un solo contacto. La señal eléctrica analógica de salida puede medirse para que sea una corriente más alta en la almohadilla de detección de un solo contacto al medir el número de bits de memoria en combinación con respecto a una corriente de comparación para un solo bit de memoria en la almohadilla de detección de un solo contacto.

Debe entenderse que el diagrama de bloques de la Figura 7 no pretende indicar que el método 700 debe incluir todas las acciones que se muestran en la Figura 7. Más bien, el método 700 puede incluir menos componentes o componentes adicionales no ilustrados en la Figura 7.

La Figura 8 es un diagrama de bloques de un medio legible por ordenador no transitorio de ejemplo 800 que incluye instrucciones para dirigir un procesador para comunicar datos almacenados desde un cartucho de cabezal de impresión reemplazable de comunicación. El medio legible por ordenador 800 puede incluir el procesador 802 para ejecutar instrucciones que se reciben desde el medio legible por ordenador 800. Las instrucciones pueden almacenarse en el medio legible por ordenador 800. Estas instrucciones pueden indicar al procesador 802 que comunique los datos almacenados desde un cartucho de cabezal de impresión reemplazable de comunicación. Las instrucciones pueden comunicarse a través de un bus 804 como señales eléctricas, señales de luz o cualquier otro medio de comunicación adecuado para la transmisión de datos en un entorno informático similar.

El medio legible por ordenador 800 puede usar un selector de bits de memoria 806 para seleccionar un número de bits de memoria. En un ejemplo, el número de bits de memoria corresponde cada uno a un actuador de fluido que se ubica en una matriz de silicio. El número de bits de memoria puede corresponder a varios actuadores de fluido, donde el número de actuadores de fluido se encuentra en varias matrices de silicio.

El medio legible por ordenador 800 puede usar un proveedor de entrada analógica 808 para proporcionar una señal eléctrica analógica de entrada al número de bits de memoria. El medio legible por ordenador 800 es un medidor de salida analógica 810 para medir una señal eléctrica analógica de salida en una almohadilla de detección de un solo contacto que se conecta comunicativamente al número de bits de memoria, la medición a realizar para el número de bits de memoria en combinación. En un ejemplo, la señal eléctrica analógica de salida se mide para que sea un voltaje más bajo en la almohadilla de detección de un solo contacto al medir el número de bits de memoria en combinación con respecto a un voltaje de comparación para un solo bit de memoria en la almohadilla de detección de un solo contacto. La señal eléctrica analógica de salida puede medirse para que sea una corriente más alta en la almohadilla de detección de un solo contacto al medir el número de bits de memoria en combinación con respecto a una corriente de comparación para un solo bit de memoria en la almohadilla de detección de un solo contacto. Debe entenderse que el diagrama de bloques de la Figura 8 no pretende indicar que el medio legible por ordenador 800 debe incluir todos los componentes que se muestran en la Figura 8. Más bien, el medio legible por ordenador 800 puede incluir menos componentes o componentes adicionales no ilustrados en la Figura 8.

La Figura 9 es un diagrama de flujo de un método 900 de ejemplo para acceder a una celda de memoria. El orden de algunas etapas, incluidos los bloques 902 y 904, puede realizarse en cualquier orden, mientras que otras etapas, como los bloques 906 al 916, se realizan en la secuencia indicada. Además, aunque se nombran bits, señales y componentes de circuito específicos, como registros, estos elementos específicos son simplemente un ejemplo de componentes y elementos más generales que también pueden tener los mismos resultados.

En el bloque 902, el método 900 para acceder a la memoria incluye escribir un bit de habilitación de NVM en un registro de configuración. Como se usa en la presente descripción, el bit de habilitación de NVM puede referirse a un bit para habilitar un elemento semiconductor de óxido metálico de avalancha de puerta flotante (FAMOS) que puede actuar como un elemento de memoria. Como se señaló anteriormente, también pueden usarse otros elementos de memoria capaces de almacenar y cambiar entre al menos dos estados de un bit de información. La escritura del bit de habilitación de NVM en un registro de configuración también puede hacer referencia a otros ejemplos de otros elementos de almacenamiento distintos de los registros. El registro de configuración puede ser reemplazado por otros métodos de organización de datos o circuitos capaces de recibir y almacenar información tal como el bit de habilitación de NVM para un circuito de configuración dentro del cabezal de impresión.

En el bloque 904, el método 900 incluye cargar datos de la boquilla con líneas de datos, donde los datos de la boquilla incluyen información para establecer el bit de habilitación de NVM en el flujo de datos, así como la información para seleccionar un bit de memoria no volátil (NVM) para acceder mediante el uso de un dirección específica para una boquilla. Como se usa en la presente descripción, puede haber una serie de líneas que proporcionen una señal eléctrica en una matriz de impresión, una de las cuales puede ser una línea de datos. La línea de datos puede proporcionar información a una serie de dispositivos de activación de fluido, como una selección de las boquillas que se dispararán en respuesta a una próxima señal de DISPARO. La selección de cuáles boquillas se dispararán a continuación puede almacenarse en bits NVM correspondientes a las boquillas. En un ejemplo, los datos de selección que se proporcionan por la línea de datos también incluyen un bit de habilitación de NVM correspondiente en los datos de selección de la boquilla. En un ejemplo, el bit de habilitación de NVM puede transmitirse en el encabezado o pie de página de los datos de selección de boquillas. Como se indicó anteriormente, 902 y 904 pueden realizarse en cualquier orden. El resultado de estas dos etapas es que el bit de habilitación de NVM se escribe en el registro de configuración y el bit de habilitación de NVM se establece en la línea de datos.

En el bloque 906, una señal de DISPARO se activa desde la almohadilla de DISPARO de unos circuitos integrados, primero impulsada a señal alta y luego baja. Como se usa en la presente descripción, una señal de DISPARO es una señal que se envía a cada boquilla a través de una conexión eléctrica a la almohadilla de DISPARO. Estas boquillas pueden agruparse en grupos llamados primitivos. Además de las boquillas, los bits de los registros también se conectan a una línea de DISPARO que, cuando se dispara, da lugar a que se tomen acciones en el registro de configuración. Como se señaló anteriormente, el uso del término registro es una implementación específica y en la presente descripción se contemplan otros elementos de almacenamiento. Como se usa en la presente descripción, una señal que se impulsa hacia arriba y luego hacia abajo se refiere a una amplitud de la señal que corresponde aproximadamente a la intensidad de la señal, ya sea una corriente o un voltaje. En un ejemplo, una señal de DISPARO alta puede interpretarse como un valor de 1, mientras que una señal de DISPARO baja o nada puede interpretarse como un valor de 0. En un ejemplo, la señal de DISPARO pasa de 0 a 1 a 0. La variación en la señalización puede indicar cuándo debe llevarse a cabo una acción, como disparar boquillas. La activación de la almohadilla de DISPARO de alto a bajo ha borrado el bit de habilitación de NVM del registro de configuración, sin embargo, se ha establecido un bloqueo interno dentro de los circuitos integrados. Este bloqueo interno combinado con la futura señalización puede permitir un acceso a un bit de memoria.

En el bloque 908, el método 900 incluye escribir un bit de habilitación de NVM en un registro de configuración. Este es la misma etapa que el bloque 902, sin embargo, en este caso, la etapa se realiza después de que se haya establecido el bloqueo interno y se haya borrado el bit de habilitación de NVM en el registro de configuración. Escribir el bit de habilitación de NVM nuevamente en el registro de configuración, mientras se transmite el bit de habilitación de NVM a través de una línea de datos, habilita el acceso a un bit de acceso a la memoria.

En el bloque 910, el método 900 incluye escribir un bit de acceso a la memoria en un registro de configuración de la memoria. Como se usa en la presente descripción, el registro de configuración de memoria puede ser otro elemento de almacenamiento separado del registro de configuración. En algunos ejemplos, hay menos bits en el registro de configuración de memoria que en el registro de configuración. Una vez que se escribe un bit de acceso a la memoria en el registro de configuración de la memoria, puede accederse a la memoria de los circuitos integrados. Los bits habilitados del registro de configuración de memoria pueden actuar como señales de control que permiten acceder a los elementos de memoria NVM o FAMOS.

En el bloque de decisión 912, se realiza una determinación con base en las señales de control que se indican por los bits del registro de configuración de memoria. Si los bits del registro de configuración de memoria indican una escritura en la memoria, el método 900 pasa al bloque 914. Si los bits del registro de configuración de memoria no indican una escritura en la memoria, el método 900 pasa al bloque 916.

En el bloque 914, la almohadilla de DISPARO se activa a nivel alto durante el tiempo de escritura deseado, luego a nivel bajo. En un ejemplo, la activación de la almohadilla de DISPARO puede incluir proporcionar una señal 0, luego una señal 1, luego una señal 0 en la línea de disparo. El valor de la señal puede corresponder a una corriente o voltaje en una línea de DISPARO. Durante la duración del tiempo de escritura, puede accederse al elemento de memoria, como un FAMOS. El acceso a FAMOS u otro elemento de memoria puede incluir escribir información en FAMOS o en el elemento de memoria.

En el bloque 916, la almohadilla de DISPARO puede ser alta y un voltaje o corriente forzada en una línea de DETECCIÓN para medición, luego retornar a la línea de DISPARO a una señal baja. Como se usa en la presente descripción, la línea de DETECCIÓN puede referirse a una línea de sensor que se conecta a una almohadilla, como una almohadilla de sensor. La línea de detección puede usarse para detectar condiciones en los circuitos integrados, como grietas o temperatura de una matriz de impresión. Ya sea que se proceda a través del bloque 914 o del bloque 916, el flanco descendente de la señal de DISPARO borra el registro de configuración de memoria y borra el bit de habilitación de NVM del registro de configuración.

La Figura 10 es un dibujo que muestra un conjunto de señales de ejemplo 1000 para una escritura de registro de configuración. Como se señaló anteriormente, se contemplan otras estructuras de organización y almacenamiento de datos distintos de los registros. En un ejemplo, pueden usarse otros elementos de almacenamiento en lugar de un registro. Los conjuntos de señales se proporcionan para ilustrar una forma de acceder al registro de configuración mediante el uso de las mismas líneas que se usan para proporcionar datos a los dispositivos de activación de fluidos tales como boquillas.

El conjunto de señales 1000 puede incluir una línea de MODO 1002, una línea de DISPARO 1004, una línea CLK 1006 y una línea de DATOS 1008. Como se usa en la presente descripción, la línea de modo puede estar conectada. Como se usa en la presente descripción, una línea puede referirse a un medio de transmisión de señales, como trazas metálicas para señales eléctricas. Para señales eléctricas, también son posibles otros tipos de líneas conductoras. Asimismo, si se envían señales distintas de las señales eléctricas, también podrían usarse los medios de transmisión adecuados. La línea de MODO 1002 puede indicar que un modo puede conectarse a los circuitos integrados, tal como una matriz que incluye un registro de configuración de la matriz. La línea de DISPARO 1004 puede conectarse al registro de configuración de los circuitos integrados así como a los dispositivos de activación de fluido y puede indicar cuándo deben actuar los dispositivos de activación de fluido. Esta acción puede incluir la dispersión de gotitas de tinta correspondientes a actuadores de fluido seleccionados hacia un medio de impresión. La acción que se toma en respuesta a una señal de DISPARO que se conecta al registro de configuración también puede incluir la escritura o borrado de bits en los registros o en la memoria.

La línea CLK 1006 muestra una señal de reloj de configuración que habilita acciones sobre las acciones ascendentes de cada tic del reloj. La línea de DATOS 1008 puede ser una línea de datos de configuración para una matriz de impresión específica y sus registros y bits de memoria asociados. Los datos de configuración pueden recibirse directamente de la línea de DATOS 1008 cuando se cumplen ciertas condiciones.

Por ejemplo, el registro de configuración puede habilitarse para una acción de escritura cuando una señal en la línea de MODO 1002 cambia a 1010 alto y la línea de DATOS 1008 también proporciona una señal 1012 alta que muestra un valor de señal de 1. Después de un registro de configuración que habilita la acción de las dos líneas, los datos adicionales pueden cambiarse al registro serial habilitado en el tiempo con los flancos ascendentes de la señal CLK como se ve en la acción ascendente A 1014, la acción ascendente B 1016, la acción ascendente C 1018 y la acción ascendente D 1020. A tiempo con cada una de estas acciones ascendentes, los datos de la línea de DATOS 1008 pueden transmitirse al registro de configuración. Por ejemplo, los datos para un bit de tercer lugar 1022 para un registro de configuración pueden desplazarse al registro cuando la línea de DATOS 1008 está señalando alto en el momento de la acción ascendente A 1014 en la línea CLK 1006. Asimismo, los datos para un bit de segundo lugar 1024 para un registro de configuración pueden desplazarse al registro cuando la línea de DATOS 1008 está señalizando baja en el momento de la acción ascendente B 1016 en la línea CLK 1006. En un ejemplo, los datos para un bit de primer lugar 1026 para un registro de configuración pueden desplazarse al registro de configuración cuando la línea de DATOS 1008 está señalando alto en el momento de la acción ascendente C 1018 en la línea CLK 1006. En un ejemplo, los datos para un bit de lugar cero 1028 para un registro de configuración pueden desplazarse al registro cuando la línea de DATOS 1008 está señalando alto en el momento de la acción ascendente D 1020 en la línea CLK 1006. Este ejemplo muestra una escritura de registro de configuración de 4 bits de longitud, por lo tanto, los cuatro lugares de datos que pueden indicarse en la línea DATOS 1008 con las correspondientes acciones ascendentes en la línea CLK 1006. Como se señaló anteriormente, otras longitudes de escrituras de registro de configuración podrían ser de mayor o menor tamaño en dependencia del tamaño del registro de configuración. Asimismo, puede usarse una señalización similar para escribir en otras configuraciones de memoria y también puede variar en longitud y cantidad de datos transferidos de acuerdo con el tamaño y la estructura de la memoria. En un ejemplo, los flancos ascendentes de CLK desplazan datos al registro de configuración en serie y los bits antiguos/extra se desplazan al final, como Msbits.

La Figura 11 es un esquema de un acceso de ejemplo 1110 a bits de memoria mediante el uso de múltiples registros habilitados y datos de boquillas. Los elementos numerados similares son los que se describen en la Figura 10. Además, para conectarse al registro de configuración 1102 como se indica en la Figura 11, la línea de MODO 1002, la línea de DISPARO 1004, la línea CLK 1006 y la línea de DATOS 1008 también pueden conectarse comunicativamente al registro de configuración de memoria 1104. Dado que los bits de datos de acceso a la memoria, tales como los bits de habilitación de NVM, pueden incluirse en los datos de la boquilla, este bit de los datos de la boquilla 1106 puede escribirse en el registro de configuración de memoria 1104 mediante el uso de los métodos descritos al menos en la Figura 9 o la Figura 13. Además de habilitar un acceso a memoria o un modo de escritura de acceso a memoria, el registro de configuración 1102 también puede tener bits para servir como señales de control 1108 para probar elementos de los circuitos integrados tales como detección de grietas, habilitación de vigilancia, retardos analógicos y validación de componentes.

El registro de configuración de memoria 1104 se habilita a través de un bit en el flujo de datos de puntos, tal como el bit de los datos de boquilla 1106 así como un bit de memoria de registro de configuración 1110 en el registro de configuración 1102. Cuando los tres se habilitan, es decir, el bit en los datos de la boquilla 1106, el bit de memoria del registro de configuración 1110 y el registro de configuración de memoria 1104, entonces el registro de configuración de memoria 1104 está habilitado para acceder a los bits de control de la memoria 1112. Cuando la línea de DISPARO 1004 señala un flanco descendente, se borran los bits en el registro de configuración de memoria 1104 así como el bit de memoria del registro de configuración 1110 en el registro de configuración 1102.

La Figura 12 es un esquema que muestra un ejemplo de circuitos lógicos 1200 que acceden a una celda de memoria. Es posible que no se muestren muchos componentes para facilitar la descripción de los componentes mostrados. Además, los circuitos lógicos que se muestra aquí pueden ser parte de los mismos circuitos de matriz, pueden estar físicamente separados y también pueden ser los mismos circuitos que realizan diferentes tareas mientras se encuentra en diferentes estados. Por ejemplo, el circuito de activación de fluido puede estar físicamente separado del circuito de configuración en un ejemplo, y en otro ejemplo, puede ser el mismo circuito en diferentes estados.

Los circuitos lógicos 1200 pueden incluir un circuito de activación de fluido 1202. Como se usa en la presente descripción, el circuito de activación de fluido 1202 puede ser un circuito que usa información de selección 1204 para controlar la dispersión de fluido a través de un dispositivo de activación de fluido 1206. En un ejemplo, el circuito de activación de fluido 1202 puede estar dispuesto sobre o dentro de unos circuitos integrados. El dispositivo de activación de fluido 1206 puede ser una primitiva de un grupo de primitivas. Como se usa en la presente descripción, una primitiva puede referirse a un grupo de boquillas de dispersión de fluidos que expulsan o desplazan de otra manera fluidos como la tinta hacia un medio de impresión. Los datos de selección 1204 en el circuito de activación de fluido 1202 pueden usarse para seleccionar boquillas específicas por línea de dirección y número primitivo o número de región para indicar qué boquillas pueden dispararse en respuesta a una señal de DISPARO.

La información de selección 1204 también puede incluir un bit de estado de datos 1208. El bit de estado de datos 1208 puede almacenarse en un encabezado o pie de página de un paquete de información de selección 1204. El bit de estado de datos también puede corresponder a un 0 o un 1. En un ejemplo, un 0 del bit de estado de datos puede indicar que el bit de estado de datos no está intentando iniciar el proceso para acceder a una celda de memoria 1210. Un 1 almacenado en el bit de estado de datos 1208 puede indicar que el bit de estado de datos está iniciando el proceso para acceder a la celda de memoria 1210. Sin embargo, para acceder a la celda de memoria 1210, el bit de estado de datos 1208, el circuito de configuración 1212 y el circuito de memoria 1214 deben todos habilitarse cuando se despliega una señal de DISPARO a través de los circuitos integrados. Como se usa en la presente descripción, el circuito de configuración 1212 puede incluir el registro de configuración 1102 de la Figura 11 así como otros tipos de circuitos de conversión de bits. Como se usa en la presente descripción, el circuito de memoria 1214 puede incluir el registro de configuración de memoria 1104 de la Figura 11 así como otros tipos de circuitos de conversión de bits.

El circuito de configuración 1212 puede configurarse para tener un estado de acceso a la configuración que puede establecerse en uno de, y cambiar entre, un estado habilitado y un estado deshabilitado. En un ejemplo, el circuito de configuración 1212 puede configurarse para habilitar y deshabilitar el estado de acceso a la configuración en respuesta a un bit de estado de configuración 1216. En un ejemplo, el bit de estado de configuración 1216 puede almacenarse en un registro de configuración. El circuito de activación de fluido 1202 puede transmitir información de selección 1204 para un dispositivo de activación de fluido 1206 mientras que dentro de los mismos datos y circuitos, la información de selección 1204 incluye un bit de estado de datos 1208 establecido para habilitar el estado de acceso a la configuración. En consecuencia, el bit de estado de configuración 1216 puede establecerse o cambiarse de manera que el circuito de configuración 1212 cambie de un estado inhabilitado a un estado habilitado. En un ejemplo, un bit de estado de datos 1208 puede establecerse en un valor alto o un 1 y estos datos pueden reflejarse, emparejarse o desplazarse de manera que un estado de habilitación se refleje en el circuito de configuración 1212. En un ejemplo, esta duplicación, coincidencia o desplazamiento puede realizarse mediante el bit de estado de configuración 1216 que puede reflejar el valor o señal del bit de estado de datos 1208.

El circuito de memoria 1214 puede configurarse para tener un estado de acceso a la memoria que puede establecerse en uno de, y cambiar entre un estado habilitado y un estado inhabilitado. En un ejemplo, el circuito de memoria 1214 se configura para habilitar o deshabilitar el estado de acceso a la memoria en respuesta a un bit de estado de memoria 1218. En un ejemplo, el bit de estado de memoria 1218 puede cambiarse en respuesta al bit de estado de datos 1208 y el bit de estado de configuración 1216, ambos señalando alto, cada uno con valores de 1, o ambos indicando que están habilitados en el momento de una acción de subida de la señal CLK o de una acción de subida de la señal de DISPARO.

En un ejemplo, la celda de memoria 1210 se hace accesible al tener habilitados tanto el estado de acceso a la memoria del circuito de memoria 1214 como el estado de acceso a la configuración del circuito de configuración 1212. En un ejemplo, cuando el bit de estado de datos 1208 se habilita así como el bit de estado de configuración 1216 del circuito de configuración 1212 y el bit de estado de memoria 1218 del circuito de memoria 1214, entonces puede accederse a la celda de memoria 1210. En un ejemplo, puede accederse a la celda de memoria en respuesta a que el estado de acceso a la memoria esté habilitado, el estado de acceso a la configuración esté habilitado y el circuito de activación de fluido para transmitir información de selección que incluye el bit de estado de datos que se establece. En un ejemplo, el bit de estado de datos debe establecerse en un estado de acceso a la memoria junto con la habilitación del circuito de configuración 1212 y el circuito de memoria 1214. El hecho de que se prohíba el acceso a menos que los tres estados estén habilitados garantiza que no se escriba accidentalmente en la memoria el ruido de la señal que pueda estar presente en los circuitos compartidos. Como el circuito de activación de fluido 1202 incluye datos de selección 1204 que pueden seleccionarse de una gran cantidad de boquillas a lo largo del tiempo para indicar la impresión en una señal de DISPARO, este circuito compartido debe asegurarse para garantizar que estas muchas señales no afecten a los datos en una celda de memoria 1210. En consecuencia, la secuencia descrita y el número de bits de estado que deben habilitarse para acceder a la celda de memoria 1210 permiten la protección de los datos de la celda de memoria y también asegura que el acceso a la celda de memoria se conceda cuando se pretende.

En un ejemplo, se accede a la celda de memoria 1210 durante la duración de una señal de DISPARO. El acceso a la celda de memoria 1210 puede ser para escribir en la celda de memoria 1210 o la modificación o lectura de la celda de memoria 1210. En un ejemplo, el flanco descendente de una señal de DISPARO establece el estado de acceso a la memoria a un estado inhabilitado y el estado de acceso a la configuración a un estado inhabilitado. El establecimiento del estado inhabilitado puede lograrse restableciendo el bit de estado de configuración 1216 y el bit de estado de memoria 1218 a 0 o a una señal baja o mediante la eliminación de cualquier valor almacenado.

En un ejemplo, el bit de estado de memoria 1218, el bit de estado de configuración 1216 y el bit de estado de datos 1208 deben recibirse a través del mismo panel de interfaz. En un ejemplo, este puede ser el panel de DATOS, el panel CLK, el panel de DISPARO u otros, en dependencia de las implementaciones específicas. Como se usa en la presente descripción, cada una de estas almohadillas corresponde a una línea sobre la cual se proporcionan señales eléctricas a los diversos circuitos lógicos 1200. En un ejemplo, una señal de reloj o CLK en el circuito integrado activa un bit de estado de memoria 1218 para habilitar el estado de acceso a la memoria y un bit de estado de configuración 1216 para habilitar el estado de acceso a la configuración. Como se muestra en la Figura 10, esto puede ocurrir en una acción ascendente. En un ejemplo, la activación de un bit de estado de memoria 1218 para habilitar el estado de acceso a la memoria y un bit de estado de configuración 1216 para habilitar el estado de acceso a la configuración también puede estar en el flanco descendente de una señal de reloj.

La Figura 13 es un diagrama de flujo de un método de ejemplo 1300 para acceder a una celda de memoria en respuesta a estados de acceso habilitado. La secuencia que se muestra puede incluir u omitir acciones que se toman por los circuitos integrados para facilitar la descripción de los elementos mostrados.

En el bloque 1302, el método 1300 comienza al configurar un circuito integrado para que tenga un estado de acceso a la memoria que puede establecerse en uno de entre un estado habilitado y un estado inhabilitado. En un ejemplo, un circuito de configuración habilita o deshabilita el estado de acceso a la configuración en respuesta al bit de estado de configuración.

En el bloque 1304, el método 1300 incluye transmitir, con un circuito de activación de fluido, información de selección para un dispositivo de activación de fluido, que incluye la información de selección de un bit de estado de datos. En un ejemplo, un circuito de memoria habilita o deshabilita el estado de acceso a la memoria en respuesta al bit de estado de la memoria.

En el bloque 1306, el método 1300 incluye configurar una matriz de celdas de memoria de manera que cada celda de memoria sea accesible por el estado de acceso a la memoria habilitado y el bit de estado de datos establecido. En un ejemplo, el acceso a la celda de memoria incluye que el estado de acceso a la configuración esté habilitado además de que el bit de estado de datos y el estado de acceso a la memoria también estén habilitados. Puede accederse a la celda de memoria durante la duración de una señal de DISPARO. En un ejemplo, el flanco descendente de una señal de DISPARO establece el estado de acceso a la memoria a un estado inhabilitado y el estado de acceso a la configuración a un estado inhabilitado. En un ejemplo, el bit de estado de memoria, el bit de estado de configuración y el bit de estado de datos deben recibirse a través del mismo panel de interfaz. El método 1300 puede incluir además activar un bit de configuración de memoria para habilitar el estado de acceso a la memoria y un bit de estado de configuración para habilitar el estado de acceso a la configuración en respuesta a una señal de reloj.

En un ejemplo, para acceder a la memoria, las etapas incluyen establecer el bit de habilitación mediante el uso de datos que son parte del flujo de datos de los dispositivos de activación de fluido. Además, en un ejemplo, escribe el bit de registro de configuración. Después de estas dos etapas, conduce la señal de DISPARO a nivel alto para permitir que se establezca un bit de habilitación interno y que se borre el bit de configuración. Cuando se establece un bit de configuración por segunda vez, y el bit de habilitación interno se establece como se indicó anteriormente, puede escribirse en el registro de configuración de memoria para configurar la condición de lectura/escritura, así como cuál de los dos tipos de bits de memoria puede ser accesible.

La Figura 14 es un diagrama de bloques de un circuito de ejemplo y un plan de escritura de bits de memoria 1400. Los elementos numerados similares son los descritos con respecto a la Figura 4.

El regulador de voltaje de memoria 1402 puede proporcionar voltaje a los bits de memoria 424 en respuesta a una única acción de aumento de la señal de DISPARO que habilita el modo de escritura de memoria a través de los registros de memoria y configuración. Pueden verse ejemplos de habilitación de un modo de escritura al menos con respecto a la Figura 9 a la 13. El regulador de voltaje de memoria 1402 puede aceptar energía de una fuente de energía compartida (VPP) 1404 que se comparte con los actuadores de fluido. La almohadilla de VPP 1404 puede referirse a un bus de potencia compartida (VPP) que se conecta a los actuadores de fluido. En un ejemplo, los actuadores de fluido son boquillas. El regulador de voltaje de memoria puede escribir en los bits de memoria correspondientes a los actuadores de fluido seleccionados.

Los bits de memoria que se escribirán en paralelo pueden seleccionarse mediante el uso de la ruta de datos de alta velocidad, como parte de los datos primitivos del grupo de pulsos de disparo. En un ejemplo, los bits de memoria se seleccionan mediante un número primitivo y un número de dirección como actuadores de fluido. La selección de bits de memoria por número primitivo y número de dirección permite seleccionar y escribir en paralelo varios bits de memoria que se ubican dentro de la misma matriz y en la misma dirección. La selección de bits de memoria por número primitivo y número de dirección también permite seleccionar y escribir en paralelo múltiples bits de memoria dentro de diferentes matrices de silicio en el mismo cabezal de impresión. En un ejemplo, las diferentes matrices de silicio pueden estar dentro de una sola pluma, como una pluma de color con tres matrices de silicio. La selección y escritura paralela de bits de memoria por número primitivo y número de dirección también permite la selección de múltiples bits de memoria en múltiples matrices de silicio. Estos bits de silicio también pueden estar en varios cabezales de impresión dentro del sistema de impresión, como la escritura paralela de bits de memoria en una pluma de color y una pluma de negro.

Al seleccionar bits por dirección, cada matriz de silicio única puede seleccionar un bit en un número de dirección diferente, pero los bits dentro de la misma matriz se seleccionarán en la misma dirección. Esto reduce el tiempo de prueba de fabricación de la pluma al escribir varios bits en paralelo dentro de la matriz o a través de las ranuras dentro de un cabezal de impresión. Además, las presentes técnicas mejoran el control del nivel de programación mediante el uso de una señal de almohadilla de DISPARO para controlar el tiempo de escritura.

En un ejemplo, la señal de DISPARO en realidad no va al regulador de voltaje de memoria 1402. En cambio, el regulador de voltaje de memoria 1402 se habilita por el estado del modo de acceso a la memoria en el que ha entrado la matriz mediante el uso de la secuencia que se muestra en la Figura 9 - 13. Una vez que se habilita el regulador de voltaje de memoria 1402, una acción ascendente en la señal de DISPARO puede habilitar la memoria. La habilitación del bit de memoria permite que la corriente fluya desde el regulador de voltaje de memoria 1402 a través de la combinación seleccionada de bits de memoria, programándolos así en paralelo.

La Figura 15 es un diagrama de flujo de un método de ejemplo 1500 para proporcionar un voltaje de escritura con un regulador de voltaje de memoria a la combinación seleccionada de bits de memoria. La secuencia que se muestra puede incluir u omitir acciones que se toman por los circuitos integrados para facilitar la descripción de los elementos mostrados.

En el bloque 1502, el método 1500 incluye seleccionar al menos un bit de memoria de la pluralidad de bits de memoria y actuadores de disparo de un grupo de pulsos de disparo. En un ejemplo, la selección de la combinación de bits de memoria se realiza con un solo grupo de pulsos de disparo. El número de dispositivos de activación de fluidos puede activarse con la misma línea de datos para acceder a la memoria. En un ejemplo, cada una de las combinaciones seleccionadas de bits de memoria se escribe uno a la vez o en paralelo en respuesta a una única acción de aumento de la señal de DISPARO. En un ejemplo, un primer bit de memoria de la combinación seleccionada de bits de memoria se ubica en una primera matriz de silicio y un segundo bit de memoria de la combinación seleccionada de bits de memoria se ubica en una segunda matriz de silicio. En un ejemplo, la primera matriz de silicio se ubica en una primera pluma de impresión y la segunda matriz de silicio se ubica en una segunda pluma de impresión. En un ejemplo, cada uno del número de bits de memoria corresponde a un actuador de fluido. En un ejemplo, la combinación seleccionada del número de bits de memoria se identifica en los datos seleccionados por un número primitivo y un número de dirección en el grupo de pulsos de disparo único.

En el bloque 1504, el método 1500 incluye proporcionar un voltaje de escritura con un regulador de voltaje de memoria a al menos un bit de memoria de la pluralidad de bits de memoria. En un ejemplo, el regulador de voltaje de memoria proporciona el voltaje de escritura a la combinación seleccionada del número de bits de memoria durante la duración de una sola señal de DISPARO.

La Figura 16 es un diagrama de bloques que ilustra otro ejemplo de un circuito integrado 1600 con múltiples bits de memoria asociados con cada actuador de fluido. Las conexiones entre elementos pueden ser una ruta de señal, una traza u otra conexión comunicativa o conductora de electricidad. El circuito integrado 1600 puede incluir una pluralidad de dispositivos de activación de fluido 1602^oa 1602ⁿ, una pluralidad de celdas de memoria 1604^oaa 1604^nb, un circuito de selección 1606 y una lógica de control 1608. Además, el circuito integrado 1602 incluye un circuito de escritura 1610, un sensor 1612 y un registro de configuración 1614.

En este ejemplo, el circuito de selección 1606 incluye un decodificador de direcciones 1616 y una lógica de activación 1618. El decodificador de direcciones 1616 recibe direcciones y datos a través de una interfaz de datos 1620. El decodificador de direcciones 1616 se acopla eléctricamente a la lógica de activación 1618. La lógica de activación 1618 recibe una señal de disparo a través de una interfaz de disparo 1622. Cada celda de memoria 1604^oaa 1604^nbse acopla eléctricamente al circuito de escritura 1610 a través de una interfaz de detección 1624. El sensor 1612 se acopla eléctricamente a la lógica de control 1608 a través de una ruta de señal y a la interfaz de detección 1624.

El decodificador de direcciones 1616 selecciona los dispositivos de activación de fluido 1602^oa 1602ⁿy las celdas de memoria 1604^oaa 1604^nbcorrespondientes a los dispositivos de activación de fluido seleccionados 1602^oa 1602ⁿen respuesta a una dirección. Como se ilustra, cada dispositivo de activación de fluido 1602ⁿtiene múltiples celdas de memoria 1604^nay 1604^nb. En un ejemplo, las múltiples celdas de memoria 1604^nay 1604^nbpor dispositivo de activación de fluido 1602ⁿ, pueden ubicarse fuera del registro de configuración 1614.

Las direcciones pueden recibirse a través de una interfaz de datos 1620. En un ejemplo, la lógica de activación 1618 activa los dispositivos de activación de fluido seleccionados 1602^oa 1602ⁿy las celdas de memoria 1604^oaa 1604^nbcorrespondientes a los dispositivos de activación de fluido seleccionados 1602^oa 1602ⁿcon base en una señal de datos y una señal de disparo. La señal de datos puede incluir datos de la boquilla que indiquen qué dispositivo(s) de activación de fluido para la dirección proporcionada debe(n) seleccionarse. La señal de datos puede recibirse a través de la interfaz de datos 1620. La señal de disparo indica cuándo deben activarse (es decir, disparar) los dispositivos de activación de fluido seleccionados o cuándo debe accederse a las celdas de memoria correspondientes. La señal de disparo puede recibirse a través de la interfaz de disparo 1622. Cada una de la interfaz de datos 1620, la interfaz de disparo 1622 y la interfaz de detección 1624 pueden ser una placa de contacto, una clavija, una protuberancia, un cable u otra interfaz eléctrica adecuada para transmitir señales hacia y/o desde el circuito integrado 1600. Cada una de las interfaces 1620, 1622 y 1624 puede acoplarse eléctricamente a un sistema de expulsión de fluido.

El registro de configuración 1614 almacena datos para habilitar o inhabilitar el acceso a la pluralidad de celdas de memoria 1604^oaa 1604^nb. La lógica de control 1608 activa los dispositivos de activación de fluido seleccionados 1602^oa 1602ⁿo accede a las celdas de memoria 1604^oaa 1604^nbcorrespondientes a los dispositivos de activación de fluido seleccionados 1602^oa 1602ⁿcon base en los datos almacenados en el registro de configuración 1614. En un ejemplo, el registro de configuración 1614 puede tener múltiples bits para corresponder a la pluralidad de celdas de memoria 1604^oaa 1604^nb. En otro ejemplo, el registro de configuración 1614 también almacena o transmite datos para habilitar o deshabilitar el sensor 1612.

El registro de configuración 1614 puede ser un dispositivo de memoria (por ejemplo, memoria no volátil, registro de desplazamiento, etc.) y puede incluir cualquier número adecuado de bits (por ejemplo, 4 bits a 24 bits, como 12 bits) y puede incluir varios bits por cada uno de los dispositivos de activación de fluido 1602^oa 1602ⁿ. En ciertos ejemplos, el registro de configuración 1614 también puede almacenar datos de configuración para probar el circuito integrado 1600, detectar grietas dentro de un sustrato del circuito integrado 1600, habilitar temporizadores del circuito integrado 1600, establecer retardos analógicos del circuito integrado 1600, validar operaciones del circuito integrado 1600, o para configurar otras funciones del circuito integrado 1600.

Los datos almacenados en las celdas de memoria 1604^oaa 1604^nbpueden leerse a través de la interfaz de detección 1624 cuando se ha accedido a las celdas de memoria seleccionadas 1604^oaa 1604^nbmediante la lógica de control 1608. Además, el circuito de escritura 1610 puede escribir datos en celdas de memoria seleccionadas cuando las celdas de memoria seleccionadas 1604^oaa 1604^nbhan sido accedidas por la lógica de control 1608. El sensor 1612 puede ser un dispositivo de unión (por ejemplo, un diodo térmico), un dispositivo resistivo (por ejemplo, un detector de grietas) u otro dispositivo adecuado para detectar un estado del circuito integrado 1600. El sensor 1612 puede leerse a través de la interfaz de detección 1624.

Claims

REIVINDICACIONES

1. Un circuito integrado (400) para un componente de impresión (406) que comprende:

una pluralidad de bits de memoria (424);

una pluralidad de actuadores de disparo de un grupo de pulsos de disparo (418);

un circuito de selección para seleccionar al menos un bit de memoria de la pluralidad de bits de memoria (424) y los actuadores de disparo del grupo de pulsos de disparo (418); y

un regulador de voltaje de memoria (1402) para proporcionar un voltaje de escritura a al menos un bit de memoria de la pluralidad de bits de memoria (424).

2. El circuito integrado (400) de la reivindicación 1, en donde cada uno de los bits de memoria (424) se escribe en respuesta a una acción de aumento de la señal de DISPARO.

3. El circuito integrado (400) de la reivindicación 1 o 2, en donde el al menos un bit de memoria (424) y los actuadores de disparo se seleccionan sobre una línea de datos, y el al menos un bit de memoria (424) se escribe y los actuadores de disparo se activan sobre una línea de disparo.

4. El circuito integrado (400) de cualquiera de las reivindicaciones 1-3, en donde un primer bit de memoria seleccionado (424) se ubica en una primera matriz de silicio y un segundo bit de memoria seleccionado (424) se ubica en una segunda matriz de silicio.

5. El circuito integrado (400) de la reivindicación 4, en donde la primera matriz de silicio se ubica en una primera pluma de impresión (302) y la segunda matriz de silicio se ubica en una segunda pluma de impresión (304).

6. El circuito integrado (400) de cualquiera de las reivindicaciones 1-5, en donde al menos cada uno de la pluralidad de bits de memoria (424) se asocia con un actuador de fluido.

7. El circuito integrado (400) de cualquiera de las reivindicaciones 1-6, en donde los bits de memoria seleccionados de la pluralidad de bits de memoria (424) se identifican en datos seleccionados por un número primitivo y un número de dirección en un solo grupo de pulsos de disparo (418).

8. El circuito integrado (400) de cualquiera de las reivindicaciones 1-7, en donde el regulador de voltaje de memoria (1402) proporciona el voltaje de escritura a los bits de memoria seleccionados (424) durante la duración de una única señal de DISPARO.

9. El circuito integrado (400) de cualquiera de las reivindicaciones 1-8, en donde los bits de memoria seleccionados (424) se subdividen además por una pluralidad de bits en un registro de configuración (416).

10. Un método para escribir datos almacenados en un cartucho de cabezal de impresión reemplazable, que comprende:

seleccionar al menos un bit de memoria de una pluralidad de bits de memoria (424) y actuadores de disparo de un grupo de pulsos de disparo (418); y

proporcionar un voltaje de escritura con un regulador de voltaje de memoria (1402) a al menos un bit de memoria de la pluralidad de bits de memoria (424).

11. El método de la reivindicación 10, en donde cada uno de los bits de memoria (424) se escribe en respuesta a una acción de aumento de la señal de DISPARO.

12. El método de la reivindicación 10 u 11, en donde el al menos un bit de memoria (424) y los actuadores de disparo se seleccionan sobre una línea de datos, y el al menos un bit de memoria (424) se escribe y la activación de disparo se activa sobre una línea de disparo.

13. El método de cualquiera de las reivindicaciones 10-12, en donde cada bit de memoria seleccionado de la pluralidad de bits de memoria (424) se asocia a un actuador de fluido.

14. El método de cualquiera de las reivindicaciones 10-13, en donde los bits de memoria seleccionados (424) se subdividen además por una pluralidad de bits en un registro de configuración (416).

15. El método de cualquiera de las reivindicaciones 10-14, en donde el regulador de voltaje de memoria (1402) proporciona el voltaje de escritura a los bits de memoria seleccionados (424) durante la duración de una única señal de DISPARO.