ES2535271T3 - Procedimiento y aparato para una reducción de potencia relativa a una tasa de absorción específica en una notificación de margen de potencia - Google Patents

Procedimiento y aparato para una reducción de potencia relativa a una tasa de absorción específica en una notificación de margen de potencia Download PDF

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Abstract

Un procedimiento de comunicaciones inalámbricas, que comprende: recibir (600) una concesión de transmisión de enlace ascendente desde una estación base de servicio; determinar (601) una reducción de potencia máxima para transmisiones de enlace ascendente en un dispositivo móvil; determinar (602) una reducción de potencia relacionada con una tasa de absorción específica, SAR; comparar (603) la reducción de potencia máxima con la reducción de potencia relacionada con SAR; y ajustar (604) la potencia de transmisión según la reducción de potencia relacionada con SAR en respuesta a que la reducción de potencia relacionada con SAR supera la reducción de potencia máxima.

Description

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20-04-2015
Usar condiciones para transmitir la PHR según la presente divulgación es beneficioso, ya que las condiciones permiten a un UE transmitir una PHR a una estación base solamente si la información de reducción de potencia SAR supone una diferencia en la estación base. Por ejemplo, si la reducción de potencia estándar es mayor que la reducción de potencia SAR actual, el UE usará PR y no la reducción de potencia SAR actual. En este caso, la estación base no necesita ninguna información adicional.
Según otro aspecto de la presente divulgación, un temporizador de prohibición aparte puede configurarse por una estación base para limitar la frecuencia de la notificación PHR. El temporizador de prohibición puede iniciarse o reiniciarse cuando un UE envía una PHR. Según realizaciones ilustrativas, el UE puede entonces provocar la generación y/o el envío de una PHR solamente si el temporizador de prohibición ha expirado o no está en funcionamiento.
La FIG. 10 es un diagrama de bloques que ilustra un UE 120 configurado según un aspecto de la presente divulgación. El UE 120 incluye un controlador/procesador 480. El controlador/procesador 480 controla, gestiona y dirige toda la funcionalidad del UE 120. El UE 120 también incluye un receptor 1000. El receptor 1000 puede incluir componentes tales como antenas 452a a 452r, desmoduladores 454a a 454r, un detector MIMO 456 y un procesador de recepción 458, como se ilustra en la FIG. 4. El receptor 1000 funciona bajo el control del controlador/procesador 480 para proporcionar medios para recibir una concesión de transmisión de enlace ascendente desde una estación base de servicio. Usando el MCS asignado al UE 120 en la concesión de transmisión de enlace ascendente, el controlador/procesador 480 accede a una tabla de valores de reducción de potencia máxima dentro de una memoria 482 para proporcionar medios para determinar una reducción de potencia máxima para transmisiones de enlace ascendente en el UE 120. Un módulo de reducción de potencia relacionada con SAR 1001, bajo el control del controlador/procesador 480, proporciona medios para determinar un valor de reducción de potencia relacionada con SAR. El módulo de reducción de potencia relacionada con SAR 1001 tendrá en cuenta la orientación y la proximidad del dispositivo o la potencia total usada durante transmisiones simultáneas. El controlador/procesador 480 controla un comparador 1002 para proporcionar medios para comparar la reducción de potencia máxima con la reducción de potencia relacionada con SAR. Un módulo de ajuste de potencia 1003 del UE 120 bajo el control del controlador/procesador 480 funciona para proporcionar medios para ajustar la potencia de transmisión según la reducción de potencia relacionada con SAR en respuesta al comparador 1002 tras encontrar que el valor de reducción de potencia relacionada con SAR supera la reducción de potencia máxima.
Para su funcionalidad de notificación, el controlador/procesador 480 accede a la memoria 482 para recuperar una reducción de potencia anterior relacionada con SAR y controla el comparador 1002 para proporcionar medios para comparar la reducción de potencia determinada relacionada con SAR con una reducción de potencia anterior relacionada con SAR. Un generador de notificaciones de margen de potencia 1004 se hace funcionar, bajo el control del controlador/procesador 480, para proporcionar medios para generar una notificación de margen de potencia cuando la reducción de potencia determinada relacionada con SAR supera la reducción de potencia anterior relacionada con SAR. Un transmisor 1005, bajo el control del controlador/procesador 480, proporciona medios para transmitir la notificación de margen de potencia desde el dispositivo móvil hasta la estación base de servicio. El transmisor 1005 puede incluir componentes tales como un procesador de transmisión 464, un procesador MIMO TX 466, moduladores 454a a 454r y antenas 452a a 452r, como se ilustra en la FIG. 4.
Los expertos en la técnica apreciarán además que los diversos bloques lógicos, módulos, circuitos y etapas de algoritmo ilustrativos descritos en relación con la divulgación presentada en el presente documento pueden implementarse como hardware electrónico, como software informático, o como combinaciones de ambos. Para ilustrar claramente esta intercambiabilidad de hardware y software, varios componentes, bloques, módulos, circuitos y etapas ilustrativos se han descrito anteriormente de manera genérica en lo que respecta a su funcionalidad. Si tal funcionalidad se implementa en hardware o en software depende de la aplicación particular y de las limitaciones de diseño impuestas en el sistema global. Los expertos en la técnica pueden implementar la funcionalidad descrita de diferentes maneras para cada aplicación particular, pero no debe interpretarse que tales decisiones de implementación suponen un apartamiento del alcance de la presente divulgación.
Los diversos bloques lógicos, módulos y circuitos ilustrativos descritos en relación con la divulgación presentada en el presente documento pueden implementarse o realizarse con un procesador de propósito general, con un procesador de señales digitales (DSP), con un circuito integrado de aplicación específica (ASIC), con una matriz de puertas de campo programable (FPGA) o con otro dispositivo de lógica programable, puerta discreta o lógica de transistor, componentes de hardware discretos, o con cualquier combinación de los mismos diseñada para realizar las funciones descritas en el presente documento. Un procesador de propósito general puede ser un microprocesador pero, como alternativa, el procesador puede ser cualquier máquina de estados, microcontrolador, controlador o procesador convencionales. Un procesador también puede implementarse como una combinación de dispositivos informáticos, por ejemplo, una combinación de un DSP y un microprocesador, una pluralidad de
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