DE69908680D1 - Adaptervorrichtung mit einem lokalen Speicher und Verfahren zur Emulation in einem Prozessor - Google Patents

Adaptervorrichtung mit einem lokalen Speicher und Verfahren zur Emulation in einem Prozessor

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Andrew Michael Jones
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STMicroelectronics Ltd Great Britain
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Families Citing this family (19)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100337149B1 (ko) * 2000-07-05 2002-05-18 권 기 홍 프로그램 테스트 및 디버깅이 용이한 중앙처리장치
JP3796111B2 (ja) 2000-11-10 2006-07-12 株式会社ルネサステクノロジ データプロセッサ
US7478394B1 (en) * 2001-06-04 2009-01-13 Hewlett-Packard Development Company, L.P. Context-corrupting context switching
US6895536B2 (en) * 2001-10-01 2005-05-17 Tektronix, Inc. Testable up down counter for use in a logic analyzer
JP2004054825A (ja) * 2002-07-24 2004-02-19 Matsushita Electric Ind Co Ltd 半導体集積回路装置及びそのデバッガ装置
US7496818B1 (en) 2003-02-27 2009-02-24 Marvell International Ltd. Apparatus and method for testing and debugging an integrated circuit
US7216276B1 (en) 2003-02-27 2007-05-08 Marvell International Ltd. Apparatus and method for testing and debugging an integrated circuit
US7444571B1 (en) 2003-02-27 2008-10-28 Marvell International Ltd. Apparatus and method for testing and debugging an integrated circuit
US7500250B2 (en) * 2003-03-27 2009-03-03 Microsoft Corporation Configurable event handling for user interface components
US7734797B2 (en) * 2004-03-29 2010-06-08 Marvell International Ltd. Inter-processor communication link with manageability port
EP2339475A1 (de) * 2009-12-07 2011-06-29 STMicroelectronics (Research & Development) Limited Inter-Chip Kommunikationsschnittstelle für ein Multi-Chip-Gehäuse
EP2339476B1 (de) * 2009-12-07 2012-08-15 STMicroelectronics (Research & Development) Limited Schnittstelle zum Verbinden von Halbleiterchips innerhalb eines IC-Gehäuses
EP2333673B1 (de) * 2009-12-07 2014-04-16 STMicroelectronics (Research & Development) Limited Signalabtastung und Übertragung
EP2333830B1 (de) 2009-12-07 2014-09-03 STMicroelectronics (Research & Development) Limited Verpackung bestehend aus einem ersten und einem Siliziumwürfel zusammengekoppelt durch eine Multiplex-Bus
EP2330514B1 (de) 2009-12-07 2018-12-05 STMicroelectronics (Research & Development) Limited Verpackung von integrierten Schaltungen
EP2339795B1 (de) * 2009-12-07 2013-08-14 STMicroelectronics (Research & Development) Limited Inter-Chip Kommunikationsschnittstelle für ein Multi-Chip-Gehäuse
US8521937B2 (en) 2011-02-16 2013-08-27 Stmicroelectronics (Grenoble 2) Sas Method and apparatus for interfacing multiple dies with mapping to modify source identity
US8881145B2 (en) * 2011-12-15 2014-11-04 Industrial Technology Research Institute System and method for generating application-level dependencies in one or more virtual machines
US10432351B2 (en) 2017-10-17 2019-10-01 Aagey Holding, LLC Computer network system and method to reduce network latency with a pool of ready connections

Family Cites Families (38)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3939455A (en) 1971-10-01 1976-02-17 Hitachi, Ltd. Microprocessor having an interface for connection of external devices
JPS54100634A (en) 1978-01-26 1979-08-08 Toshiba Corp Computer
US4315308A (en) 1978-12-21 1982-02-09 Intel Corporation Interface between a microprocessor chip and peripheral subsystems
US5243698A (en) 1982-11-26 1993-09-07 Inmos Limited Microcomputer
JPH06103472B2 (ja) 1986-10-29 1994-12-14 日本電気株式会社 デバツグ用マイクロプロセツサ
US4964033A (en) 1989-01-03 1990-10-16 Honeywell Inc. Microprocessor controlled interconnection apparatus for very high speed integrated circuits
KR0169736B1 (ko) 1990-03-30 1999-01-15 엔. 라이스 머레트 데이타 통신 인터페이스 및 이의 통신 방법
US5228039A (en) * 1990-05-09 1993-07-13 Applied Microsystems Corporation Source-level in-circuit software code debugging instrument
US5298921A (en) 1990-09-27 1994-03-29 Advanced Micro Devices, Inc. System for communicating with external device registers via two-byte data packets over a serial bus
CA2051029C (en) * 1990-11-30 1996-11-05 Pradeep S. Sindhu Arbitration of packet switched busses, including busses for shared memory multiprocessors
JPH0695875A (ja) 1991-01-09 1994-04-08 Mitsubishi Electric Corp マイクロコンピュータのメモリアクセス方法
US5353419A (en) 1992-01-09 1994-10-04 Trustees Of The University Of Pennsylvania Memory-side driven anticipatory instruction transfer interface with processor-side instruction selection
JPH05324860A (ja) 1992-05-27 1993-12-10 Nec Corp シングルチップマイクロコンピュータ
JPH05334459A (ja) 1992-05-28 1993-12-17 Nec Corp マイクロコンピュータ
JP3203401B2 (ja) 1993-05-21 2001-08-27 三菱電機株式会社 データ処理装置
US5426769A (en) 1993-08-26 1995-06-20 Metalink Corp. System and method for producing input/output expansion for single chip microcomputers
GB2282244B (en) 1993-09-23 1998-01-14 Advanced Risc Mach Ltd Integrated circuit
JP3131675B2 (ja) 1993-10-12 2001-02-05 三菱電機株式会社 ワンチップマイクロコンピュータ及びそのプログラムの開発，評価方法
JPH07110803A (ja) 1993-10-13 1995-04-25 Nec Corp シングルチップマイクロコンピュータ
EP0652516A1 (de) 1993-11-03 1995-05-10 Advanced Micro Devices, Inc. Integrierter Mikroprozessor
US5606710A (en) 1994-12-20 1997-02-25 National Semiconductor Corporation Multiple chip package processor having feed through paths on one die
JP2752592B2 (ja) * 1994-12-28 1998-05-18 日本ヒューレット・パッカード株式会社 マイクロプロセッサ、マイクロプロセッサ−デバッグツール間信号伝送方法及びトレース方法
CN1279449C (zh) 1994-12-28 2006-10-11 株式会社东芝 微处理器
WO1996038789A2 (en) 1995-06-01 1996-12-05 Hal Computer Systems, Inc. Programmable instruction trap system and method
US5701488A (en) * 1995-06-07 1997-12-23 Motorola, Inc. Method and apparatus for restoring a target MCU debug session to a prior state
US5544311A (en) 1995-09-11 1996-08-06 Rockwell International Corporation On-chip debug port
JPH1083318A (ja) 1996-07-17 1998-03-31 Teijin Seiki Co Ltd 電子回路解析装置
EP0840223B1 (de) 1996-10-31 2002-05-15 STMicroelectronics Limited Mikrorechner mit Zugriff auf einen externen Speicher
GB9622684D0 (en) 1996-10-31 1997-01-08 Sgs Thomson Microelectronics An integrated circuit device and method of communication therwith
GB9622683D0 (en) * 1996-10-31 1997-01-08 Sgs Thomson Microelectronics Message protocol
US5892897A (en) 1997-02-05 1999-04-06 Motorola, Inc. Method and apparatus for microprocessor debugging
US6314530B1 (en) * 1997-04-08 2001-11-06 Advanced Micro Devices, Inc. Processor having a trace access instruction to access on-chip trace memory
US6185732B1 (en) * 1997-04-08 2001-02-06 Advanced Micro Devices, Inc. Software debug port for a microprocessor
US6189140B1 (en) * 1997-04-08 2001-02-13 Advanced Micro Devices, Inc. Debug interface including logic generating handshake signals between a processor, an input/output port, and a trace logic
US5930819A (en) * 1997-06-25 1999-07-27 Sun Microsystems, Inc. Method for performing in-line bank conflict detection and resolution in a multi-ported non-blocking cache
US6356960B1 (en) * 1997-10-29 2002-03-12 Sgs-Thomson Microelectronics Limited Microprocessor having an on-chip CPU fetching a debugging routine from a memory in an external debugging device in response to a control signal received through a debugging port
SE520126C2 (sv) * 1997-12-11 2003-05-27 Axis Ab I/U-Processor och metod för styrning av periferienheter
US6175914B1 (en) 1997-12-17 2001-01-16 Advanced Micro Devices, Inc. Processor including a combined parallel debug and trace port and a serial port

Also Published As

Publication number Publication date
EP0942373A1 (de) 1999-09-15
US20020188822A1 (en) 2002-12-12
EP0942373B1 (de) 2003-06-11
US6526501B2 (en) 2003-02-25
GB9805486D0 (en) 1998-05-13

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