DE2541201B2 - Schaltungsanordnung mit veränderbarem Teilerverhältnis für die digitale Frequenzanzeige in einem Rundfunkgerät - Google Patents
Schaltungsanordnung mit veränderbarem Teilerverhältnis für die digitale Frequenzanzeige in einem RundfunkgerätInfo
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Description
In der DE-OS 23 58 673 ist eine Schaltungsanordnung für die digitale Frequenzanzeige in einem Rundfunkgerät
für den AM- und FM-Bereich beschrieben, bei der die Schwingungen des AM- und FM-Oszillators
verstärkt in rechteckförmige Schwingungen umgewandelt und mittels elektronischer Zähler gezählt werden.
Bei der bekannten Anordnung ist zur Verstärkung der Schwingungen des AM-Oszillators und der Schwingungen
des FM-Oszillators ein so breitbandig bemessener, gemeinsamer Breitbandverstärker vorgesehen, daß
sowohl die Oszillatorschwingungen für den AM-Bereich als auch diejenigen für den FM-Bereich erfaßt werden.
Die Ankopplung des Breitbandverstärkers an die Oszillatoren ist so lose bemessen, daß die Oszillatoren
durch Kapazitätsänderungen des Breitbandverstärkers nicht nennenswert verstimmt werden. Dem für den AMund
FM-Bereich gemeinsamen Breitbandverstärker ist eine Teilerkette nachgeschaltet. Wegen der um
Größenordnungen unterschiedlichen Frequenzen bei AM und FM muß das Teilerverhältnis der Teilerkette je
nach Betriebsart (Bereichswahl) veränderbar sein, damit die gewünschte Darstellung der Ziffern in jedem Fall in
denselben Anzeigefeldern einer für die Darstellung der
Ziffern vorgesehenen Anzeige erfolgen kann. Es ist deshalb vorgesehen (Fig.5), daß sine (oder auch
mehrere) der Teilerstufen der Teilerkette wahlweise umgangen wird, so daß diese Teilerstufe nicht in die
Teilung der der Teilerkette zugeführten Schwingungen
ίο einbezogen wird. Es hat sich jedoch gezeigt daß die
praktische Realisierung verschiedener Teilerverhältnisse durch Umgehung einzelner Teilerstufen relativ
aufwendig ist
Der Erfindung liegt daher die Aufgabe zugrunde, eine
Der Erfindung liegt daher die Aufgabe zugrunde, eine
is einfachere Möglichkeit für die Umschaltung der
Teilerkette auf verschiedene Teilerverhältnisse vorzusehen.
Die Erfindung geht aus von der im Oberbegriff des Anspruchs 1 vorausgesetzten Schaltungsanordnung.
Die Lösung der Aufgabe erfolgt durch die im kennzeichnenden Teil beschriebene Erfindung.
An Hand der Zeichnung wird die Erfindung nachfolgend näher beschrieben. Es zeigt
F i g. 1 die externe Beschallung eines erfindungsgemaß verwendeten Zählers,
F i g. 1 die externe Beschallung eines erfindungsgemaß verwendeten Zählers,
F i g. 2 ein Impulsdiagramm zu F i g. 1 und
F i g. 3 ein Ausführurgsbeispiel der Erfindung.
In Fig. 1 ist ein Zähler 1 mit einem Eingang 2 und einem Ausgang 3 dargestellt Der Zähler 1 ist ein Dezimalzähler mit zwei Resel-Eingängen 5, 6, mittels derer der Dezimalzähler 1 auf die Zahl Neun gestellt werden kann. Die beiden Reset-Eingänge 5,6 sind intern über ein NAND-Gatter 4 verknüpft so daß beiüpielsweise der eine Reset-Eingang 5 nur dann wirksam ist und der Dezimalzähler 1 mittels einer logischen »1« an dem Reset-Eingang 5 nur dann auf die Zahl Neun gestellt werden kann, wenn an dem anderen Reset-Eingang 6 ebenfalls das logische Potential »1« ansteht Bei »0«-Potential an dem Reset-Eingang 6 ist der Reset-Eingang 5 unwirksam. Es wird weiter vorausgesetzt daß der Dezimalzähler 1 auf die abfallenden (negativen) Flanken der seinem Eingang 2 zugefilihrten Rechteckschwingungen anspricht Der soweit beschriebene Dezimalzähler ist bekannt beispielsweise durch
F i g. 3 ein Ausführurgsbeispiel der Erfindung.
In Fig. 1 ist ein Zähler 1 mit einem Eingang 2 und einem Ausgang 3 dargestellt Der Zähler 1 ist ein Dezimalzähler mit zwei Resel-Eingängen 5, 6, mittels derer der Dezimalzähler 1 auf die Zahl Neun gestellt werden kann. Die beiden Reset-Eingänge 5,6 sind intern über ein NAND-Gatter 4 verknüpft so daß beiüpielsweise der eine Reset-Eingang 5 nur dann wirksam ist und der Dezimalzähler 1 mittels einer logischen »1« an dem Reset-Eingang 5 nur dann auf die Zahl Neun gestellt werden kann, wenn an dem anderen Reset-Eingang 6 ebenfalls das logische Potential »1« ansteht Bei »0«-Potential an dem Reset-Eingang 6 ist der Reset-Eingang 5 unwirksam. Es wird weiter vorausgesetzt daß der Dezimalzähler 1 auf die abfallenden (negativen) Flanken der seinem Eingang 2 zugefilihrten Rechteckschwingungen anspricht Der soweit beschriebene Dezimalzähler ist bekannt beispielsweise durch
« den Typ SN 749ON von Texas Instruments (»Das TTL-Kochbuch«, S. 39, Texas Instruments Deutschland
GmbH).
Zum besseren Verständnis der bei Anwendung der Erfindung auftretenden Wirkungsweise ist in F i g. 2 in
der oberen Reihe ein Zählimpuls 12 dargestellt der dem Eingang 2 des Dezimalzählers 1 zugeführt wird Am
Eingang 2 des Dezimalzählers 1 ist ein Differenzieirglied 7, 9 vorgesehen, über das der in F i g. 2 in der unteren
Reihe gezeigte differenzierte Impuls dem einen Reset-Eingang 5 als Reset-lmpuls 13 in Form einer
kurzzeitig vorhandenen logischen »1« zugeführt wird. Wenn gleichzeitig der andere Reset-Eingang 6 über eine
Steuerleitung 11 mit logisch »0« angesteuert wird, ist der Reset-lmpuls 13 ohne Einfluß auf den Dezimailzähler
10, so daß dieser als 1 :10-Teiler arbeitet und auf die
abfallende Flanke (Wechsel von logisch »1« auf logisch »0«)des Zählimpulses 12 anspricht
Wird der Reset-Eingang 6 über die Steuerleitung 11
dagegen mit logisch »1« angesteuert so ist der
f>5 Reset-lmpuls 13 am Reset-Eingang 5 wirksam, so daß
der Dezimalzähier zu Beginn jedes Zählimpulses 12 auf
den Zählerstand »Neun« gestellt wird. Da der Dezimalzähler 1 auf die abfallende (negative) Flanke des
Zählimpulses 12 anspricht, zählt der Dezimaizähler 1 am
Ende des Zählimpulses 12 von Neun auf Zehn £= Null. In
der beschriebenen Art erzeugt also je ein Zählimpuls 12 am Eingang 2 jeweils nur einen Impuls am Ausgang 3
des Dezimalzählers 1, d. h, das Teilerverhältnis beträgt
in diesem Fall 1 :1. Durch Ansteuerung des Reset-Eingangs
6 über eine Steuerleitung 11 mit den logischen Signalen »0« und »1« kann also das Teilerverhältnis des
Dezimalzählers 1 zwischen 1:10 und 1 :1 verändert werden. ι ο
Eine besonders vorteilhafte Ausführungsform der Erfindung ist in Fig.3 dargestellt, die den eingangs
erwähnten gemeinsamen Breitbandverstärker 8 und die nachgeschaltete Teilerkeite 142 1, 15 zeigt Die
Teilerkette enthält eine Teilerstufe 14 mit dem Teilerverhältnis 1 :4, eine weitere Teilerstufe 15 mit
dem Teilerverhältnis 1: 2£ und zwei Dezimalzähler 1,
die wahlweise als 1:10- oder l:l-Teiler arbeiten können. Wie in der Hauptanmeldung erwähnt ist, erfolgt
die Zählung der der Teilerkette von dem gemeinsamen Breitbandverstärker 8 zugeführten Rechteckschwingungen
nur während einer bestimmten 7eit, der
sogenannten Torzeit Deshalb wird in Fig.3 den Teilerstufen 1,14,15 über eine Klemme 17 ein Impuls
zugeführt, dessen Dauer gleich der Torzeit ist Die Zähler 1, 14, 15, die die Teilerkette bilden, können
nämlich nur dann die ihnen zugeführten Schwingungen zählen, wenn ihnen über die Klemme 17 das logische
Potential »1« zugeführt wird.
Das Gesamtteilerverhältnis der Teilerkette beträgt in Fig.3 mit den eingetragenen Weiten 1 :1000. Die
beiden Dezimalzähler 1 sind jeder für sich wie in F i g. 1 mit je einem Differenzierglied 7, 9 extern beschaltet
Außerdem sind die beiden Reset-Eingänge 6 über eine Diode 10 miteinander verbunden. Wird den beiden
Reset-Eingängen 6 über die Steuerleitungen 18, 19 je eine logische »0« zugeführt, beträgt das Teilerverhältnis
der beiden Dezimalzähler 1 jeweils 1 :10. Wird jedoch nicht dargestellten Zähler zugeführt dessen Zählerstand
auf einer Anzeige angezeigt wird. Durch die zugleich mit der Bereichs-Umschaltung vorgenommene
Änderung des Teilungsverhältnisses der Teilerkette ist gewährleistet, daß trotz der bei AM und FM um
Größenordnungen unterschiedlichen Frequenzen die Darstellung der Ziffern immer in denselben Anzeigefeldern
der erwähnten Anzeige erfolgt
über die Steuerleitung 19 eine logische »1« an den einen Reset-Eingang 6 geführt, arbeitet der zugehörige Dezimalteiler 1 in der an Hand von F i g. 1 beschriebenen Weise nur noch als 1 :1-Teiler, so daß das gesamte Teilerverhältnis der "leiterkette 1, 14, 15 jetzt 1 :100 beträgt Wenn an die andere Steuerleitung 18 eine logische »1« geführt wird, liegen wegen der gezeigten Durchlaßrichtung der Diode 10 beide Reset-Eingänge 6 auf logisch »1«, so daß beide Der.imaizähler 1 als 1 :1-Teiler arbeiten und dsis Gesamtteilerverhältnis der Teilerkette 1,14,15 nun nur noch 1:10 beträgt
über die Steuerleitung 19 eine logische »1« an den einen Reset-Eingang 6 geführt, arbeitet der zugehörige Dezimalteiler 1 in der an Hand von F i g. 1 beschriebenen Weise nur noch als 1 :1-Teiler, so daß das gesamte Teilerverhältnis der "leiterkette 1, 14, 15 jetzt 1 :100 beträgt Wenn an die andere Steuerleitung 18 eine logische »1« geführt wird, liegen wegen der gezeigten Durchlaßrichtung der Diode 10 beide Reset-Eingänge 6 auf logisch »1«, so daß beide Der.imaizähler 1 als 1 :1-Teiler arbeiten und dsis Gesamtteilerverhältnis der Teilerkette 1,14,15 nun nur noch 1:10 beträgt
Gemäß einer vorteilhaften Weiterbildung der Erfindung kann in Reihe zu dem Kondensator 7 des
Differenziergliedes 7, 9 noch ein zusätzlicher Widerstand (nicht dargestellt) geschaltet werden, dessen
gemeinsamer Verbtndungspunkt mit dem Widerstund 9 mit dem Reset-Eingang 5 verbunden ist
Dadurch tritt eine Verminderung des bei der abfallenden Flanke des Zählimpulses 12 fließenden
Spitzenstromes 13a auf. Otine diese Maßnahme können nämlich in dem Dezimalzähler vorhandene Substrat-Dioden
zerstört werden.
Die beschriebene Ansteuerung der Reset-Eingänge 6 mit den logischen Signalen »0« oder »1« erfolgt zugleich
mit der Bereichs-Umschaltung des nicht dargestellten Rundfunkgerätes. Es ergeben sich beispielsweise folgende
Teilerverhältnisse der Teilerketten: 1 :1000 für UKW, 1 :100 für KW und 1 :10 für MW. Von dem
Ausgang 16 der letzten Teilerstufe 15 werden die in ihrer Frequenz heruntergeteilten Schwingungen einem
Claims (3)
1. Schaltungsanordnung für die digitale Frequemzanzeige
in einem Rundfunkgerät für den AM- und FM-Bereich, bei der die Schwingungen des AM- und
FM-Oszillators von einem gemeinsamen Breitbandverstärker verstärkt werden, dem eine Teilerkette
mit mehreren Teilerstufen nachgeschaltet ist, deren Teilerverhältnis in Abhängigkeit vom eingeschalteten
Empfangsbereich veränderbar ist, dadurch
gekennzeichnet, daß mindestens eine Teilerstufe ein Dezimalzähler (1) mit zwei Reset-Eingängen
(5,6) ist, mittels derer der Dezimalzähler (1) auf die Zahl Neun gestellt: werden kann und von denen
der eine Reset-Eingang (5) nur dann wirksam ist,
wenn dem anderen Reset-Eingang (6) ein bestimmtes logisches Potential zugeführt wird, und daß der
Dezimalzähler (1) die abfallenden Flanken der ihm zugeführten, dem Breitbandverstärker (8) entnommenen
RecWieckschwingungen (12) zählt, und daß
dem einen Reset-Eingang (S) über ein Differenzierglied (7,9) die ansteigenden Flanken der Rechteckschwingungen
(12) zugeführt werden, und daß der andere Reset-Eingang (6) zugleich mit der Bereichsumschaltung
Ober eine Steuerleitung (11; 18, 19) wahlweise mit »0«- oder »1 «-Potential ansteuerbar
ist, so daß das Teilerverhältnis des Dezimalteilers (1) von 1 :10 auf 1 :1 veränderbar ist
2. Schaltungsanordnung nach Anspruch 1, dadurch gekennzeichnet daß die Teilerkette (1,14,15) zwei
Dezimalzähler \\) enthält, deren Teilerverhältnis
von 1:10 auf 1:1 veränderbar ist, und daß die
beiden anderen Resel-Eingänge (6) der Dezimalzähler (1) über eine Diode (10) miteit nder verbunden
sind, und daß jeder der anderen Reset-Eingänge (6) für sich ansteuerbar ist
3. Schaltungsanordnung nach Anspruch 1, dadurch gekennzeichnet, daß in Reihe mit dem Kondensator
(7) des Differenziergliedes (7, 9) ein zusätzlicher Widerstand zur Strombegrenzung geschaltet ist und
daß der gemeinsame Verbindungspunkt des zusätzlichen Widerstandes und des Widerstandes (9) des
Differenziergliedes (7,9) mit dem einen Reset-Eingang (5) des Dezimalzählers (1) verbunden ist
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