DE19736787A1 - Verfahren zum Bilden einer Zwischenverbindungsstruktur - Google Patents
Verfahren zum Bilden einer ZwischenverbindungsstrukturInfo
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- 229910021332 silicide Inorganic materials 0.000 title claims abstract description 58
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 title claims abstract description 47
- 230000015572 biosynthetic process Effects 0.000 title abstract description 13
- 229910052751 metal Inorganic materials 0.000 claims abstract description 41
- 239000002184 metal Substances 0.000 claims abstract description 41
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims abstract description 7
- 229920005591 polysilicon Polymers 0.000 claims abstract description 7
- 239000000758 substrate Substances 0.000 claims abstract description 5
- 238000000034 method Methods 0.000 claims description 39
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 claims description 26
- 229910052719 titanium Inorganic materials 0.000 claims description 25
- 239000010936 titanium Substances 0.000 claims description 25
- 238000005229 chemical vapour deposition Methods 0.000 claims description 8
- 239000011248 coating agent Substances 0.000 claims description 3
- 238000000576 coating method Methods 0.000 claims description 3
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 25
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 25
- 239000010703 silicon Substances 0.000 description 23
- 229910052710 silicon Inorganic materials 0.000 description 22
- 238000006243 chemical reaction Methods 0.000 description 13
- 238000005530 etching Methods 0.000 description 10
- 239000000377 silicon dioxide Substances 0.000 description 10
- 238000005240 physical vapour deposition Methods 0.000 description 9
- 229910021341 titanium silicide Inorganic materials 0.000 description 9
- 235000012239 silicon dioxide Nutrition 0.000 description 8
- 229910052581 Si3N4 Inorganic materials 0.000 description 7
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 7
- 229910052814 silicon oxide Inorganic materials 0.000 description 6
- 238000001020 plasma etching Methods 0.000 description 5
- 238000000137 annealing Methods 0.000 description 4
- 150000004767 nitrides Chemical class 0.000 description 4
- 239000004065 semiconductor Substances 0.000 description 4
- 229910008484 TiSi Inorganic materials 0.000 description 3
- 238000004140 cleaning Methods 0.000 description 3
- 230000007547 defect Effects 0.000 description 3
- 238000000151 deposition Methods 0.000 description 3
- 230000008021 deposition Effects 0.000 description 3
- 238000004519 manufacturing process Methods 0.000 description 3
- 239000000463 material Substances 0.000 description 3
- 125000006850 spacer group Chemical group 0.000 description 3
- 238000007669 thermal treatment Methods 0.000 description 3
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 description 2
- 230000008030 elimination Effects 0.000 description 2
- 238000003379 elimination reaction Methods 0.000 description 2
- 238000005121 nitriding Methods 0.000 description 2
- 238000000206 photolithography Methods 0.000 description 2
- 229920002120 photoresistant polymer Polymers 0.000 description 2
- BASFCYQUMIYNBI-UHFFFAOYSA-N platinum Chemical compound [Pt] BASFCYQUMIYNBI-UHFFFAOYSA-N 0.000 description 2
- 229910052715 tantalum Inorganic materials 0.000 description 2
- GUVRBAGPIYLISA-UHFFFAOYSA-N tantalum atom Chemical compound [Ta] GUVRBAGPIYLISA-UHFFFAOYSA-N 0.000 description 2
- VHUUQVKOLVNVRT-UHFFFAOYSA-N Ammonium hydroxide Chemical compound [NH4+].[OH-] VHUUQVKOLVNVRT-UHFFFAOYSA-N 0.000 description 1
- VYZAMTAEIAYCRO-UHFFFAOYSA-N Chromium Chemical compound [Cr] VYZAMTAEIAYCRO-UHFFFAOYSA-N 0.000 description 1
- MHAJPDPJQMAIIY-UHFFFAOYSA-N Hydrogen peroxide Chemical compound OO MHAJPDPJQMAIIY-UHFFFAOYSA-N 0.000 description 1
- ZOKXTWBITQBERF-UHFFFAOYSA-N Molybdenum Chemical compound [Mo] ZOKXTWBITQBERF-UHFFFAOYSA-N 0.000 description 1
- KJTLSVCANCCWHF-UHFFFAOYSA-N Ruthenium Chemical compound [Ru] KJTLSVCANCCWHF-UHFFFAOYSA-N 0.000 description 1
- FRIKWZARTBPWBN-UHFFFAOYSA-N [Si].O=[Si]=O Chemical compound [Si].O=[Si]=O FRIKWZARTBPWBN-UHFFFAOYSA-N 0.000 description 1
- 239000000908 ammonium hydroxide Substances 0.000 description 1
- 229910021417 amorphous silicon Inorganic materials 0.000 description 1
- 230000015556 catabolic process Effects 0.000 description 1
- 238000003486 chemical etching Methods 0.000 description 1
- 229910052804 chromium Inorganic materials 0.000 description 1
- 239000011651 chromium Substances 0.000 description 1
- 229910017052 cobalt Inorganic materials 0.000 description 1
- 239000010941 cobalt Substances 0.000 description 1
- GUTLYIVDDKVIGB-UHFFFAOYSA-N cobalt atom Chemical compound [Co] GUTLYIVDDKVIGB-UHFFFAOYSA-N 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 229910021419 crystalline silicon Inorganic materials 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
- 238000005137 deposition process Methods 0.000 description 1
- 239000003989 dielectric material Substances 0.000 description 1
- 238000009792 diffusion process Methods 0.000 description 1
- 238000005538 encapsulation Methods 0.000 description 1
- 230000008020 evaporation Effects 0.000 description 1
- 238000001704 evaporation Methods 0.000 description 1
- 230000003993 interaction Effects 0.000 description 1
- 150000002500 ions Chemical class 0.000 description 1
- 238000011068 loading method Methods 0.000 description 1
- 230000000873 masking effect Effects 0.000 description 1
- 229910021471 metal-silicon alloy Inorganic materials 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 229910052750 molybdenum Inorganic materials 0.000 description 1
- 239000011733 molybdenum Substances 0.000 description 1
- 229910052759 nickel Inorganic materials 0.000 description 1
- 210000002381 plasma Anatomy 0.000 description 1
- 229910052697 platinum Inorganic materials 0.000 description 1
- 108090000623 proteins and genes Proteins 0.000 description 1
- 229910052707 ruthenium Inorganic materials 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- GWEVSGVZZGPLCZ-UHFFFAOYSA-N titanium dioxide Inorganic materials O=[Ti]=O GWEVSGVZZGPLCZ-UHFFFAOYSA-N 0.000 description 1
- 239000004408 titanium dioxide Substances 0.000 description 1
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 1
- 229910052721 tungsten Inorganic materials 0.000 description 1
- 239000010937 tungsten Substances 0.000 description 1
- 238000003631 wet chemical etching Methods 0.000 description 1
- 238000001039 wet etching Methods 0.000 description 1
- 201000009482 yaws Diseases 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
- H01L21/283—Deposition of conductive or insulating materials for electrodes conducting electric current
- H01L21/285—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation
- H01L21/28506—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers
- H01L21/28512—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers on semiconductor bodies comprising elements of Group IV of the Periodic Table
- H01L21/28518—Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers on semiconductor bodies comprising elements of Group IV of the Periodic Table the conductive layers comprising silicides
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3205—Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
- H01L21/321—After treatment
- H01L21/3213—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer
- H01L21/32133—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only
- H01L21/32134—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by liquid etching only
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- Manufacturing & Machinery (AREA)
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- Power Engineering (AREA)
- General Chemical & Material Sciences (AREA)
- Chemical Kinetics & Catalysis (AREA)
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Description
Die Erfindung betrifft ein Verfahren zum Bilden einer Zwi
schenverbindungsstruktur nach dem Oberbegriff des Anspruchs 1.
Metall-Silicium-Legierungen mit hoher Leitfähigkeit werden bei
der Bildung elektrischer Zwischenverbindungsstrukturen von Halbleiter
bauelementen verwendet.
Diese Silicide enthalten ein Metall wie z. B. Titan, Platin
oder Wolfram, es werden jedoch auch Tantal-, Chrom-, Molybdän-, Nickel-,
Kobalt- und Rutheniumsilicide verwendet. Im folgenden werden bekannte,
Silicide verwendende Verfahren zur Bildung elektrischer Zwischenverbin
dungsstrukturen, wie die direkte Deposition eines Silicids oder Metalls
auf eine Halbleiterbauelementoberfläche aus Targets mit Hilfe von Sput
tern, die physikalische Aufdampfung ("PVD") oder chemische Aufdampfung
("CVD") nahezu stöchiometrischer Silicide kurz diskutiert.
Ein chemisches Aufdampfungsverfahren ("CVD") umfaßt die Depo
sition einer unstrukturierten Schicht eines Metallsilicids in nahezu
stöchiometrischem Verhältnis zum Bilden eines leitenden Silicids auf ei
ner Halbleiter-Waferoberfläche. Anschließend werden bekannte Photolitho
graphietechniken und Plasmaätzen angewandt, um die Silicidschicht zu
strukturieren und so die Mikroschaltungsanordnung, z. B. die elektrische
Zwischenverbindungsstruktur auf dem Wafer, festzulegen.
Ein typisches Verfahren zur Bildung einer Silicidmikroschal
tungsanordnung mittels CVD ist das folgende: (A) Bilden und Strukturie
ren einer Siliciumdioxidschicht zum Freilegen der Bereiche des darunter
liegenden Siliciums, auf denen Metallsilicid aufgebracht werden soll;
(B) Säubern der freigelegten Bereiche des Siliciums und Siliciumdioxids,
um jegliche Eigenoxid- oder Fremdschichten zu entfernen; (C) Aufbringen
von Metallsilicid mittels chemischer Aufdampfung; (D) Photolithographi
sches Strukturieren des Metallsilicids; (E) Plasmaätzen des Metallsili
cids; und (F) Entfernen des Photolacks (nach dem Ätzen).
Das Bilden von Metallsilicid-Mikroschaltungsanordnungen mit
tels eines CVD-Verfahrens hat den Vorteil, daß thermische Beschränkungen
des CVD-Verfahrens nur von der Depositionstemperatur abhängen. Die Bil
dung von Siliciden mit einem solchen CVD-Verfahren erfordert jedoch eine
photolithographische Strukturierung sowie ein Plasmaätzen des Metallsi
licids zur Bildung der gewünschten Mikroschaltungsanordnung. Diese
Strukturierungs- und Ätzschritte erhöhen die Kosten und können die Aus
beute vermindern.
Bei einem physikalischen Aufdampfungsverfahren (PVD) werden
Metallsilicide, wie Titan oder Tantal, aus einem nahezu stöchiometri
schen Silicidtarget auf die gesamte Waferoberfläche aufgebracht. Das Si
licid wird zunächst strukturiert und dann zur Festlegung der Silicid-Mi
kroschaltungsanordnung geätzt. Anschließend wird ein Temperschritt
durchgeführt, um das aufgebrachte Silicid von einer metallischen Phase
mit hohem elektrischen Widerstand in eine metallische Phase mit niedri
gem elektrischen Widerstand umzuwandeln.
Ein typisches Verfahren zur Bildung einer Metallsilicid-Mikro
schaltungsanordnung mittels PVD ist das folgende: (A) Bilden und Struk
turieren einer Siliciumdioxidschicht zum Freilegen von Bereichen der
darunterliegenden Siliciumschicht, auf denen das Metallsilicid gebildet
werden soll; (B) Säubern der freigelegten Bereiche des Siliciums und Si
liciumdioxids, um jegliche Eigenoxid- oder Fremdschichten zu entfernen;
(C) Aufbringen von Metallsilicid durch physikalische Aufdampfung; (D)
photolithographisches Strukturieren des Metallsilicids; (E) Plasmaätzen
des Metallsilicids; (F) Entfernen des Photolacks (nach dem Ätzen); und
(G) Tempern des Silicids zur Reduzierung des elektrischen Widerstands
der Silicid-Mikroschaltungsanordnung.
Die Herstellung von Silicid-Mikroschaltungsanordnungen mittels
eines physikalischen Aufdamfungsverfahrens erfordert ebenfalls das kost
spielige und zeitraubende photolithographische Strukturieren und Plas
maätzen des Metallsilicids. Außerdem erfordert ein solches Verfahren ei
nen separaten Temperzyklus zur Umwandlung des Silicids in eine metalli
sche Phase mit niedrigem elektrischen Widerstand, was die Kosten und die
Herstellungsdauer weiter erhöht.
Ein physikalisches Aufdampfungsverfahren kann mit einem Tem
perschritt kombiniert werden, was zu einem Verfahren führt, in dem die
Silicid-Mikroschaltungsanordnung nicht durch photolithographisches
Strukturieren, sondern durch selektive Phasenbildung und selektives che
misches Ätzen festgelegt wird. Ein solches Verfahren ist allgemein als
selbstjustierendes Silicid- oder "Salicid"-Verfahren bekannt.
Ein Salicidverfahren beruht auf den thermodynamischen Unter
schieden zwischen (1) Reaktionen von Metall mit Silicium und (2) Reak
tionen von Metall mit Siliciumdioxid. Reaktionen zwischen Metall und Si
licium, die zur Bildung von Metallsiliciden führen, können bei Tempera
turen von etwa 600°C angeregt werden, während Reaktionen zwischen Metall
und Siliciumdioxid Temperaturen oberhalb von etwa 750°C erfordern. Folg
lich kann man bei genauer Kontrolle der Reaktionstemperatur steuern, ob
ein Metall nur mit Silicium oder mit Silicium und Siliciumdioxid rea
giert. Bei einem solchen Verfahren wird der elektrische Widerstand der
resultierenden Silicidschicht durch die Verfahrenstemperatur und die An
fangsdicke des Metalls bestimmt.
Ein Salicidverfahren erfordert zwar zahlreiche Verfahrens
schritte, Photolithographie und Plasmaätzen sind jedoch nicht erforder
lich. Ein Strukturieren der selbstjustierenden Strukturen wird durch se
lektives naßchemisches Ätzen erreicht. Die metallische Schicht wird mit
Silicium in einer nitrierenden Umgebung thermisch reagiert, um Metallni
tride in auf Siliciumdioxid liegenden Bereichen und Metallsilicide in
auf Silicium liegenden Bereichen zu bilden. Anschließend werden Ätzlö
sungen, die Metallnitride mit höheren Raten als Metallsilicide ätzen,
wie z. B. Ammoniumhydroxid (NH4OH)- und Wasserstoffperoxid (H2O2)-Mi
schungen, verwendet, um die Silicid-Mikroschaltungsanordnung festzule
gen.
Ein typisches bekanntes Salicidverfahren ist das folgende: (A)
Aufbringen, Dotieren und Strukturieren einer Siliciumschicht; (B) Auf
bringen einer Verkappungsschicht aus Siliciumoxid oder Siliciumnitrid
auf dem Silicium; (C) unstrukturiertes Rückätzen der Verkappungsschicht
zur Bildung von Seitenwandsabstandsschichten längs des Siliciums und zum
Freilegen von Bereichen des Siliciums, auf denen Metallsilicid gebildet
werden soll; (D) Säubern der freigelegten Siliciumoberflächen, um jegli
che Eigenoxid- oder Fremdschichten zu entfernen; (E) Aufbringen eines
Metalls durch unstrukturierte physikalische Aufdampfung; (F) Reagieren
des Metalls während einer ersten, in nitrierender Umgebung durchgeführ
ten thermischen Reaktion mit Silicium zur Bildung von Metallsilicid und
mit der Verkappungsschicht zur Bildung von Metallnitrid; (G) Ätzen des
Metallnitrids über selektives chemisches Atzen; und (H) Umwandeln des
Metallsilicids in einer zweiten thermischen Reaktion in eine Silicidpha
se mit niedrigem elektrischen Widerstand. Die zweite thermische Reak
tion ist nicht erforderlich, wenn die Temperatur der ersten thermischen
Reaktion ausreichend hoch ist, um direkt die Silicidphase mit niedrigem
elektrischen Widerstand zu bilden.
Die Reaktionstemperatur eines solchen Salicidverfahrens ist
kritisch. Wenn die Reaktionstemperatur zu gering ist, kann der Schicht
widerstand der resultierenden Silicidschicht zu groß sein und einen an
schließenden Temperschritt zum Umwandeln des Silicids in eine metalli
sche Phase mit niedrigem elektrischen Widerstand erfordern. Wenn ande
rerseits die Reaktionstemperatur zu groß ist, können die Reaktionen zwi
schen Metall und Silicium unkontrollierte Reaktionen zwischen Metall und
Siliciumdioxid oder Siliciumnitrid bewirken, die zur unerwünschten Bil
dung von Silicid führen können. Diese unerwünschte Silicidbildung kann
verschiedene Mikroschaltungsanordnungen versehentlich kurzschließen, was
zu Defekten führt.
Das Temperaturfenster, in dem ein Silicid mit niedrigem elek
trischen Widerstand ohne unerwünschtes Kurzschließen der Mikroschal
tungsanordnung gebildet werden kann, kann 15°C betragen. Es gibt jedoch
gegenwärtig kein Verfahren, welches solch enge Reaktionstemperaturtole
ranzen einhalten kann, was dazu führt, daß bekannte Salicidverfahren ei
nen zweiten thermischen Temperschritt erfordern, um das Silicid in eine
Phase mit niedrigem elektrischen Widerstand umzuwandeln.
Aufgabe der Erfindung ist es, ein Verfahren zum Bilden einer
Zwischenverbindungsstruktur nach dem Oberbegriff des Anspruchs 1 zu
schaffen, bei dem die oben beschriebenen Nachteile vermieden werden.
Diese Aufgabe wird entsprechend dem kennzeichnenden Teil des
Anspruchs 1 gelöst. Hierzu werden beim Beschichten nicht-thermische
Energiequellen so angewandt, daß erste Bereiche ein Metallsilicid bilden
und zweite Bereiche im metallischen Zustand bleiben, woraufhin mittels
eines nassen Ätzmittels die zweiten Bereiche selektiv entfernt und die
ersten Bereiche im wesentlichen intakt gelassen werden.
Weitere Ausgestaltungen der Erfindung sind der nachfolgenden
Beschreibung und den Unteransprüchen zu entnehmen.
Die Erfindung wird nachstehend anhand eines in den beigefügten
Abbildungen dargestellten Ausführungsbeispiels näher erläutert.
Fig. 1-4 und Fig. 5 sind jeweils Querschnittsansichten von Be
reichen erster und zweiter Halbleiterstrukturen mit einem CVD-Salicid
verfahren.
Gemäß Fig. 1 enthält eine Struktur 10 ein Siliciumsubstrat 12,
auf dem eine Gateoxidschicht 14 und Feldoxidregionen 16 gebildet sind.
Die Gateoxidschicht 14 kann z. B. eine 1500 Å dicke Siliciumdioxidschicht
sein. Zur Bildung eines Gates 18 wird eine Polysiliciumschicht aufge
bracht und strukturiert. Es können auch Strukturen mit Gates aus kri
stallinem oder amorphem Silicium sowie Strukturen mit dotierten Gates
verwendet werden. Das Gate 18 ist vorzugweise 3000 Å dick, die Dicke
kann jedoch im Bereich zwischen 1000 und 6000 Å liegen. Seitenwandab
standsschichten 20 werden gebildet und können aus Siliciumdioxid, Sili
ciumnitrid oder einem anderen geeigneten dielektrischen Material beste
hen.
Gemäß Fig. 2 wird eine Titanschicht 22 auf der Struktur 10
mittels eines CVD-Systems mit zusätzlichen nicht-thermischen Energie
quellen, wie z. B. RF-Plasmen, aufgebracht. Ein solches CVD-System ist
z. B. das Phoenix CVD-System, erhältlich bei der Material Research Corpo
ration (MRC), Orangeburg, New York. Die Verwendung solcher zusätzlichen
Energiequellen führt dazu, daß solche Bereiche 22a der Titanschicht 22,
die über dem Gate 18 liegen, Titansilicide, z. B. TiSi2 bilden, während
solche Bereiche 22b der Titanschicht 22, die auf den Seitenwandabstands
schichten 20, der Gateoxidschicht 14 und den Feldoxidregionen 16 liegen,
in einem metallischen Titanzustand bleiben. Folglich führt das Aufbrin
gen einer Titanschicht 22 auf der Struktur 10 mittels eines MRC Phoenix
CVD-Systems dazu, daß gemäß Fig. 3 Bereiche 22a aus Titansilicid über
dem Gate 18 und Bereiche 22b aus metallischem Titan über den Seitenwand
abstandsschichten 20, der Gateoxidschicht 14 und den Feldoxidregionen 16
gebildet werden.
Die beim Depositionsverfahren verwendete Dauer, Energie und
spezifische chemische Zusammensetzung kann der gewünschten Dicke des zu
bildenden Bereichs 22a aus Titansilicid angepaßt werden. Obwohl die
Dicke des Bereichs 22a in bevorzugten Ausführungsformen etwa 2000 Å be
trägt, ist jede Dicke im Bereich von 500 bis 5000 Å akzeptabel. Zu die
sem Zeitpunkt des Verfahrens befindet sich der Bereich 22a im wesentli
chen in der hochresistiven C49-Phase.
Das Bilden einer einzelnen Titanschicht 22, welche Bereiche
22a aus Titansilicid über dem Gate 18 und Bereiche 22b aus metallischem
Titan über den Seitenwandsabstandsschichten 20, der Gateoxidregion 14
und den Feldoxidregionen 16 enthält, hat den Vorteil, daß die Titan
schicht 22 nun ohne photolitographisches Strukturieren oder teure oder
zeitraubende Maskierungsschritte selektiv geätzt werden kann. In einem
nachfolgenden Ätzschritt wird ein nasses Ätzmittel, wie z. B. H2O2 oder
NH4OH, auf die Struktur 10 angewandt. Das nasse Ätzmittel entfernt gemäß
Fig. 4 selektiv die Bereiche 22b der Titanschicht 22, während es die Be
reiche 22a der Titanschicht 22 im wesentlichen intakt läßt.
In einem nachfolgenden thermischen Schritt wird die Struktur
10 auf etwa 750°C erhitzt. Wenn die Temperatur des Bereichs 22a etwa
750°C erreicht, wird die C49-Phase von TiSi2 mit höherem elektrischen
Widerstand in eine C54-Phase von TiSi2 mit niedrigerem elektrischen Wi
derstand umgewandelt. Der Widerstand des Bereichs 22a kann so auf ein
gewünschtes Niveau abgesenkt werden.
Tabelle 1 faßt das CVD-Salicid-Verfahren zusammen und ver
gleicht es Schritt für Schritt mit bekannten Verfahren (PVD-Salicidver
fahren und CVD-Silicidverfahren).
Tabelle 1
Der Bereich 22a wird während des Beschichtens von Titan auf
der Struktur 10 gebildet und erfordert daher keinen separaten thermi
schen Schritt. Folglich ist nur ein thermisches Behandeln, etwa zum Um
wandeln der C49-Phase mit höherem elektrischen Widerstand in die
C54-Phase mit niedrigerem elektrischen Widerstand erforderlich. Das Eli
minieren eines separaten thermischen Schritts zum Fördern der Silicium
bildung reduziert nicht nur die Zahl erforderlicher thermischer Zyklen
und damit die Belastung eines Grundwafers, auf dem die Struktur 10 ge
bildet wird, sondern vermindert auch das Auftreten von Gateoxiddefekten
und erleichtert die Belastungs- und Haltbarkeitsanforderungen an die bei
der Bildung der Seitenwandabstandsschichten 20 verwendeten Materialien.
Ferner ist es nicht länger erforderlich, unstrukturierte Schichten ther
misch zu behandeln, was das Auftreten von Kurzschlüssen im Bauelement
wesentlich reduziert.
Die Elimination eines separaten thermischen Schritts beim Bil
den des Bereichs 22a führt zu zahlreichen weiteren Vorteilen gegenüber
bekannten CVD-Verfahren. Zunächst hängt die Dicke des gebildeten Be
reichs 22a von den Beschichtungsparametern des Titans ab. Im Gegensatz
dazu hängt die Dicke einer mit einem bekannten thermisch umgewandelten
CVD-Salicidverfahren gebildeten Silicidschicht von thermischen Pulsen
ab, die unkontrollierbare Veränderungen aufweisen können. Im Ergebnis
können die CVD-Verfahren der Erfindung Silicidschichten mit einer ge
naueren und gleichmäßigeren Dicke bilden. Da der Endschichtwiderstand
des Bereichs 22a durch die Dicke des CVD-Salicids bestimmt wird, statt
durch die Anfangsdicke des nach einem ersten thermischen Zyklus gebilde
ten Silicids, kann der Widerstand des Bereichs 22a mit größerer Genauig
keit gesteuert werden.
Die Elimination eines thermischen Reaktionsschrittes bei der
Silicidbildung beugt außerdem unerwünschten lateralen Diffusionen vor,
was Randdefekte, die von Wechselwirkungen zwischen metallischem Titan
und Silicium während thermischer Behandlung herrühren und die die Bau
elementausbeute verhindern würden, effizient vermeidet. Ferner werden
ein lokaler Zusammenbruch sowie eine Silicidbildung auf unerwünscht dün
nen Siliciumoxid/Siliciumnitridschichten, die von der jeweiligen Behand
lung herrühren, vermieden. Außerdem tragen die beim beschriebenen
CVD-Salicidverfahren verwendeten tieferen Temperaturen, verbunden mit einer
verminderten Zahl thermischer Behandlungsschritte, dazu bei, daß eine
unerwünschte Bildung von Siliciden aus aufgebrachtem Titan und Silicium
dioxid vermieden wird.
In anderen Ausführungsform können Bereiche der Gateoxidschicht
14, die nicht wesentlich unter dem Gate 18 liegen, vor dem Titanbe
schichten weggeätzt werden. Auf diese Weise reagiert das beschichtete
Titan mit freigelegten Bereichen des Siliciumsubstrats 12 gemäß Fig. 5
zum Bilden einer Titansilicidschicht 22c. Der auf den Seitenwandsab
standsschichten 20 und den Feldoxidregionen 16 liegende Bereich 22b kann
bei einem nachfolgenden Naßätzen entfernt werden, und der verbleibende
Bereich 22a und die verbleibende Titansilicidschicht 22c können in die
C54-Phase mit nierdrigem elektrischen Widerstand umgewandelt werden.
Die beschriebenen Ausführungsformen können auch bei der Bil
dung verschiedener anderer Silicide verwendet werden. Ferner ist die Er
leichterung des selektiven Ätzens zwischen Titansilicid und metalli
schem Titan nicht auf das Siliciumsubstrat 12 und die Seitenwandab
standsschichten 20 beschränkt, sondern kann über jeder Silicium/Silici
umoxid- oder Silicium/Siliciumnitrid-Grenzfläche realisiert werden. Das
bedeutet, daß beim Beschichten von Titan sowohl auf Silicium als auch
auf Siliciumoxid oder Siliciumnitrid die über dem Silicium beschichten
Titanbereiche Titansilicid bilden, während die über Siliciumoxid oder
Siliciumnitrid beschichten Titanbereiche metallisches Titan bleiben. An
schließend kann jedes geeignete Naßätzmittel angewandt werden, um ohne
weiteres die metallischen Titanbereiche zu entfernen, ohne wesentliche
Bereiche des Titansilicids zu entfernen.
Die CVD-Verfahren der Erfindung ermöglichen ohne weiteres das
Bilden selektiver Silicidzwischenverbindungsstrukturen und damit den
Entwurf und die Herstellung neuartiger programmierbarer Schaltkreise und
Layouts. Ferner sind die Ausführungsformen gleichermaßen auf n-leitende
wie p-leitende Materialien anwendbar.
Claims (7)
1. Verfahren zum Bilden einer Zwischenverbindungsstruktur, bei
dem eine Polysiliciumstruktur (10) auf einem Substrat (12) und eine die
Polysiliciumstruktur (10) umgebende dielektrische Schicht gebildet, und
bei dem mittels chemischer Aufdampfung (CVD) die Polysiliciumstruktur
(10) und die dielektrische Schicht mit einer daraufliegenden metalli
schen Schicht (22) beschichtet werden, dadurch gekennzeichnet, daß beim
Beschichten mit der metallischen Schicht (22) nicht-thermische Energie
quellen so angewandt werden, daß erste Bereiche (22a), die im wesentli
chen über der Polysiliciumstrukur (10) liegen, ein Metallsilicid bilden,
und zweite Bereiche (22b), die im wesentlichen über der dielektrischen
Schicht liegen, im metallischen Zustand bleiben, und daß mittels eines
nassen Ätzmittels die zweiten Bereiche (22b) selektiv entfernt werden,
wobei die ersten Bereiche (22a) im wesentlichen intakt gelassen werden.
2. Verfahren nach Anspruch 1, dadurch gekennzeichnet, daß für
die metallische Schicht (22) Titan verwendet wird.
3. Verfahren nach Anspruch 1 oder 2, dadurch gekennzeichnet,
daß als Ätzmittel H2O2 verwendet wird.
4. Verfahren nach Anspruch 1 oder 2, dadurch gekennzeichnet,
daß als Ätzmittel NH4OH verwendet wird.
5. Verfahren nach einem der Ansprüche 1 bis 4, dadurch gekenn
zeichnet, daß ferner die Zwischenverbindungsstruktur auf eine vorbe
stimmte Temperatur erhitzt wird, um das Metallsilicid aus einem Zustand
mit höherem elektrischen Widerstand in einen Zustand mit niedrigerem
elektrischen Widerstand umzuwandeln.
6. Verfahren nach Anspruch 5, dadurch gekennzeichnet, daß als
vorbestimmte Temperatur eine Temperatur von etwa 750°C gewählt wird.
7. Verfahren nach Anspruch 5 oder 6, dadurch gekennzeichnet,
daß eine C49-Phase als Zustand mit höherem elektrischen Widerstand in
eine C54-Phase als Zustand mit niedrigerem elektrischen Widerstand um
gewandelt wird.
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US73390496A | 1996-10-18 | 1996-10-18 |
Publications (1)
Publication Number | Publication Date |
---|---|
DE19736787A1 true DE19736787A1 (de) | 1998-05-28 |
Family
ID=24949586
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE19736787A Ceased DE19736787A1 (de) | 1996-10-18 | 1997-08-23 | Verfahren zum Bilden einer Zwischenverbindungsstruktur |
Country Status (2)
Country | Link |
---|---|
KR (1) | KR19980032341A (de) |
DE (1) | DE19736787A1 (de) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2001077209A (ja) * | 1999-07-08 | 2001-03-23 | Mitsubishi Electric Corp | 半導体装置の製造方法 |
-
1997
- 1997-08-23 DE DE19736787A patent/DE19736787A1/de not_active Ceased
- 1997-08-29 KR KR1019970043178A patent/KR19980032341A/ko not_active Application Discontinuation
Also Published As
Publication number | Publication date |
---|---|
KR19980032341A (ko) | 1998-07-25 |
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