DE112006003861B4 - Halbleiterbaugruppe und Verfahren zur Herstellung einer Halbleiterbaugruppe - Google Patents
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Abstract
Eine Halbleiterbaugruppe (24; 26) weist ein Halbleitebauelement (1) mit einem Schaltungsträger (2; 27), einem Halbleiterchip (3) und einer Vielzahl von elektrischen Verbindungen (4) auf. Eine Haftkraftverstärkungsschicht (22) wird zumindest an Bereichen des Halbleiterbauelements (1) abgeschieden und Kunststoff-Vergussmaterial (25) verkapselt zumindest den Halbleiterchip (3), die Vielzahl der elektrischen Verbindungen (4) und die Vielzahl der inneren Kontaktpads (9). Oberflächenbereiche (17) des Halbleiterbauelements (1) werden selektiv aktiviert.
Description
- Die Erfindung betrifft ein Verfahren zur Herstellung einer Halbleiterbaugruppe und, insbesondere, ein Verfahren zur Herstellung einer verkapselten Halbleiterbaugruppe.
- Es ist bekannt, dass verkapselte Halbleiterbaugruppen, die ein Kunststoff-Vergussmaterial als das Baugruppengehäuse enthalten, anfällig für Rissbildung während eines Reflow-Lötens sind. Dieses Phänomen wird allgemein als der „Popkorn-Effekt” bezeichnet und führt oftmals zu einem Defekt der Baugruppe.
- Diese Rissbildung ist das Ergebnis der Ansammlung von Feuchtigkeit innerhalb der Halbleiterbaugruppe, welche dann, wenn die Baugruppe auf eine höhere Temperatur während des Rückflusslötprozesses erwärmt wird, verdampft, wodurch der Aufbau eines Wasserdampfdrucks innerhalb der Baugruppe verursacht wird, der zu einer Rissbildung des Verkapselungsmaterials führt Die Ungleichheit in den thermischen Ausdehnungskoeffizienten zwischen verschiedenen Materialien der Baugruppe, zum Beispiel Leadframe aus Metall und Kunststoff-Vergussmaterial, kann auch zu einer Ausbildung von Rissen und sogar zu einer kompletten Ablösung an den Schnittstellen zwischen diesen Materialien führen. Feuchtigkeit kann sich in diesen Rissen ansammeln und den Popkorn-Effekt während eines Reflow-Lötens verschlimmern.
- Das Problem der Rissbildung ist schwerwiegender für so genannte „grüne” bzw. umweltfreundliche Baugruppen, die unverbleites Lötmittel verwenden, das eine höhere Rückflusslöttemperatur von ungefähr 260°C benötigt, und für so genannte ”robuste” Baugruppen, die benötigt werden, um extremeren Betriebsbedingungen standzuhalten, wie beispielsweise Baugruppen für Automobilanwendungen.
- Mit diesem Problem hat sich beispielsweise die
WO 00/74131 A1 - Die
US 4,517,734 beschreibt ein Verfahren zur Herstellung von Halbleiterbauteilen, bei dem Aluminiumleiterbahnen mit einem Korrosionsschutz versehen werden. Als Korrosionsschutz, der insbesondere gegen Korrosion durch direkten Kontakt zwischen den Aluminiumleiterbahnen und einer Kunststoffgehäusemasse wirken soll, wird eine Schicht aus Aluminiumoxid eingesetzt:
Das DokumentUS 3 986 897 beschreibt ein Verfahren zur Herstellung einer Halbleiterbaugruppe, wobei die Halbleiterbaugruppe Chipanschlusspads aus Aluminium aufweist, welche derart selektiv aktiviert werden, dass die freiliegenden Oberflächen der Chipanschlusspads hydroxil angereichertes Aluminiumoxid aufweisen. Dabei wird jedoch nicht auf das Verkapseln der Halbleiterbaugruppe eingegangen. Auch eine zusätzliche Haftverstärkungsschicht wird nicht abgeschieden. - Es ist eine Aufgabe der Erfindung, ein Verfahren zur Herstellung von Halbleiterbaugruppen anzugeben, bei dem das Haftvermögen zwischen den eingebetteten Komponenten und dem Kunststoffgehäusematerial verbessert ist und bei welchem die Rissbildung während eines Rückflusslötprozesses verringert ist. Es ist auch gewünscht, dass diese Verbesserungen für die Verwendung bei „grünen” Baugruppen und bei „robusten” Baugruppen geeignet sind.
- Es ist eine weitere Aufgabe der Erfindung, Verfahren zur Herstellung der Baugruppen anzugeben, die einfach sind, und die leicht in den Fertigungsprozess integriert werden können.
- Diese Aufgaben werden durch das Verfahren des Anspruchs 1 gelöst. Weitere vorteilhafte Verbesserungen sind Gegenstand der abhängigen Ansprüche.
- Die Erfindung betrifft ein Verfahren zur Herstellung einer Halbleiterbaugruppe. Ein Verfahren zur Herstellung einer Halbleiterbaugruppe weist das Bereitstellen eines Halbleiterbauelements auf. Das Halbleiterbauelement weist einen Schaltungsträger, zumindest einen Halbleiterchip und eine Vielzahl von elektrischen Verbindungen auf. Der Schaltungsträger weist zumindest eine Bauteilposition auf. Jede Bauteilposition weist ein Die-Pad, eine Vielzahl von inneren Kontaktpads, eine Vielzahl von äußeren Kontaktbereichen und eine Umverdrahtungsstruktur auf, welche die Vielzahl der inneren Kontaktpads und die Vielzahl der äußeren Kontaktbereiche elektrisch verbindet. Der Halbleiterchip weist eine aktive Oberfläche mit integrierten Schaltungsbauteilen und eine Vielzahl von Chip-Anschlusspads und eine passive Fläche auf. Die passive Fläche des Halbleiterchips ist auf dem Die-Pad der zumindest einen Bauteilposition des Schaltungsträgers angeordnet. Die Vielzahl von elektrischen Verbindungen erstreckt sich zwischen der Vielzahl von Chip-Anschlusspads und verbindet die Vielzahl von Chip-Anschlusspads mit der Vielzahl von inneren Kontaktpads des Schaltunnngsträgers.
- Freiliegenden Oberflächenbereiche der Chip-Anschlusspads des Halbleiterbauelements werden selektiv aktiviert und eine Haftkraftverstärkungsschicht wird zumindest auf Bereichen des Halbleiterbauelements abgeschieden. Zumindest die obere Oberfläche des Die-Pads, der Halbleiterchip, die Vielzahl von elektrischen Verbindungen und die Vielzahl der inneren Kontaktpads werden in Kunststoff-Vergussmaterial verkapselt.
- Das Verfahren gemäß der Erfindung hat den Vorteil, dass diese Oberflächenbereiche des Halbleiterbauelements selektiv aktiviert werden, nachdem das Halbleiterbauelement hergestellt ist, und insbesondere nachdem die passive Fläche des Halbleiterchips auf dem Die-Pad des Schaltungsträgers montiert ist, und nachdem die elektrischen Verbindungen zwischen den Chip-Anschlusspads und den inneren Kontaktpads des Schaltungsträger ausgebildet sind. Deshalb werden die elektrisch leitenden Schnittstellen zwischen den Bereichen des Halbleiterbauelements, die später innerhalb Kunststoff-Vergussmaterials des Baugruppengehäuses verkapselt werden, vor der selektiven Aktivierung definierter Oberflächenbereiche ausgebildet. Deshalb werden der Kontaktwiderstand der elektrischen Verbindungen und die Funktionalität der Baugruppe durch die selektive Aktivierungsbehandlung nicht beeinflusst.
- Wie vorstehend diskutiert, werden freiliegenden Oberflächenbereiche der Chip-Anschlusspads als definierte Bereiche des Halbleiterbauelements selektiv aktiviert, um aktivierte Oberflächenbereiche zu bilden. Andere Bereiche des Halbleiterbauelements bleiben unaktiviert und werden von der Aktivierungsbehandlung nicht beeinflusst Die Oberflächenbereiche, die zu aktivieren sind, können auf der Grundlage bestehenden Wissens ausgewählt werden, welches zum Beispiel zeigt, dass diese bestimmten Oberflächenbereiche schlecht oder unzureichend mit einer Haftkraftverstärkungsschicht bedeckt sind. Die selektiv aktivierten Oberflächenbereiche haben eine größere Affinität für die Haftkraftverstärkungsschicht als diese Oberflächenbereiche vor dem Aktivierungsprozess.
- Eine selektive Aktivierung von definierten Bereichen des Halbleiterbauelements kann bei dem Verfahren gemäß der Erfindung ohne die Durchführung von Maskierungsschritten leicht erreicht werden. Dies vereinfacht den Herstellungsprozess außerordentlich und hat den zusätzlichen Vorteil, dass sehr kleine Bereiche selektiv aktiviert werden können, ohne fein strukturierte Masken zu benötigen. Zusätzliche Prozessschritte werden deshalb vermieden. Die selektive Aktivierung von definierten und gewünschten Bereichen findet automatisch bei geeigneter Auswahl der zur Aktivierung verwendete chemischen Mittel statt.
- Gemäß der Erfindung werden Bereiche des Halbleiterbauelements dadurch selektiv aktiviert, dass sie Wasser im flüssigen Zustand ausgesetzt werden. Das Wasser wird bei einer Temperatur im Bereich von 60°C bis 100°C bereitgestellt und kann in geeigneter Weise durch kochendes Wasser oder Wasserdampf gebildet werden. Wasser hat den Vorteil, dass komplexe Bedingungen für die Handhabung nicht notwendig sind, und dass die Materialkosten sehr gering sind. Bei einer Ausführungsform wird das Halbleiterbauelement in kochendes Wasser eingetaucht, so dass all die Oberflächen des Halbleiterbauelements für bestimmte Zeit in Kontakt mit dem Wasser sind.
- Bei der Erfindung werden die freiliegenden Oberflächen der Chip-Anschlusspads selektiv aktiviert. Freiliegende Oberflächen der Chip-Anschlusspads sind als jene äußeren Oberflächen definiert, die nicht mit einer elektrischen Verbindung versehen sind.
- Bei der Erfindung weisen die Chip-Anschlusspads Aluminium auf, und der Aktivierungsprozess wird unter Bedingungen ausgeführt, bei denen die freiliegenden Oberflächen der Chip-Anschlusspads hydroxylangereichertes Aluminiumoxid aufweisen. Wie vorstehend diskutiert, beeinflusst die Zeit, welche die Chip-Anschlusspads Wasser ausgesetzt sind, das Ausmaß der Reaktion. Der Reaktionsablauf hängt auch von der Temperatur des Wassers ab. Deshalb werden die Bedingungen angepasst, bis die freiliegenden Oberflächen der Chipkontakte hydroxylangereichertes Aluminiumoxid aufweisen.
- Bei einer weiteren Ausführungsform wird der Aktivierungsprozess unter Bedingungen ausgeführt, so dass die freiliegenden Oberflächen der Chip-Anschlusspads im Wesentlichen vollständig hydroxyliertes Aluminiumoxid aufweisen. Typischerweise werden die Chip-Anschlusspads für eine längere Zeit Wasser ausgesetzt, um eine vollständigere Umwandlung des Aluminiumoxids in vollständig hydroxyliertes Aluminiumoxid zu erreichen. Bei der weiteren Ausführungsform wird der Aktivierungsprozess unter Bedingungen ausgeführt, so dass die freiliegenden Oberflächen der Chip-Anschlusspads im Wesentlichen aus Böhmit oder Gibbsit bestehen. Bei dieser Ausführungsform der Erfindung weisen die Chip-Anschlusspads eine äußere Schicht aus Böhmit oder Gibbsit in den freiliegenden Bereichen auf. Der Bereich des Chip-Anschlusspads, der mit der elektrischen Verbindung versehen ist, enthält kein Böhmit oder Gibbsit.
- Die Haftkraftverstärkungsschicht kann im Wesentlichen alle Oberflächen des Halbleiterbauelements bedecken, die durch das Kunststoff-Vergussmaterial zu verkapseln sind. Diese Oberflächen sind als der innere Bereich des Halbleiterbauelements definiert. Eine im Wesentlichen komplette Bedeckung der Oberflächen stellt das best mögliche Haftvermögen zwischen dem Kunststoff-Vergussmaterial und den eingebetteten Komponenten sicher.
- Bei einer Ausführungsform der Erfindung wird die Haftkraftverstärkungsschicht durch eine elektrolytische Abscheidungstechnik abgeschieden. Diese Technik ist dadurch vorteilhaft, dass eine Beschichtung oder Schicht auf allen Oberflächen komplexer Form leicht abgeschieden wird. Da das Halbleiterbauelement ein dreidimensionales Objekt ist, ist elektrolytische Abscheidungs- und Galvanisierungstechnik besonders vorteilhaft.
- Bei einer Ausführungsform der Erfindung weist die Haftkraftverstärkungsschicht Zirkonium und Chrom auf und kann auch Zirkoniumoxid und Chromoxide aufweisen. Die Haftkraftverstärkungsschicht kann durch einen als A2 Plating bekannten Prozess unter Verwendung eines kommerziell erhältlichen Plattierungsbades abgeschieden werden.
- Die Haftkraftverstärkungsschicht kann unter Abscheidungsbedingungen abgeschieden werden, um eine Schicht mit einer dendritischen Struktur zu erzeugen. Die Struktur eines elektrolytischen Abscheidungsmaterials variiert in Abhängigkeit von den Abscheidungsbedingungen. Deshalb werden die Bedingungen so gewählt, um eine dendritische Struktur mit der gewünschten mittleren Dicke und Oberflächenrauhigkeit zu erzeugen.
- Die Verkapselung zumindest der oberen Oberfläche des Die-Pads, des Halbleiterchips, der Vielzahl von elektrischen Verbindungen und der Vielzahl von inneren Kontaktpads kann durch einen Spritzgießprozess durchgeführt werden. Dieser Prozess wird im Allgemeinen bei der Herstellung von verkapselten Halbleiterbaugruppen verwendet und wird deshalb zuverlässig und kostengünstig in dem Herstellungsverfahren gemäß der Erfindung angewendet.
- Bei einer Ausführungsform wird der Schaltungsträger in der Form eines Leadframe-Streifens bereitgestellt, wobei jede Bauteilposition des Leadframe-Streifens einen Leadframe für eine einzelne Halbleiterbaugruppe bereitstellt. Bei einer alternativen Ausführungsform wird der Schaltungsträger in der Form eines Umverdrahtungssubstrats bereitgestellt. Die Vielzahl von elektrischen Verbindungen kann durch Herstellen einer Vielzahl von Drahtverbindungen gebildet werden, wobei eine bekannte Draht-Bonding-Technik angewendet wird.
- Bei den erfindungsgemäßen Verfahren ergibt sich eine Halbleiterbaugruppe die ein Halbleiterbauelement aufweist.
- Das Halbleiterbauelement weist einen Schaltungsträger, einen Halbleiterchip und eine Vielzahl von elektrischen Verbindungen auf. Der Schaltungsträger weist ein Die-Pad, eine Vielzahl von inneren Kontaktpads, eine Vielzahl von äußeren Kontaktbereichen und eine Umverdrahtungsstruktur auf, welche die Vielzahl von inneren Kontaktpads und die Vielzahl von äußeren Kontaktbereichen elektrisch verbindet. Der Halbleiterchip weist eine aktive Oberfläche mit integrierten Schaltungsbauteilen und eine Vielzahl von Chip-Anschlusspads, die auf der aktiven Oberfläche angeordnet sind, und eine passive Fläche auf. Die passive Fläche des Halbleiterchips ist auf dem Die-Pad des Schaltungsträgers montiert. Die Vielzahl von elektrischen Verbindungen erstreckt sich zwischen der Vielzahl von Chip-Anschlusspads und verbindet elektrisch die Vielzahl von Chip-Anschlusspads mit der Vielzahl innerer Kontaktpads des Schaltungsträgers.
- Die Halbleiterbaugruppe weist weiterhin eine Haftkraftverstärkungsschicht und ein Kunststoff-Vergussmaterial auf. Die Haftkraftverstärkungsschicht ist zumindest an Bereichen des Halbleiterbauelements angeordnet. Das Kunststoff-Vergussmaterial verkapselt zumindest die obere Oberfläche des Die-Pads, den Halbleiterchip, die Vielzahl von elektrischen Verbindungen und die Vielzahl von inneren Kontaktpads. Oberflächenbereiche des Halbleiterbauelements sind selektiv aktiviert.
- Die Halbleiterbaugruppe weist ein Halbleiterbauelement mit Oberflächenbereichen auf, die selektiv aktiviert sind. Das Halbleiterbauelement weist auch Oberflächenbereiche auf, die nicht selektiv aktiviert sind. Die selektiv aktivierten Bereiche können von Bereichen umgeben sein, die nicht selektiv aktiviert sind. Die aktivierten Oberflächenbereiche weisen eine äußere Schicht auf, die eine andere chemische Zusammensetzung als das Basismaterial des Bereiches aufweist.
- Definierte Bereiche, die aktiviert werden sollen, werden ausgewählt, und das Halbleiterbauelement wird einer geeigneten Behandlung unterzogen, durch die nur die Oberfläche der definierten Bereiche aktiviert wird. Andere Oberflächenbereiche des Halbleiterbauelements, die nicht definiert sind, werden nicht aktiviert. Die selektive Aktivierung von Oberflächenbereichen der Halbleiterbauelemente unterscheidet sich deshalb von einem Reinigungsprozess, da ein Reinigungsprozess alle freiliegenden Oberflächen betrifft.
- Die Oberflächenbereiche werden selektiv aktiviert, nachdem die passive Fläche des Halbleiterchips auf das Die-Pad des Schaltungsträgers montiert worden ist, und nachdem die Vielzahl von elektrischen Verbindungen, welche die Chip-Anschlusspads mit den inneren Kontaktpads des Schaltungsträgers elektrisch verbindet, ausgebildet worden ist. Deshalb bleiben die Schnittstellen zwischen den elektrischen Verbindungen und den Chip-Anschlusspads und zwischen den elektrischen Verbindungen und inneren Kontaktpads frei von der Haftkraftverstärkungsschicht. Die Schnittstellen bilden keine freien Flächen des Halbleiterbauelements und werden deshalb nicht selektiv aktiviert.
- Die Halbleiterbaugruppe bietet eine verbesserte Feuchtigkeitsresistenz und Beständigkeit gegen Löten aufgrund der Haftkraftverstärkungsschicht, die zumindest Bereiche der Oberflächen des Halbleiterbauelements bedeckt. Die Haftkraftverstärkungsschicht bietet eine verbesserte Haftung zwischen dem Kunststoff-Vergussmaterial, welches das Bauelementgehäuse bildet, und den Oberflächen des mit der Haftkraftverstärkungsschicht beschichteten Halbleiterbauelements. Dies unterdrückt die Bildung von Rissen aufgrund der Ungleichheit beim thermischen Ausdehnungskoeffizienten der Materialien des Halbleiterbauelements und des Kunststoff-Vergussmaterials. Folglich wird die Ansammlung von Feuchtigkeit in durch Risse gebildete Hohlräume verhindert, wodurch eines der Defekte ausgeschlossen wird, von dem angenommen wird, dass er zum Auftreten des Popkorn-Effekts während des Rückflusslötprozesses führt. Dies hat den Vorteil, dass die Baugruppe weniger wahrscheinlich ausfällt, wenn der Kunde einen Rückflusslötprozess durchführt, um die Baugruppe auf ein übergeordnetes Substrat wie etwa eine Leiterplatte zu montieren.
- Die Oberflächenbereiche des Halbleiterbauelements, die selektiv aktiviert werden, bilden eine Oberfläche, auf der die Haftkraftverstärkungsschicht zuverlässiger abgeschieden werden kann, als wenn diese Bereiche unaktiviert bleiben. Falls das Helbleiterbauelement verschiedene Materialien aufweist, zum Beispiel verschiedene Metalle, die eine unterschiedliche Affinität für des Material der Haftkraftverstärkungsschicht aufweisen, zum Beispiel, verschiedene Benetzungseigenschaften, können deshalb die Bereiche, die Materialien mit einer schlechteren Affinität für die Haftkraftverstärkungsschicht aufweisen, selektiv aktiviert werden.
- Die selektiv aktivierten Oberflächenbereiche haben eine verbesserte Affinität für das Material der Haftkraftverstärkungsschicht. Die selektiv aktivierten Oberflächenbereiche werden deshalb mit der Haftkraftverstärkungsschicht bedeckt und stehen direkt in Kontakt mit dieser. Die Haftkraftverstärkungsschicht kann dann zuverlässiger auf den selektiv aktivierten Bereichen abgeschieden werden, so dass die Gesamtbedeckung der Haftkraftverstärkungsschicht auf den Oberflächen des Halbleiterbauelements verbessert ist. Deshalb wird die Zuverlässigkeit der Halbleiterbaugruppe verbessert, da schlechte oder ungleichmäßige Bedeckung der Haftkraftverstärkungsschicht vermieden wird und deshalb eine vereinzelte Rissbildung in den unbedeckten Bereichen vermieden wird.
- Die Oberflächen, die vorher als mit der Haftkraftverstärkungsschicht schlecht beschichtet erkannt wurden, können einer Aktivierungsbehandlung ausgesetzt werden, die nur diese Bereiche aktiviert, wobei andere Bereiche des Halbleiterbauelements, die vorher als durch die Haftkraftverstärkungsschicht zuverlässig beschichtet erkannt wurden, unbehandelt und unaktiviert bleiben.
- Das Halbleiterbauelement weist innere Bereiche und äußere Bereiche auf. Die inneren Bereiche sind als jene Bereiche des Halbleiterbauelements definiert, die innerhalb eines Baugruppengehäuses positioniert und durch das Kunststoff-Vergussmaterial verkapselt und von der Haftkraftverstärkungsschicht bedeckt sind. Äußere Bereiche des Halbleiterbauelements sind als jene Bereiche des Halbleiterbauelements definiert, die außerhalb des Baugruppengehäuses positioniert und nicht durch das Kunststoff-Vergussmaterial verkapselt sind.
- Gemäß der Erfindung, werden die freiliegenden Oberflächen der Chip-Anschlusspads selektiv aktiviert. In diesem Zusammenhang bezeichnen freiliegende Oberflächen jene Oberflächen der Chip-Anschlusspads, die nicht mit der elektrischen Verbindung versehen sind, die an dem Chip-Anschlusspad angeordnet ist. Freiliegend bedeutet nicht notwendigerweise, dass diese Oberflächen der Chip-Anschlusspads unbedeckt sind.
- Die Oberfläche der Chip-Anschlusspads, die mit dem Anschlussdraht versehen sind, und die eine Schnittstelle mit der elektrischen Verbindung bildet, bleibt unaktiviert, wenn die Aktivierung der freiliegenden Oberflächen der Chip-Anschlusspads durchgeführt wird, nachdem die elektrischen Verbindungen zwischen den Chip-Anschlusspads und den inneren Kontaktbereichen des Schaltungsträgers hergestellt worden sind.
- Man hat herausgefunden, dass die Chip-Anschlusspads schlechte oder keine Bedeckung mit der Haftkraftverstärkungsschicht aufweisen. Frühere Versuche, dieses Problem zu lösen, haben sich darauf konzentriert, die Chip-Anschlusspads während der Wafer-Herstellungsphase zu behandeln, was beim Stand der Technik im allgemeinen als Front End bezeichnet wird. Jedoch haben diese Verfahren den Nachteil, dass die Analyse in der Wafer-Phase schwierig ist und die Qualität der Pad-Aktivierung oder -Konditionierung nur in einer viel späteren Phase bei der Herstellung der Baugruppe sichtbar werden, nachdem der Chip mit der Haftkraftverstärkungsschicht beschichtet worden ist. Weiterhin hat man herausgefunden, dass einige Pad-Konditionierungsbehandlungen die Gate-Bereiche der integrierten Schaltungsbauteile verschmutzen, die in der aktiven Oberfläche des Halbleiterchips vorhanden sind, was eine unakzeptable Auswirkung auf die elektrische Robustheit der Bauteile hat.
- Die Herstellung einer Halbleiterbaugruppe mit einem Halbleiterchip wird typischerweise in einer Fabrik durchgeführt, die sich von derjenigen unterscheidet, in welcher der Halbleiterchip hergestellt wird, was im Allgemeinen als Back End bezeichnet wird. Falls daher Anschlusspad-Konditionierung oder Aktivierung in der Wafer-Phase durchgeführt wird, müssen Ergebnisse von der Baugruppen-Herstellerfabrik an den Wafer-Hersteller weitergegeben werden. Folglich ist die Optimierung zeitaufwändig und Verbesserungen der Baugruppe können sich verzögern. Die Erfindung ermöglicht es, dass die Pad-Konditionierung oder -Aktivierung in der Baugruppen-Herstellerfabrik in einer Phase durchgeführt wird, kurz bevor die Haftkraftverstärkungsschicht aufgebracht wird. Dies ermöglicht eine schnellere Optimierung des Aktivierungsprozess, wenn die Ergebnisse der Haftkraftverstärkungsschicht sofort dazu verwendet werden können, die Aktivierungsbehandlung zu optimieren.
- Die Nachteile des Wafer-phasen-Konditionierens werden durch Aktivierung nur der freiliegenden Oberflächen der Chip-Ansschlusspads während des Baugruppenherstellungsprozesses vermieden. Die einstehende Baugruppe und die Verfahren der Erfindung haben den weiteren Vorteil, dass die Oberflächen der Chip-Anschlusspads nur in jenen Bereichen aktiviert werden, in denen die Anschlusspad-Aktivierung tatsächlich notwendig ist, da der Bereich der Chip-Anschlusspads, der mit der elektrischen Verbindung versehen ist, mit der Haftkraftverstärkungsschicht nicht beschichtet ist. Eine größere Vielfalt von Aktivierungsprozessen ist deshalb im Prinzip möglich, einschließlich der Bereitstellung von elektrisch nichtleitenden oder elektrisch schwach leitenden aktivierten Oberflächenbereichen.
- Die aktivierten Oberflächenbereiche besitzen eine Affinität für das Material der Haftkraftverstärkungsschicht, welches in der Baugruppe aufzunehmen ist, und sind für das Verfahren geeignet, durch welches die Haftkraftverstärkungsschicht abgeschieden wird. Falls zum Beispiel Galvanisation verwendet wird, um die Haftkraftverstärkungsschicht abzuscheiden, sollten die aktivierten Oberflächen elektrisch leitend sein.
- Die Chip-Anschlusspads Aluminium weisen auf, und die freiliegenden Oberflächen der Chip-Anschlusspads weisen hydroxylangereichertes Aluminiumoxid auf. Hydroxylangereichertes Aluminiumoxid wird durch Behandeln des Halbleiterbauelements mit kochendem Wasser oder Wasserdampf erzeugt. Dieser Prozess wird typischerweise ungefähr bei Atmosphärendruck durchgeführt. Die Schicht aus Aluminiumoxid, die auf der Oberfläche der Chip-Anschlusspads vorhanden ist, reagiert mit dem heißen Wasser oder Wasserdampf und bildet ein hydroxylangereichertes Aluminiumoxid. Hydroxylangereichertes Aluminiumoxid hat den Vorteil, dass sich die chemischen Eigenschaften des Aluminiumoxids ändern und die Umformung des im Wesentlichen hydroxylfreien Aluminiumoxids in ein hydroxylangereichertes Aluminiumoxid führt dazu, dass die Oberfläche der Chip-Anschlusspads einen geringeren elektrischen Widerstand hat. Deshalb haben diese freiliegenden Bereiche der Chip-Anschlusspads, die eine Oberflächenschicht aus hydroxylangereichertem Aluminiumoxid aufweisen, einen geringeren elektrischen Widerstand, und falls die Haftkraftverstärkungsschicht durch einen elektrochemischen Plattierungsprozess abgeschieden wird, können diese Bereiche leichter elektroplattiert werden als unbehandelte Chip-Kontaktpads, die eine äußere Oberflächenschicht aus Aluminiumoxid aufweisen.
- Gemäß der Erfindung, weisen die freiliegenden Oberflächen der Chip-Anschlusspads im Wesentlichen vollständig hydroxyliertes Aluminiumoxid auf. Der Grad der Oxidation kann dadurch gesteuert werden, indem die Zeit, welche die Chip-Anschlusspads Wasserdampf oder kochendem Wasser ausgesetzt sind, erhöht wird. Durch die Bildung von Aluminiumhydroxidbindungen verlieren die Aluminiumkationen teilweise ihren Lewis-Säure-Charakter. Die Aluminiumhydroxidbindungen erlauben Protonen- und Ladungsübertragung und vergrößern die elektrochemische Reaktivität. Die Haftkraftverstärkungsschicht kann deshalb zuverlässiger durch Elektroplattieren an den aktivierten freiliegenden Bereiche der Chip-Kontaktpads abgeschieden werden als es für nichtaktivierte freiliegende Kontaktpads zu beobachten ist, welche eine Oberflächenschicht aus nativem Aluminiumoxid enthalten.
- Weiterhin weisen die freiliegenden Oberflächen der Chip-Anschlusspads im Wesentlichen Böhmit (AlOOH) oder Gibbsit (Al(OH)3) auf.
- Gemäß der Erfindung bedeckt die Haftkraftverstärkungsschicht im Wesentlichen die gesamten Oberflächen des Halbleiterbauelements, die durch das Kunststoff-Vergussmaterial verkapselt sind. Die Haftkraftverstärkungsschicht bedeckt deshalb im Wesentlichen die gesamten Oberflächen des inneren Bereichs des Halbleiterbauelements. Die Haftkraftverstärkungsschicht bedeckt deshalb die aktivierten Oberflächen und unaktivierten Oberflächen des Halbleiterbauelements.
- Gemäß der Erfindung weist die Haftkraftverstärkungsschicht Zirkon und Chrom auf und kann auch Zirkonoxid oder Chromoxide aufweisen. Die Haftkraftverstärkungsschicht kann eine dendritische Struktur aufweisen. Eine dendritische Struktur hat den Vorteil, dass der Oberflächenbereich der Haftkraftverstärkungsschicht vergrößert ist und eine mechanische Verankerung zwischen der Haftkraftverstärkungsschicht und dem Kunststoff-Vergussmaterial gebildet wird. Dies verbessert weiterhin das Haftvermögen zwischen den eingebetteten Halbleiterbauelementen und dem Kunststoff-Vergussmaterial.
- Gemäß der Erfindung weist der Schaltungsträger einen Leadframe-Steifen auf. Bei dieser Ausführungsform bilden die Lead-Finger des Leadframe-Steifens die Umverdrahtungsstruktur des Schaltungsträgers. Der äußere Bereich jedes der Lead-Finger bildet den äußeren Kontaktbereich der Umverdrahtungsstruktur.
- Weiterhin weist der Schaltungsträger ein Umverdrahtungssubstrat auf. Das Umverdrahtungssubstrat weist eine obere Oberfläche auf, auf der des Die-Pad und innere Kontaktbereiche angeordnet sind. Die untere Oberfläche des Umverdrahtungssubstrats weist äußere Kontaktbereiche, die durch Leiterzüge elektrisch verbunden sind, und Durchkontaktierungen zu den inneren Kontaktflächen auf. Die Leiterzüge und Durchkontaktierungen bilden bei dieser Ausführungsform die Umverdrahtungsstruktur des Schaltungsträgers.
- Ausführungsformen der Erfindung werden nun unter Bezugnahme auf die Zeichnungen erläutert.
-
1 stellt die selektive Aktivierung der Chip-Anschlusspads eines Halbleiterbauelements dar, -
2 stellt das Halbleiterbauelement nach der Abscheidung einer Haftkraftverstärkungsschicht dar, -
3 zeigt rasterelektronenmikroskopische Aufnahmen, welche die Haftkraftverstärkungsschichten vergleichen, die auf nichtaktivierten und aktivierten Oberflächenbereichen abgeschieden wurden, -
4 stellt die chemische Reaktion dar, durch welche die Chip-Anschlusspads der1 aktiviert werden, -
5 stellt eine auf einem Halbleiter-Leadframe basierende verkapselte Baugruppe mit aktivierten Chip-Anschlusspads und einer Haftkraftverstärkungsschicht dar, und -
6 zeigt eine verkapselte Halbleiterbaugruppe mit einem Umverdrahtungssubstrat, aktivierten Chip-Anschlusspads und einer Haftkraftverstärkungsschicht. -
1 stellt ein Halbleiterbauelement1 dar, welches einen Leadframe2 , einen Halbleiterchip3 und eine Vielzahl von Anschlussdrähten4 aufweist.1 zeigt die Schnittansicht einer einzelnen Bauteilposition eines Leadframe-Streifens. Der Leadframe-Streifen weist eine Vielzahl von Bauteilpositionen auf, die in Reihen und Spalten angeordnet sind. Jede Bauteilposition stellt einen Leadframe2 für eine einzelne Halbleiterbaugruppe bereit. - Der Leadframe
2 weist ein Die-Pad5 und eine Vielzahl von Lead-Fingern6 auf. Das Die-Pad5 ist ungefähr im seitlichen Zentrum des Leadframes2 angeordnet und ist seitlich von einer Vielzahl von Lead-Fingern6 umgeben, die bei dieser Ausführungsform der Erfindung im Wesentlichen in der gleichen Ebene wie das Die-Pad5 liegen. Jeder Lead-Finger6 weist einen inneren Bereich7 , der durch das Kunststoff-Vergussmaterial der Baugruppe verkapselt wird, und einen äußeren Bereich8 auf, der sich außerhalb des Kunststoff-Vergussmaterials erstreckt und die äußeren Kontaktbereiche der Baugruppe bildet. Der innere Bereich7 und der äußere Bereich8 der Lead-Finger6 sind bezüglich des Kunststoff-Vergussmaterials in5 dargestellt, welche die zusammengefügte Halbleiterbaugruppe zeigt. - Ein inneres Kontaktpad
9 ist auf der oberen Oberfläche jedes Lead-Fingers6 in Richtung auf das innerste Ende des inneren Bereichs7 angeordnet. Die Vielzahl von inneren Kontaktpads9 weist ein Material auf, das für ein Draht-Bonding geeignet ist und bei dieser Ausführungsform der Erfindung Ni/NiP aufweist. - Der Leadframe
2 bildet den Schaltungsträger der Halbleiterbaugruppe. Die Lead-Finger6 bilden die Umverdrahtungsstruktur zwischen den inneren Kontaktpads9 und den äußeren Bereichen8 der Vielzahl von Lead-Fingern6 , welche die äußeren Kontaktbereiche der Halbleiterbaugruppe bilden. - Der Halbleiterchip
2 hat eine aktive Oberfläche10 , die integrierte Schaltkreise aufweist (die nicht in den Figuren dargestellt sind), und eine Vielzahl von Chip-Kontaktpads11 . Die Chip-Kontaktpads11 weisen Aluminium auf. Der Halbleiterchip3 weist auch eine rückseitige passive Fläche12 auf. Die passive Fläche12 des Halbleiterchips3 ist auf der oberen Oberfläche des Die-Pads5 durch eine Schicht aus Klebemittel13 montiert. - Eine Vielzahl von Anschlussdrähten
4 ist vorgesehen, die Gold aufweisen. Ein Anschlussdraht4 erstreckt sich zwischen jedem Chip-Kontaktpad11 und einem inneren Kontaktpad9 , der auf dem inneren Bereich7 eines jeden Lead-Fingers6 angeordnet ist. Typischerweise ist ein Chip-Anschlusspad11 durch einen Anschlussdraht4 mit einem Lead-Finger6 elektrisch verbunden, der seitlich benachbart zu dem Chip-Anschlusspad11 angeordnet ist Das Halbleiterbauelement1 besteht aus einem Leadframe2 , einem Halbleiterchip3 und der Vielzahl von Anschlussdrähten4 . - Jeder Chip-Anschlusspad
11 weist zwei Typen von Bereichen auf. Ein erster Bereich14 ist mit der Schnittstelle versehen, die zwischen dem Ende15 des Anschlussdrahts4 und der oberen Oberfläche16 jedes Kontaktpads11 gebildet ist. Der erste Bereich14 ist deshalb bedeckt und nicht freigelegt. Der zweite Bereich17 eines jeden Chip-Anschlusspads11 ist nicht mit dem Ende15 des Anschlussdrahtes4 versehen. Die obere Oberfläche16 jedes Chip-Anschlusspads11 ist deshalb im zweiten Bereich17 freigelegt. Die Vielzahl von Chip-Anschlusspads11 weist Aluminium auf, das eine native Aluminiumoxidschicht18 an der oberen Oberfläche16 in zumindest den freiliegenden Bereichen17 aufweist. - Im nächsten Verfahrensschritt wird das Halbleiterbauelement
1 für eine bestimmte Zeit in kochendes Wasser gebracht. In diesem Schritt werden die freiliegenden Bereiche17 der Chip-Anschlusspads11 selektiv aktiviert. Dies ist in1 durch die Pfeile19 angegeben. Gemäß der Erfindung wird zumindest die obere Oberfläche16 des zweiten freiliegenden Bereichs17 jedes Anschlusspads11 aktiviert, um ein verbessertes Haftvermögen zwischen der Vielzahl von Chip-Anschlusspads11 und einer Haftkraftverstärkungsschicht anzugeben, die auf den freiliegenden Bereichen17 der Vielzahl von Anschlusspads11 abzuscheiden sind. -
2 stellt den nächsten Verfahrensschritt des Verfahrens zur Herstellung einer Halbleiterbaugruppe dar. Eine Haftkraftverstärkungsschicht21 wird auf allen freien Flächen22 des Halbleiterbauelements1 abgeschieden, welche durch das Kunstsfoff-Vergussmaterial der Halbleiterbaugruppe verkapselt werden sollen. Die Haftkraftverstärkungsschicht22 weist Zirkonium und Chrom auf und wird auf den freien Flächen22 des Halbleiterbauelements durch Elektroplattierung abgeschieden. Dieser Prozess wird allgemein als ein A2 Plating-Prozess bezeichnet. A2 ist der kommerzielle Name des Elektroplattierungsbades. Die Haftkraftverstärkungsschicht22 wird unter Elektroplattierungsbedingungen abgeschieden, so dass die Schicht22 mit einer dendritischen Struktur23 wächst. Die dendritische Struktur23 bildet eine aufgeraute Oberfläche, welche den Oberflächenbereich der Schicht22 vergrößert und einen zusätzlichen mechanischen Verankerungsmechanismus zwischen der Haftkraftverstärkungsschicht22 und dem Kunststoff-Vergussmaterial der Baugruppe bildet. - Die Haftkraftverstärkungsschicht
22 wird auf dem Halbleiterbauelement1 abgeschieden, nachdem der Halbleiterchip3 auf dem Die-Pad5 montiert ist und nachdem die Anschlussdrähte4 zwischen den Chip-Kontaktpads11 und den inneren Kontaktpads9 des Leadframes2 ausgebildet sind. Dies stellt sicher, dass all die Oberflächen21 , die innerhalb des Kunststoff-Vergussmaterial verkapselt werden sollen, mit der Haftkraftverstärkungsschicht beschichtet werden. Dies verbessert das Haftvermögen zwischen dem Kunststoff-Vergussmaterial und dem Halbleiterbauelement1 und verbessert die Zuverlässigkeit der Baugruppe. - Die Haftkraftverstärkungsschicht
22 wird typischerweise auf einem Leadframe-Streifen abgeschieden, der eine Vielzahl von Bauteilpositionen aufweist, wobei jede Bauteilposition ein Halbleiterbauelement1 umfasst. - Wie man anhand der
2 erkennt, wird die Haftkraftverstärkungsschicht22 auf den inneren Bereichen7 der Lead-Finger6 , dem Die-Pad5 , den Oberflächen des Halbleiterchips3 und den Anschlussdrähten4 abgeschieden. Die freiliegenden Bereiche17 der Chip-Anschlusspads11 werden auch mit der Haftkraftverstärkungsschicht22 beschichtet. Dies steht im Gegensatz zu Halbleiterbauelementen, die nicht der Wasserbehandlung gemäß der Erfindung unterzogen worden sind. Die freiliegenden Bereiche17 sind durch die Wasserbehandlung aktiviert worden und zumindest die Oberflächen der freiliegenden Bereiche17 haben eine verbesserte Affinität für die Haftkraftverstärkungsschicht22 . - Die Verbesserung der Abscheidung der Haftkraftverstärkungsschicht
22 auf den aktivierten Oberflächen20 in den freiliegenden Bereichen17 der Aluminium-Chip-Anschlusspads11 ist durch die in3 gezeigten Vergleichsbeispiele dargestellt. -
3 zeigt eine rasterelektronenmikroskopische (SEM) Aufnahme der Haftkraftverstärkungsschichten22 , die Zirkonium und Chrom aufweisen, welche unter Verwendung eines A2 Plattierungsbades auf den Aluminium-Anschlusspads von Leistungs-MOSFET Bauteilen abgeschieden werden. -
3a zeigt eine rasterelektronenmikroskopische (SEM) Aufnahme für eine Haftkraftverstärkungsschicht22 , die auf einem Aluminium-Anschlusspad11 eines nicht-robusten Leistungs-MOSFET Bauteils abgeschieden ist. Die freiliegenden Bereiche des Aluminium-Anschlusspads11 wurden unter Anwendung einer wasserbasierten Aktivierungsbehandlung gemäß der Erfindung aktiviert. Der Chip-Anschlusspad11 wurde keiner anderen Pad-Aktivierungsbehandlung unterzogen. Wie man anhand der3a erkennen kann, wurde die Haftkraftverstärkungsschicht22 erfolgreich auf dem wasseraktivierten Chip-Anschlusspad11 abgeschieden. -
3b zeigt eine rasterelektronenmikroskopische (SEM) Aufnahme für ein robustes MOSFET-Leistungsglied, bei welchem die Aluminium-Chip-Anschlusspads11 vorher einer ungenügenden herkömmlichen Pad-Aktivierungsbehandlung unterzogen wurden.3b zeigt, dass eine Haftkraftverstärkungsschicht22 auf dem Chip-Anschlusspad11 nicht abgeschieden wurde und stellt das Problem der schlechten Abscheidung der Haftkraftverstärkungsschicht auf herkömmlichen Chip-Anschlusspads dar. -
3c zeigt eine rasterelektronenmikroskopische (SEM) Aufnahme für ein robustes MOSFET-Leistungsglied, bei welchem die Aluminium-Chip-Anschlusspads11 vorher einer ungenügenden herkömmlichen Pad-Aktivierungsbehandlung wie bei dem Leistungsglied der3b unterzogen wurden. Die Chip-Anschlusspads11 des Leistungsglieds der3c wurden dann einer wasserbasierten Aktivierungsbehandlung gemäß der Erfindung unterzogen. Wie man anhand der3c erkennen kann, wurde die Haftkraftverstärkungsschicht22 erfolgreich auf dem aktivierten Chip-Anschlusspad abgeschieden, im Gegensatz zu dem nicht-aktivierten, in3b gezeigten Chip-Kontaktpad. - Die freiliegenden Bereiche
17 der Chip-Anschlusspads11 werden gemäß einer Ausführungsform der Erfindung dadurch selektiv aktiviert, dass alle der freien Flächen des Halbleiterbauelements1 für eine vorgegeben Zeit kochendem Wasser ausgesetzt werden. Man nimmt an, dass die Aluminiumoxidschicht18 , die auf der Oberfläche16 der freiliegenden Bereiche17 des Aluminium-Chip-Anschlusspads11 angeordnet ist, mit dem heißen Wasser reagiert, wodurch sich hydroxylangereichertes Aluminiumoxid an der äußersten Oberfläche16 bildet. Die anderen freien Flächen des Halbleiterbauelements1 , die auch mit dem heißen Wasser in Kontakt sind, bleiben unbeeinflusst, da keine chemische Reaktion stattfindet. Die Reaktion zwischen dem heißen Wasser und der Aluminiumoxidschicht18 in den freiliegenden Bereichen17 der Chip-Anschlusspads11 ist in der1 durch die Pfeile19 dargestellt. - Die chemische Reaktion, von der man annimmt, dass sie stattfindet, ist in
4 dargestellt. Das Halbleiterbauelement1 wird in Kontakt mit dem heißen Wasser gehalten bis die Aluminiumoxidschicht18 durch chemische Reaktion in ein vollständig hydroxyliertes Aluminiumoxid mit einer Gibbsit-Struktur umgewandet worden ist. - Die Anwendung des wasserbasierten Verfahrens gemäß der Erfindung verändert die chemischen Eigenschaften der Aluminiumoxidschicht
18 , die an der oberen Oberfläche16 der Chip-Anschlusspads11 vorhanden ist. Die vorgefertigten Aluminium-Chip-Anschlusspads11 bestehen im Wesentlichen aus hydroxylfreiem Aluminiumoxid, das dann, wenn es kochendem Wasser ausgesetzt wird, in ein hydroxylangereichertes Aluminiumoxid AlOOH (Böhmit) and Al(OH)3 (Gibbsit) umgewandelt wird, welches einen geringeren elektrischen Widerstand als Aluminiumoxid aufweist. Deshalb können die aktivierten Oberflächenbereiche20 leichter durch die Haftkraftverstärkungsschicht plattiert werden. Die freiliegenden Bereiche17 , die das hydroxylierte Aluminiumoxid aufweisen, sind deshalb aktiviert. -
4 zeigt schematisch die zunehmende Hydroxylierung der Aluminiumoxidschicht18 . Die Aluminiumoxidbindungen sind gebrochen, das Aluminium-Kation verliert teilweise seine Lewis-Säure-Eigenschaften und Al-OH-Bindungen werden geschaffen. Dies erlaubt Protonen- und deshalb Ladungsübertragung über die Aluminium-Oxo-Hydroxid-Schicht. Folglich nimmt die elektochemische Reaktivität der oberen Oberfläche16 der Anschlusspads11 in den freiliegenden Bereichen17 zu und eine aktivierte obere Oberfläche20 wird in den freiliegenden Bereichen17 der Chip-Anschlusspads11 ausgebildet Die freiliegenden Bereiche17 der Chip-Anschlusspads11 weisen eine äußere Schicht aus hydroxylangereichertes Aluminiumoxid auf, die auf dem massiven Aluminum abgeschieden ist; aus dem der Chip-Anschlusspad11 gebildet ist. -
5 stellt das Halbleiterbauelement1 dar, das die aktivierten Chip-Anschlusspads20 und die Haftkraftverstärkungsschicht22 aufweist, wie sie in3 nach einem Spritzgießprozess zu Herstellung der Halbleiterbaugruppe24 gezeigt ist Die Oberflächen21 des Halbleiterbauelements1 , die innerhalb der Halbleiterbaugruppe24 angeordnet ist, werden mit der Haftkraftverstärkungsschicht22 mit einer dendritischen Struktur23 beschichtet. Die aktivierten Oberflächenbereiche20 der Chip-Anschlusspads11 werden mit der Haftkraftverstärkungsschicht22 beschichtet. Das Kunststoff-Vergussmaterial25 , das die Halbleiterbaugruppe24 bildet, ist deshalb in Kontakt mit der Haftkraftverstärkungsschicht22 . - Die Haftkraftverstärkungsschicht
22 verbessert zusammen mit ihrer dendritischen Struktur23 das Haftvermögen zwischen den Oberflächen21 oder dem Halbleiterbauelement1 , das innerhalb der Baugruppe24 angeordnet ist, und dem Kunststoff-Vergussmaterial25 . Dieses verbesserte Haftvermögen unterdrückt die Rissbildung zwischen dem Halbleiterbauelement1 und dem Kunststoff-Vergussmaterial25 und verhindert folglich die Ansammlung von Feuchtigkeit an den Schnittstellen, die während eines späteren Rückflusslötprozesses verdampft, wodurch Risse in der Baugruppe24 und das als Popkorn-Effekt bekannte Phänomen entstehen. -
6 stellt eine erfindungsgemäß hergestellte verkapselte Halbleiterbaugruppe26 dar. Die Halbleiterbaugruppe26 weist einen Schaltungsträger, einen Halbleiterchip und eine Vielzahl von Anschlussdrähten4 auf. - Schaltungsträger weist ein Umverdrahtungssubstrat
27 auf. Das Umverdrahtungssubstrat27 hat eine obere Oberfläche28 , die ein Die-Pad5 aufweist, das ungefähr in der seitlichen Mitte angeordnet ist, die von einer Vielzahl von inneren Kontaktpads9 umgeben ist. Die untere Oberfläche des Umverdrahtungssubstrats27 weist eine Vielzahl von äußeren Kontaktbereichen28 auf, die mit den inneren Kontaktbereichen9 , die auf der oberen Oberfläche28 des Umverdrahtungssubstrats27 angeordnet sind, durch Leiterzüge29 und Durchkontaktierungen30 elektrischen verbunden sind. - Die Halbleiterbaugruppe
26 wurde durch Bereitstellen des Umverdrahtungssubstrats und Montieren der passiven Fläche12 des Halbleiterchips3 an das Die-Pad5 hergestellt. Eine Vielzahl von Anschlussdrähten14 wurden dann hergestellt, wobei sich jeder zwischen einem Chip-Kontakt oder -Anschlusspad11 und einem inneren Kontaktpad9 erstreckt, um ein Halbleiterbauelement1 zu bilden. Die Chip-Anschlusspads11 weisen Aluminium auf. - Das Halbleiterbauelement
1 wurde dann kochendem Wasser ausgesetzt, was eine selektive Aktivierung der freiliegenden Bereiche17 der Chip-Kontaktpads11 ergab, wie im Zusammenhang mit den1 bis5 beschrieben ist. Deshalb weist die Halbleiterbaugruppe26 auch Chip-Kontaktpads11 auf, in denen die freiliegenden Bereiche17 der Chip-Kontaktpads11 , die nicht mit mit den Enden15 der Anschlussdrähte4 versehen sind, zumindest teilweise hydroxyliertes Aluminiumoxid aufweisen. Die freiliegenden Bereiche17 weisen eine äußere Schicht20 auf, die auf Aluminium abgeschieden ist, das den Chip-Anschlusspad11 aufweist und das als Ergebnis einer vorstehend beschriebenen wasserbasierten Aktivierungsbehandlung ausgebildet wurde. Die aktivierte Schicht20 , die in den freiliegenden Bereichen17 der Chip-Anschlusspads11 vorhanden ist, weist hydroxylangereichertes Aluminiumoxid auf. - Die obere Oberfläche des Umverdrahtungssubstrats
27 , der Halbleiterchip3 , die Anschlussdrähte4 und die freiliegenden Bereiche17 der Chip-Kontaktpads11 werden dann durch ein A2-Elektroplating mit der Haftkraftverstärkungsschicht22 beschichtet. Ein Spritzgießprozess wurde dann ausgeführt, um die mit der Haftkraftverstärkungsschicht22 beschichteten Oberflächen in Epoxydharz25 einzubetten, um die Halbleiterbaugruppe26 zu bilden. - Bezugszeichenliste
-
- 1
- Halbleiterbauelement
- 2
- Leadframe
- 3
- Halbleiterchip
- 4
- Anschlussdraht
- 5
- Die-Pad
- 6
- Lead-Finger
- 7
- innerer Bereich
- 8
- äußerer Bereich
- 9
- inneres Kontaktpad
- 10
- aktive Oberfläche
- 11
- Chip-Kontaktpad
- 12
- passive Fläche
- 13
- Klebemittel
- 14
- unbelichteter Bereich
- 15
- Ende des Anschlussdrahtes
- 16
- obere Oberfläche der Chip-Anschlusspads
- 17
- freiliegende Bereiche der Chip-Anschlusspads
- 18
- Aluminiumoxidschicht
- 19
- Aktivierung
- 20
- aktivierte Oberfläche
- 21
- freie Fläche
- 22
- Haftkraftverstärkungsschicht
- 23
- dendritische Struktur
- 24
- Halbleiterbaugruppe
- 25
- Kunststoff-Vergussmaterial
- 26
- zweite Halbleiterbaugruppe
- 27
- Umverdrahtungssubstrat
- 28
- obere Oberfläche des Umverdrahtungssubstrats
- 29
- äußerer Kontaktbereich
- 30
- Leiterzug
- 31
- Durchkontaktierung
Claims (12)
- Verfahren zur Herstellung einer Halbleiterbaugruppe (
24 ;26 ), aufweisend: (1) Bereitstellen eines Halbleiterbauelements (1 ) aufweisend: (a) einen Schaltungsträger (2 ;27 ), wobei der Schaltungsträger (2 ;27 ) zumindest eine Bauteilposition aufweist, wobei jede Bauteilposition ein Die-Pad (5 ), eine Vielzahl von inneren Kontaktpads (9 ), eine Vielzahl von äußeren Kontaktbereichen (8 ,29 ) und eine Umverdrahtungsstruktur, welche die Vielzahl der inneren Kontaktpads (9 ) und die Vielzahl der äußeren Kontaktbereiche (8 ;29 ) elektrisch verbindet, aufweist; (b) zumindest einen Halbleiterchip (3 ), der eine aktive Oberfläche (10 ) mit integrierten Schaltungsbauteilen und eine Vielzahl von Chip-Anschlusspads (11 ) und eine passive Fläche (12 ) aufweist, wobei die passive Fläche (12 ) des Halbleiterchips (3 ) auf dem Die-Pad (5 ) der zumindest einen Bauteilposition des Schaltungsträgers (2 ;27 ) montiert ist; und (c) eine Vielzahl von elektrischen Verbindungen (4 ), wobei die Vielzahl der elektrischen Verbindungen (4 ) sich zwischen der Vielzahl der Chip Anschlusspads (11 ) und der Vielzahl der inneren Kontaktpads (9 ) erstreckt und die Vielzahl von Chip-Anschlusspads (11 ) mit der Vielzahl der inneren Kontaktpads (9 ) des Schaltungsträgers (2 ;27 ) elektrisch verbindet; wobei die Chip-Anschlusspads (11 ) jeweils eine freiliegende Oberfläche (17 ), die nicht durch ein Ende (15 ) einer der elektrischen Verbindungen (4 ) bedeckt ist, aufweisen; (2) selektives Aktivieren ausschließlich der freiliegenden Oberflächen (17 ) der Chip-Anschlusspads (11 ) des Halbleiterbauelements (1 ) durch eine Reaktion zwischen heißem Wasser mit einer Temperatur im Bereich von 60°C bis 100°C und einer nativen Aluminiumoxidschicht auf den freiliegenden Oberflächen (17 ) der Chip-Anschlusspads (11 ); (3) Abscheiden einer Haftkraftverstärkungsschicht (22 ) zumindest an Bereichen des Halbleiterbauelements (1 ); und (4) Verkapseln zumindest der oberen Oberfläche des Die-Pads (5 ), des Halbleiterchips (3 ), der Vielzahl der elektrischen Verbindungen (4 ) und der Vielzahl der inneren Kontaktpads (9 ) in Kunststoff-Vergussmaterial (25 ). - Verfahren zur Herstellung einer Halbleiterbaugruppe (
24 ;26 ) nach Anspruch dadurch gekennzeichnet, dass die Chip-Anschlusspads (11 ) Aluminium enthalten und der Aktivierungsprozess derart ausgeführt wird, dass die freiliegenden Oberflächen (17 ) der Chip-Anschlusspads (11 ) hydroxylangereichertes Aluminiumoxid aufweisen. - Verfahren zur Herstellung einer Halbleiterbaugruppe (
24 ;26 ) nach Anspruch 2, dadurch gekennzeichnet, dass der Aktivierungsprozess derart ausgeführt wird, dass die freiliegende Oberflächen (17 ) der Chip-Anschlusspads (11 ) vollständig hydroxyliertes Aluminiumoxid aufweist. - Verfahren zur Herstellung einer Halbleiterbaugruppe (
24 ;26 ) nach einem der vorhergehenden Ansprüche dadurch gekennzeichnet, dass der Aktivierungsprozess derart ausgeführt wird, dass die freiliegenden Oberflächen (17 ) der Chip-Anschlusspads (11 ) aus Böhmit oder Gibbsit bestehen. - Verfahren zur Herstellung einer Halbleiterbaugruppe (
24 ;26 ) nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, dass die Haftkraftverstärkungsschicht (22 ) die gesamten Oberflächen (21 ) des Halbleiterbauelements (1 ) bedeckt, die durch das Kunststoff-Vergussmaterial verkapselt werden sollen. - Verfahren zur Herstellung einer Halbleiterbaugruppe (
24 ;26 ) nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, dass die Haftkraftverstärkungsschicht (22 ) durch ein elektrolytisches Abscheidungsverfahren abgeschieden wird. - Verfahren zur Herstellung einer Halbleiterbaugruppe (
24 ;26 ) nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, dass die Haftkraftverstärkungsschicht (22 ) Zr und Cr aufweist. - Verfahren zur Herstellung einer Halbleiterbaugruppe (
24 ;26 ) nach einem der vorhergehenden Ansprüche dadurch gekennzeichnet, dass die Haftkraftverstärkungsschicht (22 ) unter Abscheidungsbedingungen abgeschieden wird, wodurch eine dendritische Struktur (23 ) hergestellt wird. - Verfahren zur Herstellung einer Halbleiterbaugruppe (
24 ;26 ) nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, dass die Verkapselung zumindest der oberen Oberfläche des Die-Pads (5 ), des Halbleiterchips (3 ), der Vielzahl der elektrischen Verbindungen (4 ) und der Vielzahl der inneren Kontaktpads (9 ) durch eine Spritzgießverfahren durchgeführt wird. - Verfahren zur Herstellung einer Halbleiterbaugruppe (
24 ;26 ) nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, dass der Schaltungsträger (2 ) in der Form eines Leadframe-Streifens bereitgestellt wird. - Verfahren zur Herstellung einer Halbleiterbaugruppe (
24 ;26 ) nach einem der Ansprüche 1 bis 15, dadurch gekennzeichnet, dass der Schaltungsträger (27 ) in der Form eines Umverdrahtungssubstrats bereitgestellt wird. - Verfahren zur Herstellung einer Halbleiterbaugruppe (
24 ;26 ) nach einem der vorhergehenden Ansprüche, dadurch gekennzeichnet, dass die elektrische Verbindungen (4 ) durch eine Vielzahl von Drahtverbindungen gebildet werden.
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Families Citing this family (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010251483A (ja) * | 2009-04-14 | 2010-11-04 | Renesas Electronics Corp | 半導体装置およびその製造方法 |
US9201123B2 (en) | 2011-11-04 | 2015-12-01 | Infineon Technologies Ag | Magnetic sensor device and a method for fabricating the same |
US9121880B2 (en) * | 2011-11-04 | 2015-09-01 | Infineon Technologies Ag | Magnetic sensor device |
US10727085B2 (en) * | 2015-12-30 | 2020-07-28 | Texas Instruments Incorporated | Printed adhesion deposition to mitigate integrated circuit package delamination |
DE102016103585B4 (de) * | 2016-02-29 | 2022-01-13 | Infineon Technologies Ag | Verfahren zum Herstellen eines Package mit lötbarem elektrischen Kontakt |
DE102016106137B4 (de) * | 2016-04-04 | 2023-12-28 | Infineon Technologies Ag | Elektronikvorrichtungsgehäuse umfassend eine dielektrische Schicht und ein Kapselungsmaterial |
DE102018118544B4 (de) * | 2018-07-31 | 2024-01-18 | Infineon Technologies Ag | Haftungsverbessernde Strukturen für ein Package |
DE102019117534B4 (de) * | 2019-06-28 | 2022-03-03 | Infineon Technologies Ag | Anorganisches Verkapselungsmittel für eine elektronische Komponente mit Haftvermittler |
DE102020114527B4 (de) | 2020-05-29 | 2023-11-30 | Infineon Technologies Ag | Chipgehäuse und verfahren zum bilden eines chipgehäuses |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3986897A (en) * | 1974-09-30 | 1976-10-19 | Motorola, Inc. | Aluminum treatment to prevent hillocking |
US4517734A (en) * | 1982-05-12 | 1985-05-21 | Eastman Kodak Company | Method of passivating aluminum interconnects of non-hermetically sealed integrated circuit semiconductor devices |
WO2000074131A1 (en) * | 1999-05-31 | 2000-12-07 | Infineon Technologies A.G. | A method of assembling a semiconductor device package |
DE10148120A1 (de) * | 2001-09-28 | 2003-04-17 | Infineon Technologies Ag | Elektronische Bauteile mit Halbleiterchips und ein Systemträger mit Bauteilpositionen sowie Verfahren zur Herstellung derselben |
Family Cites Families (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5250363A (en) * | 1989-10-13 | 1993-10-05 | Olin Corporation | Chromium-zinc anti-tarnish coating for copper foil having a dark color |
US5343073A (en) * | 1992-01-17 | 1994-08-30 | Olin Corporation | Lead frames having a chromium and zinc alloy coating |
US5543586A (en) * | 1994-03-11 | 1996-08-06 | The Panda Project | Apparatus having inner layers supporting surface-mount components |
JPH09286971A (ja) * | 1996-04-19 | 1997-11-04 | Toray Dow Corning Silicone Co Ltd | シリコーン系ダイボンディング剤、半導体装置の製造方法および半導体装置 |
US6046507A (en) * | 1997-12-08 | 2000-04-04 | Advanced Micro Devices | Electrophoretic coating methodology to improve internal package delamination and wire bond reliability |
US6368899B1 (en) * | 2000-03-08 | 2002-04-09 | Maxwell Electronic Components Group, Inc. | Electronic device packaging |
JP2002299538A (ja) * | 2001-03-30 | 2002-10-11 | Dainippon Printing Co Ltd | リードフレーム及びそれを用いた半導体パッケージ |
DE10124047B4 (de) * | 2001-05-16 | 2006-12-14 | Infineon Technologies Ag | Verfahren zur Herstellung elektronischer Bauteile mit Halbleiterchips und Systemträger |
US6777788B1 (en) * | 2002-09-10 | 2004-08-17 | National Semiconductor Corporation | Method and structure for applying thick solder layer onto die attach pad |
JP3841768B2 (ja) * | 2003-05-22 | 2006-11-01 | 新光電気工業株式会社 | パッケージ部品及び半導体パッケージ |
DE10330192B4 (de) * | 2003-07-03 | 2008-11-13 | Infineon Technologies Ag | Verfahren zum Abscheiden einer porösen Haftvermittlungsschicht auf einer Oberfläche eines elektrisch leitenden Körpers sowie Verwendung des Verfahrens |
US7049683B1 (en) * | 2003-07-19 | 2006-05-23 | Ns Electronics Bangkok (1993) Ltd. | Semiconductor package including organo-metallic coating formed on surface of leadframe roughened using chemical etchant to prevent separation between leadframe and molding compound |
DE102004047510A1 (de) * | 2004-09-28 | 2006-04-13 | Infineon Technologies Ag | Halbleiterbauteil mit in Kunststoffgehäusemasse eingebetteten Halbleiterbauteilkomponenten |
-
2006
- 2006-05-10 DE DE112006003861.3T patent/DE112006003861B4/de not_active Expired - Fee Related
- 2006-05-10 WO PCT/IB2006/001218 patent/WO2007129132A1/en active Application Filing
-
2008
- 2008-10-07 US US12/247,031 patent/US8410586B2/en active Active
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3986897A (en) * | 1974-09-30 | 1976-10-19 | Motorola, Inc. | Aluminum treatment to prevent hillocking |
US4517734A (en) * | 1982-05-12 | 1985-05-21 | Eastman Kodak Company | Method of passivating aluminum interconnects of non-hermetically sealed integrated circuit semiconductor devices |
WO2000074131A1 (en) * | 1999-05-31 | 2000-12-07 | Infineon Technologies A.G. | A method of assembling a semiconductor device package |
DE10148120A1 (de) * | 2001-09-28 | 2003-04-17 | Infineon Technologies Ag | Elektronische Bauteile mit Halbleiterchips und ein Systemträger mit Bauteilpositionen sowie Verfahren zur Herstellung derselben |
Also Published As
Publication number | Publication date |
---|---|
US8410586B2 (en) | 2013-04-02 |
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Legal Events
Date | Code | Title | Description |
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OP8 | Request for examination as to paragraph 44 patent law | ||
8181 | Inventor (new situation) |
Inventor name: WONG, FEE HOON, MELAKA, MY Inventor name: SCHILZ, CHRISTOF MATTHIAS, DR., BATANG TIGA, T, MY Inventor name: JORDAN, STEFFEN, DR., 93161 SINZING, DE Inventor name: RIEDL, EDMUND, 93083 OBERTRAUBLING, DE |
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R016 | Response to examination communication | ||
R016 | Response to examination communication | ||
R002 | Refusal decision in examination/registration proceedings | ||
R006 | Appeal filed | ||
R008 | Case pending at federal patent court | ||
R019 | Grant decision by federal patent court | ||
R082 | Change of representative |
Representative=s name: WESTPHAL, MUSSGNUG & PARTNER PATENTANWAELTE MI, DE |
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R020 | Patent grant now final | ||
R082 | Change of representative | ||
R082 | Change of representative | ||
R119 | Application deemed withdrawn, or ip right lapsed, due to non-payment of renewal fee |