DE102019118421B4 - Leistungselektronische Schalteinrichtung mit einem Verbindungsmittel und mit einem Leistungshalbleiterbauelement - Google Patents
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Abstract
Leistungselektronische Schalteinrichtung (1) mit einem Substrat (2), das einen Isolierstoffkörper (20) mit einer zugeordneten Dicke (820) und hierauf angeordnet ein erste und eine zweite Leiterbahn (22,24) mit einer zugeordneten Dicke (822) aufweist, mit einem mit der ersten Leiterbahn (22) elektrisch leitend verbundenen Leistungshalbleiterbauelement (5) und mit einer dieses Leistungshalbleiterbauelement (5) mit einer zweiten Leiterbahn (24) des Substrats (2) verbindendenden Verbindungseinrichtung (3), die zwischen dem Leistungshalbleiterbauelement und der zweiten Leiterbahn (24) in einem Abschnitt einen bogenförmigen Verlauf (36) aufweist, wobei die erste Leiterbahn (22) eine Vertiefung (28) mit einer zugeordneten Tiefe (828) aufweist, wobei die Leiterbahn (22) im Bereich der Vertiefung (28) eine um die Tiefe (828) reduzierte Dicke aufweist und in dieser Vertiefung (28) das Leistungshalbleiterbauelement (5) angeordnet ist.
Description
- Die Erfindung beschreibt eine leistungselektronische Schalteinrichtung mit einem Substrat, das einen Isolierstoffkörper und hierauf angeordnet eine erste und eine zweite Leiterbahn aufweist, mit einem mit der ersten Leiterbahn elektrisch leitend verbundenen Leistungshalbleiterbauelement und mit einer dieses Leistungshalbleiterbauelement mit einer zweiten Leiterbahn des Substrats verbindendenden Verbindungseinrichtung.
- Die
DE 10 2007 006 706 A1 offenbart als Stand der Technik eine Schaltungsanordnung mit einem Substrat, auf einer Hauptfläche dieses Substrats angeordneten Leiterbahnen, mindestens einem mit seiner ersten Hauptfläche auf einer ersten Leiterbahn angeordnetem Halbleiterbauelement und eine elektrisch leitfähige Verbindungseinrichtung zu mindestens einer Kontaktfläche der zweiten Hauptfläche des Halbleiterbauelements. Hierbei ist die Verbindung des Halbleiterbauelements mit der ersten Leiterbahn und / oder der Verbindungseinrichtung als Drucksinterverbindung ausgebildet und zwischen der Verbindungseinrichtung und einem zugeordneten Rand des Halbleiterbauelements ein Isolierstoff angeordnet. - Aus der
US 2019/0139882A1 - Aus der
DE 10 2018 110 132 B3 ist ein Drucksinterverfahren mit folgenden aufeinanderfolgenden Verfahrensschritten bekannt: a) Bereitstellen einer Sinterkomponentenanordnung mit einem Vertiefungen aufweisenden Werkstückträger, mit einem auf einer Hauptfläche des Werkstückträgers aufliegenden Substrat auf dem Leistungshalbleiterbauelemente angeordnet sind, wobei zwischen den Leistungshalbleiterbauelementen und dem Substrat ein zu versintender Sinterstoff angeordnet ist, wobei ein erstes Leistungshalbleiterbauelement und ein erster Bereich des Substrats über dem Werkstückträger in Normalenrichtung der ersten Hauptseite der Isolationsschicht fluchtend zu einer ersten Vertiefung des Werkstückträgers angeordnet sind, und ein zweites Leistungshalbleiterbauelement und ein zweiter Bereich des Substrats über dem Werkstückträger in Normalenrichtung der ersten Hauptseite der Isolationsschicht fluchtend zu einer zweiten Vertiefung des Werkstückträgers angeordnet sind; b) Druckbeaufschlagung der Leistungshalbleiterbauelemente und Temperaturbeaufschlagung des Sinterstoffs, wobei ein Teil des ersten Bereichs des Substrats in die erste Vertiefung und ein Teil des zweiten Bereichs des Substrats in die zweite Vertiefung hineingedrückt werden und der Sinterstoff in ein Sintermetall überführt wird. - Aus der
DE 10 2015 120 156 A1 ist eine Vorrichtung bekannt, die ausgebildet ist mit einem ein elastisches Kissenelement aufweisenden Pressstempel zur materialschlüssigen Drucksinterverbindung, eines ersten mit einem zweiten Verbindungspartner eines Leistungselektronik-Bauteils, wobei das elastische Kissenelement des Pressstempels von einem formstabilen Rahmen umgeben ist, innerhalb welchem das Kissenelement und ein Führungsteil des Pressstempels derart linear beweglich geführt werden, dass sich der formstabile Rahmen auf den ersten Verbindungspartner oder einen Werkstückträger mit darin angeordnetem ersten Verbindungspartner, absenkt und nach Anliegen an diesem der Presstempel samt elastischem Kissenelement auf den zweiten Verbindungspartner abgesenkt wird und das elastische Kissen ein notwendiger Druck ausgeübt wird um den ersten mit dem zweiten Verbindungspartner zu verbinden. - In Kenntnis des genannten Standes der Technik, liegt der Erfindung die Aufgabe zugrunde, eine leistungselektronische Schalteinrichtung vorzustellen, bei der die Anordnung der Verbindungseinrichtung verbessert wird.
- Diese Aufgabe wird erfindungsgemäß gelöst durch eine leistungselektronische Schalteinrichtung mit einem Substrat, das einen Isolierstoffkörper mit einer zugeordneten Dicke und hierauf angeordnet eine erste und eine zweite Leiterbahn mit einer zugeordneten Dicke aufweist, mit einem mit der ersten Leiterbahn elektrisch leitend verbundenen Leistungshalbleiterbauelement und mit einer dieses Leistungshalbleiterbauelement mit einer zweiten Leiterbahn des Substrats verbindendenden Verbindungseinrichtung, die zwischen dem Leistungshalbleiterbauelement und der zweiten Leiterbahn in einem Abschnitt einen bogenförmigen Verlauf aufweist, wobei die erste Leiterbahn eine Vertiefung mit einer zugeordneten Tiefe aufweist, wobei die Leiterbahn im Bereich der Vertiefung eine um die Tiefe reduzierte Dicke aufweist und in dieser Vertiefung das Leistungshalbleiterbauelement angeordnet ist.
- Unter einer Vertiefung soll hier und im Folgenden verstanden werden, dass durch diese Vertiefung die Dicke der ersten Leiterbahn, insbesondere der die Vertiefung umgebenden Bereiche der ersten Leiterbahn, im Bereich der Vertiefung selbst, um eine definierte Tiefe reduziert ist.
- Es kann vorteilhaft sein, wenn die Verbindungseinrichtung als eine Bond-, insbesondere Drahtbondverbindung ausgebildet ist. Eine vorteilhafte Alternative hierzu ist die Ausbildung als ein Folienverbund, insbesondere mit einer dem Substrat und dem Leistungshalbleiterbauelement zugewandten, ersten elektrisch leitfähigen Folie, einer im Folienverbund folgenden elektrisch isolierenden Folie und einer im Folienverbund weiter folgenden zweiten elektrisch leitfähigen Folie. Hierbei ist es bevorzugt, wenn die jeweilige Dicke der elektrisch leitfähigen Folie des Folienverbunds zwischen 10 µm und 500 µm, vorzugsweise zwischen 50 µm und 250 µm, beträgt und die Dicke der elektrisch isolierenden Folie des Folienverbunds zwischen 2 µm und 200 µm, vorzugsweise zwischen 10 µm und 100 µm, beträgt.
- Es kann auch bevorzugt sein, wenn die elektrisch leitende Verbindung zwischen der Verbindungseinrichtung und der zweiten Leiterbahn sowie die elektrisch leitende Verbindung zwischen der Verbindungseinrichtung und dem Leistungshalbleiterbauelement jeweils unabhängig voneinander als kraft- oder stoffschlüssige Verbindung insbesondere als Lotverbindung oder als Schweißverbindung, insbesondere als Laserschweißverbindung, oder als Sinterverbindung oder als Klebeverbindung ausgebildet ist.
- Bei einer ersten vorteilhaften Ausgestaltung ist die Tiefe der Vertiefung derartig bemessen, dass sie mindestens die halbe Dicke des Leistungshalbleiterbauelements samt auf dessen Hauptflächen angeordneten Verbindungsmitteln, soweit vorhanden, beträgt.
- Bei einer zweiten vorteilhaften Ausgestaltung ist die Tiefe der Vertiefung derartig bemessen, dass das Niveau der Oberfläche des Leistungshalbleiterbauelements mit auf dessen Hauptflächen angeordneten Verbindungsmitteln, soweit vorhanden, gleich ist dem Niveau der Oberfläche der ersten Leiterbahnen des Substrats.
- Bei einer dritten vorteilhaften Ausgestaltung ist die Tiefe der Vertiefung derartig bemessen, dass das Niveau der Oberfläche des Leistungshalbleiterbauelements mit auf dessen Hauptflächen angeordneten Verbindungsmitteln, soweit vorhanden, gleich ist dem Niveau der Oberfläche der zweiten Leiterbahnen des Substrats mit dort angeordnetem Verbindungsmittel.
- Es kann bevorzugt sein, wenn die Höhe des bogenförmigen Verlaufs der Verbindungseinrichtung minimal 10%, bevorzugt minimal 25% und insbesondere bevorzugt minimal 40% der Dicke der Verbindungseinrichtung beträgt.
- Hierbei ist es dann ebenfalls bevorzugt, wenn die Höhe des bogenförmigen Verlaufs der Verbindungseinrichtung maximal 200%, bevorzugt maximal 100% und insbesondere bevorzugt maximal 60% der Dicke der Verbindungseinrichtung beträgt.
- Für Leistungshalbleiterbauelemente, insbesondere Leistungstransistoren und Leistungsdioden, gelten abhängig von deren Spannungsklasse folgende bevorzugte Wertebereiche der Höhe des bogenförmigen Verlaufs:
- • Spannungsklasse 600V bis 750V: 10% bis 60% der Dicke der Verbindungseinrichtung;
- • Spannungsklasse 1200V: 25% bis 100% der Dicke der Verbindungseinrichtung;
- • Spannungsklasse 1700V: 40% bis 150% der Dicke der Verbindungseinrichtung;
- • Spannungsklasse über 1700V: mindestens 40% der Dicke der Verbindungseinrichtung.
- Selbstverständlich können, sofern dies nicht per se oder explizit ausgeschlossen ist, die im Singular genannten Merkmale, insbesondere das Leistungshalbleiterbauelement wie auch die jeweiligen Leiterbahnen, auch mehrfach in der erfindungsgemäßen leistungselektronischen Schalteinrichtung vorhanden sein.
- Es versteht sich, dass die verschiedenen Ausgestaltungen der Erfindung einzeln oder in beliebigen Kombinationen realisiert sein können, um Verbesserungen zu erreichen. Insbesondere sind die vorstehend und im Folgenden genannten und erläuterten Merkmale nicht nur in den angegebenen Kombinationen, sondern auch in anderen Kombinationen oder in Alleinstellung einsetzbar, ohne den Rahmen der vorliegenden Erfindung zu verlassen.
- Weitere Erläuterungen der Erfindung, vorteilhafte Einzelheiten und Merkmale, ergeben sich aus der nachfolgenden Beschreibung der in den
1 bis4 schematisch dargestellten Ausführungsbeispiele der Erfindung, oder von jeweiligen Teilen hiervon. -
1 zeigt eine leistungselektronische Schalteinrichtung in seitlicher Ansicht gemäß dem Stand der Technik. -
2 zeigt eine erste Ausgestaltung einer erfindungsgemäßen leistungselektronischen Schalteinrichtung in seitlicher Ansicht. -
3 zeigt diese erste Ausgestaltung in Draufsicht. -
4 zeigt eine zweite Ausgestaltung einer erfindungsgemäßen leistungselektronischen Schalteinrichtung in seitlicher Ansicht. - Im Weiteren werden folgende in den Figuren verwendete Größen verwendet, die jeweils in Normalenrichtung N des Substrats
2 bestimmt sind: - • 800 - der Abstand zwischen der Oberfläche
950 des Leistungshalbleiterbauelements5 samt darauf befindlichem Verbindungsmittel50 ,52 ,54 zur Oberfläche220 der ersten Leiterbahn22 ; - • 802 - der Abstand zwischen der Oberfläche
950 des Leistungshalbleiterbauelements5 samt darauf befindlichem Verbindungsmittel52 ,54 zur Oberfläche der zweiten Leiterbahn24 mit hierauf befindlichem Verbindungsmittel240 ; - • 820 - die Dicke des Isolierstoffkörpers
20 des Substrats2 ; - • 822 - die Dicke der ersten Leiterbahn
22 des Substrats2 ; - • 824 - die Dicke der ersten Leiterbahn
24 des Substrats2 ; - • 828 - die Tiefe der Vertiefung
28 der ersten Leiterbahn22 in der das Leistungshalbleiterbauelement5 angeordnet ist; - • 830 - die Dicke der Verbindungseinrichtung
3 ; - • 832 - die Höhe des bogenförmigen Verlaufs
36 der Verbindungseinrichtung3 ; wobei hier, bei Vorliegen eines Folienverbunds als Verbindungseinrichtung3 , auf den Höhenunterschied innerhalb einer der Folien abgestellt wird; - • 850 - die Dicke des Leistungshalbleiterbauelements
5 samt Verbindungsmittel50 ,52 ,54 auf beiden Hauptflächen; - • 852 - die Dicke des Leistungshalbleiterbauelements
5 ohne Verbindungsmittel; - • 854 - die Dicke des Verbindungsmittels
50 auf der ersten Hauptfläche des Leistungshalbleiterbauelements5 ; - • 856 - die Dicke des Verbindungsmittels
52 ,54 auf der zweiten Hauptfläche des Leistungshalbleiterbauelements5 ; - • 922 - das Niveau der Oberfläche
220 der ersten Leiterbahnen22 des Substrats2 ; - • 924 - das Niveau der Oberfläche der zweiten Leiterbahnen
24 des Substrats2 mit dort angeordnetem Verbindungsmittel240 ; - • 950 - das Niveau der Oberfläche des Leistungshalbleiterbauelements
5 samt dort angeordnetem Verbindungsmittel52 ,54 ; -
1 zeigt eine leistungselektronische Schalteinrichtung, wie auch die für das Verständnis der Erfindung relevanten Größen, vgl. oben, in seitlicher Ansicht gemäß dem Stand der Technik. Diese leistungselektronische Schalteinrichtung1 ist ausgebildet mit einem Substrat2 , das einen Isolierstoffkörper20 , hier einen Keramikkörper wie beispielhaft Aluminiumoxid, Aluminiumnitrid oder Siliziumnitrid, und hierauf angeordnet eine erste und eine zweite Leiterbahn22 ,24 , ausgebildet bevorzugt aus Kupfer oder Aluminium, aufweist. Auf der Oberfläche220 der ersten Leiterbahn22 angeordnet und mit ihr elektrisch leitend verbundenen ist ein Leistungshalbleiterbauelement5 , hier ausgebildet als ein Leistungstransistor. Die Verbindung des Leistungshalbleiterbauelements5 mit der Oberfläche220 der ersten Leiterbahn22 erfolgt hier stoffschlüssig mittels eines zwischen der Oberfläche220 der ersten Leiterbahn22 und der zugewandten Hauptfläche des Leistungshalbleiterbauelements5 angeordneten Verbindungsmittels50 , hier ohne Beschränkung der Allgemeinheit ausgebildet als ein Sinterverbindungsmittel, wie es im Rahmen der Herstellung einer Drucksinterverbindung aus einer Sinterpaste ausgebildet wird. - Dieses Leistungshalbleiterbauelement
5 ist mit einer zweiten Leiterbahn24 des Substrats2 mittels einer Verbindungseinrichtung3 elektrisch leitend verbunden. Diese Verbindungseinrichtung3 weist zwischen dem Leistungshalbleiterbauelement5 und der zweiten Leiterbahn24 in einem Abschnitt einen bogenförmigen Verlauf36 auf. In dem Volumenbereich732 , der sich unterhalb dieses bogenförmigen Verlaufs36 ausbildet ist, ein gelartiger Isolierstoff4 angeordnet. - Die Verbindungseinrichtung
3 selbst ist hier als ein Folienverbund mit einer dem Substrat2 und damit auch dem Leistungshalbleiterbauelement10 zugewandten, ersten elektrisch leitfähigen, Folie30 , einer im Folienverbund, und damit im Wesentlichen in Normalenrichtung N des Substrats, folgenden elektrisch isolierenden Folie32 und einer im Folienverbund weiter folgenden zweiten elektrisch leitfähigen Folie34 , ausgebildet. Insbesondere die elektrisch leitfähigen Folien30 ,34 können in sich strukturiert sein und somit Folienleiterbahnen ausbilden. Dargestellt ist dies am Beispiel der ersten elektrisch leitfähigen Folie30 . Weiterhin kann der Folienverbund Durchkontaktierungen320 zwischen der ersten und zweiten elektrisch leitfähigen Folie30 ,34 durch die elektrisch isolierende Folie32 hindurch aufweisen, wie dies oberhalb des Leistungshalbleiterbauelements5 dargestellt ist. - Hier beträgt die Dicke der ersten und zweiten elektrisch leitfähigen Folie
30 ,34 des Folienverbunds 250 µm und die Dicke der elektrisch isolierenden Folie32 des Folienverbunds 80 µm. - Die elektrisch leitenden Verbindungen zwischen der Verbindungseinrichtung
3 , hier zwei voneinander elektrisch isolierte Folienleiterbahnen der ersten elektrisch leitfähigen Folie30 des Folienverbunds und dem Leistungshalbleiterbauelement5 , hier seiner zweiten dem Substrat2 abgewandten Hauptfläche, sind jeweils als stoffschlüssige Verbindung, hier wiederum eine Sinterverbindung mit einem zugeordneten Verbindungsmittel52 ,54 , hier einem Sinterverbindungsmittel, ausgebildet. - Die elektrisch leitende Verbindung zwischen der Verbindungseinrichtung
3 und der zweiten Leiterbahn24 ist hier ebenfalls als stoffschlüssige Verbindung, allerdings als Laserschweißverbindung ausgebildet. Daher ist hier zwischen dem Folienverbund, genauer seiner ersten elektrisch leitfähigen Folie30 und der zweiten Leiterbahn24 des Substrats2 kein Verbindungsmittel angeordnet. -
2 zeigt eine erste Ausgestaltung einer erfindungsgemäßen leistungselektronischen Schalteinrichtung, wie auch die für das Verständnis der Erfindung relevanten Größen, in seitlicher Ansicht. Die Ausgestaltung des Verbindungsmittels3 als Folienverbund, wie auch das Leistungshalbleiterbauelement5 und die Verbindungen zwischen dem Folienverbund3 und dem Leistungshalbleiterbauelement5 wie auch der zweiten Leiterbahn24 sind grundsätzlich identisch denjenigen wie unter1 beschrieben. - Die erfindungsgemäße Ausgestaltung unterscheidet sich vom Stand der Technik gemäß
1 dadurch, dass hier die erste Leiterbahn22 eine Vertiefung28 aufweist und in dieser Vertiefung28 das Leistungshalbleiterbauelement5 angeordnet ist. - In dieser ersten Ausgestaltung ist die Tiefe
828 der Vertiefung28 derartig bemessen, dass das Niveau950 der Oberfläche des Leistungshalbleiterbauelements5 samt auf dessen beiden Hauptflächen angeordneten Verbindungsmitteln50 ,52 ,54 gleich ist dem Niveau922 der Oberfläche der ersten Leiterbahnen22 des Substrats2 . Unter einem gleichen Niveau sollen auch, insbesondere fertigungsbedingte, Abweichungen des jeweiligen Wertes von bis zu 10% verstanden werden. - Typische Größen dieser ersten Ausgestaltung der leistungselektronischen Schaltung sind hier:
- • die Dicke
820 des Isolierstoffkörpers20 des Substrats2 : 250µm; - • die Dicke 822,824 der ersten und zweiten Leiterbahn
22 ,24 des Substrats2 : 300µm; - • die Tiefe
828 der Vertiefung28 der ersten Leiterbahn22 in der das Leistungshalbleiterbauelement5 angeordnet ist: 100µm; - • die Dicke
830 der Verbindungseinrichtung3 : 580µm; - • die Höhe des bogenförmigen Verlaufs
36 der Verbindungseinrichtung: 460µm; - • die Dicke des Leistungshalbleiterbauelements
5 samt Verbindungsmitteln50 ,52 ,54 auf beiden Hauptflächen: 100µm ; - • die Dicke
852 des Leistungshalbleiterbauelements5 ohne Verbindungsmittel: 80µm; - • die Dicke
854 des Verbindungsmittels50 auf der ersten Hauptfläche des Leistungshalbleiterbauelements5 : 20µm; - • die Dicke
856 des Verbindungsmittels52 ,54 auf der zweiten Hauptfläche des Leistungshalbleiterbauelements5 : 20µm; - Die Höhe
832 des bogenförmigen Verlaufs36 der Verbindungseinrichtung3 beträgt hier ca. 80% der Dicke der Verbindungseinrichtung830 . Diese ist somit für Leistungshalbleiterbauelemente5 einer Spannungsklasse von 1200V geeignet. - Durch die genannte Ausgestaltung werden die Vorteile eines Aufbaus der leistungselektronischen Schalteinrichtung gemäß dem unter
1 genannten Stand der Technik mit Substraten in DCB-, AMB- oder verwandten Technologien mit denjenigen der Verwendung von klassischen Leiterplatten - PCBs mit in ihrem Schichtaufbau angeordneten Leistungshalbleiterbauelement verbunden. Der Vorteil des klassischen leistungselektronischen Substrats mit seiner hohen Stromtragfähigkeit wird nicht gemindert, da unterhalb der Vertiefung noch eine Dicke der ersten Leiterbahn von 200µm erhalten bleibt, die zur notwendigen Stromtragfähigkeit absolut ausreichend ist. Diese Stromtragfähigkeit wird durch fachübliche klassische Leiterplatten nicht oder nur mit erheblichem Aufwand erreicht. Zudem erlauben derartige Aufbauten mit klassischen Leiterplatten nicht die Ausbildung eines bogenförmigen Verlaufs einer Verbindungseinrichtung oder eines Äquivalents hierzu. -
3 zeigt diese erste Ausgestaltung der erfindungsgemäßen leistungselektronischen Schalteinrichtung in Draufsicht. Dargestellt ist wiederum der Isolierstoffkörper20 mit einer ersten und zweiten Leiterbahn22 ,24 . In jeweils einer Vertiefung28 der ersten Leiterbahn22 ist ein Leistungshalbleiterbauelement5 angeordnet. Es kann auch vorteilhaft sein in einer Vertiefung eine Mehrzahl von Leistungshalbleiterbauelementen anzuordnen. Das Leistungshalbleiterbauelement5 weist auf seiner dem Substrat2 abgewandten Hauptseite zwei Verbindungsmittel52 ,54 auf. Ein erstes Verbindungsmittel52 ist hier auf der Steueranschlussfläche des Leistungshalbleiterbauelements5 angeordnet, während ein zweites Verbindungsmittel54 auf der Lastanschlussfläche des Leistungshalbleiterbauelements5 angeordnet ist. -
4 zeigt eine zweite Ausgestaltung einer erfindungsgemäßen leistungselektronischen Schalteinrichtung1 in seitlicher Ansicht. Diese zweite Ausgestaltung unterscheidet sich von der ersten einerseits dahingehend, dass hier die Verbindung zwischen der als Folienverbund vorliegenden Verbindungseinrichtung3 zur zweiten Leiterbahn24 mittels einer stoffschlüssigen Verbindung mit einem Verbindungsmittel240 ausgebildet ist. Ohne Beschränkung der Allgemeinheit ist dieses wiederum ein Sinterverbindungsmittel. - Andererseits ist hier die Tiefe
828 der Vertiefung28 derartig bemessen, dass das Niveau950 der Oberfläche des Leistungshalbleiterbauelements5 mit auf dessen Hauptflächen angeordneten Verbindungsmitteln50 ,52 ,54 gleich ist dem Niveau924 der Oberfläche der zweiten Leiterbahnen24 des Substrats2 samt dort angeordnetem Verbindungsmittel240 .
Claims (10)
- Leistungselektronische Schalteinrichtung (1) mit einem Substrat (2), das einen Isolierstoffkörper (20) mit einer zugeordneten Dicke (820) und hierauf angeordnet ein erste und eine zweite Leiterbahn (22,24) mit einer zugeordneten Dicke (822) aufweist, mit einem mit der ersten Leiterbahn (22) elektrisch leitend verbundenen Leistungshalbleiterbauelement (5) und mit einer dieses Leistungshalbleiterbauelement (5) mit einer zweiten Leiterbahn (24) des Substrats (2) verbindendenden Verbindungseinrichtung (3), die zwischen dem Leistungshalbleiterbauelement und der zweiten Leiterbahn (24) in einem Abschnitt einen bogenförmigen Verlauf (36) aufweist, wobei die erste Leiterbahn (22) eine Vertiefung (28) mit einer zugeordneten Tiefe (828) aufweist, wobei die Leiterbahn (22) im Bereich der Vertiefung (28) eine um die Tiefe (828) reduzierte Dicke aufweist und in dieser Vertiefung (28) das Leistungshalbleiterbauelement (5) angeordnet ist.
- Schalteinrichtung nach
Anspruch 1 , wobei die Verbindungseinrichtung (3) als eine Bond-, insbesondere Drahtbondverbindung, oder als ein Folienverbund, insbesondere mit einer dem Substrat (2) und dem Leistungshalbleiterbauelement (10) zugewandten, ersten elektrisch leitfähigen Folie (30), einer im Folienverbund folgenden elektrisch isolierenden Folie (32) und einer im Folienverbund weiter folgenden zweiten elektrisch leitfähigen Folie (34), ausgebildet ist. - Schalteinrichtung nach
Anspruch 2 , wobei die jeweilige Dicke der elektrisch leitfähigen Folie (30,34) des Folienverbunds zwischen 10 µm und 500 µm, vorzugsweise zwischen 50 µm und 250 µm, beträgt und die Dicke der elektrisch isolierenden Folie (32) des Folienverbunds zwischen 2 µm und 200 µm, vorzugsweise zwischen 10 µm und 100 µm, beträgt. - Schalteinrichtung nach einem der vorhergehenden Ansprüche, wobei die elektrisch leitende Verbindung zwischen der Verbindungseinrichtung (3) und der zweiten Leiterbahn (24) sowie die elektrisch leitende Verbindung zwischen der Verbindungseinrichtung (3) und dem Leistungshalbleiterbauelement (5) jeweils unabhängig voneinander als kraft- oder stoffschlüssige Verbindung insbesondere als Lotverbindung oder als Schweißverbindung, insbesondere als Laserschweißverbindung, oder als Sinterverbindung oder als Klebeverbindung ausgebildet ist.
- Schalteinrichtung nach
Anspruch 4 , wobei eine stoffschlüssige Verbindung ein Verbindungsmittel (50, 52, 54, 240) mit einer Dicke (850, 852) dieses Verbindungsmittels aufweist. - Schalteinrichtung nach einem der
Ansprüche 1 bis5 , wobei die Tiefe (828) der Vertiefung (28) derartig bemessen ist, dass sie mindestens die halben Dicke (850) des Leistungshalbleiterbauelements (5) samt auf dessen Hauptflächen angeordneten Verbindungsmitteln (50,52,54), soweit vorhanden, beträgt. - Schalteinrichtung nach einem der
Ansprüche 1 bis5 , wobei die Tiefe (828) der Vertiefung (28) derartig bemessen ist, dass das Niveau (950) der Oberfläche des Leistungshalbleiterbauelements (5) samt auf dessen Hauptflächen angeordneten Verbindungsmitteln (50,52,54), soweit vorhanden, gleich ist dem Niveau (922) der Oberfläche der ersten Leiterbahnen (22) des Substrats (2). - Schalteinrichtung nach einem der
Ansprüche 1 bis5 , wobei die Tiefe (828) der Vertiefung (28) derartig bemessen ist, dass das Niveau (950) der Oberfläche des Leistungshalbleiterbauelements (5) samt auf dessen Hauptflächen angeordneten Verbindungsmitteln (50,52,54), soweit vorhanden, gleich ist dem Niveau (924) der Oberfläche der zweiten Leiterbahnen (24) des Substrats (2) mit dort angeordnetem Verbindungsmittel (240). - Schalteinrichtung nach einem der vorhergehenden Ansprüche, wobei die Höhe des bogenförmigen Verlaufs (36) der Verbindungseinrichtung (3) minimal 10%, bevorzugt minimal 25% und insbesondere bevorzugt minimal 40% der Dicke (830) der Verbindungseinrichtung (3) beträgt.
- Schalteinrichtung nach einem der vorhergehenden Ansprüche, wobei die Höhe des bogenförmigen Verlaufs (36) der Verbindungseinrichtung (3) maximal 200%, bevorzugt maximal 100% und insbesondere bevorzugt maximal 60% der Dicke (830) der Verbindungseinrichtung (3) beträgt.
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE102015120156A1 (de) * | 2015-11-20 | 2017-05-24 | Semikron Elektronik Gmbh & Co. Kg | Vorrichtung zur materialschlüssigen Verbindung von Verbindungspartnern eines Leistungselekronik-Bauteils |
US20190139882A1 (en) * | 2017-11-06 | 2019-05-09 | Molex, Llc | Circuit assembly and mounting unit |
DE102018110132B3 (de) * | 2018-04-26 | 2018-11-29 | Semikron Elektronik Gmbh & Co. Kg | Drucksinterverfahren bei dem Leistungshalbleiterbauelemente mit einem Substrat über eine Sinterverbindung miteinander verbunden werden |
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