DE102017128535A1 - Halbleiter-Packages und Verfahren für deren Bildung - Google Patents
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- H01L21/568—Temporary substrate used as encapsulation process aid
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76871—Layers specifically deposited to enhance or enable the nucleation of further layers, i.e. seed layers
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- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76877—Filling of holes, grooves or trenches, e.g. vias, with conductive material
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- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/31—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
- H01L23/3107—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
- H01L23/3121—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed a substrate forming part of the encapsulation
- H01L23/3128—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed a substrate forming part of the encapsulation the substrate having spherical bumps for external connection
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- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/482—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of lead-in layers inseparably applied to the semiconductor body
- H01L23/485—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of lead-in layers inseparably applied to the semiconductor body consisting of layered constructions comprising conductive layers and insulating layers, e.g. planar contacts
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- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/49822—Multilayer substrates
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- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/49827—Via connections through the substrates, e.g. pins going through the substrate, coaxial cables
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- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/49838—Geometry or layout
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- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
- H01L23/538—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames the interconnection structure between a plurality of semiconductor chips being formed on, or in, insulating substrates
- H01L23/5384—Conductive vias through the substrate with or without pins, e.g. buried coaxial conductors
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- H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
- H01L23/538—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames the interconnection structure between a plurality of semiconductor chips being formed on, or in, insulating substrates
- H01L23/5389—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames the interconnection structure between a plurality of semiconductor chips being formed on, or in, insulating substrates the chips being integrally enclosed by the interconnect and support structures
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- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/02—Bonding areas ; Manufacturing methods related thereto
- H01L24/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L24/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
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- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/02—Bonding areas ; Manufacturing methods related thereto
- H01L24/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L24/06—Structure, shape, material or disposition of the bonding areas prior to the connecting process of a plurality of bonding areas
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- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/10—Bump connectors ; Manufacturing methods related thereto
- H01L24/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L24/14—Structure, shape, material or disposition of the bump connectors prior to the connecting process of a plurality of bump connectors
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- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/18—High density interconnect [HDI] connectors; Manufacturing methods related thereto
- H01L24/19—Manufacturing methods of high density interconnect preforms
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- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/18—High density interconnect [HDI] connectors; Manufacturing methods related thereto
- H01L24/20—Structure, shape, material or disposition of high density interconnect preforms
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- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/03—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
- H01L25/10—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices having separate containers
- H01L25/105—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices having separate containers the devices being of a type provided for in group H01L27/00
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- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/50—Multistep manufacturing processes of assemblies consisting of devices, each device being of a type provided for in group H01L27/00 or H01L29/00
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/50—Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
- H01L21/56—Encapsulations, e.g. encapsulation layers, coatings
- H01L21/563—Encapsulation of active face of flip-chip device, e.g. underfilling or underencapsulation of flip-chip, encapsulation preform on chip or mounting substrate
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- H01L2221/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof covered by H01L21/00
- H01L2221/67—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere
- H01L2221/683—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere for supporting or gripping
- H01L2221/68304—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere for supporting or gripping using temporarily an auxiliary support
- H01L2221/68345—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere for supporting or gripping using temporarily an auxiliary support used as a support during the manufacture of self supporting substrates
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- H01L2221/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof covered by H01L21/00
- H01L2221/67—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere
- H01L2221/683—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere for supporting or gripping
- H01L2221/68304—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere for supporting or gripping using temporarily an auxiliary support
- H01L2221/68359—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere for supporting or gripping using temporarily an auxiliary support used as a support during manufacture of interconnect decals or build up layers
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- H01L2221/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof covered by H01L21/00
- H01L2221/67—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere
- H01L2221/683—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere for supporting or gripping
- H01L2221/68304—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere for supporting or gripping using temporarily an auxiliary support
- H01L2221/68372—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere for supporting or gripping using temporarily an auxiliary support used to support a device or wafer when forming electrical connections thereto
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- H01L2221/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof covered by H01L21/00
- H01L2221/67—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere
- H01L2221/683—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere for supporting or gripping
- H01L2221/68304—Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere for supporting or gripping using temporarily an auxiliary support
- H01L2221/68381—Details of chemical or physical process used for separating the auxiliary support from a device or wafer
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/0401—Bonding areas specifically adapted for bump connectors, e.g. under bump metallisation [UBM]
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/04105—Bonding areas formed on an encapsulation of the semiconductor or solid-state body, e.g. bonding areas on chip-scale packages
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/05001—Internal layers
- H01L2224/05099—Material
- H01L2224/051—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/05117—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
- H01L2224/05124—Aluminium [Al] as principal constituent
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/12105—Bump connectors formed on an encapsulation of the semiconductor or solid-state body, e.g. bumps on chip-scale packages
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/18—High density interconnect [HDI] connectors; Manufacturing methods related thereto
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/18—High density interconnect [HDI] connectors; Manufacturing methods related thereto
- H01L2224/20—Structure, shape, material or disposition of high density interconnect preforms
- H01L2224/21—Structure, shape, material or disposition of high density interconnect preforms of an individual HDI interconnect
- H01L2224/214—Connecting portions
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32135—Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
- H01L2224/32145—Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/4805—Shape
- H01L2224/4809—Loop shape
- H01L2224/48091—Arched
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- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/49811—Additional leads joined to the metallisation on the insulating substrate, e.g. pins, bumps, wires, flat leads
- H01L23/49816—Spherical bumps on the substrate for external connection, e.g. ball grid arrays [BGA]
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- H01L2924/15311—Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a ball array, e.g. BGA
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Abstract
Bereitgestellt wird eine Vorrichtung, die Folgendes umfasst: ein erstes Vorrichtungspackage, das Folgendes umfasst: eine erste Umverteilungsstruktur, die eine erste Umverteilungsleitung und eine zweite Umverteilungsleitung umfasst; ein Die auf der ersten Umverteilungsstruktur; eine erste Durchkontaktierung, die an eine erste Seite der ersten Umverteilungsleitung gekoppelt ist; eine zweite Durchkontaktierung, die an eine erste Seite der zweiten Umverteilungsleitung gekoppelt ist und sich durch die zweite Umverteilungsleitung erstreckt; eine Einkapselung, die den Die, die erste Durchkontaktierung und die zweite Durchkontaktierung umgibt; und eine zweite Umverteilungsstruktur über der Einkapselung, wobei die zweite Umverteilungsstruktur elektrisch mit dem Die, der ersten Durchkontaktierung und der zweiten Durchkontaktierung verbunden ist; einen ersten leitfähigen Verbinder, der an eine zweite Seite der ersten Umverteilungsleitung gekoppelt ist, wobei der erste leitfähige Verbinder entlang einer unterschiedlichen Achse als der Längsachse der ersten Durchkontaktierung angeordnet ist; und einen zweiten leitfähigen Verbinder, der an eine zweite Seite der zweiten Umverteilungsleitung gekoppelt ist, wobei der zweite leitfähige Verbinder entlang einer Längsachse der zweiten Durchkontaktierung angeordnet ist.
Description
- INANSPRUCHNAHME EINER PRIORITÄT UND QUERVERWEIS
- Diese Anmeldung beansprucht den Vorteil der vorläufigen
US-Patentanmeldung Nr. 62/565,321 - ALLGEMEINER STAND DER TECHNIK
- Die Halbleiterbranche ist aufgrund permanenter Verbesserungen bei der Integrationsdichte von einer Vielzahl von elektronischen Bauelementen (z. B. Transistoren, Dioden, Widerständen, Kondensatoren usw.) schnell gewachsen. Die Verbesserung bei der Integrationsdichte ist bislang größtenteils Ergebnis der iterativen Verringerung der Mindestmerkmalsgröße, wodurch mehr Bauelemente in einer gegebenen Fläche integriert werden können. Da die Nachfrage nach immer kleineren elektronischen Vorrichtungen bislang gestiegen ist, ist ein Bedarf an kleineren und kreativeren Packaging-Techniken von Halbleiter-Dies entstanden. Ein Beispiel für solche Packaging-Systeme ist die Package-on-Package-Technologie (PoP). In einer PoP-Vorrichtung ist ein oberes Halbleiter-Package auf einem unteren Halbleiter-Package gestapelt, um ein hohes Niveau an Integrations- und Bauelementdichte bereitzustellen. Die PoP-Technologie ermöglicht allgemein die Herstellung von Halbleitervorrichtungen mit verbesserten Funktionalitäten und geringen notwendigen Montageflächen auf einer gedruckten Leiterplatte (Printed Circuit Board - PCB).
- Figurenliste
- Gesichtspunkte der vorliegenden Offenbarung sind bei der Lektüre der folgenden detaillierten Beschreibung im Zusammenhang mit den begleitenden Figuren am besten verständlich. Es sei erwähnt, dass verschiedene Merkmale gemäß der Standardpraxis in der Branche nicht maßstabsgetreu sind. Tatsächlich kann es sein, dass die Abmessungen der verschiedenen Merkmale der Verständlichkeit der Erörterung halber beliebig vergrößert oder verkleinert wurden.
-
1 bis14 sind verschiedene Ansichten von Zwischenschritten während eines Prozesses zum Bilden eines Vorrichtungspackages gemäß einigen Ausführungsformen. -
15 bis18 sind verschiedene Ansichten von Zwischenschritten während eines Prozesses zum Bilden einer Package-Struktur gemäß einigen Ausführungsformen. - DETAILLIERTE BESCHREIBUNG
- Die folgende Offenbarung stellt viele verschiedene Ausführungsformen oder Beispiele zur Ausführung verschiedener Merkmale der Erfindung bereit. Spezifische Beispiele von Bauelementen und Anordnungen sind in der Folge beschrieben, um die vorliegende Offenbarung zu vereinfachen. Dabei handelt es sich selbstverständlich lediglich um Beispiele und damit wird keine Einschränkung beabsichtigt. Zum Beispiel kann die Bildung eines ersten Merkmals über oder auf einem zweiten Merkmal in der folgenden Beschreibung Ausführungsformen umfassen, in denen das erste und das zweite Merkmal in direktem Kontakt gebildet sind, und kann auch Ausführungsformen umfassen, in denen zusätzliche Merkmale zwischen dem ersten und dem zweiten Merkmal gebildet sein können, derart dass es sein kann, dass das erste und das zweite Merkmal nicht in direktem Kontakt stehen. Zusätzlich kann die vorliegende Offenbarung Bezugsziffern und/oder -buchstaben in den verschiedenen Beispielen wiederholen. Diese Wiederholung dient den Zwecken der Einfachheit und Deutlichkeit und schreibt an sich keine Beziehung zwischen den verschiedenen erörterten Ausführungsformen und/oder Ausgestaltungen vor.
- Ferner können Begriffe, die eine räumliche Beziehung beschreiben, wie beispielsweise „unterhalb“, „unter“, „untere/r/s“, „über“, „obere/r/s“ und dergleichen, hier der Einfachheit der Beschreibung halber verwendet werden, um die Beziehung eines Elements oder Merkmals zu (einem) andere/n Element/en oder Merkmal/en zu beschreiben, wie in den Figuren veranschaulicht. Es wird beabsichtigt, dass Begriffe, die eine räumliche Beziehung beschreiben, zusätzlich zu der in den Figuren bildlich dargestellten Ausrichtung verschiedene Ausrichtungen der Vorrichtung bei der Verwendung oder beim Betrieb umfassen. Die Vorrichtung kann anders (um 90 Grad gedreht oder in anderen Ausrichtungen) ausgerichtet sein und die Bezeichnungen für räumliche Beziehungen, die hier verwendet werden, können ebenfalls dementsprechend ausgelegt werden.
- Es werden Halbleiter-Packages und Verfahren zu deren Bildung gemäß einigen Ausführungsformen offenbart. Insbesondere wird eine erste Umverteilungsstruktur gebildet, die Umverteilungsleitungen aufweist. Eine erste Durchkontaktierung wird sich von einer Fläche eines ersten leitfähigen Merkmals erstreckend gebildet. Eine zweite Durchkontaktierung wird sich von einer Lücke zwischen einem zweiten und einem dritten leitfähigen Merkmal erstreckend gebildet. Die zweite Durchkontaktierung ist länger als die erste Durchkontaktierung. Leitfähige Verbinder, wie beispielsweise Lot, sind an der Rückseite der ersten Umverteilungsstruktur angebracht. Ein erster leitfähiger Verbinder ist an das erste leitfähige Merkmal gekoppelt und ist von der ersten Durchkontaktierung versetzt. Folglich erstreckt eine intermetallische Verbindung (Intermetallic Compound - IMC), die während des Reflow gebildet wird, sich nicht seitlich zur ersten Durchkontaktierung. Ein zweiter leitfähiger Verbinder ist an das zweite und das dritte leitfähige Merkmal gekoppelt und ist mit der zweiten Durchkontaktierung ausgerichtet. Folglich wird, wenn eine IMC während des Reflows gebildet wird, Kupfer von der zweiten Durchkontaktierung und nicht von dem zweiten und dem dritten leitfähigen Merkmal diffundiert. Durch die Vermeidung der Diffusion von Kupfer von dem zweiten und dem dritten leitfähigen Merkmal kann die Ablösung von während der Bildung der Durchkontaktierungen verwendeten Keimschichten vermieden werden.
-
1 bis14 sind verschiedene Ansichten von Zwischenschritten während eines Prozesses zum Bilden eines Halbleiter-Packages200 gemäß einigen Ausführungsformen.1 bis14 sind Querschnittsansichten. Das Vorrichtungspackage200 kann als ein Integrated Fan-Out-Package (InFO) bezeichnet werden. - In
1 ist das Vorrichtungspackage200 an einer Zwischenstufe der Verarbeitung gezeigt, die eine Ablöseschicht102 umfasst, die auf einem Trägersubstrat100 gebildet ist. Ein Package-Gebiet600 für die Bildung des Vorrichtungspackages200 ist veranschaulicht. Obgleich nur ein Package-Gebiet gezeigt ist, können viele gebildete Package-Gebiete vorhanden sein. - Das Trägersubstrat
100 kann ein Glasträgersubstrat, ein Keramikträgersubstrat oder dergleichen sein. Das Trägersubstrat100 kann ein Wafer sein, derart, dass mehrere Packages gleichzeitig auf dem Trägersubstrat100 gebildet werden können. Die Ablöseschicht102 kann aus einem Material auf Polymerbasis gebildet werden, das gemeinsam mit dem Trägersubstrat100 von den darüberliegenden Strukturen entfernt werden kann, die in anschließenden Schritten gebildet werden. In einigen Ausführungsformen ist die Ablöseschicht102 ein thermisches Ablösungsmaterial auf Epoxidbasis, das seine Klebeeigenschaft verliert, wenn es erhitzt wird, wie beispielsweise eine Ablösungsbeschichtung aus Licht-Wärme-Umwandlungsmaterial (Light-To-Heat-Conversion - LTHC). In anderen Ausführungsformen kann die Ablöseschicht102 ein Ultraviolett-Kleber (UV) sein, der seine Klebeeigenschaft verliert, wenn er UV-Licht ausgesetzt wird. Die Ablöseschicht102 kann als eine Flüssigkeit abgegeben und ausgehärtet werden, kann eine dünne Laminatschicht sein, die auf das Trägersubstrat100 laminiert ist, oder kann dergleichen sein. Die Oberfläche der Ablöseschicht102 kann nivelliert sein und kann einen hohen Grad an Koplanarität aufweisen. - In
2 ist eine dielektrische Schicht104 auf der Ablöseschicht102 gebildet. Die untere Fläche der dielektrischen Schicht104 kann mit der Oberfläche der Ablöseschicht102 in Kontakt sein. In einigen Ausführungsformen ist die dielektrische Schicht104 aus einem Polymer, wie beispielsweise Polybenzoxazol (PBO), Polyimid, Benzocyclobuten (BCB) oder dergleichen gebildet. In anderen Ausführungsformen ist die dielektrische Schicht104 aus einem Nitrid, wie beispielsweise Siliziumnitrid; einem Oxid, wie beispielsweise Siliziumoxid, Phosphorsilikatglas (PSG), Borsilikatglas (BSG), mit Bor dotiertem Phosphorsilikatglas (BPSG) oder dergleichen; oder dergleichen gebildet. Die dielektrische Schicht104 kann durch irgendeinen annehmbaren Abscheidungsprozess, wie beispielsweise Aufschleudern, chemische Gasphasenabscheidung (Chemical Vapor Deposition - CVD), Laminieren, dergleichen oder eine Kombination davon gebildet werden. - In
3 ist eine Keimschicht106 über der dielektrischen Schicht104 gebildet. In einigen Ausführungsformen ist die Keimschicht106 eine Metallschicht, die eine Einzelschicht oder eine Verbundschicht sein kann, die mehrere Unterschichten umfasst, die aus verschiedenen Materialien gebildet sind. In einigen Ausführungsformen umfasst die Keimschicht106 eine Titanschicht und eine Kupferschicht über der Titanschicht. Die Keimschicht106 kann unter Verwendung von zum Beispiel PVD oder dergleichen gebildet werden. - In
4 ist eine Metallisierungsstruktur108 über der dielektrischen Schicht104 gebildet. Ein Fotoresist (nicht gezeigt) wird auf der Keimschicht106 gebildet und strukturiert. Das Fotoresist kann durch Aufschleudern oder dergleichen gebildet werden und kann zur Strukturierung mit Licht belichtet werden. Die Struktur des Fotoresists entspricht der Metallisierungsstruktur108 . Die Strukturierung bildet Öffnungen durch das Fotoresist, um die Keimschicht106 freizulegen. Ein leitfähiges Material wird in den Öffnungen des Fotoresists und auf den freiliegenden Abschnitten der Keimschicht106 gebildet. Das leitfähige Material kann durch Plattierung, wie beispielsweise Elektroplattierung oder stromlose Plattierung, oder dergleichen, gebildet werden. Das leitfähige Material kann ein Metall oder eine Metalllegierung, wie beispielsweise Kupfer, Titan, Wolfram, Aluminium, dergleichen oder Kombinationen davon sein. Dann werden das Fotoresist und Abschnitte der Keimschicht106 , auf denen das leitfähige Material nicht gebildet ist, entfernt. Das Fotoresist kann durch einen annehmbaren Veraschungs- oder Ablösungsprozess, wie beispielsweise unter Verwendung eines Sauerstoffplasmas oder dergleichen, entfernt werden. Nachdem das Fotoresist entfernt wurde, werden freiliegende Abschnitte der Keimschicht106 entfernt, wie beispielsweise unter Verwendung eines annehmbaren Ätzprozesses, wie beispielsweise durch Nass- oder Trockenätzen. Die übrigen Abschnitte der Keimschicht106 und des leitfähigen Materials bilden die Metallisierungsstruktur108 . - Die leitfähigen Merkmale der Metallisierungsstruktur
108 können als Umverteilungsschichten oder Umverteilungsleitungen bezeichnet werden. Es kann sein, dass die Umverteilungsleitungen nicht gebildet werden, um eine gleichförmige Breite aufzuweisen, und einige von den Umverteilungsleitungen können mehrere leitfähige Merkmale umfassen. Zuerst können die Umverteilungsleitungen108A jeweils ein einzelnes leitfähiges Merkmal umfassen, das elektrisch mit Vorrichtungen des Vorrichtungspackages200 verbunden werden wird. Zweite Umverteilungsleitungen108B können jeweils mehrere leitfähige Merkmale umfassen, die durch eine Lücke110 getrennt sind, und werden elektrisch miteinander und mit Vorrichtungen des Vorrichtungspackages200 verbunden. Die kombinierte BreiteWB der zweiten Umverteilungsleitungen108B kann im Wesentlichen gleich der BreiteWA der ersten Umverteilungsleitungen108A sein oder kann sich davon unterscheiden. - In einigen Ausführungsformen werden die leitfähigen Merkmale der zweiten Umverteilungsleitungen
108B separat während der Bildung der Metallisierungsstruktur108 gebildet, z. B. kann jedes leitfähige Merkmal einer Öffnung in dem Fotoresist entsprechen, die die Keimschicht106 freilegt. In einigen Ausführungsformen wird ein einzelnes leitfähiges Merkmal während der Bildung der Metallisierungsstruktur108 gebildet und die Lücken110 werden danach unter Verwendung annehmbarer Ätztechniken gebildet, um das einzelne leitfähige Merkmal in mehrere leitfähige Merkmale zu unterteilen. Die Lücken110 werden gebildet, um eine BreiteWG aufzuweisen. Die Lücken110 können sich von Oberflächen der zweiten Umverteilungsleitungen108B zu unteren Flächen der zweiten Umverteilungsleitungen108B erstrecken, derart, dass die dielektrische Schicht104 freiliegt. Die Lücken110 können in einer Mitte der zweiten Umverteilungsleitungen108B gebildet werden, derart, dass die leitfähigen Merkmale der zweiten Umverteilungsleitungen108B eine gleiche Länge aufweisen, oder können von der Mitte der zweiten Umverteilungsleitungen108B versetzt gebildet werden, derart, dass die leitfähigen Merkmale der zweiten Umverteilungsleitungen108B eine unterschiedliche Länge aufweisen. - In
5 ist eine dielektrische Schicht112 auf der Metallisierungsstruktur108 und der dielektrischen Schicht104 gebildet. In einigen Ausführungsformen ist die dielektrische Schicht112 aus einem Polymer gebildet, das ein lichtempfindliches Material, wie beispielsweise PBO, Polyimid, BCB oder dergleichen, sein kann, das unter Verwendung einer Lithografiemaske strukturiert werden kann. In anderen Ausführungsformen ist die dielektrische Schicht112 aus einem Nitrid, wie beispielsweise einem Siliziumnitrid; einem Oxid, wie beispielsweise Siliziumoxid, PSG, BSG, BPSG; oder dergleichen gebildet. Die dielektrische Schicht112 kann durch Aufschleudern, Laminierung, CVD, dergleichen oder eine Kombination davon gebildet werden - Die dielektrische Schicht
112 wird dann strukturiert, um die Öffnungen114 zu bilden, um Abschnitte der Metallisierungsstruktur108 freizulegen. Die Strukturierung kann durch einen annehmbaren Prozess erfolgen, wie beispielsweise durch Belichten der dielektrischen Schicht112 mit Licht, wenn die dielektrische Schicht ein lichtempfindliches Material ist, oder durch Ätzen unter Verwendung von zum Beispiel einem anisotropen Ätzen. Die ersten Öffnungen114A werden durch Freilegen der ersten Umverteilungsleitungen108A gebildet und die zweiten Öffnungen114B werden durch Freilegen der zweiten Umverteilungsleitungen108B gebildet. Die zweiten Öffnungen114B werden über den Lücken110 der zweiten Umverteilungsleitungen108B gebildet; an sich werden Seiten der leitfähigen Merkmale freigelegt, Abschnitte der Oberflächen der leitfähigen Merkmale werden freigelegt und Abschnitte der dielektrischen Schicht104 werden freigelegt. In der veranschaulichten Ausführungsform weisen die ersten Öffnungen114A und die zweiten Öffnungen114B jeweils eine gleiche BreiteWO auf. In anderen Ausführungsformen weisen die ersten Öffnungen114A und zweiten Öffnungen114B unterschiedliche Breiten auf. Die BreiteWO der Öffnungen114 ist größer als die BreiteWG der Lücken110 . - Die Öffnungen
114 können über einer Mitte von jeder von den Metallisierungsstrukturen108 gebildet werden oder können von der Mitte versetzt gebildet werden. In der gezeigten Ausführungsform werden die ersten Öffnungen114A von den Mitten der Metallisierungsstrukturen108 versetzt gebildet und die zweiten Öffnungen114B werden über Mitten der Metallisierungsstrukturen108 gebildet. - Die dielektrischen Schichten
104 und112 und die Metallisierungsstrukturen108 können als eine Rückseiten-Umverteilungsstruktur116 bezeichnet werden. Wie veranschaulicht, umfasst die Rückseiten-Umverteilungsstruktur116 die zwei dielektrischen Schichten104 und112 und eine Metallisierungsstruktur108 . In anderen Ausführungsformen kann die Rückseiten-Umverteilungsstruktur116 irgendeine Anzahl von dielektrischen Schichten, Metallisierungsstrukturen und Durchkontaktierungen umfassen. Eine oder mehrere zusätzliche Metallisierungsstrukturen und dielektrische Schichten können in der Rückseiten-Umverteilungsstruktur116 durch Wiederholen der Prozesse zum Bilden der Metallisierungsstrukturen108 und der dielektrischen Schicht112 gebildet werden. Während der Bildung einer Metallisierungsstruktur durch Bilden der Keimschicht und des leitfähigen Materials der Metallisierungsstruktur in der Öffnung der darunterliegenden dielektrischen Schicht können Durchkontaktierungen gebildet werden. Die Durchkontaktierungen können daher die verschiedenen Metallisierungsstrukturen zusammenschalten und sie elektrisch koppeln. - In
6 wird eine Keimschicht118 über der Rückseiten-Umverteilungsstruktur116 und in den Öffnungen114 gebildet. Die Keimschicht118 befindet sich über der dielektrischen Schicht112 , freiliegenden Abschnitten der Metallisierungsstruktur108 und freiliegenden Abschnitten der dielektrischen Schicht104 . In einigen Ausführungsformen ist die Keimschicht118 eine Metallschicht, die eine Einzelschicht oder eine Verbundschicht sein kann, die mehrere Unterschichten umfasst, die aus verschiedenen Materialien gebildet sind. In einigen Ausführungsformen umfasst die Keimschicht118 eine Titanschicht und eine Kupferschicht über der Titanschicht. Die Keimschicht118 kann unter Verwendung von zum Beispiel PVD oder dergleichen gebildet werden. - In
7 wird ein Fotoresist120 auf der Keimschicht118 gebildet und strukturiert. Das Fotoresist120 kann durch Aufschleudern oder dergleichen gebildet werden und kann zur Strukturierung mit Licht belichtet werden. Die Struktur des Fotoresists120 entspricht durchgehenden Durchkontaktierungen, die anschließend gebildet werden. Die Strukturierung bildet Öffnungen durch das Fotoresist120 , um die Keimschicht118 freizulegen. Die Öffnungen durch das Fotoresist120 werden über den Öffnungen114 in der dielektrischen Schicht112 gebildet und können über sowohl den ersten Öffnungen114A als auch den zweiten Öffnungen114B eine gleiche Breite Wp aufweisen. Die BreiteWP der Öffnungen ist größer als die BreiteWO der Öffnungen114 . - In
8 wird ein leitfähiges Material in den Öffnungen des Fotoresists120 und auf den freiliegenden Abschnitten der Keimschicht118 gebildet. Das leitfähige Material kann durch Plattierung, wie beispielsweise Elektroplattierung oder stromlose Plattierung, oder dergleichen gebildet werden. Das leitfähige Material kann ein Metall oder eine Metalllegierung, wie beispielsweise Kupfer, Titan, Wolfram, Aluminium, dergleichen oder Kombinationen davon sein. Das Fotoresist120 und Abschnitte der Keimschicht118 , auf denen das leitfähige Material nicht gebildet ist, werden entfernt. Das Fotoresist kann durch einen annehmbaren Veraschungs- oder Ablösungsprozess, wie beispielsweise unter Verwendung eines Sauerstoffplasmas oder dergleichen, entfernt werden. Nachdem das Fotoresist entfernt wurde, werden freiliegende Abschnitte der Keimschicht118 entfernt, wie beispielsweise unter Verwendung eines annehmbaren Ätzprozesses, wie beispielsweise durch Nass- oder Trockenätzen. Die übrigen Abschnitte der Keimschicht und des leitfähigen Materials bilden durchgehende Durchkontaktierungen122 , die elektrisch mit den Umverteilungsleitungen verbunden sind. - Da die Keimschicht
118 in den Lücken110 der zweiten Umverteilungsleitungen108B gebildet ist, werden zweite Durchkontaktierungen122B gebildet, die sich durch die zweiten Umverteilungsleitungen108B erstrecken. Umgekehrt werden erste Durchkontaktierungen122A auf den ersten Umverteilungsleitungen108A gebildet und erstrecken sich nicht durch die ersten Umverteilungsleitungen108A . Die ersten Durchkontaktierungen122A und zweiten Durchkontaktierungen122B können beide die gleiche Breite Wp über der dielektrischen Schicht112 und die gleiche Breite Wo in den Öffnungen114 aufweisen. Die zweiten Durchkontaktierungen122B weisen auch die BreiteWG in den Lücken110 auf. Da die zweiten Durchkontaktierungen122B drei unterschiedliche Breiten, jede mit einer absteigenden Breite, aufweisen, können die zweiten Durchkontaktierungen122B als eine Leiterstruktur aufweisend bezeichnet werden. Da die ersten Öffnungen114A von den Mittelpunkten der Metallisierungsstrukturen108 versetzt gebildet wurden, werden die ersten Durchkontaktierungen122A von den Mittelpunkten der ersten Umverteilungsleitungen108A versetzt gebildet. - Obgleich die ersten Durchkontaktierungen
122A als eine Änderung in den Breiten aufweisend veranschaulicht sind und die zweiten Durchkontaktierungen122B als zwei Änderungen in den Breiten aufweisend veranschaulicht sind, versteht sich, dass die ersten Durchkontaktierungen122A und zweiten Durchkontaktierungen122B in anderen Ausführungsformen irgendeine Anzahl von Änderungen in den Breiten aufweisen können. Gemäß Ausführungsformen weisen die zweiten Durchkontaktierungen122B mehr Änderungen bei den Breiten auf als die ersten Durchkontaktierungen122A . - In
9 werden integrierte Schaltungs-Dies124 durch einen Klebstoff126 an der dielektrischen Schicht112 zum Haften gebracht. Wie in4 veranschaulicht, wird ein integriertes Schaltungs-Die124 in dem Package-Gebiet600 zum Haften gebracht. In anderen Ausführungsformen können mehrere integrierte Schaltungs-Dies124 in jedem Gebiet zum Haften gebracht werden. Die integrierten Schaltungsdies124 können freiliegende Dies, wie beispielsweise Logik-Dies (z. B. Zentraleinheit, Mikrocontroller usw.), Speicherdies (z. B. dynamischer RAM-Speicher-Die (Dynamic Random Access Memory - DRAM), statischer RAM-Speicher-Die (Static Random Access Memory - SRAM) usw.), Leistungsverwaltung-Dies (z. B integrierter Schaltungs-Die mit Leistungsverwaltung (Power Management Integrated Circuit (PMIC)), Hochfrequenz-Dies (HF), Sensor-Dies, mikroelektromechanische System-Dies (MEMS), Signalverarbeitungsdies (z. B. digitaler Signalverarbeitungsdie (Digital Signal Processing (DSP)), Front-End-Dies (z. B. analoge Front-End (AFE) Dies), dergleichen oder eine Kombination davon umfassen. Auch können in einigen Ausführungsformen die integrierten Schaltungsdies124 in den verschiedenen Package-Gebieten (nicht gezeigt) verschiedene Größen (z. B. verschiedene Höhen und/oder Oberflächen) aufweisen und in anderen Ausführungsformen können die integrierten Schaltungsdies124 die gleiche Größe (z. B. gleiche Höhen und/oder Oberflächen) aufweisen. - Bevor sie an der dielektrischen Schicht
112 zum Haften gebracht werden, können die integrierten Schaltungsdies124 gemäß anwendbaren Herstellungsprozessen verarbeitet werden, um integrierte Schaltungen in den integrierten Schaltungsdies124 zu bilden. Zum Beispiel umfassen die integrierten Schaltungsdies124 jeweils ein Halbleitersubstrat128 wie beispielsweise dotiertes oder undotiertes Silizium oder eine aktive Schicht eines Semiconductor-On-Insulator-Substrats (SOI). Das Halbleitersubstrat kann andere Halbleitermaterialien, wie beispielsweise Germanium; einen Verbindungshalbleiter, der Siliziumcarbid, Galliumarsenid, Galliumphosphid, Indiumphosphid, Indiumarsenid und/oder Indiumantimonid umfasst; einen Legierungshalbleiter, der SiGe, GaAsP, AlInAs, AlGaAs, GaInAs, GaInP und/oder GaInAsP umfasst; oder Kombinationen davon umfassen. Es können auch andere Substrate verwendet werden, wie beispielsweise mehrschichtige oder Gradient-Substrate. In und/oder auf dem Halbleitersubstrat128 können Vorrichtungen, wie beispielsweise Transistoren, Dioden, Kondensatoren, Widerstände usw. gebildet werden und können durch Zusammenschaltungsstrukturen130 , die zum Beispiel durch Metallisierungsstrukturen in einer oder mehreren dielektrischen Schichten auf dem Halbleitersubstrat128 gebildet sind, zusammengeschaltet werden, um eine integrierte Schaltung zu bilden. - Die integrierten Schaltungsdies
124 umfassen ferner Anschlüsse132 , wie beispielsweise Aluminiumanschlüsse, mit denen externe Verbindungen hergestellt werden. Die Anschlüsse132 sind, was als entsprechende aktive Seiten der integrierten Schaltungsdies124 bezeichnet werden kann. Auf den integrierten Schaltungsdies124 und auf Abschnitten der Anschlüsse132 befinden sich dünne Passivierungsschichten134 . Öffnungen verlaufen durch die dünnen Passivierungsschichten134 zu den Anschlüssen132 . Die-Verbinder136 , wie beispielsweise leitfähige Säulen (die zum Beispiel ein Metall, wie beispielsweise Kupfer, umfassen) befinden sich in den Öffnungen durch die dünnen Passivierungsschichten134 und sind mechanisch und elektrisch an die entsprechenden Anschlüsse132 gekoppelt. Die Die-Verbinder136 können zum Beispiel durch Plattierung oder dergleichen gebildet werden. Die Die-Verbinder136 koppeln die jeweiligen integrierten Schaltungen elektrisch an die integrierten Schaltungs-Dies124 . - Ein dielektrisches Material
138 befindet sich auf den aktiven Seiten der integrierten Schaltungsdies124 , wie beispielsweise auf den dünnen Passivierungsschichten134 und den Die-Verbindern136 . Das dielektrische Material138 verkapselt die Die-Verbinder136 seitlich und das dielektrische Material138 grenzt seitlich an die entsprechenden integrierten Schaltungsdies124 an. Das dielektrische Material138 kann anfangs gebildet werden, um die Die-Verbinder136 zu vergraben oder abzudecken; wenn die Die-Verbinder136 vergraben sind, kann die Oberfläche des dielektrischen Materials138 eine unebene Topologie aufweisen. Das dielektrische Material138 kann ein Polymer, wie beispielsweise PBO, Polyimid, BCB, oder dergleichen; ein Nitrid, wie beispielsweise Siliziumnitrid oder dergleichen; ein Oxid, wie beispielsweise Siliziumoxid, PSG, BSG, BPSG oder dergleichen; dergleichen oder eine Kombination davon umfassen und kann zum Beispiel durch Aufschleudern, Laminierung, CVD oder dergleichen gebildet werden. - Der Kleber
126 befindet sich auf Rückseiten der integrierten Schaltungsdies124 und bringt die integrierten Schaltungsdies124 an der Rückseiten-Umverteilungsstruktur116 , wie beispielsweise der dielektrischen Schicht112 in der Veranschaulichung, zum Haften. Der Kleber126 kann irgendein geeigneter Kleber, Epoxid, Die-Befestigungsfilm (Die Attach Film - DAF) oder dergleichen sein. Der Kleber126 kann an einer Rückseite der integrierten Schaltungsdies124 , wie beispielsweise an einer Rückseite des entsprechenden Halbleiter-Wafers, aufgebracht werden oder kann über der Fläche des Trägersubstrats100 aufgebracht werden. Die integrierten Schaltungsdies124 können vereinzelt, wie beispielsweise durch Sägen oder Dicing, und durch den Kleber126 unter Verwendung von zum Beispiel einem Pick-and-Place-Werkzeug an der dielektrischen Schicht112 zum Haften gebracht werden. - Obgleich die integrierten Schaltungsdies
124 vorhergehend als freiliegende Dies (z. B. offene Dies) veranschaulicht und beschrieben sind, können die integrierten Schaltungs-Dies124 in anderen Ausführungsformen geschlossene Chips sein (z. B. ein oder mehrere freiliegende Dies, die mit anderen Package-Merkmalen, wie beispielsweise Umverteilungsstrukturen, passiven Vorrichtungen usw. integriert sind). Zum Beispiel können die integrierten Schaltungsdies124 ein Speicher-Package (z. B. ein Hybrid Memory Cube) sein, das mehrere gestapelte und zusammengeschaltete Speicherdies umfasst. - In
10 ist eine Einkapselung140 auf den verschiedenen Bauelementen gebildet. Die Einkapselung140 kann eine Formmasse, Epoxid oder dergleichen sein und kann durch Formpressen, Spritzpressen oder dergleichen angewandt werden. Die Einkapselung140 kann über dem Trägersubstrat100 gebildet werden, derart, dass die Die-Verbinder136 der integrierten Schaltungs-Dies124 und/oder der durchgehenden Durchkontaktierungen122 vergraben oder bedeckt werden. Die Einkapselung140 wird dann ausgehärtet. - In
11 wird ein Planarisierungsprozess auf der Einkapselung140 durchgeführt, um die durchgehenden Durchkontaktierungen122 und die Die-Verbinder136 freizulegen. Der Planarisierungsprozess kann auch das dielektrische Material138 schleifen. Die Oberflächen der durchgehenden Durchkontaktierungen122 , Die-Verbinder136 , des dielektrischen Materials138 und der Einkapselung140 sind nach dem Planarisierungsprozess koplanar. Der Planarisierungsprozess kann zum Beispiel ein chemisch-mechanisches Polieren (CMP), ein Schleifprozess oder dergleichen sein. In einigen Ausführungsformen kann die Planarisierung weggelassen werden, zum Beispiel wenn die durchgehenden Durchkontaktierungen122 und Die-Verbinder136 bereits freiliegen. Wie vorhergehend erwähnt, erstrecken sich die zweiten Durchkontaktierungen122B durch die Metallisierungsstruktur108 . An sich sind die zweiten Durchkontaktierungen122B nach dem Planarisierungsprozess länger als die ersten Durchkontaktierungen122A , wenn die ersten Durchkontaktierungen122A und die zweiten Durchkontaktierungen122B mit einer selben Metallisierungsschicht der Rückseiten-Umverteilungsstruktur116 verbunden sind. - In
12 wird eine Vorderseiten-Umverteilungsstruktur142 auf der Einkapselung140 , den durchgehenden Durchkontaktierungen122 und den Die-Verbindern136 gebildet. Die Vorderseiten-Umverteilungsstruktur142 umfasst mehrere dielektrische Schichten und Metallisierungsstrukturen. Zum Beispiel kann die Vorderseiten-Umverteilungsstruktur142 wie mehrere diskrete Metallisierungsstrukturen strukturiert werden, die durch (eine) entsprechende dielektrische Schicht/en voneinander getrennt sind. - In einigen Ausführungsformen sind die dielektrischen Schichten aus einem Polymer gebildet, das ein lichtempfindliches Material, wie beispielsweise PBO, Polyimid, BCB oder dergleichen, sein kann, das unter Verwendung einer Lithografiemaske strukturiert werden kann. In anderen Ausführungsformen sind die dielektrischen Schichten aus einem Nitrid, wie beispielsweise einem Siliziumnitrid; einem Oxid, wie beispielsweise Siliziumoxid, PSG, BSG, BPSG; oder dergleichen gebildet. Die dielektrischen Schichten können durch Aufschleudern, Laminierung, CVD, dergleichen oder eine Kombination davon gebildet werden.
- Nach der Bildung werden die dielektrischen Schichten strukturiert, um darunterliegende leitfähige Merkmale freizulegen. Die untere dielektrische Schicht wird strukturiert, um Abschnitte der durchgehenden Durchkontaktierungen
122 freizulegen und die Die-Verbinder136 und die dielektrische/n Zwischenschicht/en werden strukturiert, um Abschnitte von darunter liegenden Metallisierungsstrukturen freizulegen. Die Strukturierung kann durch einen annehmbaren Prozess erfolgen, wie beispielsweise durch Belichten der dielektrischen Schicht mit Licht, wenn die dielektrischen Schichten ein lichtempfindliches Material sind, oder durch Ätzen unter Verwendung zum Beispiel eines anisotropen Ätzens. Wenn die dielektrischen Schichten lichtempfindliche Materialien sind, können die dielektrischen Schichten nach der Belichtung entwickelt werden. - Metallisierungsstrukturen mit Durchkontaktierungen werden auf jeder dielektrischen Schicht gebildet. Eine Keimschicht (nicht gezeigt) wird über der dielektrischen Schicht und in Öffnungen durch die dielektrische Schicht gebildet. In einigen Ausführungsformen ist die Keimschicht eine Metallschicht, die eine Einzelschicht oder eine Verbundschicht sein kann, die mehrere Unterschichten umfasst, die aus verschiedenen Materialien gebildet sind. In einigen Ausführungsformen umfasst die Keimschicht eine Titanschicht und eine Kupferschicht über der Titanschicht. Die Keimschicht kann unter Verwendung eines Abscheidungsprozesses, wie beispielsweise PVD oder dergleichen, gebildet werden. Dann wird ein Fotoresist auf der Keimschicht gebildet und strukturiert. Das Fotoresist kann durch Aufschleudern oder dergleichen gebildet werden und kann zur Strukturierung mit Licht belichtet werden. Die Struktur des Fotoresists entspricht der Metallisierungsstruktur. Die Strukturierung bildet Öffnungen durch das Fotoresist, um die Keimschicht freizulegen. Ein leitfähiges Material wird in den Öffnungen des Fotoresists und auf den freiliegenden Abschnitten der Keimschicht gebildet. Das leitfähige Material kann durch Plattierung, wie beispielsweise Elektroplattierung oder stromlose Plattierung oder dergleichen, gebildet werden. Das leitfähige Material kann ein Metall oder eine Metalllegierung, wie beispielsweise Kupfer, Titan, Wolfram, Aluminium, dergleichen oder Kombinationen davon umfassen. Dann werden das Fotoresist und Abschnitte der Keimschicht, auf denen das leitfähige Material nicht gebildet ist, entfernt. Das Fotoresist kann durch einen annehmbaren Veraschungs- oder Ablösungsprozess, wie beispielsweise unter Verwendung eines Sauerstoffplasmas oder dergleichen, entfernt werden. Nachdem das Fotoresist entfernt wurde, werden freiliegende Abschnitte der Keimschicht entfernt, wie beispielsweise unter Verwendung eines annehmbaren Ätzprozesses, wie beispielsweise durch Nass- oder Trockenätzen. Die übrigen Abschnitte der Keimschicht und des leitfähigen Materials bilden die Metallisierungsstruktur und Durchkontaktierungen für eine Metallisierungsebene der Vorderseiten-Umverteilungsstruktur
142 . - Die Vorderseiten-Umverteilungsstruktur
142 ist als ein Beispiel gezeigt. Es können mehr oder weniger dielektrische Schichten und Metallisierungsstrukturen als gezeigt in der Vorderseiten-Umverteilungsstruktur142 gebildet werden. Der Durchschnittsfachmann wird ohne Weiteres verstehen, welche Schritte und Prozesse weggelassen oder wiederholt würden, um mehr oder weniger dielektrische Schichten und Metallisierungsstrukturen zu bilden. - Die obere dielektrische Schicht der Vorderseiten-Umverteilungsstruktur
142 wird strukturiert, um Abschnitte der Metallisierungsstrukturen für die Bildung von leitfähigen Anschlüssen freizulegen. Die leitfähigen Anschlüsse werden verwendet, um sich mit leitfähigen Verbindern zu koppeln und können als Under-Bump-Metallisierungen (UBMs)144 bezeichnet werden. Die Strukturierung kann durch einen annehmbaren Prozess erfolgen, wie beispielsweise Belichten der oberen dielektrischen Schicht mit Licht, wenn die obere dielektrische Schicht ein lichtempfindliches Material ist, oder durch Ätzen unter Verwendung zum Beispiel eines anisotropen Ätzens. Wenn die obere dielektrische Schicht ein lichtempfindliches Material ist, kann die obere dielektrische Schichte nach der Belichtung entwickelt werden. Die UBMs144 werden dann auf der Außenseite der Vorderseiten-Umverteilungsstruktur142 gebildet. Die UBMs144 werden sich durch Öffnungen in der oberen dielektrischen Schicht erstreckend gebildet, um die Metallisierungsschichten der Vorderseiten-Umverteilungsstruktur142 zu kontaktieren. - Als ein Beispiel für die Bildung der UBMs
144 wird eine Keimschicht (nicht gezeigt) über der oberen dielektrischen Schicht und in Öffnungen durch die obere dielektrische Schicht gebildet. In einigen Ausführungsformen ist die Keimschicht eine Metallschicht, die eine Einzelschicht oder eine Verbundschicht sein kann, die mehrere Unterschichten umfasst, die aus verschiedenen Materialien gebildet sind. In einigen Ausführungsformen umfasst die Keimschicht eine Titanschicht und eine Kupferschicht über der Titanschicht. Die Keimschicht kann unter Verwendung eines Abscheidungsprozesses, wie beispielsweise PVD oder dergleichen, gebildet werden. Dann wird ein Fotoresist auf der Keimschicht gebildet und strukturiert. Das Fotoresist kann durch Aufschleudern oder dergleichen gebildet werden und kann zur Strukturierung mit Licht belichtet werden. Die Struktur des Fotoresists entspricht der Struktur der leitfähigen Anschlüsse in der Vorderseiten-Umverteilungsstruktur142 . Die Strukturierung bildet Öffnungen durch das Fotoresist, um die Keimschicht freizulegen. Ein leitfähiges Material wird in den Öffnungen des Fotoresists und auf den freiliegenden Abschnitten der Keimschicht gebildet. Das leitfähige Material kann durch Plattierung, wie beispielsweise Elektroplattierung oder stromlose Plattierung oder dergleichen, gebildet werden. Das leitfähige Material kann ein Metall oder eine Metalllegierung, wie beispielsweise Kupfer, Titan, Wolfram, Aluminium, dergleichen oder Kombinationen davon umfassen. Dann werden das Fotoresist und Abschnitte der Keimschicht, auf denen das leitfähige Material nicht gebildet ist, entfernt. Das Fotoresist kann durch einen annehmbaren Veraschungs- oder Ablösungsprozess, wie beispielsweise unter Verwendung eines Sauerstoffplasmas oder dergleichen, entfernt werden. Nachdem das Fotoresist entfernt wurde, werden freiliegende Abschnitte der Keimschicht entfernt, wie beispielsweise unter Verwendung eines annehmbaren Ätzprozesses, wie beispielsweise durch Nass- oder Trockenätzen. Die übrigen Abschnitte der Keimschicht und des leitfähigen Materials bilden die UBMs144 . - Auf den UBMs
144 werden leitfähige Verbinder146 gebildet. Die leitfähigen Verbinder146 können BGA-Verbinder, Lötkugeln, Metallsäulen, Controlled-Collapse-Chip-Connection-Kontakthöcker (C4), mit Electroless Nickel-Electroless Palladium-Immersion Gold (ENEPIG) Technik gebildete Kontakthöcker oder dergleichen sein. Die leitfähigen Verbinder146 können aus einem Metall oder einer Metalllegierung, wie beispielsweise Lot, Kupfer, Aluminium, Gold, Nickel, Silber, Palladium, Zinn, dergleichen oder einer Kombination davon gebildet werden. In einigen Ausführungsformen werden die leitfähigen Verbinder146 durch anfängliches Bilden einer Schicht aus Lot durch so allgemein verwendete Verfahren wie beispielsweise Aufdampfen, Elektroplattierung, Drucken, Lotzufuhr, Kugelplatzierung oder dergleichen gebildet werden. Nachdem eine Lotschicht auf der Struktur gebildet wurde, kann ein Reflow durchgeführt werden, um das Material in die gewünschten Kontakthöckerformen zu formen. In einer anderen Ausführungsform sind die leitfähigen Verbinder146 Metallsäulen (wie beispielsweise eine Kupfersäule), die durch ein Sputtern, Drucken, Elektroplattierung, stromlose Plattierung, CVD oder dergleichen gebildet werden. Die Metallsäulen können lotfrei sein und weisen im Wesentlichen vertikale Seitenwände auf. In einigen Ausführungsformen wird eine Metalldeckschicht (nicht gezeigt) auf der Oberseite der UBMs144 gebildet. Die Metalldeckschicht kann Nickel, Zinn, Zinn-Blei, Gold, Silber, Palladium, Indium, Nickel-Palladium-Gold, Nickel-Gold, dergleichen oder eine Kombination davon umfassen und kann durch einen Plattierungsprozess gebildet werden. - In
13 wird eine Trägersubstratablösung durchgeführt, um das Trägersubstrat100 von der Rückseiten-Umverteilungsstruktur116 , z. B. der dielektrischen Schicht104 , zu entfernen (abzulösen). Gemäß einigen Ausführungsformen umfasst die Ablösung das Projizieren eines Lichts, wie beispielsweise eines Laserlichts oder eines UV-Lichts, auf die Ablöseschicht102 , derart, dass sich die Ablöseschicht102 unter der Hitze des Lichtes zersetzt und das Trägersubstrat100 entfernt werden kann. Die Struktur wird dann umgedreht und auf dem Band148 platziert. - Ferner werden in
13 die Öffnungen150 durch die dielektrische Schicht104 gebildet, um Abschnitte der Metallisierungsstruktur108 freizulegen. Die Öffnungen können zum Beispiel unter Verwendung von Laserbohren, annehmbaren Ätztechniken oder dergleichen gebildet werden. Die ersten Öffnungen150A werden durch Freilegen der ersten Umverteilungsleitungen108A gebildet und die zweiten Öffnungen150B werden durch Freilegen der zweiten Umverteilungsleitungen108B gebildet. Die ersten Öffnungen150A werden von den Mitten der ersten Durchkontaktierungen122A versetzt gebildet, derart, dass die ersten Öffnungen150A in einem Abstand Do von Abschnitten der ersten Durchkontaktierungen122A in der dielektrischen Schicht112 angeordnet werden. Die zweiten Öffnungen150B werden zentriert unter den zweiten Durchkontaktierungen122B gebildet, derart, dass die Keimschicht118 und Abschnitte der Keimschicht106 , die sich durch die zweiten Umverteilungsleitungen108B erstrecken, freiliegen. - In
14 werden Abschnitte der Keimschichten106 und118 , die durch die Öffnungen150 freiliegen, verdünnt oder vollständig entfernt. Die freiliegenden Abschnitte der Keimschichten106 und118 können durch einen annehmbaren Ätzprozess verdünnt oder entfernt werden, wie beispielsweise durch Nass- oder Trockenätzen. In Ausführungsformen, in denen die Keimschichten106 und118 mehrere Schichten umfassen, kann der Ätzprozess einige oder alle von den freiliegenden mehreren Schichten entfernen. In Ausführungsformen, in denen die Keimschichten106 und118 eine Titanschicht über der dielektrischen Schicht104 und eine Kupferschicht über der Titanschicht umfassen, kann der Ätzprozess die Titanschicht entfernen und die Kupferschicht intakt lassen, wodurch die Schicht verdünnt wird. In solchen Ausführungsformen wird der Ätzprozess mit einem oder mehreren Ätzmitteln durchgeführt, die für die Titanschicht selektiv sind (die z. B. die Titanschicht mit einer im Wesentlichen höheren Rate ätzen als die Kupferschicht). In anderen Ausführungsformen werden die freiliegenden Abschnitte der Keimschichten106 und118 vollständig entfernt (z. B. werden alle Schichten entfernt). -
15 bis18 sind verschiedene Ansichten von Zwischenschritten während eines Prozesses zum Bilden einer Package-Struktur400 gemäß einigen Ausführungsformen.15 bis18 sind Querschnittsansichten. Die Package-Struktur400 kann als eine Package-on-Package-Struktur (PoP) bezeichnet werden. - In
15 wird ein Vorrichtungspackage300 an das Vorrichtungspackage200 gebondet. Das Vorrichtungspackage300 kann in jedem Package-Gebiet600 an das Vorrichtungspackage200 gebondet werden. Das Vorrichtungspackage300 umfasst ein Substrat302 und einen oder mehrere gestapelte Dies308 (308A und308B ), die an das Substrat302 gekoppelt sind. Obwohl ein einziger Stapel von Dies308 (308A und308B ) veranschaulicht ist, können in anderen Ausführungsformen mehrere gestapelte Dies308 (die jeweils einen oder mehrere gestapelte Dies aufweisen) nebeneinander angeordnet an eine selbe Fläche des Substrats302 gekoppelt sein. - Das Substrat
302 kann aus einem Halbleitermaterial, wie beispielsweise Silizium, Germanium, Diamant oder dergleichen bestehen. In einigen Ausführungsformen können auch Verbundmaterialien, wie beispielsweise Siliziumgermanium, Siliziumcarbid, Galliumarsenid, Indiumarsenid, Indiumphosphid, Siliziumgermaniumcarbid, Galliumarsenidphosphid, Galliumindiumphosphid, Kombinationen davon und dergleichen verwendet werden. Darüber hinaus kann das Substrat302 ein Silicon-on-Insulator-Substrat (SOI) sein. Allgemein umfasst ein SOI-Substrat eine Schicht aus einem Halbleitermaterial, wie beispielsweise epitaktischem Silizium, Germanium, Siliziumgermanium, SOI, Silicon Germanium On Insulator (SGOI) oder Kombinationen davon. Das Substrat302 basiert in einer alternativen Ausführungsform auf einem Isolierkern, wie beispielsweise einem glasfaserverstärkten Harzkern. Ein beispielhaftes Kernmaterial ist Glasfaserharz wie beispielsweise FR4. Alternativen für das Kernmaterial umfassen Bismaleimidtriazinharz (BT) oder alternativ andere gedruckte Leiterplattenmaterialien (PCB) oder dünne Schichten. Dünne Aufbauschichten, wie beispielsweise Ajinomoto Build-up Film (ABF) oder andere Laminate, können für das Substrat302 verwendet werden. - Das Substrat
302 kann aktive und/oder passive Vorrichtungen (nicht gezeigt) umfassen. Wie ein Durchschnittsfachmann erkennen wird, kann eine große Vielzahl von Vorrichtungen, wie beispielsweise Transistoren, Kondensatoren, Widerstände, Kombinationen davon und dergleichen verwendet werden, um die strukturellen und funktionellen Anforderungen der Gestaltung für das Vorrichtungspackage300 zu erzeugen. Die Vorrichtungen können unter Verwendung von irgendwelchen zweckmäßigen Verfahren gebildet werden. - Das Substrat
302 kann auch Metallisierungsschichten (nicht gezeigt) und durchgehende Durchkontaktierungen306 umfassen. Die Metallisierungsschichten können über den aktiven und passiven Vorrichtungen gebildet werden und werden gestaltet, um die verschiedenen Vorrichtungen zu verbinden, um funktionale Schaltungen zu bilden. Die Metallisierungsschichten können aus abwechselnden Schichten von Dielektrikum (z. B. Low-K-Dielektrikum) und leitfähigem Material (z. B. Kupfer) mit Durchkontaktierungen gebildet werden, die die Schichten aus leitfähigem Material zusammenschalten und durch irgendeinen geeigneten Prozess (wie beispielsweise Abscheidung, Damascene, Dual Damascene oder dergleichen) gebildet werden können. In einigen Ausführungsformen ist das Substrat302 im Wesentlichen frei von aktiven und passiven Vorrichtungen. - Das Substrat
302 kann Bondinseln303 auf einer ersten Seite des Substrats202 , um sich an die gestapelten Dies308 zu koppeln, und Bondinseln304 auf einer zweiten Seite des Substrats302 aufweisen, wobei die zweite Seite der ersten Seite des Substrats302 entgegengesetzt ist, um sich an die leitfähigen Verbinder314 zu koppeln. In einigen Ausführungsformen werden die Bondinseln303 und304 durch Bilden von Aussparungen (nicht gezeigt) in dielektrische Schichten (nicht gezeigt) auf den ersten und zweiten Seiten des Substrats302 gebildet. Die Aussparungen können gebildet werden, um das Einbetten der Bondinseln303 und304 in die dielektrischen Schichten zu ermöglichen. In anderen Ausführungsformen werden die Aussparungen weggelassen, da die Bondinseln303 und304 auf der dielektrischen Schicht gebildet werden können. In einigen Ausführungsformen umfassen die Bondinseln303 und304 eine dünne Keimschicht (nicht gezeigt), die aus Kupfer, Titan, Nickel, Gold, Palladium, dergleichen oder einer Kombination davon hergestellt wird. Das leitfähige Material der Bondinseln303 und304 kann über der dünnen Keimschicht abgeschieden werden. Das leitfähige Material kann durch einen elektrochemischen Plattierungsprozess, einen stromlosen Plattierungsprozess, CVD, ALD, PVD, dergleichen oder eine Kombination davon gebildet werden. Das leitfähige Material der Bondinseln303 und304 kann Kupfer, Wolfram, Aluminium, Silber, Gold, Nickel, dergleichen oder eine Kombination davon sein. - In einer Ausführungsform sind die Bondinseln
303 und304 UBMs, die drei Schichten aus leitfähigen Materialien, wie beispielsweise eine Schicht aus Titan, eine Schicht aus Kupfer und eine Schicht aus Nickel, umfassen. Zum Beispiel können die Bondinseln304 eine Schicht aus Titan (nicht gezeigt), einen Hauptabschnitt304A aus Kupfer und eine Nickeloberflächenausführung304B umfassen. Die Nickeloberflächenausführung304B kann die Haltbarkeit des Vorrichtungspackages300 verbessern, was besonders vorteilhaft sein kann, wenn das Vorrichtungspackage300 eine Speichervorrichtung, wie beispielsweise ein DRAM-Modul ist. Der Durchschnittsfachmann wird indes erkennen, dass viele geeignete Anordnungen von Materialien und Schichten bestehen, wie beispielsweise eine Anordnung von Chrom/Chrom-Kupfer-Legierung/Kupfer/Gold, eine Anordnung von Titan/Titan-Wolfram/Kupfer oder eine Anordnung von Kupfer/Nickel/Gold, die sich zur Bildung der UBMs303 und304 eignen. Es versteht sich, dass beabsichtigt wird, dass irgendwelche geeigneten Materialien oder Schichten aus Material, die für die UBMs303 und304 verwendet werden können, vollständig innerhalb des beabsichtigten Schutzumfangs der vorliegenden Anmeldung umfasst sind. In einigen Ausführungsformen erstrecken sich die durchgehenden Durchkontaktierungen306 durch das Substrat302 und koppeln mindestens eine Bondinsel303 an mindestens eine Bondinsel304 . - In der veranschaulichten Ausführungsform werden die gestapelten Dies
308 durch Drahtbonds310 an das Substrat302 gekoppelt, obgleich auch andere Verbindungen, wie beispielsweise leitfähige Kontakthöcker, verwendet werden können. In einer Ausführungsform sind die gestapelten Dies308 gestapelte Speicher-Dies. Zum Beispiel können die gestapelten Speicher-Dies308 Low-Power (LP) Double Data Rate (DDR) Speichermodule, wie beispielsweise LPDDR1, LPDDR2, LPDDR3, LPDDR4 oder ähnliche Speichermodule umfassen. Wie vorhergehend erwähnt, können die Bondinseln304 in solchen Ausführungsformen eine Nickeloberflächenausführung304B aufweisen. - In einigen Ausführungsformen können die gestapelten Dies
308 und die Drahtbonds310 durch ein Formmaterial312 eingekapselt werden. Das Formmaterial312 kann auf den gestapelten Dies308 und den Drahtbonds310 , zum Beispiel unter Verwendung von Formpressen, geformt werden. In einigen Ausführungsformen ist das Formmaterial312 eine Formmasse, ein Polymer, ein Epoxid, Siliziumoxid-Füllstoffmaterial, dergleichen oder eine Kombination davon. Ein Aushärtungsschritt kann durchgeführt werden, um das Formmaterial312 auszuhärten, wobei das Aushärten ein thermisches Aushärten, ein UV-Aushärten, dergleichen oder eine Kombination davon sein kann. - In einigen Ausführungsformen werden die gestapelten Dies
308 und die Drahtbonds310 in dem Formmaterial312 vergraben und nach dem Aushärten des Formmaterials312 wird ein Planarisierungsschritt, wie beispielsweise Schleifen, durchgeführt, um überschüssige Abschnitte des Formmaterials312 zu entfernen und eine im Wesentlichen ebene Fläche für das Vorrichtungspackage300 bereitzustellen. - Nachdem das Vorrichtungspackage
300 gebildet wurde, wird das Vorrichtungspackage300 mechanisch und elektrisch mittels leitfähigen Verbindern314 , den Bondinseln304 und der Metallisierungsstruktur108 an das Vorrichtungspackage200 gebondet. In einigen Ausführungsformen werden die gestapelten Speicher-Dies308 durch die Drahtbonds310 , Bondinseln303 und304 , durchgehenden Durchkontaktierungen306 , leitfähigen Verbinder314 , durchgehenden Durchkontaktierungen122 und die Vorderseiten-Umverteilungsstruktur142 an die integrierten Schaltungsdies124 gekoppelt. - Die leitfähigen Verbinder
314 können den vorhergehend beschriebenen leitfähigen Verbindern146 ähnlich sein und die Beschreibung wird hier nicht wiederholt, obgleich die leitfähigen Verbinder314 und die leitfähigen Verbinder146 nicht die gleichen sein müssen. Die leitfähigen Verbinder314 können auf einer den gestapelten Speicherdies308 entgegengesetzten Seite des Substrats302 angeordnet sein. In einigen Ausführungsformen kann auch ein Lötstopplack (nicht gezeigt) auf der Seite des Substrats302 gebildet werden, die den gestapelten Speicherdies308 entgegengesetzt ist. Die leitfähigen Verbinder314 können in Öffnungen in dem Lötstopplack (nicht gezeigt) angeordnet werden, um elektrisch und mechanisch an leitfähige Merkmale (z. B. die Bondinseln304 ) in dem Substrat302 gekoppelt zu werden. Der Lötstopplack kann verwendet werden, um Bereiche des Substrats302 vor äußerer Beschädigung zu schützen. - In einigen Ausführungsformen werden vor dem Bonden der leitfähigen Verbinder
314 die leitfähigen Verbinder314 mit einem Flussmittel (nicht gezeigt), wie beispielsweise einem rückstandsfreien Flussmittel, beschichtet. Die leitfähigen Verbinder314 können in das Flussmittel eingetaucht werden oder das Flussmittel kann auf die leitfähigen Verbinder314 gestrahlt werden. In einer anderen Ausführungsform kann das Flussmittel auf die Flächen der Metallisierungsstrukturen108 aufgebracht werden. - In einigen Ausführungsformen können die leitfähigen Verbinder
314 ein wahlfreies Epoxidflussmittel (nicht gezeigt) aufweisen, das darauf gebildet ist, bevor sie mit mindestens etwas von dem Epoxidabschnitt des Epoxidflussmittels reflow-gelötet werden, nachdem das Vorrichtungspackage300 an dem Vorrichtungspackage200 angebracht wurde. Dieser übrige Epoxidabschnitt kann als ein Füllmaterial wirken, um Spannungen zu verringern und die Verbindungen, die aus dem Reflow der leitfähigen Verbinder314 entstehen, zu schützen. - Wahlfrei kann ein Füllmaterial
316 zwischen den Vorrichtungspackages200 und300 gebildet werden. In einer Ausführungsform ist das Füllmaterial316 ein Schutzmaterial, das verwendet wird, um die Vorrichtungspackages200 und300 vor Verschlechterung des Zustands durch Betrieb und Umwelt, wie beispielsweise Spannungen, die durch die Erzeugung von Hitze während des Betriebs verursacht werden, zu polstern und zu unterstützen. Das Füllmaterial316 kann in dem Raum zwischen den Vorrichtungspackages200 und300 eingespritzt oder auf eine andere Art darin gebildet werden und kann zum Beispiel ein flüssiges Epoxid sein, das zwischen den Vorrichtungpackages200 und300 abgegeben wird und dann ausgehärtet wird, um hart zu werden. -
16A ,16B ,16C und16D sind detaillierte Ansichten der leitfähigen Verbinder314 und Metallisierungsstrukturen108 , nachdem ein Prozess zum Bonden durchgeführt wurde, um die Vorrichtungspackages200 und300 physikalisch und elektrisch zu koppeln. Das Bonden zwischen den Vorrichtungspackages200 und300 kann Lötbonden sein. In einer Ausführungsform wird das Vorrichtungspackage300 durch einen Reflow-Prozess an das Vorrichtungspackage200 gebondet.16A und16B sind Querschnitts- beziehungsweise Draufsichten, die eine Verbindung für die ersten Umverteilungsleitungen108A zeigen.16C und16D sind Querschnittsbeziehungsweise Draufsichten, die eine Verbindung für die zweiten Umverteilungsleitungen108B zeigen. - In
16A ,16B ,16C und16D wird der Prozess zum Bonden durchgeführt, um ein Reflow der leitfähigen Verbinder314 durchzuführen, derart, dass sie mit den Bondinseln304 und Metallisierungsstrukturen108 in Kontakt sind. Nach dem Prozess zum Bonden kann sich eine intermetallische Verbindung (Intermetallic Compound - IMC) 318 an Grenzflächen der Metallisierungsstrukturen108 und leitfähigen Verbinder314 bilden. Da die freiliegenden Abschnitte der Keimschichten106 und118 teilweise oder vollständig entfernt wurden, kann die IMC318 sich teilweise oder vollständig durch die Metallisierungsstrukturen108 erstrecken. Die IMC318 kann sich auch über einen AbstandDI seitlich entlang der Metallisierungsstrukturen108 von Seiten der ersten Öffnungen150 erstrecken. - Die Bonds, die durch den Prozess zum Bonden gebildet werden, umfassen die leitfähigen Verbinder
314 (z. B. Lot), die zwei unterschiedliche Metalle kontaktieren. In einer Ausführungsform werden die Metallisierungsstrukturen108 aus Kupfer gebildet und die Bondinseln304 weisen eine Nickeloberflächenausführung304B auf, was Nickel-Lot-Kupfer-Verbindungen ergibt. Wenn solche Verbindungen gebildet werden, diffundiert Kupfer während des Reflows von den Metallisierungsstrukturen108 in die leitfähigen Verbinder314 und in Richtung der Nickeloberflächenausführung304B . Ein Gradient von diffundiertem Kupfer wird in den leitfähigen Verbindern314 in der Richtung der durchgezogenen Pfeile gebildet. Eine übermäßige Diffusion von Kupfer von den Metallisierungsstrukturen108 in der Nähe der Keimschichten118 kann die Ablösung der Keimschicht118 von den Metallisierungsstrukturen108 verursachen. Insbesondere kann die Diffusion von Kupfer von Abschnitten der Metallisierungsstrukturen108 zwischen den Keimschichten118 und der dielektrischen Schicht104 die Ablösung der Keimschichten118 verursachen. - In
16A und16B sind die ersten Öffnungen150A in der dielektrischen Schicht104 seitlich in einen AbstandDO von Abschnitten der ersten Durchkontaktierungen122A in der dielektrischen Schicht112 angeordnet. An sich sind die leitfähigen Verbinder314 in einer Draufsicht seitlich im Abstand Do von Seiten der ersten Durchkontaktierungen122A angeordnet und sind nicht entlang der Längsachsen der ersten Durchkontaktierungen122A angeordnet. Der Durchmesser Do wird gewählt, um ausreichend groß zu sein, derart, dass die IMC318A sich nicht seitlich zu Seiten der ersten Durchkontaktierungen122A erstreckt. Mit anderen Worten, der AbstandDO ist größer als der AbstandDI und kann mindestens zweimal so groß wie der AbstandDI sein. In einer Ausführungsform kann der AbstandDI von etwa 2 µm bis etwa 13 µm, wie beispielsweise etwa 13 µm, betragen, und der AbstandDO kann von etwa 25 µm bis etwa 35 µm, wie beispielsweise etwa 35 µm, betragen. Das Bilden der ersten Öffnungen150A (siehe z. B.13 ), derart, dass die IMC318A sich nicht seitlich zu Seiten der ersten Durchkontaktierungen122A erstrecken, kann die Diffusion von Kupfer von Abschnitten der ersten Umverteilungsleitungen108A zwischen den Keimschichten118 und der dielektrischen Schicht104 vermeiden, wodurch die Ablösung der Keimschichten118 vermieden wird. - In
16C und16D werden die zweiten Öffnungen150B in der dielektrischen Schicht104 seitlich mit den Lücken110 in den zweiten Umverteilungsleitungen108B ausgerichtet. An sich sind die leitfähigen Verbinder314 in einer Draufsicht nicht seitlich von Seiten der zweiten Durchkontaktierungen122B beabstandet und sind entlang der Längsachsen der zweiten Durchkontaktierungen122B angeordnet. Da die freiliegenden Abschnitte der Keimschichten106 und118 teilweise oder vollständig entfernt wurden, erstreckt sich die IMC318 in einer Längsrichtung in die zweiten Durchkontaktierungen122B . Das Bilden der IMC318B derart, dass sie sich in die zweiten Durchkontaktierungen122B erstreckt, kann ergeben, dass etwas von dem diffundierten Kupfer von den zweiten Durchkontaktierungen122B anstatt den Metallisierungsstrukturen108 bezogen wird. Dies kann das Kupfer verringern, das von den Metallisierungsstrukturen108 diffundiert wird, wodurch die Ablösung der Keimschichten118 vermieden wird und auch die Verringerung der Dicke der zweiten Umverteilungsleitungen108B vermieden wird. - Wie weiter gezeigt, umfasst die Metallisierungsstruktur
108 Schlitze322 , die um den Umfang der leitfähigen Verbinder314 und der durchgehenden Durchkontaktierungen122 angeordnet sind. Die Schlitze322 stellen einen Spannungsabbau bereit, wodurch die Zuverlässigkeit der elektrischen Verbindungen verbessert wird. Insbesondere stellen die Schlitze322 zusätzliche Seitenwände für die Metallisierungsstrukturen108 bereit, wodurch die Haftung zwischen den Metallisierungsstrukturen108 und Polyimidmaterialien, wie beispielsweise der dielektrischen Schicht112 , verbessert werden. Die Schlitze322 sind zumindest teilweise um die leitfähigen Verbinder314 in den ersten Umverteilungsleitungen108A angeordnet und können vollständig um die leitfähigen Verbinder314 in den zweiten Umverteilungsleitungen108B angeordnet sein. - In
17 wird ein Vereinzelungsprozess320 durch Vereinzeln entlang Ritzrahmengebieten, z. B. zwischen benachbarten Packagegebieten, durchgeführt. In einigen Ausführungsformen umfasst der Vereinzelungsprozess320 einen Sägeprozess, einen Laser-Prozess oder eine Kombination davon. Der Vereinzelungsprozess320 vereinzelt das Packagegebiet600 von benachbarten Packagegebieten (nicht gezeigt). Die resultierende Package-Struktur400 ist nach der Vereinzelung gezeigt, die von dem Package-Gebiet600 sein kann. -
18 zeigt die Package-Struktur400 , nachdem sie an einem Substrat500 angebracht wurde. Das Substrat500 kann als ein Package-Substrat500 bezeichnet werden. Das Package-Substrat400 wird durch Montieren des Vorrichtungspackages200 an dem Substrat500 unter Verwendung der leitfähigen Verbindungen146 an dem Substrat500 angebracht. - Das Package-Substrat
500 kann aus einem Halbleitermaterial, wie beispielsweise Silizium, Germanium, Diamant oder dergleichen bestehen. Alternativ können auch Verbundmaterialien, wie beispielsweise Siliziumgermanium, Siliziumcarbid, Galliumarsenid, Indiumarsenid, Indiumphosphid, Siliziumgermaniumcarbid, Galliumarsenidphosphid, Galliumindiumphosphid, Kombinationen davon und dergleichen verwendet werden. Darüber hinaus kann das Package-Substrat500 ein SOI-Substrat sein. Allgemein umfasst ein SOI-Substrat eine Schicht aus einem Halbleitermaterial, wie beispielsweise epitaktisches Silizium, Germanium, Siliziumgermanium, SOI, SGOI oder Kombinationen davon. Das Package-Substrat500 basiert in einer alternativen Ausführungsform auf einem Isolierkern, wie beispielsweise einem glasfaserverstärkten Harzkern. Ein beispielhaftes Kernmaterial ist Glasfaserharz wie beispielsweise FR4. Alternativen für das Kernmaterial umfassen Bismaleimidtriazinharz (BT) oder alternativ andere PCB-Materialien oder dünne Schichten. Dünne Aufbauschichten, wie beispielsweise ABF oder andere Laminate, können für das Package-Substrat500 verwendet werden. - Das Package-Substrat
500 kann aktive und passive Vorrichtungen (nicht gezeigt) umfassen. Wie ein Durchschnittsfachmann erkennen wird, kann eine große Vielzahl von Vorrichtungen, wie beispielsweise Transistoren, Kondensatoren, Widerstände, Kombinationen davon und dergleichen verwendet werden, um die strukturellen und funktionellen Anforderungen der Gestaltung für die Package-Struktur400 zu erzeugen. Die Vorrichtungen können unter Verwendung von irgendwelchen zweckmäßigen Verfahren gebildet werden. - Das Package-Substrat
500 kann auch Metallisierungsschichten und Durchkontaktierungen (nicht gezeigt) und Bondinseln502 über den Metallisierungsschichten und Durchkontaktierungen umfassen. Die Metallisierungsschichten können über den aktiven und passiven Vorrichtungen gebildet werden und werden gestaltet, um die verschiedenen Vorrichtungen zu verbinden, um funktionale Schaltungen zu bilden. Die Metallisierungsschichten können aus abwechselnden Schichten von Dielektrikum (z. B. Low-K-Dielektrikum) und leitfähigem Material (z. B. Kupfer) mit Durchkontaktierungen gebildet werden, die die Schichten aus leitfähigem Material zusammenschalten und durch irgendeinen geeigneten Prozess (wie beispielsweise Abscheidung, Damascene, Dual Damascene oder dergleichen) gebildet werden können. In einigen Ausführungsformen ist das Package-Substrat500 im Wesentlichen frei von aktiven und passiven Vorrichtungen. - In einigen Ausführungsformen werden die leitfähigen Verbinder
146 reflow-gelötet, um das Vorrichtungspackage200 an den Bondinseln502 anzubringen. Die leitfähigen Verbinder146 koppeln das Package-Substrat500 einschließlich Metallisierungsschichten in dem Package-Substrat500 elektrisch und/oder physikalisch an das Vorrichtungspackage200 . In einigen Ausführungsformen können passive Vorrichtungen (z. B. oberflächenmontierte Vorrichtungen (Surface Mount Devices - SMDs), die nicht veranschaulicht sind) vor dem Montieren an dem Package-Substrat500 an dem Vorrichtungspackage200 angebracht (z. B. an die Bondinseln502 gebondet werden). In solchen Ausführungsformen können die passiven Vorrichtungen an eine gleiche Fläche des Vorrichtungspackages200 gebondet werden wie die leitfähigen Verbinder146 . - Die leitfähigen Verbinder
146 können ein Epoxidflussmittel (nicht gezeigt) aufweisen, das darauf gebildet ist, bevor sie mit mindestens etwas von dem Epoxidabschnitt des Epoxidflussmittels reflow-gelötet werden, das übrig ist, nachdem das Vorrichtungspackage200 an dem Package-Substrat500 angebracht wurde. Dieser übrige Epoxidabschnitt kann als ein Füllmaterial wirken, um Spannungen zu verringern und die Verbindungen, die aus dem Reflow der leitfähigen Verbinder146 entstehen, zu schützen. In einigen Ausführungsformen kann ein Füllmaterial (nicht gezeigt) zwischen dem Vorrichtungspackage200 und dem Package-Substrat500 und die leitfähigen Verbinder146 umgebend gebildet werden. Das Füllmaterial kann durch einen Kapillarströmungsprozess gebildet werden, nachdem das Vorrichtungspackage200 angebracht wurde, oder kann durch ein geeignetes Abscheidungsverfahren gebildet werden, bevor das Vorrichtungspackage200 angebracht wird. - Mit Ausführungsformen können Vorteile bewerkstelligt werden. Durch das seitliche Anordnen der leitfähigen Verbinder
314 mit einem ausreichenden Abstand Do von Seiten der ersten Durchkontaktierungen122A in einer Draufsicht kann die Diffusion von Kupfer von den Metallisierungsstrukturen108 in der Nähe der Keimschichten118 vermieden werden. Das Bilden der IMC318B derart, dass sie sich in die zweiten Durchkontaktierungen122B erstreckt, kann ergeben, dass etwas von dem diffundierten Kupfer von den zweiten Durchkontaktierungen122B anstatt den Metallisierungsstrukturen108 bezogen wird. Durch das Verringern der Menge an Kupfer, die von den Metallisierungsstrukturen108 unter den Keimschichten118 diffundiert wird, kann die Ablösung der Keimschichten118 vermieden werden, wodurch die Zuverlässigkeit der resultierenden Vorrichtungen verbessert wird. - Gemäß einigen Ausführungsformen umfasst eine Vorrichtung Folgendes: ein erstes Vorrichtungspackage, das Folgendes umfasst: eine erste Umverteilungsstruktur, die eine erste Umverteilungsleitung und eine zweite Umverteilungsleitung umfasst; ein Die auf der ersten Umverteilungsstruktur; eine erste Durchkontaktierung, die an eine erste Seite der ersten Umverteilungsleitung gekoppelt ist; eine zweite Durchkontaktierung, die an eine erste Seite der zweiten Umverteilungsleitung gekoppelt ist und sich durch die zweite Umverteilungsleitung erstreckt; eine Einkapselung, die den Die, die erste Durchkontaktierung und die zweite Durchkontaktierung umgibt; und eine zweite Umverteilungsstruktur über der Einkapselung, wobei die zweite Umverteilungsstruktur elektrisch mit dem Die, der ersten Durchkontaktierung und der zweiten Durchkontaktierung verbunden ist; einen ersten leitfähigen Verbinder, der an eine zweite Seite der ersten Umverteilungsleitung gekoppelt ist, wobei der erste leitfähige Verbinder entlang einer unterschiedlichen Achse als einer Längsachse der ersten Durchkontaktierung angeordnet ist; und einen zweiten leitfähigen Verbinder, der an eine zweite Seite der zweiten Umverteilungsleitung gekoppelt ist, wobei der zweite leitfähige Verbinder entlang einer Längsachse der zweiten Durchkontaktierung angeordnet ist.
- In einigen Ausführungsformen umfasst die Vorrichtung ferner Folgendes: ein zweites Vorrichtungspackage, das eine erste Bondinsel und eine zweite Bondinsel umfasst, wobei der erste leitfähige Verbinder an die erste Bondinsel gekoppelt ist, wobei der zweite leitfähige Verbinder an die zweite Bondinsel gekoppelt ist. In einigen Ausführungsformen weisen die erste Bondinsel und die zweite Bondinsel eine Nickeloberflächenausführung auf. In einigen Ausführungsformen sind die erste Umverteilungsleitung und die zweite Umverteilungsleitung aus Kupfer gebildet. In einigen Ausführungsformen umfasst die erste Umverteilungsstruktur ferner Folgendes: eine erste dielektrische Schicht, wobei die erste Umverteilungsleitung und die zweite Umverteilungsleitung auf der ersten dielektrischen Schicht angeordnet sind; und eine zweite dielektrische Schicht auf der ersten dielektrischen Schicht. In einigen Ausführungsformen ist die zweite Durchkontaktierung länger als die erste Durchkontaktierung.
- Gemäß einigen Ausführungsformen umfasst ein Verfahren Folgendes: Bilden einer ersten Umverteilungsstruktur, die Folgendes umfasst: Abscheiden einer ersten dielektrischen Schicht über einem Trägersubstrat; Bilden eines ersten leitfähigen Merkmals auf der ersten dielektrischen Schicht; Bilden eines zweiten leitfähigen Merkmals auf der ersten dielektrischen Schicht; Bilden eines dritten leitfähigen Merkmals auf der ersten dielektrischen Schicht; und Abscheiden einer zweiten dielektrischen Schicht auf dem ersten leitfähigen Merkmal, dem zweiten leitfähigen Merkmal und dem dritten leitfähigen Merkmal; Bilden einer ersten Durchkontaktierung auf dem ersten leitfähigen Merkmal; Bilden einer zweiten Durchkontaktierung auf dem zweiten leitfähigen Merkmal, auf dem dritten leitfähigen Merkmal und zwischen dem zweiten leitfähigen Merkmal und dem dritten leitfähigen Merkmal; Anbringen eines Dies an der ersten Umverteilungsstruktur, die der ersten Durchkontaktierung und der zweiten Durchkontaktierung benachbart ist; Einkapseln des Dies, der ersten Durchkontaktierung und der zweiten Durchkontaktierung mit einer Einkapselung; Planarisieren der Einkapselung, der ersten Durchkontaktierung und der zweiten Durchkontaktierung; und Bilden einer zweiten Umverteilungsstruktur über der Einkapselung, der ersten Durchkontaktierung, der zweiten Durchkontaktierung und dem Die.
- In einigen Ausführungsformen umfasst das Verfahren ferner Folgendes: Ablösen des Trägersubstrats von der ersten Umverteilungsstruktur; und Anbringen eines Vorrichtungspackages an der ersten Umverteilungsstruktur, wobei das Vorrichtungspackage mit einem ersten Verbinder an dem ersten leitfähigen Merkmal angebracht ist, wobei das Vorrichtungspackage mit einem zweiten Verbinder an dem zweiten leitfähigen Merkmal und dem dritten leitfähigen Merkmal angebracht ist. In einigen Ausführungsformen ist der erste Verbinder nicht entlang einer Längsachse der ersten Durchkontaktierung angeordnet. In einigen Ausführungsformen ist der zweite Verbinder entlang einer Längsachse der zweiten Durchkontaktierung angeordnet. In einigen Ausführungsformen ist die erste Durchkontaktierung nach dem Planarisieren länger als die zweite Durchkontaktierung.
- Gemäß einigen Ausführungsformen umfasst ein Verfahren Folgendes: Abscheiden einer ersten Keimschicht auf einer ersten dielektrischen Schicht; Plattierung eines ersten leitfähigen Merkmals und eines zweiten leitfähigen Merkmals auf der ersten Keimschicht; Abscheiden einer zweiten dielektrischen Schicht auf dem ersten leitfähigen Merkmal und dem zweiten leitfähigen Merkmal; Bilden einer ersten Öffnung in der zweiten dielektrischen Schicht, wobei die erste Öffnung das erste leitfähige Merkmal, das zweite leitfähige Merkmal und die erste dielektrische Schicht freilegt; Abscheiden einer zweiten Keimschicht auf der zweiten dielektrischen Schicht und in der ersten Öffnung; Plattierung einer ersten Durchkontaktierung von Abschnitten der zweiten Keimschicht in der ersten Öffnung; Anbringen eines Dies an der zweiten dielektrischen Schicht; und Einkapseln der ersten Durchkontaktierung und des Dies mit einer Einkapselung.
- In einigen Ausführungsformen umfasst das Verfahren ferner Folgendes: Bilden einer zweiten Öffnung in der ersten dielektrischen Schicht, wobei die zweite Öffnung die erste Keimschicht und die zweite Keimschicht freilegt; Bilden eines reflow-fähigen Materials in der zweiten Öffnung, wobei das reflow-fähige Material entlang einer Längsachse der ersten Durchkontaktierung angeordnet ist; und Reflow des reflow-fähigen Materials zum Bilden einer intermetallischen Verbindung von dem reflow-fähigen Material und leitfähigen Material der ersten Keimschicht, der zweiten Keimschicht und der ersten Durchkontaktierung. In einigen Ausführungsformen umfasst das Verfahren ferner Folgendes: Anbringen eines Vorrichtungspackages an dem ersten leitfähigen Merkmal und dem zweiten leitfähigen Merkmal mit dem reflow-fähigen Material. In einigen Ausführungsformen, umfasst das Reflow des reflow-fähigen Materials das Diffundieren von Abschnitten des leitfähigen Materials der ersten Durchkontaktierung in das reflow-fähige Material. In einigen Ausführungsformen umfasst das Verfahren ferner Folgendes: Bilden eines dritten leitfähigen Merkmals auf der ersten dielektrischen Schicht; Abscheiden der zweiten dielektrischen Schicht auf dem dritten leitfähigen Merkmal; Bilden einer zweiten Öffnung in der zweiten dielektrischen Schicht, wobei die zweite Öffnung das dritte leitfähige Merkmal freilegt; Abscheiden der zweiten Keimschicht in der zweiten Öffnung; und Plattierung einer zweiten Durchkontaktierung von Abschnitten der zweiten Keimschicht in der zweiten Öffnung; In einigen Ausführungsformen umfasst das Verfahren ferner Folgendes: Bilden einer dritten Öffnung in der ersten dielektrischen Schicht, wobei die dritte Öffnung die erste Keimschicht freilegt; Bilden eines reflow-fähigen Materials in der dritten Öffnung, wobei das reflow-fähige Material entlang einer unterschiedlichen Achse als eine Längsachse der zweiten Durchkontaktierung angeordnet ist; und Reflow des reflow-fähigen Materials zum Bilden einer intermetallischen Verbindung von dem reflow-fähigen Material und leitfähigen Material der ersten Keimschicht. In einigen Ausführungsformen umfasst das Reflow des reflow-fähigen Materials das Diffundieren von Abschnitten des leitfähigen Materials des dritten leitfähigen Merkmals in das reflow-fähige Material. In einigen Ausführungsformen wird kein Abschnitt der intermetallischen Verbindung zwischen der zweiten Durchkontaktierung und der ersten dielektrischen Schicht gebildet; In einigen Ausführungsformen umfasst das Verfahren ferner Folgendes: Planarisieren der ersten Durchkontaktierung, der zweiten Durchkontaktierung und der Einkapselung, wobei die erste Durchkontaktierung nach dem Planarisieren länger als die zweite Durchkontaktierung ist.
- Vorhergehend wurden Merkmale von mehreren Ausführungsformen dargestellt, derart, dass der Fachmann die Gesichtspunkte der vorliegenden Offenbarung besser verstehen kann. Der Fachmann sollte verstehen, dass die vorliegende Offenbarung ohne Weiteres als Grundlage zum Gestalten oder Abwandeln anderer Prozesse und Strukturen verwendet werden kann, um die gleichen Zwecke durchzuführen und/oder die gleichen Vorteile der hier eingeführten Ausführungsformen zu erreichen. Der Fachmann sollte auch verstehen, dass solche äquivalenten Konstruktionen nicht vom Gedanken und Schutzbereich der vorliegenden Offenbarung abweichen und dass er verschiedene Änderungen, Ersetzungen und Abwandlungen daran vornehmen kann, ohne vom Gedanken und Schutzbereich der vorliegenden Offenbarung abzuweichen.
- ZITATE ENTHALTEN IN DER BESCHREIBUNG
- Diese Liste der vom Anmelder aufgeführten Dokumente wurde automatisiert erzeugt und ist ausschließlich zur besseren Information des Lesers aufgenommen. Die Liste ist nicht Bestandteil der deutschen Patent- bzw. Gebrauchsmusteranmeldung. Das DPMA übernimmt keinerlei Haftung für etwaige Fehler oder Auslassungen.
- Zitierte Patentliteratur
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- US 62565321 [0001]
Claims (20)
- Vorrichtung, die Folgendes umfasst: ein erstes Vorrichtungspackage, das Folgendes umfasst: eine erste Umverteilungsstruktur, die eine erste Umverteilungsleitung und eine zweite Umverteilungsleitung umfasst; ein Die auf der ersten Umverteilungsstruktur; eine erste Durchkontaktierung, die an eine erste Seite der ersten Umverteilungsleitung gekoppelt ist; eine zweite Durchkontaktierung, die an eine erste Seite der zweiten Umverteilungsleitung gekoppelt ist und sich durch die zweite Umverteilungsleitung erstreckt; eine Einkapselung, die den Die, die erste Durchkontaktierung und die zweite Durchkontaktierung umgibt; und eine zweite Umverteilungsstruktur über der Einkapselung, wobei die zweite Umverteilungsstruktur elektrisch mit dem Die, der ersten Durchkontaktierung und der zweiten Durchkontaktierung verbunden ist; einen ersten leitfähigen Verbinder, der an eine zweite Seite der ersten Umverteilungsleitung gekoppelt ist, wobei der erste leitfähige Verbinder entlang einer unterschiedlichen Achse als einer Längsachse der ersten Durchkontaktierung angeordnet ist; und einen zweiten leitfähigen Verbinder, der an eine zweite Seite der zweiten Umverteilungsleitung gekoppelt ist, wobei der zweite leitfähige Verbinder entlang einer Längsachse der zweiten Durchkontaktierung angeordnet ist.
- Vorrichtung nach
Anspruch 1 , die ferner Folgendes umfasst: ein zweites Vorrichtungspackage, das eine erste Bondinsel und eine zweite Bondinsel umfasst, wobei der erste leitfähige Verbinder an die erste Bondinsel gekoppelt ist, wobei der zweite leitfähige Verbinder an die zweite Bondinsel gekoppelt ist. - Vorrichtung nach
Anspruch 2 , wobei die erste Bondinsel und die zweite Bondinsel eine Nickeloberflächenausführung aufweisen. - Vorrichtung nach
Anspruch 2 oder3 , wobei die erste Umverteilungsleitung und die zweite Umverteilungsleitung aus Kupfer gebildet sind. - Vorrichtung nach einem der vorhergehenden Ansprüche, wobei die erste Umverteilungsstruktur ferner Folgendes umfasst: eine erste dielektrische Schicht, wobei die erste Umverteilungsleitung und die zweite Umverteilungsleitung auf der ersten dielektrischen Schicht angeordnet sind; und eine zweite dielektrische Schicht auf der ersten dielektrischen Schicht.
- Vorrichtung nach
Anspruch 5 , wobei die zweite Durchkontaktierung länger als die erste Durchkontaktierung ist. - Verfahren, das Folgendes aufweist: Bilden einer ersten Umverteilungsstruktur, die Folgendes umfasst: Abscheiden einer ersten dielektrischen Schicht über einem Trägersubstrat; Bilden eines ersten leitfähigen Merkmals auf der ersten dielektrischen Schicht; Bilden eines zweiten leitfähigen Merkmals auf der ersten dielektrischen Schicht; Bilden eines dritten leitfähigen Merkmals auf der ersten dielektrischen Schicht; und Abscheiden einer zweiten dielektrischen Schicht auf dem ersten leitfähigen Merkmal, dem zweiten leitfähigen Merkmal und dem dritten leitfähigen Merkmal; Bilden einer ersten Durchkontaktierung auf dem ersten leitfähigen Merkmal; Bilden einer zweiten Durchkontaktierung auf dem zweiten leitfähigen Merkmal, auf dem dritten leitfähigen Merkmal und zwischen dem zweiten leitfähigen Merkmal und dem dritten leitfähigen Merkmal; Anbringen eines Dies an der ersten Umverteilungsstruktur, die der ersten Durchkontaktierung und der zweiten Durchkontaktierung benachbart ist; Einkapseln des Dies, der ersten Durchkontaktierung und der zweiten Durchkontaktierung mit einer Einkapselung; Planarisieren der Einkapselung, der ersten Durchkontaktierung und der zweiten Durchkontaktierung; und Bilden einer zweiten Umverteilungsstruktur über der Einkapselung, der ersten Durchkontaktierung, der zweiten Durchkontaktierung und dem Die.
- Verfahren nach
Anspruch 7 , das ferner Folgendes umfasst: Ablösen des Trägersubstrats von der ersten Umverteilungsstruktur; und Anbringen eines Vorrichtungspackages an der ersten Umverteilungsstruktur, wobei das Vorrichtungspackage mit einem ersten Verbinder an dem ersten leitfähigen Merkmal angebracht ist, wobei das Vorrichtungspackage mit einem zweiten Verbinder an dem zweiten leitfähigen Merkmal und dem dritten leitfähigen Merkmal angebracht ist. - Verfahren nach
Anspruch 8 , wobei der erste Verbinder nicht entlang einer Längsachse der ersten Durchkontaktierung angeordnet ist. - Verfahren nach
Anspruch 8 oder9 , wobei der zweite Verbinder entlang einer Längsachse der zweiten Durchkontaktierung angeordnet ist. - Verfahren nach einem der
Ansprüche 7 bis10 , wobei die erste Durchkontaktierung nach dem Planarisieren länger als die zweite Durchkontaktierung ist. - Verfahren, das Folgendes aufweist: Abscheiden einer ersten Keimschicht auf einer ersten dielektrischen Schicht; Plattierung eines ersten leitfähigen Merkmals und eines zweiten leitfähigen Merkmals auf der ersten Keimschicht; Abscheiden einer zweiten dielektrischen Schicht auf dem ersten leitfähigen Merkmal und dem zweiten leitfähigen Merkmal; Bilden einer ersten Öffnung in der zweiten dielektrischen Schicht, wobei die erste Öffnung das erste leitfähige Merkmal, das zweite leitfähige Merkmal und die erste dielektrische Schicht freilegt; Abscheiden einer zweiten Keimschicht auf der zweiten dielektrischen Schicht und in der ersten Öffnung; Plattierung einer ersten Durchkontaktierung von Abschnitten der zweiten Keimschicht in der ersten Öffnung; Anbringen eines Dies an der zweiten dielektrischen Schicht; und Einkapseln der ersten Durchkontaktierung und des Dies mit einer Einkapselung.
- Verfahren nach
Anspruch 12 , das ferner Folgendes umfasst: Bilden einer zweiten Öffnung in der ersten dielektrischen Schicht, wobei die zweite Öffnung die erste Keimschicht und die zweite Keimschicht freilegt; Ätzen freiliegender Abschnitte der ersten Keimschicht und der zweiten Keimschicht, um mindestens einen Abschnitt der ersten Keimschicht und der zweiten Keimschicht zu entfernen; Bilden eines reflow-fähigen Materials in der zweiten Öffnung, wobei das reflow-fähige Material entlang einer Längsachse der ersten Durchkontaktierung angeordnet ist; und Reflow des reflow-fähigen Materials zum Bilden einer intermetallischen Verbindung von dem reflow-fähigen Material und leitfähigen Material der ersten Keimschicht, der zweiten Keimschicht und der ersten Durchkontaktierung. - Verfahren nach
Anspruch 13 , das ferner Folgendes umfasst: Anbringen eines Vorrichtungspackages an dem ersten leitfähigen Merkmal und dem zweiten leitfähigen Merkmal mit dem reflow-fähigen Material. - Verfahren nach
Anspruch 13 oder14 , wobei das Reflow des reflow-fähigen Materials das Diffundieren von Abschnitten des leitfähigen Materials der ersten Durchkontaktierung in das reflow-fähige Material umfasst. - Verfahren nach einem der vorhergehenden
Ansprüche 12 bis15 , das ferner Folgendes umfasst: Bilden eines dritten leitfähigen Merkmals auf der ersten dielektrischen Schicht; Abscheiden der zweiten dielektrischen Schicht auf dem dritten leitfähigen Merkmal; Bilden einer zweiten Öffnung in der zweiten dielektrischen Schicht, wobei die zweite Öffnung das dritte leitfähige Merkmal freilegt; Abscheiden der zweiten Keimschicht in der zweiten Öffnung; und Plattierung einer zweiten Durchkontaktierung von Abschnitten der zweiten Keimschicht in der zweiten Öffnung; - Verfahren nach
Anspruch 16 , das ferner Folgendes umfasst: Bilden einer dritten Öffnung in der ersten dielektrischen Schicht, wobei die dritte Öffnung die erste Keimschicht freilegt; Ätzen freiliegender Abschnitte der ersten Keimschicht, um mindestens einen Abschnitt der ersten Keimschicht zu entfernen; Bilden eines reflow-fähigen Materials in der dritten Öffnung, wobei das reflow-fähige Material entlang einer unterschiedlichen Achse als eine Längsachse der zweiten Durchkontaktierung angeordnet ist; und Reflow des reflow-fähigen Materials zum Bilden einer intermetallischen Verbindung von dem reflow-fähigen Material und leitfähigen Material der ersten Keimschicht. - Verfahren nach
Anspruch 17 , wobei das Reflow des reflow-fähigen Materials das Diffundieren von Abschnitten des leitfähigen Materials des dritten leitfähigen Merkmals in das reflow-fähige Material umfasst. - Verfahren nach
Anspruch 17 oder18 , wobei kein Abschnitt der intermetallischen Verbindung zwischen der zweiten Durchkontaktierung und der ersten dielektrischen Schicht gebildet wird. - Verfahren nach einem der vorhergehenden
Ansprüche 16 bis19 , das ferner Folgendes umfasst: Planarisieren der ersten Durchkontaktierung, der zweiten Durchkontaktierung und der Einkapselung, wobei die erste Durchkontaktierung nach dem Planarisieren länger als die zweite Durchkontaktierung ist.
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