CS215607B1 - Kumulační soustava přímého styku s operační pamětí - Google Patents

Description

Vynález se týká kumulační soustavy přímého styku s oparační pamětí určené, zejména pro minipočítače účastnící se monitorování, přímého zpracování výsledků měření a řízení rychlých laboratorních a technologických procesů.

Soustavy přímého styku s oparační pamětí standardně používané v minipočítačích a jiných počítačích určených k tomuto účelu mají svou funkci omezenou na následující dva režimy: jedním řežlmem je přenos bloku dat ze zvoleného vnějšího zařízení do předem vymezené části operační paměti, tj. režim přímého vstupu dat a druhým režimem je přenos bloků dat z předem vymezené části operační paměti do zvoleného vnějšího zařízení, tj. režim přímého výstupu dat.

V některých důležitých případech aplikací Odčítačů jě třeba ve vymezené části operač215 «07 ní paměti kumulovat postupně data přicházející s velkou rychlostí z jednoho nebo několika zvolených vnějších zařízení tak, že v prvním cyklu se stejně jako v uvedeném prvním režimu přímého vstupu dat vloží do vymezené části operační paměti první blok dat ze. zvoleného vnějšího zařízení a v druhém a dalších cyklech se k zaznamenaným datům přičtou data z druhého a dalších bloků dat ze stejného nebo jinýoh vnějších zařízení. Navíc je obvykle třeba, aby v případě možnosti překročení maximálního obsahu tj, přeplnění některé z buněk vymezené části operační paměti se přeplnění indikovalo a bylo možno učinit programové opatření, jež by přenosu dalších dat do přeplněných paměťových buněk zabránilo.

Standardně řešené soustavy přímého styku s opereční pamětí s dvěma popsanými režimy činnosti nelze ke kumulaci dat použít. Kumulace se musí provádět s použitím programu a tedy relativně pomalu a se značným zatížením počítače.

Výše uvedené nedostatky odstraňuje a kumulaci dat umožňuje kumulační soustava přímého styku s operační pamětí, vynKívajioí k přenosu dat mezi operační pamětí a adresovým styčným obvodem vnějšího zařízení datového registru, připojeného svým prvním vstupem dat k výstupu dat opareční paměti a svým prvním výstupem dat k vstupu dat opareční paměti, aritmetické jednotky procesoru, připojené svou výstupní sběrnicí ke druhému vstupu dat datového registru a registru povelových signálů., opatřených soustavami logických obvodů účastnících se řízení kumulační soustava a vstupní/výstupní sběrnice dat, spojené se vstupy dat styčných obvodů vnějších zařízení a přes hradla s druhým výstupem dat datového registru a využívajíoí k řízení přenostu dat mezi operační pamětí a adresovaným styčným obvodem vnějšího zařízení registru povelových signálů přímého styku a oparační pamětí a dvou logických soustav, podle vynálezu jehož podstatou je, že první vstupní sběrnice dat aritmetioké jednotky je spojená přes hradla s druhým výstupem dat datového registru a druhá vstupní sběrnice dat aritmetické jednotky je spojená přes hradla se vstupní/výstupní sběrnicí procesoru.

V jedné variantě vynálezu je kumulační soustava přímého styku s opereční paměti opatřena registrem povelových signálů přímého styku s operační pamětí, který je připojen svým výstupem signálu přímého výstupu dat přes hradlo první logické soustavy k uvolňovacímu vstupu zdroje uvolňovacího signálu hradel a svým výstupem povelového signálu přímé kumulaoe dat přes hradlo první logické soustavy k uvolňovacímu vstupu zdroje uvolňovacího signálu hradel.

Podle jiné varianty vynálezu je kumulační soustava přímého styku s opereční paměti opatřena soustavou logických obvodů pro uvolňovaní zdrojů prvního přijímaoího signálu a druhého přijímacího signálu datového registru a zápisového signálu opereční paměti. Její druhá logická soustava obsahuje hradla, přičemž hradlo je svým výstupem připojeno k uvolňovacímu vstupu zdroje prvního přijímacího signálu datového registru a jedním svým vstupem přes zpožďovací obvody k výstupu zdroje startovacího signálu, další hradlo je připojeno svým výstupem k uvolňovacímu vstupu zdroje druhého přijímacího signálu datového registjm a svými dvěma vstupy k výstupům hradel, jež jsou připojena svými prvními vstupy přes zpožďovací obvody k výstupu zdroje startovacího signálu, další hradlo je připojeno svým výstupem přes zpožďovací obvod k uvolňovacímu vstupu zdroje zápisového signálu operační paměti a svými dvěma vstupy k hradlům, jež jsou připojena svými prvními vstupy přes zpožďovací obvody k výstupu zdroje startovacího signálu, druhé vstupy hradel jsou připojeny přes

2' 6ι·7 bradla k výstupům registru povelových signálů přímého styku s operační pamětí.

Podle Jiné varianty vynálezu registr povelových signálů přímého styku s operační pamětí je připojen svým výstupem povelového signálu vstupního přenosu před hradlo první logické soustavy k uvolňovacímu vstupu zdroje ůvolňovacího signálu zdroje přenosového signálu, jehož výstup je připojen k přenosovému vstupu aritmetické jednotky

Podle další varianty vynálezu registr povelových signálů přímého styku s opereční pamětí je připojen svým výstupem povelového signálu indikace přeplnění přes hradlo první logické soustavy k uvolňovacímu vstupu.

Ještě další varianta vynálezu spočívá v tom, že hradla první logické soustavy jsou připojena svými vstupy k zdroji povelového signálu přímého styku, který je dále připojen k uvolňovacím vstupům zdroje sčítačího signálu. «

Rozšířením spojů procesoru o spoje vedené přes hradla mezi druhým výstupem dat a první vstupní sběrnicí dat aritmetické jednotky a mezi vstupní/výstupní sběrnicí procesoru a náležitým řízením těchto hradel a dalšíoh částí procesoru podle vynálezu se dosáhne možnosti rozšířit dva standardní režimy soustavy přímého styku s operační pamětí o kumulační režim přímého styku s operační pamětí. Tento režim zajišťuje technickými prostředky automatickou kumulaci dat, takže kumulace dat z adresovaných vnějších zařízení probíhá s maximální dosažitelnou rybhlostí a bez programového zatížení počítače.

Podstatu vynálezu hlíže ujasňují na výkresech obr. 1 až 6, Obr. 1 podává příklad standardního uspořádání soustavy přímého přenosu dat mezi operační pamětí a styčnými obvody vnějších zařízení a obr. 2 podává příklad časového průběhu řídících signálů této standardní soustavy Na obr. 3 je příklad zapojení kumulační soustavy přímého styku s operační pamětí podle vynálezu doprovázený na obr. 4 příkladem Časového průběhu řídících signálů Na obr. 5 je příklad zapojení zdroje řídících signálů kumulační soustavy přímého styku s operační pamětí doprovázený na obr. 6 příkladem časového průběhu řídících signálů při přímém výstupu dat, přímém vstupu dat a přímé kumulaci dat.

V příkladu standardního uspořádání soustavy přímého styku s operační pamětí na obr.

se přenos dat mezi operační pamětí 1 a styčnými obvody 70. 80, ... vnějších zařízení provádí prostřednictvím datového registru 10 a hradel 20 a 40 procesoru 7, takže nemůže dojít k porušení obsahu pracovních registrů 18 procesoru 2» ooí je základní podmínkou uskutečnění přímého styku vnějších zařízení s operační pamětí 1. Hradla 20 řízená uvolňovacím signálem 23‘umožňují přenos dat z druhého výstupu dat 14 datového registru 10 na vstupní/výstupní sběrnici 17 procesoru a hradla 40 řízená uvolňovacím signálem 43 umožňují přenos dat ze vstupní/výstupní sběrnice 17 procesoru 7 na výstupní sběrnici 35 aritmetické jednotky 30 procesoru 2 připojenou k druhému vstupu dat 13 datového registru

10. K vstupní/výstupní sběrnici 17 procesoru 2 jsou připojeny výstupy dat 22» ®2 · · · i vstupy dat 72, 82, . .. styčných obvodů 70. 80, .. vnějších zařízení počítače, kam se přenášená data ukládají při přenosu z operační paměti 1, nebo odkud se odebírají data pro přenos do operační paměti 1. Funkce operační paměti 1 je řízena čtecím signálem 2 a zápisovým signálem 2· Data jdou z výstupu dat operační paměti 1 do prvního vstupu dat 8 datového registru 10 a opačný přenos dat se uskutečňuje přes spoje mezi prvním výstupem dat 2 datového registru 10 a vstupem dat 2 operační paměti 1.

215 607

Na obr. 2 je příklad časových relaoí mezi řídicími signály uvedenýoh částí soustavy přímého styku s operační pamětí na obr. 1 pro oba možné režimy její funkce: pro přímý výetup dat z opereční paměti a pro přímý vstup dat do operační paměti. V prvním případě je aktivován, tj. má jednotkovou hodnotu uvolňovací signál 23 hradel 20 a po impulsu čteoího signálu 2 opereční paměti 1, odstartovaném krátoe po začátku intervalu T, následuje se zpožděním TI první přijímači signál 11 datového registru 10. Následkem toho je během intervalu T2 od jeho příchodu do konce intervalu T možno data, přijatá do datového registru 10 a prošlá hradly 20, jejichž průohod je uvolněn uvolňovacím signálem 23, na vstupní/výstupní sběrnici 17 procesoru 7, zapsat do registru 71, 81, . .. adresovaného stačného obvodu JO, 80, ... vnějšího zařízení. V druhém případě je během přenosového Intervalu T aktivován uvolňovací signál 43 hradel 40 a data prošlá ze vstupní/výstupní sběrnice 17 procesoru J přes hradla 40 a výstupní sběrnici 35 aritmetické jednotky 30 na druhý vstup dat 13 datového registru 10 se pomocí impulsu druhého přijímacího signálu 12 přijímají do datového registru 10 a odtud se pomoci impulsu zápisového signálu 3 zapisují během Intervalu T2 do operační paměti 1. Tímto způsobem je možno přenést do operační paměti data zavedená v intervalu TI do vstupní/výstupní sběrnice 17 procesoru J z registrů 71. 81. .. adresovaného styčného obvodu 70. 80, vnějšího zařízení Jak je naznačeno na obr 2 čárkovaně, umpuls čtecího signálu 2 se obvykle vysílá i při přímém vstupu dat a impuls zápisového signálu 2 ^se obvykle vysílá i při přímém výstupu dat, třebas jejich přítomnost není pro funkci soustavy přímého styku s operační pamětí obecně nutná. To souvisí s pravidelným opakováním čtení z operační pamětí i zápisu do operační paměti bez ohledu na operace prováděné procesorem.

Příklad zapojení kumulační soustavy přímého styku s operační pamětí podle vynálezu je na obr. 3. Procesor J této soustavy obsahuje kromě standardních částí, tj. podle obr. 1 datového registru 10, pracovních registrů 18, aritmetické jednotky 22» hradel 20 připojených svým vstupem dat 21 k druhému výstupu dat 14 datového registru 10 a svým výstupem dat 22 k vstupní/výstupní sběrnici 17 procesoru J a případně hradel 40 připojených svým vstupem dat 41 k vstupní/výstupní sběrnici 17 procesoru J a svým výstupem dat 42 k druhému vstupu dat 13 datového registru 10, ještě hradla 25 a 45. zdroj přenosového signálu 50 a indikační obvod přeplnění 55. Hradla 25 jsou připojena svým vstupem dat k druhému výstupu dat 14* datového registru 10, sxýý výstupem dat k první vstupní sběrnici 31 aritmetické jednotky 30 a jsou řízena uvolňovacím signálem 48. Hradla 55 jsou připojena svým vstupem dat 46 k vstupní/výstupní sběrnici 17 procesoru J, svým výstupem dat 47 ke druhé vstupní sběraioi 32 aritmetické jednotky 30 a jsou řízena uvolňovacím signálem 48. Zdroj přenosového signálu 50 je připojen svým výstupem přenosového signálu 52 k přenosovému vstupu 33 aritmetické jednotky 30 a je řízen uvolňovacím signálem 21' Indikační obvod přeplnění 55 se vstupy 56 je řízen uvolňovacím signálem 22· Jinak je zapojení kumulační soustavy přímého styku s operační pamětí podle vynálezu shodné se standardním uspořádáním přímého styku s operační pamětí znázorněným na obr. 1, tj. zejména standardním způsobem je provedeno spojení operační paměti 1 s datovým registrem 10. spojení datového registra 10 s aritmetickou jednotkou 30. s hradly 20 a pracovními registry 18 a standardním způsobem je provedeno i řešení stačnýoh obvodů JO, 80, ... vnějších zařízení a vstupní/výstupní sbšrnioé 17 procesoru J a spojení vstupní/výstupní sběrnice 17 s hradly 20 a případně 40 na jedné straně a se vstupy dat 72, 82. ... i výstupy dat 22» θ2» ··· styčných obvodů 70. 80. ·· Hradla 40 neuvedená na obr. 3 mohou být přirozeně použita i v kumulační soustavě přímého styku s operační pamětí podle vynálezu»: přestože nejsou na obr. 3 uvedena. Vzhledem k popsané úpravě zapojení podle vynálezu se na rodil od příkladu na obr. 1 přenos dat z registrů 71.

81. ... stačných obvodů 70. 80 ... do datového registru 10 uskutečňuej tentokráte prostřednictvím aritmetické jednotky 30. oož umožňuje doplnění dvou základních režimů přímého vstupu dat a přímého výstupu dat třetím režimem přímé kumulace dat. V tomto třetím režimu se během intervalu přímého styku nejprve čte obsah adresované buňky opereční paměti 1 do datového registru 10, pak se pomocí aritmetické jednotky 30 k obsahu datového registru 10 přičítají data z registru 21, 81 ... adresovaného styčného obvodu 22» θθ, ·· a výsledek součtu se z datového registru 10 přenáší do operační paměti 1. Přičtení se provádí tak, že se na první vstupní sběrnici 31 aritmetické jednotky 30 vedou přes hradla 25 data z výstupu 14 datového registru 10, na druhou vstupní sběrnici 32 aritmetické jednotky 30 se vedou přes hradla 45 data ze vstupní(výstupní sběrnice 17 procesoru 10 a na druhý vstup dat 13 datového registru 10 se vedou data z výstupní sběrnice 35 aritmetické jednotky 30. přičemž se pomocí impulsu sčítacího signálu 36 uvádí aritmetická jednotka 30 do sčítacího režimu.

Je-li v případě potřeby nutno realizovat kumulaci dat odčítáním obsahu registru 71.81./. adresovaného styčného obvodu 70. 80 .. od obsahu adresované buňky operační paměti 1 a aritmetická jednotka 30 neumožňuje přímé odčítání, je možno i pak uplatnit sčítací operaoi, ale z registru 21» 81 adresovaného styčného obvodu 70. 80, . je nutno vysílat invertované hodnoty dvojkových řádů odčítaného čísla a na přenosový vstup 33 aritmetické jednotky 30 vést výstupní signál 51 ze zdroje přenosového signálu 50 vybuzeného impulsem uvolňovacího signálu 52.

Překročení maximální hodnoty čísel ukládaných do perační paměti lze indikovat pomocí indikačního signálu 58 indikačního obvodu přeplnění 55. v němž se porovnávají znaménkové bity čísel na vstupníoh sběrnicích βΐ a 32 se znaménkovým bitem čísla na výstupní sběrnici 35 aritmetické jednotky 30. činnost indikačního obvodu přeplnění se uvolňuj» uvolňovacím signálem 57.

Přiklad časové relace Impulsů řídioích signálů kumulační soustavy pr ímého styku s operační pamětí při jedné kumulační operaci je znázorněn na obr 4. Po impulsu čtecího signálu 2 následuje se zpožděním TI daném dobou čtení z opereční paměti 1 impuls prvního přijímacího signálu 11 datového registru 10; pak následuje se zpožděním T3 daném v podstatě dobou průchodu dat aritmetickou jednotkou 30 při sčítání operaci impuls druhého přijímacího signálu 12 zajišťující příjem dat z výstupní sběrnice 35 aritmetické jednotky 30 do datového registru 10; pak následuje impuls zápisového signálu 2 & interval T2 nutný k zápisu dat do perační paměti 1. Během kumulačního intervalu, prodlouženého proti intervalu T dvou základních režimů přímého styku s operační pamětí o interval T3, jsou uvolněny pomocí impulsů uvolňovacíoh signálů 28, 48. a popřípadě 51 při odčítání a 57 při indikování přeplnění, funkoe hradel 25. 42» a popřípadě zdroje přenosového signálu 50 a indikačního obvodu přeplnění 22» a pomocí impulsu sčítacího signálu 26 sčítání funkoe aritmetické jednotky 30.

Příklad zapojení obvodů pro generování řídicích signálů přímého styku s operační pamětí je znázorněn na obr. 5 doplněném na obr. 6 příkladem časového průběhu řídicích signálů.

K základním částem těchto obvodů patří registr 59 povelových signálů přímého styku, první logická soustava 76. druhá logická soustava 108. zpožďovací obvody 104 až 107 a zdroj 60 povelového signálu přímého styku 6l. Registr 59 je svými výstupy 62 až 66 povelových signálů přímého styku připojen jednak přes hradla 131 až 134 první logické soustavy 76 k uvolňovacím vstupům 121, 122, 124. 125 zdrojů 71. 72, 74. 75 uvolňovaoíoh signálů 23. 28, 51 a 21» jednak přes hradla 141 až 151 druhé logické soustavy 108 k uvolňovacím vstupům 111 a 112 zdrojů 101 a 102 a přes zpožžovací obvod 106 k uvolňovacímu vstupu 113' zdroje 103· Zpožďovací obvody 104 a 105 jsou připojeny svým vstupem k výstupu zdroje 97 startovacího signálu 99 a spolu se zpožďovacím obvodem 107. připojeným svým vstupem k jednomu z hradel 141 druhé logické seustavy 108. svými výstupy k vstupům hradel 141 až 146 druhé logické soustavy 108. Povelový signál přímého styku 61 ze zdroje 60 je připojen, spolu s výstupy 62 a 66 registru 59 ke vstupům hradel 131 až 134 první logické soustavy 76 a kromě toho k uvolňovacím vstupům 120 a 123 zdrojů 70 a 73.

Operace přímého styku s operační pamětí jsou uvolňovány povelovým signálem přímého styku 61 ze zdroje 60, Režim přímého styku je řízen z registru povelových signálů přímého styku 59 následujícími povelovými signály: povelovým signálem přímého výstupu dat z operační paměti z výstupu 62, povelovým signálem přímého vstupu dat do opereční paměti z výstupu 63 a povelovým signálem přímé kumulace dat v opereční paměti z výstupu 64, z nichž může být aktivován vždy jen jediný. Dále je registr povelových signálů přímého styku 59 zdrojem povelového signálu vstupního přenosu z výstupu 65 indikujícího požadavek na uvolnění činnos ti zdroje přenosového signálu 50 a povelového signálu indikace přeplnění z výstppu 66 indikujícího požadavek na uvolnění funkce indikačního obvodu přeplnění 55 Z uvedených povelových signálů na výstupech 61 až 66 se jadnak přímo a jednak prostřednictvím první logické soustavy 76 odvozují signály pro uvolňovací vstupy 120 až 125 zdrojů 70 až 75 sčítacího signálu 36. uvolňovacích signálů 23, 28 a 48 hradel 20, 25 a 42» uvolňovacího signálu 51 zdroje přenosového signálu 50 a uvolňovacího signálu 57 indikačního obvodu přeplnění 55.

Generování čtecího signálu 2 a zápisového signálu 2 operační paměti 1 a prvního přijímaoího signálu 11 a druhého přijímacího signálu 12 datového registru 10 podle časových závislostí, jejichž příklad je na obr. 6, se provádí podle vynálezu ve zdrojích 100 až

103 řízených startovacím signálem 99 ze zdroje 97 prostřednictvím zpožťovaoíoh obvodů

104 až 107 a druhé logické soustavy logických obvodů 108, Zpožžovací obvod 104 zajišťuje zpoždění TO mezi příchodem startovaoího signálu 99 a okamžikem startu impulsu čtecího signálu 2 ze zdroje 100. Zpožžovací obvod 105 zajišťuje zpoždění TI mezi okamžikem startu impulsu čtecího signálu 2 ⁸ okamžikem startu impulsu prvního přijímaoího signálu 11, v režimu přímého výstupu a přímé kumulace dat, respektive druhého přijímacího signálu 12, tj. v režimu přímého výstupu dat, respektive mezi startem impulsu druhého přijímaoího signálu 12 a startem impulsu zápisového signálu 2‘, tj· v režimu přímého vstupu a přímé kumulace dat. Zpožžovací obvod 107 zajišťuje zpoždění T3 mezi startem impulstu prvního při j-ímaníhn signálu 11 a startem impulsu druhého přijímacího signálu 12, tj. v režimu přímé kumulace dat Spojení mezi zpožďovacími obvody 105. 106 a 107 a uvolňovacími vstupy 111 a 112 zdrojů 101 a 102 podle požadovaného průběhu přijímacích signálů 101 a 102 a zápisového signálu 3 znázorněného na obr, 6 je uskutečněno pomocí hradel 14ů až 146 druhé logické soustavy, jejíž zapojení je možno provést různými způsoby.

Minipočítače využívající kumulační soustavy přímého styku s operační pamětí podle vynálezu jsou výhodné, zejména k oddělení užitečného signálu od šumu, což je základní operace různýoh měřících soustav jako jsou Fourierovy analyzátory.

Claims (6)

1. PŘEDMĚT VYNÁLEZU

   1. Kumulační soustava přímého styku s operační pamětí využívající k přenosu dat mezi operační pamětí a adresovým styčným obvodem vnějšího zařízení datového registru připojeného svým prvním vstupem dat k výstupu dat operační paměti a svým prvním výstupem dat k vstupu dat operační paměti, aritmetické jednotky procesoru připojené svou výstupní sběrnicí ke druhému vstupu dat datového registru a vstupní/výstupní sběrnice procesoru spojené přes hradla s druhým výstupem do datového registru a využívající k řízení přenosu dat mezi operační pamětí a adresovaným styčným obvodem vnějšího zařízení registru povelových signálů ýřfmého styku s operační pamětí a dvou logických soustav, vyznačující se tím, že první vstupní sběrnice (31) aritmetické jednotky (30) je spojená přes hradla (25, s druhým výstupem (14) dat datového registru (10) a druhá vstupní sběrnice (32) aritmetické jednotky (30) je spojená přes hradla (45) se vstupní/výstupní sběrnicí (17) procesoru (7),
2. 2. Kumulační soustava přímého styku s operačníopamětí podle bodu 1, vyznačující se tím, že registr (59) povelových signálů přímého styku s operační pamětí (1) je připojen svým výstupem (62) signálu přímého výstupu dat přes hradlo (131) první logické soustavy (76) k uvolňovacímu vstupu (121) zdroje (71) uvolňovacího signálu hradel (20) a srým výstupem (64) povelového signálu přímé kumulace dat přes hradlo (132) první logické soustavy /76) k uvolňovacímu vstupu (122) zdroje (72) uvolňovacího signálu hradel (25).
3. 3. Kumulační soustava přímého styku s operační pamětí podle bodů 1 a 2, vyznačující se tím, že její druhá logická soustava (108) obsahuje hradla (141 až-151), přičemž hradlo (141) je svým výstupem připojeno k uvolňovacímu vstupu (111) zdroje (101) prvního přijímacího signálu datového registru (20) a jedním svým vstupem přes zpožďovací obvody (104, 105) k výstupu zdroje (97) startovacího signálu, hradlo (145) je připojeno svým výstupem k uvolňovacímu vstupu (112) zdroje (102) druhého přijímacího signálu datového registru , (10) a svými dvěma vstupy k výstupům hradel (142, 144) , jež jsou připojena svými prvními vstupy přes zpožďovací obvody (104, 105, 107) k výstupu zdroje (97) startovacího signálu, hradlo (147) je připojeno svým výstupem přes zpožďovací obvod (106) k uvolňovacímu vstupu (113) zdroje (103) zápisového signálu operační paměti (1) a svými dvěma vstupy k hradlům (143, 146), jež jsou připojena svými prvními vstupy přes zpožťovací obvody (104, 105, 107) k výstupu zdroje (97) startovacího signálu, druhé vstupy hradel (141, 142, 143, 144, 146) jjsou připojeny přes hradla (148 až 153) k výstupům (62, 63, 64) registru (59) povelových signálů přímého styku s operační pamětí (1).
4. 4. Kumulační soustava přímého styku s operační pamětí podle bodů 1, 2 a-3, vyznačující se tím, že registr (59) povelových signálů přímého styku s operační paměti (1) je připojen svým výstupem (65) povelového signálu vstupního přenosu přes hradlo (133) první logické soustavy (76) k uvolňovacímu vstupu (124) zdroje (74) uvolňovacího signálu zdroje (50) přenosového signálu, jehož výstup (52) je připojen k přenosovému vstupu (33) aritmetické jednotky (30).
5. 5. Kumulační soustava přímého styku s operační pamětí podle bodů 1, 2, 3 a 4, vyznačující se tím, že registr (59) povelových signálů přímého styku s operační pamětí (1) je připojen svým výstupem (66) povelového signálu indikace přeplnění přes hradlo (134) první logické soustavy (76) k uvolňovacímu vstupu (125) zdroje (75) uvolňovacího signálu (57) indikačního obvodu (55) přeplnění.
6. 6. Kumulační soustava přímého styku s operační pamětí podle bodů 1 až 5, vyznačující se tím, že hradla (131, 133, 134) první logické soustavy (76) jsou připojena svými vstupy k zdroji (60) povelového signálu přímého styku, který je dále připojen k uvolňovacímu vstupu (120) zdroje (70) sčítacího signálu.