CS201617B1 - Zapojení zkoušečky logických stavů - Google Patents

Description

Vynález se týká zapojení zkoušečky logických stavů signálů s optickou indikací v sítích

TTL.

V dosud známých zapojeních se k rozlišení testované úrovně používá komplementárních zesilovačů, popřípadě rozdílného zisku v obou větvích pro indikaci úrovní L a H. Tyto obvody potřebují ke správné funkci nastavení pracovních bodů, což přináší problémy se stabilitou, při oživování apod. Kromě toho jsou tato zapojení většinou dosti složitá.

Tyto nevýhody odstraňuje zapojení zkoušečky logických stavů s optickou indikací v sítích TTL, jehož podstata spočívá v tom že vstup signálu je spojen s uzlem spojeným se dvěma paralelními větvemi, z nichž první paralelní větev je tvořena sériovým spojením první diody, připojené anodou do uzlu a katodou k bázi tranzistoru vodivostního typu NPN, jehož koléktor je spojen se vstupem prvého hradla a druhé diody, spojené anodou s emitorem tranzistoru a katodou s bodem nulového potenciálu, zatímco druhá paralelní větev je tvořena diodou spojenou katodou s uzlem a anodou se vstupem druhého hradla.

Pokrok dosažený vynálezem spočívá v tom, že popsaný prahový obvod umožňuje sestrojit logickou zkoušečku s výbornými dynamickými vlastnostmi, vyhovující přesností a stabilitou. Zapojení je velice jednoduché a při oživování není třeba nic nastavovat.

Vynález je zobrazen na přiloženém výkrese, který představuje schéma zapojení zkoušečky logických stavů.

U zapojení zkoušečky logických stavů s optickou indikací v sítích TTL je testovaný signál v uzlu 1 rozdělen do dvou paralelních větví 2 a 2* První paralelní větev 2 je tvořena sériovým spojením první diody £, připojené anodou do uzlu χ a katodou k bázi tranzistoru 2 ^a druhé diody 2 spojené anodou s emitorem tranzistoru 2 ^a katodou s bodem nulové201 617

201 017 ho potenoiálu, Kolektor tranzistoru Ji je spojen se vstupem prvého hradla 6. Druhá paralelní větev 2 3® tvořena diodoujg spojenou katodou s uzlem 1 a anodou 8 vstupem druhého hradla 2· Obvody indikace /nezakresleno/ jsou připojeny k výstupům prvého hradla £ ^a druhého hradla 2·

Zapojení zkouěečky logických stavů používá k rozlišení testovanyo^ⁿubytků na PN přecho dech. Logická zkoušečka rozlišuje tři úrovně vstupního napětí. Pro indikaci hodnoty logická nula je třeba, aby napětí na vstupu druhého hradla 2 bylo menší než rozhodovací úroveň TTL, tj. 1,4 V. Vzhledem k tomu, že v cestě signálu je zapojena dioda 8, musí hýt vstupní napětí menší o úbytek na této diodě, t.j.

U_L . - 1,4 - 0,7 - 0,7 V.

Při splnění této podmínky je v činnosti indikační obvod, zapojený na výstup hradla^9 logická nula.

Hodnota logická jedna se indikuje obvodem, připojeným na výstup prvého hradla 6, a to tehdy, je-li sepnut tranzistor 2» ^K tomu je třeba, aby vstupní napětí bylo větší, než je součet úbytků na přechodech první diody £ a druhé diody £ a přechodu B - E tranzistoru 2' tj.

U_H - 3 x 0,7 = 2,1 V,

V případě, že napětí v uzlu 2 nesplňuje žádnou z uvedených podmínek, popřípadě není-li vstup připojen k měřenému obvodu, například nedokonalý kontakt nebo vysoký výstupní odpor zdroje signálu, není v činnosti žádná z indikačních větví.

Přesnost prahových úrovní vstupního obvodu je pro potřebu zkoušeČky dóstačujíoíj výhodné je, že zapojení má obdobnou strukturu jako TTL. Z toho plyne, že případné teplotní drifty a offset způsobený tolerancí napájecího napětí se projeví obdobně jako v testovaném zařízení. Prahový obvod podle vynálezu neobsahuje žádné pasivní prvky, které by ovlivňovaly .dynamické vlastnosti zkouěečky.

Claims (1)

1. PŘEDMĚT VYNÍLEZU

   Zapojení zkouěečky logických stavů s optickou indikací v sítích TTL, vyznačené tím, že vstup signálu je spojen s uzlem /1/ spojeným se dvěma paralelními větvemi /2 a 3/, z nichž první paralelní větev /2/ je tvořena sériovým spojením první diody /4/, připojené anodou do uzlu /1/ a katodou k bázi tranzistoru vodivostního typu NPN /5/, jehož kolektor je spojen se vstupem prvého .hradla /6/, a druhé diody /7/, spojené anodou s emitorem tranzistoru /5/ a katodou s bodem nulového potenciálu, zatímco druhá paralelní větev /3/ je tvořena diodou /8/ spojenou katodou s uzlem /1/ a anodou s vstupem druhého hradla/9/·