CS201086B1

CS201086B1 - Zapojení pro záznam a zamezení časového překrytí signálů

Info

Publication number: CS201086B1
Application number: CS191475A
Authority: CS
Inventors: Karel Bocek
Original assignee: Karel Bocek
Priority date: 1975-03-21
Filing date: 1975-03-21
Publication date: 1980-10-31

Description

(54) Zapojení pro záznam a zamezení časového překrytí signálů

Předmětem vynálezu je zapojení pro záznam a zamezení časového překrytí signálů, které řeší záznam logických signálů a uvolňování jejich průchodu spojením elementárních logických prvků do logické sítě.

Jsou známa zapojení pro uložení informace v paměti, která spočívají ve vybuzení výstupního signálu na jednom výstupu vstupním signálem, který přišel na jeden vstup, a to až v okamžiku, kdy přijde jiný vstupní signál na jiný vstup tohoto zapojení.

Uvedené zapojení představuje nejčastěji dvojková pamět, složená například ze dvou logických obvodů ANI, kde výstup každého z těchto obvodů je spojen s jedním elementárním vstupem vícenásobného vstupu druhého obvodu, čímž je dosaženo zavedení kladné zpětné vazby.

V dalším je vstup, popřípadě vícenásobný vstup logického obvodu, pokud není uvedeno jinak, označován zkráceně jako vstup, přičemž v případě spojení vstupu se dvěma, popřípadě několika různými zdroji signálu se předpokládá, že tento vstup je vícenásobný, kde násobnost tohoto vícenásobného vstupu je určena počtem připojených .zdrojů signálu tak, že každý zdroj signálu spojený s některým vstupem je spojen s jedním elementárním vstupem tohoto vícenásobného vstupu. Jako zdroj signálu je označován výstup logického obvoáu, vstup nebo výstup logické sítě složené z logických obvodů a podobně.

201 000

Jsou rovněž známá zapojení pro uvolňování průchodu signálů, například přes hradlo, popřípadě soustavu hradel, a to signály zvolená logické hodnoty na řídicích vstupech těchto hradel a podobně.

Nevýhodou známých zapojení pro použití při syntéze asynchronních logických sítí v oblasti řídicích soustav složitých výrobních procesů je zejména skutečnost, ža nevy>

lučují časové překrytí dvou nebo několika signálů, popřípadě časové překryti dvou nebo několika výrobních operací.

Tyto nevýhody odstraňuje zapojení pro záznam a zamezení časového překrytí signálů uvolňování průchodu signálů podle vynálezu, jehož podstata spočívá v tom, že druhý výstup prvního paměťového obvodu je připojen k prvnímu vstupu třetího paměťového obvodu přes první pomocný logický obvod, jehož další vstupy jsou spojeny se vstupy prvního paměťového obvodu, přičemž první výstup druhého paměťového obvodu je připojen k druhému vstupu třetího paměťového obvodu přes druhý pomocný logický obvod, jehož další vstupy jsou spojeny se vstupy druhého paměťového obvodu.

Přednosti zapojení pro záznam a zamezení časového překrytí signálů podle vynálezu je skutečnost, že umožňuje nezávisle na sobě záznam jedné informace a záznam druhá informace, a že zamezuje časová překrytí jedné odvozené informace definované prvním záznamovým signálem a prvním mazacím signálem, a druhé odvozená informace definovaná druhým záznamovým signálem a druhým mazacím signálem, a to včetně časového trvání záznamového signálu a mazacího signálu té informace, která má uvolněný průchod. Přitom se informace se zamezeným průchodem neztrácí, zapisuje se, a čeká na uvolnění průchodu.

Další předností je snadná realizovatelnost pomocí minimálního počtu elementárních logických prvků, bez nároků na složité a nákladné prostředky výpočetní techniky.

Zapojení pro záznam a zamezení časového překrytí signálů podle vynálezu je v příklad nám provedení znázorněno na výkrese, kde na obr. 1 je znázorněno vzájemná propojení logických prvků a na obr. 2 je znázorněn časový průběh signálů.

Na obr. 1 je znázorněn první paměťový obvod A s prvním vstupem složeným z elementárních vstupů βρ eg, e^, s druhým vstupem složeným z elementárních vstupů fp fg, f-j, s prvním výstupem E^ a s druhým výstupem Fp První paměťový obvod A ^se skládá z prvního logického obvodu E, s výhodou logického obvodu ANI, jehož elemerrtární vstupy e^, eg, e^ představují souhrnně první vstup prvního paměťového obvodu A, a jehož výstup E^ představuje shodně první výstup Ej tohoto prvního paměťového obvodu A, a z druhého logického obvodu F, s výhodou logického obvodu ANI, jehož elementární vstupy fp fg, f-j představují souhrnně druhý vstup prvního paměťového obvodu A, a jehož výstup F^ představuje shodně druhý výstup F^ tohoto prvního paměťového obvodu A. Výstup E-^ prvního logického obvodu E je spojen s třetím elementárním vstupem f^ druhého logického obvodu Fp jehož výstup Fj je spojen 8 třetím elementárním vstupem e^ prvního logického obvodu E.

Je znázorněn druhý paměťový obvod 2 ⁸ prvním vstupem složeným z elementárních vstupů gg, g^, β druhým vstupem složeným z elementárních vstupů hp hg, h^, s prvním

201 088 výstupem G^ a s druhým výstupem H^. Druhý paměťový obvod B se skládá z třetího logického obvodu G, s výhodou logického obvodu ANI, jehož elementární vstupy gp gg, g^ představují souhrnně první vstup druhého paměťového obvodu B, a jehož výstup G^ představuje shodně první výstup G^ tohoto druhého paměťového obvodu B, a z čtvrtého logického obvodu H, s výhodou logického obvodu ANI, jehož elementární vstupy hp hg, představují souhrnně druhý vstup druhého paměťového obvodu Hp a jehož výstup představuje shodně druhý výstup H-^ tohoto druhého paměťového obvodu B. Výstup G^ třetího logického obvodu G je spojen s třetím elementárním vstupem h^ čtvrtého logického obvodu H, jehož výstup je spojen s třetím elementárním vstupem g^ třetího logického obvodu G.

Dále je znázorněn třetí paměťový obvod C s prvním vstupem složeným z elementárních vstupů kp k₂, k^, 8 druhým vstupem složeným z elementárních vstupů lp lg, 1^, s prvním výstupem Kp s druhým výstupem Lp Třetí paměťový obvod C se skládá z pátého logického obvodu K, s výhodou logického obvodu ANI, jehož elementární vstupy kp kg, k^ představují souhrnné první vstup třetího paměťového obvodu C, a jehož výstup K^ představuje shodně první výstup tohoto třetího paměťového obvodu C, a z šestého logického obvodu L, s výhodou logického obvodu ANI, jehož elementární vstupy lp lg, 1^ představují souhrnné druhý vstup třetího paměťového obvodu C, a jehož výstup představuje shodně druhý výstup L^ tohoto třetího paměťového obvodu C.

Výstup pátého logického obvodu K je spojen s druhým elementárním vstupem lg šestého logického obvodu L, jehož výstup je spojen s druhým elementárním vstupem kg pátého logického obvodu K.

Posléze je znázorněn první pomocný logický obvod M, s výhodou logického obvodu ANI, se vstupem složeným z elementárních vstupů Hp mg, m^, s výstupem Mp druhý pomocný logický obvod N, s výhodou logického obvodu ANI, se vstupem složeným z elementárních vstupů iip ng, n^, s výstupem Hp

První elementární vstup druhého vstupu prvního paměťového obvodu A je spojen s druhým elementárním vstupem m₂ vstupu prvního pomocného logického obvodu M, popřípadě druhý elementární vstup fg druhého vstupu prvního paměťového obvodu A je spojen s třetím elementárním vstupem m^ vstupu prvního pomocného logického obvodu M, a druhý výstup prvního paměťového obvodu A je spojen se vstupem třetího paměťového obvodu C přes první pomocný logický obvod M tak, že tento druhý výstup F^ je spojen s prvním elementárním vstupem m^ vstupu tohoto prvního pomocného logického obvodu M, jehož výstup je spojen s prvním elementárním vstupem k^ prvního vstupu tohoto třetího paměťového obvodu C.

První elementární vstup g^ prvního vstupu druhého paměťového obvodu B je spojen s třetím elementárním vstupem n^ vstupu druhého pomocného logického obvodu N, popřípadě druhý elementární vstup gg prvního vstupu druhého paměťového obvodu B je spojen s druhým elementárním vstupem n₂ vstupu druhého pomocného logického obvodu N, a první výstup G^ druhého paměťového obvodu B je propojen s druhým vstupem třetího paměťového

201 080 obvodu G přes druhý pomocný logický obvod N tak, že tento první výstup G·^ je spojen s prvním elementárním vstupem n^ vstupu tohoto druhého pomocného logického obvodu N, jehož výstup N^ je spojen s prvním elementárním vstupem 1^ druhého vstupu tohoto třetího paměťového obvodu C.

Funkce zapojení pro záznam a zamezení časového překrytí signálů v příkladném provedení podle obr. 1 je znázorněna pomocí podrobného časového průběhu signálu na obr. 2. Pro každý časový průběh jednotlivého logického signálu je vyhražen jeden samostatný časový diagram.

V časovém diagramu 1 je znázorněn jedničkový impulsní signál 11, přivedený na první vstup prvního paměťového obvodu A, například na první elementární vstup e^ tohoto prvního vstupu prvního paměťového obvodu A, a jehož časové trvání vymezují časové okamžiky ^1’ ^2* ^^ent0 impulsní signál způsobuje v okamžiku t^ záznam do tohoto prvního paměťového obvodu A. Na druhém výstupu F^ prvního paměťového obvodu A vzniká jedničkový výstup ní signál 1J, znázorněný v časovém diagramu J, a jehož konec vymezuje v časovém okamžiku t^ jedničkový impulsní signál 12, znázorněný v časovém diagramu 2, a přivedený na druhý vstup prvního paměťového obvodu A, například na první elementární vstup f^ tohoto druhého vstupu prvního paměťového obvodu A,a jehož časové trvání vymezují časové okamžiky t₆.

V časovém diagramu $ je znázorněn jedničkový impulsní signál 14, přivedený na druhý vstup druhého paměťového obvodu B, například na první elementární vstup h^ tohoto druhého vstupu druhého paměťového obvodu B, a jehož časové'trvání vymezují časové okamžiky tp t^. Tento impulsní signál způsobuje v okamžiku t^ záznam do tohoto druhého paměťového obvodu B. Na prvním výstupu G^ druhého paměťového obvodu B vzniká jedničkový výstupní signál 12, znázorněný v časovém diagramu 2·

Pro první pomocný logický obvod M a druhý pomocný logický obvod N s logickou funkcí ANI je příkladný časový průběh signálu na vstupech třetího paměťového obvodu C následující:

Počínaje časovým okamžikem t^ je jedničkový logický signál na prvním elementárním vstupu m^ vstupu prvního pomocného logického obvodu M, na jeho výstupu je nulový logický signál, na prvním vstupu třetího paměťového obvodu C je tedy nulový logický signál

V časovém rozpětí od okamžiku t^ až do okamžiku t^ jsou na vstupech druhého paměťového obvodu B nulové logické signály. Předpokládá se takový předchozí stav, že na prvním výstupu Gj tohoto druhého paměťového obvodu B je nulový logický signál, který podle předchozího předpokladu trvá až do Časového okamžiku t^.

Na vstupu druhého pomocného logického obvodu N je nulový logický signál, jedničkový logický signál na jeho výstupu přechází na druhý vstup třetího paměťového obvodu C a způsobuje záznam do tohoto třetího paměťového obvodu C, na jehož prvním výstupu vzniká logický signál. V časovém okamžiku t^ přechází tento jedničkový logický signál na druhém vstupu třetího paměťového obvodu C do nulového logického signálu. Vzhledem

201 088 k paměťové funkci se stav třetího paměťového obvodu C nemění, a to až do časového okamžiku tg.

V tomto časovém okamžiku tg způsobuje přechod jedničkového logického signálu 1J na vstupu prvního pomocného logického obvodu M, který představuje logický součet signálů na druhém vstupu a na druhém výstupu F^ prvního paměťového obvodu A, a sice do nulového signálu, vznik jedničkového logického signálu na výstupu tohoto prvního pomocného logického obvodu M a tedy vznik jedničkového logického signálu na prvním vstupu třetího paměťového obvodu C, tedy vznik jedničkového logického signálu na druhém výstupu tohoto třetího paměťového obvodu C.

V časovém diagramu 6 je znázorněn jedničkový logický signál 16 a jedničkový logický signál lg, které představují souhrnně signál na vstupu prvního pomocného logického obvodu M. Logický součet těchto signálů uzavírá průchod signálu lg z prvního výstupu G^ druhého paměťového obvodu B na druhý výstup třetího paměťového obvodu C, což znázorňuje časový diagram £. Čárkovaně je vyznačen jedničkový logický signál 17, který je identický; signálu lg, plné je vyznačen jedničkový signál 18 s uvolněným průchodem na tento druhý výstup Lj třetího paměťového obvodu C.

Je zřejmé, že v příkladném provedení signály na výstupecn Kj, Kg třetího paměťového obvodu C představují signály s uvolněným průchodem, a sice jedničkový logický signál na prvním výstupu tohoto třetího paměťového obvodu C představuje logický součet jedničkového logického signálu 11 na prvním vstupu prvního paměťového obvodu A zaznamenaném jako jedničkový logický signál lg na druhém výstupu F^ prvního paměťového obvodu A a jedničkového logického signálu 12 na druhém vstupu tohoto prvního paměťového obvodu A, a to s uvolněným průchodem, jedničkový logický signál 18 na druhém výstupu tohoto třetího paměťového obvodu C představuje časově posunutý logický součet jedničkového logického signálu 14 na druhém vstupu druhého paměťového obvodu B zaznamenaném jako jedničkový logický signál 15 na prvním výstupu G^ tohoto druhého paměťového obvodu B, a to až do časového okamžiku tg uvolnění jeho průchodu.

Souhrnně logický součet signálů na elementárních vstupech f^, fg druhého vstupu prvního paměťového obvodu A a signálu na druhém výstupu F^ tohoto prvního paměťového obvodu A rovný logické jedničce má uvolněný průchod na první výstup Kj třetího paměťového obvodu C hodnotou logické nuly logického součtu signálů na elementárních vstupech gp gg prvního vstupu druhého paměťového obvodu B a signálu na prvním výstupu G₁ tohoto druhého paměťového obvodu B, a naopak, logický součet signálů na elementárních vstupech g-^, gg prvního vstupu druhého paměťového obvodu B a signálu na prvním výstupu tohoto druhého paměťového obvodu B rovný logické jedničce má uvolněný průchod na druhý výstup třetího paměťového obvodu C hodnotou logické nuly logického součtu signálů na elementárních vstupech fp fg druhého vstupu prvního paměťového obvodu A, a signálu na druhém výstupu F^ tohoto prvního paměťového obvodu A.

Uplatnění zapojení pro záznam a zamezení časového překrytí signálů podle vynálezu je

201 088 zejména v oblasti syntézy složitých logických obvodů řídicích soustav.

Bezprostřední uplatnění je například ve výrobních linkách, kde jedna informace, defi novaná záznamovým a mazacím signálem, vyvolává jednu odvozenou informaci, například řídicí signál, popřípadě časovou posloupnost řídicích signálů, další informace, definovaná obdobným záznamovým a mazacím signálem vyvolává další odvozenou informaci, například další řídicí signál, popřípadě další časovou posloupnost řídicích signálů a podobně, a kde je nutno spolehlivě zamezit časové překrytí jedné odvozené informace a další odvozené informace, popřípadě zamezit časové překrytí příslušných řídicích signálů a podobně, a to včetně časového trvání příslušného záznamového a mazacího signálu té informace, která má právě uvolněný průchod.

Přednosti tohoto uplatnění je zejména jednoduchost, přehlednost a snadná realizovatelnost příslušné logické sítě.

Claims

PŘEDMĚT VYNÁLEZU

1. Zapojení pro záznam a zamezení časového překrytí signálů, vyznačené tím, že druhý výstup /F-j/ prvního paměťového obvodu /A/ je připojen k prvnímu vstupu /k^/ třetího paměťového obvodu /0/ přes první pomocný logický obvod /M/, jehož další vstupy jsou spojeny se vstupy prvního paměťového obvodu /A/, přičemž první výstup /Gj/ druhého paměťového obvodu /B/ je připojen k druhému vstupu /1^/ třetího paměťového obvodu /0/ přes druhý pomocný logický obvod /N/, jehož další vstupy jsou spojeny se vstupy druhého paměťového obvodu /B/.
2. Zapojení podle bodu 1, vyznačené tím, že paměťový obvod /A, B, C/ se skládá z prvního obvodu ANI /E/, s výstupem /E-j/ spojeným se vstupem /f^/ dalšího obvodu ANI /F/, jehož výstup /F/ je spojen se vstupem /e^/ tohoto prvního obvodu /E/.