CN206040617U - 一种提高气密性的塑封管壳产品 - Google Patents

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Abstract

本实用新型公开了一种提高气密性的塑封管壳产品,包括载板、塑封围墙及盖板,所述塑封围墙围合在载板的边缘,形成放置芯片的型腔,所述盖板盖合在所述塑封围墙上,使型腔形成密闭的空间,所述塑封围墙表面涂覆密封涂层,所述载板的靠近型腔的非金属表面涂覆密封涂层,所述盖板的与塑封围墙配合的部位的表面涂覆密封涂层。本实用新型的产品的气密性大大提高,能够防止外界水汽进入塑封管壳内部,从而增加了使用寿命。本实用新型的产品结构简单,材料成本低且获得容易,降低了产品的成本。

Description

一种提高气密性的塑封管壳产品
技术领域
本实用新型属于半导体封装技术领域,具体涉及一种提高气密性的塑封管壳产品。
背景技术
半导体生产流程由晶圆制造、晶圆测试、芯片封装和封装后测试组成。半导体封装是指将通过测试的晶圆按照产品型号及功能需求加工得到独立芯片的过程。封装过程为:来自晶圆前道工艺的晶圆通过划片工艺后被切割为小的晶片(Die),然后将切割好的晶片用胶水贴装到相应的基板(引线框架)架的小岛上,再利用超细的金属导线或者导电性树脂将晶片的接合焊盘(Bond Pad)连接到基板的相应引脚(Lead),并构成所要求的电路;然后再对独立的晶片用塑料外壳加以封装保护,塑封之后还要进行一系列操作,封装完成后进行成品测试,通常经过入检Incoming、测试Test和包装Packing等工序,最后入库出货。
现有封装管壳类产品采用的封装材料为金属、陶瓷及塑料,由于金属材料和陶瓷材料内部分子排列紧密,分子间不存在间隙,而塑料封装材料(简称塑封料)的内部分子间存在一定空隙,可通过气体分子、水分子等小分子,封装气密性较差,因此通过塑封成型的塑封管壳的气密性也无法与金属和陶瓷类相提并论,即使在塑封管壳顶部加盖子后,其气密性也不会有很大改善,但是塑封管壳较低的制作成本是金属和陶瓷类无法比拟的。塑封管壳的气密性较低,水分子及其他小分子很容易通过塑封料内部间隙进入塑封管壳内部,导致塑封管壳内部水汽含量升高,使芯片及电连接系统发生各种物理化学反应,从而使操作器件参数不稳定甚至失效,从而降低使用寿命,所以急需一种能够提高塑封管壳的气密性的产品。
实用新型内容
本实用新型的目的在于克服现有技术的缺陷,因而提供了一种提高气密性的塑封管壳产品。
为实现上述目的,本实用新型的技术方案为:
一种提高气密性的塑封管壳产品,包括载板、塑封围墙及盖板,所述塑封围墙围合在载板的边缘,形成放置芯片的型腔,所述盖板盖合在所述塑封围墙上,使型腔形成密闭的空间,所述塑封围墙表面涂覆密封涂层,所述载板的靠近型腔的非金属表面涂覆密封涂层,所述盖板的与塑封围墙配合的部位的表面涂覆密封涂层。
优选的,所述盖板与塑封围墙的配合处设有粘结层。
进一步优选的,所述粘结层为蒸镀金属层或者非透气有机涂层。
更进一步优选的,所述蒸镀金属层为Au层、Sn层、Pb层、Ni层、Pt层中的一层或多层。
更进一步优选的,所述非透气有机涂层为气密性硅胶层。
优选的,所述密封涂层为蒸镀金属层或者非透气有机涂层。
进一步优选的,所述蒸镀金属层为Au层、Sn层、Pb层、Ni层、Pt层中的一层或多层。
进一步优选的,所述非透气有机涂层为气密性硅胶层。
优选的,所述盖板的材质为金属、玻璃或塑料。
优选的,所述型腔内设有芯片。
进一步优选的,所述芯片粘结在载板的焊盘上。
进一步优选的,所述芯片通过导线与载板的引脚相连。
与现有技术相比,本实用新型的有益效果是:
1.本实用新型的产品的气密性大大提高,能够防止外界水汽进入塑封管壳内部,从而增加了使用寿命。
2.本实用新型的产品结构简单,材料成本低且获得容易,降低了产品的成本。
附图说明
图1为塑封管壳的主视图;
图2为图1A-A向的截面图;
图3为未贴装掩膜板的塑封管壳的主视图;
图4为图3A-A向的截面图;
图5为贴装掩膜板后的塑封管壳的主视图;
图6为图5B-B向的截面图;
图7为图6A处的放大图;
图8为涂覆密封涂层的塑封管壳的主视图;
图9为图8C-C向的截面图;
图10为图9A处的放大图;
图11为封装芯片后的塑封管壳的主视图;
图12为图11D-D向的截面图;
图13为图12A处的放大图;
图14为涂覆密封涂层的盖板的主视图;
图15为图14A-A向的截面图;
图16为图15A处的放大图;
图17为盖板盖合塑封管壳的主视图;
图18为图17D-D向的截面图;
图19为图18A处的放大图;
其中,101.塑封管壳,102.型腔,103.塑封围墙,104.塑封料,105.引脚,106.焊盘,107.掩膜板,108.密封涂层,109.盖板,110.粘结层。
具体实施方式
下面结合实施例及附图对本实用新型作进一步说明。
实施例1
一种提高气密性的塑封管壳产品,如图1-19所示,包括载板、塑封围墙103及盖板109,所述塑封围墙103围合在载板的边缘,形成放置芯片的型腔102,所述盖板109盖合在所述塑封围墙103上,使型腔102形成密闭的空间,所述塑封围墙103表面涂覆密封涂层108,所述载板的靠近型腔102的非金属表面涂覆密封涂层108,所述盖板109的与塑封围墙103配合的部位的表面涂覆密封涂层108。所述盖板109与塑封围墙103的配合处设有粘结层110。
所述密封涂层108为蒸镀金属层。
所述蒸镀金属层为Au层。
所述盖板109的材质为塑料。
所述型腔102内设有芯片。
所述载板为金属引线框架。
所述芯片粘结在金属引线框架的焊盘106上。
所述芯片通过导线与金属引线框架的引脚105相连。
其制备方法为:
(1)提供塑封管壳101,如图1-4所示,所述塑封管壳101包括载板和塑封围墙103,所述塑封围墙103围合在载板的边缘,形成放置芯片的型腔102;
(2)采用掩膜板107掩盖型腔底部载板裸露的金属部分,如图5-7所示;采用金属引线框架作为塑封管壳101的载板,掩膜板107掩盖金属引线框架中的所有引脚105及焊盘106,仅留出引脚105间的塑封料104;
(3)对步骤(2)处理后的塑封管壳101进行金属真空蒸镀,使塑封围墙103表面及型腔102底部载板的非金属部分均形成一层密封涂层108,密封涂层108为Au层,如图8-10所示;
(4)将掩膜板107拆除后将芯片封装入塑封管壳101的型腔102内,如图11-13所示;将胶黏剂在焊盘上进行点胶,然后进行芯片上片,胶黏剂固化后再进行焊线;
(5)提供盖板109,所述盖板109能够盖合在所述塑封围墙103上,使型腔102形成密闭的空间;
(6)采用掩膜板107掩盖与塑封围墙103配合的盖板109表面的中间部分,使与塑封围墙103配合的所述盖板109配合处的盖板109表面露出;
(7)对步骤(6)处理后的盖板109进行金属真空蒸镀,使掩盖掩膜板107的盖板109一侧的未掩盖掩膜板107处形成一层密封涂层108,密封涂层108为Au层,如图14-16所示;
(8)将涂覆密封涂层108的盖板109盖合在涂覆密封涂层108的塑封管壳101上,并将盖板109与塑封管壳101配合处的密封涂层108进行焊接,形成粘结层110,使盖板109粘合在塑封管壳101上,如图17-19所示。
实施例2
本实施例与实施例1相同,不同之处在于:
蒸镀金属层为Sn层。
实施例3
本实施例与实施例1相同,不同之处在于:
蒸镀金属层为Pb层。
实施例4
本实施例与实施例1相同,不同之处在于:
蒸镀金属层为Ni-Pt-Au多金属层。盖板的材质为金属。
实施例5
本实施例与实施例1相同,不同之处在于:
蒸镀金属层为Ni-Au多金属层。
实施例6
本实施例与实施例1相同,不同之处在于:
蒸镀金属层为Ni-Au-Sn多金属层。盖板的材质为玻璃。
实施例7
本实施例与实施例1相同,不同之处在于:
密封涂层108为气密性硅胶层。将盖板109与塑封管壳101配合处的密封涂层108进行粘合。
实施例8
本实施例与实施例1相同,不同之处在于:
采用基板(PCB板)作为载板,采用掩膜板(107)全部盖住型腔102底部的基板(PCB板)上的所有引脚和金属部分,留出其他非金属部分。
采用倒装封装技术进行芯片封装。
上述虽然结合附图对本实用新型的具体实施方式进行了描述,但并非对实用新型保护范围的限制,所属领域技术人员应该明白,在本实用新型的技术方案的基础上,本领域技术人员不需要付出创造性劳动即可做出的各种修改或变形仍在本实用新型的保护范围内。

Claims (10)

1.一种提高气密性的塑封管壳产品,其特征是,包括载板、塑封围墙及盖板,所述塑封围墙围合在载板的边缘,形成放置芯片的型腔,所述盖板盖合在所述塑封围墙上,使型腔形成密闭的空间,所述塑封围墙表面涂覆密封涂层,所述载板的靠近型腔的非金属表面涂覆密封涂层,所述盖板的与塑封围墙配合的部位的表面涂覆密封涂层。
2.如权利要求1所述的一种提高气密性的塑封管壳产品,其特征是,所述盖板与塑封围墙的配合处设有粘结层。
3.如权利要求2所述的一种提高气密性的塑封管壳产品,其特征是,所述粘结层为蒸镀金属层或者非透气有机涂层。
4.如权利要求1所述的一种提高气密性的塑封管壳产品,其特征是,所述密封涂层为蒸镀金属层或者非透气有机涂层。
5.如权利要求4所述的一种提高气密性的塑封管壳产品,其特征是,所述蒸镀金属层为Au层、Sn层、Pb层、Ni层、Pt层中的一层或多层。
6.如权利要求4所述的一种提高气密性的塑封管壳产品,其特征是,所述非透气有机涂层为气密性硅胶层。
7.如权利要求1所述的一种提高气密性的塑封管壳产品,其特征是,所述盖板的材质为金属、玻璃或塑料。
8.如权利要求1所述的一种提高气密性的塑封管壳产品,其特征是,所述型腔内设有芯片。
9.如权利要求8所述的一种提高气密性的塑封管壳产品,其特征是,所述芯片粘结在载板的焊盘上。
10.如权利要求8所述的一种提高气密性的塑封管壳产品,其特征是,所述芯片通过导线与载板的引脚相连。
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* Cited by examiner, † Cited by third party
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