CN205864853U - 一种印制电路板 - Google Patents

一种印制电路板 Download PDF

Info

Publication number
CN205864853U
CN205864853U CN201620665646.6U CN201620665646U CN205864853U CN 205864853 U CN205864853 U CN 205864853U CN 201620665646 U CN201620665646 U CN 201620665646U CN 205864853 U CN205864853 U CN 205864853U
Authority
CN
China
Prior art keywords
printed circuit
circuit board
line layer
layer
board
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
CN201620665646.6U
Other languages
English (en)
Inventor
何为
胡志强
陈苑明
艾克华
王守绪
叶金洪
何雪梅
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
University of Electronic Science and Technology of China
Inno Circuits Ltd
Original Assignee
Innoquick Electronics Ltd
University of Electronic Science and Technology of China
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Innoquick Electronics Ltd, University of Electronic Science and Technology of China filed Critical Innoquick Electronics Ltd
Priority to CN201620665646.6U priority Critical patent/CN205864853U/zh
Application granted granted Critical
Publication of CN205864853U publication Critical patent/CN205864853U/zh
Expired - Fee Related legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Landscapes

  • Manufacturing Of Printed Wiring (AREA)

Abstract

本实用新型公开了一种印制电路板,印制电路板主要由多个层状叠加的第一结构和第二结构组成,所述第一结构与第二结构间隔分布,第一结构与第二结构之间通过热压成形,所述第一结构主要由线路载体组成,所述线路载体内嵌有导电凸块和线路层,所述导电凸块电镀于线路层上,所述第二结构主要由绝缘介质板组成,所述绝缘介质板上内嵌有导电块,相邻的两个第一结构上的线路层通过导电块连通。与现有技术相比,本实用新型有利于精细线路满足特定的阻抗特性要求,制成的线路导电性好,成本低,第一结构和第二结构依次交叉相叠只需一次压合便能形成任意层的印制电路板,生产效率高,节省生产时间和生产成本。

Description

一种印制电路板
技术领域
本实用新型涉及一种电子领域,尤其涉及一种印制电路板。
背景技术
随着社会与科学技术的发展,电子产品日益小型化,此发展趋势也导致了实现不同器件连接的印制电路板以及半导体芯片封装用的基板在保证良好的电性能和热性能的前提下向着轻、薄、短、小的方向发展。为达到以上的要求,尺寸更小的精细线路,厚度更薄的绝缘层是必须满足的技术条件。根据线路形成方法分类,主要有三类方法用于线路制作,分另是减成法、半加成法与全加成法。
①减成法。即在铜箔表面,贴膜显影形成抗蚀图形,通过选择性蚀刻去除裸露铜层,去抗蚀图形后得到导体图形。减成法出现时间最早,应用很广泛,然而其缺点也很明显,文献[印制电路信息,2012(2):8-12]对其做了详细研究。这种方法最大的缺点在于,蚀刻过程中,裸露铜层往下蚀刻的同时,也会往侧面蚀刻,在正常铜层厚度要求下,侧蚀往往过大,造成线路形成的困难。并且,减成法制作过程复杂,工序多,会耗用大量的水电,也会耗用大量的铜和化学品材料,并产生大量的废水等污染物,造成严重的污染和浪费。以上缺陷严重制约了减成法印制线路板制作中的应用和发展。
②半加成法。即采用绝缘基板,在绝缘层上形成被称为种子层的金属层,在其表面形成镀敷抗蚀层,其后进行曝光、显影,形成抗镀图形。其后,对未被抗镀层覆盖部分进行电镀镀铜,剥离抗镀层,蚀刻去除种子层形成线路。这种方法一般通过化学镀铜沉积种子层,由于化学沉铜得到的铜层很薄,易于蚀刻,相对来说,在一定程度上减小了线路的侧蚀,可以用于制作具有精细线路的印制电路板。然而,绝缘基材上沉积化学铜,容易出现化学镀铜层与基材附着了不足而发生分层起泡。中国实用新型专利CN200710087205.8中采用溅射法代替化学镀铜在基材表面形成铜膜作为种子层,但是溅射形成的铜膜表面光滑,无法与抗蚀干膜材料紧密贴合,难以形成图形。中国实用新型专利CN201310139462.7提出了一种层压超薄铜作为种子层的方法,然而由于铜箔很薄,层压是易产生褶皱和划伤。对此,申请号为CN2012101008183.X的中国实用新型专利进行了一些改进,使用普通铜箔代替超薄铜层压后再进行减薄处理,这种方法避免了使用昂贵的超薄铜箔,但是减铜后铜层厚度不易控制且铜的损耗量太大。
③全加成法,即采用含光敏催化剂的绝缘基板,在按线路图形曝光后,通过选择性化学沉铜得到导体图形的工艺。现有的全加成法工艺适合制作精细线路,但其基材有特殊要求,成本高且工艺还不成熟,不能大规模应用于印制电路板制作。
无论其采用全加成法还是半加成法都存在传统加成法过程的各种缺陷,并且由于其子板线路制作在未固化的绝缘基材上,热压时树脂融化,线路极易在印制电路板中移动使其很难得到合格的印制电路板。
实用新型内容
本实用新型的目的就在于提供一种解决了上述问题得到印制电路板,该方法操作简单,成本低,效率高,有效解决了全加成法制作印制线路板的高成本以及生产效率低下的问题。
为了实现上述目的,本实用新型采用的技术方案是:一种印制电路板,印制电路板主要由多个层状叠加的第一结构和第二结构组成,所述第一结构与第二结构间隔分布,第一结构与第二结构之间通过热压成形,所述第一结构主要由线路载体组成,所述线路载体内嵌有导电凸块和线路层,所述导电凸块电镀于线路层上,所述第二结构主要由绝缘介质板组成,所述绝缘介质板上内嵌有导电块,相邻的两个第一结构上的线路层通过导电块连通。
作为优选,所述线路载体为树脂板;所述绝缘介质板为半固化片。
作为优选,导电块为固化的导电浆料。
作为优选,所述第一结构的导电凸块与线路层的外侧面分别露在线路载体的上下表面上。
作为优选,所述印制电路板的上、下表面均为第一结构带线路层外侧面的一侧。
与现有技术相比,本实用新型的优点在于:
1、本实用新型以全加成法制作线路,线路完成后蚀刻掉厚铜箔并热风吹掉作为种子层的锡层,这一过程中不会对线路造成腐蚀,最终能得到截面为标准矩形的精细线路,有利于精细线路满足特定的阻抗特性要求。
2、本实用新型的全加成法在锡层表面电镀铜制作线路,制成的线路导电性好,成本低,不需要用到高成本的光敏树脂或者导电油墨。
3、导电凸块作为层间互连结构互连可靠性高,塞导电浆料的半固化片作为层间粘结结构有利于实现全加成结构的快速互连。4、第一结构和第二结构依次交叉相叠只需一次压合便能形成任意层的印制电路板,生产效率高,节省生产时间和生产成本。
附图说明
图1为本实用新型第二次电镀铜后的结构示意图;
图2为本实用新型退去抗镀层a和抗镀层b的结构示意图;
图3为本实用新型包裹树脂的结构示意图;
图4为本实用新型第一结构的结构示意图;
图5为本实用新型第二结构的结构示意图;
图6本本实用新型印制电路板结构示意图。
图中:101、铜箔;102、锡层;103、抗镀层a;104线路层;105抗镀层b;106、导电凸块;107、树脂板;201、半固化片;202、导电块。
具体实施方式
下面将对本实用新型作进一步说明。
实施例:一种印制电路板,参见图6,印制电路板主要由多个层状叠加的第一结构和第二结构组成,所述第一结构与第二结构间隔分布,第一结构与第二结构之间通过热压成形,所述第一结构主要由线路载体组成,所述线路载体内嵌有导电凸块106和线路层104,所述导电凸块106电镀于线路层104上,所述第二结构主要由绝缘介质板组成,所述绝缘介质板上内嵌有导电块202,相邻的两个第一结构上的线路层通过导电块连通,所述线路载体为树脂板107;所述绝缘介质板为半固化片201,半固化片201作为层间粘结结构,为层间互连结构互连可靠性高,导电块202为固化的导电浆料,固化的导电浆料有利于实现全加成结构的快速互连。所述第一结构的导电凸块106与线路层104的外侧面分别露在线路载体的上下表面上,所述印制电路板的上、下表面均为第一结构带线路层外侧面的一侧。
一种印制电路板的全加成制作方法,方法步骤如下,
(1)首先选取一厚铜箔101,在厚铜箔101上覆盖一层锡层102.在本步骤中覆盖锡层的方法可以为电镀锡或者喷锡,在本实施实例中,选取喷锡,锡层厚度为20~25μm。
(2)在锡层上覆盖一层感光抗蚀剂,曝光显影后形成抗镀层a103。在本步骤中,感光抗蚀剂可以为固态感光抗蚀剂或者液态感光抗蚀剂,曝光方式可以为菲林曝光或者激光直接成像(LDI),显影试剂可以为碳酸钾或者碳酸钠溶液。在本实施实例中,选取固态感光抗蚀剂,其厚度为30~35μm,激光直接成像进行曝光,显影剂为碳酸钾溶液。
(3)在未被抗镀层保护的锡表面电镀镀铜,形成线路层104。该电镀过程中电镀液选取焦磷酸铜电镀液,电镀铜厚度为30~35μm与抗蚀剂厚度一致。
(4)在电镀铜形成线路的基板表面覆盖第二层感光抗蚀剂,形成抗镀层b105,并在对应的线路层上方露出需要制作导通孔的区域,与步骤2相似,本实施同样选择固态感光抗蚀剂,其厚度为40~50μm,激光直接成像进行曝光,显影剂为碳酸钾溶液。
(5)参加图1,在未被抗镀层覆盖的导通孔区域进行第二次电镀铜,形成导电凸块106,该电镀过程中电镀液为硫酸铜溶液。该步骤中电镀的导电凸块高度可根据印制电路板中该层的介质层厚度来确定,在本实施实例中,铜凸块高度与抗蚀剂厚度一致为40~50μm。
(6)参见图2,通过退膜液退去抗镀层a103和抗镀层b105,留下线路层104及导电凸块106。在本实施实例中退膜液为NaOH溶液。
(7)参见图3,将露出的线路层104后导通铜凸块用树脂包裹,固化树脂后磨平树脂表面,形成树脂板107。在本步骤中,树脂的主要成分为双酚A环氧树脂、芳香胺、酸酐固化剂以及碳化硅和氮化硅等填料,烘干树脂的温度为155~165℃,时间为2~3小时,磨平树脂后需露出导通铜凸块上表面。
(8)参见图4,蚀刻掉厚铜箔101,热风吹去锡层102,得到线路层内嵌于树脂板的单层线路板,即第一结构。
(9)制作带导电块的第二结构;
参见图5,选取固化片,在半固化片中与线路层导通孔对应区域钻孔;用导电浆料塞填孔,并固化导电浆料,固化后磨刷半固化片表面去除表面导电浆料,形成带固化导电浆的第二结构。选取的半固化片的Tg值应大于等于170℃,钻孔方式可以为机械钻孔或者激光钻孔,在本实施实例中选取激光钻孔,钻孔的部位与线路层导通孔的部位相对应。用导电银浆对半固化片进行塞孔,然后固化导电浆料。导电浆料塞孔方法为以在填孔相应位置钻孔的环氧树脂板作为网板进行印刷填孔,导电浆料固化温度应低于半固化片Tg值为100~140℃,固化后磨刷半固化片表面去除表面导电浆料。
(10)将第一结构和第二结构依次交叉叠加,并通过热压形成印制板
参见图6,在一层第二结构两侧各贴合一层第一结构,再在第一结构外依次叠放第二结构、第一结构直至达到印制电路板需要的层数,在叠合过程中,第一结构包含线路的一面需置于线路板外侧。最终,N层第一结构和N-1层第二结构经过一次热压形成任意层数的印制电路板。压合温度为180~210℃,压力为20~50MPa,时间为2~3h。
以上对本实用新型所提供的一种印制电路板进行了详尽介绍,本文中应用了具体个例对本实用新型的原理及实施方式进行了阐述,以上实施例的说明只是用于帮助理解本实用新型的方法及其核心思想;同时,对于本领域的一般技术人员,依据本实用新型的思想,在具体实施方式及应用范围上均会有改变之处,对本实用新型的变更和改进将是可能的,而不会超出附加权利要求所规定的构思和范围,综上所述,本说明书内容不应理解为对本实用新型的限制。

Claims (5)

1.一种印制电路板,其特征在于:印制电路板主要由多个层状叠加的第一结构和第二结构组成,所述第一结构与第二结构间隔分布,第一结构与第二结构之间通过热压成形,所述第一结构主要由线路载体组成,所述线路载体内嵌有导电凸块和线路层,所述导电凸块电镀于线路层上,所述第二结构主要由绝缘介质板组成,所述绝缘介质板上内嵌有导电块,相邻的两个第一结构上的线路层通过导电块连通。
2.根据权利要求1所述的一种印制电路板,其特征在于:所述线路载体为树脂板;所述绝缘介质板为半固化片。
3.根据权利要求1所述的一种印制电路板,其特征在于:导电块为固化的导电浆料。
4.根据权利要求1所述的一种印制电路板,其特征在于:所述第一结构的导电凸块与线路层的外侧面分别露在线路载体的上下表面上。
5.根据权利要求1所述的一种印制电路板,其特征在于:所述印制电路板的上、下表面均为第一结构带线路层外侧面的一侧。
CN201620665646.6U 2016-06-28 2016-06-28 一种印制电路板 Expired - Fee Related CN205864853U (zh)

Priority Applications (1)

Application Number Priority Date Filing Date Title
CN201620665646.6U CN205864853U (zh) 2016-06-28 2016-06-28 一种印制电路板

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN201620665646.6U CN205864853U (zh) 2016-06-28 2016-06-28 一种印制电路板

Publications (1)

Publication Number Publication Date
CN205864853U true CN205864853U (zh) 2017-01-04

Family

ID=57644037

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201620665646.6U Expired - Fee Related CN205864853U (zh) 2016-06-28 2016-06-28 一种印制电路板

Country Status (1)

Country Link
CN (1) CN205864853U (zh)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN105934084B (zh) * 2016-06-28 2019-06-07 电子科技大学 一种印制电路板及其全加成制作方法
CN110213895A (zh) * 2019-06-10 2019-09-06 深圳市鼎盛电路技术有限公司 一种pcb线路制作方法及pcb

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN105934084B (zh) * 2016-06-28 2019-06-07 电子科技大学 一种印制电路板及其全加成制作方法
CN110213895A (zh) * 2019-06-10 2019-09-06 深圳市鼎盛电路技术有限公司 一种pcb线路制作方法及pcb

Similar Documents

Publication Publication Date Title
CN101436547B (zh) 高散热性封装基板的制作方法
CN100372103C (zh) 倒装球栅阵列封装基板及其制作工艺
CN105934084B (zh) 一种印制电路板及其全加成制作方法
CN108419376A (zh) 一种选择性局部电镀高厚铜pcb板的制作方法
US8895380B2 (en) Method of making semiconductor assembly with built-in stiffener and semiconductor assembly manufactured thereby
KR20080037307A (ko) 회로기판 및 그 제조방법
CN100581314C (zh) 线路板的立体图案化结构及其工艺
TWI287957B (en) Circuit board structure and fabricating method thereof
CN110621123A (zh) 一种导热pcb的制作方法及pcb
CN205864853U (zh) 一种印制电路板
TWI275332B (en) Method for fabricating interlayer conducting structure of circuit board
CN102548254A (zh) 芯片载体的无核制作方法
US6651324B1 (en) Process for manufacture of printed circuit boards with thick copper power circuitry and thin copper signal circuitry on the same layer
CN103874347B (zh) 高密度多层基板表面对称结构及制作方法
TWI581697B (zh) Method for manufacturing heat dissipation structure of ceramic substrate
JP2010034430A (ja) 配線基板及びその製造方法
CN102026489A (zh) 电路板的制作方法
CN102413639B (zh) 一种电路板的制造方法
JP3631682B2 (ja) 多層配線基板及びその製造方法
JP4666830B2 (ja) 多層配線基板及びその製造方法
CN101959374B (zh) 一种多层印制电路板的制造方法
KR100547349B1 (ko) 반도체 패키지 기판 및 그 제조 방법
CN117241466B (zh) 一种内埋器件的液冷电路板及其制备方法
JP2007235176A (ja) 多層配線基板とそれを用いた半導体装置
CN108901149A (zh) 一种可成像型介电材料制作双面埋线印制电路板的方法

Legal Events

Date Code Title Description
C14 Grant of patent or utility model
GR01 Patent grant
CP01 Change in the name or title of a patent holder
CP01 Change in the name or title of a patent holder

Address after: 611731, No. 2006, West Avenue, hi tech West District, Sichuan, Chengdu

Co-patentee after: INNO CIRCUITS LIMITED

Patentee after: University of Electronic Science and Technology of China

Address before: 611731, No. 2006, West Avenue, hi tech West District, Sichuan, Chengdu

Co-patentee before: INNOQUICK ELECTRONICS Ltd.

Patentee before: University of Electronic Science and Technology of China

CF01 Termination of patent right due to non-payment of annual fee

Granted publication date: 20170104