CN202711110U - 一种低成本的上电时序控制电路 - Google Patents
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Abstract
本实用新型公开了一种低成本的上电时序控制电路,包括:延时电路连接NMOS管的栅极,NMOS管的源极接地,低压差线性稳压器LDO的输出电压连接PMOS管的源极,低压差线性稳压器LDO的输出电压还通过一电阻同时连接到PMOS管的栅极和NMOS管的漏极。本实用新型电路可用于实现延时上电功能,其电路简单,成本低廉,可广泛应用于嵌入式处理器、TFT液晶等电源电路中,满足其多工作电压实现按顺序上电的需求。
Description
技术领域
本实用新型属于计算机嵌入式硬件技术领域,尤其涉及一种低成本的上电时序控制电路。
背景技术
随着IT技术的不断发展,大量的嵌入式处理器MPU广泛应用到通信、工业等诸多领域。随着嵌入式处理器主频越来越高,处理器的设计也越来越复杂,一般来说新的处理器都需要外部提供多种供电电压,如处理器待机电压、核心电压、IO电压等等。为保证处理器能够正常启动,绝大多数处理器都需要这些供电电压按一定的顺序进行启动,以避免内部电路发生紊乱。与嵌入式处理器类似,TFT液晶启动一般也需要提供多种驱动电压,这些电压也同样有启动顺序的要求。作为处理器的提供厂家,为解决上电时序问题,一般都提供与芯片配套的电源管理芯片(PMU),电源管理芯片可根据芯片上电时序要求实现多电压顺序上电功能,但PMU芯片比较复杂,成本较高,同时也与其配套处理器芯片关系密切,灵活性较差。
发明内容
针对上述存在的技术问题,本实用新型的目的是提供一种低成本的上电时序控制电路,该电路实现简单,成本低廉,灵活性好,适合各种不同的上电时序应用场合,用户也可通过组合该电路实现多种不同电压的上电时序。
为了达到上述目的,本实用新型采用如下的技术方案:
一种低成本的上电时序控制电路,包括:
延时电路连接NMOS管的栅极,NMOS管的源极接地,低压差线性稳压器LDO的输出电压连接PMOS管的源极,低压差线性稳压器LDO的输出电压还通过一电阻同时连接到PMOS管的栅极和NMOS管的漏极。
上述延时电路为阻容延时电路。
上述低压差线性稳压器LDO为三端口的1117芯片。
与现有技术相比,本实用新型电路具备如下功能和特色:
1、本实用新型电路简单、成本低廉,可实现延时上电功能,可应用于嵌入式处理器、TFT液晶等电源电路中,满足其多工作电压实现按顺序上电的需求;
2、本实用新型电路通过控制电压来控制输出电压,从而实现输出电压在控制电压后上电的功能;
3、本实用新型通过调整延时电路中的电阻值和电容值,来实现不同的上电延时时间,满足处理器上电时序中对延时时间的要求;
4、本实用新型中的LDO可以选择不带使能功能的低成本LDO,在多电压应用下成本下降尤为明显。
附图说明
图1为本实用新型的电路原理框图;
图2为本实用新型一种具体实施的电路图。
具体实施方式
参见图1,本实用新型电路由一低压差线性稳压器LDO、一NMOS管、一PMOS管、一延时电路和一电阻组成,其中,LDO用于产生系统输出电压,NMOS管和PMOS管实现了LDO输出电压到电路最终输出电压的控制,只有当控制电压达到MOS管门限值时系统才有电压输出,延时电路可用于调节上电的延时时间,电阻用来保证PMOS管漏极的电压输出;需要实现上电时序的控制电压通过延时电路输入至NMOS管的栅级,而PMOS管的漏极则为电压输出端。
本具体实施中的LDO采用的是成本低廉的三端口1117芯片,延时电路为阻容延时电路,参见图2。本实用新型电路中,低压差线性稳压器LDO用于产生系统的输出电压,但该输出电压(VCCLDO)不能直接输出到VCCOUT,需要受控制电压VCC_CTRL的控制,当控制电压VCC_CTRL达到MOS管门限值(即,导通电压)后,VCCLDO才可以输出到VCCOUT。电路中使用了两个MOS管Q1和Q2,其中,Q1为PMOS管,Q2为NMOS管,系统原理如下:当控制电压VCC_CTRL未达到Q2的导通电压时,Q2的栅极电压较低,Q2管截止,则Q2的漏极电压为LDO输出电压VCCLDO,从而Q1管也截止,系统无电压输出。当VCC_CTRL达到Q2的导通电压时,Q2栅极电压升高,Q2管导通,从而Q2的漏极电压为0,Q1的栅极电压也为0,Q1管导通,LDO输出电压VCCLDO直接输出到VCCOUT。
由于Q1管导通电压的要求,VCC_CTRL必须大于Q2管的导通电压才能够开启Q1管,为保证当VCC_CTRL大于Q2管导通电压后控制上电时间,电路中加入了一个阻容延时电路,由于电容的充电特性,使得实际到Q2管管栅极的电压将缓慢上升到VCC_CTRL。因此,通过该阻容电路可以调节在VCC_CTRL大于Q2管导通电压后开启Q2管的时间,其时间可由阻容电路时间常数来确定,用户可根据实际处理器上电时序要求来调节电阻和电容的值。
Claims (3)
1.一种低成本的上电时序控制电路,其特征在于,包括:
延时电路连接NMOS管的栅极,NMOS管的源极接地,低压差线性稳压器LDO的输出电压连接PMOS管的源极,低压差线性稳压器LDO的输出电压还通过一电阻同时连接到PMOS管的栅极和NMOS管的漏极。
2.根据权利要求1所述的低成本的上电时序控制电路,其特征在于:
所述的延时电路为阻容延时电路。
3.根据权利要求1所述的低成本的上电时序控制电路,其特征在于:
所述的低压差线性稳压器LDO为三端口的1117芯片。
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