CN201909847U - 基于vxi接口的双通道数字信号采集装置 - Google Patents
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Abstract
一种基于VXI接口的双通道数字信号采集装置,其数字信号采集装置中I通道输入口、Ⅱ通道输入口的输入差分时钟经过长线接收器接收后,经电平转换后由FPGA模块选择、整理、延时,产生电平转换器选通信号;SRAM地址、读写控制信号;计算机接收到键盘采集指令后,I通道输入口、Ⅱ通道输入口的输入差分数据通过长线接收器、电平转换器分别写入两片512K*16的SRAM中;数据采集完毕后立即通过VXI总线将暂存在SRAM中的两个通道的数据传送给计算机;时钟模块为FPGA模块提供统一的时钟信号;CPLD总线转换器完成VXI总线到FPGA模块的本地总线转换的功能;电源模块用于提供电源。
Description
技术领域
本实用新型涉及一种数字信号采集装置,尤其涉及一种基于VXI接口的双通道数字信号采集装置, 属于一种电子信息设备领域。
背景技术
常用数字信号采集卡通常以单独设备形式存在,体积较大,工作时需要外部供电,采集卡只能单路采数,采集卡采集到的数字信号需通过串口或者GPIB接口传送到计算机中。
实用新型内容
所要解决的技术问题:
针对以上不足本实用新型提供了一种以VXI模块(C尺寸)的形式插入VXI机箱内,由VXI底板为采集卡供电;采集装置将要采集的数字信号采集、存储,计算机通过1394接口读回存储的数据的数字信号采集装置。
技术方案:
一种基于VXI接口的双通道数字信号采集装置包括I通道输入口、Ⅱ通道输入口、长线接收器、电平转换器、SRAM、FPGA模块、时钟模块、CPLD总线转换器、VXI总线、电源模块、计算机;
数字信号采集装置中I通道输入口、Ⅱ通道输入口的输入差分时钟经过长线接收器接收后,经电平转换后由FPGA模块选择、整理、延时,产生电平转换器选通信号;SRAM地址、读写控制信号;
计算机接收到键盘采集指令后,I通道输入口、Ⅱ通道输入口的输入差分数据通过长线接收器、电平转换器分别写入两片512K*16的SRAM中;偶地址存I路数据,奇地址存Q路数据;
数据采集完毕后立即通过VXI总线将暂存在SRAM中的两个通道的数据传送给计算机;
时钟模块为FPGA模块提供统一的时钟信号;CPLD总线转换器完成VXI总线到FPGA模块的本地总线转换的功能;根据VXI总线协议,CPLD总线转换器采用VXI寄存器通信方式与VXI接口通信,接收来自VXI接口的指令信息,通过内部编码转换成本地总线信息,发送给FPGA模块,FPGA模块将处理结果通过本地总线返回给CPLD总线转换器,CPLD总线转换器通过内部编码转换成VXI总线信息,发送给VXI接口;电源模块用于提供电源。
有益效果:
本基于VXI接口的数字信号采集装置通过对相控阵雷达接收机通道中的I、Q数字中频信号的异步采集,并对采集的数据进行预处理,经通讯接口送入主控计算机进行信号分析,最终实现了对接收通道幅相一致性、AD特性和IQ特性的测试。
附图说明
图1是本基于VXI接口的双通道数字信号采集装置的结构框图。
具体实施方式
下面结合附图和具体实施方式对本实用新型作进一步详细地说明。
如图1所示,本基于VXI接口的双通道数字信号采集装置包括I通道输入口、Ⅱ通道输入口、长线接收器、电平转换器、SRAM、FPGA模块、时钟模块、CPLD总线转换器、VXI总线、电源模块、计算机;
数字信号采集装置中I通道输入口、Ⅱ通道输入口的输入差分时钟经过长线接收器接收后,经电平转换后由FPGA模块选择、整理、延时,产生电平转换器选通信号;SRAM地址、读写控制信号。
计算机接收到键盘采集指令后,I通道输入口、Ⅱ通道输入口的输入差分数据通过长线接收器、电平转换器分别写入两片512K*16的SRAM中。偶地址存I路数据,奇地址存Q路数据。
数据采集完毕后立即通过VXI总线将暂存在SRAM中的两个通道的数据传送给计算机。
PC机的控制信号包括启动采集信号、通道选择信号、延时选择信号和输出控制信号。
时钟模块为FPGA模块提供统一的时钟信号。它是由外部晶振产生的时钟信号,信号频率是50MHz。
CPLD总线转换器完成VXI总线到FPGA模块的本地总线转换的功能。根据VXI总线协议,CPLD总线转换器采用VXI寄存器通信方式与VXI接口通信,接收来自VXI接口的指令信息,通过内部编码转换成本地总线信息,发送给FPGA模块,FPGA模块将处理结果通过本地总线返回给CPLD总线转换器,CPLD总线转换器通过内部编码转换成VXI总线信息,发送给VXI接口。
长线接收器接收来自I通道输入口、Ⅱ通道输入口的差分输入信号。其中每个通道有16位数据差分信号,1位时钟差分信号,这些差分信号经过长线接收模块后,转换成TTL电平信号,高电平5V,低电平0V。
电平转换模块将长线接收器输出的5V信号转换为3.3V信号,0V信号仍然转换为0V信号,之所以需要电平转换,是由于内存和FPGA模块的IO口只能接受最高3.3V电平信号,超过此电平值有可能损坏器件。电源模块用于提供电源。
Claims (1)
1.一种基于VXI接口的双通道数字信号采集装置 ,其特征在于:包括I通道输入口、Ⅱ通道输入口、长线接收器、电平转换器、SRAM、FPGA模块、时钟模块、CPLD总线转换器、VXI总线、电源模块、计算机;
数字信号采集装置中I通道输入口、Ⅱ通道输入口的输入差分时钟经过长线接收器接收后,经电平转换后由FPGA模块选择、整理、延时,产生电平转换器选通信号;SRAM地址、读写控制信号;
计算机接收到键盘采集指令后,I通道输入口、Ⅱ通道输入口的输入差分数据通过长线接收器、电平转换器分别写入两片512K*16的SRAM中;偶地址存I路数据,奇地址存Q路数据;
数据采集完毕后立即通过VXI总线将暂存在SRAM中的两个通道的数据传送给计算机;
时钟模块为FPGA模块提供统一的时钟信号;CPLD总线转换器完成VXI总线到FPGA模块的本地总线转换的功能;根据VXI总线协议,CPLD总线转换器采用VXI寄存器通信方式与VXI接口通信,接收来自VXI接口的指令信息,通过内部编码转换成本地总线信息,发送给FPGA模块,FPGA模块将处理结果通过本地总线返回给CPLD总线转换器,CPLD总线转换器通过内部编码转换成VXI总线信息,发送给VXI接口;电源模块用于提供电源。
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CN2011200084070U CN201909847U (zh) | 2011-01-13 | 2011-01-13 | 基于vxi接口的双通道数字信号采集装置 |
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CN2011200084070U Expired - Lifetime CN201909847U (zh) | 2011-01-13 | 2011-01-13 | 基于vxi接口的双通道数字信号采集装置 |
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CN (1) | CN201909847U (zh) |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN102831805A (zh) * | 2012-06-13 | 2012-12-19 | 清华大学 | 一种用于计算机硬件系列课程的实验装置 |
CN103427825A (zh) * | 2012-05-15 | 2013-12-04 | 中兴通讯股份有限公司 | 时钟信号转换方法和装置 |
CN106950852A (zh) * | 2017-04-11 | 2017-07-14 | 北京航天自动控制研究所 | 一种数据采集装置 |
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2011
- 2011-01-13 CN CN2011200084070U patent/CN201909847U/zh not_active Expired - Lifetime
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Publication number | Priority date | Publication date | Assignee | Title |
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CN103427825B (zh) * | 2012-05-15 | 2017-03-15 | 深圳市中兴微电子技术有限公司 | 时钟信号转换方法和装置 |
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