CN109491940A - 一种tlk2711传输接口与usb3.0传输接口的转换电路及转换方法 - Google Patents
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Abstract
本发明涉及一种TLK2711传输接口与USB3.0传输接口的转换电路及转换方法，转换电路包括数据输入单元、FPGA数据处理单元、数据输出单元及供电单元；数据输入单元包括连接器及与连接器相互通信的TLK27711接收芯片；FPGA数据处理单元包括FPGA单元、外设存储单元、晶振单元及FLASH存储单元；TLK27711接收芯片与FPGA单元双向通信；外设存储单元与FPGA单元连接，用于进行数据存储；数据输出单元包括USB3.0发送芯片及USB3.0接口；USB3.0发送芯片与FPGA相互通信；本发明在使用时将TLK2711传输接口的输出数据实时转换为可以通过USB3.0这一通用数据传输接口进行传输的数据，为TLK2711传输数据在计算机上实时存储与显示提供了一种新的技术手段和方法，解决了现有转换电路价格昂贵的问题。
Description
技术领域
本发明涉及一种高速串行接口向另一种高速串行接口转换的电路，尤其是用于高速串行/解串收发器TLK2711向高速、便携、通用的USB3.0接口的转换电路及转换方法。
背景技术
随着我国空间遥感技术的发展，卫星遥感越来越呈现出高时间分辨率、高空间分辨率和高光谱分辨率的发展趋势，载荷数据类型越来越多样化，数据量越来越大，导致数据率、带宽等由过去几Mbps发展到目前数Gbps甚至更高。数据传输也从传统采用多路LVDS并行传输接口逐渐过渡为更高带宽、更高可靠性的接口，如基于高速串行/解串收发器TLK2711的应用，其单路传输速率高达2.5Gbps，同时TLK2711采用自同步通信方式，利用时钟和数据恢复技术代替同步传输数据和时钟，有效解决了信号和时钟偏移问题；此外，采用了串行通信技术使得设备及电缆布线更为简单，系统抗干扰能力更强。
TLK2711的应用方便了星载高分辨成像数据传输，而对于星载高分辨成像设备在地面演示验证阶段却并不能与采集存储计算机直接建立连接关系(目前计算机通用接口并无TLK2711传输接口)。
目前，国内有研究者将TLK2711数据接口转换为Camera-Link这一传统图像传输接口，但该方法需要Camera-Link转PCIe专用采集卡，工业化的Camera-Link图像采集虽然常见单售价比较昂贵。因此提供一种通用、便携的基于星上设备数据传输采集系统显得尤为重要。
发明内容
为解决高速数据串行总线TLK2711接口与采集存储计算机的数据传输所采用的转换电路价格昂贵的技术问题，本发明提供一种TLK2711传输接口与USB3.0传输接口的转换电路及转换方法。
本发明的技术解决方案如下：
本发明一种TLK2711传输接口与USB3.0传输接口的转换电路，其特殊之处在于：包括数据输入单元、FPGA数据处理单元、数据输出单元及供电单元；
所述数据输入单元包括连接器及与连接器相互通信的TLK27711接收芯片；
所述FPGA数据处理单元包括FPGA单元、外设存储单元、晶振单元及FLASH存储单元；
所述TLK27711接收芯片与FPGA单元双向通信；
所述外设存储单元与FPGA单元连接，用于进行数据存储；
所述FPGA单元包括数据合并逻辑模块及FIFO单元，所述数据合并逻辑模块用于将外设存储单元中所存储的数据进行合并，所述FIFO单元用于将合并后的数据进行存储；
所述晶振单元与FPGA单元连接；所述FLASH存储单元与FPGA单元连接；
所述数据输出单元包括USB3.0发送芯片及USB3.0接口；
所述USB3.0发送芯片与FPGA相互通信，所述USB3.0发送芯片与USB3.0接口相互通信；
所述供电单元包括供电接口及与电源接口连接的电源变换单元，所述电源变换单元用于TLK27711接收芯片、FPGA单元、晶振单元、FLASH存储单元及USB3.0发送芯片的供电。
进一步地，所述供电单元包括供电接口及与电源接口连接的电源变换单元，所述电源变换单元用于TLK27711接收芯片、FPGA单元、晶振单元、FLASH存储单元及USB3.0发送芯片的供电。
进一步地，所述FPGA单元所采用的FPGA型号为XC7K325T-1FBG900I。该型号FPGA逻辑单元充沛，内部RAM存储空间大，性价比高，功耗较低。
进一步地，所述外设存储单元为2片DDR2存储器件MT47H64M16HR芯片，MT47H64M16HR芯片数据位宽16bit。该型号存储芯片的位宽与TLK2711匹配，外部配置电路简单易实现。
进一步地，所述USB3.0发送芯片为FT601Q芯片。
进一步地，所述FLASH存储单元的型号为N25Q256AESF40G。采用该型号的FLASH存储单元性价比高，存储容量满足该电路需求，电路设计简单易行。
进一步地，所述连接器为MKHS连接器。
同时，本发明还提供了基于上述的TLK2711传输接口与USB3.0传输接口的转换电路进行数据转换的方法，其特殊之处在于，包括以下步骤：
1)TLK2711接收芯片将输入的高速串行数据解码为16bit并行数据、1路100Mhz随路时钟、2路K/D编码控制信号；
2)TLK2711接收芯片将16bit并行数据、1路100Mhz随路时钟、2路K/D编码控制信号通过总线的方式输出给FPGA单元；
3)FPGA单元接收数据，并通过内部运行软件调用其内部逻辑单元将有效数据存入外设存储单元，
4)FPGA单元根据一定的访问频率，访问外设存储单元并从外设存储单元中读取数据；
5)FPGA单元将读取的数据合并后存入内部缓存FIFO模块中；数据合并的方式是将16bit并行数据合并为1个32bit，FIFO模块的位宽是32bit；
6)FPGA单元将FIFO模块中的数据依次发送至采用了32bit数据并行输入的USB3.0发送芯片；
7)USB3.0发送芯片接收数据并通过USB3.0接口将所接收的数据输出。
本发明与现有技术相比，有益效果是：
1、本发明通过数据输入单元、FPGA单元、数据输出单元及供电单元构建TLK2711传输接口与USB3.0传输接口的转换电路，该电路通过TLK2711接收芯片接受高速串行数据，并将其解码，通过总线输出给FPGA单元，FPGA单元内部的数据合并逻辑模块将数据进行合并，之后通过FIFO缓存，最后通过发送芯片及USB3.0接口将数据输出。本发明在使用时将TLK2711传输接口的输出数据实时转换为可以通过USB3.0这一通用数据传输接口进行传输的数据，为TLK2711传输数据在计算机上实时存储与显示提供了一种新的技术手段和方法，解决了现有转换电路价格昂贵的问题。
2、本发明提供的TLK2711传输接口与USB3.0传输接口的转换电路支持双向数据传输，可以通过USB3.0向TLK2711发送数据，而后TLK2711将并行数据串化后发送至上位机。
3、本发明提供的TLK2711传输接口与USB3.0传输接口的转换电路，易于实现，经济、实用性好，该电路与任何具备USB3.0的计算机连接就可以方便的进行图像采集存储。
4、本发明的TLK2711传输接口与USB3.0传输接口的转换电路，具有带宽高、实时性好、误码率低；并具有市场通用性好、体积小、便于携带、简单方便、工作性能稳定等诸多优点，还可以用在如：高分辨成像光谱仪、立体测绘相机、大带宽可见光相机、无人机载荷成像设备等设备中。
5、本发明的FPGA数据处理单元设置有外设存储单元，外设存储单元用来存储数据，这样一方面可以使得USB3.0输出数据占用与空闲时间较均衡；另一方面可以避免数据因USB尚未与计算机系统握手，但前端却有数据发送来，从而造成数据丢失的情况。
附图说明
图1为本发明实施例TLK2711传输接口与USB3.0传输接口转换电路组成框图；
图2为本发明实施例TLK2711传输接口向USB3.0传输接口转换的电路结构及数据信息流示意图；
图3为本发明典型应用案例连接示意图。
具体实施方式
下面结合具体典型实施例对本发明进行详细说明。
如图1-2所示，本发明提供的TLK2711数据传输接口向USB3.0数据传输接口转换电路包括FPGA单元、FLASH存储单元、数据输入单元、外设存储单元、数据输出单元、晶振单元、供配电单元组成。
(1)数据输入单元
数据串行输入单元由接口连接器、TLK2711高速串行/解串收发器组成；具体应用实施案例中，连接器采用AirBorn公司生产的MKHS连接器，根据工程需要设计中使用了1片TLK2711芯片，单片工作时钟100Mhz；TLK2711将输入的高速串行数据解码为16bit并行数据、1路100Mhz随路时钟、2路K/D编码控制信号(此2路信号根据发端数据格式协议，用来判断是否为有效数据)；TLK2711将串行数据解串后通过总线的方式将数据流输出给FPGA控制单元进行数据处理。
(2)FPGA单元
FPGA单元接收数据输入单元输入的数据、时钟和控制信号，FPGA通过内部运行软件调用其内部逻辑单元将有效数据存入外设存储单元，而后将根据一定的访问频率，访问外设存储单元并从外设存储器件中读取数据，并将其进行数据合并后存入内部缓存FIFO模块中，最后将数据依次发送至数据输出单元电路。
具体到本发明一个实际应用案例中，选用了Xilinx公司FPGA型号为XC7K325T-1FBG900I，内部数据合并逻辑模块将收到的2个16bit并行数据合并为1个32bit，而后存入内部FIFO模块，这是因为电路设计所选USB3.0采用了32bit数据并行输入，案例为了读取FIFO方便而采取的此种方式，因此FIFO位宽设置为32bit，位深根据图像大小具体设置。
(3)外设存储单元
外设存储单元用来存储数据，具体到本发明实际应用案例，电路设计选用了Micron公司的2片DDR2存储器件MT47H64M16HR芯片，其单片数据位宽16bit。
(4)数据输出单元
数据输出单元由输出连接器、USB3.0发送芯片组成，工作过程中需要供配电单元提供工作电平，并接收FPGA发送的1路时钟信号、1路数据有效信号、2路控制信号、32bit并行图像数据。具体到本设计采用了1片FIDI公司生产的FT601Q芯片；输出连接器采用了USB3.0标准接口。
(5)FLASH存储单元
FLASH存储单元为一种非易失性、电可擦除可编程只读存储器，主要用来为FPGA启动提供程序加载。具体到本案例，使用了Micron公司生产的FLASH芯片N25Q256AESF40G。
(6)晶振单元
所述晶振为FPGA提供工作时钟，是整个板卡工作的源头时钟。具体到本案例，采用了100Mhz外部晶振。
(7)供配电单元
供配电单元包括电源接口连接器、数片电源变换芯片，为整个电路器件工作提供所需的多个类型的电源。
图3所示为本发明典型应用案例连接示意图，高分辨成像设备通过TLK2711高速串行/解串收发器输出数据，TLK2711高速串行/解串收发器通过差分传输线路将数据传输至TLK2711数据传输接口向USB3.0数据传输接口转换电路，数据将转换后通过USB3.0线缆输出至计算机存储设备。
Claims (8)
1.一种TLK2711传输接口与USB3.0传输接口的转换电路，其特征在于：包括数据输入单元、FPGA单元、外设存储单元、晶振单元、FLASH存储单元、数据输出单元及供电单元；
所述数据输入单元包括连接器及与连接器相互通信的TLK27711接收芯片；
所述TLK27711接收芯片与FPGA单元双向通信；
所述外设存储单元与FPGA单元连接，用于进行数据存储；
所述FPGA单元包括数据合并逻辑模块及FIFO单元，所述数据合并逻辑模块用于将外设存储单元中所存储的数据进行合并，所述FIFO单元用于将合并后的数据进行存储；
所述晶振单元与FPGA单元连接；所述FLASH存储单元与FPGA单元连接；
所述数据输出单元包括USB3.0发送芯片及USB3.0接口；
所述USB3.0发送芯片与FPGA相互通信，所述USB3.0发送芯片与USB3.0接口双向通信；
所述供电单元用于TLK27711接收芯片、FPGA单元、晶振单元、FLASH存储单元及USB3.0发送芯片的供电。
2.根据权利要求1所述的TLK2711传输接口与USB3.0传输接口的转换电路，其特征在于：
所述供电单元包括供电接口及与电源接口连接的电源变换单元，所述电源变换单元用于TLK27711接收芯片、FPGA单元、晶振单元、FLASH存储单元及USB3.0发送芯片的供电。
3.根据权利要求1或2所述的TLK2711传输接口与USB3.0传输接口的转换电路，其特征在于：
所述FPGA单元所采用的FPGA型号为XC7K325T-1FBG900I。
4.根据权利要求3所述的TLK2711传输接口与USB3.0传输接口的转换电路，其特征在于：
所述外设存储单元为2片DDR2存储器件MT47H64M16HR芯片，MT47H64M16HR芯片数据位宽16bit。
5.根据权利要求4所述的TLK2711传输接口与USB3.0传输接口的转换电路，其特征在于：
所述USB3.0发送芯片为FT601Q芯片。
6.根据权利要求5所述的TLK2711传输接口与USB3.0传输接口的转换电路，其特征在于：
所述FLASH存储单元的型号为N25Q256AESF40G。
7.根据权利要求6所述的TLK2711传输接口与USB3.0传输接口的转换电路，其特征在于：
所述连接器为MKHS连接器。
8.基于权利要求1至7任一所述的TLK2711传输接口与USB3.0传输接口的转换电路进行数据转换的方法，其特征在于，包括以下步骤：
1)TLK2711接收芯片将输入的高速串行数据解码为16bit并行数据、1路100Mhz随路时钟及2路K/D编码控制信号；
2)TLK2711接收芯片将16bit并行数据、1路100Mhz随路时钟、2路K/D编码控制信号通过总线的方式输出给FPGA单元；
3)FPGA单元接收数据，并通过内部运行软件调用其内部逻辑单元将有效数据存入外设存储单元，
4)FPGA单元根据一定的访问频率，访问外设存储单元并从外设存储单元中读取数据；
5)FPGA单元将读取的数据合并后存入内部缓存FIFO模块中；数据合并的方式是将16bit并行数据合并为1个32bit，FIFO模块的位宽是32bit；
6)FPGA单元将FIFO模块中的数据依次发送至采用了32bit数据并行输入的USB3.0发送芯片；
7)USB3.0发送芯片接收数据并通过USB3.0接口将所接收的数据输出。
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| PB01 | Publication | ||
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| SE01 | Entry into force of request for substantive examination | ||
| SE01 | Entry into force of request for substantive examination |