CN114731106A - 开关电路的栅极驱动电路及开关电源的控制电路 - Google Patents

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Abstract

开关电路(100)包含N沟道的高边晶体管(MH)及低边晶体管(ML)。PMOS晶体管的开关(SW1)及整流元件(D1)被串联地连接在供给恒压VREG的恒压线与自举线(VB)之间。比较电路(210)以自举线(VB)与开关线(VS)之间的电位差即高边电源电压VBS为电源进行动作，生成表示高边电源电压VBS与阈值电压VTH的大小关系的检测信号OVDET。电平移位电路(220)使检测信号OVDET的电平下降到接地电压为“低”的信号。PMOS用驱动器(212)根据电平移位电路(220)的输出来与低边晶体管(ML)的开关非同步地驱动开关(SW1)。

Description

开关电路的栅极驱动电路及开关电源的控制电路
技术领域
本公开涉及一种开关电路。
背景技术
在以DC/DC转换器及AC/DC转换器、逆变器为代表的电力电子领域中，使用半桥电路或全桥电路等开关电路。
图1是开关电路100R的电路图。开关电路100R包括被串联连接的高边晶体管MH及低边晶体管ML、以及对它们进行驱动的栅极驱动电路200R。栅极驱动电路200R通过对高边晶体管MH及低边晶体管ML的导通、截止进行控制，从而将开关端子SW在高状态(输入电压VIN)及低状态(接地电压0V)这2个状态，或加上高阻抗状态的3个状态间进行切换。
栅极驱动电路200R包括高边驱动器202、低边驱动器204及整流元件D1。高边晶体管MH为N沟道晶体管，为了使其导通，需要比输入电压VIN更高的驱动电压。为了生成比输入电压VIN更高的驱动电压，会利用自举电路。整流元件D1与外置的自举电容器CB一同构成自举电路。自举电容器CB的一端与开关电路100的开关端子SW连接，在其另一端，介由整流元件D1而施加有恒压VREG。
在开关端子SW为“低”(即0V)时，自举电容器CB被以恒压VREG充电。当将低边驱动器204设为低输出，将高边驱动器202设为高输出时，自举电压VB被施加到高边晶体管MH的栅极。当开关端子SW的电压VS，即高边晶体管MH的源极电压上升时，自举电压VB会随此上升，因此能够对高边晶体管MH的栅极源极间，施加大于阈值的驱动电压。
作为开关元件，以往，使用了硅(Si)的MOSFET或双极晶体管，但近年来，作为其代替，着眼于使用氮化镓(GaN)的高电子移动度晶体管(HEMT：High Electron MobilityTransistor)。GaN－HEMT具有优异的高频率特性、较低的动作电阻和高耐压，通过与Si器件的置换，可期待DC/DC转换器的高效率化、小型化。
在图1中，当以GaN－HEMT来构成高边晶体管MH及低边晶体管ML时，会存在过电压被施加到自举电容器CB的风险。接着，对该理由进行说明。
当高边晶体管MH与低边晶体管ML同时导通时，贯通电流流过，因此为了防止该贯通电流，被插入高边晶体管MH与低边晶体管ML两者都截止的死区时间(dead time)。在以DC/DC转换器为代表的若干应用中，在开关电路100从低输出转变到高输出时的死区时间期间，反向电流会流过低边晶体管ML。在为Si－MOSFET的情况下，开关端子SW的电压VS被低边晶体管ML的体二极管钳位于－Vf。因此，当忽视整流元件D1的电压降时，被施加于自举电容器CB的两端间的电压被钳位于VREG+Vf。
与此不同，GaN－HEMT不具有体二极管，在反向电流流过低边晶体管ML时，漏极源极间电压VDS会变得非常大，达到数V。因此，在自举电容器CB的两端间，施加有VREG+VDS的电压，成为过充电状态。
在自举电容器CB被过充电的状态下，当高边驱动器202输出“高”时，过电压被施加到高边晶体管MH的栅极源极间，元件的可靠性会降低。
为了解决该问题，需要对自举电容器CB的两端间电压VBS进行钳位。例如在专利文献1中，公开了相关技术。图2为现有的驱动电路200S的电路图。具体而言，在专利文献1的驱动电路200S中，开关(PMOS晶体管)SW1被与自举用的整流元件(二极管)D1串联地插入。
电阻R11、R12将自举端子的电压VB在与接地电压之间进行分压。电阻R21、R22将恒压VREG在与开关端子的电压VS之间进行分压。分压后的电压V1、V2介由开关SW11、SW12而被输入到比较器208中。开关SW11、SW12在低边晶体管ML导通期间，被控制为断开。在低边晶体管ML导通的期间，能够从VS≒0V起，将自举端子的电压VB，即自举电容器CB的两端间电压VBS与基于恒压VREG的阈值进行比较。比较器208的输出被输入到PMOS晶体管SW1的栅极。
[现有技术文献]
[专利文献]
专利文献1:美国专利申请公开第2013/0241621A1号说明书
发明内容
[发明要解决的课题]
在专利文献1所记载的技术中，仅在低边晶体管ML导通的期间，进行比较器SW1的电压比较，在低边晶体管ML截止的期间，开关SW11、SW12会断开，比较器208的输入电压被保持，比较结果也被维持。在开关SW11、SW12截止的期间，比较器208的输入会成为高阻抗，易受到噪声的影响。因此，在低边晶体管ML截止的期间，当噪声混入到比较器208的输入端子中时，会发生因比较器208导致的误检测。
本公开鉴于上述问题而完成，其一个方案的例示性目的之一在于提供一种可提高噪声耐性，并抑制自举电容器的过充电的栅极驱动电路。
[用于解决技术课题的技术方案]
本公开的一个方案涉及一种开关电路的栅极驱动电路，该开关电路包含N沟道的高边晶体管及低边晶体管。栅极驱动电路包括：开关端子，其与高边晶体管的源极及低边晶体管的漏极连接，并且连接有自举电容器的一端；自举端子，其连接有自举电容器的另一端；开关线，其与开关端子连接；自举线，其与自举端子连接；高边驱动器，其输出与高边晶体管的栅极连接，其上侧电源节点与自举线连接，其下侧电源节点与开关线连接；低边驱动器，其输出与低边晶体管的栅极连接；PMOS(P-channel Metal Oxide Semiconductor：P沟道金属氧化物半导体)晶体管的开关及整流元件，其被串联地设置在供给恒压的恒压线与自举线之间；比较电路，其以自举线与开关线之间的电位差即高边电源电压为电源进行动作，并生成表示高边电源电压与阈值电压的大小关系的检测信号；电平移位电路，其使检测信号的电平下降到接地电压为“低”的信号；以及PMOS用驱动器，其根据电平移位电路的输出来与低边晶体管的开关非同步地驱动开关。
另外，将以上构成要素的任意组合、以及各构成要素或表达方式在方法、装置、系统等之间相互置换后的结果，作为本发明的方案也是有效的。
发明效果
根据本公开的一个方案，能够提高噪声耐性，并抑制自举电容器的过充电。
附图说明
图1是开关电路的电路图。
图2是现有的驱动电路的电路图。
图3是包括实施方式的栅极驱动电路的开关电路的框图。
图4的(a)、图4的(b)是图3的开关电路的动作波形图(仿真结果)。
图5是图3的开关电路的动作波形图(仿真结果)。
图6是表示电平移位器的构成例的电路图。
图7是表示电平移位器的更具体的构成例的电路图。
图8是表示电平移位器的另一构成例的电路图。
图9是实施方式的开关电源的控制电路的框图。
图10的(a)～图10的(f)是包括栅极驱动电路的电源的电路图。
具体实施方式
(实施方式的概要)
以下，对本公开的几个例示性的实施方式的概要进行说明。该概要作为后述的详细说明的前置，以实施方式的基本理解为目的，将一个或多个实施方式中的几个概念简化并对其进行说明，并不会限定发明或公开的广度。此外，该概要并非可考虑的全部实施方式的概括性的概要，并不对实施方式的不可或缺的构成要素进行限定。方便起见，“一个实施方式”有时用于指代本说明书所公开的一个实施方式(实施例或变形例)或多个实施方式(实施例或变形例)。
一个实施方式涉及一种开关电路的栅极驱动电路，该开关电路包含N沟道的高边晶体管及低边晶体管。栅极驱动电路包括：开关端子，其与高边晶体管的源极及低边晶体管的漏极连接，并且连接有自举电容器的一端；自举端子，其连接有自举电容器的另一端；开关线，其与开关端子连接；自举线，其与自举端子连接；高边驱动器，其输出与高边晶体管的栅极连接，其上侧电源节点与自举线连接，其下侧电源节点与开关线连接；低边驱动器，其输出与低边晶体管的栅极连接；PMOS(P-channel Metal Oxide Semiconductor：P沟道金属氧化物半导体)晶体管的开关及整流元件，其被串联地设置在供给恒压的恒压线与自举线之间；比较电路，其以自举线与开关线之间的电位差即高边电源电压为电源进行动作，并生成表示高边电源电压与阈值电压的大小关系的检测信号；电平移位电路，其使检测信号的电平下降到接地电压为“低”的信号；以及PMOS用驱动器，其根据电平移位电路的输出来与低边晶体管的开关非同步地驱动开关。
根据该构成，能够与低边晶体管的导通、截止无关地，始终通过比较电路来对自举电容器的两端间产生的高边电源电压进行监视。因此，不存在比较电路的输入为高阻抗的期间，并能够提高噪声耐性。
也可以是，在一个实施方式中，电平移位电路包含脉冲发生器、开漏电路、以及锁存电路，并输出与锁存电路的状态相应的信号；该脉冲发生器分别响应于检测信号的正沿、负沿而生成具有预定的脉冲宽度的置位脉冲、复位脉冲；该开漏电路包含源极与自举线连接，并根据置位脉冲而成为导通的第1晶体管、以及源极与自举线连接，并根据复位脉冲来成为导通的第2晶体管；该锁存电路包含被交叉耦合的第1晶体管及第2晶体管，并响应于开漏电路的输出来进行状态转变。
根据该构成，能够将高边的检测信号低延迟地传输到低边。
也可以是，在一个实施方式中，电平移位电路还包含锁存稳定化电路，该锁存稳定化电路被设置在电源线与接地线之间，并将锁存电路的互补的第1节点及第2节点中的、与电平移位电路的输出相应的一者固定为“低”。利用锁存稳定化电路，根据电平移位电路的输出，能够通过作用于第1节点和第2节点来固定锁存电路的状态。关于锁存稳定化电路，无需使锁存电路的状态转变，因此动作电流非常少即可。此外，锁存稳定化电路被设置在高边线与开关线之间，它们的电位差为5V或12V左右，因此为了固定锁存电路的状态，与使电流流过电位差为数百V的高边线与接地线之间的情况相比，能够大幅削减耗电。
(实施方式)
以下，参照附图，针对实施方式进行说明。对于各附图所示的相同或等同的构成要素、构件、以及处理，标注相同的附图标记，并适当省略重复的说明。此外，实施方式并不对发明进行限定，仅为例示，实施方式所记述的一切特征或其组合并非都是发明的实质性内容。
在本说明书中，所谓“构件A与构件B连接的状态”，除包含构件A与构件B物理性地直接连接的情况之外，还包含构件A与构件B经由不对其电连接状态产生实质影响，或者不会损害其结合所起到的功能或效果的其它构件间接地连接的情况。
同样，所谓“构件C被设置在构件A与构件B之间的状态”，除包含构件A与构件C，或者构件B与构件C直接连接的情况之外，还包含经由不对其电连接状态产生实质影响，或者不会损害通过其结合而起到的功能或效果的其它构件间接地连接的情况。
图3是包括实施方式的栅极驱动电路200的开关电路100的框图。开关电路100包括高边晶体管MH、低边晶体管ML、自举电容器CB及栅极驱动电路200。高边晶体管MH及低边晶体管ML为GaN－HEMT(GaN－FET)。
栅极驱动电路200对高边晶体管MH及低边晶体管ML进行控制。栅极驱动电路200在高边脉冲SH为“高”时，使高边晶体管MH导通，在为“低”时，使高边晶体管MH截止。此外，栅极驱动电路200在控制信号SL为“高”时，使低边晶体管ML导通，在为“低”时，使低边晶体管ML截止。
栅极驱动电路200包括高边驱动器202、低边驱动器204、电平移位器206、二极管(整流元件)D1、开关SW1、比较电路210、电平移位电路220D、以及PMOS用驱动器212，并被集成化于一个半导体基板。
栅极驱动电路200的输出引脚HO与高边晶体管MH的栅极连接，开关引脚(端子)VS与高边晶体管MH的源极及低边晶体管ML的漏极连接。栅极驱动电路200的输出引脚LO与低边晶体管ML的栅极连接。
低边驱动器204基于低边脉冲SL来驱动低边晶体管ML。具体而言，低边驱动器204在低边脉冲SL为“高”时，将高电压VREG施加到低边晶体管ML的栅极，在低边脉冲SL为“低”时，将低电压(0V)施加到低边晶体管ML的栅极。
自举电容器CB的一端与VS引脚连接，其另一端与VB引脚连接。将与VS引脚连接的布线称为开关线VS。同样，将与VB引脚连接的布线称为自举线VB。
电平移位器206使高边脉冲SH进行电平移位，并将其供给到高边驱动器202。关于高边驱动器202，其输出与高边晶体管MH的栅极连接，其上侧电源节点N1与自举线VB连接，其下侧电源节点N2与开关线VS连接。高边驱动器202以自举引脚VB与开关引脚VS的电位差VBS＝VB－VS，即自举电容器CB的两端间电压为电源电压来进行动作。因此，将VBS称为高边电源电压。
高边驱动器202根据电平移位后的高边脉冲SH’来驱动高边晶体管MH。具体而言，高边驱动器202在高边脉冲SH为“高”时，将高电压VB施加到高边晶体管MH的栅极，在高边脉冲SH为“低”时，将低电压VS施加到高边晶体管MH的栅极。
作为PMOS晶体管的开关SW1与作为整流元件的二极管D1被串联地设置在恒压线(称为REG线)与自举线VB之间，该恒压线用于供给恒压VREG。
比较电路210以自举线VB与开关线VS之间的电位差VBS(高边电源电压)为电源来进行动作。比较电路210将高边电源电压VBS与规定其目标电压VBS(REF)的阈值电压VTH进行比较，生成表示它们的大小关系的过电压检测信号OVDET。检测信号OVDET在VBS＞VTH的过电压状态下为“高”，在VBS＜VTH时为“低”。比较电路210能够用电压比较器来构成。
电平移位电路230使检测信号OVDET的电平下降到接地电压为“低”的信号LVS＿OUT。
PMOS用驱动器212根据电平移位电路230的输出LVS＿OUT来与高边晶体管MH及低边晶体管ML的开关非同步地对开关SW1进行驱动。开关SW1在过电压检测信号OVDET为“高”(VBS＞VTH)时断开，在过电压检测信号OVDET为“低”(VBS＜VTH)时接通。
以上是栅极驱动电路200及开关电路100的构成。接着，对其动作进行说明。图4的(a)、图4的(b)是图3的开关电路100的动作波形图(仿真结果)。图4的(b)是将图4的(a)的时间轴放大得到的图。仿真以如下的条件来进行：VCC＝VREG＝5V，振荡频率1MHz，导通时间Ton＝50ns，VIN＝90V，死区时间30ns，CB＝1μs。
图5是电压VB、VS、高边电源电压VBS、过电压检测信号OVDET、以及开关SW1的栅极电压VPGATE的波形图(仿真结果)。当高边电源电压VBS超过阈值VTH时，过电压检测信号OVDET成为“高”，PGATE信号成为“高”，开关SW1断开。其间，高边电源电压VBS会降低下去。然后，当高边电源电压VBS低于阈值VTH时，过电压检测信号OVDET成为“低”，PGATE信号成为“低”，开关SW1接通。其间，自举电路成为激活，每当开关电压VS开关，高边电源电压VBS就会上升。在该例中，高边电源电压VBS的波动幅度非常小，达到70mV。
以上是开关电路100的动作。根据实施方式的栅极驱动电路200，能够与低边晶体管ML的导通、截止无关地，始终通过比较电路210来对自举电容器CB的两端间产生的高边电源电压VBS进行监视。因此，不存在比较电路210的输入成为高阻抗的期间，能够提高噪声耐性。
在现有技术中，存在比较电路210的停止期间，因此高边电源电压VBS的波动会变大。与此不同，根据实施方式的栅极驱动电路200，能够使高边电源电压VBS的波动变小。
图6是表示电平移位电路220D的构成例的电路图。电平移位电路220D是将输入信号LVS＿IN(上述检测信号OVDET)转换为输出信号LVS＿OUT(LVS＿OUT)的电平下降电路，该输入信号LVS＿IN以VB为“高”，以VS为“低”，该输出信号LVS＿OUT以电源电压VCC(或VREG)为“高”，以接地电压0V为“低”。
电平移位电路220D具有脉冲发生器230D、开漏电路232D、锁存电路240D、逻辑电路260D、以及锁存稳定化电路280D。
脉冲发生器230D为单触发电路，响应于输入信号LVS＿IN的正沿、负沿，在预定脉冲宽度的期间，生成为“低”的负逻辑的置位脉冲SET、复位脉冲RST。
开漏电路232D包括PMOS晶体管MP11、MP12。第1晶体管MP11的源极与自举线VB连接，并根据置位脉冲SET而成为导通。第2晶体管MP12的源极与自举线VB连接，并根据复位脉冲RST而成为导通。
锁存电路240D包含PMOS晶体管MP21、MP22。第1晶体管MP21及第2晶体管MP22被交叉耦合，并响应于开漏电路232D的输出地进行状态转变。
锁存稳定化电路280D将锁存电路240D的互补的第1节点N21及第2节点N22中的、与电平移位电路220D的输出LVS＿OUT相应的一者固定为“高”。
逻辑电路260D接受锁存电路240的输出(第1节点N21、第2节点N22的电压中的至少一者)，并生成电平移位输出信号LVS＿OUT。
锁存稳定化电路280D被构成为：维持锁存电路240D的互补的第1节点N21及第2节点N22中的、与电平移位电路220的输出LVS＿OUT的电平(高、低)相应的一者的“低”。
例如，锁存稳定化电路280D在LVS＿OUT为“高”，即第1节点N21为“高”时，以维持第1节点N21的“高”的方式进行动作，在LVS＿OUT为“低”，即第2节点N22为“高”时，以维持第2节点N22的“高”的方式进行动作。
或者相反地，也可以是，锁存稳定化电路280D被构成为：在LVS＿OUT为“高”，即第1节点N21为“高”时，以维持第2节点N22的“低”的方式进行动作，在LVS＿OUT为“低”，即第2节点N22为“高”时，维持第1节点N21的“低”。
图7是表示电平移位电路220D的更具体的构成例的电路图。逻辑电路260D包含电平移位器兼锁存电路262D、以及逆变器INV1、INV2。
电平移位器兼锁存电路262D接受锁存电路240D的输出，并进行锁存。电平移位器兼锁存电路262D将锁存电路240的输出的电平下降到以电压VCC为高电平，以电压0V为低电平的信号。电平移位器兼锁存电路262包含晶体管MN31、MN32、以及MP33～MP38。电平移位器兼锁存电路262D的输出经过2级逆变器INV、INV2而被输出。
锁存稳定化电路280D包含开关SW1、第2开关SW2、第1阻抗元件284＿1、第2阻抗元件284＿2、第1电流镜电路286＿1、以及第2电流镜电路286＿2。第1开关SW1在电平移位电路220的输出LVS＿OUT成为第1电平(高)时接通。第1阻抗元件284＿1与第1开关SW1串联地连接。第1电流镜电路286＿1对流过第1阻抗元件284＿1的电流进行复制，并将电流IAUX＿SET提供到第1节点N21。由此，节点N21被上拉。
第2开关SW2在电平移位电路220D的输出LVS＿OUT为第2电平(低)时接通。第2阻抗元件284＿2与第2开关SW2串联地连接。第2电流镜电路286＿2对流过第2阻抗元件284＿2的电流进行复制，并将电流IAUX＿RST提供给第2节点N22。由此，节点N22被上拉。
图8是表示电平移位电路220D的另一构成例(220E)的电路图。除了图7的电平移位电路220D以外，图8的电平移位电路220E还包括辅助电路250E。辅助电路250E响应于置位脉冲SET，从第2节点N22起灌入辅助电流IASST＿SET，响应于复位脉冲RST，从第1节点N21灌入辅助电流IASST＿RST。通过追加辅助电路250E，从而能够进一步地高速化。
接着，对开关电路100及驱动电路200的用途进行说明。栅极驱动电路200能够利用于绝缘型或非绝缘型电源。图9是实施方式的开关电源的框图。该开关电源300为降压(Buck)转换器，包括高边晶体管MH、低边晶体管ML、电感器L1、输出电容器C1及控制电路400。除了上述的栅极驱动电路200以外，控制电路400还包括反馈电路410。反馈电路410接收基于开关电源300的输出信号(输出电压VOUT或输出电流IOUT)的反馈信号VFB，并生成脉冲信号SH、SL，该脉冲信号SH、SL的占空比及频率会变化，使得反馈信号VFB接近预定的目标值。反馈电路410能够包含脉冲宽度调制器或脉冲频率调制器等，且能够由模拟电路(误差放大器)或数字电路(补偿器)来构成。
图10的(a)～图10的(f)是包括栅极驱动电路200的电源的电路图。栅极驱动电路200能够适用于图10的(a)所示的降压转换器的晶体管A、B的“对”的驱动。
栅极驱动电路200也能够适用于图10的(b)所示的正向转换器。具体而言，栅极驱动电路200能够利用于初级侧的高边晶体管B与低边晶体管A的“对(pair)”的驱动。
栅极驱动电路200也能够适用于图10的(c)所示的半桥转换器。具体而言栅极驱动电路200能够利用于初级侧的高边晶体管B与低边晶体管A的“对”的驱动。
栅极驱动电路200也能够适用于图10的(d)所示的全桥转换器。具体而言，栅极驱动电路200能够利用于初级侧的高边晶体管B与低边晶体管A的“对”、以及初级侧的高边晶体管D与低边晶体管C的“对”。
栅极驱动电路200也能够适用于图10的(e)所示的倍流同步整流器。具体而言，栅极驱动电路200能够利用于初级侧的高边晶体管B与低边晶体管A的“对”的驱动。
栅极驱动电路200也能够适用于图10的(f)所示的次级侧全桥同步整流器。具体而言，栅极驱动电路200能够利用于初级侧的高边晶体管B与低边晶体管A的“对”，或高边晶体管C与低边晶体管D的“对”的驱动。此外，栅极驱动电路200能够利用于次级侧的高边晶体管F与低边晶体管E的“对”，或高边晶体管G与低边晶体管H的“对”的驱动。
本领域技术人员应理解的是，实施方式仅为例示，在它们的各构成要素或各处理过程的组合中能够存在各种变形例，且那样的变形例也在本发明的范围之内。以下，针对这样的变形例进行说明。
除了电源之外，开关电路还被以电机驱动电路等各种用途来使用，本发明也能够适用于电源以外的用途。
实施方式仅表示本发明的原理、应用，对于实施方式，在不脱离权利要求书所规定的本发明的思想的范围内，允许进行许多变形例或配置的变更。
[工业可利用性]
本发明能够利用于开关电路。
[附图标记说明]
100 开关电路
MH 高边晶体管
ML 低边晶体管
CB 自举电容器
200 栅极驱动电路
202 高边驱动器
204 低边驱动器
206 电平移位器
D1 二极管
SW1 开关
210 比较电路
212 PMOS用驱动器
220 电平移位电路
230D 脉冲发生器
232D 开漏电路
240D 锁存电路
260D 逻辑电路
262D 电平移位器兼锁存电路
280D 锁存稳定化电路
INV1、INV2 逆变器
300 DC/DC转换器
310 控制器

Claims (5)

1.一种开关电路的栅极驱动电路，该开关电路包含N沟道的高边晶体管及低边晶体管；
该栅极驱动电路的特征在于，包括：
开关端子，其与上述高边晶体管的源极及上述低边晶体管的漏极连接，并且连接有自举电容器的一端，
自举端子，其连接有上述自举电容器的另一端，
开关线，其与上述开关端子连接，
自举线，其与上述自举端子连接，
高边驱动器，其输出与上述高边晶体管的栅极连接，其上侧电源节点与上述自举线连接，其下侧电源节点与上述开关线连接，
低边驱动器，其输出与上述低边晶体管的栅极连接，
PMOS(P-channel Metal Oxide Semiconductor：P沟道金属氧化物半导体)晶体管的开关及整流元件，其被串联地设置在供给恒压的恒压线与上述自举线之间，
比较电路，其以上述自举线与上述开关线之间的电位差即高边电源电压为电源进行动作，并生成表示上述高边电源电压与阈值电压的大小关系的检测信号，
电平移位电路，其使上述检测信号的电平下降到接地电压为“低”的信号，以及
PMOS用驱动器，其根据上述电平移位电路的输出来与上述高边晶体管的开关非同步地驱动上述开关。
2.如权利要求1所述的栅极驱动电路，其特征在于，
上述电平移位电路包含：
脉冲发生器，其分别响应于上述检测信号的正沿、负沿，生成具有预定的脉冲宽度的置位脉冲、复位脉冲，
开漏电路，其包含第1晶体管和第2晶体管，该第1晶体管的源极与上述自举线连接，根据上述置位脉冲而成为导通，该第2晶体管的源极与上述自举线连接，根据上述复位脉冲而成为导通，以及
锁存电路，其包含被交叉耦合的第1晶体管及第2晶体管，并响应于上述开漏电路的输出而进行状态转变；
该上述电平移位电路输出与上述锁存电路的状态相应的信号。
3.如权利要求2所述的栅极驱动电路，其特征在于，
上述电平移位电路还包含锁存稳定化电路，该锁存稳定化电路被设置在电源线与接地线之间，将上述锁存电路的互补的第1节点及第2节点中的、与上述电平移位电路的输出相应的一者固定为“低”。
4.一种开关电源的控制电路，其特征在于，
包括如权利要求1～3的任意一项所述的栅极驱动电路。
5.一种开关电源，其特征在于，
包括如权利要求1～3的任意一项所述的栅极驱动电路。
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