CN114721457B - 一种低温度系数的无电阻带隙基准源 - Google Patents
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- G05F1/567—Regulating voltage or current wherein the variable actually regulated by the final control device is dc using semiconductor devices in series with the load as final control devices sensing a condition of the system or its load in addition to means responsive to deviations in the output of the system, e.g. current, voltage, power factor for temperature compensation
Abstract
本发明公开了一种低温度系数的无电阻带隙基准源,包括依次相连的启动电路、电流源电路、高阶温度补偿电路和低阶温度补偿电路,所述启动电路使电流源电路避免简并工作点,所述电流源电路为温度补偿电路提供二阶的偏置电流,所述高阶温度补偿电路和低阶温度补偿电路通过电流镜与加权差分对构建的基准电压输出。本申请在无电阻情况下,利用不同尺寸的双极型晶体管与具有相同温度指数的电流源构建了一种高阶温度补偿方式,有别于传统带隙基准源中利用电阻实现低温度系数基准输出的方式,可以得到较为稳定的低输出基准电压。
Description
技术领域
本申请涉及属于半导体集成电路领域,涉及一种低温度系数的无电阻带隙基准源。
背景技术
在模拟与数模混合集成电路中,带隙基准源电路常作为基本模块为电路系统提供稳定的基准电压,一般通过正温度系数电压项与负温度系数电压项加权相消,得到与温度几乎无关的基准电压。温度系数作为带隙基准源的重要性能指标,一直是带隙基准源的研究重点。在标准数字CMOS技术中,由于硅化物通常用于降低多晶硅和扩散层的薄片电阻,电阻的长度和占用面积增大,增加了成本,也增加了对衬底噪声耦合的敏感性。克服该问题的方法之一是使用额外的掩模来选择性地阻止硅化物,但掩模也会增加成本。同时需要通过激光调修保证模型精确度,导致效率较低,成本较高,噪声较大。由于传统的带隙基准源一般都有电阻引入,高阶温度补偿在没有电阻的情况下很难实现。
发明内容
鉴于此,针对上述电阻带来的不利影响及无电阻情况下较难实现高阶温度补偿等问题,本申请实施例提供一种低温度系数的无电阻带隙基准源。
根据本申请实施例,提供一种低温度系数的无电阻带隙基准源,包括依次相连的启动电路、电流源电路、高阶温度补偿电路和低阶温度补偿电路,所述启动电路使电流源电路避免简并工作点,所述电流源电路为温度补偿电路提供二阶的偏置电流,所述高阶温度补偿电路和低阶温度补偿电路通过电流镜与加权差分对构建的基准电压输出。
进一步地,所述的启动电路包含PMOS管AP4、PMOS管AP5、NMOS管AN5,电容C1;NMOS管AN5源极、电容C1底端接地;NMOS管AN5漏极、PMOS管AP4漏极连接PMOS管AP5栅极;PMOS管AP5源极、PMOS管AP4源极接电源;NMOS管AN5栅极、PMOS管AP4栅极连至电流源电路中PMOS管AP1栅极;电容C1顶端、PMOS管AP5漏极连至电流源电路中NMOS管AN2漏极。
进一步地,所述的电流源电路包含PMOS管AP1、PMOS管AP2、PMOS管AP3,NMOS管AN1、NMOS管AN2、NMOS管AN3、NMOS管AN4,双极型晶体管Q1、双极型晶体管Q2;PMOS管AP1源极、PMOS管AP2源极、PMOS管AP3源极接电源;PMOS管AP1栅极、PMOS管AP2栅极、PMOS管AP3栅极、PMOS管AP3漏极接至高阶温度补偿电路中PMOS管BP7栅极,并将此处电压记做偏置电压VBIAS;PMOS管AP1漏极、NMOS管AN1漏极、NMOS管AN1栅极、NMOS管AN2栅极连接NMOS管AN4栅极;NMOS管AN1源极连接NMOS管AN4漏极;NMOS管AN4源极、双极型晶体管Q1发射极接至低阶温度补偿电路中PMOS管CP2栅极;双极型晶体管Q1基极、双极型晶体管Q1集电极、双极型晶体管Q2基极、双极型晶体管Q2集电极接地;双极型晶体管Q2发射极、NMOS管AN2源极接至高阶温度补偿电路中PMOS管BP2栅极;NMOS管AN2漏极、PMOS管AP2漏极连接NMOS管AN3栅极。
进一步地,所述的高阶温度补偿电路包含PMOS管BP1、PMOS管BP2、PMOS管BP3、PMOS管BP4、PMOS管BP5、PMOS管BP6、PMOS管BP7、PMOS管BP8、PMOS管BP9、PMOS管BP10、NMOS管BN1、NMOS管BN2、NMOS管BN3、NMOS管BN4、双极型晶体管Q3;PMOS管BP7栅极、PMOS管BP8栅极、PMOS管BP9栅极、PMOS管BP10栅极接至低阶温度补偿电路中PMOS管CP5栅极;PMOS管BP7源极、PMOS管BP8源极、PMOS管BP9源极、PMOS管BP10源极接电源;PMOS管BP7漏极、双极型晶体管Q3发射极接至PMOS管BP1栅极;双极型晶体管Q3基极、双极型晶体管Q3集电极、PMOS管BP1漏极、NMOS管BN1源极、NMOS管BN4栅极、NMOS管BN4漏极、PMOS管BP3漏极、NMOS管BN2源极、NMOS管BN3源极接地;PMOS管BP1源极、PMOS管BP2源极连接PMOS管BP8漏极;PMOS管BP2栅极连接PMOS管BP11源极;PMOS管BP2漏极、NMOS管BN1漏极、NMOS管BN1栅极、NMOS管BN2栅极连接NMOS管BN3栅极;PMOS管BP11栅极、PMOS管BP11漏极、NMOS管BN4源极连接PMOS管BP3栅极;PMOS管BP3源极、PMOS管BP4源极连接PMOS管BP9漏极;PMOS管BP4栅极、PMOS管BP4漏连接NMOS管BN2漏极;NMOS管BN3漏极、PMOS管BP6漏极、PMOS管BP6栅极接至低阶温度补偿电路中PMOS管CP3栅极,并将此处电压记做VREF1;PMOS管BP5源极、PMOS管BP6源极连接PMOS管BP10漏极。
进一步地,所述的低阶温度补偿电路包含PMOS管CP1、PMOS管CP2、PMOS管CP3、PMOS管CP4、PMOS管CP5、PMOS管CP6、NMOS管CN1、NMOS管CN2、双极型晶体管Q4、可调PMOS管电流镜PTRIM;双极型晶体管Q4基极、双极性晶体管Q4集电极、NMOS管CN1源极、NMOS管CN2源极、PMOS管CP2漏极、PMOS管CP3漏极接地;双极型晶体管Q4发射极、PMOS管CP1栅极接至可调PMOS管电流镜PTRIM;PMOS管CP1漏极、NMOS管CN1漏极、NMOS管CN1栅极连接NMOS管CN2栅极;PMOS管CP1源极、PMOS管CP2源极连接PMOS管CP5漏极;PMOS管CP5源极、PMOS管CP6源极、可调PMOS管电流镜PTRIM源极接电源;PMOS管CP5栅极、PMOS管CP6栅极连接可调PMOS管电流镜PTRIM栅极;PMOS管CP3源极、PMOS管CP4源极连接PMOS管CP6漏极;PMOS管CP4漏极、PMOS管CP4栅极连接NMOS管CN2漏极,并以此处电压作为带隙基准源的基准输出电压。
进一步地,所述的低阶温度补偿电路对由所述的高阶温度补偿电路得到的VREF1进行低阶温度补偿。
进一步地,所述低阶温度补偿电路中运用的可调PMOS管电流镜PTRIM的具体表现形式为数字修调模块,所述的数字修调模块包含PMOS管PTRIM0、PMOS管PTRIM1、PMOS管PTRIM2、PMOS管PTRIM3、PMOS管PTRIM4、PMOS管PTRIM5、PMOS管PTRIM6、PMOS管PTRIM7;PMOS管PTRIM0栅极、PMOS管PTRIM1栅极、PMOS管PTRIM2栅极、PMOS管PTRIM3栅极、PMOS管PTRIM4栅极、PMOS管PTRIM5栅极、PMOS管PTRIM6栅极、PMOS管PTRIM7栅极根据数字编码决定连接至电源或连接至前述偏置电压VBIAS。
进一步地,可调电流镜阵列中八个PMOS管的尺寸比例为PMOS管PTRIM0:PMOS管PTRIM1:PMOS管PTRIM2:PMOS管PTRIM3:PMOS管PTRIM4:PMOS管PTRIM5:PMOS管PTRIM6:PMOS管PTRIM7=1:2:4:8:16:32:64:128。
本申请的实施例提供的技术方案可以包括以下有益效果:
由上述实施例可知,本申请在无电阻情况下,利用不同尺寸的双极型晶体管与具有相同温度指数的电流源构建了一种高阶温度补偿方式,有别于传统带隙基准源中利用电阻实现低温度系数基准输出的方式,可以得到较为稳定的低输出基准电压。
应当理解的是,以上的一般描述和后文的细节描述仅是示例性和解释性的,并不能限制本申请。
附图说明
此处的附图被并入说明书中并构成本说明书的一部分,示出了符合本申请的实施例,并与说明书一起用于解释本申请的原理。
图1是本申请实例提供的一种低温度系数的无电阻带隙基准源的结构示意图。
图2是本申请实例提供的数字修调电路结构示意图。
具体实施方式
这里将详细地对示例性实施例进行说明,其示例表示在附图中。下面的描述涉及附图时,除非另有表示,不同附图中的相同数字表示相同或相似的要素。以下示例性实施例中所描述的实施方式并不代表与本申请相一致的所有实施方式。相反,它们仅是与如所附权利要求书中所详述的、本申请的一些方面相一致的装置和方法的例子。
在本申请使用的术语是仅仅出于描述特定实施例的目的,而非旨在限制本申请。在本申请和所附权利要求书中所使用的单数形式的“一种”、“所述”和“该”也旨在包括多数形式,除非上下文清楚地表示其他含义。还应当理解,本文中使用的术语“和/或”是指并包含一个或多个相关联的列出项目的任何或所有可能组合。
双极型晶体管的基极-发射极电压VBE满足: 的关系,其中,α是集电极电流依赖于温度的指数常数因子,β是与温度无关的工艺常数,T0是参考温度,VBE与T之间并非纯线性关系,由上式可以看出,VBE存在与温度相关的高阶项并不只是线性关系。根据VBE的表达式可推得,不同尺寸的BJT也可以借助具有相同α的电流源构建一个基准电压: 考虑到当满足m(β1-β2)+n(α-β2)=0时,基准电压的高阶温度项可被消除。基于此前提,采用VBE线性化补偿方式,通过合适的m,n,α,β参数实现温度补偿。
图1是本申请实例提供的一种低温度系数的无电阻带隙基准源的结构示意图,包括启动电路、电流源电路、高阶温度补偿电路和低阶温度补偿电路。
所述的启动电路包含PMOS管AP4、PMOS管AP5、NMOS管AN5,电容C1;NMOS管AN5源极、电容C1底端接地;NMOS管AN5漏极、PMOS管AP4漏极连接PMOS管AP5栅极;PMOS管AP5源极、PMOS管AP4源极接电源;NMOS管AN5栅极、PMOS管AP4栅极连至电流源电路中PMOS管AP1栅极;电容C1顶端、PMOS管AP5漏极连至电流源电路中NMOS管AN2漏极;
所述的电流源电路为自偏置电路,如果不添加启动电路,会存在简并点,因此添加了所述的启动电路来避免零电流状态。初上电时,PMOS管AP5导通,电容C1进行充电,PMOS管AP5漏端电压上升,流经NMOS管AN4的偏置电流IBIAS增大,偏置电路开始进入稳定状态,PMOS管AP5栅端电压逐渐升高,PMOS管AP5进入截止区,PMOS管AP4处于线性区。因此,在稳定状态下,启动电路不会影响到核心电路,不消耗静态电流。
所述的电流源电路包含PMOS管AP1、PMOS管AP2、PMOS管AP3,NMOS管AN1、NMOS管AN2、NMOS管AN3、NMOS管AN4,双极型晶体管Q1、双极型晶体管Q2;PMOS管AP1源极、PMOS管AP2源极、PMOS管AP3源极接电源;PMOS管AP1栅极、PMOS管AP2栅极、PMOS管AP3栅极、PMOS管AP3漏极接至高阶温度补偿电路中PMOS管BP7栅极,并将此处电压记做偏置电压VBIAS;PMOS管AP1漏极、NMOS管AN1漏极、NMOS管AN1栅极、NMOS管AN2栅极连接NMOS管AN4栅极;NMOS管AN1源极连接NMOS管AN4漏极;NMOS管AN4源极、双极型晶体管Q1发射极接至低阶温度补偿电路中PMOS管CP2栅极;双极型晶体管Q1基极、双极型晶体管Q1集电极、双极型晶体管Q2基极、双极型晶体管Q2集电极接地;双极型晶体管Q2发射极、NMOS管AN2源极接至高阶温度补偿电路中PMOS管BP2栅极;NMOS管AN2漏极、PMOS管AP2漏极连接NMOS管AN3栅极;
所述的电流源为二阶指数电流源,其中NMOS管AN4位于线性区,其他管位于饱和区,尺寸相等的PMOS管AP1,PMOS管AP2,PMOS管AP3构成电流镜,双极型晶体管Q1与双极型晶体管Q2面积比为N,最终可以得到通过NMOS管AN4的电流,称其为偏置电流I,I=KμnCoxVT2,其中其中μn∝T-1.5,VT=kT/q,故I∝T0.5。
所述的高阶温度补偿电路包含PMOS管BP1、PMOS管BP2、PMOS管BP3、PMOS管BP4、PMOS管BP5、PMOS管BP6、PMOS管BP7、PMOS管BP8、PMOS管BP9、PMOS管BP10、NMOS管BN1、NMOS管BN2、NMOS管BN3、NMOS管BN4、双极型晶体管Q3;PMOS管BP7栅极、PMOS管BP8栅极、PMOS管BP9栅极、PMOS管BP10栅极接至低阶温度补偿电路中PMOS管CP5栅极;PMOS管BP7源极、PMOS管BP8源极、PMOS管BP9源极、PMOS管BP10源极接电源;PMOS管BP7漏极、双极型晶体管Q3发射极接至PMOS管BP1栅极;双极型晶体管Q3基极、双极型晶体管Q3集电极、PMOS管BP1漏极、NMOS管BN1源极、NMOS管BN4栅极、NMOS管BN4漏极、PMOS管BP3漏极、NMOS管BN2源极、NMOS管BN3源极接地;PMOS管BP1源极、PMOS管BP2源极连接PMOS管BP8漏极;PMOS管BP2栅极连接PMOS管BP11源极;PMOS管BP2漏极、NMOS管BN1漏极、NMOS管BN1栅极、NMOS管BN2栅极连接NMOS管BN3栅极;PMOS管BP11栅极、PMOS管BP11漏极、NMOS管BN4源极连接PMOS管BP3栅极;PMOS管BP3源极、PMOS管BP4源极连接PMOS管BP9漏极;PMOS管BP4栅极、PMOS管BP4漏连接NMOS管BN2漏极;NMOS管BN3漏极、PMOS管BP6漏极、PMOS管BP6栅极接至低阶温度补偿电路中PMOS管CP3栅极,并将此处电压记做VREF1;PMOS管BP5源极、PMOS管BP6源极连接PMOS管BP10漏极;
所述的高阶温度补偿电路主要利用了加权差分电路,通过差分对的运算转化,可以消去工艺参数等干扰因素,并利用一对PMOS管对VBE2实现分压,其中,SBP1:SBP2=SBP3:SBP4=SBP5:SBP6=1:3,且电流镜尺寸均相等,经过初步高阶温度补偿得到的基准电压 得到m=1.43,n=0.5。
所述的低阶温度补偿电路包含PMOS管CP1、PMOS管CP2、PMOS管CP3、PMOS管CP4、PMOS管CP5、PMOS管CP6、NMOS管CN1、NMOS管CN2、双极型晶体管Q4、可调PMOS管电流镜PTRIM;双极型晶体管Q4基极、双极性晶体管Q4集电极、NMOS管CN1源极、NMOS管CN2源极、PMOS管CP2漏极、PMOS管CP3漏极接地;双极型晶体管Q4发射极、PMOS管CP1栅极接至可调PMOS管电流镜PTRIM;PMOS管CP1漏极、NMOS管CN1漏极、NMOS管CN1栅极连接NMOS管CN2栅极;PMOS管CP1源极、PMOS管CP2源极连接PMOS管CP5漏极;PMOS管CP5源极、PMOS管CP6源极、可调PMOS管电流镜PTRIM源极接电源;PMOS管CP5栅极、PMOS管CP6栅极连接可调PMOS管电流镜PTRIM栅极;PMOS管CP3源极、PMOS管CP4源极连接PMOS管CP6漏极;PMOS管CP4漏极、PMOS管CP4栅极连接NMOS管CN2漏极,并以此处电压作为带隙基准源的基准输出电压。
所述的低阶温度补偿电路对由所述的高阶温度补偿电路得到的VREF1进行低阶温度补偿,其中SCP1:SCP2=SCP3:SCP4=1:3,SCP1=SCP3,且电流镜尺寸均相等调节比例参数可以消去一阶项,最终得到VREF=nVG0=0.5VG0。
图2是本申请实例提供的数字修调模块示意图;所述的数字修调模块为可调PMOS管电流镜阵列,实际为所述的带隙基准源主模块的低阶温度补偿电路中运用的可调PMOS管电流镜PTRIM的具体表现形式;
所述的数字修调模块包含PMOS管PTRIM0、PMOS管PTRIM1、PMOS管PTRIM2、PMOS管PTRIM3、PMOS管PTRIM4、PMOS管PTRIM5、PMOS管PTRIM6、PMOS管PTRIM7;PMOS管PTRIM0栅极、PMOS管PTRIM1栅极、PMOS管PTRIM2栅极、PMOS管PTRIM3栅极、PMOS管PTRIM4栅极、PMOS管PTRIM5栅极、PMOS管PTRIM6栅极、PMOS管PTRIM7栅极根据数字编码决定连接至电源或连接至前述偏置电压VBIAS。
由于输入的是二进制数字编码,因此令可调电流镜阵列中八个PMOS管的尺寸比例为PMOS管PTRIM0:PMOS管PTRIM1:PMOS管PTRIM2:PMOS管PTRIM3:PMOS管PTRIM4:PMOS管PTRIM5:PMOS管PTRIM6:PMOS管PTRIM7=1:2:4:8:16:32:64:128。通过输入八位二进制数字编码,控制实际连接入主模块中低阶温度补偿电路的PMOS电流镜尺寸,从而调节流经主模块中低阶温度补偿电路的双极型晶体管Q4的发射极偏置电流,降低工艺偏差对带隙基准源输出电压的影响。
综上所述,本发明在无电阻情况下,利用不同尺寸的双极型晶体管与具有相同温度指数的电流源构建了一种高阶温度补偿方式,有别于传统带隙基准源中利用电阻实现低温度系数基准输出的方式,可以得到较为稳定的低输出基准电压。
本领域技术人员在考虑说明书及实践这里公开的内容后,将容易想到本申请的其它实施方案。本申请旨在涵盖本申请的任何变型、用途或者适应性变化,这些变型、用途或者适应性变化遵循本申请的一般性原理并包括本申请未公开的本技术领域中的公知常识或惯用技术手段。说明书和实施例仅被视为示例性的,本申请的真正范围和精神由权利要求指出。
应当理解的是,本申请并不局限于上面已经描述并在附图中示出的精确结构,并且可以在不脱离其范围进行各种修改和改变。本申请的范围仅由所附的权利要求来限制。
Claims (4)
1.一种低温度系数的无电阻带隙基准源,其特征在于,包括依次相连的启动电路、电流源电路、高阶温度补偿电路和低阶温度补偿电路,所述启动电路使电流源电路避免简并工作点,所述电流源电路为温度补偿电路提供二阶的偏置电流,所述高阶温度补偿电路和低阶温度补偿电路通过电流镜与加权差分对构建的基准电压输出;
其中,所述的启动电路包含PMOS管AP4、PMOS管AP5、NMOS管AN5,电容C1;NMOS管AN5源极、电容C1底端接地;NMOS管AN5漏极、PMOS管AP4漏极连接PMOS管AP5栅极;PMOS管AP5源极、PMOS管AP4源极接电源;NMOS管AN5栅极、PMOS管AP4栅极连至电流源电路中PMOS管AP1栅极;电容C1顶端、PMOS管AP5漏极连至电流源电路中NMOS管AN2漏极;
其中,所述的电流源电路包含PMOS管AP1、PMOS管AP2、PMOS管AP3,NMOS管AN1、NMOS管AN2、NMOS管AN3、NMOS管AN4,双极型晶体管Q1、双极型晶体管Q2;PMOS管AP1源极、PMOS管AP2源极、PMOS管AP3源极接电源;PMOS管AP1栅极、PMOS管AP2栅极、PMOS管AP3栅极、PMOS管AP3漏极接至高阶温度补偿电路中PMOS管BP7栅极,并将此处电压记做偏置电压VBIAS;PMOS管AP1漏极、NMOS管AN1漏极、NMOS管AN1栅极、NMOS管AN2栅极连接NMOS管AN4栅极;NMOS管AN1源极连接NMOS管AN4漏极;NMOS管AN4源极、双极型晶体管Q1发射极接至低阶温度补偿电路中PMOS管CP2栅极;双极型晶体管Q1基极、双极型晶体管Q1集电极、双极型晶体管Q2基极、双极型晶体管Q2集电极接地;双极型晶体管Q2发射极、NMOS管AN2源极接至高阶温度补偿电路中PMOS管BP2栅极;NMOS管AN2漏极、PMOS管AP2漏极连接NMOS管AN3栅极;
其中,所述的高阶温度补偿电路包含PMOS管BP1、PMOS管BP2、PMOS管BP3、PMOS管BP4、PMOS管BP5、PMOS管BP6、PMOS管BP7、PMOS管BP8、PMOS管BP9、PMOS管BP10、NMOS管BN1、NMOS管BN2、NMOS管BN3、NMOS管BN4、双极型晶体管Q3;PMOS管BP7栅极、PMOS管BP8栅极、PMOS管BP9栅极、PMOS管BP10栅极接至低阶温度补偿电路中PMOS管CP5栅极;PMOS管BP7源极、PMOS管BP8源极、PMOS管BP9源极、PMOS管BP10源极接电源;PMOS管BP7漏极、双极型晶体管Q3发射极接至PMOS管BP1栅极;双极型晶体管Q3基极、双极型晶体管Q3集电极、PMOS管BP1漏极、NMOS管BN1源极、NMOS管BN4栅极、NMOS管BN4漏极、PMOS管BP3漏极、NMOS管BN2源极、NMOS管BN3源极接地;PMOS管BP1源极、PMOS管BP2源极连接PMOS管BP8漏极;PMOS管BP2栅极连接PMOS管BP11源极;PMOS管BP2漏极、NMOS管BN1漏极、NMOS管BN1栅极、NMOS管BN2栅极连接NMOS管BN3栅极;PMOS管BP11栅极、PMOS管BP11漏极、NMOS管BN4源极连接PMOS管BP3栅极;PMOS管BP3源极、PMOS管BP4源极连接PMOS管BP9漏极;PMOS管BP4栅极、PMOS管BP4漏连接NMOS管BN2漏极;NMOS管BN3漏极、PMOS管BP6漏极、PMOS管BP6栅极接至低阶温度补偿电路中PMOS管CP3栅极,并将此处电压记做VREF1;PMOS管BP5源极、PMOS管BP6源极连接PMOS管BP10漏极;
其中,所述的低阶温度补偿电路包含PMOS管CP1、PMOS管CP2、PMOS管CP3、PMOS管CP4、PMOS管CP5、PMOS管CP6、NMOS管CN1、NMOS管CN2、双极型晶体管Q4、可调PMOS管电流镜PTRIM;双极型晶体管Q4基极、双极性晶体管Q4集电极、NMOS管CN1源极、NMOS管CN2源极、PMOS管CP2漏极、PMOS管CP3漏极接地;双极型晶体管Q4发射极、PMOS管CP1栅极接至可调PMOS管电流镜PTRIM;PMOS管CP1漏极、NMOS管CN1漏极、NMOS管CN1栅极连接NMOS管CN2栅极;PMOS管CP1源极、PMOS管CP2源极连接PMOS管CP5漏极;PMOS管CP5源极、PMOS管CP6源极、可调PMOS管电流镜PTRIM源极接电源;PMOS管CP5栅极、PMOS管CP6栅极连接可调PMOS管电流镜PTRIM栅极;PMOS管CP3源极、PMOS管CP4源极连接PMOS管CP6漏极;PMOS管CP4漏极、PMOS管CP4栅极连接NMOS管CN2漏极,并以此处电压作为带隙基准源的基准输出电压。
2.根据权利要求1所述的一种低温度系数的无电阻带隙基准源,其特征在于,所述的低阶温度补偿电路对由所述的高阶温度补偿电路得到的VREF1进行低阶温度补偿。
3.根据权利要求1所述的一种低温度系数的无电阻带隙基准源,其特征在于,所述低阶温度补偿电路中运用的可调PMOS管电流镜PTRIM的具体表现形式为数字修调模块,所述的数字修调模块包含PMOS管PTRIM0、PMOS管PTRIM1、PMOS管PTRIM2、PMOS管PTRIM3、PMOS管PTRIM4、PMOS管PTRIM5、PMOS管PTRIM6、PMOS管PTRIM7;PMOS管PTRIM0栅极、PMOS管PTRIM1栅极、PMOS管PTRIM2栅极、PMOS管PTRIM3栅极、PMOS管PTRIM4栅极、PMOS管PTRIM5栅极、PMOS管PTRIM6栅极、PMOS管PTRIM7栅极根据数字编码决定连接至电源或连接至偏置电压VBIAS。
4.根据权利要求3所述的一种低温度系数的无电阻带隙基准源,其特征在于,可调电流镜阵列中八个PMOS管的尺寸比例为PMOS管PTRIM0:PMOS管PTRIM1:PMOS管PTRIM2:PMOS管PTRIM3:PMOS管PTRIM4:PMOS管PTRIM5:PMOS管PTRIM6:PMOS管PTRIM7=1:2:4:8:16:32:64:128。
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