CN114299848A - 显示面板及显示装置 - Google Patents

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Abstract

本发明实施例提供了一种显示面板及显示装置，涉及显示技术领域，用于窄化显示面板的边框宽度。显示面板包括像素驱动电路，像素驱动电路包括发光控制信号端和节点控制信号端；显示面板还包括：发光驱动电路，包括多个级联且沿第一方向排列的发光驱动单元，发光驱动单元的输出端向发光控制信号端传输发光控制信号；栅极驱动电路，包括多个级联且沿第一方向排列的栅极驱动单元，栅极驱动单元的输出端向节点控制信号端传输节点控制信号；发光驱动单元的至少部分输入端和栅极驱动单元的至少部分输入端所输入的信号相同；共用传输信号线，发光驱动单元的至少部分输入端和栅极驱动单元的至少部分输入端与同一条共用传输信号线连接。

Description

显示面板及显示装置
【技术领域】
本发明涉及显示技术领域，尤其涉及一种显示面板及显示装置。
【背景技术】
随着显示技术的发展，窄边框显示屏因其简洁、可视面积大等优点，逐渐受到人们的关注。
目前，显示面板通常包括位于显示区域的多个子像素，以及位于非显示区域的用于驱动子像素点亮的驱动电路。驱动电路一般由多个级联的移位寄存单元和与移位寄存单元电连接的信号线组成。驱动电路所在区域不能够用于显示，导致显示面板的边框区域的面积较大，限制了显示面板的屏占比的提高。
【发明内容】
有鉴于此，本发明实施例提供了一种显示面板及显示装置，用以窄化显示面板的边框宽度。
一方面，本发明实施例提供了一种显示面板，包括像素驱动电路，所述像素驱动电路包括发光控制信号端和节点控制信号端；
所述显示面板还包括：
发光驱动电路，包括多个级联且沿第一方向排列的发光驱动单元，所述发光驱动单元的输出端向所述发光控制信号端传输发光控制信号；
栅极驱动电路，包括多个级联且沿所述第一方向排列的栅极驱动单元，所述栅极驱动单元的输出端向所述节点控制信号端传输节点控制信号；
所述发光驱动单元的至少部分输入端和所述栅极驱动单元的至少部分输入端所输入的信号相同；
共用传输信号线，所述发光驱动单元的至少部分输入端和所述栅极驱动单元的至少部分输入端与同一条所述共用传输信号线连接。
另一方面，本发明实施例提供了一种显示装置，包括如上所述的显示面板。
本发明实施例提供的显示面板及显示装置，通过令发光驱动单元的至少部分输入端和栅极驱动单元的至少部分输入端所输入的信号相同，并在非显示区中设置共用传输信号线，令发光驱动单元的至少部分输入端和栅极驱动单元的至少部分输入端与同一条共用传输信号线连接，在保证发光驱动单元和栅极驱动单元的正常输出的基础上，无需设置多条信号线以分别与发光驱动单元和栅极驱动单元电连接，有利于窄化非显示区的宽度。
【附图说明】
为了更清楚地说明本发明实施例的技术方案，下面将对实施例中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其它的附图。
图1为本发明实施例提供的一种显示面板的示意图；
图2为本发明实施例提供的一种子像素的等效电路图；
图3为图2所示的像素驱动电路的一种工作时序图；
图4为图2所示的像素驱动电路的另一种工作时序示意图；
图5为本发明实施例提供的一种发光驱动电路和栅极驱动电路的电路连接示意图；
图6为本发明实施例提供的一种发光驱动单元的工作时序图；
图7为本发明实施例提供的一种栅极驱动单元的工作时序图；
图8为本发明实施例提供的一种发光驱动单元和栅极驱动单元的简化布线示意图；
图9为本发明实施例提供的一种发光驱动单元的电路示意图；
图10为本发明实施例提供的一种栅极驱动单元的电路示意图；
图11为本发明实施例提供的另一种发光驱动单元和栅极驱动单元的简化布线示意图；
图12为本发明实施例提供的另一种发光驱动单元的电路示意图；
图13为本发明实施例提供的另一种栅极驱动单元的电路示意图；
图14为本发明实施例提供的又一种发光驱动单元和栅极驱动单元的布线示意图；
图15为本发明实施例提供的又一种发光驱动单元和栅极驱动单元的布线示意图；
图16为本发明实施例提供的另一种发光驱动单元和栅极驱动单元的电路示意图；
图17为本发明实施例提供的又一种发光驱动单元和栅极驱动单元的布线示意图；
图18为本发明实施例提供的一种扫描驱动单元的电路示意图；
图19为本发明实施例提供的一种显示装置的示意图。
【具体实施方式】
为了更好的理解本发明的技术方案，下面结合附图对本发明实施例进行详细描述。
应当明确，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其它实施例，都属于本发明保护的范围。
在本发明实施例中使用的术语是仅仅出于描述特定实施例的目的，而非旨在限制本发明。在本发明实施例和所附权利要求书中所使用的单数形式的“一种”、“所述”和“该”也旨在包括多数形式，除非上下文清楚地表示其他含义。
应当理解，本文中使用的术语“和/或”仅仅是一种描述关联对象的关联关系，表示可以存在三种关系，例如，A和/或B，可以表示：单独存在A，同时存在A和B，单独存在B这三种情况。另外，本文中字符“/”，一般表示前后关联对象是一种“或”的关系。
本发明实施例提供了一种显示面板，如图1所示，图1为本发明实施例提供的一种显示面板的示意图，该显示面板包括显示区AA和非显示区NA，显示区AA包括多个子像素1。示例性的，如图2所示，图2为本发明实施例提供的一种子像素的等效电路图，子像素1包括相互电连接的发光单元11和像素驱动电路12。
示例性的，如图2所示，像素驱动电路12包括驱动晶体管M0、节点控制模块121、发光控制模块122、第一节点复位模块123和数据写入模块124。驱动晶体管M0的栅极与第一节点N1电连接，驱动晶体管M0的第一极与第二节点N2电连接，驱动晶体管M0的第二极与第三节点N3电连接。节点控制模块121的一端与第一节点N1电连接，节点控制模块122的另一端与第三节点N3电连接。如图2所示，发光控制模块122包括第一子发光控制模块1221和第二子发光控制模块1222。第一子发光控制模块1221的第一端与电源电压端PVDD电连接，第一子发光控制模块1221的第二端与第二节点N2电连接。第二子发光控制模块1222的第一端与第三节点N3电连接，第二端与发光单元11电连接。第一节点复位模块123的第一端与第一复位信号端Vref1电连接，第二端与第一节点N1电连接。数据写入模块124的第一端与数据信号端Vdata电连接，数据写入模块123的第二段与第二节点N2电连接。
像素驱动电路12还包括发光控制信号端E、节点控制信号端SN、第一扫描信号端S1和第二扫描信号端S2。节点控制模块121响应于节点控制信号端SN所提供的节点控制信号，将第三节点N3和第一节点N1电连接，以控制第一节点N1，即，驱动晶体管M0的栅极的电位。第一子发光控制模块1221和第二子发光控制模块1222响应于发光控制信号端E所提供的发光控制信号，控制驱动电流流过发光单元11。第一节点复位模块123响应于第一扫描信号端S1所提供的第一扫描信号将第一复位信号端Vref1和第一节点N1电连接。数据写入模块124响应于第二扫描信号端S2所提供的第二扫描信号将数据信号端Vdata和第二节点N2电连接。
示例性的，如图2所示，节点控制模块121包括第一晶体管M1和第二晶体管M2；第一晶体管M1的第一极与第三节点N3电连接，第一晶体管M1的第二极与第二晶体管M2的第一极电连接；第二晶体管M2的第二极与驱动晶体管M0的栅极电连接；第一晶体管M1的栅极和第二晶体管M2的栅极均与节点控制信号端SN电连接。
可选的，如图2所示，上述第一子发光控制模块1221包括第三晶体管M3，第二子发光控制模块1222包括第四晶体管M4；第三晶体管M3的第一极与电源信号端PVDD电连接，第三晶体管M3的第二极与驱动晶体管M0的第一极，即第二节点N2电连接，第四晶体管M4的第一极与驱动晶体管M0的第二极，即第三节点N3电连接，第四晶体管M4的第二极与发光单元11的第一电极电连接，第三晶体管M3的栅极和第四晶体管M4的栅极均与发光控制信号端E电连接。发光单元11的第二电极与电源信号端PVEE电连接。
第一节点复位模块123包括第五晶体管M5，第五晶体管M5的栅极与第一扫描信号端S1电连接，第五晶体管M5的第一极与第一复位信号端Vref1电连接，第五晶体管M5的第二极与第二晶体管M2的第一极电连接。数据写入模块124包括第六晶体管M6，第六晶体管M6的栅极与第二扫描信号端S2电连接，第六晶体管M6的第一极与数据信号端Vdata电连接，第六晶体管M6的第二极与第二节点N2电连接。
示例性的，如图2所示，像素驱动电路12还包括发光单元复位晶体管M7和存储电容Cst。发光单元复位晶体管M7的栅极与第二扫描信号端S2电连接，发光单元复位晶体管M7的第一极与第二复位信号端Vref2电连接，发光单元复位晶体管M7的第二极与发光单元11电连接。存储电容Cst的第一极板与电源信号端PVDD电连接，存储电容Cst的第二极板与第一节点N1电连接。
可选的，如图3所示，图3为图2所示的像素驱动电路的一种工作时序图，在该像素驱动电路12工作时，在一个工作周期T内：
在第一时段t1，节点控制信号端SN传输有效电平信号，第一晶体管M1和第二晶体管M2均导通，以保证后续能够对第一节点N1进行有效充电，降低数据信号的延迟的影响。
在第二时段t2，节点控制信号端SN和第一扫描信号端S1均传输有效电平信号，第一晶体管M1、第二晶体管M2和第五晶体管M5均导通，利用第一复位信号端Vref1对第一节点N1进行复位。
在第三时段t3，节点控制信号端SN和第二扫描信号端S2均传输有效电平信号，第一晶体管M1、第二晶体管M2、第六晶体管M6、发光单元复位晶体管M7和驱动晶体管M0均导通，数据信号端Vdata所提供的数据信号通过第六晶体管M6、驱动晶体管M0、第一晶体管M1和第二晶体管M2对第一节点N1进行充电，直至第一节点N1的电位为Vdata-|Vth|完成阈值抓取。其中，Vth为驱动晶体管M0的阈值电压。第二复位信号端Vref2所提供的第二复位信号通过发光单元复位晶体管M7写入发光单元11。
在第四时段t4，节点控制信号端SN继续传输有效电平信号，第一晶体管M1和第二晶体管M2均导通，以确保在第二扫描信号端S2所提供的第二扫描信号出现延迟时，阈值抓取仍能正常进行。
在第五时段t5，发光控制信号端E传输有效电平信号，第三晶体管M3、第四晶体管M4和驱动晶体管M0导通，发光电流流过发光单元11，使发光单元11发光。
在本发明实施例中，发光驱动信号E和节点控制信号SN可以根据显示面板的不同的设计需求以多种不同的方式实现。
例如，为满足用户对于显示产品不同应用场景的显示需求，可使显示面板工作于低频显示模式和高频显示模式。在显示动态画面时，可以使显示面板工作于刷新频率大于等于60Hz高频显示模式，以提升显示面板的显示效果。图3可以为显示面板的刷新频率为60Hz时的一种时序示意图，其中，发光驱动信号E和节点控制信号SN均为脉冲信号，发光驱动信号E的脉宽大于节点控制信号SN的脉宽。
在显示静态画面时，可以使显示面板工作于刷新频率为15Hz或30Hz的低频显示模式，此时可以降低显示面板的功耗。在低频显示模式下，在像素驱动电路的一个驱动周期内，像素驱动电路的工作过程包括写入子阶段和保持子阶段。在写入子阶段，使像素驱动电路12依次执行图3所示的第一时段t1、第二时段t2、第三时段t3、第四时段t4和第五时段t5。在保持子阶段，停止向像素驱动电路12提供数据信号。即，在保持子阶段没有数据写入的过程，通过维持第一节点N1的电位来使发光单元11持续发光。
示例性的，可以在像素驱动电路的一个驱动周期内设置一个或者多个保持子阶段。在保持子阶段，可以控制发光控制信号端E的信号时序与写入子阶段时的时序相同，以使相应的发光单元11持续发光。可选的，本发明实施例可以令一个保持子阶段的时间与一个写入子阶段的时间相同，或者，本发明实施例还可以将写入子阶段划分为多等份，并令一个保持子阶段的时间等于其中一等份的整数倍。
如图4所示，图4为图2所示的像素驱动电路的另一种工作时序示意图，其中，像素驱动电路的刷新频率可以为15Hz，在像素驱动电路的一个驱动周期内，像素驱动电路的工作过程包括写入子阶段T1和保持子阶段T2。
在写入子阶段T1，本发明实施例可以令发光控制信号端E、节点控制信号端SN、第一扫描信号端S1和第二扫描信号端S2的信号均按照图3所示时序进行工作。
在保持子阶段T2，示例性的，如图4所示，本发明实施例可以令发光控制信号端E、第一扫描信号端S1和第二扫描信号端S2的信号时序与写入子阶段T1中的时序相同，使节点控制信号端SN传输令第一晶体管M1和第二晶体管M2截止的信号。如图4所示，发光驱动信号E的频率大于节点控制信号SN的频率。
在低频驱动显示时，第一节点N1的电位需要保持的时间较长。因此，在相关技术中，低频模式下，第一节点N1存在较严重的漏流问题，导致发光单元12的亮度会发生变化，出现闪烁现象。采用本发明实施例的方式，第一复位信号端Vref1通过第五晶体管M5和第二晶体管M2与第一节点N1电连接，在第五晶体管M5和第二晶体管M2截止时，能够有效降低从第一复位信号端Vref1流往第一节点N1的漏电流。而且，在保持子阶段，本发明实施例通过令节点控制信号端SN传输令第一晶体管M1和第二晶体管M2截止的信号，通过控制与第一节点N1电连接的第二晶体管M2截止，也可以减小流往第一节点N1的漏电流，改善低频显示的闪烁问题，提升低频显示效果。
示例性的，上述驱动晶体管M0、第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6和发光单元复位晶体管M7可以采用低温多晶硅工艺进行，以减少工艺所需的掩膜版的数量，简化制程，降低工艺成本。
示例性的，显示面板的非显示区NA包括发光驱动电路和栅极驱动电路。发光驱动电路用于向上述像素驱动电路12的发光控制信号端E提供发光驱动信号。栅极驱动电路用于向上述像素驱动电路12的节点控制信号端SN提供节点控制信号。如图1和图5所示，图5为本发明实施例提供的一种发光驱动电路和栅极驱动电路的电路连接示意图，发光驱动电路2包括多个级联的发光驱动单元20。在本发明实施例中，发光驱动单元20包括输出端OUT1和多个输入端。发光驱动电路2中各级发光驱动单元20的输出端OUT1与相应的像素驱动电路11的发光控制信号端E电连接。示例性的，如图5所示，发光驱动单元20的多个输入端分别包括第一电压信号端VGH1、第二电压信号端VGL2、第一时钟信号端CK1、第二时钟信号端XCK1和移位信号输入端IN1。在本发明实施例中，多个级联的发光驱动单元20表示上一级发光驱动单元20的输出端OUT1与下一级发光驱动单元20的移位信号输入端IN1电连接。发光驱动电路2中的多级发光驱动单元20能够顺次输出发光驱动信号。
本发明实施例可以根据上述像素驱动电路12所需的发光驱动信号来设计发光驱动单元20的电路结构和发光驱动单元20的各个输入端所需接收的信号。
示例性的，在本发明实施例中，第一电平信号端VGH1的信号和第二电平信号端VGL1的信号均为恒定信号，第一电平信号端VGH1的电位大于第二电平信号端VGL1的电位。上述第一时钟信号端CK1和第二时钟信号端XCK1的信号均为脉冲信号，且在其中一个传输有效电平信号时，另一个传输无效电平信号。其中，有效电平指的是能够令相应的晶体管导通的信号，无效电平指的是能够令相应的晶体管截止的信号。如图6所示，图6为本发明实施例提供的一种发光驱动单元的工作时序图，可以看出，在包括第一时钟信号端CK1和第二时钟信号端XCK1等多个输入端的信号的作用下，发光驱动单元能够将移位信号输入端IN1的信号进行移位后通过输出端OUT1输出。
继续参照图5所示，栅极驱动电路3包括多个级联的栅极驱动单元30。在本发明实施例中，栅极驱动单元30包括输出端OUT2和多个输入端。栅极驱动电路3中各级栅极驱动单元30的输出端OUT2与相应的像素驱动电路11的节点控制信号端SN电连接。示例性的，如图5所示，栅极驱动单元30的多个输入端分别包括第一电压信号端VGH2、第二电压信号端VGL2、第一时钟信号端CK2、第二时钟信号端XCK2和移位信号输入端IN2。在本发明实施例中，多个级联的栅极驱动单元30表示上一级栅极驱动单元30的输出端OUT2与下一级栅极驱动单元30的移位信号输入端IN2电连接。栅极驱动电路3中的多级栅极驱动单元30能够顺次输出节点控制信号。
本发明实施例可以根据上述像素驱动电路12所需的节点控制信号来设计栅极驱动单元30的电路结构和栅极驱动单元30的各个输入端所需接收的信号。
示例性的，在本发明实施例中，第一电平信号端VGH2的信号和第二电平信号端VGL2的信号均为恒定信号，第一电平信号端VGH2的电位大于第二电平信号端VGL2的电位。上述第一时钟信号端CK2和第二时钟信号端XCK2的信号均为脉冲信号，且在其中一个传输有效电平信号时，另一个传输无效电平信号。其中，有效电平指的是能够令相应的晶体管导通的信号，无效电平指的是能够令相应的晶体管截止的信号。如图7所示，图7为本发明实施例提供的一种栅极驱动单元的工作时序图，可以看出，在包括第一时钟信号端CK2和第二时钟信号端XCK2等多个输入端的信号的作用下，栅极驱动单元能够将移位信号输入端IN2的信号进行移位后通过输出端OUT2输出。
在本发明实施例中，发光驱动单元20的至少部分输入端所输入的信号和栅极驱动单元30的至少部分输入端所输入的信号相同。
例如，结合图5所示，本发明实施例可以令发光驱动单元20的第一电压信号端VGH1所输入的信号和栅极驱动单元30的第一电压信号端VGH2所输入的信号相同，和/或，令发光驱动单元20的第二电压信号端VGL1所输入的信号和栅极驱动单元30的第二电压信号端VGL2所输入的信号相同。结合图6和图7可以看出，本发明实施例还可以令发光驱动单元20的第一时钟信号端CK1所输入的信号和栅极驱动单元30的第一时钟信号端CK2所输入的信号相同，和/或，令发光驱动单元20的第二时钟信号端XCK1所输入的信号和栅极驱动单元30的第二时钟信号端XCK2所输入的信号相同。
在本发明实施例中，非显示区NA还包括至少一条共用传输信号线。发光驱动单元20的至少部分输入端和栅极驱动单元30的至少部分输入端与同一条共用传输信号线连接。
在本发明实施例中，共用传输信号线包括第一电压信号线VGH、第二电压信号线VGL、第一时钟信号线CK和第二时钟信号线XCK中的任意一者或多者。如图5为在显示面板中设置四条共用传输信号线4，这四条共用传输信号线4分别为第一电压信号线VGH、第二电压信号线VGL、第一时钟信号线CK和第二时钟信号线XCK的一种示意图。第一电压信号线VGH分别与发光驱动单元20的第一电压信号端VGH1和栅极驱动单元30的第一电压信号端VGH2电连接。第二电压信号线VGL分别与发光驱动单元20的第二电压信号端VGL1和栅极驱动单元30的第二电压信号端VGL2电连接。如图5所示，奇数级的发光驱动单元20的第一时钟信号端CK1与第一时钟信号线CK电连接，奇数级的发光驱动单元20的第二时钟信号端XCK1与第二时钟信号线XCK电连接。偶数级的发光驱动单元20的第一时钟信号端CK1与第二时钟信号线XCK电连接，偶数级的发光驱动单元20的第二时钟信号端XCK1与第一时钟信号线CK电连接。奇数级的栅极驱动单元30的第一时钟信号端CK2与第一时钟信号线CK电连接，奇数级的栅极驱动单元30的第二时钟信号端XCK2与第二时钟信号线XCK电连接。偶数级的栅极驱动单元30的第一时钟信号端CK2与第二时钟信号线XCK电连接，偶数级的栅极驱动单元30的第二时钟信号端XCK2与第一时钟信号线CK电连接。
如图5所示，显示面板还包括帧开始发光驱动信号线STV1和帧开始栅极驱动信号线STV2。第一级发光驱动单元20的移位信号输入端IN1与帧开始发光驱动信号线STV1电连接。第一级栅极驱动单元30的移位信号输入端IN2与帧开始栅极驱动信号线STV2电连接。
本发明实施例提供的显示面板，通过在非显示区NA中设置共用传输信号线4，令发光驱动单元20的至少部分输入端和栅极驱动单元30的至少部分输入端与同一条共用传输信号线4连接，在保证发光驱动单元20和栅极驱动单元30的正常输出的基础上，无需设置两条信号线以分别与发光驱动单元20和栅极驱动单元30电连接，有利于窄化非显示区NA的宽度。
示例性的，如图1所示，显示区AA包括多个沿第一方向h1排列的子像素行10，子像素行10包括多个沿第二方向h2排列的子像素1。第二方向h2与上述第一方向h1相互交叉。本发明实施例可以令一级发光驱动单元20和/或一级栅极驱动单元30均与一个子像素行10电连接，或者，本发明实施例也可以令一级发光驱动单元20和/或一级栅极驱动单元30均与两个子像素行10电连接，本发明实施例对此不作限定。
需要说明的是，图1所示的发光驱动电路2和栅极驱动电路3的数量及位置仅为示意，在实际的显示面板的设计中，沿第二方向h2，本发明实施例可以将发光驱动电路2和/或栅极驱动电路3设置在显示区AA的左侧，或者，也可以将发光驱动电路2和/或栅极驱动电路3设置在显示区AA的右侧，或者，也可以将发光驱动电路2和/或栅极驱动电路3设置为双边驱动，即，在显示区AA的左右两侧分别设置一套发光驱动电路2和/或栅极驱动电路3，以对显示区AA进行双边驱动，本发明实施例对此不作限定。
另外，还需要说明的是，上述图3和图4所示的节点控制信号和发光驱动信号的时序，以及图6所示的发光驱动单元的工作时序和图7所示的栅极驱动单元的工作时序仅为一种示意，本发明实施例还可以根据其他的设计需求将节点控制信号、发光驱动信号、发光驱动单元的工作时序以及栅极驱动单元的工作时序设计为其他类型，本发明实施例对此不作限定。
示例性的，在设置上述发光驱动单元20和栅极驱动单元30时，如图8所示，图8为本发明实施例提供的一种发光驱动单元和栅极驱动单元的简化布线示意图，其中以两个发光驱动单元20和两个栅极驱动单元30作为示意，本发明实施例可以令上述多个级联的发光驱动单元20沿第一方向h1排列，以及，令多个级联的栅极驱动单元30沿第一方向h1排列。
示例性的，在设置上述共用传输信号线4时，如图8所示，本发明实施例可以令共用传输信号线4沿第一方向h1延伸，以减小共用传输信号线4和发光驱动电路2中的各级发光驱动单元20的距离，以及，减小共用传输信号线4和栅极驱动电路3中的各级栅极驱动单元30的距离，以便于共用传输信号线4分别与发光驱动单元20和栅极驱动单元30电连接。
示例性的，在共用传输信号线4为多条时，本发明实施例可以令多条共用传输信号线4沿第二方向h2排列。
可选的，如图9所示，图9为本发明实施例提供的一种发光驱动单元的电路示意图，发光驱动单元20包括相互电连接的控制模块201和输出模块202。发光驱动单元20的控制模块201用于向发光驱动单元20的输出模块202提供控制信号，在控制信号的控制下，发光驱动单元20的输出模块202输出发光驱动信号。发光驱动单元20的控制模块201的控制信号输出端与发光驱动单元20的输出模块202电连接，发光驱动单元20的输出模块202与发光驱动单元20的输出端OUT1电连接。
示例性的，如图9所示，发光驱动单元20的控制模块201包括第一电压信号端VGH1、第二电压信号端VGL1、第一时钟信号端CK1、第二时钟信号端XCK1和移位信号输入端IN1。发光驱动单元20的输出模块202也包括上述第一电压信号端VGH1和第二电压信号端VGL1。
可选的，如图10所示，图10为本发明实施例提供的一种栅极驱动单元的电路示意图，栅极驱动单元30包括相互电连接的控制模块301和输出模块302。栅极驱动单元30的控制模块301用于向栅极驱动单元30的输出模块302提供控制信号，在控制信号的控制下，栅极驱动单元30的输出模块302输出节点控制信号。栅极驱动单元30的控制模块301的控制信号输出端与栅极驱动单元30的输出模块302电连接，栅极驱动单元30的输出模块302与栅极驱动单元30的输出端OUT2电连接。
示例性的，如图10所示，栅极驱动单元30的控制模块301包括第一电压信号端VGH2、第二电压信号端VGL2、第一时钟信号端CK2、第二时钟信号端XCK2和移位信号输入端IN2电连接。栅极驱动单元30的输出模块302也包括上述第一电压信号端VGH2和第二电压信号端VGL2。
可选的，如图8所示，本发明实施例可以令发光驱动单元20的输出模块202和发光驱动单元20的控制模块201沿第二方向h2排列，以减小发光驱动单元20在第一方向h1上的长度。
示例性的，如图8所示，本发明实施例也可以令栅极驱动单元30的输出模块302和栅极驱动单元30的控制模块301沿第二方向h2排列，以减小栅极驱动单元30在第一方向h1上的长度。
可选的，本发明实施例可以令发光驱动单元20的输出模块202位于发光驱动单元20的控制模块201远离至少部分共用传输信号线4的一侧。如图8所示，本发明实施例可以令共用传输信号线4包括第一电压信号线VGH、第二电压信号线VGL、第一时钟信号线CK和第二时钟信号线XCK，并令发光驱动单元20的输出模块202位于发光驱动单元20的控制模块201远离第一时钟信号线CK和第二时钟信号线XCK的一侧。结合图9所示，其中，控制模块201包括第一时钟信号端CK和第二时钟信号端XCK，本发明实施例通过令第一时钟信号线CK和第二时钟信号线XCK靠近控制模块201设置，如图8所示，在设置连接控制模块201和第一时钟信号线CK的连接线(未示出)，以及在设置连接控制模块201和第二时钟信号线信号线XCK的连接线(未示出)时，可以减短连接线的长度，有利于降低显示面板的走线复杂度。
类似的，如图8所示，本发明实施例可以令栅极驱动单元30的输出模块302位于栅极驱动单元30的控制模块301远离至少部分共用传输信号线4的一侧。如图8所示为令栅极驱动单元30的输出模块302位于栅极驱动单元30的控制模块301远离第一时钟信号线CK、第二时钟信号线XCK的一侧的示意图。如此设置，在设置连接控制模块301和第一时钟信号线CK的连接线(未示出)，以及在设置连接控制模块301和第二时钟信号线信号线XCK的连接线(未示出)时，可以减短连接线的长度，有利于降低显示面板的走线复杂度。
在设置发光驱动单元和栅极驱动单元时，可选的，如图8所示，本发明实施例可以令上述发光驱动单元20和栅极驱动单元30沿第二方向h2排布，以减小发光驱动单元20和栅极驱动单元30的整体在第一方向h1上所占的长度。
或者，如图11所示，图11为本发明实施例提供的另一种发光驱动单元和栅极驱动单元的简化布线示意图，本发明实施例还可以令发光驱动单元20和栅极驱动单元30沿第一方向h1排列，以减小发光驱动单元20和栅极驱动单元30的整体在第二方向h2的宽度。
如图11所示，本发明实施例可以令发光驱动单元20的输出模块202位于发光驱动单元20的控制模块201远离至少部分共用传输信号线4的一侧，以及，令栅极驱动单元30的输出模块302位于栅极驱动单元30的控制模块301远离至少部分共用传输信号线4的一侧，以减短共用传输信号线4和控制模块301之间的距离，以减短连接共用传输信号线4和控制模块301的连接线(未示出)的长度，降低显示面板的走线复杂度。
示例性的，如图11所示，本发明实施例可以令发光驱动单元20和栅极驱动单元30在第一方向h1上交替排布。
在令发光驱动单元20和栅极驱动单元30沿第二方向h2排布时，可选的，本发明实施例可以令至少部分共用传输信号线4位于发光驱动单元20和栅极驱动单元30之间。如图8所示，其中以第一电压信号线VGH位于发光驱动单元20远离栅极驱动单元30的一侧，第二电压信号线VGL、第一时钟信号线CK和第二时钟信号线XCK位于发光驱动单元20和栅极驱动单元30之间作为示意，如此设置，可以同时缩短第二电压信号线VGL、第一时钟信号线CK和第二时钟信号线XCK与发光驱动单元20和栅极驱动单元30的距离。
在令发光驱动单元20和栅极驱动单元30沿第一方向h1排布时，如图11所示，本发明实施例可以令发光驱动单元20和栅极驱动单元30位于至少部分共用输入信号线4的同一侧。如图11所示为令第一电压信号线VGH、第二电压信号线VGL、第一时钟信号线CK和第二时钟信号线XCK均位于发光驱动单元20和栅极驱动单元30的左侧的示意。
示例性的，如图8和图11所示，本发明实施例可以令第二时钟信号线XCK位于发光驱动单元20远离显示区AA的一侧，令第二电压信号线VGL位于第二时钟信号线XCK远离显示区AA的一侧，令第一时钟信号线CK位于第二电压信号线VGL远离显示区AA的一侧，以及，令第一电压信号线VGH位于第一时钟信号线CK远离显示区AA的一侧。
示例性的，如图9和图10所示，发光驱动单元20的输出模块202包括第一输出晶体管2021和第二输出晶体管2022；发光驱动单元20的第一输出晶体管2021的第一极与发光驱动单元20的输出端OUT1电连接，发光驱动单元20的第二输出晶体管2022的第一极与发光驱动单元20的输出端OUT1电连接。
如图8和图11所示，本发明实施例可以令发光驱动单元20的第一输出晶体管2021和发光驱动单元20的第二输出晶体管2022沿第一方向h1排列，以减小发光驱动单元20的输出模块202在第二方向h2上的宽度。
示例性的，结合图9和图10所示，栅极驱动单元30的输出模块302包括第一输出晶体管3021和第二输出晶体管3022；栅极驱动单元30的第一输出晶体管3021的第一极与栅极驱动单元30的输出端OUT2电连接，栅极驱动单元30的第二输出晶体管3022的第一极与栅极驱动单元30的输出端OUT2电连接。
如图8和图11所示，本发明实施例可以令栅极驱动单元30的第一输出晶体管3021和栅极驱动单元30的第二输出晶体管3022沿第一方向h1排列，以减小发光驱动单元20的输出模块202在第二方向h2上的宽度。
在设置发光驱动单元20的控制模块201时，可选的，如图12所示，图12为本发明实施例提供的另一种发光驱动单元的电路示意图，发光驱动单元20的控制模块201包括第一晶体管M11、第二晶体管M12、第三晶体管M13、第四晶体管M14、第五晶体管M15、第六晶体管M16、第七晶体管M17、第八晶体管M18、第九晶体管M19、第十晶体管M10。其中，第四晶体管M14的栅极和第五晶体管M15的栅极与第一时钟信号端CK1电连接。第四晶体管M14的第一极与移位信号输入端IN1电连接，第四晶体管M14第二极分别与第一晶体管M11的第二极、第二晶体管M12的栅极、第六晶体管M16的栅极和第九晶体管M19的第一极电连接；第一晶体管M11的栅极与第二时钟信号端XCK1电连接；第二晶体管M12的第一极与第一时钟信号端CK1电连接，第二晶体管M12的第二极分别与第八晶体管M18的栅极和第十晶体管M10的第一极电连接；第八晶体管M18的第一极与第一电平信号端VGH1电连接，第八晶体管M18的第二极与第一晶体管M11的第一极电连接，第五晶体管M15的第一极与第二电平信号端VGL1电连接，第九晶体管M19和第十晶体管M10的栅极均与第二电平信号端VGL1电连接，第九晶体管M19的第二极与第二输出晶体管2022的栅极电连接，第十晶体管M10的第二极与第三晶体管M13的栅极电连接，第三晶体管M13的第一极和第七晶体管M17的栅极均与第二时钟信号端XCK1电连接，第三晶体管M13的第二极与第七晶体管M17的第一极电连接，第六晶体管M16的第一极与第一电平信号端VGH1电连接，第六晶体管M16的第二极和第七晶体管M17的第二极均与第一输出晶体管2021的栅极电连接。
如图12所示，本发明实施例可以令发光驱动单元20的第一输出晶体管2021的第二极与第一电平信号端VGH1电连接，令第二输出晶体管2022的第二极与第二电平信号端VGL1电连接。
如图12所示，发光驱动单元20还包括第一电容C11、第二电容C12和第三电容C13，第一电容C11分别与第十晶体管M10的第二极和第七晶体管M17的第一极电连接，第二电容C12分别与第二时钟信号端XCK1和第二输出晶体管2022的栅极电连接，第三电容C13分别与第一电平信号端VGH1和第一输出晶体管2021的栅极电连接。
可选的，本发明实施例可以令发光驱动单元20按照图6所示时序进行工作。
在设置栅极驱动单元30的控制模块时，示例性的，如图13所示，图13为本发明实施例提供的另一种栅极驱动单元的电路示意图，本发明实施例可以令栅极驱动单元的控制模块的电路结构和发光驱动单元的电路结构相同，具体的，栅极驱动单元30的控制模块301包括第一晶体管M21、第二晶体管M22、第三晶体管M23、第四晶体管M24、第五晶体管M25、第六晶体管M26、第七晶体管M27、第八晶体管M28、第九晶体管M29和第十晶体管M20。第四晶体管M24的栅极和第五晶体管M25的栅极与第一时钟信号端CK2电连接。第四晶体管M24的第一极与移位信号输入端IN2电连接，第四晶体管M24第二极分别与第一晶体管M21的第二极、第二晶体管M22的栅极、第六晶体管M26的栅极和第九晶体管M29的第一极电连接；第一晶体管M21的栅极与第二时钟信号端XCK2电连接；第二晶体管M22的第一极与第一时钟信号端CK2电连接，第二晶体管M22的第二极分别与第八晶体管M28的栅极和第十晶体管M20的第一极电连接；第八晶体管M28的第一极与第一电平信号端VGH2电连接，第八晶体管M28的第二极与第一晶体管M21的第一极电连接，第五晶体管M25的第一极与第二电平信号端VGL2电连接，第九晶体管M29和第十晶体管M20的栅极均与第二电平信号端VGL2电连接，第九晶体管M29的第二极与第二输出晶体管3022的栅极电连接，第十晶体管M20的第二极与第三晶体管M23的栅极电连接，第三晶体管M23的第一极和第七晶体管M27的栅极均与第二时钟信号端XCK2电连接，第三晶体管M23的第二极与第七晶体管M27的第一极电连接，第六晶体管M26的第一极与第一电平信号端VGH2电连接，第六晶体管M26的第二极和第七晶体管M27的第二极均与第一输出晶体管3021的栅极电连接。
如图13所示，本发明实施例可以令栅极驱动单元30的第一输出晶体管3021的第二极与第一电平信号端VGH2电连接，令第二输出晶体管3022的第二极与第二电平信号端VGL2电连接。
如图13所示，栅极驱动单元30还包括第一电容C21、第二电容C22和第三电容C23，第一电容C21分别与第十晶体管M20的第二极和第七晶体管M27的第一极电连接，第二电容C22分别与第二时钟信号端XCK2和第二输出晶体管3022的栅极电连接，第三电容C23分别与第一电平信号端VGH2和第一输出晶体管3021的栅极电连接。
可选的，本发明实施例可以令栅极驱动单元30按照图7所示时序进行工作。
示例性的，如图14和图15所示，图14和图15分别为本发明实施例提供的另外两种发光驱动单元和栅极驱动单元的布线示意图，在图14中，发光驱动单元20和栅极驱动单元30沿第二方向h2排布，在图15中，发光驱动单元20和栅极驱动单元30沿第一方向h1排布。
如图14和图15所示，在发光驱动单元20中，第二电容C12与第一输出晶体管2021沿第二方向h2排列，第九晶体管M19位于第二电容C12远离第一输出晶体管2021的一侧；第五晶体管M15位于第九晶体管M19远离第二电容C12的一侧；第四晶体管M14位于第五晶体管M15远离第九晶体管M19的一侧；第二晶体管M12位于第五晶体管M15靠近下一级发光驱动单元20的一侧；第三电容C13与第二输出晶体管2022沿第二方向h2排列，第七晶体管M17位于第三电容C13远离第二输出晶体管2022的一侧；第三晶体管M13位于第七晶体管M17远离第三电容C13的一侧，第一电容C11位于第三晶体管M13远离第七晶体管M17的一侧；第十晶体管M10和第一电容C11沿第一方向h1排列，第六晶体管M16和第八晶体管M18沿第一方向h1排列，且，第六晶体管M16和第八晶体管M18均位于第十晶体管M10靠近第二输出晶体管2022的一侧；第一晶体管M11位于第八晶体管M18靠近第一输出晶体管2021的一侧。
如图14和图15所示，在栅极驱动单元30中，第二电容C22与第一输出晶体管3021沿第二方向h2排列，第九晶体管M29位于第二电容C22远离第一输出晶体管3021的一侧；第五晶体管M25位于第九晶体管M29远离第二电容C22的一侧；第四晶体管M24位于第五晶体管M25远离第九晶体管M29的一侧；第二晶体管M22位于第五晶体管M25靠近下一级栅极驱动单元30的一侧；第三电容C23与第二输出晶体管3022沿第二方向h2排列，第七晶体管M27位于第三电容C23远离第二输出晶体管3022的一侧；第三晶体管M23位于第七晶体管M27远离第三电容C23的一侧，第一电容C21位于第三晶体管M23远离第七晶体管M27的一侧；第十晶体管M20和第一电容C21沿第一方向h1排列，第六晶体管M26和第八晶体管M28沿第一方向h1排列，且，第六晶体管M26和第八晶体管M28均位于第十晶体管M20靠近第二输出晶体管3022的一侧；第一晶体管M21位于第八晶体管M28靠近第一输出晶体管3021的一侧。
可选的，如图12和图13所示，本发明实施例可以令栅极驱动单元20的控制模块201的电路结构和发光驱动单元30的控制模块301的电路结构相同。在此电路结构相同指的是栅极驱动单元20的控制模块201和发光驱动单元30的控制模块301具有同样类型的晶体管，并且二者中晶体管的连接方式也相同。在将二者的电路结构设置为相同时，结合图5所示，本发明实施例可以令第一级发光驱动单元20的移位信号输入端IN1所输入的信号和第一级栅极驱动单元30移位信号输入端IN2所输入的信号相互独立，即，令上述图5所示的帧开始发光驱动信号线STV1和帧开始节点控制信号线STV2相互独立，以实现各级发光驱动单元20和各级栅极驱动单元30输出各个像素驱动电路12工作所需的信号。
或者，在令栅极驱动单元20的控制模块201的电路结构和发光驱动单元30的控制模块301的电路结构相同时，本发明实施例还可以令与第一级发光驱动单元20电连接的帧开始发光驱动信号线STV1和与第一级栅极驱动单元30电连接的帧开始栅极驱动信号线STV2的信号相同。此时，本发明实施例可以令上述发光驱动单元20的控制模块201复用为栅极驱动单元30的控制模块301。如图16所示，图16为本发明实施例提供的另一种发光驱动单元和栅极驱动单元的电路示意图，其中，发光驱动单元20的控制模块201复用为栅极驱动单元30的控制模块301。具体的，结合图12和图13所示，本发明实施例可以令发光驱动单元的第一晶体管M11复用为栅极驱动单元30的第一晶体管M21，在图16中，将发光驱动单元的第一晶体管M11和栅极驱动单元的第一晶体管M21用M1表示，类似的，M2表示上述发光驱动单元的第二晶体管M12和栅极驱动单元的第一晶体管M22，……M9表示上述发光驱动单元的第九晶体管M19和栅极驱动单元的第一晶体管M29，M0表示上述发光驱动单元的第十晶体管M10和栅极驱动单元的第一晶体管M20。
示例性的，如图16所示，发光驱动单元20的第一输出晶体管2021的栅极和栅极驱动单元30的第一输出晶体管3021的栅极均与控制模块201的第一控制信号输出端A电连接，发光驱动单元20的第二输出晶体管2022的栅极和栅极驱动单元30的第二输出晶体管3022的栅极均与控制模块201的第二控制信号输出端B电连接。
在本发明实施例中，发光驱动单元20的第一输出晶体管2021的第二极与栅极驱动单元30的第一输出晶体管3021的第二极所接收的信号不同。发光驱动单元20的第二输出晶体管2022的第二极与栅极驱动单元30的第二输出晶体管3022的第二极所接收的信号不同。示例性的，本发明实施例可以根据像素驱动电路所需的发光驱动信号来设计发光驱动单元20的第一输出晶体管2021的第二极所接收的信号和第二输出晶体管2022的第二极所接收的信号，以及根据像素驱动电路所需的节点控制信号来设计栅极驱动单元30的第一输出晶体管3021的第二极所接收的信号和第二输出晶体管3022的第二极所接收的信号。如图16所示，本发明实施例可以令发光驱动单元20的第一输出晶体管2021的第二极与第一电压信号线VGH电连接，令发光驱动单元20的第二输出晶体管2022的第二极与第二电压信号线VGL电连接，令栅极驱动单元30的第一输出晶体管3021的第二极与第二电压信号线VGL电连接，令栅极驱动单元30的第二输出晶体管3022的第二极与第一电压信号线VGH电连接。
在令发光驱动单元20的控制模块201复用为栅极驱动单元30的控制模块301时，如图16所示，本发明实施例可以令当前级控制模块201的移位信号输入端IN与上一级的发光驱动单元20的输出端OUT1电连接。
可选的，如图17所示，图17为本发明实施例提供的又一种发光驱动单元和栅极驱动单元的布线示意图，其中，发光驱动单元20的控制模块201复用为栅极驱动单元30的控制模块301，在控制模块201中，第二电容C2与发光驱动单元20的第一输出晶体管2021沿第二方向h2排列，第九晶体管M9位于第二电容C2远离第一输出晶体管2021的一侧；第五晶体管M5位于第九晶体管M9远离第二电容C2的一侧；第四晶体管M4位于第五晶体管M5远离第九晶体管M9的一侧；第二晶体管M2位于第五晶体管M5靠近下一级控制单元201的一侧；第三电容C3与发光驱动单元20的第二输出晶体管2022沿第二方向h2排列，第七晶体管M7位于第三电容C3远离第二输出晶体管2022的一侧；第三晶体管M3位于第七晶体管M7远离第三电容C3的一侧，第一电容C1位于第三晶体管M3远离第七晶体管M7的一侧；第十晶体管M0和第一电容C1沿第一方向h1排列，第六晶体管M6和第八晶体管M8沿第一方向h1排列，且，第六晶体管M6和第八晶体管M8均位于第十晶体管M0靠近第二输出晶体管2022的一侧。
本发明实施例通过令发光驱动单元20的控制模块201复用为栅极驱动单元30的控制模块301，可以减少非显示区NA中的晶体管的数量，进一步窄化显示面板的边框宽度。而且，如此设置，本发明实施例还可以令帧开始发光驱动信号线STV1复用为帧开始栅极驱动信号线STV2，能够减少非显示区NA中的信号线的数量。
可选的，在设置栅极驱动单元30的输出模块302和发光驱动单元20的输出模块202时，如图17所示，本发明实施例可以令栅极驱动单元30的输出模块302位于发光驱动单元20的输出模块202远离控制模块201的一侧。
或者，本发明实施例也可以令发光驱动单元20的输出模块202位于栅极驱动单元30的输出模块302远离控制模块201的一侧，在此不再附图示意。
可选的，在令发光驱动单元20的控制模块201复用为栅极驱动单元30的控制模块301时，本发明实施例可以令至少部分共用传输信号线4位于控制模块201远离栅极驱动单元30的输出模块302的一侧；以及，令同样的共用传输信号线4位于控制模块201远离发光驱动单元20的输出模块202的一侧。如图17所示为令第一时钟信号线CK和第二时钟信号线XCK作为共用传输信号线4，令第一时钟信号线CK和第二时钟信号线XCK均位于控制模块201远离栅极驱动单元30的输出模块302的一侧的示意图。
示例性的，如图14、图15和图17所示，本发明实施例可以令栅极驱动单元30的第一输出晶体管3021的沟道的面积大于等于栅极驱动单元30的控制模块301中的任一晶体管的面积；或者，令栅极驱动单元30的第二输出晶体管3022的沟道的面积大于等于栅极驱动单元30的控制模块301中的任一晶体管的面积。
结合图2所示，在本发明实施例中，栅极驱动单元30所提供的节点控制信号用于控制像素驱动电路12中的节点控制模块121的工作，其中节点控制模块121与驱动晶体管M0的栅极电连接，驱动晶体管M0的栅极的电位与发光单元11的亮度相关。本发明实施例通过增大栅极驱动单元30的第一输出晶体管3021或第二输出晶体管3022的沟道的面积，可以减弱栅极驱动单元30所输出的节点控制信号的信号延迟，以此来保证能够对像素驱动电路12中的驱动晶体管M0的栅极的进行充分充电。
可选的，如图14所示，在将发光驱动单元20和栅极驱动单元30沿第二方向h2排列时，本发明实施例可以令发光驱动单元20的控制模块201中的晶体管和栅极驱动单元30中的控制模块301中的晶体管关于第二电压信号线VGL对称。以使布图更加规整紧凑。
示例性的，如图1所示，非显示区NA还包括扫描驱动电路5，扫描驱动电路5包括多个级联且沿第一方向h1排列的扫描驱动单元50。示例性的，如图18所示，图18为本发明实施例提供的一种扫描驱动单元的电路示意图，扫描驱动单元50包括第一晶体管M31、第二晶体管M32、第三晶体管M33、第四晶体管M34、第五晶体管M35、第六晶体管M36、第七晶体管M37、第一电容C31和第二电容C32。第一晶体管M31和第三晶体管M33的栅极均与第一时钟信号端CK3电连接，第一晶体管M31的第一极与移位信号输入端IN3电连接，第一晶体管M31的第二极与第二晶体管M32的栅极、第四晶体管M34的第一极和第六晶体管M36的第一极电连接，第二晶体管M32的第一极与第一时钟信号端CK3电连接，第二晶体管M32的第二极与第五晶体管M35的栅极电连接，第四晶体管M34的栅极与第二时钟信号端XCK3电连接，第四晶体管M34的第二极和第五晶体管M35的第一极电连接，第五晶体管M35的第二极和第一电平信号端VGH3电连接，第三晶体管M33的第一极与第二电平信号端VGL3电连接，第三晶体管M33的第二极与第七晶体管M37的栅极电连接。第七晶体管M37的第一极与第一电平信号端VGH3电连接，第七晶体管M37的第二极与扫描驱动单元50的输出端OUT3电连接。第六晶体管M36的栅极与第二电平信号端VGL3电连接，第六晶体管M36的第二极与第八晶体管M38的栅极电连接，第八晶体管M38的第一极与第二时钟信号端XCK3电连接，第八晶体管M38的第二极与扫描驱动单元50的输出端OUT3电连接。扫描驱动电路中各级扫描驱动单元的输出端OUT3与相应的像素驱动电路11电连接。
在本发明实施例中，多个级联的扫描驱动单元50表示上一级扫描驱动单元50的输出端OUT3与下一级扫描驱动单元的移位信号输入端IN3电连接。非显示区还包括帧开始扫描驱动信号线。在本发明实施例中，第一级扫描驱动单元的移位信号输入端IN3与帧开始扫描驱动信号线电连接。扫描驱动电路中的多级扫描驱动单元能够顺次输出扫描控制信号。
如图2所示，像素驱动电路12包括第一扫描控制端S1和第二扫描控制端S2。示例性的，本发明实施例可以令第i级扫描驱动单元的输出端与第i行像素驱动电路中的第二扫描控制端S2和第i+1行像素驱动电路中的第一扫描控制端S1电连接。
在设置扫描驱动单元50时，如图1所示，本发明实施例可以令扫描驱动单元50位于发光驱动单元20远离栅极驱动单元30的一侧，令显示区AA位于扫描驱动单元50远离栅极驱动单元30的一侧。
或者，本发明实施例也可以令扫描驱动单元50位于栅极驱动单元30远离发光驱动单元20的一侧，令显示区AA位于扫描驱动单元50远离栅极驱动单元30的一侧；在此不再附图示意。
本发明实施例还提供了一种显示装置，如图19所示，图19为本发明实施例提供的一种显示装置的示意图，该显示装置包括上述的显示面板100。其中，显示面板100的具体结构已经在上述实施例中进行了详细说明，此处不再赘述。当然，图19所示的显示装置仅仅为示意说明，该显示装置可以是例如手机、平板计算机、笔记本电脑、电纸书或电视机等任何具有显示功能的电子设备。
以上所述仅为本发明的较佳实施例而已，并不用以限制本发明，凡在本发明的精神和原则之内，所做的任何修改、等同替换、改进等，均应包含在本发明保护的范围之内。

Claims (22)

1.一种显示面板，其特征在于，包括像素驱动电路，所述像素驱动电路包括发光控制信号端和节点控制信号端；
所述显示面板还包括：
发光驱动电路，包括多个级联且沿第一方向排列的发光驱动单元，所述发光驱动单元的输出端向所述发光控制信号端传输发光控制信号；
栅极驱动电路，包括多个级联且沿所述第一方向排列的栅极驱动单元，所述栅极驱动单元的输出端向所述节点控制信号端传输节点控制信号；
所述发光驱动单元的至少部分输入端和所述栅极驱动单元的至少部分输入端所输入的信号相同；
共用传输信号线，所述发光驱动单元的至少部分输入端和所述栅极驱动单元的至少部分输入端与同一条所述共用传输信号线连接。
2.根据权利要求1所述的显示面板，其特征在于，
所述共用传输信号线沿所述第一方向延伸；
所述显示面板包括第一电压信号线、第二电压信号线、第一时钟信号线和第二时钟信号线；
所述共用传输信号线包括所述第一电压信号线、所述第二电压信号线、所述第一时钟信号线、所述第二时钟信号线中的任意一者或多者。
3.根据权利要求1所述的显示面板，其特征在于，
所述发光驱动单元包括控制模块和输出模块，所述发光驱动单元的所述控制模块的控制信号输出端与所述发光驱动单元的所述输出模块电连接，所述发光驱动单元的所述输出模块与所述发光驱动单元的输出端电连接；
所述栅极驱动单元包括控制模块和输出模块，所述栅极驱动单元的所述控制模块的控制信号输出端与所述栅极驱动单元的所述输出模块电连接，所述栅极驱动单元的所述输出模块与所述栅极驱动单元的输出端电连接。
4.根据权利要求3所述的显示面板，其特征在于，
所述发光驱动单元的所述输出模块和所述发光驱动单元的所述控制模块沿第二方向排列；所述第二方向与所述第一方向相互交叉；
所述栅极驱动单元的所述输出模块和所述栅极驱动单元的所述控制模块沿所述第二方向排列。
5.根据权利要求4所述的显示面板，其特征在于，
所述发光驱动单元的所述输出模块位于所述发光驱动单元的所述控制模块远离所述共用传输信号线的一侧；
所述栅极驱动单元的所述输出模块位于所述栅极驱动单元的所述控制模块远离所述共用传输信号线的一侧。
6.根据权利要求4所述的显示面板，其特征在于，
所述发光驱动单元的所述输出模块包括第一输出晶体管和第二输出晶体管；所述发光驱动单元的所述第一输出晶体管的第一极与所述发光驱动单元的输出端电连接，所述发光驱动单元的所述第二输出晶体管的第一极与所述发光驱动单元的输出端电连接；所述发光驱动单元的所述第一输出晶体管和所述发光驱动单元的所述第二输出晶体管沿所述第一方向排列；
所述栅极驱动单元的所述输出模块包括第一输出晶体管和第二输出晶体管；所述栅极驱动单元的所述第一输出晶体管的第一极与所述栅极驱动单元的输出端电连接，所述栅极驱动单元的所述第二输出晶体管的第一极与所述栅极驱动单元的输出端电连接；所述栅极驱动单元的所述第一输出晶体管和所述第二输出晶体管沿所述第一方向排列。
7.根据权利要求6所述的显示面板，其特征在于，
所述栅极驱动单元的所述第一输出晶体管的沟道的面积大于等于所述栅极驱动单元的所述控制模块中的任一晶体管的面积；或者，所述栅极驱动单元的所述第二输出晶体管的沟道的面积大于等于所述栅极驱动单元的所述控制模块中的任一晶体管的面积。
8.根据权利要求1-7所述的显示面板，其特征在于，
所述显示面板还包括帧开始发光驱动信号线和帧开始栅极驱动信号线，所述帧开始发光驱动信号线与第一级所述发光驱动单元的输入端电连接；所述帧开始栅极驱动信号线与第一级所述栅极驱动单元的输入端电连接；
所述帧开始发光驱动信号线和所述帧开始栅极驱动信号线的信号不同。
9.根据权利要求1所述的显示面板，其特征在于，
所述发光驱动单元和所述栅极驱动单元沿所述第二方向排布；
所述共用传输信号线包括第一电压信号线、第二电压信号线、第一时钟信号线和第二时钟信号线；
所述第一电压信号线位于所述发光驱动单元远离所述栅极驱动单元的一侧；
所述第二电压信号线、所述第一时钟信号线和所述第二时钟信号线位于所述发光驱动单元和所述栅极驱动单元之间。
10.根据权利要求9所述的显示面板，其特征在于，
所述发光驱动单元的所述控制模块中的晶体管和所述栅极驱动单元中的所述控制模块中的晶体管关于所述第二电压信号线对称。
11.根据权利要求1所述的显示面板，其特征在于，所述共用传输信号线包括第一电压信号线、第二电压信号线、第一时钟信号线和第二时钟信号线；
所述发光驱动单元和所述栅极驱动单元均位于所述共用输入信号线的同一侧，且，所述发光驱动单元和所述栅极驱动单元沿所述第一方向排列。
12.根据权利要求11所述的显示面板，其特征在于，
所述显示面板包括显示区，所述第二时钟信号线位于所述发光驱动单元远离所述显示区的一侧，所述第二电压信号线位于所述第二时钟信号线远离所述显示区的一侧，所述第一时钟信号线设置在所述第二电压信号线远离所述显示区的一侧，所述第一电压信号线设置在所述第一时钟信号线远离所述显示区的一侧。
13.根据权利要求6所述的显示面板，其特征在于，
所述发光驱动单元的所述控制模块复用为所述栅极驱动单元的所述控制模块；
所述发光驱动单元的所述第一输出晶体管的栅极和所述栅极驱动单元的所述第一输出晶体管的栅极均与所述控制模块的第一控制信号输出端电连接；所述发光驱动单元的所述第一输出晶体管的第二极与所述栅极驱动单元的所述第一输出晶体管的第二极所接收的信号不同；
所述发光驱动单元的所述第二输出晶体管的栅极和所述栅极驱动单元的所述第二输出晶体管的栅极均与所述控制模块的第二控制信号输出端电连接；所述发光驱动单元的所述第二输出晶体管的第二极与所述栅极驱动单元的所述第二输出晶体管的第二极所接收的信号不同。
14.根据权利要求13所述的显示面板，其特征在于，
所述显示面板还包括帧开始发光驱动信号线和帧开始栅极驱动信号线，所述帧开始发光驱动信号线与第一级所述发光驱动单元的输入端电连接；所述帧开始栅极驱动信号线与第一级所述栅极驱动单元的输入端电连接；
所述帧开始发光驱动信号线和所述帧开始栅极驱动信号线的信号相同。
15.根据权利要求13所述的显示面板，其特征在于，
所述栅极驱动单元的输出模块位于所述发光驱动单元的输出模块远离所述控制模块的一侧；
或者，
所述发光驱动单元的输出模块位于所述栅极驱动单元的输出模块远离所述控制模块的一侧。
16.根据权利要求13所述的显示面板，其特征在于，
所述共用传输信号线位于所述控制模块远离所述栅极驱动单元的输出模块的一侧；所述共用传输信号线位于所述控制模块远离所述发光驱动单元的输出模块的一侧。
17.根据权利要求1所述的显示面板，其特征在于，
所述栅极驱动单元的电路和所述发光驱动单元的电路相同。
18.根据权利要求1所述的显示面板，其特征在于，
所述显示面板包括显示区和非显示区；所述显示区包括多个子像素；所述发光驱动电路和所述栅极驱动电路位于所述非显示区；所述非显示区还包括扫描驱动电路，所述扫描驱动电路包括多个级联且沿所述第一方向排列的扫描驱动单元；
所述扫描驱动单元位于所述栅极驱动单元远离所述发光驱动单元的一侧，所述显示区位于所述扫描驱动单元远离所述栅极驱动单元的一侧；
或者，
所述扫描驱动单元位于所述发光驱动单元远离所述栅极驱动单元的一侧，所述显示区位于所述扫描驱动单元远离所述栅极驱动单元的一侧。
19.根据权利要求1所述的显示面板，其特征在于，所述像素驱动电路包括：
驱动晶体管；
节点控制模块，与所述驱动晶体管的栅极电连接，所述节点控制模块响应于所述节点控制信号，以控制所述驱动晶体管的栅极的电位；
发光控制模块，响应于所述发光控制信号，以控制驱动电流流过发光单元。
20.根据权利要求19所述的显示面板，其特征在于，所述节点控制模块包括第一晶体管和第二晶体管；
所述第一晶体管的第一极与第三节点电连接，所述第一晶体管的第二极与第二晶体管的第一极电连接；所述第二晶体管的第二极与所述驱动晶体管的栅极电连接；
所述第一晶体管的栅极和所述第二晶体管的栅极均与所述节点控制信号端电连接。
21.根据权利要求19所述的显示面板，其特征在于，
所述发光控制模块包括第三晶体管和第四晶体管；
所述第三晶体管的第一极与电源信号端电连接，所述第三晶体管的第二极与所述驱动晶体管的第一极电连接，所述第四晶体管的第一极与所述驱动晶体管的第二极电连接，所述第四晶体管的第二极与所述发光单元电连接，所述第三晶体管的栅极和所述第四晶体管的栅极均与所述发光控制信号端电连接。
22.一种显示装置，其特征在于，包括权利要求1-21任一项所述的显示面板。
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