CN114255684B - 移位寄存器单元及驱动方法、栅极驱动电路、显示装置 - Google Patents

移位寄存器单元及驱动方法、栅极驱动电路、显示装置 Download PDF

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Abstract

本发明提供一种移位寄存器单元及驱动方法、栅极驱动电路、显示装置，属于显示技术领域，其可至少部分解决现有的显示装置由于移位寄存器易出现异常而导致良率低的问题。本发明的一种移位寄存器单元，包括：第一移位寄存器、第二移位寄存器和开关控制电路，第一移位寄存器的信号输入端和第二移位寄存器的信号输入端均通过开关控制电路与级联信号输入端耦接；开关控制电路配置为控制第一移位寄存器的信号输入端与级联信号输入端之间的通断，以及控制第二移位寄存器的信号输入端与级联信号输入端之间的通断；第一移位寄存器和第二移位寄存器均配置为在接收到级联信号输入端提供的级联信号后进行工作。

Description

移位寄存器单元及驱动方法、栅极驱动电路、显示装置
技术领域
本发明属于显示技术领域，具体涉及一种移位寄存器单元及驱动方法、栅极驱动电路、显示装置。
背景技术
现有技术的显示装置中至少包括多个级联的移位寄存器，且每个移位寄存器藕接一条栅线，用于给栅线提供驱动信号。
然而，若在该显示装置的制备过程或者使用过程中，若某些移位寄存器出现异常，例如，移位寄存器中的晶体管失效、细走线良率低等，则导致显示装置不能正常显示，从而导致显示装置的良率低。
发明内容
本发明至少部分解决现有的显示装置由于移位寄存器易出现异常而导致良率低的问题，提供一种能够提高显示装置良率的移位寄存器单元。
解决本发明技术问题所采用的技术方案是一种移位寄存器单元，配置有级联信号输入端和驱动信号输出端，所述移位寄存器单元包括：第一移位寄存器、第二移位寄存器和开关控制电路，所述第一移位寄存器的信号输入端和所述第二移位寄存器的信号输入端均通过所述开关控制电路与所述级联信号输入端耦接，所述第一移位寄存器的信号输出端和所述第二移位寄存器的信号输出端均与所述驱动信号输出端耦接；所述开关控制电路配置为控制所述第一移位寄存器的信号输入端与所述级联信号输入端之间的通断，以及控制所述第二移位寄存器的信号输入端与所述级联信号输入端之间的通断；所述第一移位寄存器和所述第二移位寄存器均配置为在接收到所述级联信号输入端提供的级联信号后进行工作。
进一步优选的是，所述开关控制电路包括：第一选通子电路和第二选通子电路；所述第一选通子电路，与第一控制信号端、所述级联信号输入端、所述第一移位寄存器的信号输入端耦接，配置为响应于所述第一控制信号端所提供的第一控制信号的控制，以控制所述第一移位寄存器的信号输入端与所述级联信号输入端之间的通断；所述第二选通子电路，与第二控制信号端、所述级联信号输入端、所述第二移位寄存器的信号输入端耦接，配置为响应于所述第二控制信号端所提供的第二控制信号的控制，以控制所述第二移位寄存器的信号输入端与所述级联信号输入端之间的通断。
进一步优选的是，所述第一选通子电路包括：第一控制晶体管，所述第一控制晶体管的控制极与第一控制信号端耦接，所述第一控制晶体管的第一极与所述第一移位寄存器的信号输入端耦接，所述第一控制晶体管的第二极与所述级联信号输入端耦接；所述第二选通子电路包括：第二控制晶体管，所述第二控制晶体管的控制极与第二控制信号端耦接，所述第二控制晶体管的第一极与所述第二移位寄存器的信号输入端耦接，所述第二控制晶体管的第二极与所述级联信号输入端耦接。
进一步优选的是，所述第一移位寄存器包括：输入子电路、下拉控制子电路、输出子电路和下拉子电路：所述输入子电路，与信号输入端、上拉节点和时钟信号端连接，配置为响应所述第一时钟信号端的控制将所述信号输入端所提供的输入信号写入至所述上拉节点；所述下拉控制子电路，与工作电压端、所述上拉节点、下拉节点和所述第一时钟信号端连接，配置为响应于所述第一时钟信号端的控制将所述工作电压端提供的工作电压写入至所述下拉节点，以及响应于所述上拉节点处电压的控制将所述第一时钟信号端提供的第一时钟信号写入至所述下拉节点；所述输出子电路，与工作电压端、所述上拉节点、所述下拉节点、信号输出端、第二时钟信号端连接，配置为响应于所述上拉节点处电压的控制将所述第二时钟信号端提供的第二时钟信号写入至所述信号输出端，以及响应于所述下拉节点的控制将所述工作电压端提供的工作电压写入至所述信号输出端；所述下拉子电路，与所述工作电压端、所述上拉节点、所述下拉节点、所述第二时钟信号端连接，配置为响应所述下拉节点处电压和所述第二时钟信号端的控制将所述工作电压写入至所述上拉节点。
进一步优选的是，所述第一移位寄存器与所述第二移位寄存器具有相同的电路结构。
进一步优选的是，所述移位寄存器单元中的全部晶体管均为N型晶体管；或者，所述移位寄存器单元中的全部晶体管均为P型晶体管。
解决本发明技术问题所采用的技术方案是一种移位寄存器单元的驱动方法，基于上述的移位寄存器单元，所述方法包括：所述开关控制电路将所述级联信号输入端提供的级联信号写入至所述第一移位寄存器的信号输入端和/或所述第二移位寄存器的信号输入端；所述第一移位寄存器和/或所述第二移位寄存器根据接收到的所述级联信号进行工作。
进一步优选的是，所述开关控制电路将所述级联信号输入端提供的级联信号写入至所述第一移位寄存器的信号输入端和/或所述第二移位寄存器的信号输入端的步骤包括：所述第一选通子电路响应于所述第一控制信号的控制，以控制所述第一移位寄存器的信号输入端与所述级联信号输入端之间导通；和/或，所述第二选通子电路响应于所述第二控制信号的控制，以控制所述第二移位寄存器的信号输入端与所述级联信号输入端之间导通。
解决本发明技术问题所采用的技术方案是一种栅极驱动电路，包括：多个级联的移位寄存器单元，每个所述移位寄存器单元均配置有对应的级联信号输入端和驱动信号输出端，其中至少一个所述移位寄存器单元为上述的移位寄存器单元；除第一级移位寄存器单元外，其他级的移位寄存器单元的所述级联信号输入端与各自上一级移位寄存器单元的驱动信号输出端耦接。
进一步优选的是，所述移位寄存器单元采用权利要求2所述的移位寄存器单元；全部所述移位寄存器单元内的第一选通子电路所耦接的第一控制信号端为同一信号端；全部所述移位寄存器单元内的第二选通子电路所耦接的第二控制信号端为同一信号端。
解决本发明技术问题所采用的技术方案是一种显示装置，包括：上述的栅极驱动电路。
附图说明
附图是用来提供对本发明的进一步理解，并且构成说明书的一部分，与下面的具体实施方式一起用于解释本发明，但并不构成对本发明的限制。在附图中：
图1为本发明的实施例的一种移位寄存器单元的结构示意图；
图2为本发明的实施例的一种移位寄存器单元中的第一移位寄存器的结构示意图；
图3为本发明的实施例的一种移位寄存器单元的驱动方法的流程示意图；
图4为本发明的实施例的一种栅极驱动电路的结构示意图；
图5a和图5b为本发明的实施例的一种栅极驱动电路的时序图；
图6为本发明的实施例的一种栅极驱动电路的驱动方法的流程示意图；
其中，附图标记为：INPUT、级联信号输入端；OUTPUT、驱动信号输出端；GOA1、第一移位寄存器；GOA2、第二移位寄存器；SW1、第一控制信号端；SW2、第二控制信号端；M01、第一控制晶体管；M02、第二控制晶体管；M1、第一晶体管；M2、第二晶体管；M3、第三晶体管；M4、第四晶体管；M5、第五晶体管；M6、第六晶体管；M7、第七晶体管；M8、第八晶体管；1、开关控制电路；2、输入子电路；3、下拉控制子电路；4、输出子电路；5、下拉子电路；CK、第一时钟信号端；CB、第二时钟信号端；STV、信号输入端；G(n)、信号输出端；VL、第一工作电压端；VH、第二工作电压端；N1、上拉节点；N2、下拉节点；C1、第一电容；C2、第二电容。
具体实施方式
为使本领域技术人员更好地理解本发明的技术方案，下面结合附图和具体实施方式对本发明作进一步详细描述。
在相关技术中，为了提高显示显示装置的良率，在显示装置的栅极驱动电路中增加了冗余移位寄存器，具体的，每一个原本的移位寄存器对应一个冗余移位寄存器，这样当原本的移位寄存器出现异常时，可以启动对应的冗余移位寄存器给栅线提供驱动信号，从而保证显示装置正常显示。
然而，在该技术的显示装置中，一般通过激光切割和焊接等方式将冗余移位寄存器替换异常的移位寄存器以修复显示装置的栅极驱动线路，但该修复过程比较复杂且繁琐，并且修复工艺(如激光)有可能会产生碎屑导致线路短路。
为解决相关技术中存在的至少之一的技术问题，本公开技术方案提供了一种移位寄存器单元及驱动方法、栅极驱动电路、显示装置。
实施例1：
如图1至图3所示，本实施例提供一种移位寄存器单元，配置有级联信号输入端INPUT和驱动信号输出端OUTPUT，移位寄存器单元包括：第一移位寄存器GOA1(驱动组)、第二移位寄存器GOA2(冗余组)和开关控制电路1，第一移位寄存器GOA1的信号输入端STV和第二移位寄存器GOA2的信号输入端STV均通过开关控制电路1与级联信号输入端INPUT耦接，第一移位寄存器GOA1的信号输出端G(n)和第二移位寄存器GOA2的信号输出端G(n)均与驱动信号输出端OUTPUT耦接。
开关控制电路1配置为控制第一移位寄存器GOA1的信号输入端STV与级联信号输入端INPUT之间的通断，以及控制第二移位寄存器GOA2的信号输入端STV与级联信号输入端INPUT之间的通断。
第一移位寄存器GOA1和第二移位寄存器GOA2均配置为在接收到级联信号输入端INPUT提供的级联信号后进行工作。
其中，驱动信号输出端OUTPUT连接一条栅线，使得第一移位寄存器GOA1或者第二移位寄存器GOA2向该栅线提供驱动信号。
开关控制电路1用于控制向第一移位寄存器GOA1或者第二移位寄存器GOA2的信号输入端STV输入级联信号，以使第一移位寄存器GOA1或第二移位寄存器GOA2向栅线提供驱动信号。
本实施例的移位寄存器单元包括第一移位寄存器GOA1和第二移位寄存器GOA2，当其中之一出现异常，则可通过开关控制电路1启动另一者开始工作，例如，当第一移位寄存器GOA1出现异常，则可通过开关控制电路1启动第二移位寄存器GOA2开始工作，从而保证栅线可收到驱动信号，从而使得该移位寄存器单元对应的显示装置的显示正常。这种采用开关控制电路1选择控制第一移位寄存器GOA1和第二移位寄存器GOA2输出驱动信号的方式较简便。
优选的，开关控制电路1包括：第一选通子电路和第二选通子电路；第一选通子电路，与第一控制信号端SW1、级联信号输入端INPUT、第一移位寄存器GOA1的信号输入端STV耦接，配置为响应于第一控制信号端SW1所提供的第一控制信号的控制，以控制第一移位寄存器GOA1的信号输入端STV与级联信号输入端INPUT之间的通断；第二选通子电路，与第二控制信号端SW2、级联信号输入端INPUT、第二移位寄存器GOA2的信号输入端STV耦接，配置为响应于第二控制信号端SW2所提供的第二控制信号的控制，以控制第二移位寄存器GOA2的信号输入端STV与级联信号输入端INPUT之间的通断。
其中，开关控制电路1可由两个选通子电路构成，即第一选通子电路和第二选通子电路。
具体的，第一选通子电路包括：第一控制晶体管M01，第一控制晶体管M01的控制极与第一控制信号端SW1耦接，第一控制晶体管M01的第一极与第一移位寄存器GOA1的信号输入端STV耦接，第一控制晶体管M01的第二极与级联信号输入端INPUT耦接；第二选通子电路包括：第二控制晶体管M02，第二控制晶体管M02的控制极与第二控制信号端SW2耦接，第二控制晶体管M02的第一极与第二移位寄存器GOA2的信号输入端STV耦接，第二控制晶体管M02的第二极与级联信号输入端INPUT耦接。
具体的，第一移位寄存器GOA1包括：输入子电路2、下拉控制子电路3、输出子电路4和下拉子电路5。其中，输入子电路2，与信号输入端STV、上拉节点N1和时钟信号端连接，配置为响应第一时钟信号端CK的控制将信号输入端STV所提供的输入信号写入至上拉节点N1。
下拉控制子电路3，与工作电压端、上拉节点N1、下拉节点N2和第一时钟信号端CK连接，配置为响应于第一时钟信号端CK的控制将工作电压端提供的工作电压写入至下拉节点N2，以及响应于上拉节点N1处电压的控制将第一时钟信号端CK提供的第一时钟信号写入至下拉节点N2。
输出子电路4，与工作电压端、上拉节点N1、下拉节点N2、信号输出端G(n)、第二时钟信号端CB连接，配置为响应于上拉节点N1处电压的控制将第二时钟信号端CB提供的第二时钟信号写入至信号输出端G(n)，以及响应于下拉节点N2的控制将工作电压端提供的工作电压写入至信号输出端G(n)。
下拉子电路5，与工作电压端、上拉节点N1、下拉节点N2、第二时钟信号端CB连接，配置为响应下拉节点N2处电压和第二时钟信号端CB的控制将工作电压写入至上拉节点N1。
优选的，第一移位寄存器GOA1与第二移位寄存器GOA2具有相同的电路结构。
其中，也就是说第二移位寄存器GOA2也包括输入子电路2、下拉控制子电路3、输出子电路4和下拉子电路5，各个子电路的结构与第一移位寄存器GOA1中的子电路完全相同。
在一些实施例中，如图2所示，输入子电路2包括第一晶体管M1，下拉控制子电路3包括第二晶体管M2和第三晶体管M3，输出子电路4包括第四晶体管M4和第五晶体管M5，下拉子电路5包括第六晶体管M6和第七晶体管M7。
其中，第一晶体管M1的控制极与第一时钟信号端CK连接，第一晶体管M1的第一极与输入信号端STV连接，第一晶体管M1的第二极与上拉节点N1连接。
第二晶体管M2的控制极与上拉节点N1连接，第二晶体管M2的第一极与下拉节点N2连接，第二晶体管M2的第二极与第一时钟信号端CK连接。
第三晶体管M3的控制极与第一时钟信号端CK连接，第三晶体管M3的第一极与第一工作电压端VL连接，第三晶体管M3的第二极与下拉节点N2连接。
第四晶体管M4的控制极与下拉节点N2连接，第四晶体管M4的第一极与第二工作电压端VH连接，第四晶体管M4的第二极与信号输出端G(n)连接。
第五晶体管M5的控制极与上拉节点N1连接，第五晶体管M5的第一极与信号输出端G(n)连接，第五晶体管M5的第二极与第二时钟信号端CB连接。
第六晶体管M6的控制极与下拉节点N2连接，第六晶体管M6的第一极与第二工作电压端VH连接，第六晶体管M6的第二极与第七晶体管M7的第一极连接。
第七晶体管M7的控制极与第二时钟信号端CB连接，第七晶体管M7的第二极与上拉节点N1连接。
在一些实施例中，输出子电路4还包括第八晶体管M8、第一电容C1和第二电容C2，第五晶体管M5的控制极通过第八晶体管M8与上拉节点N1连接。
其中，第八晶体管M8的控制极与第一工作电压端VL连接，第八晶体管M8的第一极与上拉节点N1连接，第八晶体管M8的第二极与第五晶体管M5的控制极连接。
第一电容C1的第一端与第五晶体管M5的控制极连接，第一电容C1的第二端与信号输出端G(n)连接。
第二电容C2的第一端与下拉节点N2连接，第二电容C2的第二端与第四晶体管M4的第一极连接。
优选的，移位寄存器单元中的全部晶体管均为N型晶体管；或者，移位寄存器单元中的全部晶体管均为P型晶体管。
本实施例还提供一种移位寄存器单元的驱动方法，基于上述的移位寄存器单元，方法包括：
S11、开关控制电路1将级联信号输入端INPUT提供的级联信号写入至第一移位寄存器GOA1的信号输入端STV和/或第二移位寄存器GOA2的信号输入端STV。
进一步的，开关控制电路1将级联信号输入端INPUT提供的级联信号写入至第一移位寄存器GOA1的信号输入端STV和/或第二移位寄存器GOA2的信号输入端STV的步骤包括：
第一选通子电路响应于第一控制信号的控制，以控制第一移位寄存器GOA1的信号输入端STV与级联信号输入端INPUT之间导通；和/或，第二选通子电路响应于第二控制信号的控制，以控制第二移位寄存器GOA2的信号输入端STV与级联信号输入端INPUT之间导通。
S12、第一移位寄存器GOA1和/或第二移位寄存器GOA2根据接收到的级联信号进行工作。
具体的，向第一控制信号端SW1输入导通信号，使得第一控制晶体管M01导通，级联信号输入端INPUT的级联信号经过第一控制晶体管M01写入第一移位寄存器GOA1的信号输入端STV，使得第一移位寄存器GOA1的信号输出端G(n)均输出驱动信号；或者，向第二控制信号端SW2输入导通信号，使得第二控制晶体管M02导通，级联信号输入端INPUT的级联信号经过第二控制晶体管M02写入第二移位寄存器GOA2的信号输入端STV，使得第二移位寄存器GOA2的信号输出端G(n)均输出驱动信号。
需要说明的是，本实施例的驱动方法中不排除第一移位寄存器GOA1和第二移位寄存器GOA2的信号输出端G(n)同时向栅线提供驱动信号。
实施例2：
如图1至图6所示，本实施例提供一种栅极驱动电路，包括：多个级联的移位寄存器单元，每个移位寄存器单元均配置有对应的级联信号输入端INPUT和驱动信号输出端OUTPUT，其中至少一个移位寄存器单元为实施例1中的移位寄存器单元；
除第一级移位寄存器单元外，其他级的移位寄存器单元的级联信号输入端INPUT与各自上一级移位寄存器单元的驱动信号输出端OUTPUT耦接。
进一步的，全部移位寄存器单元内的第一选通子电路所耦接的第一控制信号端SW1为同一信号端；全部移位寄存器单元内的第二选通子电路所耦接的第二控制信号端SW2为同一信号端。
本实施例的移位寄存器单元的驱动方法具体如下：
S21、检测模组检测根据第二时钟信号对应的第二时钟电流是否正常。
其中，具体的检测位置为第一移位寄存器GOA1或第二移位寄存器GOA2中的第五晶体管M5的第二极处的电流。
此处的检测模组可以是显示装置之外的单独的检测模组，也可以是设置于显示装置中的检测模组，如检测芯片等结构。
S221、若第一移位寄存器GOA1的第二时钟电流异常，则根据异常第二时钟电流(Icb)确定异常移位寄存器组件。
在异常移位寄存器组件的工作时段，向级联信号输入端INPUT写入级联信号，向异常移位寄存器组件的第一控制端写入关断信号，向异常移位寄存器组件的第二控制端写入导通信号，以使第二移位寄存器GOA2输出驱动信号。
S222、若第一移位寄存器GOA1的第二时钟电流正常，则向级联信号输入端INPUT写入级联信号，向第一控制端写入导通信号，向第二控制端写入关断信号，以使第一移位寄存器GOA1输出驱动信号。
例如，如图5a和图5b所示，首先，默认第一移位寄存器GOA1能够向栅线输出驱动信号。测试第二时钟电流(Icb)，如在某个时间第二时钟电流出现异常升高或者降低(如图5a中的a部分所示)，则确认异常移位寄存器组件。通过计算得到该异常移位寄存器组件为第n-2级，则把针对第n-2级移位寄存器组件的第一控制信号端SW1、第一控制信号端SW2的信号存入集成电路IC中。在第n-3级移位寄存器组件的驱动信号输出完成时刻，向第一控制信号端SW1输入关断信号，同时向第二控制信号端SW2输入导通信号，使得第n-2级移位寄存器组件的第二移位寄存器GOA2向栅线输入驱动信号。如图5b所示，在第n-2级移位寄存器组件的驱动信号输出完成时刻，向第一控制信号端SW1输入导通信号，同时向第二控制信号端SW2输入关断信号，使得第n-1级移位寄存器组件的第一移位寄存器GOA1向栅线输入驱动信号。以上过程实现了第一移位寄存器GOA1和第二移位寄存器GOA2自动替换过程。
需要说明的是，上述驱动方法可以是在显示装置制备过程中(如背板工序完成后)的检测阶段进行，也可以是在显示装置的使用过程中进行。
实施例3：
本实施例提供一种显示装置，包括：实施例2中的栅极驱动电路。
具体的，该显示装置可为液晶显示面板、电子纸、手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
应当说明的是，在本文中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括一个……”限定的要素，并不排除在包括要素的过程、方法、物品或者设备中还存在另外的相同要素。
依照本发明的实施例如上文所述，这些实施例并没有详尽叙述所有的细节，也不限制该发明仅为所述的具体实施例。显然，根据以上描述，可作很多的修改和变化。本说明书选取并具体描述这些实施例，是为了更好地解释本发明的原理和实际应用，从而使所属技术领域技术人员能很好地利用本发明以及在本发明基础上的修改使用。本发明仅受权利要求书及其全部范围和等效物的限制。

Claims (11)

1.一种移位寄存器单元，其特征在于，配置有级联信号输入端和驱动信号输出端，所述移位寄存器单元包括：第一移位寄存器、第二移位寄存器和开关控制电路，所述第一移位寄存器的信号输入端和所述第二移位寄存器的信号输入端均通过所述开关控制电路与所述级联信号输入端耦接，所述第一移位寄存器的信号输出端和所述第二移位寄存器的信号输出端均与所述驱动信号输出端耦接；
所述开关控制电路配置为控制所述第一移位寄存器的信号输入端与所述级联信号输入端之间的通断，以及控制所述第二移位寄存器的信号输入端与所述级联信号输入端之间的通断；
所述第一移位寄存器和所述第二移位寄存器均配置为在接收到所述级联信号输入端提供的级联信号后进行工作。
2.根据权利要求1所述的移位寄存器单元，其特征在于，所述开关控制电路包括：第一选通子电路和第二选通子电路；
所述第一选通子电路，与第一控制信号端、所述级联信号输入端、所述第一移位寄存器的信号输入端耦接，配置为响应于所述第一控制信号端所提供的第一控制信号的控制，以控制所述第一移位寄存器的信号输入端与所述级联信号输入端之间的通断；
所述第二选通子电路，与第二控制信号端、所述级联信号输入端、所述第二移位寄存器的信号输入端耦接，配置为响应于所述第二控制信号端所提供的第二控制信号的控制，以控制所述第二移位寄存器的信号输入端与所述级联信号输入端之间的通断。
3.根据权利要求2所述的移位寄存器单元，其特征在于，
所述第一选通子电路包括：第一控制晶体管，所述第一控制晶体管的控制极与第一控制信号端耦接，所述第一控制晶体管的第一极与所述第一移位寄存器的信号输入端耦接，所述第一控制晶体管的第二极与所述级联信号输入端耦接；
所述第二选通子电路包括：第二控制晶体管，所述第二控制晶体管的控制极与第二控制信号端耦接，所述第二控制晶体管的第一极与所述第二移位寄存器的信号输入端耦接，所述第二控制晶体管的第二极与所述级联信号输入端耦接。
4.根据权利要求3所述的移位寄存器单元，其特征在于，所述第一移位寄存器包括：输入子电路、下拉控制子电路、输出子电路和下拉子电路：
所述输入子电路，与信号输入端、上拉节点和时钟信号端连接，配置为响应第一时钟信号端的控制将所述信号输入端所提供的输入信号写入至所述上拉节点；
所述下拉控制子电路，与工作电压端、所述上拉节点、下拉节点和所述第一时钟信号端连接，配置为响应于所述第一时钟信号端的控制将所述工作电压端提供的工作电压写入至所述下拉节点，以及响应于所述上拉节点处电压的控制将所述第一时钟信号端提供的第一时钟信号写入至所述下拉节点；
所述输出子电路，与工作电压端、所述上拉节点、所述下拉节点、信号输出端、第二时钟信号端连接，配置为响应于所述上拉节点处电压的控制将所述第二时钟信号端提供的第二时钟信号写入至所述信号输出端，以及响应于所述下拉节点的控制将所述工作电压端提供的工作电压写入至所述信号输出端；
所述下拉子电路，与所述工作电压端、所述上拉节点、所述下拉节点、所述第二时钟信号端连接，配置为响应所述下拉节点处电压和所述第二时钟信号端的控制将所述工作电压写入至所述上拉节点。
5.根据权利要求3所述的移位寄存器单元，其特征在于，所述第一移位寄存器与所述第二移位寄存器具有相同的电路结构。
6.根据权利要求1所述的移位寄存器单元，其特征在于，所述移位寄存器单元中的全部晶体管均为N型晶体管；
或者，所述移位寄存器单元中的全部晶体管均为P型晶体管。
7.一种移位寄存器单元的驱动方法，其特征在于，基于权利要求1至6中任意一项所述的移位寄存器单元，所述方法包括：
所述开关控制电路将所述级联信号输入端提供的级联信号写入至所述第一移位寄存器的信号输入端和/或所述第二移位寄存器的信号输入端；
所述第一移位寄存器和/或所述第二移位寄存器根据接收到的所述级联信号进行工作。
8.根据权利要求7所述的移位寄存器单元的驱动方法，其特征在于，所述移位寄存器单元采用上述权利要求2所述的移位寄存器单元；
所述开关控制电路将所述级联信号输入端提供的级联信号写入至所述第一移位寄存器的信号输入端和/或所述第二移位寄存器的信号输入端的步骤包括：
第一选通子电路响应于第一控制信号的控制，以控制所述第一移位寄存器的信号输入端与所述级联信号输入端之间导通；和/或，第二选通子电路响应于第二控制信号的控制，以控制所述第二移位寄存器的信号输入端与所述级联信号输入端之间导通。
9.一种栅极驱动电路，其特征在于，包括：多个级联的移位寄存器单元，每个所述移位寄存器单元均配置有对应的级联信号输入端和驱动信号输出端，其中至少一个所述移位寄存器单元为权利要求1至6中任意一项所述的移位寄存器单元；
除第一级移位寄存器单元外，其他级的移位寄存器单元的所述级联信号输入端与各自上一级移位寄存器单元的驱动信号输出端耦接。
10.根据权利要求9所述的栅极驱动电路，其特征在于，所述移位寄存器单元采用权利要求2所述的移位寄存器单元；
全部所述移位寄存器单元内的第一选通子电路所耦接的第一控制信号端为同一信号端；
全部所述移位寄存器单元内的第二选通子电路所耦接的第二控制信号端为同一信号端。
11.一种显示装置，其特征在于，包括：权利要求9或10所述的栅极驱动电路。
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